JP4926869B2 - 半導体装置の製造方法 - Google Patents
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Description
先ず、本願において開示される発明の代表的な実施の形態について概要を説明する。
(a)長方形の配線基板の第1の主面上において、長手方向に沿って設けられた第1領域および第2領域であって、それぞれが有する複数の単位デバイス領域の各々に、一つ又は複数の半導体チップをダイ・ボンディングする工程;
(b)前記工程(a)の後、上金型と下金型の間に形成された第1のキャビティ部および第2のキャビティ部に、前記第1領域および前記第2領域のそれぞれが対応するように前記配線基板を前記上金型と下金型の間に収容した状態で、前記第1のキャビティ部および前記第2のキャビティ部の各々に、レジンを注入することにより、前記第1領域および前記第2領域のそれぞれを一括して封止する工程;
(c)前記工程(b)の後、前記配線基板を切断することにより、前記複数の単位デバイス領域を相互に分割する工程、
ここで、前記工程(b)において、前記上金型と前記下金型の間には、以下が形成されている:
(b1)前記配線基板の前記第1の長辺に沿って設けられ、前記第1のキャビティ部と連結された第1のカル部;
(b2)前記配線基板の前記第1の長辺に沿って設けられ、前記第2のキャビティ部と連結された第2のカル部;
(b3)前記第1のキャビティ部と前記第2のキャビティ部とを相互に連結する第1の連結部。
(a)相互に対向する第1および第2の長辺を有する長方形の配線基板の第1の主面上において、長手方向に沿って設けられた第1矩形領域および第2矩形領域であって、それぞれが有する複数の単位デバイス領域の各々に、一つ又は複数の半導体チップをダイ・ボンディングする工程;
(b)前記工程(a)の後、上金型と下金型の間に形成された第1のキャビティ部および第2のキャビティ部に、前記第1矩形領域および前記第2矩形領域のそれぞれが対応するように前記配線基板を前記上金型と下金型の間に収容した状態で、前記第1のキャビティ部および前記第2のキャビティ部の各々に、レジンを注入することにより、前記第1矩形領域および前記第2矩形領域のそれぞれを一括して封止する工程;
(c)前記工程(b)の後、前記配線基板を切断することにより、前記複数の単位デバイス領域を相互に分割する工程、
ここで、前記工程(b)において、前記上金型と前記下金型の間には、以下が形成されている:
(b1)前記配線基板の前記第1の長辺に沿って設けられ、第1のランナー部および第1のゲートにより前記第1のキャビティ部と連結された第1のカル部;
(b2)前記配線基板の前記第1の長辺に沿って設けられ、前記第1のランナー部および第1のゲートと独立して設けられた第2のランナー部および第2のゲートにより前記第2のキャビティ部と連結された第2のカル部;
(b3)前記第1のキャビティ部と前記第2のキャビティ部との対向する一対の近接辺間で、前記第1のキャビティ部と前記第2のキャビティ部とを相互に連結する第1の連結部、
更に、ここで、前記第1の連結部は前記配線基板の前記第1の長辺と前記第2の長辺の中間よりも前記配線基板の前記第1の長辺から遠い位置に設けられている。
1.本願において、実施の態様の記載は、必要に応じて、便宜上複数のセクション等に分けて記載するが、特にそうでない旨明示した場合を除き、これらは相互に独立別個のものではなく、記載の前後を問わず、単一の例の各部分、一方が他方の一部詳細または一部または全部の変形例等である。また、原則として、同様の部分は繰り返しを省略する。また、実施の態様における各構成要素は、特にそうでない旨明示した場合、理論的にその数に限定される場合および文脈から明らかにそうでない場合を除き、必須のものではない。
実施の形態について更に詳述する。各図中において、同一または同様の部分は同一または類似の記号または参照番号で示し、説明は原則として繰り返さない。
1.本実施の形態におけるレジン封止プロセスの概要説明(主に図1から5、および図21参照)
図1に基づいて、本実施の形態におけるレジン封止プロセスの概要を説明する。図1は、本実施の形態におけるレジン封止プロセスにより、マトリクス上に配置された多数のチップ・ボンディング領域8(図21)を一括してレジン封止するため、トランスファー・モールド方式でレジンをキャビティ部34a、34bに充填したときの様子を示す模式上面図である。分かりやすくするために、上金型を取り払っている。
図6および図7に基づいて、本実施の形態におけるレジン封止プロセスに使用する金型の構造を説明する。図6は下金型31の上面図である。中央のキャビティ・ブロック35(上金型との間にキャビティ部を構成する)の一方の長辺に沿って配線基板1の位置合わせようの位置合わせピン36が設けられている。キャビティ・ブロック35の他方の長辺の外部には、この長辺に沿ってレジンタブレットを収容するポット部40aから40dが設けられている。
図8から11に基づいて、セクション2で説明した金型を用いて、セクション1に説明したレジン封止体の形成プロセスを説明する。図8は図1のC−C’断面(図10までこれと同じ)に対応し、金型が開いた状態で、複数のチップ9がダイ・ボンディングされた配線基板1が下金型31の下キャビティブロック35上に収容されたところを示す側断面図である。下基台37上に下金型31が置かれており、下金型31は、下キャビティブロック35の外、ポット・ブロック45を含む。ポット・ブロック45には、ポット部40があり、その中にレジンタブレット38とプランジャー39が収容されている。上金型41の下面にはポット部40に対向してカル部32a、ランナー部33b、およびキャビティ部3aが形成されている。また、これらの下面の表面には離型シート10が張られている。レジンタブレット38はBステージのエポキシ樹脂等の熱硬化性樹脂、硬化剤、触媒、シリカ粉末等の充填剤、シリコーン等の可とう剤、カップリング剤、内部離型剤、難燃剤、および着色剤等の組成物である。MAP方式ではキャビティが広いので、比較的粘性率の低いものが使われる。
図12から17(正面図15および16はそれぞれ側面図12および13にタイミング的に対応している)に基づいて、セクション3で説明したモールド・プロセス後処理、いわゆるゲート・ブレイク工程について説明する。図12に示すように、封止体はモールドからゲート・ブレイク・ステージ83へ移送され、ゲート・ブレイク・ステージ83に置かれる。
図18から21に基づいて、半導体装置の製造プロセス全体の流れを説明する。図19に本実施の形態における半導体装置(最終形態)の一つであるSOCデバイスの構造を示す。また、図20に本実施の形態における半導体装置(最終形態)の他の一つであるSIPデバイスの構造を示す。ここに示したように、SIPデバイスにおいては、長方形のチップが交互に90度回転して積層されている。他に相互の平行移動させて積層する方法もある。また、必ずしも積層する必要はなく、デバイス面積を大きくしてもよい場合は、旧来のMCPデバイスのように、平面的に別の位置にダイ・ボンディングしてもよい。図21に示すように、レジン封止プロセスの封止後処理が完了した配線基板1(封止体)は、第1の主面上に実効的に分離した二つのレジン封止体3aおよび3bを有している。
以上本発明者によってなされた発明を実施形態に基づいて具体的に説明したが、本発明はそれに限定されるものではなく、その要旨を逸脱しない範囲において種々変更可能であることは言うまでもない。
3a 第1領域(第1のキャビティ部)
3b 第2領域(第2のキャビティ部)
5a 第1の連結部
9 半導体チップ
18 単位デバイス領域
31 下金型
32a 第1のカル部
32d 第2のカル部
38 レジン
41 上金型
Claims (18)
- 以下の工程を含む半導体装置の製造方法:
(a)相互に対向する第1および第2の長辺を有する長方形の配線基板の第1の主面上において、長手方向に沿って設けられた第1領域および第2領域であって、それぞれが有する複数の単位デバイス領域の各々に、一つ又は複数の半導体チップをダイ・ボンディングする工程;
(b)前記工程(a)の後、第1の金型と第2の金型の間に形成された第1のキャビティ部および第2のキャビティ部に、前記第1領域および前記第2領域のそれぞれが対応するように前記配線基板を前記第1の金型と第2の金型の間に収容した状態で、前記第1のキャビティ部および前記第2のキャビティ部の各々に、レジンを注入することにより、前記第1領域および前記第2領域のそれぞれを一括して封止する工程;
(c)前記工程(b)の後、前記配線基板を切断することにより、前記複数の単位デバイス領域を相互に分割する工程、
ここで、前記工程(b)において、前記第1の金型と前記第2の金型の間には、以下が形成されている:
(b1)前記配線基板の前記第1の長辺に沿って設けられ、前記第1のキャビティ部と連結された第1のカル部;
(b2)前記配線基板の前記第1の長辺に沿って設けられ、前記第2のキャビティ部と連結された第2のカル部;
(b3)前記第1のキャビティ部と前記第2のキャビティ部とを相互に連結し、かつ突起が設けられた第1の連結部。 - 前記1項の半導体装置の製造方法において、前記第1のキャビティ部および前記第2のキャビティ部のそれぞれには、前記第2の長辺に沿って、複数のエアベント部が設けられている。
- 前記1項の半導体装置の製造方法において、前記突起部は前記第1の連結部のほぼ中央に設けられている。
- 前記1項の半導体装置の製造方法において、前記第1のカル部に対応して設けられた第1のプランジャ、および前記第2のカル部に対応して設けられた第2のプランジャは、共通の支持部材に固定されており、モータにより一括して駆動される。
- 前記1項の半導体装置の製造方法において、前記工程(b)における前記第1の金型と前記第2の金型間の前記第1の金型の表面には離型シートが敷かれている。
- 前記1項の半導体装置の製造方法において、前記配線基板の前記第1のキャビティ部と記第2のキャビティ部の間に対応する位置には、前記第1のキャビティ部と記第2のキャビティ部の一対の近接辺に沿って、スリットが設けられている。
- 前記6項の半導体装置の製造方法において、前記第1の連結部は前記スリットよりも前記配線基板の前記第1の長辺から遠い位置に設けられている。
- 前記1項の半導体装置の製造方法において、前記第1の連結部は前記配線基板の前記第1の長辺と前記第2の長辺の中間よりも前記配線基板の前記第1の長辺から遠い位置に設けられている。
- 前記1項の半導体装置の製造方法において、前記第1の連結部は前記配線基板の前記第2の長辺に近接する位置に設けられている。
- 以下の工程を含む半導体装置の製造方法:
(a)相互に対向する第1および第2の長辺を有する長方形の配線基板の第1の主面上において、長手方向に沿って設けられた第1矩形領域および第2矩形領域であって、それぞれが有する複数の単位デバイス領域の各々に、一つ又は複数の半導体チップをダイ・ボンディングする工程;
(b)前記工程(a)の後、第1の金型と第2の金型の間に形成された第1のキャビティ部および第2のキャビティ部に、前記第1矩形領域および前記第2矩形領域のそれぞれが対応するように前記配線基板を前記第1の金型と第2の金型の間に収容した状態で、前記第1のキャビティ部および前記第2のキャビティ部の各々に、レジンを注入することにより、前記第1矩形領域および前記第2矩形領域のそれぞれを一括して封止する工程;
(c)前記工程(b)の後、前記配線基板を切断することにより、前記複数の単位デバイス領域を相互に分割する工程、
ここで、前記工程(b)において、前記第1の金型と前記第2の金型の間には、以下が形成されている:
(b1)前記配線基板の前記第1の長辺に沿って設けられ、第1のランナー部および第1のゲートにより前記第1のキャビティ部と連結された第1のカル部;
(b2)前記配線基板の前記第1の長辺に沿って設けられ、前記第1のランナー部および第1のゲートと独立して設けられた第2のランナー部および第2のゲートにより前記第2のキャビティ部と連結された第2のカル部;
(b3)前記第1のキャビティ部と前記第2のキャビティ部との対向する一対の近接辺間で、前記第1のキャビティ部と前記第2のキャビティ部とを相互に連結し、かつ突起が設けられた第1の連結部、
更に、ここで、前記第1の連結部は前記配線基板の前記第1の長辺と前記第2の長辺の中間よりも前記配線基板の前記第1の長辺から遠い位置に設けられている。 - 前記10項の半導体装置の製造方法において、前記第1の連結部は前記配線基板の前記第2の長辺に近接する位置に設けられている。
- 前記10項の半導体装置の製造方法において、前記配線基板の前記第1のキャビティ部と記第2のキャビティ部の間に対応する位置には、前記近接辺に沿って、スリットが設けられている。
- 前記12項の半導体装置の製造方法において、前記第1の連結部は前記スリットよりも前記配線基板の前記第1の長辺から遠い位置に設けられている。
- 前記11項の半導体装置の製造方法において、前記工程(b)における前記第1の金型と前記第2の金型間の前記第1の金型の表面には離型シートが敷かれている。
- 前記14項の半導体装置の製造方法において、前記第1のカル部に対応して設けられた第1のプランジャ、および前記第2のカル部に対応して設けられた第2のプランジャは、共通の支持部材に固定されており、モータにより一括して駆動される。
- 前記10項の半導体装置の製造方法において、前記突起部は前記第1の連結部のほぼ中央に設けられている。
- 前記16項の半導体装置の製造方法において、前記第1のキャビティ部および前記第2のキャビティ部のそれぞれには、前記配線基板の前記第2の長辺に沿って、複数のエアベント部が設けられている。
- 前記16項の半導体装置の製造方法において、前記第1のキャビティ部と前記第2のキャビティ部間においては、前記第1の連結部以外の連結部を持たない。
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