JP4012501B2 - フラックスのフラッシング改善のためにハウジング缶とダイとの間の間隔を大きくした高電圧半導体デバイスのハウジング - Google Patents

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Description

本出願は、本明細書によって優先権を主張するMartin Standingによって2001年6月18日に出願された「High Voltage Semiconductor Device Housing With Increased Clearance Between Housing Can and Die for Improved Flux Flushing」という名称の米国特許仮出願第60/299048号明細書に基づき、この仮出願明細書の恩典を主張するものである。
本発明は半導体デバイスに関し、詳細には、デバイスの電圧定格の増大を可能にするフリップチップ型の半導体デバイスに関する。
小型化の推進によって、チップの大きさの、またはほぼチップの大きさの半導体デバイスが開発された。このようなデバイスの一型は、その内部に半導体ダイを収納し、半田や導電性エポキシなどの導電材料層によってダイの電極に接続する缶形(can-shaped)コネクタを含む。この缶形コネクタはダイを取り囲む壁部分を含む。この壁は、ダイの周縁およびその電極からあまり間隔を置かずに配置されている。このようなデバイスを、フラックス入り半田ペーストを使用してボードに半田付けすると、残留したフラックスが、半田付けした接合部の周囲に堆積する。「ノークリーン(no clean)」製品以外の市販のフラックスをこの目的に使用するときには、腐食の形成または電気破壊が起こらないように、この残留フラックスをデバイスの下から洗い流す必要がある。
図1A〜1Bおよび2A〜2Bに周知の半導体デバイスの例を示す。これらの図では、上面のドレイン電極9、ソース電極14および下面のゲート電極(図示せず)を有するMOSFETシリコンダイ10が、導電性金属缶11の中に収容されている。ドレイン電極9は、半田付けや導電性接着剤などによって缶11の内面に固定されている。缶11のリム(rim)12はダイ10の周縁から間隔を置いて配置されている。任意選択で、リム12と缶11の間に絶縁環13を配置することができる。ソース電極14の下面は、リム12のフランジ15の下面と共面とし、またはこれよりもわずかに低くすることができる。このパッケージをボード17上の導電性トレースに半田付けするときには、残留半田フラックスを洗い流さなければならない。缶のリム12とボードの間の狭いすき間16(図2B参照)が、デバイスの下を洗浄媒質が自由に流れることを制限する。したがって、デバイスの下の十分な洗浄を達成することは容易ではない。さらに、ソース電極14とリム12の内面との間の狭い間隔が、残留フラックスの洗浄を妨げ、パッケージに印加できる電圧を引き下げる可能性がある。
したがって、残留フラックスをより容易に洗浄することができ、より高い電圧を印加することができる半導体デバイスが求められている。
本発明によれば、ダイの周縁と金属缶のボディの間のすき間を拡張することができ、その結果、残留フラックスをより容易に除去することができる。
本発明に基づく半導体デバイスは、その内部に半導体ダイを収納する金属缶を含む。この金属缶は、その上面に形成され、半導体ダイの周囲にフレームを生み出す凹みを含む。この凹みは、缶の上部の剛性を増大させ、それによってダイおよびダイ取付け材料に加えられる応力が低減する。缶のリムの高さの増大および形成されたドレインコンタクト間の距離の増大によって、デバイスの下をより効果的に洗浄することができる。その結果、より高い電圧で動作することができるデバイスが得られる。
本発明の他の特徴および効果は、添付の図面に関する本発明の以下の説明から明らかとなろう。
図3を参照すると、本発明に基づく半導体デバイスは金属缶19を含む。金属缶19は銅から形成することが好ましく、銀メッキすることができる。金属缶19はウェブ(web)部分20を含む。ウェブ部分20はその中に形成された凹み21を有する。凹み21は例えばスタンピング(stamping)によって形成することができる。凹み21の代わりに、ダイ10を取り巻く金属缶19の上面のハーフシャー(half shear)を使用することもできる。
次に図4を参照すると、本発明に基づく半導体デバイスは金属缶19を含む。金属缶19は、ウェブ部分20、周壁22およびベース部分23からなる。ダイ10のドレイン9は、例えば半田または導電性エポキシの層によって金属缶19のウェブ部分20に電気的に接続されている。金属缶19のウェブ部分20には、ダイ10の周縁を取り巻くフレーム21aを形成する凹み21が形成されている。任意選択で、フレーム21aとダイ10の周縁との間に絶縁環13を配置することができる。
周壁22は、ダイ10から間隔を置いて配置されており、金属缶19のウェブ部分20の縁から下方へ延びている。ベース部分23は、周壁22の下縁の周りに間隔を置いて配置されており、ダイ10のソース14と共面である。ベース部分23は、ボード17上の導電性部分(図示せず)に電気的に接続することができ、それによってボード17上の導電性部分(図示せず)にドレイン9を電気的に接続することができる。この好ましい実施形態では、ベース部分23が金属缶19の内部から離れるように、したがってダイ10から離れるように延びている。しかし、ベース部分23は、任意の方向に延びるように形成することができる。例えば、ベース部分23を、金属缶19の内部に向かう方向に向けることができ、または、デバイスのフットプリントを低減するためにボード17に向かって垂直に導くこともできる。
ウェブ部分20はさらに、凹み21と周壁22の間に位置するリム部分24を含む。リム部分24を拡張して、ソース電極14と周壁22の間の空間30を大きくすることができる。ソース電極14と周壁22の間の距離を大きくすると、クリーページ(creepage)が改善され、したがってパッケージをより高い電圧で使用できるようになる。さらに、空間30を広げることよって、パッケージをボード17に半田付けする際に生じる残留フラックスのフラッシング(flushing)を改良することができる。リム部分24の拡張による空間の増大が実現できるのは、凹み21(またはハーフシャー)がダイ10の周囲にフレームを生み出し、このフレームが、ウェブ部分20のサイズを単純に増大させることによっては得られない剛性を与えるためである。その結果、ウェブ部分20に形成されたフレームは、以前に知られている缶の剛性を有し、同時に、デバイスの縁の周囲に、残留フラックスのより確実な洗浄を可能にするはるかに大きな間隔を提供する。
その特定の実施形態に関して本発明を説明してきたが、当業者には、他の多くの変形および修正、ならびに他の使用法が明白であろう。したがって、本発明が、本明細書の特定の開示によって限定されず、添付の請求項によってのみ限定されることが好ましい。
従来技術に基づく半導体デバイスの上面図である。 従来技術に基づく半導体デバイスの上面図である。 線2A−2Aに沿って切った図1Aおよび1Bのデバイスを矢印の方向に見た断面図である。 線2B−2Bに沿って切った図1Aおよび1Bのデバイスを矢印の方向に見た断面図である。 本発明に基づく半導体デバイスを示す図である。 線4−4に沿って切った図3に示したデバイスを矢印の方向に見た断面図である。

Claims (9)

  1. 第1の主要表面上の第1の主要電極と、
    前記第1の主要表面の反対側の第2の主要表面上の第2の主要電極と、
    前記第2の主要表面上に配置され前記第2の主要電極から電気的に分離された制御電極と
    を有する半導体ダイと金属缶とを備え、
    前記金属缶は、
    前記第1の主要表面の外側に配置された凹みを有する、前記第1の主要電極に電気的に接続されたウェブ部分と、
    前記ウェブ部分の縁から延びる周壁であって、前記半導体ダイとの間に間隔が存在する周壁と
    を備えることを特徴とする半導体デバイス。
  2. 前記周壁は、前記第2の主要電極と共面の複数のベース部分を含むことを特徴とする請求項1に記載の半導体デバイス。
  3. 前記ベース部分は、前記ダイから離れる方向へ延びていることを特徴とする請求項2に記載の半導体デバイス。
  4. 前記半導体ダイは、MOSFETであることを特徴とする請求項1に記載の半導体デバイス。
  5. 前記第1の主要電極は、導電性エポキシ層によって前記ウェブ部分に電気的に接続されていることを特徴とする請求項1に記載の半導体デバイス。
  6. 前記第1の主要電極は、半田層によって前記ウェブ部分に電気的に接続されていることを特徴とする請求項1に記載の半導体デバイス。
  7. 前記金属缶は、銅でできていることを特徴とする請求項1に記載の半導体デバイス。
  8. 前記金属缶は、銀メッキされていることを特徴とする請求項7に記載の半導体デバイス。
  9. 前記ダイの周縁と前記凹みとの間に広がる絶縁環をさらに備えていることを特徴とする請求項1に記載の半導体デバイス。
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Families Citing this family (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7524701B2 (en) * 2005-04-20 2009-04-28 International Rectifier Corporation Chip-scale package
US7786558B2 (en) * 2005-10-20 2010-08-31 Infineon Technologies Ag Semiconductor component and methods to produce a semiconductor component
US20070215997A1 (en) * 2006-03-17 2007-09-20 Martin Standing Chip-scale package
US7663212B2 (en) 2006-03-21 2010-02-16 Infineon Technologies Ag Electronic component having exposed surfaces
US7541681B2 (en) * 2006-05-04 2009-06-02 Infineon Technologies Ag Interconnection structure, electronic component and method of manufacturing the same
US9536800B2 (en) 2013-12-07 2017-01-03 Fairchild Semiconductor Corporation Packaged semiconductor devices and methods of manufacturing

Family Cites Families (47)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3403438A (en) * 1964-12-02 1968-10-01 Corning Glass Works Process for joining transistor chip to printed circuit
US3871014A (en) * 1969-08-14 1975-03-11 Ibm Flip chip module with non-uniform solder wettable areas on the substrate
US3972062A (en) * 1973-10-04 1976-07-27 Motorola, Inc. Mounting assemblies for a plurality of transistor integrated circuit chips
GB1487945A (en) * 1974-11-20 1977-10-05 Ibm Semiconductor integrated circuit devices
JPS6020943Y2 (ja) * 1979-08-29 1985-06-22 三菱電機株式会社 半導体装置
US4454454A (en) * 1983-05-13 1984-06-12 Motorola, Inc. MOSFET "H" Switch circuit for a DC motor
US4646129A (en) * 1983-09-06 1987-02-24 General Electric Company Hermetic power chip packages
US4604644A (en) * 1985-01-28 1986-08-05 International Business Machines Corporation Solder interconnection structure for joining semiconductor devices to substrates that have improved fatigue life, and process for making
US4839716A (en) * 1987-06-01 1989-06-13 Olin Corporation Semiconductor packaging
JP2984068B2 (ja) * 1991-01-31 1999-11-29 株式会社日立製作所 半導体装置の製造方法
JPH05129516A (ja) 1991-11-01 1993-05-25 Hitachi Ltd 半導体装置
US5311402A (en) * 1992-02-14 1994-05-10 Nec Corporation Semiconductor device package having locating mechanism for properly positioning semiconductor device within package
JP2833326B2 (ja) * 1992-03-03 1998-12-09 松下電器産業株式会社 電子部品実装接続体およびその製造方法
JPH065401A (ja) * 1992-06-23 1994-01-14 Mitsubishi Electric Corp チップ型抵抗素子及び半導体装置
US5583377A (en) * 1992-07-15 1996-12-10 Motorola, Inc. Pad array semiconductor device having a heat sink with die receiving cavity
JPH0637143A (ja) * 1992-07-15 1994-02-10 Toshiba Corp 半導体装置および半導体装置の製造方法
US5394490A (en) * 1992-08-11 1995-02-28 Hitachi, Ltd. Semiconductor device having an optical waveguide interposed in the space between electrode members
US5313366A (en) * 1992-08-12 1994-05-17 International Business Machines Corporation Direct chip attach module (DCAM)
JPH06244231A (ja) * 1993-02-01 1994-09-02 Motorola Inc 気密半導体デバイスおよびその製造方法
US5371404A (en) * 1993-02-04 1994-12-06 Motorola, Inc. Thermally conductive integrated circuit package with radio frequency shielding
JP2795788B2 (ja) * 1993-02-18 1998-09-10 シャープ株式会社 半導体チップの実装方法
US5703405A (en) * 1993-03-15 1997-12-30 Motorola, Inc. Integrated circuit chip formed from processing two opposing surfaces of a wafer
US5510758A (en) * 1993-04-07 1996-04-23 Matsushita Electric Industrial Co., Ltd. Multilayer microstrip wiring board with a semiconductor device mounted thereon via bumps
JP3258764B2 (ja) * 1993-06-01 2002-02-18 三菱電機株式会社 樹脂封止型半導体装置の製造方法ならびに外部引出用電極およびその製造方法
US5397921A (en) * 1993-09-03 1995-03-14 Advanced Semiconductor Assembly Technology Tab grid array
US5455456A (en) * 1993-09-15 1995-10-03 Lsi Logic Corporation Integrated circuit package lid
US5734201A (en) * 1993-11-09 1998-03-31 Motorola, Inc. Low profile semiconductor device with like-sized chip and mounting substrate
US5367435A (en) * 1993-11-16 1994-11-22 International Business Machines Corporation Electronic package structure and method of making same
US5454160A (en) * 1993-12-03 1995-10-03 Ncr Corporation Apparatus and method for stacking integrated circuit devices
JPH07193184A (ja) * 1993-12-27 1995-07-28 Fujitsu Ltd マルチチップモジュールの製造方法及びマルチチップモジュール
US5637922A (en) * 1994-02-07 1997-06-10 General Electric Company Wireless radio frequency power semiconductor devices using high density interconnect
JPH07263618A (ja) 1994-03-24 1995-10-13 Nippondenso Co Ltd 混成集積回路装置
US5578869A (en) * 1994-03-29 1996-11-26 Olin Corporation Components for housing an integrated circuit device
JP3377867B2 (ja) * 1994-08-12 2003-02-17 京セラ株式会社 半導体素子収納用パッケージ
US5886408A (en) * 1994-09-08 1999-03-23 Fujitsu Limited Multi-chip semiconductor device
JP2546192B2 (ja) * 1994-09-30 1996-10-23 日本電気株式会社 フィルムキャリア半導体装置
US5532512A (en) * 1994-10-03 1996-07-02 General Electric Company Direct stacked and flip chip power semiconductor device structures
JP3138159B2 (ja) * 1994-11-22 2001-02-26 シャープ株式会社 半導体装置、半導体装置実装体、及び半導体装置の交換方法
JPH08335653A (ja) * 1995-04-07 1996-12-17 Nitto Denko Corp 半導体装置およびその製法並びに上記半導体装置の製造に用いる半導体装置用テープキャリア
US5655703A (en) * 1995-05-25 1997-08-12 International Business Machines Corporation Solder hierarchy for chip attachment to substrates
US5674785A (en) * 1995-11-27 1997-10-07 Micron Technology, Inc. Method of producing a single piece package for semiconductor die
US5726502A (en) * 1996-04-26 1998-03-10 Motorola, Inc. Bumped semiconductor device with alignment features and method for making the same
US6051888A (en) * 1997-04-07 2000-04-18 Texas Instruments Incorporated Semiconductor package and method for increased thermal dissipation of flip-chip semiconductor package
US6133634A (en) * 1998-08-05 2000-10-17 Fairchild Semiconductor Corporation High performance flip chip package
EP0978871A3 (en) 1998-08-05 2001-12-19 Harris Corporation A low power packaging design
US6624522B2 (en) * 2000-04-04 2003-09-23 International Rectifier Corporation Chip scale surface mounted device and process of manufacture
US6391687B1 (en) * 2000-10-31 2002-05-21 Fairchild Semiconductor Corporation Column ball grid array package

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