JP3558921B2 - テープキャリア並びにテープキャリア型半導体装置の製造方法 - Google Patents
テープキャリア並びにテープキャリア型半導体装置の製造方法 Download PDFInfo
- Publication number
- JP3558921B2 JP3558921B2 JP13452999A JP13452999A JP3558921B2 JP 3558921 B2 JP3558921 B2 JP 3558921B2 JP 13452999 A JP13452999 A JP 13452999A JP 13452999 A JP13452999 A JP 13452999A JP 3558921 B2 JP3558921 B2 JP 3558921B2
- Authority
- JP
- Japan
- Prior art keywords
- tape carrier
- semiconductor device
- wiring pattern
- type semiconductor
- tape
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Images
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L24/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/498—Leads, i.e. metallisations or lead-frames on insulating substrates, e.g. chip carriers
- H01L23/4985—Flexible insulating substrates
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L24/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L24/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/93—Batch processes
- H01L24/95—Batch processes at chip-level, i.e. with connecting carried out on a plurality of singulated devices, i.e. on diced chips
- H01L24/97—Batch processes at chip-level, i.e. with connecting carried out on a plurality of singulated devices, i.e. on diced chips the devices being connected to a common substrate, e.g. interposer, said common substrate being separable into individual assemblies after connecting
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/0011—Working of insulating substrates or insulating layers
- H05K3/0044—Mechanical working of the substrate, e.g. drilling or punching
- H05K3/0052—Depaneling, i.e. dividing a panel into circuit boards; Working of the edges of circuit boards
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/15—Structure, shape, material or disposition of the bump connectors after the connecting process
- H01L2224/16—Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
- H01L2224/161—Disposition
- H01L2224/16151—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/16221—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/16225—Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
- H01L2224/29001—Core members of the layer connector
- H01L2224/29099—Material
- H01L2224/291—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
- H01L2224/29101—Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof the principal constituent melting at a temperature of less than 400°C
- H01L2224/29111—Tin [Sn] as principal constituent
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/28—Structure, shape, material or disposition of the layer connectors prior to the connecting process
- H01L2224/29—Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
- H01L2224/29001—Core members of the layer connector
- H01L2224/29099—Material
- H01L2224/29198—Material with a principal constituent of the material being a combination of two or more materials in the form of a matrix with a filler, i.e. being a hybrid material, e.g. segmented structures, foams
- H01L2224/29298—Fillers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/73—Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
- H01L2224/732—Location after the connecting process
- H01L2224/73201—Location after the connecting process on the same surface
- H01L2224/73203—Bump and layer connectors
- H01L2224/73204—Bump and layer connectors the bump connector being embedded into the layer connector
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/8319—Arrangement of the layer connectors prior to mounting
- H01L2224/83192—Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on another item or body to be connected to the semiconductor or solid-state body
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/80—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
- H01L2224/83—Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
- H01L2224/838—Bonding techniques
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/00014—Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01004—Beryllium [Be]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01005—Boron [B]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01006—Carbon [C]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01015—Phosphorus [P]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01029—Copper [Cu]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01033—Arsenic [As]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/0105—Tin [Sn]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01078—Platinum [Pt]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01079—Gold [Au]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/01—Chemical elements
- H01L2924/01082—Lead [Pb]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/0132—Binary Alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/013—Alloys
- H01L2924/014—Solder alloys
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/06—Polymers
- H01L2924/078—Adhesive characteristics other than chemical
- H01L2924/07802—Adhesive characteristics other than chemical not being an ohmic electrical conductor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/06—Polymers
- H01L2924/078—Adhesive characteristics other than chemical
- H01L2924/0781—Adhesive characteristics other than chemical being an ohmic electrical conductor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/06—Polymers
- H01L2924/078—Adhesive characteristics other than chemical
- H01L2924/0781—Adhesive characteristics other than chemical being an ohmic electrical conductor
- H01L2924/07811—Extrinsic, i.e. with electrical conductive fillers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/10—Details of semiconductor or other solid state devices to be connected
- H01L2924/11—Device type
- H01L2924/12—Passive devices, e.g. 2 terminal devices
- H01L2924/1204—Optical Diode
- H01L2924/12041—LED
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/15—Details of package parts other than the semiconductor or other solid state devices to be connected
- H01L2924/151—Die mounting substrate
- H01L2924/156—Material
- H01L2924/1579—Material with a principal constituent of the material being a polymer, e.g. polyester, phenolic based polymer, epoxy
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
- H01L2924/1901—Structure
- H01L2924/1904—Component type
- H01L2924/19041—Component type being a capacitor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/19—Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
- H01L2924/1901—Structure
- H01L2924/1904—Component type
- H01L2924/19043—Component type being a resistor
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/11—Printed elements for providing electric connections to or between printed circuits
- H05K1/117—Pads along the edge of rigid circuit boards, e.g. for pluggable connectors
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K2203/00—Indexing scheme relating to apparatus or processes for manufacturing printed circuits covered by H05K3/00
- H05K2203/15—Position of the PCB during processing
- H05K2203/1545—Continuous processing, i.e. involving rolls moving a band-like or solid carrier along a continuous production path
Landscapes
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Computer Hardware Design (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Wire Bonding (AREA)
Description
【発明の属する技術分野】
本発明は、フレキシブル配線基板上に半導体素子が接合・搭載されてなるテープキャリア型半導体装置およびその製造方法に関するものである。
【0002】
【従来の技術】
半導体素子を電子回路に実装する技術の一つとして、従来より、フレキシブル配線基板(いわゆる、テープキャリア)上に半導体素子を接合・搭載して、テープキャリア型半導体装置を得るTAB(Tape Automated Bonding)技術が一般に知られている。
【0003】
上記TAB技術によって得られるテープキャリア型半導体装置には、例えば、COF(Chip On FPC(Flexible Printed Circuit)) や、TCP(Tape Carrier Package)がある。上記COFは、テープキャリアにおいて半導体素子電極と接合する部分の配線パターンがテープキャリア材料で裏打ちされている。一方、TCPでは、半導体素子電極との接合部分はテープキャリア材料の半導体素子が搭載される部分に予め貫通穴が設けられており、インナリードと呼ばれる配線パターンが片持ち梁状に突き出した状態で、インナリードの先端部分と半導体素子電極とが接合される。
【0004】
このようなテープキャリア型半導体装置の主な用途としては、液晶ドライバやサーマルヘッドプリンタ等がある。
【0005】
上記テープキャリア型半導体装置は、長尺のテープ(テープキャリア材料)上において、同一の配線パターンをテープ送り方向に対して同一方向かつ同一間隔の配列となるように連続的に形成し、該配線パターンの所定位置に半導体素子を実装した後、該長尺のテープから個片に打ち抜かれることによって完成する。このため、上記テープキャリア上に形成されるテープキャリア型半導体装置は、テープ送り方向に対し同一方向に設計される。完成したテープキャリア型半導体装置は、例えば液晶パネルに用いられる場合等では、該テープキャリア型半導体装置の一方の辺を液晶パネルに、他方の辺をプリント基板等に接続される。
【0006】
また、上記テープキャリア型半導体装置は、フレキシブルであることから折り曲げられた状態で実装されることを前提としていることが多く、その用途に応じて高い自由度で設計される。このため、上記テープキャリア型半導体装置を長尺のテープキャリア上にレイアウト設計する場合、必ずしもテープキャリア面積を有効に利用できるところの長方形形状とはならず、L字形、T字形、三角形等、その他様々な形状となりうる。
【0007】
【発明が解決しようとする課題】
ところが、上述のように、任意形状のテープキャリア型半導体装置を、テープキャリア上において同一方向にレイアウト配置した場合、該テープキャリア上にテープキャリア型半導体装置の形成に使用されない不要な領域が発生する。例えば、図11(a)に示す形状のCOF51をテープキャリア上にレイアウトする場合、従来では、図11(b)に示すようなレイアウトとなる。すなわち、この場合には、該テープキャリアにおいて、不要領域(図中、斜線ハッチングで示す)52が生じる。
【0008】
一方、テープキャリアの製造工程および使用材料においては、該テープキャリアは全て長尺のテープ状態でリールtoリールで製造されるため、その価格はテープ面積に比例する。このため、上記テープキャリア上に、テープキャリア型半導体装置の形成に使用されない領域があっても、その部分にも製造コストはかかっている。したがって、テープキャリア型半導体装置の形成に使用されない領域が大きいほどテープキャリア型半導体装置の製造価格は上昇する。しかしながら、このような不要領域を少なくするために、上記テープキャリア型半導体装置の形状をテープキャリアを有効利用できる形状(例えば、長方形)とすることは、形状設計を自由に行えるというテープキャリア型半導体装置の利点をそこなうことになるため好ましくない。
【0009】
一方、テープキャリア上の使わない領域を極力少なくし、同時に複数個を電気テストする方法として、実開平6−82852号公報には、半導体装置TABをテープキャリアの幅方向に複数列配置する手法が開示されている。しかしながら、上記公報の場合、TABのテープ送り方向に対する向きが全て同一であること、またTABの形状がテープ面積を有効活用できる四角形であることから、上述のようにテープキャリア型半導体装置の形状が任意形状である場合には、テープ面積で無駄な領域が発生しやすいという上記課題の解決には至らない。
【0010】
本発明は、上記の問題点を解決するためになされたもので、その目的は、テープキャリア型半導体装置において、その形状を任意に設計可能であるという利点を損なうことなく、所定長さのテープキャリアにおけるテープキャリア型半導体装置の取れ数を増加させ、その製造コストを下げることにある。
【0011】
【課題を解決するための手段】
請求項1のテープキャリアは、上記の課題を解決するために、長尺のテープキャリア上に半導体素子を接合・搭載してなるテープキャリア型半導体装置に用いられ、該テープキャリア型半導体装置の配線パターンが連続的に形成されてなるテープキャリアにおいて、同一形状の配線パターンが、テープキャリアの利用面積が大きくなるようなレイアウトで、テープキャリアのテープ送り方向に対して複数の方向を有するように配置されていることを特徴としている。
【0012】
請求項5のテープキャリア型半導体装置の製造方法は、上記の課題を解決するために、同一形状の配線パターンが、テープキャリアの利用面積が大きくなるようなレイアウトで、テープキャリアのテープ送り方向に対して複数の方向を有するように配置されているテープキャリアに対して、該テープキャリア上の配線パターンの所定位置に半導体素子を接合・搭載する第1の工程と、上記配線パターン上に上記半導体素子が接合・搭載されてなるテープキャリア型半導体装置を、上記テープキャリアから打ち抜いて個々のテープキャリア型半導体装置とする第2の工程とを有することを特徴としている。
【0013】
上記請求項1および5の構成によれば、同一形状の配線パターンをテープキャリアの利用面積が大きくなるようなレイアウトでテープキャリアのテープ送り方向に対して複数の方向を有するように配置することにより、テープキャリア上に形成される全ての配線パターンを同一方向に配置する従来構成に比べて、該テープキャリア上においてテープキャリア型半導体装置の形成に寄与しない不要領域を減少させることができる。
【0014】
これにより、所定長さのテープキャリアにおいて、従来よりもテープキャリア型半導体装置の取れ数を増加させることができ、テープキャリア型半導体装置の製造価格において大きなコストダウンが得られる。
【0015】
請求項2のテープキャリアは、上記の課題を解決するために、長尺のテープキャリア上に半導体素子を接合・搭載してなるテープキャリア型半導体装置に用いられ、該テープキャリア型半導体装置の配線パターンが連続的に形成されてなるテープキャリアにおいて、形状の異なる複数種類の配線パターンが、テープキャリアの利用面積が大きくなるようなレイアウトで配置されていることを特徴としている。
【0016】
請求項6のテープキャリア型半導体装置の製造方法は、上記の課題を解決するために、形状の異なる複数種類の配線パターンが、テープキャリアの利用面積が大きくなるようなレイアウトで配置されているテープキャリアに対して、該テープキャリア上の配線パターンの所定位置に半導体素子を接合・搭載する第1の工程と、上記配線パターン上に上記半導体素子が接合・搭載されてなるテープキャリア型半導体装置を、上記テープキャリアから打ち抜いて個々のテープキャリア型半導体装置とする第2の工程とを有することを特徴としている。
【0017】
上記請求項2および6の構成によれば、形状の異なる複数種類の配線パターンを同一のテープキャリア上にレイアウトする場合、これら複数種類の配線パターンを適切に組み合わせることによって、テープキャリアの利用面積が大きくなるようなレイアウトで配置することが可能となる。このため、テープキャリア上に同一種類の配線パターンを同一方向に配置する従来構成に比べて、該テープキャリア上においてテープキャリア型半導体装置の形成に寄与しない不要領域を減少させることができる。
【0018】
これにより、所定長さのテープキャリアにおいて、従来よりもテープキャリア型半導体装置の取れ数を増加させることができ、テープキャリア型半導体装置の製造価格において大きなコストダウンが得られる。
【0019】
さらに、複数種類のテープキャリア型半導体装置を作成する場合に、1種類のテープキャリアでこれらのテープキャリア型半導体装置を同時に形成可能となるため、多品種少量生産を行う場合に好適である。
【0020】
尚、ここで、形状の異なる複数種類の配線パターンとは、鏡面対称形状の配線パターンも含むものとする。
【0021】
請求項3のテープキャリアは、請求項1または2の構成に加えて、上記配線パターンが、上記テープキャリアの基体となるテープキャリア材料上に、接着剤を介在して固定されていることを特徴としている。
【0022】
請求項4のテープキャリアは、請求項1または2の構成に加えて、上記配線パターンが、上記テープキャリアの基体となるテープキャリア材料上に、接着剤を介在せずに固定されていることを特徴としている。
【0023】
上記請求項3の構成によれば3層テープのテープキャリアに、また、上記請求項4の構成によれば2層テープのテープキャリアに本発明を適用することができる。
【0024】
請求項7のテープキャリア型半導体装置の製造方法は、請求項5の構成に加えて、上記第1の工程で、上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該配線パターンの向きに応じて回転された後、搭載されることを特徴としている。
【0025】
請求項10のテープキャリア型半導体装置の製造方法は、請求項5の構成に加えて、上記第2の工程で、上記テープキャリア上のテープキャリア型半導体装置は、該配線パターンの向きに応じて回転可能に設けられたパンチング用金型によって打ち抜かれることを特徴としている。
【0026】
すなわち、上記請求項5の構成では、同一形状の配線パターンをテープキャリアのテープ送り方向に対して複数の方向を有するように配置することにより、第1の工程においてこれらの配線パターンに搭載される半導体素子も、該配線パターンの向きに応じて搭載される必要がある。さらに、第2の工程においても、テープキャリア上のテープキャリア型半導体装置は、該配線パターンの向きに応じて打ち抜かれる必要がある。
【0027】
これに対し、上記請求項7の構成によれば、配線パターンの所定位置に搭載される半導体素子は、該配線パターンの向きに応じて回転された後、搭載されるため、上記半導体素子を配線パターンの向きに応じて搭載することが可能となる。
【0028】
また、上記請求項10の構成によれば、テープキャリア型半導体装置は、配線パターンの向きに応じて回転可能に設けられたパンチング用金型によってテープキャリアから打ち抜かれるため、配線パターンの向きに応じた打ち抜きが可能となる。
【0029】
請求項8のテープキャリア型半導体装置の製造方法は、請求項5または6の構成に加えて、上記第1の工程で、上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該テープキャリア上の配線パターンの種類数に対応して設けられたピックアップ機構によって搭載されるものであり、同種類の配線パターンに搭載される半導体素子は、同一のピックアップ機構によって搭載されることを特徴としている。
【0030】
請求項9のテープキャリア型半導体装置の製造方法は、請求項5または6の構成に加えて、上記第1の工程で、上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該テープキャリア上の配線パターンの種類数に対応する回数分だけ、該工程を実行する製造装置に通されることによって搭載されるものであり、同種類の配線パターンに搭載される半導体素子は、上記製造装置の同一通過時に搭載されることを特徴としている。
【0031】
請求項11のテープキャリア型半導体装置の製造方法は、請求項5または6の構成に加えて、上記第2の工程で、上記テープキャリア上のテープキャリア型半導体装置は、上記配線パターンの種類数に対応して設けられたパンチング用金型によってテープキャリアから打ち抜かれるものであり、同種類の配線パターンを有するテープキャリア型半導体装置は、同一のパンチング用金型によって打ち抜かれることを特徴としている。
【0032】
請求項12のテープキャリア型半導体装置の製造方法は、請求項5または6の構成に加えて、上記第2の工程で、上記テープキャリア上のテープキャリア型半導体装置は、上記配線パターンの種類数に対応して設けられたパンチング用金型によって、かつ、上記配線パターンの種類数に対応する回数分だけ、該工程を実行する製造装置に通されることによってテープキャリアから打ち抜かれるものであり、同種類の配線パターンを有するテープキャリア型半導体装置は、上記製造装置の同一通過時に、同一のパンチング用金型によって打ち抜かれることを特徴としている。
【0033】
すなわち、上記請求項5および6の構成では、上記テープキャリア上に複数種類の配線パターンを同時に形成することにより、第1の工程においてこれらの配線パターンに搭載される半導体素子も、該配線パターンの種類に応じて搭載される必要がある。さらに、第2の工程においても、テープキャリア上のテープキャリア型半導体装置は、該配線パターンの種類(形状)に応じて打ち抜かれる必要がある。尚、ここでは、上記請求項5のように同一形状の配線パターンであっても、その配置向きが異なれば別種類のものであるとする。
【0034】
これに対し、上記請求項8の構成によれば、配線パターンの所定位置に搭載される半導体素子は、該テープキャリア上の配線パターンの種類数に対応して設けられたピックアップ機構によって搭載され、同種類の配線パターンに搭載される半導体素子は、同一のピックアップ機構によって搭載される。これにより、上記半導体素子を配線パターンの種類に応じて搭載することが可能となる。
【0035】
また、上記請求項9の構成によれば、配線パターンの所定位置に搭載される半導体素子は、該テープキャリア上の配線パターンの種類数に対応する回数分だけ、該工程を実行する製造装置に通されることによって搭載されるものであり、同種類の配線パターンに搭載される半導体素子は、上記製造装置の同一通過時に搭載される。これにより、上記半導体素子を配線パターンの種類に応じて搭載することが可能となる。
【0036】
さらに、上記請求項11の構成によれば、テープキャリア型半導体装置は、上記配線パターンの種類数に対応して設けられたパンチング用金型によってテープキャリアから打ち抜かれるものであり、同種類の配線パターンを有するテープキャリア型半導体装置は、同一のパンチング用金型によって打ち抜かれる。これにより、上記テープキャリア型半導体装置を配線パターンの種類に応じてテープキャリアから打ち抜くことが可能となる。
【0037】
また、上記請求項12の構成によれば、テープキャリア型半導体装置は、上記配線パターンの種類数に対応して設けられたパンチング用金型によって、かつ、上記配線パターンの種類数に対応する回数分だけ、該工程を実行する製造装置に通されることによってテープキャリアから打ち抜かれ、同種類の配線パターンを有するテープキャリア型半導体装置は、上記製造装置の同一通過時に、同一のパンチング用金型によって打ち抜かれる。これにより、上記テープキャリア型半導体装置を配線パターンの種類に応じてテープキャリアから打ち抜くことが可能となる。
【0038】
請求項13のテープキャリア型半導体装置の製造方法は、請求項5ないし12の何れかの構成に加えて、上記第1の工程で、上記半導体素子と上記テープキャリア上の配線パターンとの接合方式が、Au−Snの合金形成によってなされていることを特徴としている。
【0039】
上記の構成によれば、例えば、金メッキされた半導体素子電極と、錫メッキされた配線パターンとを加熱加圧することにより、Au−Snの合金形成によって上記半導体素子と上記配線パターンとが接合されるため、従来の接合方式を利用することができる。
【0040】
請求項14のテープキャリア型半導体装置の製造方法は、請求項5ないし12の何れかの構成に加えて、上記第1の工程で、上記半導体素子と上記テープキャリア上の配線パターンとが、異方導電性接着剤によって接合されることを特徴としている。
【0041】
上記の構成によれば、上記半導体素子と上記テープキャリア上の配線パターンとを異方導電性接着剤によって接合することにより、該異方導電性接着剤によって端子部分の封止効果も得られる。このため、従来、このような封止効果を得るために使用されていた封止樹脂が不要となり、該封止樹脂の注入工程等を省くことができるため、従来に比べ上記第1の工程を簡略化することができる。
【0042】
【発明の実施の形態】
本発明の実施の一形態について図1ないし図10に基づいて説明すれば、以下の通りである。尚、本発明に係るテープキャリア型半導体装置には、COFやTCP等の種類があり、機能的にはCOFにもTCPにも本発明を適用することにより同様の効果が得られるため、本発明に係るテープキャリア型半導体装置の種類は特に限定されるものではない。但し、一般には、COFの方がTCPに比べて長方形状にならない場合が多くあるので、本発明を活かせる機会はCOFの方が多くあると考えられ、よって、以下の説明ではテープキャリア型半導体装置としてCOFを例示する。尚、COFには明確な定義は無く、テープに搭載された状態のものも、これを打ち抜いた個々のものもCOFと呼ばれている。
【0043】
〔実施例1〕
図1に、本実施例に係るCOF形状と、テープキャリア上でのCOFパターンレイアウトを示す。
【0044】
COF1は、図1(a)に示すような形状をしており、この形状は、図11(a)に示したCOF51と同形状であるとする。上記COF1は、配線パターンが形成されたフレキシブル配線基板上に、半導体素子(図中、黒塗りハッチングで示す)2が接合・搭載されてなる。上記配線パターンは、通常、半導体素子2の電極と接続されるインナリードと、外部回路と接続されるアウタリードとからなるが、上記図1(a)では、インナリードの図示を省略している。
【0045】
上記COF1を本実施例の方法に基づいてテープキャリア上にレイアウト設計する場合、該テープキャリア上で隣接して配置されるCOFパターン1a・1bは、互いに180°回転した向きで配列される。そして、上記テープキャリアから上記COFパターン1a・1bを打ち抜いた後は、同一形状のCOF1が得られる。
【0046】
このように、本実施例では、同一形状の複数のCOF1をテープキャリア上で異なる方向に向けてレイアウトとすることにより、同一方向にレイアウトする従来の構成に比べて、テープキャリアの長さ方向に対してより多くのCOFを搭載することができ、テープ面積の有効活用が図れる。これを、図1(b)と図11(b)との比較により具体的に説明する。
【0047】
図11(b)に示す従来構成では、全てのCOF51を同一方向に配置することにより不要領域52が生じ、所定長さLのテープキャリアにおいてCOF52の取れ数は3個である。これに対し、図1(b)に示す本実施例の構成では、やはり不要領域3が生じているものの、その面積は上記不要領域52に比べ非常に小さく、同じく所定長さLにおいてCOF1の取れ数は4個となる。すなわち、同一長さLのテープキャリアにおいて、従来では3個のCOFしか取れなかったところを、本実施例の構成では4個のCOFが取れることとなり、これは、同一数のCOFを取るためには、本実施例の場合、従来に比べて必要なテープキャリアを長さにして25%削減できることを意味する。これにより、本実施例の構成では、COFの製造価格において大きなコストダウンが得られる。
【0048】
次に、図2において、COF1の断面図を示す。上記COF1は、テープキャリアとして3層テープを使用する場合は、テープキャリア4上の所定位置に半導体素子2を接続し、該テープキャリア4と半導体素子2との間にできる隙間に封止樹脂5を注入した構造である。
【0049】
上記テープキャリア4は、ポリイミド系の絶縁材料(テープキャリア材料)6上に、厚さ5〜15μmの接着剤7を介して銅箔パターン(配線パターン)8が形成されている。上記絶縁材料6の厚さは、75μm(通常のTCPにおける厚さ)、40μm、25μmの何れかであり、該絶縁材料6の厚さを40μmまたは25μmとした場合には、フレキシブルであるというCOFの特徴を生かすうえで好ましい。また、上記半導体素子2の外部引出し電極には、突起電極(通常、バンプと呼ばれる)9が形成されている。上記銅箔パターン8や突起電極9には必要に応じて錫メッキ処理や金メッキ処理が施されており、本実施例では、上記銅箔パターン8が錫メッキされ、上記突起電極9が金メッキされているものとする。
【0050】
上記半導体素子2をテープキャリア4に接続する時には、先ず、半導体素子2の電極形成面がテープキャリア4のパターン面と相対するようにそれぞれを位置合わせし、半導体素子2の電極形成面の反対側の面もしくはテープキャリアのパターン面の反対側の面から、一定時間の加熱・加圧を施すことにより、半導体素子2の突起電極9とテープキャリア4の銅箔パターン8とを接続する。すなわち、本実施例では、上記銅箔パターン8が錫メッキされ、上記突起電極9が金メッキされていることにより、これらのメッキ材料が上記加熱・加圧によって合金化し、Au−Sn合金によって突起電極9と銅箔パターン8とが接続される。
【0051】
上記突起電極9と銅箔パターン8との接続後、テープキャリア4と半導体素子2との間にできる隙間には封止樹脂5が注入されるが、該封止樹脂5の注入は、耐湿性および機械的な強度の向上を図って行われるものである。また、上記テープキャリア4の外部接続端子(すなわちアウタリード)以外の部分は、ソルダーレジストと呼ばれる絶縁性材料が塗布され、導電性異物が直接パターン上に乗りショートすることを防ぐ役目をする。
【0052】
尚、上記図2のCOFでは3層テープからなるテープキャリア4を用いた場合を説明したが、図3に示すような2層テープからなるテープキャリア10を用いても良い。上記テープキャリア10では、接着剤7が用いられず、絶縁材料6の上に銅箔パターン8が直接形成されている。
【0053】
次いで、本実施例に係るCOFの製造過程を図4を参照して説明する。
【0054】
先ず、図4(a)に示すテープキャリア製造工程において、テープキャリア4が製造される。上記テープキャリア4は、パターン設計時において、不要領域3(図1(b)参照)が最も少なくなるように、すなわち所定長さのテープキャリア4上でCOF1の取れ数が最も多くなるようにレイアウト設計される必要がある。但し、上記テープキャリア製造工程自体は従来の工程と何ら変わりなく、ここで工程の増加が生じることはない。
【0055】
次に、図4(b)に示すILB(インナリードボンディング)工程において、上記テープキャリア4の製造工程で形成された配線パターンの所定位置に半導体素子2が接合される。このような半導体素子2の接合は、半導体ウエハから半導体素子2をピックアップして、テープキャリア4上の所定位置に位置合わせした後、インナリードボンダと呼ばれる装置によって加熱加圧することにより半導体素子2とテープキャリア4とを接続することによって行われる。尚、上記ILB工程では、テープキャリア4上に形成される配線パターンが、テープ送り方向に対して異なる方向に配列されていることより、半導体素子2の設置方向も該配線パターンの向きと合わせられなければならない。このため、上記半導体素子2のピックアップ後に、これを任意の角度に回転させる機構を設ければよく、これにより、新たな設備を必要としない。尚、上記ILB工程が、特許請求の範囲に記載の第1の工程に相当する。
【0056】
上記ILB工程後は、樹脂塗布工程および電気検査工程に続いて、図4(c)に示すパンチング工程において、上記テープキャリア4上に連続的に形成されたCOF1が、パンチングによって個々のCOF1に打ち抜かれる。上記パンチング工程はパンチング用金型を用いて行われるが、該パンチング工程においても、COF1を打ち抜く向きと配線パターンの向きとを合わせる必要がある。このため、上記パンチング用金型を任意の角度に回転させる機構を設ければよい。尚、上記パンチング工程が、特許請求の範囲に記載の第2の工程に相当する。
【0057】
こうして、完成したCOF1は、OLB(アウタリードボンディング)工程において、外部接続端子(アウタリード)と他の回路基板とを接続することによりモジュールの構成をなす。例えば、上記COF1を液晶表示装置の駆動ドライバとして用いるのであれば、液晶パネル等と接続されて液晶モジュールを構成する。また、テープキャリア4上に、抵抗、コンデンサ、LED(Liquid Crystal Display)等、他のチップ部品を搭載することも可能であり、これにより、上記テープキャリア4が回路基板を兼用するモジュール構成とすることができ、該モジュールにおいてさらなる空間の有効利用ができる。
【0058】
また、上記図4に示したCOFの製造方法では、IBL工程およびパンチング工程において、半導体素子2の設置方向およびCOF1を打ち抜く向きを配線パターンの向きとを合わせるために、半導体素子2のピックアップ機構およびパンチング用金型を回転させる方法を説明したが、これとは別のCOFの製造方法を図5および図6を参照して説明する。
【0059】
先ず、図5(a)におけるテープキャリア製造工程は、図4(a)の工程と同一である。
【0060】
図5(b)および図5(c)に示すILB工程では、半導体ウエハから半導体素子2をピックアップして、テープキャリア4上の所定位置に位置合わせする際に、複数のピックアップ機構を用いることによって、同一のテープキャリア4上に数種類の半導体素子を順番に搭載する。本実施例の構成では、テープキャリア4上に配置方向が互いに異なる2種類のCOF1a・1bが形成されるため、上記ピックアップ機構も2つ必要となる。尚、上記COF1a・1bは、テープキャリア4から打ち抜かれた後は同一のCOFとなるが、ここでは、テープキャリア上での配置方向が異なるだけのCOFも別種類であるとする。
【0061】
そして、図5(b)に示すように、一方のピックアップ機構によって、COF1aとなる配線パターン上に半導体素子2aが搭載され、次いで、図5(c)に示すように、他方のピックアップ機構によってCOF1bとなる配線パターン上に半導体素子2bが搭載される。上記半導体素子2a・2bの搭載後、インナリードボンダによって加熱加圧することにより半導体素子2とテープキャリア4とが接続されることは、図4(b)の工程と同様である。尚、上記テープキャリア4上のレイアウトにおいて、隣接するCOF1a・1bの位置関係は常に一定である。すなわち、上記テープキャリア上で、COF1a(またはCOF1b)のみに注目すれば、その配置向きおよび配置間隔は一定であるため、一つのピックアップ機構を用いてCOF1aに対して半導体素子2aを搭載することには格別の困難は生じない。
【0062】
さらに、上記ILB工程において、従来の設備を全く変えないで該ILB工程を行うことも可能である。すなわち、上記ピックアップ機構およびインナリードボンダからなるボンディング装置に対し、上記テープキャリア4を複数回通すことによって同一のテープキャリア4上に数種類の半導体素子を搭載する。本実施例の場合では、上記図5(b)の工程を1回目の通しにおいて行い、図5(c)の工程を2回目の通しにおいて行えばよい。
【0063】
上記ILB工程後には、樹脂塗布工程および電気検査工程が行われる。続いて、図6(a)および図6(b)に示すパンチング工程では、上記ILB工程と同様に、2種類のパンチング用金型を用い、2台のパンチング装置にテープキャリア4を通すか、若しくは、1台のパンチング装置にテープキャリア4を2回通すことによって、同一のテープキャリア4から2種類のCOF1を打ち抜くことができる。すなわち、図6(a)に示すように、1台目(若しくは1回目)のパンチング装置によってCOF1aを打ち抜き、2台目(若しくは2回目)のパンチング装置によってCOF1bを打ち抜けばよい。さらに、上記パンチング工程では、同時に2種類のCOF1を打ち抜き可能なパンチング用金型を用いても良い。
【0064】
〔実施例2〕
図7に本発明の他の実施例を示す。
【0065】
本実施例に係るCOF11は、図7(a)に示すような形状をしており、液晶モジュールにおいて使用されるものとする。液晶モジュールでは、液晶パネルの両端に複数個のCOFを実装する場合があり、このような場合では該液晶パネルの上下(または左右)において、鏡面対称形状のCOFによって形成されたドライバがそれぞれ実装される。本実施例の構成は、このような鏡面対称形状のCOFを製造する場合に有効である。
【0066】
本実施例の構成では、図7(b)に示すように、同一のテープキャリア4上において、上記図7(a)に示すCOF11と同形状のCOF11aと、これと鏡面対称な形状を有するCOF11bとが交互に配列されている。上記COF11bは、上記COF11aを図中で左右反転した後、反時計方向に90°回転した向きで配置されている。また、上記COF11aには半導体素子12aが接合され、上記COF11bには半導体素子12bが接合される。上記半導体素子12a・12bも、テープキャリア4上におけるCOF11a・COF11bと整合をとるように90°回転して実装される。
【0067】
このように、本実施例では、互いに鏡面形状となる2種類のCOF11a・11bをテープキャリア4上で、不要領域が最も小さくなる適切な向きでレイアウトとすることにより、テープキャリア4の長さ方向に対してより多くのCOFを搭載することができ、テープ面積の有効活用が図れる。
【0068】
一方、上記COF11a・11bを従来の方法で製造する場合には、COF11aおよびCOF11bを、それぞれ異なるテープキャリアを用いて作成する必要がある。従来の製造方法に基づいて上記COF11aが形成されたテープキャリアを図7(c)に示す。
【0069】
図7(b)に示す本実施例の構成では、同図に示す長さのテープキャリア4において、COF11a・11bの取れ数は合わせて6個である。これに対し、図7(c)に示す従来構成では、上記図7(b)と同一長さのテープキャリアにおいて、5個のCOF11aしか取れていないことがわかる。これにより、本実施例の構成では、同一長さのテープキャリアにおけるCOFの取れ数が従来の場合に比べて増加し、COFの製造価格において大きなコストダウンが得られる。
【0070】
さらに、2種類のCOFを作成する場合に、2種類のテープキャリアを作成することなく、1種類のテープキャリアで2種類のCOFを同時に形成可能となる。
【0071】
上記COF11a・11bの製造工程では、ILB工程においてCOF11a・11bに接合される半導体素子12a・12bは、全く同一であるとは限らず(すなわち、通常は上記半導体素子12a・12bが機能的に鏡面対称となるように設計される)、この場合、上記実施例1の図4(b)に示すように、上記半導体素子12a・12bのピックアップ後にこれを任意の角度に回転させる機構を設けるだけでは対処できない。
【0072】
したがって、本実施例に係るILB工程では、実施例1における図5(b)、(c)に示す方法と同様に、2台のピックアップ機構を用いて、同一のテープキャリア4上に半導体素子12a・12bを順番に搭載するか、あるいは、ピックアップ機構およびインナリードボンダからなるボンディング装置に対し、上記テープキャリア4を2回通すことによって同一のテープキャリア4上に半導体素子12a・12bを順番に搭載することが好ましい。尚、上記テープキャリア4上のレイアウトにおいて、隣接するCOF11a・11bの位置関係は常に一定である。すなわち、上記テープキャリア上で、COF11a(またはCOF11b)のみに注目すれば、その配置向きおよび配置間隔は一定であるため、一つのピックアップ機構を用いてCOF11aに対して半導体素子12aを搭載することには格別の困難は生じない。
【0073】
また、パンチング工程においても同様であり、互いに鏡面形状であるCOF11a・11bに対しては、同一のパンチング用金型を用いることはできないため、実施例1における図6(a)、(b)に示す方法と同様に、2種類のパンチング用金型を用い、2台のパンチング装置にテープキャリア4を通すか、若しくは、1台のパンチング装置にテープキャリア4を2回通すことが好ましい。
【0074】
〔実施例3〕
図8に本発明の他の実施例を示す。
【0075】
本実施例においては、同一のテープキャリア4上において、異なる形状を有する2種類のCOF13およびCOF14が交互に配列されている。上記COF13およびCOF14は、必ずしも同一のモジュールにおいて使用される必要はなく、テープキャリア4から打ち抜かれた後は、それぞれ別の用途に用いられるものであってもよい。上記COF13およびCOF14は、テープキャリア4上におけるパターン領域が最大限に有効利用できるような(すなわち、COFの形成に使用されない不要領域が最小限となるような)組み合わせとなっている。
【0076】
尚、上記図8では、同一のテープキャリア4上に形成されるCOFを2種類であるとしたが、3種類以上のCOFを同時に形成しても良い。この場合、これら複数種類のCOFは所定の順序で配列される。
【0077】
このように、本実施例の構成では、同一のテープキャリア上に異なる形状を有する複数種類のCOFが同時に形成される。この時、上記複数種類のCOFを、テープキャリア上の不要領域が最小限となるような組み合わせとすることにより、テープ面積を有効利用でき、COFの製造価格において大きなコストダウンが得られる。
【0078】
さらに、複数種類のCOFを作成する場合に、1種類のテープキャリアでこれらのCOFを同時に形成可能となるため、多品種少量生産を行う場合に好適である。
【0079】
上記COF13・14の製造工程では、ILB工程においてCOF13・14に接合される半導体素子は、基本的に別種類のものである。したがって、この場合も上記実施例2と同様に、上記実施例1の図4(b)に示すように、上記半導体素子のピックアップ後にこれを任意の角度に回転させる機構を設けるだけでは対処できない。
【0080】
したがって、本実施例に係るILB工程では、実施例1における図5(b)、(c)に示す方法と同様に、2台のピックアップ機構を用いて、同一のテープキャリア4上に半導体素子13・14を順番に搭載するか、あるいは、ピックアップ機構およびインナリードボンダからなるボンディング装置に対し、上記テープキャリア4を2回通すことによって同一のテープキャリア4上に半導体素子13・14を順番に搭載することが好ましい。尚、上記テープキャリア4上のレイアウトにおいて、隣接するCOF13・14の位置関係は常に一定である。すなわち、上記テープキャリア上で、COF13(またはCOF14)のみに注目すれば、その配置向きおよび配置間隔は一定であるため、一つのピックアップ機構を用いてCOF13に対して半導体素子を搭載することには格別の困難は生じない。
【0081】
また、上記テープキャリア上に、3種類以上のCOFを形成する場合であっても、隣接する特定の2種類のCOFについては、その位置関係は常に一定であるため、上記テープキャリア上で、特定の1種類のCOFのみに注目すれば、その配置向きおよび配置間隔は一定となる。すなわち、同一種類のCOFは、上記テープキャリア上において、一定周期の間隔でもって繰り返し形成されることとなる。
【0082】
また、パンチング工程においても同様であり、互いに異なる形状であるCOF13・14に対しては、同一のパンチング用金型を用いることはできないため、実施例1における図6(a)、(b)に示す方法と同様に、2種類のパンチング用金型を用い、2台のパンチング装置にテープキャリア4を通すか、若しくは、1台のパンチング装置にテープキャリア4を2回通すことが好ましい。
【0083】
〔実施例4〕
上記実施例1ないし3では、図2に示すように、ILB工程において、半導体素子2とテープキャリア4とは、半導体素子2の突起電極9とテープキャリア4の銅箔パターン8とを位置合わせし、インナリードボンダによって加熱・加圧を行うことによって接合されている。さらに、上記突起電極9と銅箔パターン8との接続後、テープキャリア4と半導体素子2との間にできる隙間には封止樹脂5が注入され、耐湿性および機械的な強度の向上が図られる。
【0084】
これに対して本実施例では、半導体素子とテープキャリアとの接合において、異方導電性接着剤を用いることにより、上記ILB工程における工程の簡略化を図っている。
【0085】
図9に示す構成においては、半導体素子2の突起電極9とテープキャリア10の銅箔パターン8とは、絶縁性接着剤15a内に導電粒子15bを分散させてなるフィルム状の異方導電性接着フィルム15によって接合されている。この場合、上記テープキャリア10の銅箔パターン8上に異方導電性接着フィルム15を転写し、その上に半導体素子2を位置合わせして加圧することにより、上記突起電極9と銅箔パターン8とが導電粒子15bを介して電気的に接続される。
【0086】
このように、上記異方導電性接着フィルム15を用いた場合、該異方導電性接着フィルム15によって端子部分の封止効果も得られる。このため、封止樹脂が不要となり、該封止樹脂の注入工程等を省くことができるため、従来に比べ組立工程を簡略化することができる。すなわち、上記実施例1で述べたようなAu−Sn合金形成によって半導体素子2の突起電極9とテープキャリア10の銅箔パターン8とを接合して組み立てる場合は、ILB工程において突起電極9と銅箔パターン8とを接合し、樹脂封止工程において接合部分を封止するといった2工程が必要となるが、本実施例のように異方導電性接着剤を用いれば、上記ILB工程に相当する接合工程のみで封止工程も兼ねることができるため、工程の簡略化を図ることができる。
【0087】
尚、図9においては、異方導電性接着剤としてフィルム状の異方導電性接着フィルム15を用いているが、図10に示すようなペースト状の異方導電性接着ペースト16を用いても同様の効果を得ることができる。
【0088】
また、上記図9および図10では、2層テープ構造であるテープキャリア10を用いた場合を示しているが、本発明においてテープキャリアのテープ構造は特に限定されず、3層テープ構造であるテープキャリア4を用いることも可能である。同様のことは、実施例2または3においても言える。すなわち、実施例2または3において、テープキャリア4とあるところを2層テープ構造のテープキャリア10を用いることももちろん可能である。
【0089】
【発明の効果】
請求項1の発明のテープキャリアは、以上のように、同一形状の配線パターンが、テープキャリアの利用面積が大きくなるようなレイアウトで、テープキャリアのテープ送り方向に対して複数の方向を有するように配置されている構成である。
【0090】
請求項5の発明のテープキャリア型半導体装置の製造方法は、以上のように、同一形状の配線パターンが、テープキャリアの利用面積が大きくなるようなレイアウトで、テープキャリアのテープ送り方向に対して複数の方向を有するように配置されているテープキャリアに対して、該テープキャリア上の配線パターンの所定位置に半導体素子を接合・搭載する第1の工程と、上記配線パターン上に上記半導体素子が接合・搭載されてなるテープキャリア型半導体装置を、上記テープキャリアから打ち抜いて個々のテープキャリア型半導体装置とする第2の工程とを有する構成である。
【0091】
それゆえ、上記請求項1および5の構成によれば、配線パターンのレイアウトによって、テープキャリア上に形成される全ての配線パターンを同一方向に配置する従来構成に比べて、該テープキャリア上においてテープキャリア型半導体装置の形成に寄与しない不要領域を減少させることができる。これにより、テープキャリア型半導体装置の製造価格において大きなコストダウンが得られるという効果を奏する。
【0092】
請求項2の発明のテープキャリアは、以上のように、形状の異なる複数種類の配線パターンが、テープキャリアの利用面積が大きくなるようなレイアウトで配置されている構成である。
【0093】
請求項6の発明のテープキャリア型半導体装置の製造方法は、以上のように、形状の異なる複数種類の配線パターンが、テープキャリアの利用面積が大きくなるようなレイアウトで配置されているテープキャリアに対して、該テープキャリア上の配線パターンの所定位置に半導体素子を接合・搭載する第1の工程と、上記配線パターン上に上記半導体素子が接合・搭載されてなるテープキャリア型半導体装置を、上記テープキャリアから打ち抜いて個々のテープキャリア型半導体装置とする第2の工程とを有する構成である。
【0094】
それゆえ、上記請求項2および6の構成によれば、複数種類の配線パターンを適切に組み合わせることによってテープキャリアの利用面積が大きくなり、テープキャリア上に同一種類の配線パターンを同一方向に配置する従来構成に比べて、該テープキャリア上においてテープキャリア型半導体装置の形成に寄与しない不要領域を減少させることができる。これにより、テープキャリア型半導体装置の製造価格において大きなコストダウンが得られるという効果を奏する。
【0095】
さらに、1種類のテープキャリアで複数種類のテープキャリア型半導体装置を同時に形成可能となるため、多品種少量生産を行う場合に好適であるという効果を併せて奏する。
【0096】
請求項3の発明のテープキャリアは、以上のように、請求項1または2の構成に加えて、上記配線パターンが、上記テープキャリアの基体となるテープキャリア材料上に、接着剤を介在して固定されている構成である。
【0097】
請求項4の発明のテープキャリアは、以上のように、請求項1または2の構成に加えて、上記配線パターンが、上記テープキャリアの基体となるテープキャリア材料上に、接着剤を介在せずに固定されている構成である。
【0098】
上記請求項3の構成によれば3層テープのテープキャリアに、また、上記請求項4の構成によれば2層テープのテープキャリアに本発明を適用することができる。
【0099】
それゆえ、請求項1または2の構成による効果に加えて、請求項3の構成によれば3層テープのテープキャリアに、また、上記請求項4の構成によれば2層テープのテープキャリアに本発明を適用することができるという効果を奏する。
【0100】
請求項7の発明のテープキャリア型半導体装置の製造方法は、以上のように、請求項5の構成に加えて、上記第1の工程で、上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該配線パターンの向きに応じて回転された後、搭載される構成である。
【0101】
それゆえ、請求項5の構成による効果に加えて、配線パターンの所定位置に搭載される半導体素子を該配線パターンの向きに応じて回転した後に搭載することができるため、該半導体素子を配線パターンの向きに応じて搭載することができるという効果を奏する。
【0102】
請求項8の発明のテープキャリア型半導体装置の製造方法は、以上のように、請求項5または6の構成に加えて、上記第1の工程で、上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該テープキャリア上の配線パターンの種類数に対応して設けられたピックアップ機構によって搭載されるものであり、同種類の配線パターンに搭載される半導体素子は、同一のピックアップ機構によって搭載される構成である。
【0103】
それゆえ、請求項5または6の構成による効果に加えて、配線パターンの所定位置に搭載される半導体素子に対し、同種類の配線パターンに搭載される半導体素子を同一のピックアップ機構によって搭載することによって、上記半導体素子を配線パターンの種類に応じて搭載することができるという効果を奏する。
【0104】
請求項9の発明のテープキャリア型半導体装置の製造方法は、以上のように、請求項5または6の構成に加えて、上記第1の工程で、上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該テープキャリア上の配線パターンの種類数に対応する回数分だけ、該工程を実行する製造装置に通されることによって搭載されるものであり、同種類の配線パターンに搭載される半導体素子は、上記製造装置の同一通過時に搭載される構成である。
【0105】
それゆえ、請求項5または6の構成による効果に加えて、配線パターンの所定位置に搭載される半導体素子に対し、同種類の配線パターンに搭載される半導体素子を上記製造装置の同一通過時に搭載することにより、上記半導体素子を配線パターンの種類に応じて搭載することができるという効果を奏する。
【0106】
請求項10の発明のテープキャリア型半導体装置の製造方法は、以上のように、請求項5の構成に加えて、上記第2の工程で、上記テープキャリア上のテープキャリア型半導体装置は、該配線パターンの向きに応じて回転可能に設けられたパンチング用金型によって打ち抜かれる構成である。
【0107】
それゆえ、請求項5の構成による効果に加えて、テープキャリア型半導体装置を配線パターンの向きに応じて回転させたパンチング用金型によってテープキャリアから打ち抜くことができるため、配線パターンの向きに応じた打ち抜きができるという効果を奏する。
【0108】
請求項11の発明のテープキャリア型半導体装置の製造方法は、以上のように、請求項5または6の構成に加えて、上記第2の工程で、上記テープキャリア上のテープキャリア型半導体装置は、上記配線パターンの種類数に対応して設けられたパンチング用金型によってテープキャリアから打ち抜かれるものであり、同種類の配線パターンを有するテープキャリア型半導体装置は、同一のパンチング用金型によって打ち抜かれる構成である。
【0109】
それゆえ、請求項5または6の構成による効果に加えて、同種類の配線パターンを有するテープキャリア型半導体装置を同一のパンチング用金型によって打ち抜くことにより、上記テープキャリア型半導体装置を配線パターンの種類に応じてテープキャリアから打ち抜くことができるという効果を奏する。
【0110】
請求項12の発明のテープキャリア型半導体装置の製造方法は、以上のように、請求項5または6の構成に加えて、上記第2の工程で、上記テープキャリア上のテープキャリア型半導体装置は、上記配線パターンの種類数に対応して設けられたパンチング用金型によって、かつ、上記配線パターンの種類数に対応する回数分だけ、該工程を実行する製造装置に通されることによってテープキャリアから打ち抜かれるものであり、同種類の配線パターンを有するテープキャリア型半導体装置は、上記製造装置の同一通過時に、同一のパンチング用金型によって打ち抜かれる構成である。
【0111】
それゆえ、請求項5または6の構成による効果に加えて、同種類の配線パターンを有するテープキャリア型半導体装置を、上記製造装置の同一通過時に同一のパンチング用金型によって打ち抜くことにより、上記テープキャリア型半導体装置を配線パターンの種類に応じてテープキャリアから打ち抜くことができるという効果を奏する。
【0112】
請求項13の発明のテープキャリア型半導体装置の製造方法は、以上のように、請求項5ないし12の何れかの構成に加えて、上記第1の工程で、上記半導体素子と上記テープキャリア上の配線パターンとの接合方式が、Au−Snの合金形成によってなされている構成である。
【0113】
それゆえ、請求項5ないし12の何れかの構成による効果に加えて、例えば、金メッキされた半導体素子電極と、錫メッキされた配線パターンとを加熱加圧することにより、Au−Snの合金形成によって上記半導体素子と上記配線パターンとが接合されるため、従来の接合方式を利用することができるという効果を奏する。
【0114】
請求項14の発明のテープキャリア型半導体装置の製造方法は、以上のように、請求項5ないし12の何れかの構成に加えて、上記第1の工程で、上記半導体素子と上記テープキャリア上の配線パターンとが、異方導電性接着剤によって接合される構成である。
【0115】
それゆえ、請求項5ないし12の何れかの構成による効果に加えて、上記半導体素子と上記テープキャリア上の配線パターンとを異方導電性接着剤によって接合することにより、従来の使用されていた封止樹脂の注入工程等を省くことができ、従来に比べ上記第1の工程を簡略化することができるという効果を奏する。
【図面の簡単な説明】
【図1】本発明の実施例1に係る構成を示すものであり、図1(a)は製造されるCOFの形状を示す平面図、図1(b)は上記COFの長尺のテープキャリア上でのパターンレイアウトを示す平面図である。
【図2】上記テープキャリアに3層テープを用いた場合のCOFの構成を示す断面図である。
【図3】上記テープキャリアに2層テープを用いた場合のCOFの構成を示す断面図である。
【図4】図4(a)ないし図4(c)は、上記COFの製造工程を示す説明図である。
【図5】図5(a)ないし図5(c)は、上記COFの他の製造工程の一部を示す説明図である。
【図6】図6(a)ないし図6(b)は、上記COFの他の製造工程の一部を示す説明図である。
【図7】本発明の実施例2に係る構成を示すものであり、図7(a)は製造されるCOFの形状を示す平面図、図7(b)は上記COFの長尺のテープキャリア上でのパターンレイアウトを示す平面図、図7(c)は上記COFの長尺のテープキャリア上での従来のパターンレイアウトを示す平面図である。
【図8】本発明の実施例3に係る構成を示すものであり、複数種類のCOFの長尺のテープキャリア上でのパターンレイアウトを示す平面図である。
【図9】本発明の実施例4に係る構成を示すものであり、半導体素子とテープキャリアとの接続に異方導電性接着フィルムを用いた場合のCOFの構成を示す断面図である。
【図10】本発明の実施例4に係る構成を示すものであり、半導体素子とテープキャリアとの接続に異方導電性接着ペーストを用いた場合のCOFの構成を示す断面図である。
【図11】従来構成を示すものであり、図11(a)は製造されるCOFの形状を示す平面図、11(b)は上記COFの長尺のテープキャリア上での従来のパターンレイアウトを示す平面図である。
【符号の説明】
1・11・13・14 COF(テープキャリア型半導体装置)
2・12 半導体素子
4・10 テープキャリア
6 絶縁材料(テープキャリア材料)
8 銅箔パターン(配線パターン)
15 異方導電性接着フィルム(異方導電性接着剤)
16 異方導電性接着ペースト(異方導電性接着剤)
Claims (18)
- 長尺のテープキャリア上に半導体素子を接合・搭載してなるテープキャリア型半導体装置に用いられ、該テープキャリア型半導体装置の配線パターンが連続的に形成されてなるテープキャリアにおいて、
上記配線パターンは、外部接続端子が形成された突起部を有する形状であり、
隣接して配置される複数個の配線パターンは突起部同士が互いに隣接するように配置されることで、テープキャリアの不要領域の面積を減少させるレイアウトで配置されていることを特徴とするテープキャリア。 - 上記各配線パターンは、L字型またはT字型のような突起部を有する形状であることを特徴とする請求項1に記載のテープキャリア。
- 上記各配線パターンは、L字型またはT字型の形状であることを特徴とする請求項2に記載のテープキャリア。
- 長尺のテープキャリア上に半導体素子を接合・搭載してなるテープキャリア型半導体装置に用いられ、該テープキャリア型半導体装置の配線パターンが連続的に形成されてなるテープキャリアにおいて、
上記配線パターンは、略矩形形状の基体部に突起部が組み合わされてなるL字型またはT字型の形状であり、
隣接して配置される複数個の配線パターンは突起部同士が互いに隣接するように配置されることで、テープキャリアの不要領域の面積を減少させるレイアウトで配置されていることを特徴とするテープキャリア。 - 上記テープキャリア上には、同一形状の配線パターンがテープキャリアのテープ送り方向に対して複数の方向を有するように配置されていることを特徴とする請求項1ないし4のいずれかに記載のテープキャリア。
- 上記テープキャリア上には、形状の異なる複数種類の配線パターンが形成されていることを特徴とする請求項1ないし4のいずれかに記載のテープキャリア。
- 上記配線パターンが、上記テープキャリアの基体となるテープキャリア材料上に、接着剤を介在して固定されていることを特徴とする請求項1ないし6の何れかに記載のテープキャリア。
- 上記配線パターンが、上記テープキャリアの基体となるテープキャリア材料上に、接着剤を介在せずに固定されていることを特徴とする請求項1ないし6の何れかに記載のテープキャリア。
- 上記テープキャリア型半導体装置はCOFであることを特徴とする請求項1ないし8の何れかに記載のテープキャリア。
- 上記請求項1ないし9の何れかに記載のテープキャリアに対して、該テープキャリア上の配線パターンの所定位置に半導体素子を接合・搭載する第1の工程と、
上記配線パターン上に上記半導体素子が接合・搭載されてなるテープキャリア型半導体装置を、上記テープキャリアから打ち抜いて個々のテープキャリア型半導体装置とする第2の工程とを有することを特徴とするテープキャリア型半導体装置の製造方法。 - 上記テープキャリア上には、同一形状の配線パターンがテープキャリアのテープ送り方 向に対して複数の方向を有するように配置されており、
上記第1の工程で、上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該配線パターンの向きに応じて回転された後、搭載されることを特徴とする請求項10に記載のテープキャリア型半導体装置の製造方法。 - 上記第1の工程で、
上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該テープキャリア上の配線パターンの種類数に対応して設けられたピックアップ機構によって搭載されるものであり、
同種類の配線パターンに搭載される半導体素子は、同一のピックアップ機構によって搭載されることを特徴とする請求項10に記載のテープキャリア型半導体装置の製造方法。 - 上記第1の工程で、
上記テープキャリア上の配線パターンの所定位置に搭載される半導体素子は、該テープキャリア上の配線パターンの種類数に対応する回数分だけ、該工程を実行する製造装置に通されることによって搭載されるものであり、
同種類の配線パターンに搭載される半導体素子は、上記製造装置の同一通過時に搭載されることを特徴とする請求項10に記載のテープキャリア型半導体装置の製造方法。 - 上記テープキャリア上には、同一形状の配線パターンがテープキャリアのテープ送り方向に対して複数の方向を有するように配置されており、
上記第2の工程で、上記テープキャリア上のテープキャリア型半導体装置は、該配線パターンの向きに応じて回転可能に設けられたパンチング用金型によって打ち抜かれることを特徴とする請求項10に記載のテープキャリア型半導体装置の製造方法。 - 上記第2の工程で、
上記テープキャリア上のテープキャリア型半導体装置は、上記配線パターンの種類数に対応して設けられたパンチング用金型によってテープキャリアから打ち抜かれるものであり、
同種類の配線パターンを有するテープキャリア型半導体装置は、同一のパンチング用金型によって打ち抜かれることを特徴とする請求項10に記載のテープキャリア型半導体装置の製造方法。 - 上記第2の工程で、
上記テープキャリア上のテープキャリア型半導体装置は、上記配線パターンの種類数に対応して設けられたパンチング用金型によって、かつ、上記配線パターンの種類数に対応する回数分だけ、該工程を実行する製造装置に通されることによってテープキャリアから打ち抜かれるものであり、
同種類の配線パターンを有するテープキャリア型半導体装置は、上記製造装置の同一通過時に、同一のパンチング用金型によって打ち抜かれることを特徴とする請求項10に記載のテープキャリア型半導体装置の製造方法。 - 上記第1の工程で、上記半導体素子と上記テープキャリア上の配線パターンとの接合方式が、Au−Snの合金形成によってなされていることを特徴とする請求項10ないし16の何れかに記載のテープキャリア型半導体装置の製造方法。
- 上記第1の工程で、上記半導体素子と上記テープキャリア上の配線パターンとが、異方導電性接着剤によって接合されることを特徴とする請求項10ないし16の何れかに記載のテープキャリア型半導体装置の製造方法。
Priority Applications (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13452999A JP3558921B2 (ja) | 1999-05-14 | 1999-05-14 | テープキャリア並びにテープキャリア型半導体装置の製造方法 |
US09/540,529 US6911729B1 (en) | 1999-05-14 | 2000-03-31 | Tape carrier semiconductor device |
TW092214435U TW595806U (en) | 1999-05-14 | 2000-03-31 | Tape carrier |
EP00302918A EP1052695A3 (en) | 1999-05-14 | 2000-04-06 | Tape carrier and manufacturing method of tape carrier type semiconductor device |
KR1020000018263A KR20010049250A (ko) | 1999-05-14 | 2000-04-07 | 테이프캐리어 및 테이프캐리어형 반도체장치의 제조 방법 |
SG200002005A SG98376A1 (en) | 1999-05-14 | 2000-04-07 | Tape carrier and manufacturing method of tape carrier type semiconductor device |
CNB001085689A CN1196192C (zh) | 1999-05-14 | 2000-05-15 | 载带及载带型半导体装置的制造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13452999A JP3558921B2 (ja) | 1999-05-14 | 1999-05-14 | テープキャリア並びにテープキャリア型半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2000323533A JP2000323533A (ja) | 2000-11-24 |
JP3558921B2 true JP3558921B2 (ja) | 2004-08-25 |
Family
ID=15130459
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13452999A Expired - Fee Related JP3558921B2 (ja) | 1999-05-14 | 1999-05-14 | テープキャリア並びにテープキャリア型半導体装置の製造方法 |
Country Status (7)
Country | Link |
---|---|
US (1) | US6911729B1 (ja) |
EP (1) | EP1052695A3 (ja) |
JP (1) | JP3558921B2 (ja) |
KR (1) | KR20010049250A (ja) |
CN (1) | CN1196192C (ja) |
SG (1) | SG98376A1 (ja) |
TW (1) | TW595806U (ja) |
Families Citing this family (28)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3558921B2 (ja) * | 1999-05-14 | 2004-08-25 | シャープ株式会社 | テープキャリア並びにテープキャリア型半導体装置の製造方法 |
EP1215725A3 (de) * | 2000-12-18 | 2005-03-23 | cubit electronics Gmbh | Anordnung zur Aufnahme elektrischer Bauteile und kontaktloser Transponder |
JP2002324814A (ja) * | 2001-04-25 | 2002-11-08 | Nec Corp | Cof半導体パッケージの樹脂封止方法および装置 |
US7173322B2 (en) * | 2002-03-13 | 2007-02-06 | Mitsui Mining & Smelting Co., Ltd. | COF flexible printed wiring board and method of producing the wiring board |
US20050205972A1 (en) * | 2002-03-13 | 2005-09-22 | Mitsui Mining & Smelting Co., Ltd. | COF flexible printed wiring board and semiconductor device |
JP3889700B2 (ja) * | 2002-03-13 | 2007-03-07 | 三井金属鉱業株式会社 | Cofフィルムキャリアテープの製造方法 |
JP3829939B2 (ja) * | 2003-11-14 | 2006-10-04 | セイコーエプソン株式会社 | 半導体装置の製造方法及び製造装置 |
KR20050065688A (ko) * | 2003-12-23 | 2005-06-30 | 이기종 | Lcd용 cof 본딩장치 및 본딩방법 |
KR101002346B1 (ko) * | 2003-12-30 | 2010-12-20 | 엘지디스플레이 주식회사 | 칩 실장형 필름 패키지 |
JP4070135B2 (ja) * | 2004-05-11 | 2008-04-02 | 沖電気工業株式会社 | テープキャリア、半導体装置の製造方法および半導体装置 |
US11842972B2 (en) * | 2004-09-28 | 2023-12-12 | Rohm Co., Ltd. | Semiconductor device with a semiconductor chip connected in a flip chip manner |
JP4109689B2 (ja) * | 2004-09-29 | 2008-07-02 | 三井金属鉱業株式会社 | Cof用フレキシブルプリント配線板の製造方法 |
KR101230617B1 (ko) * | 2006-06-30 | 2013-02-06 | 서울반도체 주식회사 | 발광 다이오드 및 이의 제조 방법 |
JP4283292B2 (ja) * | 2006-09-08 | 2009-06-24 | シャープ株式会社 | 半導体装置用テープキャリア、および半導体装置の製造方法 |
KR100837281B1 (ko) * | 2007-05-23 | 2008-06-11 | 삼성전자주식회사 | 반도체 소자 패키지 및 그 제조 방법 |
US7745260B2 (en) * | 2008-09-22 | 2010-06-29 | Freescale Semiconductor, Inc. | Method of forming semiconductor package |
US20120314175A1 (en) * | 2011-06-09 | 2012-12-13 | Shenzhen China Star Oploelectronics Technology Co., Ltd. | Cof, cof carrier tape and drive circuit of liquid crystal television |
CN102237334A (zh) * | 2011-06-09 | 2011-11-09 | 深圳市华星光电技术有限公司 | Cof及cof载带 |
US20120320003A1 (en) * | 2011-06-17 | 2012-12-20 | Shenzhen China Star Optoelectronics Technology Co., Ltd. | Cof, cof carrier tape and drive circuit of liquid crystal television |
CN102332446A (zh) * | 2011-06-17 | 2012-01-25 | 深圳市华星光电技术有限公司 | Cof及其载带 |
CN102323682B (zh) * | 2011-08-05 | 2013-06-26 | 深圳市华星光电技术有限公司 | 液晶面板及软板上芯片构造的卷带基板 |
US9041892B2 (en) * | 2011-08-05 | 2015-05-26 | Shenzhen China Star Optoelectronics Technology Co., Ltd. | Tape substrate for chip on film structure of liquid crystal panel |
CN102368471B (zh) * | 2011-09-14 | 2014-04-30 | 深圳市华星光电技术有限公司 | Lcd驱动芯片的cof封装方法与结构 |
KR101273524B1 (ko) * | 2011-10-12 | 2013-06-17 | 주식회사 루셈 | 반도체 칩 패키지 및 이를 이송하는 테이프 캐리어 패키지 |
JP2014011046A (ja) * | 2012-06-29 | 2014-01-20 | Murata Mfg Co Ltd | 信号線路付き基材層の製造方法及び高周波信号線路の製造方法 |
CN111788516A (zh) * | 2018-03-16 | 2020-10-16 | 深圳市柔宇科技股份有限公司 | Cof载带及其加工方法、cof载带加工设备 |
CN109300879B (zh) * | 2018-09-18 | 2020-12-29 | 惠科股份有限公司 | 驱动芯片封装结构及其分离方法、分离设备 |
CN110621116A (zh) * | 2019-09-25 | 2019-12-27 | 江苏上达电子有限公司 | 一种封装基板的制作方法 |
Family Cites Families (26)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4551912A (en) | 1983-06-30 | 1985-11-12 | International Business Machines Corporation | Highly integrated universal tape bonding |
US4977441A (en) * | 1985-12-25 | 1990-12-11 | Hitachi, Ltd. | Semiconductor device and tape carrier |
US4811081A (en) * | 1987-03-23 | 1989-03-07 | Motorola, Inc. | Semiconductor die bonding with conductive adhesive |
JPH0625976Y2 (ja) | 1987-04-21 | 1994-07-06 | テルモ株式会社 | 電子回路用基板接続体 |
JPS6473628A (en) | 1987-09-14 | 1989-03-17 | Nec Corp | Tab tape |
US5032542A (en) | 1988-11-18 | 1991-07-16 | Sanyo Electric Co., Ltd. | Method of mass-producing integrated circuit devices using strip lead frame |
JP2751450B2 (ja) * | 1989-08-28 | 1998-05-18 | セイコーエプソン株式会社 | テープキャリアの実装構造及びその実装方法 |
KR940006085B1 (ko) | 1989-11-06 | 1994-07-06 | 마쯔시다덴기산교 가부시기가이샤 | 필름캐리어제조용 필름재 |
JP2809781B2 (ja) | 1990-01-20 | 1998-10-15 | 株式会社東芝 | インナリードボンディング装置およびインナリードボンディング方法 |
AU7954491A (en) | 1990-05-14 | 1991-12-10 | Richard Lee Schendelman | Interdigitated trans-die lead construction and method of construction for maximizing population density of chip-on-board construction |
US5075252A (en) | 1990-05-14 | 1991-12-24 | Richard Schendelman | Interdigitated trans-die lead method of construction for maximizing population density of chip-on-board construction |
JPH04348540A (ja) * | 1991-05-27 | 1992-12-03 | Sony Corp | フリップチップボンダー |
JPH0653273A (ja) | 1992-07-29 | 1994-02-25 | Nec Kansai Ltd | Tab式半導体装置とその特性検査装置 |
JPH077043A (ja) | 1993-06-16 | 1995-01-10 | Toshiba Corp | インナ−リ−ドボンディング装置 |
JPH07161765A (ja) | 1993-12-03 | 1995-06-23 | Hitachi Cable Ltd | フィルムキャリア型半導体装置 |
JP3270807B2 (ja) * | 1995-06-29 | 2002-04-02 | シャープ株式会社 | テープキャリアパッケージ |
DE19601388A1 (de) | 1996-01-16 | 1997-07-24 | Siemens Ag | Leiterplatten-Trägervorrichtung |
JP3608205B2 (ja) * | 1996-10-17 | 2005-01-05 | セイコーエプソン株式会社 | 半導体装置及びその製造方法並びに回路基板 |
JP3564970B2 (ja) * | 1997-02-17 | 2004-09-15 | セイコーエプソン株式会社 | テープキャリアおよびこれを用いたテープキャリアデバイス |
US6315156B1 (en) * | 1998-01-26 | 2001-11-13 | Gpax International, Inc. | Tape-form packaging system and apparatus for effecting assembly and disassembly thereof |
US6100112A (en) * | 1998-05-28 | 2000-08-08 | The Furukawa Electric Co., Ltd. | Method of manufacturing a tape carrier with bump |
JP3512655B2 (ja) * | 1998-12-01 | 2004-03-31 | シャープ株式会社 | 半導体装置およびその製造方法並びに該半導体装置の製造に使用される補強用テープ |
JP3558921B2 (ja) * | 1999-05-14 | 2004-08-25 | シャープ株式会社 | テープキャリア並びにテープキャリア型半導体装置の製造方法 |
JP3523536B2 (ja) * | 1999-08-06 | 2004-04-26 | シャープ株式会社 | 半導体装置及びその製造方法、並びに液晶モジュール及びその搭載方法 |
JP3494940B2 (ja) * | 1999-12-20 | 2004-02-09 | シャープ株式会社 | テープキャリア型半導体装置、その製造方法及びそれを用いた液晶モジュール |
JP3536023B2 (ja) * | 2000-10-13 | 2004-06-07 | シャープ株式会社 | Cof用テープキャリアおよびこれを用いて製造されるcof構造の半導体装置 |
-
1999
- 1999-05-14 JP JP13452999A patent/JP3558921B2/ja not_active Expired - Fee Related
-
2000
- 2000-03-31 TW TW092214435U patent/TW595806U/zh unknown
- 2000-03-31 US US09/540,529 patent/US6911729B1/en not_active Expired - Fee Related
- 2000-04-06 EP EP00302918A patent/EP1052695A3/en not_active Withdrawn
- 2000-04-07 SG SG200002005A patent/SG98376A1/en unknown
- 2000-04-07 KR KR1020000018263A patent/KR20010049250A/ko not_active Application Discontinuation
- 2000-05-15 CN CNB001085689A patent/CN1196192C/zh not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
TW595806U (en) | 2004-06-21 |
CN1196192C (zh) | 2005-04-06 |
SG98376A1 (en) | 2003-09-19 |
JP2000323533A (ja) | 2000-11-24 |
KR20010049250A (ko) | 2001-06-15 |
EP1052695A3 (en) | 2002-02-27 |
US6911729B1 (en) | 2005-06-28 |
CN1274173A (zh) | 2000-11-22 |
EP1052695A2 (en) | 2000-11-15 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP3558921B2 (ja) | テープキャリア並びにテープキャリア型半導体装置の製造方法 | |
JP2980046B2 (ja) | 半導体装置の実装構造および実装方法 | |
JP3536023B2 (ja) | Cof用テープキャリアおよびこれを用いて製造されるcof構造の半導体装置 | |
JP3838331B2 (ja) | 半導体装置及びその製造方法、回路基板並びに電子機器 | |
WO2001026432A1 (en) | Wiring board, semiconductor device and method of producing, testing and packaging the same, and circuit board and electronic equipment | |
JPH10199934A (ja) | 半導体素子実装構造体及び半導体素子実装方法 | |
JP2005079581A (ja) | テープ基板、及びテープ基板を用いた半導体チップパッケージ、及び半導体チップパッケージを用いたlcd装置 | |
JP2817704B2 (ja) | テープキャリアパッケージ及び接続方法 | |
US6833512B2 (en) | Substrate board structure | |
WO2000019515A1 (fr) | Dispositif semi-conducteur et procede de fabrication de celui-ci, carte de circuit imprime et equipement electronique | |
JP2004212587A (ja) | 液晶表示パネル及びこの液晶表示パネルに使用する可撓性基板の実装方法 | |
JPH10233401A (ja) | 半導体装置 | |
JP2003332380A (ja) | 電子デバイス及びその製造方法並びに電子機器 | |
KR20090106777A (ko) | 도전성 입자가 부착된 전극을 구비한 연성회로기판 및테이프 캐리어 패키지 | |
JP2715810B2 (ja) | フィルムキャリア半導体装置とその製造方法 | |
JP3714388B2 (ja) | 半導体装置及びその製造方法、配線基板、回路基板並びに電子機器 | |
JPH0526747Y2 (ja) | ||
JP2002217239A (ja) | 異方性導電膜 | |
JP4374251B2 (ja) | 半導体装置 | |
JPH06222377A (ja) | 平面型表示装置 | |
JP2000286360A (ja) | 半導体装置及びその製造方法、回路基板並びに電子機器 | |
JPH05166884A (ja) | 半導体電子部品 | |
JP3239004B2 (ja) | 半導体装置及びその製造方法 | |
CN100390618C (zh) | 载具和电接合结构 | |
JP2556204B2 (ja) | フィルムキャリア半導体装置の実装方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040210 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20040412 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20040518 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20040519 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080528 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090528 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100528 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110528 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110528 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120528 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120528 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130528 Year of fee payment: 9 |
|
LAPS | Cancellation because of no payment of annual fees |