JP3205351B2 - 同期デジタル階層システムの同期方法及び異なるデータ構造を識別する方法及びその回路 - Google Patents
同期デジタル階層システムの同期方法及び異なるデータ構造を識別する方法及びその回路Info
- Publication number
- JP3205351B2 JP3205351B2 JP9075591A JP9075591A JP3205351B2 JP 3205351 B2 JP3205351 B2 JP 3205351B2 JP 9075591 A JP9075591 A JP 9075591A JP 9075591 A JP9075591 A JP 9075591A JP 3205351 B2 JP3205351 B2 JP 3205351B2
- Authority
- JP
- Japan
- Prior art keywords
- cell
- frame
- synchronization
- word
- steps
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- 238000000034 method Methods 0.000 title claims abstract description 30
- 230000001360 synchronised effect Effects 0.000 title claims abstract description 15
- 230000005540 biological transmission Effects 0.000 claims abstract description 7
- 238000001514 detection method Methods 0.000 claims description 13
- 125000004079 stearyl group Chemical group [H]C([*])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])C([H])([H])[H] 0.000 claims 1
- 230000007704 transition Effects 0.000 abstract description 9
- 238000010586 diagram Methods 0.000 description 6
- 230000000737 periodic effect Effects 0.000 description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 description 2
- 102100038546 Fibronectin type III and SPRY domain-containing protein 1 Human genes 0.000 description 2
- 101001030521 Homo sapiens Fibronectin type III and SPRY domain-containing protein 1 Proteins 0.000 description 2
- 230000001010 compromised effect Effects 0.000 description 1
- 238000012790 confirmation Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/02—Details
- H04J3/06—Synchronising arrangements
- H04J3/0602—Systems characterised by the synchronising information used
- H04J3/0605—Special codes used as synchronising signal
- H04J3/0608—Detectors therefor, e.g. correlators, state machines
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L7/00—Arrangements for synchronising receiver with transmitter
- H04L7/04—Speed or phase control by synchronisation signals
- H04L7/048—Speed or phase control by synchronisation signals using the properties of error detecting or error correcting codes, e.g. parity as synchronisation signal
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
- Eye Examination Apparatus (AREA)
- Ultra Sonic Daignosis Equipment (AREA)
- Electrically Operated Instructional Devices (AREA)
- Communication Control (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
- Inspection Of Paper Currency And Valuable Securities (AREA)
- Semiconductor Memories (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、同期デジタル階層シス
テムの同期方法及び異なるデータ構造を識別する方法及
びその回路に関する。
テムの同期方法及び異なるデータ構造を識別する方法及
びその回路に関する。
【０００２】
【従来の技術】国際電信電話諮問委員会（ＣＣＩＴＴ）
による同期デジタル階層ＳＤＨの導入により、世界的に
一様な伝送回路網の構成が可能となった。
による同期デジタル階層ＳＤＨの導入により、世界的に
一様な伝送回路網の構成が可能となった。
【０００３】ＳＤＨのビットレートはＣＣＩＴＴ勧告
Ｇ．７０７に特定されている。回路網のノードインタフ
ェースにおける信号の構造はＣＣＩＴＴ勧告Ｇ．７０８
に含まれており、多重化構造はＣＣＩＴＴ勧告Ｇ．７０
９に含まれている。
Ｇ．７０７に特定されている。回路網のノードインタフ
ェースにおける信号の構造はＣＣＩＴＴ勧告Ｇ．７０８
に含まれており、多重化構造はＣＣＩＴＴ勧告Ｇ．７０
９に含まれている。
【０００４】ＣＣＩＴＴ Ｇ．７０８に基づいたＳＤＨ
フレームは、１５５，５２０kbits ／ｓのビットレート
を有するオクテットによる同期トランスポートモジュー
ルＳＴＭ−１から成っている。
フレームは、１５５，５２０kbits ／ｓのビットレート
を有するオクテットによる同期トランスポートモジュー
ルＳＴＭ−１から成っている。
【０００５】このフレームは、夫々が９行含む２７０列
から成っている。９×９オクテットはいわゆるセクショ
ンオーバーヘッドＳＯＨに専用され、２６１×９オクテ
ットは“ペイロード（ｐａｙｌｏａｄ）”と呼ばれる有
用な情報パートに専用される。
から成っている。９×９オクテットはいわゆるセクショ
ンオーバーヘッドＳＯＨに専用され、２６１×９オクテ
ットは“ペイロード（ｐａｙｌｏａｄ）”と呼ばれる有
用な情報パートに専用される。
【０００６】セクションオーバーヘッドＳＯＨの第１行
は６オクテット長のフレーム同期ワードを含んでいる。
セクションオーバーヘッドの第４行は、ペイロードの仮
想コンテナＶＣ４のパスオーバーヘッドＰＯＨをアドレ
ス指定するポインタＡＵ−４ＰＴＲを含んでいる。パス
オーバーヘッドＰＯＨは、２６０×９オクテットのセル
構成されたコンテナＣ４のセルヘッダをアドレス指定す
る別のポインタＨ４を含んでいる。コンテナのセル構造
により、同期フレーム（ＳＤＨ）内のＡＴＭセル（非同
期トランスポートモジュール）の形式でデータの非同期
伝送が可能とされる。
は６オクテット長のフレーム同期ワードを含んでいる。
セクションオーバーヘッドの第４行は、ペイロードの仮
想コンテナＶＣ４のパスオーバーヘッドＰＯＨをアドレ
ス指定するポインタＡＵ−４ＰＴＲを含んでいる。パス
オーバーヘッドＰＯＨは、２６０×９オクテットのセル
構成されたコンテナＣ４のセルヘッダをアドレス指定す
る別のポインタＨ４を含んでいる。コンテナのセル構造
により、同期フレーム（ＳＤＨ）内のＡＴＭセル（非同
期トランスポートモジュール）の形式でデータの非同期
伝送が可能とされる。
【０００７】
【発明が解決しようとする課題】高速でフレーム同期を
確立するために、所定のｎビットフレーム同期ワードを
用いてローカルクロックレートでつまり１ビット間隔で
受信ビットストリームのｎビットのビットパターンを連
続的に走査し、このｎビットのビットパターンをフレー
ム同期ワードと比較し、一致する場合にフレーム同期情
報を出力することが知られている（ＤＥ２８５５６７６
Ａ１）。伝送リンクが同期していることが高い信頼性を
もって推定される前に、周期的に発生する同期ワードが
所定の間隔で繰り返して検出されねばならない。このこ
とは、同期が達成されるまでに少なくとも２フレーム長
という非常に長時間を必要とするという問題点がある。
確立するために、所定のｎビットフレーム同期ワードを
用いてローカルクロックレートでつまり１ビット間隔で
受信ビットストリームのｎビットのビットパターンを連
続的に走査し、このｎビットのビットパターンをフレー
ム同期ワードと比較し、一致する場合にフレーム同期情
報を出力することが知られている（ＤＥ２８５５６７６
Ａ１）。伝送リンクが同期していることが高い信頼性を
もって推定される前に、周期的に発生する同期ワードが
所定の間隔で繰り返して検出されねばならない。このこ
とは、同期が達成されるまでに少なくとも２フレーム長
という非常に長時間を必要とするという問題点がある。
【０００８】ＡＴＭセルが伝送されねばならないシステ
ムでは、サービスの品質が同期化損失により損なわれる
ので、同期時間が非常に短い。
ムでは、サービスの品質が同期化損失により損なわれる
ので、同期時間が非常に短い。
【０００９】外部フレーム（非同期トランスポートモジ
ュール）を持たない一定長のセルを伝送することが知ら
れている。
ュール）を持たない一定長のセルを伝送することが知ら
れている。
【００１０】セル構成された伝送だけの場合には、同じ
長さのセルが５３オクテットの同期をもって伝送され
る。各セルはセルヘッダとして５オクテットを含み、ペ
イロードとして４８オクテットを含んでいる。セルヘッ
ダは多項コードで符号化されており、そのため符号化さ
れていないペイロードは受信端でセルヘッダを復号する
ことによりセルヘッダから区別することができる。
長さのセルが５３オクテットの同期をもって伝送され
る。各セルはセルヘッダとして５オクテットを含み、ペ
イロードとして４８オクテットを含んでいる。セルヘッ
ダは多項コードで符号化されており、そのため符号化さ
れていないペイロードは受信端でセルヘッダを復号する
ことによりセルヘッダから区別することができる。
【００１１】本発明の目的は、高い信頼性と短い同期時
間を保証する同期デジタル階層ＳＤＨに基づいてフレー
ム構成されたシステムに用いる同期方法を提供すること
である。
間を保証する同期デジタル階層ＳＤＨに基づいてフレー
ム構成されたシステムに用いる同期方法を提供すること
である。
【００１２】本発明の別の目的は、２つの互換性のない
データ構造を用いた場合に、高い信頼性をもって、余分
のコストを必要とせずに正しいデータ構造を識別する方
法及びその方法を実行する回路を提供することである。
データ構造を用いた場合に、高い信頼性をもって、余分
のコストを必要とせずに正しいデータ構造を識別する方
法及びその方法を実行する回路を提供することである。
【００１３】
【課題を解決するための手段】同期をとるために、一度
だけ検出されたフレーム同期ワードについては、従来技
術において行なわれていたように繰り返して周期的に検
出することによる確認は行なわれない。しかし、ＳＤＨ
フレームで伝送されたＡＴＭセルのヘッダを復号するこ
とによる確認が行なわれ、その結果１フレーム長内で同
期が実現される。
だけ検出されたフレーム同期ワードについては、従来技
術において行なわれていたように繰り返して周期的に検
出することによる確認は行なわれない。しかし、ＳＤＨ
フレームで伝送されたＡＴＭセルのヘッダを復号するこ
とによる確認が行なわれ、その結果１フレーム長内で同
期が実現される。
【００１４】本発明によれば、フレーム同期ワードを確
認するために、同期ワードに無関係の基準、つまりペイ
ロード中のセルヘッダの正しい復号が使用される。これ
は、ペイロード、つまりＡＴＭセルが同期ワードから所
定距離隔置されたポインタを介してアドレス指定される
ためである。
認するために、同期ワードに無関係の基準、つまりペイ
ロード中のセルヘッダの正しい復号が使用される。これ
は、ペイロード、つまりＡＴＭセルが同期ワードから所
定距離隔置されたポインタを介してアドレス指定される
ためである。
【００１５】請求項１による同期方法は、周期的に同期
ワードを送信し同時に少なくとも１つのポインタを介し
て、別個の符号化ワードを有するペイロードを含むデー
タ領域をアドレス指定するフレーム構成のシステムに適
する。
ワードを送信し同時に少なくとも１つのポインタを介し
て、別個の符号化ワードを有するペイロードを含むデー
タ領域をアドレス指定するフレーム構成のシステムに適
する。
【００１６】２つの異なったデータ構造（ＳＤＨシステ
ム、ＡＴＭセル）が識別されるべき場合には、請求項４
の方法が２つの安定状態への変化を与える。請求項９の
この方法を実行する回路は、単なるバイパス構造（フレ
ーム構造又はセル構造）ではなく全ての機能ブロックの
フレキシブルな使用が可能とされるようにスイッチング
ユニットにより機能ブロックのシーケンスを変更でき
る。そのため最小限の回路だけが必要とされる。
ム、ＡＴＭセル）が識別されるべき場合には、請求項４
の方法が２つの安定状態への変化を与える。請求項９の
この方法を実行する回路は、単なるバイパス構造（フレ
ーム構造又はセル構造）ではなく全ての機能ブロックの
フレキシブルな使用が可能とされるようにスイッチング
ユニットにより機能ブロックのシーケンスを変更でき
る。そのため最小限の回路だけが必要とされる。
【００１７】
【実施例】以下、本発明の実施例について図面を参照し
て詳細に説明する。
て詳細に説明する。
【００１８】ＣＣＩＴＴにより導入された同期デジタル
階層ＳＤＨにあっては、ＣＣＩＴＴ勧告Ｇ．７０８によ
り特定されたフレーム構造が使用されている。ＳＤＨフ
レームは１５５，５２０Kb／ｓ信号用のオクテットによ
る（ｏｃｔｅｔ−ｏｒｉｅｎｔｅｄ）同期トランスポー
トモジュールＳＴＭ−１から成っている。
階層ＳＤＨにあっては、ＣＣＩＴＴ勧告Ｇ．７０８によ
り特定されたフレーム構造が使用されている。ＳＤＨフ
レームは１５５，５２０Kb／ｓ信号用のオクテットによ
る（ｏｃｔｅｔ−ｏｒｉｅｎｔｅｄ）同期トランスポー
トモジュールＳＴＭ−１から成っている。
【００１９】図１に示されているように、このフレーム
は各１オクテットに対して２７０列及び９行から成って
いる。９×９オクテットはセクションオーバーヘッドＳ
ＯＨに専用され、２６１×９オクテットは「ペイロー
ド」と呼ばれる有用な情報に専用されている。
は各１オクテットに対して２７０列及び９行から成って
いる。９×９オクテットはセクションオーバーヘッドＳ
ＯＨに専用され、２６１×９オクテットは「ペイロー
ド」と呼ばれる有用な情報に専用されている。
【００２０】セクションオーバヘッドＳＯＨの第１列
は、６オクテット長を有し、フレーム同期に対して周期
的に送信される（図１）同期ワードＳＹＮＣを含んでい
る。
は、６オクテット長を有し、フレーム同期に対して周期
的に送信される（図１）同期ワードＳＹＮＣを含んでい
る。
【００２１】ペイロードは、１４９，７６Mb／ｓのビッ
トレートを有する非同期セル構成信号、ＡＴＭセルを送
信できるセル構成されたコンテナＣ４を含んでいる。
トレートを有する非同期セル構成信号、ＡＴＭセルを送
信できるセル構成されたコンテナＣ４を含んでいる。
【００２２】ＡＴＭセルは５３オクテットの周期を有し
ており、５オクテットはセルヘッダに対してのものであ
り、４８オクテットはペイロードに対してのものであ
る。セルヘッダは多項コードに符号化されており、その
結果未符号化ペイロードは受信端でセルヘッダを復号す
ることによりセルヘッダから区別することができる。
ており、５オクテットはセルヘッダに対してのものであ
り、４８オクテットはペイロードに対してのものであ
る。セルヘッダは多項コードに符号化されており、その
結果未符号化ペイロードは受信端でセルヘッダを復号す
ることによりセルヘッダから区別することができる。
【００２３】パスオーバーヘッドＰＯＨはコンテナＣ４
に接続されており、パスオーバーヘッド及びコンテナＣ
４は仮想コンテナＶＣ４を形成している。
に接続されており、パスオーバーヘッド及びコンテナＣ
４は仮想コンテナＶＣ４を形成している。
【００２４】仮想コンテナＶＣ４のフレーム及び高レベ
ルの同期トランスポートモジュールＳＴＭ−１のフレー
ムは互いに固定した位相関係は持っていないので、いわ
ゆるポインタ法が用いられる。
ルの同期トランスポートモジュールＳＴＭ−１のフレー
ムは互いに固定した位相関係は持っていないので、いわ
ゆるポインタ法が用いられる。
【００２５】第１のポインタＡＵ−４はセクションオー
バーヘッドＳＯＨの第４行に含まれており、仮想コンテ
ナＶＣ４をアドレス指定する。つまり、これはパスオー
バーヘッドＰＯＨを指示する。
バーヘッドＳＯＨの第４行に含まれており、仮想コンテ
ナＶＣ４をアドレス指定する。つまり、これはパスオー
バーヘッドＰＯＨを指示する。
【００２６】パスオーバーヘッドの第６行は、ＡＴＭセ
ルの開始、すなわちセルヘッダ（図１）をアドレス指定
する第２のポインタＨ４を含んでいる。
ルの開始、すなわちセルヘッダ（図１）をアドレス指定
する第２のポインタＨ４を含んでいる。
【００２７】図１のフレーム構造は本発明に必須の情報
だけを示している。より詳しい説明はＣＣＩＴＴ勧告
Ｇ．７０７，Ｇ．７０８及びＧ．７０９に含まれてい
る。
だけを示している。より詳しい説明はＣＣＩＴＴ勧告
Ｇ．７０７，Ｇ．７０８及びＧ．７０９に含まれてい
る。
【００２８】図１に示されているようなフレーム構造に
ついては、本発明の同期方法は図２の状態図を参照して
説明される。
ついては、本発明の同期方法は図２の状態図を参照して
説明される。
【００２９】同期ＳＹＮＣを確立するために、フレーム
同期ワードは、ビット毎に入力ビットシーケンスを、同
期ワードを表わす所定の基準ビットパターンに比較する
ことにより、ハントモードＨＵＮＴにおいてまず検出さ
れる。
同期ワードは、ビット毎に入力ビットシーケンスを、同
期ワードを表わす所定の基準ビットパターンに比較する
ことにより、ハントモードＨＵＮＴにおいてまず検出さ
れる。
【００３０】フレームはオクテットに分割されているの
で、フレーム同期ワードの検出の直後に、全ての以後の
オクテットが配列される。
で、フレーム同期ワードの検出の直後に、全ての以後の
オクテットが配列される。
【００３１】以後の事前同期状態ＰＲＥＳＹＮＣにおい
て、セクションオーバーヘッドＳＯＨの第４行に含まれ
ており同期ワードから一定距離隔置されている第１のポ
インタＡＵ−４が読み取られる。ＡＵ−４ポインタは、
仮想コンテナＶＣ４中の第１のオクテットすなわちパス
オーバーヘッドを指示する。パスオーバーヘッドＰＯＨ
の第６行は、ＡＴＭセルの開始、つまりセルヘッダをア
ドレス指定する第２のポインタＨ４を含んでいる。
て、セクションオーバーヘッドＳＯＨの第４行に含まれ
ており同期ワードから一定距離隔置されている第１のポ
インタＡＵ−４が読み取られる。ＡＵ−４ポインタは、
仮想コンテナＶＣ４中の第１のオクテットすなわちパス
オーバーヘッドを指示する。パスオーバーヘッドＰＯＨ
の第６行は、ＡＴＭセルの開始、つまりセルヘッダをア
ドレス指定する第２のポインタＨ４を含んでいる。
【００３２】セルヘッダが符号化されている多項コード
に基づいて、復号が実行される。所定数Ｘの連続した正
しいセルヘッダが検出されると、同期状態ＳＹＮＣへの
遷移が起きる。Ｘの値は例えば６である。
に基づいて、復号が実行される。所定数Ｘの連続した正
しいセルヘッダが検出されると、同期状態ＳＹＮＣへの
遷移が起きる。Ｘの値は例えば６である。
【００３３】本発明の方法は、周期的なフレーム同期ワ
ードを検出し、フレーム中から所定のポインタを読み取
り、そしてコードワード（セルヘッダ）を探すというも
のであり、完全なフレームが受信される前でさえも極め
て速い同期を可能とする。
ードを検出し、フレーム中から所定のポインタを読み取
り、そしてコードワード（セルヘッダ）を探すというも
のであり、完全なフレームが受信される前でさえも極め
て速い同期を可能とする。
【００３４】フレーム同期ワード及びセルヘッダが正し
い位置にあることがわかる限り、システムは同期状態Ｓ
ＹＮＣにとどまる。
い位置にあることがわかる限り、システムは同期状態Ｓ
ＹＮＣにとどまる。
【００３５】エラーメッセージに応答して、チェック状
態への遷移ＴＲＯＵＢＬＥが生ずる。数ｆの連続した誤
ったセルヘッダが数Ｚの連続したセルの範囲内で検出さ
れた場合には、ハントモードへの変化ＨＵＮＴが発生す
る。これは説明された同期化に続いている。
態への遷移ＴＲＯＵＢＬＥが生ずる。数ｆの連続した誤
ったセルヘッダが数Ｚの連続したセルの範囲内で検出さ
れた場合には、ハントモードへの変化ＨＵＮＴが発生す
る。これは説明された同期化に続いている。
【００３６】例えば、単一のビットエラーにより生じた
セルヘッダ誤りだけが報告され、かつ数Ｘの連続した正
しいセルヘッダが再び検出されると、システムは同期状
態ＳＹＮＣに復帰する。このように、多少の誤りが発生
した場合でも再同期は避けられる。
セルヘッダ誤りだけが報告され、かつ数Ｘの連続した正
しいセルヘッダが再び検出されると、システムは同期状
態ＳＹＮＣに復帰する。このように、多少の誤りが発生
した場合でも再同期は避けられる。
【００３７】本発明の同期方法は、周期的な同期ワード
を送信し、かつ少なくとも１つのポインタを介して、デ
ータが別個のコードで送信されるデータ領域をアドレス
指定するこれらのシステムに広く適用できる。
を送信し、かつ少なくとも１つのポインタを介して、デ
ータが別個のコードで送信されるデータ領域をアドレス
指定するこれらのシステムに広く適用できる。
【００３８】一方では前述のＳＤＨシステムについて、
他方では５３オクテットの周期を有するＡＴＭセルの純
粋なセル構成の送信については、本発明の回路は図３を
参照して説明され、また異なるデータ構造を識別する本
発明の方法は図４の状態図を参照して説明される。
他方では５３オクテットの周期を有するＡＴＭセルの純
粋なセル構成の送信については、本発明の回路は図３を
参照して説明され、また異なるデータ構造を識別する本
発明の方法は図４の状態図を参照して説明される。
【００３９】入力ラインＥＬに入力するビットシーケン
スがフレーム同期ワード検出ユニットＦＲＡＭＥに供給
され、ここで入力ビットシーケンスがビット毎にフレー
ム同期ワードを表わす所定の基準ビットパターンに比較
される。
スがフレーム同期ワード検出ユニットＦＲＡＭＥに供給
され、ここで入力ビットシーケンスがビット毎にフレー
ム同期ワードを表わす所定の基準ビットパターンに比較
される。
【００４０】フレーム同期ワード検出ユニットＦＲＡＭ
Ｅは、第１のスイッチ位置にある第１のスイッチングユ
ニットＳ１を介して、出力ラインＡＬに接続されたセル
ヘッダデコーダユニットＣＥＬＬに接続される。その結
果、フレーム同期ワード検出ユニットＦＲＡＭＥを透過
的に通過するビットシーケンスが、セルヘッダを表わす
正しく挿入されたコードワードについて略同時にチェッ
クできる。
Ｅは、第１のスイッチ位置にある第１のスイッチングユ
ニットＳ１を介して、出力ラインＡＬに接続されたセル
ヘッダデコーダユニットＣＥＬＬに接続される。その結
果、フレーム同期ワード検出ユニットＦＲＡＭＥを透過
的に通過するビットシーケンスが、セルヘッダを表わす
正しく挿入されたコードワードについて略同時にチェッ
クできる。
【００４１】図３において、スイッチングユニットの各
第１のスイッチ位置は実線で示され、第２のスイッチ位
置は破線で示されている。
第１のスイッチ位置は実線で示され、第２のスイッチ位
置は破線で示されている。
【００４２】フレーム同期ワードの検出後に、フレーム
同期ワード検出ユニットＦＲＡＭＥは、第２のスイッチ
位置にある第２のスイッチングユニットＳ２を介して、
配列手段ＡＬＩＧに接続され、続いてポインタ読み取り
手段ＳＯＨ，ＰＯＨに接続される。配列手段ＡＬＩＧは
受信ビットシーケンスをオクテットに配列する。つまり
オクテットバウンダリコレクションに配列する。ポイン
タ読み取り手段ＳＯＨ，ＰＯＨはフレーム同期ワードか
ら所定距離隔置されているポインタを読み取る。ポイン
タ読み取り手段ＳＯＨ，ＰＯＨは第２のスイッチ位置に
ある第１のスイッチングユニットＳ１を介してセルヘッ
ダデコーダユニットＣＥＬＬに接続されている。出力ラ
インＡＬは第２のスイッチ位置にある第３のスイッチン
グユニットＳ３を介してセルヘッダデコーダユニットＣ
ＥＬＬに接続されている（図３）。
同期ワード検出ユニットＦＲＡＭＥは、第２のスイッチ
位置にある第２のスイッチングユニットＳ２を介して、
配列手段ＡＬＩＧに接続され、続いてポインタ読み取り
手段ＳＯＨ，ＰＯＨに接続される。配列手段ＡＬＩＧは
受信ビットシーケンスをオクテットに配列する。つまり
オクテットバウンダリコレクションに配列する。ポイン
タ読み取り手段ＳＯＨ，ＰＯＨはフレーム同期ワードか
ら所定距離隔置されているポインタを読み取る。ポイン
タ読み取り手段ＳＯＨ，ＰＯＨは第２のスイッチ位置に
ある第１のスイッチングユニットＳ１を介してセルヘッ
ダデコーダユニットＣＥＬＬに接続されている。出力ラ
インＡＬは第２のスイッチ位置にある第３のスイッチン
グユニットＳ３を介してセルヘッダデコーダユニットＣ
ＥＬＬに接続されている（図３）。
【００４３】読み取り手段は、第１のポインタＡＵ−４
を読み取る第１の手段と、第２のポインタＨ４を読み取
る第２の手段とから成り、そのため符号化ワードはセル
ヘッダデコーダユニットＣＥＬＬにおいて復号できる
（図１）。第１のポインタＡＵ−４は、セクションオー
バーヘッドＳＯＨのＳＤＨフレーム、第４行、第１列な
いし第９列に含まれており、セル構成された仮想コンテ
ナＶＣ４のパスオーバーヘッドＰＯＨをアドレス指定す
る。第２のポインタＨ４は、パスオーバーヘッドＰＯＨ
の第６行に含まれており、ＡＴＭセルの開始、つまりセ
ルヘッダを示す。
を読み取る第１の手段と、第２のポインタＨ４を読み取
る第２の手段とから成り、そのため符号化ワードはセル
ヘッダデコーダユニットＣＥＬＬにおいて復号できる
（図１）。第１のポインタＡＵ−４は、セクションオー
バーヘッドＳＯＨのＳＤＨフレーム、第４行、第１列な
いし第９列に含まれており、セル構成された仮想コンテ
ナＶＣ４のパスオーバーヘッドＰＯＨをアドレス指定す
る。第２のポインタＨ４は、パスオーバーヘッドＰＯＨ
の第６行に含まれており、ＡＴＭセルの開始、つまりセ
ルヘッダを示す。
【００４４】フレーム同期ワードが検出されないが、１
つの正しいセルヘッダが復号されると、３つのスイッチ
ングユニットＳ１，Ｓ２及びＳ３の第１のスイッチ位置
が有効となる。そのため、入力ビットシーケンスは、フ
レーム同期ワード検出ユニットＦＲＡＭＥ及び第１のス
イッチングユニットＳ１を介してセルヘッダデコーダユ
ニットＣＥＬＬに送られ、次に第２のスイッチングユニ
ットＳ２を介してオクテット配列手段ＡＬＩＧに送ら
れ、更に第３のスイッチングユニットＳ３を介して出力
ラインＡＬに送られる（図３）。図３に示されているよ
うに、機能ブロックＦＲＡＭＥ，ＡＬＩＧ，ＳＯＨ，Ｐ
ＯＨ及びＣＥＬＬを制御するために、制御ユニットＣと
の接続が設けられている。
つの正しいセルヘッダが復号されると、３つのスイッチ
ングユニットＳ１，Ｓ２及びＳ３の第１のスイッチ位置
が有効となる。そのため、入力ビットシーケンスは、フ
レーム同期ワード検出ユニットＦＲＡＭＥ及び第１のス
イッチングユニットＳ１を介してセルヘッダデコーダユ
ニットＣＥＬＬに送られ、次に第２のスイッチングユニ
ットＳ２を介してオクテット配列手段ＡＬＩＧに送ら
れ、更に第３のスイッチングユニットＳ３を介して出力
ラインＡＬに送られる（図３）。図３に示されているよ
うに、機能ブロックＦＲＡＭＥ，ＡＬＩＧ，ＳＯＨ，Ｐ
ＯＨ及びＣＥＬＬを制御するために、制御ユニットＣと
の接続が設けられている。
【００４５】本発明の異なるデータ構造を識別する方法
は図４の状態図を参照して説明される。
は図４の状態図を参照して説明される。
【００４６】まず、初めに、ハントモードＨＵＮＴにお
いて、入力ビットシーケンスが、所定のフレーム同期ワ
ードについて次いで正常に発生したセルヘッダについて
チェックされる。
いて、入力ビットシーケンスが、所定のフレーム同期ワ
ードについて次いで正常に発生したセルヘッダについて
チェックされる。
【００４７】正しいフレーム同期ワードあるいは正しい
セルヘッダが検出されると、フレーム同期モードあるい
はセル同期モードへの変化が夫々生ずる。
セルヘッダが検出されると、フレーム同期モードあるい
はセル同期モードへの変化が夫々生ずる。
【００４８】１つの正しいセルヘッダが検出されると、
ＣＤ１（フレーム同期ワード検出されず）、セル事前同
期状態ＰＲＥ ＣＥＬＬへの遷移が生じる。少なくとも
６つの連続した正しいセルヘッダが検出されると、ＣＤ
Ｘ（Ｘ＝６）、安定セル同期状態ＣＥＬＬ ＳＹＮＣへ
の遷移が生ずる。
ＣＤ１（フレーム同期ワード検出されず）、セル事前同
期状態ＰＲＥ ＣＥＬＬへの遷移が生じる。少なくとも
６つの連続した正しいセルヘッダが検出されると、ＣＤ
Ｘ（Ｘ＝６）、安定セル同期状態ＣＥＬＬ ＳＹＮＣへ
の遷移が生ずる。
【００４９】セル事前状態ＰＲＥ ＣＥＬＬにおいてフ
レーム同期ワードが検出されると、ＦＳＤ１、フレーム
事前状態ＰＲＥ ＦＲＡＭＥへの遷移が生ずる。
レーム同期ワードが検出されると、ＦＳＤ１、フレーム
事前状態ＰＲＥ ＦＲＡＭＥへの遷移が生ずる。
【００５０】同様に、フレーム事前同期状態ＰＲＥ Ｆ
ＲＡＭＥにおいて、フレーム同期ワードが確認されない
が、所定数の正しいセルヘッダが検出されると、ＣＤ
Ｘ、セル事前同期状態ＰＲＥ ＣＥＬＬへの遷移が発生
する。
ＲＡＭＥにおいて、フレーム同期ワードが確認されない
が、所定数の正しいセルヘッダが検出されると、ＣＤ
Ｘ、セル事前同期状態ＰＲＥ ＣＥＬＬへの遷移が発生
する。
【００５１】このように、本発明によれば、ハントモー
ドＨＵＮＴからスタートして、２つの可能な安定状態Ｆ
ＲＡＭＥ ＳＹＮＣ及びＣＥＬＬ ＳＹＮＣがいつでも
到達できる。
ドＨＵＮＴからスタートして、２つの可能な安定状態Ｆ
ＲＡＭＥ ＳＹＮＣ及びＣＥＬＬ ＳＹＮＣがいつでも
到達できる。
【００５２】セル同期状態ＣＥＬＬ ＳＹＮＣにおい
て、数ｙの連続した正しいセルヘッダが検出されると、
ＮＰＣＤｙ、システムはセル事前同期状態ＰＲＥ ＣＥ
ＬＬに復帰する。別の誤ったセルヘッダが検出される
と、ＣＤ１、システムはハントモードへ復帰する。
て、数ｙの連続した正しいセルヘッダが検出されると、
ＮＰＣＤｙ、システムはセル事前同期状態ＰＲＥ ＣＥ
ＬＬに復帰する。別の誤ったセルヘッダが検出される
と、ＣＤ１、システムはハントモードへ復帰する。
【００５３】同様に、数ｙの連続した誤ったセルヘッダ
が検出されるかあるいは数ｍの連続したフレーム同期ワ
ードが検出されないと、フレーム同期状態ＦＲＡＭＥ
ＳＹＮＣからフレーム事前同期状態ＰＲＥ ＦＲＡＭＥ
への遷移が発生する。別のフレーム同期ワードが検出さ
れないと、ＦＳＤ１、このシステムはハントモードに復
帰する。
が検出されるかあるいは数ｍの連続したフレーム同期ワ
ードが検出されないと、フレーム同期状態ＦＲＡＭＥ
ＳＹＮＣからフレーム事前同期状態ＰＲＥ ＦＲＡＭＥ
への遷移が発生する。別のフレーム同期ワードが検出さ
れないと、ＦＳＤ１、このシステムはハントモードに復
帰する。
【００５４】本発明の方法は異なるデータ構造を区別す
るために別の情報を全く必要としない。また、本発明の
回路構成は、最小限の回路で、２つの機能的にそして基
本的に異なったデータ構造を信頼性をもって識別でき
る。
るために別の情報を全く必要としない。また、本発明の
回路構成は、最小限の回路で、２つの機能的にそして基
本的に異なったデータ構造を信頼性をもって識別でき
る。
【図１】同期デジタル階層ＳＤＨに配列されたフレーム
の構造を示す図。
の構造を示す図。
【図２】本発明の同期方法を説明する状態図。
【図３】本発明の回路の構成を示すブロック図。
【図４】本発明の異なったデータ構造を識別する方法を
説明する状態図。
説明する状態図。
ＦＲＡＭＥ フレーム同期ワード検出ユニット ＡＬＩＧ 配列手段 ＳＯＨ セクションオーバーヘッド ＰＯＨ パスオーバーヘッド ＣＥＬＬ セルヘッダデコードユニット Ｃ 制御ユニット ＥＬ 入力ライン ＡＬ 出力ライン Ｓ１，Ｓ２，Ｓ３ スイッチングユニット ＡＵ−４ ポインタ ＶＣ４ データ領域 ＶＣ４ 仮想コンテナ Ｃ４ コンテナ Ｈ４ ポインタ
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ローター・クランク ドイツ連邦共和国、7015 コルンタール − ミュンヒンゲン ２、シュテッテ ィナー・シュトラーセ 29 (56)参考文献 特開 平２−26428（ＪＰ，Ａ) (58)調査した分野(Int.Cl.7，ＤＢ名) H04L 12/28 H04J 3/00
Claims (11)
- 【請求項１】 同期デジタル階層に基づいてフレーム構
成されたシステムを同期する方法において、 入力ビットシーケンスを所定の基準ビットパターンと比
較することによりハントモード（ＨＵＮＴ）でフレーム
同期ワードを見つけるステップと、 事前同期状態（ＰＲＥＳＹＮＣ）に変化し、フレーム同
期ワードから所定距離間隔を置いて配置されかつデジタ
ル符号化ビットシーケンスを含むセル構成されたデータ
領域（ＶＣ４）をアドレス指定する少なくとも一つのポ
インタ（ＡＵ−４）を読み取るステップと、 セルヘッダを示すビットシーケンスに正常に挿入された
符号化ワードを復号するステップと、及び所定数の連続
した正しいセルヘッダが復号されると同期状態（ＳＹＮ
Ｃ）に変化するステップと、 の各ステップを含むことを特徴とする同期方法。 - 【請求項２】 オクテットによる同期トランスポートモ
ジュール（ＳＴＭ−１）を用いたＣＣＩＴＴ勧告Ｇ．７
０８に基づくフレーム構造を用いるステップと、 セクションオーバーヘッド（ＳＯＨ）中のトランスポー
トモジュールのフレームの開始を識別するフレーム同期
ワードを検出し、ビットシーケンスをオクテットに配列
するステップと、 セクションオーバーヘッド（ＳＯＨ）の第４行、第１列
ないし第９列に含まれており、セル構造の仮想コンテナ
（ＶＣ４）のパスオーバーヘッド（ＰＯＨ）をアドレス
指定する第１のポインタ（ＡＵ−４）を読み取るステッ
プと、 パスオーバーヘッド（ＰＯＨ）の第６行に含まれてお
り、セル構造のコンテナ（Ｃ４）のセルヘッダをアドレ
ス指定する第２のポインタ（Ｈ４）を読み取るステップ
と、及び所定数の正しいセルヘッダが復号されると同期
状態（ＳＹＮＣ）に変化するステップと、 の各ステップを含む請求項１記載の同期方法。 - 【請求項３】 フレーム同期ワード及びセルヘッダが正
しいと判断される限りは同期状態（ＳＹＮＣ）にとどま
るステップと、 フレーム同期ワードかセルヘッダが誤りと判断されると
チェック状態（ＴＲＯＵＢＬＥ）に変化するステップ
と、及びＺ及びｆが０より大きい整数であり、誤りのセ
ルヘッダの数ｆが連続したセルの数Ｚの範囲内で検出さ
れると再同期を開始するステップと、またはＸが０より
大きい整数であり、連続した正しいセルヘッダの数Ｘが
検出されると同期状態（ＳＹＮＣ）に変化するステップ
と、 の各ステップを含む請求項１ないし２記載の同期方法。 - 【請求項４】 非同期トランスポートモジュール伝送シ
ステムに用いる異なるデータ構造を識別する方法におい
て、 所定のフレーム同期ワードについて入力ビットシーケン
スをチェックし（ＨＵＮＴ）、続いてセルヘッダを示す
正しく挿入された符号化ワードについてビットシーケン
スをチェックする（ＨＵＮＴ）ステップと、 フレーム同期ワードが検出される度にフレーム同期モー
ドに変化するステップと、及び連続した正しいセルヘッ
ダの所定の数が検出される度にセル同期モードに変化す
るステップと、 の各ステップを含むことを特徴とする識別方法。 - 【請求項５】 ＣＣＩＴＴ勧告Ｇ．７０８に特定されて
いるフレーム構造を有するフレーム同期ワードが一時的
に検出されると、フレーム事前同期状態（ＰＲＥ ＦＲ
ＡＭＥ）に変化するステップと、 フレーム同期ワードから所定距離間隔を置いて配置され
かつセル構成されたデータ領域（ＶＣ４）をアドレス指
定する少なくとも１つのポインタ（ＡＵ−４）を読み取
るステップと、及び 前記セル構造のデータ領域内の第１
の所定数の正しいセルヘッダおよび第２の所定数の正し
いフレーム同期ワードとが一時的に検出された後にフレ
ーム同期状態（ＦＲＡＭＥ ＳＹＮＣ）に変化するステ
ップと、 の各ステップを含む請求項４記載の識別方法。 - 【請求項６】 １つの正しいセルヘッダが検出されると
セル事前同期状態（ＰＲＥ ＣＥＬＬ）に変化するステ
ップと、及び少なくとも６つの連続した正しいセルヘッ
ダが検出されるとセル同期状態（ＣＥＬＬ ＳＹＮＣ）
に変化するステップと、 の各ステップを含む請求項４記載の識別方法。 - 【請求項７】 フレーム同期ワードがセル事前同期状態
（ＰＲＥ ＣＥＬＬ）において検出されるとフレーム事
前同期状態（ＰＲＥ ＦＲＡＭＥ）に変化するステップ
を含む請求項６記載の識別方法。 - 【請求項８】 フレーム事前同期状態（ＰＲＥ ＦＲＡ
ＭＥ）において所定フレーム同期ワードが確認されず、
所定数の正しいセルヘッダが検出されると、セル事前同
期状態（ＰＲＥ ＣＥＬＬ）に変化するステップを含む
請求項５記載の識別方法。 - 【請求項９】 請求項４ないし８に記載の方法を実行す
る回路であって、入力ライン（ＥＬ）に接続されたフレ
ーム同期ワード検出ユニット（ＦＲＡＭＥ）が、第１の
スイッチ位置にある第１のスイッチングユニット（Ｓ
１）を介して、出力ライン（ＡＬ）に接続されたセルヘ
ッダデコーダユニット（ＣＥＬＬ）に接続されており、
フレーム同期ワードの検出後には、前記フレーム同期ワ
ード検出ユニット（ＦＲＡＭＥ）が、第２のスイッチ位
置にある第２のスイッチングユニット（Ｓ２）を介し
て、前記フレーム同期ワードから所定距離間隔を置いて
配置されたポインタを読み取る手段（ＳＯＨ，ＰＯＨ）
に接続され、一方、前記読み取り手段（ＳＯＨ，ＰＯ
Ｈ）が、第２のスイッチ位置にある前記第１のスイッチ
ングユニット（Ｓ１）を介して、前記セルヘッダデコー
ダユニット（ＣＥＬＬ）に接続されることを特徴とする
識別回路。 - 【請求項１０】 前記ポインタ読み取り手段（ＳＯＨ，
ＰＯＨ）が、受信ビットシーケンスをオクテットに配列
する手段（ＡＬＩＧ）によって先行されており、前記配
列手段（ＡＬＩＧ）が、第１のスイッチ位置にある前記
第２のスイッチングユニット（Ｓ２）を介して、前記セ
ルヘッダデコーダユニット（ＣＥＬＬ）に接続され、か
つ第２のスイッチ位置にある前記フレーム同期ワード検
出ユニット（ＦＲＡＭＥ）に接続されており、前記出力
ライン（ＡＬ）が、第１のスイッチ位置にある第３のス
イッチングユニット（Ｓ３）を介して前記配列手段（Ａ
ＬＩＧ）に接続され、かつ第２のスイッチ位置にある前
記セルヘッダデコーダユニット（ＣＥＬＬ）に接続され
ている請求項９記載の識別回路。 - 【請求項１１】 ＣＣＩＴＴ勧告Ｇ．７０８に特定され
たフレーム構造が使用される場合、前記読み取り手段
（ＳＯＨ，ＰＯＨ）が、セクションオーバーヘッド（Ｓ
ＯＨ）の第４行、第１列ないし第９列に含まれており、
セル構成された仮想コンテナ（ＶＣ４）のパスオーバー
ヘッド（ＰＯＨ）をアドレス指定する第１のポインタ
（ＡＵ−４）を読み取る第１の手段と、前記 パスオーバーヘッド（ＰＯＨ）の第６行に含まれて
おり、コンテナ（Ｃ４）のセルヘッダをアドレス指定す
る第２のポインタを読み取る第２の手段とから成る請求
項１０記載の識別回路。
Applications Claiming Priority (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE19904012762 DE4012762A1 (de) | 1990-04-21 | 1990-04-21 | Verfahren zur synchronisation eines nach einer digitalen synchronen hierarchie rahmenstrukturierten systemes |
| DE19904015283 DE4015283A1 (de) | 1990-05-12 | 1990-05-12 | Verfahren und schaltungsanordnung zum erkennen unterschiedlicher datenstrukturen fuer asynchrone transport module uebertragende systeme |
| DE4012762:1 | 1990-05-12 | ||
| DE4015283:9 | 1990-05-12 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04229743A JPH04229743A (ja) | 1992-08-19 |
| JP3205351B2 true JP3205351B2 (ja) | 2001-09-04 |
Family
ID=25892422
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9075591A Expired - Fee Related JP3205351B2 (ja) | 1990-04-21 | 1991-04-22 | 同期デジタル階層システムの同期方法及び異なるデータ構造を識別する方法及びその回路 |
Country Status (9)
| Country | Link |
|---|---|
| US (1) | US5251239A (ja) |
| EP (1) | EP0453876B1 (ja) |
| JP (1) | JP3205351B2 (ja) |
| AT (1) | ATE154483T1 (ja) |
| AU (2) | AU642235B2 (ja) |
| CA (1) | CA2040085C (ja) |
| DE (1) | DE59108745D1 (ja) |
| ES (1) | ES2104629T3 (ja) |
| FI (1) | FI105376B (ja) |
Families Citing this family (24)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB2266979A (en) * | 1992-05-12 | 1993-11-17 | Apple Computer | Phase register for synchronization of multiple signal processors. |
| JP3306938B2 (ja) * | 1992-11-25 | 2002-07-24 | ソニー株式会社 | 同期符号抽出回路 |
| FI93289C (fi) * | 1993-03-16 | 1995-03-10 | Nokia Telecommunications Oy | Menetelmä ehdollisten kytkentöjen ohjaamiseksi synkronisessa digitaalisessa tietoliikennejärjestelmässä |
| FI93287C (fi) * | 1993-03-16 | 1995-03-10 | Nokia Telecommunications Oy | Menetelmä toisiinsa kytkettyjen SDH- ja PDH-tietoliikenneverkkojen synkronoimiseksi |
| FI93288C (fi) * | 1993-03-16 | 1995-03-10 | Nokia Telecommunications Oy | Menetelmä ehdollisten kytkentöjen ohjaamiseksi tietoliikennejärjestelmässä |
| FR2709899B1 (fr) * | 1993-09-07 | 1995-11-10 | Sagem | Procédé de détection d'une perte de synchronisation dans un réseau numérique de communication et terminal pour la mise en Óoeuvre du procédé. |
| US5646947A (en) * | 1995-03-27 | 1997-07-08 | Westinghouse Electric Corporation | Mobile telephone single channel per carrier superframe lock subsystem |
| US5963564A (en) * | 1995-06-13 | 1999-10-05 | Telefonaktiebolaget Lm Ericsson | Synchronizing the transmission of data via a two-way link |
| US6452927B1 (en) | 1995-12-29 | 2002-09-17 | Cypress Semiconductor Corporation | Method and apparatus for providing a serial interface between an asynchronous transfer mode (ATM) layer and a physical (PHY) layer |
| US5684727A (en) * | 1996-02-07 | 1997-11-04 | Macdonald, Dettwiler And Associates Ltd. | High-speed correlator |
| DE19653261A1 (de) | 1996-12-20 | 1998-06-25 | Alsthom Cge Alcatel | Synchrones digitales Nachrichtenübertragungssystem, Steuerungseinrichtung, Netzelement und zentraler Taktgenerator |
| GB9718831D0 (en) * | 1997-09-05 | 1997-11-12 | Plessey Telecomm | Data transmission in an sdh network |
| DE19740106A1 (de) | 1997-09-12 | 1999-03-18 | Alsthom Cge Alcatel | Verfahren zum Einrichten von logischen Verbindungen in einem synchronen digitalen Nachrichtenübertragungsnetz, Netzelement und Managementsystem |
| DE19740107A1 (de) | 1997-09-12 | 1999-03-18 | Alsthom Cge Alcatel | Verfahren zum Übertragen von Datenpaketen und zur Durchführung des Verfahrens geeignetes Netzelement |
| DE19813168A1 (de) * | 1998-03-25 | 1999-09-30 | Siemens Ag | Verfahren zur Datenübertragung, Codierer sowie Decodierer |
| JP3411214B2 (ja) | 1998-05-22 | 2003-05-26 | 三菱電機株式会社 | ディジタル無線通信系の受信処理方法および受信機 |
| US6584118B1 (en) * | 1998-08-27 | 2003-06-24 | Nortel Networks Limited | Payload mapping in synchronous networks |
| US6381243B1 (en) * | 1998-09-18 | 2002-04-30 | Telefonaktiebolaget Lm Ericsson (Publ) | Determining time slot delay for ATM transmission |
| JP2000324116A (ja) * | 1999-05-06 | 2000-11-24 | Nec Ic Microcomput Syst Ltd | フレーム同期方法およびフレーム同期回路 |
| EP1077562A1 (de) * | 1999-08-17 | 2001-02-21 | Siemens Aktiengesellschaft | Verfahren zur Synchronisierung von Datenpaketen variabler Länge in einem bit-orientierten Kanal |
| US20020159483A1 (en) * | 2001-04-26 | 2002-10-31 | International Business Machines Corporation | SDH/SONET frame byte alignment unit |
| JP2012094975A (ja) * | 2010-10-25 | 2012-05-17 | Fujitsu Telecom Networks Ltd | 光パケットスイッチ装置 |
| WO2013177665A1 (en) | 2012-06-01 | 2013-12-05 | Research In Motion Limited | Universal synchronization engine based on probabilistic methods for guarantee of lock in multiformat audio systems |
| US9479275B2 (en) | 2012-06-01 | 2016-10-25 | Blackberry Limited | Multiformat digital audio interface |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE2351478C3 (de) * | 1973-10-13 | 1981-10-01 | Licentia Patent-Verwaltungs-Gmbh, 6000 Frankfurt | Verfahren zur Synchronisation des Zeitrahmens im Empfänger eines Zeitmultiplex-Übertragungssystems auf den Zeitrahmen des Senders |
| DE3735377A1 (de) * | 1987-10-19 | 1989-04-27 | Siemens Ag | Verfahren zur synchronisation eines zeitmultiplexsystems fuer eine uebertragung von paketen einheitlicher laenge |
| JP2531272B2 (ja) * | 1988-08-11 | 1996-09-04 | 日本電気株式会社 | フレ―ム同期制御方式 |
| DE3833184A1 (de) * | 1988-09-30 | 1990-04-05 | Standard Elektrik Lorenz Ag | Verfahren und schaltungsanordnung zur herstellung einer rahmensynchronisation in einem zeitmultiplexsystem |
| KR910005493B1 (ko) * | 1988-12-14 | 1991-07-31 | 한국전기통신공사 | 동기식 다중화 장치의 리프레임 회로 |
| GB8910255D0 (en) * | 1989-05-04 | 1989-06-21 | Stc Plc | Data stream frame synchronisation |
-
1991
- 1991-04-11 EP EP91105725A patent/EP0453876B1/de not_active Expired - Lifetime
- 1991-04-11 ES ES91105725T patent/ES2104629T3/es not_active Expired - Lifetime
- 1991-04-11 AT AT91105725T patent/ATE154483T1/de active
- 1991-04-11 DE DE59108745T patent/DE59108745D1/de not_active Expired - Fee Related
- 1991-04-15 CA CA002040085A patent/CA2040085C/en not_active Expired - Fee Related
- 1991-04-16 AU AU75036/91A patent/AU642235B2/en not_active Ceased
- 1991-04-19 FI FI911921A patent/FI105376B/fi not_active IP Right Cessation
- 1991-04-22 US US07/690,165 patent/US5251239A/en not_active Expired - Fee Related
- 1991-04-22 JP JP9075591A patent/JP3205351B2/ja not_active Expired - Fee Related
-
1993
- 1993-08-09 AU AU44507/93A patent/AU647336B2/en not_active Ceased
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04229743A (ja) | 1992-08-19 |
| AU7503691A (en) | 1991-10-24 |
| AU647336B2 (en) | 1994-03-17 |
| DE59108745D1 (de) | 1997-07-17 |
| FI105376B (fi) | 2000-07-31 |
| AU4450793A (en) | 1993-10-21 |
| FI911921A (fi) | 1991-10-22 |
| ES2104629T3 (es) | 1997-10-16 |
| FI911921A0 (fi) | 1991-04-19 |
| ATE154483T1 (de) | 1997-06-15 |
| AU642235B2 (en) | 1993-10-14 |
| CA2040085A1 (en) | 1991-10-22 |
| US5251239A (en) | 1993-10-05 |
| EP0453876B1 (de) | 1997-06-11 |
| EP0453876A3 (en) | 1992-10-14 |
| EP0453876A2 (de) | 1991-10-30 |
| CA2040085C (en) | 1997-02-11 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JP3205351B2 (ja) | 同期デジタル階層システムの同期方法及び異なるデータ構造を識別する方法及びその回路 | |
| US5568486A (en) | Integrated user network interface device | |
| JP2948464B2 (ja) | 非同期転送モード（ａｔｍ）ペイロード同期装置 | |
| EP0503667B1 (en) | A CRC operating method and an HEC synchronizing unit in the ATM switching method | |
| EP1091513B1 (en) | Semi transparent tributary for synchronous transmission | |
| US5072449A (en) | Packet framing using cyclic redundancy checking | |
| US5220563A (en) | Device for the transmission by an asynchronous network, notably an atm type network, of signalling data, channel by channel, assembled in a multiframe transmitted synchronously in out-of-band mode | |
| JPH04261239A (ja) | デジタルｔｄｍデータストリームをポインタ処理する方法およびシステム | |
| JP2001308863A (ja) | インタフェース装置 | |
| US6256326B1 (en) | Pseudo-synchronization prevention method in SDH transmission mode, pseudo-synchronization preventing SDH transmission system, and transmitter-receiver in pseudo-synchronization preventing SDH transmission system | |
| JPH02226926A (ja) | 多重チャネルｐｃｍタイプのリング上にｈｄｌｃフレームを伝送するためのシステム | |
| US4472811A (en) | Subscribers loop synchronization | |
| US7227844B1 (en) | Non-standard concatenation mapping for payloads | |
| EP1111827A2 (en) | STS-n with enhanced granularity | |
| CA2360951A1 (en) | Method for converting nxstm-1 signals into stm-n signals | |
| US20020159483A1 (en) | SDH/SONET frame byte alignment unit | |
| JP3282707B2 (ja) | クロスコネクト回路およびこれを用いた端局装置 | |
| JP3181205B2 (ja) | Ｓｄｈインタフェース送信回路及びｓｄｈインタフェース受信回路 | |
| KR100271311B1 (ko) | 광가입자 전송장치에서의 관리단위신호에 대한 관리단위 포인터및 계위단위 포인터 처리장치 | |
| KR100255807B1 (ko) | 수요밀집형 광 가입자 전송장치의 광 송수신장치 | |
| KR19980020862A (ko) | 비동기 전송모드(atm) 셀 기반 전송방식의 프레임 동기장치 | |
| JP2962472B2 (ja) | フレーム位相変換回路、クロスコネクト装置および受信装置 | |
| JPH11112510A (ja) | 回線終端装置 | |
| Uematsu et al. | A Universal Structure for SDH Multiplex Line Terminals with a Unique CMOS LSI for SOH Processing | |
| JPH04252535A (ja) | Ａｔｍ映像符号化伝送装置 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |