JP2713009B2 - 遅延時間差吸収装置 - Google Patents
遅延時間差吸収装置Info
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- JP2713009B2 JP2713009B2 JP4091138A JP9113892A JP2713009B2 JP 2713009 B2 JP2713009 B2 JP 2713009B2 JP 4091138 A JP4091138 A JP 4091138A JP 9113892 A JP9113892 A JP 9113892A JP 2713009 B2 JP2713009 B2 JP 2713009B2
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- Japan
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- clock signal
- circuit
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Description
【０００１】
【産業上の利用分野】本発明は、ディジタル無線通信シ
ステムの遅延時間差吸収装置に利用する。特に、Ｎ（Ｎ
は自然数）本の入力信号をそれぞれ入力しフレーム同期
を確立するＮ個のフレーム同期回路から出力される出力
データ相互間の変動遅延時間差を吸収する遅延時間差吸
収装置に関するものである。
ステムの遅延時間差吸収装置に利用する。特に、Ｎ（Ｎ
は自然数）本の入力信号をそれぞれ入力しフレーム同期
を確立するＮ個のフレーム同期回路から出力される出力
データ相互間の変動遅延時間差を吸収する遅延時間差吸
収装置に関するものである。
【０００２】
【従来の技術】図２は従来例の遅延時間差吸収装置のブ
ロック構成図である。
ロック構成図である。
【０００３】従来、遅延時間差吸収装置は、図２に示す
ような構成となっていた。図２において、Ｎ本の入力信
号をＮ個のフレーム同期回路１1 〜１N でそれぞれフレ
ーム同期を確立し遅延時間差吸収回路４へ出力する。一
方、基準クロック供給回路５では、クロック供給装置な
ど外部から供給されたクロック信号を受信し、これを基
準クロック信号として遅延時間差吸収回路４へ出力す
る。Ｎ本の入力信号は、互いに周波数同期はしているが
位相が一致している保証はないので、無線回線へ送出す
るためには、ある一つの位相を基準としてＮ本のデータ
信号全てを揃える必要がある。このために、遅延時間差
吸収回路４では、基準クロック供給回路５から出力され
た基準クロック信号を基準として、Ｎ個のフレーム同期
回路１1 〜１N から出力されたＮ本のデータ信号の位相
を全て揃えた後に、無線回線へ送出していた。
ような構成となっていた。図２において、Ｎ本の入力信
号をＮ個のフレーム同期回路１1 〜１N でそれぞれフレ
ーム同期を確立し遅延時間差吸収回路４へ出力する。一
方、基準クロック供給回路５では、クロック供給装置な
ど外部から供給されたクロック信号を受信し、これを基
準クロック信号として遅延時間差吸収回路４へ出力す
る。Ｎ本の入力信号は、互いに周波数同期はしているが
位相が一致している保証はないので、無線回線へ送出す
るためには、ある一つの位相を基準としてＮ本のデータ
信号全てを揃える必要がある。このために、遅延時間差
吸収回路４では、基準クロック供給回路５から出力され
た基準クロック信号を基準として、Ｎ個のフレーム同期
回路１1 〜１N から出力されたＮ本のデータ信号の位相
を全て揃えた後に、無線回線へ送出していた。
【０００４】
【発明が解決しようとする課題】しかし、このような従
来例の遅延時間差吸収装置では、クロック供給装置など
外部から供給され基準クロック供給回路で受信するクロ
ック信号に障害が発生した場合には、全てのデータ信号
が無線回線へ正常な信号を送出することができなくなる
欠点があった。また、クロック供給装置などのような、
基準となるクロック信号を外部から供給する設備が必要
となり、ディジタル無線通信システム全体としての規模
が大きくなる欠点があった。
来例の遅延時間差吸収装置では、クロック供給装置など
外部から供給され基準クロック供給回路で受信するクロ
ック信号に障害が発生した場合には、全てのデータ信号
が無線回線へ正常な信号を送出することができなくなる
欠点があった。また、クロック供給装置などのような、
基準となるクロック信号を外部から供給する設備が必要
となり、ディジタル無線通信システム全体としての規模
が大きくなる欠点があった。
【０００５】本発明は上記の欠点を解決するもので、外
部からの基準クロック信号が不必要でその障害により正
常な信号を送出することができなくなることがなく、回
路規模を大幅に縮小できる遅延時間差吸収装置を提供す
ることを目的とする。
部からの基準クロック信号が不必要でその障害により正
常な信号を送出することができなくなることがなく、回
路規模を大幅に縮小できる遅延時間差吸収装置を提供す
ることを目的とする。
【０００６】
【課題を解決するための手段】本発明は、Ｎ（Ｎは自然
数）本の入力信号をそれぞれ入力しフレーム同期を確立
するＮ個のフレーム同期回路と、入力する基準クロック
信号に基づきこのＮ個のフレーム同期回路から出力され
るＮ個の出力データ相互間の変動遅延時間差を吸収する
遅延時間差吸収回路とを備えた遅延時間差吸収装置にお
いて、上記Ｎ個のフレーム同期回路は、それぞれ同期を
確立したクロック信号を出力する手段と、同期が外れた
ときおよび上位局からのＡＩＳ信号を検出したときにア
ラーム情報を出力する手段とを含み、上記Ｎ個のフレー
ム同期回路から出力されるクロック信号およびアラーム
情報をそれぞれ入力し、このアラーム情報を出力してい
ないフレーム同期回路がいずれであるかを検出してこの
入力したクロック信号およびこの検出されたアラーム回
路の情報を出力するアラーム検出回路と、このアラーム
検出回路の出力に基づき正常状態にあるクロック信号の
内の一つを選択して上記基準クロック信号として出力す
るクロック選択回路とを備えたことを特徴とする。
数）本の入力信号をそれぞれ入力しフレーム同期を確立
するＮ個のフレーム同期回路と、入力する基準クロック
信号に基づきこのＮ個のフレーム同期回路から出力され
るＮ個の出力データ相互間の変動遅延時間差を吸収する
遅延時間差吸収回路とを備えた遅延時間差吸収装置にお
いて、上記Ｎ個のフレーム同期回路は、それぞれ同期を
確立したクロック信号を出力する手段と、同期が外れた
ときおよび上位局からのＡＩＳ信号を検出したときにア
ラーム情報を出力する手段とを含み、上記Ｎ個のフレー
ム同期回路から出力されるクロック信号およびアラーム
情報をそれぞれ入力し、このアラーム情報を出力してい
ないフレーム同期回路がいずれであるかを検出してこの
入力したクロック信号およびこの検出されたアラーム回
路の情報を出力するアラーム検出回路と、このアラーム
検出回路の出力に基づき正常状態にあるクロック信号の
内の一つを選択して上記基準クロック信号として出力す
るクロック選択回路とを備えたことを特徴とする。
【０００７】
【作用】Ｎ個のフレーム同期回路は、それぞれ同期を確
立したクロック信号を出力し、同期が外れたときにアラ
ーム情報を出力する。アラーム検出回路はＮ個のフレー
ム同期回路から出力されるクロック信号およびアラーム
情報をそれぞれ入力し、このアラーム情報を出力してい
ないフレーム同期回路がいずれであるかを検出してこの
入力したクロック信号およびこの検出されたアラーム回
路の情報を出力する。クロック選択回路はアラーム検出
回路の出力に基づき正常状態にあるクロック信号の内の
一つを選択して基準クロック信号として遅延時間差吸収
回路に出力する。
立したクロック信号を出力し、同期が外れたときにアラ
ーム情報を出力する。アラーム検出回路はＮ個のフレー
ム同期回路から出力されるクロック信号およびアラーム
情報をそれぞれ入力し、このアラーム情報を出力してい
ないフレーム同期回路がいずれであるかを検出してこの
入力したクロック信号およびこの検出されたアラーム回
路の情報を出力する。クロック選択回路はアラーム検出
回路の出力に基づき正常状態にあるクロック信号の内の
一つを選択して基準クロック信号として遅延時間差吸収
回路に出力する。
【０００８】以上により外部からの基準クロック信号が
不必要でその障害により正常な信号を送出することがで
きなくなることがなく、回路規模を大幅に縮小できる。
不必要でその障害により正常な信号を送出することがで
きなくなることがなく、回路規模を大幅に縮小できる。
【０００９】
【実施例】本発明の実施例について図面を参照して説明
する。図１は本発明一実施例遅延時間差吸収装置のブロ
ック構成図である。
する。図１は本発明一実施例遅延時間差吸収装置のブロ
ック構成図である。
【００１０】図１において、遅延時間差吸収装置は、Ｎ
（Ｎは自然数）本の入力信号をそれぞれ入力しフレーム
同期を確立するＮ個のフレーム同期回路１1 〜１N と、
入力する基準クロック信号に基づきこのＮ個のフレーム
同期回路１から出力されるＮ個の出力データ相互間の変
動遅延時間差を吸収する遅延時間差吸収回路４とを備え
る。
（Ｎは自然数）本の入力信号をそれぞれ入力しフレーム
同期を確立するＮ個のフレーム同期回路１1 〜１N と、
入力する基準クロック信号に基づきこのＮ個のフレーム
同期回路１から出力されるＮ個の出力データ相互間の変
動遅延時間差を吸収する遅延時間差吸収回路４とを備え
る。
【００１１】ここで本発明の特徴とするところは、Ｎ個
のフレーム同期回路１は、それぞれ同期を確立したクロ
ック信号を出力する手段と、同期が外れたときにアラー
ム情報を出力する手段とを含み、Ｎ個のフレーム同期回
路１から出力されるクロック信号およびアラーム情報を
それぞれ入力し、このアラーム情報を出力していないフ
レーム同期回路がいずれであるかを検出してこの入力し
たクロック信号およびこの検出されたアラーム回路の情
報を出力するアラーム検出回路２と、アラーム検出回路
２の出力に基づき正常状態にあるクロック信号の内の一
つを選択して上記基準クロック信号として出力するクロ
ック選択回路３とを備えたことにある。
のフレーム同期回路１は、それぞれ同期を確立したクロ
ック信号を出力する手段と、同期が外れたときにアラー
ム情報を出力する手段とを含み、Ｎ個のフレーム同期回
路１から出力されるクロック信号およびアラーム情報を
それぞれ入力し、このアラーム情報を出力していないフ
レーム同期回路がいずれであるかを検出してこの入力し
たクロック信号およびこの検出されたアラーム回路の情
報を出力するアラーム検出回路２と、アラーム検出回路
２の出力に基づき正常状態にあるクロック信号の内の一
つを選択して上記基準クロック信号として出力するクロ
ック選択回路３とを備えたことにある。
【００１２】このような構成の遅延時間差吸収装置の動
作について説明する。
作について説明する。
【００１３】図１において、Ｎ個のフレーム同期回路１
1 〜１N では、互いに周波数同期はしているが位相の全
く異なるＮ本の入力信号に対して、各々からクロック信
号を抽出し、フレーム同期を確立する。アラーム検出回
路２では、Ｎ本の入力信号がそれぞれ正常に伝送されて
きているか判断する。すなわち、フレーム同期が確立し
ない状態や、または入力信号がフレーム同期回路１1 〜
１N に入力される以前に回線に何らかの障害が発生して
いることを表わすＡＩＳ（Ａｌａｒｍ Ｉｎｄｉｃａｔ
ｉｏｎ Ｓｉｇｎａｌ）状態でないかどうかのアラーム
情報を、Ｎ個のフレーム同期回路１1 〜１N からそれぞ
れ入力し、Ｎ本の入力信号の中でどの入力信号が正常で
あるかを判断する。
1 〜１N では、互いに周波数同期はしているが位相の全
く異なるＮ本の入力信号に対して、各々からクロック信
号を抽出し、フレーム同期を確立する。アラーム検出回
路２では、Ｎ本の入力信号がそれぞれ正常に伝送されて
きているか判断する。すなわち、フレーム同期が確立し
ない状態や、または入力信号がフレーム同期回路１1 〜
１N に入力される以前に回線に何らかの障害が発生して
いることを表わすＡＩＳ（Ａｌａｒｍ Ｉｎｄｉｃａｔ
ｉｏｎ Ｓｉｇｎａｌ）状態でないかどうかのアラーム
情報を、Ｎ個のフレーム同期回路１1 〜１N からそれぞ
れ入力し、Ｎ本の入力信号の中でどの入力信号が正常で
あるかを判断する。
【００１４】クロック選択回路３では、アラーム検出回
路２からの情報に基づきＮ個のフレーム同期回路１1 〜
１N からそれぞれ出力されたＮ本のクロック信号のうち
正常状態にあるものをいずれか１本選択する。遅延時間
差吸収回路４では、Ｎ個のフレーム同期回路１1 〜１N
で抽出されたＮ本のクロック信号相互間の位相差を吸収
するために、クロック選択回路３から出力されたクロッ
ク信号を用いて、Ｎ本のデータ信号の位相をすべて揃え
る。１本のクロック信号により位相を全て揃えられたＮ
本のデータ信号は、１組のデータ信号系列としてディジ
タル無線回線へ送出する。
路２からの情報に基づきＮ個のフレーム同期回路１1 〜
１N からそれぞれ出力されたＮ本のクロック信号のうち
正常状態にあるものをいずれか１本選択する。遅延時間
差吸収回路４では、Ｎ個のフレーム同期回路１1 〜１N
で抽出されたＮ本のクロック信号相互間の位相差を吸収
するために、クロック選択回路３から出力されたクロッ
ク信号を用いて、Ｎ本のデータ信号の位相をすべて揃え
る。１本のクロック信号により位相を全て揃えられたＮ
本のデータ信号は、１組のデータ信号系列としてディジ
タル無線回線へ送出する。
【００１５】ここで、いま、クロック選択回路３ではＩ
番目（１≦Ｉ≦Ｎ）の入力信号から抽出されたクロック
信号を選択しているとする。この状態で、Ｉ番目以外の
入力信号がアラーム状態となっても、Ｉ番目の入力信号
が正常である限り、Ｉ番目のクロック信号を選択したま
まである。また、Ｉ番目の入力信号にアラームが発生し
た場合には、アラーム検出回路２で、まず（Ｉ＋１）番
目の入力信号が正常状態にあるかどうかを判断し、正常
状態であれば（Ｉ＋１）番目のクロック信号を選択する
ようにクロック選択回路３に命令し、アラーム状態であ
れば次に（Ｉ＋２）番目の入力信号が正常状態にあるか
どうかを判断する。上述のようにして、Ｎ本の入力信号
からいずれか正常状態にあるクロック信号を選択するよ
うにする。
番目（１≦Ｉ≦Ｎ）の入力信号から抽出されたクロック
信号を選択しているとする。この状態で、Ｉ番目以外の
入力信号がアラーム状態となっても、Ｉ番目の入力信号
が正常である限り、Ｉ番目のクロック信号を選択したま
まである。また、Ｉ番目の入力信号にアラームが発生し
た場合には、アラーム検出回路２で、まず（Ｉ＋１）番
目の入力信号が正常状態にあるかどうかを判断し、正常
状態であれば（Ｉ＋１）番目のクロック信号を選択する
ようにクロック選択回路３に命令し、アラーム状態であ
れば次に（Ｉ＋２）番目の入力信号が正常状態にあるか
どうかを判断する。上述のようにして、Ｎ本の入力信号
からいずれか正常状態にあるクロック信号を選択するよ
うにする。
【００１６】
【発明の効果】以上説明したように、本発明は、外部か
らの基準クロック信号が不必要でその障害により正常な
信号を送出することができなくなることがなく、回路規
模を大幅に縮小できる優れた効果がある。
らの基準クロック信号が不必要でその障害により正常な
信号を送出することができなくなることがなく、回路規
模を大幅に縮小できる優れた効果がある。
【図１】本発明一実施例遅延時間差吸収装置のブロック
構成図。
構成図。
【図２】従来例の遅延時間差吸収装置のブロック構成
図。
図。
１1 〜１N フレーム同期回路 ２ アラーム検出回路 ３ クロック選択回路 ４ 遅延時間差吸収回路 ５ 基準クロック供給回路
Claims (1)
- 【請求項１】 Ｎ（Ｎは自然数）本の入力信号をそれぞ
れ入力しフレーム同期を確立するＮ個のフレーム同期回
路と、入力する基準クロック信号に基づきこのＮ個のフ
レーム同期回路から出力されるＮ個の出力データ相互間
の変動遅延時間差を吸収する遅延時間差吸収回路とを備
えた遅延時間差吸収装置において、 上記Ｎ個のフレーム同期回路は、それぞれ同期を確立し
たクロック信号を出力する手段と、同期が外れたときお
よび上位局からのＡＩＳ信号を検出したときにアラーム
情報を出力する手段とを含み、 上記Ｎ個のフレーム同期回路から出力されるクロック信
号およびアラーム情報をそれぞれ入力し、このアラーム
情報を出力していないフレーム同期回路がいずれである
かを検出してこの入力したクロック信号およびこの検出
されたアラーム回路の情報を出力するアラーム検出回路
と、このアラーム検出回路の出力に基づき正常状態にあ
るクロック信号の内の一つを選択して上記基準クロック
信号として出力するクロック選択回路とを備えたことを
特徴とする遅延時間差吸収装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4091138A JP2713009B2 (ja) | 1992-04-10 | 1992-04-10 | 遅延時間差吸収装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4091138A JP2713009B2 (ja) | 1992-04-10 | 1992-04-10 | 遅延時間差吸収装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05292077A JPH05292077A (ja) | 1993-11-05 |
| JP2713009B2 true JP2713009B2 (ja) | 1998-02-16 |
Family
ID=14018173
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4091138A Expired - Fee Related JP2713009B2 (ja) | 1992-04-10 | 1992-04-10 | 遅延時間差吸収装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2713009B2 (ja) |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5779738A (en) * | 1980-11-05 | 1982-05-19 | Nec Corp | Delay equalizing circuit |
| JPH0316441A (ja) * | 1989-06-14 | 1991-01-24 | Fujitsu Ltd | 従属同期クロック選択方式 |
| JPH03258046A (ja) * | 1990-03-08 | 1991-11-18 | Nec Corp | Ａｉｓ送出回路 |
| JPH0458631A (ja) * | 1990-06-28 | 1992-02-25 | Nec Corp | フレーム位相合わせ方式 |
-
1992
- 1992-04-10 JP JP4091138A patent/JP2713009B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05292077A (ja) | 1993-11-05 |
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Legal Events
| Date | Code | Title | Description |
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| FPAY | Renewal fee payment (event date is renewal date of database) |
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