JP2571024B2 - マルチチップモジュール - Google Patents
マルチチップモジュールInfo
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- Wire Bonding (AREA)
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
Description
【0001】
【産業上の利用分野】本発明はマルチチップモジュール
(以下MCMと記す)に関する。
(以下MCMと記す)に関する。
【0002】
【従来の技術】従来のMCMは、図4(a),(b)に
示すように、ガラスエポキシ基板1の上に設けた素子載
置部の周縁に沿って配置した接続端子2と、接続端子2
以外の素子載置部を含む表面を被覆して形成したソルダ
レジスト膜又はエッチングレジスト膜等からなる保護膜
3とを備えた回路基板の接続端子2にバンプ5を介して
電気的に接続して搭載した半導体チップ6と、この半導
体チップ6と回路基板との間の隙間に注入して加熱硬化
した封止樹脂7とを備えて構成される。
示すように、ガラスエポキシ基板1の上に設けた素子載
置部の周縁に沿って配置した接続端子2と、接続端子2
以外の素子載置部を含む表面を被覆して形成したソルダ
レジスト膜又はエッチングレジスト膜等からなる保護膜
3とを備えた回路基板の接続端子2にバンプ5を介して
電気的に接続して搭載した半導体チップ6と、この半導
体チップ6と回路基板との間の隙間に注入して加熱硬化
した封止樹脂7とを備えて構成される。
【0003】
【発明が解決しようとする課題】この従来のMCMは、
半導体チップと回路基板との隙間に液状の封止樹脂を注
入して充填させる際に、半導体チップと回路基板との間
隔が約40μmと狭く、液状の封止樹脂に含まれている
粒径約30μmのフィラーにより目詰りを生じ樹脂が流
れ込まなかったり、不均一な流れ込みによって気泡を生
じ、ボイドが発生し封止強度が低下して信頼性が低下す
るという問題点がある。
半導体チップと回路基板との隙間に液状の封止樹脂を注
入して充填させる際に、半導体チップと回路基板との間
隔が約40μmと狭く、液状の封止樹脂に含まれている
粒径約30μmのフィラーにより目詰りを生じ樹脂が流
れ込まなかったり、不均一な流れ込みによって気泡を生
じ、ボイドが発生し封止強度が低下して信頼性が低下す
るという問題点がある。
【0004】また、半導体チップを回路基板上に仮固定
するために、半導体チップの中央部に仮固定樹脂を設け
たものでは、仮固定樹脂の後側に封止樹脂が流れ込ま
ず、ボイドが発生するという問題もある。
するために、半導体チップの中央部に仮固定樹脂を設け
たものでは、仮固定樹脂の後側に封止樹脂が流れ込ま
ず、ボイドが発生するという問題もある。
【0005】本発明の目的は、回路基板上に搭載した半
導体チップと回路基板との間隙に流し込む封止樹脂の流
れを均一にしてボイドの発生を防ぎ、封止の信頼性を向
上させたMCMを提供することにある。
導体チップと回路基板との間隙に流し込む封止樹脂の流
れを均一にしてボイドの発生を防ぎ、封止の信頼性を向
上させたMCMを提供することにある。
【0006】
【課題を解決するための手段】本発明のマルチチップモ
ジュールは、絶縁基板上に設けた素子載置部に配置して
形成した接続端子と、前記接続端子以外の前記素子載置
部を含む表面を被覆して形成した絶縁性の保護膜と、前
記素子載置部の前記保護膜をパターニングして形成し且
つ前記素子載置部を横断して少くとも2箇所の前記接続
端子間を通りその先端が搭載する半導体チップの外周よ
りも外方に延在する溝とを備えた回路基板と、前記接続
端子に接続して前記回路基板上に搭載した半導体チップ
と、前記溝を含む前記回路基板と前記半導体チップとの
間隙に流し込んで封止した封止樹脂とを含んで構成され
る。
ジュールは、絶縁基板上に設けた素子載置部に配置して
形成した接続端子と、前記接続端子以外の前記素子載置
部を含む表面を被覆して形成した絶縁性の保護膜と、前
記素子載置部の前記保護膜をパターニングして形成し且
つ前記素子載置部を横断して少くとも2箇所の前記接続
端子間を通りその先端が搭載する半導体チップの外周よ
りも外方に延在する溝とを備えた回路基板と、前記接続
端子に接続して前記回路基板上に搭載した半導体チップ
と、前記溝を含む前記回路基板と前記半導体チップとの
間隙に流し込んで封止した封止樹脂とを含んで構成され
る。
【0007】
【実施例】次に、本発明について図面を参照して説明す
る。
る。
【0008】図1(a)は本発明の第1の実施例を示す
部分切欠平面図、図1(b)は図1(a)のA−A′線
断面図である。
部分切欠平面図、図1(b)は図1(a)のA−A′線
断面図である。
【0009】図1(a),(b)に示すように、厚さ
0.5mmのガラスエポキシ基板1の上に設けた素子載
置部の周縁に沿って接続端子2を120μmのピッチで
配置し、この接続端子2以外の素子載置部を含むガラス
エポキシ基板1の表面をソルダレジスト膜又はエッチン
グレジスト膜等からなる厚さ10〜15μmの絶縁性保
護膜3で被覆する。次に、保護膜3を選択的にエッチン
グして接続端子2の配列の対向する2辺の各接続端子の
間を通り且つ平行に配列した溝4を形成して回路基板を
構成する。
0.5mmのガラスエポキシ基板1の上に設けた素子載
置部の周縁に沿って接続端子2を120μmのピッチで
配置し、この接続端子2以外の素子載置部を含むガラス
エポキシ基板1の表面をソルダレジスト膜又はエッチン
グレジスト膜等からなる厚さ10〜15μmの絶縁性保
護膜3で被覆する。次に、保護膜3を選択的にエッチン
グして接続端子2の配列の対向する2辺の各接続端子の
間を通り且つ平行に配列した溝4を形成して回路基板を
構成する。
【0010】次に、半導体チップ6の電極パッドに半田
又は金,銅からなるバンプ5を形成したプリップチップ
のバンプ5を回路基板上の各接続端子2に接続して半導
体チップ6を搭載する。このときのバンプ5の径は約8
0μmであり、半導体チップ6と回路基板との間隔は溝
4の部分で50〜65μmとなる。また、溝4の端部は
半導体チップ6の周端より更に外方に突出している。次
に、溝4を含む回路基板と半導体チップとの間隙にシリ
カ等の平均粒径15μm(最大粒径30μm)のフィラ
ーを含む液状の封止樹脂7を溝4に沿って流し込み加熱
硬化させ、封止する。
又は金,銅からなるバンプ5を形成したプリップチップ
のバンプ5を回路基板上の各接続端子2に接続して半導
体チップ6を搭載する。このときのバンプ5の径は約8
0μmであり、半導体チップ6と回路基板との間隔は溝
4の部分で50〜65μmとなる。また、溝4の端部は
半導体チップ6の周端より更に外方に突出している。次
に、溝4を含む回路基板と半導体チップとの間隙にシリ
カ等の平均粒径15μm(最大粒径30μm)のフィラ
ーを含む液状の封止樹脂7を溝4に沿って流し込み加熱
硬化させ、封止する。
【0011】ここで液状の封止樹脂7は間隔が広がった
溝4内を円滑に流れるため、目詰りや気泡を生ずること
を防止でき、ボイドの発生を抑制できる。
溝4内を円滑に流れるため、目詰りや気泡を生ずること
を防止でき、ボイドの発生を抑制できる。
【0012】図2(a)は本発明の第2の実施例を示す
部分切欠平面図、図2(b)は図2(a)のB−B′線
断面図である。
部分切欠平面図、図2(b)は図2(a)のB−B′線
断面図である。
【0013】図2(a),(b)に示すように、素子載
置部の中央部に半導体チップ6を仮固定する仮固定樹脂
8を設け、この仮固定樹脂8の周囲に環状の溝4aを形
成した以外は第1の実施例と同様の構成を有しており、
環状の溝4aによって仮固定樹脂8の封止樹脂7の注入
側と反対側の陰になる部分にも封止樹脂7が容易に且つ
円滑に流れ込みボイドの発生を防止できる利点がある。
置部の中央部に半導体チップ6を仮固定する仮固定樹脂
8を設け、この仮固定樹脂8の周囲に環状の溝4aを形
成した以外は第1の実施例と同様の構成を有しており、
環状の溝4aによって仮固定樹脂8の封止樹脂7の注入
側と反対側の陰になる部分にも封止樹脂7が容易に且つ
円滑に流れ込みボイドの発生を防止できる利点がある。
【0014】図3は本発明の第3の実施例を示す部分切
欠平面図である。
欠平面図である。
【0015】図3に示すように、接続端子2の配列の一
端から放射状に溝4を形成した以外は第1の実施例と同
様の構成を有しており、半導体チップ6を搭載した素子
載置部の一端から溝4に沿って封止樹脂7を流し込むこ
とが可能となり、搭載した半導体チップの周囲に他の実
装部品が密集していて封止樹脂の注入個所に制約がある
場合に適用できる利点がある。
端から放射状に溝4を形成した以外は第1の実施例と同
様の構成を有しており、半導体チップ6を搭載した素子
載置部の一端から溝4に沿って封止樹脂7を流し込むこ
とが可能となり、搭載した半導体チップの周囲に他の実
装部品が密集していて封止樹脂の注入個所に制約がある
場合に適用できる利点がある。
【0016】なお、以上説明した実施例では、いずれも
半導体チップ6を回路基板上に搭載した後に回路基板と
半導体チップ6との間隙に封止樹脂を流し込む例につい
て説明したが、半導体チップ6のバンプ5を接続端子2
に接合する前に素子載置部に粘度の高い封止樹脂を設け
ており、半導体チップ6の金又は銅からなるバンプ5を
接続端子2に圧着して接合すると同時に封止樹脂を圧着
し、溝4に沿って半導体チップ6の周囲に押し広げて封
止しても良い。
半導体チップ6を回路基板上に搭載した後に回路基板と
半導体チップ6との間隙に封止樹脂を流し込む例につい
て説明したが、半導体チップ6のバンプ5を接続端子2
に接合する前に素子載置部に粘度の高い封止樹脂を設け
ており、半導体チップ6の金又は銅からなるバンプ5を
接続端子2に圧着して接合すると同時に封止樹脂を圧着
し、溝4に沿って半導体チップ6の周囲に押し広げて封
止しても良い。
【0017】
【発明の効果】以上説明したように本発明は、素子載置
部に形成した保護膜を選択的にエッチングして接続端子
の間を通る溝を形成することにより、搭載した半導体チ
ップと回路基板との間隙を封止する封止樹脂の流れを円
滑にしてフィラーによる目詰りや気泡の発生を防ぎ、封
止樹脂にボイドが生ずることを抑制できるという効果を
有する。
部に形成した保護膜を選択的にエッチングして接続端子
の間を通る溝を形成することにより、搭載した半導体チ
ップと回路基板との間隙を封止する封止樹脂の流れを円
滑にしてフィラーによる目詰りや気泡の発生を防ぎ、封
止樹脂にボイドが生ずることを抑制できるという効果を
有する。
【0018】また、溝の形成により、封止樹脂と回路基
板との接着面積が広くなり接着強度を強化でき、回路基
板と半導体チップとの熱膨張率の違いによる伸縮でバン
プ接合部に加わる応力を緩和でき、温度サイクルに対す
る耐性を向上できるという効果を有する。
板との接着面積が広くなり接着強度を強化でき、回路基
板と半導体チップとの熱膨張率の違いによる伸縮でバン
プ接合部に加わる応力を緩和でき、温度サイクルに対す
る耐性を向上できるという効果を有する。
【図1】本発明の第1の実施例を示す部分切欠平面図お
よびA−A′線断面図。
よびA−A′線断面図。
【図2】本発明の第2の実施例を示す部分切欠平面図お
よびB−B′線断面図。
よびB−B′線断面図。
【図3】本発明の第3の実施例を示す部分切欠平面図。
【図4】従来のマルチチップモジュールの一例を示す部
分切欠平面図およびC−C′線断面図。
分切欠平面図およびC−C′線断面図。
1 ガラスエポキシ基板 2 接続端子 3 保護膜 4,4a 溝 5 バンプ 6 半導体チップ 7 封止樹脂 8 仮固定樹脂
Claims (3)
- 【請求項1】 絶縁基板上に設けた素子載置部に配置し
て形成した接続端子と、前記接続端子以外の前記素子載
置部を含む表面を被覆して形成した絶縁性の保護膜と、
前記素子載置部の前記保護膜をパターニングして形成し
且つ前記素子載置部を横断して少くとも2箇所の前記接
続端子間を通りその先端が搭載する半導体チップの外周
よりも外方に延在する溝とを備えた回路基板と、前記接
続端子に接続して前記回路基板上に搭載した半導体チッ
プと、前記溝を含む前記回路基板と前記半導体チップと
の間隙に流し込んで封止した封止樹脂とを含むことを特
徴とするマルチチップモジュール。 - 【請求項2】 保護膜がソルダレジスト膜又はエッチン
グレジスト膜からなる請求項1記載のマルチチップモジ
ュール。 - 【請求項3】 素子載置部の中央部に設けた仮固定樹脂
を有する請求項1記載のマルチチップモジュール。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6232733A JP2571024B2 (ja) | 1994-09-28 | 1994-09-28 | マルチチップモジュール |
| US08/534,940 US5686763A (en) | 1994-09-28 | 1995-09-28 | Device module comprising a substrate having grooves fixed to circuit chips with improved sealing characteristics |
| US08/857,822 US5763295A (en) | 1994-09-28 | 1997-05-16 | Device module comprising a substrate having grooves fixed to circuit chips with improved sealing characteristics |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6232733A JP2571024B2 (ja) | 1994-09-28 | 1994-09-28 | マルチチップモジュール |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0897313A JPH0897313A (ja) | 1996-04-12 |
| JP2571024B2 true JP2571024B2 (ja) | 1997-01-16 |
Family
ID=16943933
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6232733A Expired - Lifetime JP2571024B2 (ja) | 1994-09-28 | 1994-09-28 | マルチチップモジュール |
Country Status (2)
| Country | Link |
|---|---|
| US (2) | US5686763A (ja) |
| JP (1) | JP2571024B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008004607A (ja) * | 2006-06-20 | 2008-01-10 | Matsushita Electric Ind Co Ltd | 回路基板及び電子部品の実装方法 |
Families Citing this family (30)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1997016848A1 (en) * | 1995-10-31 | 1997-05-09 | Ibiden Co., Ltd. | Electronic part module and process for manufacturing the same |
| JPH10270624A (ja) * | 1997-03-27 | 1998-10-09 | Toshiba Corp | チップサイズパッケージ及びその製造方法 |
| JPH10341068A (ja) * | 1997-06-06 | 1998-12-22 | Sony Corp | プリント配線基板及び電子部品の実装方法 |
| US6049122A (en) * | 1997-10-16 | 2000-04-11 | Fujitsu Limited | Flip chip mounting substrate with resin filled between substrate and semiconductor chip |
| JP3278055B2 (ja) | 1998-06-30 | 2002-04-30 | セイコーインスツルメンツ株式会社 | 電子回路装置 |
| JP3907845B2 (ja) * | 1998-08-18 | 2007-04-18 | 沖電気工業株式会社 | 半導体装置 |
| US6246124B1 (en) | 1998-09-16 | 2001-06-12 | International Business Machines Corporation | Encapsulated chip module and method of making same |
| US6410364B1 (en) * | 1998-09-30 | 2002-06-25 | Seiko Epson Corporation | Semiconductor device, method of connecting a semiconductor chip, circuit board, and electronic equipment |
| DE19908474C2 (de) * | 1999-02-26 | 2001-02-15 | Siemens Ag | Verfahren zur Montage eines Halbleiterchips auf einer Tragschicht |
| DE19915651A1 (de) * | 1999-04-07 | 2000-07-06 | Siemens Ag | Halbleiterbauelement mit Distanzelementen zwischen einem Halbleiterchip und einem Systemträger |
| DE10039927B4 (de) * | 2000-08-16 | 2006-04-27 | Infineon Technologies Ag | Oberflächenmontierbares Gehäuse für ein elektronisches Bauelement |
| WO2002103793A1 (en) | 2001-06-07 | 2002-12-27 | Renesas Technology Corp. | Semiconductor device and manufacturing method thereof |
| US6860891B2 (en) * | 2001-09-28 | 2005-03-01 | Ethicen, Inc. | Arrangement and method for vascular anastomosis |
| JP2003264256A (ja) | 2002-03-08 | 2003-09-19 | Hitachi Ltd | 半導体装置 |
| FR2856520B1 (fr) * | 2003-06-17 | 2006-02-17 | St Microelectronics Sa | Dispositif semi-conducteur a billes de connexion electrique entre une puce de circuits integres et une plaque support et procede pour sa fabrication |
| US7033864B2 (en) * | 2004-09-03 | 2006-04-25 | Texas Instruments Incorporated | Grooved substrates for uniform underfilling solder ball assembled electronic devices |
| JP4692720B2 (ja) * | 2004-12-17 | 2011-06-01 | セイコーエプソン株式会社 | 配線基板、半導体装置及びその製造方法 |
| JP4692719B2 (ja) * | 2004-12-17 | 2011-06-01 | セイコーエプソン株式会社 | 配線基板、半導体装置及びその製造方法 |
| JP4502204B2 (ja) * | 2005-03-22 | 2010-07-14 | ルネサスエレクトロニクス株式会社 | 半導体装置 |
| JP2006317821A (ja) * | 2005-05-16 | 2006-11-24 | Nec Lcd Technologies Ltd | 液晶表示装置 |
| JP4536603B2 (ja) * | 2005-06-09 | 2010-09-01 | 新光電気工業株式会社 | 半導体装置の製造方法及び半導体装置用実装基板及び半導体装置 |
| JP2007158081A (ja) * | 2005-12-06 | 2007-06-21 | Shinko Electric Ind Co Ltd | 実装基板および半導体装置 |
| JP5117371B2 (ja) * | 2008-12-24 | 2013-01-16 | 新光電気工業株式会社 | 半導体装置およびその製造方法 |
| KR101046387B1 (ko) * | 2009-04-10 | 2011-07-05 | 주식회사 하이닉스반도체 | 반도체 패키지 |
| JP5783670B2 (ja) | 2009-08-11 | 2015-09-24 | 武蔵エンジニアリング株式会社 | 液体材料の塗布方法、塗布装置およびプログラム |
| JP5418367B2 (ja) * | 2010-03-30 | 2014-02-19 | 富士通株式会社 | プリント配線板ユニットおよび電子機器 |
| JP6214030B2 (ja) * | 2013-06-27 | 2017-10-18 | 太陽誘電株式会社 | 回路基板、回路モジュール、回路基板の製造方法及び回路モジュールの製造方法 |
| JP7021625B2 (ja) * | 2018-09-28 | 2022-02-17 | 豊田合成株式会社 | 発光装置 |
| CN110349945B (zh) * | 2019-07-15 | 2024-05-24 | 星科金朋半导体(江阴)有限公司 | 一种多芯片的封装结构及其封装方法 |
| EP4340005A1 (de) * | 2022-09-19 | 2024-03-20 | Siemens Aktiengesellschaft | Unterfülltes elektronikmodul mit fliessrichtungsleitstrukturen |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5299730A (en) * | 1989-08-28 | 1994-04-05 | Lsi Logic Corporation | Method and apparatus for isolation of flux materials in flip-chip manufacturing |
| US5656862A (en) * | 1990-03-14 | 1997-08-12 | International Business Machines Corporation | Solder interconnection structure |
| JPH0451057A (ja) * | 1990-06-18 | 1992-02-19 | Canon Inc | 画像形成装置 |
| FR2690278A1 (fr) * | 1992-04-15 | 1993-10-22 | Picogiga Sa | Composant photovoltaïque multispectral à empilement de cellules, et procédé de réalisation. |
| US5482896A (en) * | 1993-11-18 | 1996-01-09 | Eastman Kodak Company | Light emitting device comprising an organic LED array on an ultra thin substrate and process for forming same |
| US5579573A (en) * | 1994-10-11 | 1996-12-03 | Ford Motor Company | Method for fabricating an undercoated chip electrically interconnected to a substrate |
-
1994
- 1994-09-28 JP JP6232733A patent/JP2571024B2/ja not_active Expired - Lifetime
-
1995
- 1995-09-28 US US08/534,940 patent/US5686763A/en not_active Expired - Fee Related
-
1997
- 1997-05-16 US US08/857,822 patent/US5763295A/en not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008004607A (ja) * | 2006-06-20 | 2008-01-10 | Matsushita Electric Ind Co Ltd | 回路基板及び電子部品の実装方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0897313A (ja) | 1996-04-12 |
| US5686763A (en) | 1997-11-11 |
| US5763295A (en) | 1998-06-09 |
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