JP2000124259A - Icチップ、半導体装置、及び、半導体装置の製造方法 - Google Patents

Icチップ、半導体装置、及び、半導体装置の製造方法

Info

Publication number
JP2000124259A
JP2000124259A JP10289459A JP28945998A JP2000124259A JP 2000124259 A JP2000124259 A JP 2000124259A JP 10289459 A JP10289459 A JP 10289459A JP 28945998 A JP28945998 A JP 28945998A JP 2000124259 A JP2000124259 A JP 2000124259A
Authority
JP
Japan
Prior art keywords
chip
semiconductor device
solder
lands
printed circuit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP10289459A
Other languages
English (en)
Inventor
Kiyoshi Hasegawa
潔 長谷川
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Corp
Original Assignee
Sony Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sony Corp filed Critical Sony Corp
Priority to JP10289459A priority Critical patent/JP2000124259A/ja
Publication of JP2000124259A publication Critical patent/JP2000124259A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L24/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13099Material
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
    • H01L2224/1401Structure
    • H01L2224/1403Bump connectors having different sizes, e.g. different diameters, heights or widths
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73203Bump and layer connectors
    • H01L2224/73204Bump and layer connectors the bump connector being embedded into the layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01004Beryllium [Be]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01006Carbon [C]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01033Arsenic [As]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/013Alloys
    • H01L2924/014Solder alloys
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/095Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00 with a principal constituent of the material being a combination of two or more materials provided in the groups H01L2924/013 - H01L2924/0715
    • H01L2924/097Glass-ceramics, e.g. devitrified glass
    • H01L2924/09701Low temperature co-fired ceramic [LTCC]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/14Integrated circuits
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Electric Connection Of Electric Components To Printed Circuits (AREA)
  • Wire Bonding (AREA)

Abstract

(57)【要約】 【課題】 補強ランドを有していなくても電気的接続の
信頼性が高いICチップ、半導体装置、及び、半導体装
置の製造方法を提供する。 【解決手段】 半導体装置は、ICチップ20と、IC
チップ20を実装するプリント回路基板30とを備えて
いる。ICチップ20は、複数の同心状の円周上に、電
極に対応した半田ランド22を互いに離隔して有し、更
に、各半田ランド上にバンプ24を有する。プリント回
路基板30は、ICチップ20の半田ランド22に対応
する位置に半田ランド28を有する。これにより、プリ
ント回路基板30及びICチップ20の熱膨張係数が異
なっても、プリント回路基板30及びICチップ20を
相互に接合している接合部(半田)に加わる応力は、全
ての接合部に分散し、接合部が破断し難い。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、ICチップ、半導
体装置、及び、半導体装置の製造方法に関し、更に詳し
くは、補強ランドを有していなくても電気的接続の信頼
性が高いICチップ、半導体装置、及び、半導体装置の
製造方法に関するものである。
【0002】
【従来の技術】IC(Integrated Circuit)チップを直
接にプリント回路基板に実装する際、バンプと呼ばれる
半球状の電極を形成し、フェイスダウン方式、例えばフ
リップチップ方式で実装している。本明細書でICチッ
プとは、単なる集積回路ではなく、実装し得る状態の半
導体装置をいう。以下、図面を用いて従来例を説明す
る。図7は、ベアチップをICチップとしてプリント回
路基板上に実装してなる半導体装置の側面断面図であ
り、図8は、実装する前のICチップの背面図である。
従来の半導体装置1は、ICチップ1Aとプリント回路
基板6とを備えている。ICチップ1Aは、電極に対応
した半田ランド4及びその上のバンプ(半田バンプ)2
と、ICチップ1A−プリント回路基板6の間の接合補
強のために形成された補強ランド5及びその上の補強バ
ンプ3とを備えている。補強ランド5及び補強バンプ3
は、ICチップ1Aの背面の四隅に形成されている。バ
ンプ2は、補強バンプ3以外の領域にグリッド状に形成
されている。また、プリント回路基板6は、半田ランド
4及び補強ランド5に対応する位置に、それぞれ、半田
ランド7A及び補強ランド7Bを有する。
【0003】以下、ICチップ1A及びプリント回路基
板6に補強バンプ及び補強ランドが形成されている理由
を説明する。ICチップ1Aとプリント回路基板6と
は、熱膨張係数が異なるため、使用時等に生じる熱によ
ってこれらが膨張すると、バンプ2を溶融、固化してな
る接合部2Aに応力が加わる。最も大きな応力が加わる
接合部は、ICチップ1Aの中心から最も距離の遠い接
合部である。この応力により接合部が破断することを防
止し、実装後の電気的接続の長期的信頼性を得るため
に、充分に大きい寸法を有する補強バンプ3を四隅に設
けている。尚、応力が、補強バンプ3を溶融、固化して
なる補強部3Aにのみ集中することを防止するために、
ICチップ1Aとプリント回路基板6との間に封止用の
樹脂8を流入、固化させることもある。
【0004】また、図9は、従来のCSP(チップサイ
ズパッケージ又はチップスケールパッケージ)をプリン
ト回路基板上に実装してなる半導体装置の側面断面図で
あり、図10は、従来のCSPの背面図である。CSP
9は、小型化を目的としてICチップとほぼ同等の平面
寸法で形成されているが、ICチップ1Aと同様、電気
的接続の信頼性を向上させるために、半田ランド12及
びその上に形成されたバンプ10の他に、補強ランド1
3及びその上に形成された補強バンプ11を背面の四隅
に有する。また、CSP9を実装するプリント回路基板
14には、半田ランド12及び補強ランドに対応する位
置に、それぞれ、半田ランド16及び補強ランド18を
有する。
【0005】
【発明が解決しようとする課題】ところで、近年、電極
パッド数の増加、ICチップの寸法の縮小に伴い、再配
列された半田ランドやバンプのピッチも益々縮小せざる
を得ない。このため、以下の問題が生じていた。第1
に、種々の制約により、寸法の大きな補強バンプを四隅
に配置することが困難である。第2に、バンプのピッチ
を縮小するとバンプの寸法も小さくなり、これに伴い、
補強バンプの寸法もバンプに合わせて小さくする必要が
ある。その結果、補強バンプが高い応力に耐えられず、
補強バンプとしての機能を充分に有していないことが多
い。第3に、CSPであっても、前述のように背面の四
隅に補強ランド及び補強バンプを設ける必要があり、こ
のため、CSPの小型化が妨げられている。
【0006】以上のような事情に照らして、本発明の目
的は、補強ランドを有していなくても電気的接続の信頼
性が高いICチップ、半導体装置、及び、半導体装置の
製造方法を提供することである。
【0007】
【課題を解決するための手段】本発明者は、鋭意検討の
結果、半田ランドやバンプの配置を工夫することによ
り、上記目的を達成できることを見い出し、本発明を完
成するに至った。
【0008】上記目的を達成するために、本発明に係る
ICチップは、電極に対応した半田ランドを円周上に互
いに離隔して有することを特徴としている。好適には、
複数の同心状の円周上に半田ランドを有する。また、本
発明に係る半導体装置は、本発明に係るICチップと、
該ICチップの半田ランドに対応する位置に半田ランド
を有するプリント回路基板とを備え、ICチップがプリ
ント回路基板上に実装されていることを特徴としてい
る。これにより、補強ランドを有していなくても電気的
接続の信頼性の高い半導体装置が実現する。
【0009】好適には、ICチップ及びプリント回路基
板のそれぞれの半田ランドのうち最外円周上の半田ラン
ドの数が、何れも5以上である。本発明に係る半導体装
置では、ICチップが、チップサイズパッケージ、ボー
ルグリッドアレイパッケージ、及び、マルチチップモジ
ュールパッケージの何れかであってもよい。
【0010】本発明方法に係る半導体装置の製造方法
は、本発明に係る半導体装置を製造する方法であって、
プリント回路基板の半田ランド上にクリームはんだを被
着させ、リフロー法によりICチップを実装することを
特徴としている。本発明方法では、特にバンプを形成す
る必要はないが、ICチップの半田ランド上にバンプを
形成し、リフロー法によりプリント回路基板上にICチ
ップを実装することにより、ICチップとプリント回路
基板との電気的接続の信頼性を更に高くなる。
【0011】
【発明の実施の形態】以下に、実施形態例を挙げ、添付
図面を参照して、本発明の実施の形態を具体的かつより
詳細に説明する。実施形態例1 本実施形態例は、本発明に係るICチップを用いて本発
明に係る半導体装置を本発明方法により製造する例であ
る。図1は、本実施形態例のICチップの背面図であ
る。本実施形態例のICチップ20は、ベアチップであ
り、互いに異なる半径を有する複数の同心状の円周21
A〜Cの上に、電極に対応した半田ランド22を互いに
離隔して有し、更に、各半田ランド上にバンプ(半田バ
ンプ)24を有する。同心状の各円周の中心は、ICチ
ップ20の中心に一致している。
【0012】図2は、ICチップ20を用いて製造され
た半導体装置の側面断面図である。図2に示した半導体
装置26は、ICチップ20と、ICチップ20の半田
ランド22に対応する位置に半田ランド28を有するプ
リント回路基板30とを備えている。半導体装置26を
製造するには、プリント回路基板30の半田ランド28
の上にクリームはんだを被着させ、また、ICチップ2
0の半田ランド22の上にバンプ24を形成する。そし
て、リフロー法により、クリーム半田及びバンプ24を
溶融、固化してなる接合部32を形成して、プリント回
路基板30にICチップ20を実装する。その後、必要
に応じ、ICチップ20とプリント回路基板30との間
に封止用の樹脂8を流入、固化させる。
【0013】本実施形態例では、半導体装置26は同心
状の円周上に接合部32を有している。従って、半導体
装置26が熱膨張したとき、プリント回路基板30及び
ICチップ30の熱膨張係数が異なるため接合部32に
応力が加わっても、この応力は全ての接合部に分散され
る。よって、補強ランドを有していなくても電気的接続
の信頼性が高い。尚、円周21A〜Cの数は、バンプ数
に応じて増減させてもよく、また、各円周の中心は、I
Cチップ20の中心に必ずしも一致していなくてもよ
い。また、バンプを形成しないICチップ、すなわちラ
ンド・グリッド・アレイ(LGA)のICチップを用い
て半導体装置を製造しても、半導体装置26と同様の効
果を奏することができる。
【0014】実施形態例1の改変例1 図3は、本改変例のICチップの背面図である。本改変
例のICチップ34では、バンプの形成されている同心
状の円周36、38が、一部、ICチップ34の外方に
位置しており、ICチップの背面の四隅の領域にバンプ
40が形成されている(図3参照)。尚、本改変例で
は、最外円周上のバンプに加えられる応力を各バンプに
均一に分散するために、各円周の中心をICチップの中
心に一致させている。本改変例により、背面の四隅の領
域にまでバンプを形成したICチップが実現される。
【0015】実施形態例1の改変例2 図4は、本改変例のICチップの背面図である。本改変
例のICチップ42は、改変例1に比べ、バンプのうち
ICチップ42の背面中央の領域に形成されたバンプ4
3は、従来と同様、グリッド状に形成されている。尚、
ICチップ背面の任意の位置にバンプを形成するには、
任意の位置にバンプをグリッド状に形成している特開平
9−306918に記載された公知の方法を用いればよ
い。本改変例により、改変例1と同様、背面の四隅の領
域にまでバンプを形成したICチップが実現される。
【0016】実施形態例2 本実施形態例では、CSPを例に挙げて説明する。図5
は、本実施形態例のCSPの構成を示す斜視図である。
本実施形態例のCSP80は、円盤状のインターポーザ
81と、インターポーザ81の表面側にダイボンドされ
たICチップ83と、インターポーザ81の裏面に形成
されたバンプ82と、ICチップ83及びインターポー
ザ81に電気的に接続されたボンディングワイヤ85
と、ICチップを封止する樹脂84とを備えている。
【0017】図6は、CSP80の背面図である。CS
P80は、複数の同心状の円周上に、電極に対応した半
田ランド(図示せず)を互いに離隔して有し、更に、各
半田ランド上にバンプ82を有する。同心状の各円周の
中心は、ICチップ20の中心、すなわちインターポー
ザ81の中心に一致している。インターポーザ81の材
質は、例えばポリイミド、ガラスエポキシ、セラミック
などである。
【0018】本実施形態例のCSPは、補強ランドを有
していなくても電気的接続の信頼性が高く、従って、C
SPを小型化することができる。
【0019】
【発明の効果】本発明に係るICチップによれば、電極
に対応した半田ランドを円周上に互いに離隔して有す
る。これにより、ICチップは、従来のように補強バン
プや補強ランドを有する必要がなく、補強バンプや補強
ランドが形成されていた領域に半田ランドやバンプを形
成することが可能になる。また、本発明に係る半導体装
置によれば、本発明に係るICチップと、該ICチップ
の半田ランドに対応する位置に半田ランドを有するプリ
ント回路基板とを備え、ICチップがプリント回路基板
上に実装されている。これにより、プリント回路基板及
びICチップが熱膨張しても、ICチップ及びプリント
回路基板を接合している接合部に加わる応力は、全ての
接合部に分散される。よって、補強部のみで応力緩和す
る従来の半導体装置に比べ、電気的接続の信頼性が遙か
に高い。
【図面の簡単な説明】
【図1】実施形態例1のICチップの背面図である。
【図2】実施形態例1の半導体装置の側面断面図であ
る。
【図3】実施形態例1の改変例1のICチップの背面図
である。
【図4】実施形態例1の改変例2のICチップの背面図
である。
【図5】実施形態例2のCSPの構成を示す斜視図であ
る。
【図6】実施形態例2のCSPの背面図である。
【図7】従来の半導体装置の側面断面図である。
【図8】従来のICチップの背面図である。
【図9】従来のCSPをプリント回路基板上に実装して
なる半導体装置の側面断面図である。
【図10】従来のCSPの背面図である。
【符号の説明】
1……半導体装置、1A……ICチップ、2……バン
プ、2A……接合部、3……補強バンプ、3A……補強
部、4……半田ランド、5……補強ランド、6……プリ
ント回路基板、7A……半田ランド、7B……補強ラン
ド、8……樹脂、9……CSP、10……バンプ、11
……補強バンプ、12……半田ランド、13……補強ラ
ンド、14……プリント回路基板、16……半田ラン
ド、18……補強ランド、20……ICチップ、21A
〜C……円周、22……半田ランド、24……バンプ、
26……半導体装置、28……半田ランド、30……プ
リント回路基板、32……接合部、34……ICチッ
プ、36、38……円周、40……バンプ、42……I
Cチップ、43……バンプ、80……CSP、81……
インターポーザ、82……バンプ、83……ICチッ
プ、84……樹脂、85……ボンディングワイヤ。

Claims (7)

    【特許請求の範囲】
  1. 【請求項1】 電極に対応した半田ランドを円周上に互
    いに離隔して有することを特徴とするICチップ。
  2. 【請求項2】 複数の同心状の円周上に半田ランドを有
    することを特徴とする請求項1に記載のICチップ。
  3. 【請求項3】 請求項1又は2に記載のICチップと、 該ICチップの半田ランドに対応する位置に半田ランド
    を有するプリント回路基板とを備え、ICチップがプリ
    ント回路基板上に実装されていることを特徴とする半導
    体装置。
  4. 【請求項4】 ICチップ及びプリント回路基板のそれ
    ぞれの半田ランドのうち最外円周上の半田ランドの数
    が、何れも5以上であることを特徴とする請求項3に記
    載の半導体装置。
  5. 【請求項5】 ICチップが、チップサイズパッケー
    ジ、ボールグリッドアレイパッケージ、及び、マルチチ
    ップモジュールパッケージの何れかであることを特徴と
    する請求項3又は4に記載の半導体装置。
  6. 【請求項6】 請求項3に記載の半導体装置の製造方法
    であって、 プリント回路基板の半田ランド上にクリームはんだを被
    着させ、リフロー法によりICチップを実装することを
    特徴とする半導体装置の製造方法。
  7. 【請求項7】 ICチップの半田ランド上にバンプを形
    成し、リフロー法によりプリント回路基板上にICチッ
    プを実装することを特徴とする請求項6に記載の半導体
    装置の製造方法。
JP10289459A 1998-10-12 1998-10-12 Icチップ、半導体装置、及び、半導体装置の製造方法 Pending JP2000124259A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP10289459A JP2000124259A (ja) 1998-10-12 1998-10-12 Icチップ、半導体装置、及び、半導体装置の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP10289459A JP2000124259A (ja) 1998-10-12 1998-10-12 Icチップ、半導体装置、及び、半導体装置の製造方法

Publications (1)

Publication Number Publication Date
JP2000124259A true JP2000124259A (ja) 2000-04-28

Family

ID=17743550

Family Applications (1)

Application Number Title Priority Date Filing Date
JP10289459A Pending JP2000124259A (ja) 1998-10-12 1998-10-12 Icチップ、半導体装置、及び、半導体装置の製造方法

Country Status (1)

Country Link
JP (1) JP2000124259A (ja)

Cited By (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6793500B1 (en) 2003-09-18 2004-09-21 International Business Machines Corporation Radial contact pad footprint and wiring for electrical components
JP2007142124A (ja) * 2005-11-18 2007-06-07 Matsushita Electric Ind Co Ltd 半導体装置およびその製造方法
JP2007242782A (ja) * 2006-03-07 2007-09-20 Fujikura Ltd 半導体装置及び電子装置
JP2008112878A (ja) * 2006-10-31 2008-05-15 Seiko Instruments Inc 半導体装置
JP2008227020A (ja) * 2007-03-09 2008-09-25 Nec Corp 電子部品の実装構造
JP2010129728A (ja) * 2008-11-27 2010-06-10 Kyocera Corp 発光装置及び発光装置を用いた照明装置
CN102420198A (zh) * 2010-09-28 2012-04-18 大日本印刷株式会社 半导体器件以及半导体器件的制造方法
JP2012209320A (ja) * 2011-03-29 2012-10-25 Dainippon Printing Co Ltd 半導体装置および半導体装置の製造方法
JP2014219391A (ja) * 2013-05-06 2014-11-20 巨擘科技股▲ふん▼有限公司Princo Corp. 腕時計の構造、腕時計用電子コア及び腕時計の製造方法
US20150008565A1 (en) * 2012-03-07 2015-01-08 Mitsubishi Electric Corporation High-frequency package

Cited By (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6793500B1 (en) 2003-09-18 2004-09-21 International Business Machines Corporation Radial contact pad footprint and wiring for electrical components
JP2007142124A (ja) * 2005-11-18 2007-06-07 Matsushita Electric Ind Co Ltd 半導体装置およびその製造方法
JP2007242782A (ja) * 2006-03-07 2007-09-20 Fujikura Ltd 半導体装置及び電子装置
JP2008112878A (ja) * 2006-10-31 2008-05-15 Seiko Instruments Inc 半導体装置
US8362610B2 (en) 2007-03-09 2013-01-29 Nec Corporation Mounting configuration of electronic component
JP2008227020A (ja) * 2007-03-09 2008-09-25 Nec Corp 電子部品の実装構造
JP2010129728A (ja) * 2008-11-27 2010-06-10 Kyocera Corp 発光装置及び発光装置を用いた照明装置
CN102420198A (zh) * 2010-09-28 2012-04-18 大日本印刷株式会社 半导体器件以及半导体器件的制造方法
CN105206586A (zh) * 2010-09-28 2015-12-30 大日本印刷株式会社 半导体器件以及半导体器件的制造方法
US9263374B2 (en) 2010-09-28 2016-02-16 Dai Nippon Printing Co., Ltd. Semiconductor device and manufacturing method therefor
CN105206586B (zh) * 2010-09-28 2019-01-22 大日本印刷株式会社 半导体器件以及半导体器件的制造方法
JP2012209320A (ja) * 2011-03-29 2012-10-25 Dainippon Printing Co Ltd 半導体装置および半導体装置の製造方法
US20150008565A1 (en) * 2012-03-07 2015-01-08 Mitsubishi Electric Corporation High-frequency package
US9368457B2 (en) * 2012-03-07 2016-06-14 Mitsubishi Electric Corporation High-frequency package
JP2014219391A (ja) * 2013-05-06 2014-11-20 巨擘科技股▲ふん▼有限公司Princo Corp. 腕時計の構造、腕時計用電子コア及び腕時計の製造方法
US9256209B2 (en) 2013-05-06 2016-02-09 Princo Middle East Fze Wristwatch structure, electronic core for wristwatch, and method for manufacturing wristwatch

Similar Documents

Publication Publication Date Title
US5859474A (en) Reflow ball grid array assembly
JP5420505B2 (ja) 半導体装置の製造方法
US6414849B1 (en) Low stress and low profile cavity down flip chip and wire bond BGA package
US6507119B2 (en) Direct-downset flip-chip package assembly and method of fabricating the same
JPH07153903A (ja) 半導体装置パッケージ
JPH07170098A (ja) 電子部品の実装構造および実装方法
US6160313A (en) Semiconductor device having an insulating substrate
JP2000124259A (ja) Icチップ、半導体装置、及び、半導体装置の製造方法
KR20010070124A (ko) 배선의 레이아웃이 향상된 칩 스케일 패키지
JPH0547998A (ja) 高密度実装化半導体装置
JP2001185585A (ja) 半導体装置およびその製造方法
JP3332555B2 (ja) 半導体装置およびその製造方法
JP2007207805A (ja) 半導体装置の製造方法及び半導体装置
JP2000243862A (ja) インターポーザ基板
JPH1074887A (ja) 電子部品及びその製造方法
JP3563170B2 (ja) 半導体装置の製造方法
JPH0777243B2 (ja) 表面実装用パツケ−ジ
JP2001044307A (ja) 半導体装置およびその製造方法
JP2699932B2 (ja) 半導体装置
JPH11186440A (ja) 半導体装置
JP3600138B2 (ja) 半導体装置
JP3132481B2 (ja) 回路装置、半導体チップ、インターポーザ基板、回路装置の製造方法
JPH0945807A (ja) 半導体装置
KR100308116B1 (ko) 칩스케일반도체패키지및그제조방법_
JPH10335386A (ja) 半導体実装方法