JP2023112038A - 積層セラミックキャパシタ及びその製造方法 - Google Patents

積層セラミックキャパシタ及びその製造方法 Download PDF

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Abstract

【課題】積層セラミックキャパシタ及びその製造方法を提供する。【解決手段】誘電体層を含み、セラミック本体と、上記セラミック本体の内部に配置された複数の内部電極と、上記内部電極の端部上に配置された第1サイドマージン部及び第2サイドマージン部と、を含む積層セラミックキャパシタであって、上記セラミック本体は、上記誘電体層を挟んで互いに対向するように配置される複数の内部電極を含み、容量が形成される部分である活性部と、上記活性部の上部及び下部に形成されたカバー部と、を含み、上記第1及び第2サイドマージン部は、第1領域と第2領域とに分けられ、上記カバー部は、第1領域と第2領域とに分けられ、上記カバー部と第1及び第2サイドマージン部の第2領域に含まれるマグネシウム(Mg)の含量が、第1領域に含まれるマグネシウム(Mg)の含量よりもそれぞれさらに多い、積層セラミックキャパシタを提供する。【選択図】図4

Description

本発明は、サイドマージン部及びカバー部に含まれるマグネシウム(Mg)の含量を調節することで、信頼性を向上させることができる積層セラミックキャパシタ及びその製造方法に関する。
通常、キャパシタ、インダクタ、圧電体素子、バリスタ、またはサーミスタなどのセラミック材料を用いる電子部品は、セラミック材料からなるセラミック本体と、本体の内部に形成された内部電極と、上記内部電極と接続されるようにセラミック本体の表面に設けられた外部電極と、を備える。
近年、電子製品の小型化及び多機能化に伴い、チップ部品も小型化及び高機能化する傾向にあるため、積層セラミックキャパシタにも、小型でありながらも、容量が大きい高容量の製品が求められている。
積層セラミックキャパシタの小型化及び高容量化のためには、電極有効面積の最大化(容量の実現に必要な有効体積分率の増加)が求められる。
上記のように小型及び高容量の積層セラミックキャパシタを実現するために、積層セラミックキャパシタを製造するにあたり、内部電極が本体の幅方向に露出するようにすることで、マージンのない設計によって内部電極の幅方向の面積を最大化するとともに、かかるチップの製作後に、焼成前の段階で、チップの幅方向の電極露出面にサイドマージン部を別に付着して完成する方法が適用されている。
しかしながら、上記の方法において、サイドマージン部を形成する過程で、セラミック本体とサイドマージン部が接触する界面にボイド(void)が多く生成され、信頼性が低下し得る。
また、セラミック本体とサイドマージン部が接触する界面に生成されたボイド(void)によって電界の集中が発生し、これによって絶縁破壊電圧(Breakdown Voltage、BDV)が低くなるという問題が発生する。
また、上記ボイド(void)により、外側の焼結緻密度の低下による耐湿信頼性の低下が引き起こされる恐れがある。
したがって、超小型及び高容量の製品において絶縁破壊電圧(Breakdown Voltage、BDV)の低下及び耐湿信頼性の低下を防ぐことができる研究が必要な状況である。
韓国公開特許第2010-0136917号公報
本発明は、サイドマージン部とカバー部に含まれるマグネシウム(Mg)の含量を調節することで、信頼性を向上させることができる積層セラミックキャパシタ及びその製造方法を提供することを目的とする。
本発明の一実施形態は、誘電体層を含み、互いに対向する第1面及び第2面、上記第1面と第2面を連結する第3面及び第4面、及び上記第1面~第4面と連結され、互いに対向する第5面及び第6面を有するセラミック本体と、上記セラミック本体の内部に配置され、上記第1面及び第2面に露出し、且つ上記第3面または第4面に一端が露出する複数の内部電極と、上記第1面及び第2面に露出した上記内部電極の端部上に配置された第1サイドマージン部及び第2サイドマージン部と、を含む積層セラミックキャパシタであって、上記セラミック本体は、上記誘電体層を挟んで互いに対向するように配置される上記複数の内部電極を含み、容量が形成される部分である活性部と、上記活性部の上部及び下部に形成されたカバー部と、を含み、上記第1及び第2サイドマージン部は、サイドマージン部の外側面に隣接した第1領域と、上記第1面及び第2面に露出した内部電極に隣接した第2領域とに分けられ、上記カバー部は、上記セラミック本体の外側面に隣接した第1領域と、上記複数の内部電極のうち最外側に配置された内部電極に隣接した第2領域とに分けられ、上記カバー部の第2領域と上記第1及び第2サイドマージン部の第2領域に含まれるマグネシウム(Mg)の含量が、上記カバー部の第1領域と上記第1及び第2サイドマージン部の第1領域に含まれるマグネシウム(Mg)の含量よりもそれぞれさらに多い、積層セラミックキャパシタを提供する。
本発明の他の実施形態は、複数個の第1内部電極パターンが所定の間隔を置いて形成された第1セラミックグリーンシート、及び複数個の第2内部電極パターンが所定の間隔を置いて形成された第2セラミックグリーンシートを製造する段階と、上記第1内部電極パターンと上記第2内部電極パターンが交差されるように上記第1セラミックグリーンシートと上記第2セラミックグリーンシートを積層することで、セラミックグリーンシート積層本体を形成する段階と、上記第1内部電極パターンと第2内部電極パターンの末端が幅方向に露出した側面を有するように、上記セラミックグリーンシート積層本体を切断する段階と、上記第1内部電極パターンと第2内部電極パターンの末端が露出した側面に第1サイドマージン部及び第2サイドマージン部を形成する段階と、上記切断した積層本体を焼成することで、誘電体層と第1及び第2内部電極を含むセラミック本体を製造する段階と、を含む積層セラミックキャパシタの製造方法であって、上記セラミック本体は、上記誘電体層を挟んで互いに対向するように配置される上記第1内部電極及び第2内部電極を含み、容量が形成される部分である活性部と、上記活性部の上部及び下部に形成されたカバー部と、を含み、上記第1及び第2サイドマージン部は、サイドマージン部の外側面に隣接した第1領域と、上記第1及び第2内部電極に隣接した第2領域とに分けられ、上記カバー部は、上記セラミック本体の外側面に隣接した第1領域と、上記第1及び第2内部電極のうち最外側に配置された内部電極に隣接した第2領域とに分けられ、上記カバー部の第2領域と上記第1及び第2サイドマージン部の第2領域に含まれるマグネシウム(Mg)の含量が、上記カバー部の第1領域と上記第1及び第2サイドマージン部の第1領域に含まれるマグネシウム(Mg)の含量よりもそれぞれさらに多い、積層セラミックキャパシタの製造方法を提供する。
本発明の一実施形態によると、第1及び第2サイドマージン部は、サイドマージン部の外側面に隣接した第1領域と、内部電極に隣接した第2領域とに分けられ、上記第2領域に含まれるマグネシウム(Mg)の含量が、第1領域に含まれるマグネシウム(Mg)の含量より多くなるように調節することで、絶縁破壊電圧(Breakdown Voltage、BDV)を増加させ、信頼性を向上させることができる。
具体的には、セラミック本体の幅方向の側面に隣接したサイドマージン部の領域に含まれるマグネシウム(Mg)の含量を調節することで、セラミック本体の幅方向の側面に露出した内部電極の先端の酸化層の長さを制御することができ、これにより、絶縁破壊電圧(Breakdown Voltage、BDV)を増加させることができ、耐湿信頼性が向上することができる。
また、カバー部は、セラミック本体の外側面に隣接した第1領域と、複数の内部電極のうち最外側に配置された内部電極に隣接した第2領域とに分けられ、上記第2領域に含まれるマグネシウム(Mg)の含量が、第1領域に含まれるマグネシウム(Mg)の含量より多くなるように調節することで、セラミック本体の外側面に隣接した第1領域の緻密度を高め、耐湿信頼性を向上させることができる。
本発明の一実施形態による積層セラミックキャパシタを示す概略的な斜視図である。 図1のセラミック本体の外観を示す斜視図である。 図2のセラミック本体の焼成前のセラミックグリーンシート積層本体を示す斜視図である。 図2のB方向から見た側面図である。 本発明の他の実施形態による積層セラミックキャパシタの製造方法を概略的に示す断面図である。 本発明の他の実施形態による積層セラミックキャパシタの製造方法を概略的に示す断面図である。 本発明の他の実施形態による積層セラミックキャパシタの製造方法を概略的に示す断面図である。 本発明の他の実施形態による積層セラミックキャパシタの製造方法を概略的に示す斜視図である。 本発明の他の実施形態による積層セラミックキャパシタの製造方法を概略的に示す断面図である。 本発明の他の実施形態による積層セラミックキャパシタの製造方法を概略的に示す断面図である。 本発明の実施例と比較例による絶縁破壊電圧(Breakdown Voltage、BDV)を比較したグラフである。
以下では、添付の図面を参照して本発明の好ましい実施形態について説明する。しかし、本発明の実施形態は様々な他の形態に変形されることができ、本発明の範囲は以下で説明する実施形態に限定されない。また、本発明の実施形態は、当該技術分野で平均的な知識を有する者に本発明をより完全に説明するために提供されるものである。したがって、図面における要素の形状及び大きさなどはより明確な説明のために拡大縮小表示(または強調表示や簡略化表示)がされることがある。
図1は本発明の一実施形態による積層セラミックキャパシタを示す概略的な斜視図である。
図2は図1のセラミック本体の外観を示す斜視図である。
図3は図2のセラミック本体の焼成前のセラミックグリーンシート積層本体を示す斜視図である。
図4は図2のB方向から見た側面図である。
図1から図4を参照すると、本実施形態による積層セラミックキャパシタ100は、セラミック本体110と、上記セラミック本体110の内部に形成される複数の内部電極121、122と、上記セラミック本体110の外表面に形成される外部電極131、132と、を含む。
上記セラミック本体110は、互いに対向する第1面1及び第2面2と、上記第1面と第2面を連結する第3面3及び第4面4と、上面と下面である第5面5及び第6面6と、を有することができる。
上記第1面1及び第2面2はセラミック本体110の幅方向において対面する面、上記第3面3及び第4面4は長さ方向において対面する面、上記第5面5及び第6面6は厚さ方向において対面する面と定義することができる。
上記セラミック本体110の形状は特に制限されないが、図面に示すように、直方体形状であることができる。
上記セラミック本体110の内部に形成された複数の内部電極121、122は、セラミック本体の第3面3または第4面4に一端が露出する。
上記内部電極121、122は、互いに異なる極性を有する第1内部電極121及び第2内部電極122を一対とすることができる。
第1内部電極121の一端は第3面3に露出し、第2内部電極122の一端は第4面4に露出することができる。
上記第1内部電極121及び第2内部電極122の他端は、第3面3または第4面4から所定の間隔を置いて形成される。
上記セラミック本体の第3面3及び第4面4には第1及び第2外部電極131、132が形成され、上記内部電極とそれぞれ電気的に接続されることができる。
本発明の一実施形態による積層セラミックキャパシタ100は、上記セラミック本体110の内部に配置され、上記第1面及び第2面1、2に露出し、且つ上記第3面3または第4面4に一端が露出する複数の内部電極121、122と、上記第1面1及び第2面2に露出した上記内部電極121、122の端部上に配置された第1サイドマージン部112及び第2サイドマージン部113と、を含む。
上記セラミック本体110の内部には複数の内部電極121、122が形成されている。上記複数の内部電極121、122の各末端は、上記セラミック本体110の幅方向の面である第1面1及び第2面2に露出し、露出した端部上に第1サイドマージン部112及び第2サイドマージン部113が配置される。
第1サイドマージン部112及び第2サイドマージン部113の平均厚さは、2μm以上10μm以下であることができる。
本発明の一実施形態によると、上記セラミック本体110は、複数の誘電体層111が積層された積層体と、上記積層体の両側面に配置される第1サイドマージン部112及び第2サイドマージン部113とで構成されることができる。
上記複数の誘電体層111は焼結された状態であって、隣接する誘電体層同士の境界は、確認が不可能な程度に一体化されることができる。
上記セラミック本体110の長さは、セラミック本体の第3面3から第4面4までの距離に相当する。
上記誘電体層111の長さは、セラミック本体の第3面3と第4面4との間の距離を形成する。
これに制限されるものではないが、本発明の一実施形態によると、セラミック本体の長さは400~1400μmであることができる。より具体的には、セラミック本体の長さは400~800μm、または、600~1400μmであることができる。
上記誘電体層111上に内部電極121、122が形成されることができ、内部電極121、122は、焼結により、一誘電体層を間に挟んで上記セラミック本体の内部に形成されることができる。
図3を参照すると、誘電体層111に第1内部電極121が形成されている。上記第1内部電極121は、誘電体層の長さ方向においては全体的に形成されない。すなわち、第1内部電極121の一端は、セラミック本体の第4面4から所定の間隔を置いて形成されることができ、第1内部電極121の他端は、第3面3まで形成されて第3面3に露出することができる。
セラミック本体の第3面3に露出した第1内部電極の端部は第1外部電極131と接続される。
第1内部電極とは反対に、第2内部電極122の一端は、第3面3から所定の間隔を置いて形成され、第2内部電極122の他端は、第4面4に露出して第2外部電極132と接続される。
上記内部電極は、高容量の積層セラミックキャパシタを実現するために、400層以上積層されることができるが、必ずしもこれに制限されるものではない。
上記誘電体層111は第1内部電極121の幅と同一の幅を有することができる。すなわち、上記第1内部電極121は、誘電体層111の幅方向においては全体的に形成されることができる。
これに制限されるものではないが、本発明の一実施形態によると、誘電体層の幅及び内部電極の幅は100~900μmであることができる。より具体的には、誘電体層の幅及び内部電極の幅は100~500μm、または、100~900μmであることができる。
セラミック本体が小型化するにつれ、サイドマージン部の厚さが積層セラミックキャパシタの電気的特性に影響し得る。本発明の一実施形態によると、サイドマージン部の厚さが10μm以下に形成され、小型化した積層セラミックキャパシタの特性を向上させることができる。
すなわち、サイドマージン部の厚さが10μm以下に形成されることで、容量を形成する内部電極の重なり面積を最大に確保し、高容量及び小型の積層セラミックキャパシタを実現することができる。
このようなセラミック本体110は、キャパシタの容量の形成に寄与する部分としての活性部Aと、活性部Aの上下部にそれぞれ形成された上下マージン部としての上部及び下部カバー部114、115と、で構成されることができる。
上記活性部Aは、誘電体層111を挟んで複数の第1及び第2内部電極121、122を繰り返し積層することで形成されることができる。
上記上部カバー部114及び下部カバー部115は、内部電極を含まないことを除き、誘電体層111と同一の材料及び構成を有することができる。
すなわち、上記上部カバー部114及び下部カバー部115はセラミック材料を含むことができ、例えば、チタン酸バリウム(BaTiO)系セラミック材料を含むことができる。
上記上部カバー部114及び下部カバー部115はそれぞれ20μm以下の厚さを有することができるが、必ずしもこれに制限されるものではない。
上記上部カバー部114及び下部カバー部115は、単一の誘電体層または2つ以上の誘電体層を活性部Aの上下面にそれぞれ上下方向に積層することで形成されることができ、基本的に、物理的または化学的ストレスによる内部電極の損傷を防止する役割を果たすことができる。
本発明の一実施形態において、内部電極と誘電体層は同時に切断されて形成されるものであって、内部電極の幅と誘電体層の幅が同一に形成されることができる。これについてのより具体的な事項は後述する。
本実施形態において、誘電体層の幅は内部電極の幅と同一に形成される。これにより、セラミック本体110の幅方向の第1面及び第2面に内部電極121、122の末端が露出することができる。
上記内部電極121、122の末端が露出したセラミック本体110の幅方向の両側面には、第1サイドマージン部112及び第2サイドマージン部113が形成されることができる。
上記第1サイドマージン部112及び第2サイドマージン部113の厚さは10μm以下であることができる。上記第1サイドマージン部112及び第2サイドマージン部113の厚さが小さいほど、セラミック本体内に形成される内部電極の重なり面積が相対的に広くなることができる。
上記第1サイドマージン部112及び第2サイドマージン部113の厚さは、セラミック本体110の側面に露出する内部電極のショートを防止することができる厚さであれば特に制限されないが、例えば、2μm以上であることができる。
上記第1及び第2サイドマージン部の厚さが2μm未満である場合には、外部衝撃に対する機械的強度が低下する恐れがあり、上記第1及び第2サイドマージン部の厚さが10μmを超える場合には、内部電極の重なり面積が相対的に減少し、積層セラミックキャパシタの高容量の確保が困難であり得る。
積層セラミックキャパシタの容量を最大化するために、誘電体層を薄膜化する方法、薄膜化した誘電体層を高積層化する方法、内部電極のカバレッジを向上させる方法などが考えられている。
また、容量を形成する内部電極の重なり面積を増加させる方法が考えられている。
内部電極の重なり面積を増加させるためには、内部電極が形成されていないマージン部の領域を最小化せる必要がある。
特に、積層セラミックキャパシタが小型化するほど、内部電極の重なり領域を増加させるためには、マージン部の領域を最小化させる必要がある。
本実施形態によると、誘電体層の幅方向の全体に内部電極が形成され、サイドマージン部の厚さが10μm以下に設定されるため、内部電極の重なり面積が広いという特徴を有する。
通常、誘電体層が高積層化するほど、誘電体層及び内部電極の厚さは薄くなる。したがって、内部電極のショート現象が頻繁に発生し得る。また、誘電体層の一部にのみ内部電極が形成される場合、内部電極による段差が生じて、絶縁抵抗の加速寿命や信頼性が低下し得る。
しかし、本実施形態によると、薄膜の内部電極及び誘電体層を形成しても、内部電極が誘電体層の幅方向において全体的に形成されるため、内部電極の重なり面積が大きくなり、積層セラミックキャパシタの容量が大きくすることができる。
また、内部電極による段差を減少させることで、絶縁抵抗の加速寿命を向上させるため、優れた容量特性及び信頼性を有する積層セラミックキャパシタを提供することができる。
本発明の一実施形態によると、上記第1及び第2サイドマージン部112、113は、サイドマージン部112、113の外側面に隣接した第1領域112a、113aと、上記セラミック本体110の第1面1及び第2面2に露出した内部電極121、122に隣接した第2領域112b、113bと、に分けられ、上記第2領域112b、113bに含まれるマグネシウム(Mg)の含量が、第1領域112a、113aに含まれるマグネシウム(Mg)の含量より多い。
上記セラミック本体110の側面に配置された第1及び第2サイドマージン部112、113が、組成が互いに異なる2つの領域に分けられ、この際、上記第2領域112b、113bに含まれるマグネシウム(Mg)の含量が、第1領域112a、113aに含まれるマグネシウム(Mg)の含量より多くなるように調節することで、絶縁破壊電圧(Breakdown Voltage、BDV)を増加させ、信頼性を向上させることができる。
具体的には、セラミック本体110の第1面1及び第2面2に露出した内部電極121、122に隣接したサイドマージン部の第2領域112b、113bに含まれるマグネシウム(Mg)の含量を調節することで、セラミック本体の幅方向の側面に露出した内部電極の先端の酸化層の長さを制御することができる。これにより、絶縁破壊電圧(Breakdown Voltage、BDV)を増加させることができ、耐湿信頼性を向上させることができる。
通常、サイドマージン部の形成過程で、セラミック本体とサイドマージン部が接触する界面にボイド(void)が多く生成され、信頼性が低下し得る。
また、セラミック本体とサイドマージン部が接触する界面に生成されたボイド(void)によって電界の集中が発生し、これによって絶縁破壊電圧(Breakdown Voltage、BDV)が低くなるという問題が発生する。
また、上記ボイド(void)により、外側の焼結緻密度の低下による耐湿信頼性の低下が引き起こされる恐れがある。
本発明の一実施形態によると、セラミック本体110の第1面1及び第2面2に露出した内部電極121、122に隣接したサイドマージン部の内側の第2領域112b、113bに含まれるマグネシウム(Mg)の含量を調節することで、セラミック本体とサイドマージン部が接触する界面に生成されたボイド(void)に酸化層を形成することができる。
上記のように、セラミック本体とサイドマージン部が接触する界面に生成されたボイド(void)に酸化層を形成する場合、絶縁性が確保されるため、電界の集中を緩和することができる。これにより、絶縁破壊電圧(Breakdown Voltage、BDV)が増加し、ショート不良が減少することができる。
また、上記セラミック本体110の側面に配置された第1及び第2サイドマージン部112、113が、組成が互いに異なる2つの領域に分けられ、この際、各領域に含まれるマグネシウム(Mg)の含量を異ならせることで、第1及び第2サイドマージン部112、113の緻密度を向上させて耐湿特性を改善することができる。
具体的には、上記第1及び第2サイドマージン部112、113の第2領域112b、113bに含まれるマグネシウム(Mg)の含量が、外側の第1領域112a、113aに含まれるマグネシウム(Mg)の含量より多くなるように調節することで、上記第1及び第2サイドマージン部112、113の第1領域112a、113aの緻密度を向上させて耐湿特性を改善することができる。
特に、上記サイドマージン部112、113の外側面に隣接した上記第1及び第2サイドマージン部112、113の第1領域112a、113aに含まれるマグネシウム(Mg)の含量を小さくすることで、第1外部電極131及び第2外部電極132との密着力が向上することができる。
上記第1及び第2サイドマージン部112、113の第2領域112b、113bに含まれるマグネシウム(Mg)の含量が、第1領域112a、113aに含まれるマグネシウム(Mg)の含量より多くなるように調節する方法としては、積層セラミックキャパシタの製作過程で、セラミック本体形成用誘電体の組成と第1及び第2サイドマージン部形成用誘電体の組成を互いに異ならせることにより調節が可能である。
すなわち、セラミック本体形成用誘電体の組成と異なって、第1及び第2サイドマージン部形成用誘電体の組成中のマグネシウム(Mg)の含量を増加させ、焼結及び焼成過程で拡散によりマグネシウム(Mg)の含量を調節する場合、上記第2領域112b、113bに含まれるマグネシウム(Mg)の含量が、第1領域112a、113aに含まれるマグネシウム(Mg)の含量より多くなるように調節することができる。
これにより、内部電極の先端部に集中される電界を緩和することができ、積層セラミックキャパシタの主な不良の1つである絶縁破壊を防止して積層セラミックキャパシタの信頼性を向上させることができる。
本発明の一実施形態によると、上記第1及び第2サイドマージン部112、113の第2領域112b、113bのマグネシウム(Mg)の含量は、上記第1及び第2サイドマージン部に含まれるチタン(Ti)に対して10モル以上30モル以下であることができる。
上記第1及び第2サイドマージン部112、113の第2領域112b、113bのマグネシウム(Mg)の含量が、上記第1及び第2サイドマージン部に含まれるチタン(Ti)に対して10モル以上30モル以下になるように調節することで、絶縁破壊電圧(Breakdown Voltage、BDV)を増加させ、耐湿信頼性を向上させることができる。
上記第1及び第2サイドマージン部112、113の第2領域112b、113bのマグネシウム(Mg)の含量が、上記第1及び第2サイドマージン部に含まれるチタン(Ti)に対して10モル未満である場合には、セラミック本体とサイドマージン部が接触する界面に生成されたボイド(void)に酸化層が十分に形成されず、絶縁破壊電圧(Breakdown Voltage、BDV)が低くなり、ショート不良が増加し得る。
一方、上記第1及び第2サイドマージン部112、113の第2領域112b、113bのマグネシウム(Mg)の含量が、上記第1及び第2サイドマージン部に含まれるチタン(Ti)に対して30モルを超える場合には、焼結性の低下によって信頼性及び絶縁破壊電圧(Breakdown Voltage、BDV)の散布が不均一であるという問題が発生し得る。
図4を参照すると、上記上部及び下部カバー部114、115は、上記セラミック本体110の外側面に隣接した第1領域114a、115aと、上記複数の内部電極121、122のうち最外側に配置された内部電極に隣接した第2領域114b、115bと、に分けられ、上記第2領域114b、115bに含まれるマグネシウム(Mg)の含量が、第1領域114a、115aに含まれるマグネシウム(Mg)の含量より多いことを特徴とする。
上記セラミック本体110の上部及び下部カバー部114、115が、組成が互いに異なる2つの領域に分けられ、この際、各領域に含まれるマグネシウム(Mg)の含量を異ならせることで、上部及び下部カバー部114、115の緻密度を向上させて耐湿特性を改善することができる。
上記上部及び下部カバー部114、115の第2領域114b、115bに含まれるマグネシウム(Mg)の含量は、第1領域114a、115aに含まれるマグネシウム(Mg)の含量より多いことができる。
上記上部及び下部カバー部114、115の第2領域114b、115bに含まれるマグネシウム(Mg)の含量が、外側の第1領域114a、115aに含まれるマグネシウム(Mg)の含量より多くなるように調節することで、上記上部及び下部カバー部114、115の第1領域114a、115aの緻密度を向上させて耐湿特性を改善することができる。
特に、上記セラミック本体110の外側面に隣接した上記上部及び下部カバー部114、115の第1領域114a、115aに含まれるマグネシウム(Mg)の含量を小さくすることで、第1外部電極131及び第2外部電極132との密着力が向上することができる。
また、上記上部及び下部カバー部114、115の第2領域114b、115bのマグネシウム(Mg)の含量は、上記上部及び下部カバー部114、115に含まれるチタン(Ti)に対して10モル以上30モル以下であることができる。
上記上部及び下部カバー部114、115の第2領域114b、115bのマグネシウム(Mg)の含量が、上記上部及び下部カバー部114、115に含まれるチタン(Ti)に対して10モル以上30モル以下になるように調節することで、耐湿信頼性を向上させることができる。
上記上部及び下部カバー部114、115の第2領域114b、115bのマグネシウム(Mg)の含量が、上記上部及び下部カバー部114、115に含まれるチタン(Ti)に対して10モル未満である場合には、上部及び下部カバー部114、115の第2領域114b、115b内の誘電体粒が過度に粒成長するため、DC-bias特性が確保されず、必要な容量の確保が困難である。
一方、上記上部及び下部カバー部114、115の第2領域114b、115bのマグネシウム(Mg)の含量が、上記上部及び下部カバー部114、115に含まれるチタン(Ti)に対して30モルを超える場合には、焼結性の低下によって耐湿信頼性の散布が不均一であるという問題が発生し得る。
上記上部及び下部カバー部114、115の第2領域114b、115bは、セラミック本体110との接着力を強化するための添加剤がさらに含まれることができる。
上記上部及び下部カバー部114、115の第2領域114b、115bに含まれるマグネシウム(Mg)の含量が、第1領域114a、115aに含まれるマグネシウム(Mg)の含量より多くなるように調節する方法としては、積層セラミックキャパシタの製作過程で、セラミック本体形成用誘電体の組成とカバー部形成用誘電体の組成を互いに異ならせることで可能である。
すなわち、セラミック本体形成用誘電体の組成と異なって、カバー部形成用誘電体の組成中のマグネシウム(Mg)の含量を増加させ、焼結及び焼成過程で拡散によりマグネシウム(Mg)の含量を調節する場合、上記上部及び下部カバー部114、115の第2領域114b、115bに含まれるマグネシウム(Mg)の含量が、第1領域114a、115aに含まれるマグネシウム(Mg)の含量より多くなるように調節することができる。
本発明の一実施形態によると、上記誘電体層111の厚さは0.4μm以下、上記内部電極121、122の厚さは0.4μm以下の、超小型の積層セラミックキャパシタであることを特徴とする。
本発明の一実施形態のように、上記誘電体層111の厚さが0.4μm以下、上記内部電極121、122の厚さが0.4μm以下の薄膜の誘電体層と内部電極が適用された場合、セラミック本体とサイドマージン部の外側面に発生するボイド(void)による信頼性の問題は非常に重要な課題である。
すなわち、従来の積層セラミックキャパシタの場合は、本発明の一実施形態のように積層セラミックキャパシタに含まれるサイドマージン部の各領域のマグネシウム(Mg)の含量を調節しなくても、信頼性に大きな問題はなかった。
しかし、本発明の一実施形態のように薄膜の誘電体層及び内部電極が適用される製品では、セラミック本体とサイドマージン部が接触する界面に生成されたボイド(void)によるBDV及び信頼性の低下を防止するために、サイドマージン部の各領域のマグネシウム(Mg)の含量を調節しなければならない。
すなわち、本発明の一実施形態では、上記第2領域112b、113bのマグネシウム(Mg)の含量が、上記第1及び第2サイドマージン部に含まれるチタン(Ti)に対して10モル以上30モル以下となるように調節することで、誘電体層111と第1及び第2内部電極121、122の厚さが0.4μm以下の薄膜の場合にも絶縁破壊電圧(Breakdown Voltage、BDV)を増加させ、耐湿信頼性を向上させることができる。
但し、上記薄膜が、誘電体層111と第1及び第2内部電極121、122の厚さが0.4μm以下であることを意味するのではなく、従来の製品よりも薄い厚さの誘電体層と内部電極を含むという概念で理解されることができる。
一方、上記第1及び第2サイドマージン部112、113の第1領域112a、113aの幅は12μm以下であり、第2領域112b、113bの幅は3μm以下であることができるが、必ずしもこれに制限されるものではない。
図4を参照すると、上記複数の内部電極121、122のうち、中央部に配置される内部電極の末端と接する上記第1または第2サイドマージン部領域の厚さtc1に対して、最外側に配置される内部電極の末端と接する上記第1または第2サイドマージン部領域の厚さtc2の比率は1.0以下であることができる。
中央部に配置される内部電極の末端と接する上記第1または第2サイドマージン部領域の厚さtc1に対して、最外側に配置される内部電極の末端と接する上記第1または第2サイドマージン部領域の厚さtc2の比率の下限値は特に制限されないが、0.9以上であることが好ましい。
本発明の一実施形態によると、従来と異なって、セラミックグリーンシートをセラミック本体の側面に付着して上記第1または第2サイドマージン部を形成するため、第1または第2サイドマージン部の位置毎の厚さが一定である。
すなわち、従来は、セラミックスラリーを塗布若しくは印刷する方式によりサイドマージン部を形成していたため、サイドマージン部の位置毎の厚さのばらつきが激しかった。
具体的には、従来は、セラミック本体の中央部に配置される内部電極の末端と接する第1または第2サイドマージン部領域の厚さが、他の領域の厚さに比べて厚く形成されていた。
例えば、従来は、中央部に配置される内部電極の末端と接する第1または第2サイドマージン部領域の厚さに対して、最外側に配置される内部電極の末端と接する第1または第2サイドマージン部領域の厚さの比率が0.9未満程度と、そのばらつきが大きい。
このようにサイドマージン部の位置毎の厚さのばらつきが大きい従来の場合、同じサイズの積層セラミックキャパシタにおいてサイドマージン部が占める部分が大きいため、容量形成部のサイズを大きく確保することができず、高容量を確保することが困難であった。
これに対し、本発明の一実施形態は、第1及び第2サイドマージン部112、113の平均厚さが2μm以上10μm以下であり、上記複数の内部電極121、122のうち、中央部に配置される内部電極の末端と接する上記第1または第2サイドマージン部領域の厚さtc1に対して、最外側に配置される内部電極の末端と接する上記第1または第2サイドマージン部領域の厚さtc2の比率が0.9以上1.0以下であるため、サイドマージン部の厚さが薄く、厚さのばらつきが少ないため、容量形成部のサイズを大きく確保することができる。
これにより、高容量の積層セラミックキャパシタの実現が可能である。
一方、図4を参照すると、上記複数の内部電極121、122のうち、中央部に配置される内部電極の末端と接する上記第1または第2サイドマージン部領域の厚さtc1に対して、上記セラミック本体110の角と接する上記第1または第2サイドマージン部領域の厚さtc3の比率は1.0以下であることができる。
中央部に配置される内部電極の末端と接する上記第1または第2サイドマージン部領域の厚さtc1に対して、上記セラミック本体110の角と接する上記第1または第2サイドマージン部領域の厚さtc3の比率の下限値は0.9以上であることが好ましい。
上記の特徴により、サイドマージン部の領域毎の厚さのばらつきが少ないため、容量形成部のサイズを大きく確保することができ、これにより、高容量の積層セラミックキャパシタの実現が可能である。
図5aから図5fは、本発明の他の実施形態による積層セラミックキャパシタの製造方法を概略的に示す断面図及び斜視図である。
本発明の他の実施形態によると、複数個の第1内部電極パターンが所定の間隔を置いて形成された第1セラミックグリーンシート、及び複数個の第2内部電極パターンが所定の間隔を置いて形成された第2セラミックグリーンシートを製造する段階と、上記第1内部電極パターンと上記第2内部電極パターンが交差されるように上記第1セラミックグリーンシートと上記第2セラミックグリーンシートを積層することで、セラミックグリーンシート積層本体を形成する段階と、上記第1内部電極パターンと第2内部電極パターンの末端が幅方向に露出した側面を有するように、上記セラミックグリーンシート積層本体を切断する段階と、上記第1内部電極パターンと第2内部電極パターンの末端が露出した側面に第1サイドマージン部及び第2サイドマージン部を形成する段階と、上記切断した積層本体を焼成することで、誘電体層と第1及び第2内部電極を含むセラミック本体を製造する段階と、を含む積層セラミックキャパシタの製造方法であって、上記セラミック本体は、上記誘電体層を挟んで互いに対向するように配置される上記第1内部電極及び第2内部電極を含み、容量が形成される部分である活性部と、上記活性部の上部及び下部に形成されたカバー部と、を含み、上記第1及び第2サイドマージン部は、サイドマージン部の外側面に隣接した第1領域と、上記第1及び第2内部電極に隣接した第2領域とに分けられ、上記カバー部は、上記セラミック本体の外側面に隣接した第1領域と、上記第1及び第2内部電極のうち最外側に配置された内部電極に隣接した第2領域とに分けられ、上記カバー部の第2領域と上記第1及び第2サイドマージン部の第2領域に含まれるマグネシウム(Mg)の含量が、上記カバー部の第1領域と上記第1及び第2サイドマージン部の第1領域に含まれるマグネシウム(Mg)の含量よりもそれぞれさらに多い、積層セラミックキャパシタの製造方法を提供する。
以下、本発明の他の実施形態による積層セラミックキャパシタの製造方法を説明する。
図5aに示すように、セラミックグリーンシート211上に、所定の間隔を置いて複数個のストライプ状の第1内部電極パターン221を形成する。上記複数個のストライプ状の第1内部電極パターン221は、互いに平行に形成することができる。
上記セラミックグリーンシート211は、セラミック粉末、有機溶剤、及び有機バインダーを含むセラミックペーストで形成されることができる。
上記セラミック粉末は高い誘電率を有する物質であって、これに制限されるものではないが、チタン酸バリウム(BaTiO)系材料、鉛複合ペロブスカイト系材料、またはチタン酸ストロンチウム(SrTiO)系材料などを用いることができ、チタン酸バリウム(BaTiO)粉末を用いることが好ましい。上記セラミックグリーンシート211が焼成されると、セラミック本体110を構成する誘電体層111になる。
ストライプ状の第1内部電極パターン221は、導電性金属を含む内部電極ペーストによって形成されることができる。上記導電性金属は、これに制限されるものではないが、ニッケル(Ni)、銅(Cu)、パラジウム(Pd)、またはこれらの合金であることができる。
上記セラミックグリーンシート211上にストライプ状の第1内部電極パターン221を形成する方法は特に制限されないが、例えば、スクリーン印刷法またはグラビア印刷法などの印刷法により形成することができる。
また、図示していないが、さらに他のセラミックグリーンシート211上に、所定の間隔を置いて複数個のストライプ状の第2内部電極パターン222を形成することができる。
以下、第1内部電極パターン221が形成されたセラミックグリーンシートを第1セラミックグリーンシートと称し、第2内部電極パターン222が形成されたセラミックグリーンシートを第2セラミックグリーンシートと称する。
次に、図5bに示すように、ストライプ状の第1内部電極パターン221とストライプ状の第2内部電極パターン222とが交差積層されるように、第1及び第2セラミックグリーンシートを交互に積層することができる。
その後、上記ストライプ状の第1内部電極パターン221により第1内部電極121を形成することができ、ストライプ状の第2内部電極パターン222により第2内部電極122を形成することができる。
本発明の他の実施形態によると、上記第1及び第2セラミックグリーンシートの厚さtdは0.6μm以下であり、第1及び第2内部電極パターンの厚さteは0.5μm以下である。
本発明は、誘電体層の厚さが0.4μm以下、内部電極の厚さが0.4μm以下の薄膜を有する超小型及び高容量の積層セラミックキャパシタであることを特徴とする。したがって、上記第1及び第2セラミックグリーンシートの厚さtdは0.6μm以下であり、第1及び第2内部電極パターンの厚さteは0.5μm以下であることを特徴とする。
図5cは、本発明の一実施形態によって第1及び第2セラミックグリーンシートが積層されたセラミックグリーンシート積層本体220を示す断面図であり、図5dは、第1及び第2セラミックグリーンシートが積層されたセラミックグリーンシート積層本体220を示す斜視図である。
図5c及び図5dを参照すると、複数個の平行なストライプ状の第1内部電極パターン221が印刷された第1セラミックグリーンシートと、複数個の平行なストライプ状の第2内部電極パターン222が印刷された第2セラミックグリーンシートは、互いに交互に積層される。
より具体的には、第1セラミックグリーンシートに印刷されたストライプ状の第1内部電極パターン221の中央部と、第2セラミックグリーンシートに印刷されたストライプ状の第2内部電極パターン222の間の間隔とが重なるように積層されることができる。
次に、図5dに示すように、上記セラミックグリーンシート積層本体220は、複数個のストライプ状の第1内部電極パターン221及びストライプ状の第2内部電極パターン222を横切るように切断することができる。すなわち、上記セラミックグリーンシート積層本体220は、互いに直交するC1-C1及びC2-C2の切断線に沿って切断された積層本体210になることができる。
より具体的には、ストライプ状の第1内部電極パターン221及びストライプ状の第2内部電極パターン222を長さ方向に切断することで、一定の幅を有する複数個の内部電極に分割することができる。この際、積層されたセラミックグリーンシートも内部電極パターンとともに切断する。これにより、内部電極の幅と同一の幅を有するように誘電体層が形成されることができる。
また、C2-C2の切断線に沿って、個別のセラミック本体のサイズに合わせて切断することができる。すなわち、第1サイドマージン部及び第2サイドマージン部を形成する前に、棒状積層体をC2-C2の切断線に沿って個別のセラミック本体のサイズに切断することで、複数個の積層本体210を形成することができる。
すなわち、棒状積層体を、重なっている第1内部電極の中心部と第2内部電極の間に形成された所定の間隔が同一の切断線に沿って切断されるように切断することができる。これにより、第1内部電極及び第2内部電極の一端は、切断面において交互に露出することができる。
その後、上記積層本体210の第1及び第2側面に第1サイドマージン部及び第2サイドマージン部を形成することができる。
次に、図5eに示すように、上記積層本体210の第1及び第2側面のそれぞれに、第1サイドマージン部212及び第2サイドマージン部(不図示)を形成することができる。
具体的には、第1サイドマージン部212の形成方法として、側面用セラミックグリーンシート212をゴム製の打抜き弾性材300の上部に配置する。
次に、上記積層本体210の第1側面が上記側面用セラミックグリーンシート212と向かい合うように上記積層本体210を90度回転した後、上記積層本体210を上記側面用セラミックグリーンシート212に加圧密着させる。
上記積層本体210を上記側面用セラミックグリーンシート212に加圧密着させて側面用セラミックグリーンシート212を上記積層本体210に転写する場合、上記ゴム製の打抜き弾性材300により、上記側面用セラミックグリーンシート212は上記積層本体210の側面の角部まで形成され、残りの部分は切断されることができる。
図5fでは、側面用セラミックグリーンシート212が上記積層本体210の側面の角部まで形成されたことを示している。
その後、上記積層本体210を回転し、積層本体210の第2側面に第2サイドマージン部を形成することができる。
次に、上記積層本体210の両側面に第1及び第2サイドマージン部が形成された積層本体をか焼及び焼成して、誘電体層と第1及び第2内部電極を含むセラミック本体を形成することができる。
その後、上記第1内部電極が露出したセラミック本体の第3側面と、上記第2内部電極が露出したセラミック本体の第4側面に、それぞれ外部電極を形成することができる。
本発明の他の実施形態によると、側面用セラミックグリーンシートが薄く、且つ厚さのばらつきが少ないため、容量形成部のサイズを大きく確保することができる。
具体的には、焼成後における第1及び第2サイドマージン部112、113の平均厚さが2μm以上10μm以下であり、位置毎の厚さのばらつきが少ないため、容量形成部のサイズを大きく確保することができる。
これにより、高容量の積層セラミックキャパシタの実現が可能である。
その他に、上述の本発明の一実施形態における特徴と同一の部分に関する説明は、重複を避けるためにここでは省略する。
以下、実験例を挙げて本発明をより詳細に説明するが、これは発明の具体的な理解のためのものにすぎず、本発明の範囲が実験例によって限定されるものではない。
(実験例)
本発明の一実施形態によって、従来のサイドマージン部を形成する比較例と、マグネシウム(Mg)の含量が異なる第1及び第2領域を含むサイドマージン部を形成する実施例をそれぞれ準備した。
そして、幅方向に内部電極が露出し、マージンのないグリーンチップの電極露出部に、上記比較例と実施例のように側面用セラミックグリーンシートを付着してサイドマージン部を形成することができるように、セラミックグリーンシート積層本体を形成した。
チップの変形を最小化した条件で一定の温度と圧力を加えながら、セラミックグリーンシート積層本体の両面に側面形成用セラミックグリーンシートを付着し、0603サイズ(横×縦×高さ:0.6mm×0.3mm×0.3mm)の積層セラミックキャパシタグリーンチップを製作した。
このように製作が完了した積層セラミックキャパシタの試験片を、400℃以下、窒素雰囲気でか焼工程を経て、焼成温度1200℃以下、水素濃度0.5%H以下の条件で焼成した後、外観不良、絶縁抵抗、及び耐湿特性などの電気的特性を総合的に確認した。
図6は本発明の実施例と比較例による絶縁破壊電圧(Breakdown Voltage、BDV)を比較したグラフである。
図6において、比較例1は従来の積層セラミックキャパシタの構造であって、サイドマージン部に含まれるマグネシウム(Mg)の含量に差がない場合であり、実施例1及び2はそれぞれ、第1及び第2内部電極121、122に隣接した第1及び第2サイドマージン部112、113の第2領域112b、113bに含まれるマグネシウム(Mg)の含量が10モル及び30モルである場合であり、比較例2は、第1及び第2内部電極121、122に隣接した第1及び第2サイドマージン部112、113の第2領域112b、113bに含まれるマグネシウム(Mg)の含量が50モルである場合である。
実施例1及び2の場合、従来の積層セラミックキャパシタである比較例1に比べて絶縁破壊電圧(Breakdown Voltage、BDV)が増加していることが分かる。
比較例2の場合、絶縁破壊電圧(Breakdown Voltage、BDV)が増加するものの、その散布が不均一であり、耐湿信頼性の散布も不均一であるため、本発明において、第1及び第2サイドマージン部112、113の第2領域112b、113bに含まれるマグネシウム(Mg)の含量は30モル以下であることが好ましい。
以上、本発明の実施形態について詳細に説明したが、本発明の範囲はこれに限定されず、特許請求の範囲に記載された本発明の技術的思想から外れない範囲内で多様な修正及び変形が可能であるということは、当技術分野の通常の知識を有する者には明らかである。
110 セラミック本体
111 誘電体層
112、113 第1及び第2サイドマージン部
121、122 第1及び第2内部電極
131、132 第1及び第2外部電極

Claims (16)

  1. 誘電体層を含み、互いに対向する第1面及び第2面、前記第1面と第2面を連結する第3面及び第4面、及び前記第1面~第4面と連結され、互いに対向する第5面及び第6面を有するセラミック本体と、
    前記セラミック本体の内部に配置され、前記第1面及び第2面に露出し、且つ前記第3面または第4面に一端が露出する複数の内部電極と、
    前記第1面及び第2面に露出した前記内部電極の端部上に配置された第1サイドマージン部及び第2サイドマージン部と、を含む積層セラミックキャパシタであって、
    前記セラミック本体は、前記誘電体層を挟んで互いに対向するように配置される前記複数の内部電極を含み、容量が形成される部分である活性部と、前記活性部の上部及び下部に形成されたカバー部と、を含み、
    前記第1及び第2サイドマージン部は、サイドマージン部の外側面に隣接した第1領域と、前記第1面及び第2面に露出した内部電極に隣接した第2領域とに分けられ、
    前記カバー部は、前記セラミック本体の外側面に隣接した第1領域と、前記複数の内部電極のうち最外側に配置された内部電極に隣接した第2領域とに分けられ、
    前記カバー部と第1及び第2サイドマージン部の第2領域に含まれるマグネシウム(Mg)の含量が、第1領域に含まれるマグネシウム(Mg)の含量よりもそれぞれさらに多い、積層セラミックキャパシタ。
  2. 前記第2領域のマグネシウム(Mg)の含量は、前記カバー部と第1及び第2サイドマージン部に含まれるチタン(Ti)に対して10モル以上30モル以下である、請求項1に記載の積層セラミックキャパシタ。
  3. 前記複数の内部電極のうち、中央部に配置される内部電極の末端と接する前記第1または第2サイドマージン部領域の厚さに対して、最外側に配置される内部電極の末端と接する前記第1または第2サイドマージン部領域の厚さの比率が0.9以上1.0以下である、請求項1に記載の積層セラミックキャパシタ。
  4. 前記複数の内部電極のうち、中央部に配置される内部電極の末端と接する前記第1または第2サイドマージン部領域の厚さに対して、前記セラミック本体の角と接する前記第1または第2サイドマージン部領域の厚さの比率が0.9以上1.0以下である、請求項1から3のいずれか一項に記載の積層セラミックキャパシタ。
  5. 前記誘電体層の厚さが0.4μm 以下である、請求項1に記載の積層セラミックキャパシタ。
  6. 前記内部電極の厚さが0.4μm以下である、請求項1に記載の積層セラミックキャパシタ。
  7. 前記誘電体層の厚さが0.4μm以下であり、前記内部電極の厚さが0.4μm以下である、請求項1から3のいずれか一項に記載の積層セラミックキャパシタ。
  8. 前記第1サイドマージン部及び第2サイドマージン部は、平均厚さが2μm以上10μm以下である、請求項1から3のいずれか一項に記載の積層セラミックキャパシタ。
  9. 前記第1及び第2サイドマージン部の第1領域の幅が12μm以下であり、第2領域の幅が3μm以下である、請求項1から3のいずれか一項に記載の積層セラミックキャパシタ。
  10. 複数個の第1内部電極パターンが所定の間隔を置いて形成された第1セラミックグリーンシート、及び複数個の第2内部電極パターンが所定の間隔を置いて形成された第2セラミックグリーンシートを製造する段階と、
    前記第1内部電極パターンと前記第2内部電極パターンが交差されるように前記第1セラミックグリーンシートと前記第2セラミックグリーンシートを積層することで、セラミックグリーンシート積層本体を形成する段階と、
    前記第1内部電極パターンと第2内部電極パターンの末端が幅方向に露出した側面を有するように、前記セラミックグリーンシート積層本体を切断する段階と、
    前記第1内部電極パターンと第2内部電極パターンの末端が露出した側面に、第1サイドマージン部及び第2サイドマージン部を形成する段階と、
    前記切断した積層本体を焼成することで、誘電体層と第1及び第2内部電極を含むセラミック本体を製造する段階と、を含む積層セラミックキャパシタの製造方法であって、
    前記セラミック本体は、前記誘電体層を挟んで互いに対向するように配置される前記第1内部電極及び第2内部電極を含み、容量が形成される部分である活性部と、前記活性部の上部及び下部に形成されたカバー部と、を含み、
    前記第1及び第2サイドマージン部は、サイドマージン部の外側面に隣接した第1領域と、前記第1及び第2内部電極に隣接した第2領域とに分けられ、
    前記カバー部は、前記セラミック本体の外側面に隣接した第1領域と、前記第1及び第2内部電極のうち最外側に配置された内部電極に隣接した第2領域とに分けられ、
    前記カバー部と第1及び第2サイドマージン部の第2領域に含まれるマグネシウム(Mg)の含量が、第1領域に含まれるマグネシウム(Mg)の含量よりもそれぞれさらに多い、積層セラミックキャパシタの製造方法。
  11. 前記第2領域のマグネシウム(Mg)の含量は、前記カバー部と第1及び第2サイドマージン部に含まれるチタン(Ti)に対して10モル以上30モル以下である、請求項10に記載の積層セラミックキャパシタの製造方法。
  12. 前記第1及び第2セラミックグリーンシートの厚さが0.6μm以下であり、前記第1及び第2内部電極パターンの厚さが0.5μm以下である、請求項10に記載の積層セラミックキャパシタの製造方法。
  13. 前記第1及び第2内部電極のうち、中央部に配置される内部電極の末端と接する前記第1または第2サイドマージン部領域の厚さに対して、最外側に配置される内部電極の末端と接する前記第1または第2サイドマージン部領域の厚さの比率が0.9以上1.0以下である、請求項10 に記載の積層セラミックキャパシタの製造方法。
  14. 前記第1及び第2内部電極のうち、中央部に配置される内部電極の末端と接する前記第1または第2サイドマージン部領域の厚さに対して、前記セラミックグリーンシート積層本体の角と接する前記第1または第2サイドマージン部領域の厚さの比率が0.9以上1.0以下である、請求項10から13のいずれか一項に記載の積層セラミックキャパシタの製造方法。
  15. 前記第1サイドマージン部及び第2サイドマージン部は、平均厚さが2μm以上10μm以下である、請求項10から13のいずれか一項に記載の積層セラミックキャパシタの製造方法。
  16. 前記第1及び第2サイドマージン部の第1領域の幅が12μm以下であり、第2領域の幅が3μm以下である、請求項10から13のいずれか一項に記載の積層セラミックキャパシタの製造方法。
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Families Citing this family (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR102543977B1 (ko) 2018-08-09 2023-06-15 삼성전기주식회사 적층 세라믹 커패시터 및 그 제조 방법
KR20200075287A (ko) * 2018-12-18 2020-06-26 삼성전기주식회사 커패시터 부품
KR20190116113A (ko) * 2019-06-21 2019-10-14 삼성전기주식회사 적층 세라믹 커패시터 및 그 제조 방법
KR20210081668A (ko) * 2019-12-24 2021-07-02 삼성전기주식회사 적층 세라믹 커패시터 및 그 제조 방법
JP2021174829A (ja) * 2020-04-22 2021-11-01 株式会社村田製作所 積層セラミックコンデンサ
JP2021174822A (ja) 2020-04-22 2021-11-01 株式会社村田製作所 積層セラミックコンデンサ
KR20220058118A (ko) 2020-10-30 2022-05-09 삼성전기주식회사 적층형 전자 부품
KR20230068724A (ko) 2021-11-11 2023-05-18 삼성전기주식회사 커패시터 부품
KR20230090738A (ko) * 2021-12-15 2023-06-22 삼성전기주식회사 적층 세라믹 커패시터의 제조 방법 및 적층 세라믹 커패시터

Family Cites Families (28)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2998639B2 (ja) * 1996-06-20 2000-01-11 株式会社村田製作所 積層セラミックコンデンサ
US7433173B2 (en) * 2004-11-25 2008-10-07 Kyocera Corporation Multilayer ceramic capacitor and method for manufacturing the same
FR2915796B1 (fr) 2007-05-03 2009-06-12 Siemens Vdo Automotive Sas Dispositif de suppression du phenomene d'interferences entre zones de detection capacitives d'un capteur
US7859823B2 (en) * 2007-06-08 2010-12-28 Murata Manufacturing Co., Ltd. Multi-layered ceramic electronic component
JP4925958B2 (ja) * 2007-07-27 2012-05-09 京セラ株式会社 積層セラミックコンデンサ
KR101120004B1 (ko) 2009-06-19 2012-02-22 가부시키가이샤 무라타 세이사쿠쇼 세라믹 전자부품
KR101523630B1 (ko) 2009-12-11 2015-05-28 가부시키가이샤 무라타 세이사쿠쇼 적층형 세라믹 전자부품
KR101474065B1 (ko) 2012-09-27 2014-12-17 삼성전기주식회사 적층 칩 전자부품, 그 실장 기판 및 포장체
KR101452068B1 (ko) 2012-12-18 2014-10-16 삼성전기주식회사 적층 세라믹 커패시터 및 적층 세라믹 커패시터가 실장된 회로 기판
JP6024483B2 (ja) * 2013-01-29 2016-11-16 株式会社村田製作所 積層型セラミック電子部品
JP5696821B2 (ja) * 2013-03-19 2015-04-08 株式会社村田製作所 積層セラミックコンデンサ
KR101548797B1 (ko) * 2013-04-08 2015-08-31 삼성전기주식회사 적층 세라믹 커패시터 및 그 제조방법
JP5617026B2 (ja) * 2013-11-19 2014-10-29 太陽誘電株式会社 積層セラミックコンデンサ
JP6439551B2 (ja) * 2014-05-21 2018-12-19 株式会社村田製作所 積層セラミックコンデンサ
JP2016001723A (ja) * 2014-05-22 2016-01-07 株式会社村田製作所 積層セラミックコンデンサ
US8971017B1 (en) * 2014-10-30 2015-03-03 Murata Manufacturing Co., Ltd. Multilayer ceramic capacitor
JP2015053526A (ja) * 2014-12-04 2015-03-19 株式会社村田製作所 積層セラミックコンデンサ
JP6370744B2 (ja) 2015-06-24 2018-08-08 太陽誘電株式会社 積層セラミックコンデンサ及びその製造方法
JP6665438B2 (ja) * 2015-07-17 2020-03-13 株式会社村田製作所 積層セラミックコンデンサ
KR102183425B1 (ko) * 2015-07-22 2020-11-27 삼성전기주식회사 적층 세라믹 전자부품
JP6416744B2 (ja) * 2015-12-15 2018-10-31 太陽誘電株式会社 積層セラミックコンデンサ及びその製造方法
JP6449798B2 (ja) * 2016-01-26 2019-01-09 太陽誘電株式会社 積層セラミック電子部品及びその製造方法、並びにセラミック素体
JP2018063969A (ja) * 2016-10-11 2018-04-19 株式会社村田製作所 積層セラミックコンデンサ
JP6745700B2 (ja) * 2016-10-17 2020-08-26 太陽誘電株式会社 積層セラミックコンデンサ及びその製造方法
JP6996854B2 (ja) * 2017-03-08 2022-01-17 太陽誘電株式会社 積層セラミックコンデンサ及びその製造方法
CN106944028A (zh) * 2017-03-21 2017-07-14 北京化工大学 一种3d结构的石墨烯基复合固体碱催化剂的制备方法
KR102543977B1 (ko) 2018-08-09 2023-06-15 삼성전기주식회사 적층 세라믹 커패시터 및 그 제조 방법
KR102495669B1 (ko) 2018-08-10 2023-02-03 삼성전기주식회사 적층 세라믹 커패시터 및 그 제조 방법

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