JP2003323164A - 液晶表示装置とその駆動方法 - Google Patents
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Abstract
る際の低消費電力化を図る。 【解決手段】 表示データ量が異なる第1の液晶表示パ
ネル(メインパネル)と第2の液晶表示パネル(サブパ
ネル)の二つの液晶表示パネルと、メインパネル側にド
レインドライバとゲートドライバを有して、メインパネ
ルとサブパネルを択一的または同時的に映像の表示を可
能とした。メインパネルPNL1側にタイミングコント
ローラ(TCON)520と映像メモリ(グラフィック
RAM)521を備えたソースドライバ52とゲートド
ライバ51を備える。タイミングコントローラ520の
制御の下に、ソースドライバ51は、メインパネルPN
L1とサブパネルPNL2に連通する共通のソース線D
Lm(DLs)に映像信号を供給し、ゲートドライバ5
1はメインパネルPNL1とサブパネルPNL2のそれ
ぞれに個別に有する各ゲート線GLm、GLmsに走査
信号をそれぞれ供給する。
Description
り、特に表示データ量が異なる二つの液晶表示パネルを
有し、各液晶表示パネルに択一的または同時的に映像の
表示を可能とした液晶表示装置とその駆動方法に関す
る。
力といった特徴を生かして、パーソナルコンピュータに
代表される情報機器や携帯型の情報端末、デジタルカメ
ラやカメラ一体型VTR等の映像情報、文字情報の表示
デバイスとして広く用いられている。近年、特に携帯電
話機や携帯情報端末等の小型機器の急速な普及に伴っ
て、低消費電力に対する要求がますます強くなってい
る。
ンテンツ情報などの主たる利用情報の表示を行う画面と
は別に機器のステータス情報や操作情報、などの簡単な
情報を表示する画面を備えることで、利便性や省電力化
を達成することが期待されている。すなわち、折り畳み
タイプの携帯電話機など、本体の二面に画面を有するも
のなどでの待ち受け状態では、表示データ量が少なく、
小サイズ、低消費電力の画面のみ動作状態とし、通信情
報の送受操作では必要とされる表示データ量の画面を動
作させることで、全体としての低消費電力化が可能とな
る。
して駆動される二つの液晶表示パネルを携帯電話機など
に組み込むためには制限された筐体内容積が不足し、ま
たそれぞれに有する駆動回路を使用状態に応じて駆動さ
せるための回路も必要となるため、回路構成が複雑にな
り、コスト高を招く。
表示パネルで実現する際の容積低減と回路構成を簡単に
し、かつ低電力化した液晶表示装置とその駆動方法を提
供することにある。
め、本発明は、表示データ量が異なる第1の液晶表示パ
ネル(以下、メインパネルとも称する)と第2の液晶表
示パネル(以下、サブパネルとも称する)の二つの液晶
表示パネルと、メインパネル側にドレインドライバとゲ
ートドライバを有して、メインパネルとサブパネルを択
一的または同時的に映像の表示を可能とした液晶表示装
置を基本構成とする。
グコントローラ(TCON)と映像メモリ(グラフィッ
クRAM)を備えた映像信号線駆動回路(以下、ドレイ
ンドライバとも称する)と走査信号線駆動回路(以下、
ゲートドライバとも称する)を備える。そして、上記タ
イミングコントローラの制御の下に、ドレインドライバ
は、メインパネルとサブパネルに連通する共通の映像信
号線(以下、ドレイン線とも称する)に映像信号を供給
し、ゲートドライバはメインパネルとサブパネルのそれ
ぞれに個別に有する各ゲート線に走査信号をそれぞれ供
給する機能を有する。
の特徴は下記(1)乃至(5)に記載のとおりである。
差する第2方向に並設された多数の主走査信号線と、前
記第2方向に延在し前記第1方向に並設された多数の主
映像信号線とを形成した第1アクティブ基板を有する第
1の液晶表示パネルと、前記第1方向に延在し前記第2
方向に並設された多数の副走査信号線と、前記第2方向
に延在し前記第1方向に並設された多数の副映像信号線
を形成した第2アクティブ基板を有する第2の液晶表示
パネルと、前記第1の液晶表示パネルの第1アクティブ
基板に搭載されて前記主走査信号線と前記副走査線に走
査信号を供給する走査信号線駆動回路と、前記第1の液
晶表示パネルの第1アクティブ基板に搭載され、少なく
とも前記第1の液晶表示パネルの表示領域に表示される
表示データ容量を有する映像メモリとタイミングコンバ
ータを内蔵して前記主映像信号線と前記副映像信号線に
映像信号を供給する映像信号線駆動回路と、前記走査信
号線駆動回路から出力される副走査信号および前記映像
信号線駆動回路から出力される副映像信号を前記副走査
信号線および前記副映像信号線に接続するフレキシブル
プリント基板を有し、前記タイミングコンバータの制御
に基づいて前記第1の液晶表示パネルと第2の液晶表示
パネルに異なる映像信号を供給する。
駆動回路に有する映像メモリは、その一部に前記第2の
液晶表示装置に表示する表示データの領域を可変的に有
する。
記走査信号線駆動回路は前記主走査線に供給する主走査
信号と前記副走査線に供給する副走査信号の総和を生成
する。
て、前記副映像信号線は前記主映像信号線の一部に前記
フレキシブルプリント基板を介して接続されている。
て、前記副走査信号線の数および前記副映像信号線の数
は前記主走査信号線の数および前記主映像信号線の数よ
り少ない。
表示装置の駆動方法の特徴は下記(6)乃至(11)に
記載のとおりである。
に基づいて前記第1の液晶表示パネルと第2の液晶表示
パネルに択一的または同時的に映像信号を表示する。
駆動回路の走査信号出力数を前記第1の液晶表示パネル
の主走査信号線と前記第2の液晶表示パネルの副走査信
号線の総和とした。
表示パネルにのみ表示を行う場合は、前記映像メモリの
全領域に当該第1の液晶表示パネルの表示データを格納
し、前記走査信号線駆動回路は前記主走査信号線に走査
信号を順次供給すると共に、前記副走査信号線には帰線
期間にリフレッシュのための走査信号を一括出力する。
表示パネルと前記第2の液晶表示パネルとに表示を行う
場合は、前記映像メモリの領域の一部に前記第2の液晶
表示パネルの表示データを格納すると共に、残りの領域
に前記第1の液晶表示パネルの表示データを格納し、前
記走査信号線駆動回路は前記主走査信号線に走査信号を
順次供給し、前記第2の液晶表示パネルの表示期間に対
応する主走査信号線の帰線期間にリフレッシュのための
走査信号を一括出力する。
晶表示パネルにのみ表示を行う場合は、前記映像メモリ
の一部の域に当該第2の液晶表示パネルの表示データを
格納し、前記走査信号線駆動回路は前記副走査信号線に
走査信号を順次供給すると共に、前記主走査信号線には
帰線期間にリフレッシュのための走査信号を一括出力す
る。
前記映像信号線駆動回路は、前記第1の液晶表示パネル
と前記第2の液晶表示パネルのそれぞれの表示データを
前記主映像信号線および/または前記副映像信号線に出
力する。
の駆動方法により、二つの液晶表示パネルで択一的また
は同時的に二つの画面を表示する際の映像メモリの容積
低減と回路構成の簡単化、かつ低電力化を実現できる。
る実施例の構成に限定されるものではなく、本発明の技
術思想を逸脱することなく種々の変更が可能であり、薄
膜トランジスタをアクティブ素子としたアクティブマト
リクス型に限らず、その他の既知のアクティブ素子を用
いたもの、あるいは単純マトリクス型などの液晶表示パ
ネルを用いた液晶表示装置にも同様に適用できることは
言うまでもない。
態について、実施例の図面を参照して詳細に説明する。
以下の説明中に参照する図面において、同一機能を有す
るものは同一の参照符号を付し、重複説明は可能な限る
省略する。なお、ここでは薄膜トランジスタをアクティ
ブ素子として用いたツイステッドネマチック型液晶表示
パネルを例として説明する。
施例の構成を模式的に説明する平面図である。図中の参
照符号PNL1はメインパネルを示し、第1基板1mと
第2基板503mの間に液晶層が挟持されている。第1
基板1mの主面すなわち第2基板503mと対向する内
面に第1の方向(水平方向、以下x方向)に延在し第2
の方向(垂直方向、以下y方向)に並設された多数のゲ
ート線GLmを有する。また、前記y方向に延在しx方
向に並設されてゲート線GLmに交差して配置された多
数のソース線(ドレイン線)DLmを有する。以下、ソ
ース線DLmとして説明する。
1基板1sと第2基板503sの間に液晶層が挟持され
ている。第1基板1sの主面すなわち第2基板503s
と対向する内面にx方向に延在しy方向に並設された多
数のゲート線GLsを有する。また、前記y方向に延在
しx方向に並設されてゲート線GLsに交差して配置さ
れた多数のソース線DLsを有する。本実施例では、表
示の解像度(精細度)が同一で、サブパネルPNL2の
画面サイズがメインパネルPNL1の画面サイズより小
さい。
ース線DLsの数はメインパネルPNL1に有するソー
ス線DLmの数より少なく、またサブパネルPNL2に
有するゲート線GLsの数はメインパネルPNL1に有
するゲート線GLmの数より少ない。
方向の片側(図1の左側)辺にはゲートドライバ(半導
体チップ)51が搭載されている。このゲートドライバ
51はメインパネルPNL1のゲート線GLmとサブパ
ネルPNL2のゲート線GLsにゲート信号(走査信
号)を供給する。すなわち、このゲートドライバ51は
メインパネルPNL1のゲート線GLmとサブパネルP
NL2のゲート線GLsの両方にゲート信号を供給する
端子を有する。
1の下側)辺にはソースドライバ(ドレインドライバ:
半導体チップ)52が搭載されている。以下、ソースド
ライバ52として説明する。メインパネルPNL1のソ
ース線DLmの一部はサブパネルPNL2のソース線D
Lsに連通してメインパネルPNL1の第1基板1mに
搭載されたソースドライバ52で駆動される。
ブルプリント基板300を介して外部信号源(本体側の
CPU等)から入力する映像データやクロック信号を含
む各種タイミング信号に基づいてメインパネルPNL1
とサブパネルPNL2に映像を表示するタイミング信号
等を生成するタイミングコンバータ(TCON)520
および映像データを格納する映像メモリ(グラフィック
メモリ:GRAM)521を内蔵している。以下、映像
メモリを内蔵メモリとして説明する。なお、フレキシブ
ルプリント基板300には電源回路(半導体チップ)5
3が搭載されている。
2の間は第2のフレキシブルプリント基板301で接続
され、ゲートドライバ51とソースドライバ52からの
走査信号と映像信号(階調電圧)が供給される。また、
メインパネルPNL1とサブパネルPNL2の各第2基
板503m,503sの内面には3色のカラーフィルタ
(RGB)と共通電極が形成され、共通電極には共通電
極電圧(Vcom)が印加される。なお、カラーフィル
タや共通電極は図示を省略してある。
ネルに対する走査信号と映像信号(表示データ)の供給
形態例を説明する模式図である。この例では、メインパ
ネルPNL1の表示容量がx方向で176列×RGB、
y方向で240行である。そして、サブパネルPNL2
の表示容量はx方向で88列×RGB、y方向で64行
である。
21はメインパネルPNL1の表示容量である(176
列×RGB)×240行)に相当する容量を有する。こ
の内蔵メモリ521はメインパネルPNL1とサブパネ
ルPNLの両者に割当可能である。ソースドライバ52
はメインパネルPNL1の表示幅(176×RGB=5
28本のソース線の配列幅)に相当する端子数を有す
る。
ルPNL1を走査するための端子数(240本)の配列
幅に相当する端子数に加えて、サブパネルPNL2を走
査するための端子数(64本)の配列幅に相当する端子
数を有する。サブパネルPNL2のソース線DLsはメ
インパネルPNL1のソース線DLmを電気的に延長し
たものである。サブパネルPNL2のソース線DLsと
メインパネルPNL1のソース線DLmとは第2のフレ
キシブルプリント基板301で接続されることは前記の
とおりである。
L1とサブパネルPNL2の各表示モードにおける映像
表示の状態を説明する模式図、図4は図3におけるメイ
ンパネルPNL1とサブパネルPNL2の各表示モード
に対する内蔵メモリのメモリ領域の割当てを説明する模
式図である。図4の内蔵メモリの割当て状態(a)
(b)(c)は図3の(a)(b)(c)の各表示モー
ドに対応する。
モードを有する。その第1表示モードはメインパネルP
NL1のみに表示を行い(PNL1がオン)、サブパネ
ルPNL2には表示をしない(PNL2がオフ)モー
ド、第2表示モードはメインパネルPNL1とサブパネ
ルPNL2の両者に表示を行うモード(PNL1、PN
L2共にオン)、第3表示モードはサブパネルPNL2
のみに表示を行い(PNL2がオン)、メインパネルP
NL1には表示をしない(PNL1がオフ)モードであ
る。図3中の白抜きは各パネルの表示状態を、斜線は非
表示状態を示し、図4中の白抜きは内蔵メモリ521
(GRAM)の表示に利用される領域を、斜線は表示に
利用されない領域を示す。
ドでの内蔵メモリの表示データ領域の割当て状態を示
す。この動作モードでは、内蔵メモリの240行全て
(176列×RGB)×240行をメインパネルPNL
1の表示データの格納に使用する。また、図4の(a)
は図3の(b)の第2表示モードでの内蔵メモリの領域
割当て状態を示す。この動作モードでは、内蔵メモリの
行方向(176列×RGB)×176行の領域をメイン
パネルPNL1に表示に用い、同(176列×RGB)
×64行をサブパネルPNL2の表示に用いる。このと
き、メインパネルPNL1の画面は、両端(176列×
RGB)×32、および(176列×RGB)×32は
非表示とされ、この分をサブパネルPNL2の表示に割
当てられ、メインパネルPNL1にはサブパネルPNL
2に表示される分、狭くなった画面表示となる。
1の動作は、メインパネルPNL1とサブパルスPNL
2の両方を走査する。但し、合計の走査行数はソースド
ライバ52が扱える行数以下とする。ここでは全行数
(240+64=304行)がソースドライバ52の扱
える行数(240行)に対して大きいので、少なくとも
超過分は非走査とする。非走査行は帰線期間にリフレッ
シュのために一括印加する。内蔵メモリ521をメイン
パルスPML1の行数分(176行)とサブパルスPN
L2の行数分(64行)の表示データの格納に用いる。
した第3表示モードでの内蔵メモリの表示データ格納領
域の割当て状態を示す。この動作モードでは、内蔵メモ
リの(176列×RGB)×64行にサブパネルPNL
2の表示データの領域に割りあてる。ゲートドライバ5
1の動作としては、サブパネルPNL2側を走査し、メ
インパルスPNL1側は帰線期間にリフレッシュのため
に一括して走査パルスを印加する。内蔵メモリ521全
体行(64行)をサブパネルPNL2の表示データの格
納に用いる。サブパネルPNL2にのみ表示を行う時
は、内蔵メモリ521のアクセス領域が少ない、すなわ
ち走査行数が少ないので、消費電力の低減が可能であ
る。
て、メインパネルPNL1にのみ表示を行う第1表示モ
ードではゲートドライバ51はメインパネルPNL1を
通常走査し、サブパネルPNL2はその帰線期間に一括
して走査パルスを印加し、リフレッシュを行う。内蔵メ
モリ521全体(ここでは、240行分)をメインパネ
ルPNL1での表示データの格納に用いる。このゲート
線の駆動のための制御信号はタイミングコントローラ
(TCON)520で生成される。
施例の構成を模式的に説明する平面図である。また、図
6は図5におけるメインパネルとサブパネルに対する走
査信号と映像信号(表示データ)の供給形態例を説明す
る模式図である。この例でも、メインパネルPNL1の
表示容量がx方向で176列×RGB、y方向で240
行である。そして、サブパネルPNL2の表示容量はx
方向で88列×RGB、y方向で64行である。
は同一機能部分に対応する。本実施例は、ゲートドライ
バをメインパネルPNL1の両側(図5では左右)に分
割して第1のゲートドライバ511と第2のゲートドラ
イバ512として搭載する。メインパネルPNL1のゲ
ート線GLmは当該パネルの左右から配線される。サブ
パネルPNL2のゲート線GLsへの配線は第1のゲー
トドライバ511から引き出されているが、第2のゲー
トドライバ512から引き出すようにしてもよい。他の
構成は第1実施例と同様なので重複説明は省略する。
パネルで構成する表示面の周縁、所謂額縁領域における
ゲート配線を左右対称とすることができ、また配線に要
するスペースに余裕があるため、当該配線幅の寸法を広
くすることが可能となり、配線抵抗の低減等、設計裕度
が向上する。
法を前記図3および図4で説明した各表示モードについ
て説明する。
法の説明図であり、図2に示した本発明の第1実施例の
構成にゲート線番号とソース線番号を付して簡略化した
説明図である。また、図8は図7の構成とした液晶表示
装置の駆動方法の第1例を説明するタイミング図であ
る。この駆動例は図3の(a)および図4の(a)で説
明したメインパネルのみで表示を行う(PNL1:オ
ン、PNL2:オフ)の第1表示モードに対応する。な
お、図6で説明した第2実施例についても、メインパネ
ルPNL1の左右に振り分けたゲート線に図7と同様の
番号を付したものとすることで図8の動作説明が適用さ
れる。
ルPNL2のゲート線(G1乃至G64)へのゲート信
号線、GLmはメインパネルPNL1のゲート線(G6
5乃至G304)へのゲート信号線、DLm(S1乃至
S528)はソースドライバ52からメインパネルPN
L1のソース線(176×RGB)出力されるソース信
号線である。このソース信号線DLmの一部(S1乃至
S264)はサブパネルPNL2のソース線(88列×
RGB)へのソース信号線DLsに連通している。ゲー
トドライバ51からサブパネルPNL2のゲート線G1
乃至G64にゲート信号が供給される。また、ゲートド
ライバ51からメインパネルPNL1のゲート線G65
乃至G304にゲート信号が供給される。
1乃至G304、S1,S2乃至S528は図7におけ
る同一参照符号を付したゲート線およびソース線に対応
する。また、参照符号Fはフレーム周期、Tsは走査期
間、Tbは帰線期間、Vcomは対向電極電圧を示す。
以下、図3の(a)および図4の(a)も参照して本動
作例を説明する。
ネルPNL2のゲート線G1乃至G64には、その帰線
期間Tbに走査信号(ハイレベルの走査パルス)を一括
して印加し非走査とする。表示するメインパネルPNL
1のゲート線G64乃至G304には、その走査期間T
sに順次走査信号を供給する。なお、走査期間Tsと走
査信号を一括して印加する帰線期間Tbの期間に対向電
極に電圧Vcomを表示レベル(ローレベル)とする。
S1乃至S528NIオフレベル(ローレベル)を印加
し、走査期間Tsでは表示レベルである階調信号を供給
する。このような動作により、メインパネルPNL1に
のみ表示を行うことができる。
法の第2例を説明するタイミング図である。この駆動例
は図3の(b)および図4の(b)で説明したメインパ
ネルサブパネルの両方で表示を行う(PNL1:オン、
PNL2:オン)の第2表示モードに対応する。なお、
図6で説明した第2実施例についても、メインパネルP
NL1の左右に振り分けたゲート線に図7と同様の番号
を付したものとすることで図9の動作説明が適用され
る。図9図において図8と同一参照符号は同一機能部分
のタイミングを示す。以下、図9に示した第2表示モー
ドの動作を図7および図3の(a)と図4の(a)も参
照して本動作例を説明する。
のゲート線G1乃至G64に走査期間Tsで走査信号を
供給する。一方、メインパネルPNL1のゲート線G6
5乃至G304の帰線期間Tbに走査信号(走査パル
ス)を一括して印加し非走査とする。一方、図4の
(b)に示したように、内蔵メモリ(GRAM)521
の走査線64本分に相当する領域にサブパネルPNL2
用の表示データを格納し、走査線176本分に相当する
領域にメインパネルPNL1用の表示データを格納して
おく。そして、帰線期間Tbではソース線S1乃至S5
28にオフレベル(非表示レベル)を供給し、走査期間
Tsではオンレベル(表示レベル)を供給する。
内蔵メモリ(GRAM)521の走査線64本分に相当
する映像が表示され、メインパネルPNL1の走査線3
2乃至208までの範囲に内蔵メモリ(GRAM)52
1の走査線176本分の映像が表示される。
方法の第3例を説明するタイミング図である。この駆動
例は図3の(c)および図4の(c)で説明したサブパ
ネルのみで表示を行う(PNL1:オフ、PNL2:オ
ン)の第3表示モードに対応する。なお、図6で説明し
た第2実施例についても、メインパネルPNL1の左右
に振り分けたゲート線に図7と同様の番号を付したもの
とすることで図10の動作説明が適用される。図10に
おいて図8と同一参照符号は同一機能部分のタイミング
を示す。以下、図10に示した第3表示モードの動作を
図7および図3の(c)と図4の(c)も参照して本動
作例を説明する。
ルPNL1のゲート線G65乃至G304には、その帰
線期間Tbに走査信号(ハイレベルの走査パルス)を一
括して印加し非走査とする。表示するサブパネルPNL
2のゲート線G1乃至G64には、その走査期間Tsに
順次走査信号を供給する。なお、走査期間Tsと走査信
号を一括して印加する帰線期間Tbの期間に対向電極に
電圧Vcomを表示レベル(ローレベル)とする。
S1乃至S528NIオフレベル(ローレベル)を印加
し、走査期間Tsでは表示レベルである階調信号を供給
する。そして、ソース電極S265乃至528にはオフ
レベルを供給する。このような動作により、サブパネル
PNL2にのみ表示を行うことができる。したがって、
この表示モードでは消費電力を抑制して長時間の待ち受
け等を実現できる。
た液晶表示モジュールの構成例を説明する展開斜視図で
ある。メインパネルPNL1の第1基板1にはアクティ
ブマトリクスアレイ(表示領域)50とゲートドライバ
51とソースドライバ52を有し、第2基板503の主
面(内面)にはカラーフィルタCFおよび共通電極(図
示せず)が形成されている。そして、第1基板1と第2
基板503の間に液晶層が封入されている。さらに、第
1基板1背面には位相差フィルム504と偏光フィルム
505が設置されている。また、第2基板503の上面
にも位相差フィルム509と偏光フィルム501が設置
されている。
イバ51とソースドライバ52が実装され、ソースドラ
イバ52の実装辺に集積回路チップからなる電源回路5
3が搭載された第1フレキシブルプリント基板300の
一端が接続され、他端の端子301が図示しない外部信
号源に接続される。参照符号506は一端に発光ダイオ
ード506と導光板507で構成した照明装置(バック
ライト)が配置されている。これらの構成要素は下ケー
ス508と上ケース500で一体化されて液晶表示モジ
ュールとされている。この液晶表示モジュールは携帯電
話機や携帯情報端末の表示手段として使用される。
ルPNL2が第2フレキシブルプリント基板301で接
続されている。このサブパネルPNL2の構造もメイン
パネルPNL1の構造に準じたものとなっており、ゲー
ト線およびソース線の数は前記したようになっている。
例を説明する平面図である。メインパネルPNL1は第
1基板1と第2基板503で液晶表示パネルが形成さ
れ、そのアクティブマトリクスアレイ(表示領域)50
の周辺に集積回路チップからなる走査信号線駆動回路5
1と映像信号線駆動回路52が実装されている。フレキ
シブルプリント基板300には電源回路53が搭載され
ている。
シブルプリント基板301でサブパネルPNL2が接続
されている。このような液晶表示装置は、例えば、形態
電話機の主表示画面にメインパネルPNL1を、待ち受
け表示や時計表示等の簡単なデータ表示にサブパネルP
NL2を用いるような使い方ができる。
ば、二つの画面を二つの液晶表示パネルを択一的にある
いは同時に用いるる際の機器の容積低減と回路構成の簡
単化が実現され、全体として低電力の液晶表示装置を提
供することができる。
を模式的に説明する平面図である。
る走査信号と映像信号(表示データ)の供給形態例を説
明する模式図である。
L1とサブパネルPNL2の各表示モードにおける映像
表示の状態を説明する模式図である。
ルPNL2の各表示モードに対する内蔵メモリのメモリ
領域の割当てを説明する模式図である。
を模式的に説明する平面図である。
る走査信号と映像信号(表示データ)の供給形態例を説
明する模式図である。
である。
1例を説明するタイミング図である。
を説明するタイミング図である。
例を説明するタイミング図である。
モジュールの構成例を説明する展開斜視図である。
る平面図である。
第2基板、50・・・・表示領域、51・・・・走査線
駆動回路(ゲートドライバ)、52・・・・映像信号線
駆動回路(ソースドライバ)、53・・・・電源回路、
520・・・・タイミングコントローラ、521・・・
・内蔵メモリ、300,301・・・・フレキシブルプ
リント基板。
Claims (11)
- 【請求項1】第1方向に延在し該第1方向に交差する第
2方向に並設された多数の主走査信号線と、前記第2方
向に延在し前記第1方向に並設された多数の主映像信号
線とを形成した第1アクティブ基板を有する第1の液晶
表示パネルと、 前記第1方向に延在し前記第2方向に並設された多数の
副走査信号線と、前記第2方向に延在し前記第1方向に
並設された多数の副映像信号線を形成した第2アクティ
ブ基板を有する第2の液晶表示パネルと、 前記第1の液晶表示パネルの第1アクティブ基板に搭載
されて前記主走査信号線と前記副走査線に走査信号を供
給する走査信号線駆動回路と、 前記第1の液晶表示パネルの第1アクティブ基板に搭載
され、少なくとも前記第1の液晶表示パネルの表示領域
に表示される表示データ容量を有する映像メモリとタイ
ミングコンバータを内蔵して前記主映像信号線と前記副
映像信号線に映像信号を供給する映像信号線駆動回路
と、 前記走査信号線駆動回路から出力される副走査信号およ
び前記映像信号線駆動回路から出力される副映像信号を
前記副走査信号線および前記副映像信号線に接続するフ
レキシブルプリント基板を有し、 前記タイミングコンバータの制御に基づいて前記第1の
液晶表示パネルと第2の液晶表示パネルに異なる映像信
号を供給することを特徴とする液晶表示装置。 - 【請求項2】前記映像信号線駆動回路に有する映像メモ
リは、その一部に前記第2の液晶表示装置に表示する表
示データの領域を可変的に有することを特徴とする請求
項1に記載の液晶表示装置。 - 【請求項3】前記走査信号線駆動回路は前記主走査線に
供給する主走査信号と前記副走査線に供給する副走査信
号の総和を生成することを特徴とする請求項1または2
に記載の液晶表示装置。 - 【請求項4】前記副映像信号線は前記主映像信号線の一
部に前記フレキシブルプリント基板を介して接続されて
いることを特徴とする請求項1乃至3の何れかに記載の
液晶表示装置。 - 【請求項5】前記副走査信号線の数および前記副映像信
号線の数は前記主走査信号線の数および前記主映像信号
線の数より少ないことを特徴とする請求項1乃至4の何
れかに記載の液晶表示装置。 - 【請求項6】第1方向に延在し該第1方向に交差する第
2方向に並設された多数の主走査信号線と、前記第2方
向に延在し前記第1方向に並設された多数の主映像信号
線とを形成した第1アクティブ基板を有する第1の液晶
表示パネルと、 前記第1方向に延在し前記第2方向に並設された多数の
副走査信号線と、前記第2方向に延在し前記第1方向に
並設された多数の副映像信号線を形成した第2アクティ
ブ基板を有する第2の液晶表示パネルと、 前記第1の液晶表示パネルの第1アクティブ基板に搭載
されて前記主走査信号線と前記副走査線に走査信号を供
給する走査信号線駆動回路と、 前記第1の液晶表示パネルの第1アクティブ基板に搭載
され、前記第1の液晶表示パネルの表示領域に表示され
る表示データ容量を有する映像メモリとタイミングコン
バータを内蔵して前記主映像信号線と前記副映像信号線
に映像信号を供給する映像信号線駆動回路と、 前記走査信号線駆動回路から出力される副走査信号およ
び前記映像信号線駆動回路から出力される副映像信号を
前記副走査信号線および前記副映像信号線に接続するフ
レキシブルプリント基板を有する液晶表示装置の駆動方
法であって、 前記タイミングコンバータの制御に基づいて前記第1の
液晶表示パネルと第2の液晶表示パネルに択一的または
同時的に映像信号を表示することを特徴とする液晶表示
装置の駆動方法。 - 【請求項7】前記走査信号線駆動回路の走査信号出力数
は前記第1の液晶表示パネルの主走査信号線と前記第2
の液晶表示パネルの副走査信号線の総和であることを特
徴とする請求項6に記載の液晶表示装置の駆動方法。 - 【請求項8】前記第1の液晶表示パネルにのみ表示を行
う場合は、前記映像メモリの全領域に当該第1の液晶表
示パネルの表示データを格納し、前記走査信号線駆動回
路は前記主走査信号線に走査信号を順次供給すると共
に、前記副走査信号線の帰線期間にリフレッシュのため
の走査信号を一括出力することを特徴とする請求項6に
記載の液晶表示装置の駆動方法。 - 【請求項9】前記第1の液晶表示パネルと前記第2の液
晶表示パネルとに表示を行う場合は、前記映像メモリの
領域の一部に前記第2の液晶表示パネルの表示データを
格納すると共に、残りの領域に前記第1の液晶表示パネ
ルの表示データを格納し、 前記走査信号線駆動回路は前記主走査信号線に走査信号
を順次供給し、前記第2の液晶表示パネルの表示期間に
対応する主走査信号線の帰線期間にリフレッシュのため
の走査信号を一括出力することを特徴とする請求項6に
記載の液晶表示装置の駆動方法。 - 【請求項10】前記第2の液晶表示パネルにのみ表示を
行う場合は、前記映像メモリの一部の域に当該第2の液
晶表示パネルの表示データを格納し、前記走査信号線駆
動回路は前記副走査信号線に走査信号を順次供給すると
共に、前記主走査信号線には帰線期間にリフレッシュの
ための走査信号を一括出力することを特徴とする請求項
6に記載の液晶表示装置の駆動方法。 - 【請求項11】前記映像信号線駆動回路は、前記第1の
液晶表示パネルと前記第2の液晶表示パネルのそれぞれ
の表示データを前記主映像信号線および/または前記副
映像信号線に出力することを特徴とする請求項8乃至1
0の何れかに記載の液晶表示装置の駆動方法。
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