CN109872700B - 一种显示模组及其驱动方法、显示装置 - Google Patents

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Abstract

本发明公开一种显示模组及其驱动方法、显示装置，涉及显示技术领域，为解决在利用MUX向显示产品的数据信号线提供数据信号时，由于MUX损耗较大，导致的显示产品达不到目标显示亮度的问题。该显示模组中每个信号输入子电路包括至少两个晶体管，对应相同信号输入子电路的控制信号线用于加载相同的控制信号，对应不同信号输入子电路的控制信号线用于加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开；至少两个晶体管中各晶体管对应的沟道宽长比之和等于第一预设值，且在垂直于显示模组的基底的方向上，至少两个晶体管中各晶体管的栅极和有源层之间的正对面积均小于第二预设值。本发明提供的显示模组用于显示画面。

Description

一种显示模组及其驱动方法、显示装置
技术领域
本发明涉及显示技术领域，尤其涉及一种显示模组及其驱动方法、显示装置。
背景技术
随着显示技术的不断发展，显示产品的分辨率要求越来越高，而显示产品的分辨率越高，需要的数据信号线的数量越多，由于数据信号线与显示产品中的源极驱动芯片连接，由源极驱动芯片为数据信号线提供数据信号，而源极驱动芯片能够与数据信号线连接的引脚数量有限，因此，会在源极驱动芯片和数据信号线之间引入多路选择器(英文：multiplexer，以下简称：MUX)，通过将多路选择器连接在源极驱动芯片的一个数据信号输出引脚和多条数据信号线之间，实现将由源极驱动芯片的一个数据信号输出引脚输出的数据信号分时传输至该多条数据信号线中，从而实现对显示产品的驱动。
但是，由于MUX存在一定的压降，使得由源极驱动芯片提供的数据信号在经过MUX传输至数据信号线时，会在MUX上产生损耗，从而使得数据信号线实际接收到的数据信号的电压值小于源极驱动芯片提供的数据信号的电压值，导致显示产品达不到目标显示亮度。
发明内容
本发明的目的在于提供一种显示模组及其驱动方法、显示装置，用于解决在利用MUX向显示产品的数据信号线提供数据信号时，由于MUX损耗较大，导致的显示产品达不到目标显示亮度的问题。
为了实现上述目的，本发明提供如下技术方案：
本发明的第一方面提供一种一种显示模组，包括多个信号输入电路，每个所述信号输入电路均包括：
信号传输线、多条控制信号线和多条数据信号线；以及，
与所述多条数据信号线一一对应的多个信号输入子电路，每个所述信号输入子电路包括至少两个晶体管，所述至少两个晶体管包括的输入电极均与所述信号传输线耦接，所述至少两个晶体管包括的输出电极均与对应的所述数据信号线耦接，所述多个信号输入子电路中包括的晶体管的栅极与所述多条控制信号线一一对应耦接；对应相同所述信号输入子电路的控制信号线用于加载相同的控制信号，对应不同所述信号输入子电路的控制信号线用于加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开；
所述至少两个晶体管中各所述晶体管对应的沟道宽长比之和等于第一预设值，且在垂直于所述显示模组的基底的方向上，所述至少两个晶体管中各所述晶体管的栅极和有源层之间的正对面积均小于第二预设值。
可选的，在垂直于所述基底的方向上，所述至少两个晶体管中各所述晶体管的栅极和有源层之间的正对面积之和等于所述第二预设值。
可选的，所述多个信号输入子电路沿垂直于所述数据信号线的延伸方向依次排列；
所述信号输入子电路包括两个晶体管，所述两个晶体管沿所述数据信号线的延伸方向依次排列，所述两个晶体管的输入电极相耦接，所述两个晶体管的输出电极相耦接；所述两个晶体管中的其中一个晶体管的输入电极与所述信号传输线耦接，所述两个晶体管中的另一个晶体管的输出电极与对应的所述数据信号线耦接。
可选的，所述晶体管中的有源层包括至少两个相互独立的有源图形，每个所述有源图形在所述基底上的正投影均与该晶体管中的栅极在所述基底上的正投影部分重叠，与该晶体管中的输入电极在所述基底上的正投影部分重叠，且与该晶体管中的输出电极在所述基底上的正投影部分重叠。
可选的，每个所述信号输入电路均包括三个信号输入子电路；
所述三个信号输入子电路中的第一个信号输入子电路用于将所述信号传输线提供的红色数据信号传输至对应的数据信号线，该数据信号线将所述红色数据信号传输至所述显示模组中与该数据信号线对应的红色亚像素单元；
所述三个信号输入子电路中的第二个信号输入子电路用于将所述信号传输线提供的绿色数据信号传输至对应的数据信号线，该数据信号线将所述绿色数据信号传输至所述显示模组中与该数据信号线对应的绿色亚像素单元；
所述三个信号输入子电路中的第三个信号输入子电路用于将所述信号传输线提供的蓝色数据信号传输至对应的数据信号线，该数据信号线将所述蓝色数据信号传输至所述显示模组中与该数据信号线对应的蓝色亚像素单元。
可选的，每个所述信号输入电路均包括两个信号输入子电路；
所述两个信号输入子电路中的第一个信号输入子电路用于将所述信号传输线提供的第一颜色数据信号传输至对应的数据信号线，该数据信号线将所述第一颜色数据信号传输至所述显示模组中与该数据信号线对应的第一颜色亚像素单元；
所述两个信号输入子电路中的第二个信号输入子电路用于将所述信号传输线提供的第二颜色数据信号传输至对应的数据信号线，该数据信号线将所述第二颜色数据信号传输至所述显示模组中与该数据信号线对应的第二颜色亚像素单元；
所述第一颜色包括红色、绿色和蓝色中的其中一种颜色，所述第二颜色包括红色、绿色和蓝色中的另一种颜色。
可选的，在所述信号输入电路中，相邻的两个信号输入子电路中，其中一个信号输入子电路的晶体管的输入电极复用另一个信号输入子电路的晶体管的输入电极。
基于上述显示模组的技术方案，本发明的第二方面提供一种显示装置，包括上述显示模组。
基于上述显示模组的技术方案，本发明的第三方面提供一种显示模组的驱动方法，用于驱动上述显示模组，所述驱动方法包括：
充电时段，向所述显示模组中每个信号输入电路包括的多条控制信号线加载对应的控制信号，对应所述信号输入电路中同一个信号输入子电路的控制信号线加载相同的控制信号，对应所述信号输入电路中不同信号输入子电路的控制信号线加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开；所述信号输入子电路在其对应的控制信号为有效电平时，将其对应的信号传输线与对应的数据信号线之间连通。
可选的，当所述信号输入子电路包括两个晶体管时，所述驱动方法具体包括：
在所述充电时段，所述信号输入子电路在其对应的控制信号为有效电平时，控制其包括的两个晶体管均导通，以将其对应的信号传输线与对应的数据信号线之间连通。
本发明提供的技术方案中，包括多个信号输入电路，每个信号输入电路包括信号传输线、多条控制信号线、多条数据信号线，以及与多条数据信号线一一对应的多个信号输入子电路，其中信号输入子电路包括至少两个晶体管，所述至少两个晶体管包括的输入电极均与信号传输线耦接，至少两个晶体管包括的输出电极均与对应的数据信号线耦接，多个信号输入子电路中包括的晶体管的栅极与多条控制信号线一一对应耦接，而且设置了所述至少两个晶体管中各晶体管对应的沟道宽长比之和等于第一预设值，且在垂直于显示模组的基底的方向上，至少两个晶体管中各晶体管的栅极和有源层之间的正对面积均小于第二预设值，从而实现了在不改变数据信号线对应的晶体管的W/L的前提下，降低了数据信号线对应的各晶体管的沟道电容，使得在通过信号输入子电路向对应的数据信号线充电时，信号输入子电路的损耗有效降低，提升了信号输入电路整体的充电能力，实现了低功耗快速响应；因此本发明提供的技术方案在包括上述信号输入电路时，不仅能够提升显示模组显示的画质感，还更有利于降低显示产品的功耗。
另外，本发明提供的技术方案中，设置对应相同信号输入子电路的控制信号线用于加载相同的控制信号，以及对应不同信号输入子电路的控制信号线用于加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开，不仅实现了通过一个信号输入电路分时向对应的数据信号线传输数据信号，而且，通过同时驱动至少两个晶体管来实现向对应的数据信号线传输数据信号，大幅度的提升了数据信号线上传输的数据信号的上升时间和下降时间，从而有效保证了充电效果。
附图说明
此处所说明的附图用来提供对本发明的进一步理解，构成本发明的一部分，本发明的示意性实施例及其说明用于解释本发明，并不构成对本发明的不当限定。在附图中：
图1为信号输入电路的一种结构示意图；
图2为图1结构的信号输入电路对应的控制信号时序图；
图3为信号输入电路的另一种结构示意图；
图4为有源图形与栅极之间的宽长比示意图；
图5为晶体管的截面示意图；
图6为本发明实施例提供的信号输入电路的一种结构示意图；
图7为图6结构的信号输入电路对应的控制信号时序图；
图8为本发明实施例提供的信号输入电路的另一种结构示意图；
图9为图3结构的信号输入电路对应的仿真示意图；
图10为图8结构的信号输入电路对应的仿真示意图。
具体实施方式
为了进一步说明本发明实施例提供的显示模组及其驱动方法、显示装置，下面结合说明书附图进行详细描述。
在相关技术中，以液晶显示装置为例，液晶显示装置包括显示区域和围绕显示区域的周边区域，液晶显示装置的显示区域设置有阵列分布的亚像素单元，以及多条数据信号线，其中多条数据信号线能够延伸至周边区域，周边区域设置有MUX和源极驱动芯片，MUX设置在源极驱动芯片和数据信号线之间，且分别与二者耦接，用于将源极驱动芯片提供的数据信号传输至数据信号线，数据信号线继续将接收到的数据信号传输至对应的亚像素单元，从而控制液晶显示装置实现显示。
本发明的发明人经研究发现，目前MUX主要由晶体管组成，因此晶体管的驱动性能决定了MUX自身的损耗，更详细地说，晶体管的驱动性能主要由沟道宽长比(W/L)和晶体管中形成的沟道电容值决定，其中W/L决定了晶体管对应的电阻值，即W/L越大，晶体管的电阻值越小，相应的在晶体管上产生的损耗越小；晶体管中形成的沟道电容即晶体管中栅极和有源层之间正对部分形成的电容，该电容的电容值与W×L成正比，即W×L越大，晶体管的沟道电容值越大，相应的在晶体管上产生的损耗越大。
示例性的，源极驱动芯片输出的数据信号的电压值为5V时，在经过MUX传输至数据信号线时，由于MUX自身存在压降，会导致实际传输至数据信号线上的数据信号的电压值只有4.5V，低于液晶最大偏转电压，导致液晶显示装置的灰阶亮度不足。而且，当显示产品在沿数据信号线的延伸方向具有较高的分辨率时，会进一步导致液晶显示装置在远离源极驱动芯片的一端充电不足，影响显示产品的显示质量。
基于上述对MUX产生损耗的原因的分析，本发明的发明人发现可通过增加MUX中晶体管的W/L，来降低晶体管的损耗，提升MUX的充电能力，但是单纯的增加W/L不仅需要增加显示产品周边区域的面积，不利于显示产品的窄边框发展，而且容易导致MUX中晶体管的沟道电容增加，这样反而会降低MUX的充电能力；或者也可以通过降低MUX中晶体管的沟道电容，来降低晶体管的损耗，提升MUX的充电能力，但是降低MUX中晶体管的沟道电容会容易降低W/L，同样会降低MUX的充电能力。
综合上述研究结果，本发明的发明人提出一种新型的MUX结构，能够实现在不改变MUX中W/L的情况下，降低MUX中晶体管的沟道电容，从而有效降低MUX的损耗，提升MUX的充电能力。
具体地，如图1至图3所示，图1为1/3MUX，即MUX将由源极驱动芯片中一个引脚输出的数据信号分时传输至三条数据信号线12中；图2为1/2MUX，即MUX将由源极驱动芯片中一个引脚输出的数据信号分时传输至两条数据信号线12中。以图1为例，MUX包括三个晶体管131，每个晶体管131的输出电极1311与对应的一条数据信号线12耦接，有两个晶体管131复用一个输入电极1310，每个晶体管131的输入电极1310均与源极驱动芯片中的同一个引脚耦接，各晶体管131的栅极1312与各自对应的控制信号线11耦接，各晶体管131用于在控制信号线11提供的控制信号的控制下处于导通状态或截止状态，以实现将由源极驱动芯片提供的数据信号传输至对应的数据信号线12。
如图4和图5所示，图3中示出了对应一个有源图形1313的W'和L'的示意，基于图4和图5的示意，能够得到图1和图3中每条数据信号线12对应的晶体管131的W/L＝4W'/L'，每个晶体管131中栅极1312和有源层之间形成的正对面积为4W'×L'。示例性的，可定义4W'/L'为第一预设值，4W'×L'为第二预设值。
基于上述研究过程，本发明的发明人对图1的结构进行改进，具体提出如下技术方案：
请参阅图6至图8，本发明实施例提供了一种显示模组，包括多个信号输入电路1(即上述MUX)，每个信号输入电路1均包括：
信号传输线10、多条控制信号线11和多条数据信号线12；以及，
与多条数据信号线12一一对应的多个信号输入子电路13，每个信号输入子电路13包括至少两个晶体管131，至少两个晶体管131包括的输入电极1310均与信号传输线10耦接，至少两个晶体管131包括的输出电极1311均与对应的数据信号线12耦接，多个信号输入子电路13中包括的晶体管131的栅极1312与多条控制信号线11一一对应耦接；对应相同信号输入子电路13的控制信号线11用于加载相同的控制信号，对应不同信号输入子电路13的控制信号线11用于加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开，具体见图7；
所述至少两个晶体管131中各晶体管131对应的沟道宽长比之和等于第一预设值，且在垂直于显示模组的基底的方向上，至少两个晶体管131中各晶体管131的栅极1312和有源层(包括有源图形1313)之间的正对面积均小于第二预设值。
具体地，上述信号传输线10与显示模组中源极驱动芯片的一个数据信号输出引脚耦接，用于接收由该引脚输出的数据信号；上述多条控制信号线11可以设置为均相互独立，也可以设置为对应同一个信号输入子电路13的控制信号线11之间连通，对应不同信号输入子电路13的控制信号线11之间不连通；上述多条数据信号线12均与显示模组中对应的亚像素单元耦接，用于将接收到的数据信号传输至对应的亚像素单元。
上述信号输入子电路13与数据信号线12一一对应，每个信号输入子电路13均包括至少两个晶体管131，该至少两个晶体管131包括的输入电极1310均与信号传输线10耦接，具体耦接方式可包括至少两个晶体管131包括的输入电极1310分别与信号传输线10耦接，或者至少两个晶体管131包括的输入电极1310彼此耦接，且至少两个晶体管131中最靠近信号传输线10的晶体管131的输入电极1310与信号传输线10耦接，从而实现至少两个晶体管131包括的输入电极1310均与信号传输线10耦接。同样的，该至少两个晶体管131包括的输出电极1311均与对应的数据信号线12耦接，具体耦接方式可包括至少两个晶体管131包括的输出电极1311分别与对应的数据信号线12耦接，或者至少两个晶体管131包括的输出电极1311彼此耦接，且至少两个晶体管131中最靠近对应的数据信号线12的晶体管131的输出电极1311与该数据信号线12耦接，从而实现至少两个晶体管131包括的输出电极1311均与对应的数据信号线12耦接。
上述多个信号输入子电路13中包括的晶体管131的栅极1312与多条控制信号线11一一对应耦接，在对应的控制信号线11上加载的控制信号的控制下，晶体管131能够在导通状态和截止状态下切换。更详细地说，可设置对应相同信号输入子电路13的控制信号线11用于加载相同的控制信号，对应不同信号输入子电路13的控制信号线11用于加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开；这样在驱动每个信号输入电路1工作时，信号输入电路1中包括的各信号输入子电路13依次处于工作状态，以实现将接收到的数据信号分时传输至对应的数据信号线12中。
值得注意，上述显示模组包括显示区域和围绕显示区域的周边区域，上述信号传输线10、控制信号线11、信号输入子电路13以及每条数据信号线12的至少部分均位于周边区域，每条数据信号线12的剩余部分可延伸至显示区域，与显示区域中对应的亚像素单元耦接。另外，上述控制信号的有效电平为：能够控制对应的晶体管131导通的电平值。
此外，可设置所述至少两个晶体管131中各晶体管131对应的沟道宽长比之和等于第一预设值，且在垂直于显示模组的基底的方向上，至少两个晶体管131中各晶体管131的栅极1312和有源层之间的正对面积均小于第二预设值。更详细地说，以图6和图7为例，每条数据信号线12对应两个晶体管131，每个晶体管131对应的沟道宽长比均为2W'/L'，每条数据信号线12对应的晶体管131的W/L＝2W'/L'+2W'/L'＝4W'/L'，等于第一预设值；在垂直于显示模组的基底的方向上，各晶体管131的栅极1312和有源层之间的正对面积均为2W'×L'，小于第二预设值。
根据上述显示模组的具体结构，和分时向数据信号线12中传输数据信号的方式可知，本发明实施例提供的显示模组中，包括多个信号输入电路1，每个信号输入电路1包括信号传输线10、多条控制信号线11、多条数据信号线12，以及与多条数据信号线12一一对应的多个信号输入子电路13，其中信号输入子电路13包括至少两个晶体管131，所述至少两个晶体管131包括的输入电极1310均与信号传输线10耦接，至少两个晶体管131包括的输出电极1311均与对应的数据信号线12耦接，多个信号输入子电路13中包括的晶体管131的栅极1312与多条控制信号线11一一对应耦接，而且设置了所述至少两个晶体管131中各晶体管131对应的沟道宽长比之和等于第一预设值，且在垂直于显示模组的基底的方向上，至少两个晶体管131中各晶体管131的栅极1312和有源层之间的正对面积均小于第二预设值，从而实现了在不改变数据信号线12对应的晶体管131的W/L的前提下，降低了数据信号线12对应的各晶体管131的沟道电容，使得在通过信号输入子电路13向对应的数据信号线12传输数据信号(即通过信号输入子电路13向对应的数据信号线12充电)时，信号输入子电路13的损耗有效降低，提升了信号输入电路1整体的充电能力，实现了低功耗快速响应；因此本发明实施例提供的显示模组在包括上述信号输入电路1时，不仅会提升显示模组显示的画质感，而且，在应用于高分辨率的显示产品，以及笔记本电脑、平板电脑和车载等显示产品时，更有利于降低显示产品的功耗。
另外，上述设置对应相同信号输入子电路13的控制信号线11用于加载相同的控制信号，以及对应不同信号输入子电路13的控制信号线11用于加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开，不仅实现了通过一个信号输入电路1分时向对应的数据信号线12传输数据信号，而且，如图10所示，通过同时驱动至少两个晶体管131来实现向对应的数据信号线12传输数据信号，大幅度的提升了数据信号线12上传输的数据信号Data的上升时间(英文：rising time，简称：Tr)和下降时间(英文：falling time，简称：Tf)，从而有效保证了充电效果。
需要说明的是，本发明实施例提供的显示模组适用于采用低温多晶硅技术(英文：Low Temperature Poly-silicon，以下简称：LTPS)形成的薄膜场效应晶体管液晶显示器，但不仅限于此。
在一些实施例中，在垂直于基底的方向上，所述至少两个晶体管131中各晶体管131的栅极1312和有源层之间的正对面积之和等于第二预设值。
具体地，上述各晶体管131的栅极1312和有源层之间的正对面积可根据实际需要设置，只需满足小于所述第二预设值即可，示例性的，可设置在垂直于基底的方向上，所述至少两个晶体管131中各晶体管131的栅极1312和有源层之间的正对面积之和等于第二预设值，从而更好的改善了晶体管131的驱动性能，有效提升了信号输入电路1的充电能力。
上述信号输入子电路13的具体设置方式多种多样，在一些实施例中，可设置多个信号输入子电路13沿垂直于数据信号线12的延伸方向依次排列；信号输入子电路13包括两个晶体管131，两个晶体管131沿数据信号线12的延伸方向依次排列，两个晶体管131的输入电极1310相耦接，两个晶体管131的输出电极1311相耦接；两个晶体管131中的其中一个晶体管131的输入电极1310与信号传输线10耦接，两个晶体管131中的另一个晶体管131的输出电极1311与对应的数据信号线12耦接。
具体地，上述信号输入子电路13的位置可以根据实际需要设置，示例性的，可将多个信号输入子电路13均设置在显示模组的周边区域，并将多个信号输入子电路13沿垂直于数据信号线12的延伸方向依次排列，这样不仅能够最大限度的缩小周边区域的面积，而且更利于显示模组实现窄边框化。
同样的，每个信号输入子电路13中包括的晶体管131的位置也可以根据实际需要设置，以信号输入子电路13包括两个晶体管131为例，可设置两个晶体管131沿数据信号线12的延伸方向依次排列，这样的设置方式使得每个信号输入子电路13在垂直于数据信号线12的延伸方向上占据的宽度较小，从而使得在显示模组的周边区域能够设置更多数量的信号输入子电路13，从而更有利于实现为大尺寸、高分辨率的显示产品充电。
在按照上述方式设置信号输入子电路13中的晶体管131时，还可设置所述两个晶体管131的输入电极1310相耦接，两个晶体管131的输出电极1311相耦接；两个晶体管131中的其中一个晶体管131的输入电极1310与信号传输线10耦接，两个晶体管131中的另一个晶体管131的输出电极1311与对应的数据信号线12耦接。更详细地说，在将所述两个晶体管131按照上述方式设置时，可将所述两个晶体管131位于对应的信号传输线10和对应的数据信号线12之间，使得所述两个晶体管131中，其中一个晶体管131更靠近信号传输线10，另一个晶体管131更靠近对应的数据信号线12，从而可将更靠近信号传输线10的晶体管131的输入电极1310与信号传输线10耦接，将更靠近数据信号线12的晶体管131的输出电极1311与对应的数据信号线12耦接，同时将所述两个晶体管131的输入电极1310相耦接，两个晶体管131的输出电极1311相耦接，这样就实现了在保证信号输入子电路13正常的充电功能的同时，缩短了信号输入子电路13中导电连接线的长度，有效减小了信号输入子电路13在周边区域的占用面积。
同样的，还可以设置与所述两个晶体管131对应的两条控制信号线11相对设置，并将所述两个晶体管131位于所述两条控制信号线11之间；这样就使得所述两个晶体管131中，每个晶体管131均能够与其对应的控制信号线11相靠近，在将晶体管131的栅极1312与其对应的控制信号线11耦接时，能够有效缩短导电连接线的长度，从而有效减小了信号输入子电路13在周边区域的占用面积。
在一些实施例中，可设置晶体管131中的有源层包括至少两个相互独立的有源图形1313，每个有源图形1313在基底上的正投影均与该晶体管131中的栅极1312在基底上的正投影部分重叠，与该晶体管131中的输入电极1310在基底上的正投影部分重叠，且与该晶体管131中的输出电极1311在基底上的正投影部分重叠。
具体地，上述设置晶体管131中的有源层包括至少两个相互独立的有源图形1313，并设置每个有源图形1313在基底上的正投影均与该晶体管131中的栅极1312在基底上的正投影部分重叠，与该晶体管131中的输入电极1310在基底上的正投影部分重叠，且与该晶体管131中的输出电极1311在基底上的正投影部分重叠；不仅使得每个有源图形1313均能够形成相应的沟道，保证其对应形成的晶体管131能够实现正常的功能，而且能够有效减小有源层的整体面积，进而减小有源层与对应的栅极1312之间形成的正对面积，有效减小该有源层对应形成的晶体管131的沟道电容，提升晶体管131的驱动能力。
值得注意的是，上述实施例提供的信号输入电路1中，包括的信号输入子电路13的数量可根据实际需要设置，下面列举两种具体实施例。
显示模组的显示区域可包括阵列分布的多个亚像素单元，该多个亚像素单元可具体包括红色亚像素单元、绿色亚像素单元和蓝色亚像素单元，并可设置相同颜色的亚像素单元位于一列，即设置该多个亚像素单元可具体形成为包括多列红色亚像素单元、多列绿色亚像素单元和多列蓝色亚像素单元。
当设置每条数据信号线12对应一列亚像素单元，即每条数据信号线12为对应的一列亚像素单元提供对应的数据信号时，可设置信号输入电路1包括三个信号输入子电路13或者包括两个信号输入子电路13。
具体地，如图6所示，在一些实施例中，每个信号输入电路1均包括三个信号输入子电路13；其中，三个信号输入子电路13中的第一个信号输入子电路用于将信号传输线10提供的红色数据信号传输至对应的数据信号线12，该数据信号线12将红色数据信号传输至显示模组中与该数据信号线12对应的红色亚像素单元；三个信号输入子电路13中的第二个信号输入子电路用于将信号传输线10提供的绿色数据信号传输至对应的数据信号线12，该数据信号线12将绿色数据信号传输至显示模组中与该数据信号线12对应的绿色亚像素单元；三个信号输入子电路13中的第三个信号输入子电路用于将信号传输线10提供的蓝色数据信号传输至对应的数据信号线12，该数据信号线12将蓝色数据信号传输至显示模组中与该数据信号线12对应的蓝色亚像素单元。
当信号输入电路1包括三个信号输入子电路13时，可设置该三个信号输入子电路13与一列红色亚像素单元、一列绿色亚像素单元和一列蓝色亚像素单元一一对应，从而实现通过一个信号输入电路1控制一组像素单元。值得注意，一个像素单元包括一个红色亚像素单元、一个绿色亚像素单元和一个蓝色亚像素单元，一组亚像素单元即由一列红色亚像素单元、一列绿色亚像素单元和一列蓝色亚像素单元对应形成的亚像素单元。
如图8所示，在另外一些实施例中，每个信号输入电路1均包括两个信号输入子电路13；其中，两个信号输入子电路13中的第一个信号输入子电路用于将信号传输线10提供的第一颜色数据信号传输至对应的数据信号线12，该数据信号线12将第一颜色数据信号传输至显示模组中与该数据信号线12对应的第一颜色亚像素单元；两个信号输入子电路13中的第二个信号输入子电路用于将信号传输线10提供的第二颜色数据信号传输至对应的数据信号线12，该数据信号线12将第二颜色数据信号传输至显示模组中与该数据信号线12对应的第二颜色亚像素单元；第一颜色包括红色、绿色和蓝色中的其中一种颜色，第二颜色包括红色、绿色和蓝色中的另一种颜色。
当信号输入电路1包括两个信号输入子电路13时，可设置两个信号输入子电路13中的第一个信号输入子电路用于将信号传输线10提供的第一颜色数据信号传输至对应的第一颜色亚像素单元；两个信号输入子电路13中的第二个信号输入子电路用于将信号传输线10提供的第二颜色数据信号传输至对应的第二颜色亚像素单元；同时可设置第一颜色包括红色、绿色和蓝色中的其中一种颜色，第二颜色包括红色、绿色和蓝色中的另一种颜色；这样可设置在显示模组包括的全部信号输入电路1中，第一部分信号输入电路1包括的两个信号输入子电路13分别对应红色亚像素单元和绿色亚像素单元，第二部分信号输入电路1包括的两个信号输入子电路13分别对应红色亚像素单元和蓝色亚像素单元，第三部分信号输入电路1包括的两个信号输入子电路13分别对应绿色亚像素单元和蓝色亚像素单元，这样就能够实现对显示模组中的全部亚像素单元进行充电。
进一步地，在信号输入电路1中，可设置相邻的两个信号输入子电路13中，其中一个信号输入子电路13的晶体管131的输入电极1310复用另一个信号输入子电路13的晶体管131的输入电极1310。
具体地，如图8所示，在相邻的两个信号输入子电路13中，可设置其中一个信号输入子电路13的晶体管131的输入电极1310复用另一个信号输入子电路13的晶体管131的输入电极1310，这样不仅保证了相邻的两个信号输入子电路13正常的工作性能，还有效减小了信号输入电路1的形成面积，更有利于显示模组的窄边框化需求。
需要说明，上述实施例中提到的晶体管131的类型可根据实际需要进行选择，示例性的，选用NMOS薄膜晶体管131或PMOS薄膜晶体管131，但不仅限于此。
如图3和图8所示，以上述实施例提供的信号输入电路1包括两个信号输入子电路13为例，对将图3和图8对应的信号输入电路1应用在分辨率为1800×1800显示产品中时进行充电过程的仿真模拟，对应得到的仿真结果如图9和图10所示。
对应图3和图9能够看出，在MUX1处于有效电平的时间内，数据信号Data始终处于上升状态，且在MUX1处于有效电平的时间内，数据信号所能够达到的最大电压值小于目标值5V；在MUX2处于有效电平的时间内，数据信号Data处于平稳状态，但数据信号Data所能够达到的最大电压值仍然小于目标值5V；可见，对于图3的输入信号电路结构，存在充电不足的问题，在这种情况下，当显示模组为液晶显示模组，且该液晶显示模组在显示画面时，液晶显示模组中大多亚像素单元接收到的数据信号的电压远低于要求的液晶偏转电压，从而导致透过率较低，严重影响画质感。
而对于上述实施例提供的显示模组中采用的信号输入电路1结构，具体如图8和图10所示，在MUX1/MUX1'处于有效电平的时间内，数据信号Data快速上升并最终处于平稳状态，且在处于平稳状态后，数据信号Data所能够达到的电压值大于目标值5V；在MUX2/MUX2'处于有效电平的时间内，数据信号Data仍然处于平稳状态，且数据信号Data所能够达到的电压值仍然大于目标值5V；可见，对于图8的输入信号电路结构，不存在充电不足的问题，在这种情况下，当驱动显示模组显示时，能够满足显示模组显示画面的快速刷新，实现高分辨率显示模组的快速开启和关闭。
需要说明，上述实施例引用的附图1、附图3、附图4、附图6和附图8中的圆圈代表连接过孔。
本发明实施例还提供了一种显示装置，包括上述实施例提供的显示模组。
由于上述实施例提供的显示模组包括所述信号输入电路1，使得其不仅能够实现良好的画质感，还能够降低显示模组的功耗；而且上述显示模组还能够大幅度的提升数据信号线12上传输的数据信号的上升时间和下降时间，有效保证了显示模组的充电效果，因此本发明实施例提供的显示装置在包括上述实施例提供的显示模组时，同样具有显示模组所能够实现的全部有益效果，此处不再赘述。
需要说明的是，所述显示装置可以为：电视、显示器、数码相框、手机、平板电脑等任何具有显示功能的产品或部件，其中，所述显示装置还包括柔性电路板、印刷电路板和背板等。
本发明实施例还提供了一种显示模组的驱动方法，用于驱动上述实施例提供的显示模组，所述驱动方法包括：
充电时段，向显示模组中每个信号输入电路1包括的多条控制信号线11加载对应的控制信号，对应信号输入电路1中同一个信号输入子电路13的控制信号线11加载相同的控制信号，对应信号输入电路1中不同信号输入子电路13的控制信号线11加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开；信号输入子电路13在其对应的控制信号为有效电平时，将其对应的信号传输线10与对应的数据信号线12之间连通。
具体地，请参阅图6和图7，以显示模组中每个信号输入电路1均包括三个信号输入子电路13，每个信号输入子电路13均包括两个晶体管131为例，所述三个信号输入子电路13中的第一个信号输入子电路13对应的两个第一控制信号线(MUX1和MUX1')上加载相同的第一控制信号，所述三个信号输入子电路13中的第二个信号输入子电路13对应的两个第二控制信号线(MUX2和MUX2')上加载相同的第二控制信号，所述三个信号输入子电路13中的第三个信号输入子电路13对应的两个第三控制信号线(MUX3和MUX3')上加载相同的第三控制信号；第一控制信号的有效电平所处的时段、第二控制信号的有效电平所处的时段和第三控制信号的有效电平所处的时段相互错开，即在同一时段，只能有一个控制信号处于有效电平。需要说明，图7中，各控制信号对应的有效电平均为高电平，当然也可以设置各控制信号对应的有效电平为低电平。
相比于图2中的时序图，在利用本发明实施例提供的驱动上述驱动模组时，只需要通过源极驱动芯片为增加的MUX1'、MUX2'和MUX3'分配相应的控制信号即可，实现方式简单方便。
更详细地说，在驱动显示模组实现显示功能时，在充电时段，先通过设置在显示模组的周边区域的信号输入电路1为显示区域的亚像素单元进行充电，具体充电过程包括：对显示模组中显示区域内的亚像素单元进行逐行扫描(扫描信号如图9和图10中的Gate)，在扫描每一行像素单元时，向显示模组中每个信号输入电路1包括的多条控制信号线11加载对应的控制信号，对应信号输入电路1中同一个信号输入子电路13的控制信号线11加载相同的控制信号，使得每一个信号输入子电路13包括的全部晶体管131能够在同一时间开启，实现将接收到的数据信号传输至对应的数据信号线12；同时对应信号输入电路1中不同信号输入子电路13的控制信号线11加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开，使得同一个信号输入电路1中包括的多个信号输入子电路13能够逐个被驱动，以将从信号传输线10接收的数据信号逐个传输至对应的数据信号线12，实现分时充电。
需要说明，信号输入子电路13在其对应的控制信号为有效电平时，将其对应的信号传输线10与对应的数据信号线12之间连通。
采用本发明实施例提供的驱动方法驱动上述实施例提供的显示模组时，显示模组中的信号输入子电路13的损耗有效降低，从而提升了信号输入电路1整体的充电能力，提升了显示模组显示的画质感，更有利于降低显示产品的功耗。
另外，采用本发明实施例提供的驱动方法驱动上述实施例提供的显示模组时，对应相同信号输入子电路13的控制信号线11加载相同的控制信号，对应不同信号输入子电路13的控制信号线11加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开，不仅实现了通过一个信号输入电路1分时向对应的数据信号线12传输数据信号，而且，通过同时驱动至少两个晶体管131来实现向对应的数据信号线12传输数据信号，大幅度的提升了数据信号线12上传输的数据信号的上升时间和下降时间，从而有效保证了充电效果。
在一些实施例中，当信号输入子电路13包括两个晶体管131时，上述实施例提供的驱动方法具体包括：在充电时段，信号输入子电路13在其对应的控制信号为有效电平时，控制其包括的两个晶体管131均导通，以将其对应的信号传输线10与对应的数据信号线12之间连通。
具体地，在充电时段，在一个信号输入电路1中，当某个信号输入子电路13在其对应的控制信号为有效电平时，控制其包括的两个晶体管131均导通，以将其对应的信号传输线10与对应的数据信号线12之间连通；同时，由于此时该信号输入电路1中的其它信号输入子电路13对应的控制信号均为非有效电平，因此，该其它信号输入子电路13中的晶体管131均处于截止状态，不会向对应的数据信号线12传输对应的数据信号。
需要说明，本说明书中的各个实施例均采用递进的方式描述，各个实施例之间相同相似的部分互相参见即可，每个实施例重点说明的都是与其他实施例的不同之处。尤其，对于方法实施例而言，由于其基本相似于产品实施例，所以描述得比较简单，相关之处参见产品实施例的部分说明即可。
除非另外定义，本公开使用的技术术语或者科学术语应当为本发明所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“耦接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性连接或者信号连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
可以理解，当诸如层、膜、区域或基板之类的元件被称作位于另一元件“上”或“下”时，该元件可以“直接”位于另一元件“上”或“下”，或者可以存在中间元件。
在上述实施方式的描述中，具体特征、结构、材料或者特点可以在任何的一个或多个实施例或示例中以合适的方式结合。
以上所述，仅为本发明的具体实施方式，但本发明的保护范围并不局限于此，任何熟悉本技术领域的技术人员在本发明揭露的技术范围内，可轻易想到变化或替换，都应涵盖在本发明的保护范围之内。因此，本发明的保护范围应以所述权利要求的保护范围为准。

Claims (10)

1.一种显示模组，其特征在于，包括多个信号输入电路，每个所述信号输入电路均包括：
信号传输线、多条控制信号线和多条数据信号线；以及，
与所述多条数据信号线一一对应的多个信号输入子电路，每个所述信号输入子电路包括至少两个晶体管，沿所述数据信号线的延伸方向，所述至少两个晶体管位于对应的数据信号线的一侧，所述至少两个晶体管包括的输入电极均与所述信号传输线耦接，所述至少两个晶体管包括的输出电极均与对应的所述数据信号线耦接，所述多个信号输入子电路中包括的晶体管的栅极与所述多条控制信号线一一对应耦接；对应相同所述信号输入子电路的控制信号线用于加载相同的控制信号，对应不同所述信号输入子电路的控制信号线用于加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开；
所述至少两个晶体管中各所述晶体管对应的沟道宽长比之和等于第一预设值，且在垂直于所述显示模组的基底的方向上，所述至少两个晶体管中各所述晶体管的栅极和有源层之间的正对面积均小于第二预设值；
所述第一预设值包括：在每个所述信号输入子电路包括一个晶体管的情况下，该一个晶体管对应的沟道宽长比；
所述第二预设值包括：在每个所述信号输入子电路包括一个晶体管的情况下，该一个晶体管的栅极和有源层之间的正对面积。
2.根据权利要求1所述的显示模组，其特征在于，在垂直于所述基底的方向上，所述至少两个晶体管中各所述晶体管的栅极和有源层之间的正对面积之和等于所述第二预设值。
3.根据权利要求1所述的显示模组，其特征在于，所述多个信号输入子电路沿垂直于所述数据信号线的延伸方向依次排列；
所述信号输入子电路包括两个晶体管，所述两个晶体管沿所述数据信号线的延伸方向依次排列，所述两个晶体管的输入电极相耦接，所述两个晶体管的输出电极相耦接；所述两个晶体管中的其中一个晶体管的输入电极与所述信号传输线耦接，所述两个晶体管中的另一个晶体管的输出电极与对应的所述数据信号线耦接。
4.根据权利要求3所述的显示模组，其特征在于，所述晶体管中的有源层包括至少两个相互独立的有源图形，每个所述有源图形在所述基底上的正投影均与该晶体管中的栅极在所述基底上的正投影部分重叠，与该晶体管中的输入电极在所述基底上的正投影部分重叠，且与该晶体管中的输出电极在所述基底上的正投影部分重叠。
5.根据权利要求3所述的显示模组，其特征在于，每个所述信号输入电路均包括三个信号输入子电路；
所述三个信号输入子电路中的第一个信号输入子电路用于将所述信号传输线提供的红色数据信号传输至对应的数据信号线，该数据信号线将所述红色数据信号传输至所述显示模组中与该数据信号线对应的红色亚像素单元；
所述三个信号输入子电路中的第二个信号输入子电路用于将所述信号传输线提供的绿色数据信号传输至对应的数据信号线，该数据信号线将所述绿色数据信号传输至所述显示模组中与该数据信号线对应的绿色亚像素单元；
所述三个信号输入子电路中的第三个信号输入子电路用于将所述信号传输线提供的蓝色数据信号传输至对应的数据信号线，该数据信号线将所述蓝色数据信号传输至所述显示模组中与该数据信号线对应的蓝色亚像素单元。
6.根据权利要求3所述的显示模组，其特征在于，每个所述信号输入电路均包括两个信号输入子电路；
所述两个信号输入子电路中的第一个信号输入子电路用于将所述信号传输线提供的第一颜色数据信号传输至对应的数据信号线，该数据信号线将所述第一颜色数据信号传输至所述显示模组中与该数据信号线对应的第一颜色亚像素单元；
所述两个信号输入子电路中的第二个信号输入子电路用于将所述信号传输线提供的第二颜色数据信号传输至对应的数据信号线，该数据信号线将所述第二颜色数据信号传输至所述显示模组中与该数据信号线对应的第二颜色亚像素单元；
所述第一颜色包括红色、绿色和蓝色中的其中一种颜色，所述第二颜色包括红色、绿色和蓝色中的另一种颜色。
7.根据权利要求5或6所述的显示模组，其特征在于，在所述信号输入电路中，相邻的两个信号输入子电路中，其中一个信号输入子电路的晶体管的输入电极复用另一个信号输入子电路的晶体管的输入电极。
8.一种显示装置，其特征在于，包括如权利要求1~7中任一项所述的显示模组。
9.一种显示模组的驱动方法，其特征在于，用于驱动如权利要求1~7中任一项所述的显示模组，所述驱动方法包括：
充电时段，向所述显示模组中每个信号输入电路包括的多条控制信号线加载对应的控制信号，对应所述信号输入电路中同一个信号输入子电路的控制信号线加载相同的控制信号，对应所述信号输入电路中不同信号输入子电路的控制信号线加载不同的控制信号，且该不同的控制信号的有效电平所处的时段相互错开；所述信号输入子电路在其对应的控制信号为有效电平时，将其对应的信号传输线与对应的数据信号线之间连通。
10.根据权利要求9所述的显示模组的驱动方法，其特征在于，当所述信号输入子电路包括两个晶体管时，所述驱动方法具体包括：
在所述充电时段，所述信号输入子电路在其对应的控制信号为有效电平时，控制其包括的两个晶体管均导通，以将其对应的信号传输线与对应的数据信号线之间连通。
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