DE102020111391A1 - Rückseitenkondensatortechniken - Google Patents
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- H01L2224/08145—Disposition the bonding area connecting directly to another bonding area, i.e. connectorless bonding, e.g. bumpless bonding the bonding area connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
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- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier
- H01L27/04—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier the substrate being a semiconductor body
- H01L27/06—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having at least one potential-jump barrier or surface barrier; including integrated passive circuit elements with at least one potential-jump barrier or surface barrier the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration
- H01L27/0688—Integrated circuits having a three-dimensional layout
Abstract
Einige Ausführungsformen betreffen eine Halbleiterstruktur aufweisend ein Halbleitersubstrat aufweisend eine Vorderseitenfläche und eine Rückseitenfläche. Eine Zwischenverbindungsstruktur ist über der Vorderseitenfläche angeordnet. Die Zwischenverbindungsstruktur weist mehrere Metallleitungen und Durchkontaktierungen auf, welche Halbleitertransistorvorrichtungen angeordnet in oder auf der Vorderseitenfläche des Halbleitersubstrats funktionell miteinander verbinden. Ein Graben ist in der Rückseitenfläche des Halbleitersubstrats angeordnet. Der Graben ist mit einer inneren Kondensatorelektrode, einer über der inneren Kondensatorelektrode angeordneten dielektrischen Kondensatorschicht und einer über der dielektrischen Kondensatorschicht angeordneten äußeren Kondensatorelektrode gefüllt.
Description
- VERWANDTE ANMELDUNG
- Diese Anmeldung beansprucht die Priorität der vorläufigen US-Anmeldung Nr.
62/868,289 - STAND DER TECHNIK
- Mobiltelefone und andere mobile Vorrichtungen sind häufig auf Keramikkondensatoren und andere passive Bauelemente angewiesen, welche einzeln auf gedruckten Schaltungsplatten (PCBs) der mobilen Vorrichtungen angebracht und durch die PCBs elektrisch mit integrierten Schaltungen (ICs) der mobilen Vorrichtungen verbunden sind. Dies verbraucht jedoch große Teile der Oberfläche auf den PCBs und beschränkt somit die Größe der mobilen Vorrichtung und/oder die Funktionalität der mobilen Vorrichtung. Ferner erhöht das einzelne Anbringen und elektrische Verbinden der passiven Vorrichtungen die Herstellungskosten. Folglich setzen mobile Vorrichtungen immer stärker auf integrierte passive Bauelemente (IPDs), um Größe und Kosten zu verringern und die Funktionalität zu erhöhen. Ein IPD ist eine Sammlung aus einem oder mehreren passiven Bauelementen, welche in eine einzige monolithische Vorrichtung eingebettet und als eine integrierte Schaltung (IC) gepackt werden.
- Figurenliste
- Aspekte der vorliegenden Offenbarung lassen sich am besten anhand der folgenden detaillierten Beschreibung in Verbindung mit den beiliegenden Zeichnungen verstehen. Es ist zu beachten, dass gemäß der branchenüblichen Praxis verschiedene Merkmale nicht maßstabsgetreu dargestellt sind. Tatsächlich können die Abmessungen der verschiedenen Merkmale zugunsten einer klaren Erläuterung willkürlich vergrößert oder verkleinert sein.
-
1 stellt eine Querschnittsansicht einiger Ausführungsformen einer Halbleiterstruktur aufweisend einen Rückseitengrabenkondensator mit einer hohen Flächenkapazität dar. -
2 stellt eine Querschnittsansicht einiger Ausführungsformen einer Halbleiterstruktur aufweisend einen Rückseitengrabenkondensator mit einer hohen Flächenkapazität dar. -
3 stellt eine Querschnittsansicht einiger Ausführungsformen einer dreidimensionalen IC dar, welche Rückseitengrabenkondensatoren aufweist. -
4-11 stellen eine Reihe von Querschnittsansichten dar, welche gemeinsam einige Ausführungsformen der Herstellung einer Halbleiterstruktur im Einklang mit einigen Ausführungsformen der vorliegenden Offenbarung darstellen. -
12 stellt ein Ablaufdiagramm dar, welches einige Ausführungsformen von Verfahren im Einklang mit der vorliegenden Offenbarung darstellt. - AUSFÜHRLICHE BESCHREIBUNG
- Die vorliegende Offenbarung stellt viele verschiedene Ausführungsformen oder Beispiele zum Umsetzen verschiedener Merkmale dieser Offenbarung bereit. Nachfolgend sind spezifische Beispiele von Komponente und Anordnungen beschrieben, um die vorliegende Offenbarung zu vereinfachen. Dies sind natürlich nur Beispiele, und sollen keinesfalls als Einschränkung ausgelegt werden. Zum Beispiel kann die Bildung eines ersten Merkmals über oder auf einem zweiten Merkmal in der folgenden Beschreibung Ausführungsformen umfassen, in welchen das erste und das zweite Merkmal in direktem Kontakt miteinander gebildet sind, können jedoch auch Ausführungsformen umfassen, in welchen zusätzliche Merkmale derart zwischen dem ersten Merkmal und dem zweiten Merkmal gebildet sein können, dass das erste und das zweite Merkmal nicht in direktem Kontakt miteinander sein können. Darüber hinaus kann die vorliegende Offenbarung Bezugsziffern und/oder -Zeichen in den verschiedenen Beispielen wiederholen. Diese Wiederholung dient dem Zweck der Vereinfachung und Klarheit, und schreibt für sich selbst keine Beziehung zwischen den verschiedenen erörterten Ausführungsformen und/oder Konfigurationen vor.
- Ferner können Begriffe räumlicher Beziehungen, wie zum Beispiel „unter“, „darunter“, „niedriger“, „über“, „obere/r/s“ und dergleichen hierin zum Zweck einer einfacheren Beschreibung der Beziehung eines in den FIG. dargestellten Elements oder Merkmals zu (einem) anderen Element(en) oder Merkmal(en) verwendet werden. Die Begriffe räumlicher Beziehungen sollen dazu dienen, verschiedene Ausrichtungen der Vorrichtung bei der Verwendung oder im Betrieb zusätzlich zur in den FIG. abgebildeten Ausrichtung einzuschließen. Die Vorrichtung kann anders ausgerichtet sein (um 90 Grad gedreht oder in anderen Ausrichtungen) und die hierin verwendeten Begriffe räumlicher Beziehungen können somit auch dementsprechend ausgelegt werden.
- Metall-Isolator-Metall-Kondensatoren (MIM-Kondensatoren) oder Metall-Oxid-Metall-Kondensatoren (MOM-Kondensatoren) sind üblicherweise in integrierten Schaltungen (ICs) eingebettet und werden anstelle von Keramikkondensatoren verwendet, um die Größe mobiler Vorrichtungen zu verringern, die Kosten mobiler Vorrichtungen zu verringern, die Funktionalität mobiler Vorrichtungen zu erhöhen, oder eine beliebige Kombination der vorstehenden Ziele zu erreichen. In einigen Fällen ist ein MIM- oder ein MOM-Kondensator in einer Zwischenverbindungsstruktur, welche über einer Vorderseite eines Halbleitersubstrat liegt, angeordnet. Die Zwischenverbindungsstruktur kann zum Beispiel aus einer Anzahl horizontaler Metallleitungen (z.B. Drähte), welche übereinandergestapelt und durch vertikale Durchkontaktierungen miteinander verbunden sind, zusammengesetzt sein, wobei die Zwischenverbindungsstruktur Halbleiterbauelemente (z.B. Transistoren) auf der Vorderseite des Halbleitersubstrats funktionell miteinander verbindet, um eine vordefinierte Schaltungsanordnung umzusetzen. Der MIM-/MOM-Kondensator kann seine Elektroden gebildet in der Zwischenverbindungsstruktur über der Vorderseite des Substrats aufweisen, sodass der MIM-/MOM-Kondensator einfach in den Rest der IC integriert werden kann. Für große Kapazitätswerte ist im Allgemeinen jedoch eine große Fläche auf der IC für derartige MIM-/MOM-Kondensatoren erforderlich. Dies bedeutet höhere Kosten für die IC, und ist somit in mancher Hinsicht keine wirklich optimale Lösung.
- Verschiedene Ausführungsformen der vorliegenden Anmeldung betreffen einen Kondensator, welcher auf einer Rückseite eines Halbleitersubstrats gebildet ist. Somit werden Halbleiterbauelemente, wie zum Beispiel Transistoren, an einer Vorderseite des Halbleitersubstrats gebildet, und eine Zwischenverbindungsstruktur wird über der Vorderseite des Substrats gebildet, um die Halbleiterbauelemente funktionell miteinander zu verbinden. Ein Graben wird in der Rückseite des Substrats gebildet, und wird abwechselnd mit leitfähigen Schichten und dielektrischen Schichten ausgekleidet, welche übereinandergestapelt werden, um einen Kondensator in dem Graben in der Rückseite des Substrats zu schaffen. Durch Bilden des Kondensators in dem Graben in der Rückseite des Substrats ist die Auswirkung des Kondensators auf die Gesamtfläche der IC im Vergleich zu traditionellen MIM-/MON-Kondensatoren begrenzt. Ferner können mehrere dieser Substrate, jedes davon aufweisend einen oder mehrere Rückseitenkondensatoren, in einigen Fällen übereinandergestapelt werden, um eine dreidimensionale IC zu bilden, welche relativ hohe Kapazitätswerte mit einem relativ geringen Platzbedarf bereitstellt.
- Bezugnehmend auf
1 ist eine Querschnittsansicht einiger Ausführungsformen einer Halbleiterstruktur100 aufweisend einen Rückseitengrabenkondensator bereitgestellt. - Die Halbleiterstruktur
100 weist ein Halbleitersubstrat102 aufweisend eine Vorderseitenfläche102f und eine Rückseitenfläche102b auf. Halbleitervorrichtungen110 , wie zum Beispiel Transistoren, sind an der Vorderseitenfläche102f angeordnet. Die dargestellte Halbleitervorrichtung110 manifestiert sich als ein Transistor, welcher einen ersten und einen zweiten Source-/Drain-Bereich126 ,128 , welche mit einer ersten Dotierungsleitfähigkeit (z.B. Typ n) dotiert sind, aufweist. Ein Körperbereich, welcher derart dargestellt ist, dass er einem Wannenbereich130 in1 entspricht, ist mit einer zweiten Dotierungsleitfähigkeit (z.B. Typ p) dotiert, und trennt den ersten und den zweiten Source-/Drain-Bereich126 ,128 voneinander. Der zweite Dotierungstyp ist dem ersten Dotierungstyp entgegengesetzt. Eine Gate-Elektrode132 ist über dem Körperbereich angeordnet, und ist vom Körperbereich durch ein Gate-Dielektrikum134 getrennt. Andere Halbleitervorrichtungen, wie zum Beispiel aktive Bauelemente, wie zum Beispiel Bipolartransistoren (BJTs) oder FinFETs, und/oder passive Bauelemente, wie zum Beispiel Widerstände oder Dioden, könnten an der Vorderseitenfläche102f vorhanden sein. - Eine Vorderseite-Zwischenverbindungsstruktur
104 ist über der Vorderseitenfläche102f angeordnet. Die Vorderseite-Zwischenverbindungsstruktur104 weist mehrere Vorderseite-Metallleitungen und Vorderseite-Durchkontaktierungen auf, welche die Halbleitervorrichtungen110 funktionell miteinander verbindet. - Die Vorderseite-Zwischenverbindungsstruktur
104 weist mehrere leitfähige Schichten eingebettet in dielektrische Materialschichten auf. Die dielektrischen Materialschichten weisen mehrere dielektrische Zwischenschichten (ILD-Schichten)106a ,106b ,106c auf, welche ein geeignetes dielektrisches Material enthalten können. Zum Beispiel kann in den vorliegenden Ausführungsform die mehreren ILD-Schichten106a ,106b ,106c ein Material mit niedriger Dielektrizitätskonstante (niedrigem k) enthalten, wobei das Material eine niedrigere Konstante als jene von thermischem Siliziumoxid aufweist. In anderen Ausführungsform enthalten die ILD-Schichten106a ,106b ,106c Siliziumdioxid oder ein anderes dielektrisches Material. Das dielektrische Material kann durch CVD, HDPCVD, PECVD, Kombinationen davon oder andere geeignete Prozesse gebildet werden. Zum Zweck der Veranschaulichung sind in1 nur drei Vorderseite-ILD-Schichten gezeigt, wobei sich jedoch versteht, dass eine beliebige Anzahl von Vorderseite-ILD-Schichten umgesetzt werden kann, und dass die dargestellten Vorderseite-ILD-Schichten nur als Beispiel dienen. - Die mehreren leitfähigen Schichten in der Vorderseite-Zwischenverbindungsstruktur
104 stellen Verbindungsleitungen zwischen den verschiedenen Halbleitervorrichtungen110 bereit. Die mehreren leitfähigen Schichten weisen Metallleitungen auf, darunter die Metall-Eins-Leitungen108a , die Metall-Zwei-Leitungen108b , und so weiter bis zur obersten Metallleitung108c . Die mehreren leitfähigen Schichten weisen ferner Kontakte110a zum Verbinden der Metall-Eins-Leitungen108a mit den Halbleitervorrichtungen110 und Durchkontaktierungen110b ,110c zum Verbinden benachbarter Metallleitungen (z.B.108b und108c ) auf. Die leitfähigen Schichten der Vorderseite-Zwischenverbindungsstruktur104 können leitfähige Materialien, wie zum Beispiel Aluminium, Aluminium/Silizium/Kupferlegierung, Titan, Titannitrid, Wolfram, Polysilizium, Metallsilizid oder Kombinationen daraus, enthalten, gebildet durch einen Prozess, wie zum Beispiel PVD, CVD, Kombinationen davon oder andere geeignete Prozesse. Andere Herstellungstechniken zum Bilden der Vorderseite-Zwischenverbindungsstruktur104 können Fotolithografiebearbeitung und Ätzen umfassen, um die leitfähigen Materialien zur vertikalen Verbindung (zum Beispiel Durchkontaktierungen/Kontakte) und zur horizontalen Verbindung (zum Beispiel Metallschichten) zu strukturieren. Alternativ dazu kann eine mehrschichtige Kupfer-Zwischenverbindungsstruktur verwendet werden, um die Metallstrukturen zu bilden. Die Kupfer-Zwischenverbindungsstruktur kann Kupfer, Kupferlegierung, Titan, Titannitrid, Tantal, Tantalnitrid, Wolfram, Polysilizium, Metallsilizid oder Kombinationen daraus enthalten. Die Kupfer-Zwischenverbindungsstruktur kann durch Damaszenertechnik umfassend dielektrische Abscheidung, Ätzen, Abscheidung und Planarisierung gebildet werden. Die Abscheidung kann Zerstäubung, Elektroplattierung, CVD oder andere geeignete Prozesse umfassen. - Ein Graben
112 ist in der Rückseitenfläche102b des Halbleitersubstrats102 angeordnet. Der Graben112 ist mit einer unteren Kondensatorelektrode114 , einer über der unteren Kondensatorelektrode114 angeordneten dielektrischen Kondensatorschicht116 und einer über der dielektrischen Kondensatorschicht116 angeordneten oberen Kondensatorelektrode118 gefüllt. Die dielektrische Kondensatorschicht116 trennt die untere Kondensatorelektrode114 und die obere Kondensatorelektrode118 voneinander, wodurch im Bereich des Halbleitersubstrats am nächsten an der Rückseitenfläche102b eine oder mehrere Kondensatorelemente geschaffen werden. - In der Ausführungsform von
1 ist eine innerste Fläche112i des Grabens112 beabstandet von und direkt unterhalb einer unteren Ausdehnung des Wannenbereichs130 der Halbleitervorrichtung110 im Halbleitersubstrat angeordnet. In einigen Ausführungsformen überzieht ein dotierter Bereich136 die innerste Fläche des Grabens112 , die Grabenseitenwände und optional auch die Rückseite des Halbleitersubstrats, und kann als eine weitere Kondensatorelektrode dienen. Somit kann in1 ein erstes Kondensatorelement101 den dotierten Bereich136 und die durch einen inneren Abschnitt der dielektrischen Kondensatorschicht116 beabstandete untere Kondensatorelektrode114 aufweisen, und ein zweites Kondensatorelement103 kann die untere Kondensatorelektrode114 und die durch einen äußeren Abschnitt der dielektrischen Kondensatorschicht116 beabstandete obere Kondensatorelektrode118 aufweisen. In einigen Ausführungsformen kann das erste Kondensatorelement101 parallel zum zweiten Kondensatorelement103 angeordnet sein, um eine weitere Erhöhung der Kapazität pro Einheitsfläche zu verwirklichen. - Eine Rückseite-Zwischenverbindungsstruktur
120 weist mehrere Rückseite-Metallleitungen und Rückseite-Kontakten und Rückseite-Durchkontaktierungen auf, um die untere Kondensatorelektrode114 und die obere Kondensatorelektrode118 funktionell mit den Halbleitervorrichtungen110 und/oder anderen Rückseitengrabenkondensatoren zu verbinden. In einigen Ausführungsformen sind die Rückseite-Metallleitungen dicker als die Vorderseite-Metallleitungen, wobei in anderen Ausführungsformen die Rückseite-Metallleitungen hingegen dieselbe Dicke aufweisen, wie die Vorderseite-Metallleitungen. Diese Konfiguration stellt eine relativ hohe Flächenkapazität in einem relativ kleinen Flächenbereich der IC bereit. - Die Rückseite-Zwischenverbindungsstruktur
120 weist mehrere leitfähige Rückseitenschichten eingebettet in dielektrische Rückseitenmaterialschichten auf. Die dielektrischen Materialschichten weisen mehrere Rückseite-ILD-Schichten142a ,142b auf, welche jeweils ein geeignetes dielektrisches Material enthalten können. Zum Beispiel kann in den vorliegenden Ausführungsformen die mehrere Rückseite-ILD-Schichten142a ,142b ein Material mit niedriger Dielektrizitätskonstante (niedrigem k) enthalten, wobei das Material eine niedrigere Konstante als jene von thermischem Siliziumoxid aufweist. In anderen Ausführungsformen enthalten die Rückseite-ILD-Schichten142a ,142b Siliziumdioxid oder ein anderes dielektrisches Material. Das dielektrische Material kann durch CVD, HDPCVD, PECVD, Kombinationen davon oder andere geeignete Prozesse gebildet werden. Zum Zweck der Veranschaulichung sind in der Rückseite-Zwischenverbindungsstruktur120 von1 nur zwei Rückseite-ILD-Schichten gezeigt, wobei sich jedoch versteht, dass eine beliebige Anzahl von Rückseite-ILD-Schichten umgesetzt werden kann, und dass die dargestellten Rückseite-ILD-Schichten nur als Beispiel dienen. - Die mehrere leitfähigem Schichten in der Rückseite-Zwischenverbindungsstruktur
120 stellen Verbindungsleitungen zwischen den verschiedenen Kondensatorelektroden bereit. Die mehreren leitfähigen Schichten weisen Metallleitungen auf, darunter die Metall-Eins-Leitungen132a und eine oberste Metallleitung122b . Die mehreren leitfähigen Schichten umfasst ferner Kontakte124 zum Verbinden der Metallleitungen mit den Kondensatorelektroden. Die leitfähigen Schichten der Rückseite-Zwischenverbindungsstruktur120 können leitfähige Materialien, wie zum Beispiel Aluminium, Aluminium/Silizium/Kupferlegierung, Titan, Titannitrid, Wolfram, Polysilizium, Metallsilizid oder Kombinationen daraus, enthalten, gebildet durch einen Prozess, wie zum Beispiel PVD, CVD, Kombinationen davon oder andere geeignete Prozesse. Andere Herstellungstechniken zum Bilden der Rückseite-Zwischenverbindungsstruktur120 können Fotolithografiebearbeitung und Ätzen umfassen, um die leitfähigen Materialien zur vertikalen Verbindung (zum Beispiel Durchkontaktierungen/Kontakte) und zur horizontalen Verbindung (zum Beispiel Metallschichten) zu strukturieren. Alternativ dazu kann eine mehrschichtige Kupfer-Zwischenverbindungsstruktur verwendet werden, um die Metallstrukturen zu bilden. Die Kupfer-Zwischenverbindungsstruktur kann Kupfer, Kupferlegierung, Titan, Titannitrid, Tantal, Tantalnitrid, Wolfram, Polysilizium, Metallsilizid oder Kombinationen daraus enthalten. Die Kupfer-Zwischenverbindungsstruktur kann durch Damaszenertechnik umfassend dielektrische Abscheidung, Ätzen, Abscheidung und Planarisierung gebildet werden. Die Abscheidung kann Zerstäubung, Elektroplattierung, CVD oder andere geeignete Prozesse umfassen. -
2 stellt eine weitere Ausführungsform dar, wobei die innerste Fläche112i des Grabens112 vom Wannenbereich130 der Halbleitervorrichtung110 im Halbleitersubstrat seitlich versetzt ist und eine vertikale Überlappung mit diesem aufweist. Ferner stellt2 ein Beispiel dar, in welchem der Rückseitengrabenkondensator eine untere Kondensatorelektrode114 und eine Zwischenkondensatorelektrode117 , welche durch einen unteren Abschnitt des Kondensator-Dielektrikums116a voneinander getrennt sind; und eine obere Kondensatorelektrode118 , welche durch einen oberen Abschnitt der dielektrischen Kondensatorschicht116b von der Zwischenkondensatorelektrode117 getrennt ist, aufweist. In einigen Ausführungsformen überzieht ein dotierter Bereich136 die innerste Fläche des Grabens112 , die Grabenseitenwände und optional auch die Hinterseite des Halbleitersubstrats, und kann als eine weitere Kondensatorelektrode dienen. Somit kann in2 ein erstes Kondensatorelement101 den dotierten Bereich136 und die untere Kondensatorelektrode114 aufweisen, welche durch einen unteren Abschnitt der dielektrischen Kondensatorschicht116c voneinander beabstandet sind. Ein zweites Kondensatorelement103 kann die untere Kondensatorelektrode114 und die Zwischenkondensatorelektrode117 aufweisen, welche durch den unteren Abschnitt der dielektrischen Kondensatorschicht116a voneinander beabstandet sind. Ein drittes Kondensatorelement105 kann die Zwischenkondensatorelektrode117 und die obere Kondensatorelektrode118 aufweisen, welche durch den oberen Abschnitt der dielektrischen Kondensatorschicht116b voneinander beabstandet sind. In einigen Ausführungsformen kann das erste Kondensatorelement101 parallel zum zweiten Kondensatorelement103 und/oder zum dritten Kondensatorelement105 angeordnet werden, um eine weitere Erhöhung der Kapazität pro Einheitsfläche zu verwirklichen. Während die obere Kondensatorelektrode118 von1 ein fester Körper war, weist die obere Kondensatorelektrode118 von2 einen U-förmigen Querschnitt auf. Im Beispiel von2 weisen die untere Kondensatorelektrode114 und/oder die Zwischenkondensatorelektrode117 obere Flächen auf, welche unter einer oberen Fläche der Metall-Eins-Leitung122a angeordnet sind, und die obere Fläche der oberen Kondensatorelektrode118 kann in einigen Ausführungsformen auf einer Ebene oder fluchtend mit der oberen Fläche der Metall-Eins-Leitung122a angeordnet sein. - Es versteht sich, dass
1 und2 zwar als Beispiele dargestellt sind, diese dargestellten Ausführungsformen aber keine Einschränkung bedeuten. Zum Beispiel zeigt zwar1 zwei leitfähige Schichten angeordnet über einer innersten Fläche des Grabens, und2 zeigt drei leitfähige Schichten angeordnet über einer innersten Fläche des Grabens, jedoch könnte eine beliebige Anzahl leitfähiger Schichten vorhanden sein. Im Allgemeinen tendieren hinzugefügte zusätzliche leitfähige Schichten dazu, die Kapazität weiter zu erhöhen, wenn die betreffenden Kondensatorelektroden parallelgeschaltet sind. Allerdings erhöhen diese zusätzlichen Schichten auch die Bearbeitungszeit und die Komplexität, sodass weniger leitfähige Schichten, wie in1 , einen rationalisierten Ansatz bereitstellen. - Bezugnehmend auf
3 ist eine Querschnittsansicht einiger Ausführungsformen einer Halbleiterstruktur300 bereitgestellt. Die Halbleiterstruktur300 weist eine Anzahl von übereinander gestapelten Substraten auf, wobei eines oder mehrere der Substrate mindestens einen Rückseitengrabenkondensator aufweist/aufweisen. - Die Halbleiterstruktur
300 weist ein erstes Halbleitersubstrat302 aufweisend eine erste Vorderseitenfläche302f und eine erste Rückseitenfläche302b auf. Ein zweites Halbleitersubstrat304 weist eine zweite Vorderseitenfläche304f und eine zweite Rückseitenfläche304b auf. Das zweite Halbleitersubstrat304 ist über dem ersten Halbleitersubstrat302 angeordnet. Eine erste Zwischenverbindungsstruktur306 ist zwischen der ersten Vorderseitenfläche302f des ersten Halbleitersubstrats302 und der zweiten Vorderseitenfläche304f des zweiten Halbleitersubstrats304 angeordnet. Die erste Zwischenverbindungsstruktur306 weist mehrere erste Metallleitungen und Durchkontaktierungen auf, welche erste Halbleiterbauelemente, welche in oder auf der ersten Vorderseitenfläche302f des ersten Halbleitersubstrats302 angeordnet sind, funktionell miteinander verbinden. Eine zweite Zwischenverbindungsstruktur312 ist zwischen der ersten Zwischenverbindungsstruktur306 und der zweiten Vorderseitenfläche304f des zweiten Halbleitersubstrats304 angeordnet. Die zweite Zwischenverbindungsstruktur312 weist mehrere zweite Metallleitungen und Durchkontaktierungen auf, welche zweite Halbleiterbauelemente, welche in oder auf der zweiten Vorderseitenfläche304f des zweiten Halbleitersubstrats304 angeordnet sind, funktionell miteinander verbinden. Ein erster Graben317 ist in der ersten Rückseitenfläche302b des ersten Halbleitersubstrats302 angeordnet. Der erste Graben317 ist mit einer ersten inneren Kondensatorelektrode314 , einer über der ersten inneren Kondensatorelektrode314 angeordneten ersten dielektrischen Kondensatorschicht316 und einer über der ersten dielektrischen Kondensatorschicht316 angeordneten ersten äußeren Kondensatorelektrode318 gefüllt. In einigen Ausführungsformen kann somit der Kondensator in1 und/oder2 in den ersten Graben317 von3 eingesetzt sein. Ein zweiter Graben319 ist in der zweiten Rückseitenfläche des zweiten Halbleitersubstrats304 angeordnet. Der zweite Graben319 ist mit einer zweiten inneren Kondensatorelektrode344 , einer über der zweiten inneren Kondensatorelektrode angeordneten zweiten dielektrischen Kondensatorschicht346 und einer über der zweiten dielektrischen Kondensatorschicht angeordneten zweiten äußeren Kondensatorelektrode348 gefüllt. In einigen Ausführungsformen kann somit der Kondensator in1 und/oder2 in den zweiten Graben319 von3 eingesetzt sein. - Die Halbleiterstruktur
300 weist ferner ein drittes Halbleitersubstrat320 aufweisend eine dritte Vorderseitenfläche320f und eine dritte Rückseitenfläche320b auf. Das dritte Halbleitersubstrat320 ist unter dem ersten Halbleitersubstrat302 angeordnet. Eine dritte Zwischenverbindungsstruktur322 ist zwischen der ersten Rückseitenfläche302b des ersten Halbleitersubstrats und der dritten Vorderseitenfläche320f des dritten Halbleitersubstrats angeordnet. Die dritte Zwischenverbindungsstruktur322 weist mehrere dritte Metallleitungen und Durchkontaktierungen auf, welche dritte Halbleiterbauelemente, welche in oder auf der dritten Vorderseitenfläche302f des dritten Halbleitersubstrats302 angeordnet sind, funktionell miteinander verbinden. Ein dritter Graben326 ist in der dritten Rückseitenfläche des dritten Halbleitersubstrats angeordnet. Der dritte Graben326 ist mit einer dritten inneren Kondensatorelektrode354 , einer über der dritten inneren Kondensatorelektrode angeordneten dritten dielektrischen Kondensatorschicht356 und einer über der dritten dielektrischen Kondensatorschicht angeordneten dritten äußeren Kondensatorelektrode358 gefüllt. In einigen Ausführungsformen kann somit der Kondensator in1 und/oder2 in den dritten Graben326 von3 eingesetzt sein. - Ferner weist die Halbleiterstruktur
300 auf: ein viertes Halbleitersubstrat328 aufweisend eine vierte Vorderseitenfläche328f und eine vierte Rückseitenfläche328b . Das vierte Halbleitersubstrat328 ist unter dem dritten Halbleitersubstrat320 angeordnet. Eine vierte Zwischenverbindungsstruktur330 ist zwischen der dritten Rückseitenfläche des dritten Halbleitersubstrats320 und der vierten Vorderseitenfläche des vierten Halbleitersubstrats328 angeordnet. Die vierte Zwischenverbindungsstruktur330 weist mehrere vierte Metallleitungen und Durchkontaktierungen auf, welche vierte Halbleiterbauelemente, welche in oder auf der vierten Vorderseitenfläche des vierten Halbleitersubstrats328 angeordnet sind, funktionell miteinander verbinden. Das vierte Halbleitersubstrat328 weist eine vierte Dicke auf, welche größer ist, als eine erste Dicke des ersten Halbleitersubstrats302 . Zusätzliche Substrate (z.B.350 ) können in einigen Fällen ebenfalls vorhanden sein, und können auch zusätzliche Rückseitengrabenkondensatoren (z.B.370 ) aufweisen. - Ein Bondpad oder ein Landingpad
372 , welches ein Metall, wie zum Beispiel Kupfer oder Aluminium enthält, ist über einer Passivierungsschicht374 angeordnet, und über eine Wiederverteilungsschicht-Durchkontaktierung (RDL-Durchkontaktierung)376 mit einer zweiten Rückseite-Zwischenverbindungsstruktur307 verbunden. Das Bondpad oder Landingpad372 kann durch die RDL-Durchkontaktierung376 und eine zweite Rückseite-Zwischenverbindungsstruktur308 funktionell mit einem/einer oder mehreren Kondensatoren oder Halbleitervorrichtungen auf der 3DIC verbunden sein. Die Passivierungsschicht374 kann zum Beispiel ein Harz, ein Epoxid, einen Kunststoff oder ein Keramikmaterial enthalten. - In einigen Ausführungsformen weisen das erste, das zweite und das dritte Halbleitersubstrat jeweils eine erste Dicke auf, welche für das erste, das zweite und das dritte Halbleitersubstrat dieselbe ist, und das vierte Halbleitersubstrat
328 weist eine vierte Dicke auf, welcher größer ist als die erste Dicke. - Die Halbleiterstruktur
300 weist ferner Durchkontaktierungen durch ein Substrat (TSV) auf, welche sich durch mehrere Substrate erstrecken. Zum Beispiel weist das erste Halbleitersubstrat302 eine TSV340 auf, um die erste Zwischenverbindungsstruktur306 mit der dritten Zwischenverbindungsstruktur322 zu verbinden. Die Durchkontaktierungen durch das Substrat weisen äußere Seitenwände auf, welche auf der ersten Vorderseite um einen ersten Abstand und auf der ersten Rückseite um einen zweiten Abstand beabstandet sind, wobei der erste Abstand geringer ist als der zweite Abstand. Die übrigen Halbleitersubstrate können ebenfalls Durchkontaktierungen durch das Substrat aufweisen, wobei in einigen Ausführungsformen im untersten Substrat (z.B. dem vierten Halbleitersubstrat328 ) keine Durchkontaktierungen durch das Substrat angeordnet sind. - Die Halbleiterstruktur
300 weist ferner verschiedene Bondingstrukturen auf, um die verschiedenen Substrate und Zwischenverbindungsstrukturen miteinander zu verbinden. Zum Beispiel ist eine erste Vorderseite-Bondingstruktur342 angeordnet an der ersten Vorderseite des ersten Halbleitersubstrats302 mit einer zweiten Vorderseite-Bondingstruktur345 angeordnet über dem zweiten Halbleitersubstrat304 verbunden. Die erste Vorderseite-Bondingstruktur342 entspricht der zweiten Vorderseite-Bondingstruktur345 , und ist durch eine Hybridbindung mit der zweiten Vorderseite-Bondingstruktur verbunden. In einigen Ausführungsformen enthält die erste Vorderseite-Bondingstruktur342 leitfähige Merkmale (z.B. Metallmerkmale343 ) angeordnet in einem Feld einer dielektrischen Schicht347 , und die zweite Vorderseite-Bondingstruktur345 enthält leitfähige Merkmale (z.B. Metallmerkmale351 ) angeordnet in einem Feld einer dielektrischen Schicht349 . Ferner können einige Merkmale381 der ersten Vorderseite-Bondingstruktur342 elektrisch mit Halbleiterbauelementen und/oder Kondensatoren am ersten Halbleitersubstrat302 verbunden sein, während andere Merkmale „Dummy“-Strukturen 382 sind, welche die Verbindung unterstützen, jedoch elektrisch potentialfrei oder von Halbleiterbauelementen und Kondensatoren an den Substraten getrennt sind. - Das/die Halbleitersubstrat(e)
302 ,304 ,320 ,328 und/oder350 kann/können zum Beispiel ein Grundhalbleitersubstrat, ein SOI-Substrat oder ein anderes Halbleitersubstrat sein oder aufweisen. Ferner kann/können das/die Halbleitersubstrat(e) zum Beispiel, monokristallines Silizium, ein anderes Silizium oder ein anderes Halbleitermaterial sein oder aufweisen. - In einigen Ausführungsformen sind die dielektrischen Kondensatorschichten
316 ,346 hergestellt aus oder enthalten Siliziumdioxid, ein dielektrisches Material mit hohem κ oder ein dielektrisches Material mit niedrigem κ. Die Verwendung eines dielektrischen Materials mit hohem κ ist insofern vorteilhaft, als dass es die Kapazität des Kondensators im Vergleich zu Siliziumdioxid oder einem dielektrischen Material mit niedrigem κ für eine bestimmten Fläche erhöht. Die Metall-Interconnect-Leitungen und/oder Durchkontaktierungen sind typischerweise hergestellt aus oder enthalten ein Metall, wie zum Beispiel Aluminium und/oder Kupfer. - In einigen Ausführungsformen wird die Halbleiterstruktur
300 von3 durch Bilden von Halbleitertransistorvorrichtungen, einer Vorderseite-Zwischenverbindungsstruktur, einer Rückseite-Kondensatorstruktur und eine Rückseite-Zwischenverbindungsstruktur für das erste Halbleitersubstrat gebildet (optional kann das Halbleitersubstrat verdünnt werden, zum Beispiel durch Verwendung eines Schleifvorgangs vor der Bildung des Grabens in der Rückseite des Substrats, wobei in diesem Fall der Rückseitenkondensator jenem von2 ähnlicher sein kann, als jenem von1 ). Halbleitertransistorvorrichtungen, eine Vorderseite-Zwischenverbindungsstruktur, eine Rückseite-Kondensatorstruktur und eine Rückseite-Zwischenverbindungsstruktur können auch für die anderen Halbleitersubstrate gebildet werden. Dann kann die Vorderseite-Zwischenverbindungsstruktur eines Substrats zum Beispiel durch Verwendung einer Hybridbindung entweder mit einer Vorderseite-Zwischenverbindungsstruktur oder mit einer Rückseite-Zwischenverbindungsstruktur eines anderen Substrats verbunden werden. Auf diese Weise können die Substrate gestapelt werden, um die Struktur von3 zu bilden. - Die
4 -12 stellen eine Reihe von Querschnittsansichten dar, welche gemeinsam einige Ausführungsformen der Herstellung einer Halbleiterstruktur im Einklang mit einigen Ausführungsformen der vorliegenden Offenbarung darstellen. - In
4 ist ein erstes Halbleitersubstrats102 bereitgestellt, und mehrere Halbleitervorrichtungen110 , wie zum Beispiel Transistoren, werden an einer ersten Vorderseite102f des ersten Halbleitersubstrats102 gebildet. In einigen Ausführungsformen kann das erste Halbleitersubstrat102 einen monokristallinen Siliziumwafer, einen Halbleiter-auf-Isolator-Wafer (SOI-Wafer) oder ein weiteres Halbleitersubstrat aufweisen. Eine erste Vorderseite-Zwischenverbindungsstruktur104 wird über der ersten Vorderseite des ersten Substrats gebildet, und auch eine Durchkontaktierung durch ein Substrat (TSV)186 wird gebildet. In einigen Ausführungsformen kann die TSV186 vor den Halbleitervorrichtungen110 gebildet werden, wobei die TSV186 in anderen Ausführungsformen jedoch nach den Halbleitervorrichtungen110 gebildet werden kann. Häufig enthält die TSV186 Kupfer oder eine Kupferlegierung, und kann Seitenwände aufweisen, welche mit einer Barriereschicht zum Beispiel aufweisend Tantal oder Titan überzogen sind. - In
5 wird ein erster Graben112 in einer Rückseite des ersten Halbleitersubstrats102 gebildet. Der erste Graben112 kann durch Aufschleudern einer Fotolacklösung auf die Rückseite des ersten Halbleitersubstrats102 , Einbrennen des Fotolacks und dann Belichten des Fotolacks mit Licht durch eine Strichplatte oder Fotomaske und Entwickeln des belichteten Fotolacks zum Bilden einer strukturierten Maske an der Rückseite des ersten Substrats gebildet werden. Dann wird eine Ätzung mit der positionierten strukturierten Maske vorgenommen. Die Ätzung kann eine Nassätzung oder eine Trockenätzung sein, und falls ein Graben mit hohem Aspektverhältnis gewünscht ist, kann in einigen Umsetzungen ein Bosch-Ätzprozess verwendet werden. In anderen Ausführungsformen können zum Beispiel Extrem-Ultraviolett-Fotolithografie- und/oder Elektronenstrahllithografie-Techniken dazu verwendet werden, den ersten Graben112 zu bilden. - In
6 wird eine erste dielektrische Schicht116a , wie zum Beispiel eine dielektrische Schicht mit hohem k, über der Rückseite des ersten Halbleitersubstrats102 gebildet, und zwar auch an einer innersten Fläche und Seitenwänden des Grabens112 . Die erste dielektrische Schicht116a kann unter anderem durch physikalische Aufdampfung (PVD), chemische Dampfabscheidung (CVD), Atomlagenabscheidung (ALD) oder thermische Oxidation gebildet werden. In einigen Ausführungsformen ist die erste dielektrische Schicht116a eine konforme Schicht. In einigen Ausführungsformen ist die erste dielektrische Schicht116a ein Dielektrikum mit hohem k, und kann Hafnium und/oder Zirkonium enthalten, und kann unter anderem die Form von Hafniumsilikat, Zirkoniumsilikat, Hafniumdioxid und/oder Zirkoniumdioxid annehmen. - Weiterhin bezugnehmend auf
6 wird dann eine erste leitfähige Schicht114 über der ersten dielektrischen Schicht116a gebildet. Die erste leitfähige Schicht114 kann einer Kondensatorelektrode entsprechen, und kann ein Metall oder dotiertes Polysilizium enthalten und konform sein. Metalle können zum Beispiel Kupfer, Aluminium, Wolfram, Nickel, Titan, Zirkonium und/oder andere aufweisen; und können unter anderem durch PVD, CVD, ALD, Zerstäubung/Sputtern oder Elektroplattieren gebildet werden. - In
7 ist die erste leitfähige Schicht114 zum Beispiel durch Bilden einer Fotomaske und anschließendes Ausführen einer Ätzung mit der positionierten Fotomaske strukturiert worden. Die Fotomaske wird dann entfernt, zum Beispiel durch Veraschen oder Plasmaablösung, und eine zweite dielektrische Schicht116b , wie zum Beispiel eine dielektrische Schicht mit hohem k, wird über einer oberen Fläche der ersten leitfähigen Schicht114 in dem Graben112 gebildet. Die zweite dielektrische Schicht116b überzieht eine innerste Fläche und Seitenwände des Grabens, überzieht innere Seitenwände der ersten leitfähigen Schicht in dem Graben, und erstreckt sich über eine obere Fläche der ersten leitfähigen Schicht114 und der ersten dielektrischen Schicht116a an der Rückseite des Substrats außerhalb des Grabens. In einigen Ausführungsformen ist die zweite dielektrische Schicht116b eine konforme Schicht. Die zweite dielektrische Schicht116b kann durch PVD, CVD, ALD, thermische Oxidation oder andere Verfahren gebildet werden. In einigen Ausführungsformen kann die zweite dielektrische Schicht116b ein dielektrisches Material mit hohem k aufweisen, welches Hafnium und/oder Zirkonium enthalten kann, und kann unter anderem die Form von Hafniumsilikat, Zirkoniumsilikat, Hafniumdioxid und/oder Zirkoniumdioxid annehmen. - Weiterhin bezugnehmend auf
7 wird dann eine zweite leitfähige Schicht118 über der zweiten dielektrischen Schicht116b gebildet. Die zweite leitfähige Schicht118 kann einer Kondensatorelektrode entsprechen, und kann ein Metall oder dotiertes Polysilizium enthalten. Metalle können zum Beispiel Kupfer, Aluminium, Wolfram, Nickel, Titan, Zirkonium und/oder andere aufweisen; und können unter anderem durch PVD, CVD, ALD, Zerstäubung/Sputtern oder Elektroplattieren gebildet werden. - In
8 wird ein chemisch-mechanischer Planarisierungsvorgang (CMP-Vorgang) durchgeführt. In den dargestellten Ausführungsformen planarisiert der CMP-Vorgang eine obere Fläche der ersten leitfähigen Schicht114 mit einer oberen Fläche der zweiten leitfähigen Schicht118 . Es versteht sich, dass in anderen Ausführungsformen, in welchen zum Beispiel zusätzliche dielektrische Kondensatorschichten und/oder zusätzliche leitfähige Schichten vorhanden sind, der CMP-Vorgang an einer oder mehreren der leitfähigen Schichten und/oder dielektrischen Kondensatorschichten gestoppt werden kann, während andere dieser Schichten auf unterschiedlichen Stufenhöhen belassen werden. - In
9 wird eine erste Rückseite-Zwischenverbindungsstruktur120 gebildet. Die erste Rückseite-Zwischenverbindungsstruktur120 kann zum Beispiel gebildet werden, in dem eine erste ILD-Schicht über der planarisierten oberen Fläche von8 gebildet wird, und danach Fotolithografie dazu verwendet wird, Kontaktöffnungen in der ersten ILD-Schicht zu bilden. Metall, welches zum Beispiel Wolfram, Aluminium und/oder Kupfer aufweisen kann, kann in den Kontaktöffnungen gebildet werden, und kann danach planarisiert werden, um Kontakte zu schaffen. Zusätzliche ILD-Schichten können gebildet werden, und danach können Durchkontaktierungsöffnungen und Leitungsöffnungen gebildet und mit Metall, wie zum Beispiel Kupfer oder Kupfer-Aluminiumlegierung, gefüllt und danach planarisiert werden, um Metallleitungen und Durchkontaktierungen der ersten Rückseite-Zwischenverbindungsstruktur zu bilden. - In
10 wird die erste Halbleiterstruktur100 (welche das erste Halbleitersubstrat102 , die erste Vorderseite-Zwischenverbindungsstruktur104 angeordnet an einer Vorderseite des ersten Halbleitersubstrats102 , und die erste Rückseite-Zwischenverbindungsstruktur120 angeordnet an der Rückseite des ersten Halbleitersubstrats102 aufweist) mit einer zweiten Halbleiterstruktur200 (welche ein zweites Halbleitersubstrat202 , eine zweite Vorderseite-Zwischenverbindungsstruktur204 und eine zweite Rückseite-Zwischenverbindungsstruktur220 aufweist) verbunden. Der Verbindungsprozess ist ein Hybrid-Bindungsprozess, wobei dielektrisches Material der ersten Halbleiterstruktur100 mit dielektrischem Material der zweiten Halbleiterstruktur200 verbunden wird; und wobei Metall der ersten Halbleiterstruktur100 mit Metall der zweiten Halbleiterstruktur200 verbunden wird. - In
11 werden zusätzliche Halbleiterstrukturen aufweisend eine dritte Halbleiterstruktur300 , eine vierte Halbleiterstruktur400 und eine fünfte Halbleiterstruktur500 miteinander verbunden, um eine dreidimensionale IC1100 zu bilden. Typischerweise werden diese zusätzlichen Halbleiterstrukturen unter Verwendung einer Bondingstruktur miteinander verbunden, welche eine Hybrid-Bindung aufweisen kann, oder welche Lotkügelchen, Löthöcker, leitfähige Pfeiler, wie zum Beispiel Kupfer- oder Kupferlegierungspfeiler, Mikrohöcker oder andere Bondingstrukturen aufweisen kann. - Zum Beispiel kann ein drittes Halbleitersubstrat
303 aufweisend eine dritte Vorderseitenfläche303f und eine dritte Rückseitenfläche303b mit einer ersten Rückseite-Zwischenverbindungsstruktur120 verbunden werden. Ein dritter Graben326 ist in der dritten Rückseitenfläche des dritten Halbleitersubstrats302 angeordnet. Der dritte Graben326 ist mit einer dritten inneren Kondensatorelektrode, einer über der dritten inneren Kondensatorelektrode angeordneten dritten dielektrischen Kondensatorschicht und einer über der dritten dielektrischen Kondensatorschicht angeordneten dritten äußeren Kondensatorelektrode gefüllt. In einigen Ausführungsformen kann somit zum Beispiel der Kondensator in1 und/oder2 in den dritten Graben326 eingesetzt sein. Somit ist nach dem Verbinden das dritte Halbleitersubstrat303 unter dem ersten Halbleitersubstrat102 angeordnet. Die erste Rückseite-Zwischenverbindungsstruktur120 und eine dritte Vorderseite-Zwischenverbindungsstruktur350 sind zwischen der ersten Rückseitenfläche102b des ersten Halbleitersubstrats und der dritten Vorderseitenfläche303f des dritten Halbleitersubstrats angeordnet. Die erste Rückseite-Zwischenverbindungsstruktur120 weist mehrere Metallleitungen und Durchkontaktierungen auf, welche funktionell mit Kondensatorelektroden des ersten Grabenkondensators zu anderen leitfähigen Merkmalen in der 3DIC verbunden sind. Die dritte Vorderseite-Zwischenverbindungsstruktur305 weist auch mehrere Metallleitungen und Durchkontaktierungen auf, welche Halbleiterbauelemente, welche in oder auf dem dritten Substrat angeordnet sind, funktionell miteinander verbinden. - Ein viertes Halbleitersubstrat
402 aufweisend eine vierte Vorderseitenfläche402f und eine vierte Rückseitenfläche402b , und ein fünftes Halbleitersubstrat502 aufweisend eine fünfte Vorderseitenfläche502f und eine fünfte Rückseitenfläche502b können ebenfalls als Teil der 3DIC 1100 verbunden werden. Eine vierte Vorderseite-Zwischenverbindungsstruktur404 ist vorhanden. Auch eine fünfte Vorderseite-Zwischenverbindungsstruktur504 und eine fünfte Rückseite-Zwischenverbindungsstruktur520 sind vorhanden. Die fünfte Vorderseite-Zwischenverbindungsstruktur504 ist mit der dritten Rückseite-Zwischenverbindungsstruktur321 verbunden, und die fünfte Rückseite-Zwischenverbindungsstruktur520 ist mit der vierten Vorderseite-Zwischenverbindungsstruktur404 verbunden. -
12 zeigt einige Ausführungsformen eines Verfahrens zum Bilden einer Halbleiterstruktur im Einklang mit einigen Aspekten der Offenbarung. Es versteht sich, dass die dargestellten Vorgänge in anderen Ausführungsformen in anderer Reihenfolge durchgeführt werden können, ein oder mehrere der dargestellten Vorgänge in einigen anderen Ausführungsformen weggelassen werden können, und zusätzliche Vorgänge, welche in12 nicht dargestellt sind, in anderen Umsetzungen hinzukommen können.12 ist somit nur ein nicht einschränkendes Beispiel. - Bei
1202 werden Halbleitervorrichtungen bzw. -Bauelemente an einer Vorderseite eines Halbleitersubstrats gebildet. - Bei
1204 wird ein Graben in einer Rückseite des Halbleitersubstrats gebildet. - Bei
1206 werden abwechselnd leitfähige und isolierende Schichten in dem Graben an der Rückseite des Halbleitersubstrats gebildet, um einen Rückseitenkondensator zu schaffen. - Bei
1208 wird eine Rückseite-Zwischenverbindungsstruktur an der Rückseite des Halbleitersubstrats gebildet, um Kondensatorelektroden des Rückseitenkondensators zu verbinden. - Bei
1210 wird das Halbleitersubstrat optional mit anderen Halbleitersubstraten zum Bilden einer 3DIC verbunden. - Somit betreffen einige Ausführungsformen der vorliegenden Offenbarung eine Halbleiterstruktur. Die Struktur weist ein Halbleitersubstrat aufweisend eine Vorderseitenfläche und eine Rückseitenfläche auf. Eine Vorderseite-Zwischenverbindungsstruktur ist über der Vorderseitenfläche angeordnet und weist mehrere Metallleitungen und Durchkontaktierungen auf, welche Halbleiterbauelemente angeordnet in oder auf der Vorderseitenfläche des Halbleitersubstrats funktionell miteinander verbinden. Ein Graben ist in der Rückseitenfläche des Halbleitersubstrats angeordnet. Der Graben ist mit einer inneren Kondensatorelektrode in dem Graben, einer dielektrischen Kondensatorschicht in dem Graben und über der inneren Kondensatorelektrode angeordnet, und einer äußeren Kondensatorelektrode in dem Graben und über der dielektrischen Kondensatorschicht angeordnet gefüllt.
- Andere Ausführungsformen betreffen eine Halbleiterstruktur. Die Halbleiterstruktur weist ein erstes Halbleitersubstrat aufweisend eine erste Vorderseitenfläche und eine erste Rückseitenfläche auf. Ein zweites Halbleitersubstrat weist eine zweite Vorderseitenfläche und eine zweite Rückseitenfläche auf. Das zweite Halbleitersubstrat ist über dem ersten Halbleitersubstrat angeordnet. Eine erste Zwischenverbindungsstruktur ist zwischen der ersten Vorderseitenfläche des ersten Halbleitersubstrats und der zweiten Vorderseitenfläche des zweiten Halbleitersubstrats angeordnet. Die erste Zwischenverbindungsstruktur weist mehrere erste Metallleitungen und Durchkontaktierungen auf, welche erste Halbleiterbauelemente, welche in oder auf der ersten Vorderseitenfläche des ersten Halbleitersubstrats angeordnet sind, funktionell miteinander verbinden. Eine zweite Zwischenverbindungsstruktur ist zwischen der ersten Zwischenverbindungsstruktur und der zweiten Vorderseitenfläche des zweiten Halbleitersubstrats angeordnet. Die zweite Zwischenverbindungsstruktur weist mehrere zweite Metallleitungen und Durchkontaktierungen auf, welche zweite Halbleiterbauelemente, welche in oder auf der zweiten Vorderseitenfläche des zweiten Halbleitersubstrats angeordnet sind, funktionell miteinander verbinden. Ein erster Graben ist in der ersten Rückseitenfläche des ersten Halbleitersubstrats angeordnet. Der erste Graben ist mit einer ersten inneren Kondensatorelektrode, einer über der ersten inneren Kondensatorelektrode angeordneten ersten dielektrischen Kondensatorschicht und einer über der ersten dielektrischen Kondensatorschicht angeordneten ersten äußeren Kondensatorelektrode gefüllt. Ein zweiter Graben ist in der zweiten Rückseitenfläche des zweiten Halbleitersubstrats angeordnet. Der zweite Graben ist mit einer zweiten inneren Kondensatorelektrode, einer über der zweiten inneren Kondensatorelektrode angeordneten zweiten dielektrischen Kondensatorschicht und einer über der zweiten dielektrischen Kondensatorschicht angeordneten zweiten äußeren Kondensatorelektrode gefüllt.
- Einige weitere Ausführungsformen betreffen ein Verfahren. In dem Verfahren werden Halbleitervorrichtungen bzw. -Bauelemente an einer Vorderseite eines Halbleitersubstrats gebildet. Ein Graben wird in einer Rückseite des Halbleitersubstrats gebildet. Leitfähige und isolierende Schichten werden abwechselnd in dem Graben an der Rückseite des Halbleitersubstrats gebildet, um einen Rückseitenkondensator zu schaffen. Eine Rückseite-Zwischenverbindungsstruktur wird an der Rückseite des Halbleitersubstrats gebildet, um Kondensatorelektroden des Rückseitenkondensators zu verbinden.
- Das Vorstehende umreißt Merkmale verschiedener Ausführungsformen derart, dass Fachleute die Aspekte der vorliegenden Offenbarung besser verstehen können. Fachleute sollten verstehen, dass sie die vorliegende Offenbarung problemlos als eine Grundlage zum Entwerfen oder Modifizieren weiterer Prozesse und Strukturen zum Ausführen derselben Zwecke und/oder zum Erlangen derselben Vorteile der hierin vorgestellten Ausführungsformen verwenden können. Fachleute sollten auch erkennen, dass derartige äquivalente Konstruktionen nicht vom Geist und Umfang der vorliegenden Offenbarung abweichen, und dass sie verschiedenste Änderungen, Ersetzungen und Neugestaltungen daran vornehmen können, ohne vom Geist und Umfang der vorliegenden Offenbarung abzuweichen.
- ZITATE ENTHALTEN IN DER BESCHREIBUNG
- Diese Liste der vom Anmelder aufgeführten Dokumente wurde automatisiert erzeugt und ist ausschließlich zur besseren Information des Lesers aufgenommen. Die Liste ist nicht Bestandteil der deutschen Patent- bzw. Gebrauchsmusteranmeldung. Das DPMA übernimmt keinerlei Haftung für etwaige Fehler oder Auslassungen.
- Zitierte Patentliteratur
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- US 62/868289 [0001]
Claims (20)
- Halbleiterstruktur, aufweisend: ein Halbleitersubstrat, das eine Vorderseitenfläche und eine Rückseitenfläche aufweist; eine Vorderseite-Zwischenverbindungsstruktur, die über der Vorderseitenfläche angeordnet ist, wobei die Vorderseite-Zwischenverbindungsstruktur mehrere Metallleitungen und Durchkontaktierungen aufweist, welche Halbleitervorrichtungen, die in oder auf der Vorderseitenfläche des Halbleitersubstrats angeordnet sind, miteinander wirkverbinden; und einen Graben, der in der Rückseitenfläche des Halbleitersubstrats angeordnet ist, wobei der Graben gefüllt ist mit einer inneren Kondensatorelektrode in dem Graben, einer dielektrischen Kondensatorschicht in dem Graben und über der inneren Kondensatorelektrode und einer äußeren Kondensatorelektrode in dem Graben und über der dielektrischen Kondensatorschicht.
- Halbleiterstruktur nach
Anspruch 1 , wobei eine Bodenfläche des Grabens von einer unteren Ausdehnung eines Wannenbereichs einer Halbleitertransistorvorrichtung in dem Halbleitersubstrat beabstandet ist und direkt unterhalb derselben angeordnet ist. - Halbleiterstruktur nach
Anspruch 1 oder2 , wobei eine Bodenfläche des Grabens von einem Wannenbereich einer Halbleitertransistorvorrichtung in dem Halbleitersubstrat seitlich versetzt ist und eine vertikale Überlappung mit diesem aufweist. - Halbleiterstruktur nach einem der vorstehenden Ansprüche, wobei die dielektrische Kondensatorschicht eine obere Fläche, eine untere Fläche und Seitenwände der inneren Kondensatorelektrode einkapselt, und die äußere Kondensatorelektrode eine untere Fläche und äußere Seitenwände aufweist, die einen direkten Kontakt mit der dielektrischen Kondensatorschicht in dem Graben herstellen.
- Halbleiterstruktur nach einem der vorstehenden Ansprüche, wobei die innere Kondensatorelektrode Ausdehnungen aus dem Graben heraus aufweist, sodass eine äußerste Fläche der inneren Kondensatorelektrode waagrecht ist und/oder mit einer äußersten Fläche der dielektrischen Kondensatorschicht fluchtet.
- Halbleiterstruktur nach einem der vorstehenden Ansprüche, ferner aufweisend: einen dotierten Bereich, der Seitenwände des Grabens und eine Bodenfläche des Grabens überzieht, wobei der dotierte Bereich mit der äußeren Kondensatorelektrode elektrisch parallel geschaltet ist.
- Halbleiterstruktur nach einem der vorstehenden Ansprüche, wobei die äußere Kondensatorelektrode einen U-förmigen Querschnitt aufweist.
- Halbleiterstruktur nach einem der vorstehenden Ansprüche, ferner aufweisend: eine Zwischenkondensatorelektrode, die in dem Graben zwischen der inneren Kondensatorelektrode und der äußeren Kondensatorelektrode angeordnet ist.
- Halbleiterstruktur nach
Anspruch 8 , wobei zumindest eine der inneren Kondensatorelektrode und der Zwischenkondensatorelektrode eine äußerte Fläche aufweist, die näher an der Rückseite des Halbleitersubstrats angeordnet ist als eine obere Fläche einer Metallleitung in einer Rückseite-Zwischenverbindungsstruktur, welche der Rückseite des Halbleitersubstrats am nächsten angeordnet ist. - Halbleiterstruktur nach
Anspruch 9 , wobei eine äußerste Fläche der äußeren Kondensatorelektrode waagrecht ist oder mit der oberen Fläche der Metallleitung angeordnet fluchtet. - Halbleiterstruktur aufweisend: ein erstes Halbleitersubstrat, das eine erste Vorderseitenfläche und eine erste Rückseitenfläche aufweist; ein zweites Halbleitersubstrat, das eine zweite Vorderseitenfläche und eine zweite Rückseitenfläche aufweist, wobei das zweite Halbleitersubstrat über dem ersten Halbleitersubstrat angeordnet ist; eine erste Zwischenverbindungsstruktur, die zwischen der ersten Vorderseitenfläche des ersten Halbleitersubstrats und der zweiten Vorderseitenfläche des zweiten Halbleitersubstrats angeordnet ist, wobei die erste Zwischenverbindungsstruktur mehrere erste Metallleitungen und Durchkontaktierungen aufweist, welche erste Halbleitervorrichtungen, die in oder auf der ersten Vorderseitenfläche des ersten Halbleitersubstrats angeordnet sind, miteinander wirkverbinden; eine zweite Zwischenverbindungsstruktur, die zwischen der ersten Zwischenverbindungsstruktur und der zweiten Vorderseitenfläche des zweiten Halbleitersubstrats angeordnet ist, wobei die zweite Zwischenverbindungsstruktur mehrere zweite Metallleitungen und Durchkontaktierungen aufweist, welche zweite Halbleitervorrichtungen, die in oder auf der zweiten Vorderseitenfläche des zweiten Halbleitersubstrats angeordnet sind, miteinander wirkverbinden; einen ersten Graben, der in der ersten Rückseitenfläche des ersten Halbleitersubstrats angeordnet ist, wobei der erste Graben gefüllt ist mit einer ersten inneren Kondensatorelektrode, einer ersten dielektrischen Kondensatorschicht, die über der ersten inneren Kondensatorelektrode angeordnet ist, und einer ersten äußeren Kondensatorelektrode, die über der ersten dielektrischen Kondensatorschicht angeordnet ist; und einen zweiten Graben, der in der zweiten Rückseitenfläche des zweiten Halbleitersubstrats angeordnet ist, wobei der zweite Graben gefüllt ist mit einer zweiten inneren Kondensatorelektrode, einer zweiten dielektrischen Kondensatorschicht, die über der zweiten inneren Kondensatorelektrode angeordnet ist, und einer zweiten äußeren Kondensatorelektrode, über der zweiten dielektrischen Kondensatorschicht angeordnet ist.
- Halbleiterstruktur nach
Anspruch 11 , ferner aufweisend: ein drittes Halbleitersubstrat, das eine dritte Vorderseitenfläche und eine dritte Rückseitenfläche aufweist, wobei das dritte Halbleitersubstrat unter dem ersten Halbleitersubstrat angeordnet ist; eine dritte Zwischenverbindungsstruktur, die zwischen der ersten Rückseitenfläche des ersten Halbleitersubstrats und der dritten Vorderseitenfläche des dritten Halbleitersubstrats angeordnet ist, wobei die dritte Zwischenverbindungsstruktur mehrere dritte Metallleitungen und Durchkontaktierungen aufweist, die Halbleitervorrichtungen miteinander wirkverbinden, welche in oder auf der dritten Vorderseitenfläche des dritten Halbleitersubstrats angeordnet sind; und einen dritten Graben, der in der dritten Rückseitenfläche des dritten Halbleitersubstrats angeordnet ist, wobei der dritte Graben gefüllt ist mit einer dritten inneren Kondensatorelektrode, einer dritten dielektrischen Kondensatorschicht, die über der dritten inneren Kondensatorelektrode angeordnet ist, und einer dritten äußeren Kondensatorelektrode, über der dritten dielektrischen Kondensatorschicht angeordnet ist. - Halbleiterstruktur nach
Anspruch 12 , ferner aufweisend: ein viertes Halbleitersubstrat, das eine vierte Vorderseitenfläche und eine vierte Rückseitenfläche aufweist, wobei das vierte Halbleitersubstrat unter dem dritten Halbleitersubstrat angeordnet ist; eine vierte Zwischenverbindungsstruktur, die zwischen der dritten Rückseitenfläche des dritten Halbleitersubstrats und der vierten Vorderseitenfläche des vierten Halbleitersubstrats angeordnet ist, wobei die vierte Zwischenverbindungsstruktur mehrere vierte Metallleitungen und Durchkontaktierungen aufweist, die vierte Halbleitervorrichtungen miteinander wirkverbinden, welche in oder auf der vierte Vorderseitenfläche des vierten Halbleitersubstrats angeordnet sind; und wobei das vierte Halbleitersubstrat eine vierte Dicke aufweist, welche größer als eine erste Dicke des ersten Halbleitersubstrats ist. - Halbleiterstrukturen nach
Anspruch 13 , wobei das erste Halbleitersubstrat, das zweite Halbleitersubstrat und das dritte Halbleitersubstrat jeweils die erste Dicke aufweisen, und das vierte Halbleitersubstrat eine vierte Dicke aufweist, welcher größer als die erste Dicke ist. - Halbleiterstrukturen nach einem der vorstehenden
Ansprüche 12 bis14 , ferner aufweisend: Durchkontaktierungen durch das Substrat, die sich durch das erste Halbleitersubstrat erstrecken, um die erste Zwischenverbindungsstruktur mit der dritten Zwischenverbindungsstruktur zu verbinden. - Halbleiterstrukturen nach
Anspruch 15 , wobei die Durchkontaktierungen durch das Substrat äußere Seitenwände aufweisen, welche auf der ersten Vorderseitenfläche um einen ersten Abstand voneinander beabstandet sind, und welche auf der zweiten Rückseitenfläche um einen zweiten Abstand voneinander beabstandet sind, wobei der erste Abstand geringer als der zweite Abstand ist. - Halbleiterstrukturen nach
Anspruch 15 oder16 , ferner aufweisend: eine erste Rückseite-Bondingstruktur angeordnet auf der ersten Rückseitenfläche des ersten Halbleitersubstrats; und eine dritte Vorderseite-Bondingstruktur, die über der dritten Zwischenverbindungsstruktur angeordnet ist, wobei die dritte Vorderseite-Bondingstruktur der ersten Rückseite-Bondingstruktur entspricht und durch eine Hybrid-Bondung mit der ersten Rückseite-Bondingstruktur verbunden ist. - Verfahren, umfassend: Bilden von Halbleitervorrichtungen an einer Vorderseite eines Halbleitersubstrats; Bilden eines Grabens in einer Rückseite des Halbleitersubstrats; abwechselndes Bilden leitfähiger und isolierende Schichten in dem Graben an der Rückseite des Halbleitersubstrats, um einen Rückseitenkondensator zu schaffen; und Bilden einer Rückseite-Zwischenverbindungsstruktur an der Rückseite des Halbleitersubstrats zum Verbinden der Kondensatorelektroden des Rückseitenkondensators.
- Verfahren nach
Anspruch 18 , wobei das abwechselnde Bilden leitfähiger und isolierender Schichten in dem Graben an der Rückseite des Halbleitersubstrats umfasst: Bilden einer ersten konformen dielektrischen Schicht, welche den Graben auskleidet; Bilden einer ersten leitfähigen Schicht über der ersten konformen dielektrischen Schicht in dem Graben; Bilden einer zweiten konformen dielektrischen Schicht über der ersten leitfähigen Schicht in dem Graben; Bilden einer zweiten leitfähigen Schicht über der ersten konformen dielektrischen Schicht in dem Graben; und Bilden eines ersten Kontakts zur ersten leitfähigen Schicht und Bilden eines zweiten Kontakts zur zweiten leitfähigen Schicht, wobei der erste Kontakt und der zweite Kontakt einem ersten beziehungsweise einem zweiten Anschluss eines Rückseitengrabenkondensators entsprechen. - Verfahren nach
Anspruch 18 oder19 , ferner umfassend: Verbinden des Halbleitersubstrats mit mindestens einem weiteren Halbleitersubstrat zum Bilden einer dreidimensionalen integrierten Schaltung.
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US11587901B2 (en) * | 2021-03-26 | 2023-02-21 | Nanya Technology Corporation | Semiconductor device with redistribution structure and method for fabricating the same |
US11973019B2 (en) | 2021-05-19 | 2024-04-30 | Qualcomm Incorporated | Deep trench capacitors in an inter-layer medium on an interconnect layer of an integrated circuit die and related methods |
US11935760B2 (en) * | 2021-08-30 | 2024-03-19 | Taiwan Semiconductor Manufacturing Company, Ltd. | Package structure having thermal dissipation structure therein and manufacturing method thereof |
US11676892B2 (en) * | 2021-09-15 | 2023-06-13 | International Business Machines Corporation | Three-dimensional metal-insulator-metal capacitor embedded in seal structure |
US20230133157A1 (en) * | 2021-11-04 | 2023-05-04 | International Business Machines Corporation | Backside metal-insulator-metal (mim) capacitors |
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US20230260977A1 (en) * | 2022-02-17 | 2023-08-17 | Mediatek Inc. | Semiconductor packages |
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ATE427560T1 (de) * | 2003-06-20 | 2009-04-15 | Nxp Bv | Elektronische vorrichtung, anordnung und verfahren zum herstellen einer elektronischen vorrichtung |
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WO2007002185A2 (en) * | 2005-06-21 | 2007-01-04 | Cardiomems, Inc. | Method of manufacturing implantable wireless sensor for in vivo pressure measurement |
TWI267190B (en) * | 2005-08-29 | 2006-11-21 | Powerchip Semiconductor Corp | Semiconductor devices and method for fabricating the same |
JP5033807B2 (ja) * | 2005-11-08 | 2012-09-26 | エヌエックスピー ビー ヴィ | 極めて高いキャパシタンス値のための集積キャパシタの配置 |
CN100413055C (zh) * | 2005-11-30 | 2008-08-20 | 中芯国际集成电路制造(上海)有限公司 | 用于制造集成电路的电容器器件的方法与结构 |
WO2007131967A1 (en) * | 2006-05-15 | 2007-11-22 | Koninklijke Philips Electronics N.V. | Integrated low-loss capacitor-arrray structure |
US7473979B2 (en) * | 2006-05-30 | 2009-01-06 | International Business Machines Corporation | Semiconductor integrated circuit devices having high-Q wafer back-side capacitors |
US7531407B2 (en) * | 2006-07-18 | 2009-05-12 | International Business Machines Corporation | Semiconductor integrated circuit devices having high-Q wafer backside inductors and methods of fabricating same |
JP5330376B2 (ja) * | 2007-05-10 | 2013-10-30 | アイピーディーアイエイ | 集積装置及びその製造方法、並びに、システム・イン・パッケージ |
US8008748B2 (en) * | 2008-12-23 | 2011-08-30 | International Business Machines Corporation | Deep trench varactors |
US8361875B2 (en) * | 2009-03-12 | 2013-01-29 | International Business Machines Corporation | Deep trench capacitor on backside of a semiconductor substrate |
JP5613033B2 (ja) * | 2010-05-19 | 2014-10-22 | ルネサスエレクトロニクス株式会社 | 半導体装置の製造方法 |
US8693163B2 (en) * | 2010-09-01 | 2014-04-08 | Taiwan Semiconductor Manufacturing Company, Ltd. | Cylindrical embedded capacitors |
JP5863381B2 (ja) * | 2011-10-17 | 2016-02-16 | ルネサスエレクトロニクス株式会社 | 半導体装置及び半導体装置の製造方法 |
US9608130B2 (en) * | 2011-12-27 | 2017-03-28 | Maxim Integrated Products, Inc. | Semiconductor device having trench capacitor structure integrated therein |
US9196672B2 (en) * | 2012-01-06 | 2015-11-24 | Maxim Integrated Products, Inc. | Semiconductor device having capacitor integrated therein |
US9006101B2 (en) * | 2012-08-31 | 2015-04-14 | Taiwan Semiconductor Manufacturing Company, Ltd. | Interconnect structure and method |
US9978829B2 (en) * | 2012-11-26 | 2018-05-22 | Taiwan Semiconductor Manufacturing Co., Ltd. | Low impedance high density deep trench capacitor |
US9178080B2 (en) * | 2012-11-26 | 2015-11-03 | Taiwan Semiconductor Manufacturing Co., Ltd. | Deep trench structure for high density capacitor |
US9012296B2 (en) * | 2012-12-11 | 2015-04-21 | Taiwan Semiconductor Manufacturing Co., Ltd. | Self-aligned deep trench capacitor, and method for making the same |
JP2014225566A (ja) * | 2013-05-16 | 2014-12-04 | ピーエスフォー ルクスコ エスエイアールエルPS4 Luxco S.a.r.l. | 半導体装置 |
US9023688B1 (en) * | 2013-06-09 | 2015-05-05 | Monolithic 3D Inc. | Method of processing a semiconductor device |
JP2015032663A (ja) * | 2013-08-01 | 2015-02-16 | 株式会社東芝 | 固体撮像装置 |
US9331062B1 (en) * | 2013-12-06 | 2016-05-03 | Altera Corporation | Integrated circuits with backside power delivery |
US9818637B2 (en) * | 2015-12-29 | 2017-11-14 | Globalfoundries Inc. | Device layer transfer with a preserved handle wafer section |
US20170186837A1 (en) | 2015-12-29 | 2017-06-29 | Taiwan Semiconductor Manufacturing Co., Ltd. | Deep trench capacitor with scallop profile |
US10164005B2 (en) * | 2016-03-17 | 2018-12-25 | Taiwan Semiconductor Manufacturing Company Ltd. | Deep trench capacitor with a filled trench and a doped region serving as a capacitor electrode |
US10609813B2 (en) * | 2016-06-14 | 2020-03-31 | Intel Corporation | Capacitive interconnect in a semiconductor package |
CN107275315A (zh) * | 2017-05-27 | 2017-10-20 | 厦门市三安集成电路有限公司 | 一种化合物半导体背金电容的结构及其制作方法 |
US10157867B1 (en) | 2017-08-31 | 2018-12-18 | Taiwan Semiconductor Manufacturing Company, Ltd. | Interconnect structure and method |
WO2019132925A1 (en) * | 2017-12-28 | 2019-07-04 | Intel Corporation | Rf front end system with co-integrated acoustic wave resonator |
US20200219861A1 (en) * | 2017-12-28 | 2020-07-09 | Intel Corporation | Front end system having an acoustic wave resonator (awr) on an interposer substrate |
US10879183B2 (en) * | 2018-06-22 | 2020-12-29 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor device and method of manufacture |
US10615248B1 (en) * | 2018-09-26 | 2020-04-07 | International Business Machines Corporation | On-die capacitor for a VLSI chip with backside metal plates |
US10811543B2 (en) * | 2018-12-26 | 2020-10-20 | Texas Instruments Incorporated | Semiconductor device with deep trench isolation and trench capacitor |
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