CN112673475B - 显示基板及其制备方法、显示面板、显示装置 - Google Patents

显示基板及其制备方法、显示面板、显示装置 Download PDF

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Abstract

一种显示基板及其制备方法、显示面板、显示装置。显示基板包括衬底基板和重复单元，重复单元包括第一子像素和第二子像素，第一子像素的发光元件发出的光的颜色和第二子像素的发光元件发出的光的颜色相同，第一子像素的发光元件的第一发光电压施加电极的形状和第二子像素的发光元件的第一发光电压施加电极的形状不相同，每个子像素包括发光元件和像素电路，第一子像素的发光元件的第一发光电压施加电极在衬底基板上的正投影与第一子像素的像素电路的驱动电路的控制端在衬底基板上的正投影至少部分重叠，第二子像素的发光元件的第一发光电压施加电极在衬底基板上的正投影与第二子像素的像素电路的驱动电路的控制端在衬底基板上的正投影至少部分重叠。

Description

显示基板及其制备方法、显示面板、显示装置
技术领域
本公开的实施例涉及一种显示基板及其制备方法、显示面板、显示装置。
背景技术
随着有源矩阵有机发光二极管(Active-matrix organic light-emittingdiode，AMOLED)在显示领域的迅猛发展，人们对显示效果的要求越来越高。由于具有显示质量高等优点，高分辨率显示装置的应用范围也越来越广。通常，可通过减小像素的尺寸和减小像素间的间距来提高显示装置的分辨率。
发明内容
本公开至少一些实施例提供一种显示基板，包括衬底基板和设置在所述衬底基板上的多个重复单元，每个所述重复单元包括多个子像素，每个所述子像素包括发光元件和驱动所述发光元件发光的像素电路，所述像素电路包括驱动电路，所述发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在所述第一发光电压施加电极和所述第二发光电压施加电极之间的发光层，所述多个子像素包括第一子像素和第二子像素，所述第一子像素的发光元件发出的光的颜色和所述第二子像素的发光元件发出的光的颜色相同，所述第一子像素的发光元件的第一发光电压施加电极的形状和所述第二子像素的发光元件的第一发光电压施加电极的形状不相同，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影与所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠，所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影与所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的面积和所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的面积不相同。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影和所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的重叠部分的面积为第一面积，所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影和所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的重叠部分的面积为第二面积，所述第一面积和所述第二面积的比值满足以下关系式：
Amin≤A1/A2≤Amax，
其中，A1表示所述第一面积，A2表示所述第二面积，Amin表示最小比值阈值，且为90％，Amax表示最大比值阈值，且为110％。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影位于所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影内；所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影位于所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影内。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的发光元件的发光层在所述衬底基板上的正投影与所述第二子像素的发光元件的发光层在所述衬底基板上的正投影是连续的。
例如，在本公开一些实施例提供的显示基板中，所述像素电路还包括第一发光控制电路和第二发光控制电路，所述驱动电路包括控制端、第一端和第二端，且被配置为为所述发光元件提供驱动所述发光元件发光的驱动电流；所述第一发光控制电路与所述驱动电路的第一端和第一电压端连接，且被配置为实现所述驱动电路和所述第一电压端之间的连接导通或断开，所述第二发光控制电路与所述驱动电路的第二端和所述发光元件的第一发光电压施加电极电连接，且被配置为实现所述驱动电路和所述发光元件之间的连接导通或断开。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的像素电路还包括第一寄生电路，所述第二子像素的像素电路还包括第二寄生电路，所述第一寄生电路与所述第一子像素的像素电路的驱动电路的控制端和所述第一子像素的发光元件的第一发光电压施加电极电连接，且被配置为基于所述第一子像素的发光元件的第一发光电压施加电极的电压控制所述第一子像素的像素电路的驱动电路的控制端的电压，所述第二寄生电路与所述第二子像素的像素电路的驱动电路的控制端和所述第二子像素的发光元件的第一发光电压施加电极电连接，且被配置为基于所述第二子像素的发光元件的第一发光电压施加电极的电压控制所述第二子像素的像素电路的驱动电路的控制端的电压。
例如，在本公开一些实施例提供的显示基板中，所述第一寄生电路包括第一电容，所述第一电容包括第一极和第二极，所述第一子像素的发光元件的第一发光电压施加电极包括辅助电极块，所述辅助电极块在所述衬底基板上的正投影与所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠，所述辅助电极块作为所述第一电容的第一极，所述第一子像素的驱动电路的控制端复用为所述第一电容的第二极。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的发光元件的第一发光电压施加电极还包括第一驱动电极块，所述第一驱动电极块和所述辅助电极块电连接，所述第一驱动电极块在所述衬底基板上的正投影、所述第一子像素的发光元件的发光层在所述衬底基板上的正投影和所述第一子像素的发光元件的第二发光电压施加电极在所述衬底基板上的正投影至少部分重叠。
例如，在本公开一些实施例提供的显示基板中，所述第二寄生电路包括第二电容，所述第二电容包括第一极和第二极，所述第二子像素的发光元件的第一发光电压施加电极包括第二驱动电极块，所述第二驱动电极块在所述衬底基板上的正投影与所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠，所述第二驱动电极块在所述衬底基板上的正投影、所述第二子像素的发光元件的发光层在所述衬底基板上的正投影和所述第二子像素的发光元件的第二发光电压施加电极在所述衬底基板上的正投影至少部分重叠，所述第二驱动电极块复用为所述第二电容的第一极，所述第二子像素的驱动电路的控制端复用为所述第二电容的第二极。
例如，在本公开一些实施例提供的显示基板中，所述第一驱动电极块的形状与所述第二驱动电极块的形状相同，所述第一驱动电极块在所述衬底基板上的正投影的面积与所述第二驱动电极块在所述衬底基板上的正投影的面积相同。
例如，在本公开一些实施例提供的显示基板中，在所述每个重复单元中，所述第一子像素和所述第二子像素沿第一方向排列，所述第一方向平行于所述衬底基板的表面，在所述第一方向上，所述辅助电极块位于所述第一驱动电极块的远离所述第二子像素的发光元件的一侧。
例如，在本公开一些实施例提供的显示基板中，所述辅助电极块在所述衬底基板上的正投影与所述第一子像素的发光元件的发光层在所述衬底基板上的正投影不重叠。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的发光元件的第一发光电压施加电极还包括第一连接电极块，在所述第一方向上，所述第一连接电极块位于所述第一驱动电极块的远离所述第二子像素的发光元件的一侧，所述第一连接电极块位于所述辅助电极块和所述第一驱动电极块之间，且与所述辅助电极块和所述第一驱动电极块均电连接。
例如，本公开一些实施例提供的显示基板还包括中间层，在垂直于所述衬底基板的表面的方向上，所述像素电路位于所述中间层和所述衬底基板之间，所述发光元件位于所述中间层的远离所述衬底基板的一侧，所述中间层包括第一过孔，所述第一连接电极块延伸至所述第一过孔且通过所述第一过孔与所述第一子像素的像素电路电连接。
例如，在本公开一些实施例提供的显示基板中，所述第二子像素的发光元件的第一发光电压施加电极还包括第二连接电极块，所述第二连接电极块与所述第二驱动电极块电连接，在所述第一方向上，所述第二连接电极块位于所述第二驱动电极块的远离所述第一子像素的发光元件的一侧。
例如，在本公开一些实施例提供的显示基板中，所述中间层包括第二过孔，所述第二连接电极块延伸至所述第二过孔且通过所述第二过孔与所述第二子像素的像素电路电连接。
例如，在本公开一些实施例提供的显示基板中，所述第一连接电极块通过所述第一过孔与所述第一子像素的像素电路的第二发光控制电路电连接，所述第二连接电极块通过所述第二过孔与所述第二子像素的像素电路的第二发光控制电路电连接。
例如，在本公开一些实施例提供的显示基板中，所述像素电路包括有源半导体层、栅极金属层和源漏极金属层，在垂直于所述衬底基板的方向上，所述有源半导体层位于所述衬底基板与所述栅极金属层之间，所述栅极金属层位于所述有源半导体层和所述源漏极金属层之间，所述第一连接电极块通过所述第一过孔延伸到所述像素电路的源漏极金属层，所述第二连接电极块通过所述第二过孔延伸到所述像素电路的源漏极金属层。
例如，在本公开一些实施例提供的显示基板中，所述多个子像素还包括第三子像素和第四子像素，在所述每个重复单元中，所述第三子像素和所述第四子像素沿第二方向排列，且在所述第二方向上，所述第一子像素和所述第二子像素位于所述第三子像素和所述第四子像素之间，所述第二方向平行于所述衬底基板的表面，且所述第一方向和所述第二方向相互垂直。
例如，在本公开一些实施例提供的显示基板中，所述第三子像素的发光元件的第一发光电压施加电极包括彼此电连接的第三驱动电极块和第三连接电极块，所述第四子像素的发光元件的第一发光电压施加电极包括彼此电连接的第四驱动电极块和第四连接电极块，所述中间层包括第三过孔和第四过孔，所述第三连接电极块延伸至所述第三过孔且通过所述第三过孔与所述第三子像素的像素电路电连接，所述第四连接电极块延伸至所述第四过孔且通过所述第四过孔与所述第四子像素的像素电路电连接。
例如，在本公开一些实施例提供的显示基板中，在所述每个重复单元中，在所述第一方向上，所述第三连接电极位于所述第三驱动电极块的远离所述辅助电极块的一侧，在所述第二方向上，所述第三连接电极位于所述第三驱动电极块的靠近所述第四驱动电极块的一侧，在所述第一方向上，所述第四连接电极位于所述第四驱动电极块的远离所述辅助电极块的一侧，在所述第二方向上，所述第四连接电极位于所述第四驱动电极块的靠近所述第三驱动电极块的一侧。
例如，在本公开一些实施例提供的显示基板中，所述第三连接电极块通过所述第三过孔与所述第三子像素的像素电路的第二发光控制电路电连接，所述第四连接电极块通过所述第四过孔与所述第四子像素的像素电路的第二发光控制电路电连接。
例如，在本公开一些实施例提供的显示基板中，所述多个重复单元沿第二方向排列以形成多个重复单元组，所述多个重复单元组沿所述第一方向排列，在所述第一方向上，所述第一连接电极块、所述第二连接电极块、所述第三连接电极块和所述第四连接电极块位于相邻两个重复单元组之间，在所述第一方向上，所述辅助电极块的至少一部分位于在所述辅助电极块远离所述第一驱动电极块的一侧且与所述辅助电极块所在的重复单元组相邻的重复单元组中的相邻两个重复单元之间。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素和所述第二子像素均为绿色子像素，所述第三子像素为红色子像素，所述第四子像素为蓝色子像素。
例如，在本公开一些实施例提供的显示基板中，所述像素电路还包括数据写入电路、存储电路、阈值补偿电路和复位电路，所述数据写入电路与所述驱动电路的第一端电连接，且被配置为在扫描信号的控制下将数据信号写入所述存储电路；所述存储电路与所述驱动电路的控制端和所述第一电压端电连接，且被配置为存储所述数据信号；所述阈值补偿电路与所述驱动电路的控制端和第二端电连接，且被配置为对所述驱动电路进行阈值补偿；所述复位电路与所述驱动电路的控制端和所述发光元件的第一发光电压施加电极电连接，且配置为在复位控制信号的控制下对所述驱动电路的控制端和所述发光元件的第一发光电压施加电极进行复位。
例如，在本公开一些实施例提供的显示基板中，所述驱动电路包括驱动晶体管，所述驱动电路的控制端包括所述驱动晶体管的栅极，所述驱动电路的第一端包括所述驱动晶体管的第一极，所述驱动电路的第二端包括所述驱动晶体管的第二极，所述数据写入电路包括数据写入晶体管，所述存储电路包括第三电容，所述阈值补偿电路包括阈值补偿晶体管，所述复位电路包括第一复位晶体管和第二复位晶体管，所述第一发光控制电路包括第一发光控制晶体管，所述第二发光控制电路包括第二发光控制晶体管，所述复位控制信号包括第一子复位控制信号和第二子复位控制信号，所述数据写入晶体管的第一极与所述驱动晶体管的第一极电连接，所述数据写入晶体管的第二极被配置为接收所述数据信号，所述数据写入晶体管的栅极被配置为接收所述扫描信号；所述第三电容的第一极与所述第一电源端电连接，所述第三电容的第二极与所述驱动晶体管的栅极电连接；所述阈值补偿晶体管的第一极与所述驱动晶体管的第二极电连接，所述阈值补偿晶体管的第二极与所述驱动晶体管的栅极电连接，所述阈值补偿晶体管的栅极被配置为接收补偿控制信号；所述第一复位晶体管的第一极被配置为接收第一复位信号，所述第一复位晶体管的第二极与所述驱动晶体管的栅极电连接，所述第一复位晶体管的栅极被配置为接收所述第一子复位控制信号；所述第二复位晶体管的第一极被配置为接收第二复位信号，所述第二复位晶体管的第二极与所述发光元件的第一发光电压施加电极电连接，所述第二复位晶体管的栅极被配置为接收所述第二子复位控制信号；所述第一发光控制晶体管的第一极与所述第一电源端电连接，所述第一发光控制晶体管的第二极与所述驱动晶体管的第一极电连接，所述第一发光控制晶体管的栅极被配置为接收第一发光控制信号，所述第二发光控制晶体管的第一极与所述驱动晶体管的第二极电连接，所述第二发光控制晶体管的第二极与所述发光元件的第一发光电压施加电极电连接，所述第二发光控制晶体管的栅极被配置为接收第二发光控制信号。
本公开一些实施例还提供一种显示面板，包括根据上述任一项所述的显示基板。
本公开一些实施例还提供一种显示装置，包括根据上述任一项所述的显示面板。
例如，本公开一些实施例提供的显示装置还包括：驱动芯片，所述驱动芯片与所述显示面板电连接，且所述驱动芯片位于每个所述重复单元中的第一子像素的远离第二子像素的一侧。
例如，在本公开一些实施例提供的显示装置中，在每个所述重复单元中，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的面积大于所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的面积。
本公开一些实施例还提供一种用于制备根据上述任一项所述的显示基板的制备方法，包括：提供所述衬底基板，在所述衬底基板上形成所述多个重复单元，其中，每个所述重复单元包括多个子像素，每个所述子像素包括像素电路和发光元件，所述发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在所述第一发光电压施加电极和所述第二发光电压施加电极之间的发光层，所述多个子像素包括第一子像素和第二子像素，所述第一子像素的发光元件发出的光的颜色和所述第二子像素的发光元件发出的光的颜色相同，所述第一子像素的发光元件的第一发光电压施加电极的形状和所述第二子像素的发光元件的第一发光电压施加电极的形状不相同，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影与所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠，所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影与所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠。
本公开一些实施例还提供一种显示基板，包括衬底基板和设置在所述衬底基板上的多个重复单元，每个所述重复单元包括多个子像素，每个所述子像素包括发光元件和驱动所述发光元件发光的像素电路，所述像素电路包括驱动电路，所述发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在所述第一发光电压施加电极和所述第二发光电压施加电极之间的发光层，所述多个子像素的驱动电路在所述衬底基板上阵列排布，所述多个子像素包括第一子像素和第二子像素，所述第一子像素的发光元件发出的光的颜色和所述第二子像素的发光元件发出的光的颜色相同，所述第一子像素的发光元件的第一发光电压施加电极包括辅助电极块、第一驱动电极块和第一连接电极块，所述第一驱动电极块、所述辅助电极块和所述第一连接电极块彼此电连接，所述第二子像素的发光元件的第一发光电压施加电极包括第二驱动电极块和第二连接电极块，所述第二驱动电极块和所述第二连接电极块电连接，所述辅助电极块位于所述第一子像素的像素电路的驱动电路的控制端的远离所述衬底基板的一侧，所述第二驱动电极块位于所述第二子像素的像素电路的驱动电路的控制端的远离所述衬底基板的一侧。
例如，在本公开一些实施例提供的显示基板中，所述第一驱动电极块的形状和所述辅助电极块的形状不相同，所述第一驱动电极块的形状与所述第二驱动电极块的形状相同，所述第一驱动电极块在所述衬底基板上的正投影的面积与所述第二驱动电极块在所述衬底基板上的正投影的面积相同。
例如，在本公开一些实施例提供的显示基板中，所述第一连接电极块的形状与所述第二连接电极块的形状相同，所述第一连接电极块在所述衬底基板上的正投影的面积与所述第二连接电极块在所述衬底基板上的正投影的面积相同。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的像素电路的驱动电路的控制端和所述第二子像素的像素电路的驱动电路的控制端沿第一方向排布，在所述第一方向上，所述第一驱动电极块位于所述第一子像素的像素电路的驱动电路的控制端靠近所述第二子像素的像素电路的驱动电路的控制端的一侧。
例如，在本公开一些实施例提供的显示基板中，在所述第一方向上，所述第一驱动电极块位于所述第一子像素的像素电路的驱动电路的控制端和所述第二子像素的像素电路的驱动电路的控制端之间。
例如，在本公开一些实施例提供的显示基板中，在所述第一方向上，所述第一连接电极块位于所述第一驱动电极块的远离所述第二子像素的像素电路的驱动电路的控制端的一侧。
例如，在本公开一些实施例提供的显示基板中，在所述第一方向上，所述第一连接电极块位于所述第一子像素的像素电路的驱动电路的控制端和所述第二子像素的像素电路的驱动电路的控制端之间。
例如，在本公开一些实施例提供的显示基板中，在所述第一方向上，所述第一连接电极块位于所述第一驱动电极块和所述辅助电极块之间。
例如，在本公开一些实施例提供的显示基板中，在所述第一方向上，所述第二连接电极块位于所述第二子像素的像素电路的驱动电路的控制端的远离所述第一子像素的像素电路的驱动电路的控制端的一侧，所述第二驱动电极块位于所述第二连接电极块和所述第一驱动电极块之间。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的像素电路的驱动电路的控制端的中心和所述第一驱动电极块的中心之间的距离大于所述第二子像素的像素电路的驱动电路的控制端的中心和所述第二驱动电极块的中心之间的距离。
本公开一些实施例还提供一种显示基板，包括衬底基板和设置在所述衬底基板上的多个重复单元，每个所述重复单元包括多个子像素，每个所述子像素包括发光元件和驱动所述发光元件发光的像素电路，所述发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在所述第一发光电压施加电极和所述第二发光电压施加电极之间的发光层，所述像素电路包括驱动电路、第二发光控制电路和复位电路，所述第二发光控制电路电连接至第二发光控制信号线、所述驱动电路的第二端、所述发光元件的第一发光电压施加电极，且被配置为在所述第二发光控制信号线提供的第二发光控制信号的控制下实现所述驱动电路和所述发光元件之间的连接导通或断开，所述复位电路电连接至所述驱动电路的控制端和第一复位控制信号线，且配置为在所述第一复位控制信号线提供的第一子复位控制信号的控制下对所述驱动电路的控制端进行复位，所述第二发光控制信号线和所述第一复位控制信号线沿第一方向排布，所述多个子像素包括第一子像素和第二子像素，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影和与所述第二子像素的像素电路的复位电路连接的第一复位控制信号线在所述衬底基板上的正投影、与所述第一子像素的像素电路的第二发光控制电路连接的第二发光控制信号线在所述衬底基板上的正投影均至少部分重叠，所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影和与所述第二子像素的像素电路的第二发光控制电路连接的第二发光控制信号线在所述衬底基板上的正投影至少部分重叠。
例如，在本公开一些实施例提供的显示基板中，所述像素电路还包括数据写入电路，所述数据写入电路电连接至所述驱动电路的第一端和第一扫描信号线，且被配置为在所述第一扫描信号线提供的扫描信号的控制下将数据信号写入所述驱动电路的控制端，在所述第一方向上，所述第一扫描信号线位于所述第二发光控制信号线和所述第一复位控制信号线之间，所述第一子像素的发光元件的第一发光电压施加电极和所述第二子像素的发光元件的第一发光电压施加电极沿所述第一方向排布，在所述第一方向上，与所述第二子像素的像素电路的数据写入电路连接的第一扫描信号线位于所述第一子像素的发光元件的第一发光电压施加电极和所述第二子像素的发光元件的第一发光电压施加电极之间。
例如，在本公开一些实施例提供的显示基板中，所述复位电路还与第一复位电源信号线电连接，所述复位电路配置为在所述第一复位控制信号线提供的第一子复位控制信号的控制下根据所述第一复位电源信号线提供的第一复位信号对所述驱动电路的控制端进行复位，在所述第一方向上，所述第一复位电源信号线位于所述第一复位控制信号线的远离所述第二发光控制信号线的一侧，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影还和与所述第二子像素的像素电路的复位电路连接的第一复位电源信号线在所述衬底基板上的正投影至少部分重叠。
例如，在本公开一些实施例提供的显示基板中，所述第二发光控制信号线、所述第一复位控制信号线、所述第一扫描信号线和所述第一复位电源信号线均沿第二方向延伸，所述第二方向与所述第一方向相互垂直。
例如，在本公开一些实施例提供的显示基板中，所述第二发光控制信号线、所述第一复位控制信号线、所述第一扫描信号线和所述第一复位电源信号线彼此平行。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的发光元件的第一发光电压施加电极包括辅助电极块、第一驱动电极块和第一连接电极块，所述第一驱动电极块、所述辅助电极块和所述第一连接电极块彼此电连接，且沿所述第一方向排布，所述第二子像素的发光元件的第一发光电压施加电极包括第二驱动电极块和第二连接电极块，所述第二驱动电极块和所述第二连接电极块电连接，且沿所述第一方向排布，在所述第一方向上，所述第一连接电极块和所述辅助电极块均位于所述第一驱动电极块的远离所述第二驱动电极块的一侧，所述第一连接电极块位于所述辅助电极块和所述第一驱动电极块之间，所述第二连接电极块位于所述第二驱动电极块的远离所述第一驱动电极块的一侧，所述第一驱动电极块在所述衬底基板上的正投影和与所述第二子像素的像素电路的复位电路连接的第一复位控制信号线在所述衬底基板上的正投影、与所述第二子像素的像素电路的复位电路连接的第一复位电源信号线在所述衬底基板上的正投影均至少部分重叠，所述第一连接电极块在所述衬底基板上的正投影和与所述第一子像素的像素电路的第二发光控制电路连接的第二发光控制信号线在所述衬底基板上的正投影至少部分重叠，在所述第一方向上，所述辅助电极块位于与所述第一子像素的像素电路的第二发光控制电路连接的第二发光控制信号线的远离所述第二子像素的发光元件的第一发光电压施加电极的一侧，所述第二连接电极块在所述衬底基板上的正投影和与所述第二子像素的像素电路的第二发光控制电路连接的第二发光控制信号线在所述衬底基板上的正投影至少部分重叠，在所述第一方向上，所述第二驱动电极块位于与所述第二子像素的像素电路的第二发光控制电路连接的第二发光控制信号线和与所述第二子像素的像素电路的数据写入电路连接的第一扫描信号线之间。
例如，在本公开一些实施例提供的显示基板中，所述第一子像素的发光元件发出的光的颜色和所述第二子像素的发光元件发出的光的颜色相同，所述第一子像素的发光元件的第一发光电压施加电极的形状和所述第二子像素的发光元件的第一发光电压施加电极的形状不相同。
附图说明
为了更清楚地说明本公开实施例的技术方案，下面将对实施例的附图作简单地介绍，显而易见地，下面描述中的附图仅仅涉及本公开的一些实施例，而非对本公开的限制。
图1为一种像素排列结构中的像素重复单元的结构示意图；
图2为本公开一些实施例提供的一种显示基板的示意性框图；
图3A为本公开一些实施例提供的一种像素电路的结构示意图；
图3B为本公开一些实施例提供的一种第一子像素的像素电路的结构示意图；
图3C为本公开一些实施例提供的一种第二子像素的像素电路的结构示意图；
图4A-4E为本公开一些实施例提供的一种像素电路的各层的示意图；
图5A为本公开一些实施例提供的一种显示基板的平面示意图；
图5B为本公开一些实施例提供的一种重复单元的平面示意图；
图6A为本公开一些实施例提供的另一种重复单元的平面示意图；
图6B为本公开一些实施例提供的一种显示基板的布局图；
图6C为图6B中线L1-L1'的截面结构示意图；
图6D为图6B中线L2-L2'的截面结构示意图；
图6E为本公开一些实施例提供的又一种显示基板的平面示意图；
图7为本公开一些实施例提供的一种显示面板的局部结构示意图；
图8A为本公开一些实施例提供的一种显示装置的示意性框图；
图8B为本公开一些实施例提供的一种显示装置的结构示意图；
图9为本公开一实施例提供的一种显示基板的制备方法的示意性流程图。
具体实施方式
为了使得本公开实施例的目的、技术方案和优点更加清楚，下面将结合本公开实施例的附图，对本公开实施例的技术方案进行清楚、完整地描述。显然，所描述的实施例是本公开的一部分实施例，而不是全部的实施例。基于所描述的本公开的实施例，本领域普通技术人员在无需创造性劳动的前提下所获得的所有其他实施例，都属于本公开保护的范围。
除非另外定义，本公开使用的技术术语或者科学术语应当为本公开所属领域内具有一般技能的人士所理解的通常意义。本公开中使用的“第一”、“第二”以及类似的词语并不表示任何顺序、数量或者重要性，而只是用来区分不同的组成部分。“包括”或者“包含”等类似的词语意指出现该词前面的元件或者物件涵盖出现在该词后面列举的元件或者物件及其等同，而不排除其他元件或者物件。“连接”或者“相连”等类似的词语并非限定于物理的或者机械的连接，而是可以包括电性的连接，不管是直接的还是间接的。“上”、“下”、“左”、“右”等仅用于表示相对位置关系，当被描述对象的绝对位置改变后，则该相对位置关系也可能相应地改变。
为了保持本公开实施例的以下说明清楚且简明，本公开省略了部分已知功能和已知部件的详细说明。
图1为一种像素排列结构中的像素重复单元的结构示意图，如图1所示，一种像素排列结构包括多个像素重复单元400，多个像素重复单元400沿方向405和方向406阵列排布。每个像素重复单元400包括红色子像素401、蓝色子像素402、第一绿色子像素403和第二绿色子像素404。如图1所示，红色子像素401和蓝色子像素402沿405方向排列，第一绿色子像素403和第二绿色子像素404沿方向406排列，且在方向405上，第一绿色子像素403和第二绿色子像素404位于红色子像素401和蓝色子像素402之间。
在对图1所示的像素排列结构中的各个子像素进行点灯检测的过程中，由于第一绿色子像素403和第二绿色子像素404的亮度不一致，从而导致亮点漏检的问题，即部分绿色子像素无法被检测到。根据实验结果可知，第一绿色子像素403的亮度比第二绿色子像素404的亮度高，从而出现第一绿色子像素403发亮，而第二绿色子像素404发暗的现象。
每个子像素中，发光元件的阳极和驱动晶体管的栅极之间存在寄生电容，该寄生电容会影响发光元件的发光亮度，且寄生电容越大，发光亮度越弱；寄生电容越小，发光亮度越强。通过对像素排列结构进行分析可知，在该像素排列结构中，用于驱动第一绿色子像素403的像素电路中的驱动晶体管的栅极未被第一绿色子像素403的发光元件中的阳极遮挡，而用于驱动第二绿色子像素404的像素电路中的驱动晶体管的栅极被第二绿色子像素404的发光元件中的阳极遮挡。由此，第一绿色子像素403的驱动晶体管的栅极和发光元件之间不存在寄生电容，或者第一绿色子像素403的驱动晶体管的栅极和发光元件之间的寄生电容小于第二绿色子像素404的驱动晶体管的栅极和发光元件之间的寄生电容，即第一绿色子像素403的驱动晶体管的栅极和发光元件之间的寄生电容和第二绿色子像素404的驱动晶体管的栅极和发光元件之间的寄生电容存在较大的差异，从而导致每个重复单元中的第一绿色子像素403和第二绿色子像素404的亮度差异，严重影响显示效果。
本公开至少一些实施例提供一种显示基板及其制备方法、显示面板、显示装置，在该显示基板中，第一子像素的发光元件覆盖第一子像素的驱动晶体管的栅极，第二子像素的发光元件也覆盖第二子像素的驱动晶体管的栅极，从而减小第一子像素的发光元件和驱动晶体管的栅极之间的寄生电容和第二子像素的发光元件和驱动晶体管的栅极之间的寄生电容的差异，使第一子像素和第二子像素的像素亮度均达到一致，从而提高显示均匀性和显示效果，解决显示面板的像素亮度差异的问题。另外，该显示基板结构简单，易于设计制造，成本较低。
下面结合附图对本公开的几个实施例进行详细说明，但是本公开并不限于这些具体的实施例。
图2为本公开一些实施例提供的一种显示基板的示意性框图，图3A为本公开一些实施例提供的一种显示基板的平面示意图，图3A为本公开一些实施例提供的一种像素电路的结构示意图，图3B为本公开一些实施例提供的一种第一子像素的像素电路的结构示意图，图3C为本公开一些实施例提供的一种第二子像素的像素电路的结构示意图。
例如，如图2所示，本公开的实施例提供的显示基板100包括衬底基板10和设置在衬底基板10上的多个重复单元11，每个重复单元11包括多个子像素12。每个子像素12包括发光元件120和像素电路121，像素电路121用于驱动发光元件120发光，像素电路121包括驱动电路122。
例如，显示基板100可以应用于显示面板，例如有源矩阵有机发光二极管(AMOLED)显示面板等。显示基板100可以为阵列基板。
例如，衬底基板10可以为玻璃基板、石英基板、塑料基板等合适的基板。
例如，每个子像素12的发光元件120包括第一发光电压施加电极、第二发光电压施加电极和设置在第一发光电压施加电极和第二发光电压施加电极之间的发光层。
例如，多个子像素12包括第一子像素G1和第二子像素G2。
例如，如图3A所示，像素电路121还包括第一发光控制电路123和第二发光控制电路124。驱动电路122包括控制端、第一端和第二端，且被配置为为发光元件120提供驱动发光元件120发光的驱动电流。例如，第一发光控制电路123与驱动电路122的第一端和第一电压端VDD连接，且被配置为实现驱动电路122和第一电压端VDD之间的连接导通或断开，第二发光控制电路124与驱动电路122的第二端和发光元件120的第一发光电压施加电极电连接，且被配置为实现驱动电路122和发光元件120之间的连接导通或断开。
例如，如图3B和图3C所示，第一子像素G1的像素电路121a还包括第一寄生电路125a，第二子像素G2的像素电路121b还包括第二寄生电路125b。例如，第一寄生电路125a与第一子像素G1的像素电路121a的驱动电路122a的控制端和第一子像素G1的发光元件120a的第一发光电压施加电极电连接，且被配置为基于第一子像素G1的发光元件120a的第一发光电压施加电极的电压控制第一子像素G1的像素电路121a的驱动电路122a的控制端的电压。第二寄生电路125b与第二子像素G2的像素电路121b的驱动电路的控制端和第二子像素G2的发光元件120b的第一发光电压施加电极电连接，且被配置为基于第二子像素G2的发光元件120b的第一发光电压施加电极的电压控制第二子像素G2的像素电路121b的驱动电路122b的控制端的电压。
需要说明的是，像素电路121还可以包括寄生电路，而图3A中未示出该寄生电路，例如，图3A未示出了第一子像素G1的像素电路中的第一寄生电路和第二子像素G2的像素电路中的第二寄生电路。
例如，如图3A所示，像素电路121还包括数据写入电路126、存储电路127、阈值补偿电路128和复位电路129。数据写入电路126与驱动电路122的第一端电连接，且被配置为在扫描信号的控制下将数据信号写入存储电路127；存储电路127与驱动电路122的控制端和第一电压端VDD电连接，且被配置为存储数据信号；阈值补偿电路128与驱动电路122的控制端和第二端电连接，且被配置为对驱动电路122进行阈值补偿；复位电路129与驱动电路122的控制端和发光元件120的第一发光电压施加电极电连接，且配置为在复位控制信号的控制下对驱动电路122的控制端和发光元件120的第一发光电压施加电极进行复位。
例如，如图3A所示，驱动电路122包括驱动晶体管T1，驱动电路122的控制端包括驱动晶体管T1的栅极，驱动电路122的第一端包括驱动晶体管T1的第一极，驱动电路122的第二端包括驱动晶体管T1的第二极。
例如，如图3A所示，数据写入电路126包括数据写入晶体管T2，存储电路127包括第三电容C2，阈值补偿电路128包括阈值补偿晶体管T3，第一发光控制电路123包括第一发光控制晶体管T4，第二发光控制电路124包括第二发光控制晶体管T5，复位电路129包括第一复位晶体管T6和第二复位晶体管T7，复位控制信号可以包括第一子复位控制信号和第二子复位控制信号。
例如，如图3A所示，数据写入晶体管T2的第一极与驱动晶体管T1的第一极电连接，数据写入晶体管T2的第二极被配置为与数据线Vd电连接以接收数据信号，数据写入晶体管T2的栅极被配置为与第一扫描信号线Ga1电连接以接收扫描信号；第三电容C2的第一极与第一电源端VDD电连接，第三电容C2的第二极与驱动晶体管T1的栅极电连接；阈值补偿晶体管T3的第一极与驱动晶体管T1的第二极电连接，阈值补偿晶体管T3的第二极与驱动晶体管T1的栅极电连接，阈值补偿晶体管T3的栅极被配置为与第二扫描信号线Ga2电连接以接收补偿控制信号；第一复位晶体管T6的第一极被配置为与第一复位电源端Vinit1电连接以接收第一复位信号，第一复位晶体管T6的第二极与驱动晶体管T1的栅极电连接，第一复位晶体管T6的栅极被配置为与第一复位控制信号线Rst1电连接以接收第一子复位控制信号；第二复位晶体管T7的第一极被配置为与第二复位电源端Vinit2电连接以接收第二复位信号，第二复位晶体管T7的第二极与发光元件120的第一发光电压施加电极电连接，第二复位晶体管T7的栅极被配置为与第二复位控制信号线Rst2电连接以接收第二子复位控制信号；第一发光控制晶体管T4的第一极与第一电源端VDD电连接，第一发光控制晶体管T4的第二极与驱动晶体管T1的第一极电连接，第一发光控制晶体管T4的栅极被配置为与第一发光控制信号线EM1电连接以接收第一发光控制信号；第二发光控制晶体管T5的第一极与驱动晶体管T1的第二极电连接，第二发光控制晶体管T5的第二极与发光元件120的第一发光电压施加电极电连接，第二发光控制晶体管T5的栅极被配置为与第二发光控制信号线EM2电连接以接收第二发光控制信号；发光元件120的第二发光电压施加电极与第二电源端VSS电连接。
例如，如图3B所示，对于第一子像素G1，第一寄生电路125a包括第一电容C11，第一电容C11包括第一极CC3a和第二极CC4a。第一电容C11的第一极CC3a与第一子像素G1的发光元件120a的第一发光电压施加电极电连接，第一电容C11的第二极CC4a与第一子像素G1的像素电路121a的驱动晶体管T1的栅极电连接。
例如，如图3C所示，对于第二子像素G2，第二寄生电路125b包括第二电容C12，第二电容C12包括第一极和第二极。第二电容C12的第一极与第二子像素G2的发光元件120b的第一发光电压施加电极电连接，第二电容C12的第二极与第二子像素G2的像素电路121b的驱动晶体管T1的栅极电连接。
例如，第一电容C11的电容值和第二电容C12的电容值可以相同，从而可以使第一子像素G1和第二子像素G2的像素亮度均达到一致，提高显示均匀性和显示效果。
例如，第一电源端VDD和第二电源端VSS之一为高压端，另一个为低压端。例如，如图3A所示的实施例中，第一电源端VDD为电压源以输出恒定的第一电压，第一电压为正电压；而第二电源端VSS可以为电压源以输出恒定的第二电压，第二电压为负电压等。例如，在一些示例中，第二电源端VSS可以接地。
例如，对于第一子像素G1，如图3B所示，第一子像素G1的像素电路121a还包括数据写入电路126a、存储电路127a、阈值补偿电路128a和复位电路129a；对于第二子像素G2，如图3C所示，第二子像素G2的像素电路121b还包括数据写入电路126b、存储电路127b、阈值补偿电路128b和复位电路129b。第一子像素G1的像素电路121a和第二子像素G2的像素电路121b中的各个电路中的各个元件的连接关系以及作用等均与上面对图3A描述的示例相类似，重复之处在此不再赘述。
例如，如图3A所示，扫描信号和补偿控制信号可以相同，即，数据写入晶体管T2的栅极和阈值补偿晶体管T3的栅极可以电连接到同一条信号线，例如第一扫描信号线Ga1，以接收相同的信号(例如，扫描信号)，此时，显示基板100可以不设置第二扫描信号线Ga2，减少信号线的数量。又例如，数据写入晶体管T2的栅极和阈值补偿晶体管T3的栅极也可以分别电连接至不同的信号线，即数据写入晶体管T2的栅极电连接到第一扫描信号线Ga1，阈值补偿晶体管T3的栅极电连接到第二扫描信号线Ga2，而第一扫描信号线Ga1和第二扫描信号线Ga2传输的信号相同。
需要说明的是，扫描信号和补偿控制信号也可以不相同，从而使得数据写入晶体管T2的栅极和阈值补偿晶体管T3可以被分开单独控制，增加控制像素电路的灵活性。
例如，如图3A-3B所示，第一发光控制信号和第二发光控制信号可以相同，即，第一发光控制晶体管T4的栅极和第二发光控制晶体管T5的栅极可以电连接到同一条信号线，例如第一发光控制信号线EM1，以接收相同的信号(例如，第一发光控制信号)，此时，显示基板100可以不设置第二发光控制信号线EM2，减少信号线的数量。又例如，第一发光控制晶体管T4的栅极和第二发光控制晶体管T5的栅极也可以分别电连接至不同的信号线，即，第一发光控制晶体管T4的栅极电连接到第一发光控制信号线EM1，第二发光控制晶体管T5的栅极电连接到第二发光控制信号线EM2，而第一发光控制信号线EM1和第二发光控制信号线EM2传输的信号相同。
需要说明的是，当第一发光控制晶体管T4和第二发光控制晶体管T5为不同类型的晶体管，例如，第一发光控制晶体管T4为P型晶体管，而第二发光控制晶体管T5为N型晶体管时，第一发光控制信号和第二发光控制信号也可以不相同，本公开的实施例对此不作限制。
例如，第一子复位控制信号和第二子复位控制信号可以相同，即，第一复位晶体管T6的栅极和第二复位晶体管T7的栅极可以电连接到同一条信号线，例如第一复位控制信号线Rst1，以接收相同的信号(例如，第一子复位控制信号)，此时，显示基板100可以不设置第二复位控制信号线Rst2，减少信号线的数量。又例如，第一复位晶体管T6的栅极和第二复位晶体管T7的栅极也可以分别电连接至不同的信号线，即第一复位晶体管T6的栅极电连接到第一复位控制信号线Rst1，第二复位晶体管T7的栅极电连接到第二复位控制信号线Rst2，而第一复位控制信号线Rst1和第二复位控制信号线Rst2传输的信号相同。需要说明的是，第一子复位控制信号和第二子复位控制信号也可以不相同。
例如，在一些示例中，第二子复位控制信号可以与扫描信号相同，即第二复位晶体管T7的栅极可以电连接到第一扫描信号线Ga1以接收扫描信号作为第二子复位控制信号。
例如，第一复位电源端Vinit1和第二复位电源端Vinit2可以为直流参考电压端，以输出恒定的直流参考电压。第一复位电源端Vinit1和第二复位电源端Vinit2可以为高压端，也可以为低压端，只要其能够提供第一复位信号和第二复位信号以对驱动晶体管T1的栅极和发光元件120的第一发光电压施加电极进行复位即可，本公开对此不作限制。
需要说明的是，图3A-3B所示的像素电路中的驱动电路122、数据写入电路126、存储电路127、阈值补偿电路128和复位电路129仅为示意性的，驱动电路122、数据写入电路126、存储电路127、阈值补偿电路128和复位电路129等电路的具体结构可以根据实际应用需求进行设定，本公开的实施例对此不作具体限定。
例如，按照晶体管的特性，晶体管可以分为N型晶体管和P型晶体管，为了清楚起见，本公开的实施例以晶体管为P型晶体管(例如，P型MOS晶体管)为例详细阐述了本公开的技术方案，也就是说，在本公开的描述中，驱动晶体管T1、数据写入晶体管T2、阈值补偿晶体管T3、第一发光控制晶体管T4、第二发光控制晶体管T5、第一复位晶体管T6和第二复位晶体管T7等均可以为P型晶体管。然而本公开的实施例的晶体管不限于P型晶体管，本领域技术人员还可以根据实际需要利用N型晶体管(例如，N型MOS晶体管)实现本公开的实施例中的一个或多个晶体管的功能。
需要说明的是，本公开的实施例中采用的晶体管可以为薄膜晶体管或场效应晶体管或其他特性相同的开关器件，薄膜晶体管可以包括氧化物半导体薄膜晶体管、非晶硅薄膜晶体管或多晶硅薄膜晶体管等。晶体管的源极、漏极在结构上可以是对称的，所以其源极、漏极在物理结构上可以是没有区别的。在本公开的实施例中，为了区分晶体管，除作为控制极的栅极，直接描述了其中一极为第一极，另一极为第二极，所以本公开的实施例中全部或部分晶体管的第一极和第二极根据需要是可以互换的。
需要说明的是，除了设置位置以外，第一子像素G1的像素电路121a中的各个电路(例如，驱动电路122a、第一发光控制电路123a、第二发光控制电路124a、数据写入电路126a、存储电路127a、阈值补偿电路128a、复位电路129a等)的连接关系、结构和类型等分别与第二子像素G2的像素电路121b中的对应的各个电路(例如，驱动电路122b、第一发光控制电路123b、第二发光控制电路124b、数据写入电路126b、存储电路127b、阈值补偿电路128b、复位电路129b等)的连接关系、结构和类型等均相同，也就是说，例如，第一子像素G1的像素电路121a中的驱动电路122a的结构和类型等均与第二子像素G2的像素电路121b中的驱动电路122b的结构和类型等相同。且，第一子像素G1的像素电路121a中的各个电路与第二子像素G2的像素电路121b中的对应的各个电路可以采用同一工艺同时制备，例如，第一子像素G1的像素电路121a中的驱动电路122a与第二子像素G2的像素电路121b中的驱动电路122b采用同一构图工艺同时制备得到。
值得注意的是，如图3B所示，与第一子像素G1的像素电路121a中的各个电路电连接的各条信号线分别为第一扫描信号线Ga1a、第二扫描信号线Ga2a、第一复位控制信号线Rst1a、第二复位控制信号线Rst2a、第一复位电源端Vinit1a、第二复位电源端Vinit2a、第一发光控制信号线EM1a、第二发光控制信号线EM2a、数据线Vd。如图3C所示，与第二子像素G2的像素电路121b中的各个电路电连接的各条信号线分别为第一扫描信号线Ga1b、第二扫描信号线Ga2b、第一复位控制信号线Rst1b、第二复位控制信号线Rst2b、第一复位电源端Vinit1b、第二复位电源端Vinit2b、第一发光控制信号线EM1b、第二发光控制信号线EM2b、数据线Vd。
需要说明的是，在本公开实施例中，子像素的像素电路除了可以为图3A所示的7T2C(即七个晶体管、一个电容和一个寄生电容)的结构之外，还可以为包括其他数量的晶体管的结构，如6T2C结构或者9T2C结构，本公开实施例对此不作限定。
图4A-4E为本公开一些实施例提供的一种像素电路的各层的示意图。下面结合附图4A-4E描述像素电路中的各个电路在背板上的位置关系，图4A-4E所示的示例以第一子像素G1的像素电路121a为例。如图3B所示，该第一子像素G1的像素电路121a包括图3B所示的驱动晶体管T1、数据写入晶体管T2、阈值补偿晶体管T3、第一发光控制晶体管T4、第二发光控制晶体管T5、第一复位晶体管T6和第二复位晶体管T7、第一电容C11、第三电容C2，图4A-4E还示出了连接到第一子像素G1的像素电路121a的第一扫描信号线Ga1a、第二扫描信号线Ga2a、第一复位控制信号线Rst1a、第二复位控制信号线Rst2a、第一复位电源端Vinit1a的第一复位电源信号线Init1a、第二复位电源端Vinit2a的第二复位电源信号线Init2a、第一发光控制信号线EM1a、第二发光控制信号线EM2a、数据线Vd、第一电源端VDD的第一电源信号线VDD1、第二电源信号线VDD2，第一电源信号线VDD1和第二电源信号线VDD2彼此电连接。需要说明的是，在图4A至4E所示的示例中，第一扫描信号线Ga1a和第二扫描信号线Ga2a为同一条信号线，第一复位电源信号线Init1a和第二复位电源信号线Init2a为同一条信号线，第一复位控制信号线Rst1a和第二复位控制信号线Rst2a为同一条信号线，第一发光控制信号线EM1a和第二发光控制信号线EM2a为同一条信号线。
例如，图4A示出了该像素电路121a的有源半导体层310。有源半导体层310可采用半导体材料图案化形成。有源半导体层310可用于制作上述的驱动晶体管T1、数据写入晶体管T2、阈值补偿晶体管T3、第一发光控制晶体管T4、第二发光控制晶体管T5、第一复位晶体管T6和第二复位晶体管T7的有源层，各有源层可包括源极区域、漏极区域和源极区域和漏极区域之间的沟道区。例如，各晶体管的有源层一体设置。
例如，有源半导体层310可采用非晶硅、多晶硅、氧化物半导体材料等制作。需要说明的是，上述的源极区域和漏极区域可为掺杂有n型杂质或p型杂质的区域。
例如，像素电路121a的栅极金属层可以包括第一导电层和第二导电层。在上述的有源半导体层310上形成有栅极绝缘层(未示出)，用于保护上述的有源半导体层310。图4B示出了该像素电路121a的第一导电层320，第一导电层320设置在栅极绝缘层上，从而与有源半导体层310绝缘。第一导电层320可以包括第三电容C2的第二极CC2a、第一扫描信号线Ga1a、第二扫描信号线Ga2a、第一复位控制信号线Rst1a、第二复位控制信号线Rst2a、第一发光控制信号线EM1a、第二发光控制信号线EM2a、以及驱动晶体管T1、数据写入晶体管T2、阈值补偿晶体管T3、第一发光控制晶体管T4、第二发光控制晶体管T5、第一复位晶体管T6和第二复位晶体管T7的栅极。
例如，如图4B所示，数据写入晶体管T2的栅极可以为第一扫描信号线Ga1a与有源半导体层310交叠的部分，第一发光控制晶体管T4的栅极可以为第一发光控制信号线EM1a/第二发光控制信号线EM2a与有源半导体层310交叠的第一部分，第二发光控制晶体管T5的栅极可以为第一发光控制信号线EM1a/第二发光控制信号线EM2a与有源半导体层310交叠的第二部分，第一复位晶体管T6的栅极为第一复位控制信号线Rst1a/第二复位控制信号线Rst2a与有源半导体层310交叠的第一部分，第二复位晶体管T7的栅极为第一复位控制信号线Rst1a/第二复位控制信号线Rst2a与有源半导体层310交叠的第二部分，阈值补偿晶体管T3可为双栅结构的薄膜晶体管，阈值补偿晶体管T3的第一个栅极可为第二扫描信号线Ga2a与有源半导体层310交叠的部分，阈值补偿晶体管T3的第二个栅极可为从第二扫描信号线Ga2a突出的突出部与有源半导体层310交叠的部分；如图3B和4B所示，驱动晶体管T1的栅极可为第一电容C11的第二极CC4a和第三电容C2的第二极CC2a。
需要说明的是，图4A中的各虚线矩形框示出了第一导电层320与有源半导体层310交叠的各个部分。
例如，如图4B所示，第一扫描信号线Ga1a/第二扫描信号线Ga2a、第一复位控制信号线Rst1a/第二复位控制信号线Rst2a和第一发光控制信号线EM1a/第二发光控制信号线EM2a沿第一方向X排布。第一扫描信号线Ga1a/第二扫描信号线Ga2a位于第一复位控制信号线Rst1a/第二复位控制信号线Rst2a和第一发光控制信号线EM1a/第二发光控制信号线EM2a之间。
例如，在第一方向X上，第一电容C11的第二极CC4a(即第三电容C2的第二极CC2a)位于第一扫描信号线Ga1a/第二扫描信号线Ga2a和第一发光控制信号线EM1/a第二发光控制信号线EM2a之间。从第二扫描信号线Ga2a突出的突出部位于第二扫描信号线Ga2a的远离第一发光控制信号线EM1a/第二发光控制信号线EM2a的一侧。
例如，如图4A所示，在第一方向X上，数据写入晶体管T2的栅极、阈值补偿晶体管T3的栅极、第一复位晶体管T6的栅极和第二复位晶体管T7的栅极均位于驱动晶体管T1的栅极的第一侧，第一发光控制晶体管T4的栅极、第二发光控制晶体管T5的栅极均位于驱动晶体管T1的栅极的第二侧，例如，图6A-6E所示的示例中，第一子像素G1的像素电路121a的驱动晶体管T1的栅极的第一侧和第二侧为在第一方向X上驱动晶体管T1的栅极的彼此相对的两侧，例如，如图4A-4E所示，第一子像素G1的像素电路121a的驱动晶体管T1的栅极的第一侧可以为驱动晶体管T1的栅极的上侧，第一子像素G1的像素电路121a的驱动晶体管T1的栅极的第二侧可以为驱动晶体管T1的栅极的下侧。
例如，在一些实施例中，如图4A-4E所示，在第二方向Y上，数据写入晶体管T2的栅极和第一发光控制晶体管T4的栅极均位于驱动晶体管T1的栅极的第三侧，阈值补偿晶体管T3的第一个栅极、第二发光控制晶体管T5的栅极和第二复位晶体管T7的栅极均位于驱动晶体管T1的栅极的第四侧，例如，图4A-4E所示的示例中，第一子像素G1的像素电路121a的驱动晶体管T1的栅极的第三侧和第四侧为在第二方向Y上驱动晶体管T1的栅极的彼此相对的两侧，例如，如图4A-4E所示，第一子像素G1的像素电路121a的驱动晶体管T1的栅极的第三侧可以为第一子像素G1的像素电路121a的驱动晶体管T1的栅极的右侧，第一子像素G1的像素电路121a的驱动晶体管T1的栅极的第四侧可以为第一子像素G1的像素电路121a的驱动晶体管T1的栅极的左侧。
例如，在上述的第一导电层320上形成有第一绝缘层(未示出)，用于保护上述的第一导电层320。图4C示出了该像素电路120a的第二导电层330，第二导电层330包括第三电容C2的第一极CC1a、第一复位电源信号线Init1a、第二复位电源信号线Init2a、第二电源信号线VDD2。第二电源信号线VDD2与第三电容C2的第一极CC1a一体形成。第三电容C2的第一极CC1a与第三电容C2的第二极CC2a至少部分重叠以形成第三电容C2。
例如，在上述的第二导电层330上形成有第二绝缘层(未示出)，用于保护上述的第二导电层330。图4D示出了该像素电路121a的源漏极金属层340，源漏极金属层340包括数据线Vd和第一电源信号线VDD1。
图4E为上述的有源半导体层310、第一导电层320、第二导电层330和源漏极金属层340的层叠位置关系的示意图。如图4D和4E所示，数据线Vd通过栅极绝缘层、第一绝缘层和第二绝缘层中的至少一个过孔(例如，过孔381a)与有源半导体层310中的数据写入晶体管T2的源极区域相连。第一电源信号线VDD1通过栅极绝缘层、第一绝缘层和第二绝缘层中的至少一个过孔(例如，过孔382a)与有源半导体层310中对应的第一发光控制晶体管T4的源极区域相连。第一电源信号线VDD1通过第二绝缘层中的至少一个过孔(例如，过孔3832a)与第二导电层330中的第三电容C2的第一极CC1a相连。第一电源信号线VDD1还通过第二绝缘层中的至少一个过孔(例如，过孔3831a)与第二导电层330中的第二电源信号线VDD2相连。
例如，如图4D和4E所示，源漏极金属层340还包括第一连接部341a、第二连接部342a和第三连接部343a。第一连接部341a的一端通过栅极绝缘层、第一绝缘层和第二绝缘层中的至少一个过孔(例如，过孔384a)与有源半导体层310中对应的阈值补偿晶体管T3的漏极区域相连，第一连接部341a的另一端通过第一绝缘层和第二绝缘层中的至少一个过孔(例如，过孔385a)与第一导电层320中的驱动晶体管T1的栅极(即第三电容C2的第二极CC2a)相连。第二连接部342a的一端通过第二绝缘层中的一个过孔(例如，过孔386a)与第一复位电源信号线Init1a/第二复位电源信号线Init2a相连，第二连接部342a的另一端通过栅极绝缘层、第一绝缘层和第二绝缘层中的至少一个过孔(例如，过孔387a)与有源半导体层310中的第二复位晶体管T7的漏极区域相连。第三连接部343a通过栅极绝缘层、第一绝缘层和第二绝缘层中的至少一个过孔(例如，过孔388a)与有源半导体层310中的第二发光控制晶体管T5的漏极区域相连。
例如，在上述的源漏极金属层340上形成有中间层(未示出)，用于保护上述的源漏极金属层340。各个子像素的发光元件的第一发光电压施加电极可设置在中间层远离衬底基板的一侧。
例如，如图4A-4E所示，在第一方向X上，第一扫描信号线Ga1a、第二扫描信号线Ga2a、第一复位控制信号线Rst1a、第二复位控制信号线Rst2a、第一复位电源信号线Init1a和第二复位电源信号线Init2a均位于第一子像素G1的像素电路121a的驱动晶体管T1的栅极的第一侧，第一发光控制信号线EM1a、第二发光控制信号线EM2a均位于第一子像素G1的像素电路121a的驱动晶体管T1的第二侧。
例如，第一扫描信号线Ga1a、第二扫描信号线Ga2a、第一复位控制信号线Rst1a、第二复位控制信号线Rst2a、第一发光控制信号线EM1a、第二发光控制信号线EM2a、第一复位电源信号线Init1a和第二复位电源信号线Init2a均沿第二方向Y延伸，数据线Vd沿第一方向X延伸。
例如，第一电源信号线VDD1沿第一方向X延伸，第二电源信号线VDD2沿第二方向Y延伸。第一电源端VDD的信号线在显示基板上网格化布线，也就是说，在整个显示基板上，第一电源信号线VDD1和第二电源信号线VDD2呈网格状排列，从而第一电源端VDD的信号线的电阻较小、压降较低，进而可以提高第一电源端VDD提供的电源电压的稳定性。
例如，第一扫描信号线Ga1a、第二扫描信号线Ga2a、第一复位控制信号线Rst1a、第二复位控制信号线Rst2a、第一发光控制信号线EM1a、第二发光控制信号线EM2a位于同一层，第一复位电源信号线Init1a、第二复位电源信号线Init2a和第二电源信号线VDD2a位于同一层。第一电源信号线VDD1和数据线Vd位于同一层。
需要说明的是，每个像素电路中的驱动电路、第一发光控制电路、第二发光控制电路、数据写入电路、存储电路、阈值补偿电路和复位电路等的位置排布关系不限于图4A-4E所示的示例，根据实际应用需求，可以具体设置驱动电路、第一发光控制电路、第二发光控制电路、数据写入电路、存储电路、阈值补偿电路和复位电路的位置。
图5A为本公开一些实施例提供的一种显示基板的平面示意图；图5B为本公开一些实施例提供的一种重复单元的平面示意图；图6A为本公开一些实施例提供的另一种重复单元的平面示意图；图6B为本公开一些实施例提供的一种显示基板的布局图；图6C为图6B中线L1-L1'的截面结构示意图；图6D为图6B中线L2-L2'的截面结构示意图；图6E为本公开一些实施例提供的又一种显示基板的平面示意图。
例如，如图5A所示，在本公开的一些实施例中，显示基板10中的像素排列结构可以为GGRB像素排列结构，以增加包含该显示基板10的显示面板的PPI(pixel per inch，每英寸的像素数)，从而在显示分辨率相同的情况下，增大显示面板的视觉分辨率。例如，每个重复单元11包括四个子像素，四个子像素分别为第一子像素G1、第二子像素G2、第三子像素R和第四子像素B，且该四个子像素可以采用GGRB的排列方式。需要说明的是，在图5A中仅示出了两个完整的重复单元11，但本公开不限于此，显示基板10上包括有多个重复单元11，且多个重复单元11沿第一方向X和第二方向Y阵列排布。
例如，如图5A所示，区域31至40可以为衬底基板10上各个子像素的像素电路所在区域，例如，区域31至35位于第一行，区域36至40位于第二行；区域31和36位于第一列，区域32和37位于第二列，区域33和38位于第三列，区域34和39位于第四列，区域35和40位于第五列。例如，在图5A所示的示例中，在虚线圈出的重复单元11中，第一子像素G1的像素电路位于区域32，第二子像素G2的像素电路位于区域37，第三子像素R的像素电路位于区域38，第四子像素B的像素电路位于区域36。
需要说明的是，在本公开中，“行”可以表示各个像素电路所在区域对应的行，“列”可以表示各个像素电路所在区域对应的列。
例如，发光元件120被配置为在工作时接收发光信号(例如，可以为电流信号)，并发出与该发光信号相对应强度的光。发光元件120可以为发光二极管，发光二极管例如可以为有机发光二极管(OLED)或量子点发光二极管(QLED)等，但本公开的实施例不限于此。
例如，如图6C所示，发光元件120包括第一发光电压施加电极1201、第二发光电压施加电极1202和设置在第一发光电压施加电极1201和第二发光电压施加电极1202之间的发光层1203。例如，如图6C所示，第一子像素G1的发光元件包括第一发光电压施加电极1201a、第二发光电压施加电极1202和发光层1203a，第二子像素G2的发光元件包括第一发光电压施加电极1201b、第二发光电压施加电极1202和发光层1203a。
例如，如图6C所示，第一子像素G1的发光元件的第一发光电压施加电极1201a在衬底基板10上的正投影与第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影至少部分重叠，第二子像素G2的发光元件的第一发光电压施加电极1201b在衬底基板10上的正投影与第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影至少部分重叠。
例如，第一子像素G1的发光元件的第一发光电压施加电极1201a和第二子像素G2的发光元件的第一发光电压施加电极1201b可以位于同一层，第一子像素G1的发光元件的第二发光电压施加电极1202和第二子像素G2的发光元件的第二发光电压施加电极1202可以一体设置。
例如，第一子像素G1的发光元件的发光层1203a在衬底基板10上的正投影与第二子像素G2的发光元件的发光层1203a在衬底基板10上的正投影是连续的，也就是说，第一子像素G1的发光元件的发光层1203a和第二子像素G2的发光元件的发光层1203a可以由高精细金属掩模(FMM)板中的一个开孔制作，可以有效降低FMM的工艺难度。例如，第一子像素G1的发光元件的发光层1203a和第二子像素G2的发光元件的发光层1203a为一个整体。
例如，每个子像素的发光层1203的材料可以根据每个子像素的发光元件120发射光的颜色的不同进行选择。每个子像素的发光层1203的材料包括荧光发光材料或磷光发光材料等。例如，在一些实施例中，第一发光电压施加电极1201为阳极，第二发光电压施加电极1202为阴极，第一发光电压施加电极1201和第二发光电压施加电极1202均采用导电材料制备。需要说明的是，在一些示例中，第一发光电压施加电极1201和发光层1203之间设置有第一有机层，第二发光电压施加电极1202和发光层1203之间设置有第二有机层。第一有机层和第二有机层用于起平坦作用，可以被省略。
例如，在每个重复单元11中，第一子像素G1的发光元件120a发出的光的颜色和第二子像素G2的发光元件120b发出的光的颜色相同，也就是说，第一子像素G1和第二子像素G2为相同颜色的子像素。例如，第一子像素G1和第二子像素G2为敏感颜色子像素，当显示基板100采用红绿蓝(RGB)显示模式时，上述的敏感颜色为绿色，即第一子像素G1和第二子像素G2均为绿色子像素。例如，第三子像素R可以为红色子像素，第四子像素B可以为蓝色子像素。
例如，每个重复单元11中的四个子像素可以形成两个虚拟像素，重复单元11中的第三子像素R和第四子像素B分别被所述两个虚拟像素共用。多个重复单元11中的子像素形成像素阵列，在像素阵列的行方向上，子像素密度是虚拟像素密度的1.5倍，在像素阵列的列方向上，子像素密度是虚拟像素密度的1.5倍。
例如，第一子像素G1和第二子像素G2分别属于两个虚拟像素。
需要说明的是，第一，由于第三子像素R和第四子像素B是被相邻的两个虚拟像素共享，因而每个虚拟像素的边界也是非常模糊的，因而，本公开实施例并不对每个虚拟像素的形状进行限定。第二、虚拟像素的划分与驱动方式相关，虚拟像素的具体划分方式可以根据实际的驱动方式确定，本公开对此不作具体限制。
例如，如图6C所示，第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影位于第一子像素G1的发光元件120a的第一发光电压施加电极1201a在衬底基板10上的正投影内；第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影位于第二子像素G2的发光元件120b的第一发光电压施加电极1201b在衬底基板10上的正投影内。也就是说，第一子像素G1的发光元件120a的第一发光电压施加电极1201a在衬底基板10上的正投影完全覆盖第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影，第二子像素G2的发光元件120b的第一发光电压施加电极1201b在衬底基板10上的正投影完全覆盖第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影，例如，第一子像素G1的发光元件120a的第一发光电压施加电极1201a在衬底基板10上的正投影的面积可以大于第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影的面积，第二子像素G2的发光元件120b的第一发光电压施加电极1201b在衬底基板10上的正投影的面积可以大于第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影的面积。
例如，如图3B所示，当第一子像素G1的像素电路的驱动电路122a包括驱动晶体管T1时，第一子像素G1的像素电路的驱动电路122a的控制端1221a为第一子像素G1的像素电路驱动晶体管T1的栅极，则第一子像素G1的发光元件120a的第一发光电压施加电极在衬底基板10上的正投影与第一子像素G1的驱动晶体管T1的栅极在衬底基板10上的正投影至少部分重叠；如图3C所示，当第二子像素G2的像素电路的驱动电路122b包括驱动晶体管T1时，第二子像素G2的像素电路的驱动电路122b的控制端1221b为第二子像素G2的像素电路的驱动晶体管T1的栅极，第二子像素G2的发光元件120b的第一发光电压施加电极在衬底基板10上的正投影与第二子像素G2的驱动晶体管T1的栅极在衬底基板10上的正投影至少部分重叠。
例如，第一子像素G1的驱动晶体管T1的栅极在衬底基板10上的正投影位于第一子像素G1的发光元件120a的第一发光电压施加电极在衬底基板10上的正投影内；第二子像素G2的驱动晶体管T1的栅极在衬底基板10上的正投影位于第二子像素G2的发光元件120b的第一发光电压施加电极在衬底基板10上的正投影内。
例如，如图6C所示，第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影和第一子像素G1的发光元件的第一发光电压施加电极1201a在衬底基板10上的正投影的重叠部分的面积为第一面积AR1，第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影和第二子像素G2的发光元件的第一发光电压施加电极1201b在衬底基板10上的正投影的重叠部分的面积为第二面积AR2，第一面积AR1和第二面积AR2的比值满足以下关系式：
Amin≤AR1/AR2≤Amax，
其中，AR1表示第一面积，AR2表示第二面积，Amin表示最小比值阈值，且为90％，Amax表示最大比值阈值，且为110％。
例如，在一些示例中，第一面积AR1可以大于等于第二面积AR2，此时，最小比值阈值Amin可以为90％，最大比值阈值Amax也可以为100％；在另一些示例中，第一面积AR1可以小于第二面积AR2，此时，最小比值阈值Amin也可以为95％，最大比值阈值Amax也可以为105％。本公开的实施例对最小比值阈值和最大比值阈值的具体值不作具体限制，只要保证第一面积AR1和第二面积AR2之间的差异较小(例如，小于10％)，进而可以保证第一子像素G1的发光元件的第一发光电压施加电极1201a和第一子像素G1的驱动电路的控制端1221a之间的寄生电容(即图3B所示的第一电容C11)和第二子像素G2的发光元件的第一发光电压施加电极1201b和第二子像素G2的驱动电路的控制端1221b之间的寄生电容(即图3C所示的第二电容C12)之间的差异也较小(例如，小于10％)，从而提高包含该显示基板100的显示面板的显示效果即可。例如，第一面积AR1和第二面积AR2的比值处于上述最小比值阈值和最大比值阈值之间时，即使在低灰阶(如64灰阶)下，即在人眼识别能力较高的情况下，用户也可能并无法看出第一子像素G1和第二子像素G2之间的亮度差异，有效改善显示面板的显示效果，提升用户体验。
例如，如图5A和5B所示，第一子像素G1的发光元件120a的第一发光电压施加电极1201a的形状与第二子像素G2的发光元件的第一发光电压施加电极1201b的形状不相同。例如，在一些示例中，第一子像素G1的发光元件的第一发光电压施加电极1201a的形状可以为八边形，第二子像素G2的发光元件的第一发光电压施加电极1201b的形状可以为五边形。
例如，在每个重复单元11中，第一子像素G1的发光元件的第一发光电压施加电极1201a在衬底基板10上的正投影的面积和第二子像素G2的发光元件的第一发光电压施加电极1201b在衬底基板10上的正投影的面积不相同，第一子像素G1的发光元件的第一发光电压施加电极1201a在衬底基板10上的正投影的面积大于第二子像素G2的发光元件的第一发光电压施加电极1201b在衬底基板10上的正投影的面积。
例如，如图5B所示，第一子像素G1的发光元件120a的第一发光电压施加电极1201a包括辅助电极块Ae，辅助电极块Ae在衬底基板10上的正投影与第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影至少部分重叠。例如，在一些示例中，第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影位于辅助电极块Ae在衬底基板10上的正投影内。
例如，第一子像素G1的驱动晶体管T1的栅极在衬底基板10上的正投影位于第一子像素G1的发光元件120a的第一发光电压施加电极的辅助电极块Ae在衬底基板10上的正投影内。
例如，辅助电极块Ae作为第一电容C11的第一极CC3，第一子像素G1的驱动电路122a的控制端1221a复用为第一电容C11的第二极CC4，也就是说，辅助电极块Ae即为第一电容C11的第一极CC3，第一子像素G1的驱动电路122a的控制端1221a(即第一子像素G1的驱动晶体管T1的栅极)即为第一电容C11的第二极CC4。
例如，如图5B所示，辅助电极块Ae的形状可以为矩形，且辅助电极块Ae在衬底基板10上的正投影的形状与辅助电极块Ae的形状相同，即也为矩形。但本公开不限于此，辅助电极块Ae的形状也可以为五边形、六边形、椭圆形等。
例如，如图5B所示，第一子像素G1的发光元件120a的第一发光电压施加电极1201a还包括第一驱动电极块De1，第一驱动电极块De1和辅助电极块Ae电连接。
例如，如图5B所示，第一驱动电极块De1的形状可以为五边形，且第一驱动电极块De1在衬底基板10上的正投影的形状与第一驱动电极块De1的形状相同，即也为五边形。五边形可以是由一个三角形和一个矩形组成。
例如，在5B所示的示例中，第一驱动电极块De1和辅助电极块Ae一体设置，由此，第一发光电压施加电极1201a的形状可以为八边形，且该八边形可以是由一个五边形和一个矩形组成。
需要说明的是，在另一些示例中，第一驱动电极块De1和辅助电极块Ae也可以分别单独设置，只要第一驱动电极块De1和辅助电极块Ae能够彼此电连接即可。
例如，第一驱动电极块De1和辅助电极块Ae可以由同一构图工艺同时形成。
例如，如图6C所示，第一驱动电极块De1和辅助电极块Ae位于同一层。
例如，如图6C所示，第一驱动电极块De1在衬底基板10上的正投影、第一子像素G1的发光元件的发光层1203a在衬底基板10上的正投影和第一子像素G1的发光元件的第二发光电压施加电极1202在衬底基板10上的正投影至少部分重叠。
例如，在一些实施例中，显示基板上所有子像素的发光元件的第二发光电压施加电极均一体设置，也就是说，第二发光电压施加电极1202整层覆盖在整个衬底基板10上，即第二发光电压施加电极1202可以为一个面状电极。例如，如图6C所示，对于第一子像素G1和第二子像素G2，面状的第二发光电压施加电极1202与第一子像素G1的发光元件的第一发光电压施加电极1201a交叠的部分可以表示为第一子像素G1的发光元件的第二发光电压施加电极1202，面状的第二发光电压施加电极与第二子像素G2的发光元件的第一发光电压施加电极1201b交叠的部分可以表示为第二子像素G2的发光元件的第二发光电压施加电极1202。第一子像素G1的发光元件的第二发光电压施加电极1202和第二子像素G2的发光元件的第二发光电压施加电极1202一体设置。
例如，如图6C所示，第一子像素G1的发光元件的发光层和第二子像素G2的发光元件的发光层一体设置。对于第一子像素G1和第二子像素G2，发光层1203a与第一子像素G1的发光元件的第一发光电压施加电极1201a交叠的部分可以表示为第一子像素G1的发光元件的发光层，发光层1203a与第二子像素G2的发光元件的第一发光电压施加电极1201b交叠的部分可以表示为第二子像素G2的发光元件的发光层。
例如，如图6C所示，显示基板100还包括像素界定层160，位于各个子像素的发光元件的第一发光电压施加电极远离衬底基板10的一侧且包括第一开口，第一开口暴露第一子像素G1的发光元件的第一发光电压施加电极1201a和第二子像素G2的发光元件的第一发光电压施加电极1201b，第一子像素G1的发光元件的发光层1203a和第二子像素G2的发光元件的发光层1203a的至少部分位于第一开口内并覆盖第一发光电压施加电极1201a和第一发光电压施加电极1201b的被暴露的部分，第一开口与第一发光电压施加电极1201a交叠的部分区域为第一子像素G1的有效发光区，第一开口与第一发光电压施加电极1201b交叠的部分区域为第二子像素G2的有效发光区。
需要说明的是，在本公开的实施例中，每个发光元件的发光层可以包括电致发光层本身以及位于电致发光层两侧的其他公共层，例如，空穴注入层、空穴传输层、电子注入层以及电子传输层等等，但是在本公开的附图中，仅示出了发光层中的电致发光层，而没有示出其他公共层。
例如，在一些示例中，第一驱动电极块De1在衬底基板10上的正投影和第一子像素G1的发光元件的第二发光电压施加电极1202在衬底基板10上的正投影也可以不完全重叠，例如，第一驱动电极块De1在衬底基板10上的正投影位于第一子像素G1的发光元件的第二发光电压施加电极1202在衬底基板10上的正投影内，第一子像素G1的发光元件的发光层1203a在衬底基板10上的正投影也可以位于第一子像素G1的发光元件的第二发光电压施加电极1202在衬底基板10上的正投影内。
需要说明的是，在第一驱动电极块De1在衬底基板10上的正投影、第一子像素G1的发光元件的发光层1203a在衬底基板10上的正投影和第一子像素G1的发光元件的第二发光电压施加电极1202在衬底基板10上的正投影的投影重叠的区域内，对于第一子像素G1，第一子像素G1的发光元件的发光层的对应于像素界定层160的第一开口的部分用于发光。
例如，如图5B所示，第二子像素G2的发光元件120b的第一发光电压施加电极1201b包括第二驱动电极块De2。第二驱动电极块De2在衬底基板10上的正投影与第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影至少部分重叠。例如，在一些示例中，第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影可以位于第二驱动电极块De2在衬底基板10上的正投影内。例如，第二子像素G2的驱动晶体管T1的栅极在衬底基板10上的正投影位于第二子像素G2的发光元件120b的第一发光电压施加电极的第二驱动电极块De2在衬底基板10上的正投影内。
例如，第二驱动电极块De2可以复用为第二电容C12的第一极，第二子像素G2的驱动电路122b的控制端1221b复用为第二电容C12的第二极，也就是说，第二驱动电极块De2即为第二电容C12的第一极，第二子像素G2的驱动电路122b的控制端1221b(即第二子像素G2的驱动晶体管T1的栅极)即为第二电容C12的第二极。
例如，如图5B所示，第一驱动电极块De1的形状与第二驱动电极块De2的形状可以相同，即，第二驱动电极块De2的形状也可以为五边形。第二驱动电极块De2在衬底基板10上的正投影的形状与第二驱动电极块De2的形状相同，即也为五边形。
例如，第一驱动电极块De1在衬底基板10上的正投影的面积与第二驱动电极块De2在衬底基板10上的正投影的面积相同。
需要说明的是，在一些实施例中，第一驱动电极块De1的形状与第二驱动电极块De2的形状也可以为矩形或菱形等。第一驱动电极块De1的形状与第二驱动电极块De2的形状也可以不相同，本公开对此不作限制。
例如，如图6C所示，第二驱动电极块De2在衬底基板10上的正投影、第二子像素G2的发光元件的发光层1203a在衬底基板10上的正投影和第二子像素G2的发光元件的第二发光电压施加电极1202在衬底基板10上的正投影均至少部分重叠。
例如，在一些示例中，第二驱动电极块De2在衬底基板10上的正投影和第二子像素G2的发光元件的第二发光电压施加电极1202在衬底基板10上的正投影也可以不完全重叠，例如，第二驱动电极块De2在衬底基板10上的正投影位于第二子像素G2的发光元件的第二发光电压施加电极1202在衬底基板10上的正投影内。
需要说明的是，在第二驱动电极块De2在衬底基板10上的正投影、第二子像素G2的发光元件的发光层1203a在衬底基板10上的正投影和第二子像素G2的发光元件的第二发光电压施加电极1202在衬底基板10上正投影的投影重叠的区域内，对于第二子像素G2，第二子像素G2的发光元件的发光层的对应于像素界定层160的第一开口的部分用于发光。
例如，如图5A和5B所示，在每个重复单元11中，第一子像素G1和第二子像素G2沿第一方向X排列，第一方向X平行于衬底基板10的表面。例如，在第一方向X上，辅助电极块Ae位于第一驱动电极块De1的远离第二子像素G2的发光元件的一侧，也就是说，如图5B所示，在第一方向X上，第一驱动电极块De1位于辅助电极块Ae和第二驱动电极块De2之间。
例如，如图6C所示，辅助电极块Ae在衬底基板10上的正投影与第一子像素G1的发光元件的发光层1203a在衬底基板10上的正投影不重叠。例如，在一些示例中，辅助电极块Ae在衬底基板10上的正投影与第一子像素G1的发光元件的发光层1203a在衬底基板10上的正投影完全不重叠。
例如，如图6A和6B所示，第一子像素G1的发光元件的第一发光电压施加电极还包括第一连接电极块Ce1，在第一方向X上，第一连接电极块Ce1位于第一驱动电极块De1的远离第二子像素G2的发光元件的一侧，第一连接电极块Ce1位于辅助电极块Ae和第一驱动电极块De1之间，且与辅助电极块Ae和第一驱动电极块De1均电连接。
例如，在一些实施例中，第一连接电极块Ce1、辅助电极块Ae和第一驱动电极块De1均一体设置。需要说明的是，在另一些示例中，第一连接电极块Ce1、辅助电极块Ae和第一驱动电极块De1也可以分别单独设置，只要第一连接电极块Ce1、辅助电极块Ae和第一驱动电极块De1能够彼此电连接即可。
例如，第一连接电极块Ce1用于连接第一驱动电极块De1与第一子像素G1的像素电路。
例如，如图6C所示，第一连接电极块Ce1、辅助电极块Ae和第一驱动电极块De1位于同一层。第一连接电极块Ce1、辅助电极块Ae和第一驱动电极块De1可以由同一构图工艺同时形成。
例如，第一连接电极块Ce1的形状可以为规则形状，例如，矩形、菱形等；第一连接电极块Ce1的形状也可以为不规则形状。
例如，如图6A和6B所示，在一些示例中，辅助电极块Ae的形状和第一连接电极块Ce1的形状均为矩形，且在第二方向Y上，辅助电极块Ae的宽度小于第一连接电极块Ce1的宽度，即辅助电极块Ae和第一连接电极块Ce1形成阶梯状。在第二方向Y上，第一连接电极块Ce1的宽度小于第一驱动电极块De1的最大宽度。
例如，第一驱动电极块De1具有五个内角，五个内角可以包括两个直角、两个钝角和一个锐角，第一连接电极块Ce1从第一驱动电极块De1的锐角所在的一侧沿第一驱动电极块De1的远离第二子像素G2的发光元件的方向延伸。
例如，在一些实施例中，第一连接电极块Ce1在衬底基板10上的正投影与第一子像素G1的发光元件的发光层1203a在衬底基板10上的正投影不重叠，且第一连接电极块Ce1在衬底基板10上的正投影与第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影也不重叠。但本公开不限于此，第一连接电极块Ce1在衬底基板10上的正投影与第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影也可以部分重叠。需要说明的是，当第一连接电极块Ce1在衬底基板10上的正投影与第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影部分重叠时，第一连接电极块Ce1在衬底基板10上的正投影与第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影之间的重叠部分的面积小于辅助电极块Ae在衬底基板10上的正投影与第一子像素G1的像素电路的驱动电路的控制端1221a在衬底基板10上的正投影之间的重叠部分的面积。
例如，如图6C和6D所示，显示基板100还包括中间层101。在垂直于衬底基板10的表面的方向上，每个子像素的像素电路121位于中间层101和衬底基板10之间，发光元件120位于中间层101的远离衬底基板10的一侧，也就是说，中间层101位于发光元件120和衬底基板10之间。
例如，在一些实施例中，所有子像素的发光元件所在的层构成第一功能层组，所有子像素的像素电路所在的层构成第二功能层组，也就是说，在垂直于衬底基板10的表面的方向上，第一功能层组位于中间层101的远离衬底基板10的一侧，第二功能层组位于中间层101的靠近衬底基板10的一侧，即第二功能层组位于中间层101和衬底基板10之间，中间层101位于第一功能层组和第二功能层组之间。中间层101位于第一功能层组和第二功能层组之间。例如，图3A所示的驱动电路122、数据写入电路126、存储电路127、阈值补偿电路128和复位电路129等均位于第二功能层组中。例如，第一子像素G1的像素电路121a中第一寄生电路125a和第二子像素G2的像素电路121b中第一寄生电路125b也位于第二功能层组中。
需要说明的是，在本公开的实施例中，第一功能层组可以包括多个子层，例如，第一功能层组可以包括第一子像素G1的发光元件的第一发光电压施加电极1201a所在的子层、第一子像素G1的发光元件的第二发光电压施加电极1202所在的子层、第一子像素G1的发光元件的发光层1203a所在的子层。类似地，第二功能层组也可以包括多个子层，例如，第二功能层组可以包括第一子像素G2的像素电路中的各个元件所在的子层，当像素电路包括晶体管时，第二功能层组可以包括晶体管的栅极所在的子层、源漏极所在的子层、有源层所在的子层、栅极绝缘层所在的子层等。
例如，中间层101可以为一平坦层。例如，如图6C和6D所示，在垂直于衬底基板10的表面的方向上，第一子像素G1的发光元件的第一发光电压施加电极1201a设置在第一子像素G1的发光元件的发光层1203a的靠近中间层101的一侧，第一子像素G1的发光元件的第二发光电压施加电极1202设置在第一子像素G1的发光元件的发光层1203a的远离中间层101的一侧。
例如，如图6C所示，中间层101包括第一过孔h1，第一连接电极块Ce1延伸至第一过孔h1处且通过第一过孔h1与第一子像素G1的像素电路电连接，例如，第一连接电极块Ce1通过第一过孔h1与第一子像素G1的像素电路的第二发光控制电路124a电连接。例如，第一连接电极块Ce1可以覆盖并填充第一过孔h1。
例如，在第一子像素G1中，第一连接电极块Ce1通过第一过孔h1与第一子像素G1的像素电路的第二发光控制晶体管T5的第二极电连接。
例如，如图4A-4E所示，像素电路121可以包括有源半导体层310、栅极金属层(包括第一导电层320和第二导电层330)和源漏极金属层340，在垂直于衬底基板10的方向上，有源半导体层310位于衬底基板10与栅极金属层之间，栅极金属层位于有源半导体层310和源漏极金属层340之间，例如，栅极金属层的第一导电层320位于有源半导体层310和栅极金属层的第二导电层330之间，栅极金属层的第二导电层330位于栅极金属层的第一导电层320和源漏极金属层340之间。
例如，在本公开中，每个子像素的像素电路121中的各个晶体管(例如，驱动晶体管T1、数据写入晶体管T2、阈值补偿晶体管T3、第一发光控制晶体管T4、第二发光控制晶体管T5、第一复位晶体管T6和第二复位晶体管T7等)的有源层均位于有源半导体层310内，像素电路121中的各个晶体管的栅极均位于栅极金属层的第一导电层320内，像素电路121中的各个晶体管的源极和漏极均位于源漏极金属层340内。
例如，第一连接电极块Ce1通过第一过孔h1延伸到像素电路的源漏极金属层。
例如，第二子像素G2的发光元件的第一发光电压施加电极还包括第二连接电极块Ce2，第二连接电极块Ce2与第二驱动电极块De2电连接。例如，在一些实施例中，第二连接电极块Ce2与第二驱动电极块De2一体设置。需要说明的是，在另一些示例中，第二连接电极块Ce2与第二驱动电极块De2也可以分别单独设置，只要第二连接电极块Ce2与第二驱动电极块De2能够彼此电连接即可。
例如，第二连接电极块Ce2用于连接第二驱动电极块De2与第二子像素G2的像素电路。
例如，如图6A和6B所示，在第一方向X上，第二连接电极块Ce2位于第二驱动电极块De2的远离第一子像素G1的发光元件的一侧，也就是说，如图6A和6B所示，在第一方向X上，第二驱动电极块De2位于第二连接电极块Ce2和第一驱动电极块De1之间。
例如，如图6C所示，第二连接电极块Ce2与第二驱动电极块De2位于同一层。第二连接电极块Ce2与第二驱动电极块De2可以由同一构图工艺同时形成。
例如，第二连接电极块Ce2的形状可以为规则形状，例如，矩形、菱形等；第二连接电极块Ce2的形状也可以为不规则形状。
例如，在一些示例中，在第二方向Y上，第二连接电极块Ce2的宽度小于第二驱动电极块De2的最大宽度。例如，第二驱动电极块De2具有五个内角，五个内角可以包括两个直角、两个钝角和一个锐角，第二连接电极块Ce2从第二驱动电极块De2的锐角所在的一侧沿第二驱动电极块De2的远离第一子像素G1的发光元件的方向延伸。
例如，在一些示例中，第一连接电极块Ce1的形状和第二连接电极块Ce2的形状可以相同。
例如，在一些实施例中，第二连接电极块Ce2在衬底基板10上的正投影与第二子像素G2的发光元件的发光层1203a在衬底基板10上的正投影不重叠，且第二连接电极块Ce2在衬底基板10上的正投影与第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影也不重叠。但本公开不限于此，第二连接电极块Ce2在衬底基板10上的正投影与第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影也可以部分重叠。需要说明的是，当第二连接电极块Ce2在衬底基板10上的正投影与第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影部分重叠时，第二连接电极块Ce2在衬底基板10上的正投影与第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影之间的重叠部分的面积小于第二驱动电极块De2在衬底基板10上的正投影与第二子像素G2的像素电路的驱动电路的控制端1221b在衬底基板10上的正投影之间的重叠部分的面积。
例如，与第一子像素G1类似，在垂直于衬底基板10的表面的方向上，第二子像素G2的发光元件的第一发光电压施加电极1201b设置在第二子像素G2的发光元件的发光层1203a的靠近中间层101的一侧，第二子像素G2的发光元件的第二发光电压施加电极1202设置在第二子像素G2的发光元件的发光层1203a的远离中间层101的一侧。
例如，如图6C所示，中间层101包括第二过孔h2，第二连接电极块Ce2延伸至第二过孔h2处且通过第二过孔h2与第二子像素G2的像素电路电连接，例如，第二连接电极块Ce2通过第二过孔h2与第二子像素G2的像素电路的第二发光控制电路124b电连接。例如，第二连接电极块Ce2可以覆盖并填充第二过孔h2。
例如，在第二子像素G2中，第二连接电极块Ce2通过第二过孔h2与第二子像素G2的像素电路121b的第二发光控制晶体管T5的第二极电连接。
例如，第二连接电极块Ce2通过第二过孔h2延伸到像素电路的源漏极金属层。
例如，如图5A所示，在每个重复单元11中，第三子像素R和第四子像素B沿第二方向Y排列，且在第二方向Y上，第一子像素G1和第二子像素G2位于第三子像素R和第四子像素B之间，第二方向Y平行于衬底基板10的表面，且第一方向X和第二方向Y相互垂直。
例如，在每个重复单元11内，第一子像素G1的中心和第二子像素G2的中心的连线为第一中心线，第三子像素R的中心和第四子像素B的中心的连线为第二中心线。第一中心线的长度短于第二中心线的长度。例如，第一中心线和第二中心线相互垂直平分，且第一中心线与第一方向X大致平行，第二中心线与第二方向Y大致平行。
例如，第三子像素R的发光元件包括第一发光电压施加电极、第二发光电压施加电极和发光层，如图6D所示，第四子像素B的发光元件包括第一发光电压施加电极1201d、第二发光电压施加电极1202d和发光层1203d。需要说明的是，对于第三子像素R，面状的第二发光电压施加电极1202与第三子像素R的发光元件的第一发光电压施加电极交叠的部分可以表示为第三子像素R的发光元件的第二发光电压施加电极；对于第四子像素B，面状的第二发光电压施加电极与第四子像素B的发光元件的第一发光电压施加电极交叠的部分可以表示为第四子像素B的发光元件的第二发光电压施加电极。也就是说，第一子像素G1的发光元件的第二发光电压施加电极、第二子像素G2的发光元件的第二发光电压施加电极、第三子像素R的发光元件的第二发光电压施加电极、第四子像素B的发光元件的第二发光电压施加电极为一个整体。
例如，第三子像素R的发光元件的第一发光电压施加电极在衬底基板10上的正投影与第三子像素R的像素电路的驱动电路的控制端在衬底基板10上的正投影可以至少部分重叠。
例如，第四子像素B的发光元件的第一发光电压施加电极1201d在衬底基板10上的正投影与第四子像素B的像素电路的驱动电路的控制端在衬底基板10上的正投影也可以至少部分重叠。例如，如图6D所示，第四子像素B的像素电路的驱动电路的控制端1221d在衬底基板10上的正投影位于第四子像素B的发光元件的第一发光电压施加电极1201d在衬底基板10上的正投影内。
例如，如图6A和6B所示，第三子像素R的发光元件的第一发光电压施加电极包括彼此电连接的第三驱动电极块De3和第三连接电极块Ce3，第四子像素B的发光元件的第一发光电压施加电极1201d包括彼此电连接的第四驱动电极块De4和第四连接电极块Ce4。例如，第三子像素R的像素电路的驱动电路的控制端1221c在衬底基板10上的正投影与第三驱动电极块De3在衬底基板10上的正投影至少部分重叠；如图6D所示，第四子像素B的像素电路的驱动电路的控制端1221d在衬底基板10上的正投影和第四驱动电极块De4在衬底基板10上的正投影至少部分重叠，例如，第四子像素B的像素电路的驱动电路的控制端1221d在衬底基板10上的正投影位于第四驱动电极块De4在衬底基板10上的正投影内。
例如，第三连接电极块Ce3用于连接第三驱动电极块De3与第三子像素R的像素电路；第四连接电极块Ce4用于连接第四驱动电极块De4与第四子像素B的像素电路。
例如，第三子像素R的像素电路还包括第三寄生电路，第四子像素B的像素电路还包括第四寄生电路。第三寄生电路包括第四电容，第四寄生电路包括第五电容。第三驱动电极块De3复用为第四电容的第一极，第三子像素R的驱动电路的控制端复用为第四电容的第二极；第四驱动电极块De4复用为第五电容的第一极，第四子像素B的驱动电路的控制端复用为第五电容的第二极。
例如，第三驱动电极块De3的形状可以为规则的六边形，第四驱动电极块De4的形状也可以为规则的六边形。第三连接电极块Ce3的形状可以为不规则的六边形，第四连接电极块Ce4的形状也可以为不规则的六边形。
需要说明的是，在一些实施例中，第三驱动电极块De3和第四驱动电极块De4的形状也可以为矩形或长椭圆形等。本公开对第三驱动电极块De3、第三连接电极块Ce3、第四驱动电极块De4和第四连接电极块Ce4的形状不作具体限制。
例如，第三连接电极块Ce3可以为从六边形的第三驱动电极块De3的一条侧边(例如，六边形的右下侧的侧边)向外凸出的部分；第四连接电极块Ce4可以为从六边形的第四驱动电极块De4的一条侧边(例如，六边形的左下侧的侧边)向外凸出的部分。
需要说明的是，各子像素的驱动电极块的面积可以根据发光材料的发光效率具体设置，例如发光材料的发光效率较高，则子像素的驱动电极块的面积可以较小；而发光材料的发光效率较低，则子像素的驱动电极块的面积可以较大。例如，在一些实施例中，第三驱动电极块De3的面积小于第四驱动电极块De4的面积。第三驱动电极块De3的面积大于第一驱动电极块De1的面积，第三驱动电极块De3的面积大于第二驱动电极块De2的面积。
例如，在一些实施例中，第三驱动电极块De3和第三连接电极块Ce3一体设置，第四驱动电极块De4和第四连接电极块Ce4也一体设置。需要说明的是，在另一些示例中，第三驱动电极块De3和第三连接电极块Ce3也可以分别单独设置，只要第三驱动电极块De3和第三连接电极块Ce3能够彼此电连接即可，同理，第四驱动电极块De4和第四连接电极块Ce4也可以分别单独设置，只要第四驱动电极块De4和第四连接电极块Ce4能够彼此电连接即可。
例如，第三驱动电极块De3和第三连接电极块Ce3位于同一层。如图6D所示，第四驱动电极块De4和第四连接电极块Ce4位于同一层。
例如，与第一子像素G1和第二子像素G2类似，在垂直于衬底基板10的表面的方向上，第三子像素R的发光元件的第一发光电压施加电极设置在第三子像素R的发光元件的发光层的靠近中间层101的一侧，第三子像素R的发光元件的第二发光电压施加电极设置在第三子像素R的发光元件的发光层的远离中间层101的一侧；如图6D所示，在垂直于衬底基板10的表面的方向上，第四子像素B的发光元件的第一发光电压施加电极1201d设置在第四子像素B的发光元件的发光层1203d的靠近中间层101的一侧，第四子像素B的发光元件的第二发光电压施加电极1202d设置在第四子像素B的发光元件的发光层1203d的远离中间层101的一侧。
例如，如图6B所示，中间层101包括第三过孔h3，第三连接电极块Ce3延伸至第三过孔h3处且通过第三过孔h3与第三子像素R的像素电路电连接。例如，第三连接电极块Ce3可以覆盖并填充第三过孔h3。
例如，如图6D所示，中间层101包括第四过孔h4，第四连接电极块Ce4延伸至第四过孔h4处且通过第四过孔h4与第四子像素B的像素电路电连接。例如，第四连接电极块Ce4可以覆盖并填充第四过孔h4。
例如，第三连接电极块Ce3通过第三过孔h3延伸到像素电路的源漏极金属层；第四连接电极块Ce4通过第四过孔h4延伸到像素电路的源漏极金属层。
例如，第三连接电极块Ce3通过第三过孔h3延伸到像素电路的源漏极金属层，以与位于像素电路的源漏极金属层的第三子像素R的第二发光控制晶体管的第二极电连接。例如，第四连接电极块Ce4通过第四过孔h4延伸到像素电路的源漏极金属层，以与位于像素电路的源漏极金属层的第四子像素B的第二发光控制晶体管的第二极电连接。
例如，如图6A和6B所示，在每个重复单元11中，在第一方向X上，第三连接电极Ce3位于第三驱动电极块De3的远离第一子像素G1的辅助电极块Ae的一侧，在第二方向Y上，第三连接电极Ce3位于第三驱动电极块De3的靠近第四驱动电极块De4的一侧，也就是说，在图6A和6B所示的示例中，第三连接电极块Ce3位于第三驱动电极块De3的右下侧，即第三子像素R的发光元件的第一发光电压施加电极1201c的形状可以为Q字镜像对称的形状。
例如，如图6A和6B所示，在每个重复单元11中，在第一方向X上，第四连接电极Ce4位于第四驱动电极块De4的远离第一子像素G1的辅助电极块Ae的一侧，在第二方向Y上，第四连接电极Ce4位于第四驱动电极块De4的靠近第三驱动电极块De3的一侧，也就是说，在图6A和6B所示的示例中，第四连接电极块Ce4位于第四驱动电极块De4的左下侧，即第四子像素B的发光元件的第一发光电压施加电极1201d的形状可以为Q形。
例如，第三连接电极Ce3通过第三过孔h3与第三子像素R的像素电路的第二发光控制电路124c电连接，例如，第三连接电极Ce3通过第三过孔h3与第三子像素R的像素电路的第二发光控制晶体管的第二极电连接。
例如，如图6D所示，第四连接电极块Ce4通过第四过孔h4与第四子像素B的像素电路的第二发光控制电路124d电连接，例如，第四连接电极块Ce4通过第四过孔h4与第四子像素B的像素电路的第二发光控制晶体管的第二极电连接。
例如，如图6B所示，在图6D所示的源漏极金属层340上形成有中间层(未示出)，各个子像素的发光元件的第一发光电压施加电极设置在中间层上。第一子像素G1的发光元件的第一发光电压施加电极的第一连接电极块Ce1、第一驱动电极块De1和辅助电极块Ae、第二子像素G2的发光元件的第一发光电压施加电极的第二连接电极块Ce2、第二驱动电极块De2、第三子像素R的发光元件的第一发光电压施加电极的第三连接电极块Ce3、第三驱动电极块De3、第四子像素B的发光元件的第一发光电压施加电极的第四连接电极块Ce4、第四驱动电极块De4均设置在中间层上，第一子像素G1的第一连接电极块Ce1通过第一过孔h1与第一子像素G1的像素电路121a中的第二发光控制晶体管T5连接，第二子像素G2的第二连接电极块Ce2通过第二过孔h2与第二子像素G2的像素电路121b中的第二发光控制晶体管T5连接，第三子像素R的第三连接电极块Ce3通过第三过孔h3与第三子像素R的像素电路中的第二发光控制晶体管T5连接，第四子像素B的第四连接电极块Ce4通过第三过孔h4与第四子像素B的像素电路中的第二发光控制晶体管T5连接。
例如，第一子像素G1的辅助电极块Ae在衬底基板上的正投影与第一子像素G1的像素电路121a中的驱动晶体管的栅极在衬底基板上的正投影至少部分重叠，第二子像素G2的第二驱动电极块De2在衬底基板上的正投影与第二子像素G2的像素电路121b中的驱动晶体管的栅极在衬底基板上的正投影至少部分重叠，第三子像素R的第三驱动电极块De3在衬底基板上的正投影与第三子像素R的像素电路中的驱动晶体管的栅极在衬底基板上的正投影至少部分重叠，第四子像素B的第四驱动电极块De4在衬底基板上的正投影与第四子像素B的像素电路中的驱动晶体管的栅极在衬底基板上的正投影至少部分重叠。
需要说明的是，图6E示出了各个子像素的驱动电极块、各第一子像素的辅助电极块和各个子像素的连接电极块，图6E还示出了与各个连接电极块对应的过孔。需要说明的是，各个子像素的连接电极块可以覆盖并填充对应的过孔，例如，第一连接电极块覆盖并填充第一过孔h1，第二连接电极块覆盖并填充第二过孔h2，第三连接电极块覆盖并填充第三过孔h3，第四连接电极块覆盖并填充第四过孔h4，然而，为了示出各个过孔的位置，在图6E中各个过孔位于对应的连接电极块上方。
例如，如图6E所示，在第二方向Y上，各过孔排列为多行过孔，每行过孔中的各个过孔按照第三过孔h3、第一过孔h1、第四过孔h4和第二过孔h2的顺序排列，即第三过孔h3、第一过孔h1、第四过孔h4和第二过孔h2为一个排列周期HT1，在该排列周期HT1中，第一过孔h1对应位于第二行且与该第一过孔h1相邻的第一子像素G1，第二过孔h2对应位于第一行且与该第二过孔h2相邻的第二子像素G2，第三过孔h3对应位于第一行且与该第三过孔h3相邻的第三子像素R，第四过孔h4对应位于第一行与该第四过孔h4相邻的第四子像素B。
例如，在第二方向Y上，每行过孔中的各个过孔位于同一条直线上，即每个排列周期HT1中的第一过孔h1、第三过孔h3、第二过孔h2和第四过孔h4位于同一条直线上，且各个排列周期HT1也位于同一条直线上。
例如，在第二方向Y上，任意相邻的两个过孔之间的距离为第一固定距离d1，也就是说，如图6E所示，在排列周期HT1中，第一过孔h1和第四过孔h4之间的距离为第一固定距离d1，第一过孔h1和第三过孔h3之间的距离也为第一固定距离d1，第二过孔h2和第三过孔h3之间的距离也为第一固定距离d1，第二过孔h2和第四过孔h4之间的距离也为第一固定距离d1。需要说明的是，“相邻的两个过孔”表示该两个过孔之间不存在过孔，第一固定距离d1可以表示在第二方向Y上相邻的两个过孔的中心之间的距离。
例如，如图6E所示，在第一方向X上，各第一过孔h1和各第二过孔h2排列为多个第一过孔列，各第三过孔h3和各第四过孔h4排列为多个第二过孔列，在第二方向Y上，第一过孔列和第二过孔列交替排列，也就是说，多个第一过孔列可以为奇数列，而多个第二过孔列则为偶数列。在每个第一过孔列中，各第一过孔h1和各第二过孔h2位于同一条直线上，在每个第二过孔列中，各第三过孔h3和各第四过孔h4也位于同一条直线上。
例如，在第一方向X上，任意相邻的第一过孔h1和第二过孔h2之间的距离为第二固定距离d2，任意相邻的第三过孔h3和第四过孔h4之间的距离为第三固定距离d3，第二固定距离d2和第三固定距离d3相等。需要说明的是，第二固定距离d2可以表示在第一方向X上相邻的第一过孔h1的中心和第二过孔h2的中心之间的距离，第三固定距离d3可以表示在第一方向X上相邻的第三过孔h3的中心和第四过孔h4的中心之间的距离。
例如，多个重复单元11沿第二方向Y排列以形成多个重复单元组，多个重复单元组沿第一方向X排列。如图6E所示，在第一方向X上，第一连接电极块、第二连接电极块、第三连接电极块和第四连接电极块位于相邻两个重复单元组之间，在第一方向X上，辅助电极块的至少一部分位于在辅助电极块远离第一驱动电极块的一侧且与辅助电极块所在的重复单元组相邻的重复单元组中的相邻两个重复单元之间。例如，在一些实施例中，第P个重复单元组位于第一行，第P+1个重复单元组位于第二行。对于位于第P+1个重复单元组中的重复单元，辅助电极块Ae的至少一部分位于在辅助电极块Ae远离第一驱动电极块De1的一侧且与辅助电极块Ae所在的重复单元组(即第P+1个重复单元组)相邻的重复单元组(即第P个重复单元组)中的相邻两个重复单元之间，例如，如图6E所示，位于第二行的重复单元中的辅助电极块Ae的至少一部分延伸至第一行，且位于第一行的相邻两个重复单元之间，例如，位于第二行的重复单元中的辅助电极块Ae的至少一部分位于第一行的相邻的第三子像素R和第四子像素B之间。
例如，如图6C所示，第一子像素G1的第二发光控制电路124a的第二发光控制晶体管包括第二极1241a(例如，漏极)和有源层1242a。第一子像素G1的驱动电路的驱动晶体管包括栅极1221a(即驱动电路122a的控制端)和有源层1222a。需要说明的是，图6C没有示出第一子像素G1的第二发光控制晶体管的栅极和第一极、第一子像素G1的驱动晶体管的第一极和第二极等。
例如，有源半导体层310和第一导电层320之间设置有栅极绝缘层，即如图6C所示，在第一子像素G1的驱动晶体管的栅极1221a和有源层1222a之间设置有栅极绝缘层131，栅极绝缘层131覆盖在整个显示基板100上，由此，第二发光控制晶体管的栅极和有源层之间也设置有栅极绝缘层131。第一子像素G1的驱动晶体管的栅极1221a设置在栅极绝缘层131的远离衬底基板10的一侧。如图6C所示，在栅极绝缘层131的远离衬底基板10的一侧还设置有与第一子像素G1的第一发光控制电路连接的第一发光控制信号线EM1a和第二发光控制电路连接的第二发光控制信号线EM2a。
例如，如图6C所示，第一连接电极块Ce1在衬底基板10上的正投影和与第一子像素G1的像素电路的第二发光控制电路连接的第二发光控制信号线EM2a(即与第一子像素G1的第一发光控制电路连接的第一发光控制信号线EM1a)在衬底基板10上的正投影均至少部分重叠。
例如，如图6C所示，在第一子像素G1的驱动晶体管的栅极1221a上还设置有第一绝缘层132，在第一绝缘层132的远离衬底基板10的一侧设置有第一子像素G1的第三电容C2的第一极CC1a。在第三电容C2的第二极CC2a的远离衬底基板10的一侧设置有第二绝缘层133。第一子像素G1的第二发光控制晶体管的第二极1241a设置在第二绝缘层133的远离衬底基板10的一侧，且通过贯穿第二绝缘层133、第一绝缘层132和栅极绝缘层131的过孔388a与第二发光控制晶体管的有源层1242a电连接。例如，第一绝缘层132和第二绝缘层133也覆盖在整个显示基板100上。
例如，在第二绝缘层133的远离衬底基板10的一侧还设置有第一子像素G1的第一连接部341a，第一子像素G1的第一连接部341a通过贯穿第二绝缘层133、第一子像素G1的第三电容C2的第一极CC1a和第一绝缘层132的过孔385a与第一子像素G1的驱动晶体管的栅极1221a电连接。第一连接部341a在衬底基板10上的正投影和第一子像素G1的驱动晶体管的栅极1221a在衬底基板10上的正投影至少部分重叠，也就是说，第一连接部341a在衬底基板10上的正投影、第一子像素G1的驱动晶体管的栅极1221a在衬底基板10上的正投影和辅助电极块Ae在衬底基板10上的正投影至少部分重叠。
需要说明的是，对于第一子像素G1，在垂直于衬底基板10的方向上，第一电容C11的第一极CC3a(即辅助电极块Ae)和第二极CC4a(即第一子像素G1的驱动晶体管的栅极1221a)之间，还设置有第一子像素G1的第三电容C2的第一极CC1a、第一子像素G1的第一连接部341a等金属层，因此，在辅助电极块Ae和第一子像素G1的第一连接部341a之间也可能存在寄生电容，在辅助电极块Ae和第一子像素G1的第三电容C2的第一极CC1a之间也可能存在寄生电容，在第一子像素G1的第三电容C2的第一极CC1a和第一子像素G1的第一连接部341a之间也可能存在寄生电容，在第一子像素G1的驱动晶体管的栅极1221a和第一子像素G1的第一连接部341a之间也可能存在寄生电容，在第一子像素G1的驱动晶体管的栅极1221a和第一子像素G1的第三电容C2的第一极CC1a之间也可能存在寄生电容，这些寄生电容的位置和大小等与显示基板的具体版图(Layout)结构相关，对此，本公开不作详细描述。
例如，第一子像素G1的第二发光控制晶体管的第二极1241a、第一连接部341a均位于像素电路的源漏极金属层340中，第一子像素G1的驱动晶体管的栅极1221a和第一发光控制信号线EM1a/第二发光控制信号线EM2a均位于像素电路的第一导电层320中，第一子像素G1的第三电容C2的第一极CC1a位于像素电路的第二导电层330中，第一子像素G1的第二发光控制晶体管的有源层1242a和驱动晶体管的有源层1222a位于像素电路的有源半导体层310中。
例如，第一连接电极块Ce1通过第一过孔h1延伸到像素电路的源漏极金属层340，以与位于像素电路的源漏极金属层340中的第一子像素G1的第二发光控制晶体管的第二极1241a电连接。
例如，如图6C所示，在垂直于衬底基板10的方向上，在第一连接电极块Ce1和衬底基板10之间设置有与第二子像素G2的像素电路连接的第一复位电源信号线Init1b/第二复位电源信号线Init2b、第二子像素G2的第二连接部342b的至少部分和过孔386b，第二子像素G2的第二连接部342b通过该过孔386b与第一复位电源信号线Init1b/第二复位电源信号线Init2b电连接。
例如，第一复位电源信号线Init1b/第二复位电源信号线Init2b位于像素电路的第二导电层330中。
例如，如图6C所示，在垂直于衬底基板10的方向上，在第一驱动电极块De1和衬底基板10之间设置有与第二子像素G2的像素电路连接的第一复位控制信号线Rst1a/第二复位控制信号线Rst2a、第二子像素G2的第二连接部342b的至少部分、第二子像素G2的第一连接部341b的至少部分、过孔387b、过孔384b、第二子像素G2的第一复位晶体管T6的第二极1291b(也为第二子像素G2的阈值补偿晶体管T3的第二极)、第二子像素G2的第一复位晶体管T6的第一极1292b(也为第二子像素G2的第二复位晶体管T7的第一极)，第二子像素G2的第二连接部342b通过过孔387b与第二子像素G2的第一复位晶体管T6的第一极1292b电连接，第二子像素G2的第一连接部341b通过过孔384b与第二子像素G2的第一复位晶体管T6的第二极1291b电连接。
例如，如图6C所示，第二子像素G2的第二发光控制电路124b的第二发光控制晶体管包括第二极1241b(例如，漏极)和有源层1242b。第二子像素G2的驱动电路的驱动晶体管包括栅极1221b(即驱动电路122b的控制端)和有源层1222b。需要说明的是，图6C没有示出第二子像素G2的第二发光控制晶体管的栅极和第一极、第二子像素G2的驱动晶体管的第一极和第二极等。
例如，在第二子像素G2的驱动晶体管的栅极1221b和有源层1222b之间也设置有栅极绝缘层131。在第二子像素G2的驱动晶体管的栅极1221b上也设置有第一绝缘层132。在第一绝缘层132的远离衬底基板10的一侧设置有第二子像素G2的第三电容C2的第一极CC1b。第二子像素G2的第二发光控制晶体管的第二极1241b设置在第二绝缘层133的远离衬底基板10的一侧，且通过贯穿第二绝缘层133、第一绝缘层132和栅极绝缘层131的过孔388b与第二子像素G2的第二发光控制晶体管的有源层1242b电连接。
例如，如图6C所示，在栅极绝缘层131的远离衬底基板10的一侧还设置有与第二子像素G2的第一发光控制电路连接的第一发光控制信号线EM1b和第二发光控制电路连接的第二发光控制信号线EM2b。
例如，如图6C所示，第二连接电极块Ce2在衬底基板10上的正投影和与第二子像素G2的像素电路的第二发光控制电路连接的第二发光控制信号线EM2b(即与第二子像素G2的第一发光控制电路连接的第一发光控制信号线EM1b)在衬底基板10上的正投影均至少部分重叠。
例如，如图6C所示，在栅极绝缘层131的远离衬底基板10的一侧还设置有与第二子像素G2的数据写入晶体管电连接的第一扫描信号线Ga1b和与第二子像素G2的阈值补偿晶体管电连接的第二扫描信号线Ga2b。
例如，在第二绝缘层133的远离衬底基板10的一侧还设置有第二子像素G2的第一连接部341b，第二子像素G2的第一连接部341b通过贯穿第二绝缘层133、第二子像素G2的第三电容C2的第一极CC1b和第一绝缘层132的过孔385b与第二子像素G2的驱动晶体管的栅极1221b电连接。第二子像素G2的第一连接部341b在衬底基板10上的正投影和第二子像素G2的驱动晶体管的栅极1221b在衬底基板10上的正投影至少部分重叠，也就是说，第一连接部341b在衬底基板10上的正投影、第二子像素G2的驱动晶体管的栅极1221b在衬底基板10上的正投影和第二驱动电极块De2在衬底基板10上的正投影至少部分重叠。
需要说明的是，对于第二子像素G2，在垂直于衬底基板10的方向上，第二电容C12的第一极CC1b(即第二驱动电极块De2)和第二极(即第二子像素G2的驱动晶体管的栅极1221b)之间，还设置有第二子像素G2的第三电容C2的第一极CC1b、第二子像素G2的第一连接部341b等金属层，因此，在第二驱动电极块De2和第二子像素G2的第一连接部341b之间也可能存在寄生电容，在第二驱动电极块De2和第二子像素G2的第三电容C2的第一极CC1b之间也可能存在寄生电容，在第二子像素G2的第三电容C2的第一极CC1b和第二子像素G2的第一连接部341b之间也可能存在寄生电容，在第二子像素G2的驱动晶体管的栅极1221b和第二子像素G2的第一连接部341b之间也可能存在寄生电容，在第二子像素G2的驱动晶体管的栅极1221b和第二子像素G2的第三电容C2的第一极CC1b之间也可能存在寄生电容，这些寄生电容的位置和大小等与显示基板的具体版图(Layout)结构相关，对此，本公开不作详细描述。
例如，第二子像素G2的第二发光控制晶体管的第二极1241b、第一连接部341b均位于像素电路的源漏极金属层340中，第二子像素G2的驱动晶体管的栅极1221b和第一发光控制信号线EM1b/第二发光控制信号线EM2b位于像素电路的第一导电层320中，第二子像素G2的第三电容C2的第一极CC1b位于像素电路的第二导电层330中，第二子像素G2的第二发光控制晶体管的有源层1242b和驱动晶体管的有源层1222b位于像素电路的有源半导体层310中。
例如，第二连接电极块Ce2通过第二过孔h2延伸到像素电路的源漏极金属层340，以与位于像素电路的源漏极金属层340的第二子像素G2的第二发光控制晶体管的第二极1241b电连接。
例如，如图6B和图6C所示，第二子像素G2的第一发光电压施加电极在衬底基板上的正投影与第二子像素G2的像素电路对应的有源半导体层在衬底基板上的正投影的重叠部分的形状可以包括“几”字形，该“几”字形对应的有源半导体层部分包括第二子像素G2的像素电路的驱动晶体管的有源层。在垂直于衬底基板的方向上，第二子像素G2的像素电路对应的有源半导体层的与第二子像素G2的第一发光电压施加电极交叠的部分可以包括第二子像素G2的像素电路的驱动晶体管的有源层。此外，第二子像素G2的像素电路对应的有源半导体层的与第二子像素G2的第一发光电压施加电极交叠的部分还可以包括第二子像素G2的像素电路的第二发光控制晶体管T5的漏极区域。
例如，如图6B和图6C所示，第二子像素G2的第一发光电压施加电极在衬底基板上的正投影与第二子像素G2的像素电路对应的源漏极金属层在衬底基板上的正投影部分重叠。在垂直于衬底基板的方向上，第二子像素G2的像素电路对应的源漏极金属层的与第二子像素G2的第一发光电压施加电极交叠的部分包括第一连接部的一部分(即第一连接部的与第二子像素G2的像素电路的驱动晶体管的栅极交叠的部分)和第三连接部(即第二子像素G2的像素电路的第二发光控制晶体管T5的漏极)、第一电源信号线VDD1的一部分等。
例如，如图6B和图6C所示，在垂直于衬底基板的方向上，第二子像素G2的像素电路对应的有源半导体层的与第一子像素G1的第一发光电压施加电极交叠的部分可以包括第二子像素G2的像素电路中的复位电路129b中的第一复位晶体管T6和第二复位晶体管T7的有源层、漏极区域、第一子像素G1的像素电路中的驱动晶体管的有源层(“几”字形)的一部分、第一子像素G1的像素电路的第二发光控制晶体管T5的漏极区域等。
例如，如图6B和图6C所示，第一子像素G1的第一发光电压施加电极在衬底基板上的正投影与第一子像素G1的像素电路对应的源漏极金属层在衬底基板上的正投影、第二子像素G2的像素电路对应的源漏极金属层在衬底基板上的正投影均部分重叠。例如，在垂直于衬底基板的方向上，第二子像素G2的像素电路对应的源漏极金属层的与第一子像素G1的第一发光电压施加电极交叠的部分包括第一连接部的一部分(即第一连接部的与阈值补偿晶体管的漏极区域交叠的部分)、第二连接部(即第二子像素G2的像素电路的第二复位晶体管的漏极和第一复位电源信号线之间的连接部)和第一电源信号线VDD1的一部分等。第一子像素G1的像素电路对应的源漏极金属层的与第一子像素G1的第一发光电压施加电极交叠的部分包括第一连接部的一部分(即第一连接部的与第一子像素G1的像素电路的驱动晶体管的栅极交叠的部分)和第三连接部(即第一子像素G1的像素电路的第二发光控制晶体管的漏极)等。例如，如图6D所示，第四子像素B的第二发光控制电路124d的第二发光控制晶体管包括第二极1241d(例如，漏极)和有源层1242c。第三子像素R的驱动电路的驱动晶体管包括栅极1221d(即驱动电路122d的控制端)和有源层1222d。需要说明的是，图6D没有示出第四子像素B的第二发光控制晶体管的栅极和第一极、第四子像素B的驱动晶体管的第一极和第二极等。
例如，如图6D所示，在第四子像素B的驱动晶体管的栅极1221d和有源层1222d之间设置有栅极绝缘层131，在第四子像素B的驱动晶体管的栅极1221d上也设置有第一绝缘层132。在第一绝缘层132的远离衬底基板10的一侧设置有第四子像素B的第三电容C2的第一极CC1d。第四子像素B的第二发光控制晶体管的第二极1241d设置在第二绝缘层133的远离衬底基板10的一侧，且通过贯穿第二绝缘层133、第一绝缘层132和栅极绝缘层131的过孔388d与第四子像素B的第二发光控制晶体管的有源层1242d电连接。
例如，如图6D所示，在栅极绝缘层131的远离衬底基板10的一侧还设置有与第四子像素B的第一发光控制电路连接的第一发光控制信号线EM1d和第二发光控制电路连接的第二发光控制信号线EM2d。例如，如图6B和图6C所示，对于位于第二行的第四子像素B，与该第四子像素B对应的第一发光控制信号线EM1d和第二发光控制信号线EM2d为同一条信号线，且该第一发光控制信号线EM1d/第二发光控制信号线EM2d和与位于第二行的第二子像素G2对应的第一发光控制信号线EM1b/第二发光控制信号线EM2b也为同一条信号线。
例如，如图6D所示，第四连接电极块Ce4在衬底基板10上的正投影和与第四子像素B的像素电路的第二发光控制电路连接的第二发光控制信号线EM2d(即与第四子像素B的第一发光控制电路连接的第一发光控制信号线EM1d)在衬底基板10上的正投影均至少部分重叠。
例如，如图6D所示，在栅极绝缘层131的远离衬底基板10的一侧还设置有与第四子像素B的数据写入晶体管电连接的第一扫描信号线Ga1d和与第四子像素B的阈值补偿晶体管电连接的第二扫描信号线Ga2d。例如，如图6B和图6C所示，对于位于第二行的第四子像素B，与该第四子像素B对应的第一扫描信号线Ga1d和第二扫描信号线Ga2d为同一条信号线，且该第一扫描信号线Ga1d/第二扫描信号线Ga2d和与位于第二行的第二子像素G2对应的第一扫描信号线Ga1b/第二扫描信号线Ga2b也为同一条信号线。
例如，在第二绝缘层133的远离衬底基板10的一侧还设置有第四子像素B的第一连接部341d，第四子像素B的第一连接部341d通过贯穿第二绝缘层133、第四子像素B的第三电容C2的第一极CC1d和第一绝缘层132的过孔385d与第四子像素B的驱动晶体管的栅极1221d电连接。第四子像素B的第一连接部341d在衬底基板10上的正投影和第四子像素B的驱动晶体管的栅极1221d在衬底基板10上的正投影至少部分重叠，也就是说，第一连接部341d在衬底基板10上的正投影、第四子像素B的驱动晶体管的栅极1221d在衬底基板10上的正投影和第四驱动电极块De4在衬底基板10上的正投影至少部分重叠。
需要说明的是，对于第四子像素B，在垂直于衬底基板10的方向上，第四驱动电极块De4和第四子像素B的驱动晶体管的栅极1221d之间，还设置有第四子像素B的第三电容C2的第一极CC1d、第四子像素B的第一连接部341d等金属层，因此，在第四驱动电极块De4和第四子像素B的第一连接部341d之间也可能存在寄生电容，在第四驱动电极块De4和第四子像素B的第三电容C2的第一极CC1d之间也可能存在寄生电容，在第四子像素B的第三电容C2的第一极CC1d和第四子像素B的第一连接部341d之间也可能存在寄生电容，在第四子像素B的驱动晶体管的栅极1221d和第四子像素B的第一连接部341d之间也可能存在寄生电容，在第四子像素B的驱动晶体管的栅极1221d和第四子像素B的第三电容C2的第一极CC1d之间也可能存在寄生电容，这些寄生电容的位置和大小等与显示基板的具体版图(Layout)结构相关，对此，本公开不作详细描述。
例如，如图6D所示，在衬底基板10上设置有与第四子像素B的像素电路连接的第一复位电源信号线Init1d/第二复位电源信号线Init2和和过孔386d；在垂直于衬底基板10的方向上，在第四驱动电极块Ce1和衬底基板10之间设置有第四子像素B的第二连接部342d的至少部分，第四子像素B的第二连接部342d通过该过孔386d与第一复位电源信号线Init1d/第二复位电源信号线Init2d电连接。
例如，如图6D所示，在垂直于衬底基板10的方向上，在第四驱动电极块De4和衬底基板10之间设置有与第四子像素B的像素电路连接的第一复位控制信号线Rst1d/第二复位控制信号线Rst2d、第四子像素B的第二连接部342d的至少部分、第四子像素B的第一连接部341d、过孔387d、过孔384d、第四子像素B的第一复位晶体管T6的第二极1291d(也为第四子像素B的阈值补偿晶体管T3的第二极)、第四子像素B的第一复位晶体管T6的第一极1292d(也为第四子像素B的第二复位晶体管T7的第一极)，第四子像素B的第二连接部342d通过过孔387d与第四子像素B的第一复位晶体管T6的第一极1292d电连接，第四子像素B的第一连接部341d通过过孔384d与第四子像素B的第一复位晶体管T6的第二极1291d电连接。
例如，第四子像素B的第二发光控制晶体管的第二极1241d、第一连接部341d均位于像素电路的源漏极金属层340中，第四子像素B的驱动晶体管的栅极1221d和第一发光控制信号线EM1d/第二发光控制信号线EM2d位于第四子像素B的像素电路的栅极金属层第一导电层320中，第四子像素B的第三电容C2的第一极CC1d和第一复位电源信号线Init1d/第二复位电源信号线Init2d位于像素电路的第二导电层330中，第四子像素B的第二发光控制晶体管的有源层1242d和驱动晶体管的有源层1222d位于像素电路的有源半导体层310中。
例如，第四连接电极块Ce4通过第四过孔h4延伸到像素电路的源漏极金属层，以与位于像素电路的源漏极金属层的第四子像素B的第二发光控制晶体管的第二极1241d电连接。
例如，第三子像素R的像素电路和第四子像素B的像素电路中的各个电路(例如，驱动电路、第一发光控制电路、第二发光控制电路、存储电路、复位电路、阈值补偿电路、数据写入电路等)的连接关系与图3A所示的示例相同。
本公开的实施例还提供一种显示基板。如图2所示，显示基板100包括衬底基板10和设置在衬底基板10上的多个重复单元11，每个重复单元11包括多个子像素12。每个子像素12包括发光元件120和像素电路121，像素电路121用于驱动发光元件120发光，像素电路121包括驱动电路122。
例如，如图5A所示，多个子像素12的驱动电路122在衬底基板10上阵列排布，例如，区域31至40可以为衬底基板10上各个子像素的驱动电路所在区域，在图5A所示的示例中示出了两行五列的驱动电路。例如，在图3A所示的示例中，在虚线圈出的重复单元11中，第一子像素G1的像素电路的驱动电路位于区域32，第二子像素G2的像素电路的驱动电路位于区域37，第三子像素R的像素电路的驱动电路位于区域38，第四子像素B的像素电路的驱动电路位于区域36。
需要说明的是，在本公开中，“行”可以表示各个像素电路所在区域对应的行，“列”可以表示各个像素电路所在区域对应的列。
例如，每个子像素的发光元件120包括第一发光电压施加电极、第二发光电压施加电极和设置在第一发光电压施加电极和第二发光电压施加电极之间的发光层。例如，在一些实施例中，第一发光电压施加电极为阳极，第二发光电压施加电极为阴极。
例如，如图5A和6A所示，多个子像素12包括第一子像素G1和第二子像素G2。例如，第一子像素G1的发光元件发出的光的颜色和第二子像素G2的发光元件发出的光的颜色相同，例如，第一子像素G1和第二子像素G2均为绿色子像素。
例如，如图6A所示，第一子像素G1的发光元件的第一发光电压施加电极和第二子像素G2的发光元件的第一发光电压施加电极沿第一方向X排布。
例如，如图6A所示，第一子像素G1的发光元件的第一发光电压施加电极1201a包括辅助电极块Ae、第一驱动电极块De1和第一连接电极块Ce1，辅助电极块Ae、第一驱动电极块De1和第一连接电极块Ce1彼此电连接。
例如，如图6A所示，第二子像素G2的发光元件的第一发光电压施加电极1201b包括第二驱动电极块De2和第二连接电极块Ce2，第二驱动电极块De2和第二连接电极块Ce2电连接。
例如，第一子像素G1的发光元件的第一发光电压施加电极1201a的面积和第二子像素G2的发光元件的第一发光电压施加电极1201b的面积不相同，例如，第一子像素G1的发光元件的第一发光电压施加电极1201a的面积大于第二子像素G2的发光元件的第一发光电压施加电极1201b的面积。
例如，如图6B所示，辅助电极块Ae位于第一子像素G1的像素电路的驱动电路的控制端的远离衬底基板10的一侧，第二驱动电极块De2位于第二子像素G2的像素电路的驱动电路的控制端的远离衬底基板10的一侧。例如，辅助电极块Ae的形状与第二驱动电极块De2的形状不相同，也就是说，位于第一子像素G1的像素电路的驱动电路的控制端的远离衬底基板10的一侧的第一子像素G1的阳极部分的形状与位于第二子像素G2的像素电路的驱动电路的控制端的远离衬底基板10的一侧的第二子像素G2的阳极部分的形状不相同。
例如，如图3A所示，每个子像素的像素电路121的驱动电路122包括驱动晶体管T1。辅助电极块Ae位于第一子像素G1的像素电路的驱动晶体管T1的栅极的远离衬底基板10的一侧，第二驱动电极块De2位于第二子像素G2的像素电路的驱动晶体管T1的栅极的远离衬底基板10的一侧。
例如，辅助电极块Ae在衬底基板上的正投影与第一子像素G1的像素电路的驱动晶体管T1的栅极在衬底基板上的正投影至少部分重叠，第二驱动电极块De2在衬底基板上的正投影与第二子像素G2的像素电路的驱动晶体管T1的栅极在衬底基板上的正投影至少部分重叠。
例如，辅助电极块Ae在衬底基板上的正投影与第一子像素G1的像素电路的驱动晶体管T1的栅极在衬底基板上的正投影的重叠部分的面积为第一面积，第二驱动电极块De2在衬底基板上的正投影与第二子像素G2的像素电路的驱动晶体管T1的栅极在衬底基板上的正投影的重叠部分的面积为第二面积，第一面积和第二面积的比值满足以下关系式：
Amin≤AR1/AR2≤Amax，
其中，AR1表示第一面积，AR2表示第二面积，Amin表示最小比值阈值，且为90％，Amax表示最大比值阈值，且为110％。
例如，如图6A和图6B所示，第一驱动电极块De1的形状和辅助电极块Ae的形状不相同，第一驱动电极块De1的形状与第二驱动电极块De2的形状相同，例如，第一驱动电机块De1的形状和第二驱动电极块De2的形状均可以为五边形，辅助电极块Ae的形状可以为矩形。但本公开不限于此，第一驱动电机块De1的形状和第二驱动电极块De2的形状也可以为矩形等，辅助电极块Ae的形状也可以为五边形、六边形、椭圆形等。
例如，第一驱动电极块De1在衬底基板10上的正投影的面积与第二驱动电极块De2在衬底基板10上的正投影的面积相同。
例如，如图6A和图6B所示，第一连接电极块Ce1的形状与第二连接电极块Ce2的形状也可以相同，例如，第一连接电极块Ce1的形状与第二连接电极块Ce2的形状均可以为矩形。
例如，第一连接电极块Ce1在衬底基板10上的正投影的面积与第二连接电极块Ce2在衬底基板10上的正投影的面积相同。
需要说明的是，在本公开的一些实施例中，第一连接电极块Ce1的形状与第二连接电极块Ce2的形状也可以不相同，和/或，第一连接电极块Ce1在衬底基板10上的正投影的面积与第二连接电极块Ce2在衬底基板10上的正投影的面积也可以不相同。
例如，如图6B所示，第一子像素G1的像素电路的驱动电路的控制端和第二子像素G2的像素电路的驱动电路的控制端沿第一方向X排布，也就是说，第一子像素G1的像素电路的驱动晶体管T1的栅极和第二子像素G2的像素电路的驱动晶体管T1的栅极沿第一方向X排布。
例如，如图6B所示，在第一方向X上，第一驱动电极块De1位于第一子像素G1的像素电路的驱动电路的控制端靠近第二子像素G2的像素电路的驱动电路的控制端的一侧。例如，在一些示例中，如图6B所示，在第一方向X上，第一驱动电极块De1位于第一子像素G1的像素电路的驱动电路的控制端和第二子像素G2的像素电路的驱动电路的控制端之间。
例如，如图6B所示，在第一方向X上，第一连接电极块Ce1位于第一驱动电极块De1的远离第二子像素G2的像素电路的驱动电路的控制端的一侧。例如，在第一方向X上，第一连接电极块Ce1位于第一子像素G1的像素电路的驱动电路的控制端和第二子像素G2的像素电路的驱动电路的控制端之间。也就是说，在第一方向X上，第一连接电极块Ce1和第一驱动电极块De1均位于第一子像素G1的像素电路的驱动电路的控制端和第二子像素G2的像素电路的驱动电路的控制端之间。
例如，在第一方向X上，第一连接电极块Ce1位于第一驱动电极块De1的远离第二驱动电极块De2的一侧，也就是说，第一驱动电极块De1位于第一连接电极块Ce1和第二驱动电极块De2之间。
例如，在第一方向X上，第一连接电极块Ce1位于第一驱动电极块De1和辅助电极块Ae之间，也就是说，辅助电极块Ae位于第一连接电极块Ce1的远离第一驱动电极块De1的一侧。
例如，在第一方向X上，第二连接电极块Ce2位于第二子像素G2的像素电路的驱动电路的控制端的远离第一子像素G1的像素电路的驱动电路的控制端的一侧。
例如，在第一方向X上，第二驱动电极块De2位于第二连接电极块Ce2和第一驱动电极块De1之间，即第二连接电极块Ce2位于第二驱动电极块De2的远离第一驱动电极块De1的一侧。
例如，如图5A所示，多个子像素12还包括第三子像素R和第四子像素B。例如，第三子像素R的发光元件的第一发光电压施加电极和第四子像素B的发光元件的第一发光电压施加电极沿第二方向Y排布。第一方向X和第二方向Y相互垂直。
例如，如图6A所示，第三子像素R的发光元件的第一发光电压施加电极包括第三驱动电极块De3和第三连接电极块Ce3，第三驱动电极块De3和第三连接电极块Ce3彼此电连接。例如，第三驱动电极块De3在衬底基板上的正投影与第三子像素R的像素电路的驱动电路的控制端在衬底基板上的正投影至少部分重叠。
例如，如图6A所示，第四子像素B的发光元件的第一发光电压施加电极包括第四驱动电极块De4和第四连接电极块Ce4，第四驱动电极块De4和第四连接电极块Ce4彼此电连接。例如，如图6B示，第四驱动电极块De4位于第四子像素B的像素电路的驱动电路的控制端的远离衬底基板10的一侧，例如，第四驱动电极块De4在衬底基板上的正投影与第四子像素B的像素电路的驱动电路的控制端在衬底基板上的正投影至少部分重叠。
例如，在第一方向X上，第一子像素G1的像素电路的驱动电路的控制端(即驱动晶体管的栅极)的中心和第一驱动电极块De1的中心之间的距离大于第二子像素G2的像素电路的驱动电路的控制端的中心和第二驱动电极块De2的中心之间的距离。
需要说明的是，在本公开中，“中心”可以表示元件的物理形状的几何中心。在对像素排列结构进行设计时，驱动晶体管的栅极、发光元件的阳极等元件一般会设计为规则的形状，比如，矩形、六边形、五边形、梯形或其他形状。在进行设计时，元件(例如，驱动晶体管的栅极或发光元件的阳极等)的中心可以是上述规则形状的几何中心。然而，在实际制造工艺中，所形成的驱动晶体管的栅极、发光元件的阳极等元件的形状一般会与上述设计的规则形状有一定的偏差。例如，上述规则的形状的各个角可能会变成圆角，因此，驱动晶体管的栅极、发光元件的阳极等元件的形状可以为圆角图形。此外，实际制造的驱动晶体管的栅极、发光元件的阳极等元件的形状还可能会与设计的形状有其他的变化。例如，设计为六边形的子像素的形状在实际制造中可能变成近似椭圆形。因此，驱动晶体管的栅极、发光元件的阳极等元件的中心也可能并非制作形成的子像素的不规则形状的严格的几何中心。在本公开的实施例中，元件的中心可以与元件的形状的几何中心有一定的偏移量。此外，“中心”也可以表示元件的重心。
本公开的实施例还提供一种显示基板。如图2所示，显示基板100包括衬底基板10和设置在衬底基板10上的多个重复单元11，每个重复单元11包括多个子像素12。每个子像素12包括发光元件120和像素电路121，像素电路121用于驱动发光元件120发光。
例如，每个子像素的发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在第一发光电压施加电极和第二发光电压施加电极之间的发光层。
例如，如图3A所示，每个子像素的像素电路121包括驱动电路122、第二发光控制电路124和复位电路129。
例如，第二发光控制电路124电连接至第二发光控制信号线EM2、驱动电路122的第二端、发光元件120的第一发光电压施加电极，且被配置为在第二发光控制信号线EM2提供的第二发光控制信号的控制下实现驱动电路122和发光元件120之间的连接导通或断开。
复位电路129电连接至驱动电路122的控制端和第一复位控制信号线Rst1，且配置为在第一复位控制信号线Rst1提供的第一子复位控制信号的控制下对驱动电路122的控制端进行复位。
例如，第二发光控制信号线EM2和第一复位控制信号线Rst1沿第一方向X排布。如图4B所示，对于第一子像素G1，与该第一子像素G1的第二发光控制电路连接的第二发光控制信号线EM2a和与该第一子像素G1的复位电路连接的第一复位控制信号线Rst1a沿第一方向X排布。
例如，如图5A所示，多个子像素12包括第一子像素G1和第二子像素G2。例如，第一子像素G1的发光元件发出的光的颜色和第二子像素G2的发光元件发出的光的颜色相同，第一子像G1素的发光元件的第一发光电压施加电极的形状和第二子像素G2的发光元件的第一发光电压施加电极的形状不相同。
例如，如图6B所示，第一子像素G1的发光元件的第一发光电压施加电极在衬底基板上的正投影和与第二子像素G2的像素电路的复位电路连接的第一复位控制信号线Rst1b在衬底基板上的正投影、与第一子像素G1的像素电路的第二发光控制电路连接的第二发光控制信号线EM2a在衬底基板上的正投影均至少部分重叠，第二子像素G2的发光元件的第一发光电压施加电极在衬底基板上的正投影和与第二子像素G2的像素电路的第二发光控制电路连接的第二发光控制信号线EM2b在衬底基板上的正投影至少部分重叠。
例如，如图3A所示，复位电路129还电连接至发光元件的第一发光电压施加电极和第二复位控制信号线Rst2，且配置为在第二复位控制信号线Rst2提供的第二子复位控制信号的控制下对发光元件的第一发光电压施加电极进行复位。例如，在一些实施例中，第一复位控制信号线Rst1和第二复位控制信号线Rst2为同一条信号线。
例如，如图3A所示，每个子像素的像素电路121还包括数据写入电路126，数据写入电路126电连接至驱动电路122的第一端和第一扫描信号线Ga1，且被配置为在第一扫描信号线Ga1提供的扫描信号的控制下将数据信号写入驱动电路122的控制端。
例如，在第一方向X上，第一扫描信号线Ga1位于第二发光控制信号线EM1和第一复位控制信号线Rst1之间，如图4B所示，对于第一子像素G1，与该第一子像素G1的数据写入电路连接的第一扫描信号线Ga1a位于与该第一子像素G1的第二发光控制电路连接的第二发光控制信号线EM2a和与该第一子像素G1的复位电路连接的第一复位控制信号线Rst1a之间。
例如，如图6A所示，第一子像素G1的发光元件的第一发光电压施加电极和第二子像素G2的发光元件的第一发光电压施加电极沿第一方向X排布。
例如，如图6B所示，在第一方向X上，与第二子像素G2的像素电路的数据写入电路连接的第一扫描信号线Ga1b位于第一子像素G1的发光元件的第一发光电压施加电极和第二子像素G2的发光元件的第一发光电压施加电极之间。
例如，每个子像素的复位电路129还与第一复位电源信号线电连接，复位电路129配置为在第一复位控制信号线提供的第一子复位控制信号的控制下根据第一复位电源信号线提供的第一复位信号对驱动电路1222的控制端进行复位。
例如，每个子像素的复位电路129还与第二复位电源信号线电连接，复位电路129配置为在第二复位控制信号线提供的第二子复位控制信号的控制下根据第二复位电源信号线提供的第二复位信号对发光元件的第一发光电压施加电极进行复位。例如，在一些实施例中，第一复位电源信号线和第二复位电源信号线为同一条信号线。
例如，在第一方向X上，第一复位电源信号线位于第一复位控制信号线的远离第二发光控制信号线的一侧，也就是说，第一复位控制信号线位于第一复位电源信号线和第二发光控制信号线。如图4E所示，对于第一子像素G1，在第一方向X上，与该第一子像素G1的复位电路连接的第一复位电源信号线Init1a位于与该第一子像素G1的复位电路连接的第一复位控制信号线Rst1a的远离与该第一子像素G1的第二发光控制电路连接的第二发光控制信号线EM2a的一侧，即第一复位控制信号线Rst1a位于第一复位电源信号线Init1a和第二发光控制信号线EM2a之间。
例如，第二发光控制信号线、第一复位控制信号线、第一扫描信号线和第一复位电源信号线均沿第二方向延伸，第二方向与第一方向相互垂直。例如，第二发光控制信号线、第一复位控制信号线、第一扫描信号线和第一复位电源信号线彼此平行，例如，大致平行。如图4E所示，对于第一子像素G1，与该第一子像素G1的第二发光控制电路连接的第二发光控制信号线EM2a、与该第一子像素G1的复位电路连接的第一复位控制信号线Rst1a、与该第一子像素G1的数据写入电路连接的第一扫描信号线Ga1a和与该第一子像素G1的复位电路连接的第一复位电源信号线Init1a均沿第二方向Y延伸，且彼此大致平行。
需要说明的是，在本公开中，“延伸”表示各条信号线(例如，第二发光控制信号线、第一复位控制信号线、第一扫描信号线和第一复位电源信号线)大体上的走线方向，各条信号线在微观上可能并不是直线，而是呈波浪状沿第二方向Y延伸。
例如，如图6B所示，第一子像素G1的发光元件的第一发光电压施加电极在衬底基板上的正投影还和与第二子像素G2的像素电路的复位电路连接的第一复位电源信号线Rst1b在衬底基板上的正投影至少部分重叠。
例如，如图6A所示，第一子像素G1的发光元件的第一发光电压施加电极包括辅助电极块Ae、第一驱动电极块De1和第一连接电极块Ce1，辅助电极块Ae、第一驱动电极块De1和第一连接电极块Ce1彼此电连接，且沿第一方向X排布。第二子像素G2的发光元件的第一发光电压施加电极包括第二驱动电极块De2和第二连接电极块Ce2，第二驱动电极块De2和第二连接电极块Ce2电连接，且沿第一方向X排布。
例如，在第一方向X上，第一连接电极块Ce1和辅助电极Ae块均位于第一驱动电极块De1的远离第二驱动电极块De2的一侧，第一连接电极块Ce1位于辅助电极Ae和第一驱动电极块De1之间，第二连接电极块Ce2位于第二驱动电极块De2的远离第一驱动电极块De1的一侧。
例如，如图6B所示，第一驱动电极块De1在衬底基板上的正投影和与第二子像素G2的像素电路的复位电路连接的第一复位控制信号线Rst1b在衬底基板上的正投影、与第二子像素G2的像素电路的复位电路连接的第一复位电源信号线Init1b在衬底基板上的正投影均至少部分重叠，第一连接电极块Ce1在衬底基板上的正投影和与第一子像素G1的像素电路的第二发光控制电路连接的第二发光控制信号线EM1a在衬底基板上的正投影至少部分重叠。在第一方向上，辅助电极块Ae位于与第一子像素G1的像素电路的第二发光控制电路连接的第二发光控制信号线EM1a的远离第二子像素G2的发光元件的第一发光电压施加电极的一侧。
例如，如图6B所示，第二连接电极块Ce2在衬底基板上的正投影和与第二子像素G2的像素电路的第二发光控制电路连接的第二发光控制信号线EM1b在衬底基板上的正投影至少部分重叠，在第一方向X上，第二驱动电极块De2位于与第二子像素G2的像素电路的第二发光控制电路连接的第二发光控制信号线EM1b和与第二子像素G2的像素电路的数据写入电路连接的第一扫描信号线Ga1b之间。
本公开的实施例还提供一种显示面板。图7为本公开一些实施例提供的一种显示面板的局部结构示意图。例如，如图7所示，显示面板700包括上述任一实施例所述的显示基板100。
例如，如图7所示，多个重复单元11沿第二方向Y排列以形成多个重复单元组，图7示出了两个重复单元组，且两个重复单元组分别为第P个重复单元组和第P+1个重复单元组，第P个重复单元组和第P+1个重复单元组为相邻的两个重复单元组，例如，P为大于等于1的正整数。多个重复单元组沿第一方向X排列。也就是说，显示基板100中的多个重复单元11沿第一方向X和第二方向Y呈阵列排布。
需要说明的是，参考上面的图5A和图6E，第P个重复单元组位于第一行，第P+1个重复单元组位于第二行，图7中并没有示出各个子像素的发光元件的连接电极块。
例如，第P个重复单元组中的重复单元的第一子像素G1和第二子像素G2的中心的连线的延长线和第P+1个重复单元组中的重复单元的第一子像素G1和第二子像素G2的中心的连线的延长线不重合。例如，第P个重复单元组中的重复单元的第一子像素G1和第二子像素G2的中心的连线的延长线穿过第P+1个重复单元组中相邻两个重复单元之间的间隔的中心，类似地，第P+1个重复单元组中的重复单元的第一子像素G1和第二子像素G2的中心的连线的延长线穿过第P个重复单元组中相邻两个重复单元之间的间隔的中心。
例如，显示面板700可以为液晶显示面板或有机发光二极管(OLED)显示面板等。例如，当显示面板700为液晶显示面板时，显示基板100可以为阵列基板，也可以为彩膜基板。当显示面板700为有机发光二极管显示面板时，显示基板100可以为阵列基板。
例如，显示面板700可以为矩形面板、圆形面板、椭圆形面板或多边形面板等。另外，显示面板700不仅可以为平面面板，也可以为曲面面板，甚至球面面板。
例如，显示面板700还可以具备触控功能，即显示面板600可以为触控显示面板。
例如，显示面板700可以应用于手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件中。
本公开的实施例还提供一种显示装置，图8A为本公开一些实施例提供的一种显示装置的示意性框图，图8B为本公开一些实施例提供的一种显示装置的结构示意图。
例如，如图8A所示，本公开实施例提供的显示装置800包括显示面板801，显示面板801包括显示基板802，显示面板801为上述任一实施例所述的显示面板700，显示基板802为上述任一实施例所述的显示基板100。
例如，如图8A所示，显示装置800还可以包括驱动芯片803，驱动芯片803与显示面板801电连接。
例如，驱动芯片803位于每个重复单元11中的第一子像素G1的远离第二子像素G2的一侧。如图8B所示，显示基板802上的每个重复单元11中的第一子像素G1和第二子像素G2沿第一方向X排列，在第一方向X上，驱动芯片803位于每个重复单元11中的第一子像素G1的远离第二子像素G2的一侧。也就是说，在第一方向X上，第一子像素G1与驱动芯片803之间的距离小于第二子像素G2与驱动芯片803之间的距离。例如，在图8B所示的示例中，相对于第二子像素G2，第一子像素G1更靠近显示面板801的上侧，从而驱动芯片803可以位于显示面板801的上侧。
例如，驱动芯片803可以为半导体芯片，且可以包括数据驱动器。驱动芯片803中的数据驱动器用于驱动显示面板801中的多条数据线，例如，数据驱动器可以向多条数据线提供数据信号。
例如，显示装置800可以为手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。
需要说明的是，对于该显示装置800的其它组成部分(例如控制装置、图像数据编码/解码装置、栅极驱动器、定时控制器、时钟电路等)均为本领域的普通技术人员应该理解具有的，在此不做赘述，也不应作为对本发明的限制。
本公开的实施例还提供一种用于制备根据上述任一实施例所述的显示基板的制备方法，图9为本公开一实施例提供的一种显示基板的制备方法的示意性流程图。
例如，如图9所示，显示基板的制备方法可以包括：
S10：提供衬底基板，
S11：在衬底基板上形成多个重复单元。
例如，在步骤S11中，每个重复单元包括多个子像素，每个子像素包括像素电路和发光元件，发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在第一发光电压施加电极和第二发光电压施加电极之间的发光层，多个子像素包括第一子像素和第二子像素，第一子像素的发光元件发出的光的颜色和第二子像素的发光元件发出的光的颜色相同，第一子像素的发光元件的第一发光电压施加电极的形状和第二子像素的发光元件的第一发光电压施加电极的形状不相同，第一子像素的发光元件的第一发光电压施加电极在衬底基板上的正投影与第一子像素的像素电路的驱动电路的控制端在衬底基板上的正投影至少部分重叠，第二子像素的发光元件的第一发光电压施加电极在衬底基板上的正投影与第二子像素的像素电路的驱动电路的控制端在衬底基板上的正投影至少部分重叠。
例如，在步骤S11中，在形成第一子像素的发光元件的第一发光电压施加电极时，通过一次构图工艺形成第一驱动电极块和辅助电极块，且辅助电极块在衬底基板上的正投影与第一子像素的像素电路的驱动电路的控制端在衬底基板上的正投影至少部分重叠，例如，第一子像素的像素电路的驱动电路的控制端在衬底基板上的正投影位于辅助电极块在衬底基板上的正投影内。例如，在本公开的实施例中，一次构图工艺可以包括：光刻涂覆、曝光、显影、刻蚀和光刻胶剥离等操作。
需要说明的是，当第一发光电压施加电极包括第一连接电极块时，在形成第一驱动电极块和辅助电极块的同时，还可以形成第一连接电极块。
例如，在步骤S11中，在形成第二子像素的发光元件的第一发光电压施加电极时，形成第二驱动电极块，且第二驱动电极块在衬底基板上的正投影与第二子像素的像素电路的驱动电路的控制端在衬底基板上的正投影至少部分重叠，例如，第二子像素的像素电路的驱动电路的控制端在衬底基板上的正投影位于第二驱动电极块在衬底基板上的正投影内。
需要说明的是，当第二发光电压施加电极包括第二连接电极块时，可以通过一次构图工艺形成第二驱动电极块和第二连接电极块。
值得注意的是，关于重复单元的详细说明可以参考上述显示基板的实施例中的相关描述，重复之处在此不再赘述。
对于本公开，还有以下几点需要说明：
(1)本公开实施例附图只涉及到与本公开实施例涉及到的结构，其他结构可参考通常设计。
(2)为了清晰起见，在用于描述本发明的实施例的附图中，层或结构的厚度和尺寸被放大。可以理解，当诸如层、膜、区域或基板之类的元件被称作位于另一元件“上”或“下”时，该元件可以“直接”位于另一元件“上”或“下”，或者可以存在中间元件。
(3)在不冲突的情况下，本公开的实施例及实施例中的特征可以相互组合以得到新的实施例。
以上所述仅为本公开的具体实施方式，但本公开的保护范围并不局限于此，本公开的保护范围应以所述权利要求的保护范围为准。

Claims (48)

1.一种显示基板，包括衬底基板和设置在所述衬底基板上的多个重复单元，
其中，每个所述重复单元包括多个子像素，每个所述子像素包括发光元件和驱动所述发光元件发光的像素电路，
所述像素电路包括驱动电路，
所述发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在所述第一发光电压施加电极和所述第二发光电压施加电极之间的发光层，
所述多个子像素包括第一子像素和第二子像素，所述第一子像素的发光元件发出的光的颜色和所述第二子像素的发光元件发出的光的颜色相同，所述第一子像素的发光元件的第一发光电压施加电极的形状和所述第二子像素的发光元件的第一发光电压施加电极的形状不相同，
所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影与所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠，
所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影与所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠。
2.根据权利要求1所述的显示基板，其中，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的面积和所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的面积不相同。
3.根据权利要求1所述的显示基板，其中，所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影和所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的重叠部分的面积为第一面积，所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影和所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的重叠部分的面积为第二面积，
所述第一面积和所述第二面积的比值满足以下关系式：
Amin≤A1/A2≤Amax，
其中，A1表示所述第一面积，A2表示所述第二面积，Amin表示最小比值阈值，且为90％，Amax表示最大比值阈值，且为110％。
4.根据权利要求1-3任一项所述的显示基板，其中，所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影位于所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影内；
所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影位于所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影内。
5.根据权利要求1-3任一项所述的显示基板，其中，所述第一子像素的发光元件的发光层在所述衬底基板上的正投影与所述第二子像素的发光元件的发光层在所述衬底基板上的正投影是连续的。
6.根据权利要求1-3任一项所述的显示基板，其中，所述像素电路还包括第一发光控制电路和第二发光控制电路，
所述驱动电路包括控制端、第一端和第二端，且被配置为为所述发光元件提供驱动所述发光元件发光的驱动电流；
所述第一发光控制电路与所述驱动电路的第一端和第一电压端连接，且被配置为实现所述驱动电路和所述第一电压端之间的连接导通或断开，
所述第二发光控制电路与所述驱动电路的第二端和所述发光元件的第一发光电压施加电极电连接，且被配置为实现所述驱动电路和所述发光元件之间的连接导通或断开。
7.根据权利要求6所述的显示基板，其中，所述第一子像素的像素电路还包括第一寄生电路，所述第二子像素的像素电路还包括第二寄生电路，
所述第一寄生电路与所述第一子像素的像素电路的驱动电路的控制端和所述第一子像素的发光元件的第一发光电压施加电极电连接，且被配置为基于所述第一子像素的发光元件的第一发光电压施加电极的电压控制所述第一子像素的像素电路的驱动电路的控制端的电压，
所述第二寄生电路与所述第二子像素的像素电路的驱动电路的控制端和所述第二子像素的发光元件的第一发光电压施加电极电连接，且被配置为基于所述第二子像素的发光元件的第一发光电压施加电极的电压控制所述第二子像素的像素电路的驱动电路的控制端的电压。
8.根据权利要求7所述的显示基板，其中，所述第一寄生电路包括第一电容，所述第一电容包括第一极和第二极，
所述第一子像素的发光元件的第一发光电压施加电极包括辅助电极块，所述辅助电极块在所述衬底基板上的正投影与所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠，
所述辅助电极块作为所述第一电容的第一极，所述第一子像素的驱动电路的控制端复用为所述第一电容的第二极。
9.根据权利要求8所述的显示基板，其中，所述第一子像素的发光元件的第一发光电压施加电极还包括第一驱动电极块，所述第一驱动电极块和所述辅助电极块电连接，
所述第一驱动电极块在所述衬底基板上的正投影、所述第一子像素的发光元件的发光层在所述衬底基板上的正投影和所述第一子像素的发光元件的第二发光电压施加电极在所述衬底基板上的正投影至少部分重叠。
10.根据权利要求9所述的显示基板，其中，所述第二寄生电路包括第二电容，所述第二电容包括第一极和第二极，
所述第二子像素的发光元件的第一发光电压施加电极包括第二驱动电极块，所述第二驱动电极块在所述衬底基板上的正投影与所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠，
所述第二驱动电极块在所述衬底基板上的正投影、所述第二子像素的发光元件的发光层在所述衬底基板上的正投影和所述第二子像素的发光元件的第二发光电压施加电极在所述衬底基板上的正投影至少部分重叠，
所述第二驱动电极块复用为所述第二电容的第一极，所述第二子像素的驱动电路的控制端复用为所述第二电容的第二极。
11.根据权利要求10所述的显示基板，其中，所述第一驱动电极块的形状与所述第二驱动电极块的形状相同，所述第一驱动电极块在所述衬底基板上的正投影的面积与所述第二驱动电极块在所述衬底基板上的正投影的面积相同。
12.根据权利要求10所述的显示基板，其中，在所述每个重复单元中，所述第一子像素和所述第二子像素沿第一方向排列，所述第一方向平行于所述衬底基板的表面，
在所述第一方向上，所述辅助电极块位于所述第一驱动电极块的远离所述第二子像素的发光元件的一侧。
13.根据权利要求8所述的显示基板，其中，所述辅助电极块在所述衬底基板上的正投影与所述第一子像素的发光元件的发光层在所述衬底基板上的正投影不重叠。
14.根据权利要求12所述的显示基板，其中，所述第一子像素的发光元件的第一发光电压施加电极还包括第一连接电极块，
在所述第一方向上，所述第一连接电极块位于所述第一驱动电极块的远离所述第二子像素的发光元件的一侧，所述第一连接电极块位于所述辅助电极块和所述第一驱动电极块之间，且与所述辅助电极块和所述第一驱动电极块均电连接。
15.根据权利要求14所述的显示基板，还包括中间层，
其中，在垂直于所述衬底基板的表面的方向上，所述像素电路位于所述中间层和所述衬底基板之间，所述发光元件位于所述中间层的远离所述衬底基板的一侧，
所述中间层包括第一过孔，所述第一连接电极块延伸至所述第一过孔且通过所述第一过孔与所述第一子像素的像素电路电连接。
16.根据权利要求15所述的显示基板，其中，所述第二子像素的发光元件的第一发光电压施加电极还包括第二连接电极块，所述第二连接电极块与所述第二驱动电极块电连接，
在所述第一方向上，所述第二连接电极块位于所述第二驱动电极块的远离所述第一子像素的发光元件的一侧。
17.根据权利要求16所述的显示基板，其中，
所述中间层包括第二过孔，所述第二连接电极块延伸至所述第二过孔且通过所述第二过孔与所述第二子像素的像素电路电连接。
18.根据权利要求17所述的显示基板，其中，所述第一连接电极块通过所述第一过孔与所述第一子像素的像素电路的第二发光控制电路电连接，所述第二连接电极块通过所述第二过孔与所述第二子像素的像素电路的第二发光控制电路电连接。
19.根据权利要求17所述的显示基板，其中，所述像素电路包括有源半导体层、栅极金属层和源漏极金属层，在垂直于所述衬底基板的方向上，所述有源半导体层位于所述衬底基板与所述栅极金属层之间，所述栅极金属层位于所述有源半导体层和所述源漏极金属层之间，
所述第一连接电极块通过所述第一过孔延伸到所述像素电路的源漏极金属层，
所述第二连接电极块通过所述第二过孔延伸到所述像素电路的源漏极金属层。
20.根据权利要求16所述的显示基板，其中，所述多个子像素还包括第三子像素和第四子像素，
其中，在所述每个重复单元中，所述第三子像素和所述第四子像素沿第二方向排列，且在所述第二方向上，所述第一子像素和所述第二子像素位于所述第三子像素和所述第四子像素之间，
所述第二方向平行于所述衬底基板的表面，且所述第一方向和所述第二方向相互垂直。
21.根据权利要求20所述的显示基板，其中，所述第三子像素的发光元件的第一发光电压施加电极包括彼此电连接的第三驱动电极块和第三连接电极块，所述第四子像素的发光元件的第一发光电压施加电极包括彼此电连接的第四驱动电极块和第四连接电极块，
所述中间层包括第三过孔和第四过孔，所述第三连接电极块延伸至所述第三过孔且通过所述第三过孔与所述第三子像素的像素电路电连接，所述第四连接电极块延伸至所述第四过孔且通过所述第四过孔与所述第四子像素的像素电路电连接。
22.根据权利要求21所述的显示基板，其中，在所述每个重复单元中，
在所述第一方向上，所述第三连接电极位于所述第三驱动电极块的远离所述辅助电极块的一侧，在所述第二方向上，所述第三连接电极位于所述第三驱动电极块的靠近所述第四驱动电极块的一侧，
在所述第一方向上，所述第四连接电极位于所述第四驱动电极块的远离所述辅助电极块的一侧，在所述第二方向上，所述第四连接电极位于所述第四驱动电极块的靠近所述第三驱动电极块的一侧。
23.根据权利要求21所述的显示基板，其中，所述第三连接电极块通过所述第三过孔与所述第三子像素的像素电路的第二发光控制电路电连接，
所述第四连接电极块通过所述第四过孔与所述第四子像素的像素电路的第二发光控制电路电连接。
24.根据权利要求21所述的显示基板，其中，所述多个重复单元沿所述第二方向排列以形成多个重复单元组，所述多个重复单元组沿所述第一方向排列，
在所述第一方向上，所述第一连接电极块、所述第二连接电极块、所述第三连接电极块和所述第四连接电极块位于相邻两个重复单元组之间，
在所述第一方向上，所述辅助电极块的至少一部分位于在所述辅助电极块远离所述第一驱动电极块的一侧且与所述辅助电极块所在的重复单元组相邻的重复单元组中的相邻两个重复单元之间。
25.根据权利要求20所述的显示基板，其中，所述第一子像素和所述第二子像素均为绿色子像素，所述第三子像素为红色子像素，所述第四子像素为蓝色子像素。
26.根据权利要求6所述的显示基板，其中，所述像素电路还包括数据写入电路、存储电路、阈值补偿电路和复位电路，
所述数据写入电路与所述驱动电路的第一端电连接，且被配置为在扫描信号的控制下将数据信号写入所述存储电路；
所述存储电路与所述驱动电路的控制端和所述第一电压端电连接，且被配置为存储所述数据信号；
所述阈值补偿电路与所述驱动电路的控制端和第二端电连接，且被配置为对所述驱动电路进行阈值补偿；
所述复位电路与所述驱动电路的控制端和所述发光元件的第一发光电压施加电极电连接，且配置为在复位控制信号的控制下对所述驱动电路的控制端和所述发光元件的第一发光电压施加电极进行复位。
27.根据权利要求26所述的显示基板，其中，所述驱动电路包括驱动晶体管，所述驱动电路的控制端包括所述驱动晶体管的栅极，所述驱动电路的第一端包括所述驱动晶体管的第一极，所述驱动电路的第二端包括所述驱动晶体管的第二极，
所述数据写入电路包括数据写入晶体管，所述存储电路包括第三电容，所述阈值补偿电路包括阈值补偿晶体管，所述复位电路包括第一复位晶体管和第二复位晶体管，所述第一发光控制电路包括第一发光控制晶体管，所述第二发光控制电路包括第二发光控制晶体管，所述复位控制信号包括第一子复位控制信号和第二子复位控制信号，
所述数据写入晶体管的第一极与所述驱动晶体管的第一极电连接，所述数据写入晶体管的第二极被配置为接收所述数据信号，所述数据写入晶体管的栅极被配置为接收所述扫描信号；
所述第三电容的第一极与所述第一电源端电连接，所述第三电容的第二极与所述驱动晶体管的栅极电连接；
所述阈值补偿晶体管的第一极与所述驱动晶体管的第二极电连接，所述阈值补偿晶体管的第二极与所述驱动晶体管的栅极电连接，所述阈值补偿晶体管的栅极被配置为接收补偿控制信号；
所述第一复位晶体管的第一极被配置为接收第一复位信号，所述第一复位晶体管的第二极与所述驱动晶体管的栅极电连接，所述第一复位晶体管的栅极被配置为接收所述第一子复位控制信号；
所述第二复位晶体管的第一极被配置为接收第二复位信号，所述第二复位晶体管的第二极与所述发光元件的第一发光电压施加电极电连接，所述第二复位晶体管的栅极被配置为接收所述第二子复位控制信号；
所述第一发光控制晶体管的第一极与所述第一电源端电连接，所述第一发光控制晶体管的第二极与所述驱动晶体管的第一极电连接，所述第一发光控制晶体管的栅极被配置为接收第一发光控制信号，
所述第二发光控制晶体管的第一极与所述驱动晶体管的第二极电连接，所述第二发光控制晶体管的第二极与所述发光元件的第一发光电压施加电极电连接，所述第二发光控制晶体管的栅极被配置为接收第二发光控制信号。
28.一种显示面板，包括根据权利要求1-27任一项所述的显示基板。
29.一种显示装置，包括：根据权利要求28所述的显示面板。
30.根据权利要求29所述的显示装置，还包括：驱动芯片，
其中，所述驱动芯片与所述显示面板电连接，且所述驱动芯片位于每个所述重复单元中的第一子像素的远离第二子像素的一侧。
31.根据权利要求29所述的显示装置，其中，在每个所述重复单元中，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的面积大于所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影的面积。
32.一种用于制备根据权利要求1-27任一项所述的显示基板的制备方法，包括：
提供所述衬底基板，
在所述衬底基板上形成所述多个重复单元，其中，每个所述重复单元包括多个子像素，每个所述子像素包括像素电路和发光元件，所述发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在所述第一发光电压施加电极和所述第二发光电压施加电极之间的发光层，所述多个子像素包括第一子像素和第二子像素，所述第一子像素的发光元件发出的光的颜色和所述第二子像素的发光元件发出的光的颜色相同，所述第一子像素的发光元件的第一发光电压施加电极的形状和所述第二子像素的发光元件的第一发光电压施加电极的形状不相同，所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影与所述第一子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠，所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影与所述第二子像素的像素电路的驱动电路的控制端在所述衬底基板上的正投影至少部分重叠。
33.一种显示基板，包括衬底基板和设置在所述衬底基板上的多个重复单元，
其中，每个所述重复单元包括多个子像素，每个所述子像素包括发光元件和驱动所述发光元件发光的像素电路，所述像素电路包括驱动电路，所述发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在所述第一发光电压施加电极和所述第二发光电压施加电极之间的发光层，
所述多个子像素的驱动电路在所述衬底基板上阵列排布，
所述多个子像素包括第一子像素和第二子像素，所述第一子像素的发光元件发出的光的颜色和所述第二子像素的发光元件发出的光的颜色相同，
所述第一子像素的发光元件的第一发光电压施加电极包括辅助电极块、第一驱动电极块和第一连接电极块，所述第一驱动电极块、所述辅助电极块和所述第一连接电极块彼此电连接，
所述第二子像素的发光元件的第一发光电压施加电极包括第二驱动电极块和第二连接电极块，所述第二驱动电极块和所述第二连接电极块电连接，
所述辅助电极块位于所述第一子像素的像素电路的驱动电路的控制端的远离所述衬底基板的一侧，
所述第二驱动电极块位于所述第二子像素的像素电路的驱动电路的控制端的远离所述衬底基板的一侧；
其中，所述第一子像素的像素电路的驱动电路的控制端的中心和所述第一驱动电极块的中心之间的距离大于所述第二子像素的像素电路的驱动电路的控制端的中心和所述第二驱动电极块的中心之间的距离。
34.根据权利要求33所述的显示基板，其中，所述第一驱动电极块的形状和所述辅助电极块的形状不相同，所述第一驱动电极块的形状与所述第二驱动电极块的形状相同，所述第一驱动电极块在所述衬底基板上的正投影的面积与所述第二驱动电极块在所述衬底基板上的正投影的面积相同。
35.根据权利要求33所述的显示基板，其中，所述第一连接电极块的形状与所述第二连接电极块的形状相同，所述第一连接电极块在所述衬底基板上的正投影的面积与所述第二连接电极块在所述衬底基板上的正投影的面积相同。
36.根据权利要求33-35任一项所述的显示基板，其中，所述第一子像素的像素电路的驱动电路的控制端和所述第二子像素的像素电路的驱动电路的控制端沿第一方向排布，
在所述第一方向上，所述第一驱动电极块位于所述第一子像素的像素电路的驱动电路的控制端靠近所述第二子像素的像素电路的驱动电路的控制端的一侧。
37.根据权利要求36所述的显示基板，其中，在所述第一方向上，所述第一驱动电极块位于所述第一子像素的像素电路的驱动电路的控制端和所述第二子像素的像素电路的驱动电路的控制端之间。
38.根据权利要求37所述的显示基板，其中，在所述第一方向上，所述第一连接电极块位于所述第一驱动电极块的远离所述第二子像素的像素电路的驱动电路的控制端的一侧。
39.根据权利要求38所述的显示基板，其中，在所述第一方向上，所述第一连接电极块位于所述第一子像素的像素电路的驱动电路的控制端和所述第二子像素的像素电路的驱动电路的控制端之间。
40.根据权利要求38所述的显示基板，其中，在所述第一方向上，所述第一连接电极块位于所述第一驱动电极块和所述辅助电极块之间。
41.根据权利要求36所述的显示基板，其中，在所述第一方向上，所述第二连接电极块位于所述第二子像素的像素电路的驱动电路的控制端的远离所述第一子像素的像素电路的驱动电路的控制端的一侧，
所述第二驱动电极块位于所述第二连接电极块和所述第一驱动电极块之间。
42.一种显示基板，包括衬底基板和设置在所述衬底基板上的多个重复单元，
其中，每个所述重复单元包括多个子像素，每个所述子像素包括发光元件和驱动所述发光元件发光的像素电路，
所述发光元件包括第一发光电压施加电极、第二发光电压施加电极和设置在所述第一发光电压施加电极和所述第二发光电压施加电极之间的发光层，
所述像素电路包括驱动电路、第二发光控制电路和复位电路，
所述第二发光控制电路电连接至第二发光控制信号线、所述驱动电路的第二端、所述发光元件的第一发光电压施加电极，且被配置为在所述第二发光控制信号线提供的第二发光控制信号的控制下实现所述驱动电路和所述发光元件之间的连接导通或断开，
所述复位电路电连接至所述驱动电路的控制端和第一复位控制信号线，且配置为在所述第一复位控制信号线提供的第一子复位控制信号的控制下对所述驱动电路的控制端进行复位，
所述第二发光控制信号线和所述第一复位控制信号线沿第一方向排布，
所述多个子像素包括第一子像素和第二子像素，
所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影和与所述第二子像素的像素电路的复位电路连接的第一复位控制信号线在所述衬底基板上的正投影、与所述第一子像素的像素电路的第二发光控制电路连接的第二发光控制信号线在所述衬底基板上的正投影均至少部分重叠，
所述第二子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影和与所述第二子像素的像素电路的第二发光控制电路连接的第二发光控制信号线在所述衬底基板上的正投影至少部分重叠。
43.根据权利要求42所述的显示基板，其中，所述像素电路还包括数据写入电路，
所述数据写入电路电连接至所述驱动电路的第一端和第一扫描信号线，且被配置为在所述第一扫描信号线提供的扫描信号的控制下将数据信号写入所述驱动电路的控制端，
在所述第一方向上，所述第一扫描信号线位于所述第二发光控制信号线和所述第一复位控制信号线之间，
所述第一子像素的发光元件的第一发光电压施加电极和所述第二子像素的发光元件的第一发光电压施加电极沿所述第一方向排布，
在所述第一方向上，与所述第二子像素的像素电路的数据写入电路连接的第一扫描信号线位于所述第一子像素的发光元件的第一发光电压施加电极和所述第二子像素的发光元件的第一发光电压施加电极之间。
44.根据权利要求43所述的显示基板，其中，所述复位电路还与第一复位电源信号线电连接，
所述复位电路配置为在所述第一复位控制信号线提供的第一子复位控制信号的控制下根据所述第一复位电源信号线提供的第一复位信号对所述驱动电路的控制端进行复位，
在所述第一方向上，所述第一复位电源信号线位于所述第一复位控制信号线的远离所述第二发光控制信号线的一侧，
所述第一子像素的发光元件的第一发光电压施加电极在所述衬底基板上的正投影还和与所述第二子像素的像素电路的复位电路连接的第一复位电源信号线在所述衬底基板上的正投影至少部分重叠。
45.根据权利要求44所述的显示基板，其中，所述第二发光控制信号线、所述第一复位控制信号线、所述第一扫描信号线和所述第一复位电源信号线均沿第二方向延伸，所述第二方向与所述第一方向相互垂直。
46.根据权利要求44所述的显示基板，其中，所述第二发光控制信号线、所述第一复位控制信号线、所述第一扫描信号线和所述第一复位电源信号线彼此平行。
47.根据权利要求44所述的显示基板，其中，所述第一子像素的发光元件的第一发光电压施加电极包括辅助电极块、第一驱动电极块和第一连接电极块，所述第一驱动电极块、所述辅助电极块和所述第一连接电极块彼此电连接，且沿所述第一方向排布，
所述第二子像素的发光元件的第一发光电压施加电极包括第二驱动电极块和第二连接电极块，所述第二驱动电极块和所述第二连接电极块电连接，且沿所述第一方向排布，
在所述第一方向上，所述第一连接电极块和所述辅助电极块均位于所述第一驱动电极块的远离所述第二驱动电极块的一侧，所述第一连接电极块位于所述辅助电极块和所述第一驱动电极块之间，所述第二连接电极块位于所述第二驱动电极块的远离所述第一驱动电极块的一侧，
所述第一驱动电极块在所述衬底基板上的正投影和与所述第二子像素的像素电路的复位电路连接的第一复位控制信号线在所述衬底基板上的正投影、与所述第二子像素的像素电路的复位电路连接的第一复位电源信号线在所述衬底基板上的正投影均至少部分重叠，
所述第一连接电极块在所述衬底基板上的正投影和与所述第一子像素的像素电路的第二发光控制电路连接的第二发光控制信号线在所述衬底基板上的正投影至少部分重叠，
在所述第一方向上，所述辅助电极块位于与所述第一子像素的像素电路的第二发光控制电路连接的第二发光控制信号线的远离所述第二子像素的发光元件的第一发光电压施加电极的一侧，
所述第二连接电极块在所述衬底基板上的正投影和与所述第二子像素的像素电路的第二发光控制电路连接的第二发光控制信号线在所述衬底基板上的正投影至少部分重叠，
在所述第一方向上，所述第二驱动电极块位于与所述第二子像素的像素电路的第二发光控制电路连接的第二发光控制信号线和与所述第二子像素的像素电路的数据写入电路连接的第一扫描信号线之间。
48.根据权利要求42或43所述的显示基板，其中，所述第一子像素的发光元件发出的光的颜色和所述第二子像素的发光元件发出的光的颜色相同，所述第一子像素的发光元件的第一发光电压施加电极的形状和所述第二子像素的发光元件的第一发光电压施加电极的形状不相同。
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