CN111474200B - 制备电子元件显微结构样品的方法 - Google Patents
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Abstract
本揭示内容涉及电镜样品的制备,提供了一种制备电子元件显微结构样品的方法,包含:获得电子元件样品,其包含可挠性层;经由预处理电子元件样品而获得经预处理的样品,并且经预处理的样品具有待观测区域与第一刚性层,第一刚性层位于可挠性层的下方,其中,当可挠性层位于电子元件样品的上表面时,预处理是夹埋法;或当可挠性层位于电子元件样品之内时,预处理是包埋法其包含:以树脂包埋电子元件样品;以及以离子抛光处理经预处理的样品而得到一截面样品,其中截面样品具有损伤区域和加工区域,并且在截面样品中,待观测区域位于加工区域内。
Description
技术领域
本揭示内容涉及电子显微镜的样品制备技术领域,特别是涉及利用离子抛光仪进行扫描式电子显微镜样品的制备方法。
背景技术
随着电子产品制造技术的更新换代,一些电子产品(例如,触控面板)的主体结构由原先的单一刚性基底逐渐发展为刚性基底与柔性基底相贴合的复合结构,在主流趋势的引导下也亦逐渐向可挠式的单一柔性基底方向发展。因此,对于电子元件结构与材料的解析难度也随之增加。
扫描电镜(亦即扫描式电子显微镜)的截面样品的制备方法主要有玻璃刀脆断截面、液氮低温脆断截面、金相镶嵌研磨截面、和离子抛光研磨截面。其中,玻璃刀脆断仅适用于单一硬质基底;液氮低温脆断仅适用于单一柔性基底,且多膜层柔性基底材料制备时容易出现分层;金相镶埋研磨机械损伤较大,容易造成柔性基底形变。相较而言,离子抛光过程中虽然外力作用最小,但是也存在表层辐照损伤大、柔性基底易变形、加工深度有限等缺陷。
再者,对于刚性基底与柔性基底相互贴合的复合结构样品,习知的制样方式在不进行结构分离的前提下的裁减方法为刚性基底采用玻璃刀脆断,柔性基底采用刀片划断。样品在这样的裁切过程中容易产生结构上的损坏。同时样品的表面膜层的厚度也会影响此方法的可行性。
图1A至图1B为习知的以离子抛光制备扫描电镜的截面样品的示意图。其中,电子元件样品10为一柔性基底,以离子束(例如,氩离子束)20进行离子抛光得到截面样品30。截面样品30包含由表层辐照损伤所造成的损伤区域32和加工区域34,其中损伤区域32为不理想的扫描电镜观察的区域,加工区域34为适合扫描电镜观察的区域。因此,关于柔性基底的结构,习知的制样方式由于柔性基底上下表面无支撑保护层,因此样品上表面裸露,在以离子抛光仪截面时直接与高能离子束接触,表面辐照损伤严重,同时上表面的起伏会造成窗帘效应,影响截面平整度;并且,样品下表面与熔融热熔胶接触,易受热形变。
图2A为习知的以离子抛光制备扫描电镜的电子元件样品的影像,可观察到此样品存在形变。图2B为习知的以离子抛光制备扫描电镜的电子元件样品的影像,可观察到此样品的上表面具有损伤。
发明内容
为解决以离子抛光在制备扫描电镜的截面样品过程中产生损伤与形变而影响样品质量的难题,本揭示内容通过改进利用离子抛光制备截面样品的方法来实现样品的损伤与形变的最小化。
本揭示内容的一些实施方式是提供了一种制备电子元件显微结构样品的方法,包含:获得电子元件样品,其包含可挠性层;经由预处理电子元件样品而获得经预处理的样品,并且经预处理的样品具有待观测区域与第一刚性层,第一刚性层位于可挠性层的下方,其中,当可挠性层位于电子元件样品的上表面时,预处理是夹埋法;或当可挠性层位于电子元件样品之内时,预处理是包埋法其包含:以树脂包埋电子元件样品;以及以离子抛光处理经预处理的样品而得到一截面样品,其中截面样品具有损伤区域和加工区域,并且在截面样品中,待观测区域位于加工区域内。
本揭示内容的实施方式提供的制备电子元件显微结构样品方法的有益效果包括:针对包含可挠性材料层的结构,提供了扫描式电镜需要的截面样品,此截面样品具有减小的形变,并且截面样品中的待观测区域具有低的离子抛光损伤,因此可以得到更高精度解析的电子元件样品的显微结构影像。
附图说明
本揭示内容的各方面,可由以下的详细描述,并与所附图式一起阅读,而得到最佳的理解。值得注意的是,根据产业界的普遍惯例,各个特征并未按比例绘制。事实上,为了清楚地说明和讨论,各个特征的尺寸可能任意地增加或减小。
图1A和图1B是习知的利用离子抛光制备柔性基底样品的示意图。
图2A是以习知的方式利用离子抛光制备的电子元件样品的扫描电镜影像。
图2B是以习知的方式利用离子抛光制备的的电子元件样品的扫描电镜影像。
图3是根据本揭示内容的一些实施方式,制备电子元件显微结构样品的方法的流程图。
图4A至图4C是根据本揭示内容的一些实施方式,以夹埋法预处理,之后以离子抛光制备柔性基底样品的过程的示意图。
图5A至图5C是根据本揭示内容的一些实施方式,以夹埋法预处理,之后以离子抛光制备复合结构样品的过程的示意图。
图6A和图6B为以夹埋法预处理,之后以离子抛光制备柔性基底样品的金相图。
图7A至图7D为以夹埋法预处理,之后以离子抛光制备柔性基底样品的扫描电镜影像。
图8A至图8E为根据本揭示内容的一些实施方式,以包埋法预处理,之后以离子抛光制备复合结构样品的过程的示意图。
图9A为以包埋法预处理,之后以离子抛光制备复合结构样品的金相图。
图9B为以包埋法预处理,之后以离子抛光制备复合结构样品的扫描电镜影像。
图10A至图10H为根据本揭示内容的一些实施方式,以离型包埋法预处理,之后以离子抛光制备复合结构样品的过程的示意图。
图11A为以离型包埋法预处理,之后以离子抛光制备复合结构样品的金相图。
图11B为以离型包埋法预处理,之后以离子抛光制备复合结构样品的扫描电镜影像。
符号说明
10:电子元件样品 110:步骤
20:离子束 112:步骤
30:截面样品 200:电子元件样品
32:损伤区域 202:柔性基底
34:加工区域 204:刚性基底支撑层
100:方法 206:刚性基底保护层
102:步骤 208:第一粘着层
104:预处理步骤 210:第二粘着层
106:预处理步骤 212:离子束
108:步骤 220:截面样品
222:损伤区域 506:表面层别
224:加工区域 512:硬质基底
300:电子元件样品 514:粘着层
302:刚性基底 520:树脂
304:柔性基底 530:离子束
306:刚性基底保护层 540:截面样品
308:粘着层 542:损伤区域
310:离子束 544:加工区域
320:截面样品
322:损伤区域
324:加工区域
400:电子元件样品
402:刚性基底
404:柔性基底
406:表面层别
410:树脂
420:离子束
430:截面样品
432:损伤区域
434:加工区域
500:电子元件样品
502:刚性基底
504:柔性基底
具体实施方式
以下的揭示内容提供了不同的实施方式或实施例,以实现所提供的标的之不同的特征。以下描述组件和配置的具体实施例,以简化本揭示内容。当然,这些仅是实施例,并不旨在限制本揭示内容。例如,在随后的描述中,形成第一特征高于第二特征,可包括第一和第二特征以直接接触形成的实施方式,且也可包括附加的特征设置于第一和第二特征之间,因此第一和第二特征不是直接接触的实施方式。此外,本揭示内容可在各个实施例中重复标示数字和/或字母。这样的重复,并不是意指所讨论的各个实施方式之间和/或配置之间的关系。
此外,为了便于描述一个元件或特征与另一个元件或特征之间,如图式中所绘示的关系,在此可能使用空间上的相对用语,诸如「之下」、「下方」、「低于」、「之上」、「上方」、「高于」、和类似用语。除了图式中绘示的方向之外,空间上的相对用语旨在涵盖装置在使用中或操作中的不同方向。设备可以有其他方向(旋转90度或其他方向),并且此处所使用的空间上相对用语也可以相应地解释。
下面结合附图与具体实施方式对本揭示内容的实施方式作进一步详细描述。
请参看图3,绘示本揭示内容的制备电子元件显微结构样品的方法的流程。在方法100中,步骤102为获得一电子元件样品,此电子元件样品包含一可挠性层。在一些实施方式中,电子元件样品例如为触控屏的偏光片。在一些实施方式中,电子元件样品具有复合的结构,其包含硬质基底层以及柔性基底层;在另一些实施方式中,电子元件样品为单一的柔性基底层。在一些实施方式中,步骤102包含裁减样品,例如裁减至不大于1.0公分x 0.6公分的尺寸。
接着,方法100进行预处理步骤。在一些实施方式中,预理处步骤104为夹埋法。当电子元件为一柔性基底,或者为一复合结构,而其表面层为柔性基底时,以夹埋法进行预处理。换言之,当电子元件的上表面层为可挠性层时,以夹埋法进行预处理。夹埋法为将柔性材料层夹置于上下两层刚性层之间,因此达到底部支撑作用与表面保护作用,避免后续加对表层的辐照损伤以及柔性基底的形变。
在另一些实施方式中,预处理步骤106为包埋法。当电子元件样品为复合结构,其中至少一内部层面为可挠性层时,以包埋法进行预处理。换言之,以包埋法预处理的电子元件样品为可挠性层位于样品的上表面层与下表面层之间。包埋法为将电子元件以树脂包埋,利用树脂对整体结构的固定与保护,避免裁切过程对结构上的破坏。再者,在一些实施方式中,可对非目标层别进行剥离,弥补后续离子抛光在加工深度上的缺陷,同时整体结构可以得到良好的刚性支撑,避免后续加工的变形。
接着,在方法100中,步骤108为离子抛光,使用离子抛光仪,利用离子束(例如氩离子束)研磨电子元件的截面。之后步骤110为获得一截面样品,然后进行步骤112,以扫描电镜观测截面截品。
在一些实施方式中,步骤108包含将样品用热熔胶固定于样品台上,将样品台固定于支架上,并且调整支架与档片位置,以及将样品研磨减薄,依据样品所需加工深度设置离子抛光仪的加工参数。
请参看图4A至图4C,绘示以夹埋法做预处理,再利用离子抛光制备柔性基底样品的过程的示意图。在图4A中,电子元件样品200由一柔性基底202构成。图4B绘示在柔性基底202的下表面上设置刚性基底支撑层204,在柔性基底202上表面上设置刚性基底保护层206。在一些实施方式中,刚性基底支撑层204经由第一粘着层208而附着在柔性基底202的下表面上,刚性基底保护层206经由第二粘着层210附着在柔性基底202的上表面上。之后进行离子抛光,以离子束212(例如氩离子束)进行离子抛光。图4C绘示离子抛光所得的截面样品220包含损伤区域222和加工区域224。其中,损伤区域222主要位于刚性基底保护层206,而柔性基底202的位置与加工区域224重迭。由于离子抛光的加工区域224为较理想的扫描电镜观测的区域,因此柔性基底202中的待观测区域会位于适合于扫描电镜观测的区域。
具体的,在一些实施方式中,取表面平整且厚度不大于1毫米的刚性材料,表面涂覆适量的第一粘着剂,将裁减后的柔性基底样品固定于刚性基底上,待分析位置可能稍微露出外边缘。待第一粘着剂固化后,于样品上表面涂覆适量第二粘着剂,取另一表面平整的刚性材质,覆盖样品上表面。待第二粘着剂固化后,裁切至适当大小,如图4B所示。在一些实施方式中,第一粘着剂和第二粘着剂为460快干胶。在一些实施方式中,使用0.35毫米的玻璃(例如素玻璃)作为刚性基底支撑层204。在一些实施方式中,使用0.35毫米的玻璃(例如素玻璃)作为刚性基底保护层206。
之后利用离子抛光仪以获得截面样品。在一些实施方式中,离子抛光的加速电压为5至6.5kV,氩气流速为5至6.5(亦即阀门口全开大小的10%至13%),加工时间为8至18小时。离子抛光仪的加速电压、氩气流速、和加工时间可能取决于样品的待分析深度。在一些实施方式中,当样品分析深度为1.5毫米时,离子抛光仪的加速电压为6.0kV,氩气流速6.0(亦即阀门口全开大小的12%),加工时间为15小时。在另一些实施方式中,当样品分析深度为1.0毫米时,离子抛光仪的加速电压为6.0kV,氩气流速5.5(亦即阀门口(亦即阀门口全开大小的10%)大小的11%),加工时间为12小时。在又另一些实施方式中,当样品分析深度为0.5毫米时,离子抛光仪的加速电压为为5.5kV,氩气流速5.5(亦即阀门口全开大小的11%),加工时间为10小时。
本揭示的一些实施方式中,离子抛光仪的气体流速设定值为阀门大小设定。在一些实施方式中,进气口压力设定为0.12至0.28Mpa,例如,0.15Mpa、0.2Mpa、或0.25Mpa。阀门口调节范围为0至50,其中0为全关,50为全开。在一些实施方式中,阀门口调节大小为全开大小的7%至15%,例如,8%、10%、12%、或14%。在一实施例中,上述的氩气流速5.5,为进气口压力设定0.2MPa,而阀门口调节大小为全开大小的11%(=5.5/50)。
因此对于单一柔性基底的结构,在其下表面和上表面分别覆盖刚性基底,达到底部支撑作用与表面保护作用,避免后续离子抛光加工对表层的辐照损伤以及柔性基底的形变。
请参看图5A至图5C,绘示以夹埋法做预处理,再利用离子抛光制备复合结构样品的过程的示意图。在图5A中,电子元件样品300由刚性基底302和柔性基底304所构成。图4B绘示在柔性基底304的上表面上设置刚性基底保护层306。在一些实施方式中,刚性基底保护层306经由粘着层308而附着在柔性基底304的上表面上。在一些实施方式中,使用0.35毫米的玻璃(例如素玻璃)作为刚性基底保护层306。之后,进行离子抛光,以离子束310(例如氩离子束)进行离子抛光。图5C绘示离子抛光所得的截面样品320包含损伤区域322和加工区域324。其中,损伤区域322主要位于刚性基底保护层306,而柔性基底304的位置与加工区域324重迭。由于离子抛光的加工区域324为较理想的扫描电镜观测的区域,因此柔性基底304中的待观测区域会位于适合于扫描电镜观测的区域。
换言之,当电子元件样品为复合样品结构,例如包含刚性基底及柔性基底,且电子元件样品的上表面层为柔性基底时,亦可使用夹埋法处理样品。由于样品的本身在下方已具有刚性基底,因此不须再设置下方的刚性基底支撑层,而是在柔性基底的层别上方设置一刚性基底保护层;之后再进行离子抛光处理,使离子抛光所造成的损伤区域不会落在柔性基底中的待观测区域。
图6A和图6B为以夹埋法预理处,之后以离子抛光制备柔性基底样品的金相图。图6A和图6B为相同的样品的不同放大倍率的影像,可观察到即使在图6B的较大倍率的影像中,样品的截面平整,没有因离子抛光所造成的损伤或形变。
图7A至图7D为以夹埋法预处理,之后以离子抛光制备柔性基底基底样品的扫描电镜影像。可观察到样品的截面平整,无明显窗帘效应,层别清晰。
请参看图8A至图8E,绘示以包埋法做预处理,再利用离子抛光制备复合结构样品的过程的示意图。在图8A中,电子元件样品400包含刚性基底402、柔性基底404、和表面层别406。
图8B绘示以树脂410包埋电子元件样品400。在一些实施方式中,树脂为环氧树脂。在一些实施方式中,环氧树脂(A剂)与添加剂(B剂,例如硬化剂)的比例范围为2:0.8至2:1.2,例如比例为2:1。在一些实施方式中,环氧树脂的固化时间为4小时至26小时,例如5小时、8小时、12小时、16小时、20小时、或24小时,取决于环氧树脂的种类和电子元件样品对环氧树脂固化时的热敏感度。
图8C绘示将树脂包埋后的样品切割。当树脂完全固化后,用精密切割机将样品切割至适宜大小,例如图8C中的虚线为切割线。
图8D绘示将切割后的样品进行离子抛光。以离子束420(例如氩离子束)进行离子抛光。在一些实施方式中,离子抛光的加速电压为4至6kV,氩气流速为4至6(亦即阀门口全开大小的8%至12%),加工时间为4至14小时。离子抛光仪的加速电压、氩气流速、和加工时间可能取决于样品的待分析深度。在一些实施方式中,当样品分析深度为1.5毫米时,离子抛光仪的加速电压为5.0kV,氩气流速5.0(亦即阀门口全开大小的10%),加工时间为12小时。在另一些实施方式中,当样品分析深度为1.0毫米时,离子抛光仪的加速电压为5.0kV,氩气流速5.0(亦即阀门口全开大小的10%),加工时间为8小时。在又另一些实施方式中,当样品分析深度为0.5毫米时,离子抛光仪的加速电压为为4.5kV,氩气流速5.0(亦即阀门口全开大小的10%),加工时间为6小时。
图8E绘示离子抛光所得的截面样品430,截面样品430包含损伤区域432和加工区域434。其中,损伤区域432主要位于树脂410所在的位置,因此,柔性基底404和/或表面层别406会与截面样品430的加工区域434重迭。
在一些实施方式,当电子元件样品400的表面层别厚度大于1.5毫米时,在树脂固化后和样品切割前,对样品进行平面减薄,以减薄在柔性基底上方的样品层厚度。在一实施例中,研磨参数为:磨盘转速300rpm/分钟、砂纸目数:120目、400目。由于离子抛光的加工深度有限,一般大约为0.3毫米至1.5毫米,因此实施减薄处理,可减小样品在离子抛光所需的加工深度。
图9A和图9B分别地呈现以包埋法预处理和以离子抛光制备复合结构样品的金相图和扫描电镜影像。可观察到样品的截面平整,无明显窗帘效应,而且层别清晰。
在一些实施方式中,当电子元件样品的厚度较厚,且需要控制整体样品的厚度小于5毫米时,可对样品作离型包埋的预处理,图10A至图10H绘示以离型包埋预处理和离子抛光制备复合结构样品的过程。
在图10A中,电子元件样品500包含刚性基底502、柔性基底504、和表面层别506。
图10B绘示设置离型层在刚性基底502下方。在一些实施方式中,硬质基底512经由粘着层514而附着在电子元件样品500的刚性基底502下方。在一些实施方式中,使用压克力板作为刚性基底,和选用460快干胶作为粘着剂。
图10C绘示以树脂520包埋电子元件样品500。树脂520可类似于图8B所讨论的树脂410。
图10D绘示研磨树脂包埋后的上表面膜层。可选的,当电子元件样品500的表面层别506厚度大于1.5毫米时,在树脂固化后和样品切割前,对样品进行平面减薄,以减薄在柔性基底504上方的样品层厚度。在一实施例中,研磨参数为:磨盘转速300rpm/分钟、砂纸目数:120目、400目。
图10E绘示将树脂包埋后的样品切割。当树脂完全固化后,用精密切割机将样品切割至适宜大小,例如图10E的虚线为切割线。
图10F绘示切割后的样品。之后,进行离型处理,将粘着层514移除,因此硬质基底512和在下方的树脂520也一并移除,因此减小了样品的厚度。
图10G绘示将离型处理后的样品进行离子抛光。以离子束530(例如氩离子束)进行离子抛光。可能以类似于第8D图所讨论的离子抛光的加工参数进行。
图10H绘示离子抛光所得的截面样品540,截面样品540包含损伤区域542和加工区域544。其中,损伤区域542主要位于表面层别506所在的位置,因此,柔性基底504会与截面样品540的加工区域544重迭。
图11A和图11B分别地呈现以离型包埋法预处理和以离子抛光制备复合结构样品的金相图和扫描电镜影像。可观察到样品的截面平整,无明显窗帘效应,而且层别清晰。
综上,本发明的实施方式通过对不同特性的基底结构进行相对应的样品预处理,有效地提高离子抛光制备的样品质量,满足高精度解析的需求。
以上所述仅为本发明的较佳实施例而已,并不用以限制本发明,凡在本发明的精神和原则之内,所做的任何修改、等同替换、改进等,均应包含在本发明保护的范围之内。
Claims (7)
1.一种制备电子元件显微结构样品的方法,其特征在于,包含:
获得一电子元件样品,其包含一可挠性层;
经由预处理所述电子元件样品而获得一经预处理的样品,并且所述经预处理的样品具有一待观测区域与一第一刚性层,所述第一刚性层位于所述可挠性层的下方,其中,
当所述可挠性层位于所述电子元件样品的一上表面时,所述预处理是夹埋法,所述夹埋法包含:在所述电子元件样品的一下表面下设置一第一粘着层;
在所述第一粘着层下设置所述第一刚性层,所述第一刚性层为玻璃;
在所述电子元件样品的一上表面上设置一第二粘着层;以及
在所述第二粘着层上设置一第二刚性层,所述第二刚性层为玻璃,从而所述经预处理的样品为一复合结构,所述第一刚性层和所述第二刚性层的厚度为0.2至0.5毫米;以及
以离子抛光处理所述复合结构而得到一截面样品,其中所述截面样品具有一损伤区域和一加工区域,并且在所述截面样品中,含有所述可挠性层的所述待观测区域位于所述加工区域内且不重叠于所述损伤区域。
2.如权利要求1所述之制备电子元件显微结构样品的方法,其特征在于,所述预处理是所述夹埋法,所述离子抛光的加速电压为5至6.5kV,加工时间为8至18小时。
3.如权利要求1所述之制备电子元件显微结构样品的方法,其特征在于,当所述可挠性层位于所述电子元件样品之内时,所述预处理是包埋法,所述包埋法包含:以树脂包埋所述电子元件样品,在所述包埋法中,当所述电子元件样品还包含位于所述可挠性层之上且大于1.5毫米的表面层别时,还包含减薄所述表面层別。
4.如权利要求3所述之制备电子元件显微结构样品的方法,其特征在于,在所述包埋法中,更包含:在以所述树脂包埋该电子元件样品之前,依序设置一粘着层和一硬质基底在所述电子元件样品的一下表面上,并且在以所述树脂包埋所述电子元件样品之后,移除所述粘着层和所述硬质基底。
5.如权利要求4所述之制备电子元件显微结构样品的方法,其特征在于,所述硬质基底为压克力板。
6.如权利要求4所述之制备电子元件显微结构样品的方法,其特征在于,所述经预处理的样品的厚度小于5毫米。
7.如权利要求3所述之制备电子元件显微结构样品的方法,其特征在于,所述预处理是所述包埋法,所述离子抛光的加速电压为4至6kV,加工时间为4至14小时。
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