CN105427790A - 一种移位寄存器、其驱动方法、栅极驱动电路及显示装置 - Google Patents

一种移位寄存器、其驱动方法、栅极驱动电路及显示装置 Download PDF

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Abstract

本发明公开了一种移位寄存器、其驱动方法、栅极驱动电路及显示装置，包括：输入模块，节点控制模块、第一输出模块以及第二输出模块；其中，输入模块通过输入信号端和第一时钟信号端来控制第一节点的电位，节点控制模块通过第一控制信号端和直流信号端来控制第一节点的电位，第一输出模块通过第二控制信号端和直流信号端来控制驱动信号输出端的电位，第二输出模块在第一节点处于浮接状态时保持第一节点与驱动信号输出端之间的电压差稳定，并且通过第一节点和第二时钟信号端来控制驱动信号输出端的电位。这样通过上述四个模块的相互配合，能够通过简单的结构以及较少的信号线来实现扫描信号的输出，从而简化制备工艺，降低生产成本。

Description

一种移位寄存器、其驱动方法、栅极驱动电路及显示装置
技术领域
本发明涉及显示技术领域，特别涉及一种移位寄存器、其驱动方法、栅极驱动电路及显示装置。
背景技术
随着显示技术的飞速发展，显示器越来越向着高集成度和低成本的方向发展。其中，阵列基板行驱动(GateDriveronArray，GOA)技术将薄膜晶体管(ThinFilmTransistor，TFT)栅极开关电路集成在显示面板的阵列基板上以形成对显示面板的扫描驱动，从而可以省去栅极集成电路(IntegratedCircuit，IC)的绑定(Bonding)区域以及扇出(Fan-out)区域的布线空间，不仅可以在材料成本和制备工艺两方面降低产品成本，而且可以使显示面板做到两边对称和窄边框的美观设计；并且，这种集成工艺还可以省去栅极扫描线方向的Bonding工艺，从而提高了产能和良率。
一般的栅极驱动电路均是由多个级联的移位寄存器组成，通过各级移位寄存器实现依次向显示面板上的各行栅线输入扫描信号。目前，虽然可以通过输入较多的不同功能的控制信号来实现扫描信号的输出，但是这样使得栅极驱动电路中组成各级移位寄存器的开关晶体管的个数较多，以及各开关晶体管之间连接的具体结构也比较复杂，导致工艺难度加大，生产成本增加，甚至由于需要使用较多的信号线将多种不同功能的信号输入各级移位寄存器，从而造成显示面板的开口率降低，使得该显示面板不具备竞争力。
发明内容
本发明实施例提供了一种移位寄存器、其驱动方法、栅极驱动电路及显示装置，不仅结构简单，而且需要连接的用于实现扫描信号的输出的不同功能的信号线较少，从而简化工艺复杂度，降低生产成本。
因此，本发明实施例提供了一种移位寄存器，包括：输入模块，节点控制模块、第一输出模块以及第二输出模块；其中，
所述输入模块，其第一端与输入信号端相连，第二端与第一时钟信号端相连，第三端与第一节点相连；所述输入模块用于在所述第一时钟信号端的控制下将所述输入信号端的信号提供给所述第一节点；
所述节点控制模块，其第一端与直流信号端相连，第二端与第一控制信号端相连，第三端与所述第一节点相连；所述节点控制模块用于在所述第一控制信号端的控制下将所述直流信号端的信号提供给所述第一节点；
所述第一输出模块，其第一端与所述直流信号端相连，第二端与第二控制信号端相连，第三端与移位寄存器的驱动信号输出端相连；所述第一输出模块用于在所述第二控制信号端的控制下将所述直流信号端的信号提供给所述驱动信号输出端；
所述第二输出模块，其第一端与第二时钟信号端相连，第二端与所述第一节点相连，第三端与所述驱动信号输出端相连；所述第二输出模块用于在所述第一节点的控制下将所述第二时钟信号端的信号提供给所述驱动信号输出端，以及当所述第一节点处于浮接状态时，保持所述第一节点与所述驱动信号输出端之间的电压差稳定。
在一种可能的实施方式中，在本发明实施例提供的上述移位寄存器中，所述输入模块具体可以包括：第一开关晶体管；其中，
所述第一开关晶体管的源极与所述输入信号端相连，栅极与所述第一时钟信号端相连，漏极与所述第一节点相连。
在一种可能的实施方式中，在本发明实施例提供的上述移位寄存器中，所述节点控制模块具体可以包括：第二开关晶体管；其中，
所述第二开关晶体管的源极与所述直流信号端相连，栅极与所述第一控制信号端相连，漏极与所述第一节点相连。
在一种可能的实施方式中，在本发明实施例提供的上述移位寄存器中，所述第一输出模块具体可以包括：第三开关晶体管；其中，
所述第三开关晶体管的源极与所述直流信号端相连，栅极与所述第二控制信号端相连，漏极与所述驱动信号输出端相连。
在一种可能的实施方式中，在本发明实施例提供的上述移位寄存器中，所述第二输出模块具体可以包括：第四开关晶体管和电容；其中，
所述第四开关晶体管的源极与所述第二时钟信号端相连，栅极与所述第一节点相连，漏极与所述驱动信号输出端相连；
所述电容的第一端与所述第一节点相连，第二端与所述驱动信号输出端相连。
在一种可能的实施方式中，在本发明实施例提供的上述移位寄存器中，所述第一控制信号端与所述第二控制信号端为同一控制信号端。
相应地，本发明实施例还提供了一种上述任一种移位寄存器的驱动方法，包括：第一阶段、第二阶段、第三阶段和第四阶段；其中，
在所述第一阶段，所述节点控制模块在所述第一控制信号端的控制下将所述直流信号端的信号提供给所述第一节点；所述第一输出模块在所述第二控制信号端的控制下将所述直流信号端的信号提供给所述驱动信号输出端；
在所述第二阶段，所述输入模块在所述第一时钟信号端的控制下将所述输入信号端的信号提供给所述第一节点；所述第二输出模块在所述第一节点的控制下将所述第二时钟信号端的信号提供给所述驱动信号输出端；
在所述第三阶段，当所述第一节点处于浮接状态时，所述第二输出模块保持所述第一节点与所述驱动信号输出端之间的电压差稳定，以及在所述第一节点的控制下将所述第二时钟信号端的信号提供给所述驱动信号输出端；
在所述第四阶段，所述输入模块在所述第一时钟信号端的控制下将所述输入信号端的信号提供给所述第一节点；所述节点控制模块在所述第一控制信号端的控制下将所述直流信号端的信号提供给所述第一节点；所述第一输出模块在所述第二控制信号端的控制下将所述直流信号端的信号提供给所述驱动信号输出端。
相应地，本发明实施例还提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述任一种移位寄存器；其中，
第一级移位寄存器的输入信号端与帧触发信号端相连；
除第一级移位寄存器之外，其余各级移位寄存器的输入信号端分别与上一级移位寄存器的驱动信号输出端相连。
相应地，本发明实施例还提供了一种显示装置，包括本发明实施例提供的上述栅极驱动电路。
在一种可能的实施方式中，在本发明实施例提供的上述显示装置中，所述显示装置为有机电致发光显示装置。
在一种可能的实施方式中，在本发明实施例提供的上述显示装置中，所述有机电致发光显示装置包括呈矩阵排列的且至少具有发光控制信号端和扫描信号端的多个像素电路；其中，
每一行像素电路对应所述栅极驱动电路中的一个移位寄存器；且各行像素电路的发光控制信号端与对应的移位寄存器的第一控制信号端和第二控制信号端相连；各行像素电路的扫描信号端与对应的移位寄存器的驱动信号输出端相连。
本发明实施例提供的移位寄存器、其驱动方法、栅极驱动电路及显示装置，包括：输入模块，节点控制模块、第一输出模块以及第二输出模块；其中，输入模块通过输入信号端和第一时钟信号端来控制第一节点的电位，节点控制模块通过第一控制信号端和直流信号端来控制第一节点的电位，第一输出模块通过第二控制信号端和直流信号端来控制驱动信号输出端的电位，第二输出模块在第一节点处于浮接状态时保持第一节点与驱动信号输出端之间的电压差稳定，并且通过第一节点和第二时钟信号端来控制驱动信号输出端的电位。这样通过上述四个模块的相互配合，能够通过简单的结构以及较少的信号线来实现扫描信号的输出，从而简化制备工艺，降低生产成本。
附图说明
图1为本发明实施例提供的移位寄存器的结构示意图；
图2a为本发明实施例提供的移位寄存器的具体结构示意图之一；
图2b为本发明实施例提供的移位寄存器的具体结构示意图之二；
图2c为本发明实施例提供的移位寄存器的具体结构示意图之三；
图2d为本发明实施例提供的移位寄存器的具体结构示意图之四；
图3a为本发明实施例提供的移位寄存器的具体结构示意图之五；
图3b为本发明实施例提供的移位寄存器的具体结构示意图之六；
图3c为本发明实施例提供的移位寄存器的具体结构示意图之七；
图3d为本发明实施例提供的移位寄存器的具体结构示意图之八；
图4a为图2d所示的移位寄存器的电路时序图；
图4b为图3d所示的移位寄存器的电路时序图；
图5为本发明实施例提供的移位寄存器的驱动方法的流程图；
图6为本发明实施例提供的栅极驱动电路的结构示意图。
具体实施方式
下面结合附图，对本发明实施例提供的移位寄存器、其驱动方法、栅极驱动电路及显示装置的具体实施方式进行详细的说明。
本发明实施例提供的一种移位寄存器，如图1所示，包括：输入模块1，节点控制模块2、第一输出模块3以及第二输出模块4；其中，
输入模块1，其第一端与输入信号端Input相连，第二端与第一时钟信号端CK1相连，第三端与第一节点A相连；输入模块1用于在第一时钟信号端CK1的控制下将输入信号端Input的信号提供给第一节点A；
节点控制模块2，其第一端与直流信号端VC相连，第二端与第一控制信号端CS1相连，第三端与第一节点A相连；节点控制模块2用于在第一控制信号端CS1的控制下将直流信号端VC的信号提供给第一节点A；
第一输出模块3，其第一端与直流信号端VC相连，第二端与第二控制信号端CS2相连，第三端与移位寄存器的驱动信号输出端Output相连；第一输出模块用于在第二控制信号端CS2的控制下将直流信号端VC的信号提供给驱动信号输出端Output；
第二输出模块4，其第一端与第二时钟信号端CK2相连，第二端与第一节点A相连，第三端与驱动信号输出端Output相连；第二输出模块用于在第一节点A的控制下将第二时钟信号端CK2的信号提供给驱动信号输出端Output，以及当第一节点A处于浮接状态时，保持第一节点A与驱动信号输出端Output之间的电压差稳定。
本发明实施例提供的上述移位寄存器，包括：输入模块，节点控制模块、第一输出模块以及第二输出模块；其中，输入模块通过输入信号端和第一时钟信号端来控制第一节点的电位，节点控制模块通过第一控制信号端和直流信号端来控制第一节点的电位，第一输出模块通过第二控制信号端和直流信号端来控制驱动信号输出端的电位，第二输出模块在第一节点处于浮接状态时保持第一节点与驱动信号输出端之间的电压差稳定，并且通过第一节点和第二时钟信号端来控制驱动信号输出端的电位。该移位寄存器通过上述四个模块的相互配合，能够通过简单的结构以及较少的信号线来实现扫描信号的输出，从而简化制备工艺，降低生产成本。
在本发明实施例提供的上述移位寄存器中，第一时钟信号端输出的第一时钟信号与第二时钟信号端输出的第二时钟信号周期相同；当输入信号端的有效脉冲信号为低电位时，直流信号端的电压为高电位，当输入信号端的有效脉冲信号为高电位时，直流信号端的电压为低电位。
在具体实施时，在本发明实施例提供的上述移位寄存器中，第一时钟信号和第二时钟信号的占空比可以均为0.5，且第一时钟信号与第二时钟信号相位相反；
或者，当输入信号端的有效脉冲信号为低电位时，第一时钟信号和第二时钟信号的占空比均大于0.5，且第一时钟信号在一个周期内低电位的时间段处于第二时钟信号在一个周期内高电位的时间段之间；
或者，当输入信号端的有效脉冲信号为高电位时，第一时钟信号和第二时钟信号的占空比均小于0.5，第一时钟信号在一个周期内高电位的时间段处于第二时钟信号在一个周期内低电位的时间段之间。
具体地，在本发明实施例提供的上述移位寄存器中，如图2a至图3d所示，输入模块具体可以包括：第一开关晶体管M1；其中，
第一开关晶体管M1的源极与输入信号端Input相连，栅极与第一时钟信号端CK1相连，漏极与第一节点A相连。
在具体实施时，当输入信号端Input的有效脉冲信号为低电位时，如图2a至图2d所示，第一开关晶体管M1可以为P型开关晶体管；或者，当输入信号端Input的有效脉冲信号为高电位时，如图3a至图3d所示，第一开关晶体管M1可以为N型开关晶体管，在此不作限定。
在具体实施时，当第一开关晶体管在第一时钟信号端的控制下处于导通状态时，将输入信号端的信号提供给第一节点。
以上仅是举例说明移位寄存器中输入模块的具体结构，在具体实施时，输入模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不作限定。
具体地，在本发明实施例提供的上述移位寄存器中，如图2a至图3d所示，节点控制模块2具体可以包括：第二开关晶体管M2；其中，
第二开关晶体管M2的源极与直流信号端VC相连，栅极与第一控制信号端CS1相连，漏极与第一节点A相连。
在具体实施时，第二开关晶体管M2可以为P型开关晶体管，也可以为N型开关晶体管，在此不作限定。如图2a、图2b、图2d和图3b所示，当第二开关晶体管M2为P型开关晶体管时，第一控制信号端CS1为高电位时，第二开关晶体管M2处于导通状态，并将直流信号端VC的信号提供给第一节点A；如图2c、图3a、图3c和图3d所示，当第二开关晶体管M2为N型开关晶体管时，当第一控制信号端CS1为低电位时，第二开关晶体管M2处于导通状态，并将直流信号端VC的信号提供给第一节点A。
以上仅是举例说明移位寄存器中节点控制模块的具体结构，在具体实施时，节点控制模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不作限定。
具体地，在本发明实施例提供的上述移位寄存器中，如图2a至图3d所示，第一输出模块3具体可以包括：第三开关晶体管M3；其中，
第三开关晶体管M3的源极与直流信号端VC相连，栅极与第二控制信号端CS2相连，漏极与驱动信号输出端Output相连。
在具体实施时，第三开关晶体管M3可以为P型开关晶体管，也可以为N型开关晶体管，在此不作限定。如图2a、图2c、图2d和图3c所示，当第三开关晶体管M3为P型开关晶体管时，第二控制信号端CS2为高电位时，第三开关晶体管M3处于导通状态，并将直流信号端VC的信号提供给驱动信号输出端Output；如图2b、图3a、图3b和图3d所示，当第三开关晶体管M3为N型开关晶体管时，第二控制信号端CS2为低电位时，第三开关晶体管M3处于导通状态，并将直流信号端VC的信号提供给驱动信号输出端Output。
以上仅是举例说明移位寄存器中第一输出模块的具体结构，在具体实施时，第一输出模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不作限定。
具体地，在具体实施时，在本发明实施例提供的上述移位寄存器中，如图2a和图2d所示，第二开关晶体管M2和第三开关晶体管M3均可以为P型开关晶体管，或者，如图3a和图3d所示，第二开关晶体管M2和第三开关晶体管M3均可以为N型开关晶体管。这样可以将第一控制信号端CS1和第二控制信号端CS2设置为同一控制信号端。如图2d和图3d所示，第二控制信号端CS2为第一控制信号端CS1，第一控制信号端CS1同时控制第二开关晶体管M2和第三开关晶体管M3的导通和截止；当然第一控制信号端CS1也可以为第二控制信号端CS2，这样第二控制信号端CS2同时控制第二开关晶体管M2和第三开关晶体管M3的导通和截止，在此不作限定。通过将第二开关晶体管M2和第三开关晶体管M3设置为同一类型的开关晶体管，可以采用同一控制信号来控制这两个开关晶体管，从而可以进一步减少了信号线的数量。
具体地，在本发明实施例提供的上述移位寄存器中，如图2a至图3d所示，第二输出模块4具体可以包括：第四开关晶体管M4和电容C；其中，
第四开关晶体管M4的源极与第二时钟信号端CK2相连，栅极与第一节点A相连，漏极与驱动信号输出端Output相连；
电容C的第一端与第一节点A相连，第二端与驱动信号输出端Output相连。
在具体实施时，当输入信号端Input的有效脉冲信号为低电位时，如图2a至图2d所示，第四开关晶体管M4可以为P型开关晶体管；或者，当输入信号端Input的有效脉冲信号为高电位时，如图3a至图3d所示，第四开关晶体管M4可以为N型开关晶体管，在此不作限定。
进一步地，在具体实施时，当第四开关晶体管在第一节点的控制下处于导通状态时，将第二时钟信号端的第二时钟信号提供给驱动信号输出端；以及当第一节点处于浮接状态时，由于电容的自举作用，保持电容两端的电压差，即保持第一节点与驱动信号输出端之间的电压差稳定。
以上仅是举例说明移位寄存器中第二输出模块的具体结构，在具体实施时，第二输出模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不作限定。
较佳地，为了简化制备工艺，在具体实施时，在本发明实施例提供的上述移位寄存器中，如图2a和图2d所示，所有开关晶体管均可以为P型开关晶体管；或者，如图3a和图3d所示，所有开关晶体管均可以为N型开关晶体管，在此不作限定。
进一步的，在具体实施时，P型开关晶体管在高电位作用下截止，在低电位作用下导通；N型开关晶体管在高电位作用下导通，在低电位作用下截止。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，ThinFilmTransistor)，也可以是金属氧化物半导体场效应管(MOS，MetalOxideScmiconductor)，在此不作限定。在具体实施中，这些晶体管的源极和漏极根据晶体管类型以及输入信号的不同，其功能可以互换，在此不做具体区分。
下面分别以移位寄存器中的所有开关晶体管均为P型开关晶体管或均为N型开关晶体管为例，结合电路时序图对本发明实施例提供的上述移位寄存器的工作过程作以描述。下述描述中以1表示高电位信号，0表示低电位信号。
实施例一、
以图2d所示的移位寄存器的结构为例对其工作过程作以描述，其中在图2d所示的移位寄存器中，所有开关晶体管均为P型开关晶体管，各P型开关晶体管在低电位作用下导通，在高电位作用下截止；直流信号端VC的电位为高电位，对应的输入输出时序图如图4a所示，具体地，选取如图4a所示的输入输出时序图中的第一阶段T1、第二阶段T2、第三阶段T3和第四阶段T4四个阶段。
在第一阶段T1，Input＝1，CK1＝1，CK2＝0，CS1＝0。由于CK1＝1，因此第一开关晶体管M1截止；由于CS1＝0，因此第二开关晶体管M2和第三开关晶体管M3均导通；由于第二开关晶体管M2导通并将高电位的直流信号端VC的信号提供给第一节点A，因此第一节点A的电位为高电位；由于第一节点A的电位为高电位，因此第四开关晶体管M4截止；由于第三开关晶体管M3导通并将高电位的直流信号端VC的信号提供给驱动信号输出端Output，因此，驱动信号输出端Output输出高电位扫描信号。
之后，Input＝1，CK1＝1，CK2＝1，CS1＝1。由于CK1＝1，因此第一开关晶体管M1截止；由于CS1＝1，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第一开关晶体管M1和第二开关晶体管M2均截止，因此第一节点A处于浮接状态；由于第一节点A处于浮接状态，由于电容C的自举作用，第一节点A保持为前一时间段的高电位，因此第四开关晶体管M4截止；因此，驱动信号输出端Output保持输出前半时间段的高电位扫描信号。
在第二阶段T2，Input＝0，CK1＝0，CK2＝1，CS1＝1。由于CS1＝1，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于CK1＝0，因此第一开关晶体管M1导通并将低电位的输入信号端Input的信号提供给第一节点A，因此第一节点A的电位为低电位；由于第一节点A的电位为低电位，因此第四开关晶体管M4导通并将高电位的第二时钟信号端CK2的信号提供给驱动信号输出端Output，因此，电容C充电，驱动信号输出端Output输出高电位扫描信号。
之后，Input＝1，CK1＝1，CK2＝1，CS1＝1。由于CK1＝1，因此第一开关晶体管M1截止；由于CS1＝1，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第一开关晶体管M1和第二开关晶体管M2均截止，因此第一节点A处于浮接状态；由于第一节点A处于浮接状态，由于电容C的自举作用，第一节点A保持为前一时间段的低电位，以保证第四开关晶体管M4导通；由于第四开关晶体管M4导通并将高电位的第二时钟信号端CK2的信号提供给驱动信号输出端Output，因此驱动信号输出端Output输出高电位扫描信号。
在第三阶段T3，Input＝1，CK1＝1，CK2＝0，CS1＝1。由于CK1＝1，因此第一开关晶体管M1截止；由于CS1＝1，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第一开关晶体管M1和第二开关晶体管M2均截止，因此第一节点A处于浮接状态；由于第一节点A处于浮接状态，由于电容C的自举作用，第一节点A保持为前一时间段的低电位，以保证第四开关晶体管M4导通；由于第四开关晶体管M4导通并将低电位的第二时钟信号端CK2的信号提供给驱动信号输出端Output，因此，驱动信号输出端Output输出低电位扫描信号。
之后，Input＝1，CK1＝1，CK2＝1，CS1＝1。由于CK1＝1，因此第一开关晶体管M1截止；由于CS1＝1，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第一开关晶体管M1和第二开关晶体管M2均截止，因此第一节点A处于浮接状态；由于第一节点A处于浮接状态，由于电容C的自举作用，第一节点A保持为前一时间段的低电位，以保证第四开关晶体管M4导通；由于第四开关晶体管M4导通并将高电位的第二时钟信号端CK2的信号提供给驱动信号输出端Output，因此，驱动信号输出端Output输出高电位扫描信号。
在第四阶段T4，Input＝1，CK1＝0，CK2＝1，CS1＝1。由于CK1＝0，因此第一开关晶体管M1导通并将高电位的输入信号端Input的信号提供给第一节点A，因此第一节点A的电位为高电位；由于第一节点A的电位为高电位，因此第四开关晶体管M4截止；由于CS1＝1，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第三开关晶体管M3和第四开关晶体管M4均截止，因此，驱动信号输出端Output保持输出第三阶段后半时间段的高电位扫描信号。
之后，Input＝1，CK1＝0，CK2＝1，CS1＝0。由于CK1＝0，因此第一开关晶体管M1导通并将高电位的直流信号端VC的信号提供给第一节点A，因此第一节点A的电位为高电位；由于第一节点A的电位为高电位，因此第四开关晶体管M4截止；由于CS1＝0，因此第二开关晶体管M2和第三开关晶体管M3均导通；由于第二开关晶体管M2导通并将高电位的直流信号端VC的信号提供给第一节点A，进一步保证第一节点A的电位为高电位，进一步保证第四开关晶体管M4截止；由于第三开关晶体管M3导通并将高电位的直流信号端VC的信号提供给驱动信号输出端Output，因此驱动信号输出端Output输出高电位扫描信号。
本发明实施例提供的上述移位寄存器，在第四阶段之后，由于CS1＝0使第二开关晶体管导通并将高电位的直流信号端的信号提供给第一节点，使第一节点的电位一直保持为高电位以保证第四开关晶体管截止，从而不影响驱动信号输出端输出的扫描信号的电位；由于CS1＝0使第三开关晶体管导通并将高电位的直流信号端的信号提供给驱动信号输出端，以保证驱动信号输出端一直输出高电位的扫描信号，直至下一帧开始。
本发明实施例提供的上述移位寄存器，仅通过使用四个开关晶体管和一个电容即可实现扫描信号的输出，简化了制备工艺，降低了生产成本。
实施例二、
以图3d所示的移位寄存器的结构为例对其工作过程作以描述，其中在图3d所示的移位寄存器中，所有开关晶体管均为N型开关晶体管，各N型开关晶体管在高电位作用下导通，在低电位作用下截止；直流信号端VC的电位为低电位，对应的输入输出时序图如图4b所示，具体地，选取如图4b所示的输入输出时序图中的第一阶段T1、第二阶段T2、第三阶段T3和第四阶段T4四个阶段。
在第一阶段T1，Input＝0，CK1＝0，CK2＝1，CS1＝1。由于CK1＝0，因此第一开关晶体管M1截止；由于CS1＝1，因此第二开关晶体管M2和第三开关晶体管M3均导通；由于第二开关晶体管M2导通并将低电位的直流信号端VC的信号提供给第一节点A，因此第一节点A的电位为低电位；由于第一节点A的电位为低电位，因此第四开关晶体管M4截止；由于第三开关晶体管M3导通并将低电位的直流信号端VC的信号提供给驱动信号输出端Output，因此，驱动信号输出端Output输出低电位扫描信号。
之后，Input＝0，CK1＝0，CK2＝0，CS1＝0。由于CK1＝0，因此第一开关晶体管M1截止；由于CS1＝0，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第一开关晶体管M1和第二开关晶体管M2均截止，因此第一节点A处于浮接状态；由于第一节点A处于浮接状态，由于电容C的自举作用，第一节点A保持为前一时间段的低电位，因此第四开关晶体管M4截止；因此，驱动信号输出端Output保持输出前半时间段的低电位扫描信号。
在第二阶段T2，Input＝1，CK1＝1，CK2＝0，CS1＝0。由于CS1＝0，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于CK1＝1，因此第一开关晶体管M1导通并将高电位的输入信号端Input的信号提供给第一节点A，因此第一节点A的电位为高电位；由于第一节点A的电位为高电位，因此第四开关晶体管M4导通并将低电位的第二时钟信号端CK2的信号提供给驱动信号输出端Output，因此，电容C充电，驱动信号输出端Output输出低电位扫描信号。
之后，Input＝0，CK1＝0，CK2＝0，CS1＝0。由于CK1＝0，因此第一开关晶体管M1截止；由于CS1＝0，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第一开关晶体管M1和第二开关晶体管M2均截止，因此第一节点A处于浮接状态；由于第一节点A处于浮接状态，由于电容C的自举作用，第一节点A保持为前一时间段的高电位，以保证第四开关晶体管M4导通；由于第四开关晶体管M4导通并将低电位的第二时钟信号端CK2的信号提供给驱动信号输出端Output，因此驱动信号输出端Output输出低电位扫描信号。
在第三阶段T3，Input＝0，CK1＝0，CK2＝1，CS1＝0。由于CK1＝0，因此第一开关晶体管M1截止；由于CS1＝0，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第一开关晶体管M1和第二开关晶体管M2均截止，因此第一节点A处于浮接状态；由于第一节点A处于浮接状态，由于电容C的自举作用，第一节点A保持为前一时间段的高电位，以保证第四开关晶体管M4导通；由于第四开关晶体管M4导通并将高电位的第二时钟信号端CK2的信号提供给驱动信号输出端Output，因此，驱动信号输出端Output输出高电位扫描信号。
之后，Input＝0，CK1＝0，CK2＝0，CS1＝0。由于CK1＝0，因此第一开关晶体管M1截止；由于CS1＝0，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第一开关晶体管M1和第二开关晶体管M2均截止，因此第一节点A处于浮接状态；由于第一节点A处于浮接状态，由于电容C的自举作用，第一节点A保持为前一时间段的高电位，以保证第四开关晶体管M4导通；由于第四开关晶体管M4导通并将低电位的第二时钟信号端CK2的信号提供给驱动信号输出端Output，因此，驱动信号输出端Output输出低电位扫描信号。
在第四阶段T4，Input＝0，CK1＝1，CK2＝0，CS1＝0。由于CK1＝1，因此第一开关晶体管M1导通并将低电位的输入信号端Input的信号提供给第一节点A，因此第一节点A的电位为低电位；由于第一节点A的电位为低电位，因此第四开关晶体管M4截止；由于CS1＝0，因此第二开关晶体管M2和第三开关晶体管M3均截止；由于第三开关晶体管M3和第四开关晶体管M4均截止，因此，驱动信号输出端Output保持输出第三阶段后半时间段的低电位扫描信号。
之后，Input＝0，CK1＝1，CK2＝0，CS1＝1。由于CK1＝1，因此第一开关晶体管M1导通并将低电位的直流信号端VC的信号提供给第一节点A，因此第一节点A的电位为低电位；由于第一节点A的电位为低电位，因此第四开关晶体管M4截止；由于CS1＝1，因此第二开关晶体管M2和第三开关晶体管M3均导通；由于第二开关晶体管M2导通并将低电位的直流信号端VC的信号提供给第一节点A，进一步保证第一节点A的电位为低电位，进一步保证第四开关晶体管M4截止；由于第三开关晶体管M3导通并将低电位的直流信号端VC的信号提供给驱动信号输出端Output，因此驱动信号输出端Output输出低电位扫描信号。
本发明实施例提供的上述移位寄存器，在第四阶段之后，由于CS1＝1使第二开关晶体管导通并将低电位的直流信号端的信号提供给第一节点，使第一节点的电位一直保持为低电位以保证第四开关晶体管截止，从而不影响驱动信号输出端输出的扫描信号的电位；由于CS1＝1使第三开关晶体管导通并将低电位的直流信号端的信号提供给驱动信号输出端，以保证驱动信号输出端一直输出低电位的扫描信号，直至下一帧开始。
本发明实施例提供的上述移位寄存器，仅通过使用四个开关晶体管和一个电容即可实现扫描信号的输出，简化了制备工艺，降低了生产成本。
基于同一发明构思，本发明实施例还提供了上述任一种移位寄存器的驱动方法，如图5所示，包括：S501第一阶段、S502第二阶段、S503第三阶段和S504第四阶段；其中，
S501、在第一阶段，节点控制模块在第一控制信号端的控制下将直流信号端的信号提供给第一节点；第一输出模块在第二控制信号端的控制下将直流信号端的信号提供给驱动信号输出端；
S502、在第二阶段，输入模块在第一时钟信号端的控制下将输入信号端的信号提供给第一节点；第二输出模块在第一节点的控制下将第二时钟信号端的信号提供给驱动信号输出端；
S503、在第三阶段，当第一节点处于浮接状态时，第二输出模块保持第一节点与驱动信号输出端之间的电压差稳定，以及在第一节点的控制下将第二时钟信号端的信号提供给驱动信号输出端；
S504、在第四阶段，输入模块在第一时钟信号端的控制下将输入信号端的信号提供给第一节点；节点控制模块在第一控制信号端的控制下将直流信号端的信号提供给第一节点；第一输出模块在第二控制信号端的控制下将直流信号端的信号提供给驱动信号输出端。
基于同一发明构思，本发明实施例还提供了一种栅极驱动电路，如图6所示，包括级联的多个移位寄存器：SR(1)、SR(2)…SR(n)…SR(N-1)、SR(N)(共N个移位寄存器，1≤n≤N)，第一级移位寄存器SR(1)的输入信号端Input与帧触发信号端STV相连，除第一级移位寄存器SR(1)之外，其余各级移位寄存器SR(n)的输入信号端Input分别与上一级移位寄存器SR(n-1)的驱动信号输出端Output_n-1相连。
具体地，上述栅极驱动电路中的每个移位寄存器的具体结构与本发明上述移位寄存器在功能和结构上均相同，重复之处不再赘述。该栅极驱动电路可以应用于液晶显示面板中，也可以应用于有机电致发光显示面板中，在此不作限定。
进一步地，在本发明提供的上述栅极驱动电路中，各级移位寄存器均包括：输入信号端、第一时钟信号端，第二时钟信号端，第一控制信号端，第二控制信号端和直流信号端。
具体地，在本发明提供的上述栅极驱动电路中，如图6所示，第2k-1级移位寄存器的第一时钟信号端CK1的信号和第2k级移位寄存器的第二时钟信号端CK2的信号均由同一时钟端即第一时钟端ck1输入；第2k-1级移位寄存器的第二时钟信号端CK2的信号和第2k级移位寄存器的第一时钟信号端CK1的信号均由同一时钟端即第二时钟端ck2输入；其中，k为大于0的正整数。
基于同一发明构思，本发明实施例还提供了一种显示装置，包括上述的栅极驱动电路。通过该栅极驱动电路为显示装置中阵列基板上的各栅线提供扫描信号，其具体实施可参见上述栅极驱动电路的描述，相同之处不再赘述。
进一步地，本发明实施例提供的上述显示装置为有机电致发光显示装置。
一般有机电致发光显示装置包括呈矩阵排列的多个像素结构，每个像素结构中均包括至少一个发光像素以及与发光像素对应的像素电路，并且每行像素电路对应连接所在行的移位寄存器以输入扫描信号；一帧时间内，在发光阶段发光像素在发光控制信号端的信号的有效脉冲信号的控制下发光，在其余阶段发光像素不发光且发光控制信号端的信号的电位均与其有效脉冲信号的电位相反；由于在一帧时间内，在发光像素处于发光阶段时不输入扫描信号，此时发光控制信号端的信号为有效脉冲信号；而在发光像素不发光时进行扫描信号的输入，此时发光控制信号端的信号的电位与有效脉冲信号电位相反，当扫描信号输出完成后为了使发光像素继续发光，此时发光控制信号端的信号的变成有效脉冲信号。由此可知有机电致发光显示装置的像素电路中的发光控制信号端的信号的时序满足本发明实施例提供的移位寄存器中第一控制信号端的信号的时序以及第二控制信号端的信号的时序要求，因此将像素电路中的发光控制信号端的信号应用于移位寄存器中，能够实现移位寄存器输出扫描信号的功能，这样可以进一步减少控制信号线的数量，简化制备工艺。
因此，较佳地，在具体实施时，在本发明实施例提供的上述显示装置中，有机电致发光显示装置包括呈矩阵排列的且至少具有发光控制信号端和扫描信号端的多个像素电路；其中，
每一行像素电路对应栅极驱动电路中的一个移位寄存器；且各行像素电路的发光控制信号端与对应的移位寄存器的第一控制信号端和第二控制信号端相连；各行像素电路的扫描信号端与对应的移位寄存器的驱动信号输出端相连。
本发明实施例提供的移位寄存器、其驱动方法、栅极驱动电路及显示装置，包括：输入模块，节点控制模块、第一输出模块以及第二输出模块；其中，输入模块通过输入信号端和第一时钟信号端来控制第一节点的电位，节点控制模块通过第一控制信号端和直流信号端来控制第一节点的电位，第一输出模块通过第二控制信号端和直流信号端来控制驱动信号输出端的电位，第二输出模块在第一节点处于浮接状态时保持第一节点与驱动信号输出端之间的电压差稳定，并且通过第一节点和第二时钟信号端来控制驱动信号输出端的电位。这样通过上述四个模块的相互配合，可通过简单的结构以及较少的信号线来实现扫描信号的输出，从而简化制备工艺，降低生产成本。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (11)

1.一种移位寄存器，其特征在于，包括：输入模块，节点控制模块、第一输出模块以及第二输出模块；其中，
所述输入模块，其第一端与输入信号端相连，第二端与第一时钟信号端相连，第三端与第一节点相连；所述输入模块用于在所述第一时钟信号端的控制下将所述输入信号端的信号提供给所述第一节点；
所述节点控制模块，其第一端与直流信号端相连，第二端与第一控制信号端相连，第三端与所述第一节点相连；所述节点控制模块用于在所述第一控制信号端的控制下将所述直流信号端的信号提供给所述第一节点；
所述第一输出模块，其第一端与所述直流信号端相连，第二端与第二控制信号端相连，第三端与移位寄存器的驱动信号输出端相连；所述第一输出模块用于在所述第二控制信号端的控制下将所述直流信号端的信号提供给所述驱动信号输出端；
所述第二输出模块，其第一端与第二时钟信号端相连，第二端与所述第一节点相连，第三端与所述驱动信号输出端相连；所述第二输出模块用于在所述第一节点的控制下将所述第二时钟信号端的信号提供给所述驱动信号输出端，以及当所述第一节点处于浮接状态时，保持所述第一节点与所述驱动信号输出端之间的电压差稳定。
2.如权利要求1所述的移位寄存器，其特征在于，所述输入模块具体包括：第一开关晶体管；其中，
所述第一开关晶体管的源极与所述输入信号端相连，栅极与所述第一时钟信号端相连，漏极与所述第一节点相连。
3.如权利要求1所述的移位寄存器，其特征在于，所述节点控制模块具体包括：第二开关晶体管；其中，
所述第二开关晶体管的源极与所述直流信号端相连，栅极与所述第一控制信号端相连，漏极与所述第一节点相连。
4.如权利要求1所述的移位寄存器，其特征在于，所述第一输出模块具体包括：第三开关晶体管；其中，
所述第三开关晶体管的源极与所述直流信号端相连，栅极与所述第二控制信号端相连，漏极与所述驱动信号输出端相连。
5.如权利要求1所述的移位寄存器，其特征在于，所述第二输出模块具体包括：第四开关晶体管和电容；其中，
所述第四开关晶体管的源极与所述第二时钟信号端相连，栅极与所述第一节点相连，漏极与所述驱动信号输出端相连；
所述电容的第一端与所述第一节点相连，第二端与所述驱动信号输出端相连。
6.如权利要求1-5任一项所述的移位寄存器，其特征在于，所述第一控制信号端与所述第二控制信号端为同一控制信号端。
7.一种如权利要求1-6任一项所述的移位寄存器的驱动方法，其特征在于，包括：第一阶段、第二阶段、第三阶段和第四阶段；其中，
在所述第一阶段，所述节点控制模块在所述第一控制信号端的控制下将所述直流信号端的信号提供给所述第一节点；所述第一输出模块在所述第二控制信号端的控制下将所述直流信号端的信号提供给所述驱动信号输出端；
在所述第二阶段，所述输入模块在所述第一时钟信号端的控制下将所述输入信号端的信号提供给所述第一节点；所述第二输出模块在所述第一节点的控制下将所述第二时钟信号端的信号提供给所述驱动信号输出端；
在所述第三阶段，所述第一节点处于浮接状态，所述第二输出模块保持所述第一节点与所述驱动信号输出端之间的电压差稳定，以及在所述第一节点的控制下将所述第二时钟信号端的信号提供给所述驱动信号输出端；
在所述第四阶段，所述输入模块在所述第一时钟信号端的控制下将所述输入信号端的信号提供给所述第一节点；所述节点控制模块在所述第一控制信号端的控制下将所述直流信号端的信号提供给所述第一节点；所述第一输出模块在所述第二控制信号端的控制下将所述直流信号端的信号提供给所述驱动信号输出端。
8.一种栅极驱动电路，其特征在于，包括级联的多个如权利要求1-6任一项所述的移位寄存器；其中，
第一级移位寄存器的输入信号端与帧触发信号端相连；
除第一级移位寄存器之外，其余各级移位寄存器的输入信号端分别与上一级移位寄存器的驱动信号输出端相连。
9.一种显示装置，其特征在于，包括如权利要求8所述的栅极驱动电路。
10.如权利要求9所述的显示装置，其特征在于，所述显示装置为有机电致发光显示装置。
11.如权利要求10所述的显示装置，其特征在于，所述有机电致发光显示装置包括呈矩阵排列的且至少具有发光控制信号端和扫描信号端的多个像素电路；其中，
每一行像素电路对应所述栅极驱动电路中的一个移位寄存器；且各行像素电路的发光控制信号端与对应的移位寄存器的第一控制信号端和第二控制信号端相连；各行像素电路的扫描信号端与对应的移位寄存器的驱动信号输出端相连。
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