CN105632444A - 一种移位寄存器、栅极驱动电路及显示面板 - Google Patents

一种移位寄存器、栅极驱动电路及显示面板 Download PDF

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Abstract

本发明公开了一种移位寄存器、栅极驱动电路及显示面板，在移位寄存器中，第一节点控制模块在第一时钟信号端的控制下将输入信号端的信号提供给第一节点，在第二节点的控制下将第一参考信号端的信号提供给第一节点；第二节点控制模块在第三时钟信号端的控制下将第二参考信号端的信号提供给第二节点，在第一节点的控制下将第三时钟信号端的信号提供给第二节点；第一输出模块在第一节点的控制下将第二时钟信号端的信号提供给输出端，在第一节点处于浮接状态时稳定第一节点与输出端之间的电压差；第二输出模块在第二节点的控制下将第一参考信号端的信号提供给输出端。通过上述四个模块的相互配合，能够通过简单的结构实现移位输出的功能。

Description

一种移位寄存器、栅极驱动电路及显示面板
技术领域
本发明涉及显示技术领域，尤指一种移位寄存器、栅极驱动电路及显示面板。
背景技术
随着显示技术的飞速发展，显示器越来越向着高集成度和低成本的方向发展。其中，GOA(GateDriveronArray，阵列基板行驱动)技术将TFT(ThinFilmTransistor，薄膜晶体管)栅极开关电路集成在显示面板的阵列基板上以形成对显示面板的扫描驱动，从而可以省去栅极集成电路(IC，IntegratedCircuit)的绑定(Bonding)区域以及扇出(Fan-out)区域的布线空间，不仅可以在材料成本和制作工艺两方面降低产品成本，而且可以使显示面板做到两边对称和窄边框的美观设计；并且，这种集成工艺还可以省去栅极扫描线方向的Bonding工艺，从而提高了产能和良率。
一般的栅极驱动电路均是由多个级联的移位寄存器组成，通过各级移位寄存器实现依次向显示面板上的各行栅线输入扫描信号。但是目前的移位寄存器中开关晶体管的个数较多，结构比较复杂，因此仍会占用较大的边框面积。
发明内容
本发明实施例提供了一种移位寄存器、栅极驱动电路及显示面板，用以实现一种结构简单的移位寄存器。
本发明实施例提供的一种移位寄存器，包括：第一节点控制模块，第二节点控制模块，第一输出模块和第二输出模块；其中，
所述第一节点控制模块分别与输入信号端、第一时钟信号端、第一参考信号端、第一节点和第二节点相连；所述第一节点控制模块用于在所述第一时钟信号端的控制下将所述输入信号端的信号提供给所述第一节点，在所述第二节点的控制下将所述第一参考信号端的信号提供给所述第一节点；
所述第二节点控制模块分别与第二参考信号端、第三时钟信号端、所述第一节点和所述第二节点相连；所述第二节点控制模块用于在所述第三时钟信号端的控制下将所述第二参考信号端的信号提供给所述第二节点，在所述第一节点的控制下将所述第三时钟信号端的信号提供给所述第二节点；
所述第一输出模块分别与所述第一节点、第二时钟信号端和所述移位寄存器的输出端相连；所述第一输出模块用于在所述第一节点的控制下将所述第二时钟信号端的信号提供给所述输出端，在所述第一节点处于浮接状态时稳定所述第一节点与所述输出端之间的电压差；
所述第二输出模块分别与所述第二节点、所述第一参考信号端和所述输出端相连；所述第二输出模块用于在所述第二节点的控制下将所述第一参考信号端的信号提供给所述输出端。
较佳地，在本发明实施例提供的上述移位寄存器中，所述第一节点控制模块包括：第一开关晶体管和第二开关晶体管；其中，
所述第一开关晶体管，其栅极与所述第一时钟信号端相连，源极与所述输入信号端相连，漏极与所述第一节点相连；
所述第二开关晶体管，其栅极与所述第二节点相连，源极与所述第一参考信号端相连，漏极与所述第一节点相连。
较佳地，在本发明实施例提供的上述移位寄存器中，所述第二节点控制模块包括：第三开关晶体管和第四开关晶体管；其中
所述第三开关晶体管，其栅极与所述第三时钟信号端相连，源极与所述第二参考信号端相连，漏极与所述第二节点相连；
所述第四开关晶体管，其栅极与所述第一节点相连，源极与所述第三时钟信号端相连，漏极与所述第二节点相连。
较佳地，在本发明实施例提供的上述移位寄存器中，所述第一输出模块包括：第五开关晶体管和第一电容；其中，
所述第五开关晶体管，其栅极与所述第一节点相连，源极与所述第二时钟信号端相连，漏极与所述输出端相连；
所述第一电容连接于所述第五开关晶体管的栅极与漏极之间。
较佳地，在本发明实施例提供的上述移位寄存器中，所述第二输出模块包括：第六开关晶体管；其中，
所述第六开关晶体管，其栅极与所述第二节点相连，源极与所述第一参考信号端相连，漏极与所述输出端相连。
较佳地，在本发明实施例提供的上述移位寄存器中，所述第二输出模块还包括连接于所述第六开关晶体管的栅极与源极之间的第二电容。
较佳地，在本发明实施例提供的上述移位寄存器中，所有开关晶体管均为P型晶体管，或所有开关晶体管均为N型晶体管。
相应地，本发明实施例还提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述任一种移位寄存器；其中，
第一级移位寄存器的输入信号端与起始信号端相连；
除第一级移位寄存器之外，其余各级移位寄存器的输入信号端均与上一级移位寄存器的输出端相连。
相应地，本发明实施例还提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。
较佳地，在本发明实施例提供的上述显示面板中，还包括：与所述栅极驱动电路中的各级移位寄存器一一对应的一行有机电极发光像素；其中
各行所述有机电致发光像素在对应的发光控制端的控制下发光，且各行所述有机电致发光像素对应的发光控制端与对应级移位寄存器的第三时钟信号端相连。
本发明有益效果如下：
本发明实施例提供的一种移位寄存器、栅极驱动电路及显示面板，其中移位寄存器包括：第一节点控制模块，第二节点控制模块，第一输出模块和第二输出模块；其中，第一节点控制模块用于在第一时钟信号端的控制下将输入信号端的信号提供给第一节点，在第二节点的控制下将第一参考信号端的信号提供给第一节点；第二节点控制模块用于在第三时钟信号端的控制下将第二参考信号端的信号提供给第二节点，在第一节点的控制下将第三时钟信号端的信号提供给第二节点；第一输出模块用于在第一节点的控制下将第二时钟信号端的信号提供给输出端，在第一节点处于浮接状态时稳定第一节点与输出端之间的电压差；第二输出模块用于在第二节点的控制下将第一参考信号端的信号提供给输出端。移位寄存器通过上述四个模块的相互配合，能够通过简单的结构实现移位输出的功能，从而可以降低生产成本。
附图说明
图1为本发明实施例提供的移位寄存器的结构示意图；
图2a为本发明实施例提供的移位寄存器的具体结构示意图之一；
图2b为本发明实施例提供的移位寄存器的具体结构示意图之一；
图3a为本发明实施例提供的移位寄存器的具体结构示意图之一；
图3b为本发明实施例提供的移位寄存器的具体结构示意图之一；
图4a为3a提供的移位寄存器的对应的电路时序图；
图4b为3b提供的移位寄存器的对应的电路时序图；
图5为本发明实施例提供的移位寄存器的结构示意图。
具体实施方式
下面结合附图，对本发明实施例提供的移位寄存器、栅极驱动电路及显示面板的具体实施方式进行详细的说明。
本发明实施例提供的一种移位寄存器，如图1所示，包括：第一节点控制模块11，第二节点控制模块12，第一输出模块13和第二输出模块14；其中，
第一节点控制模块11分别与输入信号端Input、第一时钟信号端CK1、第一参考信号端Vref1、第一节点A和第二节点B相连；第一节点控制模块11用于在第一时钟信号端CK1的控制下将输入信号端Input的信号提供给第一节点A，在第二节点B的控制下将第一参考信号端Vref1的信号提供给第一节点A；
第二节点控制模块12分别与第二参考信号端Vref2、第三时钟信号端CK3、第一节点A和第二节点B相连；第二节点控制模块12用于在第三时钟信号端CK3的控制下将第二参考信号端Vref2的信号提供给第二节点B，在第一节点A的控制下将第三时钟信号端CK3的信号提供给第二节点B；
第一输出模块13分别与第一节点A、第二时钟信号端CK2和移位寄存器的输出端Output相连；第一输出模块13用于在第一节点A的控制下将第二时钟信号端CK2的信号提供给输出端Output，在第一节点A处于浮接状态时稳定第一节点A与输出端Output之间的电压差；
第二输出模块14分别与第二节点B、第一参考信号端Vref1和输出端相连Output；第二输出模块14用于在第二节点B的控制下将第一参考信号端Vref1的信号提供给输出端Output。
本发明实施例提供的上述移位寄存器，包括第一节点控制模块，第二节点控制模块，第一输出模块和第二输出模块；其中，第一节点控制模块用于在第一时钟信号端的控制下将输入信号端的信号提供给第一节点，在第二节点的控制下将第一参考信号端的信号提供给第一节点；第二节点控制模块用于在第三时钟信号端的控制下将第二参考信号端的信号提供给第二节点，在第一节点的控制下将第三时钟信号端的信号提供给第二节点；第一输出模块用于在第一节点的控制下将第二时钟信号端的信号提供给输出端，在第一节点处于浮接状态时稳定第一节点与输出端之间的电压差；第二输出模块用于在第二节点的控制下将第一参考信号端的信号提供给输出端。移位寄存器通过上述四个模块的相互配合，能够通过简单的结构实现移位输出的功能，从而可以降低生产成本。
下面结合具体实施例，对本发明进行详细说明。需要说明的是，本实施例中是为了更好的解释本发明，但不限制本发明。
较佳地，在本发明实施例提供的上述移位寄存器中，如图2a至图3b所示，第一节点控制模块11包括：第一开关晶体管M1和第二开关晶体管M2；其中，
第一开关晶体管M1，其栅极与第一时钟信号端CK1相连，源极与输入信号端InpuM相连，漏极与第一节点A相连；
第二开关晶体管M2，其栅极与第二节点B相连，源极与第一参考信号端Vref1相连，漏极与第一节点A相连。
在具体实施时，本发明实施例提供的上述移位寄存器中，当第一开关晶体管在第一时钟信号端的控制下处于导通状态时，导通的第一开关晶体管将输入信号端的信号提供给第一节点；当第二开关晶体管在第二节点的控制下处于导通状态时，导通的第二开关晶体管将第一参考信号端的信号提供给第一节点。
进一步地，在具体实施时，本发明实施例提供的上述移位寄存器中，如图2a和图3a所示，第一开关晶体管M1和第二开关晶体管M2均为N型晶体管，或者，如图2b和图3b所示，第一开关晶体管M1和第二开关晶体管M2均为P型晶体管，在此不作限定。
具体地，N型晶体管在其栅极电位为高电位时处于导通状态，在其栅极电位为低电位时处于截止状态；P型晶体管在其栅极电位为低电位时处于导通状态，在其栅极电位为高电位时处于截止状态。
以上仅是举例说明移位寄存器中第一节点控制模块的具体结构，在具体实施时，第一节点控制模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
较佳地，在本发明实施例提供的上述移位寄存器中，如图2a至图3b所示，第二节点控制模块12包括：第三开关晶体管M3和第四开关晶体管M4；其中
第三开关晶体管M3，其栅极与第三时钟信号端CK3相连，源极与第二参考信号端Vref2相连，漏极与第二节点B相连；
第四开关晶体管M4，其栅极与第一节点A相连，源极与第三时钟信号端CK3相连，漏极与第二节点B相连。
在具体实施时，本发明实施例提供的上述移位寄存器中，当第三开关晶体管在第三时钟信号端的控制下处于导通状态时，导通的第三开关晶体管将第二参考信号端的信号提供给第二节点；当第四开关晶体管在第一节点的控制下处于导通状态时，导通的第四开关晶体管将第三时钟信号端的信号提供给第二节点。
进一步地，在具体实施时，本发明实施例提供的上述移位寄存器，如图2a和图3a所示，第三开关晶体管M3和第四开关晶体管M4均为N型晶体管，或者，如图2b和图3b所示，第三开关晶体管M3和第四开关晶体管M4均为P型晶体管，在此不作限定。
以上仅是举例说明移位寄存器中第二节点控制模块的具体结构，在具体实施时，第二节点控制模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
较佳地，在本发明实施例提供的上述移位寄存器中，如图2a至图3b所示，第一输出模块13包括：第五开关晶体管M5和第一电容C1；其中，
第五开关晶体管M5，其栅极与第一节点A相连，源极与第二时钟信号端CK2相连，漏极与输出端Output相连；
第一电容C1连接于第五开关晶体管M5的栅极与漏极之间。
在具体实施时，本发明实施例提供的上述移位寄存器中，当第五开关晶体管在第一节点的控制下处于导通状态时，导通的第五开关晶体管将第二时钟信号端的信号提供给输出端；当第一节点处于浮接状态时，由于第一电容的自举作用，第一节点的电位随着输出端的电位的改变而改变，从而使第一节点与输出端之间的电压差保持稳定。
进一步地，在具体实施时，本发明实施例提供的上述移位寄存器，如图2a和图3a所示，第五开关晶体管M5为N型晶体管，或者，如图2b和图3b所示，第五开关晶体管M5为P型晶体管，在此不作限定。
以上仅是举例说明移位寄存器中第一输出模块的具体结构，在具体实施时，第一输出模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
较佳地，在本发明实施例提供的上述移位寄存器中，如图2a和图2b所示，第二输出模块14包括：第六开关晶体管M6；其中，
第六开关晶体管M6，其栅极与第二节点B相连，源极与第一参考信号端Vref1相连，漏极与输出端Output相连。
在具体实施时，本发明实施例提供的上述移位寄存器中，当第六开关晶体管在第二节点的控制下处于导通状态时，导通的第六开关晶体管将第一参考信号端的信号提供给输出端。
进一步地，在具体实施时，本发明实施例提供的上述移位寄存器，如图2a所示，第六开关晶体管M6为N型晶体管，或者，如图2b所示，第六开关晶体管M6为P型晶体管，在此不作限定。
较佳地，为了稳定第六开关晶体管栅极的电压，在本发明实施例提供的上述移位寄存器中，如图3a和图3b所示，第二输出模块14还包括连接于第六开关晶体管M6的栅极与源极之间的第二电容C2。
以上仅是举例说明移位寄存器中第二输出模块的具体结构，在具体实施时，第二输出模块的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，ThinFilmTransistor)，也可以是金属氧化物半导体场效应管(MOS，MetalOxideScmiconductor)，在此不做限定。在具体实施中，这些开关晶体管的源极和漏极根据晶体管类型以及输入信号的不同，其功能可以互换，在此不做具体区分。
较佳地，为了简化在本发明实施例提供的上述移位寄存器中，为了简化制作工艺，将所有开关晶体管的极性设计为相同。如图2a和图3a所示，所有开关晶体管(M1、M2、M3、M4、M5和M6)均为N型晶体管，或如图2b和图3b所示，所有开关晶体管(M1、M2、M3、M4、M5和M6)均为P型晶体管。
进一步地，在本发明实施例提供的上述移位寄存器中，如图2a和图3a所示，当所有开关晶体管(M1、M2、M3、M4、M5和M6)均为N型晶体管时，第一参考信号端Vref1的电位为低电位，第二参考信号端Vref2的电位为高电位；如图2b和图3b所示，当所有开关晶体管(M1、M2、M3、M4、M5和M6)均为P型晶体管时，第一参考信号端Vref1的电位为高电位，第二参考信号端Vref2的电位为低电位。
下面结合电路时序图对本发明实施例提供的上述移位寄存器的工作过程作以描述。下述描述中以1表示高电位信号，0表示低电位信号，其中，1和0代表其逻辑电位，仅是为了更好的解释本发明实施例提供的上述移位寄存器的工作过程，而不是在具体实施时施加在各开关晶体管的栅极上的电位。
实施例一、
以图3a所示的移位寄存器的结构为例对其工作过程作以描述，其中，在图3a所示的移位寄存器中，所有开关晶体管均为N型开关晶体管；第一参考信号端Vref1的电位为低电位，第二参考信号端Vref2的电位为高电位；对应的输入输出时序图如图4a所示，具体地，选取如图4a所示的输入输出时序图中的第一阶段T1、第二阶段T2、第三阶段T3、第四阶段T4和第五阶段T5五个阶段。
在第一阶段T1，Input＝0，CK1＝0，CK2＝1，CK3＝1。
由于CK3＝1，第三开关晶体管M3导通，导通的第三开关晶体管M3将第二参考信号端Verf2的高电位信号提供该第二节点B，因此第二节点B的电位为高电位，并通过第二电容C2进行保持；第二节点B控制第六开关晶体管M6和第二开关晶体管M2导通，导通的第二开关晶体管M2将第一参考信号端Verf1的低电位信号提供给第一节点A，因此第一节点A的电位为低电位，并通过第一电容C1进行保持；第一节点A控制第五开关晶体管截止；由于CK1＝0，因此第一开关晶体管M1截止；在第二节点B的控制下导通的第六开关晶体管M6将第一参考信号端Verf1的低电位信号提供给输出端Output，因此输出端Output的电位为低电位。
在第二阶段T2，Input＝1，CK1＝1，CK2＝0，CK3＝0。
由于CK1＝1，第一开关晶体管M1导通，导通的第一开关晶体管M1将输入信号端Input的高电位信号提供给第一节点A，因此第一节点A的电位为高电位，并通过第一电容C1进行保持；第一节点A控制第四开关晶体管M4和第五开关晶体管M5导通，导通的第四开关晶体管M4将第三时钟信号端CK3的低电位信号提供第二节点B，因此第二节点B的电位为低电位，并通过第二电容C2进行保持；第二节点B控制第二开关晶体管M2和第六开关晶体管M6截止；由于CK3＝0，第三开关晶体管M3截止；在第一节点A的控制下导通的第五开关晶体管M5将第二时钟信号端CK2的低电位信号提供给输出端Output，因此输出端Output的电位为低电位。
在第三阶段T3，Input＝0，CK1＝0，CK2＝1，CK3＝0。
由于CK1＝0，第一开关晶体管M1截止；由于CK3＝0，第三开关晶体管M3截止；由于第一节点A处于浮接状态(Floating)，第一节点A的电位仍为高电位，第二开关晶体管M2导通，导通的第二开关晶体管M2将第二时钟信号端CK2的高电位信号提供给输出端Output，因此输出端Output的电位为高电位；由于第一电容C1的自举作用，输出端Output的电位由T2阶段的低电位变为高电位，因此第一节点A的电位进一步被拉高，以保证第二开关晶体管M2的导通更加充分，以使第二时钟信号端CK2的高电位信号完整输入到输出端Output；在此阶段，由于第一节点A的电位为高电位，因此第四开关晶体管M4导通，导通的第四开关晶体管M4将第三时钟信号端CK3的低电位信号提供给第二节点B，因此第二节点B的电位为低电位，并通过第二电容C2进行保持，第六开关晶体管M6截止。
在第四阶段T4，Input＝0，CK1＝1，CK2＝0，CK3＝1。
由于CK1＝1，第一开关晶体管M1导通，导通的第一开关晶体管M1将输入信号端Input的低电位信号提供给第一节点A，因此第一节点A的电位为低电位，并通过第一电容C1进行保持；第一节点A控制第四开关晶体管M4和第五开关晶体管截止；由于CK3＝1，第三开关晶体管M3导通，导通的第三开关晶体管M3将第二参考信号端Vref2的高电位信号提供给第二节点B，因此第二节点B的电位为高电位，并通过第二电容C2进行保持；第二节点B控制第二开关晶体管M2和第六开关晶体管M6导通；导通的第二开关晶体管M2将第一参考信号端Vref1的低电位信号提供给第一节点A，进一步保证第四开关晶体管M4和第五开关晶体管M5截止；导通的第六开关晶体管M6将第一参考信号端Vref1的低电位信号提供给输出端Output，因此输出端Output的电位为低电位。
在第五阶段T5，Input＝0，CK1＝0，CK2＝1，CK3＝1。
由于CK3＝1，第三开关晶体管M3导通，导通的第三开关晶体管M3将第二参考信号端Verf2的高电位信号提供该第二节点B，因此第二节点B的电位为高电位，并通过第二电容C2进行保持；第二节点B控制第六开关晶体管M6和第二开关晶体管M2导通，导通的第二开关晶体管M2将第一参考信号端Verf1的低电位信号提供给第一节点A，因此第一节点A的电位为低电位，并通过第一电容C1进行保持；第一节点A控制第五开关晶体管截止；由于CK1＝0，因此第一开关晶体管截止；在第二节点B的控制下导通的第六开关晶体管M6将第一参考信号端Verf1的低电位信号提供给输出端Output，因此输出端Output的电位为低电位。
在本发明实施例提供的上述移位寄存器中，在第五阶段之后，一直重复执行第四阶段和第五阶段的工作过程，以保证输出端的电位保持为低电位。
实施例二、
以图3b所示的移位寄存器的结构为例对其工作过程作以描述，其中，在图3b所示的移位寄存器中，所有开关晶体管均为P型开关晶体管；第一参考信号端Vref1的电位为高电位，第二参考信号端Vref2的电位为低电位；对应的输入输出时序图如图4b所示，具体地，选取如图4b所示的输入输出时序图中的第一阶段T1、第二阶段T2、第三阶段T3、第四阶段T4和第五阶段T5五个阶段。
在第一阶段T1，Input＝1，CK1＝1，CK2＝0，CK3＝0。
由于CK3＝0，第三开关晶体管M3导通，导通的第三开关晶体管M3将第二参考信号端Verf2的低电位信号提供该第二节点B，因此第二节点B的电位为低电位，并通过第二电容C2进行保持；第二节点B控制第六开关晶体管M6和第二开关晶体管M2导通，导通的第二开关晶体管M2将第一参考信号端Verf1的高电位信号提供给第一节点A，因此第一节点A的电位为高电位，并通过第一电容C1进行保持；第一节点A控制第五开关晶体管截止；由于CK1＝1，因此第一开关晶体管M1截止；在第二节点B的控制下导通的第六开关晶体管M6将第一参考信号端Verf1的高电位信号提供给输出端Output，因此输出端Output的电位为高电位。
在第二阶段T2，Input＝0，CK1＝0，CK2＝1，CK3＝1。
由于CK1＝0，第一开关晶体管M1导通，导通的第一开关晶体管M1将输入信号端Input的低电位信号提供给第一节点A，因此第一节点A的电位为低电位，并通过第一电容C1进行保持；第一节点A控制第四开关晶体管M4和第五开关晶体管M5导通，导通的第四开关晶体管M4将第三时钟信号端CK3的高电位信号提供第二节点B，因此第二节点B的电位为高电位，并通过第二电容C2进行保持；第二节点B控制第二开关晶体管M2和第六开关晶体管M6截止；由于CK3＝1，第三开关晶体管M3截止；在第一节点A的控制下导通的第五开关晶体管M5将第二时钟信号端CK2的高电位信号提供给输出端Output，因此输出端Output的电位为高电位。
在第三阶段T3，Input＝1，CK1＝1，CK2＝0，CK3＝1。
由于CK1＝1，第一开关晶体管M1截止；由于CK3＝1，第三开关晶体管M3截止；由于第一节点A处于浮接状态(Floating)，第一节点A的电位仍为低电位，第二开关晶体管M2导通，导通的第二开关晶体管M2将第二时钟信号端CK2的低电位信号提供给输出端Output，因此输出端Output的电位为低电位；由于第一电容C1的自举作用，输出端Output的电位由T2阶段的高电位变为低电位，因此第一节点A的电位进一步被拉低，以保证第二开关晶体管M2的导通更加充分，以使第二时钟信号端CK2的低电位信号完整输入到输出端Output；在此阶段，由于第一节点A的电位为低电位，因此第四开关晶体管M4导通，导通的第四开关晶体管M4将第三时钟信号端CK3的高电位信号提供给第二节点B，因此第二节点B的电位为高电位，并通过第二电容C2进行保持，第六开关晶体管M6截止。
在第四阶段T4，Input＝1，CK1＝0，CK2＝1，CK3＝0。
由于CK1＝0，第一开关晶体管M1导通，导通的第一开关晶体管M1将输入信号端Input的高电位信号提供给第一节点A，因此第一节点A的电位为高电位，并通过第一电容C1进行保持；第一节点A控制第四开关晶体管M4和第五开关晶体管截止；由于CK3＝0，第三开关晶体管M3导通，导通的第三开关晶体管M3将第二参考信号端Vref2的低电位信号提供给第二节点B，因此第二节点B的电位为低电位，并通过第二电容C2进行保持；第二节点B控制第二开关晶体管M2和第六开关晶体管M6导通；导通的第二开关晶体管M2将第一参考信号端Vref1的高电位信号提供给第一节点A，进一步保证第四开关晶体管M4和第五开关晶体管M5截止；导通的第六开关晶体管M6将第一参考信号端Vref1的高电位信号提供给输出端Output，因此输出端Output的电位为高电位。
在第五阶段T5，Input＝1，CK1＝1，CK2＝0，CK3＝0。
由于CK3＝0，第三开关晶体管M3导通，导通的第三开关晶体管M3将第二参考信号端Verf2的低电位信号提供该第二节点B，因此第二节点B的电位为低电位，并通过第二电容C2进行保持；第二节点B控制第六开关晶体管M6和第二开关晶体管M2导通，导通的第二开关晶体管M2将第一参考信号端Verf1的高电位信号提供给第一节点A，因此第一节点A的电位为高电位，并通过第一电容C1进行保持；第一节点A控制第五开关晶体管截止；由于CK1＝1，因此第一开关晶体管截止；在第二节点B的控制下导通的第六开关晶体管M6将第一参考信号端Verf1的高电位信号提供给输出端Output，因此输出端Output的电位为高电位。
在本发明实施例提供的上述移位寄存器中，在第五阶段之后，一直重复执行第四阶段和第五阶段的工作过程，以保证输出端的电位保持为高电位。
基于同一发明构思，本发明实施例还提供了一种栅极驱动电路，如图5所示，包括级联的多个移位寄存器：SR(1)、SR(2)…SR(n)…SR(N-1)、SR(N)(共N个移位寄存器，1≤n≤N)，第一级移位寄存器SR(1)的输入信号端Input与起始信号端STV相连，除第一级移位寄存器SR(1)之外，其余各级移位寄存器SR(n)的输入信号端Input分别与上一级移位寄存器SR(n-1)的输出端Output_n-1相连。
具体地，上述栅极驱动电路中的每个移位寄存器的具体结构与本发明上述移位寄存器在功能和结构上均相同，重复之处不再赘述。
基于同一发明构思，本发明实施例还提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。该显示面板可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。对于该显示面板的其它必不可少的组成部分均为本领域的普通技术人员应该理解具有的，在此不做赘述，也不应作为对本发明的限制。
在具体实施时，本发明实施例提供的上述显示面板可以是液晶显示面板，也可以是有机电致发光显示面板，在此不作限定。
进一步地，当本发明实施例提供的上述显示面板为有机电致发光显示面板时，一般设置有呈矩阵排列的有机电致发光像素，每一行有机电致发光像素在发光显示时，一般是在一帧的时间内，先在扫描信号的控制下实现数据写入，之后在发光控制端的控制下依据写入的数据进行显示。因此，在一帧时间内，发光控制端的信号只有在一小段时间内是控制有机电致发光像素关闭的，其余时间都是控制有机电致发光像素发光的，以此来保证有机电致发光像素在显示周期中发光显示。并且一般在发光控制端的信号控制有机电致发光像素关闭时，控制有机电致发光像素数据写入的栅极扫描信号开始输出，以便将数据电压信号写入到有机电致发光像素中。数据电压信号写入完毕后，发光控制端的信号控制开始控制有机电致发光像素发光，有机电致发光像素便发出写入的数据电压信号所控制的亮度。
因此，在具体实施时，当本发明实施例提供的上述显示面板为有机电致发光显示面板时，还包括：与栅极驱动电路中的各级移位寄存器一一对应的一行有机电极发光像素；其中
各行有机电致发光像素在对应的发光控制端的控制下发光，且各行有机电致发光像素对应的发光控制端与对应级移位寄存器的第三时钟信号端相连。即利用各行有机电致发光像素对应的发光控制端作为栅极驱动电路中对应级的移位寄存器的第三时钟信号端，从而可以减少信号线的设置，使显示面板中栅极驱动电路的结构相对简单。
本发明实施例提供的一种移位寄存器、栅极驱动电路及显示面板，其中移位寄存器包括：第一节点控制模块，第二节点控制模块，第一输出模块和第二输出模块；其中，第一节点控制模块用于在第一时钟信号端的控制下将输入信号端的信号提供给第一节点，在第二节点的控制下将第一参考信号端的信号提供给第一节点；第二节点控制模块用于在第三时钟信号端的控制下将第二参考信号端的信号提供给第二节点，在第一节点的控制下将第三时钟信号端的信号提供给第二节点；第一输出模块用于在第一节点的控制下将第二时钟信号端的信号提供给输出端，在第一节点处于浮接状态时稳定第一节点与输出端之间的电压差；第二输出模块用于在第二节点的控制下将第一参考信号端的信号提供给输出端。移位寄存器通过上述四个模块的相互配合，能够通过简单的结构实现移位输出的功能，从而可以降低生产成本。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (10)

1.一种移位寄存器，其特征在于，包括：第一节点控制模块，第二节点控制模块，第一输出模块和第二输出模块；其中，
所述第一节点控制模块分别与输入信号端、第一时钟信号端、第一参考信号端、第一节点和第二节点相连；所述第一节点控制模块用于在所述第一时钟信号端的控制下将所述输入信号端的信号提供给所述第一节点，在所述第二节点的控制下将所述第一参考信号端的信号提供给所述第一节点；
所述第二节点控制模块分别与第二参考信号端、第三时钟信号端、所述第一节点和所述第二节点相连；所述第二节点控制模块用于在所述第三时钟信号端的控制下将所述第二参考信号端的信号提供给所述第二节点，在所述第一节点的控制下将所述第三时钟信号端的信号提供给所述第二节点；
所述第一输出模块分别与所述第一节点、第二时钟信号端和所述移位寄存器的输出端相连；所述第一输出模块用于在所述第一节点的控制下将所述第二时钟信号端的信号提供给所述输出端，在所述第一节点处于浮接状态时稳定所述第一节点与所述输出端之间的电压差；
所述第二输出模块分别与所述第二节点、所述第一参考信号端和所述输出端相连；所述第二输出模块用于在所述第二节点的控制下将所述第一参考信号端的信号提供给所述输出端。
2.如权利要求1所述的移位寄存器，其特征在于，所述第一节点控制模块包括：第一开关晶体管和第二开关晶体管；其中，
所述第一开关晶体管，其栅极与所述第一时钟信号端相连，源极与所述输入信号端相连，漏极与所述第一节点相连；
所述第二开关晶体管，其栅极与所述第二节点相连，源极与所述第一参考信号端相连，漏极与所述第一节点相连。
3.如权利要求1所述的移位寄存器，其特征在于，所述第二节点控制模块包括：第三开关晶体管和第四开关晶体管；其中
所述第三开关晶体管，其栅极与所述第三时钟信号端相连，源极与所述第二参考信号端相连，漏极与所述第二节点相连；
所述第四开关晶体管，其栅极与所述第一节点相连，源极与所述第三时钟信号端相连，漏极与所述第二节点相连。
4.如权利要求1所述的移位寄存器，其特征在于，所述第一输出模块包括：第五开关晶体管和第一电容；其中，
所述第五开关晶体管，其栅极与所述第一节点相连，源极与所述第二时钟信号端相连，漏极与所述输出端相连；
所述第一电容连接于所述第五开关晶体管的栅极与漏极之间。
5.如权利要求1所述的移位寄存器，其特征在于，所述第二输出模块包括：第六开关晶体管；其中，
所述第六开关晶体管，其栅极与所述第二节点相连，源极与所述第一参考信号端相连，漏极与所述输出端相连。
6.如权利要求5所述的移位寄存器，其特征在于，所述第二输出模块还包括连接于所述第六开关晶体管的栅极与源极之间的第二电容。
7.如权利要求2-6任一项所述的移位寄存器，其特征在于，所有开关晶体管均为P型晶体管，或所有开关晶体管均为N型晶体管。
8.一种栅极驱动电路，其特征在于，包括级联的多个如权利要求1-7任一项所述的移位寄存器；其中，
第一级移位寄存器的输入信号端与起始信号端相连；
除第一级移位寄存器之外，其余各级移位寄存器的输入信号端均与上一级移位寄存器的输出端相连。
9.一种显示面板，其特征在于，包括如权利要求8所述的栅极驱动电路。
10.如权利要求9所述显示面板，其特征在于，还包括：与所述栅极驱动电路中的各级移位寄存器一一对应的一行有机电极发光像素；其中
各行所述有机电致发光像素在对应的发光控制端的控制下发光，且各行所述有机电致发光像素对应的发光控制端与对应级移位寄存器的第三时钟信号端相连。
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