CN104966506A - 一种移位寄存器、显示面板的驱动方法及相关装置 - Google Patents

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Abstract

本发明公开了一种移位寄存器、显示面板的驱动方法及相关装置，移位寄存器中增加了输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端，用于选择驱动输出端是否有扫描信号输出。进而在栅极驱动电路中，可以实现选择性的向部分栅线输出扫描信号。进一步在本发明实施例提供的显示面板中在采用上述栅极驱动电路，并且还增加了分别连接两个移位寄存器的第三节点以及分别连接两个移位寄存器的第四节点之间的开关器件，以及模式切换电路。这样当模式切换电路可以根据不同的模式控制信号使显示面板按不同的分辨率进行显示，从而可以选择性的使显示面板降低功耗，延长待机时间。

Description

一种移位寄存器、显示面板的驱动方法及相关装置
技术领域
本发明涉及显示技术领域，尤指一种移位寄存器、显示面板的驱动方法及相关装置。
背景技术
在科技发展日新月异的现今时代中，液晶显示器已经广泛地应用在电子显示产品上，如电视机、计算机、手机及个人数字助理装置等。液晶显示器包括数据驱动装置(Source Driver)、栅极驱动装置(Gate Driver)及液晶显示面板等。其中，液晶显示面板中具有像素阵列，而栅极驱动装置用以依序开启像素阵列中对应的像素行，以将数据驱动器输出的像素数据传输至像素，进而显示待显图像。
目前，栅极驱动装置一般通过阵列工艺形成在液晶显示器的阵列基板上，即阵列基板行驱动(Gate Driver on Array,GOA)工艺，这种集成工艺不仅节省了成本，而且可以做到液晶面板(Panel)两边对称的美观设计，同时，也省去了栅极集成电路(IC，Integrated Circuit)的绑定(Bonding)区域以及扇出(Fan-out)区域的布线空间，从而可以实现窄边框的设计；并且，这种集成工艺还可以省去栅极扫描线方向的Bonding工艺，从而提高了产能和良率。
栅极驱动装置通常由多个级联的移位寄存器构成，这样将各级移位寄存器的驱动信号输出端分别对应一条栅线，用于沿扫描方向依次向各栅线输出扫描信号。具体移位寄存器的结构如图1所示，包括：输入单元01、复位单元02、节点控制单元03、上拉单元04、下拉单元05、输入信号端Input、复位信号端Reset、第一时钟信号端ck和参考信号端Vref；其中，输入单元01的输出端、复位单元02的输出端、节点控制单元03的第一端、以及上拉单元04的控制端均与第一节点PU相连，节点控制单元03的第二端和下拉单元05的控制端均与第二节点PD相连；上拉单元04的输出端和下拉单元05的输出端均与移位在寄存器的驱动信号输出端Out相连；输入单元01用于在输入信号端Input的控制下控制第一节点PU的电位，复位单元02用于在复位信号端Reset的控制下控制第一节点PU的电位，节点控制单元03用于控制第一节点PU和第二节点PD的电位，上拉单元04用于在第一节点PU的控制下将第一时钟信号端ck的信号提供给驱动信号输出端Out，下拉单元05用于在第二节点PD的控制下，将参考信号端Vref的信号提供给提供给驱动信号输出端Out。
目前，显示面板中的栅极驱动装置中移位寄存器一般均如图1所示，显示面板通过各级移位寄存器沿扫描方向依次向各栅线输出扫描信号。但是随着显示产品分辨率越来越高，显示面板的功耗也随着分辨率的增大而增大，导致待机时间大大减小。因此如何降低显示产品的功耗，以提高待机时间是本领域技术人员亟需解决的技术问题。
发明内容
有鉴于此，本发明实施例提供一种移位寄存器、显示面板的驱动方法及相关装置，用于实现可以在特殊情况下降低显示面板的分辨率，从而降低显示面板的功耗。
本发明实施例提供的一种移位寄存器，包括：输入单元、复位单元、节点控制单元、第一上拉单元、第一下拉单元、输入信号端、复位信号端、第一时钟信号端和参考信号端；其中，所述输入单元的输出端、所述复位单元的输出端、所述节点控制单元的第一端、以及所述第一上拉单元的控制端均与第一节点相连，所述节点控制单元的第二端和第一下拉单元的控制端均与第二节点相连；所述第一上拉单元的输出端和所述第一下拉单元的输出端均与所述移位寄存器的驱动信号输出端相连；所述输入单元用于在输入信号端的控制下控制所述第一节点的电位，所述复位单元用于在复位信号端的控制下控制所述第一节点的电位，所述节点控制单元用于控制所述第一节点和所述第二节点的电位，所述第一上拉单元用于在所述第一节点的控制下将第一时钟信号端的信号提供给驱动信号输出端，所述第一下拉单元用于在所述第二节点的控制下，将参考信号端的信号提供给所述提供给驱动信号输出端；所述移位寄存器还包括：输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端；其中，
所述输出控制单元的第一输入端与所述第一节点相连，第二输入端与所述第二节点相连，第三输入端与所述选择控制信号端相连，第一输出端分别与第三节点和所述第二上拉单元的第一输入端相连，第二输出端分别与第四节点和所述第二下拉单元的第一输入端相连；所述第二上拉单元的第二输入端与所述第一时钟信号端相连，输出端与所述第二下拉单元的输出端相连作为所述移位寄存器的选择驱动输出端；所述第二下拉单元的第二输入端与所述参考信号端相连；
所述输出控制单元用于在所述选择控制信号端接收到选择控制信号时，使所述第一节点和所述第三节点导通，以及使所述第二节点和所述第四节点导通；所述第二上拉单元用于在所述第三节点的控制下将所述第一时钟信号端的信号提供给所述选择驱动输出端；所述第二下拉单元用于在所述第四节点的控制下，将所述参考信号端的信号提供给所述选择驱动输出端。
在一种可能的实施方式中，在本发明实施例提供的移位寄存器中，所述输出控制单元，具体包括：第一开关晶体管和第二开关晶体管；其中，
所述第一开关晶体管，其栅极与所述选择控制信号端相连，源极与所述第一节点相连，漏极与所述第三节点相连；
所述第二开关晶体管，其栅极与所述选择控制信号端相连，源极与所述第二节点相连，漏极与所述第四节点相连。
在一种可能的实施方式中，在本发明实施例提供的移位寄存器中，所述第二上拉单元，具体包括：第三开关晶体管；其中，
所述第三开关晶体管，其栅极与所述第三节点相连，源极与所述第一时钟信号端相连，漏极与所述选择驱动输出端相连。
在一种可能的实施方式中，在本发明实施例提供的移位寄存器中，所述第二下拉单元，具体包括：第四开关晶体管；其中，
所述第四开关晶体管，其栅极与所述第四节点相连，源极与所述参考信号端相连，漏极与所述选择驱动输出端相连。
相应地，本发明实施例还提供了一种栅极驱动电路，包括级联的多个本发明实施例提供的上述任一种移位寄存器；其中，
除最后一级移位寄存器之外，其余每一级移位寄存器的驱动信号输出端分别与与其相邻的下一级移位寄存器的输入信号端相连；
第一级移位寄存器的信号输入端用于接收触发信号；
除第一级移位寄存器之外，其余每一级移位寄存器的驱动信号输出端分别与与其相邻的上一级移位寄存器的复位信号端相连；
各级移位寄存器的选择驱动输出端用于与栅线相连。
相应地，本发明实施例还提供了一种显示面板，包括N条栅线，分别位于显示面板两侧且均与所述N条栅线连接的第一栅极驱动电路和第二栅极驱动电路；所述第一栅极驱动电路和所述第二栅极驱动电路均为如权利要求5所述的栅极驱动电路；且各所述栅极驱动电路中的移位寄存器的选择驱动输出端与对应的栅线连接；
所述显示面板还包括：与各栅极驱动电路连接的至少用于向各栅极驱动电路输出选择控制信号、以及向所述第一栅极驱动电路输出第一组时序控制信号，向所述第二栅极驱动电路输出的第二组时序控制信号的驱动控制电路；其中，各组时序控制信号至少包括触发信号和时钟信号，且各组时序控制信号中触发信号的宽度相同，各所述栅极驱动电路用于在接收的对应组时序控制信号的控制下依次由驱动信号输出端输出扫描信号。
较佳地，在本发明实施例提供的上述显示面板中，还包括：与各所述驱动控制电路连接的模式切换电路；其中，所述模式切换电路用于，在接收到第一模式控制信号时：
使所述第一组时序控制信号中各信号的时序比所述第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；
并且控制所述驱动控制电路向与所述第一栅极驱动电路中与奇数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向与所述第二栅极驱动电路中与偶数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号。
较佳地，在本发明实施例提供的上述显示面板中，还包括：针对每一个n的取值，分别连接在所述第一栅极驱动电路的第3n-2级移位寄存器的第三节点与第3n级移位寄存器的第三节点之间的第一开关器件，以及分别连接在所述第一栅极驱动电路的第3n-2级移位寄存器的第四节点与第3n级移位寄存器的第四节点之间的第二开关器件；其中，n为大于0的正整数，所述模式切换电路还用于，在接收到第二模式控制信号时：
控制所有的第一开关器件和所有第二开关器件处于导通状态；
使所述第二组时序控制信号中各信号的时序比所述第一组时序控制信号中对应信号的时序延迟一个触发信号宽度；
并且控制所述驱动控制电路向所述第一栅极驱动电路中与第3n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向所述第二栅极驱动电路中与第3n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号。
较佳地，在本发明实施例提供的上述显示面板中，还包括：针对每一个n的取值，分别连接在所述第一栅极驱动电路的第4n-1级移位寄存器的第三节点与第4n-3级移位寄存器的第三节点之间的第三开关器件，分别连接在所述第一栅极驱动电路的第4n-1级移位寄存器的第四节点与第4n-3级移位寄存器的第四节点之间的第四开关器件，分别连接在所述第二栅极驱动电路的第4n级移位寄存器的第三节点与第4n-2级移位寄存器的第三节点之间的第五开关器件，以及分别连接在所述第二栅极驱动电路的第4n级移位寄存器的第四节点与第4n-2级移位寄存器的第四节点之间的第六开关器件；
所述模式切换电路还用于，在接收到第三模式控制信号时：
控制所有的第一开关器件和所有第二开关器件处于关闭状态；控制所有的第三开关器件、所有第四开关器件、所有第五开关器件和所有第六开关器件处于导通状态；
使所述第一组时序控制信号中各信号的时序比所述第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；
并且控制所述驱动控制电路向与所述第一栅极驱动电路中与第4n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向所述第二栅极驱动电路中与第4n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号。
较佳地，在本发明实施例提供的上述显示面板中，所述模式切换电路还用于，在接收到第四模式控制信号时：
控制所有的开关器件处于关闭状态；
使所述第二组时序控制信号中各信号的时序与所述第一组时序控制信号中对应信号的时序相同；
并且控制所述驱动控制电路向所有移位寄存器的选择控制信号端均输出选择控制信号。
相应地，本发明实施例还提供了一种显示装置，包括本发明实施例提供的上述任一种显示面板。
相应地，本发明实施例还提供了一种上述显示面板的驱动方法，包括：
当所述模式切换电路在接收到第一模式控制信号时：控制所有开关器件处于关闭状态，使所述第一组时序控制信号中各信号的时序比所述第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制所述驱动控制电路向与所述第一栅极驱动电路中与奇数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向与所述第二栅极驱动电路中与偶数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当所述模式切换电路在接收到第二模式控制信号时：控制所有的第一开关器件和所有第二开关器件处于导通状态；控制所有的第三开关器件、所有第四开关器件、所有第五开关器件和所有第六开关器件处于关闭状态；使所述第二组时序控制信号中各信号的时序比所述第一组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制所述驱动控制电路向所述第一栅极驱动电路中与第3n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向所述第二栅极驱动电路中与第3n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当所述模式切换电路在接收到第三模式控制信号时：控制所有的第一开关器件和所有第二开关器件处于关闭状态；控制所有的第三开关器件、所有第四开关器件、所有第五开关器件和所有第六开关器件处于导通状态；使所述第一组时序控制信号中各信号的时序比所述第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制所述驱动控制电路向与所述第一栅极驱动电路中与第4n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向所述第二栅极驱动电路中与第4n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当所述模式切换电路在接收到第四模式控制信号时：控制所有的开关器件处于关闭状态；使所述第二组时序控制信号中各信号的时序与所述第一组时序控制信号中对应信号的时序相同；并且控制所述驱动控制电路向所有移位寄存器的选择控制信号端均输出选择控制信号。
本发明实施例提供的上述移位寄存器、显示面板的驱动方法及相关装置，移位寄存器相当于在现有的移位寄存器的基础上增加了输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端；其中，输出控制单元用于在选择控制信号端接收到选择控制信号时，使第一节点和第三节点导通，以及使第二节点和第四节点导通；第二上拉单元用于在第三节点的控制下将第一时钟信号端的信号提供给选择驱动输出端；第二下拉单元用于在第四节点的控制下，将参考信号端的信号提供给选择驱动输出端。从而可以通过输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端的控制决定选择驱动输出端是否有扫描信号输出。进而在采用上述移位寄存器构成的栅极驱动电路中，可以实现选择性的向部分栅线输出扫描信号。进一步在本发明实施例提供的显示面板中在采用上述栅极驱动电路，并且还增加了分别连接两个移位寄存器的第三节点以及分别连接两个移位寄存器的第四节点之间的开关器件，以及与驱动控制电路连接的模式切换电路。这样当模式切换电路在接收到不同的模式控制信号时，可以使显示面板按不同的分辨率进行显示，从而可以选择性的使显示面板降低功耗，延长待机时间。
附图说明
图1为现有的移位寄存器的结构示意图；
图2为本发明实施例提供的移位寄存器的结构示意图之一；
图3为本发明实施例提供的移位寄存器的结构示意图之二；
图4为本发明实施例提供的移位寄存器的具体结构示意图；
图5为图4所示的移位寄存器对应的输入输出时序图；
图6为本发明实施例提供的栅极驱动电路的结构示意图；
图7为本发明实施例提供的显示面板的结构示意图之一；
图8为本发明实施例提供的第一栅极驱动电路对应的输入输出时序图；
图9a为本发明实施例提供的显示面板的结构示意图之二；
图9b为本发明实施例提供的显示面板中当模式切换电路接收到第一模式控制信号时或第三模式控制信号时控制驱动控制电路输出的两组时序控制信号的时序图；
图9c为本发明实施例提供的显示面板中当模式切换电路接收到第一模式控制信号时所对应的栅线上的扫描信号时序图；
图10a为本发明实施例提供的显示面板的结构示意图之二；
图10b为本发明实施例提供的显示面板中当模式切换电路接收到第二模式控制信号时控制驱动控制电路输出的两组时序控制信号的时序图；
图10c为本发明实施例提供的显示面板中当模式切换电路接收到第二模式控制信号时所对应的栅线上的扫描信号时序图；
图10d为图10a为所示显示面板的局部放大示意图；
图11a为本发明实施例提供的显示面板的结构示意图之三；
图11b为本发明实施例提供的显示面板中当模式切换电路接收到第三模式控制信号时所对应的栅线上的扫描信号时序图；
图12为本发明实施例提供的显示面板中当模式切换电路接收到第四模式控制信号时所对应的栅线上的扫描信号时序图。
具体实施方式
为了实现一种可以降低功耗的显示面板，本发明实施例提供的显示面板的栅极驱动电路采用了特殊设计的移位寄存器。下面结合附图，对本发明实施例提供的移位寄存器、显示面板的驱动方法及相关装置的具体实施方式进行详细地说明。
下面先对本发明实施例提供的移位寄存器进行说明。
本发明实施例提供的一种移位寄存器，如图2所示，包括：输入单元1、复位单元2、节点控制单元3、第一上拉单元4、第一下拉单元5、输入信号端Input、复位信号端Reset、第一时钟信号端ck1和参考信号端Vref；其中，输入单元1的输出端、复位单元2的输出端、节点控制单元3的第一端、以及第一上拉单元4的控制端均与第一节点PU相连，节点控制单元3的第二端、第一下拉单元5的控制端均与第二节点PD相连；第一上拉单元4的输出端和第一下拉单元5的输出端均与移位在寄存器的驱动信号输出端Out相连；输入单元1用于在输入信号端Input的控制下控制第一节点PU的电位，复位单元2用于在复位信号端Reset的控制下控制第一节点PU的电位，节点控制单元3用于控制第一节点A和第二节点B的电位，第一上拉单元4用于在第一节点PU的控制下将第一时钟信号端ck1的信号提供给驱动信号输出端Out，第一下拉单元5用于在第二节点PD的控制下，将参考信号端Vref的信号提供给提供给驱动信号输出端Out；移位寄存器还包括：输出控制单元6、第二上拉单元7、第二下拉单元8和选择控制信号端EN；其中，
输出控制单元6的第一输入端与第一节点PU相连，第二输入端与第二节点PD相连，第三输入端与选择控制信号端EN相连，第一输出端分别与第三节点A和第二上拉单元7的第一输入端相连，第二输出端分别与第四节点B和第二下拉单元8的第一输入端相连；第二上拉单元7的第二输入端与第一时钟信号端ck1相连，输出端分别与第二下拉单元8的输出端相连作为移位寄存器的选择驱动输出端Output；第二下拉单元8的第二输入端与参考信号端Vref相连；
输出控制单元6用于在选择控制信号端EN接收到选择控制信号时，使第一节点PU和第三节点A导通，以及使第二节点PD和第四节点B导通；第二上拉单元7用于在第三节点A的控制下将第一时钟信号端ck1的信号提供给选择驱动输出端Output；第二下拉单元8用于在第四节点B的控制下，将参考信号端Vref的信号提供给选择驱动输出端Output。
本发明实施例提供的上述移位寄存器，相当于在现有的移位寄存器的基础上增加了输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端；其中，输出控制单元用于在选择控制信号端接收到选择控制信号时，使第一节点和第三节点导通，以及使第二节点和第四节点导通；第二上拉单元用于在第三节点的控制下将第一时钟信号端的信号提供给选择驱动输出端；第二下拉单元用于在第四节点的控制下，将参考信号端的信号提供给选择驱动输出端。从而可以通过输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端的控制决定选择驱动输出端是否有扫描信号输出。进而在采用上述移位寄存器构成的栅极驱动电路中，可以实现选择性的向部分栅线输出扫描信号。
下面结合具体实施例，对本发明进行详细说明。需要说明的是，本实施例中是为了更好的解释本发明，但不限制本发明。
较佳地，在本发明实施例提供的上述移位寄存器中，如图3所示，输出控制单元6，具体可以包括：第一开关晶体管T1和第二开关晶体管T2；其中，
第一开关晶体管T1，其栅极与选择控制信号端EN相连，源极与第一节点PU相连，漏极与第三节点A相连；
第二开关晶体管T2，其栅极与选择控制信号端EN相连，源极与第二节点PD相连，漏极与第四节点B相连。
本发明实施例提供的上述移位寄存器，当选择控制信号端控制第一开关晶体管和第二开关晶体管处于导通状态时，第一节点与第三节点被导通，并且第二节点与第四节点被导通。
在具体实施时，第一开关晶体管和第二开关晶体管可以均为P型晶体管，也可以均为N型晶体管，在此不作限定。
以上仅是举例说明移位寄存器中输出控制单元的具体结构，在具体实施时，输出控制单元的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
较佳地，在本发明实施例提供的上述移位寄存器中，如图3所示，第二上拉单元7，具体可以包括：第三开关晶体管T3；其中，
第三开关晶体管T3，其栅极与第三节点A相连，源极与第一时钟信号端ck1相连，漏极与选择驱动输出端Output相连。
本发明实施例提供的上述移位寄存器，当第三开关晶体管在第三节点的控制下处于导通状态时，第三开关晶体管将第一时钟信号端的信号提供给选择驱动输出端。
以上仅是举例说明移位寄存器中第二上拉单元的具体结构，在具体实施时，第二上拉单元的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
较佳地，在本发明实施例提供的上述移位寄存器中，如图3所示，第二下拉单元8，具体可以包括：第四开关晶体管T4；其中，
第四开关晶体管T4，其栅极与第四节点B相连，源极与参考信号端Vref相连，漏极与选择驱动输出端Output相连。
本发明实施例提供的上述移位寄存器，当第三开关晶体管在第三节点的控制下处于导通状态时，第三开关晶体管将第一时钟信号端的信号提供给选择驱动输出端。
以上仅是举例说明移位寄存器中第二下拉单元的具体结构，在具体实施时，第二下拉单元的具体结构不限于本发明实施例提供的上述结构，还可以是本领域技术人员可知的其他结构，在此不做限定。
具体地，在本发明实施例提供的上述移位寄存器中，节点控制单元具体用于根据第一节点的电位控制第二节点的电位，根据第二节点的电位控制第一节点的电位，从而通过控制第一节点和第二节点的电位，实现移位寄存器的基本功能。
进一步地，在本发明实施例提供的上述移位寄存器中，输入单元、复位单元、节点控制单元、第一上拉单元和第一下拉单元的结构均与现有技术相同，在此不作详述。下面通过一个具体实施例说明，但是不限于此。
实施例一：
具体地，如图4所示，输入单元1可以包括第五开关晶体管T5；复位单元2可以包括第六开关晶体管T6；节点控制单元3可以包括第七开关晶体管T7、第八开关晶体管T8、第九开关晶体管T9和第十开关晶体管T10和第一电容C1；第一上拉单元4可以包括第十一开关晶体管T11和第二电容C2；第一下拉单元5可以包括第十二开关晶体管T12；
其中，第五开关晶体管T5的栅极与输入信号端Input相连，源极与第一直流信号端VDD相连，漏极与上拉节点PU相连；第六开关晶体管T6的栅极与复位信号端Reset相连，源极与第二直流信号端VSS相连，漏极与第一节点PU相连；第七开关晶体管T7的栅极与源极均与第二时钟信号端ckb1相连，漏极与第二节点PD相连；第八开关晶体管T8的栅极与第二节点PD相连，源极与参考信号端Vref相连，漏极与第一节点PU相连；第九开关晶体管T9的栅极与第一节点PU相连，源极与参考信号端Vref相连，漏极与第二节点PD相连；第十开关晶体管T10的栅极与驱动信号输出端Out相连，源极与参考信号端Vref相连，漏极与第二节点PD相连；第十一开关晶体管T11的栅极与第一节点PU相连，源极与第一时钟信号端ck1相连，漏极与驱动信号输出端Out相连；第十二开关晶体管T12的栅极与第二节点PD相连，源极与参考信号端Vref相连，漏极与驱动信号输出端Out相连；第一电容C1连接于第二节点PD与参考信号端Vref之间；第二电容C2连接于第一节点PU与驱动信号输出端Out之间。
具体地，在图4中所有开关晶体管均为N型晶体管，当然在具体实施时，所有开关晶体管也可以均为P型晶体管，或者部分晶体管为N型晶体管，部分晶体管为P型晶体管，在此不作限定。
具体地，以图4所示的移位寄存器为例对本发明实施例提供的移位寄存器的工作原理进行说明。对应的工作时序图如图5所示，可以分为t1、t2、t3、t4和t5五个阶段。下述描述中以1表示高电位信号，0表示低电位信号。
在第一阶段t1，Input＝1，ck1＝0，ckb1＝1，Reset＝0，EN＝1。
由于Input＝1，第五开关晶体管T1导通，第一节点PU的电位为高电位，第十一开关晶体管T11导通，驱动信号输出端Out的电位为低电位。由于ckb1＝1，第七开关晶体管T7导通，同时由于第一节点PU的电位为高电位，第九开关晶体管T9导通，第二节点PD的电位为低电位。由于EN＝1，第一开关晶体管T1和第二开关晶体管T2导通，第三节点A的电位为高电位，第三开关晶体管T3导通，选择驱动输出端Output的电位为低电位。
在第二阶段t2，Input＝0，ck1＝1，ckb1＝0，Reset＝0，EN＝1。
由于ck1＝1，由于第二电容的自举作用，第一节点PU的电位被进一步拉高，第十一开关晶体管T11导通，驱动信号输出端Out的电位为高电位。由于第一节点PU的电位为高电位，第九开关晶体管T9导通，第二节点PD的电位为低电位。由于驱动信号输出端Out的电位为高电位，第十开关晶体管T10导通，第二节点PD的电位为低电位。由于EN＝1，第一开关晶体管T1和第二开关晶体管T2导通，第三节点A的电位为高电位，第三开关晶体管T3导通，选择驱动输出端Output的电位为高电位。
在第三阶段t3，Input＝0，ck1＝0，ckb1＝1，Reset＝1，EN＝1。
由于Reset＝1，第六开关晶体管T1导通，第一节点PU的电位为低电位。由于ckb1＝1，第七开关晶体管T7导通，第二节点PD的电位为高电位，第十二开关晶体管T12导通，驱动信号输出端Out的电位为低电位。由于第二节点PD的电位为高电位，第八开关晶体管T8导通，第一节点PU的电位为低电位。由于EN＝1，第一开关晶体管T1和第二开关晶体管T2导通，第四节点B的电位为高电位，第四开关晶体管T4导通，选择驱动输出端Output的电位为低电位。
在第四阶段t4，Input＝0，ck1＝1，ckb1＝0，Reset＝0，EN＝1。
由于第一电容C1的作用，第二节点PD的电位仍保持为高电位，第十二开关晶体管T12导通，驱动信号输出端Out的电位为低电位。由于第二节点PD的电位为高电位，第八开关晶体管T8导通，第一节点PU的电位为低电位。由于EN＝1，第一开关晶体管T1和第二开关晶体管T2导通，第四节点B的电位为高电位，第四开关晶体管T4导通，选择驱动输出端Output的电位为低电位。
在第五阶段t5，Input＝0，ck1＝0，ckb1＝1，Reset＝0，EN＝1。
由于ckb1＝1，第七开关晶体管T7导通，第二节点PD的电位为高电位，第十二开关晶体管T12导通，驱动信号输出端Out的电位为低电位。由于第二节点PD的电位为高电位，第八开关晶体管T8导通，第一节点PU的电位为低电位。由于EN＝1，第一开关晶体管T1和第二开关晶体管T2导通，第四节点B的电位为高电位，第四开关晶体管T4导通，选择驱动输出端Output的电位为低电位。
之后，移位寄存器一直重复第四阶段和第五阶段，直至输入信号端Input的电位再次变为高电位。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，Thin Film Transistor)，也可以是金属氧化物半导体场效应管(MOS，Metal Oxide Scmiconductor)，在此不做限定。在具体实施中，这些开关晶体管的源极和漏极根据晶体管类型以及输入信号的不同，其功能可以互换，在此不做具体区分。
基于同一发明构思，本发明实施例还提供了一种栅极驱动电路，如图6所示，包括级联的多个本发明实施例提供的上述移位寄存器：SR(1)、SR(2)…SR(m)…SR(N-1)、SR(N)(共N个移位寄存器，1≤m≤N)；其中，
除最后一级移位寄存器SR(N)之外，其余每一级移位寄存器SR(m)的驱动信号输出端OUT_m(1≤m≤N)分别与与其相邻的下一级移位寄存器SR(m+1)的输入信号端Input相连；
第一级移位寄存器SR(1)的信号输入端Input用于接收触发信号；
除第一级移位寄存器SR(1)之外，其余每一级移位寄存器SR(m)的驱动信号输出端OUT_m分别与与其相邻的上一级移位寄存器SR(m-1)的复位信号端Reset相连；
各级移位寄存器SR(m)的选择驱动输出端Output_m用于与栅线相连。
上述栅极驱动电路通过各级移位寄存器SR(m)的选择驱动输出端Output_m与对应的栅线gatem连接，用于顺序地向对应的栅线输出扫描信号。
进一步地，在本发明实施例提供的上述栅极驱动电路中，如图6所示，一般奇数级移位寄存器的第一时钟信号端ck1与偶数级移位寄存器的第二时钟信号端ckb1用于接收同一时钟信号(图中表示为CK1)，奇数级移位寄存器的第二时钟信号端ckb1与偶数级移位寄存器的第一时钟信号端ck1用于接收同一时钟信号(图中表示为CKB1)。
基于同一发明构思，本发明实施例还提供了一种显示面板，如图7所示，包括N条栅线(gate1、gate2、gate3…)，分别位于显示面板两侧且均与N条栅线连接的第一栅极驱动电路GOA1和第二栅极驱动电路GOA2，其中，第一栅极驱动电路GOA1和第二栅极驱动电路GOA2均为本发明实施例提供的上述栅极驱动电路；且各栅极驱动电路中的移位寄存器SR(n)的选择驱动输出端与对应的栅线连接；
显示面板还包括：与各栅极驱动电路(GOA1和GOA2)连接的至少用于向各栅极驱动电路(GOA1和GOA2)输出选择控制信号、以及向第一栅极驱动电路GOA1输出第一组时序控制信号(至少包括第一触发信号STV1、第一时钟信号CK1和第二时钟信号CKB1)，向第二栅极驱动电路输出的第二组时序控制信号(至少包括第二触发信号STV2、第三时钟信号CK2和第四时钟信号CKB2)的驱动控制电路10；其中，各组时序控制信号至少包括触发信号和时钟信号，且各组时序控制信号中触发信号的宽度相同，各栅极驱动电路(GOA1和GOA2)用于在接收的对应组时序控制信号的控制下依次由驱动信号输出端输出扫描信号。
下面通以第一栅极驱动电路GOA1为例，具体说明一组时序控制信号对一个栅极驱动电路的控制。第一栅极驱动电路GOA1如图6所示，驱动控制电路向第一级移位寄存器SR(1)输入第一触发信号STV1，分别向奇数级移位寄存器的第一时钟信号端ck1和偶数级移位寄存器的第二时钟信号端ckb1输入第一时钟信号CK1，向奇数级移位寄存器的第二时钟信号端ckb1和偶数级移位寄存器的第一时钟信号端ck1输入第二时钟信号CKB1。
当第一级移位寄存器SR(1)收到第一触发信号STV1后，当第一时钟信号端ck1第一次接收到第一时钟信号CK1时驱动信号输出端Out_1输出扫描信号，此时若对应的输出控制单元处于导通状态，则选择驱动输出端Output_1向第1条栅线gate1输出扫描信号，第一级移位寄存器SR(1)驱动信号输出端Out_1输出的扫描信号提供给第二级移位寄存器SR(2)的输入信号端Input；当第二级移位寄存器SR(2)收到第一级移位寄存器SR(1)输出的扫描信号后，当其第一时钟信号端ck1第一次接收到第二时钟信号CKB1驱动信号输出端Out_2输出扫描信号，此时若对应的输出控制单元处于导通状态，则选择驱动输出端Output_2向第2条栅线gate2输出扫描信号，第二级移位寄存器SR(2)驱动信号输出端Out_2输出的扫描信号提供给第三级移位寄存器SR(3)的输入信号端Input；当第三级移位寄存器SR(3)收到第二级移位寄存器SR(2)输出的扫描信号后，当其第一时钟信号端ck1接收到第一时钟信号CK1时驱动信号输出端Out_3输出扫描信号，此时若对应的输出控制单元处于导通状态，则选择驱动输出端Output_3向第3条栅线gate3输出扫描信号，第三级移位寄存器SR(3)驱动信号输出端Out_3输出的扫描信号提供给第四级移位寄存器SR(4)的输入信号端Input，依次类推，各级移位寄存器依次向对应的栅线输出扫描信号。具体第一栅极驱动电路对应的输入输出时序图如图8所示。
具体地，驱动控制电路向第二栅极驱动电路的第一级移位寄存器输入第二触发信号，分别向奇数级移位寄存器的第一时钟信号端和偶数级移位寄存器的第二时钟信号端输入第三时钟信号，向奇数级移位寄存器的第二时钟信号端和偶数级移位寄存器的第一时钟信号端输入第四时钟信号。第二栅极驱动电路的具体工作原理与第一栅极驱动电路的工作原理相同，在此不作赘述。
较佳地，在本发明实施例提供的上述显示面板中，如图9a所示，还包括：与各驱动控制电路10连接的模式切换电路20；其中，模式切换电路20用于，在接收到第一模式控制信号时：
使第一组时序控制信号(至少包括第一触发信号STV1、第一时钟信号CK1和第二时钟信号CKB1)中各信号的时序比第二组时序控制信号(至少包括第二触发信号STV2、第三时钟信号CK2和第四时钟信号CKB2)中对应信号的时序延迟一个触发信号宽度；具体两组时序控制信号时序图如图9b所示；目的是为了使各级移位寄存的驱动信号输出端依次有扫描信号输出；并且当第一驱动控制电路的第n级移位寄存的驱动信号输出端输出扫描信号时，第二驱动控制电路的第n+1级移位寄存的驱动信号输出端也输出扫描信号；
并且控制驱动控制电路10向与第一栅极驱动电路GOA1中与奇数条栅线(gate1、gate3、gate5…)连接的移位寄存器(SR(1)、SR(3)、SR(5)…)的选择控制信号端均输出选择控制信号，向与第二栅极驱动电路GOA2中与偶数条栅线(gate2、gate4、gate6…)连接的移位寄存器(SR(2)、SR(4)、SR(4)…)的选择控制信号端均输出选择控制信号；目的是为了使第一栅极驱动电路仅向奇数条栅线依次输出扫描信号，使第二栅极驱动电路仅向偶数条栅线依次输出扫描信号，从而实现沿扫描方向以相邻的两条栅线为一栅线组，各栅线组依次接收扫描信号，即显示面板是以两条栅线同时扫描的，显示面板的分辨率降低为1/2分辨率。
具体地，在图9a中，栅线起始端为黑点表示栅极驱动电路中移位寄存器的选择控制信号端是有选择控制信号的，对应的选择驱动输出端是可以输出扫描信号的，栅线起始端为圆圈表示栅极驱动电路中移位寄存器的选择控制信号端是没有选择控制信号的，对应的选择驱动输出端是不输出扫描信号的。
具体地，本发明实施例提供的上述显示面板，当模式切换电路接收到第一模式控制信号时，沿扫描方向显示面板上各栅线上扫描信号的时序图如图9c所示。
较佳地，在本发明实施例提供的上述显示面板中，如图10a和图10d所示，还包括：针对每一个n的取值，分别连接在第一栅极驱动电路GOA1的第3n-2级移位寄存器的第三节点与第3n级移位寄存器的第三节点之间的第一开关器件30(具体结构图10a中未示出，参见图10d)，以及分别连接在第一栅极驱动电路的第3n-2级移位寄存器的第四节点与第3n级移位寄存器的第四节点之间的第二开关器件40(具体结构图10a中未示出，参见图10d，图10d为图10a中虚线框的局部具体结构示意图)；其中n为大于0的整数，模式切换电路20还用于，在接收到第二模式控制信号时：
控制所有的第一开关器件30和所有第二开关器件40处于导通状态；目的是为了使第一栅极驱动电路第3n-2级移位寄存器的第三节点与第3n级移位寄存器的第三节点的电位相同，以及使第一栅极驱动电路的第3n-2级移位寄存器的第四节点与第3n级移位寄存器的第四节点的电位相同，从而使第一栅极驱动电路的第3n-2级移位寄存器的选择驱动输出端的电位与第3n级移位寄存器的选择驱动输出端的电位相同；
使第二组时序控制信号(至少包括第二触发信号STV2、第三时钟信号CK2和第四时钟信号CKB2)中各信号的时序比第一组时序控制信号(至少包括第一触发信号STV1、第一时钟信号CK1和第二时钟信号CKB1)中对应信号的时序延迟一个触发信号宽度；具体两组时序控制信号时序图如图10b所示；目的是为了使各级移位寄存的驱动信号输出端依次有扫描信号输出；并且当第二驱动控制电路的第n级移位寄存的驱动信号输出端输出扫描信号时，第一驱动控制电路的第n+1级移位寄存的驱动信号输出端也输出扫描信号；
并且控制驱动控制电路向第一栅极驱动电路中与第3n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向第二栅极驱动电路中与第3n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号。目的是为了使第一栅极驱动电路仅向第3n条栅线依次输出扫描信号，使第二栅极驱动电路仅向第3n-1条栅线依次输出扫描信号，从而实现沿扫描方向以相邻的三条栅线为一栅线组，各栅线组依次接收扫描信号，即显示面板是以三条栅线同时扫描的，显示面板的分辨率降低为1/3分辨率。
具体地，在图10a中，栅线起始端为黑点表示栅极驱动电路中移位寄存器的选择控制信号端是有选择控制信号的，对应的选择驱动输出端是可以输出扫描信号的，栅线起始端为圆圈表示栅极驱动电路中移位寄存器的选择控制信号端是没有选择控制信号的，对应的驱动输出端是不输出扫描信号的。
具体地，本发明实施例提供的上述显示面板，当模式切换电路接收到第二模式控制信号时，沿扫描方向显示面板上各栅线上扫描信号的时序图如图10c所示。
较佳地，在本发明实施例提供的上述显示面板中，如图11a所示，还包括：针对每一个n的取值，分别连接在第一栅极驱动电路GOA1的第4n-1级移位寄存器的第三节点与第4n-3级移位寄存器的第三节点之间的第三开关器件50，分别连接在第一栅极驱动电路GOA1的第4n-1级移位寄存器的第四节点与第4n-3级移位寄存器的第四节点之间的第四开关器件60，分别连接在第二栅极驱动电路GOA2的第4n级移位寄存器的第三节点与第4n-2级移位寄存器的第三节点之间的第五开关器件70，以及分别连接在第二栅极驱动电路GOA2的第4n级移位寄存器的第四节点与第4n-2级移位寄存器的第四节点之间的第六开关器件80；
模式切换电路还用于，在接收到第三模式控制信号时：
控制所有的第一开关器件30和所有第二开关器件40处于关闭状态；控制所有的第三开关器件50、所有第四开关器件60、所有第五开关器件70和所有第六开关器件80处于导通状态；目的是为了使第一栅极驱动电路的第4n-1级移位寄存器的选择驱动输出端的电位与第4n-3级移位寄存器的选择驱动输出端的电位相同；使第二栅极驱动电路的第4n级移位寄存器的选择驱动输出端的电位与第4n-2级移位寄存器的选择驱动输出端的电位相同；
使第一组时序控制信号中各信号的时序比第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；目的是为了使各级移位寄存的驱动信号输出端依次有扫描信号输出；并且当第一驱动控制电路的第n级移位寄存的驱动信号输出端输出扫描信号时，第二驱动控制电路的第n+1级移位寄存的驱动信号输出端也输出扫描信号；
并且控制驱动控制电路向与第一栅极驱动电路中与第4n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向第二栅极驱动电路中与第4n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号。目的是为了使第一栅极驱动电路仅向第4n-1条栅线依次输出扫描信号，使第二栅极驱动电路仅向第4n条栅线依次输出扫描信号，从而实现沿扫描方向以相邻的四条栅线为一栅线组，各栅线组依次接收扫描信号，即显示面板是以四条栅线同时扫描的，显示面板的分辨率降低为1/4分辨率。
具体地，本发明实施例提供的上述显示面板，当模式切换电路接收到第三模式控制信号时，沿扫描方向显示面板上各栅线上扫描信号的时序图如图11b所示。
较佳地，在本发明实施例提供的上述显示面板中，模式切换电路还用于，在接收到第四模式控制信号时：
控制所有的开关器件处于关闭状态；目的是为了保证各栅线的信号之间互相不影响；
使第二组时序控制信号中各信号的时序与第一组时序控制信号中对应信号的时序相同；目的是为了使当第一驱动控制电路的第n级移位寄存的驱动信号输出端输出扫描信号时，第二驱动控制电路的第n级移位寄存的驱动信号输出端也输出扫描信号；
并且控制驱动控制电路向所有移位寄存器的选择控制信号端均输出选择控制信号。目的是为了第一栅极驱动电路向N条栅线依次输出扫描信号，使第二栅极驱动电路向N条栅线依次输出扫描信号，从而实现沿扫描方向逐行扫描的功能，即显示面板具有较高的分辨率。这样本发明实施例提供的上述显示面板，不仅可以可以在需要省电的时候，设置为低分辨率显示，并且可以在不需要省电的时候实现高分辨率显示。
具体地，本发明实施例提供的上述显示面板，当模式切换电路接收到第四模式控制信号时，沿扫描方向显示面板上各栅线上扫描信号的时序图如图12所示。
需要说明的是，在本发明实施例提供的显示面板中，第一模式控制信号、第二模式控制信号、第三模式控制信号和第四模式控制信号中，各模式控制信号的维持时长是扫描N条栅线所用的时长的整数倍，且任意两个模式控制信号之间的切换点与扫描栅线的起始点同步。
进一步地，本发明实施例提供的上述显示面板，开关器件可以是开关晶体管，也可以是其它电子开关控制模块，在此不作限定。
具体地，本发明实施例提供的上述显示面板，通过在移位寄存器中设置输出控制单元、第二上拉单元、第二下拉单元，在移位寄存器之间增加开关器件，以及控制两组时序控制信号的时序达到降低分辨率，虽然本发明实施例只是给出了四种情况，但是基于上述思想得到的实现1/5分辨、1/6分辨等的显示面板也属于本发明的保护范围。
在具体实施时，在本发明实施例提供的上述显示面板，使用者可以根据实际需求通过该显示面板的操作界面向模式切换电路发送模式控制信号，在此不作限定。
进一步地，发明实施例提供的上述显示面板，既可以是液晶显示面板，也可以是有机电致发光显示面板，在此不作限定。
基于同一发明构思，本发明实施例还提供了一种显示装置，包括本发明实施例提供的上述任一种显示面板。该显示装置可以为：手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。该显示装置的实施可以参见上述显示面板的实施例，重复之处不再赘述。
基于同一发明构思，本发明实施例还提供了上述显示面板的驱动方法，包括：
当模式切换电路在接收到第一模式控制信号时：控制所有开关器件处于关闭状态，使第一组时序控制信号中各信号的时序比第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制驱动控制电路向与第一栅极驱动电路中与奇数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向与第二栅极驱动电路中与偶数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当模式切换电路在接收到第二模式控制信号时：控制所有的第一开关器件和所有第二开关器件处于导通状态；控制所有的第三开关器件、所有第四开关器件、所有第五开关器件和所有第六开关器件处于关闭状态；使第二组时序控制信号中各信号的时序比第一组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制驱动控制电路向第一栅极驱动电路中与第3n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向第二栅极驱动电路中与第3n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当模式切换电路在接收到第三模式控制信号时：控制所有的第一开关器件和所有第二开关器件处于关闭状态；控制所有的第三开关器件、所有第四开关器件、所有第五开关器件和所有第六开关器件处于导通状态；使第一组时序控制信号中各信号的时序比第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制驱动控制电路向与第一栅极驱动电路中与第4n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向第二栅极驱动电路中与第4n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当模式切换电路在接收到第四模式控制信号时：控制所有的开关器件处于关闭状态；使第二组时序控制信号中各信号的时序与第一组时序控制信号中对应信号的时序相同；并且控制驱动控制电路向所有移位寄存器的选择控制信号端均输出选择控制信号。
本发明实施例提供的一种移位寄存器、显示面板的驱动方法及相关装置，移位寄存器相当于在现有的移位寄存器的基础上增加了输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端；其中，输出控制单元用于在选择控制信号端接收到选择控制信号时，使第一节点和第三节点导通，以及使第二节点和第四节点导通；第二上拉单元用于在第三节点的控制下将第一时钟信号端的信号提供给选择驱动输出端；第二下拉单元用于在第四节点的控制下，将参考信号端的信号提供给选择驱动输出端。从而可以通过输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端的控制决定选择驱动输出端是否有扫描信号输出。进而在采用上述移位寄存器构成的栅极驱动电路中，可以实现选择性的向部分栅线输出扫描信号。进一步在本发明实施例提供的显示面板中在采用上述栅极驱动电路，并且还增加了分别连接两个移位寄存器的第三节点以及分别连接两个移位寄存器的第四节点之间的开关器件，以及与驱动控制电路连接的模式切换电路。这样当模式切换电路在接收到不同的模式控制信号时，可以使显示面板按不同的分辨率进行显示，从而可以选择性的使显示面板降低功耗，延长待机时间。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (12)

1.一种移位寄存器，包括：输入单元、复位单元、节点控制单元、第一上拉单元、第一下拉单元、输入信号端、复位信号端、第一时钟信号端和参考信号端；其中，所述输入单元的输出端、所述复位单元的输出端、所述节点控制单元的第一端、以及所述第一上拉单元的控制端均与第一节点相连，所述节点控制单元的第二端和第一下拉单元的控制端均与第二节点相连；所述第一上拉单元的输出端和所述第一下拉单元的输出端均与所述移位寄存器的驱动信号输出端相连；所述输入单元用于在输入信号端的控制下控制所述第一节点的电位，所述复位单元用于在复位信号端的控制下控制所述第一节点的电位，所述节点控制单元用于控制所述第一节点和所述第二节点的电位，所述第一上拉单元用于在所述第一节点的控制下将第一时钟信号端的信号提供给驱动信号输出端，所述第一下拉单元用于在所述第二节点的控制下，将参考信号端的信号提供给所述提供给驱动信号输出端；其特征在于，所述移位寄存器还包括：输出控制单元、第二上拉单元、第二下拉单元和选择控制信号端；其中，
所述输出控制单元的第一输入端与所述第一节点相连，第二输入端与所述第二节点相连，第三输入端与所述选择控制信号端相连，第一输出端分别与第三节点和所述第二上拉单元的第一输入端相连，第二输出端分别与第四节点和所述第二下拉单元的第一输入端相连；所述第二上拉单元的第二输入端与所述第一时钟信号端相连，输出端与所述第二下拉单元的输出端相连作为所述移位寄存器的选择驱动输出端；所述第二下拉单元的第二输入端与所述参考信号端相连；
所述输出控制单元用于在所述选择控制信号端接收到选择控制信号时，使所述第一节点和所述第三节点导通，以及使所述第二节点和所述第四节点导通；所述第二上拉单元用于在所述第三节点的控制下将所述第一时钟信号端的信号提供给所述选择驱动输出端；所述第二下拉单元用于在所述第四节点的控制下，将所述参考信号端的信号提供给所述选择驱动输出端。
2.如权利要求1所述的移位寄存器，其特征在于，所述输出控制单元，具体包括：第一开关晶体管和第二开关晶体管；其中，
所述第一开关晶体管，其栅极与所述选择控制信号端相连，源极与所述第一节点相连，漏极与所述第三节点相连；
所述第二开关晶体管，其栅极与所述选择控制信号端相连，源极与所述第二节点相连，漏极与所述第四节点相连。
3.如权利要求1所述的移位寄存器，其特征在于，所述第二上拉单元，具体包括：第三开关晶体管；其中，
所述第三开关晶体管，其栅极与所述第三节点相连，源极与所述第一时钟信号端相连，漏极与所述选择驱动输出端相连。
4.如权利要求1所述的移位寄存器，其特征在于，所述第二下拉单元，具体包括：第四开关晶体管；其中，
所述第四开关晶体管，其栅极与所述第四节点相连，源极与所述参考信号端相连，漏极与所述选择驱动输出端相连。
5.一种栅极驱动电路，其特征在于，包括级联的多个如权利要求1-4任一项所述的移位寄存器；其中，
除最后一级移位寄存器之外，其余每一级移位寄存器的驱动信号输出端分别与与其相邻的下一级移位寄存器的输入信号端相连；
第一级移位寄存器的信号输入端用于接收触发信号；
除第一级移位寄存器之外，其余每一级移位寄存器的驱动信号输出端分别与与其相邻的上一级移位寄存器的复位信号端相连；
各级移位寄存器的选择驱动输出端用于与栅线相连。
6.一种显示面板，包括N条栅线，分别位于显示面板两侧且均与所述N条栅线连接的第一栅极驱动电路和第二栅极驱动电路，其特征在于，所述第一栅极驱动电路和所述第二栅极驱动电路均为如权利要求5所述的栅极驱动电路；且各所述栅极驱动电路中的移位寄存器的选择驱动输出端与对应的栅线连接；
所述显示面板还包括：与各栅极驱动电路连接的至少用于向各栅极驱动电路输出选择控制信号、以及向所述第一栅极驱动电路输出第一组时序控制信号，向所述第二栅极驱动电路输出的第二组时序控制信号的驱动控制电路；其中，各组时序控制信号至少包括触发信号和时钟信号，且各组时序控制信号中触发信号的宽度相同，各所述栅极驱动电路用于在接收的对应组时序控制信号的控制下依次由驱动信号输出端输出扫描信号。
7.如权利要求6所述的显示面板，其特征在于，还包括：与各所述驱动控制电路连接的模式切换电路；其中，所述模式切换电路用于，在接收到第一模式控制信号时：
使所述第一组时序控制信号中各信号的时序比所述第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；
并且控制所述驱动控制电路向与所述第一栅极驱动电路中与奇数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向与所述第二栅极驱动电路中与偶数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号。
8.如权利要求7所述的显示面板，其特征在于，还包括：针对每一个n的取值，分别连接在所述第一栅极驱动电路的第3n-2级移位寄存器的第三节点与第3n级移位寄存器的第三节点之间的第一开关器件，以及分别连接在所述第一栅极驱动电路的第3n-2级移位寄存器的第四节点与第3n级移位寄存器的第四节点之间的第二开关器件；其中，n为大于0的正整数，所述模式切换电路还用于，在接收到第二模式控制信号时：
控制所有的第一开关器件和所有第二开关器件处于导通状态；
使所述第二组时序控制信号中各信号的时序比所述第一组时序控制信号中对应信号的时序延迟一个触发信号宽度；
并且控制所述驱动控制电路向所述第一栅极驱动电路中与第3n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向所述第二栅极驱动电路中与第3n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号。
9.如权利要求8所述的显示面板，其特征在于，还包括：针对每一个n的取值，分别连接在所述第一栅极驱动电路的第4n-1级移位寄存器的第三节点与第4n-3级移位寄存器的第三节点之间的第三开关器件，分别连接在所述第一栅极驱动电路的第4n-1级移位寄存器的第四节点与第4n-3级移位寄存器的第四节点之间的第四开关器件，分别连接在所述第二栅极驱动电路的第4n级移位寄存器的第三节点与第4n-2级移位寄存器的第三节点之间的第五开关器件，分别连接在所述第二栅极驱动电路的第4n级移位寄存器的第四节点与第4n-2级移位寄存器的第四节点之间的第六开关器件；
所述模式切换电路还用于，在接收到第三模式控制信号时：
控制所有的第一开关器件和所有第二开关器件处于关闭状态；控制所有的第三开关器件、所有第四开关器件、所有第五开关器件和所有第六开关器件处于导通状态；
使所述第一组时序控制信号中各信号的时序比所述第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；
并且控制所述驱动控制电路向与所述第一栅极驱动电路中与第4n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向所述第二栅极驱动电路中与第4n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号。
10.如权利要求9所述的显示面板，其特征在于，所述模式切换电路还用于，在接收到第四模式控制信号时：
控制所有的开关器件处于关闭状态；
使所述第二组时序控制信号中各信号的时序与所述第一组时序控制信号中对应信号的时序相同；
并且控制所述驱动控制电路向所有移位寄存器的选择控制信号端均输出选择控制信号。
11.一种显示装置，其特征在于，包括如权利要求6-10任一项所述的显示面板。
12.一种如权利要求10所述的显示面板的驱动方法，其特征在于，包括：
当所述模式切换电路在接收到第一模式控制信号时：控制所有开关器件处于关闭状态，使所述第一组时序控制信号中各信号的时序比所述第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制所述驱动控制电路向与所述第一栅极驱动电路中与奇数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向与所述第二栅极驱动电路中与偶数条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当所述模式切换电路在接收到第二模式控制信号时：控制所有的第一开关器件和所有第二开关器件处于导通状态；控制所有的第三开关器件、所有第四开关器件、所有第五开关器件和所有第六开关器件处于关闭状态；使所述第二组时序控制信号中各信号的时序比所述第一组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制所述驱动控制电路向所述第一栅极驱动电路中与第3n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向所述第二栅极驱动电路中与第3n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当所述模式切换电路在接收到第三模式控制信号时：控制所有的第一开关器件和所有第二开关器件处于关闭状态；控制所有的第三开关器件、所有第四开关器件、所有第五开关器件和所有第六开关器件处于导通状态；使所述第一组时序控制信号中各信号的时序比所述第二组时序控制信号中对应信号的时序延迟一个触发信号宽度；并且控制所述驱动控制电路向与所述第一栅极驱动电路中与第4n-1条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号，向所述第二栅极驱动电路中与第4n条栅线连接的移位寄存器的选择控制信号端均输出选择控制信号；
当所述模式切换电路在接收到第四模式控制信号时：控制所有的开关器件处于关闭状态；使所述第二组时序控制信号中各信号的时序与所述第一组时序控制信号中对应信号的时序相同；并且控制所述驱动控制电路向所有移位寄存器的选择控制信号端均输出选择控制信号。
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