CN106960655A - 一种栅极驱动电路及显示面板 - Google Patents

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Abstract

本发明公开了一种栅极驱动电路及显示面板，该栅极驱动电路通过增加控制模块，在触控阶段控制输出模块的关键节点的电位，即在触控阶段将切换信号端的低电平信号输出到本级移位寄存器的输出模块的第一节点，稳定关键节点即第一节点在触控阶段的电位，避免关键节点的电位处于Floating状态而被电容耦合偏离稳定电位；在触控阶段结束前过渡到显示的阶段，将切换信号端的高电平信号输出到第一节点，从而拉高第一节点的电位，进而使得输出模块在显示阶段可以在高电位的第一节点的控制下稳定输出扫描信号，保证显示面板在显示阶段的正常显示。

Description

一种栅极驱动电路及显示面板
技术领域
本发明涉及显示技术领域，尤其涉及一种栅极驱动电路及显示面板。
背景技术
目前在触控显示面板中，移位寄存器的电路结构如图1所示，其主要包括：开关晶体管M1～M8和电容C1和C2；在触控时间段Touch内，如图2所示，移位寄存器电路中的控制信号CK，CKB，CN，CNB，RESET都处于低电平状态，触控结束后进入显示阶段Display用于显示画面的第一行栅线对应的移位寄存器的关键节点PU的状态是高电平并且为Floating状态，其在触控阶段也是以Floating状态保持较长的时间(50us-150us)；在触控结束后，关键节点PU需要进一步被拉高，才能保证移位寄存器正常输出，从而保证该行显示正常。但是，触控阶段显示面板内的触控电压信号的电压在不断的高低变化，关键节点PU的电压信号处于Floating状态，就会很容易被电容耦合而偏离高电平，这样导致在触控结束后即使控制信号CN变为高电平，但此时信号输入端Input信号为低电平，使得开关晶体管M1无法在此时打开，进而无法使关键节点PU的电位拉高到高电平准位，从而影响了该移位寄存器正常输出扫描信号，进而影响了显示面板的显示效果。
因此，如何在触控阶段稳定移位寄存器的关键节点的电位，且在触控结束后保证关键节点的电位达到准位，从而保证移位寄存器的正常输出，是本领域技术人员亟待解决的技术问题。
发明内容
本发明实施例提供了一种栅极驱动电路及显示面板，用以在触控阶段稳定移位寄存器的关键节点的电位，且在触控结束后保证关键节点的电位达到准位，从而保证移位寄存器的正常输出。
本发明实施例提供了一种栅极驱动电路，包括：级联的且与栅线一一对应的多个移位寄存器；每个所述移位寄存器包括：在显示阶段用于向对应的所述栅线输入扫描信号的输出模块，以及在触控阶段用于控制所述输出模块的节点电位的控制模块；其中，
各所述移位寄存器的控制模块的第一控制端与相邻上一级所述移位寄存器的输出模块的第一节点相连，第二控制端用于输入第一控制信号，输入端与切换信号端相连，输出端与本级所述移位寄存器的输出模块的第一节点相连；
在触控阶段，所述控制模块用于在相邻上一级所述移位寄存器的输出模块的第一节点和所述第一控制信号的控制下，将所述切换信号端的低电平信号输出到本级移位寄存器的输出模块的第一节点；
在触控阶段到显示阶段的过渡阶段，所述控制模块用于在相邻上一级所述移位寄存器的输出模块的第一节点和所述第一控制信号的控制下，将所述切换信号端的高电平信号输出到本级移位寄存器的输出模块的第一节点；
在显示阶段，所述输出模块用于在本级移位寄存器的所述第一节点的控制下，向对应的所述栅线输入扫描信号。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述控制模块，包括：第一子单元和第二子单元；其中，
所述第一子单元的控制端用于输入所述第一控制信号，输入端与所述切换信号端相连，输出端与所述第二子单元的输入端相连；所述第一子单元用于在所述第一控制信号的控制下，将所述切换信号端的信号输出到所述第二子单元的输入端；
所述第二子单元的控制端与相邻上一级所述移位寄存器的输出模块的第一节点相连，输出端与本级所述移位寄存器的输出模块的第一节点相连；所述第二子单元用于在相邻上一级所述移位寄存器的输出模块的第一节点的控制下，将所述第一子单元的输出端的信号输出到本级所述移位寄存器的输出模块的第一节点。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，还包括：重置模块；
所述重置模块的控制端用于输入第二控制信号，输入端用于输入低电平信号，输出端与所述第二子单元的输入端相连；所述重置模块用于在所述第二控制信号的控制下，将所述低电平信号输出到所述第二子单元的输入端。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述重置模块，包括：第一开关晶体管；
所述第一开关晶体管的栅极用于输入第二控制信号，源极用于输入低电平信号，漏极与所述第二子单元的输入端相连。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述第一子单元，包括：第二开关晶体管；
所述第二开关晶体管的栅极用于输入所述第一控制信号，源极与所述切换信号端相连，漏极与所述第二子单元的输入端相连。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述第二子单元，包括：第三开关晶体管；
所述第三开关晶体管的栅极与相邻上一级所述移位寄存器的输出模块的第一节点相连，源极与所述第一子单元的输出端相连，漏极与本级所述移位寄存器的输出模块的第一节点相连。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述输出模块，包括：上拉单元、复位单元、下拉单元、控制单元和输出单元；其中，
所述上拉单元的控制端与信号输入端相连，输入端用于输入第一参考信号，输出端与本级移位寄存器的所述第一节点相连；所述上拉单元用于在所述信号输入端的控制下，将所述第一参考信号输出到本级移位寄存器的所述第一节点；
所述复位单元的控制端与复位信号端相连，输入端用于输入第二参考信号，输出端与本级移位寄存器的所述第一节点相连；所述复位单元用于在所述复位信号端的控制下，将所述第二参考信号输出到本级移位寄存器的所述第一节点；
所述下拉单元的控制端与第二节点相连，输入端用于输入低电平信号，输出端与本级移位寄存器的所述第一节点相连；所述下拉单元用于在所述第二节点的控制下，将所述低电平信号输出到本级移位寄存器的所述第一节点；
所述控制单元的第一控制端和第一输入端用于输入第一时钟信号，第二控制端与本级移位寄存器的所述第一节点相连，第三控制端与所述输出单元的输出端相连，第二输入端用于输入所述低电平信号，输出端与所述第二节点相连；所述控制单元用于在所述第一时钟信号的控制下，将所述第一时钟信号输出到所述第二节点，在本级移位寄存器的所述第一节点或所述输出单元的输出端的控制下，将所述低电平信号输出到所述第二节点；
所述输出单元的第一控制端与本级移位寄存器的所述第一节点相连，第二控制端与所述第二节点相连，第一输入端用于输入第二时钟信号，第二输入端用于输入所述低电平信号，输出端用于输出扫描信号；所述输出单元用于在本级移位寄存器的所述第一节点的控制下将所述第二时钟信号通过所述输出端输出，在所述第二节点的控制下将所述低电平信号通过所述输出端输出。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述上拉单元，包括：第四开关晶体管；
所述第四开关晶体管的栅极与所述信号输入端相连，源极用于输入所述第一参考信号，漏极与本级移位寄存器的所述第一节点相连。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述复位单元，包括：第五开关晶体管；
所述第五开关晶体管的栅极与所述复位信号端相连，源极用于输入所述第二参考信号，漏极与本级移位寄存器的所述第一节点相连。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述下拉单元，包括：第六开关晶体管；
所述第六开关晶体管的栅极与所述第二节点相连，源极用于输入所述低电平信号，漏极与本级移位寄存器的所述第一节点相连。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述控制单元，包括：第七开关晶体管、第八开关晶体管和第九开关晶体管；其中，
所述第七开关晶体管的栅极和源极用于输入所述第一时钟信号，漏极与所述第二节点相连；
所述第八开关晶体管的栅极与本级移位寄存器的所述第一节点相连，源极用于输入所述低电平信号，漏极与所述第二节点相连；
所述第九开关晶体管的栅极与所述输出单元的输出端相连，源极用于输入所述低电平信号，漏极与所述第二节点相连。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，所述输出单元，包括：第十开关晶体管、第十一开关晶体管和电容；其中，
所述第十开关晶体管的栅极与本级移位寄存器的所述第一节点相连，源极用于输入所述第二时钟信号，漏极用于将所述第二时钟信号输出；
所述第十一开关晶体管的栅极与所述第二节点相连，源极用于输入所述低电平信号，漏极用于将所述低电平信号输出；
所述电容连接于本级移位寄存器的所述第一节点与所述第十开关晶体管的漏极之间。
在一种可能的实施方式中，本发明实施例提供的上述栅极驱动电路中，除第一级移位寄存器和最后一级移位寄存器之外，其余每级移位寄存器的输出模块的第一节点均与其相邻的下一级移位寄存器的控制模块的第一控制端相连；且每级移位寄存器的输出模块的输出端均向与其相邻的下一级移位寄存器的输出模块输入触发信号，向与其相邻的上一级移位寄存器的输出模块输入复位信号；
第一级移位寄存器的输出模块的第一节点与第二级移位寄存器的控制模块的第一控制端相连；且输出模块的输出端向第二级移位寄存器的输出模块输入触发信号；
最后一级移位寄存器的输出模块的输出端向与其相邻的上一级移位寄存器的输出模块输入复位信号。
本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。
本发明实施例的有益效果包括：
本发明实施例提供了一种栅极驱动电路及显示面板，该栅极驱动电路可以包括：级联的且与栅线一一对应的多个移位寄存器；每个移位寄存器包括：在显示阶段用于向对应的栅线输入扫描信号的输出模块，以及在触控阶段用于控制输出模块的节点电位的控制模块；其中，各移位寄存器的控制模块的第一控制端与相邻上一级移位寄存器的输出模块的第一节点相连，第二控制端用于输入第一控制信号，输入端与切换信号端相连，输出端与本级移位寄存器的输出模块的第一节点相连；在触控阶段，控制模块用于在相邻上一级移位寄存器的输出模块的第一节点和第一控制信号的控制下，将切换信号端的低电平信号输出到本级移位寄存器的输出模块的第一节点；在触控阶段到显示阶段的过渡阶段，控制模块用于在相邻上一级移位寄存器的输出模块的第一节点和第一控制信号的控制下，将切换信号端的高电平信号输出到本级移位寄存器的输出模块的第一节点；在显示阶段，输出模块用于在本级移位寄存器的第一节点的控制下，向对应的栅线输入扫描信号。
本发明实施例提供的上述栅极驱动电路，通过增加控制模块在触控阶段控制输出模块的关键节点的电位，即在触控阶段将切换信号端的低电平信号输出到本级移位寄存器的输出模块的第一节点，稳定关键节点即第一节点在触控阶段的电位，避免关键节点的电位处于Floating状态而被电容耦合偏离稳定电位；在触控结束前过渡到显示的阶段，将切换信号端的高电平信号输出到第一节点，从而拉高第一节点的电位，进而使得输出模块在显示阶段可以在高电位的第一节点的控制下稳定输出扫描信号，保证显示面板在显示阶段的正常显示。
附图说明
图1为现有技术中移位寄存器的结构示意图；
图2为现有技术中移位寄存器的工作时序图；
图3为本发明实施例提供的栅极驱动电路的结构示意图；
图4为本发明实施例提供的栅极驱动电路中移位寄存器的结构示意图；
图5为本发明实施例提供的移位寄存器的工作时序图。
具体实施方式
下面结合附图，对本发明实施例提供的栅极驱动电路及显示面板的具体实施方式进行详细的说明。
本发明实施例提供了一种栅极驱动电路，如图3所示，包括：级联的且与栅线一一对应的多个移位寄存器；每个所述移位寄存器包括：在显示阶段用于向对应的栅线输入扫描信号的输出模块01，以及在触控阶段用于控制输出模块的节点电位的控制模块02；其中，
各移位寄存器的控制模块02的第一控制端与相邻上一级移位寄存器的输出模块01的第一节点P1-U相连，第二控制端用于输入第一控制信号CL1，输入端与切换信号端EN相连，输出端与本级移位寄存器的输出模块01的第一节点P1相连；
在触控阶段，控制模块02用于在相邻上一级移位寄存器的输出模块01的第一节点P1和第一控制信号CL1的控制下，将切换信号端EN的低电平信号输出到本级移位寄存器的输出模块01的第一节点P1；
在触控阶段到显示阶段的过渡阶段，控制模块02用于在相邻上一级移位寄存器的输出模块01的第一节点P1-U和第一控制信号CL1的控制下，将切换信号端EN的高电平信号输出到本级移位寄存器的输出模块01的第一节点P1；
在显示阶段，输出模块01用于在本级移位寄存器的第一节点P1的控制下，通过输出端Out向对应的栅线输入扫描信号。
本发明实施例提供的上述栅极驱动电路，通过增加控制模块在触控阶段控制输出模块的关键节点的电位，即在触控阶段将切换信号端的低电平信号输出到本级移位寄存器的输出模块的第一节点，稳定关键节点即第一节点在触控阶段的电位，避免关键节点的电位处于Floating状态而被电容耦合偏离稳定电位；在触控结束前过渡到显示的阶段，将切换信号端的高电平信号输出到第一节点，从而拉高第一节点的电位，进而使得输出模块在显示阶段可以在高电位的第一节点的控制下稳定输出扫描信号，保证显示面板在显示阶段的正常显示。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，控制模块02可以包括：第一子单元021和第二子单元022；其中，第一子单元021的控制端用于输入第一控制信号CL1，输入端与切换信号端EN相连，输出端与第二子单元022的输入端相连；第一子单元021用于在第一控制信号CL1的控制下，将切换信号端EN的信号输出到第二子单元022的输入端；第二子单元022的控制端与相邻上一级移位寄存器的输出模块01的第一节点P1-U相连，输出端与本级移位寄存器的输出模块01的第一节点P1相连；第二子单元022用于在相邻上一级移位寄存器的输出模块01的第一节点P1-U的控制下，将第一子单元021的输出端的信号输出到本级移位寄存器的输出模块01的第一节点P1。
具体地，本发明实施例提供的上述栅极驱动电路中，控制模块可以包括第一子单元和第二子单元；其中，第一子单元用于将切换信号端的信号输出到第二子单元的输入端，进而第二子单元将切换信号端的信号输出到输出模块的关键节点即第一节点，从而实现在触控阶段将低电平信号输入到关键节点即第一节点，用以稳定第一节点的电位；在触控结束前过渡到显示阶段的时间段，将高电平信号输出到输出模块的关键节点即第一节点，拉高第一节点的电位，以保证移位寄存器的正常输出。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，还可以包括：重置模块03；重置模块03的控制端用于输入第二控制信号CL2，输入端用于输入低电平信号VGL，输出端与第二子单元022的输入端相连；重置模块03用于在第二控制信号CL2的控制下，将低电平信号VGL输出到第二子单元022的输入端。具体地，在触控阶段结束后，通过增加的重置模块可以将低电平信号输出到第二子单元的输入端，从而拉低第二子单元的输入端的信号，进而防止下次操作误拉高。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，重置模块03可以包括：第一开关晶体管T1；第一开关晶体管T1的栅极用于输入第二控制信号CL2，源极用于输入低电平信号VGL，漏极与第二子单元022的输入端相连。具体地，第一开关晶体管可以在第二控制信号的控制下导通，导通的第一开关晶体管可以将低电平信号输出到第二子单元的输入端。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，第一子单元021可以包括：第二开关晶体管T2；第二开关晶体管T2的栅极用于输入第一控制信号CL1，源极与切换信号端EN相连，漏极与第二子单元022的输入端相连。具体地，第二开关晶体管可以在第一控制信号的控制下导通，导通的第二开关晶体管可以将切换信号端的信号输出到第二子单元的输入端。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，第二子单元022可以包括：第三开关晶体管T3；第三开关晶体管T3的栅极与相邻上一级移位寄存器的输出模块01的第一节点P1-U相连，源极与第一子单元021的输出端相连，漏极与本级移位寄存器的输出模块01的第一节点P1相连。具体地，第三开关晶体管可以在相邻上一级移位寄存器的输出模块的第一节点的控制下导通，导通的第三开关晶体管可以将第一子单元输出端的信号输出到本级移位寄存器的输出模块的第一节点。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，输出模块可以包括：上拉单元011、复位单元012、下拉单元013、控制单元014和输出单元015；其中，
上拉单元011的控制端与信号输入端Input相连，输入端用于输入第一参考信号Vref1，输出端与本级移位寄存器的第一节点P1相连；上拉单元011用于在信号输入端Input的控制下，将第一参考信号Vref1输出到本级移位寄存器的第一节点P1；
复位单元012的控制端与复位信号端Reset相连，输入端用于输入第二参考信号Vref2，输出端与本级移位寄存器的第一节点P1相连；复位单元012用于在复位信号端Reset的控制下，将第二参考信号Vref2输出到本级移位寄存器的第一节点P1；
下拉单元013的控制端与第二节点P2相连，输入端用于输入低电平信号VGL，输出端与本级移位寄存器的第一节点P1相连；下拉单元013用于在第二节点P2的控制下，将低电平信号VGL输出到本级移位寄存器的第一节点P1；
控制单元014的第一控制端和第一输入端用于输入第一时钟信号CLK1，第二控制端与本级移位寄存器的第一节点P1相连，第三控制端与输出单元015的输出端相连，第二输入端用于输入低电平信号VGL，输出端与第二节点P2相连；控制单元014用于在第一时钟信号CLK1的控制下，将第一时钟信号CLK1输出到第二节点P2，在本级移位寄存器的第一节点P1或输出单元015的输出端的控制下，将低电平信号VGL输出到第二节点P2；
输出单元015的第一控制端与本级移位寄存器的第一节点P1相连，第二控制端与第二节点P2相连，第一输入端用于输入第二时钟信号CLK2，第二输入端用于输入低电平信号VGL，输出端用于输出扫描信号；输出单元015用于在本级移位寄存器的第一节点P1的控制下将第二时钟信号CLK2通过输出端输出，在第二节点P2的控制下将低电平信号VGL通过输出端输出。
具体地，本发明实施例提供的上述栅极驱动电路中，输出模块用于在显示阶段向对应的栅线输入扫描信号，实现正常的栅极驱动的功能，其中输出模块包括上拉单元、复位单元、下拉单元、控制单元和输出单元，各单元在各自的控制信号的控制下，完成对应的功能，从而实现输出模块的正常输出。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，上拉单元011可以包括：第四开关晶体管T4；第四开关晶体管T4的栅极与信号输入端Input相连，源极用于输入第一参考信号Vref1，漏极与本级移位寄存器的第一节点P1相连。具体地，第四开关晶体管可以在信号输入端的控制下导通，导通的第四开关晶体管可以将第一参考信号输出到第一节点。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，复位单元012可以包括：第五开关晶体管T5；第五开关晶体管T5的栅极与复位信号端Reset相连，源极用于输入第二参考信号Vref2，漏极与本级移位寄存器的第一节点P1相连。具体地，第五开关晶体管可以在复位信号端的控制下导通，导通的第五开关晶体管可以将第二参考信号输出到第一节点。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，下拉单元013可以包括：第六开关晶体管T6；第六开关晶体管T6的栅极与第二节点P2相连，源极用于输入低电平信号VGL，漏极与本级移位寄存器的第一节点P1相连。具体地，第六开关晶体管可以在第二节点的控制下导通，导通的第六开关晶体管可以将低电平信号输出到第一节点。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，控制单元014可以包括：第七开关晶体管T7、第八开关晶体管T8和第九开关晶体管T9；其中，第七开关晶体管T7的栅极和源极用于输入第一时钟信号CLK1，漏极与第二节点P2相连；第八开关晶体管T8的栅极与本级移位寄存器的第一节点P1相连，源极用于输入低电平信号VGL，漏极与第二节点P2相连；第九开关晶体管T9的栅极与输出单元015的输出端相连，源极用于输入低电平信号VGL，漏极与第二节点P2相连。具体地，第七开关晶体管导通，可以将第一时钟信号输出到第二节点；第八开关晶体管导通、第九开关晶体管导通可以将低电平信号输出到第二节点。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图4所示，输出单元015包括：第十开关晶体管T10、第十一开关晶体管T11和电容C；其中，第十开关晶体管T10的栅极与本级移位寄存器的第一节点P1相连，源极用于输入第二时钟信号CLK2，漏极用于将第二时钟信号CLK2输出；第十一开关晶体管T11的栅极与第二节点P2相连，源极用于输入低电平信号VGL，漏极用于将低电平信号VGL输出；电容C连接于本级移位寄存器的第一节点P1与第十开关晶体管T10的漏极之间。具体地，导通的第十开关晶体管可以将第二时钟信号输出，导通的第十一开关晶体管可以将低电平信号输出。
需要说明的是本发明上述实施例中提到的开关晶体管可以是薄膜晶体管(TFT，Thin Film Transistor)，也可以是金属氧化物半导体场效应管(MOS，Metal OxideSemiconductor)，在此不做限定。在具体实施中，这些晶体管的源极和漏极可以互换，不做具体区分。在描述具体实施例时以薄膜晶体管为例进行说明。
下面结合图4所示的栅极驱动电路的移位寄存器以及图5所示的图4的输入输出时序图，对本发明实施例提供的栅极驱动电路中移位寄存器的工作过程作以描述。具体地，选取如图5所示的输入输出时序图中的t1～t3三个阶段。下述描述中以VGH表示高电平信号，VGL表示低电平信号。
在t1阶段即显示阶段，CLK1、CLK2、Vref1、Vref2、Input、Reset、P1(本级移位寄存器的第一节点)、P1-U(相邻上一级移位寄存器的第一节点)、EN、CL1、CL2的信号的电平变化如图5所示，由于在显示阶段CL1＝0，因此该阶段第二开关晶体管T2截止，第三开关晶体管T3无法将切换信号端EN的信号输出到输出模块的第一节点，因此不影响输出模块的工作过程。输出模块的工作过程与现有技术中移位寄存器的工作过程相同，在此不作详述。
在t2阶段即触控阶段，CLK1＝VGL、CLK2＝VGL、Vref1＝VGH、Vref2＝VGL、Input＝VGL、Reset＝VGL、P1＝VGL、P1-U＝VGH、EN＝VGL、CL1＝VGH、CL2＝VGL。由于P1-U＝VGH和CL1＝VGH，因此第二开关晶体管T2和第三开关晶体管T3导通；导通的第二开关晶体管T2将切换信号端EN的VGL输出到第三开关晶体管T3的源极，进而导通第三开关晶体管T3将VGL信号输出到本级移位寄存器的第一节点P1，从而稳定第一节点P1在触控阶段的电位，避免被电容耦合偏离电位。
在t3阶段即触控阶段结束前过渡到显示阶段的时间段，CLK1＝VGL、CLK2＝VGL、Vref1＝VGH、Vref2＝VGL、Input＝VGL、Reset＝VGL、P1＝VGH、P1-U＝VGH、EN＝VGH、CL1＝VGH、CL2＝VGL。由于P1-U＝VGH和CL1＝VGH，因此第二开关晶体管T2和第三开关晶体管T3导通；导通的第二开关晶体管T2将切换信号端EN的VGH输出到第三开关晶体管T3的源极，进而导通第三开关晶体管T3将VGH信号输出到本级移位寄存器的第一节点P1，从而拉高第一节点P1的电位，保证触控阶段结束后，第一节点P1的电位是高电位，从而保证输出模块正常输出扫描信号。另外，接下来进入显示阶段后，如图5所示，第二控制信号CL2可以变为高电平，从而使得第一开关晶体管T1导通，导通的第一开关晶体管T1将低电平信号VGL输出到第三开关晶体管T3的源极，从而拉低第三开关晶体管T3的源极的电位，防止下次操作误拉高。
在具体实施时，本发明实施例提供的上述栅极驱动电路中，如图3所示，其中图3仅示出了第N级移位寄存器和第N+1级移位寄存器。除第一级移位寄存器和最后一级移位寄存器之外，其余每级移位寄存器的输出模块的第一节点均与其相邻的下一级移位寄存器的控制模块的第一控制端相连；且每级移位寄存器的输出模块的输出端均向与其相邻的下一级移位寄存器的输出模块输入触发信号，向与其相邻的上一级移位寄存器的输出模块输入复位信号；第一级移位寄存器的输出模块的第一节点与第二级移位寄存器的控制模块的第一控制端相连；且输出模块的输出端向第二级移位寄存器的输出模块输入触发信号；最后一级移位寄存器的输出模块的输出端向与其相邻的上一级移位寄存器的输出模块输入复位信号。
基于同一发明构思，本发明实施例提供了一种显示面板，包括本发明实施例提供的上述栅极驱动电路。该显示面板可以应用于手机、平板电脑、电视机、显示器、笔记本电脑、数码相框、导航仪等任何具有显示功能的产品或部件。由于该显示面板解决问题的原理与栅极驱动电路相似，因此该显示面板的实施可以参见上述栅极驱动电路的实施，重复之处不再赘述。
本发明实施例提供了一种栅极驱动电路及显示面板，该栅极驱动电路可以包括：级联的且与栅线一一对应的多个移位寄存器；每个移位寄存器包括：在显示阶段用于向对应的栅线输入扫描信号的输出模块，以及在触控阶段用于控制输出模块的节点电位的控制模块；其中，各移位寄存器的控制模块的第一控制端与相邻上一级移位寄存器的输出模块的第一节点相连，第二控制端用于输入第一控制信号，输入端与切换信号端相连，输出端与本级移位寄存器的输出模块的第一节点相连；在触控阶段，控制模块用于在相邻上一级移位寄存器的输出模块的第一节点和第一控制信号的控制下，将切换信号端的低电平信号输出到本级移位寄存器的输出模块的第一节点；在触控阶段到显示阶段的过渡阶段，控制模块用于在相邻上一级移位寄存器的输出模块的第一节点和第一控制信号的控制下，将切换信号端的高电平信号输出到本级移位寄存器的输出模块的第一节点；在显示阶段，输出模块用于在本级移位寄存器的第一节点的控制下，向对应的栅线输入扫描信号。
本发明实施例提供的上述栅极驱动电路，通过增加控制模块在触控阶段控制输出模块的关键节点的电位，即在触控阶段将切换信号端的低电平信号输出到本级移位寄存器的输出模块的第一节点，稳定关键节点即第一节点在触控阶段的电位，避免关键节点的电位处于Floating状态而被电容耦合偏离稳定电位；在触控结束前过渡到显示的阶段，将切换信号端的高电平信号输出到第一节点，从而拉高第一节点的电位，进而使得输出模块在显示阶段可以在高电位的第一节点的控制下稳定输出扫描信号，保证显示面板在显示阶段的正常显示。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (14)

1.一种栅极驱动电路，其特征在于，包括：级联的且与栅线一一对应的多个移位寄存器；每个所述移位寄存器包括：在显示阶段用于向对应的所述栅线输入扫描信号的输出模块，以及在触控阶段用于控制所述输出模块的节点电位的控制模块；其中，
各所述移位寄存器的控制模块的第一控制端与相邻上一级所述移位寄存器的输出模块的第一节点相连，第二控制端用于输入第一控制信号，输入端与切换信号端相连，输出端与本级所述移位寄存器的输出模块的第一节点相连；
在触控阶段，所述控制模块用于在相邻上一级所述移位寄存器的输出模块的第一节点和所述第一控制信号的控制下，将所述切换信号端的低电平信号输出到本级移位寄存器的输出模块的第一节点；
在触控阶段到显示阶段的过渡阶段，所述控制模块用于在相邻上一级所述移位寄存器的输出模块的第一节点和所述第一控制信号的控制下，将所述切换信号端的高电平信号输出到本级移位寄存器的输出模块的第一节点；
在显示阶段，所述输出模块用于在本级移位寄存器的所述第一节点的控制下，向对应的所述栅线输入扫描信号。
2.如权利要求1所述的栅极驱动电路，其特征在于，所述控制模块，包括：第一子单元和第二子单元；其中，
所述第一子单元的控制端用于输入所述第一控制信号，输入端与所述切换信号端相连，输出端与所述第二子单元的输入端相连；所述第一子单元用于在所述第一控制信号的控制下，将所述切换信号端的信号输出到所述第二子单元的输入端；
所述第二子单元的控制端与相邻上一级所述移位寄存器的输出模块的第一节点相连，输出端与本级所述移位寄存器的输出模块的第一节点相连；所述第二子单元用于在相邻上一级所述移位寄存器的输出模块的第一节点的控制下，将所述第一子单元的输出端的信号输出到本级所述移位寄存器的输出模块的第一节点。
3.如权利要求2所述的栅极驱动电路，其特征在于，还包括：重置模块；
所述重置模块的控制端用于输入第二控制信号，输入端用于输入低电平信号，输出端与所述第二子单元的输入端相连；所述重置模块用于在所述第二控制信号的控制下，将所述低电平信号输出到所述第二子单元的输入端。
4.如权利要求3所述的栅极驱动电路，其特征在于，所述重置模块，包括：第一开关晶体管；
所述第一开关晶体管的栅极用于输入第二控制信号，源极用于输入低电平信号，漏极与所述第二子单元的输入端相连。
5.如权利要求2所述的栅极驱动电路，其特征在于，所述第一子单元，包括：第二开关晶体管；
所述第二开关晶体管的栅极用于输入所述第一控制信号，源极与所述切换信号端相连，漏极与所述第二子单元的输入端相连。
6.如权利要求2所述的栅极驱动电路，其特征在于，所述第二子单元，包括：第三开关晶体管；
所述第三开关晶体管的栅极与相邻上一级所述移位寄存器的输出模块的第一节点相连，源极与所述第一子单元的输出端相连，漏极与本级所述移位寄存器的输出模块的第一节点相连。
7.如权利要求1-6任一项所述的栅极驱动电路，其特征在于，所述输出模块，包括：上拉单元、复位单元、下拉单元、控制单元和输出单元；其中，
所述上拉单元的控制端与信号输入端相连，输入端用于输入第一参考信号，输出端与本级移位寄存器的所述第一节点相连；所述上拉单元用于在所述信号输入端的控制下，将所述第一参考信号输出到本级移位寄存器的所述第一节点；
所述复位单元的控制端与复位信号端相连，输入端用于输入第二参考信号，输出端与本级移位寄存器的所述第一节点相连；所述复位单元用于在所述复位信号端的控制下，将所述第二参考信号输出到本级移位寄存器的所述第一节点；
所述下拉单元的控制端与第二节点相连，输入端用于输入低电平信号，输出端与本级移位寄存器的所述第一节点相连；所述下拉单元用于在所述第二节点的控制下，将所述低电平信号输出到本级移位寄存器的所述第一节点；
所述控制单元的第一控制端和第一输入端用于输入第一时钟信号，第二控制端与本级移位寄存器的所述第一节点相连，第三控制端与所述输出单元的输出端相连，第二输入端用于输入所述低电平信号，输出端与所述第二节点相连；所述控制单元用于在所述第一时钟信号的控制下，将所述第一时钟信号输出到所述第二节点，在本级移位寄存器的所述第一节点或所述输出单元的输出端的控制下，将所述低电平信号输出到所述第二节点；
所述输出单元的第一控制端与本级移位寄存器的所述第一节点相连，第二控制端与所述第二节点相连，第一输入端用于输入第二时钟信号，第二输入端用于输入所述低电平信号，输出端用于输出扫描信号；所述输出单元用于在本级移位寄存器的所述第一节点的控制下将所述第二时钟信号通过所述输出端输出，在所述第二节点的控制下将所述低电平信号通过所述输出端输出。
8.如权利要求7所述的栅极驱动电路，其特征在于，所述上拉单元，包括：第四开关晶体管；
所述第四开关晶体管的栅极与所述信号输入端相连，源极用于输入所述第一参考信号，漏极与本级移位寄存器的所述第一节点相连。
9.如权利要求7所述的栅极驱动电路，其特征在于，所述复位单元，包括：第五开关晶体管；
所述第五开关晶体管的栅极与所述复位信号端相连，源极用于输入所述第二参考信号，漏极与本级移位寄存器的所述第一节点相连。
10.如权利要求7所述的栅极驱动电路，其特征在于，所述下拉单元，包括：第六开关晶体管；
所述第六开关晶体管的栅极与所述第二节点相连，源极用于输入所述低电平信号，漏极与本级移位寄存器的所述第一节点相连。
11.如权利要求7所述的栅极驱动电路，其特征在于，所述控制单元，包括：第七开关晶体管、第八开关晶体管和第九开关晶体管；其中，
所述第七开关晶体管的栅极和源极用于输入所述第一时钟信号，漏极与所述第二节点相连；
所述第八开关晶体管的栅极与本级移位寄存器的所述第一节点相连，源极用于输入所述低电平信号，漏极与所述第二节点相连；
所述第九开关晶体管的栅极与所述输出单元的输出端相连，源极用于输入所述低电平信号，漏极与所述第二节点相连。
12.如权利要求7所述的栅极驱动电路，其特征在于，所述输出单元，包括：第十开关晶体管、第十一开关晶体管和电容；其中，
所述第十开关晶体管的栅极与本级移位寄存器的所述第一节点相连，源极用于输入所述第二时钟信号，漏极用于将所述第二时钟信号输出；
所述第十一开关晶体管的栅极与所述第二节点相连，源极用于输入所述低电平信号，漏极用于将所述低电平信号输出；
所述电容连接于本级移位寄存器的所述第一节点与所述第十开关晶体管的漏极之间。
13.如权利要求1所述的栅极驱动电路，其特征在于，除第一级移位寄存器和最后一级移位寄存器之外，其余每级移位寄存器的输出模块的第一节点均与其相邻的下一级移位寄存器的控制模块的第一控制端相连；且每级移位寄存器的输出模块的输出端均向与其相邻的下一级移位寄存器的输出模块输入触发信号，向与其相邻的上一级移位寄存器的输出模块输入复位信号；
第一级移位寄存器的输出模块的第一节点与第二级移位寄存器的控制模块的第一控制端相连；且输出模块的输出端向第二级移位寄存器的输出模块输入触发信号；
最后一级移位寄存器的输出模块的输出端向与其相邻的上一级移位寄存器的输出模块输入复位信号。
14.一种显示面板，其特征在于，包括如权利要求1-13任一项所述的栅极驱动电路。
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