WO1993009565A1 - Appareil et procede pour la fabrication de tranches de semi-conducteur - Google Patents

Appareil et procede pour la fabrication de tranches de semi-conducteur Download PDF

Info

Publication number
WO1993009565A1
WO1993009565A1 PCT/JP1992/001401 JP9201401W WO9309565A1 WO 1993009565 A1 WO1993009565 A1 WO 1993009565A1 JP 9201401 W JP9201401 W JP 9201401W WO 9309565 A1 WO9309565 A1 WO 9309565A1
Authority
WO
WIPO (PCT)
Prior art keywords
wafer
information
identification number
identifier information
jig
Prior art date
Application number
PCT/JP1992/001401
Other languages
English (en)
French (fr)
Inventor
Eiji Iwakiri
Shingo Fukushima
Yukitaka Takitani
Original Assignee
Komatsu Electronic Metals Co., Ltd.
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Komatsu Electronic Metals Co., Ltd. filed Critical Komatsu Electronic Metals Co., Ltd.
Priority to US08/232,198 priority Critical patent/US5537325A/en
Priority to EP92922598A priority patent/EP0616364A1/en
Publication of WO1993009565A1 publication Critical patent/WO1993009565A1/ja

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67242Apparatus for monitoring, sorting or marking
    • H01L21/67282Marking devices
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/544Marks applied to semiconductor devices or parts, e.g. registration marks, alignment structures, wafer maps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2223/00Details relating to semiconductor or other solid state devices covered by the group H01L23/00
    • H01L2223/544Marks applied to semiconductor devices or parts
    • H01L2223/54493Peripheral marks on wafers, e.g. orientation flats, notches, lot number
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00

Definitions

  • the present invention relates to an apparatus and a method for manufacturing a semiconductor wafer, and more particularly to tracking of a manufacturing history.
  • next process is a batch process such as a cleaning process or a chemical treatment process
  • the process can be shifted to the next process unless one lot of processing is completed.
  • processing time is wasted due to the increased waiting time, and this is a problem that prevents cost reduction, especially in the flow of small-lot multi-products.
  • bar codes are a significant source of contamination during cleaning.
  • laser marking has to be marked at a considerable depth, which can cause changes in wafer characteristics due to the high energy of the laser.
  • contaminants can easily accumulate on the engraved part, which may affect other types.
  • some products go through a process that can never be stamped.
  • the conventional method has a problem that quality information on a wafer-by-wafer basis cannot be easily and sufficiently managed.
  • the present invention has been made in view of the above-mentioned circumstances, and indicates the order of a wafer to be worked at any place in each work process, which is cut out from a material ingot. It is an object of the present invention to provide a method and a manufacturing apparatus capable of discriminating, on a sheet-by-sheet basis, under what conditions processing has been performed.
  • an object of the present invention is to provide a method and a manufacturing apparatus capable of easily and sufficiently managing quality information for every wafer for each wafer.
  • an identification number is set for each semiconductor wafer, this is stored in a storage medium as identifier information, and how the wafer is transported, and which The processing path as to whether the data has been processed as described above is newly tracked one by one in association with the identifier information in the previous process as identifier information, and these are additionally stored as wafer information in the storage medium. Based on the obtained wafer information, the history of each wafer is managed over the entire wafer manufacturing process.
  • an identification number is set for each semiconductor wafer,
  • An identification number assigning means for storing this in a storage medium as identifier information, and a processing path indicating how the wafer is transported and processed in each manufacturing process is newly defined as identifier information.
  • a wafer information storage means for tracking wafers one by one in association with the identifier information in the previous step, and additionally storing the wafer information as the wafer information, and a wafer manufacturing process based on the stored wafer information.
  • Wafer history management means for managing the history of individual wafers throughout. For example, the order cut out from a raw material ingot is given to each wafer as a wafer identification number, and the processing of how the wafers were transported and processed in each manufacturing process Track the path one by one and store it as information.
  • the processing path is represented by position coordinates in a manufacturing apparatus, jig, or the like.
  • Computers and computer networks are used as storage media.
  • the wafers can be identified one by one, so that the quality control for each wafer can be realized reliably and with a small number of man-hours.
  • next process is a batch process such as a cleaning process or a chemical treatment process, it can be performed for each batch.
  • the process can be shifted to the next process, and the waste of processing time can be reduced.
  • the wafer can be identified without printing on the wafer or adding external identifier information such as laser marking, deterioration of the quality of the wafer due to the identification can be prevented.
  • FIG. 1 is a diagram schematically illustrating a management device according to an embodiment of the present invention.
  • FIG. 2 is a view showing a silicon single crystal of the present invention.
  • FIG. 3 is a diagram showing a transport device according to the embodiment of the present invention.
  • FIG. 4 is a diagram showing identification data according to the embodiment of the present invention.
  • FIG. 5 is a diagram showing a circular plate according to the embodiment of the present invention.
  • FIG. 6 is a block diagram showing a mirror finishing apparatus according to the embodiment of the present invention.
  • FIG. 7 is a diagram showing an example of mounting a wafer on a circular plate according to the embodiment of the present invention.
  • FIG. 8 is a diagram showing identification data of the example of the present invention.
  • FIG. 9 is a diagram showing a cleaning apparatus according to an embodiment of the present invention.
  • FIG. 10 is a diagram showing an inspection apparatus according to an embodiment of the present invention.
  • FIG. 1 is a schematic configuration diagram showing a silicon wafer manufacturing process according to an embodiment of the present invention.
  • the silicon wafer manufacturing process consists of a pulling process 1 for forming material ingots by the cZ (Chiyoklarski pulling) method of growing columnar crystals from the melt of the raw material (silicon) in the crucible; Slicing process 2 for cutting ingots into single wafers, heat treatment process 3 for removing crystal defects, etc., mirror processing process 4 for processing the surface into a precise mirror surface, and mirror-processed wafer surface It consists of a cleaning process 5 for cleaning and removing extraneous substances such as garbage and drugs, and an inspection process 6 for inspecting the status of these processing processes, checking for non-defective products and performing feedback on quality information.
  • a pulling process 1 for forming material ingots by the cZ (Chiyoklarski pulling) method of growing columnar crystals from the melt of the raw material (silicon) in the crucible
  • Slicing process 2 for cutting ingots into single wafers
  • heat treatment process 3 for removing crystal defects, etc.
  • the computer manages the transfer route and quality information of each wafer in each process unit, and reports it to other processes for the pulling process management computer 11, the slice process management computer 21, and so on.
  • a computer for heat treatment process management 31, a computer for mirror surface finishing process management 41, a computer for cleaning process management 51, and a computer for inspection process management 61 are connected.
  • the host computer 7 is connected to a host computer 7 via a computer network 8 called a LAN, and the quality information, which is reported in units of C, corresponds to C, and a database is created. It is configured.
  • the wafer is strongly cut in the slicing process 2 in the slicing process 2.
  • the numbers are set to the wafers in the cutting order. Go.
  • the cut wafers are stored one by one in a transport jig (carrier) as shown in FIG.
  • the number of the groove of the transfer jig, the number of the wafer, and the number of the jig are recorded in correspondence with each other, and reported to other processes via the computer network 8.
  • the identification of the wafer can be expressed by the groove position of the transport jig.
  • the wafer When the wafer is automatically stored in the groove of the transfer jig, the correspondence with the wafer is performed automatically. Further, when a person performs the work of transferring the wafer to the transport jig, it can be read by a bar code or an image recognition device.
  • the wafer cut in the slicing step 2 is stored in a transfer jig and transferred to a jig for heat treatment, but when stored again in the transfer jig after heat treatment, the initial storage position is If it is transferred to be returned in a state where it has been maintained, ⁇ ⁇ ha remains identifiable. Furthermore, in the mirror finishing process, the wafer stored and transported from the heat treatment process to the transport jig is glued to a mirror finishing jig one by one and processed. In this step, for example, about 4 to 10 wafers are attached to a circular plate on which the marker M is engraved as shown in FIG.
  • the position of the marker M is detected by the plate position determining mechanism 401, and the position is first corrected so that the marker M comes to the sticking position.
  • the wafers are stuck in sequence using the stitching machine 402.
  • an identification number is set sequentially in the rotation direction of the plate, and the identification number is made to correspond to the pen number.
  • the plate number is read using a bar code reader or an image recognition device or the like, so that the wafer number is associated with the plate number.
  • a polishing machine 403 a plurality of plates (four in this case) on which wafers are adhered are rotated together to perform polishing.
  • the position of the marker M is detected by the plate positioning mechanism 404, and the position is corrected based on the position of the marker M so that the wafer attached first comes to the position where it is peeled off first. I do. Then, with the position of the plate corrected so that the first bonded wafer comes to the peeling mechanism 405 side, the wafers are peeled off in the order in which they were attached to the plate using the peeling mechanism 405. I will do it.
  • the number of the jig, the position of the groove and the wafer number of the peeled wafer are made to correspond to each other. Also in this peeling step, the plate number is read using a bar code reader or an image reading device 407, and the plate number and the plate number are correlated.
  • the wafers are peeled off one by one in the order in which they have been attached after the positioning of the plate, and stored in the transport jig.
  • the transfer jigs are stored one by one while the numbers of the transfer jigs, the positions of the grooves and the wafer numbers correspond to each other. In this way, the identification number of the wafer is maintained correctly.
  • Fig. 8 shows an example of the correspondence between wafer numbers, plates, and transfer jigs.
  • the information is transmitted to the computer 7 in a state where the quality information and the computer number are associated with each other in the computer 41 for process management.
  • FIG. 9 shows the cleaning jig.
  • a jig having the same groove structure as the transfer jig is used as a cleaning jig.
  • the replacement history can be managed. Therefore, even in this process, the wafer identification number is maintained in the form of the transfer jig position.
  • the wafers of the transfer jigs are transferred, but if the jig numbers and the groove numbers are managed in association with each other, the wafers can be transferred even when they are transferred.
  • the identification number can be maintained.
  • an image reading device may be used here.
  • a bar code may be used to display the jig number.
  • the quality information managed in this way can be managed collectively on a host computer using a computer network, as shown in Fig. 1. This is extremely effective in maintaining information and efficiently reusing information.
  • each wafer is managed instead of being controlled in units of lots, defects such as defects caused by differences in processing conditions between the end and the center of the jig in the heat treatment process can be easily determined. They can be found, correction of details becomes easy, and detailed management can be performed.
  • history information can be obtained each time one process is completed, and if a defect is detected, the conditions in the previous process are reviewed and adjusted, and repair is performed. Since corrective actions can be made, condition changes can be made at an early stage, and the occurrence of defective products can be prevented.
  • the process can be shifted to the next process for each carrier. Waste of time can be reduced, and it is effective in increasing the variety of small quantities.
  • the management is not limited to the case where the management is performed in all the processing steps as in the above-described embodiment, and the management may be performed only in a part of the processing steps.
  • a wafer cut in the slicing process can be identified in units of wafer until the final process, and the working conditions in each process can be identified in units of wafer. It is possible to accumulate data at a time, and to perform management without deteriorating the quality of wafers, and to perform fine-grained management.

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Manufacturing & Machinery (AREA)
  • Container, Conveyance, Adherence, Positioning, Of Wafer (AREA)

Description

明細書
半導体ゥュハ製造装置および製造方法
発明の技術分野
本発明は、 半導体ウェハの製造装置および製造方法にかかり、 特 に製造履歴の追跡に関する。
背景技術 ·
I C、 L S I などの材料となるシリ コン、 ゲルマニウム、 ガリ ウ ムヒ素などの半導体ゥュハに要求される品質は、 デバイ スの高集積 化に伴い年々高いものとなってきている。
半導体ゥュハは同じ加工機で加工したと しても、 ゥュハ単位では 良品率を左右するほど品質が異なることがある。 従って、 品質改善 のためには品質と作業条件の関係をゥュハ単位で対応させたデータ を蓄積することが必要である。
従来、 半導体ゥュハの生産はロッ 卜単位 ( 2 0 ~ 3 0 0枚程度の 同じ特性を要求されるウェハ群) に行われており、 作業実績などの 品質情報は、 作業者がロッ ト単位に日報等に記載して管理している のが常である。
しかし、 この方法では、 あるウェハが素材イ ンゴッ トのどの位置 から切り出されたか、 どの熱処理装置で処理されたか、 洗浄機の槽 のどの位置で洗浄されたか等の重要なゥュハ単位の品質情報が管理 できないため、 品質改善に必要となる情報が不足するという問題点 がある。 また、 品質情報の管理を手作業で行っているので、 情報の 信頼性の低下や管理工数の増大等の問題もある。
さらにまた、 ロッ ト単位での管理を行つているため、 次工程が洗 浄工程や化学処理工程等の一括処理工程の場合は、 1 ロ ッ 卜の処理 が終了しないと、 次工程に移行できず、 待ち時間が多く なるため、 処理時間に無駄が多く、 少量多品種化の流れの中ではこれが特にコ ス 卜の低減を阻む問題となっている。
一般に加工対象物を個々に管理する方法と して、 対象物 1個毎に バーコ一ドゃ刻印等を施し、 それを識別記号として管理する方法が ある。 しかし、 半導体ウェハの場合はこのような方法で識別記号を 付加することは品質上好ましくない。
例えば、 バーコー ドなどは洗浄の際の重大な汚染源となる。 また、 レー'ザマーキングは刻印をかなりの深さに施さなければならないた め、 レーザの高エネルギーによるゥェハの特性変化を招きかねない。 また、 刻印部に汚染物質がたまりやすく なり、 他のゥ ハに影響を 及ぼすおそれもある。 また、 製品によっては絶対に刻印を施せない 工程を経るものもある。
このように従来の方法では、 ウェハ単位の品質情報を容易かつ十 分に管理することができないという問題があった。
発明の概要
本発明は、 前記実情に鑑みてなされたもので、 各作業工程のいか なる場所においても作業対象となっているゥュハが、 素材ィ ンゴッ トから何番目に切り出されたものであるか、 そしてそれまでにいか なる条件で処理を受けてきたものであるかを 1枚毎に識別すること のできる方法および製造装置を提供することを目的とする。
すなわち、 本発明は、 いかなるウェハに対しても 1枚ごとに品質 情報を容易、 かつ十分に管理することのできる方法および製造装置 を提供することを目的とする。
そこで本発明の方法では、 半導体ウェハ 1枚毎に識別番号を設定 し、 これを識別子情報として記憶媒体に記億させるとともに、 さら にウェハがどのように搬送され、 それぞれの製造工程の中でどのよ うに処理されたかという処理経路を新しく識別子情報と して前工程 での識別子情報に対応づけてゥヱハ 1枚づっ追跡し、 これらをゥェ ハ情報として前記記憶媒体に追加記憶し、 この記億されたウェハ情 報に基づいてゥュハ製造工程全般にわたつて個々のウェハの履歴を 管理するようにしている。
また本発明の装置では、 半導体ウェハ 1枚毎に識別番号を設定し、 これを識別子情報と して記憶媒体に記憶させる識別番号付与手段と、 このゥヱハがどのように搬送され、 それぞれの製造工程の中でどの ように処理されたかという処理経路を新しく識別子情報と して前ェ 程での識別子情報に対応づけてゥュハ 1枚づっ追跡し、 ゥ ハ情報 と して前記記憶媒体に追加記憶するゥュハ情報記憶手段と、 この記 憶されたゥヱハ情報に基づいてゥヱハ製造工程全般にわたって個々 のウェハの履歴を管理するウェハ履歴管理手段とを具備している。 例えば、 素材イ ンゴッ 卜から切り出された順番をウェハの識別番 号と してウェハ 1枚ごとに与えて、 ウェハがそれぞれの製造工程の 中をどのように搬送されどのように処理されたかという処理経路を ウェハ 1枚づっ追跡し、 ゥヱハ情報と して記憶する。
こ こで望ま しく は、 処理経路は、 製造装置の号機、 治具等におけ る位置座標で表す。
また、 記憶媒体と しては、 コンピュータおよびコンピュータネッ トワークを利用する。
【作用】
本発明によれば、 ゥヱハを 1枚ごとに識別することができるため ウェハ単位の品質管理が確実にしかも少ない工数で実現できる。
さ らに、 ロッ ト単位での管理が不要となり、 ゥヱハ単位で管理す ることができるため、 次工程が洗浄工程や化学処理工程等の一括処 理工程の場合にも、 1処理バッチ毎に、 次工程に移行させることが でき、 処理時間の無駄を低減するこ とができ、 少量多品種化に有効 である。
しかも、 ウェハに印字をしたり レーザマーキングなどの外的な識 別子情報を付加することなく ウェハの識別を行う ことができるため、 それによるウェハの品質の劣化を防止することもできる。
また、 ウェハ単位で作業実績データを蓄積できれば、 ゥュハの不 良要因の発見をきめ細かく行う こ とができ、 ひいてはウェハの良品 率の向上につながる。 また、 抵抗値等の物性的特性をウェハ単位で提示することができ るため、 デバイスをウェハ上に作り込む際にも細かな調整を行う こ とが可能となり、 デバイス自身の良品率向上につながるものである。 図面の簡単な説明
図 1は本発明実施例の管理装置を概要を示す図。
図 2は本発明のシリ コン単結晶を示す図。
図 3は本発明実施例の搬送装置を示す図。
図 4は本発明実施例の識別データを示す図。
図 5は本発明実施例の円形プレー トを示す図。
図 6は本発明実施例の鏡面加工装置を示すプロッ ク図。
図 7は本発明実施例の円形プレー 卜へのウェハ搭載例を示す図。 図 8は本発明実施例の識別データを示す図。
図 9は本発明実施例の洗浄装置を示す図。
図 1 0は本発明実施例の検査装置を示す図。
発明を実施すべき最良の形態
以下、 本発明の実施例について、 図面を参照しつつ詳細に説明す o
図 1は、 本発明実施例のシリコンウェハ製造工程を示す概略構成 図である。
シリ コンウェハの製造工程は、 るつぼ内の原料 (シリ コン) 融液 から円柱状の锆晶を育成する c Z (チヨクラルスキー引上げ) 法で、 素材ィンゴツ トを形成する引上げ工程 1と、 素材イ ンゴッ トを 1枚 単位のウェハに切断するスライス工程 2と、 結晶欠陥等を除去する 熱処理工程 3と、 ゥ ハ表面を精密な鏡面に加工する鏡面加工工程 4と、 鏡面加工されたウェハの表面のごみや薬物等の付着物を洗浄 除去する洗浄工程 5と、 これらの処理工程の状況を検査し、 良品不 良品のチェックや品質情報のフィ一ドバックを行う検査工程 6とか ら構成される。 そしてこれら引上げ工程 1から検査工程 6までの各 工程には、 各工程単位でウェハ 1枚 1枚の搬送経路や品質情報を管 理し、 それぞれ他工程に報告する引上げ工程管理用コンピュー夕 1 1 、 スライ ス工程管理用コ ン ピュータ 2 1、 熱処理工程管理用コン ピュータ 3 1、 鏡面加工工程管理用コ ンピュータ 4 1、 洗浄工程管 理用コンピュータ 5 1、 検査工程管理用コンピュータ 6 1が接続さ れており、 これら各工程管理用コンピュータは.、 L A Nと呼ばれて いるコンピュータネッ トワーク網 8を介してホス トコンピュータ 7 に接続され、 こ こでゥヱハ単位に報告されてく る品質情報とゥヱハ の対応をとりデータべ一ス化を行うように構成されている。
まず、 引上げ工程では、 図 2に示すようなシ リ コ ンイ ンゴッ トが 形成されると、 スライス工程 2でゥヱハに切断される力く、 このとき 切り出された順番にゥュハに番号を設定していく。 切断されたゥュ ハは、 1枚毎に図 3に示すような搬送治具 (キャ リア) に格納され る。 こ こでは搬送治具の溝の番号、 ゥュハの番号そして治具の番号 を対応させて記録し他の工程にコ ン ピュータネッ トワーク網 8を介 して報告する。 これにより、 図 4に識別データ例を示すように、 ゥ ュハの識別は搬送治具の溝位置で表現することができる。 ウェハが 自動的に搬送治具の溝に格納される場合、 ゥュハとの対応は自動的 に行われる。 また、 ゥュハを搬送治具へ移載する作業を人間が行う 場合は、 バーコ一 ドゃ画像認識装置等で読み取ることができる。
このようにしてスライス工程 2で切断されたウェハは、 搬送治具 に格納されて熱処理用の治具に移し替えられるが、 熱処理後再び搬 送治具に格納される際、 初期の格納位置が維持された状態で戻され るように移載されれば、 ゥヱハは識別可能な状態のままである。 さらに鏡面加工工程では、 熱処理工程から搬送治具に格納されて 搬送されてきたゥュハを鏡面加工用の治具に 1枚単位ではりつけて 加工される。 この工程では図 5に示すようにマーカ Mの刻印された 円形のプレー トに、 例えば 4枚〜 1 0枚程度のウェハを 1枚づっ張 り付けていく。 このゥヱハが張り付けれらたプレー トを 4個程度ま とめて回転させながら、 ウェハ面側を研磨布に摺動させ、 そこに研 磨剤を加えウェハを研磨加工していく ようにする。 従って、 マーカ Mの刻印位置から順番にゥェハを張り付けておく ようにすれば、 回 転した後であつても容易に識別可能である。
この処理について説明する。 図 6に示すように、 プレー ト位置決 め機構 4 0 1 によってマーカ Mの位置を検出すると共に、 最初にゥ ヱハ張り付け位置にこのマーカ Mが来るように位置修正を行う。
このようにして 1番目のウェハを張る位置が張り付け機 4 0 2側 に来るようにプレー トを位置修正した状態で、 張り付け機 4 0 2を 用いて順番にウェハを張り付けていく、 図 7に示すようにプレー ト の回転方向に順次識別番号を設定しておき、 それとゥニハ番号とを 対応させるようにする。 そして、 プレー トの番号をバーコー ドリー ダもしく は画像認識装置等を利用して読取り、 ウェハ番号とプレー ト番号との対応をとるようにする。 次に研磨機 4 0 3を用いてゥェ ハの貼着されたプレー トを複数個 (こ こでは 4個) 一緒に回転させ 研磨加工を行う。 研磨加工が終了するとプレー 卜位置決め機構 4 0 4によつてマーカ Mの位置を検出するとともに、 最初に張り付けら れたゥュハが最初に剥がす位置に来るようにマーカ Mの位置を基準 にして位置修正を行う。 そして、 一番目に張り付けられたウェハが 剥離機構 4 0 5側に来るようにプレー トを位置修正した状態で、 剥 離機構 4 0 5を用いてプレー 卜にはりつけられた順番にウェハを剥 がしていく。 ,そして剥がしたウェハを搬送治具の番号、 溝の位置と ウェハ番号とを対応させるようにする。 この剥離工程でも、 バーコ — ドリーダもしく は画像読取装置 4 0 7を用いてプレー ト番号を読 取りゥュハ番号とプレー ト番号との対応をとる。 このようにして、 プレー トの位置決めを行ってから張り付けた順番にゥュハを 1枚づ つ剥がし、 搬送治具に格納していく。 この格納に際しても搬送治具 - の番号、 溝の位置とウェハ番号を対応させながら 1枚づっ格納して いく ようにする。 このように してウェハの識別番号は正しく保持される。
図 8にゥュハ番号とプレー 卜および搬送治具に対応デ一夕の一例 を示す。 このように して工程管理用のコ ン ピュータ 4 1 に品質情報 とゥヱハ番号の対応が取られた状態で、 コ ン ピュータ 7へと情報が 伝達される。
そして洗浄工程では、 搬送治具から洗浄治具、 洗浄治具から搬送 洽具にゥュハを移し替えるという作業がある。 図 9に洗浄治具を示 す。 図 9に示すように搬送治具と同様の溝構造をもった治具を洗浄 治具と して用いることにより、 移し変えに際しては治具番号、 溝番 号の対応をとれば、 ゥヱハの移し替えの履歴は管理できる。 従って、 この工程でもゥュハの識別番号は搬送治具位置という形で維持され る o
さらに検査工程では図 1 0に示すように、 搬送治具同志のウェハ の移し替えを行うが、 治具の番号と溝番号を対応させて管理するよ うにすれば移し替えの際にもウェハの識別番号を維持することがで きる。 治具の番号の読み取りは、 こ こでも画像読取装置を用いれば 良い。 また治具の番号の表示にはバー コ一 ドを用いてもよい。
このようにして管理されるゥヱハ単位の品質情報は、 図 1 にも示 されるようにコ ンピュータネ ッ ト ワークを利用してホス ト コ ン ピュ 一夕で一括管理するようにすれば、 情報の維持や情報の効率的な再 利用等に極めて有効である。
そしてロッ ト単位での管理ではなく ウェハ 1枚 1枚の管理がなさ れるため、 例えば熱処理工程における治具の端部と中央部とでの処 理条件の差等に起因する不良等を容易に発見することができ、 細部 の補正が容易となり緻密な管理を行う ことができる。
また本発明ではウェハの品質管理に主眼をおいている力《、 ウェハ 単位の物流管理や原価管理にも利用することが可能である。
また、 1工程終了毎に履歴情報を得ることができ、 不良が検出さ れた場合に、 それまでの工程での条件の見直しおよび調整を行い修 正を行うことができるため、 早期に条件変更を行う ことができ、 不 良の多発を防ぐことができる。
さらにロヅ ト単位での管理が不要となるため、 次工程が洗浄工程 や化学処理工程等の一括処理工程の場合にも、 1 キャ リ ア毎に、 次 工程に移行させることができ、 処理時間の無駄を低減することがで き、 少量多品種化に有効である。
なお、 前記実施例のように全処理行程で管理を行う場合に限定さ れることなく、 一部の処理工程でのみ管理をおこなうようにしても よい。
産業上の利用可能性
以上説明してきたように、 本発明によれば、 スライ ス工程で切り 出されたウェハは最終工程までゥヱハ単位に識別することが可能で あり、 各工程での作業条件をゥュハ単位に対応した形で蓄積してい く ことができ、 ウェハの品質を劣化させることなく管理を行う こと ができ、 きめ細かな管理をおこなうことができる。

Claims

請求の範囲
( 1 ) 半導体ウェハ 1枚毎に識別番号を設定し、 これを識別子情 報と して記憶媒体に記憶させる識別番号付与手段と、
前記ウェハがどのように搬送され、 それぞれの製造工程の 中でどのように処理されたかという処理経路を新しく識別子情報と して前工程での識別子情報に対応づけてゥュハ 1枚づっ追跡し、 ゥ ェハ情報として前記記憶媒体に追加記憶するゥュハ情報記憶手段と この記憶されたゥュハ情報に基づいてゥュハ製造工程全般 にわたつて個々のウェハの履歴を管理するゥュハ履歴管理手段とを 具備するようにしたことを特徴とする半導体ゥュハ製造装置。
( 2 ) 前記識別子情報は、 各工程でゥュハを収納する治具におけ るゥュハの位置座標で構築されるものであることを特徴とする請求 の範囲(1 ) に記載の半導体ゥュハ製造装置。
( 3 ) 半導体ゥュハ 1枚毎に識別番号を設定し、 これを識別子情 報として記憶媒体に記憶させる識別番号付与工程と、
前記ゥュハがどのように搬送され、 それぞれの製造工程の 中でどのように処理されたかという処理経路を新しく識別子情報と して前工程での識別子情報に対応づけてゥュハ 1枚づっ追跡し、 ゥ ュハ情報として前記記憶媒体に追加記憶するゥュハ情報追加記憶ェ 程とを有し
この記憶されたゥュハ情報に基づいてゥュハ製造工程全般 にわたつて個々のゥュハの履歴を管理するようにしたことを特徵と する半導体ゥュハの製造方法。
( 4 ) 前記識別子情報は、 各工程でウェハを収納する治具におけ るゥュハの位置座標で構築されるものであることを特徴とする請求 の範 0 (3) に記載の半導体ゥュハ製造方法
PCT/JP1992/001401 1991-10-29 1992-10-29 Appareil et procede pour la fabrication de tranches de semi-conducteur WO1993009565A1 (fr)

Priority Applications (2)

Application Number Priority Date Filing Date Title
US08/232,198 US5537325A (en) 1991-10-29 1992-10-29 Apparatus for and method of manufacturing semiconductor wafer
EP92922598A EP0616364A1 (en) 1991-10-29 1992-10-29 Apparatus for and method of manufacturing semiconductor wafer

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP3/283241 1991-10-29
JP3283241A JPH05121521A (ja) 1991-10-29 1991-10-29 半導体ウエハ製造装置および製造方法

Publications (1)

Publication Number Publication Date
WO1993009565A1 true WO1993009565A1 (fr) 1993-05-13

Family

ID=17662921

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP1992/001401 WO1993009565A1 (fr) 1991-10-29 1992-10-29 Appareil et procede pour la fabrication de tranches de semi-conducteur

Country Status (4)

Country Link
US (1) US5537325A (ja)
EP (1) EP0616364A1 (ja)
JP (1) JPH05121521A (ja)
WO (1) WO1993009565A1 (ja)

Families Citing this family (54)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3654597B2 (ja) * 1993-07-15 2005-06-02 株式会社ルネサステクノロジ 製造システムおよび製造方法
US5625816A (en) * 1994-04-05 1997-04-29 Advanced Micro Devices, Inc. Method and system for generating product performance history
US5607642A (en) * 1994-06-10 1997-03-04 Johnson & Johnson Vision Products, Inc. Interactive control system for packaging control of contact lenses
US5751581A (en) * 1995-11-13 1998-05-12 Advanced Micro Devices Material movement server
JP3501896B2 (ja) * 1996-03-21 2004-03-02 トーヨーエイテック株式会社 ウェハ製造装置
CH691798A5 (fr) * 1996-06-19 2001-10-31 Hct Shaping Systems Sa Centre de découpage destiné à produire des tranches à partir de pièces à trancher.
US5927512A (en) * 1997-01-17 1999-07-27 Micron Technology, Inc. Method for sorting integrated circuit devices
US6100486A (en) 1998-08-13 2000-08-08 Micron Technology, Inc. Method for sorting integrated circuit devices
US5942739A (en) * 1997-01-22 1999-08-24 Advanced Micro Devices, Inc. Process timer monitor
US5844803A (en) * 1997-02-17 1998-12-01 Micron Technology, Inc. Method of sorting a group of integrated circuit devices for those devices requiring special testing
US5862054A (en) * 1997-02-20 1999-01-19 Taiwan Semiconductor Manufacturing Company, Ltd. Process monitoring system for real time statistical process control
US5915231A (en) * 1997-02-26 1999-06-22 Micron Technology, Inc. Method in an integrated circuit (IC) manufacturing process for identifying and redirecting IC's mis-processed during their manufacture
US5856923A (en) * 1997-03-24 1999-01-05 Micron Technology, Inc. Method for continuous, non lot-based integrated circuit manufacturing
US6122562A (en) * 1997-05-05 2000-09-19 Applied Materials, Inc. Method and apparatus for selectively marking a semiconductor wafer
US5907492A (en) * 1997-06-06 1999-05-25 Micron Technology, Inc. Method for using data regarding manufacturing procedures integrated circuits (IC's) have undergone, such as repairs, to select procedures the IC's will undergo, such as additional repairs
US7120513B1 (en) 1997-06-06 2006-10-10 Micron Technology, Inc. Method for using data regarding manufacturing procedures integrated circuits (ICS) have undergone, such as repairs, to select procedures the ICS will undergo, such as additional repairs
US5943551A (en) * 1997-09-04 1999-08-24 Texas Instruments Incorporated Apparatus and method for detecting defects on silicon dies on a silicon wafer
US6895109B1 (en) 1997-09-04 2005-05-17 Texas Instruments Incorporated Apparatus and method for automatically detecting defects on silicon dies on silicon wafers
KR100299593B1 (ko) * 1998-01-23 2001-11-30 윤종용 반도체장치 제조용 백 랩핑 인라인 시스템
EP0972300B1 (en) * 1998-02-10 2006-03-01 Koninklijke Philips Electronics N.V. Method of manufacturing integrated circuits
US6049624A (en) * 1998-02-20 2000-04-11 Micron Technology, Inc. Non-lot based method for assembling integrated circuit devices
US6615091B1 (en) * 1998-06-26 2003-09-02 Eveready Battery Company, Inc. Control system and method therefor
US6325198B1 (en) 1998-06-26 2001-12-04 Eveready Battery Company, Inc. High speed manufacturing system
US7575501B1 (en) 1999-04-01 2009-08-18 Beaver Creek Concepts Inc Advanced workpiece finishing
US20130189801A1 (en) * 1998-11-06 2013-07-25 Semcon Tech, Llc Advanced finishing control
US7878882B2 (en) * 1999-04-01 2011-02-01 Charles J. Molnar Advanced workpiece finishing
US7220164B1 (en) 2003-12-08 2007-05-22 Beaver Creek Concepts Inc Advanced finishing control
US6739947B1 (en) 1998-11-06 2004-05-25 Beaver Creek Concepts Inc In situ friction detector method and apparatus
US7008300B1 (en) 2000-10-10 2006-03-07 Beaver Creek Concepts Inc Advanced wafer refining
US6656023B1 (en) 1998-11-06 2003-12-02 Beaver Creek Concepts Inc In situ control with lubricant and tracking
US6986698B1 (en) 1999-04-01 2006-01-17 Beaver Creek Concepts Inc Wafer refining
US7131890B1 (en) 1998-11-06 2006-11-07 Beaver Creek Concepts, Inc. In situ finishing control
US7572169B1 (en) 1998-11-06 2009-08-11 Beaver Creek Concepts Inc Advanced finishing control
US8353738B2 (en) * 1998-11-06 2013-01-15 Semcon Tech, Llc Advanced finishing control
WO2000036479A1 (en) * 1998-12-16 2000-06-22 Speedfam-Ipec Corporation An equipment virtual controller
US6551933B1 (en) 1999-03-25 2003-04-22 Beaver Creek Concepts Inc Abrasive finishing with lubricant and tracking
JP2001144159A (ja) * 1999-11-15 2001-05-25 Matsushita Electronics Industry Corp ウエハ補充方法
US6482661B1 (en) * 2000-03-09 2002-11-19 Intergen, Inc. Method of tracking wafers from ingot
US6303398B1 (en) * 2000-05-04 2001-10-16 Advanced Micro Devices, Inc. Method and system of managing wafers in a semiconductor device production facility
US6351684B1 (en) * 2000-09-19 2002-02-26 Advanced Micro Devices, Inc. Mask identification database server
US6796883B1 (en) 2001-03-15 2004-09-28 Beaver Creek Concepts Inc Controlled lubricated finishing
US7156717B2 (en) 2001-09-20 2007-01-02 Molnar Charles J situ finishing aid control
US6724476B1 (en) * 2002-10-01 2004-04-20 Advanced Micro Devices, Inc. Low defect metrology approach on clean track using integrated metrology
CN100518482C (zh) * 2004-07-26 2009-07-22 株式会社日立制作所 部件追踪管理装置、管理方法及管理程序
US7991499B2 (en) * 2006-12-27 2011-08-02 Molnar Charles J Advanced finishing control
WO2008151649A1 (en) 2007-06-13 2008-12-18 Conergy Ag Method for marking wafers
US8357286B1 (en) 2007-10-29 2013-01-22 Semcon Tech, Llc Versatile workpiece refining
US8844801B2 (en) 2010-11-26 2014-09-30 International Business Machines Corporation Identification and trace of items within an assembly or manufacturing process
KR101701487B1 (ko) * 2015-04-28 2017-02-03 웅진에너지 주식회사 인라인 웨이퍼 처리시스템 및 그 처리방법
DE102016112049B3 (de) * 2016-06-30 2017-08-24 Infineon Technologies Ag Verfahren zum herstellen von cz-siliziumwafern und verfahren zum herstellen einer halbleitervorrichtung
US10930535B2 (en) 2016-12-02 2021-02-23 Applied Materials, Inc. RFID part authentication and tracking of processing components
JP7083966B2 (ja) * 2019-05-30 2022-06-13 ヤマハ発動機株式会社 部品実装管理装置、部品実装管理方法、部品実装管理プログラム、記録媒体
TWI790474B (zh) 2019-12-09 2023-01-21 日商Sumco股份有限公司 晶圓製造系統
US20220043432A1 (en) * 2020-08-06 2022-02-10 Changxin Memory Technologies, Inc. System for detecting semiconductor process and method for detecting semiconductor process

Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS51140199A (en) * 1975-05-30 1976-12-02 Hitachi Metals Ltd Crystal working process
JPS55115325A (en) * 1979-02-28 1980-09-05 Chiyou Lsi Gijutsu Kenkyu Kumiai Numbering method of semiconductor wafer
JPS58177938U (ja) * 1982-05-22 1983-11-28 相合 征一郎 自動化ラインにおける搬送用ボツクス
JPS60217624A (ja) * 1984-04-13 1985-10-31 Toshiba Corp 半導体ウエ−ハ製造方法
JPS61158944U (ja) * 1985-03-26 1986-10-02
JPS61236136A (ja) * 1985-04-12 1986-10-21 Hitachi Ltd ウエハカセツト治具

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS52119174A (en) * 1976-03-31 1977-10-06 Toshiba Corp Controlling method of semiconductor
JPS5850750A (ja) * 1981-09-19 1983-03-25 Mitsubishi Electric Corp 半導体装置の製造方法
US4571685A (en) * 1982-06-23 1986-02-18 Nec Corporation Production system for manufacturing semiconductor devices
DE3402656A1 (de) * 1984-01-26 1985-08-01 Siemens AG, 1000 Berlin und 8000 München Vorrichtung zur automatischen durchfuehrung von analyseverfahren
JPS62282848A (ja) * 1986-05-30 1987-12-08 Tokyo Keiki Co Ltd Faシステムのデ−タ処理装置
JPS63220513A (ja) * 1987-03-09 1988-09-13 Oki Electric Ind Co Ltd モニタウエハのデ−タ管理方法
US4829445A (en) * 1987-03-11 1989-05-09 National Semiconductor Corporation Distributed routing unit for fully-automated flexible manufacturing system
JPS63232921A (ja) * 1987-03-19 1988-09-28 Toshiba Corp 製造方法及び装置
EP0346801B1 (de) * 1988-06-17 1996-12-27 Siemens Aktiengesellschaft Verfahren und Anordnung zur Ausführung eines Programms in einem heterogenen Mehrrechnersystem
JP2558822B2 (ja) * 1988-08-02 1996-11-27 株式会社日立製作所 半導体ウェハの生産管理方法および半導体ウェハ
JPH02208949A (ja) * 1989-02-09 1990-08-20 Mitsubishi Electric Corp 半導体製造装置
JPH02307266A (ja) * 1989-05-23 1990-12-20 Seiko Epson Corp 半導体集積回路装置
EP0437634B1 (en) * 1989-08-10 1996-11-20 Fujitsu Limited Control system for manufacturing process
JP2753142B2 (ja) * 1990-11-27 1998-05-18 株式会社東芝 半導体装置の生産システムにおける生産管理方法、生産管理装置および製造装置
JPH04199733A (ja) * 1990-11-29 1992-07-20 Tokyo Seimitsu Co Ltd 半導体チップの製造方法及びその装置

Patent Citations (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS51140199A (en) * 1975-05-30 1976-12-02 Hitachi Metals Ltd Crystal working process
JPS55115325A (en) * 1979-02-28 1980-09-05 Chiyou Lsi Gijutsu Kenkyu Kumiai Numbering method of semiconductor wafer
JPS58177938U (ja) * 1982-05-22 1983-11-28 相合 征一郎 自動化ラインにおける搬送用ボツクス
JPS60217624A (ja) * 1984-04-13 1985-10-31 Toshiba Corp 半導体ウエ−ハ製造方法
JPS61158944U (ja) * 1985-03-26 1986-10-02
JPS61236136A (ja) * 1985-04-12 1986-10-21 Hitachi Ltd ウエハカセツト治具

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
See also references of EP0616364A4 *

Also Published As

Publication number Publication date
EP0616364A1 (en) 1994-09-21
EP0616364A4 (en) 1994-08-01
JPH05121521A (ja) 1993-05-18
US5537325A (en) 1996-07-16

Similar Documents

Publication Publication Date Title
WO1993009565A1 (fr) Appareil et procede pour la fabrication de tranches de semi-conducteur
US7778721B2 (en) Small lot size lithography bays
JP5417998B2 (ja) ウェーハ製造履歴追跡方法
JP2000331962A (ja) 半導体ウエハの加工方法および半導体ウエハ支持部材
US10026632B2 (en) Wafer processing system and wafer processing method using same
JP2022075786A (ja) 搬送装置、および基板処理システム
KR20040100996A (ko) 테스트 기판 재생 방법 및 장치
JP5767520B2 (ja) ワークの複合面取り加工装置
JP2000260738A (ja) 半導体基板の研削加工方法ならびに半導体装置および半導体装置の製造方法
US6599763B1 (en) Wafer randomization and alignment system integrated into a multiple chamber wafer processing system
JP3280747B2 (ja) ダイシング加工管理方法および加工品質管理システム
JP2008293508A (ja) 半導体ウエハの加工方法および半導体ウエハ支持部材
JP6105308B2 (ja) 加工装置
JP2014154633A (ja) 加工装置
JPH09306873A (ja) ウェーハの分割システム
US7578723B2 (en) Polishing tape and polishing device using same
JP2003031644A (ja) 半導体製造装置
US20240227100A1 (en) Jig for being integrated with ingot
JPH11204462A (ja) ダイシング装置
JP2002110491A (ja) 検査用ウェーハ及び検査サンプルの作製方法及び作製装置
JP7292125B2 (ja) 生産システム
KR100556328B1 (ko) 낱장별로 웨이퍼 품질관리가 수행되는 웨이퍼 생산방법 및생산 시스템
JPH0973615A (ja) 磁気ヘッドの検査データ収集方法
JP2002050554A (ja) 検査用ウェーハ、その作製方法及びその作製装置
TW202215572A (zh) 加工裝置及加工裝置之使用方法

Legal Events

Date Code Title Description
AK Designated states

Kind code of ref document: A1

Designated state(s): US

AL Designated countries for regional patents

Kind code of ref document: A1

Designated state(s): AT BE CH DE DK ES FR GB GR IE IT LU MC NL SE

DFPE Request for preliminary examination filed prior to expiration of 19th month from priority date (pct application filed before 20040101)
WWE Wipo information: entry into national phase

Ref document number: 08232198

Country of ref document: US

WWE Wipo information: entry into national phase

Ref document number: 1992922598

Country of ref document: EP

WWP Wipo information: published in national office

Ref document number: 1992922598

Country of ref document: EP

WWR Wipo information: refused in national office

Ref document number: 1992922598

Country of ref document: EP

WWW Wipo information: withdrawn in national office

Ref document number: 1992922598

Country of ref document: EP