TWI240908B - Display apparatus drive circuit having a plurality of cascade connected driver ICs - Google Patents

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Description

1240908 發明說明（1) 一、【發明所屬之技術領域】 具 t，明係關於一種顯示設備驅動電路，尤關於 有稷婁:個級聯連接驅動器Ic之顯示設備驅動電路。 一、【先前技術】 近年來’由於顯示面板的尺寸變大，故 聯連接驗細$ τ P ^ % $複數個級 立 要驅動态I c之顯示設備的驅動電路已引起廣泛的注 、就1種驅動器1(:而言，圖7顯示此種習知的驅動電路 以下稱為專利文件丄）。圖7之驅動器IC701由相位 電路702、資料閂鎖電路7〇3、灰階選擇電路7 出電 路705所構成。 叛出電 。相位調整電路702接收顯示資料且接收未顯示之UD控 制器所供應的時脈，並進行相位調整，接著將資料傳送ς 下一級的驅動器IC且將資料傳送給資料閂鎖電路7〇3。基σ 於資料閂鎖電路70 3所閂鎖的資料，灰階選擇電路7〇4將^控 制輸出電路70 5，俾能藉由輸出電路70 5驅動未顯示的液: 顯示面板。 如圖8所示，相位調整電路702由所構成正反器電路 801、用以產生（疋/2)之相位差的時脈信號之pL°L電路 802 (DLL電路）、及正反器電路80 3。以時脈信號重洗供 應給正反器電路801的資料，接著以偏移達（疋/2 )的日^ 脈化號閂鎖住供應給正反器電路8 0 3的資料，俾能調整資 料與時脈 < 間的相位差。 貝 [專利文件1 ]
1240908 圖式簡單說明 3 0 3、3 0 4、3 0 5、3 0 6、3 0 7、3 0 8 閃鎖電路 309 選擇器電路 3091 、 3093 、 3094 NAND 閘 3092、603 反相器 501、504、601、606 緩衝器 5 02 電路 503、605 組合電路 602、6 04構成電路 801、8 03 正反器電路 80 2 PLL電路 7 0 1 驅動器
第14頁

Claims (1)

  1. !24〇9〇8 修正 月 ' ^__ 案號 Qiniiiftci 曰 六、申請專利範圍 1基：：：示設，驅動電路，具有-相位調整電路，其位在 中，、复二〇:，脈2 *料而驅動-顯示設備的-驅動器之 ，、中该相位調整電路包含： 一弟一同步延遲 能率且將1告 路，用以調整該已輸入的時脈之一 —楚，、田作一第一時脈加以輸出； 弟一同步延 一預定之延遲旦日腺甘，用以使該已調整的時脈延遲達 _筮 π = f、當作一第二時脈加以輸出； 第一保持電路，卜 並加以輪出；及 °應該第一時脈而用以保持該資料 第二保持電路， 保持電路所輸出处、、、回應該第二時脈而用以保持該第一 ， 貝料並加以輸出。 2 ·如申請專利範圍第1項 調整電路包含一第二、之顯示設備驅動電路，其中該相位 保持一啟動脈衝並::t電路，其回應該第一時脈而用以 回應該第一時脈之一輪出、及包含一第四保持電路，其 所輸出之啟動脈衝廿f相信號而用以保持該第三保持電路 衡並加以輪出。 3 ·如申请專利範圍第1 器更包含一資料閂鎖、之顯示設備驅動電路，其中該驅動 資料與該第一時脈_味路，回應該相位調整電路所輸出之 就而進行操作。 4 ·如申睛專利範圍第1 設定在百分之五十^員，顯示設備驅動電路，其中工作比 十的讀第-同步延遲電路係輪出該已輸入 I 第15頁 」丄，’亡、才楚 -^^93101¾
    第2項之顯示設備驅動電路，其中延遲 延遲電路係輸出該第一時脈。 1240908 六、中請專利範圍 的時脈 5 ·如申請專利範圍 疋/2的該第二同步 6 ·如申請專利範圍 閂鎖電路在該第一 料。 第5項之顯示設備驅動電路，其中兮資 時脈的一上升緣與一下降緣時吸收資貝"、 7 ·如申晴專利範 閂鎖電路包含_ 脈之該上升緣時 料。 圍第6項之顯示設備驅動電路，复中哕 電路’用以交替地輪出在該第1、時 所問鎖之資料與其該下降緣時所問鎖之資 .種顯不設備驅動電路，具有禎數之, 入的時脈鱼眘枓《Τή聰叙％ ，、有複數之驅動态，基於已輸 與貝枓而驅動顯示設備，各驅動器包含： 一第一同步延遲電路，用 工作比且將其當作第-時脈加以已輸人的時脈之一 第二同步延遲電路，用 宏夕M b 用以使该第一時脈延遲遠一褚 疋之延遲量且將其當作第—延 _ ^遲時脈加以輸出； 第一相位調整電路，样姓盆 延遲時脈$ ^ Α Μ I_ #保持基於該第一時脈與該第一 了脈而輸入的貝科並加以輪出； 一閂鎖電路，回應該第一主 出的資料· 币 時脈而保持該已保持並已輸
    _案號 931〇i8i8 1240908 月 曰 修正 六、申請專利範圍 LJi_J 一第三同步延遲電路，用以重新調整該第一時脈的工 作比，且將其當作第二時脈而提供給下一級的驅動器； 一第四同步延遲電路，用以使該第二時脈延遲達預定 之延遲量並輸出第二延遲時脈；及 一第二相位調整電路，保持基於該第二時脈與該第二 延遲時脈而輸入的資料，且輸出所保持的資料給該下一級 的驅動器。 9.如申請專利範圍第8項之顯示設備驅動電路，更包含一閂 鎖電路，用以回應該第一時脈而閂鎖啟動脈衝。 1 0.如申請專利範圍第8項之顯示設備驅動電路，其中包含 一第一閂鎖電路，其回應該第一時脈與該第一延遲時脈而 閂鎖已輸入的資料並加以輸出。 11.如申請專利範圍第1 0項之顯示設備驅動電路，其中包含 一第二閂鎖電路，其回應該第二時脈與該第二延遲時脈而 閂鎖已輸入的資料並加以輸出。
    第17頁 1240908 式 圖 i i— 画3
    第頁 1240908 & 式 圖 i niEE^M i mi^fvs-fi^ Ηβ§0 s髪 I ^ASM ^A?s 画4
    第頁 1240908 式 圖 画5 ml^ivw+iv
    502 第頁 1240908 式 圖 議IC1π 画7
    701 頁 第
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