TW503387B - HOUT position control circuit - Google Patents

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TW503387B
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delay
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Yoshiyuki Uto
Takafumi Esaki
Yasuhiro Fukuda
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Nippon Electric Co
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Description

503387 五、發明說明（1) 技術領域 本發明是關於顯示器中用來控制顯示影像位置的水平 輸出位置控制電路。 發明背景 多同步顯示器使用水平輸出位置控制電路來控制輸入 水平同步訊號（之後表示成’Hsync訊號’）到輸出水平驅 動訊號（之後表示成’ Η 〇 u t訊號’）間的延遲量來執行影像 顯示位置（之後簡稱位置控制）的控制。 傳統上，多同步顯示器的水平輸出位置控制電路，是 在PLL迴路中具有一可調整延遲電路，而位置控制是由控 制可調整延遲電路的延遲值來執行。 圖1是傳統水平輸出位置控制電路組成的方塊圖。 如圖1，傳統水平輸出位置控制電路與可調整延遲電 路24、25在相位補償器3的輸入端。兩個給相位補償器3的 輸入訊號分別由可調整延遲電路24、25來延遲。位置控制 是由控制延遲值來執行。 圖2是圖1可調整延遲電路24、25組成的方塊圖。 多同步顯示器需要和輸入H sync訊號相同比例的延遲 量。因此，和可調整延遲電路24、25的輸入訊號29同步的 鋸齒波31是由鋸齒波產生電路28所產生的，而延遲的輸出 訊號2 7是由補償器3 2所產生。 延遲值的控制是由延遲控制電壓30所執行，其為DC電 壓0
503387 五、發明說明（2) 圖3是由鋸齒波產生延遲值過程的時序圖。 然而，因為傳統水平輸出位置控制電路在PLL迴路中 具有可調整延遲電路，可調整延遲電路中的分散會造成位 置的偏移。 而且，因為可調整延遲電路是以類比方式操作，延遲 值會隨著雜訊而產生抖動雜訊。 發明概要 因此，本發明的目的是提供一水平輸出位置控制電路 可以抑制位置的偏移或抖動雜訊。 本發明的另一目的是提供一位置控制電路用來控制多 同步顯示器中顯示影像的垂直位置以抑制位置的偏移或抖 動雜訊。 根據本發明，一種水平輸出位置控制電路，用以在一 多同步顯示器中控制顯示影像水平位置，具有： 一第一 PLL電路，其與輸入水平同步訊號鎖相； 一第二PLL電路，其與該第一PLL電路的輸出鎖相；和 一延遲產生裝置，用以在該第一PLL電路和該第二PLL 電路之輸出間產生一延遲來控制該輸入水平同步訊號到輸 出水平驅動訊號間的延遲量。 根據本發明的另一實施樣態，一種水平輸出位置控制 電路，用以在一多同步顯示器中控制顯示影像水平位置， 其中：該顯示影像的位置控制是以數位方式執行。 根據本發明的另一實施樣態，一種位置控制電路，用
503387 五、發明說明（3) 以在多同步顯示器中控制顯示影像垂直位置，具有· 一第一 PLL電路，與輸入垂直同步訊號鎖相'· 一第二PLL電路，與該第一PLL電路的輪出鎖相； 一延遲產生裝置，用以在該第一 PLL電路和該第二p 電路之輸出間產生一延遲來控制該輸入垂直 出垂直驅動訊號間的延遲量。 根據本發明的另一實施樣態，一種位置控制電路， 以在一多同步顯示器中控制顯示影像垂直位置，其中： 該顯示影像的位置控制是以數位方式執行。 而且’本發明也提供使用上述水平輪出位置控制電路 或位置控制電路的多同步顯示器。 較佳實施例之說明 本發明的較佳實施例參考附圖解釋。 圖4是本發明較佳實施例的水平輸出位置控制電路的 方塊圖。 圖4中，PLL電路1用來配合輸入Hsync訊號18的相位而 PLL電路2用來配合PLL電路1的Μ值可程式解碼器7的輸出的 相位。 PLL電路1和2的元件解釋如下。
Hsync訊號18輸入到PLL電路1的相位補償器3，其與 1 / N可程式分頻器6的輸出比較相位。然後，誤差輸出，也⑩ 就是相位補償器3的输出，由LPF4平滑。藉由LPF4的輸出 電壓，控制VC05的震盪頻率。
第8頁 503387 五、發明說明（4) 1/N可程式分頻器6籍由輸入Hsync訊號18的頻率來改 變分頻值N。分頻值N為正整數並由分值解碼值控制電路8 設定。 由輸入的Hsync訊號18，可以產生系統時脈14的鎖 相。系統時脈1 4用來作為系統時脈以控制分值解碼值控制 電路8，Hsync訊號，垂直同步訊號（之後稱。7此訊號） 等。 Μ值可程式解碼器7，如之後圖5所描述，用來解碼1/N 可程式分頻器6的Mth時脈。解碼值於，其中M為整數，是在 執行位置控制時由分值解碼值控制電路8所設定。 電ί2中，M#可程式解碼器7的輸出與布朗管_ 產生的FBP汛號17由相位補償器9比較相位，然後誤 出，也就是相位補償器9的輸出，由LPF丨〇所平滑。粗 3 LPF10的輸出電壓，控制vc〇11的震盪頻率。 _ 1/N可程式分頻器12的分頻值1^設定成與pLL電路 作炎可愈程式忠分頻器6相目。1/N可程式分頻器12的輪出用爽 作為布朗管13的H〇ut訊號16。 和出用來 本實施例的水平輸出位置控制操作解釋如下。 首先’ PLL電路！和2的操作解釋 ^18 ί ^ 6 ^ ^ #HS-C H私―尺田微處理器，DSp等構成。 待輪入的Hsync訊號18執行鎖相震盪 b而對 訊 分值解
第9頁 503387
圖L’B)表示輸入的Hsync訊號18，C)表示1/N可程 裔6的輪出，和A)表示作為vc〇5輸出的系統時脈“ 為HsynC訊號^與！/^可程式分頻器6的輸出鎖相
nc
有相同時序。作為vc〇5輸出的系統時脈丨4相當 號1 8乘以頻率N 位置控制操作解釋如下。
Μ值可程式解碼器7，其與1/Ν可程式分頻器6同步，在 1/Ν可程式分頻器6的任意數值μ輸出脈衝。 圖5 , C )和D )分別表示ι/Ν可程式分頻器6 值可程 式解碼器7的輸出。 Μ值可程式解碼器7的輸出〇)具有相當於由分值解碼 值控制電路8所設定的Μ值的延遲，並週期性輸出相同訊號 作為1/Ν可程式分頻器6的輸出。 ' Μ值可程式解碼器7的輸出D)由PLL電路2舆FBP17鎖 相。由Hout訊號16到FBP訊號17的延遲為布朗管13所決定 的常數值。
Hsync訊號18到Hout訊號16的延遲量Η可藉由改變Μ值 可程式解碼器7的Μ值來設定。 因此，Hsync訊號18到Hout訊號16的延遲量Η控制， 也就是，位置控制，可以籍由控制Μ值可程式解碼器7的Μ 值來執行。
第10頁 503387 五、發明說明（6) 因此，在較佳實施例中，只 的Μ值便可以以數位方式執行位置控疋M ^I程式解碼器7 傳統==償器輸入的位置控/調整延遲電路不再需要 調整延遲電路延遲值的改變等塑雜訊等因為可 偏移。 解决了#整延遲電路分散所造成的位置 而且，在本實施例中，因為伋 行，多同步顯示器所需的接腳平衡方式執 以It ^控制* *值解碼值控制f路8職定的M值來執二了 本發明另一較隹實施例參考圖解釋如下。 圖6是本發明Vsync訊號位置控制電路的方塊圖。 圖6，除了Vsync訊號21是輸入訊號，γ驅動脈衝22是 給布朗管13的驅動脈衝而VFBP23是由布朗管13來的fbp， 電路組成與圖4的實施例相同。相同元件的解釋省略。 在本實施例中，和圖4的實施例相同，vsync訊號21， 位置控制可以使用Μ值可程式解碼器7的值來執行。 雖然本發明針對特定實施例完整清楚地揭露，申請專 利範圍並不限於實施例，所有的改變及變更對於熟於此技 術的人只要簡單的學習便可以實施。
第11頁 503387 圖式簡單說明 本發明將配合附圖詳細說明，其中： 圖1是傳統水平輸出位置控制電路的方塊圖， 圖2是圖1可調整延遲電路的方塊圖， 圖3是由鋸齒波產生延遲值過程的時序圖， 圖4是本發明較佳實施例水平輸出位置控制電路的方 塊圖， 圖5是圖4水平輸出位置控制電路操作的時序圖，和 圖6是本發明另一較佳實施例的Vsync訊號位置控制電 路的方塊圖。 圈示符號說明： 1 :PLL電路 2 :PLL電路 3 :相位補償器 6 Π / N可程式分頻器 7:M值可程式解碼器 8 :分值解碼控制電路 9 :相位補償器 1 2 : 1 / N可程式分頻器 1 3 :布朗管 1 4 :系統時脈 16:Hout 訊號 17:FBP訊號 18:Hsync 訊號
第12頁 503387 圖式簡單說明 25:可調整延遲電路 26:分值控制電路 2 7 :輸出訊號 28:鋸齒波產生電路 29 :輸入訊號 3 0 :延遲控制電壓 DC Level Adjustable:可調整 Dc 準位（fig.2) 31:鋸齒波產生電路的輪出 3 2 :補償器 delay value:延遲值（fig· 3) delay control vo 1 tage :延遲控制電壓（fige3) position control H:位置控制 u (fig. 5) delay at braun tubel3:布朗管的延遲 d e 1 a y t ο M v a 1 u e :延遲 M 值（f i g β 5 ) N times clock of VC05:VC05 N倍時脈（fig· 5)
第13頁

Claims (1)

  1. 503387 六、申請專利範圍 1. 一種水平輸出位置控制電路，用以在一多同步顯示 器中控制顯示影像水平位置，具有： 一第一 PLL電路，其與輸入水平同步訊號鎖相； 一第二PLL電路，其與該第一 PLL電路的輸出鎖相；和 一延遲產生裝置，用以在該第一 PLL電路和該第二PLL 電路之輸出間產生一延遲來控制該輸入水平同步訊號到輸 出水平驅動訊號間的延遲量。 2. —種水平輸出位置控制電路，用以在一多同步顯示 器中控制顯示影像水平位置，其中： 該顯示影像的位置控制是以數位方式執行。 3. —種位置控制電路，用以在多同步顯示器中控制顯 示影像垂直位置，具有： 一第一PLL電路，與輸入垂直同步訊號鎖相； 一第二PLL電路，與該第一PLL電路的輸出鎖相；和 一延遲產生裝置，用以在該第一 PLL電路和該第二PLL 電路之輸出間產生一延遲來控制該輸入垂直同步訊號到輸 出垂直驅動訊號間的延遲量。 4. 一種位置控制電路，用以在一多同步顯示器中控制 顯示影像垂直位置，其中： 該顯示影像的位置控制是以數位方式執行。
    第14頁 503387 六、申請專利範圍 5. —種多同步顯示器，具有如申請專利範圍第1項所 述之該水平輸出位置控制電路。 6 · —種多同步顯示器，具有如申請專利範圍第2項所 述之該水平輸出位置控制電路。 7. —種多同步顯示器，具有如申請專利範圍第3項所 述之該位置控制電路。 8. —種多同步顯示器，具有如申請專利範圍第4項所 述之該位置控制電路。
    第15頁
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