JP3270406B2 - ポジション制御回路 - Google Patents
ポジション制御回路Info
- Publication number
- JP3270406B2 JP3270406B2 JP34820298A JP34820298A JP3270406B2 JP 3270406 B2 JP3270406 B2 JP 3270406B2 JP 34820298 A JP34820298 A JP 34820298A JP 34820298 A JP34820298 A JP 34820298A JP 3270406 B2 JP3270406 B2 JP 3270406B2
- Authority
- JP
- Japan
- Prior art keywords
- value
- programmable
- output
- frequency divider
- frequency
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/04—Synchronising
- H04N5/12—Devices in which the synchronising signals are only operative if a phase difference occurs between synchronising and synchronised scanning devices, e.g. flywheel synchronising
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G1/00—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data
- G09G1/06—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows
- G09G1/14—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows the beam tracing a pattern independent of the information to be displayed, this latter determining the parts of the pattern rendered respectively visible and invisible
- G09G1/16—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows the beam tracing a pattern independent of the information to be displayed, this latter determining the parts of the pattern rendered respectively visible and invisible the pattern of rectangular co-ordinates extending over the whole area of the screen, i.e. television type raster
- G09G1/165—Details of a display terminal using a CRT, the details relating to the control arrangement of the display terminal and to the interfaces thereto
- G09G1/167—Details of the interface to the display terminal specific for a CRT
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/04—Synchronising
- H04N5/12—Devices in which the synchronising signals are only operative if a phase difference occurs between synchronising and synchronised scanning devices, e.g. flywheel synchronising
- H04N5/126—Devices in which the synchronising signals are only operative if a phase difference occurs between synchronising and synchronised scanning devices, e.g. flywheel synchronising whereby the synchronisation signal indirectly commands a frequency generator
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2340/00—Aspects of display data processing
- G09G2340/04—Changes in size, position or resolution of an image
- G09G2340/0464—Positioning
- G09G2340/0478—Horizontal positioning
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/44—Receiver circuitry for the reception of television signals according to analogue transmission standards
- H04N5/46—Receiver circuitry for the reception of television signals according to analogue transmission standards for receiving on more than one standard at will
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Multimedia (AREA)
- Theoretical Computer Science (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Physics & Mathematics (AREA)
- Remote Sensing (AREA)
- Radar, Positioning & Navigation (AREA)
- Synchronizing For Television (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Details Of Television Scanning (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Description
に関し、詳しくはマルチシンクディスプレイに用いら
れ、映像の表示位置を制御するポジション制御回路に関
する。
示位置制御(以下「ポジション制御」という)を行うた
めに、入力水平同期信号(以下「Hsync信号」とい
う)から出力水平ドライブ信号(以下「Hout信号」
という)までの遅延量を制御するHOUTポジション制
御回路が用いられている。
HOUTポジション制御回路は、PLLループの中に可
変遅延回路を設け、その遅延値を制御することでポジシ
ョン制御を行っていた。
路の構成を示すブロック図である。
Tポジション制御回路では、位相比較器3の入力段に可
変遅延回路24および25を設け、位相比較器3の2つ
の入力信号のそれぞれを可変遅延回路24および25に
よって遅延させ、、その遅延値を制御することによって
ポジション制御を行っていた。
よび25の構成を示すブロック図である。
力されるHsync信号に対して同一割合での遅延値を
必要とするため、のこぎり波発生回路28によって可変
遅延回路24および25の入力信号29に同期したのこ
ぎり波31を作り、コンパレータ32を用いて遅延した
出力信号27を作っていた。
制御電圧30を用いて行っていた。
る処理のイメージ図である。
従来のHOUTポジション制御回路では、PLLループ
の中に可変遅延回路が存在するため、可変遅延回路のバ
ラツキがポジションのずれとなってしまう欠点がある。
しているため、ノイズにより遅延値が変動してしまい、
ジッタとなって現れてしまう欠点がある。
ので、上記欠点を解決するHOUTポジション制御回路
を提供することを目的とする。
成するために、マルチシンクディスプレイの入力水平同
期信号から出力水平ドライブ信号までの遅延量を制御す
るポジション制御回路において、入力水平同期信号と前
記入力水平同期信号の周波数によって分周値を可変する
第1のプログラマブル分周器の出力とを比較する位相比
較器と、前記比較結果を第1の低域フィルタに通した出
力に応じて発振周波数を制御する第1の電圧制御発振回
路と、前記第1の電圧制御発振回路の出力を前記第1の
プログラマブル分周器に入力し、前記第1のプログラマ
ブル分周器の任意のカウント値でパルスを出力するプロ
グラマブルデコーダと、から成る第1のPLL回路と、
前記プログラマブルデコーダの出力とブラウン管からの
フライバックパルス信号とを比較する位相比較器と、前
記比較結果を第2の低域フィルタに通した出力に応じて
発振周波数を制御する第2の電圧制御発振回路と、前記
第2の電圧制御発振回路の出力を入力とする第2のプロ
グラマブル分周器と、から成る第2のPLL回路と、前
記第1のプログラマブル分周器の分周値と前記プログラ
マブルデコーダのデコード値と前記第2のプログラマブ
ル分周器の分周値とを夫々設定する分周値デコード値制
御回路と、を設け、前記第1のプログラマブル分周器の
分周値と前記第2のプログラマブル分周器の分周値とを
同じ値に設定し、前記ポジション制御を前記プログラマ
ブルデコーダのデコード値で制御することを特徴とす
る。
を参照して説明する。
制御回路の一実施の形態のブロック図である。
sync信号18に対して位相を合わせるためのもので
あり、PLL回路2はPLL回路1のM値プログラマブ
ルデコーダ7の出力に対して位相を合わせるためのもの
である。
ついて説明する。
位相比較器3に入力されて1/Nプログラマブル分周器
6の出力と位相を比較され、誤差出力すなわち位相比較
器3の出力はLPF4で平滑される。このLPF4の出
力の電圧によってVCO5は発振周波数を制御される。
るHsync信号18の周波数によって分周値Nを可変
させるものであり、この分周値Nは正の整数で分周値デ
コード値制御回路8から設定される。
8に対して位相ロックのかかったシステムクロック14
が生成できる。システムクロック14は分周値デコード
値制御回路8、およびHsync信号、垂直同期信号
(以下「Vsync信号」という)等を制御する際のシ
ステムクロックとして使用される。
後に説明する図2に示すように、1/Nプログラマブル
分周器6のMクロック目をデコードするためのものであ
り、デコード値M(Mは正の整数)はポジション制御を
行う際に分周値デコード値制御回路8から設定される。
グラマブルデコーダ7の出力は、位相比較器9によっ
て、ブラウン管13内にて生成するFBP信号17と位
相を比較され、誤差出力すなわち位相比較器9の出力は
LPF10で平滑される。このLPF10の出力の電圧
によってVCO11は発振周波数を制御される。
Nは、PLL回路1内の1/Nプログラマブル分周器6
と同じ値に設定する。1/Nプログラマブル分周器12
の出力はブラウン管13内のHout信号として使用す
る。
ン制御の動作について説明する。
の動作について、図2を用いて説明する。
制御回路の動作を示すタイミングチャートである。
4、VCO5および1/Nプログラマブル分周器6によ
って、入力するHsync信号18に対して位相ロック
のかかった発振を行う。
の分周比は、入力するHsync信号18の周波数に基
づき分周値デコード値制御回路8によって設定される。
一般に分周値デコード値制御回路8はマイコン、DSP
等によって構成される。
信号18、C)は1/Nプログラマブル分周器6の出
力、A)はVCO5の出力であるシステムクロック14
のタイミングを表している。
ル分周器6の出力とは位相ロックしているため同じタイ
ミングとなり、VCO5の出力であるシステムクロック
14は入力するHsync信号18のN倍の周波数とな
る。
ログラマブルデコーダ7の出力とFBP信号17とを位
相ロックさせている。
明する。
ログラマブル分周器6と同期しており、1/Nプログラ
マブル分周器6の任意のカウント値Mの値でパルスを出
力する。
ログラマブル分周器6の出力とM値プログラマブルデコ
ーダ7の出力のタイミングを表している。
は分周値デコード値制御回路8にて設定されたMの値だ
け遅延をもち、周期的に1/Nプログラマブル分周器6
の出力と同一の信号が生成される。
はPLL回路2によってFBP信号17と位相ロックす
る。Hout信号16からFBP信号17までの遅延は
ブラウン管13によって決まる一定値のものである。
信号18からHout信号16までの遅延量HはM値プ
ログラマブルデコーダ7のM値を変化させることで設定
することができる。
信号16までの遅延量Hの制御、すなわちポジション制
御はM値プログラマブルデコーダ7のM値の値を制御す
ることで可能となる。
ション制御がM値プログラマブルデコーダ7の値をディ
ジタル的に設定するだけで可能となるため、従来、位相
比較器の入力部分に設けていたポジション制御用の可変
遅延回路が不要となった。
イズ等で発生する遅延値のゆれがジッタとなり画質を悪
化していたことを抑えることができる。同時に、可変遅
延回路で発生するバラツキによってポジションのずれが
発生することを抑えることができる。
制御をディジタル的行うことができるため、分周値デコ
ード値制御回路8にて設定するM値を制御することによ
り、マルチシンクディスプレイにて必要とされるピンバ
ランス補正、キーバランス補正等が可能となる。
面を参照して説明する。
するポジション制御回路の実施の形態のブロック図であ
る。
信号、Vドライブパルス22がブラウン管13に出力す
るドライブパルス、VFBP23がブラウン管13から
のFBP、その他の構成は図1に示した実施の形態と同
一であるので詳しい説明は省略する。
の形態と同様に、入力されるVsync信号21に対し
て、M値プログラマブルデコーダ7の値でポジションを
制御できることがわかる。
ジション制御がM値プログラマブルデコーダ7の値をデ
ィジタル的に設定するだけで可能となるため、従来位相
比較器の入力部分に設けていたポジション制御用の可変
遅延回路が不要となった。
で発生する遅延値のゆれがジッタとなり画質を悪化して
いたことを抑えることができる。同時に可変遅延回路で
発生するバラツキでポジションのずれが発生することを
抑えることができる。
ことができるため、図1に示した分周値デコード値制御
回路8にて設定するM値を制御することにより、マルチ
シンクディスプレイにて必要とされるピンバランス補
正、キーバランス補正等が可能となる。
実施の形態のブロック図である。
作を示すタイミングチャートである。
ン制御回路の実施の形態のブロック図である。
すブロック図である。
ク図である。
ージ図である。
Claims (1)
- 【請求項1】マルチシンクディスプレイの入力水平同期
信号から出力水平ドライブ信号までの遅延量を制御する
ポジション制御回路において、 入力水平同期信号と前記入力水平同期信号の周波数によ
って分周値を可変する第1のプログラマブル分周器の出
力とを比較する位相比較器と、前記比較結果を第1の低
域フィルタに通した出力に応じて発振周波数を制御する
第1の電圧制御発振回路と、前記第1の電圧制御発振回
路の出力を前記第1のプログラマブル分周器に入力し、
前記第1のプログラマブル分周器の任意のカウント値で
パルスを出力するプログラマブルデコーダと、から成る
第1のPLL回路と、 前記プログラマブルデコーダの出力とブラウン管からの
フライバックパルス信号とを比較する位相比較器と、前
記比較結果を第2の低域フィルタに通した出力に応じて
発振周波数を制御する第2の電圧制御発振回路と、前記
第2の電圧制御発振回路の出力を入力とする第2のプロ
グラマブル分周器と、から成る第2のPLL回路と、 前記第1のプログラマブル分周器の分周値と前記プログ
ラマブルデコーダのデコード値と前記第2のプログラマ
ブル分周器の分周値とを夫々設定する分周値デコード値
制御回路と、を設け、 前記第1のプログラマブル分周器の分周値と前記第2の
プログラマブル分周器の分周値とを同じ値に設定し、 前記ポジション制御を前記プログラマブルデコーダのデ
コード値で制御することを特徴とするポジション制御回
路。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP34820298A JP3270406B2 (ja) | 1998-12-08 | 1998-12-08 | ポジション制御回路 |
TW088121616A TW503387B (en) | 1998-12-08 | 1999-12-08 | HOUT position control circuit |
US09/456,816 US6549198B1 (en) | 1998-12-08 | 1999-12-08 | Hout position control circuit |
KR1019990055791A KR100360958B1 (ko) | 1998-12-08 | 1999-12-08 | Hout 위치 제어 회로 및 멀티 싱크 모니터 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP34820298A JP3270406B2 (ja) | 1998-12-08 | 1998-12-08 | ポジション制御回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2000172213A JP2000172213A (ja) | 2000-06-23 |
JP3270406B2 true JP3270406B2 (ja) | 2002-04-02 |
Family
ID=18395445
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP34820298A Expired - Fee Related JP3270406B2 (ja) | 1998-12-08 | 1998-12-08 | ポジション制御回路 |
Country Status (4)
Country | Link |
---|---|
US (1) | US6549198B1 (ja) |
JP (1) | JP3270406B2 (ja) |
KR (1) | KR100360958B1 (ja) |
TW (1) | TW503387B (ja) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2000023063A (ja) | 1998-06-26 | 2000-01-21 | Sony Corp | 映像再生装置及び再生方法 |
JP2001320680A (ja) * | 2000-05-09 | 2001-11-16 | Sony Corp | 信号処理装置および方法 |
JP2002101316A (ja) | 2000-09-26 | 2002-04-05 | Mitsubishi Electric Corp | クロック生成回路及び画像表示装置 |
JP2003189116A (ja) * | 2001-12-14 | 2003-07-04 | Sanyo Electric Co Ltd | 駆動回路 |
US11073570B1 (en) * | 2020-05-28 | 2021-07-27 | Western Digital Technologies, Inc. | Detecting problematic voltage signals from charge pumps |
Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4327376A (en) * | 1978-10-05 | 1982-04-27 | Rca Corporation | Dual phase-control loop horizontal deflection synchronizing circuit |
JPS5844069B2 (ja) | 1980-01-08 | 1983-09-30 | エステ−化学工業株式会社 | ゴムもしくは合成樹脂製水受付手袋の製造方法 |
JPS6176911A (ja) | 1984-09-25 | 1986-04-19 | Japan Servo Co Ltd | 磁気エンコ−ダ |
JPS62216588A (ja) | 1986-03-18 | 1987-09-24 | Toshiba Corp | 水平位相シフト回路 |
DE3677214D1 (de) * | 1986-07-31 | 1991-02-28 | Itt Ind Gmbh Deutsche | Digitale horizontalablenkschaltung. |
US5043813A (en) * | 1990-03-26 | 1991-08-27 | Thomson Consumer Electronics, Inc. | Display locked timing signals for video processing |
US5329367A (en) * | 1990-03-26 | 1994-07-12 | Thomson Consumer Electronics, Inc. | Horizontal blanking |
DE4011241B4 (de) * | 1990-04-06 | 2005-06-02 | Micronas Gmbh | Digitale Fernsehsignalverarbeitungsschaltung mit orthogonalem Ausgangstakt |
KR950007539Y1 (ko) * | 1992-01-27 | 1995-09-13 | 강명춘 | 사출 성형기의 호퍼 드라이어 다이 |
JPH06350864A (ja) * | 1993-06-08 | 1994-12-22 | Hitachi Ltd | 表示画像調整回路 |
US5812210A (en) * | 1994-02-01 | 1998-09-22 | Hitachi, Ltd. | Display apparatus |
US5565928A (en) * | 1994-06-10 | 1996-10-15 | Thomson Consumer Electronics, Inc. | Circuit for generating a scan at a multiple of a synchronizing signal |
JPH0937100A (ja) * | 1995-07-22 | 1997-02-07 | Victor Co Of Japan Ltd | 映像表示位置制御回路 |
US6005634A (en) * | 1996-07-24 | 1999-12-21 | Motorola, Inc. | Method and apparatus for controlling the display of a video image |
SG65628A1 (en) * | 1996-12-19 | 1999-06-22 | Motorola Inc | Digital horizontal flyback control circuit |
KR19980069395A (ko) * | 1997-02-28 | 1998-10-26 | 배순훈 | 방송종류인식에 의한 crt화면의 수평위치 자동변환장치 |
-
1998
- 1998-12-08 JP JP34820298A patent/JP3270406B2/ja not_active Expired - Fee Related
-
1999
- 1999-12-08 KR KR1019990055791A patent/KR100360958B1/ko not_active IP Right Cessation
- 1999-12-08 US US09/456,816 patent/US6549198B1/en not_active Expired - Fee Related
- 1999-12-08 TW TW088121616A patent/TW503387B/zh active
Also Published As
Publication number | Publication date |
---|---|
TW503387B (en) | 2002-09-21 |
US6549198B1 (en) | 2003-04-15 |
KR100360958B1 (ko) | 2002-11-18 |
KR20000052437A (ko) | 2000-08-25 |
JP2000172213A (ja) | 2000-06-23 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4271531A (en) | Frequency synthesizer | |
KR20110030569A (ko) | 수신 장치에서 출력 클럭 주파수를 보정하는 회로 | |
JP3848325B2 (ja) | 分数分周シンセサイザおよび出力位相の同期化方法 | |
US20090161809A1 (en) | Method and Apparatus for Variable Frame Rate | |
US7561205B2 (en) | Apparatus and method for adjusting a pixel clock frequency based on a phase locked loop | |
JP3270406B2 (ja) | ポジション制御回路 | |
EP0713627B1 (en) | Synchronizing arrangement and method | |
US6686969B1 (en) | Display device | |
JP2002043939A (ja) | Pll周波数シンセサイザ回路 | |
JP2002101316A (ja) | クロック生成回路及び画像表示装置 | |
JP3415570B2 (ja) | Crtモニタ用pllシステム | |
US7801261B2 (en) | Clock recovery from data streams containing embedded reference clock values | |
US5168360A (en) | Sampling clock generating circuit for a-d conversion of a variety of video signals | |
JP2003177734A (ja) | 映像処理のためのコスト信号発生方法及び装置 | |
JP3320576B2 (ja) | 発振回路 | |
KR100677202B1 (ko) | 고화질 디지털 티브이의 적응형 클럭 발생장치 | |
JPH08125884A (ja) | Pll回路 | |
JP2009177575A (ja) | 基準クロック信号生成装置 | |
KR100317289B1 (ko) | 디지털 티브이의 동기신호 보정장치 | |
JPH10191093A (ja) | デジタル水平フライバック制御回路 | |
JPH06276089A (ja) | Pll回路 | |
JP3353372B2 (ja) | 液晶表示装置 | |
JPH08307259A (ja) | 周波数シンセサイザ | |
JP2006186502A (ja) | Pll装置及び映像同期制御装置 | |
JPH01114122A (ja) | デジタル周波数シンセサイザ |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20000822 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20011218 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313113 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080118 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090118 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100118 Year of fee payment: 8 |
|
LAPS | Cancellation because of no payment of annual fees |