TW201944385A - 顯示面板和畫素電路 - Google Patents

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Abstract

一種顯示面板，包含多個畫素電路，每個畫素電路包含第一電晶體、寫入電路、發光單元、第一電容和控制電路。第一電晶體的第一端用於接收第一驅動訊號，控制端耦接於第一節點。寫入電路耦接於第一節點和第二節點，用於將第一資料訊號傳遞至第一節點，以及將第二資料訊號傳遞至第二節點。發光單元的第一端耦接於第一電晶體的第二端，第二端用於接收一第二驅動訊號。第一電容耦接於第一節點與第一電晶體的第一端之間。控制電路用於依據發光控制訊號調整第二節點的第二節點電壓。當第二節點電壓低於預設電壓值時，控制電路輸出參考電壓至第一節點。

Description

顯示面板和畫素電路
本揭示文件有關一種顯示面板和畫素電路，尤指一種可調變發光時間之畫素電路。
目前的製程技術製作出的微發光二極體(micro light-emitting diode)，在流過不同電流時會產生色偏。因此，使用微發光二極體做為發光元件的顯示面板，大都會固定微發光二極體的導通電流，並以調變微發光二極體在每一幀畫面中的導通時間的方式，來使人眼感受到不同亮度的畫面。對於顯示裝置中用於驅動畫素電路發光的主要電源訊號而言，其經常因為需要提供大電流以點亮多個微發光二極體，使得其電壓因為負載效應而降低。若畫素電路中負責控制微發光二極體的導通時間的電路是使用前述主要電源訊號做為控制訊號，則顯示面板中不同位置的畫素電路會因為接收到的主要電源訊號的壓降程度不同，而在控制微發光二極體的導通與關斷時具有不同程度的時間誤差。此外，用於畫素電路的薄膜電晶體(thin-film transistor，簡稱TFT)經常因為製程因素而產生特性變 異，亦即顯示面板不同位置的薄膜電晶體會具有不同的特性。薄膜電晶體特性不均勻的問題亦會影響顯示面板控制微發光二極體的導通時間之準確度。因此，如何提供能準確控制微發光二極體的導通時間之顯示面板和畫素電路，實為業界有待解決的問題。
本揭示文件提供一種顯示面板。顯示面板包含多個畫素電路，其中每個畫素電路包含第一電晶體、寫入電路、發光單元、第一電容和控制電路。第一電晶體包含第一端、第二端和控制端，其中第一電晶體的第一端用於接收第一驅動訊號，第一電晶體的控制端耦接於第一節點。寫入電路耦接於第一節點和第二節點，用於將第一資料訊號傳遞至第一節點，以及將第二資料訊號傳遞至第二節點。發光單元包含第一端和第二端，其中發光單元的第一端耦接於第一電晶體的第二端，發光單元的第二端用於接收一第二驅動訊號。第一電容耦接於第一節點與第一電晶體的第一端之間。控制電路耦接於第一節點和第二節點，用於依據發光控制訊號調整第二節點的第二節點電壓，其中當第二節點電壓低於預設電壓值時，控制電路輸出參考電壓至第一節點。
本揭示文件提供一種顯示面板。顯示面板包含多個畫素電路，其中每個畫素電路包含第一電晶體、補償電路、重置電路、寫入電路、控制電路、第一電容和發光 單元。第一電晶體包含第一端、第二端和控制端，其中第一電晶體的控制端耦接於第一節點。補償電路耦接於第一電晶體的第一端、第二端，且耦接於第一節點，用於依據第一電晶體的臨界電壓以及第一資料訊號調整第一節點的第一節點電壓。重置電路用於將重置電壓傳遞至第一節點。寫入電路用於將第二資料訊號傳遞至第二節點。控制電路耦接於第一節點和第二節點，用於依據發光控制訊號調整第二節點的第二節點電壓，其中當第二節點電壓低於預設電壓值時，控制電路輸出參考電壓至第一節點。第一電容耦接於第一節點與補償電路之間。發光單元包含第一端和第二端，其中發光單元的第一端耦接於補償電路，發光單元的第二端用於接收第二驅動訊號。
本揭示文件提供一種畫素電路，畫素電路包含：第一電晶體、發光單元、第一電容、第二電晶體、第二電容、第一補償電路、寫入電路和第二補償電路。第一電晶體包含第一端、第二端和控制端，其中第一電晶體的第一端用於接收第一驅動訊號，第一電晶體的控制端耦接於第一節點。發光單元包含第一端和第二端，其中發光單元的第一端耦接於第一電晶體的第二端，發光單元的第二端用於接收第二驅動訊號。第一電容耦接於第一節點與第一電晶體的第一端之間。第二電晶體包含第一端、第二端和控制端，其中第二電晶體的第一端用於接收參考電壓，第二電晶體的控制端耦接於第二節點。第二電容包含一第一端和一第二端，第二電容的第一端用於接收發光控制訊 號，第二電容的第二端耦接於第二節點，其中發光控制訊號具有斜坡脈衝波形。第一補償電路耦接於第一節點、第二節點以及第二電晶體的第二端，用於依據第二電晶體的臨界電壓調整第二節點的第二節點電壓。寫入電路用於將第一資料訊號傳遞至第一節點，且將第二資料訊號傳遞至第二節點。第二補償電路用於將第一電晶體產生的驅動電流傳遞至比較電路，其中當比較電路接收到的驅動電流不等於預設電流值，比較電路輸出調整訊號，以將第一資料訊號的電壓準位設置為負相關於的驅動電流的大小。
上述的顯示面板和畫素電路能克服微發光二極體作為發光單元的色偏問題。
100、700、1100、1400‧‧‧顯示面板
102‧‧‧源極驅動器
104‧‧‧閘極驅動器
110、610、710、1110、1140‧‧‧畫素電路
PX‧‧‧畫素矩陣
210‧‧‧寫入電路
220‧‧‧控制電路
T1~T2‧‧‧第一電晶體~第二電晶體
C1~C2‧‧‧第一電容~第二電容
N1~N2‧‧‧第一節點~第二節點
D1~D2‧‧‧第一資料訊號~第二資料訊號
SW1~SW15‧‧‧第一開關~第十五開關
V1~V2‧‧‧第一節點電壓~第二節點電壓
VDD‧‧‧第一驅動訊號
VSS‧‧‧第二驅動訊號
Vpwm‧‧‧發光控制訊號
Vx‧‧‧參考電壓
EU‧‧‧發光單元
R1~R4‧‧‧資料線
L1~L5‧‧‧第一電壓準位~第五電壓準位
S1[1]~S1[n]、S1‧‧‧第一控制訊號
S2[1]~S2[n]、S2‧‧‧第二控制訊號
S3[1]~S3[n]、S3‧‧‧第三控制訊號
S4[1]~S4[n]、S4‧‧‧第四控制訊號
S5[1]~S5[n]、S5‧‧‧第五控制訊號
S6[1]~S6[n]、S6‧‧‧第六控制訊號
S7[1]~S7[n]、S7‧‧‧第七控制訊號
S8[1]~S8[n]、S8‧‧‧第八控制訊號
S9[1]~S9[n]、S9‧‧‧第九控制訊號
S10[1]~S10[n]、S10‧‧‧第十控制訊號
S11[1]~S11[n]、S11‧‧‧第十一控制訊號
S12[1]~S12[n]、S12‧‧‧第十二控制訊號
720、1420‧‧‧比較電路
AD‧‧‧調整訊號
1210‧‧‧補償電路
1220‧‧‧重置電路
1230‧‧‧寫入電路
1240‧‧‧控制電路
Vset‧‧‧重置電壓
1510‧‧‧第一補償電路
1520‧‧‧寫入電路
1530‧‧‧第二補償電路
為讓揭示文件之上述和其他目的、特徵、優點與實施例能更明顯易懂，所附圖式之說明如下：第1圖為依據本揭示文件一實施例的顯示面板簡化後的功能方塊圖。
第2圖為第1圖的畫素電路的功能方塊圖。
第3圖為依據本揭示文件一實施例的顯示面板的控制訊號簡化後的波形示意圖。
第4圖為第2圖的畫素電路的節點電壓波形式意圖。
第5A圖為第2圖的畫素電路於第一子時段的等效電路操作示意圖。
第5B圖為第2圖的畫素電路於第二子時段的等效電路 操作示意圖。
第6圖為依據本揭示文件一實施例的畫素電路簡化後的功能方塊圖。
第7圖為依據本揭示文件一實施例的顯示面板簡化後的功能方塊圖。
第8圖為第7圖的畫素電路的功能方塊圖。
第9圖為依據本揭示文件一實施例的顯示面板的控制訊號簡化後的波形示意圖。
第10圖為第8圖的畫素電路於補償階段的等效電路操作示意圖。
第11圖為依據本揭示文件一實施例的顯示面板簡化後的功能方塊圖。
第12圖為第11圖的畫素電路的功能方塊圖。
第13圖為依據本揭示文件一實施例的顯示面板的控制訊號簡化後的波形示意圖。
第14圖為依據本揭示文件一實施例的顯示面板簡化後的功能方塊圖。
第15圖為第14圖的畫素電路的電路方塊圖。
第16圖為依據本揭示文件一實施例的顯示面板的控制訊號簡化後的波形示意圖。
第17圖為依據本揭示文件一實施例的顯示面板顯示多幀畫面時的波形示意圖。
以下將配合相關圖式來說明本揭示文件的實施例。在圖式中，相同的標號表示相同或類似的元件或方法流程。
第1圖為依據本揭示文件一實施例的顯示面板100簡化後的功能方塊圖。顯示面板100包含源極驅動器102、閘極驅動器104以及多個畫素電路110，其中畫素電路110排列成具有多列的畫素矩陣PX。閘極驅動器104用於對應地提供多個第一控制訊號S1[1]~S1[n]以及多個第二控制訊號S2[1]~S2[n]至多列的畫素電路110，以驅動畫素矩陣PX更新顯示畫面。
例如，閘極驅動器104提供第一控制訊號S1[1]與第二控制訊號S2[1]至第一列的畫素電路110，並提供第一控制訊號S1[2]與第二控制訊號S2[2]至第二列的畫素電路110，依此類推，直到閘極驅動器104提供第一控制訊號S1[n]與第二控制訊號S2[n]至第n列的畫素電路110，其中n為正整數。為使圖面簡潔而易於說明，顯示面板100中的其他元件與連接關係並未繪示於第1圖中。
本案說明書和圖式中使用的元件編號和訊號編號中的索引[1]~[n]，只是為了方便指稱個別的元件和訊號，並非有意將前述元件和訊號的數量侷限在特定數目。在本案說明書和圖式中，若使用某一元件編號或訊號編號時沒有指明該元件編號或訊號編號的索引，則代表該元件編號或訊號編號是指稱所屬元件群組或訊號群組中不特定的任一元件或訊號。例如，訊號編號S1[1]指稱的對象是第 一控制訊號S1[1]，而訊號編號S1指稱的對象則是第一控制訊號S1[1]~S1[n]中不特定的任意第一控制訊號S1。又例如，訊號編號S2[1]指稱的對象是第二控制訊號S2[1]，而訊號編號S2指稱的對象則是第二控制訊號S2[1]~S2[n]中不特定的任意第二控制訊號S2。
第2圖為第1圖的畫素電路110的功能方塊圖。畫素電路110包含第一電晶體T1、第一電容C1、寫入電路210、控制電路220以及發光單元EU。第一電晶體T1包含第一端、第二端和控制端，其中第一電晶體T1的第一端用於接收第一驅動訊號VDD，控制端耦則接於第一節點N1。第一電容C1耦接於第一節點N1與第一電晶體T1的第一端之間。發光單元EU包含第一端和第二端，其中發光單元EU的第一端耦接於第一電晶體T1的第二端，且發光單元EU的第二端用於接收第二驅動訊號VSS。
寫入電路210耦接於第一節點N1和第二節點N2，用於將第一資料訊號D1傳遞至第一節點N1，以及將第二資料訊號D2傳遞至第二節點N2。具體而言，寫入電路210包含第一開關SW1和第二開關SW2。第一開關SW1包含第一端、第二端和控制端。第一開關SW1的第一端耦接於第一節點N1，第二端則用於接收第一資料訊號D1。第二開關SW2包含第一端、第二端和控制端。第二開關SW2的第一端耦接於第二節點N2，第二端則用於接收第二資料訊號D2。
在本實施例中，第一開關SW1的控制端用於接 收第一控制訊號S1，第二開關SW2的控制端用於接收第二控制訊號S2。第一開關SW1的第二端以及第二開關SW2的第二端都耦接於同一條資料線R1，以透過資料線R1自源極驅動器102分別接收第一資料訊號D1與第二資料訊號D2。
在某些實施例中，畫素電路110的第一開關SW1的第二端以及第二開關SW2的第二端亦可以分別耦接於不同的資料線，並分別透過不同的資料線自源極驅動器102接收第一資料訊號D1與第二資料訊號D2。
控制電路220耦接於第一節點N1和第二節點N2，用於依據發光控制訊號Vpwm調整第二節點N2的第二節點電壓V2。具體而言，控制電路220包含第二電晶體T2和第二電容C2。第二電晶體T2包含第一端、第二端和控制端。第二電晶體T2的第一端用於接收參考電壓Vx，第二端耦接於第一節點N1，控制端耦則接於第二節點N2。第二電容C2包含第一端和第二端。第二電容C2的第一端用於接收發光控制訊號Vpwm，第二端則耦接於第二節點N2。
當第二節點電壓V2低於預設電壓值時，控制電路220會將參考電壓Vx輸出至第一節點N1，以將第一節點N1的第一節點電壓V1設置為等於參考電壓Vx，其中參考電壓Vx高於或等於第一驅動訊號VDD的電壓準位。如此一來，便可以決定第一電晶體T1的導通時間，控制電路220的詳細運作將於後續段落中進一步說明。
實作上，第一開關SW1、第二開關SW2、第一電晶體T1與第二電晶體T2可以用P型薄膜電晶體來實現， 或是用其他合適種類的P型電晶體來實現。發光單元EU可以用有機發光二極體(organic light-emitting diode)或是微發光二極體來實現。
第3圖為依據本揭示文件一實施例的顯示面板100的控制訊號簡化後的波形示意圖。以下將以第2圖搭配第3圖來進一步說明畫素電路110的運作。在本實施例中，參考電壓Vx具有固定電壓準位。於寫入階段，第一驅動訊號VDD維持於第一電壓準位L1，第二驅動訊號VSS自第二電壓準位L2切換至第一電壓準位L1，其中第一電壓準位L1高於第二電壓準位L2。如此一來，可以確保發光單元EU維持於關斷狀態。
另外，發光控制訊號Vpwm維持於第三電壓準位L3。第一控制訊號S1[1]~S1[n]會依序由禁能準位(例如，高電壓準位)切換至致能準位(例如，低電壓準位)，第二控制訊號S2[1]~S2[n]也會依序由禁能準位切換至致能準位。在相鄰的兩個第一控制訊號S1依序切換至致能準位的期間，會有一個第二控制訊號S2切換至致能準位。相似地，在相鄰的兩個第二控制訊號S2依序切換至致能準位的期間，會有一個第一控制訊號S1切換至致能準位。
例如，如第3圖所示，第一控制訊號S1[1]和第一控制訊號S1[2]切換至致能準位的期間，第二控制訊號S2[1]會切換至致能準位。第二控制訊號S2[1]和第二控制訊號S2[2]切換至致能準位的期間，第一控制訊號S1[2]會切換至致能準位。
換言之，於寫入階段，畫素電路110的第一開關SW1和第二開關SW2會依序導通。因此，第一資料訊號D1會先被傳遞至第一節點N1，接著第二資料訊號D2會被傳遞至第二節點N2。值得一提的是，第二資料訊號D2會將第二節點電壓V2設置為高於參考電壓Vx以關斷第二電晶體T2。
於發光階段，第一驅動訊號VDD維持於第一電壓準位L1，第二驅動訊號VSS則會自第一電壓準位L1切換至第二電壓準位L2以導通發光單元EU。發光控制訊號Vpwm自第三電壓準位L3逐漸下降，因而具有斜坡脈衝波型。第一控制訊號S1[1]~S1[n]與第二控制訊號S2[1]~S2[n]都維持於禁能準位。因此，畫素電路110的第一開關SW1與第二開關SW2都維持於關斷狀態。
以下將以第4圖來進一步說明畫素電路110於發光階段中的運作。如第4圖所示，發光階段包含第一子時段與第二子時段。
於第一子時段中，畫素電路110的等效電路如第5A圖所示。第一電晶體T1會依據第一節點電壓V1產生如以下《公式1》所示的驅動電流Idr，以點亮發光單元EU：
Figure TW201944385A_D0001
 其中，Vth1表示第一電晶體T1的臨界電壓。k代表第一電晶體T1的載子遷移率(carrier mobility)、閘極氧化層的單位電容大小以及閘極寬長比三者的乘積。
隨著發光控制訊號Vpwm的電壓準位逐漸下降，第二節點電壓V2亦會因為第二電容C2的電容耦合效應而逐漸下降。由於此時的第二節點電壓V2仍高於以下《公式2》所示的預設電壓值，所以第二電晶體T2會維持於關斷狀態：Vp=Vx-|Vth2| 《公式2》其中，Vth2表示第二電晶體T2的臨界電壓。Vp代表前述的預設電壓值。
接著，於第二子時段，畫素電路110的等效電路如第5B圖所示。隨著發光控制訊號Vpwm的電壓準位繼續下降，第二節點電壓V2會下降至小於《公式2》所示的預設電壓值。因此，第二電晶體T2會被導通且參考電壓Vx會傳遞至第一節點N1，使得第一節點電壓V1等於參考電壓Vx。在本實施例中，參考電壓Vx會高於或等於第一驅動訊號VDD的第一電壓準位L1。因此，於第二子時段，第一電晶體T1會自導通狀態被切換至關斷狀態。
由上述可知，驅動電流Idri會負相關於第一節點電壓V1被第一資料訊號D1所設置的大小。第一子時段的長度會正相關於第二節點電壓V2被第二資料訊號D2所設置的大小。因此，藉由固定第一資料訊號D1的電壓準位，且調變第二資料訊號D2的電壓準位，便可控制畫素電路110的發光時間，並使其產生固定大小的驅動電流Idr。
換言之，畫素電路110可以避免發光單元EU因為流過不同大小的電流而產生色偏的問題。畫素電路110還 可以透過不同的發光時間，於多幀畫面中以近似積分的方式使人眼感受到不同亮度的顯示畫面。
在上述的實施例中，第一驅動訊號VDD是直流訊號，而第二驅動訊號VSS是交流訊號，以於寫入階段關斷發光單元EU，並於發光階段導通發光單元EU。然而，本發明並不以上述實施例為限，第一驅動訊號VDD與第二驅動訊號VSS的電壓準位可依據實際需求設置
例如，在某些實施例中，第一驅動訊號VDD會於寫入階段自第一電壓準位L1切換至第二電壓準位L2，並於發光階段由第二電壓準位L2切換至第一電壓準位L1，而第二驅動訊號VSS則會維持於第二電壓準位L2。
第6圖為依據本揭示文件一實施例的畫素電路610簡化後的功能方塊圖。畫素電路610相似於畫素電路110，且顯示面板100的畫素電路110可置換為畫素電路610。
畫素電路610與畫素電路110的差異在於，畫素電路610的第一開關SW1與第二開關SW2的控制端共同用於接收第一控制訊號S1。另外，畫素電路610的第一開關SW1的第二端耦接於資料線R1，以自資料線R1接收第一資料訊號，第二開關SW2的第二端則耦接於另一條資料線R2，以自資料線R2接收第二資料訊號。
換言之，於寫入階段中，當第一資料訊號D1傳遞至第一節點N1時，第二資料訊號D2也會一併傳遞至第二節點N2。如此一來，可以縮短寫入階段的時間長度。前 述畫素電路110的其餘連接方式、元件、實施方式以及優點，皆適用於畫素電路610，為簡潔起見，在此不重複贅述。
第7圖為依據本揭示文件一實施例的顯示面板700簡化後的功能方塊圖。顯示面板700相似於顯示面板100，差異在於顯示面板700包含多個畫素電路710與比較電路720，且顯示面板700對應地提供多個第一控制訊號S1[1]~S1[n]、多個第二控制訊號S2[1]~S2[n]以及多個第三控制訊號S3[1]~S3[n]至多列的畫素電路710。
比較電路720耦接於多個畫素電路710，且用於調整第一資料訊號D1的電壓準位，以補償顯示面板700不同位置之畫素電路710的特性變異。實作上，比較電路720可以整合於源極驅動器102之中，亦可以用不同於源極驅動器102之電路來實現。比較電路720的詳細運作將於後續段落中進一步說明。
第8圖為第7圖的畫素電路710的功能方塊圖。畫素電路710相似於前述的畫素電路110，差異在於，畫素電路710還包含第三開關SW3。第三開關SW3包含第一端、第二端和控制端。第三開關SW3的第一端耦接於比較電路720，第二端耦接於第一電晶體T1的第二端，控制端則用於接收第三控制訊號S3。
第9圖為依據本揭示文件一實施例的顯示面板700的控制訊號簡化後的波形示意圖。以下將以第8圖搭配第9圖進一步說明畫素電路710的運作。
於重置階段，第一驅動訊號VDD維持於第一電 壓準位L1，且第二驅動訊號VSS自第二電壓準位L2切換至第一電壓準位L1，其中第一電壓準位L1高於第二電壓準位L2。發光控制訊號Vpwm維持於第三電壓準位L3，參考電壓Vx維持於第四電壓準位L4。第一控制訊號S1[1]~S1[n]會切換至致能準位。接著，在第一控制訊號S1[1]~S1[n]切換至禁能準位之後，第二控制訊號S2[1]~S2[n]才切換至致能準位。第三控制訊號S3則維持於禁能準位，以關斷第三開關SW3。
因此，第一開關SW1會先被導通，使得第一資料訊號D1傳遞至第一節點N1，以設置第一節點電壓V1。接著，在第一開關SW1關斷之後，第二開關SW2才被導通，使得第二資料訊號D2傳遞至第二節點N2，以設置第二節點電壓V2。值得注意的是，第一節點電壓V1會低於第一驅動訊號VDD的第一電壓準位L1，以使第一電晶體T1導通。第二節點電壓V2會高於參考電壓Vx的第四電壓準位L4，以使第二電晶體T2關斷。
於補償階段，第一驅動訊號VDD和第二驅動訊號VSS維持於第一電壓準位L1。發光控制訊號Vpwm維持於第三電壓準位L3，且參考電壓Vx維持於第四電壓準位L4。第一控制訊號S1和第二控制訊號S2切換至禁能準位，以關斷第一開關SW1和第二開關SW2。第三控制訊號S3切換至致能準位，以導通第三開關SW3。
因此，畫素電路710會形成如第10圖所示的等效電路。此時，第一電晶體T1會依據第一節點電壓V1產生 驅動電流Idr。驅動電流Idr會經由第三開關SW3流至比較電路720，且比較電路720會將驅動電流Idr和事先儲存的預設電流值進行比較。
由前述《公式1》可知，驅動電流Idr的大小會負相關於第一節點電壓V1，並負相關於第一電晶體T1的臨界電壓。因此，當比較電路720發現驅動電流Idr不等於預設電流值時，比較電路720會判斷第一電晶體T1的臨界電壓發生變異。此時，比較電路720會輸出調整訊號AD至源極驅動器102，以將第一資料訊號D1的電壓準位設置為正相關於驅動電流Idr的大小，以補償第一電晶體T1的臨界電壓變異。
在接下來的寫入階段與發光階段中，第三控制訊號S3會維持於禁能準位，以使第三電晶體T3維持於關斷狀態。前述畫素電路110於寫入階段與發光階段的其餘運作方式以及優點，皆適用於畫素電路710，為簡潔起見，在此不重複贅述。
在某些畫素電路710的第一開關SW1和第二開關SW2分別耦接於不同資料線的實施例中，第一開關SW1和第二開關SW2於重置階段及/或寫入階段可以同時導通，以縮短重置階段及/或寫入階段的時間長度。
由上述可知，第一電壓訊號D1的電壓準位會依據第一電晶體T1的臨界電壓變異而被適應性地調整。因此，即使顯示面板700中不同區域的多個第一電晶體T1具有不同的特性，這些第一電晶體T1仍能於發光階段產生相 同大小的驅動電流Idr。換言之，顯示面板700可以克服製程中的不穩定因素而提供高品質的顯示畫面。
第11圖為依據本揭示文件一實施例的顯示面板1100簡化後的功能方塊圖。顯示面板1100包含源極驅動器102、閘極驅動器104以及多個畫素電路1110，其中畫素電路1110排列成具有多列的畫素矩陣PX。閘極驅動器104用於對應地提供多個第四控制訊號S4[1]~S4[n]、多個第五控制訊號S5[1]~S5[n]以及多個第六控制訊號S6[1]~S6[n]至多列的畫素電路1110。
第12圖為第11圖的畫素電路1110的功能方塊圖。畫素電路1110包含第一電晶體T1、發光單元EU、補償電路1210、重置電路1220、寫入電路1230以及控制電路1240。第一電晶體T1包含第一端、第二端和控制端，其中第一電晶體T1的控制端耦接於第一節點N1。
補償電路1210耦接於第一電晶體T1的第一端和第二端，且耦接於第一節點N1。補償電路1210用於依據第一電晶體T1的臨界電壓以及第一資料訊號D1調整第一節點N1的第一節點電壓V1，以補償第一電晶體T1的臨界電壓變異。重置電路1220用於將重置電壓Vset傳遞至第一節點N1。寫入電路1230用於將第二資料訊號D2傳遞至第二節點N2。
控制電路1240耦接於第一節點N1和第二節點N2，用於依據發光控制訊號Vpwm調整第二節點N2的第二節點電壓V2。當第二節點電壓V2低於如前述《公式2》所 示的預設電壓值時，控制電路1240會輸出參考電壓Vx至第一節點V1，以決定第一電晶體T1的導通時間。第一電容C1耦接於第一節點N1與補償電路1210之間。發光單元EU包含第一端和第二端。發光單元EU的第一端耦接於補償電路1210，第二端則用於接收第二驅動訊號VSS。
具體而言，補償電路1210包含第四開關SW4、第五開關SW5、第六開關SW6以及第七開關SW7。第四開關SW4包含第一端、第二端和控制端。第四開關SW4的第一端用於接收第一資料訊號D1，第二端耦接於第一電晶體T1的第一端，控制端則用於接收第四控制訊號S4。第五開關SW5包含第一端、第二端和控制端。第五開關SW5的第一端耦接於第一節點N1，第二端耦接於第一電晶體T1的第二端，控制端用於接收第四控制訊號S4。
第六開關SW6包含第一端、第二端和控制端。第六開關SW6的第一端用於接收第一驅動訊號VDD，第二端耦接於第一電晶體T1的第一端，控制端則用於接收第五控制訊號S5。第七開關SW7包含第一端、第二端和控制端。第七開關SW7的第一端耦接於第一電晶體T1的第二端，第二端耦接於發光單元EU的第一端，控制端則用於接收第五控制訊號S5。
重置電路1220包含第八開關SW8，其中第八開關SW8包含第一端、第二端和控制端。第八開關SW8的第一端耦接於第一節點N1，第二端用於接收重置電壓Vset，控制端則用於接收畫素矩陣PX中前一列之第四控制訊號 S4。
例如，於畫素矩陣PX具有n列的情況下，以第12圖的畫素電路1110位於第n列為例。第四開關SW4和第五開關SW5的控制端會接收到第四控制訊號S4[n]，而第八開關SW8的控制端則會接收第n-1列的第四控制訊號S4[n-1]，其中n為正整數。
寫入電路1230包含第九開關SW9，其中第九開關SW9包含第一端、第二端和控制端。第九開關SW9的第一端耦接於第二節點N2，第二端用於接收第二資料訊號D2，控制端則用於接收第六控制訊號S6。在本實施例中，第四開關SW4的第一端耦接於資料線R3，以自資料線R3接收第一資料訊號D1，第九開關SW9的第二端耦接於資料線R4，以自資料線R4接收第二資料訊號D2，但本發明並不以此實施例為限。在某些實施例中，第四開關SW4的第一端與第九開關SW9的第二端是耦接於同一條資料線，且第四開關SW4和第九開關SW9可以先後自該條資料線接收第一資料訊號D1和第二資料訊號D2。
實作上，第四開關SW4、第五開關SW5、第六開關SW6、第七開關SW7、第八開關SW8以及第九開關SW9可以用P型薄膜電晶體來實現，或是用其他合適種類的P型電晶體來實現。
第13圖為依據本揭示文件一實施例的顯示面板1100的控制訊號簡化後的波形示意圖。在本實施例中，參考電壓Vx具有固定電壓準位。於補償階段，第一驅動訊 號VDD維持於第一電壓準位L1，第二驅動訊號VSS自第二電壓準位L2切換至第一電壓準位L1，且第一電壓準位L1高於第二電壓準位L2。發光控制訊號Vpwm維持於第三電壓準位L3。另外，第四控制訊號S4[1]~S4[n]會依序切換至致能準位。第五控制訊號S5[1]~S5[n]與第六控制訊號S6[1]~S6[n]都維持於禁能準位。
因此，於補償階段，第九開關SW9維持於關斷狀態。重置電壓Vset會先經由第八開關SW8傳遞至第一節點N1，以將第一節點電壓V1重置為重置電壓Vset。接著，在第八開關SW8由導通狀態切換至關斷狀態後，第一資料訊號D1會經由第四開關SW4和第五開關SW5對第一節點N1進行充電，直到第一節點電壓V1等於以下《公式3》所示的電壓值：V1=D1-|Vth1| 《公式3》
接著，於寫入階段，第一驅動訊號VDD與第二驅動訊號VSS維持於第一電壓準位L1。發光控制訊號Vpwm維持於第三電壓準位L3。另外，第六控制訊號S6[1]~S6[n]會依序切換至致能準位。第四控制訊號S4[1]~S4[n]與第五控制訊號S5[1]~S5[n]都維持於禁能準位。
因此，於寫入階段，第四開關SW4、第五開關SW5、第六開關SW6、第七開關SW7以及第八開關SW8維持於關斷狀態。第二資料訊號D2會經由第九開關SW9傳遞至第二節點N2，以設置第二節點電壓V2。
接著，於發光階段，第一驅動訊號VDD維持於第一電壓準位L1，第二驅動訊號VSS自第一電壓準位L1切換至第二電壓準位L2。發光控制訊號Vpwm自第三電壓準位L3逐漸下降，因而具有斜坡脈衝波形。另外，第四控制訊號S4[1]~S4[n]與第六控制訊號S6[1]~S6[n]都維持於禁能準位。第五控制訊號S5[1]~S5[n]則切換至致能準位。
因此，第四開關SW4、第五開關SW5、第八開關SW8和第九開關SW9會處於關斷狀態。第六開關SW6和第七開關SW7會處於導通狀態。第二節點電壓V2會因為第二電容C2的電容耦合效應，而隨著發光控制訊號Vpwm逐漸下降。第一電晶體T1會產生如以下《公式4》所示的驅動電流Idr：
Figure TW201944385A_D0002
在本實施例中，參考電壓Vx會高於或等於第一驅動訊號VDD的第一電壓準位L1。因此，第一電晶體T1會持續產生驅動電流Idr，直到第二節點電壓V2下降至小於前述《公式2》所示的預設電壓值。當第二節點電壓V2小於前述《公式2》所示的預設電壓值，第二電晶體會T2導通，使得第一節點電壓V1被設置為參考電壓Vx，進而使得第一電晶體T1切換至關斷狀態。
由《公式4》可知，本實施例中的驅動電流Idr的大小不會受到第一電晶體T1的臨界電壓變異影響。因 此，顯示面板1100可以克服製程中的不穩定因素而提供高品質的顯示畫面。另外，在某些實施例中，第13圖的補償階段以及寫入階段的順序可互相調換。
第14圖為依據本揭示文件一實施例的顯示面板1400簡化後的功能方塊圖。顯示面板1400包含源極驅動器102、閘極驅動器104、多個畫素電路1410以及比較電路1420，其中畫素電路1410排列成具有多列的畫素矩陣PX。閘極驅動器104用於對應地提供多個第七控制訊號S7[1]~S7[n]、多個第八控制訊號S8[1]~S8[n]、多個第九控制訊號S9[1]~S9[n]、多個第十控制訊號S10[1]~S10[n]、多個第十一控制訊號S11[1]~S11[n]以及多個第十二控制訊號S12[1]~S12[n]至多列的畫素電路1410。
第15圖為第14圖的畫素電路1410的電路方塊圖。畫素電路1410包含第一電晶體T1、發光單元EU、第一電容C1、第二電晶體T2、第二電容C2、第一補償電路1510、寫入電路1520、第二補償電路1530。
比較電路1420耦接於多個畫素電路1410，且用於調整第一資料訊號D1的電壓準位，以補償畫素電路1410中電晶體的臨界電壓變異。實作上，比較電路1420可以整合於源極驅動器102之中，亦可以用不同於源極驅動器102之電路來實現。比較電路1420的詳細運作將於後續段落中進一步說明。
第一電晶體T1包含第一端、第二端和控制端。 第一電晶體T1的第一端用於接收第一驅動訊號VDD，控制端耦接於第一節點N1。發光單元EU包含第一端和第二端。發光單元EU的第一端耦接於第一電晶體T1的第二端，發光單元EU的第二端用於接收第二驅動訊號VSS。
第一電容C1耦接於第一節點N1與第一電晶體T1的第一端之間。第二電晶體T2包含第一端、第二端和控制端。第二電晶體T2的第一端用於接收參考電壓Vx，控制端則耦接於第二節點N2。第二電容C2包含第一端和第二端。第二電容C2的第一端用於接收發光控制訊號Vpwm，第二端則耦接於第二節點N2。
第一補償電路1510耦接於第一節點N1、第二節點N2以及第二電晶體T2的第二端。第一補償電路1510用於依據第二電晶體T2的臨界電壓調整第二節點N2的第二節點電壓V2，以補償第二電晶體T2的臨界電壓變異。
具體而言，第一補償電路1510包含第十開關SW10、第十一開關SW11與第十二開關SW12。第十開關SW10包含第一端、第二端和控制端。第十開關SW10的第一端用於接收重置電壓Vset，第二端耦接於第二節點N2，控制端則用於接收第七控制訊號S7。第十一開關SW11包含第一端、第二端和控制端。第十一開關SW11的第一端耦接於第二節點N2，第二端耦接於第二電晶體T2的第二端，控制端則用於接收第八控制訊號S8。第十二開關SW12包含第一端、第二端和控制端。第十二開關SW12的第一端耦接於第二電晶體T2的第二端，第二端耦接於第一節點N1，控制 端則用於接收第九控制訊號S9。
寫入電路1520用於將第一資料訊號D1傳遞至第一節點N1，且將第二資料訊號D2傳遞至第二節點N2。具體而言，寫入電路1520包含第三電容C3、第十三開關SW13與第十四開關SW14。第三電容C3包含第一端和第二端，其中第三電容C3的第一端耦接於第二節點N2。第十三開關SW13包含第一端、第二端和控制端。第十三開關SW13的第一端耦接於第一節點N1，第二端用於接收第一資料訊號D1，控制端用於接收第十控制訊號S10。第十四開關SW14包含第一端、第二端和控制端。第十四開關SW14的第一端耦接於第三電容C3的第二端，第二端用於接收第二資料訊號D2，控制端用於接收第十一控制訊號S11。
第二補償電路1530用於將第一電晶體T1產生的驅動電流Idr傳遞至比較電路1420，且包含第十五開關SW15，其中第十五開關SW15包含第一端、第二端和控制端。第十五開關SW15的第一端耦接於比較電路1420，第二端耦接於第一電晶體T1的第二端，控制端則用於接收第十二控制訊號S12。
比較電路1420用於將接收到的驅動電流Idr和預設電流值進行比較，以調整第一資料訊號D1的電壓準位。第二補償電路1530和比較電路1420的運作將於後續的段落中進一步說明。實作上，第十開關SW10、第十一開關SW11、第十二開關SW12、第十三開關SW13、第十四開關SW14以及第十五開關SW15可以用P型薄膜電晶體來實 現，或是用其他合適種類的P型電晶體來實現。
第16圖為依據本揭示文件一實施例的顯示面板1400的控制訊號簡化後的波形示意圖。於重置階段，第一驅動訊號VDD維持於第一電壓準位L1，第二驅動訊號VSS由第二電壓準位L2切換至第一電壓準位L1，以關斷發光單元EU，其中第一電壓準位L1高於第二電壓準位L2。發光控制訊號Vpwm維持於第三電壓準位L3，且參考電壓Vx維持於第四電壓準位L4。第七控制訊號S7、第十控制訊號S10以及第十一控制訊號S11具有致能準位(例如，低電壓準位)，且第八控制訊號S8、第九控制訊號S9和第十二控制訊號S12具有禁能準位(例如，高電壓準位)。
因此，於重置階段，第十開關SW10、第十三開關SW13以及第十四開關SW14處於導通狀態，且第十一開關SW11、第十二開關SW12與第十五開關SW15處於關斷狀態。第一電壓訊號D1會經由第十三開關SW13傳遞至第一節點N1，以重置第一節點電壓V1。第二電壓訊號D2會經由第十四開關SW14傳遞至第三電容C3的第二端。重置電壓Vset會經由第十開關SW10傳遞至第二節點N2，以重置第二節點電壓V2。
接著，於補償階段，第一驅動訊號VDD和第二驅動訊號VSS維持於第一電壓準位L1。發光控制訊號Vpwm維持於第三電壓準位L3，參考電壓Vx則切換至第五電壓準位L5，其中第五電壓準位L5高於第四電壓準位L4。第八控制訊號S8、以及第十一控制訊號S11具有致能準位， 且第七控制訊號S7、第九控制訊號S9、第十控制訊號S10、以及第十二控制訊號S12具有禁能準位。
因此，於補償階段，第十一開關SW11、以及第十四開關SW14會被導通，且第十開關SW10、第十二開關SW12、第十三開關SW13、以及第十五開關SW15會被關斷。參考電壓Vx會透過第十一開關SW11對第二節點N2充電，直到第二節點電壓V2等於以下《公式5》所示的電壓值：V2=L5-|Vth2| 《公式5》
接著，於第一寫入階段，第一驅動訊號VDD和第二驅動訊號VSS維持於第一電壓準位L1。發光控制訊號Vpwm維持於第三電壓準位L3，參考電壓Vx維持於第五電壓準位L5。第十控制訊號S10[1]~S10[n]會依序切換至致能準位。第七控制訊號S7、第八控制訊號S8、第九控制訊號S9、第十一控制訊號S11以及第十二控制訊號S12則具有禁能準位。
因此，第十三開關SW13會導通，而第十開關SW10、第十一開關SW11、第十二開關SW12、第十四開關SW14以及第十五開關SW15會關斷。第一電壓訊號D1會經由第十三開關SW13傳遞至第一節點N1，以設置第一節點電壓V1。
接著，於第二寫入階段，第一驅動訊號VDD和第二驅動訊號VSS維持於第一電壓準位L1。發光控制訊號Vpwm維持於第三電壓準位L3，參考電壓Vx維持於第五電 壓準位L5。第十一控制訊號S11[1]~S11[n]會依序切換至致能準位。第七控制訊號S7、第八控制訊號S8、第九控制訊號S9、第十控制訊號S10以及第十二控制訊號S12則具有禁能準位。
因此，第十四開關SW14會導通，而第十開關SW10、第十一開關SW11、第十二開關SW12、第十三開關SW13以及第十五開關SW15會關斷。第二電壓訊號D2會經由第十三開關SW13傳遞至第三電容C3的第二端，而第三電容C3的第二端的電壓變化量則會因為第三電容C3的電容耦合效應傳遞至第二節點N2，進而使第二節點電壓V2具有如以下《公式6》所示的電壓值：V2=L5-|Vth2|+△V 《公式6》其中，△V代表第三電容C3的第二端於第二寫入階段中的電壓變化量。
於發光階段，第二寫入階段，第一驅動訊號VDD維持於第一電壓準位L1，第二驅動訊號VSS切換至第二電壓準位L2，以導通發光單元EU。發光控制訊號Vpwm自第三電壓準位L3逐漸下降，參考電壓Vx則維持於第五電壓準位L5。第九控制訊號S9具有致能準位。第七控制訊號S7、第八控制訊號S8、第十控制訊號S10、第十一控制訊號S11以及第十二控制訊號S12則具有禁能準位。
因此，第十開關SW10、第十一開關SW11、第十二開關SW12、第十三開關SW13、第十四開關SW14以及第十五開關SW15會關斷。第二節點電壓V2會因為第二 電容C2的電容耦合效應，而隨著發光控制訊號Vpwm逐漸下降。第一電晶體T1會依據第一節點電壓V1產生驅動電流Idr，以點亮發光單元EU。
在本實施例中，參考電壓Vx的第五電壓準位L5會高於或等於第一驅動訊號VDD的第一電壓準位L1。因此，第一電晶體T1會持續產生驅動電流Idr，直到第二節點電壓V2下降至小於前述《公式2》所示的預設電壓值。在此情況下，第二電晶體會T2導通，使得第一節點電壓V1被設置為第五電壓準位L5，進而使得第一電晶體T1切換至關斷狀態。
第17圖為顯示面板1400顯示多幀畫面時的波形示意圖。於第1幀畫面至第n幀畫面每一者之期間，顯示面板1400會執行第16圖的重置階段、補償階段、第一寫入階段、第二寫入階段、以及發光階段。第1幀畫面至第n幀畫面的每一者開始之前，多個第十控制訊號S10[1]~S10[n]會具有致能準位，以將所有畫素電路1410的第一節點電壓V1設置為一預設電壓準位。
接著，第十二控制訊號S12[1]~S12[n]的其中一者會切換至致能準位，以導通對應一列畫素電路1410的第十五開關SW15。第一電晶體T1產生的驅動電流Idr會經由第十五開關SW15流至比較電路1420，且比較電路1420會將驅動電流Idr和事先儲存的預設電流值進行比較。由前述《公式1》可知，驅動電流Idr的大小會負相關於第一節點電壓V1，並負相關於第一電晶體T1的臨界電壓。因此， 當比較電路1420發現驅動電流Idr不等於預設電流值時，比較電路1420會判斷第一電晶體T1的臨界電壓發生變異。此時，比較電路1420會輸出調整訊號AD至源極驅動器102，以於第一寫入階段中將第一資料訊號D1的電壓準位設置為正相關於驅動電流Idr的大小。如此一來，便可以補償第一電晶體T1的臨界電壓變異。
由上述可知，顯示面板1400的第一電壓訊號D1的電壓準位，會依據第一電晶體T1的臨界電壓變異而被適應性地調整。因此，即使顯示面板1400中不同區域的第一電晶體T1具有不同的特性，這些第一電晶體T1仍能產生相同大小的驅動電流Idr。
另外，畫素電路1410的第二節點電壓V2會依據第二電晶體T2的臨界電壓而被適應性地設置。因此，因此，即使顯示面板1400中不同區域的第二電晶體T2具有不同的特性，第二電晶體T2仍能於發光階段中的預期時間點被準時導通。換言之，顯示面板1400可以克服製程中的不穩定因素而提供高品質的顯示畫面。
綜上所述，顯示面板100、700、1100和1400沒有使用第一驅動訊號VDD來控制第二電晶體T2之開關運作。因此，即使第一驅動訊號VDD因為需要提供大電流給多個發光單元EU而產生壓降，每個第二電晶體T2仍能於發光階段中準時開啟。如此一來，顯示面板100、700、1100和1400便可提供高品質的顯示畫面。
上述多個實施例的畫素電路的開關，亦可以用 各種合適種類的N型電晶體來實現。在此情況下，各個開關對應的控制訊號的致能準位為高電壓準位，而禁能準位則為低電壓準位。
在說明書及申請專利範圍中使用了某些詞彙來指稱特定的元件。然而，所屬技術領域中具有通常知識者應可理解，同樣的元件可能會用不同的名詞來稱呼。說明書及申請專利範圍並不以名稱的差異做為區分元件的方式，而是以元件在功能上的差異來做為區分的基準。在說明書及申請專利範圍所提及的「包含」為開放式的用語，故應解釋成「包含但不限定於」。另外，「耦接」在此包含任何直接及間接的連接手段。因此，若文中描述第一元件耦接於第二元件，則代表第一元件可通過電性連接或無線傳輸、光學傳輸等信號連接方式而直接地連接於第二元件，或者通過其他元件或連接手段間接地電性或信號連接至該第二元件。
在此所使用的「及/或」的描述方式，包含所列舉的其中之一或多個項目的任意組合。另外，除非說明書中特別指明，否則任何單數格的用語都同時包含複數格的涵義。
以上僅為本揭示文件的較佳實施例，凡依本揭示文件請求項所做的均等變化與修飾，皆應屬本揭示文件的涵蓋範圍。

Claims (17)

  1. 一種顯示面板，包含多個畫素電路，其中每個畫素電路包含：一第一電晶體，包含一第一端、一第二端和一控制端，其中該第一電晶體的該第一端用於接收一第一驅動訊號，該第一電晶體的該控制端耦接於一第一節點；一寫入電路，耦接於該第一節點和一第二節點，用於將一第一資料訊號傳遞至該第一節點，以及將一第二資料訊號傳遞至該第二節點；一發光單元，包含一第一端和一第二端，其中該發光單元的該第一端耦接於該第一電晶體的該第二端，該發光單元的該第二端用於接收一第二驅動訊號；一第一電容，耦接於該第一節點與該第一電晶體的該第一端之間；以及一控制電路，耦接於該第一節點和該第二節點，用於依據一發光控制訊號調整該第二節點的一第二節點電壓，其中當該第二節點電壓低於一預設電壓值時，該控制電路輸出一參考電壓至該第一節點。
  2. 如請求項1的顯示面板，其中該發光控制訊號具有斜坡脈衝波形。
  3. 如請求項1的顯示面板，其中該控制電路包含：一第二電晶體，包含一第一端、一第二端和一控制 端，其中該第二電晶體的該第一端用於接收該參考電壓，該第二電晶體的該第二端耦接於該第一節點，該第二電晶體的該控制端耦接於該第二節點；以及一第二電容，包含一第一端和一第二端，該第二電容的該第一端用於接收該發光控制訊號，該第二電容的該第二端耦接於該第二節點。
  4. 如請求項1的顯示面板，該顯示面板包含一第一資料線和一第二資料線，其中該寫入電路包含：一第一開關，包含一第一端、一第二端和一控制端，其中該第一開關的該第一端耦接於該第一節點，該第一開關的該第二端用於自該第一資料線接收該第一資料訊號；以及一第二開關，包含一第一端、一第二端和一控制端，其中該第二開關的該第一端耦接於該第二節點，該第二開關的該第二端用於自該第二資料線接收該第二資料訊號；其中該第一開關的該控制端用於接收一第一控制訊號，該第二開關的該控制端用於接收一第二控制訊號，以使該第一開關和該第二開關依序導通。
  5. 如請求項1的顯示面板，該顯示面板包含一第一資料線，其中該寫入電路包含：一第一開關，包含一第一端、一第二端和一控制端，其中該第一開關的該第一端耦接於該第一節點，該第一開關的該第二端用於自該第一資料線接收該第一資料訊 號；以及一第二開關，包含一第一端、一第二端和一控制端，其中該第二開關的該第一端耦接於該第二節點，該第二開關的該第二端用於自該第一資料線接收該第二資料訊號；其中該第一開關的該控制端以及該第二開關的該控制端用於接收一第一控制訊號。
  6. 如請求項1至5任一項的顯示面板，其中於一寫入階段，該第一驅動訊號與該第二驅動訊號維持於一第一電壓準位，於一發光階段，該第一驅動訊號維持於該第一電壓準位，該第二驅動訊號切換至一第二電壓準位，並且該第一電壓準位高於該第二電壓準位，或者於該寫入階段，該第一驅動訊號與該第二驅動訊號維持於該第二電壓準位，於該發光階段，該第一驅動訊號切換至該第一電壓準位，該第二驅動訊號維持於該第二電壓準位，並且該第一電壓準位高於該第二電壓準位，其中，該發光控制訊號於該寫入階段具有固定電壓，且於該發光階段具有斜坡脈衝波形。
  7. 如請求項1至5任一項的顯示面板，其中該顯示面板另包含一比較電路，該畫素電路另包含：一第三開關，包含一第一端、一第二端和一控制端，該第三開關的該第二端耦接於該第一電晶體的該第二端，該第三開關的該控制端用於接收一第三控制訊號；其中該比較電路耦接於該第三開關的該第一端，用於 透過該第三開關接收該第一電晶體產生的一驅動電流，當該比較電路接收到的該驅動電流不等於一預設電流值，該比較電路輸出一調整訊號，以將該第一資料訊號的電壓準位設置為負相關於的該驅動電流的大小。
  8. 一種顯示面板，包含多個畫素電路，其中每個畫素電路包含：一第一電晶體，包含一第一端、一第二端和一控制端，其中該第一電晶體的該控制端耦接於一第一節點；一補償電路，耦接於該第一電晶體的該第一端、該第二端，且耦接於該第一節點，用於依據該第一電晶體的臨界電壓以及一第一資料訊號調整該第一節點的一第一節點電壓；一重置電路，用於將一重置電壓傳遞至該第一節點；一寫入電路，用於將一第二資料訊號傳遞至一第二節點；一控制電路，耦接於該第一節點和該第二節點，用於依據一發光控制訊號調整該第二節點的一第二節點電壓，其中當該第二節點電壓低於一預設電壓值時，該控制電路輸出一參考電壓至該第一節點；一第一電容，耦接於該第一節點與該補償電路之間；以及一發光單元，包含一第一端和一第二端，其中該發光單元的該第一端耦接於補償電路，該發光單元的該第二端用於接收一第二驅動訊號。
  9. 如請求項8的顯示面板，其中該發光控制訊號具有斜坡脈衝波形。
  10. 如請求項8的顯示面板，其中該控制電路包含：一第二電晶體，包含一第一端、一第二端和一控制端，其中該第二電晶體的該第一端用於接收該參考電壓，該第二電晶體的該第二端耦接於該第一節點，該第二電晶體的該控制端耦接於該第二節點；以及一第二電容，包含一第一端和一第二端，該第二電容的該第一端用於接收該發光控制訊號，該第二電容的該第二端耦接於該第二節點。
  11. 如請求項8的顯示面板，其中該補償電路包含：一第四開關，包含一第一端、一第二端和一控制端，其中該第四開關的該第一端用於接收該第一資料訊號，該第四開關的該第二端耦接於該第一電晶體的該第一端，該第四開關的該控制端用於接收一第四控制訊號；一第五開關，包含一第一端、一第二端和一控制端，其中該第五開關的該第一端耦接於該第一節點，該第五開關的該第二端耦接於該第一電晶體的該第二端，該第五開關的該控制端用於接收該第四控制訊號；一第六開關，包含一第一端、一第二端和一控制端， 其中該第六開關的該第一端用於接收一第一驅動訊號，該第六開關的該第二端耦接於該第一電晶體的該第一端，該第六開關的該控制端用於接收一第五控制訊號；以及一第七開關，包含一第一端、一第二端和一控制端，其中該第七開關的該第一端耦接於該第一電晶體的該第二端，該第七開關的該第二端耦接於該發光單元的該第一端，該第七開關的該控制端用於接收該第五控制訊號。
  12. 如請求項11的顯示面板，該多個畫素電路排列成具有多列之矩陣形狀，該畫素電路位於第N列，且N為正整數，其中該重置電路包含：一第八開關，包含一第一端、一第二端和一控制端，其中該第八開關的該第一端耦接於該第一節點，該第八開關的該第二端用於接收該重置電壓，該第八開關的該控制端用於接收第N-1列之第四控制訊號。
  13. 如請求項8的顯示面板，其中該寫入電路包含：一第九開關，包含一第一端、一第二端和一控制端，其中該第九開關的該第一端耦接於該第二節點，該第九開關的該第二端用於接收該第二資料訊號，該第九開關的該控制端用於接收一第六控制訊號。
  14. 一種畫素電路，包含：一第一電晶體，包含一第一端、一第二端和一控制 端，其中該第一電晶體的該第一端用於接收一第一驅動訊號，該第一電晶體的該控制端耦接於一第一節點；一發光單元，包含一第一端和一第二端，其中該發光單元的該第一端耦接於該第一電晶體的該第二端，該發光單元的該第二端用於接收一第二驅動訊號；一第一電容，耦接於該第一節點與該第一電晶體的該第一端之間；一第二電晶體，包含一第一端、一第二端和一控制端，其中該第二電晶體的該第一端用於接收一參考電壓，該第二電晶體的該控制端耦接於一第二節點；一第二電容，包含一第一端和一第二端，該第二電容的該第一端用於接收一發光控制訊號，該第二電容的該第二端耦接於該第二節點，其中該發光控制訊號具有斜坡脈衝波形；一第一補償電路，耦接於該第一節點、該第二節點以及該第二電晶體的該第二端，用於依據該第二電晶體的臨界電壓調整該第二節點的一第二節點電壓；一寫入電路，用於將一第一資料訊號傳遞至該第一節點，且將一第二資料訊號傳遞至該第二節點；以及一第二補償電路，用於將該第一電晶體產生的一驅動電流傳遞至一比較電路，其中當該比較電路接收到的該驅動電流不等於一預設電流值，該比較電路輸出一調整訊號，以將該第一資料訊號的電壓準位設置為正相關於的該驅動電流的大小。
  15. 如請求項14的畫素電路，其中，該第一補償電路包含：一第十開關，包含一第一端、一第二端和一控制端，其中該第十開關的該第一端用於接收一重置電壓，該第十開關的該第二端耦接於該第二節點，該第十開關的該控制端用於接收一第七控制訊號；一第十一開關，包含一第一端、一第二端和一控制端，其中該第十一開關的該第一端耦接於該第二節點，該第十一開關的該第二端耦接於該第二電晶體的該第二端，該第十一開關的該控制端用於接收一第八控制訊號；以及一第十二開關，包含一第一端、一第二端和一控制端，其中該第十二開關的該第一端耦接於該第二電晶體的該第二端，該第十二開關的該第二端耦接於該第一節點，該第十二開關的該控制端用於接收一第九控制訊號。
  16. 如請求項14的畫素電路，其中，該寫入電路包含：一第三電容，包含一第一端和一第二端，其中該第三電容的該第一端耦接於該第二節點；一第十三開關，包含一第一端、一第二端和一控制端，其中該第十三開關的該第一端耦接於該第一節點，該第十三開關的該第二端用於接收該第一資料訊號，該第十三開關的該控制端用於接收一第十控制訊號；以及一第十四開關，包含一第一端、一第二端和一控制 端，其中該第十四開關的該第一端耦接於該第三電容的該第二端，該第十三開關的該第二端用於接收該第二資料訊號，該第十四開關的該控制端用於接收一第十一控制訊號。
  17. 如請求項14的畫素電路，其中，該第二補償電路包含：一第十五開關，包含一第一端、一第二端和一控制端，其中該第十五開關的該第一端耦接於該比較電路，該第十五開關的該第二端耦接於該第一電晶體的該第二端，該第十五開關的該控制端用於接收一第十二控制訊號。
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