KR970023999A - 반도체 장치 제조 방법(A Method of Manufacturing Semiconductor Devices) - Google Patents
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Abstract
절연 영역을 평탄화시키는데 있어서 양호한 제어와 생산성을 제공하는 반도체 장치 제조 방법. 이 방법은 다수의 트렌치가 충전 물질로 완전히 채워지도록 다수의 트렌치와 함께 형성된 반도체 기판에 충전 물질을 형성하는 단계; 충전 물질의 표면으로 다수의 트렌치 패턴을 인버팅시켜 얻은 패턴을 갖고 있는 마스크를 형성하는 단계, 다수의 트렌치 각각에 충전 재료로 구성된 돌출부가 잔존하도록 마스크를 이용하여 충전 재료를 소정 깊이까지 에칭하는 단계; 및 평탄화를 위해 마스크를 제거한 후 돌출부를 제거하는 단계를 포함한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
도 4A 내지 도 4D 및 도 4E-1 내지 도 4G-1은 본 발명의 제1 양호한 실시예로서 실행된 제조 단계들을 순차적으로 보여주는 단면도.
도 4E-2 내지 도 4G-2는 본 발명의 제2 양호한 실시예로서 실행된 제조 단계를 순차적으로 보여주는 단면도.
Claims (6)
- 반도체 장치를 제조하는 방법에 있어서, 다수의 트렌치들이 충전 재료로 완전히 채워지도록 다수의 트렌치와 함께 형성된 반도체 기판 상에 충전 재료를 형성하는 단계; 상기 다수의 트렌치의 패턴을 상기 충전 재료의 표면에 인버팅시켜서 얻은 패턴을 갖고 있는 마스크를 형성하는 단계; 상기 다수의 트렌치들 각각에 상기 충전 재료로 구성된 돌출부를 잔존시키기 위해서 상기 마스크를 이용하여 상기 충전 재료를 소정 깊이까지 에칭하는 단계; 및 평탄화를 위해 상기 마스크를 제거한 후 상기 돌출부를 제거하는 단계를 포함하는 반도체 장치 제조 방법.
- 제1항에 있어서, 상기 다수의 트렌치 바깥쪽의 상기 반도체 기판 표면과 상기 충전 물질 사이에 스톱퍼층이 형성되어 있고, 상기 스톱퍼층은 상기 다수의 트렌치에 상기 충전 재료로 구성된 상기 돌출부가 잔존하도록 상기 마스크를 이용하여 상기 충전 재료를 상기 소정 깊이까지 에칭할 때 에칭 스톱퍼로서 작용하는 반도체 장치 제조 방법.
- 제1 또는 2항에 있어서, 상기 돌출부는 평탄화를 위해 상기 반도체 기판 전체에 걸쳐서 이온 조사하여 제거되는 반도체 장치 제조 방법.
- 제3항에 있어서, 상기 이온 조사는 상기 반도체 기판의 표면에 수직하게 실행되는 반도체 장치 제조 방법.
- 제1 또는 2항에 있어서, 상기 돌출부는 평탄화를 위해 연마에 의해 제거되는 반도체 장치 제조 방법.
- 반도체 장치 제조 방법에 있어서, 반도체 기판의 소자 형성 영역에 스톱퍼층을 형성하는 단계; 상기 소자 형성 영역 바깥의 상기 반도체 기판 상에 다수의 트렌치를 형성하는 단계; 상기 다수의 트렌치들이 상기 스톱퍼층을 덮도록 상기 반도체 기판 내에 매립되게 절연막을 형성하는 단계; 상기 소자 형성 영역 위에 개구를 갖고 있으며 마스크 패턴을 상기 절연막상에 형성하는 단계; 상기 절연막으로 구성된 돌출부를 형성하고 마스크로서 상기 마스크 패턴을 이용하여 상기 절연막을 에칭하므로써 상기 스톱퍼층을 노출시켜 상기 다수의 트렌치 각각으로부터 상기 돌출부를 돌출시키는 단계; 및 상기 마스크를 제거한 후 상기 돌출부를 제거해서 상기 반도체 기판의 표면을 평탄화시키는 단계를 포함하는 반도체 장치 제조 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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JPH11214499A (ja) * | 1998-01-27 | 1999-08-06 | Mitsubishi Electric Corp | 半導体装置の製造方法 |
TW498440B (en) * | 1998-03-30 | 2002-08-11 | Hitachi Ltd | Manufacture method of semiconductor device |
JP2000040737A (ja) | 1998-07-24 | 2000-02-08 | Oki Electric Ind Co Ltd | 素子分離領域の形成方法 |
GB2352874B (en) * | 1999-07-01 | 2002-10-09 | Lucent Technologies Inc | An integrated circuit and a process for manufacturing the integrated circuit |
US6682978B1 (en) * | 1999-08-30 | 2004-01-27 | Advanced Micro Devices, Inc. | Integrated circuit having increased gate coupling capacitance |
US6383933B1 (en) * | 2000-03-23 | 2002-05-07 | National Semiconductor Corporation | Method of using organic material to enhance STI planarization or other planarization processes |
US6664190B2 (en) | 2001-09-14 | 2003-12-16 | Chartered Semiconductor Manufacturing Ltd. | Pre STI-CMP planarization scheme |
US6869857B2 (en) | 2001-11-30 | 2005-03-22 | Chartered Semiconductor Manufacturing Ltd. | Method to achieve STI planarization |
JP4318892B2 (ja) | 2002-05-30 | 2009-08-26 | 富士通マイクロエレクトロニクス株式会社 | 電子装置の設計方法および製造方法 |
JP2006165376A (ja) | 2004-12-09 | 2006-06-22 | Fujitsu Ltd | 電子装置及びその設計方法 |
JP4671759B2 (ja) * | 2005-05-18 | 2011-04-20 | 富士通セミコンダクター株式会社 | 半導体装置の製造方法 |
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JP2009117681A (ja) * | 2007-11-08 | 2009-05-28 | Panasonic Corp | 半導体装置の製造方法および固体撮像装置の製造方法 |
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KR20150021811A (ko) * | 2013-08-21 | 2015-03-03 | 삼성전자주식회사 | 반도체 소자의 제조방법 |
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US4665010A (en) * | 1985-04-29 | 1987-05-12 | International Business Machines Corporation | Method of fabricating photopolymer isolation trenches in the surface of a semiconductor wafer |
US4714520A (en) * | 1985-07-25 | 1987-12-22 | Advanced Micro Devices, Inc. | Method for filling a trench in an integrated circuit structure without producing voids |
US4654120A (en) * | 1985-10-31 | 1987-03-31 | International Business Machines Corporation | Method of making a planar trench semiconductor structure |
US4954459A (en) * | 1988-05-12 | 1990-09-04 | Advanced Micro Devices, Inc. | Method of planarization of topologies in integrated circuit structures |
EP0545263B1 (en) * | 1991-11-29 | 2002-06-19 | Sony Corporation | Method of forming trench isolation having polishing step and method of manufacturing semiconductor device |
US5229316A (en) * | 1992-04-16 | 1993-07-20 | Micron Technology, Inc. | Semiconductor processing method for forming substrate isolation trenches |
JP3047343B2 (ja) * | 1994-07-30 | 2000-05-29 | 日本電気株式会社 | 半導体装置の製造方法 |
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