KR920010653A - 메모리 불량 해석 장치 - Google Patents

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KR920010653A
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히사오 쯔까꼬시
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아오이 죠이찌
가부시끼가이샤 도시바
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Abstract

내용 없음

Description

메모리 불량 해석 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 의한 메모리 불량 해석 장치의 제1실시예의 구성을 도시한 블럭도,
제2도는 본 발명에 관한 불량 해석용 메모리(FAM)으로의 불량 정보 기입에 대한 설명도.

Claims (1)

  1. 용장 회로를 갖는 피측정 메모리(50)의 메모리 셀을 선택하는 어드레스 신호를 발생함과 동시에 상기 어드레스 신호에 의해 선택되는 메모리 셀에 기입하는 데이타를 발생하는 알고리즈믹 패턴 발생기(2), 상기 어드레스 신호에 의해 선택된 메모리 셀에 상기 데이타가 기입된 후에 독출을 행하여, 독출된 데이타와 상기 알고리즈믹 패턴 발생기에서의 데이타가 일치하고 있는지의 여부를 비교하여 일치하지 않는 경우에 상기 메모리 셀이 불량인 것을 나타내는 불량 신호를 발생하는 비교 수단(4), 복수의 메모리 셀을 갖는 불량 해석용 메모리(8) 및 상기 알고리즈믹 패턴 발생기에서의 어드레스 신호를 수신하여, 소정의 규칙에 기초해서 상기 피측정 메모리의 복수의 메모리 셀을 상기 불량 해석용 메모리중 하나의 메모리 셀에 대응시키도록 상기 불량 해석용 메모리의 어드레스 할당을 행하는 어드레스 할당 수단(6)을 구비하고, 상기 불량 해석용 메모리가 상기 피측정 메모리의 메모리 셀이 불량인 것을 나타내는 불량 신호가 상기 비교 수단에서 송출된 때에 상기 불량인 메모리 셀에 대응하는 자체 메모리 셀에 불량 정보를 기입하는 것을 특징으로 하는 메모리 불량 해석 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910020081A 1990-11-13 1991-11-12 메모리 불량 해석 장치 KR950013401B1 (ko)

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