KR920010615A - 전류 미러형 감지증폭기를 가진 메모리 디바이스 - Google Patents
전류 미러형 감지증폭기를 가진 메모리 디바이스 Download PDFInfo
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 전류미러형 감지 증폭기를 가진 종래 메모리 디바이스를 도시한 회로도.
제2A도 및 제2B도는 반도체집적 회로 칩상에 배열된 정보 메모리셀 유니트를 도시한 개략 회로도,
제3도는 본발명에 따른 바람직한 실시예의 전류미러형 감지 증폭기를 가진 메모리 디바이스를 도시한 회로도.
Claims (4)
- 소정수의 행과 소정수의 열을 가진 매트릭스 패턴으로 배열된 다수의 정보메모리셀 유니트로, 각각의 상기 정보 메모리셀 유니트는 선택셀 및 정보 메모리셀을 포함하며, 정보는 상기 정보 메모리셀의 최소하나의 메모리셀에 저장되는 상기 다수의 정보 메모리셀 유니트와, 상기 선택셀의 온 및 오프를 제어하는 선택기와 상기 정보메모리셀을 억세스하기 위한 어드레스 디코더를 포함하는 다수의 어드레스 디코더 유니트로서, 상기 선택기는 선택라인에 의해 각 열에서 상기 선택셀에 연결되며, 상기 어드레스 디코더는 각 열의 출력에서 워드 라인에 의해 상기 정보 메모리셀에 연결되는 상기 다수의 어드레스 디코더 유니트와, 디지트 라인에 의해 정보 메모리셀 유니트의 행에 연결된 다수의 감지 증폭기와, 선택셀과 기준메모리셀을 포함하며 상기 정보메모리셀 유니트의 열에 연결되어 상기 선택셀이 상기 선택라인에 의해 상기 각 열에서 상기 선택기에 연결되는 다수의 기준메모리셀 유니트로, 상기 기준메모리셀은 상기 워드라인에 의해 상기 각 열에서 상기 어드레스 디코더의 상기 출력에 연결됨으로써, 상기 기준메모리셀 유니트 중 하나는 상기 선택셀이 상기 어드레스 디코더 유니트의 상기 선택기에 의해 상기 기준 메모리셀 유니트 중 상기 하나에서 선택될 때 기준 전압을 상기 감지 증폭기에 연결된 기준전압 라인에 인가하는 상기 다수의 기준 메모리셀 유니트를 포함하는 전류 미러형 감지 증폭기를 가진 메모리 디바이스.
- 제1항에 있어서, 상기 선택셀 및 상기 정보 메모리셀이 각각의 상기 정보 메모리셀 유니트내 NMOS트랜지스터이며, 상기 NMOS 트랜지스터는 상기 정보 메모리셀중 최소하나의 정보 메모리셀에 대해 공핍형이며, 상기 선택셀 및 상기 기준 메모리셀이 상기 각각의 상기 기준 메모리셀유니트 NMOS트랜지스터이며, 상기 NMOS 트랜지스터는 상기 기준 메모리셀에 대해 공핍형인 전류 미러형 감지 증폭기를 가진 메모리 디바이스.
- 제1항에 있어서, 각각의 상기 정보 메모리셀 유니트는 선택 NMOS 트랜지스터와 세 개의 정보 메모리셀NMOS 트랜지스터를 포함하며, 세정보 메모리셀 중하나는 상기 디지트라인과 소스-드레인 경로에 의한 접지간 직렬로, 그리고 게이트에서 상기 선택라인과 상기 워드 라인에 직렬 연결된 공급형 트랜지스터이며 각각의 상기 기준 메모리셀 유니트는 선택 NMOS 트랜지스터와 기준전압라인과 소스-드레인 경로에 의한 접지간 직렬로, 그리고 게이트에서 상기 선택 라인과 상기 워드라인에 직렬 연결에 공핍형의 3개의 기준 메모리셀 NMOS트랜지스터를 포함하는 전류 미러형 감지 증폭기를 가진 메모리 디바이스.
- 제1항에 있어서, 상기 기준 메모리셀 유니트는 상기 기준 전압에 의해 상기 감지 증폭기에 연결되며, 상기 기전 전압 라인은 소스에서 고전압 전압 전원공급기와 연결된 제1의 PMOS 트랜지스터의 게이트와 드레인에 연결되며, 각각의 상기 감지 증폭기는 게이트에서 상기 기준 전압 라인과, 드레인에서 상기 디지트 라인과, 그리고 소스에서 성기 고전압 전원 공급기와 연결된 제2의 PMOOS트랜지스터와, 한 입력에서 상기 상기 제2의 PMOS 트랜지스터의 상기 드레인과, 그리고 한출력에서 한출력 신호 라인과 연결된 인버터를 포함하는 전류 미러형 감지 증폭기를 가진 메모리 디바이스.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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