KR900005060B1 - Pcm 신호를 기록 및 재생하기 위한 방법 및 장치 - Google Patents

Pcm 신호를 기록 및 재생하기 위한 방법 및 장치 Download PDF

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Abstract

내용 없음.

Description

PCM 신호를 기록 및 재생하기 위한 방법 및 장치
제1도는 본 발명에 의한 PCM 신호기록재생장치를 도시한 구성도.
제2도는 자기테이프위의 기록 패턴을 도시한 도면.
제3도 및 제4도는 종래의 기록 데이터를 도시한 구성도.
제5도는 종래의 입출력 데이터를 도시한 구성도.
제6a~e도는 본 발명에 의한 입출력 데이터의 변환을 도시한 도면.
제7도 및 제8도는 본 발명에 의한 기록 데이터를 도시한 구성도.
제9도는 데이터 변환회로를 도시한 구성도.
제10도는 제9도의 회로의 동작을 설명하는 타이밍도.
본 발명은 PCM 신호의 기록재생기술에 관한 것으로, 특히 오디오 PCM 신호를 디지탈 오디오 테이프 레코더(이하, DAT라 한다)에 기록재생하는 데 적합한 PCM 신호를 기록 및 재생하기 위한 방법 및 장치에 관한 것이다.
오디오 신호를 PCM 신호로 변환해서 자기테이프 위에 기록하는 DAT는 음질이 우수하며, 기록재생에 따른 질의 저하가 없다는 특징이 있다.
회전헤드형의 디지탈 오디오 테이프 레코더의 기술경향은 EIAJ(Electoronics Idustries Association of Japan)에서 발행한 ELECTRONICS, vol. 24, No. 10. 1984년 p.36-42, 특히 p. 40~42의 "DAT Meeting Activity"에 기술되어 있다.
상기 문헌의 p. 40에 있어서는 R-DAT의 실험 포맷으로서, 샘플링 주파수 48㎑. 샘플당 양자화 비트 수 16비트 및 좌우 2채널의 제1 PCM 신호를 테이프에 기록하는 것이 기재되어 있다 제1 PCM 신호는 일본에 있어서의 위성을 사용한 방송에 의한 PCM 신호의 공신중의 B모드 규격에 해당한다.
제2도는 상기 문헌의 p. 40에 기재된 R-DAT의 자기 테이프위의 기록 패턴을 도시한 도면이다. 자기 테이프(33)에서 상기 제1 PCM 신호는 플러스 애지무스트랙(34) 및 마이너스 애지무스트랙(35)에 128블럭씩 교대로 기록된다. 여기서 애지무스트랙이라는 것은 제1도에 도시된 헤드(32a), (32b)의 헤드갭이 제2도의 사선으로 표시된 것과 같이, 기록방향과 직각인 면에 대해서 기울어져 있으므로, 상기 제1 PCM 신호의 기록도 제2도의 사선방향으로 기록되는 트랙을 말한다. 다음에 플러스 애지무스와 마이너스 애지무스라는 것은 트랙(34), (35)의 경사진 방향이 사선으로 표시된 것과 같이 서로 역방향이라는 것을 의미한다.
제3도 및 제4도는 제2도의 각 트랙에 기록되는 PCM 데이터의 1예의 구성을 도시한 도면이다. 제3도는 제2도의 플러스 애지무스트랙(34)의 데이터 배열을 도시한 도면이고, 제4도는 제2도의 마이너스 애지무스 트랙(35)의 데이터 배열을 도시한 도면이다.
(36)은 8비트로 구성된 1심볼 단위를 나타낸다 통상, 1워드 신호는 상위 심볼과 하위 심볼의 2개의 심볼로 구성되어 있다. 1블럭은 32심볼로 구성되고, 128블럭은 1트랙에 기록된다. (38)은 제 1에러검출 및 정정코드 Q를 나타내고, (37)은 제 2에러검출 및 정정코드 p를 나타낸다. L은 왼쪽채널 데이터를 나타내고 R은 오른쪽 채널 데이터를 나타낸다. 또, L또는 R의 첨자는 왼쪽 채널 데이터 또는 오른쪽 채널 데이터의 일련번호를 나타내며, 0,2,4‥‥‥, 는 짝수번째의 데이터, 1.3.5‥‥‥, 는 홀수번째의 데이터를 나타낸다 또, u는 상기의 상위 심볼을 나타내며, 1은 상기의 하위 심볼을 나타낸다.
데이터 재생시에 큰 버스트 에러가 발생되어도, 평균값 보간에 의한 에러 보상을 할 수 있도록 데이터 기록시에 데이터의 분산을 실행하고 있다. 즉, 왼쪽 채널의 짝수번째의 데이터를 플러스 애지무스 트랙의 전반에, 왼쪽채널의 홀수번째와 데이터를 마이너스 애지무스 트랙의 후반에 기록하고 있으며, 오른쪽 채널의 짝수번째의 데이터를 마이너스 애지무스 트랙의 전반에, 오른쪽 채널의 홀수번째의 데이터를 플러스 애지무스 트랙의 후반에 기록하고 있다
이하 제3도 및 제4도를 참조하여 이 배열의 예를 설명한다. 왼쪽 채널의 짝수번째의 데이터 L0u가 제3도의 블럭번호 0에 기록된다. 따라서 이것은 데인터 L0u가 기록방양으로 제2도의 플러스 애지무스 트랙(34)의 전반에 기록되어 있는 것을 의미한다. 또, 데이터 L0u의 다음의 데이터 L1u가 제4도의 블럭번호(76)에 기륵된다. 따라서. 이것은 L1u가 기록방향으로 제2도의 마이너스 애지무스 트랙(35)의 후반에 기록되어 있는 것을 의미한다. 여기서 왼쪽 채널의 짝수번째의 데이터 L0u와 이 데이터에 대응하는 오른쪽 채널의 짝수번째의 데이터 RO1의 심볼의 간격으로 같은 블럭번호 0에 배치되어 있다. 회전헤드방식 DAT에 있어서, 샘플링 준파수가 48㎑, 실린더 회전수가 2,000rpm이므로, 5760심볼의 데이터는 2트랙위에 기록된다.
이와 같이. R-DAT에 있어서는 샘플링 주파수 48㎑, 샘플당 양자화 비트수 16비트 및 좌우 2채널의 제1 PCM 신호를 기록하는데 가장 적합하도록 데이터의 배열이 정하여져 있었다. 그러나, 샘플링 주파수, 샘플당 양자화 비트수 및 채널수가 상기 제1 PCM 신호와 다른 제2 PCM 신호를 기록하는 경우의 구체적 배려에 대해서는 검토되지 않았다. 이 제2 PCM 신호원의 1예는 일본에서 위성을 사용한 방송에 의한 PCM 신호의 송신중의 A모드의 규격에 해당한다.
본 발명의 목적은 샘플이 주파수, 샘플당 양자화 비트수 및 채널수가 다른 제2 PCM 신호원을 기록할 수가 있는 PCM 신호를 기록 및 재생하기 위한 방법 및 장치를 제공하는 것이다.
본 발명에 의하면, 샘플링 주파수, 샘플당 양자화 비트수 및 채널수가 다른 PCM 신호를 일정한 워드수 단위로 소정의 순서로 교체를 행하여 기록하는 것에 의해 버스트에러에 대해시 가상 적합한 데이터 배열로 기록할 수 있도록 한 것이다.
이하, 본 발명의 1실시예를 제1도를 참조하여 설명한다. 제1도는 R-DAT의 구성을 도시한 도면이다.
기록시에 4채널의 A, B, C, D의 아날로그신호가 입력단자(1)에서 입력된다. 입력신호는 증폭회로(2)에 의해 소정의 레벨까지 증폭되고, 필터(3)에 의해 대역폭이 제한되고, 샘플홀드회로(4)에 의해 샘플링된다. 샘플링된 입력신호는 스위치회로(5)를 거쳐서 차례로 A/D 변환기(6)에 입력되어 PCM 신호로 변환된다. A/D변환기(6)에서 공급된 PCM 신호는 데이터 변환회로(7)에서 소정의 순서로 교체를 행하여, 버스라인(14)를 거쳐서 RAM(15)에 라이트 된다. RAM(15)와 에러 정정회로(20)사이에 PCM 신호가 교환되어 재생시에 에러를 검출, 정정하기 위한 에러 정정코드가 PCM 신호에 부가된다. 어드레스 발생회로(17)∼(19) 및 어드레스 스위치회로(16)에 의해서 RAM(15)의 어드레스가 제어되어 상기 제3도 및 제4도에 도시된 포맷에 따라서 PCM 신호의 배열이 행하여 진다. 에러 정정코드가 PCM 신호에 부가되어 PCM 신호가 재배열된 후에, 데이터는 블럭 단위로 RAM(15)로 부터 리드되어 변조회로(23)에 의해서 변조된다. 제어신호 발생회로(24) 및 스위치회로(25)에 의해 동기신호등의 제어신호가 변조된 데이터에 부가된다. 그 결과로서 데이터는 기록앰프(26)에 의해 소정의 레벨로 증폭되고, 스위치회로(31)을 거쳐서 회전혜드(32)에 공급되어 자기 테이프(33)위에 기록된다. 여기서 스위치회로(31)은 기록동작과 재생동작의 전환을 행하는 것이다. 또, 타이밍 발생회로(21)은 발진회로(22)에 의해서 생성된 클럭퍽스에 따라서 전체회로(블럭 (4), ~(7), (11)~(13), (17)~(20), (24))를 제어하는 타이밍 신호를 생성하는 회로이다.
재생시에 스위치회로(31)은 재생위치로 전환된다. 회전혜드(32)에 의해서 재생된 신호는 재생앰프(30)으로 입력되어 증폭 및 파형등화가 행하여 진다. 그 결과로서 신호는 데이터 스트로브회로(29)에 의해 디지탈 신호로 변환된 후에, 복조회로(27)에 의한 데이터의 복조와 동기검출회로(28)에 의한 동기신호의 검출이 각각 행하여 진다. 여기서 검출된 동기신호늘 데이터 재생의 기준으로서 이용된다. 복조회로(27)에 의해서 복조된 데이터는 버스라인(14)를 거쳐서 RAM(15)에 저장된 후에, 어드레스 발생회로(17)∼(19) 및 어드레스 스위치회로(16)에 의한 데이터의 재배열 및 에러 정정회로(20)에 의한 에러정정을 행한다. 그 결과로서 데이터는 버스라인(14)를 거쳐서 데이터 변환회로(13)에 입력된다. 데이터 변환회로(13)에서는 데이터 변환회로(7)에서 행한 데이터의 교체와 반대의 교체를 행한다. 시계열순으로 바꾸어진 PCM 신호는 D/A 변환기(12)에 의해 차례로 아날로그 신호로 변환되고. 앰플 홀드회로(11)에 의해 각 채널로 리샘플이 행하여 진다. 각 채널의 리샘플된 아날로그 시호는 필터(10)과 증폭회로(9)를 거쳐서 출력단자(8)로 부터 출력된다.
여기서 제1도의 점선으로 나타낸 부분(39)는 샘플링 주과수 48㎑, 샘플당 양자화 비트수 16비트, 2채널의 상기 제1 PCM 신호를 기록하는 데 적합한 구성으로 되어 있다. 본 발명에 의하면, 이것은 C 채널과 D 채널용의 블럭 (1)∼(4) 및 (8)∼(11)과 데이터 변환회로(7) 및 (13)을 부가하는 것에 의해, 샘플링 주파수 32㎑. 샘플당 양자화 비트수 12비트, 4채널의 상기 제2 PCM 신호를 기록할 수 있도록 배려한 것이다.
먼저, 제5도에 대해서 설명한다.
제5도는 상기 좌우 2채널의 제1 PCM 신호원을 기록하는 경우에 A/D 변환기 (6)의 출력 데이터의 순서를 도시한 도면이다. 첨자는 시계열에 있어서의 각 데이터 워드의 순번을 나타내며, 16비트의 1워드 단위로 공급되게 된다. 다음에 이 출력 데이터는 RAM(15)로 전송된다. RAM(15)에서 이와 같은 순서로 입력된 PCM 신호는 제3도 및 제4도와 제2도를 참조하여 설명한 바와 같이 각 채널의 짝수번째의 데이터와 홀수번째의 데이터가 다른 트랙위에 배치되어도 되고, 또한 트백방향으로 분리되어도 되도륵 재배열된다.
샘플링 주파수 32㎑, 샘플당 양자화 비트수 12비트, 4채널의 제2 PCM 신호를 기록할 수 있는 경우나. A/D 변환기 (6)의 출력데이터의 순서는 제6a도와 같이 된다. 기서 이 제2 PCM 신호는 샘플링 주파수 48㎑, 샘플당 양자화 비트수 16비트, 2채널의 상기 제1 PCM 신호와 시간당의 데이터 비트수가 동일하기 때문에 교체를 행하지 않고 그대로 기록하는 것도 가능하다. 그러나, 이 경우에 각 채널의 짝수번째 및 홀수번째의 데이터의 위치가 각각 제5도의 왼쪽 채널 데이터와 오른쪽 채널 데이터의 짝수번째 및 홀수번째의 데이터의 위치와 대응하지 않으므로, 상술한 바와 같이 짝수번째의 데이터와 홀수번째의 데이터를 떨어뜨려서 배치할 수가 없다. 따라서, 본 발명의 1실시예에 있어서 제6b, c도에 도시한 것과 같은 데이터의 교체를 데이터 변환회로(7)에서 실행한다. 즉, 제6a도에 도시한 것과 같은 12비트(예를 들어 A0)로 되는 각 워드를 제6b도에 도시한 것과 같이 4비트 군(A0a,A0b,A0c)으로 분할한다. 그리고 제6c도에 도시한 것과 같이, 16비트(A0a,A0b,A0c,C0a)로, 즉 다응과 같은 단위로 데이터의 교체를 실행한다. 제6d도는 제5도에 해당하는 도면이다.
(1) A채널과 C채널의 짝구번째의 데이터 (A0a,A0b,A0c,C0a)를 L채널의 짝수전째의 데이터 (L'0)의 위치에 배치한다.
(2) A채널과 C채럴의 홀수번째의 데이터(A1a, A1b, A1c, C1a)를 L채널의 홀수번째의 데이터 (L'1)의 위치에 배치한다.
(3) B채널과 D채럴의 짝수번째의 데이터 (B0a, B0b, B0c, D0a)를 R채널의 짝수번째의 데이터 (R'0)의 위치에 배치한다.
(4) B채널과 D채널의 홀수번째의 데이터(B1a, B1b, B1c, D1a)를 R채널의 홀수번째의 데이터 (R'1)의 위치에 배치한다.
제6도에 의한 변환에서 A, C 채널의 데이터를 왼쪽 채널의 위치에, 또 B, D 채널의 데이터를 오른쪽 채널의 위치에 배치하고 있으나, 그외의 조합도, 예를 들면 A, B 채널의 데이터를 L채널의 위치에, C, D 채널의 데이터를 R채널의 위치에 배치하여도 된다.
제7도 및 제8도는 제6도에 도시한 변환을 이용해서, 샘플링 주파수 32㎑, 샘플당 양자화 비트수 12비트, 4채럴의 제3 PCM 신호를 케이프 위에 기록하는 경우의 데이터의 구성을 도시한 도면이다. 제7도는 제2도의 플러스 애지무스 트랙(34)에 기록되는 데이터의 구성도이고, 제8도는 제2도의 마이너스 애지무스 트랙(35)에 기록되는 데이터의 구성을 포시한 도면이다. 제7도 및 제8도에 도시된 데이터 제6e도에 해당한다. 제3도와 제4도의 경우와 마찬가지로, 각 채널의 짝수번째의 데이터와 홀수번째의 데이터가 인접한 트랙위에 트랙방향으로 일정하게 배치되어 있다. 1트랙의 연속 에러 또는 2트랙에 걸치는 1/2의 연속 에러가 발생하여도, 시계열에서의 연속데이터가 에러로 되지 않으므로 평균값 보간을 실행할 수가 있다.
즉, 에러를 에러 데이터의 편균값 보간을 사용하여 보상할 수가 있다.
이와 같이, 제6도의 변환을 이용하는 것에 의해서 샘플링 주파수 32㎑, 샘플링 양자화 비트수 12비트, 4채널의 제2 PCM 신호를 기록할 수가 있고, 또 버스트 에러에 대해서도 가장 적합한 데이터 구성으로 할 수가 있다. 그리고, 재생시에 제6b도에서 제6c도의 역변환을 실행할 수도 있다.
제9도는 데이터 변환회로(7)과 (13)의 구성예를 도시한 것이다. 동일도면에서 (45)는 RAM, (46)은 어드레스 스위치회로, (47)은 가산회로, (49), (50)은 카운터, (48)은 오프세트 발생회로를 나타낸다. 또, 제10도는 제9도에 도시한 회로의 입출력신호의 타이밍도이다.
입력단자(40)에서 입역된 데이터(40-1)은 RAM(45)에 라이트 된다. 그리고, RAM(45)에서 리드된 데이터는 데이터 (41-1)로서 출력단자(41)로 출력된다. 이 RAM(45)의 리드 어드레스와 라이트 어드레스를 제어하는 것에 의해 데이터의 변환을 실행한다. RAM의 용량은 4비트×21워드이다. 카운터 (49)는 입력단자(43)에서 입력된 클럭신호(43-1)에 따라서 차례로 계수하는 21스텝 카운터이다. RAM(45)의 리드 및 라이트 어드레스는 카운터 (49)에 의해 얻어진 값을 이용한다. 카운터 (50)은 48스텝 카운터이며, 입력된 데이터의 일련번호를 나타낸다. 카운터(50)은 입력단자(44)에서 입력된 리세트신호(44-1)에 의해 변환 개시시 리세트된다. 리드 어드레스는 카운터(50)의 값에 따라서 오프세트 발생회로(48)에서 출력된 오프세트 값으로 카운터 (49)의 값을 가산회로(47)에서 가산하는 것에 의해 제어된다. (42)는 RAM(45)의 데이터 라이트 제어신호(21-1)의 입력단자를 나타낸다.
제10도의 입출력신호의 타이밍도에서 클럭신호(43-1)이 "1"일때, 어드레스 스위치회로(46)은 카운터 (49)로 전환되고, 동시에 RAM 라이트 제어신호(42-1)이 RAM(45)에 공급되어 데이터의 라이트가 행하여 진다. 플럭신호(43-1)이 "0"일때, 어드레스 스위치회로(46)이 가산회로(47)로 전환되어 데이터의 리드가 행하여 진다.
제9도의 회로에 있어서, 오프세트 발생회로(48)의 메모리 내용을 바꾸는 것에 의해 제6도의 양쪽데이터 변환 및 역의 데이터 변환을 실행할 수가 있다.
다음에, 제9도의 데이터 변환회로에 있어서, 데이터를 변환할시 RAM(45)의 입출력 데이터 및 어드레스 상태의 1예를 표 1에 나타낸다.
[표 1a]
Figure kpo00001
[표 1b]
Figure kpo00002
[표 1c]
Figure kpo00003
표 1은 데이터 변환회로(7)에 있어서 데이터를 기록할시 데이터 변환을 도시한 것이다. 데이터 변환회로(13)에 있어서 데이터를 재생할시 데이터 변환도 마찬가자로 실행할 수가 있다. 라이트 어드레스는 카운터(49)의 값이다. 리드 어드레스는 라이그 어드레스에 오프세트 값을 부가하여 얻을 수 있다. 가산회로(47)에 있어서 라이트 어드레스와 오프세트 값과의 가산은 모듈로(modulo)21하는 가산이다.
이상 기술한 바와 같이, 본 발명은 샘플링 주파수 32㎑, 샘플당 양자화 비트수 12비트, 4채널의 제2 PCM 신호를 버스트 에러에 대해서 가장 적합한 데이터 구성으로 되도록 기록할 수가 있다.
상기 실시예에 있어서. 회전혜드 방식 DAT에 대해서 기술하였으나, 고정 혜드방식 DAT에 대해서도 마찬가지의 변환으로 대응할 수가 있다 또, 입출력 신호가 디지탈 신호인 경우에도 입출력 신호를 제6a도와 같은 구성으로 하면 문제가 없다.

Claims (10)

  1. 샘플당 양자화 비트수 m 및 n채널(A,B,C,D)를 갖는 입력 PCM 신호를 채널당 m'비트 및 n'채널을 갖는 기록 PCM 신호로서 기록하기 위한 PCM 신호의 기록방법에 있어서, n채널을 갖는 상기 PCM 신호를 n'조합으로 분할하는 스텝, 각각의 상기 n'조합에서 상기 PCM 신호를 k비트 데이터 단위로 분할하는 스텝, 상기 k비트 데이터 단위를 1채널에서 생플당 양자화 비트수 m'를 갖는 신호로 변환하는 스텝과 각각의 상기 n'채럴에 대응하도록 1채널에서 m'비트를 갖는 상기 신호에 포함된 데이터를 배열하는 스텝을 포함하는 PCM 신호의 기록방법.
  2. 특허청구의 범위 제1항에 의한 상기 PCM 신호의 기록방법에 의해 기록된 k비트 데이터 단위를 n
    Figure kpo00004
    m 비트 단위로서 취하면서 샘플당 양자화 비트수 m 및 n'채널을 갖는 PCM 신호로 변환하는 스텝을 포함하는 PCM 신호의 재생방법.
  3. 특허청구의 범위 제2항에 있어서, 상기 m비트, n채널, n'채널 및 k비트는 각각 12비트, 4채널, 2채널 및 4비트이고, 2개의 8비트 데이터는 샘플당 양자화 비트수 12비트 및 4채널을 갖는 PCM 신호의 각 채널에서 8비트를 추출하는 것에 의해 형성되고, 상기 8비트 데이터는 2채널의 4비트로 형성되는 PCM 신호의 기록 및 재생방법.
  4. 특허청구의 범위 제3항에 있어서. 상기 PCM 신호는 횐전헤드(32a,32b)에 의해서 자기 기록매체(33)위에 2트랙단위로 기록되고, 2채널씩 2분할된 PCM신호로 되는 2개의 PCM 신호에 포함된 제1 PCM 신호는 기록방향에 대하여 상기 2트랙에 포함된 제 1트랙(34)의 전반 및 제 2트랙(35)의 후반에 기록되고, 제2 PCM 신호는 상기 제 2트랙 (35)의 전반 및 상기 제 1트랙 (34)의 후반에 기록되는 PCM 신호의 기록 및 재생방법.
  5. 특허청구의 범위 제4항에 있어서, 짝수번째의 데이터 (또는 흘수번째의 데이터)는 각 트랙의 전반에 기록되고. 홀수번째의 데이터 (또는 짝수번째의 데이터)는 각 트랙의 후반에 기록되는 PCM 신호의 기록 및 재생방법.
  6. 샘플링 주파수 fs, 샘플당 양자화 비트수 m비트 및 n채널을 갖는 PCM 신호를 기록 및 재생하기 위한 PCM 신호의 기록 및 재생장치 (여기서, fs, m, n은 정수)에 있어서, 생플링 주파수 b/a×fs. 샘플당 양자화 비트수 d/c×m비트 및 (a×e)/(b×d) ×n채널을 갖는 PCM 신호를 i비트군으로 분할하는 수단(여기서, i는 2×m×n비트와 2×m×n×a/b)비트와의 최소공배수이고, a, b, c및 d는 양의 정수), 상기 i비트 데이터에 포함된 각 채널의 짝수번째의 워드 및 홀수번째의 워드가 각각 샘플링 주파수 fs, 샘플당 양자화 비트수 m비트 및 n채널을 갖는 상기 PCM 신호의 각 채널의 짝수번째의 워드위비 및 홀수번째의 워드위치에 일치하도록 m/c비트단위로서 취하면서 상기 i비트군의 데이터 순서를 교체하는 수단을 갖는 데이터 변환장치(7, 13)을 포함하는 PCM 신호의 기록 및 재생장치.
  7. 특허청구의 범위 제6항에 있어서, fs는 48㎑, m은 16비트, n, a, b, c 및 d는 각각 2, 3, 2, 4 및 3인 PCM 신호의 기록 및 재생장치.
  8. 특허청구의 범위 제1항에 있어서, 상기 m비트, n채널, n'채널 및 k이트는 각각 12비트, 4채널, 2채널 및 4비트이고, 2개의 8비트 데이터는 샘플당 양자화 비트수 12비트 및 4채널을 갖는 PCM 신호의 각 채널에서 8비트를 추출하는 것에 의해 형성되고, 상기 하나의 8비트 데이터는 2채널의 4비트로 형성되는 PCM 신호의 기록 및 재생방법.
  9. 특허청구의 범위 제8항에 있어서, 상기 PCM 신호는 회전헤드(32a,32b)에 의해서 자기 기록매체(33)위에 2트랙단위로 기록되고, 2채널씩 분할된 PCM 신호로 되는 2개의 PCM 신호에 포함된 제1 PCM 신호는 기록방향에 대하여 상기 2트랙에 포함된 제 1트랙(34)의 전반 및 제 2트랙(35)의 후반에 기록되고, 제2 PCM 신호는 상기 제 2트랙(35)의 전반 및 상기 제 1트랙(34)의 후반에 기록되는 PCM 신호의 기록 및 재생 방법.
  10. 특허청구의 범위 제9항에 있어서, 짝수번째의 데이터 (또는 홀수번째의 데이터)는 각 트랙의 전반에 기록되고, 홀수번째의 데이터 (또는 짝수번째의 데이터)는 가 트랙의 후반에 기록되는 PCM 신호의 기록 및 재생방법.
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