KR900003595B1 - Pcm 신호를 기록하기 위한 방법 및 장치 - Google Patents

Pcm 신호를 기록하기 위한 방법 및 장치 Download PDF

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Abstract

내용 없음.

Description

PCM 신호를 기록하기 위한 방법 및 장치
제 1 도는 본 발명의 1실시예에 있어서의 제 1 트랙위의 데이터포맷을 도시한 도면.
제 2 도는 제 2 트랙위에 있어서의 데이터포맷을 도시한 도면.
제 3 도는 자기 테이프위의 트랙배열을 도시한 도면.
제 4 도는 데이터 변화방법을 설명하는 도면.
제 5 도는 PCM 신호 기록장치의 구성을 도시한 도면.
제 6 도는 메모리의 동작의 설명도.
제 7 도는 데이터변환회로의 도면.
제 8 도는 데이터변환회로의 타이밍도.
제 9 도는 a 및 제 9 도 b는 위드를 변환시키지 않은 경우에 각각 제 1 도 및 제 2 도에 해당하는 데이터 기록포맷을 도시한 도면.
*도면의 주요부분에 대한 부호의 설명
2 : 블럭 3 : 제 1 의 에러검출 및 정정코드
4 : 제 2 의 에러검출 및 정정코드 6 : 제 1 의 트랙
7 : 제 2 의 트랙 8, 9 : PCM 신호
1, 10, 11, 12 : 심볼 22 : 데이터변환회로
23, 24, 25, 26 : 메모리 27 : 메모리 제어회로
28 : 에러검출 및 정정코드 가산회로 37, 38, 39 : 래치회로
본 발명은 PCM 신호를 기록하는 기술에 관한 것으로, 특히 회전헤드형식의 PCM 레코더에 적합한 PCM 신호를 기록하기 위한 방법과 장치에 관한 것이다.
1983년 10월 12일에 공개된 일본국특허 공개공보 제 58-173934호(1982년 4월 3일 에 출원된 일본국 특허 출원 제 57-55660호)에 기재되어 있는 바와같이, PCM 레코더에 있어서 샘플링 주파수가 48KHZ또는 44.1KHZ이고 양자화 비트수가 16비트인 PCM 신호(1워드)는 8비트로 기록된다(8비트를 1심볼이라고 한다). 회전 헤드에 의해서 자기테이프위에 PCM 신호를 기록하기 위한 회전헤드형식의 PCM 레코더에 있어서, 1983년 11월 2일에 공개된 일본국 특허 공개공보 제 58-188314호(1982년 4월 26일에 출원된 일본국 특허출원 제 57-69915호)에 기재된 바와같이 본래의 PCM 신호를 각각의 트랙에 재구성하기 위해서 데이터 열(data sequence)이 기록된다.
한편, 기록매체로의 PCM 신호의 기록시간이 통상 기록의 기록시간의 대략 2배가 되는 장시간 기록은 오디오 신호와 같은 기록되어야 할 신호의 샘플링 주파수를 32KHz로 설정하고, 또 신호를 12비트로 비선형 양자화하에 달성할 수있다. 그러나, 1워드가 12비트로 구성되므로, 심볼 단위로 신호를 기록하는 종래의 방법을 사용할 수가 없었다.
회전헤드형식의 디지탈 오디오 테이프 레코더(R-DAT)의 기술경향은EIAJ(Electronics Industries Association of Japan)에 의해서 1984년 출판된 "ELECTRONICS"지의 Vol. 24. No. 10, p.36-42에 기술된 "DAT Metting Activity", 특히 p. 40~42에 설명되어 있다.
본 발명의 목적은 데이터처리의 단위로서, 1위드의 비트수보다 적은 소정의 비트수로 원드신호를 기록하는 PCM 신호의 기록 윤곽에 적합한 소정의 비트수로 구성된 각 워드를 갖는 입력 PCM 신호를 변환하기 위한 방법과 장치를 제공하는 것이다.
본 발명의 다른 목적은 8비트 단위로 신호가 처리되는 시스템에 적용할 수 있도록 12비트 워드를 갖는 PCM 신호를 8비트 데이터로 변환하여, 16비트 워드를 갖는 PCM 신호를 기록할 때에 달성되었던 것과 같은 에러잠복능력을 갖는 회전헤드형식의 PCM 레코더에 적합한 PCM 신호의 기록방법을 제공하는 것이다.
본 발명의 상기 및 그 밖의 목적과 새로운 특징은 본 명세서의 기술 및 첨부도면으로 명확하게 될 것이다.
본 발명의 하나의 특징에 따르면, 2워드 PCM 신호를 각 워드의 상위비트로 각각 구성된 심볼과 각 워드의 하위비트로 구성된 심볼을 포함하는 3개의 심볼데이터로 변환하고, 인접한 PCM 신호를 8비트 또는 심볼단위로 신호의 처리를 용이하게 하고, 또 재생시에 발생하는 버스트 에러에 대해 보상하도록, 각각 다른 트랙위에 홀수 데이터와 짝수 데이터가 서로 거리를 두고 떨어져서 배열된다.
본 발명의 다른 특징에 따르면 샘플링된 2개의 채널의 PCM 신호가 3심볼 데이터로 변환되어 다수의 회전헤드에 의해서 기록매체위에 기록된다. 기록매체위의 교호(쌍)의 트랙위에 기록될 수 있는 소정의 심볼데이터수는 시계열적으로 PCM 신호의 전반과 후반에 해당하는 2개의 군으로 분류되고, PCM 신호의 전반의 짝수 PCM 신호에 해당하는 짝수 심볼데이터와 후반의 홀수 PCM 신호에 해당하는 홀수 심볼 데이터는 고호 트랙중의 하나에 기록되며, 전반의 홀수 PCM 신호에 대한 홀수 심볼 데이터는 고호 트랙중의 하나에 기록되며, 전반의 홀수 PCM신호에대한 홀수 심볼 데이터와 후반의 짝수 PCM 신호에 대한 짝수 심볼 데이터는 다른 트랙위에 기록되어 고호(쌍)의 트랙의 단위로 데이터가 이루어진다. 한편, 에러 검출 및 정정 코드가 각가 트랙에서 이루어진다. 각 트랙의 전반과 후반에서 PCM 신호의 짝수 심볼 데이터와 홀수 심볼 데이터는 이순서로 또는 반대 순서로 배열된다.
본 발명에 따르면, 12비트 워드를 갖는 PCM 신호는 신호가 8비트로 처리되는 시스템에 이 신호를 적용할 수 있도록, 간단한 처리에 의하여 8비트 신호로 변환될 수 있다. 만일 1트랙의 버스트 에러나 또는 트랙의 절반까지의 다수 트랙위의 버스터 에러가 발생하면, 재생시에 시계열적으로 버스터 에러로서 나타나지 않아서, 에러 잠복 능력을 향상시키게 된다.
이하, 본 발명의 구성에 대해서 실시예와 함께 설명한다.
본 발명의 1실시예를 제 1 도 및 제 2 도를 참조해서 설명한다.
제 1 도 및 제 2 도는 본 발명의 데이터포맷을 도시한 것이다. 12비트 워드를 갖는 2채널의 PCM 신호가 2트랙에 배열되어 있다. 제 1 도는 제 1 트랙위의 데이터포맷을 도시한 것이고, 제 2 도는 제 2 트랙위의 데이터포맷을 도시한 것이다. (1)은 8비트로 구성된 1심볼을 나타내고, (2)는 1블럭을 나타낸다. 통상, 1워드신호는 상위심볼과 하위심볼의 2심빌로 구성된다. 1블럭은 32심볼로 구성되고, 128블럭은 1트랙위에 기록된다. (3)은 제 1 에러검출 및 정정코드 Q를 나타내고, (4)는 제 2 에러검출 및 정정코드 P를 나타낸다.
샘플링 주파수가 32KHz(1워드=12비트를 위한)이고, 또 회전헤드의 회전속도가 1000rpm일때, 회전당 데이터의 수는 1920워드/채널이다. 2개의 기록헤드가 실린더위에 탑재되어 있으므로 1회전에 2트랙이 기록된다. 따라서 1920워드/채널의 데이터가 반드시 2트랙위에 배열된다.
2채널의 PCM 신호는 편리를 위해서 좌측 및 우측신호 L 및 R 로 나타낸다. 16비트 워드를 갖는 2채널의 PCM 신호의 제 1 및 제 2 트랙위에 데이터포맷을 제 9 도 A 및 B에 도시하였다. 상세한 것을 1984년 3월 19일에 출원되었고, 현재의 양수인에게 양도된 일본국 특허출원 제 54-50915호를 기초로 해서, 1985년 3월 15일 히로아끼 다까하시와 마사하루 고바야시, 다까하루 노구찌, 도시푸미 시부야 및 다까오 아리이에 의한 "Potary Head Type PCM Recording and Reproduction Method and ststem"명칭의 미국 특허출원 제 712, 094호(1985년 3월 18일에 출원된 유럽 특허출원 제 85103110. 4호)에 기재되어 있으며, 그 기재된 것을 참고로하여 여기에 인용하였다.
제 1 도에 있어서 L채널의 PCM 신호를 L0~L1919로 나타낸다. 첨자는 시계열상의 순번을 나타낸다. 사선을 친 곳은 비어 있는 영역이다.
12비트 워드를 갖는 2개의 L 및 R채널의 PCM 신호에 있어서, 같은 순번에서의 L채널 데이터의 2워드(24비트) 및 R채널 데어터의 2워드는 3심볼 데이터로 변환된다. 12비트 Lr의 8비트는 1심볼로 되고, 12비트 Rr의 8비트는 1심볼로 되며, 12비트 Lr의 나머지 4비트 및 12비트 Rr의 나머지 4비트는 1심볼로 된다. 이렇게 변환된 3개의 8비트 데이터중에서 L 및 R PCM 신호에 관계되는 L 및 R 홀수 데이터와 L 및 R 짝수 데이터는 서로 다른 트랙상에서 거리를 두고 배열된다.제 1 도에 도시한 바와같이 0번째-959번째의 3심볼 데이터에 있어서, 짝수 데이터는 제 1 트랙의 전반에 배열되고, 홀수 데이터는 제 2 트랙의 후반에 배열된다. 제 2 도에 도시한 바와같이, 960번째-1919번째의 데이터에 있어서, 짝수 데이터는 제 2 트랙의 전반에 배열되고, 홀수 데이터는 제 1 트랙의 후반에 배열된다. 이 배열에 의해서 만일 1트랙의 버스터 에러나 또는 트랙의 절반까지의 2트랙위의 버스트에러가 발생하더라도, 재생시에 시계열상에서 버스트에러가 나타나지 않는다.
각 트랙의 전반과 후반의 각 영역에서 데이터는 2개의 연속된 심볼이 같은 블럭내에서 가깝게 배열되도록 배열된다. 예를 들면, 제 1 트랙의 전반에서 제 1심볼 L0및 제 2 심볼 L0/R0은 제 1 블럭내에서 제 1 및 제 3 의 위치에 배열되고, 제 3 심볼 R0및 제 4 심볼 L2느 제 3 블럭내에서 제 1 및 제 3 의 위치에 배열되며, 이하 마찬가지로 배열된다. L 채널의 1워드 및 R 채널의 1워드에 있어서의 데이터가 연속된 심볼내에 포함되어 있기 때문에, 만일 에러가 양쪽 심볼에서 발생했다 하더라도 에러잠복능력은 영향을 받지 않는다. 연합된 워드의 심볼은 다음에 설명할 제 2 에러검출 및 정정코드열에 포함되도록 블럭내의 고호위치에 배열된다.
이렇게 해서 배열된 데이터는 재생시에 에러가 검출되어 정정될 수 있도록 거기에 부가된 제 1 에러 검출 및 정정코드(패리티 심볼 Q)(3) 및 제 2 에러검출 및 정정코드(패리티 심볼 P)(4)를 갖는다. 에러검출 및 정정코드를 부가하기 위해서 제 1 에러검출 및 정정코드(3)이 첫번째에 부가되고, 다음에 제 2 에러검출 및 정정코드(4)가 부가된다. 제 1 에러검출 및 정정코드(Q)(3)은 모든 4블럭의 동일한 심볼수(예를들면 제 0번째, 제 4번째, 제 8 번째, …블럭의 첫번째 심볼)에 부가되고, 또 그것은 32심볼의 코드길이의 7의 최소거리를 갖는 리드-솔로몬코드(Reed-Solomon)가 사용된다. 제 2 에러검출 및 정정코드(P)(4)는 모든 2블럭의 홀수와 짝수 심볼에 부가되고, 또 그것은 32심볼의 코드 길이와 5의 최소거리를 갖는 리드-솔로몬코드가 사용된다.
제 3 도는 자기테이프를 나타내고 자기테이프위의 트랙 배열을 도시한 것이다. (5)는 자기테이프를 나타내고, (6) 및 (7)은 한쌍의 회전헤드에 의해 주사된 제 1 및 제 2 트랙을 나타낸다. 데이터는 제 1 도에 도시한 바와같이 2개의 인접한 트랙내에 분산되어 있다.
제 4 도는 12비트 PCM 신호를 8비트 심볼로 변환하기 위한 방법을 도시한 것이다. 상술한 바와같이, 같은 순번에서 L채널의 12비트 데이터(8) 및 채널의 12비트데이터(9)는 3심볼(8비트/심볼)데이터(10)-(12)로 변환된다. 심볼(10)은 L채널의 데이터(8)의 8상위비트로 구성되고, 심볼(12)는 R채널의 데이터(9)의 8상위비트로 구성되며, 또 심볼(11)은 L채널의 데이터(8)의 4하위 비트 및 R 채널이 데이터(9)의 4하위비트로 구성된다. 이러한 비트 변환포맷에 의해서 다음에 설명하게 될 간단한 회로로 변환이 달성된다.
제 5 도는 본 발명에 따라서 PCM 신호를 기록하는 PCM 신호의 기록장치의 구성을 도시한 것이다. (20)은 PCM 신호원 또는 전송선으로부터 PCM 신호가 되는 공급되는 입력단자, (21)은 데이터버스, (22)는 데이터변환회로, (23)-(26)은 메모리, (27)은 메모리를 위한 제어회로, (28)은 에러검출 및 정정코드 가산회로, (29)는 기록회로, (30)은, 증폭기, (31)은 회전헤드를 나타낸다.
입력단자(20)에 인가된 12비트 PCM 신호는 데이터 변환회로(22)에 의해서 8비트 데이터로 변환되고, 8비트 데이터는 데이터버스(21)을 거쳐서 메모리(23)-(26)내에 저장한다. 메모리(23)-(26)내에 저장된 PCM 신호는 에러검출 및 정정코드 가산회로(28)에 공급되어, 거기에 그들이 삽입되고, 또 제 1 에러검출 및 정정코드(3)과제 2 에러검출 및 정정코드(4)가 부가된다. 그곳에 부가된 패리팀심볼을 갖는 삽입된 PCM 신호는 한 블럭씩 기록회로(29)에 공급된다. 기록회로(29)에서 동기 신호와 서브(sub)코드가 부가되고, 신호가 증폭기(30)에 의해서 증폭되어 회전헤드(31)에 의해서 자기 테이프위에 기록된다.
메모리(23)-(26)은 각각 1트랙의 메모리용량을 갖는다. 메모리(23) 및 (25)는 제 1 도에 도시한 데이터를 저장하고, 메모리(24) 및 (26)은 제 2 도에 도시한 데이터를 저장한다. 이들 메모리는 4메모리 장소로 분할된 1개 또는 2개의 메모리일 것이다.
제 6 도는 메모리의 동작을 설명한 것이다. (32)는 데이터의 입력, (33)은 에러검출 및 정정코드의 가산, (34)는 데이터의 출력, (35)는 자기테이프로의 기록 신호를 타나낸다. 데이터/코드열내에 삽입된 번호(23)-(26)은 동작메모리를 나타낸다. 데이터 변환회로(22)로부터 출력된 PCM 신호는 L채널 및 R채널내의 1920워드의 데이터가 회전헤드(31)의 1 회전(360°)기간 동안에 각각 메모리(23) 및 (24)에 지정되도록 메모리(23) 및 (24)에 저장된다. 메모리의 어스레스는 제 1 도 및 제 2 도에 도시한 바와같이 데이터가 배열되도록 제어회로(27)에 의해서 제어된다. 메모리(23) 및 (24)에 저장된 데이터는 다음 회전기간동안에 그곳에 부가된 에러검출 및 정정코드를 갖고 데이터가 자기테이프(5)위에 기록된다. 메모리(23) 및 (24)내에 저장되었던 데이터가 기록될 때에 공급된 PCM 신호는 메모리(25) 및 (26) 내에 저장되어 다음 회전기간 동안에 자기테이프(5)위에 기록된다.
제 7 도는 데이터 변환회로(22)를 도시한 것이다. 이 회로는 12비트 신호를 8비트신호로 변환한다. (37)-(39)는 래치회로를 나타내고, (40) 및 (41)은 스위칭회로를 나타낸다. 그 동작을 제 8 도 의 타이밍도를 참조해서 설명한다.
신호원으로부터 공급되고, 또 멀티플랙서에 의해서 L 및 R채널로 교호로 배열된 PCM 신호는 입력단자(20)에 공급된다. 입력단자(20)에 인가된 L채널 PCM 신호의 8상위비트는 래치회로(37)내에 래치되고, 또 4하위비트는 스위칭회로(40)을 거쳐서 래치회로(38)내에 래치된다. 래치회로(37)내에 래치된 L채널의 8상위 비트는 심볼(10)으로서 출력단자(36)에 공급된다.
다음에 입력단자(20)에 인가된 R채널 PCM 신호의 8상위비트는 래치회로(37)내에 래치되고, 또 4하위비트는 스위칭회로(40)을 거쳐서 래치회로(39)내에 래치된다.
래치회로(38) 및 (39)내에 래치된 8비트 데이터는 심볼(11)로서 출력단자(36)에 공급된다. 결국, 래치회로(37)내에 래치된 R채널의 8상위비트는 심볼(12)로서 출력단자(36)에 공급된다.
본 실시예에 따르면, 12비트의 PCM 신호를 간단히 처리에 의해 8비트 데이터로 변환할 수 있고, 또 버스트에러에 대한 에러잠복능력을 증대시킬 수 있다. 이상 본 발명자에 의해서 이루어진 발명은 상기 실시예에 따라 구체적으로 설명했지만, 본 발명은 상기 실시예에 한정되는 것은 아니고, 그 요지를 이탈하지 않는 범위에서 여러가지로 변경가능한 것은 물론이다.

Claims (7)

  1. k채널로부터 공급되는 m비트워드를 갖는 PCM 신호를 n비트워드를 갖는 데이터로 변환하기 위한 PCM 신호의 기록방법에 있어서(단, m, n은 양의 정수, , m〉n, km은 n의 정배수), 각각의 k채널로부터의 1워드로 되는 k워드의 PCM 신호를 입력시키는 스텝, 각각 n상위비트로 구성된 k데이터를 발생하기 위해서 PCM 신호의 k워드의 각각의 n상위비트를 한정하는 스텝, PCM 신호의 각 k워드의 (m-n)하위비트를 발생하고, k·(m-n)하위비트로 구성된 k·(m-n)/ n데이터를 발생하기 위해서 k·(m-n)비트를 n비트로 분할하는 스텝과 기록워드의 단위로 n비트를 갖는 발생된 데이터를 소정의 트랙위에 기록하는 스텝을 포함하는 PCM 신호의 기록방법.
  2. 특허청구의 범위 제 1 항에 있어서, 상기 m비트, n비트, k채널을 각각 12비트, 8비트, 2채널이며, 2위드의 입력 PCM 신호가 3심볼의 8비트 데이터로 변환되고, 심볼데이터는 기록데이터가 소정의 길이의 제 1 및 제 2 의 인접트랙내에서 이루어지도록 형성되며, 또 2워드부터 변환된 3심볼 데이터는 트랙내의 데이터 블럭내에서 인접하는 영역내에 배열되는 PCM 신호의 기록방법.
  3. 특허청구의 범위 제 2 항에 있어서, 상기 트랙은 회전헤드로 기록매체를 주사하는 것에 의해 형성된 다수의 트랙쌍을 포함하고, 트랙쌍위에 기록될 입력 PCM 신호의 i워드/채널은 시계열상에서 전반과 후반으로 분할되며, PCM 신호의 전반의 짝수데이터에 해당하는 변환된 워드데이터와 PCM 신호의 후반의 홀수데이터에 해당하는 변환된 워드데이터는 트랙쌍의 제 1 트랙위에 기록될 데이터를 구성하고 PCM 신호의 전반의 홀수데이터에 해당하는 변환된 워드데이터와 PCM 신호의 후반의 짝수 데이터에 해당하는 변환된 워드데이터는 트랙쌍의 제 2 트랙위에 기록될 데이터를 구성하는 PCM 신호의 기록방법.
  4. 특허청구의 범위 제 3 항에 있어서, 짝수 또는 홀수데이터는 각 트랙의 전반에 기록되고, 홀수 또는 짝수데이터는 각 트랙의 후반에 기록되는 PCM 신호의 기록방법.
  5. 다수의 기록헤드, 상기 헤드가 탑재된 회전실린더, 각 워드내에서 첫번째 비트수를 갖는 2채널의 PCM 신호를 입력하도록 신호원에 결합된 신호입력회로, 상기 신호입력회로로부터 공급된 PCM 신호를 각 심볼내에서 상기 첫번째 비트수보다 작은 두번째 비트수를 갖는 심볼데이터로 변환하는 변환회로, 에러검출 및 정정코드와 부가적인 코드를 상기 변환회로로부터 공급된 심볼데이터에 부가하는 신호처리회로와 상기 신호처리회로로부터의 출력을 기록테이프위의 다수의 트랙쌍에 기록하는 기록회로를 포함하는 회전헤드형식의 PCM 신호기록장치의 신호기록방법에 있어서, 상기방법은 가) 상기 신호원으로부터 공급된 2채널의 PCM 신호를 각 워드의 두번째 상위비트수로 각각 구성된 심볼과 양쪽 위드의 나머지 하위비트로 구성된 두번째 비트수를 갖는 심볼을 포함하는 다수의 심볼데이터로 변환하는 스텝, 나) 상기 2채널의 입력 PCM 신호의 전반에 해당하는 제 1 심볼 데이터와 짝수데이터, 후반에 해당하는 제 2 심볼데이터와 홀수 데이터를 제 1 트랙내에 배열하고, 후반에 해당하는 제 3 심볼데이터와 짝수데이터, 전반에 해당하는제 2 심볼데이터와 홀수 데이터를 제 2 트랙내에 배열하도록 상기 변환된 심볼데이터를 2개의 트랙데이터의 단위로 저장하는 스텝, 다) 상기 트랙내에서 저장된 심볼데이터에 따라서 각 트랙에 대한 에러검출 및 정정코드를 발생하는 스텝과 라) 상기 에러 검출 및 정정코드와 저장된 심볼 데이터를 테이프위에 기록하기 위해서 그것들을 상기 회전헤드에 공급하는 스텝을 포함하는 회전헤드형식의 PCM 신호기록장치의 신호기록방법.
  6. 특허청구의 범위 제 5 항에 있어서, 상기 제 1 및 제 3 데이터의 세트 또는 상기 제 2 또는 제 4 데이터의 세트는 상기 제 1 및 제 2 트랙위에 첫번째로 기록되는 신호기록방법.
  7. 가) 기록매체와 맞물리도록 되고 다수의 기록헤드(31)을 갖는 회전실린더, 나) 각 워드내에서 각각 첫번째 비트수를 갖는 다수 채널의 PCM 신호를 입력하도록 신호원에 결합된 입력회로, 다) 상기 입력회로로부터 공급된 채널 PCM 신호를 상기 첫번째 비트수 보다 작은 두번째 비트수로 각각 구성되는 다수의 심볼로 변환하고, 동일한 시계열에서 PCM 신호의 두번째 상위비트수로 각각 구성된 심볼과 PCM 신호의 나머지 하위비트로 구성된 두번째 비트수를 갖는 심볼을 포함하는 다수의 심볼데이터를 발생하는 데이터변환회로(22), 라) 상기 데이터 변환회로의 출력을 저장하고, 다수의 트랙의 데이터를 저장하기 위한 용량을 갖는 메모리(23~26), 마) 기록매체의 트랙내에 저장된 심볼데이터를 기록하도록 메모리의 리드, 라이트를 제어하고, 제 1 및 제 2 트랙의 쌍에서 데이터량에 의해서 정해지는 데이터 단위로 저장된 심보데이터를 리드하고, 또 심볼데이터를 입력 채널 PCM 신호의 전반에 해당하는 제 1 심볼데이터와 짝수데이터, 후반에 해당하는 제 2 심볼데이터와 홀수 데이터, 후반에 해당하는 제 3 심볼데이터와 짝수데이터 및 전반에 해당하는 제 4 심볼데이터와 홀수데이터로 배열하고, 또 상기 제 1 및 제 2 심볼데이터를 제 1 트랙에, 상기 제 3 및 제 4 심볼데이터를 제 2 트랙에 분배하도록 제어하는 제어회로(27), 바) 상기 제 1 및 제 2 심볼데이터의 세트와 상기 제 3 및 제 4 심볼데이터의 세트의 각각에 에러검출 및 정정코드를 가산하는 에러검출 및 정정코드 가산회로(28)과 사) 상기 제 1, 제 2, 제 3 및 제 4 의 심볼데이터와 거기에 부가된 상기 에러검출 및 정정코드를 각각의 회전헤드에 공급하는 기록회로(29)를 포함하는 회전헤드형식의 PCM 신호의 기록장치.
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