KR880000974A - 휴즈회로와 그 내의 휴즈상태를 검출하는 검출회로를 갖는 반도체장치 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1도는 여분형태를 적용하는 반도체 메모리장치에 응용되는 본 발명에 의한 반도체 장치의 일실시예를 나타내는 시스템 개통도. 제2도는 제1도에 보인 반도체 장치내의 여분제어회로의 일실시예를 나타내는 시스템 회로도. 제3도는 제2도에 나타낸 여분제어회로의 요부를 나타내는 회로도.
Claims (4)
- 제1및 제2전원단자와, 휴즈들의 용단 및 비용단 상태들에 의해 정보를 기억시키기 위한 제1및 제2휴즈들을 갖는 상기 제1및 제2전원단자들간에 동작가능하게 연결되는 휴즈회로 수단과, 휴즈들중 적어도 하나가 용단될 때 제1논리레벨을 갖는 출력신호와 두 휴즈를 모두가 비용단될때 제2논리레벨을 갖는 출력신호를 제공하기 위해 상기 휴즈회로 수단에 동작가능하게 연결되는 정보출력회로 수단과, 그리고 휴즈들중 어느 것이 비용단됐는지를 검출하기 위한 상기 휴즈회로 수단에 동작가능하게 연결되는 검출회로 수단을 포함하며, 상기검출회로 수단은 제1휴즈와 병렬로 연결되는 제1트랜지스터와 제2휴즈와 병렬로 연결되는 제 2 트랜지스터들을 갖고 있으며, 상기 제1트랜지스터는 제 1 검사신호에 응답하여 도통되며, 상기 제2트랜지스터는 제2검사신호에 응답하여 도통되는 것이 특징인 휴즈회로와 그내의 휴즈상태를 검출하는 검출회로를 갖는 반도체 장치.
- 제1항에서, 상기 제1및 제2검사신호들은 상이한 논리레벨들을 갖고 있으며, 상기 정보출력회로 수단은 제1검사신호가 상기 제1트랜지스터에 걸릴 때 상기 제2휴즈가 비용단됨을 나타내도록 제2논리레벨을 갖는 출력신호를 발생시키며 또한 제2검사신호가 상기 제2트랜지스터에 걸릴때 상기 제1휴즈가 비용단됨을 나타내도록 제2논리레벨을 갖는 출력신호를 발생시키는 것이 특징인 휴즈회로와 그 내의 휴즈상태를 검출하는 검출회로를 갖는 반도체 장치.
- 제1항에 있어서, 상기 정보출력회로 수단은 상기 제1및 제2검사신호들이 상기 제1및 제2트랜지스터들의 각 베이스들에 걸릴때 상기 휴즈들을 통해 얻은 신호들의 논리합을 얻기 위한 OR회로를 포함하는 것이 특징인 휴즈회로와 그내의 휴즈상태를 검출하는 검출회로를 갖는 반도체 장치.
- 제1항에서, 메모리셀들의 어레이를 보충하는 메모리셀 어레이를 더 포함하며, 상기 휴즈회로 수단은 상기 메모리셀 어레이내의 결합 메모리 셀들에 관한 어드레스정보를 기억시키는 것이 특징인 휴즈회로와 그내의 휴즈상태를 검출하는 검출회로를 갖는 반도체 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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