KR20010029903A - 화상 표시 장치 및 그 구동 방법 - Google Patents

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Abstract

화상 표시 장치는 도트 매트릭스의 발광 소자, 드라이버 회로, 스위칭 회로를 구비하고 한다. 도트 매트릭스는 m-라인 x n-컬럼으로 배열된 복수의 발광 소자이고, 각 라인의 각 발광 소자의 한 단자는 전류 라인에 접속된다. 드라이버 회로는 입력 조사 신호에 따라 발광 소자의 활성 또는 비활성을 제어한다. 활성 상태시, 스위칭 회로는 공통 소스라인을 부동하고, 비활성시, 모든 소스 라인을 접지로 방전한다.

Description

화상 표시 장치 및 그 구동 방법{IMAGE DISPLAY APPARATUS AND ITS METHOD OF OPERATION}
본 발명은, 매트릭스 표시 패널로 배열된 발광 다이오드(light emitting diode, 이하, LED라 칭함)와 같은 복수의 발광 디바이스를 구비한 장치에 관한 것이다.
최근, 1000mcd 이상의 밝은 적색, 녹색 및 청색(RGB)의 LED가 개발되었고, 대규모 LED 디스플레이의 제조가 가능해졌다. 이러한 LED 디스플레이는 저전력 소모, 경량, 및 얇은 패널 디스플레이의 가능성과 같은 특징을 갖는다. 또한, 외부에서 사용될 수 있는 대규모 디스플레이에 대한 요구가 급격히 증가되었다.
실제 대규모 디스플레이는 복수의 LED 유니트를 조립함으로써, 장착 공간에 적합하도록 구성된다.
또한, LED 디스플레이는 각각의 개별 LED를 구동할 수 있는 드라이버 회로를 구비하고 있다. 특히, 디스플레이 데이터를 각각의 LED 유니트에 전송하는 각각의 LED 디스플레이에 접속되고, 복수의 LED 유니트는 대규모의 LED 디스플레이를 형성하도록 접속된다. 사용된 LED 유니트가 많으면 많을수록 LED 디스플레이의 규모가 커지게 된다. 예를 들어, 대규모 디스플레이는 수직 300 x 수평 400, 또는 120,000 LED 유니트를 사용할 수 있다.
LED 디스플레이는 다이나믹 드라이버 시스템을 그 드라이버 방법으로서 사용하고, 특히, 디스플레이는 후술하는 바와 같이, 구동시 접속된다.
예를 들어, mxn 도트 매트릭스 LED 유니트에 있어서, 각 라인내의 각 LED 애노드는 공통 소스 라인에 접속되고, 각 컬럼의 각각의 LED 캐소드는 공통 전류 라인에 접속된다. m-라인 공통 소스 라인은 소정의 주기로 디스플레이하기 위해 순차적으로 턴온된다. 예를 들어, m-라인 공통 소스 라인 스위칭은 어드레스 신호에 기초하여 디코더 회로를 경유하여 수행된다.
그러나, 선택된 공통 소스 라인에 접속된 LED가 관련 분야의 장치에서 활성화될 때, 전하(charge)는 선택되지 않은 공통 소스 라인에 접속된 비활성 LED에 축적된다. 이들의 공통 소스 라인이 선택된 때, 전하가 비활성 주기 동안에 형성되기 때문에, 과잉전류가 흐르게된다. 이 문제점의 결과로서, 저 레벨의 광의 방출을 차단하도록 제어된 LED 및 충분한 화상 콘트라스트가 획득되지 않는다.
그러므로, 본 발명의 제 1 목적은 축적된 전하의 효과를 감소시켜, 고화질의 화상 표시 장치 및 그 구동 방법을 제공하기 위한 것이다.
또한, LED 디스플레이에 있어서, 보정된 화상 데이터는 고화질의 화상을 표시하기 위해 각각의 LED 디바이스에 전형적으로 사용된다. 이는 예를 들어, 디바이스 대 디바이스 LED의 휘도 변화가 상대적으로 크기 때문이다.
특히, 제어 회로는 각각의 LED 디바이스에 대응하는 보정 데이터를 저장하기 위해 판독전용메모리(ROM) 보정 데이터 메모리부를 갖는다. ROM 내에 저장된 보정 데이터에 기초한 보정된 화상 데이터가 표시된다.
그러나, 보정 데이터가 관련 분야 장치의 ROM에 저장되기 때문에 보정 데이터는 재기입될 수 없다. 결과적으로, 관련 분야 장치는 상이한 보정 데이터가 필요로 한때 ROM과 별도로 재기입가능한 메모리 디바이스를 제공할 필요가 있다는 문제점을 갖고 있다.
그러므로, 본 발명의 제 2 목적은 1개의 보정 데이터 메모리부에 복수의 보정 데이터를 저장할 수 있는 화상 표시 장치를 제공하기 위한 것이다.
또한, LED 표시상에 화상 데이터를 정확하게 나타내기 위해, 화상 표시 장치내의 각각의 LED 디바이스의 광 방출 특성(구동 전류 대 휘도 특성)이 균일하여야 한다. 그러나, LED가 반도체 기술에 의해 웨이퍼 상에 제조되기 때문에, 발광 특성 변화는 로트 대 로트, 웨이퍼 대 웨이퍼, 및 칩 대 칩에 따라 발생된다. 그러므로, 각 화소에 대한 LED의 발광 특성 차이를 보상하기 위해 화상 데이터 진폭을 보정할 필요가 있다.
관련 분야 화상 데이터 보정의 예가 후술된다.
도 12를 참조하면, 관련 분야 LED 표시의 한 실시예의 블록도가 도시된다. 참조번호(102)는 m-라인 n-컬럼 LED 매트릭스이고, 참조번호(107)는 제어 회로이며, 참조번호(105)는 마이크로프로세서 유니트(MPU)이고, 참조번호(106)는 보정 데이터를 저장하기 위한 ROM이며, 참조번호(102)는 공통 드라이버 회로이고, 참조번호(103)는 수평 드라이버 회로이고, 참조번호(109)는 화상 데이터를 보정하기 위한 보정회로이며, 참조번호(11)는 보정 데이터를 일시적으로 저장하기 위한 RAM이다. 수평 드라이버(103), 보정 회로(109), 및 RAM(110)은 LED 매트릭스(k=1 내지 n)의 각 컬럼에 제공된 LED 드라이버 집적회로 [(104(k)]에 집적된다.
우선, 조사(illumination)를 표시하기 전에, ROM내에 저장된 mxn 화소에 대한 보정 데이터(correction data)는 고속 버퍼로 전송된다. RAM(110)은 고속 버퍼로서 사용된다. 보정 데이터 전송은 아래와 같이 수행된다. 첫째로, ROM(106)에 보유된 보정 데이터는 MPU(105)에 의해 독출된다. 그후, MPU (105)는 어드레스 버스(111)를 경유하여 LED 드라이버 IC[104(k)]를 선택하고, 각각의 선택된 컬럼에 대응하는 보정 데이터의 1 컬럼 값 또는 m-화소를 순서에 따라 출력한다. 보정 데이터 출력은 보정 데이터 버스(112)를 경유하여 각각의 LED 드라이버 IC[104(k)]에 입력되어 LED 드라이버 IC[104(k)]의 내부 RAM(110)내에 저장된다.
LED가 조사된 때, RAM(110)내에 저장된 보정 데이터는 보정 회로(109)에 순차적으로 독출된다. 입력 화상 데이터(IMDATA)는 화상 데이터 보정을 달성하기 위해 보정 데이터에 기초한 각각의 화소에 대해 증가 또는 감소된다. 보정된 화상 데이터는 드라이버 회로(103)로 출력되고, 드라이버 회로(103)는 보정된 화상 데이터에 기초한 각각의 LED에 대한 구동 전류를 발생시킨다.
그러나, 상술한 관련 분야의 LED 표시에 있어서, 보정 데이터의 총 mxn 화소 값은 버퍼, 또는 RAM(110)에 저장되어야 하고, 표시 화소 카운트가 증가함에 따라, 매우 큰 RAM 용량이 필요하게 된다. 또한, 보정 회로(109)에서 RAM(110)으로부터 독출된 보정 데이터의 동작은 RAM의 용량이 증가하면 복잡하게 된다. 이외의 문제점에 있어서, 어드레스 버스(111) 및 데이터 버스(112) 모두가 각각의 n 드라이버 IC(104)(1 내지 n)으로 분기하고, 복합 와이어링을 형성하여 주변 회로 영역이 큰 각각의 n 드라이버(104)(1 내지 n)와 접속한다.
그러므로, 본 발명의 제 3 목적은 이러한 문제점을 고려하여, 버퍼내에 저장된 데이터를 감소시킬 수 있고, 간단한 회로 구조로 화상 데이터 보정을 달성 할 수 있는 화상 표시 장치를 제공하기 위한 것이다.
본 발명의 상기 및 다른 목적은 첨부 도면과 함께 상세한 설명을 참조함으로써 명백해진다.
도 1은 본 발명의 한 실시예의 화상 표시 장치의 구조적 포맷을 도시한 개념도,
도 2는 도 1에 도시한 화상 표시 장치의 특정 예를 도시한 블록도,
도 3은 화상 표시 장치의 다른 특정 예를 도시한 블록도,
도 4는 도 3에 도시한 공통 소스 드라이버 및 스위칭 회로 제어의 타이밍도,
도 5는 본 발명의 다른 실시예의 화상 표시 장치의 구조적 포맷을 도시한 개념도,
도 6은 도 5에 도시한 화상 표시 장치의 특정 예를 도시한 블록도,
도 7은 도 6의 특정 실시예에서 전기적으로 소거가능하고 프로그램가능한 ROM(EEPROM) 및 직렬 통신 인터페이스의 상세한 구조를 도시한 블록도,
도 8은 본 발명의 다른 실시예의 화상 표시 장치의 구조적 포맷을 도시한 개념도,
도 9는 도 8에 도시한 화상 표시 장치의 특정 예를 도시한 블록도,
도 10은 도 9에 도시한 화상 표시 장치에서의 보정 데이터 전송 타이밍을 도시한 타이밍도,
도 11은 도 9에 도시한 화상 표시 장치에서의 제어 라인 수와 ROM 독출 개시 어드레스 사이의 관계를 도시한 개략도,
도 12는 관련 분야 화상 표시 장치의 회로 구조를 도시한 블록도이다.
〈도면의 주요부분에 대한 부호의 설명〉
1: 전류 소스 스위칭 회로 2: 스위칭 회로부
3: 정전류 제어 회로부 4: 발광 다이오드(LED)
5: 공통 소스 라인 6: 전류 라인
10: 도트 매트릭스 11: 디코더
12: 공통 소스 드라이버 13: 스위칭 디코더 회로
20: 버퍼 메모리부 21: 표시부
22: 수직 드라이버부 23: 수평 드라이버부
24: 화상 데이터 보정부 25: 제어부
26: 보정 데이터 메모리부 27: 화상 데이터 입력부
28: 통신 제어부 31: 시프트 레지스터
32: 메모리 회로 33: 카운터
34: 데이터 비교기 35: 정전류 드라이버부
41: LED 도트 매트릭스 42: 공통 드라이버
43: LED 드라이버 IC의 드라이버부 44: LED 드라이버 IC
45: 제어부 46: EEPROM
47: 명령 제어부 48:직렬 통신 인터페이스
49: 보정 회로 401: 레지스터
402: 시프트 레지스터
본 발명의 화상 표시 장치는 도트 매트릭스의 발광 소자, 드라이버 회로, 및 스위칭 회로를 구비한다. 도트 매트릭스는 m-라인 x n-컬럼으로 배열된 복수의 발광 소자이다. 각 라인의 각 발광 소자의 한 단자는 전류 라인에 접속되고, 각 라인의 각 발광 소자의 다른 단자는 공통 소스 라인에 접속된다. 드라이버 회로는 입력 조사 신호에 따라 발광 소자의 활성 또는 비활성을 제어한다. 표시 구동 활성 상태시, 드라이버 회로는 입력 표시 데이터에 따라 각 공통 소스 라인과 각 전류 라인의 한 단부의 접속을 제어한다. 스위칭 회로는 공통 활성 상태시 각 공통 소스 라인의 접속을 부동하고, 비활성시, 모든 소스 라인을 접지에 접속한다.
이 화상 표시 장치에 있어서, 비활성 상태시, 발광 소자 및 그 주변에 축적된 전하는 비활성 상태중에 스위칭 회로를 경유하여 방전된다. 결과적으로, 규정된 발광 소자의 활성 조사중에 축적된 전하의 효과는 필연적으로 제거되고, 고화질의 화상 표시 장치가 실현된다.
본 발명의 화상 표시 장치에 있어서, 드라이버 회로는 각 공통 소스 라인에 접속된 m-유니트의 전류 소스 스위칭 회로, 및 정전류 제어 회로부로 구성될 수 있다. 비활성시, 전류 소스 스위칭 회로는 입력 어드레스 신호에 의해 선택된 공통 소스 라인에 전류 소스를 접속한다. 정전류 제어 회로부는 메모리 회로를 구비하고, 이 메모리 회로는 n-화소의 순차 입력 표시 데이터에 대한 화소 레벨 데이터를 저장한다. 활성 상태시, 정전류 제어 회로부는 메모리 회로에 저장된 화소 레벨 데이터에 대응하는 화소 레벨 폭으로 전류 라인을 구동한다.
또한, 본 발명은 m-라인 및 n-컬럼 매트릭스로 배열된 복수의 발광 소자를 구비하고, 각 컬럼의 발광 소자의 한 단자가 전류 라인에 접속되고, 각 라인의 각 발광 소자의 다른 단자가 각 공통 소스 라인에 접속되는 화상 표시 장치의 구동방법이다. 이 구동방법은 조사의 상태를 제어하는 조사 제어 신호에 따라 활성 및 비활성 상태를 제어하는 단계, 입력 표시 데이터에 기초하여 활성 상태시 각 공통 소스 라인의 한 단부 및 각 전류 라인의 한 단부를 통한 전도를 제어하는 단계, 및 활성 상태시, 각 공통 소스 라인의 다른 단부를 부동하고, 비활성 상태시, 각 공통 소스 라인의 다른 단부를 접지하는 단계를 포함하는 것을 특징으로 한다.
본 발명의 화상 표시 장치의 구동방법에 있어서, 활성 상태시, 발광 소자 및 그 주변에 축적된 전하는 비활성 상태중에 스위칭 회로부를 통해 방전될 수 있다. 결과적으로, 규정된 발광 소자의 활성 조사중에 축적된 전하의 효과는 필연적으로 제거될 수 있어, 고화질의 화상 표시 장치의 구동방법이 제공된다.
또한, 본 발명의 화상 표시 장치는 m-라인 x n-컬럼 매트릭스로 배열된 발광 소자의 표시부, 각 발광 소자에 대응하는 보정 데이터를 저장하는 보정 데이터 메모리부, 및 보정 데이터에 기초하여 입력 화상 데이터를 보정하고, 보정된 화상 데이터를 사용하여 상기 표시부상에 화상을 표시하는 제어 및 드라이버 회로를 구비한다. 상기 보정 데이터 메모리부는 미리 저장된 제 1 보정 데이터를 유지하는 독출 전용 제 1 메모리 뱅크 및 기입가능한 제 2 메모리 뱅크를 갖는 단일 메모리 유니트를 구비한다.
이 구조의 화상 표시 장치는 소거하지 않고, 제 1 메모리 뱅크내에 제 1 보정 데이터를 유지할 수 있고, 제 1 보정 데이터와 다른 제 2 보정 데이터를 저장하기 위해 기입가능한 제 2 메모리 뱅크를 사용할 수 있다. 필요에 따라서, 제 1 보정 데이터 또는 제 2 보정 데이터중 어느 하나가 화상 데이터를 수정하도록 선택될 수 있다. 본 발명의 화상 표시 장치에 있어서, 보정 데이터 메모리부는 전기적으로 소거가능하고 기입가능한 비휘발성 메모리를 사용하여 구성될 수 있다.
또한, 본 발명의 화상 표시 장치는 통신 제어부를 구비할 수 있다. 이 통신 제어부는 제 2 메모리 뱅크내로 상기 제 1 보정 데이터와 다른 제 2 보정 데이터를 기입을 허용하고, 제 1 메모리 뱅크에의 기입을 금지할 수 있다. 또한, 기입가능한 제 2 메모리 뱅크를 기입을 금지하고, 이 메모리 뱅크내에 기입된 보정 데이터를 보호하도록 설정하는 것이 바람직할 수도 있다.
본 발명의 화상 표시 장치의 보정 데이터 메모리부에 있어서, 어드레스가 각 화소의 발광 소자에 대응하고, 제 1 메모리 뱅크 및 제 2 메모리 뱅크가 최상위 어드레스 비트에 의해 구별될 수 있도록 각 화소에 대해 보정 데이터를 저장하는 것이 바람직하다. 이 방식에 있어서, 최하위 어드레스 비트는 메모리 뱅크와 무관한 동일 독출 어드레스에 대해 설정될 수 있다.
또한, 전체 화상 데이터의 일부분을 표시하는 유니트에 상술된 화상 표시 장치를 구성하는 것이 바람직하다. 이 방식에 있어서, 대규모 표시 장치의 전체 화상은 복수의 이러한 표시 유니트에 의해 용이하게 조립될 수 있다.
또한, 본 발명의 화상 표시 장치는
(a) m-라인 x n-컬럼 매트릭스로 배열된 복수의 발광 소자로 이루어진 표시부,
(b) 각 라인에서 상기 표시부 및 소스 전류의 각 연속적인 라인을 선택하는 수직 드라이버부,
(c) 상기 선택된 라인에 대한 화상 데이터에 대응하는 화상 표시부의 각 컬럼에 구동 전류를 공급하는 수평 드라이버부,
(d) 각 화소에 대한 발광 소자의 변화에 따라 화상 데이터의 외부 입력, 및 상기 수평 드라이버부로의 보정된 화상 데이터의 출력을 보정하는 화상 데이터 보정부, 및
(e) 화상 데이터를 보정하기 위해 보정 데이터를 보유하는 보정 데이터 메모리부를 구비한다.
화상 데이터 보정부는 보정된 화상 데이터의 한 라인을 수평 드라이버부로 출력할 때, 상기 보정 데이터 메모리부로부터 보정 데이터의 한 라인을 독출한다.
이 시스템에 있어서, 화상 데이터 보정부내에 일시적으로 보유되어야하는 보정 데이터의 량이 감소될 수 있고, RAM과 같은 큰 용량의 메모리는 버퍼 메모리로서 사용되기 위해서 필요치 않고, 화상 데이터는 간단한 회로 구조를 통해 보정될 수 있다.
본 발명의 화상 표시 장치의 화상 데이터 보정부는 최소한 1 라인의 보정 데이터를 저장하기 위한 버퍼 메모리를 구비한다. 화상 데이터 보정부는 보정 데이터 메모리부로부터 그 다음 라인의 보정 데이터를 독출할 수 있고, 이는 1 라인의 보정된 화상 데이터를 수평 드라이버부로 출력한다. 이것은 화상 데이터 보정으로 인한 라인들 사이의 소정의 표시 시간 지연을 방지한다.
본 발명의 화상 표시 장치에 있어서, 시프트 레지스터는 버퍼 메모리로서 제공될 수 있고, 보정 데이터는 한번에 1 비트를 직접 순차적으로 시프트함으로써, 시프트 레지스터를 통해 독출될 수 있다. 이것은 보정 데이터 메모리부에 있어서, 보정 데이터를 버퍼 메모리로 전송하기 위해 분기하는 데이터 버스 라인의 필요성을 제거하고, 또한, 버퍼 메모리를 선택하기 위한 어드레스 버퍼의 필요성을 제거한다. 그러므로, 와이어링 영역은 감소될 수 있고, 와이어링 옵션은 증가할 수 있다.
또한, 본 발명의 화상 표시 장치에 있어서, 2 단의 상호접속된 레지스터가 버퍼 메모리로서 제공될 수 있다. 제 1 레지스터가 상기 보정 데이터의 1 라인을 출력할 때, 상기 보정 데이터의 그 다음 라인이 제 2 레지스터에서 독출된다. 한 라인의 보정 데이터의 출력 및 독출이 완료되는 각 시간에 제 2 레지스터로부터의 보정 데이터는 제 1 레지스터로 전송될 수 있다. 이 시스템에 있어서, 화상 데이터는 간단한 회로 구조로 보정될 수 있다.
상술한 화상 표시 장치에 있어서, 제 2 레지스터는 시프트 레지스터일 수 있고, 보정 데이터는 한 번에 1 비트를 연속적으로 시프트함으로써, 독출할 수 있다. 이것은 보정 데이터를 전송하기 위해 분기하는 데이터 버스 라인의 필요성을 제거하고, 또한, 버퍼 메모리를 선택하기 위한 어드레스 버스의 필요성을 제거한다.
본 발명의 화상 표시 장치는 발광 소자로서 LED를 사용할 수 있다. 화상 표시 장치에 있어서, LED 표시 주변 회로 구조는 간단하게 될 수 있고, 표시 장치는 콤팩트해질 수 있다.
최종적으로, 본 발명의 화상 표시 장치는 전체 화상을 부분으로 분할함으로써, 화상을 표시할 수 있다. 본 발명의 화상 표시 장치가 주변회로 구조를 간단하게 할 수 있기 때문에, 전체 화상의 일부를 표시하는 화상 데이터 유니트에 사용하기에 적합하다 예를 들어, 대규모 LED 표시 장치에 사용된 LED 유니트에 적합하다.
(실시예)
도 1은 도트 매트릭스(dot matrix)내에 축적된 전하를 방전하기 위해 스위칭 회로부를 구비한 화상 표시 장치를 도시한 개념도이다. 도 1의 표시 장치는 LED 도트 매트릭스(10), 전류 소스 스위칭 회로(1), 정전류 제어 회로부(3), 및 스위칭 회로부(2)를 구비한다. 도 1의 표시 장치는 발광 소자로서 LED를 사용하지만, LED 이외의 다른 디바이스가 발광 소자로서 사용될 수 있다.
(1) LED 도트 매트릭스(10)는 m-라인, n-컬럼 매트릭스로 배열된다. 각각의 컬럼내의 LED(4)의 캐소드는 전류 라인(6)에 접속된다. 각각의 라인내의 각각의 LED(4)의 애노드는 공통 소스 라인(5)에 접속된다.
(2) 전류 소스 스위칭 회로(1)는 각각의 공통 소스 라인(5)에 대응하고 이에 접속하는 m-스위칭 회로를 구비한다. 전류 소스 스위칭 회로(1)는 전류 소스를, 입력 조사 제어 신호에 의해 특정된 조사 주기동안 어드레스 신호에 의해 선택된 공통 소스 라인(5)에 접속한다. 이것은 전류를, 선택된 공통 소스 라인(5)에 접속된 LED(4)에 공급한다.
(3) 정전류 제어 회로부(3)는 n-세트의 후속 입력 화소 레벨 데이터를 저장하기 위한 메모리 회로를 구비한다. 정전류 제어 회로부(3)는 입력 조사 제어 신호에 의해 특정된 시간 간격 이상 각각의 메모리 회로에 저장된 화소 데이터에 대응하는 화소 레벨 폭에 의해 전류 라인을 구동한다.
(4) 스위칭 회로부(2)는 입력 조사 제어 신호의 조사 시간 간격 전반에 걸쳐 각 공통 소스 라인의 반대 단부를 부동(float)하고, 각 입력 조사 제어 신호의 오프 간격(비-조사 간격) 중에 각 공통 소스 라인의 반대 단부를 접지한다.
상기 구성을 갖는 표시 장치에 있어서, 전류 소스 스위칭 회로(1)의 온-오프 스위칭, 정전류 회로부(3), 및 스위칭 회로부(2)는 조사 제어 신호에 따라 모두 수행된다. 조사 제어 신호의 조사 간격중에, 전류 소스 스위칭 회로(1) 및 정전류 제어 신호(3)는 활성화되고, 스위칭 회로부(2)는 비활성화된다(공통 소스 라인의 반대 단부에 접속된 각각의 스위치는 오프된다). 활성화된 때, 전류 소스 스위칭 회로(1)는 입력 어드레스 신호에 의해 선택된 공통 소스 라인을 전류 소스에 접속한다. 이 때, 정전류 제어 회로부(3)는 각각의 메모리 회로에 저장된 화소 레벨 데이터에 대응하는 화소 레벨 폭에 의해 전류 라인을 구동한다. 이러한 방식으로, 어드레스 신호에 의해 선택된 공통 소스 라인에 접속된 LED(4)는 관련된 화소 레벨 데이터에 대응하는 화소 레벨폭으로 조사된다. 또한, 비활성화된 상태에 있어서, 전류 소스 스위칭 회로(1) 및 정전류 제어 회로부(3) 모두는 비활성화되고, 스위칭 회로부(2)는 활성화된다. 결과적으로, 조사 제어 신호에 의해 표시된 오프 간격중에, 각 LED에 의해 축적된 전하 또는 그의 관련 접속은 스위칭 회로부(2)내의 각각의 폐쇄된 스위치를 경유하여 접지로 방전된다. 그러므로, 각 LED 및 그의 관련 접속은 이러한 조건하에서 전하를 축적하지 않는다.
후속적으로, 조사 간격 및 오프 간격은 연속적으로 반복된다. 각각의 라인내에 배치된 LED는 각각의 조사 간격중에 순차적으로 조사되고, 원하는 화상이 LED 도트 매트릭스상에 표시된다. 이 시스템에 있어서, 조사 간격중에 조사되지 않은 LED(또는 관련 접속)에 의해 축적된 전하는 그 다음 오프 간격중에 방전된다. 결과적으로, 조사 간격중에, LED 조사는 원하지 않는 전하를 형성하지 않고, 방전된 상태로 항상 각각의 LED 및 그의 관련 접속에 의해 제어될 수 있다.
따라서, 도 1의 표시 장치는 충분한 화상 콘트라스트를 얻을 수 있고, 고화질의 표시가 가능하다. 이것은 조사 제어가 전하 누적의 영향 없이 수행될 수 있다.
이하, 도 2를 참조하여, 본 발명의 표시 장치의 특정 구성을 설명한다. 도 2에 있어서, 도 1에서 동일 구성요소에는 동일한 참조번호를 붙인다.
도 2에 도시한 바와 같이, 특정 실시예의 전류 소스 스위칭 회로(1)는 디코더(11) 및 공통 소스 드라이버(12)를 포함한다. 조사 제어 신호가 디지털 신호 소스 낮은 상태(LOW)인 때, 디코더(11)는 어드레스 신호에 의해 선택된 공통 소스 라인(5)과의 전류 소스 접속의 온 또는 오프하여 공통 소스 드라이버(12)를 제어한다. 조사 제어 신호가 디지털 신호 상태(HIGH)인 때, 전류 소스 스위칭 회로(1)는 전류 소스로부터 모든 공통 소스 라인의 접속을 해제하기 위해 디코더 회로(11)를 경유하여 공통 소스 드라이버(12)를 제어한다.
조사 제어 신호가 LOW인 때, 이 형태의 전류 소스 스위칭 회로(1)는 어드레스 신호에 의해 선택된 LED 도트 매트릭스(10)의 공통 소스 라인(5)만을 접속한다.
정전류 제어 회로부(3)는 시프트 레지스터(31), 메모리 회로(32), 카운터(33), 데이터 비교기(34), 및 정전류 드라이버부(35)를 구비한다. 이 형태의 정전류 제어 회로부(3)에 있어서, 화소 레벨 데이터는 시프트 클럭과 동기하여 시프트 레지스트에 의해 n-배 시프트된다. 각각의 n- 전류 라인에 대응하는 화소 레벨 데이터는 래치 클럭 신호에 응답하여 각각의 메모리 회로(32)내로 클럭되어 각각의 메모리 회로(32)에 저장된다. 조사 제어 신호가 LOW인 때, 데이터 비교기 (34)로부터의 출력 신호는 정전류 드라이버부(35)에 입력된다. 데이터 비교기는 화소 레벨 데이터를 카운터 클럭으로서 사용된 화소 레벨 기준 클럭에 의해 클럭된 카운터(33)로부터의 출력값과 비교한다. 정전류 드라이버부(35)는 화소 레벨 데이터 값에 대응하는 드라이버 펄스 폭 간격동안 각 전류 라인의 정전류의 흐름을 제어한다.
상술한 바와 같이, 조사 제어 신호가 LOW인 때, 전류 소스 스위칭 회로(1) 및 정전류 제어 회로부(3)는 LED 표시 화소 레벨 제어 수행한다. 조사 제어 신호가 HIGH인 때, LED 도트 매트릭스는 전류 소스 스위칭 회로(1) 또는 정전류 제어 회로부(3)에 접속되지 않는다.
조사 제어 신호가 HIGH인 때, 스위칭 회로부(2)는 모든 공통 소스 라인(5)을 접지하도록 스위치를 턴온시킨다. 조사 제어 신호가 LOW인 때, 스위치는 모든 공통 소스 라인(5)을 접속해제(플로트)하기 위해 턴오프된다.
상술한 바와 같이 구성된 도 2의 표시 장치는, 조사 제어 신호가 LOW인 때, 지정된 LED를 조사하도록 정전류로 LED 도트 매트릭스(10)를 구동한다. 조사 제어 신호가 HIGH인 때, LED 도트 매트릭스(10)는 플로트된다. 이 경우, LED 도트 매트릭스(10)의 각 LED내에 축적된 잔류 전하 및 관련 접속은 스위칭 회로부(2)를 통해 방전된다.
상술한 도 2의 실시예는 조사 제어 신호가 LOW인 때, 정전류로 LED 도트 매트릭스(10)를 구동하고, 조사 제어 신호가 HIGH인 때, 스위칭 회로부(2)를 턴온하도록 구성된다. 그러나, 본 발명은 이 시스템에 제한되지 않으며, 제어는 LOW 레벨 및 HIGH 레벨의 반전에 의해 수행될 수 있다.
도 3에는, 본 발명의 화상 표시 장치의 다른 실시예가 도시된다. 도 3의 구성 요소는 도 1 및 도 2의 동일한 구성요소에는 동일한 참조번호를 붙인다. 도 3에 도시한 화상 표시 장치는 스위칭 회로부(2)의 각 스위치(SW1-6)를 각각 제어하는 스위칭 디코더 회로(13)를 구비하고, 스위칭 디코더 회로(13)는 어드레스 신호 및 조사 제어 신호와 같은 입력 신호에 기초하여 스위치 회로부(2)의 스위칭 디코더 회로(13)의 각 스위치(SW 1-6)의 온 및 오프를 제어한다.
조사 제어 신호가 논리 HIGH인 때, 스위칭 디코더 회로(13)는 이 스위칭에 접속된 공통 소스 라인만을 접지하도록 어드레스 신호의 온에 의해 선택된 스위치만을 제어한다. 이때, 어드레스 신호에 의해 선택되지 않은 모든 나머지 스위치는 오프 되고, 이 들 스위치에 접속된 모든 나머지 공통 소스 라인은 플로팅 상태로 유지된다.
도 4의 타이밍도는 공통 소스 드라이버(12)의 전류 소스 스위칭 회로(1) 및 스위칭 회로부의 각 스위치(SW1-6)에 대한 표시 장치의 제어를 도시한 것이다. 도 4에 도시한 공통 라인(1-6)은 스위칭 회로부(2)의 대응하는 스위치(SW 1-6)에 접속된 공통 소스 라인이다.
도 4에 도시한 바와 같이, 조사 제어 신호가 논리 LOW 인 때, 전류 소스 스위칭 회로(1)는 어드레스 신호 내지 전류 소스에 의해 선택된 공통 소스 라인(5)만을 접속하도록 공통 소스 드라이버(12)를 제어한다. 또한, 조사 제어 신호가 논리 HIGH인 때, 스위칭 디코더회로(13)는 공통 소스 라인을 접지하기 위해 어드레스 신호에 의해 선택된 스위치만을 턴온한다. 예를 들어, 어드레스 신호가 0이고, 조사 제어 신호가 LOW 인 때, 공통 라인(1)은 온으로 제어되고, 전류 소스는 공통 소스 라인에만 접속된다. 이 때, 모든 스위치(SW 1-6)는 오프로 제어된다. 그 다음, 어드레스 신호가 0이고, 조사 제어 신호가 HIGH인 때, 공통 라인(1)은 OFF로 제어될 뿐만 아니라, 공통 라인(1)의 다른 단부에 접속된 SW 1 만이 온으로 제어되고, 공통 소스 라인만이 접지된다. 조사된 LED가 (조사되지 않은)비활성 상태로 진행한때, 스위칭 디코더 회로(13)는 LED에 접속된 공통 소스 라인을 접지하도록 스위칭 회로부(2)를 즉시 제어한다. 이것은 조사된 LED가 턴오프된 때 전하의 축적을 효과적으로 방지할 수 있다.
상술한 방식으로, 공통 라인(1-6) 및 스위치(SW 1-6)는 어드레스 신호에 따라 선택되고, 선택된 공통 소스 라인 및 스위치는 제어 신호의 로우 및 하이 레벨에 의해 온 또는 오프 제어된다. LED 조사의 연속적인 반복 및 이 화상 표시 장치를 접지하는 고통 소스 라인에 의해 LED 도트 매트릭스상에 지정된 화상이 표시된다. 이 표시 장치에 있어서, 선택된 공통 소스 라인에 접속된 스위치만이 턴온된다. 그러므로, 선택되지 않은 라인 LED를 통해 흐르는 저 레벨 전류는 확실히 방지되고, 선택되지 않은 LED의 저 레벨 조사가 방지될 수 있다.
도 5는 독출 전용 제 1 메모리 뱅크 및 기입가능한 제2 메모리 뱅크로 이루어지는 보정 데이터 메모리부를 구비하는 화상 표시 장치의 전체 개념적 구조를 도시하는 블록도이다. 도 5의 화상 표시 장치는 m-라인 x n-컬럼 매트릭스로 배열된 발광 소자의 표시부(21), 각각의 발광 소자에 대응하는 보정 데이터를 저장하기 위한 보정 데이터 메모리부(26), 및 보정된 데이터에 기초하여 입력 화상 데이터를 보정하고 보정된 화상 데이터를 사용하여 표시부(21)상에 화상을 표시하기 위한 제어 및 드라이버 회로를 구비한다. 제어 및 드라이버 회로는 수직 드라이버부(22), 수평 드라이버부(23), 화상 데이터 보정부(24), 제어부(25), 화상 데이터 입력부(27), 통신제어부(28), 및 버퍼 메모리(20)를 구비한다. 화상 표시 장치에 있어서, 화상 데이터 입력부(27)로 입력되는 화상 데이터는 제어부(25)로 전송된다.
제어부(25)에 접속된 보정 데이터 메모리부(26)는 제 1 메모리 뱅크 및 제 2 메모리 뱅크를 가진다. 예를 들어, 보정 데이터 메모리부(26)는 EEPROM(데이터가 전기적으로 소거 또는 재기입될 수 있는 비휘발성 메모리)일 수 있다. 각 화소에 대한 휘도 변화를 보정하기 위한 데이터와 같은 제 1 보정 데이터는 제 1 메모리 뱅크내에 저장된다.
본 실시예에 있어서, 발기 변화 보정 데이터는 보정 데이터의 한 예로서 사용되지만, 본 발명은 이 형태의 보정 데이터에 제한되지 않는다.
화상 데이터 보정부(24)는 제어부(25) 및 버퍼 메모리(20)로의 각각의 화소 입력에 대한 제 1 보정 데이터 또는 제 2 보정 데이터에 따라 화상 데이터 입력부(27) 및 제어부(25)를 통해 각각의 화소 입력에 대해 화상 데이터를 보정한다. 화상 데이터 보정부(24)는 각 화소에 대응하는 화소 레벨데이터로서 보정된 데이터를 수평 드라이버부(23)로 출력한다. 이 화상 표시 장치 실시예에서 버퍼 메모리(20)는 1 내지 n 컬럼에 대응하는 1 내지 n 메모리 유니트(20)를 갖는다.
수평 드라이버부(23)는 각각의 n-컬럼에 대응하는 n-메모리 유니트를 구비한다. 각 화소에 대응하는 입력 화소 레벨데이터는 이 화소를 포함하는 컬럼에 제공된 메모리에 저장된다. 수평 드라이버부(23)는 제어부(25)로부터의 제어 신호에 응답하여 메모리네 저장된 화소 레벨 데이터에 대응하는 화소 레벨 폭에 대한 지정된 전류 라인을 구동한다.
또한, 수직 드라이버부(22)는 m-공통 소스 라인 각각에 접속된 m-스위칭 회로를 구비한다. 수직 드라이버부(22)는 전류 소스를 제어부(25)로부터의 제어 신호에 따라 특정된 공통 소스 라인에 접속한다.
상술한 바와 같이, 제어부(25)는 보정 데이터메모리부(26)로부터 제 1 보정 데이터 또는 제 2 보정 데이터를 독출하여 이 데이터를 버퍼 메모리(20)에 저장한다. 제어부(20)는 또한, 버퍼 메모리(20) 및 화상 데이터보정부(24)에서 데이터 입력 출력 타이밍을 제어한다. 또한, 제어부(25)는 공통 소스 라인을 수직 드라이버부(22)내의 전류 소스와 접속하기 위해 스위칭을 제어한다. 최종적으로, 제어부(25)는 수평 제어부(23)내의 전류 라인을 구동하기 위해 스위칭을 제어한다. 이러한 방식으로, 제어부(25)는 표시부(21)의 각각의 화소를 순차적으로 조사하여 표시부(21)상의 입력 화상 데이터에 대응하는 화상을 표시한다.
특히, 본 실시예의 화상 표시 장치는 아래의 특징을 갖는다.
(1) 보정 데이터 메모리부(26)는 각각의 화소에 대응하는 미리 저장된 제 1 보정 데이터를 포함하는 제 1 메모리 뱅크 및 제 2 재기입가능한 메모리 뱅크를 구비한다.
(2) 화상 표시 장치는 통신제어부(28)를 구비한다. 통신 제어부(28)는 제 1 보정 데이터와 다른 제 2 보정 데이터가 제 2 메모리 뱅크에 기입될 수 있게 하고, 제 1 메모리 뱅크로의 기입을 금지한다.
(3) 제어부(25)는 제 1 메모리 뱅크에 저장된 제 1 보정 데이터 또는 제 2 메모리 뱅크에 저장된 제 2 보정 데이터중 어느 하나를 선택할 수 있다.
이러한 특징에 따르면, 도 5의 화상 표시 장치는 제 1 보정 데이터와 상이한 제 2 보정 데이터를 저장하기 위해 재기입가능한 제 2 메모리를 사용할 수 있고, 제 1 메모리 뱅크에 보유된 제 1 보정 데이터의 소거를 방지할 수 있다. 결과적으로, 제 1 보정 데이터 또는 제 2 보정 데이터중 어느 하나를 선택함으로써, 필요에 따라 화상 데이터를 보정할 수 있다.
실시예(2 개의 뱅크 보정 제어 회로에서의 휘도 보정 데이터, 도 6)
이하, 도 6을 참조하여 본 발명의 화상 표시 장치의 한 실시예를 설명한다. 본 실시예의 화상 표시 장치는 표시부로서 LED 도트 매트릭스(41), 수직 드라이버부로서 공통 드라이버(42), 보정 데이터 메모리부로서 EEPROM(46), 화상 데이터 보정부로서 LED 드라이버 IC(44)의 보정 회로(49), 수직 드라이버부로서 LED 드라이버 IC(44)의 드라이버부(43), 제어부로서 명령 제어부(47) 및 제어부(45), 통신 제어부로서 직렬 통신 인터페이스(48), 및 버퍼 메모리로서 LED 드라이버 IC(44)의 시프트 레지스터(402) 및 레지스터(401)를 구비한다.
명령 제어부(47)는 공통 드라이버(42)에 공통 소스 라인 선택 신호(LINE ADR)를 입력하고, 조사 제어 신호를 각 드라이버부(43) 및 보정 회로(49)에 입력한다.
이 실시예에 있어서, EEPROM(46)은 예를 들어, 보정 데이터가 쉽핑 타임(shipping time)시 펙도리(factory)에서 기입되는 BANK0, 및 사용자가 쉽핑후, 보정 데이터를 기입할 수 있는 BANK1을 포함한다. 제어부(45)는 직렬 통신 인터페이스(48)로부터의 제어 신호에 응답하여 BANK0 또는 BANK1 중 어느 하나로부터 보정 데이터를 선택한다. 이 실시예에 있어서, 기입 보호 설정은 재기입 데이터로부터 보정 데이터가 쉽핑 시간에 팩토리에서 기입된 BANK0으로 사용자가 접근하는 것을 금지시킨다.
이 실시예에서 직렬 통신 인터페이스(48)는 수신된 신호에 포함된 명령에 따라 여러 가지 처리를 수행한다. EEPROM(46)에 대한 독출 및 기입의 제어는 이하 상세히 설명된다.
이하, EEPROM(46) 판독 및 기입을 제어하기 위해 EEPROM(46)의 구조 및 직렬 통신 인터페이스(48)를 상세히 설명한다. 도 7에 도시한 바와 같이, 직렬 통신 인터페이스(48)는 어드레스 레지스터(48b), 제어 레지스터(48e), 및 AND 논리 회로(48c 및 48d)를 포함하는 기입 보호 제어부(48f), 이외에 부수적으로 명령 제어(48a)로 구성된다.
직렬 통신 인터페이스(48)로의 입력 신호(RXD)는 EEPROM (46)에 기입될 데이터를 명령하는 명령(기입 명령), 명령 제어부(48a)로 입력되는 기입가능한 통신 데이터를 포함한다. 도 7에 도시한 바와 같이, 기입가능한 데이터는 이곳에 데이터를 기입하기 위한 위치를 지정하는 개시 어드레스 데이터(도 7의 개시 어드레스) 및 기입될 데이터(도 7의 WRITE DATA)를 포함한다.
기입 명령을 포함하는 RXD 입력 신호가 직렬 통신 인터페이스(48)에 의해 수신될 때, 명령 제어부(48a)는 기입 보호를 제거하기 위한 명령 데이터(WP 설정-제거 명령 데이터)를 제어 레지스터(48e)로 출력한다. 명령 제어부(48a)는 또한 개시 어드레스 데이터의 최상위 비트(highest order bit)(A12)를 어드레스 레지스터(48b)로 출력하고, 논리 1을 AND 논리 회로(48c)로 출력한다. 또한, 명령 제어부(48a)는 기입가능한 통신 데이터를 EEPROM(46)의 어드레스 디코더(46a)로 출력한다.
여기서, 최상위 비트(A12)가 0인 때, BANK0은 기입하기 위한 ROM 영역을 나타내고, 최상위 비트(A12)가 1인 때, BANK1은 기입하기 위한 ROM 영역을 나타낸다.
본 발명에 있어서, EEPROM(46)은 2 이상의 메모리 블록을 포함한다. 2 이상의 메모리 블록의 경우에 있어서, 최상위 2 이상 비트는 적용가능한 메모리 뱅크를 나타내기 위해 사용될 수 있다.
제어 레지스터(48e)는 기입 보호 모드로 사전 설정되고, 기입 보호 모드를 나타내는 논리 0을 AND 논리 회로(48d)로 출력한다. 그러나, 기입 보호의 제거를 나타내는 명령 데이터(WP 설정 제거 명령 데이터)는 명령 제어부(48a)로부터 입력될 때, 기입 보호를 나타내는 논리 1은 AND 논리 회로(48d)로 출력된다.
논리 1이 BANK1을 나타내는 어드레스 레지스터를 통해 입력되고, 제어 레지스터(48e)가 기입 보호를 제거하기 위해 논리 1을 발생시킬 때, AND 논리 회로(48d)는 논리 1을 AND 논리 회로(48c)에 출력한다.
명령 제어부(48a)가 논리 1을 발생시키고, 논리 1이 AND 논리 회로(48c)로 출력할 때, AND 논리 회로(48c)는 논리 1을 EEPROM(46)의 XWP 단자로 출력한다. 다른 모든 시간에 AND 논리 회로(48c)는 논리 0을 출력한다. 논리 1이 EEPROM(46)의 XWP 단자로 입력된 때, 기입 보호는 제거된다(WP-OFF). 논리 0이 EEPROM(46)의 XWP 단자로 입력된 때, 기입 보호는 유지된다(WP-ON).
XWP 단자는 EEPROM(46)의 기입 보호 단자이고, 데이터 기입이 이 단자에서 유효 또는 무효로 된다. XWP=0(LOW)인 때, EEPROM에 대한 데이터 기입은 무효로 되어 기입 보호모드가 설정된다. XWP=1(HIGH)인 때, EEPROM에 대한 데이터 기입은 유효로 되어 기입 보호모드가 설정되지 않는다.
EEPROM(46)에서 BANK0과 BANK1사이의 스위칭은 기입가능한 통신 데이터내에 포함된 최상위 비트(A12)에 기초하여 어드레스 디코더(46a)에 기초하여 어드레스 디코더(46a)에 의해 달성된다. 또한, 독출용 메모리 뱅크 선택은 최상위 비트(A12)를 사용하는 데이터 기입에서와 동일한 방식으로 수행된다. 즉, 메모리 뱅크 선택은 명령 제어부(48a)로부터 입력되는 기입가능한 통신 데이터에 포함된 최상위(A12)에 기초하여 EEPROM(46) 어드레스 디코더(46a)에 의해 수행될 수 있다.
도 7에는 13 비트 와이드 어드레스 버스의 한 예가 도시되었지만, 최상위 비트에 의한 메모리 뱅크 선택은 13 비트 이상 또는 13 비트 이하의 방식에서와 동일하게 수행될 수 있다.
상술한 EEPROM(46) 및 직렬 통신 인터페이스(48) 구성에 있어서, EEPROM(46) BANK0 보정 데이터는 항상 보호되어 있고, BANK1 보정데이터는 RXD 신호에 따라 재기입될 수 있다. 또한, BANK0 또는 BANK1 이들로부터 보정 데이터를 독출하도록 선택될 수 있다.
직렬 통신 인터페이스(48)의 직접 접속에 의해 EEPROM(46)의 제어는 상술한 바와 같다. 그러나, EEPROM(46)은 도 6에 도시한 바와 같이, 중간 제어부(45)를 통해 EEPROM(46)에서 직렬 통신 인터페이스(48)의 접속에 의해 동일 형태로 제어될 수 있다. 특히, 직렬 통신 인터페이스(48)로부터 EEPROM(46)으로의 각각의 제어 신호는 직접 접속의 형태로 제어부(45)를 통해 EEPROM(46)으로 단순히 입력된다. EEPROM(46)으로부터 독출된 보정 데이터는 EEPROM(46)과 직렬 통신 인터페이스(48)사이에 접속된 제어부(45)에 의해 LED 드라이버 IC (44)의 시프트 레지스터(402)로 분기된다.
또한, 직렬 통신 인터페이스(48)에 의해 수신된 RXD 신호는 외부 콘트롤러(도시하지 않음)로부터 입력된다. 도 6에 도시한 바와 같이, EEPROM(46)으로부터 독출된 보정 데이터와 같은 데이터는 예를 들어, TXD 신호로서 직렬 통신 인터페이스(48)에 의해 외부 콘트롤러로 전송될 수 있다.
상술한 도 6의 표시 장치 실시예에 있어서, 화상 데이터, 수직 동기 신호(Vsync), 및 수평 동기 신호(Hsync)는 화상 데이터 입력부(도시하지 않음)를 통해 제어부(47)로 입력된다. 입력 화상 데이터는 명령 제어부(47)로부터 LED 드라이버 IC 보정 회로(49)로부터 전송된다.
또한, 수직 동기 신호(Vsync) 및 수평 동기 신호(Hsync)는 제어부(45), LED 드라이버 IC(44)의 보정 회로(49) 및 드라이버부(43), 및 공통 드라이버(42)로 입력된다.
제어부(45)는 입력 수직 동기 신호(Vsync) 및 수평 동기 신호(Hsync)에 동기하여 표시 장치의 각각의 요소를 제어한다. 또한, 직렬 통신 인터페이스(48)에서의 입력 신호에 따라 EEPROM(46) BANK0 또는 BANK1로부터 독출된 보정 데이터는 제어부(45) 명령에 따라 시프트 레지스터(402)로 순차적으로 전송된다. 보정 데이터의 한 개의 라인 값이 시프트 레지스터(402)로 전송된 후, 데이터는 대응 레지스터(401)를 통해 각 보정 회로(49)로 입력된다. 특히, 이 화상 데이터에 따른 화상 데이터 및 보정 데이터는 보정 회로(49)로 입력된다.
보정 회로(49)로의 화상 데이터 입력은 보정 데이터에 따라 보정 회로(49)에 의해 보정된다. 그 다음, 그 결과는 화소 레벨 데이터로서 취해지고, 각각의 드라이버부(43)로 입력한다. 보정된 화상 데이터(화소 레벨 데이터)에 기초하여 LED 도트 매트릭스(41)의 선정된 LED 라인은 화상 데이터에 따른 화상을 표시하기 위해 공통 드라이버(42) 및 각 드라이버부(43)에 의해 조사된다.
상술한 본 발명의 화상 표시 장치의 실시예에 있어서, EEPROM(46)의 BANK0에 저장된 보정 데이터, 예를 들어, 쉽핑 타임시 팩토리에서 기입된 보정 데이터는 소거되지 않고, 보유된다. 재기입가능한 BANK1은 예를 들어, 동작의 환경에 대해 설명하도록 수정된 보정 데이터를 저장하기 위해 사용자에 의해 사용될 수 있다. 필요에 따라 보정 데이터를 선택하는 것이 화상 데이터를 보정하기 위해 설정될 수 있다.
또한, 본 발명의 실시예의 구성에 있어서, EEPROM과 같은 단일 메모리 디바이스는 ROM 및 EEPROM과 같은 2 개의 메모리 디바이스를 제공하는 대신에 사용될 수 있다.
이 실시예에 있어서, 기입 보호 특징(WP 기능)을 갖는 EEPROM(46)이 기술되었다. 기입 대 독출 전용 제어는 기입 인에이블 제어 신호의 출력 상태 즉, EEPROM 기입 동안 타이밍을 제어하는 XWE를 제어함으로써, WP 기능을 갖지 않고, EEPROM에서 달성될 수 있다. 예를 들어, 활성 LOW 기입 인에이블 펄스 XWE의 경우에, 직렬 통신 인터페이스가 기입 보호 모드내에서 기입 명령을 수신할 때, 동일 기입 보호 특징은 XWE를 항상 논리 HIGH로 설정함으로써, 달성될 수 있다.
특히, 본 발명은 상술한 실시예의 구조에 제한되지 않는다. 시스템이 최소한 1 개의 보정 데이터를 갖는 경우, 보정 데이터 메모리부는 기입 보호 영역 및 기입될 수 있는 영역을 구비한다.
본 발명의 대규모 LED 표시상의 화상 표시는, 전체 화상을 LED 유니트 상의 부분 및 장착부로 분할하는 것이 바람직하다. 예를 들어, 사용자가 특정 구동조건으로 제 2 메모리 뱅크를 이미 설정한 대규모 LED 표시는 한 부분의 LED 유니트를 대체할 필요가 있다. 제 2 메모리 뱅크는 대체된 LED 유니트에 대해서만 조정하기 위해 재기입될 수 있고, 사용자의 구동조건에 대한 재조정은 용이하게 달성될 수 있다.
또한, 본 발명은 발광 다이오드를 사용하는 화상 표시 장치에 제한되지 않는다.
도 8은 보정 데이터 메모리부로부터 1 개의 보정 데이터를 독출하여 각각의 시간동안, 1 개의 보정된 화상 데이터를 출력하는 화상 데이터 보정부를 갖는 화상 장치 실시예를 개략적으로 나타내는 블록도이다. 도 8에 도시한 화상 표시 장치는,
(a) m-라인 x n-컬럼 매트릭스로 배열된 복수의 발광 소자로 이루어진 표시부(61),
(b) 표시부(61)의 각 라인 및 각 라인에 대한 소스 전류를 순차적으로 선택하는 수직 드라이버부(62),
(c) 선택된 라인에 대응하는 화상 데이터에 따른 표시부(61)가 컬럼에 구동 전류를 공급하는 수평 드라이버부(63),
(d) 각각의 화소에 대해 발광 소자의 특성의 변화에 따른 외부 입력 화상 데이터(IMDATA)를 보정하여 수평 드라이버부(63)에 보정된 데이터를 출력하는 화상 데이터 보정부(64), 및
(e) 화상 데이터 보정에 대한 보정 데이터를 보유하는 보정 데이터 메모리부 (66)를 구비한다. 이 시스템의 각 소자의 동작은 제어부(65)에 의해 제어된다.
화상 데이터 보정부(64)는 제어부(65)를 경유하여 보정 데이터 메모리부(66)로부터 보정 데이터(CRDATA)를 독출하고, 이 보정 데이터에 기초하여 제어부(65)를 경유하여 화상 데이터(IMDATA) 입력을 보정하고, 수평 드라이버부(63)로 보정된 화상 데이터를 출력한다. 총 mxn 화소의 보정 데이터는 모두 한번에 독출되는 것이 아니라, 다른 보정 데이터가 1 라인의 화상 데이터의 출력과 병렬로 한번에 1 라인 (n 화소)을 독출한다.
정지 화상에 대한 화상 데이터의 경우에, 모두 임의의 버퍼 메모리를 제공하지 않고 화상 데이터를 보정할 수 있다. 그러나, 동화상의 경우에는 1 또는 2 라인의 보정 데이터를 저장할 수 있는 버퍼 메모리는 라인들 사이의 표시 시간 지연(time lag)을 방지하기에 바람직하다. 버퍼 메모리(60)는 예를 들어, 2 단의 상호접속된 레지스터(601 및 602)로서 구성될 수 있다.
독출 데이터 판독은 예를 들어, 이하의 방법으로 진행될 수 있다. 화상 데이터 보정부(64)는 3 단의 (상부 및 하부)의 상호 접속 레지스터(601 및 602)로 이루어진다. 제 1 레지스터(601)가 1 라인의 보정 데이터를 보정 회로(69)로 출력할 때, 보정 데이터의 다음 라인은 제 2 레지스터(602)로 독출된다. 제 1 레지스터(601)가 1 라인의 보정 데이터의 독출이 완료하고, 제 2 레지스터(602)가 1 라인의 보정 데이터의 독출을 완료한때 제 2 레지스터(602)의 내용이 제 1 레지스터(601)로 전송된다.
데이터(n- 화소가 1 화소에 대한 비트 카운트를 측정하는) 정확하게 1 표시 라인 값에 대한 D-플립플롭 어레이는 얘를 들어, 제 1 및 제 2 레지스터(601, 602)로서 사용될 수 있다. 보정 데이터 입력 와이어링을 간단히 하기 위해서는 시프트 레지스터를 형성하기 위해 마스터-슬레이브 순차에 따라 제 2의 레지스터(602)의 플립플롭을 접속하는 것이 바람직하다. 이러한 구성에 있어서, 제 2 레지스터(602)의 좌측 단부에서 플립플롭에 대한 보정 데이터 입력은 클럭(CLK) 타이밍에 동기하여 오른쪽으로 순차적으로 전송(시프트)하고, 데이터는 그러므로, 제 2 레지스터(602) 내로 독출된다. 그러므로, 보정 데이터 입력에 대한 각 컬럼으로 분기하는 버스 라인은 불필요하고, 클럭 신호를 각 플립플롭으로 공급하는 와이어링은 필요로 하는 모든 와이어링이다.
도 9는 도 8에 도시한 화상 표시 장치의 상세한 구조를 도시하는 블록도이다. 우선, 각 부의 구성이 설명된다. 표시부인 LED 도트 매트릭스(71)는 m-라인 x n-컬럼 매트릭스로 배열된 LED로 이루어진다. 각 라인에 배치된 모든 LED의 애노드는 1 개의 공통 소스 라인에 접속된다. 각 라인에 배치된 모든 LED의 캐소드는 1 개의 전류 라인에 접속된다. 수직 드라이버부인 공통 드라이버(72)는 M-스위칭 회로를 구비한 전류 스위칭 및 관련 전류 소스를 포함한다. 공통 드라이버(72)는 공통 소스 라인을 전류 소스에 접속함으로써, 공통 소스 라인에 접속된 LED에 전류를 공급한다. 수평 드라이버부인 드라이버 회로(73)는 보정 회로(79)로부터의 화상 데이터 출력의 화소 레벨 폭에 따른 각각 컬럼에 대한 구동 전류의 온 및 오프를 제어하는 정 전류 제어 회로를 포함한다.
화상 데이터 보정부는 한번에 1 라인의 입력 화상 데이터를 보정하여 순차적으로 출력하는 보정 회로(79), 및 보정 데이터를 저장하기 위해 버퍼 메모리인 레지스터(701) 및 시프트 레지스터(702)로 이루어진다. 각 레지스터(701) 및 시프트 레지스터(702)는 1 컬럼의 화소에 대한 비트 수에 대응하는 플립플롭을 갖는다. 또한, 각 레지스터(701)의 플립플롭은 시프트 레지스터 (702)의 대응 플립플롭에 접속된다. 제어부는 제어회로(77)(CTL) 및 직접 메모리 억세스 콘트롤러(DMAC) (75)로 이루어진다. 보정 데이터 메모리부인 ROM(76)은 EEPROM과 같은 메모리를 포함한다. LED 도트 매트릭스(71)의 각 LED의 발광 특성의 변화로 인한 휘도 차이를 보정하기 위한 휘도 보정 데이터는 ROM(76)에 저장된다. 보정 데이터는 각각의 화소 및 각각의 컬러에 따른 각각의 LED에 대한 구동 전류를 제어하기 위한 데이터이다. LED 조사 시간 또는 구동 전류 단독 대신에 조사 시간과 구동 전류의 조합을 제어하기 위한 데이터이 적절한 데이터이다.
드라이버 회로(73), 보정 회로(79), 레지스터(701), 및 시프트 레지스터 (702)는 LED 도트 매트릭스(71)의 각 컬럼에 제공되어, 각 컬럼에 제공되고, 각 컬럼에서 LED 드라이버 IC(k)(k=1 내지 n)내에 포함된다. 각각의 컬럼에서의 시프트 레지스터(702)는 데이터 시프팅을 허용하도록 함께 접속된다. 또한, 적절한 수의 컬럼에서 LED 드라이버 IC의 수, 드라이버 회로 등을 줄이기 위해 1 개의 LED 드라이버 IC내로 조합될 수 있다.
보정 데이터 ROM(76)에의 기입 및 이곳으로부터의 독출은 직렬 통신 인터페이스인 SCI(78)을 통해 화상 데이터와 독립적으로 수행될 수 있다. ROM(76)에의 기입은 또한, 직접 전송 방법을 사용하여 ROM(76)에 직접 접속하거나, 여러 형태의 인터페이스 및 병렬 버스를 경유하여 수행될 수 있다. 데이터가 ROM(76)에 기입되고, 보정 데이터가 ROM(76)으로부터 독출될 때, DMAC(75)에 의한 데이터 전송은 차단되고, SCI(78)을 통한 데이터 수신은 우선권이 주어진다. 이것은 ROM(76) 억세스에 대한 경쟁을 제어한다.
이 실시예의 화상 데이터의 화상 데이터의 흐름은 아래와 같이 진행한다. 화상 데이터(IMDATA)는 CTL(77)로 입력되어 보정 회로(79)로 분배된다. 화상 데이터의 각 라인은 보정 회로(79)에 의해 보정된 후, 이는 드라이버 회로(73)로 출력된다.
그 다음, 보정 데이터의 흐름은 도 10의 타이밍도를 참조하여 설명된다. 설명을 간단히 하기 위해, 도 10은 3 개의 공통 소스 라인(#1 내지 #2)의 조사의 경우를 순서에 따라 도시한다. 수평 및 수직 화상 타이밍 데이터(Vsync 및 Hsync)가 CTL(77)로 입력될 때 라인(#0) 보정 데이터는 시프트 레지스터(702)내로 독출되도록 개시한다. CTL(77)로의 Vsync 입력은 LINE ADR 신호로서 공통 드라이버(72)로 전송되고, Hsync는 BLANK 신호로서 드라이버 회로(73) 및 보정 회로(79)로 전송된다.
(1) 우선, CTL(77)은 ROM(76)으로부터 라인(#0) 보정 데이터를 독출하기 위한 개시 어드레스(ADDRESS)를 DAMC(75)내로 입력한다. DAMC(75)는 데이터 입력-출력 버스(DIO)를 경유하여 ROM(76)에 독출하기 위한 개시 어드레스를 기입하고, 기입 인에이블 신호(XWE)를 ROM(76)에 발생한다. 도 11에 개략적으로 도시한 바와 같이, ROM(76)에 대한 개시 어드레스는 선택된 라인에 대응하는 ROM 메모리 맵내의 보정 데이터의 개시 어드레스를 나타낸다. CTL(77)은 Vsync 및 Hsync로부터 결정된 라인 수에 대응하는 보정 데이터를 독출하기 위한 개시 어드레스를 발생한다.
(2) 독출하기 위한 개시 어드레스를 기입한 후, DMAC(75)는 데이터 버스(DIO)를 경유하여 ROM(76)으로부터 라인(#0) 보정 데이터를 독출하고, 독출 인에이블 신호(XOE)를 발생한다. ROM(76)은 XOE 상의 LOW 펄스 카운트에 대응하는 보정 데이터를 순차적으로 출력한다.
(3) DMAC(75)내로의 라인(#0) 보정 데이터(CRDATA) 판독은 드라이버 IC[74(k)]내의 시프트 레지스터(702)전송된다. 보정 데이터는 클럭(CLK)과 동기하는 시간에 1 비트를 시프트함으로써, 시프트 레지스터(702)내로 순차적으로 전송된다.
라인(#0)보정 데이터가 시프트 레지스터(702)내로 독출될지라도, 레지스터(701)는 최종 라인인 라인(#2) 보정 데이터를 보유한다. 레지스터(701)에 유지된 라인(#2) 보정 데이터는 드라이버 회로(73)에 출력하고, 라인(#2) LED가 조사되고, 보정 데이터는 레지스터(701)내에 유지된다. 그 다음 Hsync 펄스가 입력될 때, 래치 신호(LATCH)는 DMAC(75)로부터 레지스터(701)로 발생되고, 시프트 레지스터(702)에 저장된 라인(#0) 보정 데이터는 한번에 레지스터(701)로 전송되어 라인 (#0) LED 조사가 개시된다. 그 다음, 라인(#1) 보정 데이터를 독출하기 위한 개시 어드레스는 CTL(75)로부터 DMAC(75)로 입력된다. 상술한 방식으로, DMAC(75)는 ROM(76)으로부터 라인 (#1) 보정 데이터를 독출하여 이를 시프트 레지스터(702)내에 기입한다.
이러한 방식으로, 이전의 라인이 조사될지라도, 조사될 다음 라인의 각 화소를 보정하기 위한 데이터의 입력이 완료된다. 시프트 레지스터(702)로의 보정 데이터 입력은 1 라인으로부터 그 다음 라인으로의 스위칭 조사 바로 전에 레지스터(701)내로 전송되어 유지된다. 이 보유된 보정 데이터에 기초하여 보정 회로(79)는 활성 표시 라인의 각 LED의 휘도 변화에 대해 보상함으로써, 화상 데이터를 보정한다. 이들 동작의 연속적인 반복에 의해 LED 휘도 보정은 전체 표시 장치에 걸쳐 달성된다.
우발적으로 시프트 레지스터(702)내로의 보정 데이터의 전송은 1 표시 라인의 조사하는 시간내에 완료되어야 한다. 그러므로, 라인당 너무 많은 화상 데이터를 갖지 않는 LED 유니트를 사용하는 대형 스크린 LED 표시 장치와 같은 화상 데이터는 시프트 레지스터를 경유하여 데이터 전송을 구현하는데 적합하다.
여기서, 데이터가 직렬 형태로 독출되는 직렬 EEPROM은 ROM(76)으로서 기술된다. 그러나, n-비트 어드레스 및 데이터 버스를 갖는 EEPROM이 ROM(76)으로서 사용될 수 있지만, 데이터 전송은 병렬 버스를 통해 수행될 수도 있다.
전 색(full color) 표시 장치의 경우에 있어서, 각각의 화소는 3 RGB 컬러 LED로 이루어진다. 각각의 RGB 컬러에 대한 화상 데이터는 상술한 방식으로 보정될 수 있다.
상술한 실시예들은 각각의 특성을 쉽게 이해되도록 별도의 실시예로서 제공되었다. 도 1 및 도 2에 도시된 화상 표시 장치는 축적된 전하를 방전하기 위해 발광 소자의 공통 소스 라인을 접지에 접속하는 스위칭부를 갖는다. 도 5 및 도 6에 도시한 화상 표시 장치는 보정 데이터를 저장하여 메모리에의 기입을 금지하는 제 1 메모리 뱅크 및 기입될 수 있는 제 2 메모리 뱅크를 갖는 보정 데이터 메모리부로 구성된다. 도 8 및 도 9에 도시한 화상 표시 장치에 있어서는 각각의 시간에 1 라인의 보정된 화상 데이터는 화상 데이터 보정부에서 수평 드라이버부로 출력되고, 보정 데이터의 그 다음 라인은 보정 데이터 메모리부로부터 독출된다. 그러나, 가장 이상적인 화상 표시 장치는 상술한 모든 회로를 구비한 장치에 의해 실현될 수 있다.
본 발명에 따른 화상 표시 장치에 따르면, 비활성 상태시, 발광 소자 및 그 주변에 축적된 전하는 비활성 상태중에 스위칭 회로를 경유하여 방전된다. 결과적으로, 규정된 발광 소자의 활성 조사중에 축적된 전하의 효과는 필연적으로 제거되고, 고화질의 화상 표시 장치가 실현된다.
본 발명의 화상 표시 장치의 구동방법에 따르면, 활성 상태시, 발광 소자 및 그 주변에 축적된 전하는 비활성 상태중에 스위칭 회로부를 통해 방전될 수 있다. 결과적으로, 규정된 발광 소자의 활성 조사중에 축적된 전하의 효과는 필연적으로 제거될 수 있어, 고화질의 화상 표시 장치의 구동방법이 제공된다.
본 발명은 본 발명의 필수적인 특성의 범주를 벗어나지 않고서도 변형될 수 있기 때문에, 본 실시예는 상술한 상세한 설명에 의해 한정되는 것이 아니라 첨부된 청구의 범위에 의해 정해지고, 청구의 범위내에 속하는 모든 변형 또는 이들과의 등가물은 본 청구의 범위에 의해 포함된다.

Claims (39)

  1. (a) 각 컬럼으로 배치된 각 발광 소자의 한 단자가 각 전류 라인에 접속되고, 각 라인으로 배치된 각 발광 소자의 다른 단자가 각 공통 소스 라인에 접속되는 m-라인 및 n-컬럼 매트릭스로 배열된 복수의 발광 소자의 도트 매트릭스,
    (b) 비활성 상태에 있어서, 입력 표시 데이터에 기초하여 각 공통 소스 라인 및 각 전류 라인의 한 단부를 통해 전도를 제어하고, 입력 조사 제어 신호에 따라 활성 또는 비활성인 활성 상태를 제어하기 위한 드라이버 회로, 및
    (c) 활성 상태시 각 공통 소스 라인의 다른 단부를 부동하고, 비활성시 각 공통 소스 라인의 다른 단부를 접지하는 스위칭 회로
    를 포함하는 것을 특징으로 하는 화상 표시 장치.
  2. 제 1 항에 있어서, 상기 스위칭 회로부가 각 공통 소스 라인과 접지 사이에 접속된 복수의 스위치인 것을 특징으로 하는 화상 표시 장치.
  3. 제 1 항에 있어서, 상기 스위칭 회로부가 발광 소자 조사 온 또는 오프 상태를 제어하는 조사 제어 신호에 의해 제어되는데, 상기 조사 제어 신호의 조사 온시에 상기 스위칭 회로부가 접지로부터 상기 공통 소스 라인을 접속해제하고, 상기 조사 제어 신호의 조사 오프시에 상기 스위칭 회로부가 접지에 상기 공통 소스 라인을 접속하는 것을 특징으로 하는 화상 표시 장치.
  4. 제 2 항에 있어서, 상기 스위칭 회로부가 발광 소자 조사 온 또는 오프 상태를 제어하는 조사 제어 신호에 의해 제어되는데, 상기 조사 온시에 상기 스위칭 회로부의 스위치가 접지로부터 상기 공통 소스 라인을 접속해제하기 위해 턴오프되고, 상기 조사 오프시에 상기 스위칭 회로부의 스위치가 접지에 상기 공통 소스 라인을 접속하기 위해 턴온되는 것을 특징으로 하는 화상 표시 장치.
  5. 제 1 항에 있어서, 상기 스위칭 회로부가 발광 소자를 활성시키기 위해 논리 LOW 조사 제어 신호로 접지로부터 상기 공통 소스 라인을 접속해제하고, 발광 소자를 비활성시키기 위해 논리 HIGH 조사 제어 신호로 접지에 상기 공통 소스 라인을 접속하는 것을 특징으로 하는 화상 표시 장치.
  6. 제 1 항에 있어서, 상기 드라이버 회로가 각 공통 소스 라인에 대응하는 m-스위칭 회로를 갖는 전류 소스 스위칭 회로를 구비하는데, 활성 상태시, 상기 전류 소스 스위칭 회로가 상기 전류 소스에 입력 어드레스 신호에 의해 선택된 공통 소스 라인을 접속하는 것을 특징으로 하는 화상 표시 장치.
  7. 제 6 항에 있어서, 상기 드라이버 회로가 상기 입력 표시 데이터의 n-세트의 화소 레벨 데이터를 저장하기 위해 메모리 회로를 갖는 정전류 제어 회로부를 구비하는데, 활성 상태시, 상기 정전류 제어 회로부가 각 메모리 회로에 저장된 화소 레벨 데이터에 대응하는 화소 레벨 폭으로 도전 상태로 관련된 전류 라인을 유지하는 것을 특징으로 하는 화상 표시 장치.
  8. 조사 제어 신호에 의해 m-라인 및 n-컬럼 매트릭스로 배열된 각 발광 소자의 조사 온 또는 오프 상태를 제어하고,
    상기 조사 오프시 발광 소자의 공통 소스 라인이 이들 라인을 접지로 방전시키기 위해 접지에 접속되는 것을 특징으로 하는 화상 표시 장치의 구동방법.
  9. 제 8 항에 있어서, m-라인 및 n-컬럼 매트릭스로 배열된 각 발광 소자의 한 단자가 전류 라인에 접속되고, 각 라인으로 배치된 각 발광 소자의 다른 단자가 각 공통 소스 라인에 접속되며, 상기 공통 소스 라인이 이들 라인을 방전하도록 스위치에 의해 접지에 접속되는 것을 특징으로 하는 화상 표시 장치의 구동방법.
  10. 제 8 항에 있어서, 상기 공통 소스 라인이 스위칭 회로부에 접속되고, 상기 스위칭 회로부가 발광 소자 조사 온 또는 오프의 상태를 제어하는 조사 제어 신호에 의해 제어되는데, 조사 제어 신호 온시, 상기 공통 소스 라인은 접지로부터 접속해제되고, 조사 오프 상태시, 상기 공통 소스 라인이 접지에 접속되는 것을 특징으로 하는 화상 표시 장치의 구동방법.
  11. 제 10 항에 있어서, 상기 스위칭 회로부가 발광 소자 활성시 논리 LOW 조사 제어 신호로 접지로부터 공통 소스 라인을 접속해제하고, 발광 소자의 비활성시 논리 HIGH 조사 제어 신호에 의해 접지로 공통 소스 라인을 접속하는 것을 특징으로 하는 화상 표시 장치의 구동방법.
  12. (a) 각 컬럼으로 배치된 각 발광 다이오드(LED)의 애노드가 각 전류 라인에 접속되고, 각 라인으로 배치된 각 LED의 캐소드가 각 공통 소스 라인에 접속되는 m-라인 및 n-컬럼 매트릭스로 배열된 복수의 발광 다이오드 (LED)의 도트 매트릭스,
    (b) 비활성 상태에 있어서, 입력 표시 데이터에 기초하여 각 공통 소스 라인 및 각 전류 라인의 한 단부를 통해 전도를 제어하고, 입력 조사 제어 신호에 따라 활성 또는 비활성인 활성 상태를 제어하기 위한 드라이버 회로, 및
    (c) 활성 상태시, 각 공통 소스 라인의 다른 단부를 부동하고, 비활성시, 각 공통 소스 라인의 다른 단부를 접지하는 스위칭 회로
    를 포함하는 것을 특징으로 하는 화상 표시 장치.
  13. 제 12 항에 있어서, 상기 스위칭 회로부가 각 공통 소스 라인과 접지 사이에 접속된 복수의 스위치인 것을 특징으로 하는 화상 표시 장치.
  14. 제 12 항에 있어서, 상기 스위칭 회로부가 LED 조사 온 또는 오프 상태를 제어하는 조사 제어 신호에 의해 제어되는데, 상기 조사 제어 신호의 조사 온시에 상기 스위칭 회로부가 접지로부터 상기 공통 소스 라인을 접속해제하고, 상기 조사 제어 신호의 조사 오프시에 상기 스위칭 회로부가 접지에 상기 공통 소스 라인을 접속하는 것을 특징으로 하는 화상 표시 장치.
  15. 제 13 항에 있어서, 상기 스위칭 회로부가 LED 조사 온 또는 오프 상태를 제어하는 조사 제어 신호에 의해 제어되는데, 상기 조사 온시에 상기 스위칭 회로부의 스위치가 접지로부터 상기 공통 소스 라인을 접속해제하기 위해 턴오프되고, 상기 조사 오프시에 상기 스위칭 회로부의 스위치가 접지에 상기 공통 소스 라인을 접속하기 위해 턴온되는 것을 특징으로 하는 화상 표시 장치.
  16. 제 12 항에 있어서, 상기 스위칭 회로부가 LED를 활성시키기 위해 논리 LOW 조사 제어 신호로 접지로부터 상기 공통 소스 라인을 접속해제하고, LED를 비활성시키기 위해 논리 HIGH 조사 제어 신호로 접지에 상기 공통 소스 라인을 접속하는 것을 특징으로 하는 화상 표시 장치.
  17. 제 12 항에 있어서, 상기 드라이버 회로가 각 공통 소스 라인에 대응하는 m-스위칭 회로를 갖는 전류 소스 스위칭 회로를 구비하는데, 활성 상태시, 상기 전류 소스 스위칭 회로가 상기 전류 소스에 입력 어드레스 신호에 의해 선택된 공통 소스 라인을 접속하는 것을 특징으로 하는 화상 표시 장치.
  18. 제 17 항에 있어서, 상기 드라이버 회로가 상기 입력 표시 데이터의 n-세트의 화소 레벨 데이터를 저장하기 위해 메모리 회로를 갖는 정전류 제어 회로부를 구비하는데, 활성 상태시, 상기 정전류 제어 회로부가 각 메모리 회로에 저장된 화소 레벨 데이터에 대응하는 화소 레벨 폭으로 도전 상태로 관련된 전류 라인을 유지하는 것을 특징으로 하는 화상 표시 장치.
  19. 조사 제어 신호에 의해 m-라인 및 n-컬럼 매트릭스로 배열된 각 LED의 조사 온 또는 오프 상태를 제어하고,
    상기 조사 오프시 LED의 공통 소스 라인이 이들 라인을 접지로 방전시키기 위해 접지에 접속되는 것을 특징으로 하는 화상 표시 장치의 구동방법.
  20. 제 19 항에 있어서, m-라인 및 n-컬럼 매트릭스로 배열된 각 LED의 한 단자가 전류 라인에 접속되고, 각 라인으로 배치된 각 LED의 다른 단자가 각 공통 소스 라인에 접속되며, 상기 공통 소스 라인이 이들 라인을 방전하도록 스위치에 의해 접지에 접속되는 것을 특징으로 하는 화상 표시 장치의 구동방법.
  21. 제 19 항에 있어서, 상기 공통 소스 라인이 스위칭 회로부에 접속되고, 상기 스위칭 회로부가 LED 조사 온 또는 오프의 상태를 제어하는 조사 제어 신호에 의해 제어되는데, 조사 제어 신호 온시, 상기 공통 소스 라인은 접지로부터 접속해제되고, 조사 오프 상태시 상기 공통 소스 라인이 접지에 접속되는 것을 특징으로 하는 화상 표시 장치의 구동방법.
  22. 제 21 항에 있어서, 상기 스위칭 회로부가 LED 활성시 논리 LOW 조사 제어 신호로 접지로부터 공통 소스 라인을 접속해제하고, LED의 비활성시 논리 HIGH 조사 제어 신호로 접지로부터 공통 소스 라인을 접속하는 것을 특징으로 하는 화상 표시 장치의 구동방법.
  23. (a) m-라인 및 n-컬럼 매트릭스로 배열된 화소 소자인 LED의 표시부,
    (b) 각 화소의 LED에 대응하는 보정 데이터를 저장하고, 메모리에 기입을 금지하고, 미리 저장된 제 1 보정 데이터를 유지하는 제 1 메모리 뱅크 및 메모리에 기입을 허용하는 제 2 메모리 뱅크를 구비하는 보정 데이터 메모리부, 및
    (c) 보정 데이터에 기초하여 입력 화상 데이터를 정정하고, 보정된 화상 데이터를 사용하여 상기 표시부상에 화상을 표시하는 제어 및 드라이버 회로
    를 포함하는 것을 특징으로 하는 화상 표시 장치.
  24. 제 23 항에 있어서, 상기 보정 데이터 메모리부가 전기적으로 소거가능하고 기입가능한 비휘발성 메모리인 것을 특징으로 하는 화상 표시 장치.
  25. 제 23 항 또는 제 24 항 중 어느 한 항에 있어서, 상기 제어 및 드라이버 회로가 상기 보정 데이터 메모리부를 제어하기 위한 통신 제어부를 구비하고, 이 통신 제어부가 제 2 메모리 뱅크내로 상기 제 1 보정 데이터와 다른 제 2 보정 데이터를 기입하기 위해 보정 데이터 메모리부를 제어하는 것을 특징으로 하는 화상 표시 장치.
  26. 제 23 항 또는 제 24 항 중 어느 한 항에 있어서, 상기 제어 및 드라이버 회로가 상기 보정 데이터 메모리부를 제어하기 위한 통신 제어부를 구비하고, 이 통신 제어부가 제 1 메모리 뱅크에의 기입을 금지하기 위해 보정 데이터 메모리부를 제어하는 것을 특징으로 하는 화상 표시 장치.
  27. 제 23 항 또는 제 24 항 중 어느 한 항에 있어서, 상기 제어 및 드라이버 회로가 상기 보정 데이터 메모리부를 제어하기 위한 통신 제어부를 구비하고, 이 통신 제어부가 제 2 메모리 뱅크내로 상기 제 1 보정 데이터와 다른 제 2 보정 데이터를 기입하고, 상기 제 1 메모리 뱅크에의 데이터의 기입을 금지하기 위해 보정 데이터 메모리부를 제어하는 것을 특징으로 하는 화상 표시 장치.
  28. 제 23 항에 있어서, 상기 보정 데이터 메모리부의 기입가능한 제 2 메모리 뱅크가 기입을 금지하도록 설정될 수 있는 것을 특징으로 하는 화상 표시 장치.
  29. 제 23 항에 있어서, 상기 보정 데이터 메모리부가 보정 데이터로서 각 화소에 대응하는 LED에 어드레스 및 보정 데이터를 저장하고, 상기 제 1 및 제 2 메모리 뱅크가 어드레스의 최상위 비트에 의해 구별되는 것을 특징으로 하는 화상 표시 장치.
  30. 제 23 항에 있어서, 상기 화상 표시 장치가 전체 화상 데이터를 부분으로 나누고, 일 부분을 표시하는 것을 특징으로 하는 화상 표시 장치.
  31. 제 23 항에 있어서, 각 화소의 LED의 휘도 변화를 보정하기 위한 데이터가 상기 보정 데이터 메모리부의 제 1 메모리부에 저장되는 것을 특징으로 하는 화상 표시 장치.
  32. (a) m-라인 및 n-컬럼 매트릭스로 배열된 LED인 복수의 발광 소자의 표시부,
    (b) 각 라인에서 상기 표시부 및 소스 전류의 각 연속적인 라인을 선택하기 위한 수직 드라이버부,
    (c) 상기 선택된 라인에 대한 화상 데이터에 대응하는 화상 표시부의 각 컬럼에 구동 전류를 공급하기 위한 수평 드라이버부,
    (d) 상기 보정 데이터 메모리부에 저장된 보정 데이터에 따라 화상 데이터의 외부 입력, 상기 수평 드라이버부로의 보정된 화상 데이터의 출력 및 보정된 화상 데이터의 한 라인이 수평 드라이버부로의 출력되는 각 시간에 상기 보정 데이터 메모리부로부터 보정 데이터의 한 라인의 독출을 보정하기 위한 화상 데이터 보정부, 및
    (e) 각 화소의 LED 특성 변화시 외부 입력 화상 데이터를 보정하기 위해 보정 데이터를 저장하기 위한 보정 데이터 메모리부
    를 포함하는 것을 특징으로 하는 화상 표시 장치.
  33. 제 32 항에 있어서, 상기 화상 데이터 보정부가 최소한 1 라인 이상의 보정 데이터를 저장하기 위한 버퍼 메모리를 구비하는 것을 특징으로 하는 화상 표시 장치.
  34. 제 33 항에 있어서, 상기 화상 데이터 보정부는, 보정된 화상 데이터의 한 라인을 수평 드라이버부로 출력할 때, 상기 보정 데이터 메모리부로부터 보정 데이터의 그 다음 라인을 독출하는 것을 특징으로 하는 화상 표시 장치.
  35. 제 33 항에 있어서, 상기 버퍼 메모리가 시프트 레지스터를 구비하고, 각 시프트 레지스터를 통해 한번에 1 비트를 연속적으로 시프트함으로써, 직접 데이터를 독출함을 특징으로 하는 것을 특징으로 하는 화상 표시 장치.
  36. 제 33 항에 있어서, 상기 버퍼 메모리가 2 단의 상호접속된 레지스터를 포함하는데, 제 1 레지스터가 상기 보정 데이터의 1 라인을 출력하고, 제 2 레지스터가 상기 보정 데이터의 그 다음 라인에서 독출하고, 상기 제 2 레지스터가 각 시간에 제 1 레지스터로 보정 데이터를 전송하고, 한 라인의 보정 데이터 출력 및 독출이 완료하는 것을 특징으로 하는 화상 표시 장치.
  37. 제 36 항에 있어서, 상기 제 2 레지스터가 시프트 레지스터이고, 한 번에 1 비트를 연속적으로 시프트함으로써, 직접 보정 데이터를 판독하는 것을 특징으로 하는 화상 표시 장치.
  38. 제 32 항에 있어서, 상기 화상 표시 장치가 전체 화상 데이터를 부분으로 나누고, 일 부분을 표시하는 것을 특징으로 하는 화상 표시 장치.
  39. 제 32 항에 있어서, 상기 LED인 발광 소자는 3 색, 즉, 적색, 녹색, 청색 (RGB) LED인 것을 특징으로 하는 화상 표시 장치.
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