KR101085322B1 - 배선 기판 및 그의 제조 방법 - Google Patents
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Abstract
Description
Claims (27)
- 유전체층과, 상기 유전체층을 사이에 두고 대향하는 1개의 제1 전극 및 1개의 제2 전극으로 형성되는 컨덴서를, 각각의 사이에 접착제를 개재하여 복수개의 상기 컨덴서를 적층시켜 형성되는 컨덴서 적층체와,상기 컨덴서 적층체를 내장하는 제1 수지 절연층과,상기 제1 수지 절연층을 지지하는 베이스 기판과,상기 제1 전극끼리를 전기적으로 접속하는 제1 비아 도체와,상기 제2 전극끼리를 전기적으로 접속하는 제2 비아 도체와,상기 제1 비아 도체와 전기적으로 접속되어 있는 제1 외부 단자와,상기 제2 비아 도체와 전기적으로 접속되어 있는 제2 외부 단자를 갖는 것을 특징으로 하는 배선 기판.
- 제1항에 있어서,상기 제1 전극과 제2 전극은 전극의 면 방향으로 서로 어긋나게 배치되고,상기 제1 비아 도체는, 상기 제1 전극의 단부를 관통함으로써 제1 전극끼리를 전기적으로 접속하고,상기 제2 비아 도체는, 상기 제2 전극의 단부를 관통함으로써 제2 전극끼리를 전기적으로 접속하는것을 특징으로 하는 배선 기판.
- 제1항에 있어서,상기 컨덴서 적층체의 상면은 상기 제1 수지 절연층의 상면에 있고, 상기 컨덴서 적층체의 상면과 상기 제1 수지 절연층의 상면이 동일한 면으로 되어 있는 것을 특징으로 하는 배선 기판.
- 제1항에 있어서,상기 제1 수지 절연층 위에 제2 수지 절연층을 더 갖는 것을 특징으로 하는 배선 기판.
- 제4항에 있어서,상기 베이스 기판 위 및 상기 제2 수지 절연층 위에는 도체 패턴이 형성되고,상기 비아 도체는, 상기 베이스 기판 위의 도체 패턴과 상기 제2 수지 절연층 위의 도체 패턴을 전기적으로 접속하고 있는 것을 특징으로 하는 배선 기판.
- 제4항에 있어서,상기 제2 수지 절연층 위에 제3 수지 절연층을 더 갖는 것을 특징으로 하는 배선 기판.
- 제6항에 있어서,상기 제2 수지 절연층 위에 도체 패턴을 갖고,상기 제3 수지 절연층 위에 도체 패턴을 갖는 것을 특징으로 하는 배선 기판.
- 제7항에 있어서,상기 제2 수지 절연층 위의 도체 패턴과, 상기 제3 수지 절연층 위의 도체 패턴을 전기적으로 접속하는 비아 도체를 갖는 것을 특징으로 하는 배선 기판.
- 제3항에 있어서,상기 베이스 기판 위 및 상기 제1 수지 절연층 위에는 도체 패턴이 형성되고,상기 비아 도체는, 상기 베이스 기판 위의 도체 패턴과 상기 제1 수지 절연층 위의 도체 패턴을 전기적으로 접속하고 있는 것을 특징으로 하는 배선 기판.
- 제9항에 있어서,상기 제1 수지 절연층 위의 도체 패턴과, 상기 컨덴서 적층체의 최상면에 있는 컨덴서의 제1 전극이 일체로 되어 있는 것을 특징으로 하는 배선 기판.
- 제1항에 있어서,상기 제1 전극은 복수의 제1 개구부를 갖고,상기 제2 전극은 복수의 제2 개구부를 가지며,상기 제1 비아 도체는, 상기 제2 개구부를 상기 제2 전극에 비접촉으로 관통하면서 상기 제1 전극끼리를 전기적으로 접속하고,상기 제2 비아 도체는, 상기 제1 개구부를 상기 제1 전극에 비접촉으로 관통하면서 상기 제2 전극끼리를 전기적으로 접속하는것을 특징으로 하는 배선 기판.
- 적어도 최하층의 수지 절연층과 최상층의 수지 절연층을 갖는 복수의 수지 절연층과,상기 수지 절연층의 사이에 형성되어 있는 복수의 도체 회로와,상기 복수의 수지 절연층 중의 1개의 수지 절연층에 매설되어 있고, 유전체층과, 상기 유전체층을 사이에 두고 대향하는 1개의 제1 전극 및 1개의 제2 전극으로 형성되는 컨덴서를, 각각의 사이에 접착제를 개재하여 복수개의 상기 컨덴서를 적층시켜 형성되는 컨덴서 적층체와,상기 제1 전극끼리를 전기적으로 접속하는 제1 비아 도체와,상기 제2 전극끼리를 전기적으로 접속하는 제2 비아 도체와,상기 최하층의 수지 절연층에 형성되어 있고, 상기 제1 비아 도체와 전기적으로 접속되어 있는 제1 외부 단자와 상기 제2 비아 도체와 전기적으로 접속되어 있는 제2 외부 단자로 이루어지는 제1 외부 접속 단자와,상기 최상층의 수지 절연층에 형성되어 있고, 상기 제1 비아 도체와 전기적으로 접속되어 있는 제3 외부 단자와 상기 제2 비아 도체와 전기적으로 접속되어 있는 제4 외부 단자로 이루어지는 제2 외부 접속 단자를 갖고,상기 제1 외부 접속 단자는 상기 최하층의 수지 절연층에 매설됨과 함께, 상기 제1 외부 접속 단자의 외부 단자면은, 상기 최하층의 수지 절연층의 제1 면과 동일 평면에 위치하고 있고,상기 제2 외부 접속 단자는 상기 최상층의 수지 절연층 위에 형성되어 있는 것을 특징으로 하는 배선 기판.
- 제1항에 있어서,상기 접착제는 상기 제1 수지 절연층을 형성하는 수지인 것을 특징으로 하는 배선 기판.
- 유전체층과, 상기 유전체층을 사이에 두고 대향하는 1개의 제1 전극 및 1개의 제2 전극을 갖는 컨덴서를 작성하는 컨덴서 작성 공정과,상기 컨덴서를 각각의 사이에 접착제를 개재하여 복수개의 상기 컨덴서를 적층시킴으로써 컨덴서 적층체를 작성하는 컨덴서 적층체 작성 공정과,베이스 기판 위에 제1 수지 절연층을 적층시키는 적층 공정과,상기 제1 수지 절연층에 상기 컨덴서 적층체를 매설시키는 매설 공정과,상기 컨덴서 적층체에, 상기 제1 전극끼리를 관통하는 관통 구멍과, 상기 제2 전극끼리를 관통하는 관통 구멍을 형성하는 관통 구멍 형성 공정과,상기 관통 구멍에 금속 도체를 충전시킴으로써, 상기 제1 전극끼리를 전기적으로 접속하는 제1 비아 도체와, 상기 제2 전극끼리를 전기적으로 접속하는 제2 비아 도체를 작성하는 비아 도체 작성 공정과,상기 제1 비아 도체와 전기적으로 접속되어 있는 제1 외부 단자와, 상기 제2 비아 도체와 전기적으로 접속되어 있는 제2 외부 단자를 작성하는 외부 단자 작성 공정을 갖는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제14항에 있어서,상기 컨덴서 적층체 작성 공정에서는, 상기 제1 전극과 제2 전극을 전극의 면 방향으로 서로 어긋나게 배치함으로써 컨덴서 적층체를 작성하고,상기 관통 구멍 형성 공정에서는, 상기 제1 전극의 단부를 관통하는 관통 구멍을 형성함과 함께, 상기 제2 전극의 단부를 관통하는 관통 구멍을 형성하는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제14항에 있어서,상기 매설 공정에서는, 상기 컨덴서 적층체의 상면과 상기 수지 절연층의 상면이 동일한 면으로 되도록, 상기 컨덴서 적층체를 상기 제1 수지 절연층에 매설시키는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제14항에 있어서,상기 매설 공정 후에, 상기 제1 수지 절연층 위에 제2 수지 절연층을 더 적층시키는 공정을 갖는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제17항에 있어서,상기 관통 구멍 형성 공정에서는, 상기 제1 전극 혹은 상기 제2 전극끼리를 관통할 뿐만 아니라, 상기 제2 수지 절연층도 관통하는 관통 구멍을 형성하고,상기 비아 도체 작성 공정은, 상기 베이스 기판 위의 도체 패턴과 상기 제2 수지 절연층 위의 도체 패턴을 전기적으로 접속하고 있는 비아 도체를 형성하는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제17항에 있어서,상기 비아 도체 작성 공정 후에, 상기 제2 수지 절연층 위에 제3 수지 절연층을 더 형성하고,상기 제2 수지 절연층 위의 도체 패턴과 상기 제3 수지 절연층 위의 도체 패턴을 전기적으로 접속하는 비아 도체를 형성하는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제14항에 있어서,상기 매설 공정에서는, 상기 컨덴서 적층체의 최상층의 컨덴서에 형성된 얼라인먼트 마크 혹은 최하층의 컨덴서에 형성된 얼라인먼트 마크와, 상기 베이스 기판 위에 형성된 얼라인먼트 마크를, 상기 컨덴서 적층체와 상기 제1 수지 절연층의 위치 맞춤을 위한 표지로 하는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제16항에 있어서,상기 비아 도체 작성 공정은, 상기 베이스 기판 위의 도체 패턴과 상기 제1 수지 절연층 위의 도체 패턴을 전기적으로 접속하고 있는 비아 도체를 형성하는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제21항에 있어서,상기 제1 수지 절연층 위의 도체 패턴과, 상기 컨덴서 적층체의 최상면에 있는 컨덴서의 제1 전극이 일체로 되어 있는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제14항에 있어서,상기 컨덴서 적층체 작성 공정에서는, 상기 제1 전극은 복수의 제1 개구부를 가짐과 함께, 상기 제2 전극은 복수의 제2 개구부를 갖고,상기 관통 구멍 형성 공정에서는, 상기 제2 개구부를 상기 제2 전극에 비접촉으로 관통하면서 상기 제1 전극끼리를 관통하는 관통 구멍을 형성함과 함께, 상 기 제1 개구부를 상기 제1 전극과 비접촉으로 관통하면서 상기 제2 전극끼리를 관통하는 관통 구멍을 형성하는 것을 특징으로 하는 배선 기판의 제조 방법.
- 제14항에 있어서,상기 접착제는 상기 제1 수지 절연층을 형성하는 수지인 것을 특징으로 하는 배선 기판의 제조 방법.
- 유전체층과, 상기 유전체층을 사이에 두고 대향하는 1개의 제1 전극 및 1개의 제2 전극을 갖는 컨덴서를 작성하는 컨덴서 작성 공정과,상기 컨덴서를 각각의 사이에 접착제를 개재하여 복수개의 상기 컨덴서를 적층시킴으로써 컨덴서 적층체를 작성하는 컨덴서 적층체 작성 공정과,지지판 위에, 제1 외부 단자와 제2 외부 단자를 갖는 제1 외부 접속 단자를 형성하는 제1 외부 접속 단자 형성 공정과,상기 제1 외부 접속 단자와 지지판 위에 복수의 수지 절연층과 복수의 도체 회로를 번갈아 적층시키는 빌드업 공정과,상기 복수의 수지 절연층 중 1개의 수지 절연층에 상기 컨덴서 적층체를 매설시키는 매설 공정과,상기 컨덴서 적층체에, 상기 제1 전극 혹은 상기 제2 전극끼리를 관통하는 관통 구멍을 형성하는 관통 구멍 형성 공정과,상기 관통 구멍에 금속 도체를 충전시킴으로써, 상기 제1 전극끼리를 전기적으로 접속하는 제1 비아 도체와, 상기 제2 전극끼리를 전기적으로 접속하는 제2 비아 도체를 작성하는 비아 도체 작성 공정과,상기 복수의 수지 절연층 중, 상기 지지판과는 반대측에 위치하는 최상층의 수지 절연층 위에 제3 외부 단자와 제4 외부 단자를 갖는 제2 외부 접속 단자를 형성하는 제2 외부 접속 단자 형성 공정과,상기 지지판을 제거하는 지지판 제거 공정을 갖고,상기 제1 외부 단자와 상기 제3 외부 단자는 상기 제1 비아 도체와 전기적으로 접속되어 있고, 상기 제2 외부 단자와 상기 제4 외부 단자는 상기 제2 비아 도체와 전기적으로 접속되어 있는 것을 특징으로 하는 배선 기판의 제조 방법.
- 유전체층과, 상기 유전체층을 사이에 두고 대향하는 1개의 제1 전극 및 1개의 제2 전극으로 형성되는 컨덴서를, 각각의 사이에 접착제를 개재하여 복수개의 상기 컨덴서를 적층시켜 형성되는 제1 컨덴서 적층체와,상기 제1 컨덴서 적층체를 내장하는 제1 수지 절연층과,상기 제1 수지 절연층을 지지하는 베이스 기판과,상기 베이스 기판을 지지하는 제2 수지 절연층과 - 상기 제2 수지 절연층에는, 유전체층과, 유전체층을 사이에 두고 대향하는 1개의 제1 전극 및 1개의 제2 전극으로 형성되는 컨덴서를, 각각의 사이에 접착제를 개재하여 복수개의 컨덴서를 적층시켜 형성되는 제2 컨덴서 적층체가 매설되어 있음 -,상기 제1 전극끼리를 전기적으로 접속하는 제1 비아 도체와,상기 제2 전극끼리를 전기적으로 접속하는 제2 비아 도체와,상기 제1 비아 도체와 전기적으로 접속되어 있는 제1 외부 단자와,상기 제2 비아 도체와 전기적으로 접속되어 있는 제2 외부 단자를 갖는 것을 특징으로 하는 배선 기판.
- 제26항에 있어서,상기 컨덴서의 유전체층의 두께는 0.5㎛∼10㎛인 배선 기판.
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---|---|---|---|---|
US20090296310A1 (en) * | 2008-06-03 | 2009-12-03 | Azuma Chikara | Chip capacitor precursors, packaged semiconductors, and assembly method for converting the precursors to capacitors |
WO2010041589A1 (ja) * | 2008-10-08 | 2010-04-15 | 株式会社村田製作所 | 複合モジュール |
CN102356703B (zh) * | 2009-03-19 | 2015-05-13 | 株式会社村田制作所 | 电路基板以及母层叠体 |
JP5589314B2 (ja) * | 2009-06-25 | 2014-09-17 | 株式会社リコー | 電子部品モジュールの製造方法 |
EP2519089B1 (en) * | 2009-12-24 | 2017-09-13 | Murata Manufacturing Co., Ltd. | Circuit module |
EP2745655B1 (en) * | 2011-08-15 | 2015-10-07 | SMA Solar Technology AG | Electronic device comprising a capacitor in a holder for a circuit board and method for production thereof |
CN103096646B (zh) * | 2011-10-31 | 2016-01-20 | 健鼎(无锡)电子有限公司 | 内埋元件的多层基板的制造方法 |
US20140070404A1 (en) * | 2012-09-12 | 2014-03-13 | Shing-Ren Sheu | Semiconductor package structure and interposer therefor |
US9035194B2 (en) * | 2012-10-30 | 2015-05-19 | Intel Corporation | Circuit board with integrated passive devices |
KR101420526B1 (ko) * | 2012-11-29 | 2014-07-17 | 삼성전기주식회사 | 전자부품 내장기판 및 그 제조방법 |
US20140167900A1 (en) | 2012-12-14 | 2014-06-19 | Gregorio R. Murtagian | Surface-mount inductor structures for forming one or more inductors with substrate traces |
CN106031316B (zh) * | 2014-02-21 | 2019-06-28 | 三井金属矿业株式会社 | 内置电容器层形成用覆铜层压板、多层印刷线路板以及多层印刷线路板的制造方法 |
US20190045620A1 (en) * | 2014-07-09 | 2019-02-07 | Schreiner Group Gmbh & Co. Kg | Sensor device with a flexible electrical conductor structure |
US20160055976A1 (en) * | 2014-08-25 | 2016-02-25 | Qualcomm Incorporated | Package substrates including embedded capacitors |
US9659850B2 (en) * | 2014-12-08 | 2017-05-23 | Qualcomm Incorporated | Package substrate comprising capacitor, redistribution layer and discrete coaxial connection |
CN104900406B (zh) * | 2015-06-01 | 2017-10-10 | 中国科学院上海硅酸盐研究所 | 可键合多层陶瓷电容器及其制备方法 |
JP6741419B2 (ja) * | 2015-12-11 | 2020-08-19 | 株式会社アムコー・テクノロジー・ジャパン | 半導体パッケージおよびその製造方法 |
US10373904B2 (en) | 2017-08-28 | 2019-08-06 | Micron Technology, Inc. | Semiconductor devices including capacitors, related electronic systems, and related methods |
CN111128993A (zh) * | 2019-12-18 | 2020-05-08 | 台达电子企业管理(上海)有限公司 | 基板及其所适用的制造方法及功率模块 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001297944A (ja) | 2000-04-14 | 2001-10-26 | Matsushita Electric Ind Co Ltd | 薄膜積層体とコンデンサ及びこれらの製造方法と製造装置 |
JP2007096232A (ja) * | 2005-09-30 | 2007-04-12 | Fujitsu Ltd | インターポーザ及び電子装置の製造方法 |
JP2007150123A (ja) * | 2005-11-30 | 2007-06-14 | Ngk Spark Plug Co Ltd | 配線基板内蔵用キャパシタ、キャパシタ内蔵配線基板及びその製造方法 |
Family Cites Families (17)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5818734B2 (ja) * | 1981-01-19 | 1983-04-14 | 松下電子工業株式会社 | カラ−受像管用シャドウマスク構体の製造方法 |
US4555746A (en) * | 1983-01-12 | 1985-11-26 | Matsushita Electric Industrial Co., Ltd. | Organic chip capacitor |
JPS59127829A (ja) * | 1983-01-12 | 1984-07-23 | 松下電器産業株式会社 | チツプ状フイルムコンデンサ− |
KR100890475B1 (ko) * | 1999-09-02 | 2009-03-26 | 이비덴 가부시키가이샤 | 프린트배선판 및 그 제조방법 |
CN100378880C (zh) * | 2001-06-08 | 2008-04-02 | 松下电器产业株式会社 | 层叠薄膜电容器及其制造方法 |
JP2003298232A (ja) * | 2002-04-02 | 2003-10-17 | Sony Corp | 多層配線基板の製造方法および多層配線基板 |
JP3956851B2 (ja) * | 2003-01-21 | 2007-08-08 | 凸版印刷株式会社 | 受動素子内蔵基板及びその製造方法 |
JP2005039243A (ja) * | 2003-06-24 | 2005-02-10 | Ngk Spark Plug Co Ltd | 中間基板 |
JP4700332B2 (ja) | 2003-12-05 | 2011-06-15 | イビデン株式会社 | 多層プリント配線板 |
JP2005286233A (ja) * | 2004-03-30 | 2005-10-13 | Tdk Corp | 薄膜コンデンサ及びその製造方法 |
CN100367491C (zh) * | 2004-05-28 | 2008-02-06 | 日本特殊陶业株式会社 | 中间基板 |
JP4339781B2 (ja) * | 2004-12-09 | 2009-10-07 | 日本特殊陶業株式会社 | 配線基板 |
JP4584700B2 (ja) * | 2004-12-17 | 2010-11-24 | 新光電気工業株式会社 | 配線基板の製造方法 |
JP4591100B2 (ja) * | 2005-02-03 | 2010-12-01 | ソニー株式会社 | 半導体装置およびその製造方法 |
CN1925720B (zh) * | 2005-09-01 | 2010-04-14 | 日本特殊陶业株式会社 | 布线基板、电容器 |
JP4964481B2 (ja) * | 2006-03-24 | 2012-06-27 | 日本特殊陶業株式会社 | 配線基板 |
TWI407870B (zh) * | 2006-04-25 | 2013-09-01 | Ngk Spark Plug Co | 配線基板之製造方法 |
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Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001297944A (ja) | 2000-04-14 | 2001-10-26 | Matsushita Electric Ind Co Ltd | 薄膜積層体とコンデンサ及びこれらの製造方法と製造装置 |
JP2007096232A (ja) * | 2005-09-30 | 2007-04-12 | Fujitsu Ltd | インターポーザ及び電子装置の製造方法 |
JP2007150123A (ja) * | 2005-11-30 | 2007-06-14 | Ngk Spark Plug Co Ltd | 配線基板内蔵用キャパシタ、キャパシタ内蔵配線基板及びその製造方法 |
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