KR100573520B1 - 개선된 전류 감지를 갖는 동기-정류된 직류/직류 컨버터 - Google Patents

개선된 전류 감지를 갖는 동기-정류된 직류/직류 컨버터 Download PDF

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Abstract

DC/DC 벅(buck) 펄스 폭 변조 컨버터 회로는 입력, 상측 출력 및 하측 출력을 포함한다. 상측 스위치는 공통 출력 노드 및 전압원사이에 전기적으로 연결되고, 상측 출력에 따라 좌우되는 전류의 흐름을 제어한다. 하측 스위치는 공통 출력 노드 및 접지사이에 전기적으로 연결되고, 하측 출력에 따라 좌우되는 전류의 흐름을 제어한다. 가상 접지 증폭기는 접지에 전기적으로 연결된 제 2 입력을 포함한다. 전류 귀환 저항기는 가상 접지 증폭기의 공통 출력 노드 및 제 1 입력의 중간에 전기적으로 연결된다. 가변 임피던스 소자는 가상 접지 증폭기의 출력 및 가상 접지 증폭기의 제 1 입력에 전기적으로 연결된다. 가변 임피던스 소자의 임피던스는 가상 접지 증폭기의 출력에 따라 변동된다. 샘플 및 홀드 회로는 펄스폭 변조기 컨버터 회로의 입력 및 가변 임피던스 소자의 중간에 전기적으로 연결된다.
SR 래치, 톱니파 발생기, 과전류 검출기, 샘플 및 홀드 회로, 음전류 소스, 시스템 제어 회로, 구동기, 전압 귀환 저항기, 가상 접지 증폭기

Description

개선된 전류 감지를 갖는 동기-정류된 직류/직류 컨버터{SYNCHRONOUS-RECTIFIED DC TO DC CONVERTER WITH IMPROVED CURRENT SENSING}
도 1은 본 발명의 DC/DC 컨버터의 제 1 실시예에 대한 고-레벨의 개략 및 기능도이다;
도 2는 도 1의 DC/DC 컨버터의 상세한 개략 및 기능도이다;
도 3a 및 3b는 도 2의 DC/DC 컨버터의 작동을 도시한 타이밍 도이다;
도 4는 도 2의 DC/DC 컨버터의 노드 전압 대 부하 전류의 그래프이다;
도 5는 도 2의 DC/DC 컨버터를 이용하기 위한 음전류 소스의 개략도이다; 및
도 6은 본 발명의 DC/DC 컨버터의 제 2 실시예의 상세한 개략도이다.
상응하는 참고 부호는 도면 전반에 걸쳐 상응하는 부분들을 나타낸다.
(도면의 주요부분에 대한 부호의 설명)
12:하측 FET 36:가변임피던스 소자 60:톱니 발생기
14:상측 FET 38:샘플 및 홀드 회로 62:SR 래치
16:공통 출력 노드 40:시스템 제어 회로 64:구동기
18:전원 44:전압 귀환 저항기 66:싱크 펄스
20:DC/DC 벅 컨버터 회로 46:에러 증폭기 70:과전류 검출회로
26:전류 귀환 저항기 48:기준 전압원 72:음전류 소스
30:가상 접지 회로 노드 50:보상 회로 노드 80, 82, 84:스위치
34:가상 접지 증폭기 52:보상 저항기 88:전압원
34a:반전 입력 54:보상 커패시터 90, 94:노드
34b:비-반전 입력 56:서밍 노드 92:커패시터
34c:출력 58:비교기
동기 벅 DC/DC 컨버터는 통상적으로 입력 공급 전압 또는 접지에 인덕터의 제 1 끝부분을 연결하기 위해 처리된 한 쌍의 스위치를 이용한다. 인덕터의 제 2 끝부분은 부하에 부착된다. 그것은 전계 효과 트랜지스터(FET)를 이런 스위치로 이용하는 것으로 널리 알려져 있다. 부하 전류는 FET이 온인 동안 그 공급으로 부터 상측 FET 및 인덕터를 통해 흐르고, FET가 온인 동안 접지로 부터 하측 FET 및 인덕터를 통해 흐른다.
가령, 예를 들어, 부하 전류가 증가할 때출력 전압을 의도적으로 감소시키고(즉, 출력 전압의 "드룹(droop)"), 부하 및 컨버터 소자를 보호하기 위해 전류 제한 또는 과도한-전류 트립을 제공하며, 그리고 다중-채널 또는 다중-위상 컨버터에서 각 채널에 의해 공급되는 출력 전류를 평형(balance)시키기 위한 것과 같은 다양한 기능을 수행하기 위해 부하 전류의 값을 감지하는 것이 바람직하다. 부하 전류는 인덕터의 DC 저항의 결정 및 그 DC 저항을 통한 전압 강하의 감지를 통해, 또는 가산된 직렬 감지 저항기를 통과하는 전압 강하를 감지함으로써 감지된다. 부하 전류는 또한 상측 FET 스위치를 통해 흐르는 부하 전류에 의해 발생된 전압 강하를 감지함으로써 검출된다. 그러나, 각각의 이런 방법들은 각각의 단점을 가지고 있다. 인덕터의 DC 저항을 이용하여 부하 전류를 감지하는 데는 전류의 AC 소자를 제거하기 위해 인덕터를 가로질러 R-C 필터를 가산할 필요가 있다. 따라서, 가산 소자가 필요하고 추가 비용이 든다. 직렬 감지 저항기를 가산하는 데는 또한 추가 소자가 필요하고, 비용이 증가하며, 그리고 시스템 효율이 감소된다. 게다가, 도통시에 상측 FET의 드레인-소스간 저항을 통해 전압 강하를 감지하는 데는 스위치가 온일 때의 시간이 통상적으로 매우 짧기 때문에 비실용적이라는 것이 자주 입증되었다.
그러므로, 본 기술 분야에서 필요로 하는 것은 개선된 전류 감지를 갖는 DC/DC 컨버터이다. 게다가, 본 기술 분야에서 필요로 하는 것은 스위칭 FET의 드레인-소스간 저항에 걸친 전압 강하를 감지함으로써 DC/DC 컨버터에서 부하 전류의 감지를 할 수 있는 장치 및 방법이다.
본 발명은,
(a) 입력, 상측 출력 및 하측 출력을 갖는 DC/DC 벅 펄스폭 변조기 컨버터 회로;
(b) 공통 출력 노드 및 전압원의 중간에 전기적으로 연결되는 상측 스위치;
상기 상측 스위치는 적어도 부분적으로 상기 상측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되고,
(c) 상기 공통 출력 노드 및 접지의 중간에 전기적으로 연결되는 하측 스위치;
상기 하측 스위치는 적어도 부분적으로 상기 하측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되고,
(d) 제 1 입력, 제 2 입력 및 출력을 갖는 가상 접지 증폭기;
상기 제 2 입력은 접지 전위에 전기적으로 연결되고,
(e) 상기 공통 출력 노드 및 상기 가상 접지 증폭기의 상기 제 1 입력의 중간에 전기적으로 연결되는 전류 귀환 저항기;
(f) 상기 가상 접지 증폭기의 상기 출력 및 상기 가상 접지 증폭기의 상기 제 1 입력에 전기적으로 연결되는 가변 임피던스 소자; 및
상기 가변 임피던스 소자는 적어도 부분적으로 상기 가상 접지 증폭기의 상기 출력에 따라 임피던스를 변동시키기 위해 구성되며,
(g) 상기 DC/DC 벅 펄스폭 변조기 컨버터 회로 및 상기 가변 임피던스 소자의 중간에 전기적으로 연결되는 샘플 및 홀드 회로를 포함하며,
상기 샘플 및 홀드 회로는 가상 접지 전류를 상기 가변 임피던스 소자를 통해 공급하고, 상기 가상 접지 전류를 샘플 및 홀드하기 위해 구성되는 것을 특징으로 하는 전원을 포함한다.
본 발명은 또한 전원에서 출력 전류의 감지 방법으로서, 상기 전원은 입력, 상측 출력 및 하측 출력을 갖는 DC/DC 벅 펄스폭 변조기 컨버터 회로를 포함하고, 상기 방법은:
(a) 공통 출력 노드 및 전압원의 중간에 상측 스위치를 전기적으로 연결시키는 단계;
상기 상측 스위치는 적어도 부분적으로 상기 상측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되며, 하측 스위치는 상기 공통 출력 노드 및 접지의 중간에 전기적으로 연결되고, 상기 하측 스위치는 적어도 부분적으로 상기 하측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되며,
(b) 감지된 전류를 가상 접지 노드로 향하게 하는 단계;
상기 감지된 전류는 상기 하측 스위치가 온 상태에 있을 때 알려진 일부의 출력 전류를 포함하며, 상기 감지된 전류는 제 1 방향으로 상기 가상 접지 노드로 흘러 들어가고,
(c) 가상 접지 전류를 상기 가상 접지 노드로 공급하는 단계; 및
상기 가상 접지 전류는 제 2 방향으로 상기 가상 접지 노드로 흘러 들어가며, 상기 제 2 방향은 상기 제 1 방향에 반대이고, 상기 가상 접지 전류는 실질적으로 상기 감지된 전류와 같으며 이로 인해 상기 가상 접지 노드에서 상기 감지된 전류를 제거하고,
(d) 상기 가상 접지 전류의 값을 샘플링 및 홀딩하는 단계를 포함하는 것을 특징으로 한다.
편리하게도, 본 발명은 그 중의 한 형태로 입력, 상측 출력 및 하측 출력을 갖는 DC/DC 벅(buck) 펄스폭 변조 회로를 포함한다. 상측 스위치는 공통 출력 노드 및 전압원사이에 전기적으로 연결되고, 상측 출력에 따라 좌우되는 전류의 흐름을 제어한다. 하측 스위치는 공통 출력 노드 및 접지사이에 전기적으로 연결되고, 하측 출력에 따라 좌우되는 전류의 흐름을 제어한다. 가상 접지 증폭기는 접지에 전기적으로 연결된 제 2 입력을 포함한다. 전류 귀환 저항기는 공통 출력 노드 및 가상 접지 증폭기의 제 1 입력의 중간에 전기적으로 연결된다. 가변 임피던스 소자는 가상 접지 증폭기의 출력 및 가상 접지 증폭기의 제 1 입력에 전기적으로 연결된다. 가변 임피던스 소자의 임피던스는 가상 접지 증폭기의 출력에 따라 변동된다.
샘플 및 홀드 회로는 펄스폭 변조기 컨버터 회로의 입력 및 가변 임피던스 소자의 중간에 전기적으로 연결된다. 샘플 및 홀드 회로는 가상 접지 전류를 가변 임피던스 소자를 통해 공급하고, 가상 접지 전류를 샘플시킨다.
DC/DC 컨버터 또는 본 발명의 이점은 매우 짧은 "온" 시간을 갖는 FET의 드레인-소스저항 양단에 걸친 전압 강하를 측정하는 장치 및 방법을 제공하는 것이다.
DC/DC 컨버터의 또 다른 이점은 전압 귀환 저항값을 적절하게 선택함으로써 부하 전류의 변화에 응답하여 출력 전압의 드룹량의 크기를 쉽게 조절할 수 있다는 것이다.
DC/DC 컨버터의 또 다른 이점은 전류 제한 또는 트립의 민감도 또는 크기를 전압 귀환 저항값을 적절하게 선택함으로써 쉽게 조절할 수 있다는 것이다.
DC/DC 컨버터의 추가적인 또하나의 이점은 전류 귀환 저항값을 적절하게 선택함으로써 넓은 범위의 부하 전류 및 소자 값을 채택할 수 있게 된다는 점이다.
도 1은 DC/DC 컨버터의 제 1 실시예를 도시한다. DC/DC 컨버터(10)는 하측 전계 효과 트랜지스터(FET)(12) 및 상측 FET(14)을 포함한다. 하측 FET(12)의 드레인은 공통 출력 노드(16)에서 상측 FET(14)의 소스에 전기적으로 연결된다. 상측 FET(14)의 드레인은 전원(18)에 연결된다. 하측 FET(12)의 소스는 접지에 전기적으로 연결된다. 하측 FET(12) 및 상측 FET(14)의 각 게이트 단자는 벅 컨버터 회로(20)의 각각의 출력(참조되지 않음)에 전기적으로 연결된다. 인덕터(24) 및 전류 귀환 저항기(26)는 각각 공통 출력 노드(16)에 전기적으로 연결되고, 따라서 FET(12)의 드레인 및 FET(14)의 소스에도 연결된다. 더구나 특히, 인덕터(24)는 공통 출력 노드(16) 및 부하 축적(reservoir) 커패시터(28)의 사이에 전기적으로 상호연결된다. 저항기로 개략적으로 나타낸 부하(32)는 부하 축적 커패시터(28)와 병렬로 전기적으로 연결된다.
가상 접지 증폭기(34)는 가상 접지 회로 노드(30)에 전기적으로 연결된 반전 입력(34a) 및 접지에 연결된 비-반전 입력(34b)을 갖는다. 가상 접지 증폭기(34)의 출력(34c)은 FET(36)의 게이트를 구동시키기 위해 전기적으로 연결된다. FET(36)의 소스는 가상 접지 회로 노드(30)에 전기적으로 연결된다. FET(36)의 드레인은 샘플 및 홀드 회로(38)에 전기적으로 연결된다. 따라서, 본 기술 분야에서 통상의 지식을 가진자에게도 명백하듯이, 가상 접지 증폭기(34) 및 FET(36)은 가상 접지 회로 노드(30)를 접지 전위로 계속하여 구동시키기 위해 구성된다. 가상 접지 회로 노드(30)가 계속적으로 접지 전위로 구동되면서, 회로 노드(30)에 연 결된 전류 귀환 저항기(26)의 끝부분이 접지 전위에 있게 될 것이고, 공통 출력 노드(16)에 연결된 끝부분은 음전압을 갖게 될 것이다. 공통 출력 노드(16)에 연결된 전류 귀환 저항기(26)의 끝부분의 음전압은 출력 전류 IOUT의 발생과 같을 것이고, 온-상태 저항(RDSON)이 하측 FET(12)의 드레인 및 소스사이에 존재하게 될 것이다. 전류 ISENSE는 전류 귀환 저항기(26)를 통해 흐르고, 하측 FET(12)의 RDSON 대 전류 귀환 저항기(26)의 값의 비에 의해 그 크기가 결정된다. 따라서, ISENSE는 출력 전류 IOUT의 발생이자 하측 FET(12)의 RDSON 대 전류 귀환 저항기(26)의 값의 비이고, 가령 출력 전류 IOUT을 나타낸다. 부하 전류 IL은 인덕터(24)를 통해 흐르는 전류이고 실질적으로 출력 전류 IOUT - ISENSE와 같다. 통상적으로, RDSON 대 전류 귀환 저항기(26)의 값의 비는 상대적으로 작기 때문에, ISENSE는 실질적으로 출력 전류 IOUT보다 더 작다. 그러므로, 출력 전류 IOUT 및 부하 전류 IL은 실질적으로 크기가 유사할 것이고, 따라서 ISENSE는 부하 전류를 나타낼 것이다.
전류 귀환 저항기(26)의 값은 부하 전류 IL의 값 및/또는 하측 FET(12)의 RDSON의 값에 대한 전류 흐름의 편리한 값을 제공하기 위해 선택된다. 따라서, 예를 들어, DC/DC 컨버터(10)에 구성된 전압 드룹, 전류 제한 또는 트립, 및 전류 평형의 민감도 또는 크기가 하측 FET(12)의 RDSON의 값에 비례하는 전류 귀환 저항기(26)의 값을 선택함으로써 그 크기가 조절될 수 있다. 게다가, 통상적으로 음의 값으로 나타나는, 하측 FET(12)의 RDSON에 걸친 전압 강하가 음극 전압원의 도움없이도 DC/DC 컨버터(10)에서 수용된다.
도 2에 관하여, 시스템 제어 회로(40)는 샘플 및 홀드 회로(38)에 전기적으로 연결된다. 상기 기술된 바와 같이, FET(36)의 드레인은 샘플 및 홀드 회로(38)에 연결된다. FET(36)의 소스에 의해 공급된 전류는 샘플 및 홀드 회로(38)로 부터 FET(36)의 드레인으로 들어가고, FET(36)의 소스로 나와서, 가상 접지 회로 노드(30)로 흘러 들어간다. 또한 그 반대 방향으로 부터 가상 접지 회로 노드(30)로 흘러 들어가는 것은, 상기 기술된 바와 같이, 부하 전류 IL을 나타내는 ISENSE이다. 접지 전위에서 가상 접지 회로 노드(30)를 홀드하기 위해, 가상 접지 증폭기(34)는 실질적으로 IL SENSE와 같게 하기 위해 출력(34c)를 경유하여 FET(36)을 통해 가상 접지 회로 노드(30)로 흘러 들어가는 전류를 조정한다. ISENSE는 부하 전류 IL을 나타내기 때문에, 가상 접지 증폭기(34) 및 FET(36)에 의해 제어되는 바와 같이, FET(36)을 통해 가상 접지 회로 노드(30)로 흘러 들어가는 전류는 또한 부하 전류 IL을 나타낸다. 시스템 제어 회로(40)는 주기적으로 제어 신호(40a)를 샘플 및 홀드 회로(38)에 발생시킨다. 제어 신호(40a)는 FET(36)이 온 또는 도통 상태에 있을 때 발생된다. 제어 신호(40a)에 응답하여, 샘플 및 홀드 회로(38)는 FET(36)이 온 상태일 때 FET(36)을 통해 흐르는 전류를 샘플시키고 샘플된 값을 홀드한다. 따라서, 샘플 및 홀드 회로(38)에 의해 얻은 샘플된 값은 또한 부하 전류 IL을 나타낸다. 샘플 및 홀드 회로(38)는 FET(36)을 통해 흐르는 샘플된 전류 값을 나타내는 샘플 신호(38a)를 발생한다.
DC/DC 컨버터(10)는 전압 귀환 저항기(44)를 통해 부하(32)를 통과하는 전압 VOUT을 모니터한다. 전압 귀환 저항기(44)의 한쪽 끝부분은 부하(32)에 연결되고, 나머지 끝부분은 에러 증폭기(46)의 반전 입력(46a)에 연결된다. VFB는 전압 귀환 저항기(44)를 통과하는 전압이다. 에러 증폭기(46)의 비-반전 입력(46b)은 DC/DC 컨버터(10)의 소정의 출력 전압과 실질적으로 같은 소정의 전압을 제공하는 기준 전압원(48)에 전기적으로 연결된다. 에러 증폭기(46)는 기준 전압원(48)으로 부터의 전압과 실질적으로 같도록 반전 입력(46a)에서 전압을 조정한다. 반전 입력(46a)에서 전압은 실질적으로 VOUT 및 VFB의 합과 같기 때문에, 에러 증폭기(46)는 실질적으로 기준 전압원(48)으로 부터의 전압과 같도록 VOUT 및 VFB의 합을 조정하는 역할을 한다. 에러 증폭기(46)의 출력(46c)은 보상 회로 노드(50)에 전기적으로 연결된다. 에러 증폭기(46)의 출력(46c) 및 반전 입력(46a)간 귀환 경로는 보상 저항기(52) 및 보상 커패시터(54)를 포함한다. 더구나 특히, 보상 커패시터(54)의 한쪽 끝부분은 보상 회로 노드(50)에 연결되고, 다음으로 보상 저항기(52)에 그 나머지 끝부분이 연결된다. 보상 커패시터(54)의 반대쪽에 있는 보상 저항기(52)의 끝부분이 서밍 노드(56)에 연결된다. 전압 귀환 경로에서 보상 저항기(52) 및 커패시터(54)는 시스템 안정도 및 제어 시스템 응답을 제공한다.
샘플 및 홀드 회로(38)에 의해 발생되고 부하 전류 IL을 나타내는 샘플 신호(38a)는 또한 에러 증폭기(46)의 반전 입력에 연결된다. 전압 귀환 저항기(44)를 통과하는 것을 제외하고 에러 증폭기(46)의 반전 입력(46a)에서 직류에 대한 다른 경로는 없다. 따라서, 전압 귀환 저항기(44) 즉, VFB를 통과하는 전압은 샘플링 신호(38a)에 의해 변형된다. 상기 기술된 바와 같이, 실질적으로 기준 전압원과 같도록, 에러 증폭기(46)는 VOUT 및 VFB의 합과 같은 반전 입력(46a)에서의 전압을 조정한다. 따라서, 예를 들어, 샘플링 신호(38a)가 증가함에 따라, VFB는 비례적으로 증가하고 에러 증폭기(46)는 기준 전압원(48)과 같도록 반전 입력(46a)에서의 전압을 유지시키기 위해 VOUT을 감소 시킨다. 샘플링 신호(38a)는 부하 전류 IL을 나타내기 때문에, VOUT은 부하 전류 IL에 관련하여 역비례하는 식으로 효과적으로 변조된다. 따라서, 도 4에 나타난 바와 같이, VOUT은 부하 전류 IL에 따라 변동되거나 적어도 부분적으로 드룹된다. 따라서, 귀환 저항기(44)의 값을 선택함으로써, 부하 전류 IL에 비례하여 VOUT에서 변동 또는 드룹량이 제어될 수 있게 된다.
비교기(58)의 반전 입력(58a)은 톱니 발생기(60)에 전기적으로 연결되고, 소정의 특성을 갖는 톱니 파형을 그것으로 부터 수신한다. 비교기(58)의 출력(58c)은 세트-리셋(SR) 래치(62)에 전기적으로 연결된다. SR 래치(62)의 출력(62a)은 교대로 하측 FET(12) 및 상측 FET(14)를 구동하는 구동기(64)에 전기적으로 연결되고 상기 구동기에 의해 완충된다. DC/DC 컨버터(10)는, 예를 들어, 그렇게 구성되고 그래서 SR 래치(62)의 출력(62a)에서 높은 레벨의 신호는 하측 FET(12)을 오프시키고 상측 FET(14)을 온시킨다. 톱니 발생기(60)는 싱크 펄스(66)를 시스템 제어 회로(40)로 부터 수신한다. SR 래치(62)는 또한 싱크 펄스(66)를 수신한다.
에러 증폭기(46)는 가령, 예를 들어, 감산되거나 가산되는 것과 같은 DC/DC 컨버터(10)의 소정의 출력 전압을 나타내는 기준 전압원(48)의 전압에 비례하여 실제 출력 전압을 나타내는 신호를 출력(46c)에서 발생시킨다. 예를 들어, VOUT이 기준 전압원(48)의 전압이상으로 증가함에 따라, 에러 증폭기(46)의 출력(46c)은 더 많은 음이나 음의 방향으로 증가하는 신호를 발생시킨다. 역으로, 그리고, 추가 예를 들어, Vout이 기준 전압원(48)의 전압이하로 감소함에 따라 에러 증폭기(46)는 출력(46c)에서 음의 크기가 감소하는(즉, 양의 크기가 증가) 신호를 발생시킨다. 에러 증폭기(46)의 출력(46c)은 비교기(58)의 비-반전 입력에 전기적으로 연결된다. 비교기(58)는 반전 입력(58a)에 전기적으로 연결된 톱니 파형을 비반전 입력(58b)에 전기적으로 연결된 에러 증폭기(46)의 출력(46c)과 비교한다. 비교기(58)의 출력(58c)은 가령, 예를 들면, 톱니 발생기(60)에 의해 발생된 톱니 파형이 에러 증폭기(46)의 출력(46c)보다 양(+)의 크기가 적을 동안 액티브하고 높다.
도 3a에 관하여, 출력 전압 VOUT이 소정의 출력 전압미만이거나, 기준 전압원(48)의 전압미만의 상태가 도시된다. 따라서, 에러 증폭기(46)의 출력(46c)은 상대적으로 높고, 이로 인해 비교기(58)의 비반전 입력(58b)에서 상대적으로 높은 신호를 발생한다. 적어도 톱니 파형의 주기의 실질적인 부분이 비반전 입력(58b)에 존재하는 상대적으로 높은 레벨의 신호보다 양(+)의 크기가 적을 것이다. 비교기(58)의 출력(58c)은 가령, 예를 들어, 톱니 파형이 비반전 입력(58b)에서 존재하는 상대적으로 높은 신호 보다 양(+)의 크기가 더 적은 값을 갖는 주기의 실질적인 부분동안 액티브하고 높다. 따라서, 출력(58c)의 펄스폭은 상대적으로 넓거나, 또는 선택적으로 출력(58c)의 액티브 주기는 Vout이 기준 전압원(48)의 전압미만일 때 상대적으로 기간이 길다.
역으로, 그리고 특히 도 3b를 참조로, 에러 증폭기(46)의 출력(46c)은 VOUT이 기준 전압원(48)의 전압보다 훨씬 클 때 상대적으로 낮다. 이 상태는 비교기(58)의 비반전 입력(58a)에서 상대적으로 낮은 레벨 신호를 발생한다. 톱니 파형의 주기의 상대적으로 작은 부분이 비교기(58)의 비반전 입력(58b)에 존재하는 상대적으로 낮은 레벨의 신호보다 양(+)의 크기가 적을 것이다. 비교기(58)의 출력(58c)은 비반전 입력(58b)에서 상대적으로 낮은 신호보다 양(+)의 크기가 적은 톱니 파형(예를 들어, 가장 낮은 점 또는 바닥 피크)의 주기의, 어쨌든, 상대적으로 작은 부분인 동안만 액티브할 것이다. 따라서, 출력(58c)의 펄스폭은 상대적으로 좁거나, 또는 선택적으로 출력(58c)의 액티브 주기가 VOUT이 기준 전압원(48)의 전압보다 훨씬 클 때 상대적으로 기간이 짧을 것이다.
출력(58c)이 액티브할 때, SR 래치(62)의 출력(62a)은 가령, 예를 들어, 높 게 설정된다. 역으로, 출력(58c)이 액티브하지 않을 때, SR 래치(62)의 출력(62a)은 가령, 예를 들어, 낮게 설정된다. 따라서, 톱니 파형이 기준 전압원(48)의 전압 레벨보다 양(+)의 크기가 더 클 때, SR 래치(62)의 출력(62a)은 즉, 낮게 재설정된다. 톱니 파형이 선결된 전압이하로 떨어질 때, SR 래치(62)의 출력(62a)은 즉, 높게 설정된다. SR 래치(62)의 출력(62a)이 교대로 하측 FET(12) 및 상측 FET(14)을 구동시키는 구동기(64)에 전기적으로 연결되고 상기 구동기에 의해 완충된다. DC/DC 컨버터(10)는 그렇게 구성되고, 그래서, 예를 들어, SR 래치(62)의 출력(62a)상에 높게 또는 설정된 상태로 인해 구동기(64)가 하측 FET(12)를 오프시키고 상측 FET(14)를 온시키게 된다.
과전류 검출 회로(70)에 의해 전류 트립핑 또는 과전류 보호가 된다. 과전류 검출 회로(70)는 샘플 신호(38a)를 기준 전류(도시되지 않음)와 비교하고, 샘플 신호(38a)가 기준 전류를 초과할 때 과전류 신호(70a)를 시스템 제어 회로(40)에 발생시킨다. 시스템 제어(40)는 DC/DC 컨버터(10)를 차단함으로써 과전류 신호(70a)에 응답한다. 시스템 제어(40)는, 예를 들어, 소정의 양의 시간후에 DC/DC 컨버터(10)의 작동을 재개시하기 위해 구성된다.
음전류 소스(72)는 시스템 제어(40) 및 가상 접지 회로 노드(30)의 중간에 전기적으로 연결된다. 가령, 예를 들어, 부하 전류 IL이 낮은 평균 값을 갖고 인덕터(24)를 통과하는 전압의 스위칭으로 인해 발생되는 톱니 파형이 음의 값으로 급강하할 때, 부하 전류 IL은 어떤 동작 상태하에서 음이 된다. 그런 동작 상태인 동안 즉, IL이 음일 때, 하측 FET(12)의 드레인에서의 전압이 양이다. 하측 FET(12)의 드레인상의 양 전압으로 인해 저항기(26)를 통과하는 전류를 가상 접지 회로 노드(30)로 공급하고, 이로 인해 가상 접지 노드(30)를 양 전위로 구동시키게 된다. 음 전류 소스(72)는 신호(40N)에 응답하여 IPULLDOWN을 가상 접지 회로 노드(30)로 공급하고, 이로 인해 IL이 음인 상태하에서 가상 접지 노드(30)를 접지 전위로 유지시킨다. 따라서, 가상 접지 증폭기(46), 가변 임피던스 소자(36) 및 샘플 및 홀드 회로(38)는 양-방향 식으로 동작시킬 필요가 없고(즉, 그것들은 한 방향으로만 전류를 공급시킴), DC/DC 컨버터(10)에서 음전압원을 포함할 필요가 없다.
도 5에 잘 나타난 바와 같이, 음전류 소스(72)는 스위치(80, 82, 84)를 포함한다. 각각의 스위치(80, 82, 84)는, 예를 들어, MOS 트랜지스터이다. 전류 소스(86)는 가령, 예를 들어, NMOS 미러와 같은 풀다운 전류 소스이고, 접지 및 노드(90)의 중간에 전기적으로 연결된다. 스위치(80)는 노드(90)및 전압원(88)의 중간에 전기적으로 연결되고, 노드(90)를 전압원(88)에 선택적으로 연결시킨다. 커패시터(92)는 선택적으로 노드(90) 및 노드(94)사이에 전기적으로 상호연결된다. 각각의 스위치(82, 84)는 노드(94)에 전기적으로 연결된 제 1 측을 갖고 있다. 스위치(82)의 그 나머지 측은 접지에 전기적으로 연결되고, 반면에 스위치(84)의 그 나머지 측이 가상 접지 회로 노드(30)에 전기적으로 연결된다. 전류 소스(86)에 의해 공급된 역 전류가 가상 접지 회로 노드(30)를 접지 전위로 유지시킬 필요가 없을 때 가령, 예를 들어, 하측 FET(12)가 오프일 때, 스위치(80, 82)는 닫히고 스위치(84)는 개방된다. 따라서, 노드(90)는 양 전위가 되고 노드(94)는 음 전위가 되면서, 전압원(88)의 공급 전압은 커패시터(92)를 통해 축적된다. 풀다운 전류를 전류 소스(86)로부터 공급시키기 위해, 스위치(80, 82)는 각각 오픈되고 스위치(84)는 닫힌다. 따라서, IPULLDOWN은 하측 FET(12)상에 전압 강하에 의해 유도된 보통의 순방향 전류와 같은 방향으로 가상 접지 노드(30)로 흘러 들어간다. 전류 IPULLDOWN의 가산은 가상 접지 회로 노드(30)를 접지 전위로 유지시키고, 가령, 예를 들어, 전류 제한 트립 포인트와 같은 다음 회로 동작에 영향을 주지 않도록 나중에 선택적으로 감산된다.
사용하는데 있어서, 그리고 이어서 도 3a 및 3b를 참조로, DC/DC 컨버터(10)의 작동 순서는 다음과 같다. 톱니 발생기(60)는 싱크 펄스(66)를 시스템 제어 회로(40)로 부터 수신한다. SR 래치(62)는 또한 싱크 펄스(66)를 수신한다. 싱크 펄스는 두 톱니 파형 및 SR 래치(62)의 출력(62a)을 낮은 레벨로 재설정한다. 비교기(58)의 출력 조건 또는 상태에 관계없이, SR 래치(62)는 싱크 펄스(66)에 기초한 출력(62a)을 재설정하기 위해 구성된다. 따라서, 비교기(58)의 출력이, 예를 들면, 톱니 파형보다 계속해서 높다면, 높은 레벨의 싱크 펄스(66)인 동안 SR 래치(62)의 출력(62a)은 낮을 것이다. 도 3a 및 3b의 포인트(200a 및 200b)에 각각 나타난 바와 같이, 싱크 펄스(66)는 톱니 발생기(60)에 의해 발생된 톱니 파형을 낮은 레벨로 재설정하고, SR 래치(62)의 출력(62a)을 재설정한다. DC/DC 컨버터(10)는 그렇게 구성되고, 그래서, 예를 들면, SR 래치(62)의 출력(62a)이 낮을 때, 상측 FET(14)은 오프가 되고 하측 FET(12)은 온이 된다. 따라서, 싱크 펄스(66)에 의한 SR 래치(62)의 출력(62a)의 재설정은 하측 FET(12)을 온시킨다. 이 시간 주기동안 즉, 하측 FET(12)이 온일 때, 하측 FET(12)의 RDSON이 측정된다. 싱크 펄스(66)의 가장자리, 각각의 포인트(210a, 210b)에서, 톱니 파형은 아래로 경사(즉, 음의 경사)지기 시작한다.
도 3a에 관하여, 소정의 또는 목표 레벨 보다 낮은 출력 전압 Vout을 갖는 DC/DC 컨버터(10)의 상태가 도시된다. 따라서, 부하(32)를 통과하는 전압은 바라는 것보다 더 낮다. 이 상태는 에러 증폭기(46)의 출력(46c)이 톱니 파형에 비례하여 높은 레벨을 갖게 한다. 포인트(300a)에서, 톱니 파형의 주된 또는 양(+)으로 경사된 가장자리가 에러 증폭기(46)의 출력(46c)의 출력 레벨위로 교차하고, 이로 인해 비교기(58)의 출력(58c)을 낮게 보낸다. 출력(58c)에서 이런 특별한 천이는 싱크 펄스(66)가 여전히 액티브하기 때문에 SR 래치(62)의 출력(62a)에 영향을 주지 않고, 따라서 출력(62a)은 그대로 재설정되어 있거나 낮다.
포인트(310a)에서, 톱니 파형의 하강하는 또는 음으로 경사된 가장자리는 에러 증폭기(46)의 출력(46c)의 출력 레벨아래로 교차하고, 이로 인해 비교기(58)의 출력(58c)을 높게 보낸다. 교대로, 출력(58c)에서 높은 레벨로의 이런 천이는 SR 래치(62)의 출력(62a)을 높게 설정하고, 이로 인해 상측 FET(14)을 온시키고 하측 FET(12)을 오프시킨다. 톱니 파형에 비례하는 출력(46c)의 높은 레벨로 인해 톱니 파형이 상대적으로 톱니 파형의 주기의 초기에 출력(46c)의 레벨(포인트 310a에서)밑으로 하강하게 한다. 따라서, 포인트(300a, 310b)는 상대적으로 제시간에 가깝고, 하측 FET(12)이 오프인 동안의 주기가 대응적으로 짧다. 역으로, 상측 FET(14)이 온 및 전류를 공급하는 동안의 주기가 상대적으로 길다. 따라서, 상측 FET(14)은 상대적으로 긴 시간의 주기동안 온이고, Vout이 소정의 출력 전압미만일 때 훨씬 더 많은 양의 전류를 부하(32)로 공급한다.
도 3b에 있어서, 소정의 또는 목표 레벨 보다 높은 출력 전압 Vout을 갖는 DC/DC 컨버터(10)의 상태가 도시된다. 따라서, 부하(32)를 통과하는 전압은 바라는 것보다 훨씬 더 높다. 그러므로, 에러 증폭기(46)의 출력은 톱니 파형에 비례하여 낮다. 포인트(300b)에서, 톱니 파형의 주된 또는 양(+)으로 경사된 가장자리가 에러 증폭기(46)의 출력(46c)의 출력 레벨위로 교차하고, 이로 인해 비교기(58)의 출력(58c)을 낮게 보낸다. SR 래치(62)의 출력(62a)은 싱크 펄스(66)에 의해 이미 재설정되어 있다.
포인트(310b)에서, 톱니 파형의 하강하는 또는 음으로 경사된 가장자리는 에러 증폭기(46)의 출력(46c)의 출력 레벨아래로 교차하고, 이로 인해 비교기(58)의 출력(58c)을 높게 보낸다. 교대로, 출력(58c)에서 높은 레벨로의 이런 천이는 SR 래치(62)의 출력(62a)을 높게 설정하고, 이로 인해 상측 FET(14)을 온시키고 하측 FET(12)을 오프시킨다. 톱니 파형에 비례하는 출력(46c)의 낮은 레벨로 인해 톱니 파형이 상대적으로 톱니 파형의 주기의 후반에 출력(46c)의 레벨(포인트 310b에서)밑으로 하강하게 한다. 따라서, 포인트(300a, 310b)는 도 3a에 도시된 상황(즉, 출력 (46c)이 톱니 파형에 비례하여 높을 때 및/또는 VOUT은 목표 값미만일 때)에 비례하여 실질적으로 훨씬 더 많은 양의 시간에 의해 분리되어 있다. 그러므로, 하측 FET(12)이 온인 동안의 주기가 대응적으로 기간이 더 길다. 역으로, 상측 FET(14)이 온 및 전류를 공급하는 동안의 주기가 상대적으로 짧다. 그러므로, Vout이 소정의 출력 전압보다 훨씬 더 클 때, 상측 FET(14)은 더 적은 양의 전류를 부하(32)로 공급해 준다.
두 경우에 있어서, 즉, 부하(32)를 통과하는 전압이 바라는 것보다 더 높거나 낮은 경우에, SR 래치(62)의 출력(62a)은 부하(32)를 통과하는 전압의 관련 값에 따르기 보다는 차라리 싱크 펄스(66)를 근거로 하여 낮아진다. SR 래치(62)의 출력(62a)이 낮은 상태에 있을 때, 상측 FET(14)이 오프 상태에 있고 하측 FET(12)이 온 상태에 있으며, 하측 FET(12)의 RDSON을 통과하는 전압 강하가 샘플 및 홀드된다. 따라서, 부하 전류 IL은 하측 FET(12)이 온 상태에 있을 때 접지로 부터 하측 FET(12)의 소스를 통과하여 드레인으로 흘러 간다. 하측 FET(12)을 통과하는 전류 흐름의 방향은 하측 FET(12)의 드레인상에 음전압을 전개한다. 이 음전압의 크기는 하측 FET(12)의 IL 및 RDSON의 발생이다.
도시된 실시예에 있어서, 하측 FET(12)의 소스는 접지에 전기적으로 연결된다. 그러나, 하측 FET(12)은 가령, 예를 들어, 그 소스가 저항기를 통해 접지에 묶이고, 감지 저항기(26)를 하측 FET(12)의 소스를 전기적으로 연결시키도록 선택 적으로 구성된다는 것을 이해해야 한다. 네트 효과는 같고, 가상 접지 증폭기는 계속해서 가상 접지 노드(30)를 가상 접지로 구동시킨다. 이런 선택적인 구성에 있어서, 샘플 및 홀드 회로(38)로 부터의 전류는 여전히 부하 전류 IL을 나타낸다.
하측 FET(12)의 RDSON을 통과하는 전압 강하보다 오히려 가산된 감지 저항기를 통과하는 부하-전류-유도된 전압 강하를 제외하고 측정된다. 이 선택적인 실시예는 도 6에 가장 잘 나타난다.
도시된 실시예에 있어서, 기준 전압원(48)은 고정된 전압원으로 도시된다. 그러나, 기준 전압원(48)은 선택적으로 가령, 예를 들어, 밴드갭 또는 다른 고정된 전압원으로 구성되거나, 디지털/아날로그 컨버터 또는 다른 가변 전압원으로 구성된다는 것을 이해해야 한다.
도시된 실시예에 있어서, FET(36)은 하나의 FET으로 구성된다. 그러나, FET(36)은 가령, 예를 들어, 게이트로 대체된 베이스, 소스로 대체된 에미터, 및 드레인으로 대체된 콜렉터를 갖는 NPN 트랜지스터로 구성된다는 것을 이해해야 한다.
도시된 실시예에 있어서, 가상 접지 증폭기(34)는 연속 동작을 위해 구성된다. 그러나, 가령, 예를 들면, 하측 FET(12)이 온 상태에 있을 때에만 필요로 하기 때문에, 가상 접지 증폭기(34)는 자동-제로되는 증폭기 또는 다른 비-연속적으로 동작하는 증폭기로 구성되는 것을 이해해야 한다.
도시된 실시예에 있어서, DC/DC 컨버터(10)는 그렇게 구성되고, SR 래치(62) 의 출력(62a)에서 높은 레벨의 신호는 하측 FET(12)을 오프시키고 상측 FET(14)을 온시킨다. 그러나, DC/DC 컨버터(10)는 그렇게 선택적으로 구성되고 FET(12) 및 FET(14)의 동작 극성이 반전된다는 것을 이해해야 한다.
도시된 실시예에 있어서, 시스템 제어 회로(40)는 과전류 상태의 검출에 이어 선결된 양의 시간이후 DC/DC 컨버터(10)의 작동을 재개시하기 위해 구성된다. 그러나, 시스템 제어 회로(40)는 가령, 예를 들어, 시각적 또는 청각적 경고 신호를 발생시키거나 또는 DC/DC 컨버터(10)를 완전히 차단시키기 위해 선택적으로 구성된다는 것을 이해해야 한다.
도시된 실시예에 있어서, DC/DC 컨버터(10)는 인덕터(24), 노드(16)에 연결된 커패시터(28) 및 부하(32)로 구성된다. 그러나, DC/DC 컨버터(10)는 가령, 예를 들어, 인덕터(24), 커패시터(28) 및 부하(32)없이 그렇게 구성되고, 유저, 디자이너, 또는 제조업자가 DC/DC 컨버터(10)의 노드(16)에 부착된 회로를 선택하고 주문생산할 수 있다는 것을 이해해야 한다.
DC/DC 벅(buck) 펄스폭 변조기 컨버터 회로는 입력, 상측 출력 및 하측 출력을 포함한다. 상측 스위치는 공통 출력 노드 및 전압원사이에 전기적으로 연결되고, 상측 출력에 따라 좌우되는 전류의 흐름을 제어한다. 하측 스위치는 공통 출력 노드 및 접지사이에 전기적으로 연결되고, 하측 출력에 따라 좌우되는 전류의 흐름을 제어한다. 가상 접지 증폭기는 접지에 전기적으로 연결된 제 2 입력을 포 함한다. 전류 귀환 저항기는 가상 접지 증폭기의 공통 출력 노드 및 제 1 입력의 중간에 전기적으로 연결된다. 가변 임피던스 소자는 가상 접지 증폭기의 출력 및 가상 접지 증폭기의 제 1 입력에 전기적으로 연결된다. 가변 임피던스 소자의 임피던스는 가상 접지 증폭기의 출력에 따라 변동된다. 샘플 및 홀드 회로는 펄스폭 변조기 컨버터 회로의 입력 및 가변 임피던스 소자의 중간에 전기적으로 연결된다.

Claims (53)

  1. (a) 입력, 상측 출력 및 하측 출력을 갖는 DC/DC 벅 펄스폭 변조 컨버터 회로;
    (b) 공통 출력 노드 및 전압원의 중간에 전기적으로 연결되는 상측 스위치;
    상기 상측 스위치는 적어도 부분적으로 상기 상측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되고,
    (c) 상기 공통 출력 노드 및 접지의 중간에 전기적으로 연결되는 하측 스위치;
    상기 하측 스위치는 적어도 부분적으로 상기 하측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되고,
    (d) 제 1 입력, 제 2 입력 및 출력을 갖는 가상 접지 증폭기;
    상기 제 2 입력은 접지 전위에 전기적으로 연결되고,
    (e) 상기 공통 출력 노드 및 상기 가상 접지 증폭기의 상기 제 1 입력의 중간에 전기적으로 연결되는 전류 귀환 저항기;
    (f) 상기 가상 접지 증폭기의 상기 출력 및 상기 가상 접지 증폭기의 상기 제 1 입력에 전기적으로 연결되는 가변 임피던스 소자; 및
    상기 가변 임피던스 소자는 적어도 부분적으로 상기 가상 접지 증폭기의 상기 출력에 따라 임피던스를 변동시키기 위해 구성되며,
    (g) 상기 DC/DC 벅 펄스폭 변조기 컨버터 회로 및 상기 가변 임피던스 소자의 중간에 전기적으로 연결되는 샘플 및 홀드 회로를 포함하며,
    상기 샘플 및 홀드 회로는 상기 가변 임피던스 소자를 통해 가상 접지 전류를 공급해주고 상기 가상 접지 전류를 샘플 및 홀드하기 위해 구성되는 것을 특징으로 하는 전원.
  2. 제 1 항에 있어서, 시스템 제어 회로는 상기 샘플 및 홀드 회로에 전기적으로 연결되고, 상기 시스템 제어 회로는 제 1 제어 신호를 발생하며, 상기 샘플 및 홀드 회로는 상기 제 1 제어 신호에 응답하여 상기 가상 접지 전류를 샘플 및 홀드하기 위해 구성되고, 상기 샘플 및 홀드 회로는 선택적으로 적어도 부분적으로 상기 가상 접지 전류에 따라 좌우되는 샘플 신호를 발생하며, 상기 시스템 제어 회로는 적어도 부분적으로 상기 샘플 신호에 따라 좌우되는 상기 상측 스위치 및 상기 하측 스위치중 적어도 하나를 선택적으로 활성화 및 비활성화시키고, 상기 시스템 제어 회로는 동기 신호를 발생시키며, 상기 동기 신호는 상기 상측 스위치 및 상기 하측 스위치중 적어도 하나를 재설정하는 것을 특징으로 하는 전원.
  3. 제 2 항에 있어서, 과전류 검출기 회로는 상기 샘플 및 홀드 회로 및 상기 시스템 제어 회로에 전기적으로 연결되고, 상기 과전류 검출기 회로는 상기 샘플 신호가 선결된 임계값을 초과할 때 과전류 신호를 발생시키기 위해 구성되며, 상기 시스템 제어 회로는 상기 과전류 신호에 응답하여 상기 DC/DC 벅 펄스폭 변조기 컨버터 회로를 차단하기 위해 구성되고, 상기 시스템 제어 회로는 상기 과전류 신호 를 수신한 다음의 선결된 시간 주기에 상기 DC/DC 벅 펄스폭 변조기 컨버터 회로를 재개시하기 위해 구성되는 것을 특징으로 하는 전원.
  4. 제 2 항에 있어서. 전원 출력, 전압 귀환 저항기는 상기 DC/DC 벅 펄스폭 변조기 컨버터 회로의 상기 전원 출력 및 상기 입력의 중간에 전기적으로 연결되고, 상기 시스템 제어 회로는 전류 미러를 포함하고, 상기 전류 미러는 드룹(droop) 전류를 공급하며, 상기 드룹 전류는 적어도 부분적으로 상기 접지 전류에 따라 좌우되고, 상기 드룹 전류는 상기 전압 귀환 저항기를 통과하는 귀환 전압를 변형시키고 적어도 부분적으로 상기 수하 전류에 따라 좌우되는 상기 전원의 출력 전압을 조정하기 위해 상기 DC/DC 벅 펄스폭 변조기 컨버터 회로의 입력에 전기적으로 연결되는 것을 특징으로 하는 전원.
  5. 제 1 항에 있어서, 음 전류 소스, 상기 시스템 제어 회로는 제 2 제어 신호를 발생시키고, 상기 제 2 제어 신호는 상기 음 전류 소스에 전기적으로 연결되며, 상기 음 전류 소스는 상기 제 2 제어 신호에 응답하여 음 전류를 공급하고, 상기 음 전류는 상기 가상 접지 증폭기의 상기 제 1 입력으로 흘러들어 가고 이로 인해 상기 전류 귀환 저항기를 통과하는 전류가 음일 때 상기 전류 귀환 저항기를 접지에 연결시키는 것을 특징으로 하는 전원.
  6. 제 1 항에 있어서, 상기 가변 임피던스 소자는 전계 효과 트랜지스터 및 NPN-형 트랜지스터 및 제 1 끝부분 및 제 2 끝부분을 갖는 인덕터를 포함하고, 상기 제 1 끝부분은 상기 공통 출력 노드에 전기적으로 연결되며, 상기 제 2 끝부분은 부하에 전기적으로 연결되게 하기 위해 구성되는 것을 특징으로 하는 전원.
  7. 전원에서 출력 전류의 감지 방법으로서, 상기 전원은 입력, 상측 출력 및 하측 출력을 갖는 DC/DC 벅 펄스폭 변조기 컨버터 회로를 포함하고, 상기 방법은:
    (a) 공통 출력 노드 및 전압원의 중간에 상측 스위치를 전기적으로 연결시키는 단계;
    상기 상측 스위치는 적어도 부분적으로 상기 상측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되며, 하측 스위치는 상기 공통 출력 노드 및 접지의 중간에 전기적으로 연결되고, 상기 하측 스위치는 적어도 부분적으로 상기 하측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되며,
    (b) 감지된 전류를 가상 접지 노드로 향하게 하는 단계;
    상기 감지된 전류는 상기 하측 스위치가 온 상태에 있을 때 알려진 일부의 출력 전류를 포함하며, 상기 감지된 전류는 제 1 방향으로 상기 가상 접지 노드로 흘러 들어가고,
    (c) 가상 접지 전류를 상기 가상 접지 노드로 공급하는 단계; 및
    상기 가상 접지 전류는 제 2 방향으로 상기 가상 접지 노드로 흘러 들어가며, 상기 제 2 방향은 상기 제 1 방향에 반대이고, 상기 가상 접지 전류는 실질적으로 상기 감지된 전류와 같으며 이로 인해 상기 가상 접지 노드에서 상기 감지된 전류를 제거하고,
    (d) 상기 가상 접지 전류의 값을 샘플링 및 홀딩하는 단계를 포함하는 것을 특징으로 하는 전원에서 출력 전류의 감지 방법.
  8. 제 7 항에 있어서, 적어도 부분적으로 상기 샘플링 및 홀딩 단계에 따라 좌우되는 상기 상측 스위치 및 상기 하측 스위치중 적어도 하나를 기초로 선택적으로 활성화 및 비활성화시키는 추가 단계, 및 주기적인 것과 랜덤한 것중 적어도 하나를 기초로 상기 상측 스위치 및 상기 하측 스위치중 적어도 하나를 선택적으로 가동 및 해제 시키는 추가 단계를 특징으로 하는 방법.
  9. 제 7 항에 있어서, 상기 가상 접지 전류의 상기 샘플되고 홀드된 값을 선결된 최대 제한과 비교하는 단계, 상기 가상 접지 전류가 상기 선결된 최대 제한을 초과할 때 상기 전원을 차단하는 단계, 상기 차단 단계 다음에 선결된 시간 주기에 상기 전원을 재개시하는 단계, 및 적어도 부분적으로 상기 가상 접지 전류의 상기 샘플되고 홀드된 값에 따라 좌우되는 상기 전원의 출력 전압을 조정하는 추가 단계를 특징으로 하는 방법.
  10. (a) 입력, 상측 출력 및 하측 출력을 갖는 DC/DC 벅 펄스폭 변조기 컨버터 회로;
    (b) 공통 출력 노드 및 전압원의 중간에 전기적으로 연결되는 상측 스위치;
    상기 상측 스위치는 적어도 부분적으로 상기 상측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되고,
    (c) 감지 저항기를 통해 상기 공통 출력 노드 및 접지에 전기적으로 연결되는 하측 스위치;
    상기 하측 스위치는 적어도 부분적으로 상기 하측 출력에 따라 좌우되는 전류의 흐름을 제어하기 위해 구성되고,
    (d) 제 1 입력, 제 2 입력 및 출력을 갖는 가상 접지 증폭기;
    상기 제 2 입력은 접지 전위에 전기적으로 연결되고,
    (e) 상기 공통 출력 노드 및 상기 가상 접지 증폭기의 상기 제 1 입력의 중간에 전기적으로 연결되는 전류 귀환 저항기;
    (f) 상기 가상 접지 증폭기의 상기 출력 및 상기 가상 접지 증폭기의 상기 제 1 입력에 전기적으로 연결되는 가변 임피던스 소자; 및
    상기 가변 임피던스 소자는 적어도 부분적으로 상기 가상 접지 증폭기의 상기 출력에 따라 임피던스를 변동시키기 위해 구성되며,
    (g) 상기 DC/DC 벅 펄스폭 변조기 컨버터 회로 및 상기 가변 임피던스 소자의 중간에 전기적으로 연결되는 샘플 및 홀드 회로를 포함하며,
    상기 샘플 및 홀드 회로는 상기 가변 임피던스 소자를 통해 가상 접지 전류를 공급하고 상기 가상 접지 전류를 샘플 및 홀드하기 위해 구성되는 것을 특징으로 하는 전원.
  11. 입력, 상측 회로를 구동하는 상측 출력, 및 하측 회로를 구동하는 하측 출력를 갖는 컨버터 회로;
    상기 하측 회로가 온 상태에 있는 경우 전류 신호를 수신하는 적어도 하나의 전류 감지노드;
    상기 적어도 하나의 전류 감지노드와 연결되는 적어도 하나의 입력과, 출력을 갖는 증폭기;
    상기 증폭기의 출력과 연결되고, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되는 가변 임피던스 소자; 및
    상기 컨버터 회로에 연결되고, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하는 샘플 및 홀드 회로로 구성되는 DC/DC 컨버터를 위한 제어장치.
  12. 제 11 항에 있어서, 상기 가변 임피던스 소자는 상기 증폭기의 출력과 연결되는 입력을 갖는 트랜지스터로 구성되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  13. 제 11 항에 있어서, 상기 증폭기는 두 개의 입력을 가지며, 제 1 입력은 상기 전류 감지노드와 연결되고, 제 2 입력은 기준신호와 연결되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  14. 제 11 항에 있어서, 상기 가변 임피던스 소자는, 상기 증폭기의 출력과 연결되는 제 1 노드, 상기 전류 감지노드와 연결되는 제 2 노드, 및 상기 샘플 및 홀드 회로와 연결되는 제 3 노드를 갖는 트랜지스터로 구성되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  15. 입력, 상측 출력, 및 하측 출력을 갖는 컨버터 회로;
    공통 출력노드와 연결되고, 이곳을 통과하는 전류의 흐름을 상기 상측 출력의 적어도 일부분에 따라 제어하는 상측 스위치;
    공통 출력노드와 연결되고, 이곳을 통과하는 전류의 흐름을 상기 하측 출력의 적어도 일부분에 따라 제어하는 하측 스위치;
    제 1 입력, 기준신호와 연결되는 제 2 입력, 및 출력을 갖는 증폭기;
    부하전류를 나타내는 신호를 상기 증폭기의 제 1 입력에 공급해주는 전류 귀환 저항기;
    상기 증폭기의 출력과 연결되고, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되는 가변 임피던스 소자; 및
    상기 컨버터 회로와 상기 가변 임피던스 소자에 연결되고, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하는 샘플 및 홀드 회로로 구성되는 것을 특징으로 하는 전원공급기.
  16. 제 15 항에 있어서, 상기 가변 임피던스 소자는 전계효과 트랜지스터와 바이폴라 트랜지스터 중 하나로 구성되는 것을 특징으로 하는 전원공급기.
  17. 제 15 항에 있어서, 제 1 끝부분과 제 2 끝부분을 가지며, 상기 제 1 끝부분은 상기 공통 출력노드와 연결되고, 상기 제 2 끝부분은 부하와 연결되는 인덕터를 더 포함하는 것을 특징으로 하는 전원공급기.
  18. 제 15 항에 있어서, 상기 가변 임피던스 소자는 상기 증폭기의 제 1 입력과 연결된 노드를 더 포함하는 것을 특징으로 하는 전원공급기.
  19. 제어회로;
    공통 출력노드와 연결되고, 상기 컨버터 회로의 상기 상측 출력과 연결되는 상측 스위치;
    공통 출력노드와 연결되고, 상기 컨버터 회로의 상기 하측 출력과 연결되는 하측 스위치; 및
    적어도 하나의 전류 감지노드와 상기 공통 출력노드와 연결되는 전류 감지 저항기로 구성되며,
    상기 제어회로는,
    입력, 상측 출력, 및 하측 출력을 갖는 컨버터 회로;
    전류신호를 수신하는 상기 적어도 하나의 전류 감지노드;
    상기 적어도 하나의 전류 감지노드와 연결되는 적어도 하나의 입력과, 출력을 갖는 증폭기;
    상기 증폭기의 출력과 연결되고, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되는 가변 임피던스 소자; 및
    상기 컨버터 회로의 입력에 연결되고, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하는 샘플 및 홀드 회로를 포함하는 것을 특징으로 하는 DC/DC 컨버터.
  20. 제 19 항에 있어서, 상기 가변 임피던스 소자는 상기 증폭기의 출력과 연결되는 입력을 갖는 트랜지스터로 구성되는 것을 특징으로 하는 DC/DC 컨버터.
  21. 제 19 항에 있어서, 상기 증폭기는 두 개의 입력을 가지며, 제 1 입력은 상기 전류 감지노드와 연결되고, 제 2 입력은 기준신호와 연결되는 것을 특징으로 하는 DC/DC 컨버터.
  22. 제 19 항에 있어서, 상기 가변 임피던스 소자는, 상기 증폭기의 출력과 연결되는 제 1 노드, 상기 전류 감지노드와 연결되는 제 2 노드, 및 상기 샘플 및 홀드 회로와 연결되는 제 3 노드를 갖는 트랜지스터로 구성되는 것을 특징으로 하는 DC/DC 컨버터.
  23. 입력, 상측 스위치를 구동하는 상측 출력, 및 하측 스위치를 구동하는 하측 출력을 갖는 컨버터 회로;
    DC/DC 컨버터의 부하전류를 나타내는 전류신호를 수신하는 적어도 하나의 전류 감지노드;
    상기 적어도 하나의 전류 감지노드와 연결되는 제 1 입력, 기준신호와 연결되는 제 2 입력, 및 출력을 갖는 증폭기;
    상기 증폭기의 출력과 연결되는 제 1 노드, 상기 적어도 하나의 전류 감지노드와 연결되는 제 2 노드, 및 제 3 노드를 가지며, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되는 가변 임피던스 소자; 및
    상기 컨버터 회로와 상기 가변 임피던스 소자의 상기 제 3 노드에 연결되고, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하는 샘플 및 홀드 회로로 구성되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  24. 입력, 상측 출력, 및 하측 출력를 갖는 DC-DC 펄스 폭 변조 컨버터 회로;
    공통 출력 노드와 전압원의 중간에서 전기적으로 연결되고, 이곳을 통과하는 전류의 흐름을 상기 상측 출력의 적어도 일부분에 따라 제어하는 상측 스위치;
    상기 공통 출력 노드와, 감지 저항기를 통한 접지에 전기적으로 연결되고, 이곳을 통과하는 전류의 흐름을 상기 하측 출력의 적어도 일부분에 따라 제어하는 하측 스위치;
    제 1 입력, 기준신호와 연결되는 제 2 입력, 및 출력을 갖는 증폭기;
    상기 감지 저항기와 상기 증폭기의 제 1 입력의 중간에 연결된 전류 귀환 저항기;
    상기 증폭기의 출력과 상기 증폭기의 제 1 입력에 연결되며, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되는 가변 임피던스 소자; 및
    상기 컨버터 회로와 상기 가변 임피던스 소자의 중간에 연결되고, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하는 샘플 및 홀드 회로로 구성되는 것을 특징으로 하는 전원공급기.
  25. 입력, 상측 스위치를 구동하는 상측 출력, 및 하측 스위치를 구동하는 하측 출력을 갖는 컨버터 회로;
    DC/DC 컨버터의 부하전류를 나타내는 전류신호를 수신하는 적어도 하나의 전류 감지노드;
    상기 적어도 하나의 전류 감지노드와 연결되는 제 1 입력, 기준신호와 연결되는 제 2 입력, 및 출력을 갖는 증폭기;
    상기 증폭기의 출력과 연결되는 제 1 노드, 상기 적어도 하나의 전류 감지노드에 응답하는 제 2 노드, 및 제 3 노드를 가지며, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되는 가변 임피던스 소자; 및
    상기 컨버터 회로와 상기 가변 임피던스 소자의 상기 제 3 노드에 연결되고, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하는 샘플 및 홀드 회로로 구성되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  26. 부하전류를 나타내는 신호를 수신하는 노드;
    상기 노드에서 수신된 상기 신호에 응답하며, 출력을 갖는 증폭기;
    상기 증폭기의 출력에 대한 응답으로, 상기 증폭기의 출력을 기초로 상기 노드에 전류를 제공하는 가변 임피던스 소자; 및
    상기 가변 임피던스 소자를 통하여 상기 노드에 제공된 상기 전류를 나타내는 신호를 샘플링 및 홀딩하는 샘플 및 홀드 회로로 구성되는 것을 특징으로 하는 전류 감지회로.
  27. 입력, 상측 스위치를 구동하는 상측 출력, 및 하측 스위치를 구동하는 하측 출력을 갖는 컨버터 회로;
    DC/DC 컨버터의 부하전류를 나타내는 전류신호를 수신하는 적어도 하나의 전류 감지노드;
    상기 적어도 하나의 전류 감지노드와 연결되는 제 1 입력, 기준신호와 연결되는 제 2 입력, 및 출력을 갖는 증폭기;
    상기 증폭기의 출력과 연결되는 제 1 노드, 상기 적어도 하나의 전류 감지노드의 상기 전류신호에 응답하는 제 2 노드, 및 제 3 노드를 가지며, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되는 가변 임피던스 소자; 및
    상기 컨버터 회로와 상기 가변 임피던스 소자의 상기 제 3 노드에 연결되고, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하는 샘플 및 홀드 회로로 구성되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  28. 입력, 상측 회로를 구동하는 상측 출력, 및 하측 회로를 구동하는 하측 출력을 갖는 컨버터 회로;
    상기 하측 회로가 온 상태에 놓이게 되면 전류신호를 수신하는 적어도 하나의 전류 감지노드;
    상기 적어도 하나의 전류 감지노드와 연결되는 적어도 하나의 입력과, 출력을 갖는 증폭기;
    상기 증폭기의 출력과 연결되며, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되는 가변 임피던스 소자; 및
    상기 컨버터 회로와 연결되고, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하는 샘플 및 홀드 회로로 구성되며;
    상기 컨버터 회로는:
    상기 가변 임피던스 소자를 통해서 공급되어 샘플링 및 홀딩된 전류, 상기 출력전압을 나타내는 신호, 및 제 1 기준신호를 결합함으로써 에러 신호를 판단하는 회로;
    상기 에러 신호에 대한 응답으로, 상기 에러 신호를 제 2 기준신호와 비교함으로써 제어신호를 판단하는 비교기; 및
    상기 비교기로부터의 상기 제어신호에 대한 응답으로, 상기 제어신호의 적어도 일부분을 기초로 상기 상측 출력 및 상기 하측 출력을 구동하는 출력회로를 포함하는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  29. 제 28 항에 있어서, 상기 가변 임피던스 소자는 상기 증폭기의 출력과 연결되는 입력을 갖는 트랜지스터로 구성되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  30. 제 28 항에 있어서, 상기 증폭기는 두 개의 입력을 가지며, 제 1 입력은 상기 전류 감지노드와 연결되고, 제 2 입력은 기준신호와 연결되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  31. 제 28 항에 있어서, 상기 가변 임피던스 소자는, 상기 증폭기의 출력과 연결되는 제 1 노드, 상기 전류 감지노드와 연결되는 제 2 노드, 및 상기 샘플 및 홀드 회로와 연결되는 제 3 노드를 갖는 트랜지스터로 구성되는 것을 특징으로 하는 DC/DC 컨버터를 위한 제어장치.
  32. 입력, 상측 출력, 및 하측 출력를 갖는 컨버터 회로;
    공통 출력 노드에 연결되고, 이곳을 통과하는 전류의 흐름을 상기 상측 출력의 적어도 일부분에 따라 제어하도록 구성되는 상측 스위치;
    공통 출력 노드에 연결되고, 이곳을 통과하는 전류의 흐름을 상기 하측 출력의 적어도 일부분에 따라 제어하도록 구성되는 하측 스위치;
    제 1 입력, 기준신호와 연결되는 제 2 입력, 및 출력을 갖는 증폭기;
    부하전류를 나타내는 신호를 상기 증폭기의 제 1 입력에 제공해 주는 전류 귀환 저항기;
    상기 증폭기의 출력과 연결되며, 상기 증폭기의 출력의 적어도 일부분에 따라 임피던스가 변동되도록 구성되는 가변 임피던스 소자; 및
    상기 컨버터 회로와 상기 가변 임피던스 소자와 연결되며, 상기 가변 임피던스 소자를 통해서 공급되는 전류를 샘플링 및 홀딩하도록 구성되는 샘플 및 홀드 회로로 구성되며;
    상기 컨버터 회로에는:
    상기 출력전압을 나타내는 신호, 상기 가변 임피던스 소자를 통해서 공급된 샘플링되고 홀딩된 전류, 및 제 1 기준신호의 적어도 일부분에 따라 에러 신호를 출력하는 에러 증폭기;
    상기 에러 증폭기로부터의 상기 에러 신호에 대한 응답으로, 상기 에러 신호와 제 2 기준신호의 적어도 일부분을 기초로 비교신호를 출력해내는 비교기; 및
    상기 비교기로부터의 상기 출력신호에 대한 응답으로, 상기 비교신호의 적어도 일부분을 기초로, 상기 상측 스위치 및 상기 하측 스위치를 구동하는 제어신호를 제공해주는 출력회로가 포함되는 것을 특징으로 하는 전원공급기.
  33. 제 32 항에 있어서, 상기 가변 임피던스 소자는 전계효과 트랜지스터와 바이폴라 트랜지스터 중의 하나로 구성되는 것을 특징으로 하는 전원공급기.
  34. 제 32 항에 있어서, 제 1 끝부분과 제 2 끝부분을 가지며, 상기 제 1 끝부분은 상기 공통 출력노드와 연결되고, 상기 제 2 끝부분은 부하와 연결되는 인덕터를 더 포함하는 것을 특징으로 하는 전원공급기.
  35. 제 32 항에 있어서, 상기 가변 임피던스 소자는 상기 증폭기의 제 1 입력과 연결된 노드를 더 포함하는 것을 특징으로 하는 전원공급기.
  36. 출력전압을 가지며, 출력전류를 부하에 공급해주는 DC/DC 컨버터를 제어하는 방법으로서, 상기 방법은:
    하측회로가 온 상태에 놓이게 되면, 제 1 방향을 갖고 노드로 흐르는 출력전류를 나타내는 감지전류를 노드에서 수신하는 단계;
    상기 출력전류를 또한 나타내며, 상기 제 1 방향과 반대인 제 2 방향을 갖는 전류를 상기 노드로 공급해 주는 단계;
    상기 공급된 전류의 값을 샘플링 및 홀딩하는 단계;
    상기 출력전압을 나타내는 신호를 수신하는 단계;
    상기 출력전압을 나타내는 신호, 상기 공급된 전류에 대한 샘플링 및 홀딩값, 및 제 1 기준신호의 적어도 일부분을 기초로 에러신호를 출력하는 단계;
    상기 에러신호 및 제 2 기준신호의 적어도 일부분을 기초로 비교신호를 출력하는 단계; 및
    상기 비교신호의 적어도 일부분을 기초로 상기 DC/DC 컨버터를 선택적으로 제어하는 제어신호를 출력하는 단계로 구성되는 것을 특징으로 하는 DC/DC 컨버터 제어방법.
  37. 제 36 항에 있어서, 상기 감지전류를 수신하는 단계에는 감지 저항기를 통하여 전류를 수신하는 단계를 포함하는 것을 특징으로 하는 DC/DC 컨버터 제어방법.
  38. 제 36 항에 있어서, 상기 감지전류를 수신하는 단계에는 상기 하측 회로의 노드와 상기 감지전류를 수신하는 노드사이에 연결된 감지 저항기를 통하여 전류를 수신하는 단계를 포함하는 것을 특징으로 하는 DC/DC 컨버터 제어방법.
  39. 제 36 항에 있어서, 상기 노드로 전류를 공급하는 단계에는 가변 임피던스 소자를 통하여 전류를 공급하는 단계를 포함하는 것을 특징으로 하는 DC/DC 컨버터 제어방법.
  40. 제 36 항에 있어서, 상기 제 2 기준신호는 램프신호인 것을 특징으로 하는 DC/DC 컨버터 제어방법.
  41. 제 36 항에 있어서, 상기 제어신호를 출력해 내는 단계에는 SR 래치를 구비하여 제어신호를 출력하는 것을 특징으로 하는 DC/DC 컨버터 제어방법.
  42. 제 36 항에 있어서, 상기 에러신호를 출력하는 단계 이전에, 상기 출력전압을 나타내는 신호, 상기 공급된 전류에 대한 샘플링 및 홀딩값, 및 제 1 기준신호 중 적어도 두개를 합하는 단계를 더 포함하는 것을 특징으로 하는 DC/DC 컨버터 제어방법.
  43. 입력, 상측 출력, 및 하측 출력을 갖는 DC-DC 컨버터 회로를 구성하는 전원공급기에서의 출력전류를 감지하는 방법으로서, 상기 방법은:
    하측회로가 온 상태에 놓이게 되면, 제 1 방향을 갖고 노드로 흐르는 출력전류를 나타내는 감지전류를 노드에서 수신하는 단계;
    상기 출력전류를 또한 나타내며, 상기 제 1 방향과 반대인 제 2 방향을 갖는 전류를 상기 노드로 공급해 주는 단계; 및
    상기 공급된 전류의 값을 샘플링 및 홀딩하는 단계로 구성되는 것을 특징으로 하는 전원공급기에서의 출력전류 감지방법.
  44. 제 43 항에 있어서, 상기 감지전류를 수신하는 단계에는 감지 저항기를 통하여 전류를 수신하는 단계를 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 감지방법.
  45. 제 43 항에 있어서, 상기 감지전류를 수신하는 단계에는 상기 하측 회로의 노드와 상기 감지전류를 수신하는 노드사이에 연결된 감지 저항기를 통하여 전류를 수신하는 단계를 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 감지방법.
  46. 제 43 항에 있어서, 상기 노드로 전류를 공급하는 단계에는 가변 임피던스 소자를 통하여 전류를 공급하는 단계를 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 감지방법.
  47. 입력, 상측 스위치와 연결된 상측 출력, 및 하측 스위치와 연결된 하측 출력을 갖는 컨버터 회로를 구성하는 전원공급기에서의 출력전류를 제어하는 방법으로서, 상기 방법은:
    부하전류를 나타내는 감지전류를 생성하는 단계;
    상기 감지전류를 제 1 방향으로 전류감지노드에 전송하는 단계;
    상기 감지전류와 실질적으로 동일한 전류를 상기 제 1 방향과 반대인 제 2 방향으로 상기 전류감지노드에 공급함으로써, 상기 전류감지노드에서 상기 감지전류를 상쇄시키는 단계;
    상기 공급된 전류의 값을 샘플링 및 홀딩하는 단계; 및
    상기 공급된 전류를 기초로 상기 상측 출력과 상기 하측 출력을 위한 제어신호들을 생성하는 단계로 구성되는 것을 특징으로 하는 전원공급기에서의 출력전류 제어방법.
  48. 제 47 항에 있어서, 상기 감지전류를 생성하는 단계에는 상기 하측 스위치가 온 상태에 놓일 때에 감지전류를 생성하는 단계를 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 제어방법.
  49. 제 47 항에 있어서, 상기 제어신호를 생성하는 단계에는 상기 공급된 전류의 샘플링 및 홀딩값의 적어도 일부분을 기초로 상기 상측 스위치 및 상기 하측 스위치 중 적어도 하나를 활성화 및 비활성화시키는 신호를 생성하는 단계를 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 제어방법.
  50. 제 47 항에 있어서, 상기 제어신호를 생성하는 단계에는 상기 상측 스위치 및 상기 하측 스위치 중 적어도 하나를 주기적 및 무작위 방식 중 적어도 하나의 방식으로 활성화 및 비활성화시키는 단계를 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 제어방법.
  51. 제 47 항에 있어서,
    상기 공급된 전류의 샘플링 및 홀딩값을 소정의 선택값과 비교하는 단계; 및
    상기 공급된 전류가 상기 소정의 선택값을 초과하는 경우 상기 전원공급기의 전원을 끄는 단계를 더 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 제어방법.
  52. 제 51 항에 있어서, 상기 전원공급기의 전원이 꺼진 다음 소정의 시간이 흐른 후에 상기 전원공급기를 다시 구동시키는 단계를 더 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 제어방법.
  53. 제 47 항에 있어서, 상기 제어신호를 생성하는 단계에는 상기 공급된 전류의 샘플링 및 홀딩값의 적어도 일부분을 기초로 상기 전원공급기의 출력전압을 조절하는 제어전류를 생성하는 단계를 포함하는 것을 특징으로 하는 전원공급기에서의 출력전류 제어방법.
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