JPS63208231A - 半導体装置 - Google Patents
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- JPS63208231A JPS63208231A JP62040259A JP4025987A JPS63208231A JP S63208231 A JPS63208231 A JP S63208231A JP 62040259 A JP62040259 A JP 62040259A JP 4025987 A JP4025987 A JP 4025987A JP S63208231 A JPS63208231 A JP S63208231A
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- H01L2224/48624—Aluminium (Al) as principal constituent
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、半導体装置に関し、特に、接合の上でワイヤ
ーボンディングを行う半導体装置に適用して有効な技術
に関するものである。
ーボンディングを行う半導体装置に適用して有効な技術
に関するものである。
バリキャップダイオードは、印加する電圧に応じて容量
値が変化するダイオードである(例えば。
値が変化するダイオードである(例えば。
「半導体ハンドブック(第2版)」、昭和52年11月
30日発行、ρ、383〜p、387、オーム社)、従
来、例えばレジンモールドバリキャップダイオードにお
いては、容量変化比を大きくするためにpn接合を超階
段接合とし、この接合の上に例えばアルミニウム(A1
)膜やアルミニウム−シリコン合金(A1−5i)膜か
ら成るオーミック電極を設け、この電極に金(Au)ワ
イヤーによるワイヤーボンディングを行っている。この
ワイヤーボンディングは、オーミック電極にプローブを
立ててダイオードの電気的特性の測定を行った後、この
プローブ測定による針跡のある部分の電極にAuワイヤ
ーを直接ボンディングすることにより行っていた。
30日発行、ρ、383〜p、387、オーム社)、従
来、例えばレジンモールドバリキャップダイオードにお
いては、容量変化比を大きくするためにpn接合を超階
段接合とし、この接合の上に例えばアルミニウム(A1
)膜やアルミニウム−シリコン合金(A1−5i)膜か
ら成るオーミック電極を設け、この電極に金(Au)ワ
イヤーによるワイヤーボンディングを行っている。この
ワイヤーボンディングは、オーミック電極にプローブを
立ててダイオードの電気的特性の測定を行った後、この
プローブ測定による針跡のある部分の電極にAuワイヤ
ーを直接ボンディングすることにより行っていた。
しかしながら、本発明者は、pn接合の接合深さが例え
ば1μm程度以下に浅くなると、ワイヤーボンディング
により次のような問題が生じることを見い出した。すな
わち、ダイオードの電気的特性を測定するためにオーミ
ック電極にプローブを立てた時、このプローブによる針
跡の部分の電極が局部的に薄くなる。この薄くなった部
分の電極の厚さは、プローブ測定前の電極の厚さ、プロ
ーブの先端形状、針圧等によって異なるが、例えば0.
1μm以下と非常に薄くなる。この状態でオーミック電
極に直接Auワイヤーをボンディングすると、このワイ
ヤーボンディング時の熱によりワイヤーを構成するAu
原子が例えば0.3〜0゜6μm程度の距離だけ拡散し
て薄くなった部分の電極を通って接合付近に達してしま
う、この結果、ダイオードの逆方向特性が劣化するため
逆方向電流工、が許容値以上に大きくなって不良を生じ
。
ば1μm程度以下に浅くなると、ワイヤーボンディング
により次のような問題が生じることを見い出した。すな
わち、ダイオードの電気的特性を測定するためにオーミ
ック電極にプローブを立てた時、このプローブによる針
跡の部分の電極が局部的に薄くなる。この薄くなった部
分の電極の厚さは、プローブ測定前の電極の厚さ、プロ
ーブの先端形状、針圧等によって異なるが、例えば0.
1μm以下と非常に薄くなる。この状態でオーミック電
極に直接Auワイヤーをボンディングすると、このワイ
ヤーボンディング時の熱によりワイヤーを構成するAu
原子が例えば0.3〜0゜6μm程度の距離だけ拡散し
て薄くなった部分の電極を通って接合付近に達してしま
う、この結果、ダイオードの逆方向特性が劣化するため
逆方向電流工、が許容値以上に大きくなって不良を生じ
。
選別歩留まりの低下を招いていた。
本発明の目的は、ワイヤーボンディング時にワイヤーの
構成原子が接合付近に達することによる不良の発生を防
止することのできる技術を提供することにある。
構成原子が接合付近に達することによる不良の発生を防
止することのできる技術を提供することにある。
本発明の前記ならびにその他の目的と新規な特徴は、本
明細書の記述及び添付図面によって明らかになるであろ
う。
明細書の記述及び添付図面によって明らかになるであろ
う。
本願において開示される発明のうち、代表的なものの概
要を簡単に説明すれば、下記のとおりである。
要を簡単に説明すれば、下記のとおりである。
すなわち、電極のプローブ測定部とワイヤーボンディン
グ部とを互いに分離している。
グ部とを互いに分離している。
上記した手段によれば、電気的特性の測定のために電極
にプローブを立てた時にこの部分の電極が薄くなっても
、この薄くなった部分ではワイヤーボンディングが行わ
れないので、ワイヤーボンディング時にワイヤーの構成
原子が拡散により接合付近に達するのを防止することが
でき、従ってこれによる不良の発生を防止することがで
きる。
にプローブを立てた時にこの部分の電極が薄くなっても
、この薄くなった部分ではワイヤーボンディングが行わ
れないので、ワイヤーボンディング時にワイヤーの構成
原子が拡散により接合付近に達するのを防止することが
でき、従ってこれによる不良の発生を防止することがで
きる。
以下、本発明の一実施例を図面を用いて具体的に説明す
る。
る。
なお、実施例を説明するための全図において、同一機能
を有するものには同一符号を付け、その繰り返しの説明
は省略する。
を有するものには同一符号を付け、その繰り返しの説明
は省略する。
第1図は、本発明の一実施例によるバリキャップダイオ
ードの平面図であり、第2図は、第1図のX−X線に沿
っての断面図である。
ードの平面図であり、第2図は、第1図のX−X線に沿
っての断面図である。
第1図及び第2図に示すように、本実施例によるバリキ
ャップダイオードにおいては、例えばn”型のシリコン
基板のような半導体基板l上に例えばn型シリコンのよ
うなエピタキシャル層2が設けられ、さらにこのエピタ
キシャル層2上に例えば二酸化シリコン(Si Oz
)膜のような絶縁膜3が設けられている。この絶縁膜3
には例えばほぼ正方形の平面形状を有する開口3aが設
けられ、この間口3aに対応する部分の前記エピタキシ
ャル層2中に例えばn゛型の半導体領域4及び例えばp
”型の半導体領域5が設けられている。そして、これら
の半導体領域4.5により、接合深さの浅い超階段接合
であるpn接合が形成されている。
ャップダイオードにおいては、例えばn”型のシリコン
基板のような半導体基板l上に例えばn型シリコンのよ
うなエピタキシャル層2が設けられ、さらにこのエピタ
キシャル層2上に例えば二酸化シリコン(Si Oz
)膜のような絶縁膜3が設けられている。この絶縁膜3
には例えばほぼ正方形の平面形状を有する開口3aが設
けられ、この間口3aに対応する部分の前記エピタキシ
ャル層2中に例えばn゛型の半導体領域4及び例えばp
”型の半導体領域5が設けられている。そして、これら
の半導体領域4.5により、接合深さの浅い超階段接合
であるpn接合が形成されている。
前記開口3aにおける前記半導体領域5の上には、例え
ばAl−3i膜やA1膜から成るオーミック電極6が設
けられている。この電極6の厚さは、後述のワイヤーボ
ンディング時にワイヤー9の構成原子が電極6中で拡散
する距離よりも大きく選ばれる。なお、この電極6は、
接触抵抗を小さくするために前記半導体領域5のほぼ全
面に亘って設けられている。符号7は、例えば5in2
膜、窒化シリコン(Si、N4)膜のような絶縁膜であ
る。この絶縁膜7には、ワイヤーボンディング部A及び
プローブ測定部已に対応する例えば円形の開ロアa、7
bが互いに分離して設けられている。すなわち、ワイヤ
ーボンディング部A及びプローブ測定部Bは互いに分離
している。そして、この開口7bを通じて前記電極6に
プローブ8を立てることによりダイオードの電気的特性
の測定を行うことができるようになっている。また、前
記開ロアaを通じて、例えばAuワイヤーのようなワイ
ヤー9を前記電極6にボンディングすることができるよ
うになっている。このことから明らかなように、電気的
特性の測定のためにプローブ8を電極6に立てた時にこ
の部分の電極6が薄くなっても、この薄い部分とは異な
る部分における厚い電極6でワイヤーボンディングを行
うことができるので、このワイヤーボンディング時の熱
によりワイヤー9から電極6中に拡散する例えばAuの
ような構成原子は電極6中で完全に止められる。このた
め、ワイヤー9の構成原子が拡散により接合に達するの
を完全に防止することができる。従って、ワイヤーボン
ディングによりダイオードの逆方向特性が劣化して逆方
向電流11が増大するのを防止することができ、これに
より選別工程における選別歩留まりの向上を図ることが
できると共に、信頼性の向上を図ることができる。
ばAl−3i膜やA1膜から成るオーミック電極6が設
けられている。この電極6の厚さは、後述のワイヤーボ
ンディング時にワイヤー9の構成原子が電極6中で拡散
する距離よりも大きく選ばれる。なお、この電極6は、
接触抵抗を小さくするために前記半導体領域5のほぼ全
面に亘って設けられている。符号7は、例えば5in2
膜、窒化シリコン(Si、N4)膜のような絶縁膜であ
る。この絶縁膜7には、ワイヤーボンディング部A及び
プローブ測定部已に対応する例えば円形の開ロアa、7
bが互いに分離して設けられている。すなわち、ワイヤ
ーボンディング部A及びプローブ測定部Bは互いに分離
している。そして、この開口7bを通じて前記電極6に
プローブ8を立てることによりダイオードの電気的特性
の測定を行うことができるようになっている。また、前
記開ロアaを通じて、例えばAuワイヤーのようなワイ
ヤー9を前記電極6にボンディングすることができるよ
うになっている。このことから明らかなように、電気的
特性の測定のためにプローブ8を電極6に立てた時にこ
の部分の電極6が薄くなっても、この薄い部分とは異な
る部分における厚い電極6でワイヤーボンディングを行
うことができるので、このワイヤーボンディング時の熱
によりワイヤー9から電極6中に拡散する例えばAuの
ような構成原子は電極6中で完全に止められる。このた
め、ワイヤー9の構成原子が拡散により接合に達するの
を完全に防止することができる。従って、ワイヤーボン
ディングによりダイオードの逆方向特性が劣化して逆方
向電流11が増大するのを防止することができ、これに
より選別工程における選別歩留まりの向上を図ることが
できると共に、信頼性の向上を図ることができる。
上述の逆方向電流工、の分布の一例を第3図に示す。な
お、この逆方向電流エヨの測定は逆方向バイアスVII
=34Vで行った。この第3図に示すように、本実施例
によるダイオードによれば、逆方向電流工、の分布のピ
ークは約0.1nAと低い電流値にあり1分布の幅も狭
いのに対して、プローブ測定部とワイヤーボンディング
部とが一致している従来のダイオードでは本実施例によ
るダイオードよりも分布のピークの電流値が約1桁程度
大きく1分布の幅も大きい。この第3図より。
お、この逆方向電流エヨの測定は逆方向バイアスVII
=34Vで行った。この第3図に示すように、本実施例
によるダイオードによれば、逆方向電流工、の分布のピ
ークは約0.1nAと低い電流値にあり1分布の幅も狭
いのに対して、プローブ測定部とワイヤーボンディング
部とが一致している従来のダイオードでは本実施例によ
るダイオードよりも分布のピークの電流値が約1桁程度
大きく1分布の幅も大きい。この第3図より。
本実施例のようにプローブ測定部とワイヤボンディング
部とを分離することによる逆方向電流工。
部とを分離することによる逆方向電流工。
の低減の効果が明らかである。
次に、上述のように構成された本実施例によるダイオー
ドの製造方法の一例について説明する。
ドの製造方法の一例について説明する。
第1図及び第2図に示すように、まず半導体基板1上に
エピタキシャル成長によりエピタキシャル層2を形成し
た後、このエピタキシャル層2の表面を熱酸化すること
により絶縁膜3を形成する5次に、この絶縁膜3の所定
部分をエツチング除去して開口3aを形成する0次に、
この間口3aを通じて前記エピタキシャル層2中にn型
不純物をイオン打ち込みして半導体領域4を形成する1
次に1例えば前記開口3aよりも少し大きい開口を有す
るフォトレジスト(図示せず)を前記絶縁膜3上に設け
、このフォトレジストをマスクとして前記エピタキシャ
ル層2中にp型不純物をイオン打ち込みすることにより
、半導体領域5を形成する0次に、全面に例えばAl
−Si膜を形成し、このAl −Si膜をエツチングに
より所定形状にパターンニングして電極6を形成する。
エピタキシャル成長によりエピタキシャル層2を形成し
た後、このエピタキシャル層2の表面を熱酸化すること
により絶縁膜3を形成する5次に、この絶縁膜3の所定
部分をエツチング除去して開口3aを形成する0次に、
この間口3aを通じて前記エピタキシャル層2中にn型
不純物をイオン打ち込みして半導体領域4を形成する1
次に1例えば前記開口3aよりも少し大きい開口を有す
るフォトレジスト(図示せず)を前記絶縁膜3上に設け
、このフォトレジストをマスクとして前記エピタキシャ
ル層2中にp型不純物をイオン打ち込みすることにより
、半導体領域5を形成する0次に、全面に例えばAl
−Si膜を形成し、このAl −Si膜をエツチングに
より所定形状にパターンニングして電極6を形成する。
次に、全面に例えばCVDにより絶縁膜7を形成した後
、この絶縁膜7の所定部分をエツチング除去して開ロア
a、7bを形成し、目的とするダイオードを完成させる
。
、この絶縁膜7の所定部分をエツチング除去して開ロア
a、7bを形成し、目的とするダイオードを完成させる
。
以上、本発明を実施例にもとづき具体的に説明したが1
本発明は、前記実施例に限定されるものではなく、その
要旨を逸脱しない範囲において種々変更可能であること
は言うまでもない。
本発明は、前記実施例に限定されるものではなく、その
要旨を逸脱しない範囲において種々変更可能であること
は言うまでもない。
例えば、絶縁膜7の開ロアa、7bの形状は例えば正方
形のような円形以外の形状としてもよい。
形のような円形以外の形状としてもよい。
また、これらの開ロアa、7bは必ずしも別々に設ける
必要はなく、例えば第1図において二点鎖線で示すよう
に一体に形成してもよい。これらの開ロアa、7b又は
これらを一体化した開口の形状は、プローブ測定の作業
条件、ワイヤーボンディングの作業方法等を考慮して最
適な形状に選ぶことができる。なお、絶縁膜7は必要に
応じて省略することも可能である。さらに1本発明は、
接合の上でワイヤーボンディングを行う他の半導体装置
、例えばツェナーダイオード、ショットキーバリアダイ
オード等に適用することもできる。
必要はなく、例えば第1図において二点鎖線で示すよう
に一体に形成してもよい。これらの開ロアa、7b又は
これらを一体化した開口の形状は、プローブ測定の作業
条件、ワイヤーボンディングの作業方法等を考慮して最
適な形状に選ぶことができる。なお、絶縁膜7は必要に
応じて省略することも可能である。さらに1本発明は、
接合の上でワイヤーボンディングを行う他の半導体装置
、例えばツェナーダイオード、ショットキーバリアダイ
オード等に適用することもできる。
本願において開示される発明のうち代表的なものによっ
て得られる効果を簡単に説明すれば、下記のとおりであ
る。
て得られる効果を簡単に説明すれば、下記のとおりであ
る。
すなわち、ワイヤーボンディング時にワイヤーの構成原
子が拡散により接合に達することによる不良の発生を防
止することができる。
子が拡散により接合に達することによる不良の発生を防
止することができる。
第1図は、本発明の一実施例によるバリキャップダイオ
ードを示す平面図。 第2図は、第1図のX−X線に沿っての断面図、第3図
は、第1図及び第2図に示すバリキャップダイオードの
逆方向電流工、の分布の一例を示すグラフである。 図中、1・・・半導体基板、2・・・エピタキシャル層
、3.7・・・絶縁膜、4.5・・・半導体領域、6・
・・電極、7a、7b・・・開口、8・・・プローブ、
9・・・ワイヤー、A・・・ワイヤーボンディング部、
B・・・プローブ測定部である。 第 1 図 第 2 図
ードを示す平面図。 第2図は、第1図のX−X線に沿っての断面図、第3図
は、第1図及び第2図に示すバリキャップダイオードの
逆方向電流工、の分布の一例を示すグラフである。 図中、1・・・半導体基板、2・・・エピタキシャル層
、3.7・・・絶縁膜、4.5・・・半導体領域、6・
・・電極、7a、7b・・・開口、8・・・プローブ、
9・・・ワイヤー、A・・・ワイヤーボンディング部、
B・・・プローブ測定部である。 第 1 図 第 2 図
Claims (1)
- 【特許請求の範囲】 1、接合と、この接合に設けられている電極とを有し、
この電極にワイヤーボンディングを行うようにした半導
体装置であって、前記電極のプローブ測定部と前記ワイ
ヤーボンディング部とを互いに分離したことを特徴とす
る半導体装置。 2、前記接合が超階段接合であることを特徴とする特許
請求の範囲第1項記載の半導体装置。 3、前記電極がアルミニウム膜又はアルミニウム−シリ
コン合金膜から成ることを特徴とする特許請求の範囲第
1項又は第2項記載の半導体装置。 4、前記ワイヤーボンディングを金ワイヤーにより行う
ことを特徴とする特許請求の範囲第1項〜第3項のいず
れか一項記載の半導体装置。 5、前記半導体装置がバリキャップダイオード、ツェナ
ーダイオード又はショットキーバリアダイオードである
ことを特徴とする特許請求の範囲第1項〜第4項のいず
れか一項記載の半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62040259A JPS63208231A (ja) | 1987-02-25 | 1987-02-25 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62040259A JPS63208231A (ja) | 1987-02-25 | 1987-02-25 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63208231A true JPS63208231A (ja) | 1988-08-29 |
Family
ID=12575676
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62040259A Pending JPS63208231A (ja) | 1987-02-25 | 1987-02-25 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63208231A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08139323A (ja) * | 1994-11-14 | 1996-05-31 | Rohm Co Ltd | 絶縁ゲート型半導体装置 |
JP2018006473A (ja) * | 2016-06-29 | 2018-01-11 | ローム株式会社 | 半導体装置 |
-
1987
- 1987-02-25 JP JP62040259A patent/JPS63208231A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH08139323A (ja) * | 1994-11-14 | 1996-05-31 | Rohm Co Ltd | 絶縁ゲート型半導体装置 |
JP2018006473A (ja) * | 2016-06-29 | 2018-01-11 | ローム株式会社 | 半導体装置 |
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