JPS58221548A - 位相同期回路 - Google Patents

位相同期回路

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JPS58221548A
JPS58221548A JP57105205A JP10520582A JPS58221548A JP S58221548 A JPS58221548 A JP S58221548A JP 57105205 A JP57105205 A JP 57105205A JP 10520582 A JP10520582 A JP 10520582A JP S58221548 A JPS58221548 A JP S58221548A
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sweep
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phase
circuit
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Koichiro Takeda
浩一郎 武田
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Fujitsu Ltd
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Fujitsu Ltd
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    • H03—ELECTRONIC CIRCUITRY
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    • H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08—Details of the phase-locked loop
    • H03L7/10—Details of the phase-locked loop for assuring initial synchronisation or for broadening the capture range
    • H03L7/12—Details of the phase-locked loop for assuring initial synchronisation or for broadening the capture range using a scanning signal
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L27/00—Modulated-carrier systems
    • H04L27/18—Phase-modulated carrier systems, i.e. using phase-shift keying
    • H04L27/22—Demodulator circuits; Receiver circuits
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    • H04L27/22—Demodulator circuits; Receiver circuits
    • H04L27/227—Demodulator circuits; Receiver circuits using coherent demodulation
    • H04L27/2271—Demodulator circuits; Receiver circuits using coherent demodulation wherein the carrier recovery circuit uses only the demodulated signals
    • H04L27/2272—Demodulator circuits; Receiver circuits using coherent demodulation wherein the carrier recovery circuit uses only the demodulated signals using phase locked loops
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 発明の技術分野 本発明は、ＰＳＫ信号の搬送波に位相同期させて再生搬
送波を出力し得るようにした位相同期回路に関するもの
である。
従来技術と問題点 ＰＳＫ信号を復調する為の同期検波方式に於ては、ＰＳ
Ｋ信号の搬送波に位相同期させた搬送波を再生する必要
があり、従来は例えば第１図に示す構成が採用されてい
た。同図に於て、ｌはＰＳＫ信号の入力端子、２は位相
検波器、３は復調されたデータの出力端子、−４はベー
バンド処理回路、５は加算回路、６はループフィルタ、
７は電圧制御発振器、８は掃引発振器、９は結合用のコ
ンデンサ、１０はアンドゲートである。受信入力信号が
４相ＰＳＫ信号の場合、位相検波器２では電圧制御発振
器７の出力の再生搬送波とそれを９０度移相した搬送波
とにより、４相ＰＳＫ信号を同期検波し、データを復調
して出力端子３から出力する。又そのデータはベースバ
ンド処理回路４に加えられ、位相娯差信号と同期状態で
あるか否かの判定信号すとが出力される。
位相娯差信号は加算回路５からループフィルタ６を介し
て電圧制御発振器７に制御電圧として印加され、入力端
子ｌに加えられたＰＳＫ信号の搬送波位相に、電圧制御
発振器７の出力の再生搬送波の位相が同期化される。ベ
ースバンド処理回路４からの判定信号すは、非同期状態
のとき“１”であり、同期状態のとき“０”である。従
って、同期状態のときば掃引発振器８からの掃引信号ａ
は電圧制御発振器７に加えられないものとなり、位相誤
差信号が零となるように位相同期ループが動作すること
になる。又非同期状態のときに掃引信号ａはアンドゲー
ト１０．コンデンサ９を介して加算回路５に加えられ、
位相誤差信号と共に、ループフィルタ６を介して電圧制
御発振器７の制御電圧として印加されるので、電圧制御
発振器７の出力周波数は同期引込状態となるまで掃引さ
れることになる。
第２図は第１図の各部の信号の波形の一例を示すもので
、掃引信号ａは＋ａ）、判定信号すは（ｂ）、コンデン
サ９を介して加算回路５に加えられる信号ＣはＴｅｌ、
アンドゲート１０の出力の信号ｄは＋ｄ）で示す。掃引
信号ａは第２図（ａｌに示すように一定周期で“ｌ”、
“０”を繰り返すものであり、判定信号すが非同期状態
を示す“ｌ”のとき、アントゲ−）１０を介して位相同
期ループに加えられるものである。又コンデンサ９はア
ンドゲート１０の出力と位相同期ループとの直流結合を
避けると共に、擬似的な３値信号を出力する為のもので
ある。判定信号すが非同期状態の“１”から同期状態の
０”に変化すると、アンドゲート１０の出力は掃引信号
ａのレベルに関係なく、“０”となるものであるから、
掃引信号ａが“１”のときに判定信号すが“０”となる
と、コンデンサ９の充放電により第２図（Ｃ１に示すよ
うに余分な信号成分Ｃ゛が出力されることになり、この
信号成分により折角同期引込み状態になっても外乱と同
様に同期外れとなる蓄舎がある。
又第２図（ｂｌ’　、　（Ｃ１’　、　（ｄ）’　はそ
れぞれ判定信号す、コンデンサ９の出力の信号Ｃ，アン
ドゲート１０の出力の信号ｄの波形の他の例を示すもの
であり、この場合は掃引信号ａが０″のとき判定信号す
が“０”となるものであるから、位相同期ループに加え
られる信号は、１１４以３値の信号として加えられるの
で何等問題はない。即ち掃引信号ａが“ｌ”のとき同期
状態に移行して掃引が停止されると、余分な掃引信号成
分Ｃ゛が発生して位相同期ループに外乱を与える欠点が
あった。
発明の目的 本発明は、位相同期ループの同期引込みによる掃引停止
が行われたとき、掃引信号レベルを同期直前のレベルに
保持するようにして、不要な掃引信号成分が発生しない
ようにすることを目的とするものである。以下実施例に
ついて詳細に説明する。
発明の実施例 第３図は本発明の実施例のブロック図であり、第１図と
同一符号は同一部分を示し、１１は選択回路である。こ
の選択回路１１は端子Ａにベースバンド処理回路４から
の判定信号すが入力され、端子Ｂに出力端子Ｘの出力信
号ｄが入力される。
判定信号すがｌ”のときは、掃引発振器８の出力の掃引
信号ａがそのまま出力され、判定信号すが“０”のとき
は、選択回路１１の出力端子Ｘの出力信号ｄ力びＯ″で
あると“０”、“１″であると“１″を出力する構成を
有するものである。
これは簡単な論理回路で構成することができる。
第４図は第３図の各部の信号の波形の一例を示すもので
、（ａｌに示す掃引信号ａが“１”のときに、（ｂ）に
示すように判定信号すがθ″になったとき、選択回路１
１の出力信号ｄは＋ｄ＋に示すように“１″に保持され
ることになり、それによりコンデンサ９の出力の信号Ｃ
はＴｅｌに示すように、余分の掃引信号成分を発生しな
いものとなる。
又第４図の（ｂｌ′に示すように、判定信号すが掃引信
号ａの“０″のとき“０”となると、選択回路１１の出
力端子Ｘの出力信号ｄは（ｄ）゛　に示すように“０″
となり、コンデンサ９の出力の信号Ｃは（Ｃ）゛　に示
すものとなる。この場合は、第２図の（ｂ）゛　〜（ｄ
）゛　に示す場合と同様となる。
前述の如く、掃引信号ａが“ｌ”のときに非同期状態か
ら同期状態になって、掃引が停止されても、選択回路１
１の出力信号ｄは“１″を保持するので、従来例のよう
な不要の掃引信号成分を発生することがないので、同期
状態を維持することができるものとなる。
発明の詳細 な説明したように、本発明は、ＰＳＫ信号の復調の為の
搬送波を再生する位相同期回路に於て、掃引発振器８に
より電圧制御発振器７を掃引して、同期引込みを行うと
き、同期状態となったことを示す判定信号で掃引を停止
させると共に、その直前の掃引信号ａのレベルを保持し
て位相同期ループに加えるようにしたもので、それによ
り掃引停止時の不要の掃引信号成分の発生がなくなり、
安定な位相同期動作を行うことができる利点がある。な
お判定信号すは、前述の実施例と反対に非同期状態のと
き“０”、同期状態のとき“１”とすることも可能であ
り、その場合は選択回路の論理構成は判定信号の論理に
対応した構成とすれば良いことになる。
【図面の簡単な説明】
第１図は従来の位相同期回路のブロック図、第２図は第
１図の各図の信号の一例の波形図、第３図は本発明の実
施例のブロック図、第４図は第３図の各部の信号の一例
の波形図である。 １は入力端子、２は位相検波器、３はデータの出力端子
、４はベースバンド処理回路、５は加算回路、６はルー
プフィルタ、７は電圧制御発振器、８は掃引発振器、９
はコンデンサ、１１は選択回路で゛ある。 特許出願人　　富士通株式会社 代理人弁理士　玉蟲久五部　外３名 ＃！１図 １ｓｓ図 第２図

Claims (1)

    【特許請求の範囲】
  1. ＰＳＫ信号の搬送波に位相同期させる位相同期回路に於
    て、位相同期状態の判定手段からの非同期状態判定信号
    により、掃引発振器からの掃引信号を前記搬送波を発生
    させる電圧制御発振器に加え、前記判定手段からの同期
    状態判定信号により前記掃引発振器からの掃引信号を同
    期直前のレベルに保持する回路を設けたことを特徴とす
    る位相同期回路。
JP57105205A 1982-06-18 1982-06-18 位相同期回路 Granted JPS58221548A (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP57105205A JPS58221548A (ja) 1982-06-18 1982-06-18 位相同期回路
DE8383303503T DE3377853D1 (en) 1982-06-18 1983-06-17 Phase lock loop circuit
EP83303503A EP0098705B1 (en) 1982-06-18 1983-06-17 Phase lock loop circuit
US06/693,840 US4547736A (en) 1982-06-18 1985-01-24 Phase lock loop PSK demodulator with sweep control circuit

Applications Claiming Priority (1)

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JP57105205A JPS58221548A (ja) 1982-06-18 1982-06-18 位相同期回路

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JPS58221548A true JPS58221548A (ja) 1983-12-23
JPH0588023B2 JPH0588023B2 (ja) 1993-12-20

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ID=14401159

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EP (1) EP0098705B1 (ja)
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DE (1) DE3377853D1 (ja)

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EP0098705B1 (en) 1988-08-24
EP0098705A3 (en) 1985-07-10
US4547736A (en) 1985-10-15
DE3377853D1 (en) 1988-09-29
EP0098705A2 (en) 1984-01-18
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