JPH0519717B2 - - Google Patents

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JPH0519717B2
JPH0519717B2 JP60055127A JP5512785A JPH0519717B2 JP H0519717 B2 JPH0519717 B2 JP H0519717B2 JP 60055127 A JP60055127 A JP 60055127A JP 5512785 A JP5512785 A JP 5512785A JP H0519717 B2 JPH0519717 B2 JP H0519717B2
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Description

【発明の詳細な説明】
〔産業上の利用分野〕 この発明はブラウン管表示装置（以下、CRT
と略称する）および液晶表示装置（以下、LCD
と略称する）の双方を駆動することができるデイ
スプレイコントローラに関する。 〔従来技術〕 表示装置はパーソナルコンピユータ、オフイス
コンピユータ等の端末装置として不可欠である。
従来、このコンピユータ端末装置としては、主に
CRTが用いられていたが、近年、LCDの開発が
進み、特にハンドヘルドタイプのコンピユータに
広く用いられつつある。 また、最近、これらの表示装置を駆動するLSI
によるデイスプレイコントローラが種々開発され
ている。これらのコントローラはコンピユータか
らの指示に応じて表示装置を駆動するもので、例
えば、CRTを駆動するコントローラとして、
μPD3301（日本電気株式会社）、HD46505（株式会
社、日立製作所）等があり、また、LCDを駆動
するコントローラとして、HD61830（株式会社
日立製作所）、μPD72030G（日本電気株式会社）
等がある。 〔発明が解決しようとする問題点〕 ところで、LCDは、通常上下２画面に分割さ
れて駆動され、一方、CRTは１画面として駆動
される。このため、LCDとCRTとは駆動の方法
および表示用メモリの読み出しが方法等が全く異
なり、表示装置を変更する場合、コントローラの
みならず、コンピユータプログラムをも大幅に変
更しなければならなかつた。 この発明は、上記の事情を考慮してなされたも
ので、その目的はCRT、LCD双方を駆動するこ
とができ、しかも、コンピユータ側からみれば全
く同一のプログラムによつてCRTでもLCDでも
駆動することができるデイスプレイコントローラ
を提供することにある。 〔問題を解決するための手段〕 この発明は、表示用メモリ内に書込まれたデー
タを読み出し、ブラウン管表示装置または２面分
割による液晶表示装置を行うブラウン管／液晶両
用のデイスプレイコントローラにおいて、前記ブ
ラウン管表示装置または液晶表示装置のいずれか
一方を指定する表示装置指定データが書込まれる
レジスタと、前記レジスタ内の表示装置指定デー
タに従い、前記ブラウン管表示装置または液晶表
示装置のいずれか一方に対応したクロツクパルス
を発生するクロツクパルス発生器と、前記表示装
置指定データおよび前記クロツクパルスに従い、
前記ブラウン管表示装置または液晶表示装置のい
ずれか一方に表示を行うためのタイミング信号を
発生するタイミング信号発生手段と、前記表示装
置指定データおよび前記タイミング信号に従い、
表示装置指定データがブラウン管表示装置を指定
している場合、水平走査のタイミングでアドレス
信号を逐次インクリメントして発生し、表示装置
指定データが液晶表示装置を指定している場合、
水平走査のタイミングで２面分割の各表示ブロツ
クに対応した第１、第２のアドレス信号を逐次イ
ンクリメントして交互に発生して前記表示用メモ
リを読み出すアドレス発生手段と、前記アドレス
信号に従つて前記表示用メモリから読み出された
データに基づきブラウン管表示用信号および液晶
表示用信号を各々発生する表示信号発生手段とを
具備する。 〔実施例〕 第１図はこの発明の一実施例によるデイスプレ
イコントローラ１を適用したデイスプレイシステ
ムの構成を示すブロツク図である。この図に示す
デイスプレイコントローラ１はキヤラクタ表示用
のコントローラであり、CRT２またはLCD３の
表示画面に、表示用メモリ４内のデータを、横
640ドツト×縦192ドツトによつてドツト表示させ
る。なお、CRT２，LCD３の双方を同時に駆動
することはできない。 以下、第１図のデイスプレイシステムについて
詳述する。 〔１〕 第１図の各部の構成 図において、符号５はコンピユータの中央処理
装置（CPU）、６はCPU５において用いられるプ
ログラムが記憶されたROMおよびデータ記憶用
のRAMからなるメモリである。表示用メモリ４
はCPU５によつて表示用のデータが書込まれる
メモリであり、第２図に示すように同一容量のエ
リアＥ０およびＥ１を有している。そして、端子
CSへ供給される信号“０”／“１”によつてエ
リアＥ０／Ｅ１が各々指定され、アドレス端子
ADへ供給されるアドレスデータによつてエリア
Ｅ０，Ｅ１の各アドレスが指定され、また、デー
タ端子DTを介してデータの書込み、読出しが行
われる。なお、Ｒ／Ｗはリード／ライト制御端子
である。 ここで、表示用データの構成、および表示用メ
モリ４のアドレスと表示画面の表示位置との関係
を説明する。まず、表示用データは２バイトを基
本単位とし、この２バイトが１キヤラクタに対応
している。第３図は、この基本単位となる２ガイ
ドを示す図であり、第１バイトはキヤラクタコー
ドCRC、第２バイトはフオアグラウンドカラー
コードFCA（下位４ビツト）およびバツクグラウ
ンドカラーコードBCA（上位４ビツト）である。
この場合、カラーコードFCAはキヤラクタの色
を指定するカラーコード、カラーコードBCAは
キヤラクタ以外の部分の色を指定するカラーコー
ドである。そして、１つのキヤラクタに対応する
キヤラクタコードCRCおよびカラーコードFCA，
BCAは各々、表示用メモリ４のエリアＥ０，Ｅ
１の同じアドレスに書込まれる。例えば、あるキ
ヤラクタのキヤラクタコードCRCがエリアＥ０
の第10番地に書込まれた場合、そのキヤラクタの
カラーコードFCA，BCAはエリアＥ１の10番地
に書込まれる。 次に、表示画面の表示位置とメモリ４のアドレ
スとの関係を説明する。まず、この実施例におい
ては１キヤラクタを８×８ドツトによつて表示す
る。また、画面の全ドツト数は前述したように
640×192である。したがつて、画面に表示し得る
キヤラクタ数は最大80×24である。次に、表示画
面を第４図に示すように８×８ドツト単位で区画
すると、表示用メモリ４内のデータは図の各区画
内に表示される。なお、各区画に図に示す表示位
置番号を付す。そして、表示用メモリ４のエリア
Ｅ０内には、表示位置０，１，２，…，1919に
各々表示すべきキヤラクタのキヤラクタコード
CRCが若い番地から順次記憶され、エリアＥ１
内には各キヤラクタコードCRCと対になるカラ
ーコードFCA，BCAが順次記憶される。ここで、
スタートアドレスSA（表示位置０に表示すべきキ
ヤラクタコードCRCのアドレス）は任意である。
例えば、いまスタートアドレスSAを100番地とす
れば、表示位置０，１，２，…，1919に各々表示
すべきキヤラクタのキヤラクタコードCRCが100
番地、101番地、102番地…に順次記憶される。 次に、第１図において７は表示用メモリ４から
出力されるキヤラクタコードCRCが読み込まれ
るラツチ、８はキヤラクタジエネレータである。
このキヤラクタジエネレータ８は各キヤラクタの
８×８ドツト構成によるパターンが記憶された
ROMであり、アドレス端子AD１へ供給される
キヤラクタコードCRCによつて８×８ドツト構
成のパターンが選択され、また、選択されたパタ
ーンの各行がアドレス端子AD０へ供給されるデ
ータLADによつて選択され、この選択された行
パターン（８ビツト）が出力端子OUTから出力
される。Ｐ／Ｓ（パラレル／シリアル）変換回路
９はシフトレジスタによつて構成されるもので、
そのロード端子Ｌへロード信号LD2が供給された
時キヤラクタジエネレータ８の出力を読み込み、
読み込んだデータをクロツクパターンφ0のタイ
ミングで１ドツトずつ順次出力する。出力された
データはデータDDとしてデイスプレイコントロ
ーラ１へ供給される。CRT２はデイスプレイコ
ントローラ１から出力されるカラー信号RS，
GS，BS（レツド、グリーン、ブルー）および水
平同期信号HSY、垂直同期信号VSYを受け、表
示画面に640×192ドツトのカラードツト表示を行
う。 次に、LCD３について第５図を参照して説明
する。このLCD３は同図に示すように液晶パネ
ル１３とこのパネル１３の各電極を駆動するパネ
ル駆動回路１４とから構成される。液晶パネル１
３は、横640本、縦192本の電極を有し、640×192
ドツトによる表示を行う。また、この液晶パネル
１３は表示ブロツクＡ，Ｂに分割され、２個のパ
ネルとして駆動される。次に、シフトレジスタ１
５ａ（640ビツト）、ラツチ１６ａ（640ビツト）、電
極駆動回路１７ａは各々表示ブロツクＡの列電極
を駆動する回路、シフトレジスタ１５ｂ（640ビツ
ト）、ラツチ１６ｂ（640ビツト）、電極駆動回路１
７ｂは各々表示ブロツクＢの列電極を駆動する回
路、シフトレジスタ１８（96ビツト）、電極駆動
回路１９は表示ブロツクＡ，Ｂの各行電極を駆動
する回路である。 以上の構成によるLCD３の液晶パネル１３に
表示を行わせる場合は、まず、表示ブロツクＡ，
Ｂの各第０行目（最上行）のドツト列に表示させ
るべきデータを、データLDa，LDbとしてシフト
クロツクSCKと共に出力し、シフトレジスタ１
５ａ，１５ｂ内に書込む。次に、シフトレジスタ
１５ａ，１５ｂ内に640ビツトのデータLDa，
LDbが各々書き込まれた時点でラツチクロツク
LCおよびフレーム信号FLMを出力する。ラツチ
クロツクLCが出力されると、シフトレジスタ１
５ａ，１５ｂ内のデータがラツチ１６ａ，１６ｂ
内に読み込まれ、また、ラツチクロツクLCと共
にフレーム信号FLMが出力されると、シフトレ
ジスタ１８の第０番目の記憶セル内に“１”が読
み込まれ、これにより、表示ブロツクＡ，Ｂの各
第０行目のドツト列が駆動される。次に、表示ブ
ロツクＡ，Ｂの各第１行目のドツト列に表示させ
るべきデータLDa，LDbを各々シフトクロツク
SCKと共に出力し、シフトレジスタ１５ａ，１
５ｂ内に各々640ビツトのデータLDa，LDbが書
込まれた時点でラツチクロツクLCを出力する。
ラツチクロツクLCが出力されると、シフトレジ
スタ１５ａ，１５ｂ内のデータがラツチ１６ａ，
１６ｂ内に読込まれ、また、シフトレジスタ１８
の第１番目の記憶セル内に“１”が書込まれ、こ
れにより、表示ブロツクＡ，Ｂの第１行目のドツ
ト列が駆動される。以下、同様の過程が繰り返え
されて液晶パネル１３の表示が行われる。 〔２〕 デイスプレイコントローラ１の構成 第６図はデイスプレイコントローラ１の構成を
示すブロツク図、第７図は第６図におけるアドレ
ス発生回路２１の構成を示すブロツク図である。
以下、第６図の各部の構成から説明する。 (a) 表示制御回路２２ この表示制御回路２２は、CPU５（第１図）
とコントローラ１との間のデータの受け渡しを行
うもので、CPU５から表示装置指定データＣ／
Ｌ（１ビツト）、ボーダカラーコードBOC（４ビツ
ト）、スタートアドレスSAが各々出力されたと
き、これらをレジスタ２３、ボーダレジスタ２４
およびスタートアドレスレジスタ２５（第７図）
内に各々書込む。ここで、表示装置指定データ
Ｃ／Ｌとは、表示装置の種類を指定するデータで
あり、使用する表示装置がCRTの場合に“０”、
LCDの場合に“１”となる。ボーダカラーコー
ドBOCとは、画面のボーダ領域（非表示領域）
の色を指定するデータであり、また、スタートア
ドレスSAは前述したように画面の表示位置０（第
４図参照）の表示用データが記憶されている表示
用メモリ４のアドレスである。また、この表示制
御回路２２は、CPU５から表示用データが出力
された場合に、そのデータをバツフアアンプＢ１
および端子Ｔ６を介して表示用メモリ４のデータ
端子DTへ供給し、またこの時、第１図のバツフ
アアンプＢ２をオン状態、バツフアアンプＢ３，
Ｂ４（第６図）をオフ状態とすると共に、リード
ライト制御信号RWS（“１”信号）を表示用メモ
リ４へ出力する。これにより、CPU５から出力
された表示用データがメモリ４内に書込まれる。
なお、信号RWSは、常時は、“０”信号となつて
いる。また、この表示制御回路２２は、表示を行
つていない時間帯（例えば、垂直帰線区間）にお
いて、CPU５に対しメモリ書込み許可信号を出
力する。 (b) レジスタ２７，２８ 表示用メモリ４（第１図）から読出されたキヤ
ラクタコードCRCは第１図のラツチ７に読み込
まれるが、カラーコードFCA，BCAはロード信
号LD1に基づいて一旦レジスタ２７内に読み込ま
れ、次いでロード信号LD3に基づいてレジスタ２
８内に読み込まれる。そして、レジスタ２８内に
読み込まれたカラーコードFCA，BCAが各々セ
レクタ２９の入力端子Ａ，Ｂへ供給される。な
お、レジスタ２８はタイミング合わせ用のレジス
タである。 (c) セレクタ２９ このセレクタ２９はそのセレクト端子SAへ
“１”信号が供給された時入力端子Ａのデータを
出力し、“０”信号が供給された時入力端子Ｂの
データを出力する。ここで、セレクト端子SAへ
は第１図のＰ／Ｓ変換回路９の出力データDDが
供給されている。したがつて、データDDが
“１”の時はセレクタ２９からフオワグラウンド
カラーコードFCAが出力され、また、“０”の時
はバツクグラウンドカラーコードBCAが出力さ
れる。 (d) セレクタ３０ セレクタ端子SAへ供給されるアンドゲート３
１の出力が“１”の時、セレクタ２９から出力さ
れるカラーコードFCAまたはBCAを出力し、
“０”の時はボーダレジスタ２４から出力される
ボーダカラーコードBOCを出力する。ここで、
アンドゲート３１の出力信号は画面表示を行つて
いる場合にのみ“１”となる信号である。 (e) カラーパレツト３１ このカラーパレツト３１は、セレクタ３０から
出力されるカラーコードをカラーデータRD，
GD，BD（各３ビツト）に変換して出力する回路
であ
〔発明の効果〕
この発明によれば、コンピユータのプログラム
を変更することなく、CRT，LCDのいずれをも
駆動することができる効果が得られる。
【図面の簡単な説明】
第１図はこの発明の一実施例によるデイスプレ
イコントローラ１を適用したデイスプレイシステ
ムの構成を示すブロツク図、第２図は第１図にお
ける表示用メモリ４を示す図、第３図は表示用メ
モリ４に書込まれる表示用データを示す図、第４
図は表示画面を示す図、第５図は第１図における
LCD３の構成を示すブロツク図、第６図は第１
図におけるデイスプレイコントローラ１の構成を
示すブロツク図、第７図は第６図におけるアドレ
ス発生回路２１の構成を示すブロツク図、第８図
は第６図における階調表示回路３７の動作を説明
するためのタイミング図、第９図は同階調表示回
路３７の具体的構成例を示す回路図、第１０図は
クロツクパルスφ0〜φ2の波形図、第１１図〜第
１４図は各々CRT表示の場合におけるデイスプ
レイコントローラ１の動作を説明するためのタイ
ミング図、第１５図〜第１９図は各々LCD表示
の場合におけるデイスプレイコントローラ１の動
作を説明するためのタイミングである。 １……デイスプレイコントローラ、２……
CRT、３……LCD、４……表示用メモリ、２１
……アドレス発生回路、２３……レジスタ、４８
……加算器、４９〜５２……ゲート回路、５３，
５４……オア回路、５５……加算器、５６，５７
……レジスタ、６４……垂直カウンタ。

Claims (1)

  1. 【特許請求の範囲】 １ (a) 表示用メモリ内に書込まれたデータを読
    み出し、ブラウン管表示装置または２面分割に
    よる液晶表示装置に表示を行うブラウン管／液
    晶両用のデイスプレイコントローラにおいて、 (b) 前記ブラウン管表示装置または液晶表示装置
    のいずれか一方を指定する表示装置指定データ
    が書込まれるレジスタ２３と、 (c) 前記レジスタ内の表示装置指定データに従
    い、前記ブラウン管表示装置または液晶表示装
    置のいずれか一方に対応したクロツクパルスを
    発生するクロツクパルス発生器６１と、 (d) 前記表示装置指定データおよび前記クロツク
    パルスに従い、前記ブラウン管表示装置または
    液晶表示装置のいずれか一方に表示を行うため
    のタイミング信号を発生するタイミング信号発
    生手段６２〜６５と、 (e) 前記表示装置指定データおよび前記タイミン
    グ信号に従い、表示装置指定データがブラウン
    管表示装置を指定している場合、水平走査のタ
    イミングでアドレス信号を逐次インクリメント
    して発生し、表示装置指定データが液晶表示装
    置を指定している場合、水平走査のタイミング
    で２面分割の各表示ブロツクに対応した第１、
    第２のアドレス信号を逐次インクリメントして
    交互に発生して前記表示用メモリを読み出すア
    ドレス発生手段２１と、 (f) 前記アドレス信号に従つて前記表示用メモリ
    から読み出されたデータに基づきブラウン管表
    示用信号および液晶表示用信号を各々発生する
    表示信号発生手段２４，２７〜３７，４５とを
    具備することを特徴とするデイスプレイコント
    ローラ。
JP60055127A 1985-03-19 1985-03-19 デイスプレイコントロ−ラ Granted JPS61213896A (ja)

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Application Number Priority Date Filing Date Title
JP60055127A JPS61213896A (ja) 1985-03-19 1985-03-19 デイスプレイコントロ−ラ
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