JPH02114658A - 半導体装置 - Google Patents

半導体装置

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JPH02114658A JP63267190A JP26719088A JPH02114658A JP H02114658 A JPH02114658 A JP H02114658A JP 63267190 A JP63267190 A JP 63267190A JP 26719088 A JP26719088 A JP 26719088A JP H02114658 A JPH02114658 A JP H02114658A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、半導体装置に係り、特に多ビン小型の樹脂
封止型半導体装置に関するものである。
〔従来の技術〕
従来のこの種の樹脂封止型半導体装置の構造を第3図及
び第4図に示す、この半導体装置においては、半導体チ
ップ(1)がダイパッド(2)上に接合されており、こ
の半導体チップ(1)の表面上に形成された複数の電極
(3)がそれぞれ対応するリード(4)のインナーリー
ド(5)に^U線等の金属細線(6ンにより電気的に接
続されている。そして、リード(4)のアウターリード
(7)のみが露出するように、半導体チップ(1)、ダ
イパッド(2)、インナーリード(5)及び金属細線(
6)が樹脂からなるパッケージ本体(8)により封止さ
れている。
このような半導体装置の駆動時には、−mに半導体チッ
プ(1)から熱が発生する。この熱は、パッケージ本体
(8)及びリード(4)を通して半導体装置から外方へ
放散される。
〔発明が解決しようとする課題〕
しかしながら、パッケージ本体(8)を構成するエポキ
シ等の樹脂は熱伝導率が低いので、半導体デツプ(1)
で発生した熱は効率よく半導体装置外部へ放出されずに
、半導体装置内に残ってしまう。
このため、発熱量の大きい半導体チップ(1)を用いる
と、半導体チップ(1)が昇温しで誤動作を起こす等、
半導体装置の信頼性が低下するという問題点があった。
また、放熱性を向上させるために、ダイパッド〈2)に
放熱フィンを接続し、この放熱フィンをパッケージ本体
(8)の側方に露出させる方法がある。
ところが、放熱フィンが露出する部分にはリード(4)
を設けることができないので第3図及び第4図に示すよ
うに全周にわたって電極(3)が形成されている半導体
チップ(1)を用いた多ビンの半導体装置にはこの方法
を適用することができない。
さらに、樹脂よりも熱伝導性に優れているセラミンク材
料によりパッケージ本体(8)を形成すれば半導体装置
の放熱性を向上させることができるが、セラミック材料
は樹脂に比べて著しく高価であるため半導体装置の製造
コストが大きくなるという問題点があった。
この発明はこのような問題点を解消するためになされた
もので、放熱性に優れた多ビンの樹脂封止型半導体装置
を得ることを目的とする。
〔課題を解決するための手段〕
この発明に係る半導体装置は、少なくとも一つの凹部を
有するダイパッドと、複数の電極を有すると共にダイパ
ッドの凹部を閉じるようにダイパッド上に搭載された半
導体チップと、ダイパッドの凹部の裏面にかしめにより
連結された放熱体と、それぞれ一端部が半導体チップの
対応する電極に電気的に接続された複数のリードと、こ
れらダイパッド、半導体チップ、放熱体及びリードの一
端部を樹脂封止するパッケージ本体とを備えたものであ
る。
〔作用〕
この発明においては、半導体チップで発生した熱が半導
体チップから放熱体に伝導し、さらに放熱体からパッケ
ージ本体を介して半導体装置の外部に放出される。
〔実施例〕
以下、この発明の実施例を添付図面に基づいて説明する
第1図及び第2図はそれぞれこの発明の一実施例に係る
半導体装置の構成を示す断面図及び透視平面図である。
半導体チップ(1)は、その全周にわたって複数の電極
(3)が形成された第1の面(1a)とこの第1の面(
1a)に平行な第2の面(1b)とを有している。この
半導体チップ(1)の第2の面(1b)がFeN i合
金等からなるダイパッド(2)上に接合されている。ダ
イパッド(2)には、搭載された半導体チップ(1)に
向かって開いた二つの凹部(9)が形成されており、こ
れら凹部(9)が半導体チップ(1)の第2の面(1b
)により閉じられている。また、各凹部(9)には貫通
孔(9a)が形成されている。
ダイパッド(2)の凹部(9)の裏面上には放熱体とし
て放熱ブロック(10)がかしめにより連結されている
。より詳しく述べると、放熱ブロック(]0)にはそれ
ぞれダイパッド(2)の凹部(9)の貫通孔(9a)に
対応して放熱ブロック本体(10a)から突出した二つ
の突起部(10b)が予め形成されており、これら突起
部(10b)がダイパッド(2)の凹部(9)の裏面側
から凹部(9)の貫通孔(9a)を貫き、さらに各突起
部(10b)の頭部が凹部(9)内でつぶされている。
これにより、ダイパッド(2)の凹部(9)の貫通孔(
9a)の周辺部は放熱ブロック本体(10a)と塑性変
形された突起部(10b)の頭部との間に挟まれ、放熱
ブロック(10)がダイパッド(2)に固定される。尚
、この放熱ブロック(10)はCu等の熱伝導性の優れ
た材料から形成されている。また、放熱ブロック(10
)の突起部(10b)の頭部は凹部(9)内に完全に収
まっており、ダイパッド(2)に搭載された半導体チッ
プ(1)の第2の面(1b)との間に間隙を有している
ダイパッド(2)の周囲には、半導体チップ(1)の各
電極(3)にそれぞれ対応した複数のリード〈4)がダ
イパッド(2)を囲むように放射状に配置されている。
各リード(4)はFeNi合金等から形成され、ダイパ
ッド(2)に面するー・端部はインナーリード(5)と
なって対応する半導体チップ(1)の電極(3)にへ〇
等の金属細線(6)により電気的に接続されている。そ
して、半導体チップ(1)、ダイパッド(2)、放熱ブ
ロック(1o)、インナーリード(5)及び金属細線(
6)がエポキシ等の樹脂からなるパッケージ本体(8)
により封止され、各り−ド(4)の他端部のみがアウタ
ーリード(7)としてパッケージ本体(8)がら露出し
ている。
このような半導体装置は次のようにして製造される。ま
ず、ダイパッド(2)に凹部(9)を形成する。これら
の凹部(9)はそれぞれ、第2図において、ダイパッド
(2)の適宜箇所に平行な一対の直線状の切り込み(9
b)を形成した後、この一対の切り込み(9b)ではさ
まれた部分を圧延加工することにより形成される。
次に、放熱ブロック(10)をかしめ加工によりダイパ
ッド(2)の凹部(9)の裏面に連結する。すなわち、
放熱プロ・ツク〈10)の突起部(10b)をそれぞれ
ダイパッド(2)の凹部(9)の裏面側から凹部(9)
の貫通孔(9a)内に挿入した後、この突起部(10b
)の頭部を凹部(9)内で塑性変形させる。このように
して放熱ブロック(10)が取り付けられたダイパッド
(2)の上に半導体チップ(1)の第2の面(1b)が
接合される。このとき、ダイパッド(2)の凹部(9)
は半導体チップ(1)の第2の而(1b)により閉じら
れるが、放熱ブロック(10)の突起部(10b)の頭
部はダイパッド(2)の凹部(9)内に完全に収まって
いるので、この突起部(10b)の頭部が半導体チップ
(1)に接触して半導体チップ(1)の搭載に支障を来
すことはない。
さらに、金属細線(6)を用いて半導体チップ(1)の
各電極(3)とこれに対応するリード(4)のインナー
リード(5)とを電気的に接続する。その後、半導体チ
ップ(1)、ダイパッド(2)、放熱ブロック(10)
、インナーリード(5)及び金属細線(6)をパッケー
ジ本体(8)で樹脂封止することにより、第1図及び第
2図に示すような半導体装置が得られる。
このような半導体装置の動作時においては、半導体チッ
プ(1)で発生した熱は、主にダイパッド(2)に伝導
され、さらにダイパッド(2)から熱伝導率に優れた放
熱ブロック(10)へと伝導される。
そして、放熱ブロック(10)からパッケージ本体(8
)を介して半導体装置の外部へ放出される。
この実施例の半導体装置と第3図及び第4図に示した従
来の半導体装置の各熱抵抗値を相対比較したところ、従
来の半導体装置を1としてこの実施例の半導体装置では
0.47となり、熱放散性が2倍以上も改善されるごと
が確認された。
尚、上記の実施例では、二つの凹部(9)における三箇
所のかしめ加工部で放熱ブロック(10)とダイパッド
(2)とを連結したが、これに限るものではなく、ダイ
パッド(2)に一つあるいは三つ以上の凹部(9)を形
成して放熱ブロック(10)とダイパッド(2)とを連
結してもよい。
さらに、放熱体は熱伝導性の優れたものであればブロッ
ク形状を有する必要はなく、例えば板状、棒状であって
も同様の効果が得られる。
また、第2図において、かしめ加工部をダイパッド(2
)に設けず、ダイパッド(2)をリードフレーム(図示
せず)に保持するためのサポートリード(11)に設け
ても、放熱ブロック(10)をダイパッド(2)の裏面
側に支持することができる。ところが、かしめ加工部と
して相当量の面積を占有するため、その分だけサポート
リード(11)周辺のリード(4)の本数が削減してし
まう、従って、この発明のように、ダイパッド(2)に
がしめ加工部を位置させた方がより多ビンで且つ小型の
半導体装置が得られる。
〔発明の効果〕
以上説明したようにこの発明によれば、少なくとも一つ
の凹部を有するダイパッドと、複数の電極を有すると共
にダイパッドの凹部を閉じるようにダイパッド上に搭載
された半導体チップと、ダイパッドの凹部の裏面にかし
めにより連結された放熱体と、それぞれ一端部が半導体
チップの対応する電極に電気的に接続された複数のリー
ドと、これらダイパッド、半導体チップ、放熱体及びリ
ードの一端部を樹脂封止するパッケージ本体とを備えて
いるので、樹脂で封止されながらも放熱性に優れた多ビ
ンの半導体装置が得られる。
【図面の簡単な説明】
第1図及び第2図はそれぞれこの発明の一実施例に係る
半導体装置の構造を示す断面図及び透視平面図、 第3図及び第4図はそれぞれ従来の半導体装置の構造を
示す断面図及び透視平面図である。 図において、(1)は半導体チップ、(2)はダイパッ
ド、(3)は電極、(4)はリード、(6)は金属細線
、(8)はバックージ本体、(9)は凹部、(10)は
放熱ブロックである。 なお、各図中同一符号は同一または相当部分を示す。 昂1図

Claims (1)

  1. 【特許請求の範囲】 少なくとも一つの凹部を有するダイパッドと、複数の電
    極を有すると共に前記ダイパッドの凹部を閉じるように
    前記ダイパッド上に搭載された半導体チップと、 前記ダイパッドの凹部の裏面にかしめにより連結された
    放熱体と、 それぞれ一端部が前記半導体チップの対応する電極に電
    気的に接続された複数のリードと、前記ダイパッド、前
    記半導体チップ、前記放熱体及び前記リードの一端部を
    樹脂封止するパッケージ本体と を備えたことを特徴とする半導体装置。
JP63267190A 1988-10-25 1988-10-25 半導体装置 Expired - Lifetime JPH0732215B2 (ja)

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1994006154A1 (en) * 1992-09-10 1994-03-17 Vlsi Technology, Inc. Method for thermally coupling a heat sink to a lead frame
US5299091A (en) * 1991-03-20 1994-03-29 Hitachi, Ltd. Packaged semiconductor device having heat dissipation/electrical connection bumps and method of manufacturing same
US5783860A (en) * 1996-01-31 1998-07-21 Industrial Technology Research Institute Heat sink bonded to a die paddle having at least one aperture
CN101958302A (zh) * 2010-09-04 2011-01-26 江苏长电科技股份有限公司 双面图形芯片倒装单颗封装结构及其封装方法

Families Citing this family (21)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5157478A (en) * 1989-04-19 1992-10-20 Mitsubishi Denki Kabushiki Kaisha Tape automated bonding packaged semiconductor device incorporating a heat sink
US5334872A (en) * 1990-01-29 1994-08-02 Mitsubishi Denki Kabushiki Kaisha Encapsulated semiconductor device having a hanging heat spreading plate electrically insulated from the die pad
US5319237A (en) * 1990-03-09 1994-06-07 Thomson Composants Microondes Power semiconductor component
JP3047986B2 (ja) * 1990-07-25 2000-06-05 株式会社日立製作所 半導体装置
DE69227937T2 (de) * 1991-02-12 1999-05-12 Matsushita Electronics Corp Leiterrahmen und in Harz versiegelte Halbleitervorrichtung dafür
US5172213A (en) * 1991-05-23 1992-12-15 At&T Bell Laboratories Molded circuit package having heat dissipating post
JPH0582685A (ja) * 1991-09-24 1993-04-02 Mitsubishi Electric Corp 混成集積部品の放熱部および端子部用構造体とその構造体を用いた混成集積部品の製造方法
US5497032A (en) * 1993-03-17 1996-03-05 Fujitsu Limited Semiconductor device and lead frame therefore
US5394607A (en) * 1993-05-20 1995-03-07 Texas Instruments Incorporated Method of providing low cost heat sink
TW344109B (en) * 1994-02-10 1998-11-01 Hitachi Ltd Methods of making semiconductor devices
US6686226B1 (en) 1994-02-10 2004-02-03 Hitachi, Ltd. Method of manufacturing a semiconductor device a ball grid array package structure using a supporting frame
US5682673A (en) * 1995-04-17 1997-11-04 Ipac, Inc. Method for forming encapsulated IC packages
US5750423A (en) * 1995-08-25 1998-05-12 Dai-Ichi Seiko Co., Ltd. Method for encapsulation of semiconductor devices with resin and leadframe therefor
GB2344934A (en) * 1995-10-24 2000-06-21 Altera Corp Integrated circuit package
US7635613B2 (en) * 2005-06-27 2009-12-22 Texas Instruments Incorporated Semiconductor device having firmly secured heat spreader
JP2008085002A (ja) * 2006-09-27 2008-04-10 Sanyo Electric Co Ltd 半導体装置およびその製造方法
US20090152683A1 (en) * 2007-12-18 2009-06-18 National Semiconductor Corporation Rounded die configuration for stress minimization and enhanced thermo-mechanical reliability
US7808089B2 (en) * 2007-12-18 2010-10-05 National Semiconductor Corporation Leadframe having die attach pad with delamination and crack-arresting features
US9054077B2 (en) * 2010-03-10 2015-06-09 Altera Corporation Package having spaced apart heat sink
CN104465588B (zh) * 2013-09-25 2018-11-02 恩智浦美国有限公司 具有应力释放和散热器的半导体封装件
KR20160038364A (ko) * 2014-09-30 2016-04-07 현대모비스 주식회사 비절연 타입의 전력 반도체 모듈 및 이의 제조 방법

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3942245A (en) * 1971-11-20 1976-03-09 Ferranti Limited Related to the manufacture of lead frames and the mounting of semiconductor devices thereon
US3930114A (en) * 1975-03-17 1975-12-30 Nat Semiconductor Corp Integrated circuit package utilizing novel heat sink structure
US4326238A (en) * 1977-12-28 1982-04-20 Fujitsu Limited Electronic circuit packages
US4415025A (en) * 1981-08-10 1983-11-15 International Business Machines Corporation Thermal conduction element for semiconductor devices
JPS5833857A (ja) * 1981-08-21 1983-02-28 Nec Corp 半導体装置
US4620215A (en) * 1982-04-16 1986-10-28 Amdahl Corporation Integrated circuit packaging systems with double surface heat dissipation
US4561011A (en) * 1982-10-05 1985-12-24 Mitsubishi Denki Kabushiki Kaisha Dimensionally stable semiconductor device
JPS5979417A (ja) * 1982-10-28 1984-05-08 Sony Corp 磁気ヘツド装置
JPS59164243A (ja) * 1983-03-04 1984-09-17 Tokai Rika Co Ltd 車輛用脱落式ミラ−の取付装置
JPS59178754A (ja) * 1983-03-30 1984-10-11 Hitachi Ltd 発熱体用放熱部材
JPS59202656A (ja) * 1983-04-30 1984-11-16 Matsushita Electric Works Ltd 電子回路の実装構造
JPS60180130A (ja) * 1984-02-27 1985-09-13 Sanyo Electric Co Ltd 半導体装置
US4607276A (en) * 1984-03-08 1986-08-19 Olin Corporation Tape packages
JPS62285450A (ja) * 1986-06-04 1987-12-11 Mitsubishi Electric Corp Icフラツトパツケ−ジ
US4922324A (en) * 1987-01-20 1990-05-01 Kabushiki Kaisha Toshiba Semiconductor integrated circuit device

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5299091A (en) * 1991-03-20 1994-03-29 Hitachi, Ltd. Packaged semiconductor device having heat dissipation/electrical connection bumps and method of manufacturing same
WO1994006154A1 (en) * 1992-09-10 1994-03-17 Vlsi Technology, Inc. Method for thermally coupling a heat sink to a lead frame
US5783860A (en) * 1996-01-31 1998-07-21 Industrial Technology Research Institute Heat sink bonded to a die paddle having at least one aperture
CN101958302A (zh) * 2010-09-04 2011-01-26 江苏长电科技股份有限公司 双面图形芯片倒装单颗封装结构及其封装方法

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Publication number Publication date
US5053855A (en) 1991-10-01
JPH0732215B2 (ja) 1995-04-10

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