JPH01186017A - 入力制御回路 - Google Patents
入力制御回路Info
- Publication number
- JPH01186017A JPH01186017A JP63011108A JP1110888A JPH01186017A JP H01186017 A JPH01186017 A JP H01186017A JP 63011108 A JP63011108 A JP 63011108A JP 1110888 A JP1110888 A JP 1110888A JP H01186017 A JPH01186017 A JP H01186017A
- Authority
- JP
- Japan
- Prior art keywords
- noise
- signal
- input
- buffer
- output control
- Prior art date
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- Pending
Links
- 239000000872 buffer Substances 0.000 abstract description 7
- 230000007257 malfunction Effects 0.000 description 2
- 239000003795 chemical substances by application Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Logic Circuits (AREA)
- Manipulation Of Pulses (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はCMOS集積回路に関し、特に入力制御回路に
関する。
関する。
LSIの高速・高性能化に供って、データバス等同時に
変化する信号線の数が増加し、又出力バッファにも高速
なものが多用されている。
変化する信号線の数が増加し、又出力バッファにも高速
なものが多用されている。
複数の高速出力バッファが同時に変化すると、電源ある
いはGND線にノイズが発生し、入力端子が誤まったレ
ベルを取り込んで誤動作を起すという問題が発生してい
る。
いはGND線にノイズが発生し、入力端子が誤まったレ
ベルを取り込んで誤動作を起すという問題が発生してい
る。
本発明は、出力制御信号に同期して入力の取り込みを制
限することによって前述したノイズによる誤動作を防ご
うとするものである。
限することによって前述したノイズによる誤動作を防ご
うとするものである。
第1図は本発明の一実施例である。
出力バッファG1は出力制御信号Cが“H”の時信号0
1を端子Oに出力する。この時バッファG1に大電流が
流れノイズが発生しやすいが、ゲートG3をCによって
固定レベルとしているため仮に入力Sからノイズが入っ
たとしても内部信号S1にノイズが乗ることはない。
1を端子Oに出力する。この時バッファG1に大電流が
流れノイズが発生しやすいが、ゲートG3をCによって
固定レベルとしているため仮に入力Sからノイズが入っ
たとしても内部信号S1にノイズが乗ることはない。
第2図は本発明の第2の実施例である。
入力信号をラッチするという点で前の実施例と異なる。
出力制御信号Cが“H”の間ゲー)G4を閉じることで
内部信号S2のレベルを保持し入力Sからのノイズを遮
断できる。
内部信号S2のレベルを保持し入力Sからのノイズを遮
断できる。
以上説明したように本発明は、出力制御信号に同期して
入力を制限することによってノイズの取り込みを防ぐこ
とができる。
入力を制限することによってノイズの取り込みを防ぐこ
とができる。
第1図は本発明の一実施例
第2図は本発明の別の実施例である。
図中、C・・・・・・出力制御信号、O・・・・・・出
力端子、S・・・・・・入力端子、01.SL、82・
・・・・・信号、G1・・・・・・出力ハッファ、02
〜G6.CZ・・・・・・ゲート。 代理人 弁理士 内 原 音 第7回
力端子、S・・・・・・入力端子、01.SL、82・
・・・・・信号、G1・・・・・・出力ハッファ、02
〜G6.CZ・・・・・・ゲート。 代理人 弁理士 内 原 音 第7回
Claims (1)
- CMOS集積回路において、出力制御信号に同期して入
力を制御することを特徴とする入力制御回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63011108A JPH01186017A (ja) | 1988-01-20 | 1988-01-20 | 入力制御回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63011108A JPH01186017A (ja) | 1988-01-20 | 1988-01-20 | 入力制御回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH01186017A true JPH01186017A (ja) | 1989-07-25 |
Family
ID=11768815
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63011108A Pending JPH01186017A (ja) | 1988-01-20 | 1988-01-20 | 入力制御回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH01186017A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH057139A (ja) * | 1991-06-21 | 1993-01-14 | Nec Kyushu Ltd | 半導体集積回路 |
-
1988
- 1988-01-20 JP JP63011108A patent/JPH01186017A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH057139A (ja) * | 1991-06-21 | 1993-01-14 | Nec Kyushu Ltd | 半導体集積回路 |
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