JPH0115246Y2 - - Google Patents

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JPH0115246Y2
JPH0115246Y2 JP1982080395U JP8039582U JPH0115246Y2 JP H0115246 Y2 JPH0115246 Y2 JP H0115246Y2 JP 1982080395 U JP1982080395 U JP 1982080395U JP 8039582 U JP8039582 U JP 8039582U JP H0115246 Y2 JPH0115246 Y2 JP H0115246Y2
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    • H04L7/0331—Speed or phase control by the received code signals, the signals containing no special synchronisation information using the transitions of the received signal to control the phase of the synchronising-signal-generating means, e.g. using a phase-locked loop with a digital phase-locked loop [PLL] processing binary samples, e.g. add/subtract logic for correction of receiver clock
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Description

【考案の詳細な説明】 本考案は、基地局の送信機より広域に散在する
複数の受信機を選択的に呼出す個別選択呼出通信
システムに適用され、選択呼出信号とともに必要
によりメツセージ情報を受信し、それを表示する
ことのできるデイジタル式の無線個別選択呼出受
信機に関する。
近年、集積技術の進歩によつて選択呼出受信機
の小形化と多機能化は目覚しく、メツセージ情報
を受信して表示するものも多く出現している。従
つて、最近は、このようなシステムの利用者とし
て、呼出のみのサービスを受ける人とメツセージ
のサービスを受ける人が同一システム内に混在す
るようになつてきた。そのために、利用者の所持
する選択呼出受信機としては、呼出サービスのた
めのデコーダのみを収容すればよいものと、メツ
セージサービス用のデコーダとを併わせて収容す
るものとの２通りが必要になるが、これ等を別々
に作ることは、量産性を高めるべく極めて不経済
である。
そこで、呼出のみを受信するデコーダとメツセ
ージ情報のみを受信するデコーダとは別々に作つ
ておき、呼出のみのサービスを受ける人の受信機
には、呼出のみを受信すするデコーダのみを搭載
し、メツセージサービスを受ける人の受信機に
は、呼出のみを受信するデコーダとメツセージ信
号のみを受信するデコーダとを搭載し、プラグ形
式などで接続して用いることによつてサービスに
見合つた小形で安価な受信機を提供することが考
えられる。この場合、呼出のみのサービスでは呼
出番号の受信に応答して鳴音する必要があるが、
メツセージサービスを受信する受信機に対して
は、呼出番号が受信されてもすぐに鳴音しない
で、引き続くメツセージ情報の検出が確認されて
はじめて鳴音するようにし、したがつて、メツセ
ージ情報が受信されないときは、鳴音させないよ
うに構成する必要がある。
本考案の目的は、呼出のみのサービスとメツセ
ージサービスとが混在するシステムにおいて、呼
出番号を検出するデコーダを、呼出のみの受信機
とメツセージ情報をも受信できる受信機とに共通
して使用できるように標準化して設計しておき、
それぞれのサービス用受信機のどちらにも組込み
可能にすることによつて、量産性の高い無線個別
選択呼出受信機を提供することにある。
また、本考案の他の目的は、メツセージ情報を
検出するデコーダのパネルを、呼出番号を検出す
るデコーダを搭載した受信機に抜き差しするだけ
で、容易に呼出のみに供される受信機とメツセー
ジサービスに供される受信機とに設定変えするこ
との出来る無線選択呼出受信機を提供することに
ある。
本考案によれば、呼出信号を検出するデコーダ
とメツセージ情報を検出するデコーダとの間を接
続する制御線として、メツセージ情報の検出の有
無を示す信号線と、前記メツセージ情報を検出す
るデコーダが接続されているか否かを識別する信
号線とを設け、これ等の信号線を介して前記呼出
信号を検出するデコーダに前記メツセージ情報ｂ
を検出するデコーダを接続することによつてメツ
セージ情報の受信用として動作させ、該メツセー
ジ情報を検出するデコーダを取り除くことによつ
て前記呼出情報の受信専用として動作させること
を特徴とする無線個別選択呼出受信機が得られ
る。
次に、本考案による個別選択呼出受信機につい
て図面を参照して詳細に説明する。
第１図は、本考案による実施例として、個別選
択呼出受信機の構成をブロツク図により示したも
のである。この例によれば、受信機は、アンテナ
１０と、受信部１１と、波形整形部１２と、電源
の供給を切替えるスイツチ回路１３と、呼出番号
等が書き込まれているＰ−ROM１４と、バツフ
アアンプ１５と、スピーカ１６と、電池１７と、
電源スイツチ１８とリセツトスイツチ１９と、デ
コーダ２０と、メツセージ情報を受信したり、表
示を制御するCPU３０ａとROM３０ｂとRAM
３０ｃとを含む制御部３０と、キヤラクタージエ
ネレータ４０ａとLCDドライバー４０ｂとLCD
４０ｃとを含む表示部４０と電池５０と接続栓６
０とによつて構成されている。このように構成さ
れた受信機の動作について、第２図のタイムチヤ
ートを参照して説明する。いま、この受信機にお
いて、電源スイツチ１８が閉ざされ、スイツチ回
路１３によつて第２図ｂに見られるストロークで
間欠的に前段部に対して電源のON（60ms）、
OFF（1005ms）が繰返えされているものとする。
この状態において、電源がONのときにのみ、第
２図ａに構成されるような受信信号がアンテナ１
０、受信部１１で受信され、波形整形部１２を介
してデコーダ２０へ与えられる。
デコーダ２０は、第３図にその具体的な構成例
を示してあるように、分周回路２０１，２０３
と、OSC２０２と、プリアンブル信号検出回路
２１０と、同期信号検出回路２０２と、終了（エ
ンド）信号検出回路２３０と、呼出信号検出回路
２４０と、前置信号の検出に応答する1.2秒タイ
マ２５５と、同期信号の検出に応答する12秒タイ
マ２５８と、クロツク再生回路２７０と、31進カ
ウンタ２７３と、３進カウンタ２７５と、インバ
ータゲート２０５，２０６，２５３，２５９，２
６７および２７２と、ANDゲート２０７，２０
８，２５０，２５１，２５６，２６０，２６６，
２６５，２６８，２６９および２７４と、ORゲ
ート２５４，２５７，２６４および２７６と、Ｄ
タイプのＦ／Ｆ２０４，２５２，２６１，２６
２，２６３および２７１とから構成されている。
したがつて、波形整形部１２から与えられた信号
は、デコーダ２０のクロツク再生回路２７０でビ
ツト同期がとられ、その出力は２分周回路２０１
でプリアンブル信号、フレーム同期およびアドレ
ス信号を受信するのに必要なクロツク周波数に変
換される。一方、Ｄ形Ｆ／Ｆで構成される同期化
回路２０４に与えられたデータは、ここに読み込
まれ、その出力はプリアンブル信号検出回路２１
０、同期信号検出回路２２０、終了信号検出回路
２３０および呼出信号検出回路２４０に入力され
る。そして、第４図に見られるように構成されて
いるプリアンブル信号発生回路２１０が
“01010101”のパターンを検出すると、ゲート２
０７の出力信号（第２図ｄ）によりＦ／Ｆ２５２
を反転（第２図ｅ）せしめ、ゲート２０６を介し
てゲート２０７を禁止するとともに、ゲート２０
８を開き、かつゲート２５３，２５４を介して制
御信号（第２図ｃ）をスイツチ回路１３に送る。
同時に、Ｆ／Ｆ２５２に応答して1.2秒を作るタ
イマ２５５が作動し、バツテリー・セービング信
号（第２図ｂ）には無関係に電源を受信機全部に
印加する。そして、タイマ２５５がタイムアウト
するまでに、第５図で構成される同期信号検出回
路２２０による信号の検出が確認されないと、ゲ
ート２５６，２５７を介してＦ／Ｆ２５２、タイ
マ２５５およびプリアンブル信号検出回路２１０
をリセツトし、再び分周回路２０３の出力信号ｂ
のストロークでバツテリー・セービングによる間
欠受信に移行する。
しかし、1.2秒以内に、同期信号検出回路２２
０でフレーム同期信号にの検出が確認されると、
ゲート２０８の出力信号（第２図ｆ）によつて
Ｆ／Ｆ２６１をセツトし、呼出信号を検出し終え
るのに必要にして十分な時間（本例では12sec）
を作るタイマ２５８を起動させると伴に、ゲート
２５９を介してゲート２５６を禁止してタイマ２
５５の出力を阻止する。同時に、ゲート２５０，
２５１，２６９を開いて呼出信号およびバツテリ
ー・セービング動作へ復帰させるためのエンド信
号の受信にそなえる。もし、この状態で何も受信
されないまま12秒が経過し、タイマ２５８がタイ
ムアウトすると、ゲート２５７を介してプリアン
ブル信号検出回路２１０、同期信号検出回路２２
０、第６図の回路で構成される終了信号検出回路
２３０、Ｆ／Ｆ２５２，２６１およびタイマ２５
５，２５８をリセツトし、再び分周回路２０３の
出力ｂによる間欠受信に移行する。しかし、タイ
マ２５８がタイムアウトしない間に自機の呼出信
号が入力されると、ゲート２６９を介して、31進
カウンタ２７３により入力されるクロツクに応答
して31本のアドレス指定を行なう。31進カウンタ
２７３によつて、自機の呼出番号が書き込まれ、
例えば、トランジスタアレイで構成されるP.
ROM１４のデータを読み出し、これを第７図の
回路で構成される呼出信号検出回路２４０に入力
される。その結果、呼出信号が１ビツトごとに比
較され、一致が確認されるたびにカウンタ２４２
の計数値を進め、31ビツト目の後半分のパルスを
ゲート２６８を介して呼出信号検出回路２４０へ
与えて結果を読み出す。このようにして、呼出信
号の一致が確認されると、論理“１”の信号がゲ
ート２５１を介してＦ／Ｆ２６２をセツトして信
号ｊを出力し、さらに、ゲート２６０を介して信
号ｉを送出しCPU３０ａへ送る。しかし、ここ
で、CPU３０ａからの信号（第２図ｋ）は論理
“０”なので、ゲート２６５により、阻止されて
鳴音しない。
上記の説明により理解できるように、呼出番号
を受信出来るデコーダにおいて、通常メツセージ
情報を受信するためのデコーダを組込んだパネル
が接続栓６０を介して接続されていないときは、
呼出番号の検出に応答し、ゲート２５１、Ｆ／Ｆ
２６２、ゲート２６５，２６４および２６６を介
して鳴音させ、呼出があつたことを受信機所持者
に知らせることができる。ところが、前述のごと
くメツセージデコーダを搭載したパネルが接続さ
れると、後述するCPU３０ａの出力ポート３０
１によつて、信号ｋを論理“０”としてゲート２
６５を阻止し、たとえ呼出番号が検出されても鳴
音を禁止し、メツセージ情報が受信されたときの
み信号ｌによりＦ／Ｆ２６３で呼出信号の検出情
報とのANDをとり、ゲート２６４，２６６を介
して鳴音を生ぜしめる。このとき、もし、メツセ
ージ情報が正しく受信されないと、信号ｎにより
ゲート２７６を介してＦ／Ｆ２６２，２６３をク
リアし、鳴音を生ぜしめない。
第３図のように、メツセージデコーダのパネル
が接続されているものとして説明を続けると、オ
ート・リセツト機能の有・無或は検出すべき信号
の符号構成情報などが書き込まれているＰ・
ROM１４に対して、受信機の機能指定情報がゲ
ート２７４を介して３進カウンタ２７５によりア
ドレス指定し、制御部３０を構成する第８図の入
力ポート３０４を介してCPUに読み込まれてい
るので、制御部３０は読み込まれた機能指定によ
つて待機状態にある。こうして、呼出番号の検出
された一致情報が信号ｉにより割り込み信号を受
付ける制御部３０のインタラプタ３０８の＃１に
入力されると、データバス３１１を介してプログ
ラムデータをセツトし、引き続いて送られてくる
メツセージ信号の検出にそなえる。
第８図は制御部３０の具体的な一例を示したブ
ロツク図である。この例は、出力ポート３０１〜
３０３と、入力ポート３０４〜３０６と、割り込
みポート３０８と、シリアルインタフエース３０
９と、入出力ポート３１０と、データバス３１１
と、番地の内容を指定するプログラムカウンタ３
１２と、実行すべき命令のシーケンスがストアさ
れ、プログラムカウンタ３１２で指定された番地
の内容を読出すブログラム用のROM３０ｂと、
ROM３０ｂからの情報をデコードし、各部へそ
の命令に対応する制御信号を供給するインストラ
クシヨン・デコーダ３１５と、ROM３０ｂに書
き込まれている手順を順次実行すべく、ROM３
０ｂからインストラクシヨン・デコーダ３１５へ
の情報受け渡しごとに、“＋１”したり、或は分
岐命令やジヤンプ命令に対応して変更されるプロ
グラムカウンタ３１２と算術演算、論理演算など
各種の演算を行なうALU３１３と、各種データ
の記憶、サブルーチン、割り込みにおけるプログ
ラムカウント、プログラムステータスの退避に用
いられるRAM３０ｃと、ALU３１３の演算結果
をストアしたり、RAM３０ｃ、各ポート３０１
〜３０７，３１０間のデータの送受に用いられる
ACC３１４と、実行命令サイクル時間を決定す
るシステムクロツク発生回路３１６および各種の
タイミング用のクロツク源に用いられるカウント
クロツク発生回路３１７とによつて構成されてい
る。
さて、第８図を参照し、デコーダ２０の同期化
回路に２７１でクロツクと同期がとられたメツセ
ージ情報は、入力ポート３０５を介してCPU３
０ａに入力される。また、クロツク信号は、クロ
ツク再生回路２７０の出力から入力ポート３０６
を介して読み込まれる。そして、ALU３１３で
31ビツト単位にROM30bに書き込まれている手
順に従つて演算処理され、上記31ビツト中の情報
ビツトを構成するうちの21ビツトはRAM３０ｃ
に記憶する。このようにして、順次全情報ビツト
の検出を行なう。そして、もし、ALU３１３に
おける31ビツト単位の演算過程で、規程の誤り数
（本実施例では２）以上の誤りが検出されると、
メツセージ情報は受信されなかつたものとして、
出力ポート３０２からゲート２７６を介してＦ／
Ｆ２６２，２６３をリセツトする。しかし、メツ
セージ情報が全て検出されると、出力ポート３０
３を介してＦ／Ｆ２６３をセツトし、ゲート２６
４，２６６を介してバツフアアンプ１５によりス
ピーカ１６を鳴らす。これによつて、呼出がなさ
れた旨を受信機所持者に知らせると同時に、受信
されたメツセージ内容が記憶されているRAM３
０ｃからデータを読み出し、シリアルインタフエ
ース３０９を介して表示部４０へ送出される。
第９図は表示部４０の具体的な一例を示したブ
ロツク図である。この例によれば、表示部４０
は、CPU３０ａとの間のデータをシリアルに接
続するシリアルインタフエース４０１と、シリア
ルインタフエース４０９を介して入力された命令
を取り込んでデコードし、命令の内容に対応して
各部を制御するコマンドデコーダ４０２と、入力
されたデータに対応して７×５のドツトマトリク
スによるパターンを発生するキヤラクタ発生回路
４０３と、シリアルインタフエース４０１からの
データの書き込みまたは、シリアルインタフエー
ス４０１へのデータの読み出しアドレスを指定す
るデータポインタ４０４と、キヤラクタ発生回路
４０３の出力、或はシリアルインタフエース４０
１からの表示データを記憶するデータメモリ４０
５と、LCDの行制御を行うLOWドライバ４０６
と、LCDの列制御を行なうコラムドライバ４０
７と、LCDへの供給電圧を制御するLCD電圧コ
ントローラ４０８と、LCDの駆動タイミングを
制御するLCDタイミングコントローラ４０９お
よびシステムクロツク・コントローラ４１０とに
よつて構成されている。
表示部４０の動作について、第９図を参照して
説明すると、まず、CPU３０ａの入出力ポート
３１０からの指令をシリアルインタフエース４０
１を介してうけ、コマンドデコーダ４０２で翻訳
し、メツセージデータをキヤラクタ発生回路４０
３を介してうけ、データポインタ４０４でアドレ
シングしてデータメモリ４０５に入力する。同時
に、LCDタイミングコントローラ４０９に応じ
てROWドライバ４０６、コラムドライバ４０７
を駆動して、受信されたメツセージ内容をLCD
４０ｃ上に表示する。なお、鳴音をリセツトした
いときには、プツシユスイツチ１９をプツシユす
ると、デコーダ２０および外部割込入力端子のイ
ンタラプタ３０８の＃２からの信号に応答して、
出力ポート３０２、ゲート２７６を介してＦ／Ｆ
２６２，２６３をリセツトする。但し、表示は、
鳴音停止中に再度、プツシユスイツチ１９が押さ
れたときか、或は表示開始から８秒経過したとき
にのみ切替つたり、消えたりする。
以上の説明により明らかなように、本考案によ
れば、呼出番号を検出するデコーダ回路を、メツ
セージ情報を受信できる受信機にも共通に使用で
きるように組込んでおき、更にメツセージ情報を
検出するデコーダ回路を上記呼出番号を検出する
デコーダ回路に接続できるように、パネル構造に
より標準化し、受信機筐体に抜き差しすることに
よつて、容易に呼出のみに用いられる受信機をメ
ツセージサービスにも使用できるように変更する
ことができ、これによつて、必要に応じて無駄な
く、内蔵された機能を役立てることができるとと
もに、量産性の向上に対して得られる効果は大き
い。
【図面の簡単な説明】
第１図は本考案による実施例として、個別選択
呼出受信機の構成を示すブロツク図、第２図ａ〜
ｍは、第１図における実施例の特にデコーダの各
部の動作を説明するためのタイムチヤート、第３
図は、第１図におけるデコーダ２０の具体的な構
成例を示すブロツク図、第４図は、第３図におけ
るプリアンブル信号検出回路の具体的な構成例を
示す図、第５図は、第３図における同期信号検出
回路の具体的な構成例を示す図、第６図は、第３
図における終了信号検出回路の具体的な構成例を
示す図、第７図は、第３図における呼出信号検出
回路の具体的な構成例を示す図、第８図は第１図
における制御部３０の具体的な構成例を示すブロ
ツク図、第９図は、第１図における表示部４０の
具体的な構成例を示すブロツク図である。 図において、１０はアンテナ、１１は受信部、
１２は波形整形部、１３はスイツチ回路、１４は
Ｐ−ROM、１５はバツフアアンプ、１６はスピ
ーカ、１９はリセツトスイツチ、２０はデコー
ダ、３０は制御部、３０ａはCPU、３０ｂは
ROM、３０ｃはRAM、４０は表示部、４０ａ
はキヤラクタージエネレータ、４０ｂはドライバ
ー、４０ｃはLCD、６０は接続栓、２０１，２
０３は分周回路、２１０はプリアンブル信号検出
回路、２２０は同期信号検出回路、２３０は終了
信号検出回路、２４０は呼出信号検出回路、２５
５，２５８はタイマ、２７０はクロツク再生回
路、２７３は31進カウンタ、２７５は３進カウン
タ、２０４，２５２，２６１〜２６３，２７１は
ＤタイプのＦ／Ｆ、３０１〜３０３は出力ポー
ト、３０４〜３０６は入力ポート、３０８は割り
込みポート、３１０は入出力ポート、３１２はプ
ログラムカウンタ、３１３はALU、３１５はイ
ンストラクシヨン・デコーダ、４０１はシリアル
インタフエース、４０２はコマンドデコーダ、４
０３はキヤラクタ発生回路、４０４はデータポイ
ンタ、４０５はデータメモリ、４０６はLOWド
ライバ、４０７はコラムドライバである。

Claims (1)

    【実用新案登録請求の範囲】
  1. 呼出信号を検出するデコーダとメツセージ情報
    を検出するデコーダとの間を接続する制御線とし
    て、メツセージ情報の検出の有無を示す信号線
    と、前記メツセージ情報を検出するデコーダが接
    続されているか否かを識別する信号線とを設け、
    これ等の信号線を介して前記呼出信号を検出する
    デコーダに前記メツセージ情報を検出するデコー
    ダを接続することによつてメツセージ情報の受信
    用として動作させ、該メツセージ情報を検出する
    デコーダを取り除くことによつて前記呼出情報の
    受信専用として動作させることを特徴とする無線
    個別選択呼出受信機。
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