JP6627698B2 - 半導体装置 - Google Patents

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Description

本発明は、ケース内を樹脂で封止する半導体装置に関する。
発電及び送電から効率的なエネルギーの利用及び再生まであらゆる場面で半導体装置が利用されている。半導体装置において、絶縁板上の回路パターンに半導体素子が接合され、それらを囲むように絶縁板上にケースが設けられ、ケース内が樹脂で封止されている(例えば、特許文献1参照)。樹脂は液化した状態でケース内に注入されるため、樹脂が硬化するまでの間に絶縁板とケースの隙間から樹脂が液漏れするのを防ぐ必要がある。
特開2000−323593号公報
従来は、絶縁板とケースを接着材により接着して、ケース樹脂と絶縁板の隙間を塞いで液漏れを防いでいた。従って、樹脂を注入する前に、接着材を絶縁板の外周部に環状に全周塗布して固めておく必要があった。このため、接着材の塗布工程とキュア工程に時間が必要であり、製造時間が長くなるという問題があった。
本発明は、上述のような課題を解決するためになされたもので、その目的は接着材の塗布工程とキュア工程を省いて製造時間を短くすることができる半導体装置を得るものである。
本発明に係る半導体装置は、絶縁板と、前記絶縁板上に設けられた回路パターンと、前記回路パターンに接合された半導体素子と、前記回路パターン及び前記半導体素子を囲むように前記絶縁板上に設けられ、前記絶縁板に接着されていないケースと、前記ケース内に設けられ、前記回路パターン及び前記半導体素子を封止する硬化された樹脂とを備え、前記ケースの下面に環状に設けられた凹部に、前記絶縁板の上面に環状に設けられた凸部が嵌合し、前記凸部は前記回路パターンと素材及び高さが同じであることを特徴とする。
本発明では、ケースが絶縁板に接着されておらず、装置全体の固定は硬化された樹脂によりなされる。このため、接着材の塗布工程とキュア工程を省いて製造時間を短くすることができる。
本発明の実施の形態1に係る半導体装置を示す断面図である。 本発明の実施の形態1に係る半導体装置のケースを示す下面図である。 本発明の実施の形態2に係る半導体装置を示す断面図である。 本発明の実施の形態2に係る半導体装置のケースを示す下面図である。 本発明の実施の形態3に係る半導体装置を示す断面図である。 本発明の実施の形態4に係る半導体装置を示す断面図である。 本発明の実施の形態5に係る半導体装置を示す断面図である。 本発明の実施の形態6に係る半導体装置を示す断面図である。
本発明の実施の形態に係る半導体装置について図面を参照して説明する。同じ又は対応する構成要素には同じ符号を付し、説明の繰り返しを省略する場合がある。
実施の形態1.
図1は、本発明の実施の形態1に係る半導体装置を示す断面図である。図2は、本発明の実施の形態1に係る半導体装置のケースを示す下面図である。放熱板1上に絶縁板2が設けられ、絶縁板2上に回路パターン3が設けられている。放熱板1と絶縁板2と回路パターン3は一体となっている。
電流スイッチング素子などの半導体素子4が回路パターン3にはんだ5により接合されている。ケース6が、回路パターン3及び半導体素子4を囲むように絶縁板2上に設けられている。ただし、ケース6は絶縁板2に接着されておらず、ネジによる固定などもされていない。電極7,8がケース6中に備え付けられ又は内蔵されている。半導体素子4の上面電極がワイヤ9により電極7に接続され、回路パターン3がワイヤ10により電極8に接続されている。
エポキシ系の樹脂11がケース6内に設けられ、回路パターン3及び半導体素子4などを封止する。硬化されていない素材12が、絶縁板2の上面とケース6の下面との隙間に環状に設けられ、絶縁板2の上面及びケース6の下面に密着している。素材12は、例えばポリエステル系熱可塑性エラストマーなどであり、製造中だけでなく製造後にも硬化されず、未硬化の樹脂11よりも高い粘度を有する素材である。
本実施の形態では、ケース6は絶縁板2に接着されておらず、装置全体の固定は硬化された樹脂11によりなされる。このため、接着材の塗布工程とキュア工程を省いて製造時間を短くすることができる。また、樹脂11が硬化するまでの期間、素材12により、絶縁板2とケース6の隙間から未硬化の樹脂11が漏れ出るのを防ぐことができる。
実施の形態2.
図3は、本発明の実施の形態2に係る半導体装置を示す断面図である。図4は、本発明の実施の形態2に係る半導体装置のケースを示す下面図である。本実施の形態では、実施の形態1の素材12の代わりに、ケース6の下面に凹部13が環状に設けられている。ゴムなどの弾力性部材14がケース6の凹部13に環状に設けられ、絶縁板2の上面及びケース6の下面に密着している。凹部13に押し込まれていない状態の弾力性部材14の自然長は凹部13の深さより大きい。その他の構成は実施の形態1と同様である。
樹脂11が硬化するまでの期間、半導体装置の自重又は外部応力により、弾力性部材14は絶縁板2に押し当てられる。これより、絶縁板2と弾力性部材14との間の隙間を無くして確実に気密性を確保できるため、未硬化の樹脂11が漏れ出るのを防ぐことができる。また、実施の形態1と同様に、ケース6は絶縁板2に接着されておらず、装置全体の固定は硬化された樹脂11によりなされる。このため、接着材の塗布工程とキュア工程を省いて製造時間を短くすることができる。
なお、樹脂11が硬化するまでの期間は、放熱板1とケース6を治具等で押さえておくことが好ましい。また、例えば回路パターン3と素材及び高さが同じである凸部を弾力性部材14の下方で絶縁板2に設けて押し当ての補助としてもよい。
実施の形態3.
図5は、本発明の実施の形態3に係る半導体装置を示す断面図である。本実施の形態では、実施の形態1の素材12の代わりに、ケース6の下面に環状に設けられた凹部13に、絶縁板2の上面に環状に設けられた凸部15が嵌合している。凹部13及び凸部15は複数でもよいし、1つでもよい。その他の構成は実施の形態1と同様である。
樹脂11が硬化するまでの期間において、嵌合した凹部13及び凸部15により確実に気密性を確保できる。このため、未硬化の樹脂11が漏れ出るのを防ぐことができる。また、実施の形態1と同様に、ケース6は絶縁板2に接着されておらず、装置全体の固定は硬化された樹脂11によりなされる。このため、接着材の塗布工程とキュア工程を省いて製造時間を短くすることができる。
また、凸部15は回路パターン3と素材及び高さが同じである。これにより、回路パターン3と同一プロセスで凸部15を形成することができる。また、凹部13の深さは凸部15の高さ以上である。これにより、製造公差による嵌合不具合を無くすことができる。
実施の形態4.
図6は、本発明の実施の形態4に係る半導体装置を示す断面図である。実施の形態3の構成に加えて、凹部13内において凸部15の上に弾力性部材16が設けられている。弾力性部材16は例えば樹脂性のレジストである。弾力性部材16を設けることにより、実施の形態3よりも樹脂11の液漏れ効果を高めることができる。これによって樹脂11の粘度を下げることができるため、半導体装置の部品構想の幅が広がる。その他の構成及び効果は実施の形態3と同様である。
実施の形態5.
図7は、本発明の実施の形態5に係る半導体装置を示す断面図である。本実施の形態では、実施の形態1の素材12の代わりに、ケース6の下面に環状に設けられた凸部17が、弾力性を有する樹脂系などの絶縁板2に食い込んでいる。凸部17は複数でもよいし、1つでもよい。凸部17は断面が三角形状であり、先端は丸みを帯びていてもよい。その他の構成は実施の形態1と同様である。
樹脂11が硬化するまでの期間において、凸部17が絶縁板2に食い込むことより確実に気密性を確保できる。このため、未硬化の樹脂11が漏れ出るのを防ぐことができる。また、実施の形態1と同様に、ケース6は絶縁板2に接着されておらず、装置全体の固定は硬化された樹脂11によりなされる。このため、接着材の塗布工程とキュア工程を省いて製造時間を短くすることができる。
実施の形態6.
図8は、本発明の実施の形態6に係る半導体装置を示す断面図である。本実施の形態では、実施の形態1の素材12の代わりに、絶縁板2の上面とケース6の下面との隙間に、例えば樹脂性のレジストインキなどの弾力性部材18が環状に設けられている。ケース6の下面に設けられた凸部17が弾力性部材18に食い込んでいる。凸部17は複数でもよいし、1つでもよい。凸部17は断面が三角形状であり、先端は丸みを帯びていてもよい。その他の構成は実施の形態1と同様である。
樹脂11が硬化するまでの期間、弾力性部材18により、絶縁板2とケース6の隙間から未硬化の樹脂11が漏れ出るのを防ぐことができる。そして、凸部17が絶縁板2に食い込むことより更に液漏れの防止効果を高めることができ、樹脂11の粘度の選択幅を拡げることができる。ただし、液漏れ防止が可能な厚みと弾力を維持可能な弾力性部材18であれば凸部17は無くてもよい。
また、実施の形態1と同様に、ケース6は絶縁板2に接着されておらず、装置全体の固定は硬化された樹脂11によりなされる。このため、接着材の塗布工程とキュア工程を省いて製造時間を短くすることができる。
なお、実施の形態1〜6において、半導体素子4は、珪素によって形成されたものに限らず、珪素に比べてバンドギャップが大きいワイドバンドギャップ半導体によって形成されたものでもよい。ワイドバンドギャップ半導体は、例えば、炭化珪素、窒化ガリウム系材料、又はダイヤモンドである。このようなワイドバンドギャップ半導体によって形成されたパワー半導体素子は、耐電圧性や許容電流密度が高いため、小型化できる。この小型化された素子を用いることで、この素子を組み込んだ半導体装置も小型化できる。また、素子の耐熱性が高いため、ヒートシンクの放熱フィンを小型化でき、水冷部を空冷化できるので、半導体装置を更に小型化できる。また、素子の電力損失が低く高効率であるため、半導体装置を高効率化できる。
2 絶縁板、3 回路パターン、4 半導体素子、6 ケース、11 樹脂、12 素材、13 凹部、14,16,18 弾力性部材、15,17 凸部

Claims (6)

  1. 絶縁板と、
    前記絶縁板上に設けられた回路パターンと、
    前記回路パターンに接合された半導体素子と、
    前記回路パターン及び前記半導体素子を囲むように前記絶縁板上に設けられ、前記絶縁板に接着されていないケースと、
    前記ケース内に設けられ、前記回路パターン及び前記半導体素子を封止する硬化された樹脂とを備え
    前記ケースの下面に環状に設けられた凹部に、前記絶縁板の上面に環状に設けられた凸部が嵌合し、
    前記凸部は前記回路パターンと素材及び高さが同じであることを特徴とする半導体装置。
  2. 絶縁板と、
    前記絶縁板上に設けられた回路パターンと、
    前記回路パターンに接合された半導体素子と、
    前記回路パターン及び前記半導体素子を囲むように前記絶縁板上に設けられ、前記絶縁板に接着されていないケースと、
    前記ケース内に設けられ、前記回路パターン及び前記半導体素子を封止する硬化された樹脂とを備え、
    前記ケースの下面に環状に設けられた凹部に、前記絶縁板の上面に環状に設けられた凸部が嵌合し、
    前記凹部内において前記凸部の上に設けられた弾力性部材を更に備えることを特徴とする半導体装置。
  3. 前記凹部の深さは前記凸部の高さ以上であることを特徴とする請求項1又は2に記載の半導体装置。
  4. 絶縁板と、
    前記絶縁板上に設けられた回路パターンと、
    前記回路パターンに接合された半導体素子と、
    前記回路パターン及び前記半導体素子を囲むように前記絶縁板上に設けられ、前記絶縁板に接着されていないケースと、
    前記ケース内に設けられ、前記回路パターン及び前記半導体素子を封止する硬化された樹脂とを備え、
    前記ケースの下面に環状に設けられた凸部が、弾力性を有する前記絶縁板に食い込んでいることを特徴とする半導体装置。
  5. 絶縁板と、
    前記絶縁板上に設けられた回路パターンと、
    前記回路パターンに接合された半導体素子と、
    前記回路パターン及び前記半導体素子を囲むように前記絶縁板上に設けられ、前記絶縁板に接着されていないケースと、
    前記ケース内に設けられ、前記回路パターン及び前記半導体素子を封止する硬化された樹脂と、
    前記絶縁板の上面と前記ケースの下面との隙間に環状に設けられた弾力性部材とを備え、
    前記ケースの前記下面に環状に設けられた凸部が前記弾力性部材に食い込んでいることを特徴とする半導体装置。
  6. 前記半導体素子はワイドバンドギャップ半導体によって形成されていることを特徴とする請求項1〜の何れか1項に記載の半導体装置。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS58184743A (ja) * 1982-04-23 1983-10-28 Hitachi Ltd モ−ルド型半導体装置
JPS61194754A (ja) * 1985-02-22 1986-08-29 Toshiba Corp 半導体装置
JPH11145343A (ja) * 1997-11-10 1999-05-28 Hitachi Ltd 樹脂封止型半導体装置及びその製造方法
JP2000323593A (ja) 1999-05-06 2000-11-24 Yazaki Corp 半導体装置
JP2004103846A (ja) * 2002-09-10 2004-04-02 Mitsubishi Electric Corp 電力用半導体装置
CN201352557Y (zh) * 2009-02-13 2009-11-25 亚洲光学股份有限公司 影像感测模块
DE112011103926B4 (de) * 2010-11-25 2018-03-08 Mitsubishi Electric Corporation Halbleitervorrichtung
JP2014203978A (ja) * 2013-04-05 2014-10-27 三菱電機株式会社 パワーモジュール
JP6215577B2 (ja) * 2013-05-31 2017-10-18 株式会社ヨコオ 半導体パッケージ容器、半導体装置、電子機器
JP6057926B2 (ja) * 2014-01-09 2017-01-11 三菱電機株式会社 半導体装置
JP6451257B2 (ja) * 2014-11-21 2019-01-16 富士電機株式会社 半導体装置
JP2016178595A (ja) 2015-03-23 2016-10-06 シャープ株式会社 受信装置、受信方法、及びプログラム

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