JP6259201B2 - ゲート駆動回路及びこれを含む表示装置 - Google Patents
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Description
また、本発明の目的は、横線視認現象が減少した表示装置を提供することにある。
前記複数個のステージの中でi番目ステージは(ここで、iは2以上の整数)、第1出力トランジスター、第2出力トランジスター、及び制御部を有する。前記第1出力トランジスターは、クロック信号を受信して前記i番目ステージのゲート信号を出力する。前記第1出力トランジスターは、前記i番目ステージの前のステージの制御信号に応答して電位が上昇する第1ノードに連結された制御電極を含む。前記i番目ステージの前のステージはi−1番目ステージである。前記第2出力トランジスターは、前記クロック信号を受信して前記i番目ステージのキャリー信号を出力する。前記第2出力トランジスターは、前記第1ノードに連結された制御電極を含む。前記制御部は、前記第1ノードに連結された出力電極を含む少なくとも1つの制御トランジスターを含む。前記制御部は、前記第1出力トランジスター及び前記第2出力トランジスターのオン/オフを制御する。
前記少なくとも1つの制御トランジスターは、スイッチング制御信号を受信する第1制御電極、及び該第1制御電極と異なる層上に配置されてキンク電流が減少するように基準電圧を受信する第2制御電極を含む。
前記少なくとも1つの制御トランジスターは、前記第1ノードの電位を上昇させて前記第1出力トランジスター及び前記第2出力トランジスターをターンオンさせる第1制御トランジスターを含み、前記第1ノードの電位を下降させて前記第1出力トランジスター及び前記第2出力トランジスターをターンオフさせる第2制御トランジスターを含む。
前記i番目ステージは、前記第1ノードをロー電圧に安定化させ、前記第1ノードに連結された少なくとも1つの安定化トランジスターを含む安定化部を更に含む。
前記少なくとも1つの安定化トランジスターは、i+2番目ステージのゲート信号に応答して前記第1ノードに前記ロー電圧を供給する第1安定化トランジスター、及び前記第1出力トランジスターのターンオフ区間の間に前記第1ノードの電位を前記ロー電圧に維持させる第2安定化トランジスターを含む。
前記少なくとも1つの制御トランジスターは、前記第1制御電極上に重畳して絶縁されるように配置された第1活性層、前記第1活性層上に重畳するように配置された入力電極、及び前記第1活性層上に重畳し、前記入力電極と離隔されて配置された出力電極を含み、前記入力電極及び前記出力電極は、前記第2制御電極の下に絶縁されるように配置される。
前記画素は、前記対応するゲートラインと前記対応するデータラインとに連結された薄膜トランジスター、前記薄膜トランジスターに連結された液晶キャパシター、及び前記液晶キャパシターに並列に連結されたストレージキャパシターを含む。
前記薄膜トランジスターは、前記対応するゲートラインから分岐されたゲート電極、該ゲート電極上に重畳して絶縁されるように配置された第2活性層、該第2活性層上に重畳するように配置されたソース電極、及び前記第2活性層上に重畳して前記ソース電極と離隔されて配置されたドレーン電極を含む。
前記薄膜トランジスターの前記第2活性層及び前記少なくとも1つの制御トランジスターの前記第1活性層は、同一の層上に配置される。
前記液晶キャパシターは、前記ドレーン電極に電気的に連結された第1電極、及び該第1電極と液晶層を介して配置された第2電極を含む。
前記液晶キャパシターの前記第1電極及び前記少なくとも1つの制御トランジスターの前記第2制御電極は、同一の層上に配置される。
また、第1出力トランジスターのターンオン区間で、第1ノードの電位は第1出力トランジスターの閾値電圧以上の値を有する。従って、ステージで出力されるゲート信号は遅延されない。
また、ゲート信号の遅延が防止されることによって、画素はデータ信号に対応する充分な量の画素電圧を充電することができる。画素に均一な画素電圧が充電されることによって、表示装置の横線視認現象が減少する。
14 第2絶縁層
16 第3絶縁層
100 ゲート駆動回路
111 第1出力部
112 第2出力部
113 制御部
114−1 第1プルダウン部
114−2 第2プルダウン部
115 維持部
116 スイッチング部
117 安定化部
200 データ駆動回路
210 駆動チップ
220 フレキシブル回路基板
300 回路基板
DP 表示パネル
DS1 第1基板
DS2 第2基板
SRC1〜SRCn ステージ
Claims (26)
- 各々がゲート信号を出力し、従属的に連結された複数個のステージを含むゲート駆動回路であって、
前記複数個のステージの中のi番目ステージは(ここで、iは2以上の整数)、
前記i番目ステージの前のステージの制御信号に応答して電位が上昇する第1ノードに連結された制御電極を含み、クロック信号を受信して前記i番目ステージのゲート信号を出力する出力トランジスターと、
前記第1ノードに連結された出力電極を含む少なくとも1つの制御トランジスターを含み、前記出力トランジスターのオン/オフを制御する制御部と、を備え、
前記少なくとも1つの制御トランジスターは、スイッチング制御信号を受信する第1制御電極、及び該第1制御電極と異なる層上に配置されて所定のレベルを有する基準電圧を受信する第2制御電極を含み、
前記複数個のステージの各々は、複数個の画素を含む表示パネルに前記ゲート信号を提供し、
前記複数個の画素の中の少なくともいずれか1つの画素は、
前記ゲート信号に応答してデータ信号を出力する薄膜トランジスターと、
前記薄膜トランジスターに連結された第1電極、及び該第1電極と液晶層を介して配置された第2電極を含む液晶キャパシターと、を含み、
前記第1電極は、前記データ信号に対応する電圧を受信し、
前記第2電極は、前記第1電極が受信する電圧とレベルが異なる電圧を受信し、 前記基準電圧は、前記第2電極が受信する電圧と同一なレベルを有することを特徴とするゲート駆動回路。 - 前記基準電圧は、プラス電圧であることを特徴とする請求項1に記載のゲート駆動回路。
- 前記基準電圧は、0Vより大きくて15Vより小さいか又は同一であることを特徴とする請求項2に記載のゲート駆動回路。
- 前記少なくとも1つの制御トランジスターは、
前記第1制御電極上に重畳して絶縁されるように配置された活性層と、
前記活性層上に重畳するように配置された入力電極と、
前記活性層上に重畳し、前記入力電極と離隔されて配置された出力電極と、を更に含み、
前記入力電極及び前記出力電極は、前記第2制御電極の下に絶縁されるように配置されることを特徴とする請求項2に記載のゲート駆動回路。 - 前記複数個の画素の中の少なくともいずれか1つの画素は、
前記薄膜トランジスターに連結された前記第1電極、及び前記第1電極と液晶層を介して配置された前記第2電極によって形成された前記液晶キャパシターと、
前記液晶キャパシターに並列に連結されたストレージキャパシターと、を含むことを特徴とする請求項2に記載のゲート駆動回路。 - 前記i番目ステージの前のステージは、i−1番目ステージであることを特徴とする請求項2に記載のゲート駆動回路。
- 前記少なくとも1つの制御トランジスターは、前記第1ノードの電位を上昇させて前記出力トランジスターをターンオンさせる第1制御トランジスターを含み、
前記第1制御トランジスターの前記スイッチング制御信号は、前記i−1番目ステージのキャリー信号であることを特徴とする請求項6に記載のゲート駆動回路。 - 前記第1制御トランジスターは、
前記i−1番目ステージの前記キャリー信号が共通に印加される第1制御電極及び入力電極と、
前記第1ノードに連結された出力電極と、
前記基準電圧を受信する第2制御電極と、を含むことを特徴とする請求項7に記載のゲート駆動回路。 - 前記少なくとも1つの制御トランジスターは、前記第1ノードの電位を下降させて前記出力トランジスターをターンオフさせる第2制御トランジスターを更に含み、
前記第2制御トランジスターの前記スイッチング制御信号は、前記i番目ステージの次のステージのゲート信号であることを特徴とする請求項7に記載のゲート駆動回路。 - 前記i番目ステージの次のステージは、i+1番目ステージであり、
前記第2制御トランジスターは、
前記i+1番目ステージのゲート信号が印加される第1制御電極と、
前記第1ノードの電位を下降させるロー電圧を受信する入力電極と、
前記第1ノードに連結された出力電極と、
前記基準電圧を受信する第2制御電極と、を含むことを特徴とする請求項9に記載のゲート駆動回路。 - 前記i番目ステージは、前記第1ノードを前記ロー電圧に安定化させる安定化部を含み、
前記安定化部は、
i+2番目ステージのゲート信号に応答して前記第1ノードに前記ロー電圧を供給する第1安定化トランジスターと、
前記出力トランジスターのターンオフ区間の間に前記第1ノードの電位を前記ロー電圧に維持させる第2安定化トランジスターと、を含むことを特徴とする請求項10に記載のゲート駆動回路。 - 前記第1安定化トランジスターは、
前記i+2番目ステージのゲート信号が印加される第1制御電極と、
前記ロー電圧が印加される入力電極と、
前記第1ノードに連結された出力電極と、
前記基準電圧が印加される第2制御電極と、を含み、
前記第2安定化トランジスターは、
第2ノードに連結された第1制御電極と、
前記ロー電圧が印加される入力電極と、
前記第1ノードに連結された出力電極と、
前記基準電圧が印加される第2制御電極と、を含むことを特徴とする請求項11に記載のゲート駆動回路。 - 複数個のゲートライン、該複数個のゲートラインと絶縁されるように交差する複数個のデータライン、及び対応するゲートラインと対応するデータラインとに各々連結された複数個の画素を含む表示パネルと、
前記複数個のデータラインにデータ信号を提供するデータ駆動回路と、
従属的に連結された複数個のステージを含み、前記複数個のゲートラインにゲート信号を提供するゲート駆動回路と、を備え、
前記複数個のステージの中のi番目ステージは(ここで、iは2以上の整数)、
前記i番目ステージの前のステージの制御信号に応答して電位が上昇する第1ノードに連結された制御電極を含み、クロック信号を受信して前記i番目ステージのゲート信号を出力する出力トランジスターと、
前記第1ノードに連結された出力電極を含む少なくとも1つの制御トランジスターを含み、前記出力トランジスターのオン/オフを制御する制御部と、を有し、
前記少なくとも1つの制御トランジスターは、スイッチング制御信号を受信する第1制御電極、及び該第1制御電極と異なる層上に配置されて所定のレベルを有する基準電圧を受信する第2制御電極を含み、
前記複数個の画素の中の少なくともいずれか1つの画素は、
前記ゲート信号に応答してデータ信号を出力する薄膜トランジスターと、
前記薄膜トランジスターに連結された第1電極、及び該第1電極と液晶層を介して配置された第2電極を含む液晶キャパシターと、を含み、
前記第1電極は、前記データ信号に対応する電圧を受信し、
前記第2電極は、前記第1電極が受信する電圧とレベルが異なる電圧を受信し、
前記基準電圧は、前記第2電極が受信する電圧と同一なレベルを有することを特徴とする表示装置。 - 前記基準電圧は、プラス電圧であることを特徴とする請求項13に記載の表示装置。
- 前記少なくとも1つの制御トランジスターは、
前記第1制御電極上に重畳して絶縁されるように配置された第1活性層と、
前記第1活性層上に重畳するように配置された入力電極と、
前記第1活性層上に重畳し、前記入力電極と離隔されて配置された出力電極と、を更に含み、
前記入力電極及び前記出力電極は、前記第2制御電極の下に絶縁されるように配置されることを特徴とする請求項13に記載の表示装置。 - 前記複数個の画素の中の少なくともいずれか1つの画素は、
前記対応するゲートラインから分岐されたゲート電極、該ゲート電極上に重畳して絶縁されるように配置された第2活性層、該第2活性層上に重畳するように配置されたソース電極、及び前記第2活性層上に重畳して前記ソース電極と離隔されて配置されたドレーン電極を含む前記薄膜トランジスターと、
前記ドレーン電極に電気的に連結された前記第1電極、及び前記第1電極と液晶層を介して配置された前記第2電極によって形成された前記液晶キャパシターと、
前記液晶キャパシターに並列に連結されたストレージキャパシターと、を含み、
前記第2活性層及び前記第1活性層は、同一の層上に配置され、
前記第1電極及び前記第2制御電極は、同一の層上に配置されることを特徴とする請求項15に記載の表示装置。 - 前記第1電極は、画素電圧を受信し、
前記第2電極は、前記画素電圧とレベルが異なる共通電圧を受信することを特徴とする請求項16に記載の表示装置。 - 前記ストレージキャパシターは、前記第1電極、及び前記第1電極と絶縁層を介して配置されたストレージラインを含み、
前記ストレージラインは、前記画素電圧とレベルが異なるストレージ電圧を受信し、
前記基準電圧は、前記ストレージ電圧と同一なレベルを有することを特徴とする請求項17に記載の表示装置。 - 前記i番目ステージの前のステージは、i−1番目ステージであることを特徴とする請求項13に記載の表示装置。
- 前記少なくとも1つの制御トランジスターは、前記第1ノードの電位を上昇させて前記出力トランジスターをターンオンさせる第1制御トランジスターを含み、
前記第1制御トランジスターの前記スイッチング制御信号は、前記i−1番目ステージのキャリー信号であることを特徴とする請求項19に記載の表示装置。 - 前記第1制御トランジスターは、
前記i−1番目ステージの前記キャリー信号が共通に印加される第1制御電極及び入力電極と、
前記第1ノードに連結された出力電極と、
前記基準電圧を受信する第2制御電極と、を含むことを特徴とする請求項20に記載の表示装置。 - 前記少なくとも1つの制御トランジスターは、前記第1ノードの電位を下降させて前記出力トランジスターをターンオフさせる第2制御トランジスターを更に含み、
前記第2制御トランジスターの前記スイッチング制御信号は、前記i番目ステージの次のステージのゲート信号であることを特徴とする請求項21に記載の表示装置。 - 前記i番目ステージの次のステージは、i+1番目ステージであり、
前記第2制御トランジスターは、
前記i+1番目ステージのゲート信号が印加される第1制御電極と、
前記第1ノードの電位を下降させるロー電圧を受信する入力電極と、
前記第1ノードに連結された出力電極と、
前記基準電圧を受信する第2制御電極と、を含むことを特徴とする請求項22に記載の表示装置。 - 前記i番目ステージは、前記第1ノードを前記ロー電圧に安定化させる安定化部を更に含み、
前記安定化部は、
i+2番目ステージのゲート信号に応答して前記第1ノードに前記ロー電圧を供給する第1安定化トランジスターと、
前記出力トランジスターのターンオフ区間の間に前記第1ノードの電位を前記ロー電圧に維持させる第2安定化トランジスターと、を含むことを特徴とする請求項23に記載の表示装置。 - 前記第1安定化トランジスターは、
前記i+2番目ステージのゲート信号が印加される第1制御電極と、
前記ロー電圧が印加される入力電極と、
前記第1ノードに連結された出力電極と、
前記基準電圧が印加される第2制御電極と、を含み、
前記第2安定化トランジスターは、
第2ノードに連結された第1制御電極と、
前記ロー電圧が印加される入力電極と、
前記第1ノードに連結された出力電極と、
前記基準電圧が印加される第2制御電極と、を含むことを特徴とする請求項24に記載の表示装置。 - 前記出力トランジスターは、前記クロック信号が印加される入力電極及び前記i番目ステージのゲート信号を出力する出力電極を含むことを特徴とする請求項13に記載の表示装置。
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