JP4864816B2 - 半導体集積回路装置の製造方法 - Google Patents

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Description

本発明は、半導体集積回路装置(または半導体装置)の製造方法におけるダイ・ピックアップ技術に適用して有効な技術に関する。
日本特開2005−9166号公報(特許文献1)または米国特許公開2005−0200142号公報(特許文献2)には、電子部品のマウンタ等の吸着ノズルに関して、部品が吸着されたか否かを空気流量センサの検出流量変化によって検出することが開示されている。
日本特開2003−133791号公報(特許文献3)、日本特開2004−23027号公報(特許文献4)、または日本特開2007−103777号公報(特許文献5)には、電子部品のマウンタ等で吸着ノズルによって電子部品を吸着搬送する際、部品が正しく吸着されているか否かを空気流量センサの検出流量変化によって検出することが開示されている。
日本特開2004−186352号公報(特許文献6)または米国特許公開2006−0252233号公報(特許文献7)には、ウエハ・ダイシング後の薄膜チップのピックアップに関して、ダイシングテープの下方から超音波振動を印加して、上方から吸着コレットによりチップを粘着シート(ダイシングテープ)から剥離する際に、吸着コレットの吸着流量を計測してチップがダイシングテープから完全に剥離して吸着コレットに吸着されているかを確認することが開示されている。
日本特開2005−117019号公報(特許文献8)または米国特許7115482号公報(特許文献9)には、ウエハ・ダイシング後の薄膜チップのピックアップに関して、ダイシングテープの下方から多段の突き上げ機構でチップ下面を突き上げて、上方から吸着コレットによりチップを粘着シート(ダイシングテープ)から剥離することが開示されている。
特開2005−9166号公報 米国特許公開2005−0200142号公報 特開2003−133791号公報 特開2004−23027号公報 特開2007−103777号公報 特開2004−186352号公報 米国特許公開2006−0252233号公報 特開2005−117019号公報 米国特許7115482号公報
半導体集積回路装置の製造工程のうちの組立工程におけるダイシング後のチップのピックアップ工程では、急速なチップの薄膜化によって、ピックアップ不良の低減が重要な課題となっている。特に、本願発明者が検討したところによると、剥離動作によるチップ周辺部の湾曲がチップの割れ、欠けを惹起する可能性が高いことが明らかになった。本願発明はこれらの問題を解決するためになされたものである。
本発明の目的は、信頼性の高い半導体集積回路装置の製造プロセスを提供することにある。
本発明の前記並びにその他の目的と新規な特徴は本明細書の記述及び添付図面から明らかになるであろう。
本願において開示される発明のうち代表的なものの概要を簡単に説明すれば下記の通りである。
すなわち、本願発明は、ダイシング・テープ(粘着テープ)等からチップを吸引コレットで真空吸着して剥離する場合において、吸引コレットの真空吸着系の流量をモニタすることで、チップが粘着テープから完全に剥離する以前のチップの湾曲状態を監視するものである。
本願において開示される発明のうち代表的なものによって得られる効果を簡単に説明すれば下記のとおりである。
すなわち、吸引コレットの真空吸着系の流量をモニタすることで、チップが粘着テープから完全に剥離する以前のチップの湾曲状態を監視することができるので、割れや欠けの少ないピックアップ・プロセスを提供することができる。
〔実施の形態の概要〕
先ず、本願において開示される発明の代表的な実施の形態について概要を説明する。
1.以下の工程を含む半導体集積回路装置の製造方法:
(a)ほぼ元のウエハの際の2次元的配置のままで、個々のチップ領域に分割された複数のチップを、それらの裏面を粘着テープに固定した状態でチップ処理装置に供給する工程;
(b)前記複数のチップの内の第1のチップの表面を吸着コレットで真空吸着し、且つ、前記第1のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記粘着テープを前記第1のチップの前記裏面から剥離させる工程、
ここで、前記工程(b)は以下の下位工程を含む:
(b1)前記第1のチップが前記粘着テープから完全に剥離する以前の前記第1のチップの湾曲状態を、前記吸着コレットの真空吸着系の流量を計測することによってモニタする工程。
2.前記1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b2)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続または中断させる工程;
(b3)前記剥離動作を中断させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を再開する工程。
3.前記1または2項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b4)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続または減速させる工程;
(b5)前記剥離動作を減速させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を再加速させる工程。
4.前記1から3項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b6)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続させ、または前記第1のチップの前記湾曲状態が許容範囲内になるまで前記剥離動作を後退させる工程。
5.前記1から4項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b7)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続させ、または前記第1のチップの前記湾曲状態が許容範囲内になるまで前記剥離動作を減速させる工程。
6.前記1から5項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b8)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
(b9)前記下位工程(b8)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで降下させる工程。
7.前記1から6項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b10)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
(b11)前記下位工程(b10)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程。
8.前記1から7項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b12)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
(b13)前記下位工程(b12)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させる工程。
9.前記1から8項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b14)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
(b15)前記工程(b14)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
(b16)前記下位工程(b15)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで上昇させる工程。
10.前記1から9項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b17)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
(b18)前記工程(b17)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
(b19)前記下位工程(b18)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程。
11.前記1から10項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b20)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
(b21)前記工程(b20)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
(b22)前記下位工程(b21)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックの降下を前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させる工程。
12.前記1から11項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b23)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記下部基体の主要部を成すスライド板を前記第1のチップとのオーバラップが減少するようにスライドさせる工程;
(b24)前記下位工程(b1)のモニタ情報に基づいて、前記スライド板を前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程。
13.前記1から12項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b25)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続または中断させる工程;
(b26)前記剥離動作を中断させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を再開させるか、または前記第1のチップの前記湾曲状態が前記許容範囲内になるまで前記剥離動作を後退させる工程。
14.前記1から13項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b27)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続または減速させる工程;
(b28)前記剥離動作を減速させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を再加速させるか、または前記第1のチップの前記湾曲状態が許容範囲内になるまで前記剥離動作を後退させる工程。
15.前記1から14項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b29)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
(b30)前記下位工程(b29)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程;
(b31)前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を再開するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで降下させる工程。
16.前記1から15項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b32)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
(b33)前記工程(b32)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
(b34)前記下位工程(b33)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程;
(b35)前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を再開させるか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで上昇させる工程。
17.前記1から16項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b36)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
(b37)前記下位工程(b36)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させる工程;
(b38)前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を再開するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで降下させる工程。
18.前記1から17項のいずれか一つの半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
(b39)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
(b40)前記工程(b39)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
(b41)前記下位工程(b40)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックの降下を前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させる工程;
(b42)前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を再開させるか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで上昇させる工程。
19.前記1から18項のいずれか一つの半導体集積回路装置の製造方法において、前記第1のチップの前記裏面にはあらかじめダイ・ボンディング用接着剤層が形成されている。
20.以下の工程を含む半導体集積回路装置の製造方法:
(a)ほぼ元のウエハの際の2次元的配置のままで、個々のチップ領域に分割された複数のチップを、それらの裏面を粘着テープに固定した状態でチップ処理装置に供給する工程;
(b)前記複数のチップの内の第1のチップの表面を吸着コレットで真空吸着し、且つ、前記第1のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記粘着テープを前記第1のチップの前記裏面から剥離させる工程、
ここで、前記工程(b)は以下の下位工程を含む:
(b1)前記第1のチップが前記粘着テープから完全に剥離する以前の前記第1のチップの湾曲状態を、前記吸着コレットの真空吸着系の流量を計測することによってモニタする工程;
(b2)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作の最適速度(以後のチップに対して適用されるべき速度)を決定する工程、
ここで、前記半導体集積回路装置の製造方法は更に以下の工程を含む:
(c)前記工程(b)の後、前記複数のチップの内の第2のチップの表面を吸着コレットで真空吸着し、且つ、前記第2のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記最適速度で前記剥離動作を実行することによって、前記粘着テープを前記第2のチップの前記裏面から剥離させる工程。
21.前記20項の半導体集積回路装置の製造方法において、前記第1のチップは非製品チップ(製品チップであってもよい)である。
22.前記20項の半導体集積回路装置の製造方法において、前記第2のチップは製品チップである。
23.前記20から22項のいずれか一つの半導体集積回路装置の製造方法において、前記第1のチップおよび前記第2のチップの前記裏面にはあらかじめダイ・ボンディング用接着剤層が形成されている。
24.以下の工程を含む半導体集積回路装置の製造方法:
(a)ほぼ元のウエハの際の2次元的配置のままで、個々のチップ領域に分割された複数のチップを、それらの裏面を粘着テープに固定した状態でチップ処理装置に供給する工程;
(b)前記複数のチップの内の第1のチップの表面を吸着コレットで真空吸着し、且つ、前記第1のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記粘着テープを前記第1のチップの前記裏面から剥離させる工程、
ここで、前記工程(b)は以下の下位工程を含む:
(b1)前記第1のチップが前記粘着テープから完全に剥離する以前の前記第1のチップの湾曲状態を、前記吸着コレットの真空吸着系の流量を計測することによってモニタする工程;
(b2)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
(b3)前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの最適上昇高さを決定する工程、
ここで、前記半導体集積回路装置の製造方法は更に以下の工程を含む:
(c)前記工程(b)の後、前記複数のチップの内の第2のチップの表面を吸着コレットで真空吸着し、且つ、前記第2のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記最適上昇高さだけ、前記突き上げブロックを上昇させる工程。
25.前記24項の半導体集積回路装置の製造方法において、前記第1のチップは非製品チップ(製品チップであってもよい)である。
26.前記24項の半導体集積回路装置の製造方法において、前記第2のチップは製品チップである。
27.前記24から26項のいずれか一つの半導体集積回路装置の製造方法において、前記第1のチップおよび前記第2のチップの前記裏面にはあらかじめダイ・ボンディング用接着剤層が形成されている。
28.以下の工程を含む半導体集積回路装置の製造方法:
(a)ほぼ元のウエハの際の2次元的配置のままで、個々のチップ領域に分割された複数のチップを、それらの裏面を粘着テープに固定した状態でチップ処理装置に供給する工程;
(b)前記複数のチップの内の第1のチップの表面を吸着コレットで真空吸着し、且つ、前記第1のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記粘着テープを前記第1のチップの前記裏面から剥離させる工程、
ここで、前記工程(b)は以下の下位工程を含む:
(b1)前記第1のチップが前記粘着テープから完全に剥離する以前の前記第1のチップの湾曲状態を、前記吸着コレットの真空吸着系の流量を計測することによってモニタする工程;
(b2)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記下部基体の主要部を成すスライド板を前記第1のチップとのオーバラップが減少するようにスライドさせる工程;
(b3)前記下位工程(b1)のモニタ情報に基づいて、前記スライド板の最適スライド速度を決定する工程、
ここで、前記半導体集積回路装置の製造方法は更に以下の工程を含む:
(c)前記工程(b)の後、前記複数のチップの内の第2のチップの表面を吸着コレットで真空吸着し、且つ、前記第2のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記最適スライド速度で前記スライド板を前記第2のチップとのオーバラップが減少するようにスライドさせることによって、前記粘着テープを前記第2のチップの前記裏面から剥離させる工程。
29.前記28項の半導体集積回路装置の製造方法において、前記第1のチップは非製品チップ(製品チップであってもよい)である。
30.前記29項の半導体集積回路装置の製造方法において、前記第2のチップは製品チップである。
31.前記28から30項のいずれか一つの半導体集積回路装置の製造方法において、前記第1のチップおよび前記第2のチップの前記裏面にはあらかじめダイ・ボンディング用接着剤層が形成されている。
〔本願における記載形式・基本的用語・用法の説明〕
1.本願において、実施の態様の記載は、必要に応じて、便宜上複数の部分に分けて記載する場合もあるが、特にそうでない旨明示した場合を除き、これらは相互に独立別個のものではなく、記載の前後を問わず、単一の例の各部分、一方が他方の一部詳細または一部または全部の変形例等である。また、原則として、同様の部分は繰り返しを省略する。また、実施の態様における各構成要素は、特にそうでない旨明示した場合、理論的にその数に限定される場合および文脈から明らかにそうでない場合を除き、必須のものではない。
2.同様に実施の態様等の記載において、材料、組成等について、「AからなるX」等といっても、特にそうでない旨明示した場合および文脈から明らかにそうでない場合を除き、A以外の要素を主要な構成要素のひとつとするものを排除するものではない。たとえば、成分についていえば、「Aを主要な成分として含むX」等の意味である。たとえば、「シリコン部材」等といっても、純粋なシリコンに限定されるものではなく、SiGe合金やその他シリコンを主要な成分とする多元合金、その他の添加物等を含む部材も含むものであることはいうまでもない。
3.同様に、図形、位置、属性等に関して、好適な例示をするが、特にそうでない旨明示した場合および文脈から明らかにそうでない場合を除き、厳密にそれに限定されるものではないことは言うまでもない。
4.さらに、特定の数値、数量に言及したときも、特にそうでない旨明示した場合、理論的にその数に限定される場合および文脈から明らかにそうでない場合を除き、その特定の数値を超える数値であってもよいし、その特定の数値未満の数値でもよい。
5.「ウエハ」というときは、通常は半導体集積回路装置(半導体装置、電子装置も同じ)をその上に形成する単結晶シリコンウエハを指すが、エピタキシャルウエハ、絶縁基板と半導体層等の複合ウエハ等も含むことは言うまでもない。
6.「チップ」または「ダイ」というときは、一般的にはウエハ分割工程(ブレードダイシング、レーザダイシングその他のペレタイズ工程)後の完全分離したものを指すが、本願では便宜上、分離前のチップ領域も同じ用語で示す。たとえば、いわゆるDBG(Dicing before Grinding)プロセスでは、ハーフカット・ダイシング後にグラインディングして最終的にチップに分離して、その状態でチップ裏面を保持用の粘着テープに貼り付けた後、剥離工程に進む。このような場合を含めて、たとえば「ウエハ」は分離されれば厳密にはすでにウエハではなく、チップ等も分離される前はチップ領域であってチップではないが、いつ分離されるかは個々のプロセスに依存するので、分離の前後を問わず、これらを包括して「ウエハ」、「チップ」または「ダイ」という。
7.「配線基板」というときは、一般的には有機配線基板、セラミック配線基板、リードフレーム等の外、他のチップ、ウエハその他の薄膜状集積回路装置を指す。
8.「下部基体」は、一般に「吸着駒」とも言うが、「チップ処理装置」のチップ剥離機構の中心をなし、粘着シートに固定されたウエハ(ほぼ元のウエハの際の2次元的配置のままで粘着シートに固定されたチップ群)を粘着シートを真空吸着することにより位置固定するものである。また、その中央部は、ある装置では「突き上げブロック」であり、他の装置では「スライド板」である。「下部基体」は前記中央部と周辺部からなり、周辺部はピックアップ対象チップの周辺のチップおよび粘着テープを吸着固定する働きがある。中央部と周辺部ともに吸着孔や間隙を通して真空吸引される構造となっており、位置合わせ以外では、ほとんど常に吸引状態である。
9.「吸着コレット」は、従来はメタル(ステンレスなど)、セラミック、ポリマー等の一体もので構成されていたが、本願が主に扱う薄膜ウエハまたは薄膜チップ(主に厚さが150マイクロメータ以下、特に100マイクロメータ以下)用では、チップにクラック等が入らないように、チップに直接触れるエラストマー等のポリマーを主要な構成要素とするラバー・チップとそれを保持する吸着コレット本体またはラバー・チップ・ホールダから構成されるようになっている。ラバー・チップは、一般にフッ素ゴム、二トリル・ラバー、シリコーン・ラバー等の熱硬化性エラストマー、または熱可塑性エラストマー等の弾性ポリマー材料を主要な構成要素としている。なお、具体的説明では、コレットや突き上げブロックの上下の動きを、下部基体周辺部(これが動かないものと仮定して)を基準として進めているが、これは、原理的には相対的な運動と考えられる。
〔実施の形態の詳細〕
実施の形態について更に詳述する。各図中において、同一または同様の部分は同一または類似の記号または参照番号で示し、説明は原則として繰り返さない。
なお、本願発明者らによる関連する技術分野の代表的先行出願としては、日本特許出願第2006−143277号(出願日:2006年5月23日)およびその対応米国出願第11/735741号(出願日:2007年4月12日)がある。
(実施の形態1)
1.全体プロセス・装置説明(主に図1から30)
本実施の形態は、配線基板上にチップを実装する半導体パッケージの製造に適用したものであり、その製造方法を図1〜図29を用いて工程順に説明する。
まず、図1に示すような単結晶シリコンからなるウエハ1Aの主面に周知の製造プロセスに従って集積回路を形成した後、格子状のスクライブラインによって区画された複数のチップ形成領域1A'のそれぞれに形成された集積回路の電気試験を行い、その良否を判定する。本実施の形態で使用するウエハ1Aのチップ形成領域1A'は、縦と横の長さが等しい正方形の平面形状を有している。本実施の形態では、作図上の都合から正方形のチップを例に取り説明するが、より一般的な長方形のチップでもまったく同様に処理できることは言うまでもない。長方形の場合は、図33または図36に示されたブロック、コレット等の平面形状を長方形にしたものがより適合している。
次に、図2に示すように、ウエハ1Aの集積回路形成面(図の下面側)に集積回路保護用のバックグラインドテープ3を貼り付る。そして、この状態でウエハ1Aの裏面(図の上面側)をグラインダで研削し、続いて、この研削によって生じた裏面のダメージ層を、ウエットエッチング、ドライポリッシング、プラズマエッチングなどの方法によって除去することにより、ウエハ1Aの厚さを100μm以下、例えば90μm〜15μm程度まで薄くする。前記ウエットエッチング、ドライポリッシング、プラズマエッチングなどの
処理方法は、ウエハの厚さ方向に進行する処理速度が、グラインダによる研削の速度に比べて遅い反面、ウエハ内部に与えるダメージがグラインダによる研削に比較して小さいだけでなく、グラインダによる研削で発生したウエハ内部のダメージ層を除去することができ、ウエハ1Aおよびチップが割れにくくなるという効果がある。
次に、バックグラインドテープ3を除去した後、図3に示すように、ウエハ1Aの裏面(集積回路形成面の反対側の面)にダイシングテープ4を貼り付け、この状態でダイシングテープ4の周辺部をウエハリング5に固定する。ダイシングテープ4は、ポリオレフィン(PO)、ポリ塩化ビニル(PVC)、ポリエチレンテレフタレート(PET)などからなるテープ基材の表面に感圧粘着剤を塗布して粘着性(tackness)を持たせた感圧型粘着テープやUV硬化型粘着テープを円形に裁断したものである。
次に、図4に示すように、周知のダイシングブレード6を使ってウエハ1Aをダイシングすることにより、前記複数のチップ形成領域1A'のそれぞれを正方形のチップ1に分割する。このとき、分割されたそれぞれのチップ1を円形のダイシングテープ4上に残しておく必要があるので、ダイシングテープ4は、その厚さ方向の半分程度だけ切断する。なお、ダイシングテープ4としてUV硬化型粘着テープを使用した場合は、以下で説明するチップ1の剥離工程に先立ってダイシングテープ4に紫外線を照射し、感圧粘着剤の粘着力を低下させておく。
次に、図5(平面図)および図6(断面図)に示すように、ウエハリング5に固定したダイシングテープ4の上方に押さえ板7を配置すると共に、下方にエキスパンドリング8を配置する。そして、図7に示すように、ウエハリング5の上面に押さえ板7を押し付けることにより、ダイシングテープ4の裏面の周辺部をエキスパンドリング8に押し付ける。このようにすると、ダイシングテープ4は、その中心部から周辺部に向かう強い張力を受けるので、水平方向に弛みなく引き伸ばされる。
次に、この状態でエキスパンドリング8を図8に示すチップ剥離装置100のステージ101上に位置決めし、水平に保持する。このステージ101の中央には、図示しない駆動機構によって水平方向および上下方向に移動する吸着駒102が配置されている。ダイシングテープ4は、その裏面が吸着駒102の上面と対向するように保持される。
図9は、吸着駒102の断面図、図10は、吸着駒102の上面近傍の拡大断面図、図11は、吸着駒102の上面近傍の拡大斜視図である。
吸着駒102の上面の周辺部には、複数の吸引口103と、同心円状に形成された複数の溝104とが設けられている場合と複数の吸引孔のみがもうけられている場合がある。吸引口103および溝104のそれぞれの内部は、吸着駒102を上昇させてその上面をダイシングテープ4の裏面に接触させる際、図示しない吸引機構によって減圧される。このとき、ダイシングテープ4の裏面が下方に吸引され、吸着駒102の上面と密着する。
なお、ダイシングテープ4を下方に吸引する際、上記溝104の幅や深さが大きいと、剥離の対象となるチップ1に隣接するチップ1の下方のダイシングテープ4が溝104に吸引された際、隣接するチップ1とその下方のダイシングテープ4との界面が溝104の上部領域で剥離することがある。特に、比較的粘着力が弱い感圧粘着剤を使用したダイシングテープ4では、このような剥離が生じ易い。このような現象が発生すると、剥離の対象となるチップ1をダイシングテープ4から剥がしている作業中に、隣接するチップ1がダイシングテープ4から脱落してしまうことがあるので、好ましくない。そこで、このような現象が発生するのを防ぐには、上記溝104の幅や深さをできるだけ小さくし、隣接するチップ1の下方のダイシングテープ4と吸着駒102の上面との間にできるだけ隙間が生じないようにすることが有効であり、吸引孔を多くし、溝を設けないようにすることも有効である。
吸着駒102の中心部には、ダイシングテープ4を上方に突き上げる3個のブロック110a〜110cが組み込まれている。3個のブロック110a〜110cは、外形が最も大きい第1のブロック110aの内側に、それよりも外形の小さい第2のブロック110bが配置され、さらにその内側に最も外形の小さい第3のブロック110cが配置されている。後述するように、3個のブロック110a〜110cは、外側のブロック110aと中間のブロック110bとの間に介在する第1の圧縮コイルばね111a、中間のブロック110bと内側のブロック110cとの間に介在し、上記第1の圧縮コイルばね111aよりもばね定数の大きい第2の圧縮コイルばね111b、および内側ブロック110cに連結され、図示しない駆動機構によって上下動するプッシャ112と連動して上下動するようになっている。
上記3個のブロック110a〜110cのうち、最も外形の大きい外側のブロック110aは、剥離の対象となるチップ1よりも一回り(例えば約0.5mm〜3mm程度)外形の小さいものを使用するとよい。例えば、チップ1が正方形である場合には、それよりも一回り小さい正方形とすることが望ましい。また、後述する他の実施の形態で説明するように、チップ1が長方形である場合には、それよりも一回り小さい長方形とすることが望ましい。これにより、ブロック110aの上面の外周となる角部がチップ1の外縁よりもわずかに内側に位置するようになるので、チップ1とダイシングテープ4とが剥離する際の起点となる箇所(チップ1の最外周部)に両者を剥離させる力を集中させることができる。
また、ブロック110aの上面は、ダイシングテープ4との接触面積を確保するために、平坦な面または大きな局率半径を有する面にすることが望ましい。ブロック110aの上面とダイシングテープ4との接触面積が小さい場合は、ブロック110aの上面によって下から支えられるチップ1の周辺部に大きな曲げ応力が集中するので、チップ1の周辺部が割れる恐れがある。
上記ブロック110aの内側に配置された中間のブロック110bは、ブロック110aよりも1mm〜3mm程度小さい外形を有している。また、このブロック110bよりもさらに内側に配置された最も外形の小さいブロック110cは、中間のブロック110bよりもさらに1mm〜3mm程度小さい外形を有している。本実施の形態では、加工の容易さなどを考慮して、中間のブロック110bおよび内側のブロック110cのそれぞれの形状を円柱状にしたが、外側のブロック110aと同じく四角柱状あるいはそれに近い形状にしてもよい。3個のブロック110a〜110cのそれぞれの上面の高さは、初期状態(ブロック110a〜110cの非動作時)においては互いに等しく、また吸着駒102の上面周辺部の高さとも等しくなっている。
図10に拡大して示すように、吸着駒102の周辺部と外側のブロック110aとの間、および3個のブロック110a〜110cの間には、隙間(S)が設けられている。これらの隙間(S)の内部は、図示しない吸引機構によって減圧されるようになっており、吸着駒102の上面にダイシングテープ4の裏面が接触すると、ダイシングテープ4が下方に吸引され、ブロック110a〜110cの上面と密着するようになっている。
上記のような吸着駒102を備えたチップ剥離装置100を使ってチップ1をダイシングテープ4から剥離するには、まず、図12に示すように、剥離の対象となる1個のチップ1(同図の中央部に位置するチップ1)の真下に吸着駒102の中心部(ブロック110a〜110c)を移動させると共に、このチップ1の上方に吸着コレット105を移動させる。図示しない移動機構に支持された吸着コレット105の底面の中央部には、内部が減圧される吸着口106が設けられており、剥離の対象となる1個のチップ1のみを選
択的に吸着、保持できるようになっている。図12から図31においては、簡潔性を確保するためにコレット105の詳細構造を省略して示している。この詳細構造は、図32以降で詳しく説明する。
次に、図13に示すように、吸着駒102を上昇させてその上面をダイシングテープ4の裏面に接触させると共に、前述した吸引口103、溝104および隙間(S)の内部を減圧する。これにより、剥離の対象となるチップ1と接触しているダイシングテープ4がブロック110a〜110cの上面に密着する。また、このチップ1に隣接する他のチップ1と接触しているダイシングテープ4が吸着駒102の上面周辺部に密着する。なお、このとき、吸着駒102を僅かに(例えば400μm程度)突き上げると、前述した押さ
え板7とエキスパンドリング8によって水平方向の張力が加えられているダイシングテープ4に対して、さらに張力を加えることができるので、吸着駒102とダイシングテープ4をより確実に密着させることができる。
また、吸着駒102の上昇とほぼ同時に吸着コレット105を下降させ、吸着コレット105の底面を剥離の対象となるチップ1の上面に接触させてチップ1を吸着すると共に、チップ1を下方に軽く押さえ付ける。このように、吸着駒102を使ってダイシングテープ4を下方に吸引する際、吸着コレット105を使ってチップ1を上方に吸引すると、ブロック110a〜110cの突き上げによるダイシングテープ4とチップ1の剥離を促進させることができる。
次に、図14に示すように、3個のブロック110a〜110cを同時に上方に突き上げてダイシングテープ4の裏面に上向きの荷重を加え、チップ1とダイシングテープ4とを押し上げる。また、この際、チップ1の裏面を、ダイシングテープ4を介してブロック110a〜110cの上面(接触面)で支え、チップ1にかかる曲げ応力を軽減するとともに、ブロック110aの上面の外周(角部)を、チップ1の外周よりも内側に配置することにより、チップ1とダイシングテープ4の剥離起点となっている界面に剥離する応力を集中し、チップ1の周縁部をダイシングテープ4から効率的に剥離する。このとき、剥離の対象となるチップ1に隣接する他のチップ1の下方のダイシングテープ4を下方に吸引し、吸着駒102の上面周辺部に密着させておくことにより、チップ1の周縁部におけるダイシングテープ4の剥離を促進させることができる。図15は、このときの吸着駒102の上面近傍を示す拡大斜視図である(チップ1とダイシングテープ4の図示は省略)。
上記ブロック110a〜110cの突き上げ量(ストローク)は、例えば0.2mmから0.4mm程度であるが、チップ1のサイズに応じて増減することが望ましい。すなわち、チップ1のサイズが大きい場合は、チップ1とダイシングテープ4との接触面積が大きく、従って両者の粘着力も大きいので、突き上げ量を増やす必要がある。他方、チップ1のサイズが小さい場合は、チップ1とダイシングテープ4との接触面積が小さく、従って両者の粘着力も小さいので、突き上げ量を少なくしても容易に剥離する。なお、ダイシングテープ4に塗布されている感圧粘着剤は、製造元や品種によって粘着力に差がある。従って、チップ1のサイズが同じ場合でも、粘着力の大きい感圧粘着剤を使用している場合には、突き上げ量を増やす必要がある。
また、ブロック110a〜110cを上方に突き上げてチップ1の裏面に荷重を加える際は、チップ1の最外周部において、チップの外周と直交する方向への曲げ応力を、チップの外周と平行な方向への曲げ応力より小さくすることが望ましい。チップ1の最外周部は、前述したダイシングブレード6を使ってウエハ1Aをダイシングした際に生じた微細なクラックが残留している。そのため、ブロック110a〜110cを上方に突き上げた際にチップ1の最外周部に、チップ1の外周と直交する方向に沿った強い曲げ応力が加わると、クラックが成長してチップ1が割れる恐れがある。本実施の形態では、チップ1のサイズより一回り小さい上面を有するブロック110aを使って、チップ1の最外周部より僅かに内側に均等な荷重を加えるので、上記のような問題を回避しつつ、チップ1の周縁部全体をダイシングテープ4から均等に剥離することができる。
3個のブロック110a〜110cを同時に上方に突き上げるには、図16に示すように、プッシャ112を上方に押し上げることによって、プッシャ112に連結された内側のブロック110cを押し上げる。これにより、内側ブロック110cと中間のブロック110bとの間に介在する圧縮コイルばね111bのばね力によって中間のブロック110bが押し上げられ、さらに外側のブロック110aと中間のブロック110bとの間に介在する圧縮コイルばね111aのばね力によって外側のブロック110aが押し上げら
れるので、3個のブロック110a〜110cが同時に押し上げられる。そして、外側のブロック110aの一部(図の矢印で示す面)が吸着駒102の周辺部と接触することによって、ブロック110a〜110cの上昇が停止する。このとき、剥離の対象となるチップ1の大部分の領域は、3個のブロック110a〜110cの上面によって支えられており、ブロック110aの上面の外周(角部)よりも外側の領域において、チップ1とダイシングテープ4との界面での剥離が効率的に進行する。
3個のブロック110a〜110cを同時に上方に突き上げる際は、ばね力が弱い圧縮コイルばね111aが収縮しないような弱い力でプッシャ112がブロック110cを押し上げる。このようにすると、外側のブロック110aの一部が吸着駒102の周辺部と接触するまでは、中間のブロック110bと内側のブロック110cがさらに上方に突き上ることはない。
また、圧縮コイルばね111aは、少なくともダイシングテープ4の張力に抗してブロック110aを持ち上げることができる程度のばね力を備えている必要がある。圧縮コイルばね111aのばね力がダイシングテープ4の張力よりも小さい場合は、プッシャ112を押し上げても外側のブロック110aが持ち上がらないので、外側のブロック110aの上面によってチップ1を支えることができなくなる。この場合は、チップ1とダイシングテープ4との剥離起点に十分な応力を集中させることができないので、剥離速度の低下を招いたり、チップ1に過大な曲げ応力が加わってチップ1が割れてしまうといった問題を引き起こす可能性がある。
次に、図17に示すように、中間のブロック110bと内側のブロック110cとを同時に上方に突き上げてダイシングテープ4を押し上げる。これにより、チップ1を支えるブロック110bの上面の外周(角部)の位置が、ブロック110aによって支えられていた状態に比較して、より内側に移るため、チップ1とダイシングテープ4との剥離がブロック110bの上面の外周より外側の領域からチップ1の中心方向へと進行する。図18は、このときの吸着駒102の上面近傍を示す拡大斜視図である(チップ1とダイシングテープ4の図示は省略)。
2個のブロック110b、110cを同時に上方に突き上げるには、図19に示すように、プッシャ112を押し上げることによって、プッシャ112に連結されたブロック110cをさらに押し上げる。このとき、圧縮コイルばね111bのばね力によって中間のブロック110bが押し上げられるので、2個のブロック110b、110cが同時に押し上げられる。そして、中間のブロック110bの一部(図の矢印で示す面)が外側のブロック110aと接触した時点でブロック110b、110cの上昇が停止する。また、プッシャ112がブロック110cを押し上げる力は、ばね力が弱い圧縮コイルばね111aは収縮するが、ばね力が強い圧縮コイルばね111bは収縮しない大きさとする。これにより、中間のブロック110bの一部が外側のブロック110aと接触するまでは、内側のブロック110cがさらに上方に突き上ることはない。
2個のブロック110b、110cを上方に突き上げる際には、チップ1とダイシングテープ4との剥離を促進させるために、ブロック110a〜110cの隙間(S)の内部を減圧することによって、チップ1と接触しているダイシングテープ4を下方に吸引する。また、溝104の内部を減圧し、吸着駒102の上面周辺部に接するダイシングテープ4を吸着駒102の上面に密着させる(図17)。
次に、図20に示すように、内側のブロック110cをさらに上方に突き上げてダイシングテープ4の裏面を押し上げ、ブロック110cの上面でチップ1の裏面を支える。図21は、このときの吸着駒102の上面近傍を示す拡大斜視図である(チップ1とダイシングテープ4の図示は省略)。内側のブロック110cを上方に突き上げるには、図22に示すように、圧縮コイルばね111bが収縮するような強い力でブロック110cを押し上げる。これにより、ダイシングテープ4と接触しているブロック110cの上面の外周(角部)よりも外側の領域において、チップ1とダイシングテープ4との剥離が進行する。
続いて、図23に示すように、ブロック110cを下方に引き下げると共に、吸着コレット105を上方に引き上げることにより、チップ1をダイシングテープ4から剥がす作業が完了する。
上記ブロック110cの上面は、ブロック110cを上方に突き上げた際、吸着コレット105の吸引力だけでチップ1がダイシングテープ4から剥がれる程度に面積を小さくしておく必要がある。ブロック110cの上面の面積が大きいと、チップ1とダイシングテープ4との接触面積が大きくなり、両者の粘着力も大きくなるので、吸着コレット105がチップ1を吸引する力だけではチップ1をダイシングテープ4から剥がせない。
一方、ブロック110cの上面の面積を小さくした場合は、ブロック110cがダイシングテープ4の裏面を押し上げる際、チップ1の狭い領域(中央部分)に強い荷重が集中的に加わるので、極端な場合にはチップ1が割れる恐れがある。そこで、ブロック110cを突き上げる際は、突き上げ速度を遅くしたり、ブロック110cの上面がダイシングテープ4と接触している時間を短くしたり、ブロック110cの突き上げ量(ストローク)を少なく(例えば0.2mm〜0.4mm程度)したりすることによって、チップ1の狭い領域に強い荷重が加わらないようにすることが望ましい。
また、吸着コレット105の吸引力を大きくする一つの方法として、吸着コレット105の引き上げ速度を遅くすることが有効である。チップ1の一部がダイシングテープ4に密着した状態で吸着コレット105を急速に引き上げると、吸着コレット105の底面とチップ1の上面とに隙間が生じ、吸着コレット105の内部の真空度が低下するので、チップ1を吸引する力が低下してしまう。他方、吸着コレット105の引き上げ速度を遅くした場合は、チップ1をダイシングテープ4から剥がすのに要する時間が長くなる。そこで吸着コレット105の引き上げ速度を可変にし、引き上げ開始時には引き上げ速度を遅くして吸引力を充分確保し、チップ1とダイシングテープ4との接触面積がある程度まで小さくなったら引き上げ速度を速くして剥離時間の遅延を防ぐようにするとよい。また、吸着コレット105の底面の面積をブロック110cの上面の面積より大きくすることも、吸着コレット105の吸引力を大きくする有効な方法である。
このように、吸着コレット105の吸引力を大きくすることにより、チップ1とダイシングテープ4との接触面積が比較的大きい場合であっても、吸着コレット105の吸引力だけでチップ1をダイシングテープ4から剥がすことが可能となるので、剥離時間を短縮することができると共に、ブロック110cの上面の面積を小さくした場合に生じる上記の問題を回避することができる。
また、チップ1が吸着コレット105によって下方に押さえ付けられた状態でブロック110cを下方に引き下げると、吸着コレット105も下方に移動するために、チップ1がブロック110cに当たって割れる恐れがある。従って、ブロック110cを下方に引き下げる際は、その直前に吸着コレット105を引き上げるか、少なくとも吸着コレット105が下方に移動しないように、その位置を固定しておくことが望ましい。
このようにして、ダイシングテープ4から剥離されたチップ1は、吸着コレット105に吸着、保持されて次工程(ペレット付け工程)に搬送される(一般に同一の装置のピックアップステージからダイボンディングステージまたはダイボンディング部132へ搬送される)。そして、チップ1を次工程に搬送した吸着コレット105がチップ剥離装置100に戻ってくると、前記図12〜図23に示した手順に従って、次のチップ1がダイシングテープ4から剥がされる。以後、同様の手順に従ってチップ1が1個ずつダイシングテープ4から剥がされる。
次にペレット付け工程を説明する。図24に示すように、ペレット付け工程に搬送されたチップ1は、接着部材層または接着剤10(通常、ウエハをチップに分割前、例えばダイシングテープを張る時、またはその前にウエハの裏面にDAFすなわち「ダイ・アタッチ・フィルム」と呼ばれるダイ・ボンディング用両面粘着シートまたはダイ・ボンディング用接着剤層を貼り付けておくか、ダイボンディング直前に液状の接着剤を配線基板に塗布または滴下する。DAFは一般にウエハの裏面とダイシングテープの間に挟まれる形で張られ、ダイシング等の際にチップとともに分割される。チップのピックアップの際はチップとともにピックアップされる。ダイ・アタッチ・フィルムをあらかじめ貼り付けておくとダイ・ボンディング時に改めて接着剤層を形成する必要がないので量産上有利である。)などを介して配線基板11上に実装される。すなわち、ダイシングテープ4から剥がされたチップ1は吸着コレット105に真空吸着された状態で、摂氏100度から150度程度に加熱されたダイボンディングステージ132上の配線基板11へ向けて降下する。
図25に示すように、チップ1が配線基板11に着地したのを確認すると、コレット105は所定の圧力でチップ1を押し付けたまま、真空吸引をオフし、そのままの状態で所定の時間(たとえば1秒から数秒)その位置で留まる。この間に熱圧着が進行する。
その後、図26に示すように、真空吸引をオフしたまま、コレット105はチップ1から退避する。
熱圧着が完了したチップ1は、図27に示すように、Auワイヤ12を介して配線基板11の電極13と電気的に接続される。
次に、図28に示すように、配線基板11上に実装されたチップ1の上に接着剤10などを介して第2のチップ14が積層され、Auワイヤ15を介して配線基板11の電極16と電気的に接続される。第2のチップ14は、チップ1と異なる集積回路が形成されたシリコンチップであり、前述した方法でダイシングテープ4から剥がされた後、ペレット付け工程に搬送されてチップ1の上に積層される。
その後、配線基板11をモールド工程に搬送し、図29に示すように、チップ1、14をモールド樹脂17で封止することによって、積層パッケージ18が完成する。
なお、本実施の形態では、剥離の対象となるチップ1が外側のブロック110aよりも一回り大きい場合について説明したが、例えば図30(a)に示すように、剥離の対象となるチップ1が外側のブロック110aより小さく、中間のブロック110bより大きい場合には、図30(b)に示すように、まず中間のブロック110bを突き上げてチップ1の周縁部をダイシングテープ4から剥がし、次に、図30(c)に示すように、内側のブロック110cを突き上げてチップ1の中央部をダイシングテープ4から剥がすこともできる。この場合は、例えば吸着駒102と外側のブロック110aとの間にスペーサを挟んでおき、プッシャ112を押し上げても外側のブロック110aが持ち上がらないようにしておく。
なお、本実施の形態では、3個のブロック(110a〜110c)を使ってチップを剥離する方法を説明したが、ブロックの数は3個に限定されるものではなく、剥離の対象となるチップ1のサイズが大きい場合には、4個以上のブロックを使ってもよい。また、剥離の対象となるチップ1のサイズが非常に小さい場合には、2個のブロックを使ってもよい。
2.ピックアップ部周辺詳細説明(主に図31から38)
図31から38を用いて、剥離動作制御、コレット105の詳細構造、およびそれらと下部基体102(吸着駒)との関係を説明する。
図31はピックアップ部およびその制御系を模式的に示した概念図(図31a)、タイムチャート(図31b)、および断面図(図31b)である。ピックアップ動作はダイシングテープ4上の目的とするチップ1が吸着駒102とコレット105に位置決めされるところから開始する。位置決めが完了すると吸着駒102の吸引孔103や間隙Sを介して真空引きすることによって、ダイシングテープ4が吸着駒102の上面に吸着される。その状態でピックアップ部制御系144の指令により真空吸引系107のバルブ143が開き工場真空供給源から真空供給パイプ141を介して真空が供給され、コレット105がチップ1のデバイス面に向けて真空引きしながら降下し、着地する。ここで、吸着駒102の主要部である突き上げブロック110が上昇すると、チップ1はコレット105と突き上げブロック110に挟まれたまま上昇するが、ダイシングテープ4の周辺部は吸着駒周辺部102aに真空吸着されたままなので、チップ1の周辺で張力が生じ、その結果、チップ周辺でダイシングテープ4が剥離されることになる。しかし、一方この時、チップ周辺は下側に応力を受け、湾曲することになる。そうするとコレット下面との間に隙間ができ、空気がコレット105の真空吸引系107に流入することになる。その結果、真空吸引系107に設けられたガス流量センサ21の吸引量出力が増加する。ここで、たとえば、ピックアップ部制御系144の指令により、突き上げブロック110の上昇を停止し待機状態を維持すると、ダイシングテープ4の剥離が進行して、チップ1の湾曲状態が緩和して許容範囲に戻る場合が多い。図31bに、このような過程でのガス流量センサ21の吸引量出力(デジタル出力信号およびアナログ出力信号)の推移を示す。コレット降下時には開放状態に対応して大きな吸引量を示す。t1で着地すると急速に流量が減少してt2でほぼ“0”になる。突き上げブロックが上昇開始してもしばらくは張力が小さいのでリークは発生しないが、t3までくるとチップの湾曲によるリークが始まる。ブロック110の上昇を停止し待機状態を維持するリークは解消して、t4で流量は再びほぼ“0”に戻る。なお、ガス流量センサ21はガス流量またはそれに対応した物理量が計測できるものであれば、何でもよい。言うまでもないことであるが、ラバーチップの形状・寸法は対象チップの形状・寸法とほぼ同一とする(チップが長方形なら長方形)のがチップ周辺でのクラック等を防止する観点から好適と考えられる(大きめにしたり、若干小さめにすることを排除するものではない)。これについては、突き上げブロックも同じで、本実施形態では周辺剥離の促進のためチップよりも若干小さめの例を示したが、それに限定されないのは言うまでもないく、チップと形状・寸法をほぼ同一にしてもよいし、若干大きめにしてもよい。
図32から図38に吸着コレット105の詳細構造、特にその下端部すなわちラバーチップ125とそのバリエーションおよびそれらと下部基体102(吸着駒)の関係を説明する。図32aは図1から30の説明に対応する突き上げブロック110の上面図であって、突き上げブロック110とラバーチップ125との位置関係を示す。ラバーチップ125の形状はピックアップするチップとほぼ同一である。図32bはコレット本体105(またはラバーチップ・ホールダ)の下面図である。中央に真空吸引孔122があり、各軸方向と対角線方向に真空吸引溝121が設けられている。このラバーチップ125には真空吸引溝121と突き上げブロック110aから110cに対応して真空吸引孔106aから106iが設けられている。
図33はラバーチップ125のバリエーションで内側の二つの突き上げブロック110b,110cがチップ1とほぼ同一の上面形状をしている。このようにすることで、チップのコーナ部での応力の集中を緩和することができる。
図34はコレット105が着地している状態の図32および図33のA−A断面の略断面図であり、図35は図32および図33のB−B断面の略断面図である。このときダイシングテープ4の下側は下部基体周辺部102aに設けられた吸引孔103および下部基体主要部110間等の間隙Sを通して吸着されている。また、このときダイシングテープ4の上側は真空吸引孔106を介して、真空吸引されている。
図36は、ラバーチップ125の更に別のバリエーションで、より細かくリークを検出可能にされている。すなわち、突き上げブロック110の各サブブロックと吸着駒102aの最内側部に対応してラバーチップ125内に多数の真空吸引孔106aから106wが配置されている。
図37はコレット105が着地している状態の図36のA−A断面の略断面図であり、図38は図36のB−B断面の略断面図である。
3.各剥離プロセスの詳細(主に図39から47)
以下の剥離プロセスは、セクション1で説明した全体プロセスに適宜選択して単独でまたは複数組み合わせて適用することができる。
3−1.突き上げブロック待機・後退プロセス(「剥離プロセス1」、図39から40)
図39は突き上げブロック110の各サブブロック110aから110cを順次突き上げてダイシングテープ4を剥離する際に、リーク検出を利用する方法について具体的処理ステップを示すプロセスフロー図である。図40はその要部断面フロー図である。これらに基づいて、具体的ステップの進行を説明する。以下の各例では、明確に説明できるように、各剥離素過程ごとに最初はリークして2度目はリークしない例をあげて例示している。
(1)ダイシングテープ4を下部基体102上面に真空吸着する(テープ吸着ステップ31)。
(2)コレット105が真空吸引しながらチップ1の上面(限定はされないが一般にデバイス面)に着地する(コレット着地ステップ32)。着地した状態を図40aに示す。
(3)突き上げブロック110が一括上昇する(1段目上昇ステップ33)。チップ1およびコレット105もそれに連れて押し上げられる。このとき下部基体周辺部102aは動かないのでチップ1の外周のダイシングテープ4を剥離する張力が働く。また、このステップで、リークのモニタが開始されている。
(4)リークありを検知する(リーク検知ステップ34;図40b参照)。なお、リークなしの場合は即ステップ(9)に進む。リーク133を検出したときの状態を図40bに示す。
(5)所定の時間だけ、またはリークがなくなるまで(3)の上昇動作を減速(停止を含む)する(図40c参照)。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(7)へ進む。ただ、このステップは(4)から即次のステップ(6)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。なお、以下の例でも同じであるが、一般に粘着テープからの剥離は、レオロジー的な現象であり、高速では剥離困難でも、弱めの張力をかけながら時間を置くと簡単に剥離する場合が多い。従って、停止待機や減速待機は有効な場合が多い。
(6)ステップ(3)の開始前に戻る。または、リークモニタでリークがなくなるまで(3)の処理を後退させる。すなわち、突き上げブロック110を一括降下させる。すなわち、「後退ステップ」である。これは以下の例でも同じであるが、チップが湾曲することで、張力が緩和され、その結果、時間をかけても剥離が一向に進行しない場合に有効である。このようにもとの状態に戻ると粘着テープは再びチップの裏面に粘着することになるが、一般に再粘着時の粘着力は初期粘着の際の粘着力と比較して弱いと考えられる。また、UV硬化型テープでUV照射されたものは、特に再粘着時の粘着力は大幅に減少している。
(7)突き上げブロック110が一括再上昇する(1段目上昇)。
(8)リークなしを検知する。リークがなくなった状態を図40cに示す。なお、所定の回数繰り返しても「リークなし」とならないときは、設定により、そのチップをスキップするか、リークが出ないように初期上昇量を下げて再実行するか、アラームを表示して(またはアラーム信号をホストに送信)停止するいずれかまたはそのうちの複数を選択する。
(9)突き上げブロック110bおよび110cが一括上昇する(2段目上昇ステップ35)。このとき、突き上げブロック110aや下部基体周辺部102aは動かない。
(10)リークあり(リーク検知ステップ36)。なお、リークなしの場合は即ステップ(15)に進む。
(11)所定の時間だけ、またはリークがなくなるまで(9)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(13)へ進む。ただ、このステップは(10)から即次のステップ(12)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(12)ステップ(9)の開始前に戻る。または、リークモニタでリークがなくなるまで(9)の処理を後退させる。すなわち、突き上げブロック110bおよび110cを一括降下させる。
(13)2段目を再上昇させる(2段目再上昇)。
(14)リークなし。なお、所定の回数繰り返しても「リークなし」とならないときは、設定により、そのチップをスキップするか、リークが出ないように初期上昇量を下げて再実行するか、アラームを表示して(またはアラーム信号をホストに送信)停止するいずれかまたはそのうちの複数を選択する。
(15)最終段すなわち突き上げブロック110cを単独上昇させる(最終段上昇ステップ37)。当然、チップ1とコレット105はそれに伴って上昇する。
(16)リークあり(リーク検知ステップ38)。なお、リークなしの場合は即ステップ(21)に進む。
(17)所定の時間だけ、またはリークがなくなるまで(15)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(19)へ進む。ただ、このステップは(16)から即次のステップ(18)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(18)ステップ(15)の開始前に戻る。または、リークモニタでリークがなくなるまで(15)の処理を後退させる。すなわち、突き上げブロック110cを単独降下させる。当然、チップ1とコレット105はそれに伴って降下する。
(19)最終段を再上昇させる(最終段再上昇)。
(20)リークなし。なお、所定の回数繰り返しても「リークなし」とならないときは、設定により、そのチップをスキップするか、リークが出ないように初期上昇量を下げて再実行するか、アラームを表示して(またはアラーム信号をホストに送信)停止するいずれかまたはそのうちの複数を選択する。
(21)コレットが上昇して完全剥離する(完全剥離ステップ39)。
なお、ステップ(1)、(2)以降ステップ(21)までは、コレット側、および下部基体側の吸着用真空は引いたままである。すなわち、ONのままである。
この剥離プロセスのメリットは、どのような形状のチップでもその形状に対応した突き上げが可能出るところにある。
3−2.コレット待機・後退プロセス(「剥離プロセス2」、図41から42)
図41は主にコレット105の上昇・下降を繰り返すことによってダイシングテープ4を剥離する際に、リーク検出を利用する方法について具体的処理ステップを示すプロセスフロー図である。図42はその要部断面フロー図である。これらに基づいて、具体的ステップの進行を説明する。
(1)ダイシングテープ4を下部基体102上面に真空吸着する(テープ吸着ステップ41)。
(2)コレット105が真空吸引しながらチップ1の上面(限定はされないが一般にデバイス面)に着地する(コレット着地ステップ42)。着地した状態を図42aに示す。
(3)突き上げブロック110が一括上昇する(1段目上昇ステップ43;図42b参照)。チップ1およびコレット105もそれに連れて押し上げられる。このとき下部基体周辺部102aは動かないのでチップ1の外周のダイシングテープ4を剥離する張力が働く。また、このステップで、リークのモニタが開始されている。
(4)リークありを検知する(リーク検知ステップ44)。なお、リークなしの場合は即ステップ(9)に進む。
(5)所定の時間だけ、またはリークがなくなるまで(3)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(7)へ進む。ただ、このステップは(4)から即次のステップ(6)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(6)ステップ(3)の開始前に戻る。または、リークモニタでリークがなくなるまで(3)の処理を後退させる。すなわち、突き上げブロック110を一括降下させる。すなわち、「後退ステップ」である。
(7)突き上げブロック110が一括再上昇する(1段目再上昇)。
(8)リークなしを検知する。なお、所定の回数繰り返しても「リークなし」とならないときは、設定により、そのチップをスキップするか、リークが出ないように初期上昇量を下げて再実行するか、アラームを表示して(またはアラーム信号をホストに送信)停止するいずれかまたはそのうちの複数を選択する。
(9)チップ1を真空吸着した状態でコレット105を上昇させる(コレット単独上昇ステップ45;図42cおよびd参照)。
(10)リークありを検知する(リーク検知ステップ46)。なお、リークなしの場合はそのまま完全剥離する。
(11)所定の時間だけ、またはリークがなくなるまで(9)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(13)へ進む。ただ、このステップは(10)から即次のステップ(12)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(12)ステップ(9)開始前の状態に戻る(コレット降下ステップ47;図42e参照)。または、リークモニタでリークがなくなるまで(9)の処理を後退させる。すなわち、コレット105を降下させる。すなわち、「後退ステップ」である。
(13)突き上げブロック110bおよび110cが一括上昇する(2段目上昇ステップ48)。このとき、突き上げブロック110aや下部基体周辺部102aは動かない。
(14)リークあり(リーク検知ステップ49)。なお、リークなしの場合は即ステップ(19)に進む。
(15)所定の時間だけ、またはリークがなくなるまで(13)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(17)へ進む。ただ、このステップは(14)から即次のステップ(16)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(16)ステップ(13)の開始前に戻る。または、リークモニタでリークがなくなるまで(13)の処理を後退させる。すなわち、突き上げブロック110bおよび110cを一括降下させる。
(17)2段目を再上昇させる(2段目再上昇)。
(18)リークなし。なお、所定の回数繰り返しても「リークなし」とならないときは、設定により、そのチップをスキップするか、リークが出ないように初期上昇量を下げて再実行するか、アラームを表示して(またはアラーム信号をホストに送信)停止するいずれかまたはそのうちの複数を選択する。
(19)チップ1を真空吸着した状態でコレット105を上昇させる(コレット単独上昇ステップ50)。
(20)リークありを検知する(リーク検出ステップ51)。なお、リークなしの場合はそのまま完全剥離する。
(21)所定の時間だけ、またはリークがなくなるまで(19)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(23)へ進む。ただ、このステップは(20)から即次のステップ(22)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(22)ステップ(19)開始前の状態に戻る(コレット降下ステップ52)。または、リークモニタでリークがなくなるまで(19)の処理を後退させる。すなわち、コレット105を降下させる。すなわち、「後退ステップ」である。
(23)最終段すなわち突き上げブロック110cを単独上昇させる(最終段上昇ステップ53)。当然、チップ1とコレット105はそれに伴って上昇する。
(24)リークあり(リーク検知ステップ54)。なお、リークなしの場合は即ステップ(29)に進む。
(25)所定の時間だけ、またはリークがなくなるまで(23)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(27)へ進む。ただ、このステップは(24)から即次のステップ(26)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(26)ステップ(23)の開始前に戻る。または、リークモニタでリークがなくなるまで(23)の処理を後退させる。すなわち、突き上げブロック110cを単独降下させる。当然、チップ1とコレット105はそれに伴って降下する。
(27)最終段を再上昇させる(最終段再上昇)。
(28)リークなし。なお、所定の回数繰り返しても「リークなし」とならないときは、設定により、そのチップをスキップするか、リークが出ないように初期上昇量を下げて再実行するか、アラームを表示して(またはアラーム信号をホストに送信)停止するいずれかまたはそのうちの複数を選択する。
(29)コレットが上昇して完全剥離する(完全剥離ステップ55)。
なお、ステップ(1)、(2)以降ステップ(29)までは、コレット側、および下部基体側の吸着用真空は引いたままである。すなわち、ONのままである。
この剥離プロセスのメリットは容易に剥離できる場合には、主にコレットの動きのみで比較的簡単に剥離が実行できるところにある。
3−3.突き上げブロックのみ降下剥離プロセス(「剥離プロセス3」、図43から44)
図43は、突き上げブロック110が一旦上昇し、コレット105がチップ1を吸着した状態で、突き上げブロック110のみが降下することによって、剥離を進行させるプロセスを示す。図44はその要部断面フロー図である。これらに基づいて、具体的ステップの進行を説明する。
(1)ダイシングテープ4を下部基体102上面に真空吸着する(テープ吸着ステップ61)。
(2)コレット105が真空吸引しながらチップ1の上面(限定はされないが一般にデバイス面)に着地する(コレット着地ステップ62)。着地した状態を図44aに示す。
(3)突き上げブロック110が一括上昇する(1段目上昇ステップ63;図44b参照)。チップ1およびコレット105もそれに連れて押し上げられる。このとき下部基体周辺部102aは動かないのでチップ1の外周のダイシングテープ4を剥離する張力が働く。また、このステップで、リークのモニタが開始されている。
(4)リークありを検知する(リーク検知ステップ64)。なお、リークなしの場合は即ステップ(9)に進む。
(5)所定の時間だけ、またはリークがなくなるまで(3)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(7)へ進む。ただ、このステップは(4)から即次のステップ(6)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(6)ステップ(3)の開始前に戻る。または、リークモニタでリークがなくなるまで(3)の処理を後退させる。すなわち、突き上げブロック110を一括降下させる。すなわち、「後退ステップ」である。
(7)突き上げブロック110が一括再上昇する(1段目再上昇)。
(8)リークなしを検知する。なお、所定の回数繰り返しても「リークなし」とならないときは、設定により、そのチップをスキップするか、リークが出ないように初期上昇量を下げて再実行するか、アラームを表示して(またはアラーム信号をホストに送信)停止するいずれかまたはそのうちの複数を選択する。
(9)コレット105がチップ1を真空吸着した状態で、突き上げブロック110のみを降下させる(突き上げブロック一括単独降下ステップ65;図44c参照)。
(10)リークありを検知する(リーク検知ステップ46)。なお、リークなしの場合はそのまま(13)に進む。
(11)所定の時間だけ、またはリークがなくなるまで(9)の降下動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(13)へ進む。ただ、このステップは(10)から即次のステップ(12)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(12)ステップ(9)開始前の状態に戻る(突き上げブロック再上昇ステップ67;図44d参照)。または、リークモニタでリークがなくなるまで(9)の処理を後退させる。すなわち、突き上げブロック110のみを降下させる。すなわち、「後退ステップ」である。
(13)突き上げブロック110bおよび110cが一括上昇する(2段目上昇ステップ68)。このとき、突き上げブロック110aや下部基体周辺部102aは動かない。
(14)リークあり(リーク検知ステップ69)。なお、リークなしの場合は即ステップ(19)に進む。
(15)所定の時間だけ、またはリークがなくなるまで(13)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(17)へ進む。ただ、このステップは(14)から即次のステップ(16)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(16)ステップ(13)の開始前に戻る。または、リークモニタでリークがなくなるまで(13)の処理を後退させる。すなわち、突き上げブロック110bおよび110cを一括降下させる。
(17)コレット105がチップ1を真空吸着した状態で、突き上げブロック110bおよび110cのみを降下させる(突き上げブロック一括単独降下ステップ70)。
(18)リークありを検知する(リーク検知ステップ71)。なお、リークなしの場合はそのまま(21)に進む。
(19)所定の時間だけ、またはリークがなくなるまで(17)の降下動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(21)へ進む。ただ、このステップは(18)から即次のステップ(20)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(20)ステップ(17)開始前の状態に戻る(突き上げブロック再上昇ステップ72)。または、リークモニタでリークがなくなるまで(17)の処理を後退させる。すなわち、突き上げブロック110bおよび110cのみを降下させる。すなわち、「後退ステップ」である。
(21)最終段すなわち突き上げブロック110cを単独上昇させる(最終段上昇ステップ73)。当然、チップ1とコレット105はそれに伴って上昇する。
(22)リークあり(リーク検知ステップ74)。なお、リークなしの場合は即ステップ(27)に進む。
(23)所定の時間だけ、またはリークがなくなるまで(21)の上昇動作を減速(停止を含む)する。すなわち、「待機ステップ」である。この間も、リークのモニタが連続的または断続的に実行されている。なお、リークがなくなればステップ(27)へ進む。ただ、このステップは(22)から即次のステップ(24)に移行する場合には省略可能である。その方が処理時間が短くなる場合もある。
(24)ステップ(21)の開始前に戻る。または、リークモニタでリークがなくなるまで(21)の処理を後退させる。すなわち、突き上げブロック110cを他のブロックとともに降下させる。当然、チップ1とコレット105はそれに伴って降下する。
(25)最終段を再上昇させる(最終段再上昇)。
(26)リークなし。なお、所定の回数繰り返しても「リークなし」とならないときは、設定により、そのチップをスキップするか、リークが出ないように初期上昇量を下げて再実行するか、アラームを表示して(またはアラーム信号をホストに送信)停止するいずれかまたはそのうちの複数を選択する。
(27)コレットが上昇して完全剥離する(完全剥離ステップ75)。
なお、ステップ(1)、(2)以降ステップ(27)までは、コレット側、および下部基体側の吸着用真空は引いたままである。すなわち、ONのままである。
この剥離プロセスのメリットは、突き上げブロックのトータル・ストロークを短くできるところにある。
3−4.スライド剥離プロセス(「剥離プロセス4」、図45から47)
先のセクションまでの剥離装置では、チップ1の下部には突き上げブロック110があったが、他の装置では、図46bに示すように、その代わりにスライド板183が水平方向にスライドすることによって、剥離を進行させるものがある。同図において、構造を説明する。図46aは対象とするチップ1側から見た上面図である。吸着駒102にはスライド板183を収容するためのリセス部181が設けられており、リセス部181の底面には真空吸引孔182があり、他の装置同様にリセス部181外部周辺の吸着駒102には真空吸引孔103が設けられている。図45はこの装置によってダイシングテープ4を剥離する際に、リーク検出を利用する方法について具体的処理ステップを示すプロセスフロー図である。図47はその要部断面フロー図である。図45から47に基づいて、具体的ステップの進行を説明する。
(1)ダイシングテープ4を下部基体102上面に真空吸着する(テープ吸着ステップ81)。
(2)コレット105が真空吸引しながらチップ1の上面(限定はされないが一般にデバイス面)に着地する(コレット着地ステップ82)。着地した状態を図47aに示す。
(3)コレットリークありを検出する(リーク検出ステップ83;図47b)。
(4)待機する(流量設定値到達待ちステップ84;図47c)。リーク量が許容範囲になったら次のステップに進む。
(5)スライド板183をチップ1とのオーバーラップが減少する方向にスライド開始する(スライド・ステップ85;図47d)。コレットリークありを検出するまでそのままスライドする。
(6)リークありを検出する。
(7)スライド速度をリークが許容範囲となるまで減速する(または、停止して、待つ)。すなわち、待機ステップ86である。
(8)リークなし検出。
(9)スライド再開し、スライド・ストローク・エンドに到達し、コレットが上昇を開始する(スライド・エンド&コレット上昇ステップ87)。
(10)リークありを検出する(リーク検出ステップ88)。
(11)コレット上昇速度をリークが許容範囲となるまで減速する(または、停止して、待つ)。すなわち、待機ステップ89である。
(12)リークなしを検出。
(13)コレットが上昇して完全剥離する(完全剥離ステップ90)
この剥離プロセスのメリットは比較的簡単なステップ構成で実行できるところにある。
4.各剥離ティーチング・プロセスの詳細(主に図48から50および図31)
以下のティーチング・プロセスはセクション3で説明した各種の剥離プロセス、セクション2で説明した各種のコレット構造、およびセクション1で説明した全体プロセスに適宜選択して単独でまたは複数組み合わせて適用することができる。
なお、以下のティーチングは、良品製品チップ、不良品製品チップ、または非製品チップ(上は周辺の製品と同一形状のチップでパターンが完全には形成されていないもの)のいずれかを用いて実行可能である。また、製品チップで擬似ピックアップ(完全には剥離しないピックアップ)しても、完全剥離をしなければ元の状態にもどるので、製品信頼性等の一定のリスクはあるが大きな問題はない。
4−1.突き上げブロック動作ティーチング(「ティーチング方法1」、図48から49および図31)
図48は、リーク検出とそれを用いたプロセスパラメータの自動取得すなわちティーチング・プロセスの原理を説明するための説明図である。図48a、b、およびcはその要部断面フロー図であり、図48dは図31に説明したリーク検出の原理との関係を示すタイミングチャートである。これらに基づいて、具体的ステップの進行を説明する。
(1)目的とするチップ1が吸着駒(下部基体)102と吸着コレット105の中心に来るように位置あわせする。ここで流量検出がオンになる(検出動作開始ステップすなわちティーチング開始ステップ151)。
(2)ダイシングテープ4を下部基体102上面に真空吸着する(テープ吸着ステップ152)。
(3)コレット105が真空吸引しながらチップ1の上面(限定はされないが一般にデバイス面)に着地する(コレット着地ステップ153)。着地した状態を図48aに示す。
(4)十分に遅い速度(初期速度)で突き上げブロック(突き上げ治具)全体が上面をそろえて上昇する(突き上げブロック上昇ステップ154)。
(5)リークありを検出する(リーク検出ステップ157)。その突き上げ高さ(「リーク検出開始高さ」)を記憶する。
(6)十分に遅い速度(初期速度)で突き上げブロック全体が上面をそろえてリークが許容範囲になるまで降下する。その高さ(「リーク検出終了高さ」)を記憶する。すなわち、これを「暫定第1段目上昇高さ」として記憶する(突き上げたかさ記憶ステップ158)。
(7)十分に遅い速度(初期速度)で突き上げブロックの内、突き上げブロック(突き上げ治具)110bおよび110cのみが上面をそろえて上昇する(2段目突き上げブロック上昇ステップ)。
(8)リークありを検出する(リーク検出ステップ159)。その突き上げ高さ(「リーク検出開始高さ」)を記憶する。
(9)十分に遅い速度(初期速度)で突き上げブロックの内、突き上げブロック(突き上げ治具)110bおよび110cのみが上面をそろえてリークが許容範囲になるまで降下する。その高さ(「リーク検出終了高さ」)を記憶する。すなわち、これを「暫定第2段目上昇高さ」として記憶する(突き上げたかさ記憶ステップ160)。
(10)十分に遅い速度(初期速度)で突き上げブロックの内、突き上げブロック(突き上げ治具)110cのみが上昇する(3段目突き上げブロック上昇ステップ)。
(11)リークありを検出する。その突き上げ高さ(「リーク検出開始高さ」)を記憶する。
(12)十分に遅い速度(初期速度)で突き上げブロックの内、突き上げブロック(突き上げ治具)110cのみが上面をそろえてリークが許容範囲になるまで降下する。その高さ(「リーク検出終了高さ」)を記憶する。すなわち、これを「暫定第3段目上昇高さ」として記憶する。
(13)ここで、「暫定第3段目上昇高さ」でリークなし(リーク検出ステップ161)となっているかを突き上げブロック(突き上げ治具)110cのみを追加上昇(追加上昇162)させて確認する。
(14)これにより、最終的にリークなしとなる「設定暫定第3段目上昇高さ」すなわち、「上死点」(3段目上昇高さ設定値)を記憶する(上死点設定ステップ155)。
(15)「暫定第1段目上昇高さ」、「暫定第2段目上昇高さ」および「設定暫定第3段目上昇高さ」を停止高さとして設定する(停止高さ設定ステップ156)。
(16)次に、(15)で設定した停止高さで対応するセクション3のいずれかのピックアップを実行する。そして、各回ごとに上昇速度を徐々に上げて、または下げて最適速度を記憶し、それに変更する。これは、非製品チップでも可能であるが、製品チップのピックアップを実行しながら行うことが効率的である。
4−2.スライド動作ティーチング(「ティーチング方法2」、図46から47および図50)
ここでは、セクション3−4に説明した装置構成でのスライド速度のティーチング方法を説明する。図50はそのプロセスフロー図である。図46から47および図50に基づいて具体的ステップの進行を説明する。
(1)目的とするチップ1が吸着駒(下部基体)102と吸着コレット105の中心に来るように位置あわせする。ここで流量検出がオンになる(検出動作開始ステップすなわちティーチング開始ステップ171)。
(2)ダイシングテープ4を下部基体102上面に真空吸着する(テープ吸着ステップ172)。
(3)コレット105が真空吸引しながらチップ1の上面(限定はされないが一般にデバイス面)に着地する(コレット着地ステップ173)。
(4)十分に遅い速度(初期速度)で第1のチップに対してスライド動作を開始する(スライド開始ステップ174)。リークなければストロークエンドまでスライドする(ストロークエンド・ステップ176)。製品チップの場合は剥離完了まで進む。そのスライド速度を記憶する。
(5)もう少し早い速度で第2のチップに対してスライド動作を開始する。リークなければストロークエンドまでスライドする。製品チップの場合は剥離完了まで進む。そのスライド速度を記憶する。
(6)これを繰り返して、n番目のチップでリークありを検出する(リーク検出ステップ175)。
(7)そのn番目のチップに対するスライド速度を記憶する。
(8)リークが許容範囲になるまで待機してその待機時間を記憶する。
(9)スライド動作を再開し、リークありを検出すると(8)に戻り、リークなしであれば次に進む。
(10)ストロークエンドまでスライドする。ここで、(7)またはそれ以前に記憶した速度から最適速度を所定のルールに従って選択または算出する場合は以後のステップは不要となる。
(11)必要に応じて、更に速度を上げて(6)かた(10)を繰り返し、そこで得られたデータから最適速度を設定し記憶する(最適速度記憶ステップ177)。
5.各剥離プロセスの好適な組み合わせおよびその特徴
セクション3の各剥離プロセスは、典型的な例についてその類型に分類して説明したが、実際には適宜取捨選択して、または適宜相互に組み合わせて実行するとピックアップ効率が向上したり、製品信頼性が向上することが期待できる。たとえば、セクション3−2のコレット上昇セグメント(図41ステップ45から47または50から52)すなわち、ステップの集合は剥離プロセス3のステップ67の後や剥離プロセス4の適切なステップとパラレルに適用するとピックアップ時間短縮に有効である。
6.サマリ
以上本発明者によってなされた発明を実施形態に基づいて正方形のシリコン・チップを例にとり具体的に説明したが、本発明はそれに限定されるものではなく、その要旨を逸脱しない範囲において種々変更可能であることは言うまでもない。
例えば、本発明は長方形のチップ、その他の形状のチップ、GaAsチップ等のシリコン以外のチップ、およびその他のチップ上の電子部品のピックアップに同様に適用できることは言うまでもない。
本発明の一実施の形態である半導体集積回路装置の製造方法に用いる半導体チップの斜視図である。 半導体ウエハの研削工程を示す側面図である。 半導体ウエハにダイシングテープを貼り付ける工程を示す側面図である。 半導体ウエハのダイシング工程を示す側面図である。 半導体ウエハおよびダイシングテープをウエハリングに固定し、その上方に押さえ板を配置すると共に、下方にエキスパンドリングを配置した状態を示す平面図である。 半導体ウエハおよびダイシングテープをウエハリングに固定し、その上方に押さえ板を配置すると共に、下方にエキスパンドリングを配置した状態を示す断面図である。 ダイシングテープをウエハリングを押さえ板とエキスパンドリングで挟むことによってダイシングテープの張力を与えた状態を示す断面図である。 ダイシングテープを貼り付けた半導体チップの剥離方法を説明するチップ剥離装置の要部断面図である。 チップ剥離装置の吸着駒を示す断面図である。 吸着駒の上面近傍の拡大断面図である。 吸着駒の上面近傍の拡大斜視図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大断面図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大断面図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大断面図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大斜視図である。 半導体チップの剥離方法を説明する吸着駒の断面図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大断面図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大斜視図である。 半導体チップの剥離方法を説明する吸着駒の断面図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大断面図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大斜視図である。 半導体チップの剥離方法を説明する吸着駒の断面図である。 半導体チップの剥離方法を説明する吸着駒の上面近傍の拡大断面図である。 図23で剥離された半導体チップがダイボンディング部へ搬送される様子を示す断面図である。 図23で剥離された半導体チップがダイボンディング部へ搬送され、配線基板に着地したところを示す断面図である。 図23で剥離された半導体チップがダイボンディング部で配線基板にボンディングされたところを示す断面図である。 半導体チップのペレット付け工程を示す配線基板の断面図である。 半導体チップの積層およびワイヤボンディング工程を示す配線基板の断面図である。 半導体チップの樹脂封止工程を示す配線基板の断面図である。 (a)〜(c)は、半導体チップの剥離方法の他の例を説明する吸着駒の上面近傍の断面図である。 (a)および(b)は、半導体チップの剥離方法の原理を説明するための説明図である。 (a)および(b)は、ラバーチップ、突き上げブロックの各一例およびコレット本体の構造を示す平面図である。 a)および(b)は、ラバーチップ、突き上げブロックの各他の一例およびコレット本体の構造を示す平面図である。 図33または図34のA−A断面の状態を説明する断面図である。 図33または図34のB−B断面の状態を説明する断面図である。 a)および(b)は、ラバーチップ、突き上げブロックの各更に他の一例およびコレット本体の構造を示す平面図である。 図36のA−A断面の状態を説明する断面図である。 図36のB−B断面の状態を説明する断面図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス1を示す処理フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス1を示す模式断面フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス2を示す処理フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス2を示す模式断面フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス3を示す処理フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス3を示す模式断面フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス4を示す処理フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス4に用いる剥離装置の構造を説明するための装置要部上面図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における剥離プロセス4を示す模式断面フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における初期パラメータ自動設定方法1を示す模式断面フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における初期パラメータ自動設定方法1を示す処理フロー図である。 本発明の一実施の形態である半導体集積回路装置の製造方法における初期パラメータ自動設定方法2を示す処理フロー図である。
符号の説明
1 チップ
4 粘着テープ
100 チップ装置剥離(チップ処理装置)
102 下部基体(吸着駒)
105 吸着コレット
107 真空吸着系

Claims (20)

  1. 以下の工程を含む半導体集積回路装置の製造方法:
    (a)ほぼ元のウエハの際の2次元的配置のままで、個々のチップ領域に分割された複数のチップを、それらの裏面を粘着テープに固定した状態でチップ処理装置に供給する工程;
    (b)前記複数のチップの内の第1のチップの表面を吸着コレットで真空吸着し、且つ、前記第1のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記粘着テープを前記第1のチップの前記裏面から剥離させる工程、
    ここで、前記工程(b)は以下の下位工程を含む:
    (b1)前記第1のチップが前記粘着テープから完全に剥離する以前の前記第1のチップの湾曲状態を、前記吸着コレットの真空吸着系の流量を計測することによってモニタし、そのモニタ情報に基づいて、前記剥離動作を制御する工程。
  2. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b2)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続または中断させる工程;
    (b3)前記剥離動作を中断させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を再開する工程。
  3. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b4)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続または減速させる工程;
    (b5)前記剥離動作を減速させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を再加速させる工程。
  4. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b6)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続させ、または前記第1のチップの前記湾曲状態が許容範囲内になるまで前記剥離動作を後退させる工程。
  5. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b7)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続させ、または前記第1のチップの前記湾曲状態が許容範囲内になるまで前記剥離動作を減速させる工程。
  6. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b8)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
    (b9)前記下位工程(b8)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで降下させる工程。
  7. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b10)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
    (b11)前記下位工程(b10)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程。
  8. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b12)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
    (b13)前記下位工程(b12)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させる工程。
  9. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b14)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
    (b15)前記工程(b14)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
    (b16)前記下位工程(b15)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで上昇させる工程。
  10. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b17)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
    (b18)前記工程(b17)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
    (b19)前記下位工程(b18)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程。
  11. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b20)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
    (b21)前記工程(b20)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
    (b22)前記下位工程(b21)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックの降下を前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させる工程。
  12. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b23)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記下部基体の主要部を成すスライド板を前記第1のチップとのオーバラップが減少するようにスライドさせる工程;
    (b24)前記下位工程(b1)のモニタ情報に基づいて、前記スライド板を前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程。
  13. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b25)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続または中断させる工程;
    (b26)前記剥離動作を中断させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を再開させるか、または前記第1のチップの前記湾曲状態が前記許容範囲内になるまで前記剥離動作を後退させる工程。
  14. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b27)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を継続または減速させる工程;
    (b28)前記剥離動作を減速させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作を再加速させるか、または前記第1のチップの前記湾曲状態が許容範囲内になるまで前記剥離動作を後退させる工程。
  15. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b29)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
    (b30)前記下位工程(b29)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程;
    (b31)前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を再開するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで降下させる工程。
  16. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b32)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
    (b33)前記工程(b32)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
    (b34)前記下位工程(b33)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させる工程;
    (b35)前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を再開させるか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで上昇させる工程。
  17. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b36)前記第1のチップの前記湾曲状態が許容範囲を超えるまで、前記吸着コレットを上昇させる工程;
    (b37)前記下位工程(b36)の後、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を継続するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させる工程;
    (b38)前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記吸着コレットの上昇を再開するか、または前記吸着コレットを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで降下させる工程。
  18. 前記請求項1項の半導体集積回路装置の製造方法において、前記工程(b)は更に以下の下位工程を含む:
    (b39)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
    (b40)前記工程(b39)の後、前記突き上げブロックおよび前記吸着コレットの内、前記突き上げブロックのみを、前記第1のチップの前記湾曲状態が許容範囲を超えるまで、降下させる工程;
    (b41)前記下位工程(b40)の後、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を継続するか、または前記突き上げブロックの降下を前記第1のチップの前記湾曲状態が前記許容範囲内になるまで減速させる工程;
    (b42)前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで待機させている場合において、前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの降下を再開させるか、または前記突き上げブロックを前記第1のチップの前記湾曲状態が前記許容範囲内になるまで上昇させる工程。
  19. 以下の工程を含む半導体集積回路装置の製造方法:
    (a)ほぼ元のウエハの際の2次元的配置のままで、個々のチップ領域に分割された複数のチップを、それらの裏面を粘着テープに固定した状態でチップ処理装置に供給する工程;
    (b)前記複数のチップの内の第1のチップの表面を吸着コレットで真空吸着し、且つ、前記第1のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記粘着テープを前記第1のチップの前記裏面から剥離させる工程、
    ここで、前記工程(b)は以下の下位工程を含む:
    (b1)前記第1のチップが前記粘着テープから完全に剥離する以前の前記第1のチップの湾曲状態を、前記吸着コレットの真空吸着系の流量を計測することによってモニタする工程;
    (b2)前記下位工程(b1)のモニタ情報に基づいて、前記剥離動作の最適速度を決定する工程、
    ここで、前記半導体集積回路装置の製造方法は更に以下の工程を含む:
    (c)前記工程(b)の後、前記複数のチップの内の第2のチップの表面を吸着コレットで真空吸着し、且つ、前記第2のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記最適速度で前記剥離動作を実行することによって、前記粘着テープを前記第2のチップの前記裏面から剥離させる工程。
  20. 以下の工程を含む半導体集積回路装置の製造方法:
    (a)ほぼ元のウエハの際の2次元的配置のままで、個々のチップ領域に分割された複数のチップを、それらの裏面を粘着テープに固定した状態でチップ処理装置に供給する工程;
    (b)前記複数のチップの内の第1のチップの表面を吸着コレットで真空吸着し、且つ、前記第1のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記粘着テープを前記第1のチップの前記裏面から剥離させる工程、
    ここで、前記工程(b)は以下の下位工程を含む:
    (b1)前記第1のチップが前記粘着テープから完全に剥離する以前の前記第1のチップの湾曲状態を、前記吸着コレットの真空吸着系の流量を計測することによってモニタする工程;
    (b2)前記下部基体の主要部を成す突き上げブロックを、前記吸着コレットとともに、上昇させる工程;
    (b3)前記下位工程(b1)のモニタ情報に基づいて、前記突き上げブロックの最適上昇高さを決定する工程、
    ここで、前記半導体集積回路装置の製造方法は更に以下の工程を含む:
    (c)前記工程(b)の後、前記複数のチップの内の第2のチップの表面を吸着コレットで真空吸着し、且つ、前記第2のチップの前記裏面の前記粘着テープを下部基体の上面に真空吸着した状態で、前記最適上昇高さだけ、前記突き上げブロックを上昇させる工程。
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Families Citing this family (28)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP5287276B2 (ja) * 2009-01-15 2013-09-11 Tdk株式会社 電子部品のピックアップ方法及びピックアップ装置
KR101067820B1 (ko) 2009-03-20 2011-09-27 (주)아이콘 소형부품용 픽앤플레이스장치의 피커
JP5442288B2 (ja) * 2009-03-27 2014-03-12 日東電工株式会社 保護テープ剥離方法およびこれを用いた保護テープ剥離装置
JP5627362B2 (ja) * 2010-09-16 2014-11-19 富士機械製造株式会社 ダイ供給装置
JP5805411B2 (ja) * 2011-03-23 2015-11-04 ファスフォードテクノロジ株式会社 ダイボンダのピックアップ方法およびダイボンダ
US20120267423A1 (en) * 2011-04-19 2012-10-25 Taiwan Semiconductor Manufacturing Company, Ltd. Methods and Apparatus for Thin Die Processing
CN102744795A (zh) * 2011-04-21 2012-10-24 菱生精密工业股份有限公司 晶圆切割方法
JP2013065731A (ja) * 2011-09-19 2013-04-11 Hitachi High-Tech Instruments Co Ltd ダイボンダ及びボンディング方法
JP2013065757A (ja) * 2011-09-20 2013-04-11 Toshiba Corp 半導体チップのピックアップ方法及び半導体チップのピックアップ装置
CH706280B1 (de) * 2012-03-30 2016-03-15 Esec Ag Verfahren zum Ablösen eines Halbleiterchips von einer Folie.
JP2014011416A (ja) * 2012-07-03 2014-01-20 Panasonic Corp 半導体チップのピックアップ装置およびピックアップ方法
JP5931772B2 (ja) * 2013-02-13 2016-06-08 株式会社東芝 半導体製造装置
JP5900392B2 (ja) * 2013-03-21 2016-04-06 富士ゼロックス株式会社 フィルム分離装置
CN104752292B (zh) * 2013-12-31 2018-08-24 北京北方华创微电子装备有限公司 升降针装置和半导体刻蚀设备
SG10201403372SA (en) * 2014-06-18 2016-01-28 Mfg Integration Technology Ltd System and method for peeling a semiconductor chip from a tape using a multistage ejector
KR101605961B1 (ko) * 2014-08-27 2016-03-23 주식회사 페코텍 반도체 다이 픽업용 콜렛
JP5980875B2 (ja) * 2014-10-21 2016-08-31 キヤノンマシナリー株式会社 チップ剥離装置及びチップ剥離方法
JP6643197B2 (ja) * 2016-07-13 2020-02-12 ファスフォードテクノロジ株式会社 半導体製造装置および半導体装置の製造方法
CN106941086B (zh) * 2017-03-10 2023-10-17 东莞市凯格精机股份有限公司 一种固晶机的取料设备
CN108666257B (zh) * 2017-03-31 2021-03-09 日月光半导体制造股份有限公司 元件剥离装置及元件剥离方法
WO2019008674A1 (ja) * 2017-07-04 2019-01-10 株式会社Fuji 部品実装装置
JP6967411B2 (ja) * 2017-09-19 2021-11-17 ファスフォードテクノロジ株式会社 半導体製造装置、半導体装置の製造方法およびコレット
JP7102305B2 (ja) * 2018-09-19 2022-07-19 ファスフォードテクノロジ株式会社 ダイボンディング装置および半導体装置の製造方法
JP7217605B2 (ja) * 2018-09-21 2023-02-03 ファスフォードテクノロジ株式会社 半導体製造装置、突上げ治具および半導体装置の製造方法
JP7274902B2 (ja) * 2019-03-25 2023-05-17 ファスフォードテクノロジ株式会社 半導体製造装置および半導体装置の製造方法
CN110391169A (zh) * 2019-08-15 2019-10-29 业成科技(成都)有限公司 吸嘴装置
US11652080B2 (en) * 2021-05-27 2023-05-16 Intel Corporation Thermal compression bonder nozzle with vacuum relief features
CN117594519B (zh) * 2024-01-18 2024-04-02 东莞触点智能装备有限公司 一种芯片高精度固晶机及其超薄芯片无损顶起方法

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3498877B2 (ja) * 1995-12-05 2004-02-23 株式会社東芝 半導体製造装置および半導体装置の製造方法
JP2000208447A (ja) * 1998-11-12 2000-07-28 Toshiba Corp 半導体製造装置及び半導体装置の製造方法
JP2000353710A (ja) * 1999-06-14 2000-12-19 Toshiba Corp ペレットピックアップ装置および半導体装置の製造方法
JP2001196442A (ja) * 2000-01-11 2001-07-19 Sony Corp ピックアップ装置及びワークのピックアップ方法並びにそのプログラムを格納した記憶媒体
JP2002050670A (ja) * 2000-08-04 2002-02-15 Toshiba Corp ピックアップ装置及びピックアップ方法
JP3846257B2 (ja) * 2001-10-25 2006-11-15 松下電器産業株式会社 電子部品実装装置におけるピックアップ方法
TWI283906B (en) * 2001-12-21 2007-07-11 Esec Trading Sa Pick-up tool for mounting semiconductor chips
JP2004186352A (ja) * 2002-12-03 2004-07-02 Renesas Technology Corp 半導体装置及び半導体装置の製造方法
JP2003264203A (ja) * 2002-03-11 2003-09-19 Hitachi Ltd 半導体装置の製造方法
TWI225279B (en) * 2002-03-11 2004-12-11 Hitachi Ltd Semiconductor device and its manufacturing method
JP4136692B2 (ja) * 2003-02-07 2008-08-20 芝浦メカトロニクス株式会社 ペレット搬送装置、ペレットボンディング方法およびペレットボンディング装置
JP4574251B2 (ja) * 2003-09-17 2010-11-04 ルネサスエレクトロニクス株式会社 半導体装置の製造方法
JP4226489B2 (ja) * 2004-02-25 2009-02-18 日東電工株式会社 チップのピックアップ方法
JP2005322815A (ja) * 2004-05-11 2005-11-17 Matsushita Electric Ind Co Ltd 半導体製造装置および半導体装置の製造方法
JP4298640B2 (ja) * 2004-12-06 2009-07-22 キヤノンマシナリー株式会社 ダイボンダー用コレット

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