JP4806679B2

JP4806679B2 - ジッタ発生回路

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Publication number: JP4806679B2
Application number: JP2007518907A
Authority: JP
Inventors: 隆之中村; 隆関野
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Current assignee: Advantest Corp
Priority date: 2005-06-01
Filing date: 2006-05-18
Publication date: 2011-11-02
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Description

本発明は、信号の立ち上がりおよび立ち下がりのタイミングに揺らぎを与えるジッタ発生回路に関する。

半導体試験装置において、被試験デバイス（以後、「ＤＵＴ」と称する）のジッタ耐性を試験する場合に、ＤＵＴに印加する試験パターンにジッタを付加する必要があり、ジッタ発生回路が用いられる（例えば、特許文献１参照。）。このジッタ発生回路では、正弦波のオフセット電圧とランプ発生器の出力電圧とを比較することにより、クロック信号の変化のタイミングに正弦波の揺らぎを与えている。
特開平６−１０４７０８号公報（第３−４頁、図１−３）

ところで、実際にＤＵＴに入力される信号に付加されるジッタとしては、特許文献１のジッタ発生回路等を用いて付加されるような入力信号パターンに依存しないジッタの他に、入力信号パターンに依存したパターン効果ジッタが考えられる。例えば、ドライバから出力された信号が損失のある伝送線路を通してＤＵＴに送られる場合には、伝送線路における損失によって信号の立ち上がりタイミングが遅れ、しかも、パターンによりハイレベルからローレベルあるいはローレベルからハイレベルに完全に遷移したりしなかったりする場合にはパターンにより変化するジッタが付加されることになる。このジッタの大きさは、伝送線路による損失の大きさと入力信号パターンとの組み合わせによって決まるが、実際にＤＵＴが組み込まれる装置に用いられる伝送線路をその都度再現すれば、このパターン効果ジッタを信号に付加することはできるが、多ピンのＤＵＴについて実際の伝送線路を再現することはほとんど不可能であり、簡単な構成でパターン効果ジッタを発生させることができる構成が望まれている。

本発明は、このような点に鑑みて創作されたものであり、その目的は、簡単な構成でパターン効果ジッタを発生させることができるジッタ発生回路を提供することにある。

上述した課題を解決するために、本発明のジッタ発生回路は、入力信号の信号パターンの内容を分析する信号分析手段と、信号分析手段による分析結果に応じて、入力信号を伝送線路に通したときに変化タイミングがずれる向きに入力信号の位相を調整した信号を出力する位相調整手段とを備え、入力信号の位相を調整することでジッタを付加している。実際に信号を伝送線路に通す際に損失が発生するとこの伝送線路を通して受信した信号が所定の閾値電圧を超えたり下回るタイミングが変化する。このタイミングのずれは、入力信号の信号パターンの内容と密接な関係がある。本発明では、入力信号の信号パターンの内容に応じて入力信号の位相を調整することにより、この信号パターンの内容に応じて伝送線路において発生するジッタと同じようなパターン効果ジッタを発生させることができる。しかも、実際の伝送線路と同様の配線等が不要であるため、簡単な構成でパターン効果ジッタを発生させることができる。

また、上述した信号分析手段は、入力信号の周波数特性を分析することが望ましい。入力信号の信号パターンの内容に応じて伝送線路で発生するパターン効果ジッタは、主に、入力信号の電圧変化の状態、すなわち周波数に依存していると考えることができる。したがって、入力信号の周波数特性を分析してジッタを付加することにより、より実際に近いパターン効果ジッタを発生させることが可能になる。

また、上述した信号分析手段は、入力信号の低域成分を通過させるフィルタを有しており、位相調整手段は、フィルタの出力電圧に応じて位相調整を行うことが望ましい。これにより、入力信号の周波数特性を容易に検出することが可能になる。

また、上述した信号分析手段は、入力信号の低域成分を通過させるカットオフ周波数が異なる複数のフィルタと、複数のフィルタの出力電圧を合成する合成手段とを有しており、位相調整手段は、合成手段による合成電圧に応じて位相調整を行うことが望ましい。これにより、入力信号の信号パターンに応じて可変のジッタの量を調整することができ、信号パターンに応じた適切なパターン効果ジッタを発生させることが可能になる。

また、上述したフィルタには、入力信号と逆相の信号が入力されていることが望ましい。あるいは、上述した位相調整手段は、所定の電圧からフィルタの出力電圧を差し引いた電圧に応じて位相調整を行うことが望ましい。これにより、入力信号を伝送線路に通したときに変化タイミングがずれる向きに入力信号の位相を調整することができ、伝送線路を通したときに発生するパターン効果ジッタを再現することが可能になる。

また、上述した信号分析手段は、フィルタの出力電圧の利得調整を行う利得調整手段を有することが望ましい。特に、上述した利得調整手段によって調整される利得は、伝送線路による信号損失の程度に応じて設定されることが望ましい。これにより、想定される伝送線路の特性を考慮して信号の位相調整を行うことができ、様々な伝送線路を想定した多種類のパターン効果ジッタを共通の回路を用いて発生させることが可能になる。

また、上述した位相調整手段は、信号分析手段による分析結果に応じて参照電圧が変更される差動増幅器であることが望ましい。あるいは、上述した位相調整手段は、信号分析手段による分析結果に応じて参照電圧が変更される電圧比較器であることが望ましい。上述した位相調整手段は、信号分析手段による分析結果に応じて遅延量が変更される可変遅延回路であることが望ましい。これにより、伝送線路に送出される信号の変化のタイミング（信号の位相）を確実かつ容易に変更することができる。

また、上述した信号分析手段と位相調整手段は、入力信号を出力する回路が形成されているチップあるいはモジュールに組み込まれることが望ましい。これにより、ジッタ発生回路や入力信号を出力する回路を含む構成全体の小型化と、製造工程の簡略化や部品点数の削減に伴うコストダウンなどが可能になる。

以下、本発明を適用した一実施形態のジッタ発生回路について、図面を参照しながら詳細に説明する。

図１は、一実施形態のジッタ発生回路の構成を示す図である。図１に示すように、本実施形態のジッタ発生回路１は、ドライバ入力回路１０、２０、複数の利得調整回路３０、複数のローパスフィルタ（ＬＰＦ）４０（４０Ａ、４０Ｂ）、…、複数の加算器５０、１つの加算器５２、ドライバ出力回路６０、波形整形回路７０を備えている。このジッタ発生回路１は、ＤＵＴ２とこのＤＵＴ２に向けて信号を出力するドライバ３との間に設けられており、ドライバ３からＤＵＴ２に向けて出力された信号に対して信号パターンの内容に応じたパターン周期ジッタを付加する動作を行う。

ドライバ入力回路１０は、一方の入力端に所定の参照電圧Ｖref の参照信号が、他方の入力端にドライバ３の出力信号が入力された差動増幅器であり、ドライバ３から入力される信号と同相の信号を出力する。参照電圧Ｖref は、ドライバ３から入力される信号のローレベルとハイレベルの平均電圧（５０％の電圧）に設定されている。ドライバ入力回路１０から出力される信号は、差動増幅器によって構成されるドライバ出力回路６０に入力される。また、ドライバ入力回路２０は、一方の入力端にドライバ３の出力信号が、他方の入力端に所定の参照電圧Ｖref の参照信号が入力された差動増幅器であり、ドライバ３から入力される信号と逆相の信号を出力する。これら２つのドライバ入力回路１０、２０は、同じ構成の差動増幅器が用いられるが、入力される２つの信号の関係が反対になっている。それぞれの利得調整回路３０は、外部から入力される制御データＳ１、Ｓ２、…によって利得が設定可能であり、ドライバ入力回路２０から出力される信号をそれぞれに設定された利得で増幅あるいは減衰して出力する。それぞれのローパスフィルタ４０（４０Ａ、４０Ｂ、…）は、対応する利得調整回路３０を通した後の信号の低域成分を通過させる。本実施形態では、上述した利得調整回路３０とローパスフィルタ４０からなる処理系統が複数組備わっている。それぞれの加算器５０は、これら複数組の処理系統に含まれる複数のローパスフィルタ４０の出力電圧を加算する。加算器５２は、複数の加算器５０によって加算された電圧と所定の電圧Ｖ_BB-DCとを加算して参照電圧Ｖ_BBを生成する。この参照電圧Ｖ_BBは、ドライバ出力回路６０に入力される。ドライバ出力回路６０は、ドライバ入力回路１０から出力された信号と、加算器５２から出力された参照電圧Ｖ_BBの参照信号とが入力されており、これら２つの信号を用いた差動増幅を行う。ドライバ出力回路６０から出力される信号は、波形整形回路７０によって波形整形された後にジッタ発生回路１から出力され、ＤＵＴ２の入力ピンあるいは入出力ピンに入力される。

上述した複数のローパスフィルタ４０が信号分析手段に、１つの加算器５２、１つのドライバ出力回路６０が位相調整手段に、複数の加算器５０が合成手段に、複数の利得調整回路３０が利得調整手段にそれぞれ対応する。

本実施形態のジッタ発生回路１はこのような構成を有しており、次にその動作を説明する。複数のローパスフィルタ４０Ａ、４０Ｂ、…のそれぞれは、異なるカットオフ周波数が設定されており、異なる周波数成分を通過させる。実際の伝送線路で発生するジッタを１つのフィルタで再現することが困難な場合は、それぞれのフィルタの出力を組み合わせるか、いくつかのフィルタを切り替えて動作させることになる。

図２は、ＤＵＴ２が実際に実装される環境において用いられる伝送線路による損失によって発生する信号の減衰の説明図である。なお、図２では、信号の減衰状態を説明するために極端に損失が大きい場合が示されている。図２（Ａ）には、高い周波数の信号パターンＡの信号が伝送線路に入力された状態が点線で示されている。ＤＵＴ２に接続された伝送線路における損失が大きいと、信号の電圧がローレベルからハイレベルに、あるいはハイレベルからローレベルに十分に遷移する前に次の状態変化が発生する。このときのタイミングのずれはｔ10、ｔ11となる。また、図２（Ｂ）には、低い周波数の信号パターンＣの信号が伝送線路に入力された状態が点線で示されている。伝送線路における損失が大きいと、信号電圧がローレベルからハイレベルに、あるいはハイレベルからローレベルに十分に遷移する際にある程度の時間を要するが、信号パターンＣの場合にはハイレベルあるいはローレベルの期間が長いため信号はハイレベルあるいはローレベルに近い電圧レベルまで変化する。このときのタイミングのずれはｔ20（≠ｔ10）、ｔ21（≠ｔ11）となる。実際の伝送線路には、図２（Ｃ）に示すように、図２（Ａ）に示した信号と図２（Ｂ）に示した信号とが適宜組み合わされた信号が入力される。図２（Ｃ）に示した例では、このときの信号の立ち上がりタイミングのずれｔ30は、図２（Ｂ）に示した信号パターンＣの立ち上がりタイミングのずれｔ20と等しくなるが、立ち下がりタイミングのずれｔ31は、図２（Ｂ）に示した信号パターンＣの立ち下がりタイミングのずれｔ21とは等しくならない。このように、伝送線路に入力される信号のパターンに応じて立ち上がりタイミングや立ち下がりタイミングがずれる量が変動する。本実施形態では、いろいろなパターンの信号の組み合わせで生じる低い周波数成分を複数のローパスフィルタ４０Ａ、４０Ｂ、…を用いることにより検出している。

それぞれのローパスフィルタ４０の前段に設けられたそれぞれの利得調整回路３０は、ドライバ入力回路２０から出力される電圧に対して、制御データ（Ｓ１、Ｓ２、…）に応じて設定される利得で信号の増幅あるいは減衰を行う。想定している伝送線路の長さや形状等に応じて特性（損失の量や損失の周波数依存性）は異なる。このため、入力信号が同じであっても伝送線路を通した後の減衰の程度が異なる。想定している伝送線路に対応するパターン効果ジッタを発生させるために、制御データＳ１、Ｓ２、…の内容が変更され、各利得調整回路３０における利得が可変に設定される。例えば、数々の特性を有する複数の伝送線路について、制御データＳ１、Ｓ２、…をどのような値に設定したときに各伝送線路に対応する適切なパターン効果ジッタを発生させることが可能であるかを、あらかじめ実験やシミュレーション等によって求めておいて、実際に使用される伝送線路の特性を測定してこの測定された特性に対応する制御データＳ１、Ｓ２、…を用いるようにすればよい。

複数の加算器５０では、複数のローパスフィルタ４０のそれぞれの出力電圧を加算（合成）する。また、加算器５２は、所定の電圧Ｖ_BB-DCに、複数の加算器５０によって加算された電圧を加算することにより参照電圧Ｖ_BBの参照信号を生成し、この生成した参照信号をドライバ出力回路６０に入力する。例えば、入力信号のローレベルとハイレベルの平均電圧（５０％の電圧）が所定の電圧Ｖ_BB-DCとして用いられており、この電圧Ｖ_BB-DCに、各ローパスフィルタ４０を用いて入力信号の周波数成分を分析して得られた最終段の加算器５０の出力電圧が重畳されて、ドライバ出力回路６０に入力される。したがって、ドライバ出力回路６０に入力される参照信号の電圧レベルを、入力信号の周波数に応じて変化させることができ、この参照信号の電圧レベルに対する差分増幅出力として得られる信号の立ち上がりタイミングおよび立ち下がりタイミングを、入力信号の信号パターンの内容に応じて調整することが可能になる。

このように、本実施形態のジッタ発生回路１では、入力信号の信号パターンの内容に応じて入力信号の位相を調整することにより、この信号パターンの内容に応じて実際の伝送線路において発生するジッタと同じようなパターン効果ジッタを発生させることができる。しかも、実際の伝送線路と同様の配線等が不要であるため、簡単な構成でパターン効果ジッタを発生させることができる。

また、入力信号をそれぞれのローパスフィルタ４０Ａ、４０Ｂ、…を通すことにより、入力信号の周波数特性を容易に検出することが可能になる。特に、カットオフ周波数が異なる複数のローパスフィルタ４０Ａ、４０Ｂ、…を用いることにより、様々な信号パターンに応じて可変の位相調整を行うことができ、信号パターンに応じた適切なパターン効果ジッタを発生させることが可能になる。また、それぞれのローパスフィルタ４０の出力電圧の利得調整を行うことにより（図１に示す構成では、それぞれのローパスフィルタ４０の前段に設けられたそれぞれの利得調整回路３０によってこの利得調整が行われている）、想定される伝送線路の特性を考慮して信号の位相調整を行うことができ、様々な伝送線路を想定した多種類のパターン効果ジッタを共通のジッタ発生回路１を用いて発生させることが可能になる。さらに、ドライバ出力回路６０として差動増幅器を用いることにより、ジッタ発生回路１から出力される信号の変化のタイミング（信号の位相）を確実かつ容易に変更することができる。

また、一方のドライバ入力回路１０から出力される信号と逆相の信号を他方のドライバ入力回路２０から出力することにより、入力信号を伝送線路に通したときに変化タイミングがずれる向きに入力信号の位相を調整することができ、想定される伝送線路を通したときに発生するパターン効果ジッタを再現することが可能になる。

また、本実施形態のジッタ発生回路１はＤＵＴ２とドライバ３の間に設けたため、ＤＵＴ２に対して各種の試験を行う半導体試験装置のパフォーマンスボードやソケットボードに外付けすることができ、半導体試験装置の構成を換えることなく半導体試験装置からＤＵＴ２に入力する信号にジッタを付加することが可能になる。

図３は、ジッタ発生回路１の具体的構成を部分的に示す回路図である。図３に示す構成は、図１に示したドライバ入力回路２０から加算器５２までの具体的構成を、２つの処理系統について示したものである。図３に示す構成は、一方の処理系統に対応する第１回路１００と、他方の処理系統に対応する第２回路２００と、所定の電圧Ｖ_BB-DCを発生するトランジスタ３００、抵抗３０２および定電流回路３０４と、所定の電圧Ｖ_BB-DCに２つの処理系統の出力電圧を加算する３つの抵抗３１０、３１２、３１４とを含んでいる。

第１回路１００は、差動増幅器を構成する２つのトランジスタ１０２、１０４と、これら２つのトランジスタ１０２、１０４のエミッタに共通に接続される可変定電流回路１０６と、２つのトランジスタ１０２、１０４のそれぞれのコレクタに個別に接続される負荷抵抗としての抵抗１１０、１１２と、一方の抵抗１１０に並列に接続されたコンデンサ１１４と、トランジスタ１０２のコレクタに接続されたトランジスタ１２０および定電流回路１２２とを有している。

一方のトランジスタ１０２のベースにはドライバ３から出力された信号が入力される。他方のトランジスタ１０４のベースには、所定の参照電圧（例えばトランジスタ１０２に入力される信号のローレベルとハイレベルの平均電圧）Ｖ_Rを有する参照信号が入力される。したがって、一方のトランジスタ１０２に入力された信号と逆相の信号がこのトランジスタ１０２のコレクタから出力される。この出力信号の電圧レベルは、制御データＳ１によって可変定電流回路１０６の定電流出力値を変更することにより、可変することができる。トランジスタ１０２のコレクタから出力される信号は、抵抗１１０とコンデンサ１１４によって構成されるローパスフィルタによって平滑され、これらの素子定数（抵抗値と静電容量値）で決まるカットオフ周波数以下の低域成分のみが、トランジスタ１２０を介して出力される。２つのトランジスタ１０２、１０４がドライバ入力回路２０に、抵抗１１０、コンデンサ１１４がローパスフィルタ４０Ａに、可変定電流回路１０６が１つの利得調整回路３０にそれぞれ対応する。

また、第２回路２００は、差動増幅器を構成する２つのトランジスタ２０２、２０４と、これら２つのトランジスタ２０２、２０４のエミッタに共通に接続される可変定電流回路２０６と、２つのトランジスタ２０２、２０４のそれぞれのコレクタに個別に接続される負荷抵抗としての抵抗２１０、２１２と、一方の抵抗２１０に並列に接続されたコンデンサ２１４と、トランジスタ２０２のコレクタに接続されたトランジスタ２２０および定電流回路２２２とを有している。第２回路２００の構成および各部の動作は、基本的に第１回路１００の構成および各部の動作と同じであり、抵抗２１０およびコンデンサ２１４によって構成されるローパスフィルタ４０Ｂのカットオフ周波数のみが異なっている。例えば、第１回路１００に含まれる抵抗１１０とコンデンサ１１４によって構成されるローパスフィルタ４０Ａのカットオフ周波数の方が、第２回路２００に含まれる抵抗２１０とコンデンサ２１４によって構成されるローパスフィルタ４０Ｂのカットオフ周波数よりも高く設定されている。このため、第１回路１００では入力信号の逆相の信号の高周波成分までの各周波数成分の検出が可能であり、第２回路２００では入力信号の逆相の信号の低周波成分の検出が可能となる。

第１回路１００、第２回路２００および電圧Ｖ_BB-DCを発生するトランジスタ３００の各出力端は、３つの抵抗３１０、３１２、３１４を介して接続されており、この接続点から所定の電圧Ｖ_BB-DCに２つの処理系統の出力電圧が重畳された参照電圧Ｖ_BBの参照信号が出力される。

図４は、ジッタ発生回路１の動作を説明する図である。図４（Ａ）にはドライバ入力回路１０から出力される信号と参照電圧Ｖ_BBとの関係が、図４（Ｂ）にはジッタが付加されたドライバ出力回路６０の出力信号がそれぞれ示されている。

ローレベルが続いた後にローレベルとハイレベルとが頻繁に切り替わる周波数が高い信号が入力されると（図４（Ａ）の期間Ｔ１）、そのパターン変化に対応した周波数成分が第１回路１００および第２回路２００によって検出されて、入力信号のレベル変化に合わせて変動する参照電圧Ｖ_BBが生成され、この参照電圧Ｖ_BBに対応するジッタが付加された信号がドライバ出力回路６０から出力される（図４（Ｂ）の期間Ｔ１）。また、ローレベルとハイレベルとが切り替わる周波数が低くなると（図４（Ａ）の期間Ｔ２）、この低い周波数成分を有する入力信号のレベル変化に合わせて変動する参照電圧Ｖ_BBが生成され、この参照電圧Ｖ_BBに対応するジッタが付加された信号がドライバ出力回路６０から出力される（図４（Ｂ）の期間Ｔ２）。図４（Ｂ）ではジッタが付加されない波形が点線で、ジッタが付加された波形が実線で示されている。

なお、本発明は上記実施形態に限定されるものではなく、本発明の要旨の範囲内において種々の変形実施が可能である。上述した実施形態では、差動増幅器によって構成されるドライバ出力回路６０を用いて信号の位相調整を行ったが、差動増幅器の代わりに、電圧比較器や可変遅延回路を用いるようにしてもよい。電圧比較器を用いた場合には、プラス入力端子にドライバ入力回路１０の出力信号を入力し、マイナス入力端子に参照電圧Ｖ_BBの参照信号を入力すればよい。また、可変遅延回路を用いた場合には、参照電圧Ｖ_BBに応じて遅延量を設定すればよい。

また、上述した実施形態では、複数のローパスフィルタ４０Ａ、４０Ｂ、…を用いて入力信号の信号パターンの内容（周波数特性）を分析するようにしたが、一部あるいは全部のローパスフィルタをバンドパスフィルタやハイパスフィルタに置き換えるようにしてもよい。また、フィルタ以外の構成、例えばあらかじめ検出対象となる複数の信号パターン（比較パターン）を用意しておいて、入力信号とこれら複数の比較パターンとの相関を求めて入力信号の信号パターンの内容を分析するようにしてもよい。

また、上述した実施形態では、ジッタ発生回路１内で、ドライバ入力回路１０とドライバ出力回路６０とを直接接続したが、ドライバ入力回路１０とドライバ出力回路６０との間に遅延回路を挿入するようにしてもよい。遅延回路を挿入することにより、ドライバ入力回路１０から出力される信号の位相を調整することが可能となる。

また、上述した実施形態では、ジッタ発生回路１をドライバ３とＤＵＴ２の間に設置したが、ドライバ３の前段に設けるようにしてもよい。この場合には、ジッタ発生回路１内の波形整形回路７０を省略してドライバ出力回路６０の出力信号をドライバ３に直接入力してもよい。ドライバ３（入力信号を出力する回路）やその前段に設けられた各種回路（図示せず）が１チップあるいは１つのモジュールの一部として形成されている場合に、ジッタ発生回路１をこれらのチップあるいはモジュールに組み込むようにしてもよい。これにより、ジッタ発生回路１やドライバ３等を含む回路の小型化と、製造工程の簡略化や部品点数の削減に伴うコストダウンなどが可能になる。

本発明によれば、入力信号の信号パターンの内容に応じて入力信号の位相を調整することにより、この信号パターンの内容に応じて伝送線路において発生するジッタと同じようなパターン効果ジッタを発生させることができる。しかも、実際の伝送線路と同様の配線等が不要であるため、簡単な構成でパターン効果ジッタを発生させることができる。

一実施形態のジッタ発生回路の構成を示す図である。伝送線路による損失によって発生する信号の減衰の説明図である。ジッタ発生回路の具体的構成を部分的に示す回路図である。ジッタ発生回路の動作を説明する図である。

符号の説明

１ジッタ発生回路
２ＤＵＴ（被測定デバイス）
３ドライバ
１０、２０ドライバ入力回路
３０利得調整回路
４０ローパスフィルタ（ＬＰＦ）
５０、５２加算回路
６０ドライバ出力回路
７０波形整形回路
１００第１回路
１０２、１０４、１２０、２０２、２０４、２２０トランジスタ
１０６、２０６可変定電流回路
１１０、１１２、２１０、２１２、３０２、３１０、３１２、３１４抵抗
１１４、２１４コンデンサ
１２２、２２２、３０４定電流回路
２００第２回路

Claims

入力信号の信号パターンの内容を分析する信号分析手段と、
前記信号分析手段による分析結果に応じて、前記入力信号を伝送線路に通したときに変化タイミングがずれる向きに前記入力信号の位相を調整した信号を出力する位相調整手段と、
を備え、前記入力信号の位相を調整することでジッタを付加するジッタ発生回路。
請求項１において、
前記信号分析手段は、前記入力信号の周波数特性を分析するジッタ発生回路。
請求項１において、
前記信号分析手段は、前記入力信号の低域成分を通過させるフィルタを有しており、
前記位相調整手段は、前記フィルタの出力電圧に応じて位相調整を行うジッタ発生回路。
請求項１において、
前記信号分析手段は、前記入力信号の低域成分を通過させるカットオフ周波数が異なる複数のフィルタと、前記複数のフィルタの出力電圧を合成する合成手段とを有しており、
前記位相調整手段は、前記合成手段による合成電圧に応じて位相調整を行うジッタ発生回路。
請求項３において、
前記フィルタには、前記入力信号と逆相の信号が入力されているジッタ発生回路。
請求項３において、
前記位相調整手段は、所定の電圧から前記フィルタの出力電圧を差し引いた電圧に応じて位相調整を行うジッタ発生回路。
請求項４において、
前記フィルタには、前記入力信号と逆相の信号が入力されているジッタ発生回路。
請求項４において、
前記位相調整手段は、所定の電圧から前記フィルタの出力電圧を差し引いた電圧に応じて位相調整を行うジッタ発生回路。
請求項３において、
前記信号分析手段は、前記フィルタの出力電圧の利得調整を行う利得調整手段を有するジッタ発生回路。
請求項９において、
前記利得調整手段によって調整される利得は、前記伝送線路による信号損失の程度に応じて設定されるジッタ発生回路。
請求項１において、
前記位相調整手段は、前記信号分析手段による分析結果に応じて参照電圧が変更される差動増幅器であるジッタ発生回路。
請求項１において、
前記位相調整手段は、前記信号分析手段による分析結果に応じて参照電圧が変更される電圧比較器であるジッタ発生回路。
請求項１において、
前記位相調整手段は、前記信号分析手段による分析結果に応じて遅延量が変更される可変遅延回路であるジッタ発生回路。
請求項１において、
前記信号分析手段と前記位相調整手段は、前記入力信号を出力する回路が形成されているチップあるいはモジュールに組み込まれるジッタ発生回路。