JP2017220642A - 半導体装置の製造方法、基板処理装置、プログラムおよび記録媒体 - Google Patents

半導体装置の製造方法、基板処理装置、プログラムおよび記録媒体 Download PDF

Info

Publication number
JP2017220642A
JP2017220642A JP2016116351A JP2016116351A JP2017220642A JP 2017220642 A JP2017220642 A JP 2017220642A JP 2016116351 A JP2016116351 A JP 2016116351A JP 2016116351 A JP2016116351 A JP 2016116351A JP 2017220642 A JP2017220642 A JP 2017220642A
Authority
JP
Japan
Prior art keywords
film thickness
etching
substrate
outer peripheral
peripheral surface
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2016116351A
Other languages
English (en)
Inventor
大橋 直史
Tadashi Ohashi
直史 大橋
豊田 一行
Kazuyuki Toyoda
一行 豊田
島本 聡
Satoshi Shimamoto
聡 島本
菊池 俊之
Toshiyuki Kikuchi
俊之 菊池
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Kokusai Electric Inc
Original Assignee
Hitachi Kokusai Electric Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hitachi Kokusai Electric Inc filed Critical Hitachi Kokusai Electric Inc
Priority to JP2016116351A priority Critical patent/JP2017220642A/ja
Priority to TW105124473A priority patent/TWI612617B/zh
Priority to KR1020160116184A priority patent/KR101793945B1/ko
Priority to CN201610818466.1A priority patent/CN107492491A/zh
Priority to US15/265,371 priority patent/US9991179B2/en
Publication of JP2017220642A publication Critical patent/JP2017220642A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L22/00Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
    • H01L22/20Sequence of activities consisting of a plurality of measurements, corrections, marking or sorting steps
    • H01L22/26Acting in response to an ongoing measurement without interruption of processing, e.g. endpoint detection, in-situ thickness measurement
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76801Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
    • H01L21/76802Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
    • H01L21/76807Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics for dual damascene structures
    • H01L21/76813Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics for dual damascene structures involving a partial via etch
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/76Making of isolation regions between components
    • H01L21/764Air gaps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3105After-treatment
    • H01L21/311Etching the insulating layers by chemical or physical means
    • H01L21/31105Etching inorganic layers
    • H01L21/31111Etching inorganic layers by chemical means
    • H01L21/31116Etching inorganic layers by chemical means by dry-etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01JELECTRIC DISCHARGE TUBES OR DISCHARGE LAMPS
    • H01J37/00Discharge tubes with provision for introducing objects or material to be exposed to the discharge, e.g. for the purpose of examination or processing thereof
    • H01J37/32Gas-filled discharge tubes
    • H01J37/32431Constructional details of the reactor
    • H01J37/3244Gas supply means
    • H01J37/32449Gas control, e.g. control of the gas flow
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/304Mechanical treatment, e.g. grinding, polishing, cutting
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/3205Deposition of non-insulating-, e.g. conductive- or resistive-, layers on insulating layers; After-treatment of these layers
    • H01L21/321After treatment
    • H01L21/3213Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer
    • H01L21/32133Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only
    • H01L21/32135Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only
    • H01L21/32136Physical or chemical etching of the layers, e.g. to produce a patterned layer from a pre-deposited extensive layer by chemical means only by vapour etching only using plasmas
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/67Apparatus specially adapted for handling semiconductor or electric solid state devices during manufacture or treatment thereof; Apparatus specially adapted for handling wafers during manufacture or treatment of semiconductor or electric solid state devices or components ; Apparatus not specifically provided for elsewhere
    • H01L21/67005Apparatus not specifically provided for elsewhere
    • H01L21/67011Apparatus for manufacture or treatment
    • H01L21/67017Apparatus for fluid treatment
    • H01L21/67063Apparatus for fluid treatment for etching
    • H01L21/67069Apparatus for fluid treatment for etching for drying etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76801Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
    • H01L21/76802Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
    • H01L21/76816Aspects relating to the layout of the pattern or to the size of vias or trenches
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76801Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
    • H01L21/7682Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing the dielectric comprising air gaps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76801Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
    • H01L21/76837Filling up the space between adjacent conductive structures; Gap-filling properties of dielectrics
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76838Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76838Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
    • H01L21/7684Smoothing; Planarisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L22/00Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
    • H01L22/20Sequence of activities consisting of a plurality of measurements, corrections, marking or sorting steps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L22/00Testing or measuring during manufacture or treatment; Reliability measurements, i.e. testing of parts without further processing to modify the parts as such; Structural arrangements therefor
    • H01L22/10Measuring as part of the manufacturing process
    • H01L22/12Measuring as part of the manufacturing process for structural parameters, e.g. thickness, line width, refractive index, temperature, warp, bond strength, defects, optical inspection, electrical measurement of structural dimensions, metallurgic measurement of diffusions

Landscapes

  • Engineering & Computer Science (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Chemical & Material Sciences (AREA)
  • General Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Plasma & Fusion (AREA)
  • Inorganic Chemistry (AREA)
  • Analytical Chemistry (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
  • Drying Of Semiconductors (AREA)

Abstract

【課題】エアギャップが形成された半導体装置において、良好な歩留まりを実現可能とする技術を提供する。
【解決手段】
上記課題を解決するために、第一の層間絶縁膜と、前記第一の層間絶縁膜上に形成され、配線として用いられる複数の銅含有膜が埋め込まれる溝と、前記溝の間に設けられ、前記銅含有膜間を絶縁する配線間絶縁膜と、を有する配線層が形成された基板のうち、前記配線層の膜厚情報を受信する工程と、前記基板を処理室の内側に設けられた基板載置部に載置する工程と、前記配線層の膜厚情報に対応したエッチング制御値に基づいて、前記配線層をエッチングする工程と、を有する技術を提供する。
【選択図】図1

Description

本発明は、半導体装置の製造方法、基板処理装置、プログラムおよび記録媒体に関する。
近年、半導体装置は高集積化の傾向にあり、それに伴って配線間が微細化される。このため、配線間において電気的容量が大きくなり、信号の伝搬速度の低下を引き起こすなどの問題がある。そこで、配線間をできるだけ低誘電率化することが求められている。
低誘電率化を実現する方法の一つとして、配線間に空隙を設けるエアギャップ構造が検討されている。空隙を形成する方法として、例えば配線間をエッチングする方法がある。例えば特許文献1にエアギャップの形成方法が記載されている。
特開2006−334703
ところが、配線の一部の構造では電界が強くなるため、その部分において電気的容量が大きくなることが懸念される。そのため、歩留まりの低下等を引き起こす恐れがある。
そこで本発明は、エアギャップが形成された半導体装置において、良好な歩留まりを実現可能とする技術を提供することを目的とする。
上記課題を解決するために、第一の層間絶縁膜と、前記第一の層間絶縁膜上に形成され、配線として用いられる複数の銅含有膜が埋め込まれる溝と、前記溝の間に設けられ、前記銅含有膜間を絶縁する配線間絶縁膜と、を有する配線層が形成された基板のうち、前記配線層の膜厚情報を受信する工程と、前記基板を処理室の内側に設けられた基板載置部に載置する工程と、前記配線層の膜厚情報に対応したエッチング制御値に基づいて、前記配線層をエッチングする工程とを有する技術を提供する。
本発明に係る技術によれば、エアギャップが形成された半導体装置において、良好な歩留まりを実現可能とする技術を提供することができる。
一実施形態に係る半導体デバイスの製造フローを説明する説明図である。 一実施形態に係るウエハの説明図である。 一実施形態に係るウエハの処理状態を説明する説明図である。 一実施形態に係る研磨装置を説明する説明図である。 一実施形態に係る研磨装置を説明する説明図である。 一実施形態に係る研磨後の膜厚分布を説明する説明図である。 一実施形態に係るウエハの処理状態を説明する説明図である。 一実施形態に係るウエハの処理状態を説明する説明図である。 一実施形態に係るウエハの処理状態を説明する説明図である。 一実施形態に係るウエハの処理状態と、その比較例を説明する説明図である。 一実施形態に係る基板処理装置を説明する説明図である。 一実施形態に係る基板処理装置を説明する説明図である。 一実施形態に係る基板処理装置を説明する説明図である。 一実施形態に係る基板処理装置を説明する説明図である。 一実施形態に係る基板処理装置を説明する説明図である。 一実施形態に係る基板処理装置を説明する説明図である。 一実施形態に係る基板処理フローを説明する説明図である。 一実施形態に係るウエハの処理状態を説明する説明図である。 一実施形態に係るウエハの処理状態を説明する説明図である。 一実施形態に係る基板処理装置を説明する説明図である。
(第一の実施形態)
以下に本発明の第一の実施形態について説明する。
図1を用いて、半導体装置の製造工程の一工程を説明する。
(配線層形成工程S101)
配線層形成工程S101について説明する。
配線層形成工程S101に関し、図2を用いて説明する。図2は、半導体ウエハ200に形成する配線層2006を説明した図である。配線層2006は、第一の層間絶縁膜2001上に形成される。第一の層間絶縁膜2001より下方には、図示しない電極層が存在し、電極層にはゲート電極、アノード等の構成が設けられている。
絶縁膜2001は例えばポーラス状の炭素含有シリコン膜(SiOC膜)である。絶縁膜2001上には、配線間絶縁膜2002が形成されている。配線間絶縁膜2002は、例えばSiOC膜で形成される。
配線間絶縁膜2002には複数の溝2003が設けられ、溝2003の表面にはバリア膜2004が形成されている。バリア膜2004は、例えば窒化タンタル膜(TaN膜)である。
バリア膜2004上には、スパッタ等によって銅含有膜2005が形成される。銅含有膜2005は、後に配線として用いられる。ところで基板面内均一性の観点から、各配線の抵抗値等を等しくする必要がり、そのために溝2003内を充填させる必要がある。そこで銅含有膜2005を形成する際には、銅含有膜2005が溝2003の上端からはみ出すように形成される。
なお、本実施形態においては、溝2003内の銅含有膜2005を銅含有膜2005aと呼び、溝2003の上端からはみ出した部分を銅含有膜2005bと呼ぶ。銅含有膜2005は、例えば銅で構成される。
(銅含有膜研磨工程S102)
形成された銅含有膜2005は、配線層2006上で物理的に接続され、電気的に接続された状態となっている。そこで隣接する銅含有膜2005aを絶縁するために、配線層2006上を研磨装置にて研磨する。具体的には、銅含有膜2005bを研磨する。
隣接する銅含有膜2005aを確実に絶縁するために、配線間絶縁膜2002の上端よりも低い位置まで研磨し、図3に記載のように、配線層2006上の銅含有膜2005bを除去する。
ここで、図4、図5を用いて、研磨装置400について説明する。
図4において、401は研磨盤であり、402はウエハ200を研磨する研磨布である。研磨盤401は図示しない回転機構に接続され、ウエハ200を研磨する際は、矢印406方向に回転される。
403は研磨ヘッドであり、研磨ヘッド403の上面には、軸404が接続される。軸404は図示しない回転機構・上下駆動機構に接続される。ウエハ200を研磨する間、矢印407方向に回転される。
405はスラリー(研磨剤)を供給する供給管である。ウエハ200を研磨する間、供給管405から研磨布402に向かってスラリーが供給される。
続いて、図5を用いて、研磨ヘッド403とその周辺構造の詳細を説明する。図5は研磨ヘッド403の断面図を中心に、その周辺構造を説明する説明図である。研磨ヘッド403は、トップリング403a、リテナーリング403b、弾性マット403cを有する。研磨する間、ウエハ200の外側はリテナーリング403bによって囲まれると共に、弾性マット403cによって研磨布402に抑えつけらえる。リテナーリング403bには、リテナーリング403bの外側から内側にかけてスラリーが通過するための溝403dが形成されている。溝403dはリテナーリング403bの形状に合わせて、円周状に複数設けられている。溝403dを介して、フレッシュなスラリーと、使用済みのスラリーが入れ替わるよう構成されている。
続いて、本工程における動作を説明する。
研磨ヘッド403内にウエハ200を搬入したら、供給管405からスラリーを供給すると共に、研磨盤401及び研磨ヘッド403を回転させる。スラリーはリテナーリング403b内に流れ込み、ウエハ200の表面を研磨する。このように研磨することで、図3に記載のように、銅含有膜2005bを除去することができる。所定の時間研磨したら、ウエハ200を搬出する。
ところで、研磨後の配線層2006のウエハ面内の膜厚分布を調査したところ、ウエハ200の面内では、図3のように、配線間絶縁膜2002の高さが揃わない場合があることがわかった。ウエハ面内で確認すると例えば図6のように、ウエハ200の外周面の膜厚が中央面に比べて薄い分布Aや、ウエハ200の中央面の膜厚が外周面に比べて厚い分布Bが見受けられる。
膜厚分布に偏りがあると、後述する空隙形成工程106にて、空隙を所望の深さまで形成することができる箇所とできない箇所が存在してしまう、という問題がある。ここでいう空隙とは、後にエアギャップとして用いられる空隙である。これらのばらつきは、半導体装置の歩留まり低下を引き起こす。
発明者による鋭意研究の結果、分布A、分布Bそれぞれに原因があることがわかった。以下にその原因を説明する。
分布Aの原因はウエハに対するスラリーの供給方法である。前述のように、研磨布402に供給されたスラリーはリテナーリング403bを介して、ウエハ200の周囲から供給される。そのため、ウエハ200の中央面にはウエハ外周面を研磨した後のスラリーが流れ込み、一方ウエハ外周面にはフレッシュなスラリーが流れ込む。フレッシュなスラリーは研磨効率が高いため、ウエハ200の外周面は中央面よりも研磨されてしまう。以上のことから、配線層2006の膜厚は分布Aのようになると考えられる。
分布Bになる原因はリテナーリング403bの摩耗である。研磨装置400にて多くのウエハを研磨すると、研磨布402に押し付けられたリテナーリング403bの先端が摩耗し、溝403dや研磨布402との接触面が変形したりする。そのため、本来供給されるべきスラリーがリテナーリング403bの内周に供給されない場合がある。このような場合、ウエハ200の外周面にスラリーが供給されないので、ウエハ200の中央面が研磨され、外周面が研磨されない状態になる。従って、配線層2006の膜厚は分布Bのようになると考えられる。
(膜厚測定工程S103)
本工程では、配線層2006の膜厚を測定する。測定は、例えば既存の光学測定装置にて行い、ここでは光が透過する配線間絶縁膜2002を対象に行う。測定箇所は基板面内において少なくとも二箇所であり、一箇所はウエハ200の中央面である。もう一箇所はウエハ200の外周面である。本実施形態においては、ウエハ中央面における配線間絶縁膜2002を配線間絶縁膜2002aと呼び、ウエハ外周面における配線間絶縁膜2002を配線間絶縁膜2002bと呼ぶ。
測定装置は、図3の状態のウエハ200を測定し、具体的には配線間絶縁膜2002aの高さHaと、配線間絶縁膜2002bの高さHbを測定する。なお、ここでいう配線間絶縁膜の高さとは、第一の層間絶縁膜2001の上端から配線間絶縁膜2002の上端までの幅をいう。
配線間絶縁膜の膜厚を測定すると共に、膜厚分布を測定し、測定装置はそれらの情報を上位装置に送信する。
(拡散防止膜形成工程S104)
続いて、拡散防止膜形成工程S104について、図7を用いて説明する。ここでは図3の配線層2006が形成された状態のウエハ200に対して、拡散防止膜2007を形成する。拡散防止膜2007は、例えばSiON膜である。拡散防止膜2007は絶縁性の性質および拡散を抑制する性質を有する。拡散防止膜2007を形成することで、銅含有膜2005の成分が上層への拡散を抑制することができる。また、著しく配線間が狭い場合には、配線層2006上に形成される上層を介して隣接する配線(銅含有膜2005)同士が導通する恐れがあるが、拡散防止膜2007によってそれを抑制することができる。本実施形態においては、ウエハ中央面における拡散防止膜2007を拡散防止膜2007aと呼び、ウエハ外周面における拡散防止膜2007を拡散防止膜2007bと呼ぶ。
(レジスト塗布・露光工程S105)
次にレジスト塗布・露光工程S105について説明する。
ここでは、図7に記載の拡散防止膜2007が形成された状態のウエハ200を処理する。まず、拡散防止膜2007上に、パターニング用のレジスト層2008を形成する。その後露光処理を行い、図8に記載のように、レジスト層2008を所望のパターンに形成する。本実施形態においては、ウエハ中央面におけるレジスト層2008をレジスト層2008aと呼び、ウエハ外周面におけるレジスト層2008をレジスト層2008bと呼ぶ。
(空隙形成工程S106)
レジスト層2008を所望のパターンに形成したら、エッチング処理を行い、図9に記載のように、配線間絶縁膜2002の一部をエッチングし、銅含有膜2005間に空隙2009を形成する。たとえば、隣り合う銅含有膜2005の間に空隙2009を形成する。空隙2009は、後にエアギャップとして構成される。本実施形態においては、ウエハ中央面における空隙2009を空隙2009aと呼び、ウエハ外周面における空隙2009を空隙2009bと呼ぶ。空隙2009を形成後、レジスト2008を除去する。
ここで本実施形態における空隙について詳細を説明する。
近年の微細化、高密度化に伴い、配線間の距離が狭くなってきている。そうなると配線間でコンデンサ容量が増加して信号遅延が発生するという問題がある。この場合、従来同様、配線間に低誘電率の絶縁物を充填することが考えられるが、それには物理的な限界がある。それを回避するために、配線間にエアギャップと呼ばれる空隙を設け、誘電率を下げる。
ところで、エアギャップ構造においても、隣接する配線が導通してしまうことが考えられる。これに関して本実施形態である図10(A)と、本実施形態の比較例である図10(B)を用いて説明する。図10は空隙が形成された箇所を拡大した図である。ここでは、一方の溝2003を溝2003aとし、隣接する溝2003を溝2003bと呼ぶ。更には、溝2003a、溝2003bそれぞれの底(溝の下端とも呼ぶ。)のうち、空隙2009を介して隣接する部分を溝2003cと呼ぶ。なお、溝2003cは点線○で囲む箇所である。
図10(A)、(B)それぞれの空隙2009は、溝2003に挟まれる空間である空間2010を有する。図10(A)においては、更に空間2011を有する。空間2011は、溝2003の底位置よりも下方の位置に設けられた空間である。即ち、溝2003cよりも下方に設けられている。空間2011は、例えば配線間絶縁膜2001に設けられる。
ところで、このように溝2003中に銅含有膜2003を充填した場合、溝2003cにおいて電界が集中する。そのため、図10(B)のような構成の場合、点線矢印2012のように、層間絶縁膜2001を介して電流がリークする恐れがある。そうなると、配線間の距離が縮まっている場合、リーク電流によって隣接する配線同士が導通してしまうという問題が発生する。
そこで発明者は、図10(A)のように、空間2011を設けることとした。このようにすることで、溝2003cよりも下方においても空隙が形成されるので、図10(B)のようにリーク電流によって隣接する配線同士が導通するという問題を抑制することが可能となる。
(基板処理装置)
次に、空隙形成工程S106で使用する基板処理装置100について、図11から図16を用いて説明する。本実施形態においては、基板処理装置100は空隙2009を形成するためのエッチング装置として用いられる。本実施形態においては、基板処理装置100は、図11に示されているように、枚葉式基板処理装置として構成されている。
図11に示すとおり、基板処理装置100は処理容器202を備えている。処理容器202は、例えば横断面が円形であり扁平な密閉容器として構成されている。また、処理容器202は、例えばアルミニウム(Al)やステンレス(SUS)などの金属材料または、石英により構成されている。処理容器202内には、基板としてのシリコンウエハ等のウエハ200を処理する処理空間(処理室)201、搬送室203が形成されている。処理容器202は、上部容器202aと下部容器202bで構成される。上部容器202aと下部容器202bの間には仕切り板204が設けられる。上部処理容器202aに囲まれた空間であって、仕切り板204よりも上方の空間を処理空間と呼び、それを構成する部屋を処理室201と呼ぶ。下部容器202bに囲まれた空間であって、仕切り板よりも下方の空間を搬送空間と呼び、それを構成する部屋を搬送室203と呼ぶ。仕切り板204は絶縁体で構成されており、後述する基板載置台212と下部容器202bを絶縁する。
上部容器202aと下部容器202bとの間には、絶縁体で構成され、上部容器202aを支持する支持部208が設けられる。支持部208は、上部容器202aと下部容器202bとを電気的に絶縁する。
下部容器202bの側面には、ゲートバルブ205に隣接した基板搬入出口206が設けられており、ウエハ200は基板搬入出口206を介して図示しない搬送室との間を移動する。下部容器202bの底部には、リフトピン207が複数設けられている。
処理室201内には、ウエハ200を支持する基板載置部210が設けられている。基板載置部210は、ウエハ200を載置する載置面211と、載置面211を表面に持つ基板載置台212とを有する。基板載置台212内には後述するバイアス電極219が設けられている。基板載置台212には、リフトピン207が貫通する貫通孔214が、リフトピン207と対応する位置にそれぞれ設けられていても良い。
基板載置台212はシャフト217によって支持される。シャフト217は、処理容器202の底部を貫通しており、更には処理容器202の外部で昇降機構218に接続されている。昇降機構218を作動させてシャフト217及び基板載置台212を昇降させることにより、基板載置面211上に載置されるウエハ200を昇降させることが可能に構成される。なお、シャフト217下端部の周囲はベローズ216により覆われており、処理室201内は気密に保持されている。
基板載置台212は、ウエハ200の搬送時には、基板載置面211が基板搬入出口206の位置(ウエハ搬送位置)となるように下降し、ウエハ200の処理時には図11で示されるように、ウエハ200が処理室201内の処理位置(ウエハ処理位置)まで上昇する。
具体的には、基板載置台212をウエハ搬送位置まで下降させた時には、リフトピン207の上端部が基板載置面211の上面から突出して、リフトピン207がウエハ200を下方から支持するようになっている。また、基板載置台212をウエハ処理位置まで上昇させたときには、リフトピン207は基板載置面211の上面から埋没して、基板載置面211がウエハ200を下方から支持するようになっている。なお、リフトピン207は、ウエハ200と直接触れるため、例えば、石英やアルミナなどの材質で形成することが望ましい。なお、リフトピン207に昇降機構を設けて、基板載置台212とリフトピン207が相対的に動くように構成してもよい。
バイアス電極219について図12、図13を用いて説明する。基板載置台212には、バイアス電極219としての第1バイアス電極219aと第2バイアス電極219bが設けられている。第1バイアス電極219aは、整合器220aと接続され、第2バイアス電極219bは、整合器220bと接続される。更に、第1バイアス電極219a、第2バイアス電極219bは、それぞれアースに接続される。図13に示すように第1バイアス電極219aと第2バイアス電極219bは、同心円状に形成され、基板の中心側の電位と外周側の電位を調整可能に構成される。
また、整合器220aに高周波電源221aを設け、整合器220bに高周波電源221bを設ける様に構成しても良い。高周波電源221aを設けることによって、第1バイアス電極219aの電位の調整幅を広げることができ、ウエハ200の中心側に引き込まれる活性種の量の調整幅を広げることができる。また、高周波電源221bを設けることによって、第2バイアス電極219bの電位の調整幅を広げることができ、ウエハ200の外周側に引き込まれる活性種の量の調整幅を広げることができる。例えば、活性種がプラスの電位の場合に、第1バイアス電極219aの電位をマイナスとなる様に構成し、第2バイアス電極219bの電位を第1バイアス電極219aの電位よりも高くなるように構成することによって、ウエハ200の外周側に供給される活性種量よりも中心側に供給される活性種量を多くすることができる。また、処理室201内に生成される活性種の電位が中性に近い場合であっても、高周波電源221aと高周波電源221bのいずれか若しくは両方を用いることによって、ウエハ200に引き込む量を調整することができる。
本実施形態においては、バイアス電極219、整合器220a、整合器220bをバイアス調整部と呼ぶ。高周波電源221a、高周波電源221bをバイアス調整部に含めても良い。
(排気系)
処理室201(上部容器202a)の内壁上面には、処理室201の雰囲気を排気する排気口223が設けられている。排気口223には排気管224が接続されており、排気管224には、処理室201内を所定の圧力に制御するAPC(Auto Pressure Controller)等の圧力調整器225、真空ポンプ226が順に直列に接続されている。主に、排気口223、排気管224、圧力調整器225により、排気部(排気ライン)が構成される。なお、真空ポンプ226を排気部に含めるように構成しても良い。
(バッファ室)
処理室201の上方には、バッファ室232が設けられている。バッファ室232は、側壁232a、天井232bにより構成されている。バッファ室232は、シャワーヘッド234を内包する。バッファ室232の内壁232aとシャワーヘッド234との間には、ガス供給経路235が構成される。即ち、ガス供給経路235はシャワーヘッド234の外壁234bを囲むように設けられる。
シャワーヘッド234と処理室201を区画する壁には、分散板234aが設けられる。分散板234aは例えば円盤状に構成される。処理室201側から見ると、図14のようにガス供給経路235はシャワーヘッド側壁234bと側壁232aの間であって、分散板234の水平方向周囲に設けられた構造となる。
バッファ室232の天井232bには、ガス導入管236が貫通されている。更に、ガス導入管238が接続されている。ガス導入管236はシャワーヘッド234に接続される。ガス導入管236、ガス導入管238は後述するガス供給系に接続される。
ガス導入管236から導入されたガスはシャワーヘッド234を介して処理室201に供給される。ガス導入管238から導入されたエッチングガスはガス供給経路235を介して処理室201に供給される。
シャワーヘッド234から供給されたガスはウエハ200の中心に供給される。ガス供給経路235から供給されたガスはウエハ200の外周面に供給される。ウエハの外周面(エッジ)とは、前述のウエハ中心に対して、その外周をいう。
シャワーヘッド234は、例えば、石英、アルミナ、ステンレス、アルミなどの材料で構成される。
(ガス供給系)
続いて、図15を用いてガス供給系を説明する。
図15のA1は図11のA1に接続され、A2は図11のA2に接続される。即ち、ガス供給管241aはガス導入管236に接続され、ガス供給管242aはガス導入管238に接続される。
ガス供給管241aには、上流から合流管240b、マスフローコントローラ241b、バルブ241cが設けられる。マスフローコントローラ241b、バルブ241cによって、ガス供給管241aを通過するガスの流量が制御される。合流管240bの上流にはシリコンを含む膜をエッチング可能なフッ素系エッチングガスのガス源240aが設けられる。エッチングガスとしては、例えば四フッ化炭素(CF4)や六フッ化エタン(C2F6)などのフッ素系ガスが用いられる。
好ましくは、バルブ241cの下流側に、不活性ガスを供給するための第一の不活性ガス供給管243aが接続される。不活性ガス供給管243aには、上流から不活性ガス源243b、マスフローコントローラ243c、バルブ243dが設けられる。不活性ガスは例えば窒素(N2)ガスが用いられる。不活性ガスは、ガス供給管241aを流れるガスに添加され、希釈ガスとして使用される。マスフローコントローラ243c、バルブ243dを制御することで、ガス導入管236、シャワーヘッド234を介して供給するエッチングガスの濃度や流量を、より最適にチューニングすることができる。
ガス導入管238と接続されるガス供給管242aには、上流から合流管240b、マスフローコントローラ242b、バルブ242cが設けられる。マスフローコントローラ242b、バルブ242cによって、ガス供給管242aを通過するガスの流量が制御される。合流管240bの上流にはエッチングガスのガス源240aが設けられる。
好ましくは、バルブ242cの下流側に、不活性ガスを供給するための第二の不活性ガス供給管244aが接続される。不活性ガス供給管244aには、上流から不活性ガス源244b、マスフローコントローラ244c、バルブ244dが設けられる。不活性ガスは例えばヘリウム(He)ガスが用いられる。不活性ガスは、ガス供給管242aを流れるガスに添加され、希釈ガスとして使用される。マスフローコントローラ244c、バルブ244dを制御することで、ガス導入管238、ガス供給経路235を流れるガスの濃度や流量を、より最適にチューニングすることができる。
ガス供給管241a、マスフローコントローラ241b、バルブ241c、ガス供給管242a、マスフローコントローラ242b、バルブ242c、合流管240bをまとめてエッチングガス供給部と呼ぶ。なお、ガス源240a、ガス導入管236、ガス導入管238をガス供給部に含めても良い。
第一の不活性ガス供給管243a、マスフローコントローラ243c、バルブ243d、第二の不活性ガス供給管244a、マスフローコントローラ244c、バルブ244dをまとめて不活性ガス供給部と呼ぶ。なお、不活性ガス源243b、不活性ガス源244bを不活性ガス供給部に含めても良い。
更には、エッチングガス供給部に不活性ガス供給部を含めても良い。
(プラズマ生成部)
上部容器202aにはプラズマ生成部215が接続される。プラズマ生成部215は、電源215aと整合部215bとそれらを上部容器202aに接続する配線215cを少なくとも有する。プラズマ生成部215は後述するコントローラ260に接続される。
プラズマ生成部215において、電源215aがオンになると、処理室201に供給されたエッチングガスはプラズマ状態となる。電源215のオン/オフの切り替えは、コントローラ260の指示によって制御される。
(コントローラ)
基板処理装置100は、基板処理装置100の各部の動作を制御するコントローラ260を有している。
コントローラ260の概略を図16に示す。制御部(制御手段)であるコントローラ260は、CPU(Central Processing Unit)260a、RAM(Random Access Memory)260b、記憶部としての記憶装置260c、I/Oポート260dを備えたコンピュータとして構成されている。RAM260b、記憶装置260c、I/Oポート260dは、内部バス260fを介して、CPU260aとデータ交換可能なように構成されている。基板処理装置100内のデータの送受信は、送受信部260eの支持により行われる。
コントローラ260には、例えばタッチパネル等として構成された入出力装置261や、外部記憶装置262が接続可能に構成されている。更に、上位装置270にネットワークを介して接続される受信部263が設けられる。受信部260は、上位装置から他の装置の情報を受信することが可能である。
記憶装置260cは、例えばフラッシュメモリ、HDD(Hard Disk Drive)等で構成されている。記憶装置260c内には、基板処理装置の動作を制御する制御プログラムや、後述する基板処理の手順や条件などが記載されたプロセスレシピ等が読み出し可能に格納されている。例えば、配線層2006の膜厚分布と、ガス供給部やプラズマ生成部の制御とを関連させたデータ等が記憶されている。なお、プロセスレシピは、後述する基板処理工程における各手順をコントローラ260に実行させ、所定の結果を得ることが出来るように組み合わされたものであり、プログラムとして機能する。以下、このプログラムレシピや制御プログラム等を総称して、単にプログラムともいう。なお、本明細書においてプログラムという言葉を用いた場合は、プログラムレシピ単体のみを含む場合、制御プログラム単体のみを含む場合、または、その両方を含む場合がある。また、RAM260bは、CPU260aによって読み出されたプログラムやデータ等が一時的に保持されるメモリ領域(ワークエリア)として構成されている。
I/Oポート260dは、ゲートバルブ205、昇降機構218、バイアス電極219、圧力調整器225、真空ポンプ226等、基板処理装置100の各構成に接続されている。
CPU260aは、記憶装置260cからの制御プログラムを読み出して実行すると共に、入出力装置261からの操作コマンドの入力等に応じて記憶装置260cからプロセスレシピを読み出すように構成されている。そして、CPU260aは、読み出されたプロセスレシピの内容に沿うように、ゲートバルブ205の開閉動作、昇降機構218の昇降動作、バイアス電極219への電力供給動作、圧力調整器225の圧力調整動作、真空ポンプ226のオンオフ制御、マスフローコントローラの流量調整動作、バルブ等を制御可能に構成されている。
なお、コントローラ260は、専用のコンピュータとして構成されている場合に限らず、汎用のコンピュータとして構成されていても良い。例えば、上述のプログラムを格納した外部記憶装置(例えば、磁気テープ、フレキシブルディスクやハードディスク等の磁気ディスク、CDやDVD等の光ディスク、MOなどの光磁気ディスク、USBメモリやメモリカード等の半導体メモリ)262を用意し、係る外部記憶装置262を用いて汎用のコンピュータにプログラムをインストールすること等により、本実施形態に係るコントローラ260を構成することができる。なお、コンピュータにプログラムを供給するための手段は、外部記憶装置262を介して供給する場合に限らない。例えば、インターネットや専用回線等の通信手段を用い、外部記憶装置262を介さずにプログラムを供給するようにしても良い。なお、記憶装置260cや外部記憶装置262は、コンピュータ読み取り可能な記録媒体として構成される。以下、これらを総称して、単に記録媒体ともいう。なお、本明細書において、記録媒体という言葉を用いた場合は、記憶装置260c単体のみを含む場合、外部記憶装置262単体のみを含む場合、または、その両方を含む場合がある。
(基板処理方法)
続いて、基板処理装置100を用いた空隙形成方法について、図17を用いて説明する。図17は、図1における空隙形成工程S106の詳細を説明した図である。空隙形成方法は基板処理方法の一つである。なお、以下の説明において、基板処理装置を構成する各部の動作はコントローラ260により制御される。
(膜厚情報受信工程S3002)
膜厚測定工程S103で測定した膜厚情報を、上位装置270から受信部263が受信する。受信した情報は、配線間絶縁膜2002の膜厚情報である。具体的には、配線間絶縁膜2002aや配線間絶縁膜2002bの膜厚情報である。本実施形態においては膜厚分布情報とも呼ぶ。受信した情報は、RAM260bに一時的に格納される。
(基板搬入工程S3004)
レジスト塗布・露光工程S105の後、ウエハ200は基板処理装置100に搬入される。
ここでは、基板載置部210を昇降機構218によって下降させ、リフトピン207が貫通孔214から基板載置部210の上面側に突出させた状態にする。また、処理室201内を所定の圧力に調圧した後、ゲートバルブ205を開放し、ゲートバルブ205からリフトピン207上にウエハ200を載置させる。ウエハ200をリフトピン207上に載置させた後、昇降部218によって基板載置部210を所定の位置まで上昇させることによって、ウエハ200が、リフトピン207から基板載置部210へ載置されるようになる。
(エッチング制御値調整工程S3006)
CPU260aはRAM260bに受信された膜厚情報と、記憶装置260cに記憶されたエッチング制御値データベースを読み出す。ここでいうエッチング制御値とは、例えばマスフローコントローラ、バルブ、プラズマ生成部等の制御データやそれらの稼働時間等のデータである。
続いてCPU260aは、受信した膜厚情報とエッチング制御データベースとを比較すると共に、膜厚情報に応じたエッチング制御値を抽出する。更に、CPU260aは、抽出したエッチング制御値を実現するよう、各構成に指示する。
次に、抽出されたエッチング制御値に基づいた処理について概要を説明する。詳細は後述する。
まず、処理室201内が所定の圧力(真空度)となるように、排気管224を介して処理室201内を排気する。この際、抽出したエッチング制御値の圧力値となるよう、圧力調整器225としてのAPCバルブの弁の開度をフィードバック制御する。
ウエハ200が基板載置部210に載置され、処理室201内の雰囲気が安定した後、マスフローコントローラ241b、マスフローコントローラ242b、プラズマ制御部215を稼働させると共に、バルブ241c、バルブ242cの開度を調整する。このとき、マスフローコントローラ243c、マスフローコントローラ244cを稼働させると共に、バルブ252d、バルブ244dの開度を調整しても良い。
(エッチングガス供給工程S3008)
エッチングガス供給工程では、ガス供給系から処理室201にガスを供給する。
ここでは、エッチング制御値調整工程S3006で調整されたマスフローコントローラやバルブを制御して、ウエハの中央面に供給するガスの量(もしくは濃度)と外周面に供給するガスの量(もしくは濃度)をそれぞれ制御する。
供給されたエッチングガスは、プラズマ生成部215によってプラズマ状態とされる。プラズマ状態のエッチングガスは処理室201内に供給され、ウエハ200と反応し、空隙2009を形成する。
なお、エッチングガスを供給する際、バイアス調整部によって基板載置部210のバイアスを調整しても良い。バイアスを調整する際は、上位装置270から受信した配線間絶縁膜2002の膜厚測定データに応じて、高周波電源221a、高周波電源221bを制御し、第1バイアス電極219aの電位と第2バイアス電極219bの電位を調整する。
このようにウエハ200の中央または外周それぞれに到達するエッチングガスのイオン成分量を調整することで、ウエハ200の中央と外周とでエッチング量を調整することができる。
更には、高周波電源を用いることから、より確実な異方性エッチングを実現することができる。したがって、空隙2009と溝2003の間の壁2013の厚みを確保しつつ、空隙2009を形成することが可能となる。このようにすることで、空隙形成後の半導体装置の構造では、横方向に対する強度を保つことができる。仮に高周波電源を用いない場合、イオンの引き込みが弱くなるため壁2013をエッチングしてしまうことが考えられる。この場合、配線の横方向の強度が低くなってしまう恐れがある。
所定の時間経過後、各バルブを閉じて、ガスの供給を停止する。
(基板搬出工程S3010)
成膜工程が終わった後、基板載置部210を昇降機構218によって下降させ、リフトピン207が貫通孔214から基板載置部210の上面側に突出させた状態にする。また、処理室201内を所定の圧力に調圧した後、ゲートバルブ205を解放し、ウエハ200をリフトピン207上からゲートバルブ205外へ搬送する。
続いて、本実施形態におけるエッチング制御値調整工程S3006の詳細について説明する。
前述のように、研磨工程S102終了後、配線間絶縁膜2002は、ウエハの中央面と外周面とで膜厚が異なってしまう。測定工程S103ではその膜厚分布を測定する。測定結果は上位装置270を通して、RAM260bに格納される。格納されたデータは記憶装置260c内のレシピと比較され、そのレシピに基づいた装置制御が為される。
次に、RAM260bに格納されたデータが分布Aである場合を説明する。分布Aの場合とは、図6、図7に記載のように、配線間絶縁膜2002aの膜厚Haが配線間絶縁膜2002b膜厚Hbよりも厚い場合をいう。
分布Aの場合、本工程では、ウエハ中央面のエッチング量に対して、ウエハ外周面のエッチング量を少なくするよう制御する。例えば、エッチングガスの供給量を10〜100sccmとする。更には、エッチング時間を膜厚が厚いほう、即ちウエハ中央のエッチング時間に合わせる。本実施形態においては、前述したように少なくとも空間2011を形成できる程度の時間でエッチング処理を行うものとする。また、最大でも、層間絶縁膜2001を貫通しない程度のエッチング時間とする。例えば、30〜120秒である。
ここで、膜厚が厚い方にエッチング時間を合わせる理由を説明する。仮に膜厚が薄いほう(分布Aの場合はウエハ外周、分布Bの場合はウエハ中央)にエッチング時間を合わせた場合、膜厚が厚いほう(分布Aの場合はウエハ中央、分布Bの場合はウエハ外周)にてエッチング量が不十分となる恐れがある。そのため、空間2011を形成できない恐れがある。その場合、配線間の導通につながってしまう。
そこで、本実施形態においては、膜厚が厚いほうにエッチング時間を合わせることで、ウエハ200の中央と外周において、確実に空間2011を形成可能とする。
続いて、ウエハ200の中央面のエッチング量を多くし、ウエハ200の外周面のエッチング量をウエハ中央面よりも少なくする具体的な方法を説明する。ここではエッチングガスを供給する際、ウエハ200の外周面に供給するエッチングガスの成分を、中央面よりも少なくするよう制御する。
このときガス供給系では、マスフローコントローラ241bを制御すると共に、バルブ241cの開度を制御し、シャワーヘッド234から処理室201に供給するエッチングガスの量を制御する。更に、マスフローコントローラ242bを制御すると共に、バルブ242cの開度を制御し、ガス供給経路235から処理室201にエッチングガスを供給する。ウエハ表面における単位面積当たりのエッチングガスの暴露量は、ガス供給経路235から供給されるガスの暴露量がシャワーヘッドから供給されるガスの暴露量よりも少なくなるよう制御される。
シャワーヘッド234を介して供給されたエッチングガスは、ウエハ200の中央面に形成された配線間絶縁膜2002a上に供給される。供給されたエッチングガスは、図9に記載のように、配線間絶縁膜2002aをエッチングし、溝2009aを形成する。
ガス供給経路235を介して供給されたエッチングガスはウエハ200の外周面に形成された配線間絶縁膜2002b上に供給される。供給されたエッチングガスは、図9に記載のように、配線間絶縁膜2002bをエッチングし、溝2009bを形成する。
前述のように、ウエハ表面における単位面積当たりのエッチングガスの暴露量は、配線間絶縁膜2002a上が配線間絶縁膜2002b上よりも多くなるので、配線間絶縁膜2002aのエッチング量を配線間絶縁膜2002bのエッチング量よりも多くできる。
このとき、図9、図10(A)に記載のように、溝2009a、溝2009bそれぞれで空間2011が形成されるよう、エッチング時間を調整する。このようにして、ウエハ200の面内において、溝2009に空間2011を形成することが可能となる。したがって、電力成分の漏洩が抑制された、高品質な半導体装置を提供することができる。
なお、エッチングガスの供給を制御する際に、第1バイアス電極219aと第2バイアス電極219bそれぞれの電位を調整してもよい。例えば、第1バイアス電極219aの電位が第2バイアス電極219bの電位よりも低くなるように、高周波電源221aと高周波電源221bがそれぞれ調整される。第1バイアス電極219aの電位を第2バイアス電極219bの電位よりも低くすることによって、ウエハ200の中心側に引き込まれるイオン成分の量を、ウエハ200の外周側に引き込まれるイオン成分の量よりも多くすることができ、ウエハ200の中心側のエッチング量を外周側のエッチング量よりも多くすることができる。
このようにすることで、ウエハ表面における単位面積当たりのエッチングガスの暴露量に関し、シャワーヘッド234から供給されるエッチングガス量がガス供給経路235から供給されるエッチングガス量よりも多くなるよう、より緻密に制御できる。
また、別の方法として、ガス供給管241aとガス供給管242aのエッチングガスの供給量を同じとし、替わりにガス供給管241aとガス供給管242aそれぞれのエッチングガスの濃度を制御しても良い。エッチングガスの濃度を制御する際は、不活性ガス供給系を制御することで、ガス供給管241a、ガス供給管242aを通過するエッチングガスの濃度を制御する。分布Aの場合、ガス供給管243aから供給される不活性ガスの量を、ガス供給管244aから供給される不活性ガスの量よりも少なくし、ガス供給管241aを通過するエッチングガスの濃度を、ガス供給管242aを通過するエッチングガスの濃度よりも高くする。
より良くは、ガス供給管241aとガス供給管242aのエッチングガスの供給量を異ならせると共に、濃度を異ならせても良い。このような制御をすることで、単位面積当たりのエッチングガスの暴露量をより大きい差分で供給することができる。
次に、RAM260bに格納されたデータが分布Bである場合を説明する。分布Bの場合とは、図18に記載のように、配線間絶縁膜2002bの膜厚Hbが配線間絶縁膜2002aの膜厚Haよりも厚い場合をいう。
分布Bの場合、本工程では、ウエハ中央面のエッチング量に対して、ウエハ外周面のエッチング量を多くするよう制御する。例えば、エッチングガスの供給量を10〜100sccmとする。更には、エッチング時間を膜厚が厚いほう、即ちウエハ外周のエッチング時間に合わせる。本実施形態においては、前述したように少なくとも空間2011を形成できる程度の時間でエッチング処理を行うものとする。また、最大でも、層間絶縁膜2001を貫通しない程度のエッチング時間とする。例えば、30〜120秒である。前述したように、膜厚の厚いほうにエッチング時間を合わせることで、ウエハ200の中央と外周において、確実に空間2011を形成できる。
続いて、ウエハ200の中央面のエッチング量を少なくし、ウエハ200の外周面のエッチング量を多くする具体的な方法を説明する。ここではエッチングガスを供給する際、ウエハ200の中央面に供給するエッチングガスの成分を、外周面よりも少なくするよう制御する。
このとき、ガス供給系ではマスフローコントローラ241bを制御すると共に、バルブ241cの開度を制御し、シャワーヘッド234から処理室201に供給するエッチングガスの量を制御する。更に、マスフローコントローラ242bを制御すると共に、バルブ242cの開度を制御し、ガス供給経路235から処理室201にエッチングガスを供給する。ウエハ表面における単位面積当たりのエッチングガスの暴露量は、シャワーヘッド234から供給されるガスの暴露量がガス供給経路235から供給されるガスの暴露量よりも少なくなるよう制御される。
シャワーヘッド234を介して供給されたエッチングガスは、ウエハ200の中央面に形成された配線間絶縁膜2002a上に供給される。供給されたエッチングガスは、図18に記載のように、配線間絶縁膜2002aをエッチングし、溝2009aを形成する。
ガス供給経路235を介して供給されたエッチングガスはウエハ200の外周面に形成された配線間絶縁膜2002b上に供給される。供給されたガスは、図18に記載のように、配線間絶縁膜2002bをエッチングし、溝2009bを形成する。
前述のように、ウエハ表面における単位面積当たりのエッチングガスの暴露量は、配線間絶縁膜2002b上が配線間絶縁膜2002a上よりも多くなるので、配線間絶縁膜2002bのエッチング量を配線間絶縁膜2002aのエッチング量よりも多くすることができる。
このとき、図18、図10(A)に記載のように、溝2009a、溝2009bそれぞれで空間2011が形成されるよう、エッチング時間を調整する。このようにして、ウエハ200の面内において、溝2009に空間2011を形成することが可能となる。したがって、リーク電流が抑制された、高品質な半導体装置を提供することができる。
なお、エッチングガスの供給を制御する際に、第1バイアス電極219aと第2バイアス電極219bそれぞれの電位を調整してもよい。例えば、第2バイアス電極219bの電位が第1バイアス電極219aの電位よりも低くなるように、高周波電源221aと高周波電源221bがそれぞれ調整される。第2バイアス電極219bの電位を第1バイアス電極219aの電位よりも低くすることによって、ウエハ200の外周側に引き込まれるイオン成分の量を、ウエハ200の中心側に引き込まれるイオン成分の量よりも多くすることができ、ウエハ200の外周側のエッチング量を中央側のエッチング量よりも多くすることができる。
このようにすることで、より確実にウエハ表面における単位面積当たりのエッチングガスの暴露量は、ガス供給経路235から供給されるガス量がシャワーヘッド234から供給されるガス量よりも多くなるよう制御できる。
また、別の方法として、ガス供給管241aとガス供給管242aのエッチングガスの供給量を同じとし、替わりにガス供給管241aとガス供給管242aそれぞれのエッチングガスの濃度を制御しても良い。エッチングガスの濃度を制御する際は、不活性ガス供給系を制御することで、ガス供給管241a、ガス供給管242aを通過するエッチングガスの濃度を制御する。分布Bの場合、ガス供給管244aから供給される不活性ガスの量を、ガス供給管243aから供給される不活性ガスの量よりも少なくし、ガス供給管242aを通過するエッチングガスの濃度を、ガス供給管241aを通過するエッチングガスの濃度よりも高くする。
より良くは、ガス供給管241aとガス供給管242aのエッチングガスの供給量を異ならせると共に、濃度を異ならせても良い。このような制御をすることで、単位面積当たりのエッチングガスの暴露量をより大きい差分で供給することができる。
以上説明したように、ウエハ200の単位面積当たりのエッチングガスの量をチューニングすることで、ウエハ200の中央とその外周それぞれでエッチング量を制御することができる。
このとき、ウエハ200の中央とその外周それぞれで空間2011が形成されるようエッチング量、エッチング時間を制御する。
所望の時間エッチング処理を行ったら、ウエハを搬出する。ここでは、基板載置台212を下降させ、基板載置台212の表面から突出させたリフトピン207上にウエハ200を支持させる。これにより、ウエハ200は処理位置から搬送位置となる。
次いで、ウエハ200が搬送位置まで移動すると、搬送室203の雰囲気を排気することにより、チャンバ202を高真空(超高真空)状態(例えば10−5Pa以下)に維持し、同様に高真空(超高真空)状態(例えば10−6Pa以下)に維持されている移載室との圧力差を低減する。所定の圧力に到達したら、図示しないアームによってウエハ200は搬出される。
(層間絶縁膜形成工程S107)
続いて、層間絶縁膜2012を形成する層間絶縁膜形成工程S107について説明する。ここでは分布Aを想定した図19を用いて説明する。エッチング処理により空隙2009を形成したら、ウエハ200を第二の層間絶縁膜を形成する基板処理装置に移動させる。ここでは図19に記載のように、拡散防止膜2007上に、層間絶縁膜2012を形成する。層間絶縁膜2012は、例えば炭素含有シリコン酸化膜(SiOC膜)である。形成する際は、例えばシリコン含有ガスと酸素含有ガスとをウエハ200上に供給して気相反応させ、その後炭素をドーピングする、等の方法が考えられる。
次に、この工程にて空隙2009が確保された状態で層間絶縁膜2012が形成される理由を以下に説明する。
前述のように配線間が非常に狭い場合、層間絶縁膜2012の堆積が進行するに従って、拡散防止膜2007の上部付近では、堆積物に遮られてガスが下方に回りこみにくくなる。このため、空隙2009の下方の堆積速度は、拡散防止膜2007の上方における堆積速度よりも小さくなる。そのような状態で成膜処理を継続することで、空隙2009を確保する。確保された空隙2009はエアギャップとして用いられる。本実施形態においては、ウエハ中央面における層間絶縁膜2012を層間絶縁膜2012aと呼び、ウエハ外周面における層間絶縁膜2012を層間絶縁膜2012bと呼ぶ。以上のようにして、エアギャップを形成する。
(第二の実施形態)
続いて第二の実施形態について説明する。
第二の実施形態では、空隙形成工程S106で使用するエッチング装置が異なる。第一の実施形態では基板処理装置100でエッチング処理を行っていたが、本実施形態では図20に記載の基板処理装置500でエッチング処理を行う。以下に、基板処理装置500の具体的内容を説明する。なお、図面において、第一の実施形態と同様の番号のものは第一の実施形態と同様の構成であるので説明を省略する。
図20に示すとおり、基板処理装置500は処理容器202を備えている。処理容器202内には、基板としてのシリコンウエハ等のウエハ200を処理する処理室201、搬送室203が形成されている。処理容器202は、上部容器202a、下部容器202bで構成される。下部容器202Bはアースに接続される。
(基板載置台)
処理空間201内には、ウエハ200を支持する基板載置部210が設けられている。基板支持部(サセプタ)210は、実施例1の基板処理装置100と同様の構成であるので、ここでは説明を省略する。
(プラズマ生成部)
上部容器202aの上方には、第1プラズマ生成部(上方プラズマ生成部)としての第1コイル250aが設けられている。第1コイル250aには、整合器250dを介して高周波電源250cが接続されている。第1コイル250aに高周波電力が供給されることによって、処理室201に供給されるガスを励起してプラズマを生成可能に構成される。特に、処理室201の上部であって、ウエハ200と対向する空間(第1プラズマ生成領域251)にプラズマが生成される。更に、基板載置台212と対向する空間にプラズマが生成されるように構成しても良い。
また、上部容器202aの側方に、第2プラズマ生成部(側方プラズマ生成部)としての第2コイル250bを設けている。コイル250bには、整合器250eを介して高周波電源250fが接続されている。第2コイル250bに高周波電力が供給されることによって、処理室201に供給されるガスを励起してプラズマを生成可能に構成される。特に、処理室201の側方であって、ウエハ200と対向する空間よりも外側の空間(第2プラズマ生成領域252)にプラズマが生成される。更に、基板載置台212と対向する空間よりも外側にプラズマが生成されるように構成しても良い。
なお、第1プラズマ生成部と第2プラズマ生成部とをまとめてプラズマ生成部と呼ぶ。
(排気系)
搬送室203(下部容器202b)の内壁には、処理空間201の雰囲気を排気する排気部としての排気口223が設けられている。排気口223には排気管224が接続されており、排気管224には、処理空間201内を所定の圧力に制御するAPC(Auto Pressure Controller)等の圧力調整器225、真空ポンプ226が順に直列に接続されている。主に、排気口223、排気管224、圧力調整器225、により排気系(排気ライン)が構成される。なお、真空ポンプ226を排気系(排気ライン)構成の一部に加える様にしても良い。
上部容器202aの上部には、処理空間201内に各種ガスを供給するためのガス導入口251が設けられ、ガス供給管252aが接続されている。
(ガス供給部)
ガス供給管252aを含む第一ガス供給部243からはエッチングガスが主に供給される。
ガス供給管252aには、上流方向から順に、エッチングガス供給源252b、流量制御器(流量制御部)であるMFC252c、及び開閉弁であるバルブ252dが設けられている。
エッチングガスは、エッチングガス供給源252bから、MFC252c、バルブ252d、第一ガス供給管252aを介して処理室201に供給される。
ガス供給管252aのバルブ252dよりも下流側には、不活性ガス供給管253aの下流端が接続されている。不活性ガス供給管253aには、上流方向から順に、不活性ガス供給源253b、MFC253c、及び開閉弁であるバルブ253dが設けられている。不活性ガスは、例えば窒素(N2)ガスである。
主に、ガス供給管252a、MFC252c、バルブ252dにより、エッチングガス供給系253が構成される。本実施形態においては、エッチングガス供給系253をエッチングガス供給部と呼ぶ。
また、主に、不活性ガス供給管253a、MFC253c及びバルブ253dにより不活性ガス供給部が構成される。なお、不活性ガス供給源253b、ガス供給管252aを、不活性ガス供給部に含めて考えてもよい。
更には、エッチングガス供給源252b、不活性ガス供給部を、エッチングガス供給部に含めて考えてもよい。
(制御部)
本実施形態における制御部は、第一の実施形態における制御部260と同様の構成であるので、説明を省略する。
(基板処理方法)
続いて、基板処理装置100を用いた空隙形成方法について説明する。空隙形成方法は基板処理方法の一つである。基板処理方法は、第一の実施例と略同じであるが、エッチング制御値調整工程S3006、エッチングガス供給工程S3008の内容が異なる。以下に、エッチング制御値調整工程S3006を中心に、本実施形態における基板処理方法を説明する。
なお、以下の説明において、基板処理装置を構成する各部の動作はコントローラ260により制御される。
膜厚情報受信工程S3002、基板搬入工程S3004は、第一の実施例と同様であるので説明を省略する。
(エッチング制御値調整工程S3006)
CPU260aはRAM260bに受信された膜厚情報と、記憶装置260cに記憶されたエッチング制御値データベースを読み出す。続いてCPU260aは、受信した膜厚情報とエッチング制御値データベースとを比較すると共に、膜厚情報に応じたエッチング制御値を抽出する。
まず、基板搬入工程の後、処理室201内が所定の圧力(真空度)となるように、排気管224を介して処理室201内を排気する。この際、圧力センサが測定した圧力値に基づき、圧力調整器225としてのAPCバルブの弁の開度をフィードバック制御する。
ウエハ200が基板載置部210に載置され、処理室201内の雰囲気が安定した後、MFC252c、プラズマ制御部250を稼働させると共にバルブ252dの開度を調整する。このとき、MFC253cを稼働させると共にバルブ253dの開度を調整しても良い。
(エッチングガス供給工程S3008)
まず第1コイル250aと第2コイル250bそれぞれに供給する高周波電力の設定値を調整する。例えば、第1コイル250aに供給する高周波電力が第2コイル250bに供給される高周波電力よりも大きくなるように、第1高周波電源250cと第2高周波電源250fの設定値が調整(変更)される。
更には、 第1バイアス電極219aと第2バイアス電極219bそれぞれの電位を調整してもよい。例えば、第1バイアス電極219aの電位が第2バイアス電極219bの電位よりも低くなるように、整合器220aと整合器220bが調整される。
ここでは、エッチング制御値調整工程S3006で調整されたMFC252cやバルブ252dを制御し、ウエハの中央面に供給するガスのプラズマの密度(もしくはプラズマの量)と外周面に供給するガスのプラズマの密度(もしくはプラズマの量)をそれぞれ制御する。
プラズマ状態のエッチングガスは処理室201内に供給され、空隙2009を形成する。
所定の時間経過後、各バルブを閉じて、ガスの供給を停止する。
続いて、本実施形態におけるエッチング制御値調整工程S3006の詳細について説明する。
前述のように、研磨工程S102終了後、配線間絶縁膜2002は、ウエハの中央面と外周面とで膜厚が異なってしまう。測定工程S103ではその膜厚分布を測定する。測定結果は上位装置270を通して、RAM260bに格納される。格納されたデータは記憶装置260c内のレシピと比較され、そのレシピに基づいた装置制御が為される。
次に、RAM260bに格納されたデータが分布Aである場合を説明する。
分布Aの場合、本工程では、ウエハ中央面のエッチング量に対して、ウエハ外周面のエッチング量を少なくするよう制御する。例えば、エッチングガスの供給量を10〜100sccmとする。更には、第一の実施形態と同様、エッチング時間を膜厚が厚いほう、即ちウエハ中央のエッチング時間に合わせる。例えば、30〜120秒とする。
続いて、ウエハ中央面のエッチング量を、ウエハ外周面のエッチング量よりも多くする具体的な方法を説明する。ここではエッチングガスを供給する際、ウエハ200の外周面に供給するプラズマ状態のエッチングガスの成分を、ウエハ中央面よりも少なくするよう制御する。
エッチングガス供給系252では、マスフローコントローラ252cを制御すると共に、バルブ252dの開度を制御し、エッチングガスを処理室201内に供給する。供給する際は、第一コイル250aに供給する高周波電力を、第二コイル250bに供給する高周波電力よりも大きくした状態とする。
第1コイル250aに供給する高周波電力を第2コイル250bに供給される高周波電力よりも大きくした状態でエッチングガスを供給することで、ウエハ200の中心側に供給される活性種量(活性種濃度)を、ウエハ200の外周側に供給される活性種量(活性種濃度)よりも多くすることができ、ウエハ200の中心側のエッチング量を外周側の処理量よりも多くすることができる。供給されたエッチングガスは、図9に記載のように、配線間絶縁膜2002aをエッチングして溝2009aを形成する。更に、配線間絶縁膜2002bをエッチングして溝2009bを形成する。
なお、エッチングガスの供給を制御する際に、第1バイアス電極219aと第2バイアス電極219bそれぞれの電位を調整してもよい。例えば、第1バイアス電極219aの電位が第2バイアス電極219bの電位よりも低くなるように、高周波電源221aと高周波電源221bがそれぞれ調整される。第1バイアス電極219aの電位を第2バイアス電極219bの電位よりも低くすることによって、ウエハ200の中心側に引き込まれるイオン成分の量を、ウエハ200の外周側に引き込まれるイオン成分の量よりも多くすることができ、ウエハ200の中心側のエッチング量を外周側のエッチング量よりも多くすることができる。
このとき、図9、図10(A)に記載のように、溝2009a、溝2009bそれぞれで空間2011が形成されるよう、エッチング時間を調整する。このようにして、ウエハ200の面内において、溝2009に空間2011を形成することが可能となる。したがって、リーク電流の発生が抑制された、高品質な半導体装置を提供することができる。
次に、RAM260bに格納されたデータが分布Bである場合を説明する。
分布Bの場合、本工程では、ウエハ中央面のエッチング量に対して、ウエハ外周面のエッチング量を多くするよう制御する。例えば、エッチングガスの供給量を10〜100sccmとする。更には、エッチング時間を膜厚が厚いほう、即ちウエハ外周のエッチング時間に合わせる。例えば、30〜120秒とする。
続いて、ウエハ中央面に形成するエッチング量を少なくし、ウエハ外周面のエッチング量を多くする具体的な方法を説明する。ここではエッチングガスを供給する際、ウエハ200の中央面に供給するエッチングガスの成分を、ウエハ外周面よりも少なくするよう制御する。
ガス供給系ではMFC253cを制御すると共に、バルブ252dの開度を制御し、エッチングガスを処理室201内に供給する。供給する際は、第二コイル250bに供給する高周波電力を、第一コイル250aに供給する高周波電力よりも大きくした状態とする。
第2コイル250bに供給する高周波電力を第1コイル250aに供給される高周波電力よりも大きくした状態でエッチングガスを供給することで、ウエハ200の外周側に供給される活性種量(活性種濃度)を、ウエハ200の中央側に供給される活性種量(活性種濃度)よりも多くすることができ、ウエハ200の外周側のエッチング量を中央側の処理量よりも多くすることができる。供給されたエッチングガスは、図18に記載のように、配線間絶縁膜2002aをエッチングして溝2009aを形成する。更に、配線間絶縁膜2002bをエッチングして溝2009bを形成する。
このとき、図18、図10(A)に記載のように、溝2009a、溝2009bそれぞれで空間2011が形成されるよう、エッチング時間を調整する。このようにして、ウエハ200の面内において、溝2009に空間2011を形成することが可能となる。したがって、リーク電流の発生が抑制された、高品質な半導体装置を提供することができる。
なお、エッチングガスの供給を制御する際に、第1バイアス電極219aと第2バイアス電極219bそれぞれの電位を調整してもよい。例えば、第2バイアス電極219bの電位が第1バイアス電極219aの電位よりも低くなるように、高周波電源221aと高周波電源221bがそれぞれ調整される。第2バイアス電極219bの電位を第1バイアス電極219aの電位よりも低くすることによって、ウエハ200の外周側に引き込まれるイオン成分の量を、ウエハ200の中心側に引き込まれるイオン成分の量よりも多くすることができ、ウエハ200の外周側のエッチング量を中央側のエッチング量よりも多くすることができる。
所望の時間エッチング処理を行ったら、基板搬出工程S3010を実行する。
以上説明した本実施形態に係る技術によれば、エアギャップが形成された半導体装置において、電気成分の漏洩が抑制された構造を形成でき、したがって良好な歩留まりを実現ができる。
200 ウエハ(基板)
201 処理空間
202 チャンバ
212 基板載置台

Claims (13)

  1. 第一の層間絶縁膜と、前記第一の層間絶縁膜上に形成され、配線として用いられる複数の銅含有膜が埋め込まれる溝と、前記溝の間に設けられ、前記銅含有膜間を絶縁する配線間絶縁膜と、を有する配線層が形成された基板のうち、前記配線層の膜厚情報を受信する工程と、
    前記基板を処理室の内側に設けられた基板載置部に載置する工程と、
    前記配線層の膜厚情報に対応したエッチング制御値に基づいて、前記配線層をエッチングする工程と、
    を有する半導体装置の製造方法。
  2. 前記エッチング制御値はエッチング時間であり、前記エッチング時間は前記溝の底位置よりも深い位置までエッチングするよう設定される請求項1に記載の半導体装置の製造方法。
  3. 前記配線層の膜厚情報は、前記配線間絶縁膜の膜厚情報である請求項1または請求項2に記載の半導体装置の製造方法。
  4. 前記配線層の膜厚情報は、前記銅含有膜を研磨した後の前記配線層の膜厚情報である請求項1から請求項3のうち、いずれか一項に記載の半導体装置の製造方法。
  5. 前記膜厚情報は、前記基板の中央面と外周面の膜厚分布情報であり、
    前記エッチング工程では、
    前記膜厚分布情報が、前記外周面よりも前記中央面が厚いことを示す場合には、前記中央面における前記基板の単位面積当たりの前記エッチングガスの暴露量を、前記外周面よりも多くし、
    前記膜厚分布情報が、前記中央面よりも前記外周面が大きいことを示す情報である場合には、前記外周面における前記基板の単位面積当たりの前記エッチングガスの暴露量を前記中央面よりも大きくする請求項1から請求項4のうち、いずれか一項に記載の半導体装置の製造方法。
  6. 前記膜厚情報は、前記基板の中央面と外周面の膜厚分布情報であり、
    前記エッチング工程では、
    前記膜厚分布情報が、前記外周面よりも前記中央面が厚いことを示す場合には、前記中央面に供給する前記エッチングガスの量を前記外周面よりも多くし、
    前記膜厚分布情報が、前記中央面よりも前記外周面が大きいことを示す場合には、前記外周面に供給する前記エッチングガスの量を前記中央面よりも多くする
    請求項1から請求項4のうち、いずれか一項に記載の半導体装置の製造方法。
  7. 前記膜厚情報は、前記基板の中央面とその外周面の膜厚分布情報であり、
    前記エッチング工程では、
    前記膜厚分布情報が、前記外周面よりも前記中央面が厚いことを示す場合には、前記中央面に供給する前記エッチングガスの濃度を前記外周面よりも高くし、
    前記膜厚分布情報が、前記中央面よりも前記外周面の膜厚が大きいことを示す場合には、前記外周面に供給する前記エッチングガスの濃度を前記中央面よりも高くする請求項1から請求項4のうち、いずれか一項に記載の半導体装置の製造方法。
  8. 前記エッチングガスの濃度を制御する際は、前記中央面に供給する前記エッチングガスに添加する不活性ガスの供給量を、前記外周面に供給する前記エッチングガスに添加する不活性ガスの供給量よりも多くする請求項7に記載の半導体装置の製造方法。
  9. 前記膜厚情報は、前記基板の中央面とその外周面の膜厚分布情報であり、
    前記エッチング工程では、
    前記膜厚分布情報が、前記外周面よりも前記中央面が厚いことを示す場合には、前記中央面に供給する前記エッチングガスのプラズマ密度を前記外周面よりも高くし、
    前記膜厚分布情報が、前記中央面よりも前記外周面が大きいことを示す場合には、
    前記外周面に供給する前記エッチングガスのプラズマ密度を前記中央面よりも高くする請求項1から請求項4のうち、いずれか一項に記載の半導体装置の製造方法。
  10. 更に、前記エッチング工程では、前記外周面よりも前記中央面が大きいことを示す情報である場合には、前記基板を載置する基板載置部の中央に設けられたバイアス電極の電位を、その外周に設けられたバイアス電極よりも低くし、
    前記膜厚分布情報が、前記中央面よりも前記外周面が大きいことを示す場合には、前記基板を載置する基板載置部の外周に設けられたバイアス電極の電位を、その中央に設けられたバイアス電極よりも低くする請求項9に記載の半導体装置の製造方法。
  11. 第一の層間絶縁膜と、前記第一の層間絶縁膜上に形成され、配線として用いられる複数の銅含有膜が埋め込まれる溝と、前記溝の間に設けられ、前記銅含有膜間を絶縁する配線間絶縁膜と、を有する配線層が形成された基板を載置する基板載置部と、
    前記基板載置部が内側に設けられた処理室と、
    前記配線間絶縁膜の膜厚情報を受信する受信部と、
    前記処理室にエッチングガスを供給するエッチングガス供給部と、
    前記膜厚情報に基づいて前記配線層をエッチングするよう前記エッチングガス供給部を制御する制御部と、
    を有する基板処理装置。
  12. 第一の層間絶縁膜と、前記第一の層間絶縁膜上に形成され、配線として用いられる複数の銅含有膜が埋め込まれる溝と、前記溝の間に設けられ、前記銅含有膜間を絶縁する配線間絶縁膜と、を有する配線層が形成された基板のうち、前記配線層の膜厚情報を受信する処理と、
    前記基板を処理室の内側に設けられた基板載置部に載置する処理と、
    前記配線層の膜厚情報に対応したエッチング制御値に基づいて、前記配線層をエッチングする処理と、
    を基板処理装置に実行させるプログラム。
  13. 第一の層間絶縁膜と、前記第一の層間絶縁膜上に形成され、配線として用いられる複数の銅含有膜が埋め込まれる溝と、前記溝の間に設けられ、前記銅含有膜間を絶縁する配線間絶縁膜と、を有する配線層が形成された基板のうち、前記配線層の膜厚情報を受信する処理と、
    前記基板を処理室の内側に設けられた基板載置部に載置する処理と、
    前記配線層の膜厚情報に対応したエッチング制御値に基づいて、前記配線層をエッチングする処理と、
    を基板処理装置に実行させるプログラムを記録する記録媒体。

JP2016116351A 2016-06-10 2016-06-10 半導体装置の製造方法、基板処理装置、プログラムおよび記録媒体 Pending JP2017220642A (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2016116351A JP2017220642A (ja) 2016-06-10 2016-06-10 半導体装置の製造方法、基板処理装置、プログラムおよび記録媒体
TW105124473A TWI612617B (zh) 2016-06-10 2016-08-02 半導體裝置的製造方法、基板處理裝置、程式及記錄媒體
KR1020160116184A KR101793945B1 (ko) 2016-06-10 2016-09-09 반도체 장치의 제조 방법, 기판 처리 장치 및 기록 매체
CN201610818466.1A CN107492491A (zh) 2016-06-10 2016-09-12 半导体装置的制造方法及衬底处理装置
US15/265,371 US9991179B2 (en) 2016-06-10 2016-09-14 Method of manufacturing semiconductor device

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2016116351A JP2017220642A (ja) 2016-06-10 2016-06-10 半導体装置の製造方法、基板処理装置、プログラムおよび記録媒体

Publications (1)

Publication Number Publication Date
JP2017220642A true JP2017220642A (ja) 2017-12-14

Family

ID=60384434

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2016116351A Pending JP2017220642A (ja) 2016-06-10 2016-06-10 半導体装置の製造方法、基板処理装置、プログラムおよび記録媒体

Country Status (5)

Country Link
US (1) US9991179B2 (ja)
JP (1) JP2017220642A (ja)
KR (1) KR101793945B1 (ja)
CN (1) CN107492491A (ja)
TW (1) TWI612617B (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2022202015A1 (ja) * 2021-03-24 2022-09-29 ソニーセミコンダクタソリューションズ株式会社 半導体装置、半導体装置製造方法

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2018038892A1 (en) * 2016-08-26 2018-03-01 Applied Materials, Inc. Self-healing semiconductor wafer processing
CN113823582A (zh) * 2020-06-21 2021-12-21 拓荆科技股份有限公司 用于处理站阻抗调节的装置、系统和方法
US12057394B2 (en) * 2021-08-24 2024-08-06 Qualcomm Incorporated Three-dimensional (3D) interconnect structures employing via layer conductive structures in via layers and related fabrication methods

Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6324623A (ja) * 1986-07-17 1988-02-02 Mitsubishi Electric Corp プラズマ処理装置
JPH09251986A (ja) * 1996-03-15 1997-09-22 Sony Corp エッチング装置及びエッチング方法
JP2002231807A (ja) * 2001-02-01 2002-08-16 Matsushita Electric Ind Co Ltd 半導体装置の配線形成方法
JP2004193565A (ja) * 2002-11-26 2004-07-08 Tokyo Electron Ltd プラズマ処理装置、プラズマ処理方法及びプラズマ処理装置の電極板
JP2006202833A (ja) * 2005-01-18 2006-08-03 Tokyo Electron Ltd ガス設定方法,ガス設定装置,エッチング装置及び基板処理システム
JP2008294335A (ja) * 2007-05-28 2008-12-04 Panasonic Corp 半導体装置の製造方法
JP2009152357A (ja) * 2007-12-20 2009-07-09 Oki Semiconductor Co Ltd 半導体基板の処理方法および半導体基板の処理装置
JP2013165147A (ja) * 2012-02-10 2013-08-22 Renesas Electronics Corp 半導体装置および半導体装置の製造方法
WO2014069094A1 (ja) * 2012-11-02 2014-05-08 キヤノンアネルバ株式会社 半導体装置の製造方法、イオンビームエッチング装置及び制御装置
JP2014086583A (ja) * 2012-10-24 2014-05-12 Toshiba Corp 半導体装置及びその製造方法

Family Cites Families (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3321403B2 (ja) * 1997-12-08 2002-09-03 株式会社東芝 成膜装置及び成膜方法
JP2003203970A (ja) 2002-01-04 2003-07-18 Mitsubishi Electric Corp 半導体装置およびその製造方法
JP2005039216A (ja) * 2003-06-23 2005-02-10 Toshiba Corp 不揮発性半導体記憶装置
US7723236B2 (en) * 2005-01-18 2010-05-25 Tokyo Electron Limited Gas setting method, gas setting apparatus, etching apparatus and substrate processing system
US7674393B2 (en) * 2005-03-25 2010-03-09 Tokyo Electron Limited Etching method and apparatus
JP4608370B2 (ja) 2005-06-01 2011-01-12 独立行政法人海洋研究開発機構 試料採取用マイクロミル
JP2008177266A (ja) * 2007-01-17 2008-07-31 Fujitsu Ltd 半導体基板、および半導体装置の製造方法
JP5334434B2 (ja) 2007-06-04 2013-11-06 パナソニック株式会社 半導体装置の製造方法
US7943480B2 (en) * 2008-02-12 2011-05-17 International Business Machines Corporation Sub-lithographic dimensioned air gap formation and related structure
JP2011165876A (ja) 2010-02-09 2011-08-25 Consortium For Advanced Semiconductor Materials & Related Technologies 半導体装置、及びその製造方法
JP5485309B2 (ja) 2012-01-30 2014-05-07 株式会社東芝 半導体装置及びその製造方法
CN104364898A (zh) * 2012-05-30 2015-02-18 奥林巴斯株式会社 摄像装置的制造方法以及半导体装置的制造方法

Patent Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6324623A (ja) * 1986-07-17 1988-02-02 Mitsubishi Electric Corp プラズマ処理装置
JPH09251986A (ja) * 1996-03-15 1997-09-22 Sony Corp エッチング装置及びエッチング方法
JP2002231807A (ja) * 2001-02-01 2002-08-16 Matsushita Electric Ind Co Ltd 半導体装置の配線形成方法
JP2004193565A (ja) * 2002-11-26 2004-07-08 Tokyo Electron Ltd プラズマ処理装置、プラズマ処理方法及びプラズマ処理装置の電極板
JP2006202833A (ja) * 2005-01-18 2006-08-03 Tokyo Electron Ltd ガス設定方法,ガス設定装置,エッチング装置及び基板処理システム
JP2008294335A (ja) * 2007-05-28 2008-12-04 Panasonic Corp 半導体装置の製造方法
JP2009152357A (ja) * 2007-12-20 2009-07-09 Oki Semiconductor Co Ltd 半導体基板の処理方法および半導体基板の処理装置
JP2013165147A (ja) * 2012-02-10 2013-08-22 Renesas Electronics Corp 半導体装置および半導体装置の製造方法
JP2014086583A (ja) * 2012-10-24 2014-05-12 Toshiba Corp 半導体装置及びその製造方法
WO2014069094A1 (ja) * 2012-11-02 2014-05-08 キヤノンアネルバ株式会社 半導体装置の製造方法、イオンビームエッチング装置及び制御装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2022202015A1 (ja) * 2021-03-24 2022-09-29 ソニーセミコンダクタソリューションズ株式会社 半導体装置、半導体装置製造方法

Also Published As

Publication number Publication date
TWI612617B (zh) 2018-01-21
CN107492491A (zh) 2017-12-19
US9991179B2 (en) 2018-06-05
KR101793945B1 (ko) 2017-11-06
US20170358506A1 (en) 2017-12-14
TW201743407A (zh) 2017-12-16

Similar Documents

Publication Publication Date Title
US10090161B2 (en) Plasma etching apparatus and plasma etching method
JP6055783B2 (ja) 基板載置台及びプラズマ処理装置
KR101384589B1 (ko) 반도체 장치의 제조 방법
US9449838B2 (en) Semiconductor device manufacturing method
KR100585089B1 (ko) 웨이퍼 가장자리를 처리하기 위한 플라즈마 처리장치,플라즈마 처리장치용 절연판, 플라즈마 처리장치용하부전극, 웨이퍼 가장자리의 플라즈마 처리방법 및반도체소자의 제조방법
US8980048B2 (en) Plasma etching apparatus
US9048191B2 (en) Plasma etching method
JP4877747B2 (ja) プラズマエッチング方法
US20160218012A1 (en) Method of forming fine pattern, method of manufacturing semiconductor device, substrate processing apparatus and recording medium
US20090239352A1 (en) Method for producing silicon oxide film, control program thereof, recording medium and plasma processing apparatus
KR101793945B1 (ko) 반도체 장치의 제조 방법, 기판 처리 장치 및 기록 매체
US20120184107A1 (en) Semiconductor device manufacturing method
US20070224828A1 (en) Plasma etching method
US20110017586A1 (en) Method for forming silicon oxide film, storage medium, and plasma processing apparatus
US7910495B2 (en) Plasma oxidizing method, plasma processing apparatus, and storage medium
JP2005353812A (ja) プラズマ処理装置及びプラズマ処理方法
JP2013077594A (ja) プラズマエッチング方法及び半導体装置の製造方法
JP6133347B2 (ja) 半導体装置の製造方法、基板処理システム及びプログラム
KR100585183B1 (ko) 반도체소자의 제조방법
CN114930508A (zh) 具有场聚合物保护的方向性选择性接面清洁

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20170915

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20180524

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20180529

A711 Notification of change in applicant

Free format text: JAPANESE INTERMEDIATE CODE: A712

Effective date: 20180727

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20180820

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20181205