JP2017011127A - エッチング方法 - Google Patents

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Abstract

【課題】被エッチング層のエッチング方法を提供する。
【解決手段】一実施形態の方法は、金属を含有するマスク及びシリコンを含有する被エッチング層上にフルオロカーボンを含む堆積物を形成するために、該マスク及び該被エッチング層を有する被処理体を収容したプラズマ処理装置の処理容器内において、フルオロカーボンガスを含む第1の処理ガスのプラズマを生成する工程と、堆積物に含まれるフルオロカーボンのラジカルにより被エッチング層をエッチングするために、処理容器内において不活性ガスを含む第2の処理ガスのプラズマを生成する工程と、を含む。この方法では、第1の処理ガスのプラズマを生成する工程と第2の処理ガスのプラズマを生成する工程とを含む複数回のシーケンスが実行される。
【選択図】図1

Description

本発明の実施形態は、金属を含有するマスクをその上に有する被エッチング層をエッチングする方法に関するものである。
電子デバイスの製造においては、被エッチング層のエッチングにより当該被エッチング層にトレンチ又はホールのような開口が形成されることがある。被エッチング層がシリコンを含有している場合には、当該被エッチング層のエッチングのために、一般的にはフルオロカーボンガスのプラズマが生成される。被エッチング層は、生成されたプラズマからのフッ素及び/又はフルオロカーボンの活性種によってエッチングされる。フルオロカーボンガスのプラズマを利用した被エッチング層のエッチングについては、下記の特許文献1及び特許文献2に記載されている。
また、特許文献1及び特許文献2には、被エッチング層を有する被処理体のエッジを囲むようにフォーカスリングを配置することが記載されている。フォーカスリングを用いる目的は、一般的に、エッチングの面内均一性を向上させることにある。
また、特許文献1には、金属製のマスクが被エッチング層の上に形成され、エッチングによって当該マスクのパターンが被エッチング層に転写されることが記載されている。
特開2013−98193号公報 特開2006−269879号公報
上述したエッチングでは、フォーカスリングに近い領域、即ち、被処理体のエッジ領域では、マスクのエッチングレートが、当該エッジ領域よりも被処理体の中心側にある領域(即ち、中央領域)のマスクのエッチングレートに対して、高くなることがある。即ち、エッジ領域での選択比が、中央領域での選択比よりも低くなることがある。
したがって、金属を含有するマスクをその上に有し、シリコンを含有する被エッチング層のエッチングにおいて、選択比の面内均一性を向上させることが要求されている。
一態様においては、被エッチング層をエッチングする方法が提供される。被エッチング層はシリコンを含有し、被エッチング層上には金属を含有するマスクが設けられている。この方法は、(i)フルオロカーボンを含む堆積物をマスク及び被エッチング層上に形成するために、該マスク及び該被エッチング層を有する被処理体を収容したプラズマ処理装置の処理容器内において、フルオロカーボンガスを含む第1の処理ガスのプラズマを生成する工程(以下、「堆積工程」という)と、(ii)堆積物に含まれるフルオロカーボンのラジカルにより被エッチング層をエッチングするために、処理容器内において不活性ガスを含む第2の処理ガスのプラズマを生成する工程(以下、「エッチング工程」という)と、を含む。この方法では、堆積工程とエッチング工程とを含む複数回のシーケンスが実行される。
上記一態様に係る方法の堆積工程では、被エッチング層及びマスクの表面、即ち被処理体の表面上に堆積物が形成される。堆積物は、エッチング工程においてマスクを保護する機能を有する。また、堆積物は、エッチング工程において被エッチング層のエッチングのためのフルオロカーボンのラジカルのソースとなる。したがって、この方法によれば、マスクを保護しつつ、被エッチング層をエッチングすることが可能である。また、この方法では、堆積物は、堆積工程において被処理体上のみならず、被処理体のエッジの周囲の物体上、例えば、フォーカスリング上にも形成される。このように堆積物が形成された後には、被処理体の表面及びその周囲の物体の表面は堆積物によって構成される。これにより、被処理体の表面の略全領域におけるフッ素の消費量が略均一になる。また、マスクは上述したように堆積物によって保護される。したがって、マスクの浸食が被処理体の面内において略均一に抑制される。故に、この方法によれば、被エッチング層のエッチングにおいて、選択比の面内均一性が向上される。
一実施形態では、第2の処理ガスは、不活性ガスとして希ガス又は窒素ガスを含む。
一実施形態では、第2の処理ガスは、不活性ガスとして希ガスを含み、且つ、窒素ガスを含む。この実施形態では、窒素の活性種が生成される。したがって、被エッチング層が、低誘電率膜といった膜のように水素を含む場合に、窒素の活性種により、被エッチング層からの水素の離脱が促進され、被エッチング層がより効率的にエッチングされる。
一実施形態では、第2の処理ガスは、酸素含有ガスを更に含む。この実施形態では、酸素含有ガスのプラズマの生成により、酸素の活性種が発生する。酸素の活性種は、過剰な堆積物を除去することに寄与する。したがって、マスクの開口の過剰な縮小が防止される。また、広い開口をマスクが提供している領域(以下、「ワイドエリア」という)と狭い開口をマスクが提供している領域(以下、「ナローエリア」という)を被処理体が有している場合に、ワイドエリアでは、ナローエリアに比して、被エッチング層上に多くの堆積物が形成される。一方、ワイドエリアでは、ナローエリアに比して、酸素の活性種によって減少される堆積物の量が多くなる。したがって、ナローエリアの被エッチング層上の堆積物の量とワイドエリアの被エッチング層上の堆積物の量との差異が低減されつつ、エッチングが進行する。故に、ナローエリアの被エッチング層のエッチングレートとワイドエリアの被エッチング層のエッチングレートの差異が低減される。
一実施形態では、複数回のシーケンスの少なくとも一部は、処理容器内において酸素含有ガス及び不活性ガスを含む処理ガスのプラズマを生成する工程(以下、「フラッシュ工程」という)を更に含む。この実施形態においても、酸素の活性種によって、マスクの開口の過剰な縮小が防止される。また、ナローエリアの被エッチング層のエッチングレートとワイドエリアの被エッチング層のエッチングレートの差異が低減される。さらに、この実施形態では、フラッシュ工程とエッチング工程とが分離されているので、堆積物の量の調整の制御性が高められる
一実施形態では、マスクは窒化チタン製である。また、一実施形態では、複数回のシーケンスが実行される期間にわたって、マスク及び被エッチング層を有する被処理体のエッジを囲むようにフォーカスリングが配置される。このフォーカスリングは、被エッチング層を構成する材料とは異なる材料から構成される。
一実施形態では、プラズマ処理装置は、容量結合型のプラズマ処理装置であり、処理容器内の空間を画成する面を含むシリコン製の領域を有する上部電極、及び上部電極に負極性の直流電圧を印加するための直流電源を備える。この実施形態において、少なくとも堆積工程において、上部電極に負極性の直流電圧が印加される。上部電極に負極性の直流電圧が印加されると、処理容器内の正イオンが上部電極に衝突し、上部電極の表面からシリコンが放出される。放出されたシリコンは、処理容器内のフッ素の活性種と結合する。その結果、処理容器内におけるフッ素の活性種の量が減少される。したがって、この実施形態によれば、マスクの浸食が更に低減される。なお、エッチング工程及び/又はフラッシュ工程においても、上部電極に負極性の直流電圧が印加されてもよい。
以上説明したように、金属を含有するマスクをその上に有し、シリコンを含有する被エッチング層のエッチングにおいて、選択比の面内均一性を向上させることが可能となる。
一実施形態に係るエッチング方法を示す流れ図である。 被処理体を例示する断面図である。 プラズマ処理装置の一例を概略的に示す図である。 図1に示す方法の実施の途中段階における被処理体を示す断面図である。 図1に示す方法の実施の途中段階における被処理体を示す断面図である。 図1に示す方法の実施の途中段階における被処理体の一部分を示す拡大断面図である。 図1に示す方法の実施の途中段階における被処理体の一部分を示す拡大断面図である。 図1に示す方法の実施後の被処理体の一部分を示す拡大断面図である。 図1に示す方法の実施の途中段階における被処理体の一部分を示す拡大断面図である。 別の実施形態に係るエッチング方法を示す流れ図である。 図10に示す方法の実施の途中段階における被処理体の一部分を示す拡大断面図である。 実験例1〜7及び比較実験例1〜7について説明するための図である。 実験例1〜7及び比較実験例1〜7の結果を示すグラフである。 実験例8及び比較実験例8について説明するための図である。 実験例8及び比較実験例8の結果を示す表である。 実験例9及び比較実験例9の結果を示すグラフである。
以下、図面を参照して種々の実施形態について詳細に説明する。なお、各図面において同一又は相当の部分に対しては同一の符号を附すこととする。
図1は、一実施形態に係るエッチング方法を示す流れ図である。図1に示す方法MTは、被処理体の被エッチング層をエッチングするものである。図2は、被処理体を例示する断面図である。図2に示す被処理体(以下、「ウエハW」という)は、基板SB、被エッチング層EL、及びマスクMKを有している。
被エッチング層ELは、シリコンを含有する層である。被エッチング層ELは、例えば、シリコン酸化膜、又は低誘電率膜(即ち、Low−K膜)であり得る。被エッチング層ELが低誘電率膜である場合には、当該低誘電率膜としては、例えば、SiOC膜、SiOCH膜、SiO膜、SiOF膜、Si−H含有SiO膜、Hydrogen Silses−Quioxane(HSQ)膜、多孔質シリカ膜、メチル基含有SiO膜、Methyl Silses−Quioxane(MSQ)膜、多孔質MSQ膜等を用いることができる。なお、被エッチング層ELは、上に例示した膜種の単層膜であってもよく、或いは、上に例示した二以上の膜種の複数の膜を有する積層構造を備えていてもよい。
マスクMKは、被エッチング層EL上に設けられている。マスクMKは、金属を含有している。マスクMKは、例えば、窒化チタン(TiN)、又はタングステンから形成される。マスクMKは、複数の開口を提供するパターンを有している。開口は、トレンチであってもよく、或いは、ホールであってもよい。また、後述するように、マスクMKは、幅の広い開口を提供する領域、即ち、ワイドエリアと、幅の狭い開口を提供する領域、即ち、ナローエリアとを有していてもよい。なお、以下の説明において、ウエハWのエッジを含む領域を領域R2として参照し、当該領域R2よりもウエハWの中心側の領域(即ち、中央領域)を領域R1として参照する。
方法MTでは、図2に示したウエハWのような被処理体の被エッチング層ELをエッチングするために、プラズマ処理装置を用いて複数回のシーケンスSQが実行される。図3は、プラズマ処理装置の一例を概略的に示す図である。図3に示すプラズマ処理装置10は、容量結合型プラズマエッチング装置であり、略円筒形状の処理容器12を備えている。処理容器12は、例えばアルミニウムから形成されており、当該処理容器12の内壁面には陽極酸化処理が施されている。この処理容器12は保安接地されている。
処理容器12の底部上には、略円筒形状の支持部14が設けられている。支持部14は、例えば、絶縁材料から形成されている。支持部14は、処理容器12内において、当該処理容器12の底部から鉛直方向に延在している。また、処理容器12内には、載置台PDが設けられている。載置台PDは、支持部14によって支持されている。
載置台PDは、その上面においてウエハWを保持する。載置台PDは、下部電極LE及び静電チャックESCを有している。下部電極LEは、第1プレート18a及び第2プレート18bを含んでいる。第1プレート18a及び第2プレート18bは、例えばアルミニウムといった金属から形成されており、略円盤形状を有している。第2プレート18bは、第1プレート18a上に設けられており、第1プレート18aに電気的に接続されている。
第2プレート18b上には、静電チャックESCが設けられている。静電チャックESCは、導電膜である電極を一対の絶縁層又は絶縁シート間に配置した構造を有している。静電チャックESCの電極には、直流電源22がスイッチ23を介して電気的に接続されている。この静電チャックESCは、直流電源22からの直流電圧により生じたクーロン力等の静電力によりウエハWを吸着する。これにより、静電チャックESCは、ウエハWを保持することができる。
第2プレート18bの周縁部上には、ウエハWのエッジ及び静電チャックESCを囲むようにフォーカスリングFRが配置されている。フォーカスリングFRは、略環状板形状を有している。このフォーカスリングFRは、マスクMKと異なる材料から形成されている。例えば、フォーカスリングFRは、シリコンから形成されている。
第2プレート18bの内部には、冷媒流路24が設けられている。冷媒流路24は、温調機構を構成している。冷媒流路24には、処理容器12の外部に設けられたチラーユニットから配管26aを介して冷媒が供給される。冷媒流路24に供給された冷媒は、配管26bを介してチラーユニットに戻される。このように、冷媒流路24とチラーユニットとの間では、冷媒が循環される。この冷媒の温度を制御することにより、静電チャックESCによって支持されたウエハWの温度が制御される。
また、プラズマ処理装置10には、ガス供給ライン28が設けられている。ガス供給ライン28は、伝熱ガス供給機構からの伝熱ガス、例えばHeガスを、静電チャックESCの上面とウエハWの裏面との間に供給する。
また、プラズマ処理装置10は、上部電極30を備えている。上部電極30は、載置台PDの上方において、当該載置台PDと対向配置されている。したがって、下部電極LEと上部電極30とは、互いに略平行に設けられている。上部電極30と載置台PDとの間には、ウエハWにプラズマ処理を行うための処理空間Sが提供されている。
上部電極30は、絶縁性遮蔽部材32を介して、処理容器12の上部に支持されている。一実施形態では、上部電極30は、載置台PDの上面、即ち、ウエハ載置面からの鉛直方向における距離が可変であるように構成され得る。上部電極30は、天板34及び支持体36を含み得る。天板34は処理空間Sに面しており、当該天板34には複数のガス吐出孔34aが設けられている。この天板34は、一実施形態では、シリコンから形成されている。即ち、一実施形態では、上部電極30は、処理容器12内の処理空間Sを画成する面を含むシリコン製の領域を有している。
支持体36は、天板34を着脱自在に支持するものであり、例えばアルミニウムといった導電性材料から構成され得る。この支持体36は、水冷構造を有し得る。支持体36の内部には、ガス拡散室36aが設けられている。このガス拡散室36aからは、ガス吐出孔34aに連通する複数のガス通流孔36bが下方に延びている。また、支持体36には、ガス拡散室36aに処理ガスを導くガス導入口36cが形成されており、このガス導入口36cには、ガス供給管38が接続されている。
ガス供給管38には、バルブ群42及び流量制御器群44を介して、ガスソース群40が接続されている。ガスソース群40は、複数のガスソースを含んでいる。一例では、ガスソース群40は、フルオロカーボンガスのソース、不活性ガスのソース、及び、酸素含有ガスのソースを含んでいる。ガスソース群40は、フルオロカーボンガスのソースとして、一以上のフルオロカーボンガスのソースを有することができる。フルオロカーボンガスとしては、Cガス、Cガスといった任意のフルオロカーボンガスが例示される。不活性ガスのソースは、一実施形態では希ガスのソースである。希ガスとしては、Heガス、Neガス、Arガス、Krガス、Xeガスといった任意の希ガスを用いることができる。酸素含有ガスのソースは、一例では、酸素ガス(Oガス)のソースであり得る。なお、酸素含有ガスは、酸素を含有する任意のガスであってもよく、例えば、COガス又はCOガスといった酸化炭素ガスであってもよい。また、ガスソース群40は、不活性ガスとして、或いは、低誘電率膜中の水素との反応を目的として、窒素ガス(Nガス)のソースを更に含み得る。
バルブ群42は複数のバルブを含んでおり、流量制御器群44はマスフローコントローラといった複数の流量制御器を含んでいる。ガスソース群40の複数のガスソースはそれぞれ、バルブ群42の対応のバルブ及び流量制御器群44の対応の流量制御器を介して、ガス供給管38に接続されている。
また、プラズマ処理装置10では、処理容器12の内壁に沿ってデポシールド46が着脱自在に設けられている。デポシールド46は、支持部14の外周にも設けられている。デポシールド46は、処理容器12にエッチング副生物(デポ)が付着することを防止するものであり、アルミニウム材にY等のセラミックスを被覆することにより構成され得る。
処理容器12の底部側、且つ、支持部14と処理容器12の側壁との間には排気プレート48が設けられている。排気プレート48には、当該排気プレート48を板厚方向に貫通する複数の貫通孔が形成されている。排気プレート48は、例えば、アルミニウム材にY等のセラミックスを被覆することにより構成され得る。この排気プレート48の下方、且つ、処理容器12には、排気口12eが設けられている。排気口12eには、排気管52を介して排気装置50が接続されている。排気装置50は、圧力調整弁、及び、ターボ分子ポンプなどの真空ポンプを有しており、処理容器12内の空間を所望の真空度まで減圧することができる。また、処理容器12の側壁にはウエハWの搬入出口12gが設けられており、この搬入出口12gはゲートバルブ54により開閉可能となっている。
また、プラズマ処理装置10は、第1の高周波電源62及び第2の高周波電源64を更に備えている。第1の高周波電源62は、プラズマ生成用の高周波を発生する電源であり、例えば27〜100MHzの周波数の高周波を発生する。第1の高周波電源62は、整合器66を介して下部電極LEに接続されている。整合器66は、第1の高周波電源62の出力インピーダンスと負荷側(下部電極LE側)の入力インピーダンスを整合させるための回路を有している。なお、第1の高周波電源62は、整合器66を介して上部電極30に接続されていてもよい。
第2の高周波電源64は、ウエハWにイオンを引き込むための高周波バイアスを発生する電源であり、例えば、400kHz〜13.56MHzの範囲内の周波数の高周波バイアスを発生する。第2の高周波電源64は、整合器68を介して下部電極LEに接続されている。整合器68は、第2の高周波電源64の出力インピーダンスと負荷側(下部電極LE側)の入力インピーダンスを整合させるための回路を有している。
また、プラズマ処理装置10は、電源70を更に備えている。電源70は、上部電極30に接続されている。電源70は、処理空間S内に存在する正イオンを天板34に引き込むための電圧を、上部電極30に印加する。一例においては、電源70は、負極性の直流電圧を発生する直流電源である。別の一例において、電源70は、比較的低周波の交流電圧を発生する交流電源であってもよい。電源70から上部電極に印加される電圧は、−150V以下の電圧であり得る。即ち、電源70によって上部電極30に印加される電圧は、絶対値が150V以上の負極性の電圧であり得る。このような電圧が電源70から上部電極30に印加されると、処理空間Sに存在する正イオンが、天板34に衝突する。これにより、天板34から二次電子及び/又はシリコンが放出される。放出されたシリコンは、処理空間S内に存在するフッ素の活性種と結合し、フッ素の活性種の量を低減させる。
また、一実施形態においては、プラズマ処理装置10は、制御部Cntを更に備え得る。この制御部Cntは、プロセッサ、記憶部、入力装置、表示装置等を備えるコンピュータであり、プラズマ処理装置10の各部を制御する。この制御部Cntでは、入力装置を用いて、オペレータがプラズマ処理装置10を管理するためにコマンドの入力操作等を行うことができ、また、表示装置により、プラズマ処理装置10の稼働状況を可視化して表示することができる。さらに、制御部Cntの記憶部には、プラズマ処理装置10で実行される各種処理をプロセッサにより制御するための制御プログラムや、処理条件に応じてプラズマ処理装置10の各部に処理を実行させるためのプログラム、即ち、処理レシピが格納される。
再び図1を参照して方法MTについて説明する。以下の説明では、図1と共に、図4〜図8を参照する。図4及び図5は、図1に示す方法の実施の途中段階における被処理体を示す断面図である。図6〜図7は、図1に示す方法の実施の途中段階における被処理体の一部分を示す拡大断面図である。図8は、図1に示す方法の実施後の被処理体の一部分を示す拡大断面図である。以下、図2に示したウエハWをプラズマ処理装置10を用いて処理する場合を例にとって、方法MTについて説明する。
方法MTでは、複数回のシーケンスSQの実行に先立って、プラズマ処理装置10の処理容器12内に収容されたウエハWが静電チャックESC上に載置され、当該静電チャックESCによって保持される。この状態では、図4に示すように、ウエハWのエッジはフォーカスリングFRによって囲まれている。フォーカスリングFRは、方法MTの実行期間中、ウエハWの周に配置される。
そして、方法MTでは、複数回のシーケンスSQが実行される。複数回のシーケンスSQの各々は、工程ST1及び工程ST2を含んでいる。工程ST1では、ウエハWが収容された処理容器12内で、処理ガス(第1の処理ガス)のプラズマが生成される。このため、工程ST1では、ガスソース群40の複数のガスソースのうち選択されたガスソースから処理容器12内に処理ガスが供給される。この処理ガスは、フルオロカーボンガスを含む。また、この処理ガスは、希ガス、例えば、Arガスを更に含み得る。また、工程ST1では、排気装置50が作動され、処理容器12内の圧力が所定の圧力に設定される。さらに、工程ST1では、第1の高周波電源62からの高周波が下部電極LEに供給される。なお、第2の高周波電源64からの高周波バイアスが下部電極LEに供給されてもよい。また、一実施形態の工程ST1では、電源70からの負極性の直流電圧が上部電極30に印加されてもよい。
この工程ST1では、フルオロカーボンガスを含む処理ガスのプラズマが生成され、解離したフルオロカーボンが、ウエハWの表面上に堆積して、図5及び図6に示すように堆積物DPを形成する。また、堆積物DPは、ウエハWの周囲の物体、一例ではフォーカスリングFR上にも形成される。
工程ST1では、フルオロカーボンガスの解離によって生成された活性種によって被エッチング層ELをエッチングすることよりも、解離した堆積物のウエハW上への堆積が優位となるように、条件が選択され得る。例えば、フルオロカーボンガスとしては、分子中のフッ素の原子数に対して炭素の原子数が多いフルオロカーボンガス、例えば、Cガス、Cガスが用いられる。また、第1の高周波電源62の高周波の電力としては、比較的低い電力が設定され得る。さらに、第2の高周波電源64の高周波バイアスの電力としては、比較的低い電力が設定され得る。
以下に、工程ST1における各種条件を例示する。
・処理容器内圧力:10mTorr(1.33Pa)〜150mTorr(20.00Pa)
・処理ガス
ガス:5sccm〜50sccm
Arガス:500sccm〜1500sccm
・プラズマ生成用の高周波の電力:100W〜500W
・高周波バイアスの電力:0W〜300W
・電源70の負極性の直流電圧:−1000V〜0V
続く工程ST2では、被エッチング層ELがエッチングされる。この工程ST2では、堆積物DP中のフルオロカーボンと被エッチング層ELの構成材料との反応を促進させるために、処理ガス(第2の処理ガス)のプラズマが処理容器12内において生成される。このため、工程ST2では、ガスソース群40の複数のガスソースのうち選択されたガスソースから処理容器12内に処理ガスが供給される。この処理ガスは、不活性ガスを含む。一実施形態では、不活性ガスは、Arガスといった希ガスである。不活性ガスは、窒素ガスであってもよい。別の実施形態では、処理ガスは、不活性ガスとして希ガスを含み、更に窒素ガスを含んでいてもよい。更なる実施形態では、処理ガスは、希ガス及び酸素含有ガスを含み、更に窒素ガスを含んでいてもよい。また、工程ST2では、排気装置50が作動され、処理容器12内の圧力が所定の圧力に設定される。さらに、工程ST2では、第1の高周波電源62からの高周波が下部電極LEに供給される。また、工程ST2では、第2の高周波電源64からの高周波バイアスが下部電極LEに供給される。一実施形態の工程ST2では、電源70からの負極性の直流電圧が上部電極30に印加されてもよい。
以下に、工程ST2における各種条件を例示する。
・処理容器内圧力:10mTorr(1.33Pa)〜150mTorr(20.00Pa)
・処理ガス
Arガス:500sccm〜1500sccm
ガス:0sccm〜400sccm
ガス:0sccm〜50sccm
・プラズマ生成用の高周波の電力:100W〜500W
・高周波バイアスの電力:0W〜300W
・電源70の負極性の直流電圧:−1000V〜0V
工程ST2では、不活性ガスのプラズマが生成され、イオンがウエハWに対して引き込まれる。これにより、堆積物DP中に含まれるフルオロカーボンのラジカルと被エッチング層ELの構成材料が反応し、反応生成物が排気される。この工程ST2の実行の結果、図7に示すように、被エッチング層ELがエッチングされる。
方法MTでは、続く工程STJにおいて、停止条件が満たされるか否かが判定される。停止条件はシーケンスSQが所定回数実行されている場合に満たされるものと判定される。工程STJにおいて、停止条件が満たされないと判定される場合には、工程ST1からシーケンスSQが実行される。このような、シーケンスSQの実行の繰り返しにより、被エッチング層ELが徐々にエッチングされる。一方、工程STJにおいて、停止条件が満たされると判定される場合には、方法MTが終了する。方法MTの終了時には、図8に示すように、基板SBの表面まで達する開口が被エッチング層ELに形成される。
この方法MTの工程ST1では、被エッチング層EL及びマスクMKの表面、即ちウエハWの表面上に堆積物DPが形成される。堆積物DPは、工程ST2においてマスクMKを保護する機能を有する。また、堆積物DPは、工程ST2において被エッチング層ELのエッチングのためのフルオロカーボンのラジカルのソースとなる。したがって、方法MTによれば、マスクMKを保護しつつ、被エッチング層ELをエッチングすることが可能である。また、工程ST1において形成される堆積物DPは、図5に示すように、ウエハW上のみならず、ウエハWのエッジの周囲の物体上、即ち、フォーカスリングFR上にも形成される。このように堆積物DPがウエハW上に形成された後には、ウエハWの表面及びその周囲のフォーカスリングFRの表面は堆積物によって構成される。これにより、ウエハWの表面の略全領域でのフッ素の消費量が略均一になる。また、マスクMKは上述したように堆積物DPによって保護される。したがって、マスクMKの浸食がウエハWの面内において略均一に抑制される。即ち、領域R1におけるマスクMKの浸食と領域R2におけるマスクMKの浸食が略均一に抑制される。故に、方法MTによれば、被エッチング層ELのエッチングにおいて、選択比の面内均一性が向上される。
また、上述したように、一実施形態の工程ST1では、電源70からの負極性の直流電圧が上部電極30に印加される。これにより、工程ST1において発生するフッ素の活性種の量が低減され、マスクMKの浸食が更に抑制される。なお、上述したように、工程ST2においても、電源70からの負極性の直流電圧が上部電極30に印加されてもよい。
また、上述したように、一実施形態の工程ST2で利用される処理ガスは窒素ガスを含む。この実施形態では、被エッチング層ELが上に例示した低誘電率膜といった膜のように水素を含む場合に、窒素の活性種により、被エッチング層ELからの水素の離脱が促進される。故に、被エッチング層ELがより効率的にエッチングされる。
また、上述したように、一実施形態の工程ST2で利用される処理ガスは酸素含有ガスを含む。この実施形態では、酸素含有ガスのプラズマの生成により、酸素の活性種が発生する。酸素の活性種は、過剰な堆積物DPを除去することに寄与する。したがって、マスクの開口の過剰な縮小が防止される。
ここで、図9を参照する。図9は、図1に示す方法の実施の途中段階における被処理体の一部分を示す拡大断面図である。図9の(a)には、工程ST1の実行によりナローエリアにおいて形成される堆積物DPの状態が示されており、図9の(b)には、工程ST1の実行によりワイドエリアにおいて形成される堆積物DPの状態が示されている。図9に示すように、工程ST1の実行により、ワイドエリアでは、ナローエリアに比して、被エッチング層EL上に多くの堆積物DPが形成される。一方、ワイドエリアでは、ナローエリアに比して、工程ST2の実行時に酸素の活性種によって減少される堆積物DPの量が多くなる。したがって、ナローエリアの被エッチング層EL上の堆積物の量とワイドエリアの被エッチング層EL上の堆積物の量との差異が低減されつつ、エッチングが進行する。故に、ナローエリアの被エッチング層ELのエッチングレートとワイドエリアの被エッチング層ELのエッチングレートの差異が低減される。
以下、別の実施形態に係るエッチング方法について説明する。図10は、別の実施形態に係るエッチング方法を示す流れ図である。図10に示す方法MT2は、複数回のシーケンスSQ2を含んでいる。複数回のシーケンスSQ2の各々は、工程ST1と工程ST2との間に工程ST3を含む点で、シーケンスSQと異なっている。なお、方法MT2のシーケンスSQ2の工程ST2で利用される処理ガスは酸素含有ガスを含んでいなくてもよい。
シーケンスSQ2の工程ST3では、不活性ガス及び酸素含有ガスを含む処理ガスのプラズマが処理容器12内において生成される。このため、工程ST3では、ガスソース群40の複数のガスソースのうち選択されたガスソースから処理容器12内に処理ガスが供給される。この処理ガスは、酸素含有ガスとして、例えば、酸素ガス(Oガス)を含む。また、この処理ガスは、不活性ガスとして、窒素ガス及び/又は希ガスを含む。また、工程ST3では、排気装置50が作動され、処理容器12内の圧力が所定の圧力に設定される。さらに、工程ST3では、第1の高周波電源62からの高周波が下部電極LEに供給される。また、工程ST3では、第2の高周波電源64からの高周波バイアスが下部電極LEに供給されてもよい。一実施形態の工程ST3では、電源70からの負極性の直流電圧が上部電極30に印加されてもよい。
以下に、工程ST3における各種条件を例示する。
・・処理容器内圧力:10mTorr(1.33Pa)〜150mTorr(20.00Pa)
・処理ガス
Arガス:500sccm〜1500sccm
ガス:0sccm〜400sccm
ガス:5sccm〜50sccm
・プラズマ生成用の高周波の電力:100W〜500W
・高周波バイアスの電力:0W〜300W
・電源70の負極性の直流電圧:−1000V〜0V
ここで、図11を参照する。図11は、図10に示す方法の実施の途中段階における被処理体の一部分を示す拡大断面図である。具体的に、図11の(a)には、工程ST3の実行後のナローエリアにおける堆積物DPの状態が示されており、図11の(b)には、工程ST3の実行後のワイドエリアにおける堆積物DPの状態が示されている。方法MTに関して図9を参照して説明したように、方法MT2においても、工程ST1の実行により、ワイドエリアでは、ナローエリアに比して、被エッチング層EL上に多くの堆積物DPが形成される。このようなエリアによる堆積物の量の差異を低減するために、工程ST3において、酸素含有ガスのプラズマが生成される。この工程ST3では、酸素の活性種によって減少される堆積物DPの量が、ワイドエリアでは、ナローエリアに比して多くなる。その結果、図11に示すように、ナローエリアの被エッチング層EL上の堆積物DPの量とワイドエリアの被エッチング層EL上の堆積物DPの量との差異が低減される。したがって、ナローエリアの被エッチング層ELのエッチングレートとワイドエリアの被エッチング層ELのエッチングレートの差異が低減される。また、方法MTの一実施形態では、工程ST2で用いられる処理ガスに酸素含有ガスが含められていたが、方法MT2では酸素含有ガスのプラズマの生成が工程ST2とは別途の工程ST3において行われる。即ち、方法MT2では、工程ST2と酸素含有ガスのプラズマを生成する工程ST3とが分離されている。したがって、方法MT2では、堆積物DPの量の調整の制御性が高められる。
以上、種々の実施形態について説明してきたが、上述した実施形態に限定されることなく種々の変形態様を構成可能である。例えば、方法MT及び方法MT2の実施に用いられるプラズマ処理装置は、プラズマ処理装置10に限定されるものではない。方法MT及び方法MT2の実施には、誘導結合型のプラズマ処理装置、マイクロ波といった表面波によってプラズマを生成するプラズマ処理装置のように、任意のプラズマ処理装置を用いることが可能である。
また、方法MT2のシーケンスSQ2では、工程ST1と工程ST2との間に工程ST3が実行されているが、工程ST3は工程ST2の後に実行されてもよい。
以下、方法MT及び方法MT2の評価のために行った実験例について説明するが、本発明はこれら実験例に限定されるものでない。
(実験例1〜7)
実験例1〜7では、図12の(a)に示すように、基板SB上に被エッチング層ELを有し、当該被エッチング層EL上にマスクMKを有する直径300mmのウエハを準備した。被エッチング層ELは、厚さ530nmのブラックダイアモンド(登録商標)から構成された第1の膜EL1と、厚さ50nmのTEOS膜である第2の膜EL2とを有するものであった。また、マスクMKは、TiN製であり、35nmの厚さを有し、ライン・アンド・スペースパターンを有するものであった。実験例1〜7で準備したウエハのマスクMKの開口(スペース)の幅MCDはそれぞれ、40nm、44nm、50nm、75nm、126nm、275nm,468nmであった。
実験例1〜7では、以下に示す条件のシーケンスSQを含む方法MTを、プラズマ処理装置10を用いて実行し、被エッチング層ELをエッチングした。なお、シーケンスSQの実行回数は40回であった。
<工程ST1>
・処理容器12内の空間の圧力:85mT(11.33Pa)
・処理ガス
ガス:30sccm
Arガス:1000sccm
・第1の高周波電源62の高周波:40MHz、300W
・第2の高周波電源64の高周波バイアス:13MHz、100W
・電源70の負極性の直流電圧:−300V
・処理時間:4秒
<工程ST2>
・処理容器12内の空間の圧力:85mT(11.33Pa)
・処理ガス
Arガス:1000sccm
ガス:20sccm
ガス:12sccm
・第1の高周波電源62の高周波:40MHz、300W
・第2の高周波電源64の高周波バイアス:13MHz、100W
・電源70の負極性の直流電圧:−300V
・処理時間:2秒
また、比較実験例1〜7において、実験例1〜7のウエハとそれぞれ同じウエハを準備した。そして、比較実験例1〜7では、以下に示す条件により、プラズマ処理装置10を用いて被エッチング層ELのエッチングを行った。
<比較実験例1〜7の条件>
・処理容器12内の空間の圧力:85mT(11.33Pa)
・処理ガス
ガス:30sccm
Arガス:1000sccm
ガス:20sccm
ガス:12sccm
・第1の高周波電源62の高周波:40MHz、300W
・第2の高周波電源64の高周波バイアス:13MHz、100W
・電源70の負極性の直流電圧:−300V
・処理時間:180秒
そして、実験例1〜7及び比較実験例1〜7の上記処理後のウエハのSEM画像を取得し、被エッチング層ELに形成された開口の深さDepth(図12の(b)を参照)を、SEM画像から求めた。図13のグラフに結果を示す。図13のグラフにおいて、横軸は、マスクMKの開口の幅MCDを示しており、縦軸は、ローディング効果(%)を示している。実験例1〜7についてのローディング効果(%)は、実験例7の深さDepthを100%として実験例1〜7で求めた深さDepthのそれぞれを規格化した値(%)であり、また、比較実験例1〜7についてのローディング効果(%)は、比較実験例7の深さDepthを100%として比較実験例1〜7で求めた深さDepthのそれぞれを規格化した値(%)である。図13に示すように、比較実験例1〜7では、マスクMKの開口の幅MCDが異なると、被エッチング層ELに形成された開口の深さDepthも大きく異なることが確認された。一方、実験例1〜7では、マスクMKの開口の幅MCDに差異が存在していても、被エッチング層ELに形成された開口の深さDepthの差異が低減されることが確認された。即ち、実験例1〜7では、ナローエリア及びワイドエリアの双方が存在するウエハであっても、双方のエリアにおけるエッチングレートの差異が低減されることが確認された。
(実験例8)
実験例8では、図14の(a)に示すように、基板SB上に被エッチング層ELを有し、当該被エッチング層EL上にマスクMKを有する直径300mmのウエハを準備した。被エッチング層ELは、厚さ530nmのブラックダイアモンド(登録商標)から構成された第1の膜EL1と、厚さ50nmのTEOS膜である第2の膜EL2とを有するものであった。また、マスクMKは、TiN製であり、35nmの厚さを有し、ライン・アンド・スペースパターンを有するものであった。実験例8で準備したウエハのマスクMKの開口(スペース)の幅MCDは40nmであった。そして、実験例8では、実験例1〜7の条件と同条件の方法MTをプラズマ処理装置10を用いて実行し、被エッチング層ELをエッチングした。
また、比較実験例8では、実験例8と同様のウエハを準備し、比較実験例1〜7と同様の条件で、プラズマ処理装置10を用いて被エッチング層ELをエッチングした。
そして、実験例8及び比較実験例8の上記処理後のウエハのSEM画像を取得し、被エッチング層ELに形成された開口の深さDepth、マスクMKの厚さMH、及び、被エッチング層ELの開口の上端における幅TCD(図14の(b)参照)を求めた。図15の表はその結果を示している。図15の表には、ウエハの直径上の中心、ウエハのエッジから10mm、ウエハのエッジから5mmのそれぞれの位置における深さDepth、厚さMH、幅TCDが示されている。図15の表に示すように、実験例8では、比較実験例8に比して、エッジにおけるマスクMKの厚さMHが大きかった。即ち、実験例8では、エッジにおけるマスクMKの浸食が抑制されることが確認された。また、実験例8では、ウエハ内の領域によらず、被エッチング層ELに形成された開口の上端の幅TCDが略均一となり、また、被エッチング層ELに形成された開口の深さDepthの差異も小さくなることが確認された。
(実験例9)
実験例9では、TiN製の第1の膜を有する直径300mmのウエハ、及びブラックダイアモンド(登録商標)製の第2の膜を有する直径300mmのウエハを準備し、双方のウエハの膜、即ち第1の膜及び第2の膜を実験例1〜7と同条件でプラズマ処理装置10を用いてエッチングした。また、比較実験例9では、TiN製の第1の膜を有する直径300mmのウエハ、及びブラックダイアモンド(登録商標)製の第2の膜を有する直径300mmのウエハを準備し、双方のウエハの膜、即ち第1の膜及び第2の膜を比較実験例1〜7と同様の条件でプラズマ処理装置10を用いてエッチングした。
そして、実験例9及び比較実験例9のそれぞれにおいて、エッチング前後の第2の膜の厚さの差をエッチング前後の第1の膜の厚さの差で除した値を選択比として求めた。なお、選択比については、互いに直交するウエハの二つの直径(即ち、X axis、及びY axis)上の複数の箇所において求めた。その結果を図16に示す。図16の(a)には比較実験例9の選択比のグラフが示されており、図16の(b)には実験例9の選択比のグラフが示されている。図16に示すグラフにおいて、横軸は、ウエハの直径上の各箇所のウエハの中心からの距離を示しており、縦軸は選択比を示している。図16に示すように、実験例9では、比較実験例9に比して、ウエハのエッジにおける選択比とウエハの中心側の領域における選択比との差異が大幅に低減されることが確認された。
10…プラズマ処理装置、12…処理容器、PD…載置台、LE…下部電極、ESC…静電チャック、FR…フォーカスリング、30…上部電極、34…天板、40…ガスソース群、50…排気装置、62…第1の高周波電源、64…第2の高周波電源、W…ウエハ、EL…被エッチング層、MK…マスク、DP…堆積物。

Claims (8)

  1. 被エッチング層をエッチングする方法であって、該被エッチング層はシリコンを含有し、該被エッチング層上には金属を含有するマスクが設けられており、該方法は、
    フルオロカーボンを含む堆積物を前記マスク及び前記被エッチング層上に形成するために、該マスク及び該被エッチング層を有する被処理体を収容したプラズマ処理装置の処理容器内において、フルオロカーボンガスを含む第1の処理ガスのプラズマを生成する工程と、
    前記堆積物に含まれるフルオロカーボンのラジカルにより前記被エッチング層をエッチングするために、前記処理容器内において不活性ガスを含む第2の処理ガスのプラズマを生成する工程と、
    を含み、
    第1の処理ガスのプラズマを生成する前記工程と第2の処理ガスのプラズマを生成する前記工程とを含む複数回のシーケンスが実行される、方法。
  2. 前記第2の処理ガスは、前記不活性ガスとして希ガス又は窒素ガスを含む、請求項1に記載の方法。
  3. 前記第2の処理ガスは、前記不活性ガスとして希ガスを含み、且つ、窒素ガスを含む請求項1に記載の方法。
  4. 前記第2の処理ガスは、酸素含有ガスを更に含む、請求項2又は3に記載の方法。
  5. 前記複数回のシーケンスの少なくとも一部は、処理容器内において酸素含有ガス及び不活性ガスを含む処理ガスのプラズマを生成する工程を更に含む、請求項2又は3に記載の方法。
  6. 前記マスクは窒化チタン製である、請求項1〜5の何れか一項に記載の方法。
  7. 前記複数回のシーケンスが実行される期間にわたって、前記マスク及び前記被エッチング層を有する被処理体のエッジを囲むようにフォーカスリングが配置され、
    前記フォーカスリングは、前記被エッチング層を構成する材料とは異なる材料から構成される、
    請求項1〜6の何れか一項に記載の方法。
  8. 前記プラズマ処理装置は、容量結合型のプラズマ処理装置であり、前記処理容器内の空間を画成する面を含むシリコン製の領域を有する上部電極、及び前記上部電極に負極性の直流電圧を印加するための直流電源を備え、
    少なくとも、第1の処理ガスのプラズマを生成する前記工程において、前記上部電極に前記負極性の直流電圧が印加される、
    請求項1〜7の何れか一項に記載の方法。
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Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2019207911A (ja) * 2018-05-28 2019-12-05 東京エレクトロン株式会社 膜をエッチングする方法及びプラズマ処理装置
WO2020039943A1 (ja) * 2018-08-21 2020-02-27 東京エレクトロン株式会社 エッチング方法及びプラズマ処理装置
WO2020110363A1 (ja) * 2018-11-30 2020-06-04 東京エレクトロン株式会社 基板処理方法および基板処理システム
JP2020119918A (ja) * 2019-01-18 2020-08-06 東京エレクトロン株式会社 膜をエッチングする方法
JP2020126999A (ja) * 2019-01-31 2020-08-20 東京エレクトロン株式会社 基板を処理する方法および装置
JP2021057494A (ja) * 2019-09-30 2021-04-08 東京エレクトロン株式会社 基板処理方法、及び基板処理装置
US11955316B2 (en) 2019-10-01 2024-04-09 Tokyo Electron Limited Substrate processing method, method for manufacturing semiconducor device, and plasma processing apparatus
TWI846723B (zh) 2018-08-21 2024-07-01 日商東京威力科創股份有限公司 蝕刻方法及電漿處理裝置

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7323409B2 (ja) * 2019-10-01 2023-08-08 東京エレクトロン株式会社 基板処理方法、及び、プラズマ処理装置
US20210195726A1 (en) * 2019-12-12 2021-06-24 James Andrew Leskosek Linear accelerator using a stacked array of cyclotrons
TW202213517A (zh) * 2020-08-28 2022-04-01 日商東京威力科創股份有限公司 基板處理方法及電漿處理裝置
US20220310626A1 (en) * 2021-03-29 2022-09-29 Changxin Memory Technologies, Inc. Method for fabricating semiconductor device
KR20240000122U (ko) 2022-07-12 2024-01-19 주식회사 피앤피코리아 친환경벽지로 만든 다이어리커버

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04100229A (ja) * 1990-08-20 1992-04-02 Fujitsu Ltd 半導体装置の製造方法
JPH11195641A (ja) * 1998-01-05 1999-07-21 Matsushita Electric Ind Co Ltd プラズマ処理方法
JP2003282539A (ja) * 2002-03-25 2003-10-03 Tokyo Electron Ltd プラズマエッチング方法
JP2009246183A (ja) * 2008-03-31 2009-10-22 Tokyo Electron Ltd プラズマエッチング方法及びコンピュータ読み取り可能な記憶媒体
JP2010098220A (ja) * 2008-10-20 2010-04-30 Tokyo Electron Ltd プラズマエッチング方法及びプラズマエッチング装置
JP2011082260A (ja) * 2009-10-05 2011-04-21 Asahi Kasei Corp ドライエッチング方法
JP2013098193A (ja) * 2011-10-28 2013-05-20 Tokyo Electron Ltd 半導体装置の製造方法

Family Cites Families (14)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6423175B1 (en) * 1999-10-06 2002-07-23 Taiwan Semiconductor Manufacturing Co., Ltd Apparatus and method for reducing particle contamination in an etcher
US6569774B1 (en) * 2000-08-31 2003-05-27 Micron Technology, Inc. Method to eliminate striations and surface roughness caused by dry etch
US20040241995A1 (en) * 2003-03-27 2004-12-02 Matsushita Electric Industrial Co., Ltd. Etching apparatus and etching method
US7740737B2 (en) * 2004-06-21 2010-06-22 Tokyo Electron Limited Plasma processing apparatus and method
US20060151116A1 (en) * 2005-01-12 2006-07-13 Taiwan Semiconductor Manufacturing Co., Ltd. Focus rings, apparatus in chamber, contact hole and method of forming contact hole
JP4701776B2 (ja) 2005-03-25 2011-06-15 東京エレクトロン株式会社 エッチング方法及びエッチング装置
US7704849B2 (en) * 2007-12-03 2010-04-27 Micron Technology, Inc. Methods of forming trench isolation in silicon of a semiconductor substrate by plasma
US8614151B2 (en) * 2008-01-04 2013-12-24 Micron Technology, Inc. Method of etching a high aspect ratio contact
US8652969B2 (en) * 2011-10-26 2014-02-18 International Business Machines Corporation High aspect ratio and reduced undercut trench etch process for a semiconductor substrate
US9165783B2 (en) * 2012-11-01 2015-10-20 Applied Materials, Inc. Method of patterning a low-k dielectric film
JP6538300B2 (ja) * 2012-11-08 2019-07-03 ノベラス・システムズ・インコーポレーテッドNovellus Systems Incorporated 感受性基材上にフィルムを蒸着するための方法
JP2014107387A (ja) * 2012-11-27 2014-06-09 Tokyo Electron Ltd 載置台構造及びフォーカスリングを保持する方法
JP6059048B2 (ja) * 2013-03-11 2017-01-11 東京エレクトロン株式会社 プラズマエッチング方法
JP6140575B2 (ja) * 2013-08-26 2017-05-31 東京エレクトロン株式会社 半導体装置の製造方法

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04100229A (ja) * 1990-08-20 1992-04-02 Fujitsu Ltd 半導体装置の製造方法
JPH11195641A (ja) * 1998-01-05 1999-07-21 Matsushita Electric Ind Co Ltd プラズマ処理方法
JP2003282539A (ja) * 2002-03-25 2003-10-03 Tokyo Electron Ltd プラズマエッチング方法
JP2009246183A (ja) * 2008-03-31 2009-10-22 Tokyo Electron Ltd プラズマエッチング方法及びコンピュータ読み取り可能な記憶媒体
JP2010098220A (ja) * 2008-10-20 2010-04-30 Tokyo Electron Ltd プラズマエッチング方法及びプラズマエッチング装置
JP2011082260A (ja) * 2009-10-05 2011-04-21 Asahi Kasei Corp ドライエッチング方法
JP2013098193A (ja) * 2011-10-28 2013-05-20 Tokyo Electron Ltd 半導体装置の製造方法

Cited By (19)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP7022651B2 (ja) 2018-05-28 2022-02-18 東京エレクトロン株式会社 膜をエッチングする方法及びプラズマ処理装置
JP2019207911A (ja) * 2018-05-28 2019-12-05 東京エレクトロン株式会社 膜をエッチングする方法及びプラズマ処理装置
WO2020039943A1 (ja) * 2018-08-21 2020-02-27 東京エレクトロン株式会社 エッチング方法及びプラズマ処理装置
JP2020031112A (ja) * 2018-08-21 2020-02-27 東京エレクトロン株式会社 エッチング方法及びプラズマ処理装置
TWI846723B (zh) 2018-08-21 2024-07-01 日商東京威力科創股份有限公司 蝕刻方法及電漿處理裝置
US12014930B2 (en) 2018-08-21 2024-06-18 Tokyo Electron Limited Etching method and plasma processing apparatus
JP7198609B2 (ja) 2018-08-21 2023-01-04 東京エレクトロン株式会社 エッチング方法及びプラズマ処理装置
JP2020088355A (ja) * 2018-11-30 2020-06-04 東京エレクトロン株式会社 基板処理方法
US11955337B2 (en) 2018-11-30 2024-04-09 Tokyo Electron Limited Substrate processing method and substrate processing system
WO2020110363A1 (ja) * 2018-11-30 2020-06-04 東京エレクトロン株式会社 基板処理方法および基板処理システム
JP7174634B2 (ja) 2019-01-18 2022-11-17 東京エレクトロン株式会社 膜をエッチングする方法
US11594422B2 (en) 2019-01-18 2023-02-28 Tokyo Electron Limited Film etching method for etching film
TWI833873B (zh) * 2019-01-18 2024-03-01 日商東京威力科創股份有限公司 膜之蝕刻方法
JP2020119918A (ja) * 2019-01-18 2020-08-06 東京エレクトロン株式会社 膜をエッチングする方法
JP2020126999A (ja) * 2019-01-31 2020-08-20 東京エレクトロン株式会社 基板を処理する方法および装置
JP7414535B2 (ja) 2019-01-31 2024-01-16 東京エレクトロン株式会社 基板を処理する方法および装置
JP2021057494A (ja) * 2019-09-30 2021-04-08 東京エレクトロン株式会社 基板処理方法、及び基板処理装置
JP7330046B2 (ja) 2019-09-30 2023-08-21 東京エレクトロン株式会社 基板処理方法、及び基板処理装置
US11955316B2 (en) 2019-10-01 2024-04-09 Tokyo Electron Limited Substrate processing method, method for manufacturing semiconducor device, and plasma processing apparatus

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