JP2016517607A - シフトレジスタ、表示装置、ゲート駆動回路及び駆動方法 - Google Patents
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Abstract
Description
プルアップ回路に対してプリチャージするためのプリチャージ回路と、
プリチャージされた後、出力端にハイレベルを出力させるプルアップ回路と、
出力端がハイレベルを出力した後、前記第N段のシフトレジスト回路をリセットするリセット回路と、
前記第N段のシフトレジスト回路がリセットされた後、第N段のシフトレジスト回路の出力レベルをホールドするホールド回路と
を含み、
前記プリチャージ回路は、制御端と入力端が前段のシフトレジスト回路の出力端に接続され、出力端が前記リセット回路の入力端に接続され、
前記プルアップ回路は、入力端が第1の制御信号端子に接続され、
前記リセット回路は、制御端が後段のシフトレジスト回路の出力端に接続され、出力端が接地され、
前記ホールド回路は、前記プリチャージ回路の出力端と、前記リセット回路の入力端と、前記プルアップ回路の制御端と、前記プルアップ回路の出力端とに接続され、第1の制御端が前記第1の制御信号端子に接続され、第2の制御端が前記第2の制御信号端子に接続され、
前記ホールド回路には、ゲートが前記第1の制御信号端子に接続され、ソースとドレインが互いに接続された第8のトランジスタが設置されている。
前記第2のホールド回路は、ゲートが前記ホールド回路の第2の制御端でありソースが第6のトランジスタのソースと前記プルアップ回路の出力端とに接続されドレインが接地される第4のトランジスタと、ゲートが第7のトランジスタのゲートに接続されドレインが接地される前記第6のトランジスタと、ソースが前記プリチャージ回路の出力端と前記リセット回路の入力端と前記プルアップ回路の制御端とに接続されドレインが接地される前記第7のトランジスタとを含み、
前記第1のホールド回路と第2のホールド回路は、第8のトランジスタのソースとドレイン、前記第5のトランジスタのソース、前記第6のトランジスタのゲート、前記第7のトランジスタのゲートを接続するプルダウンノードによって接続される。
前記第2のホールド回路は、ゲートが前記ホールド回路の第2の制御端であり、ソースが第7のトランジスタのソース及び前記プルアップ回路の出力端に接続され、ドレインが接地される第4のトランジスタと、ゲートが前記第7のトランジスタのゲートに接続され、ソースが前記プリチャージ回路の出力端と前記リセット回路の入力端と前記プルアップ回路の制御端とに接続され、ドレインが前記第7のトランジスタのソースに接続される第6のトランジスタと、ドレインが接地される前記第7のトランジスタとを含み、
前記第1のホールド回路と第2のホールド回路はプルダウンノードによって接続され、前記プルダウンノードは、第8のトランジスタのソースとドレイン、前記第5のトランジスタのソース、第6のトランジスタのゲート、前記第7のトランジスタのゲートに接続される。
S1,プリチャージ回路がプルアップ回路に充電する、
S2,プルアップ回路がシフトレジスト回路のレベルをプルアップさせ、シフトレジスト回路がハイレベルを出力する、
S3、リセット回路がシフトレジスト回路をリセットさせる、
S4、シフトレジスト回路がリセットされた後、ホールド回路がシフトレジスト回路の出力レベルをホールドする、
を含み、
前記ステップS4で、ホールド回路における第8のトランジスタの等価容量は第8のトランジスタのオン又はオフによって変化し、第8のトランジスタがオンされる場合の等価容量は第8のトランジスタがオフされる場合の等価容量より大きいゲート駆動方法。
本発明の実施例に係るシフトレジスタは複数段のシフトレジスタ回路を含む。図2に示すように、当図において、SR0〜SRnはn段のシフトレジスタ回路の各段であり、GL0〜GLnはn段のシフトレジスタ回路の出力端であり、STVが開始信号であり、各段のシフトレジスタは、前段の出力を開始信号STVとし、後段の出力をリセット信号RSTとし、ダブルクロックCKとCKBによって動作して、トップダウンのゲート駆動スキャン出力を実現する。
プルアップ回路に対してプリチャージするプリチャージ回路1と、
プリチャージされた後、出力端OUTPUTにハイレベルを出力させるプルアップ回路2と、
出力端OUTPUTがハイレベルを出力した後、前記第N段のシフトレジスト回路をリセットするリセット回路3と、
前記第N段のシフトレジスト回路がリセットされた後、第N段のシフトレジスト回路の出力レベルをホールドするホールド回路と
を含み、
Nが1以上の自然数である。
プルアップ回路2は、入力端が第1の制御信号端子CKに接続され、
リセット回路3は、制御端が後段のシフトレジスト回路の出力端N+1_OUTに接続され、出力端が接地され、
前記ホールド回路は、プリチャージ回路1の出力端と、リセット回路3の入力端と、プルアップ回路2の制御端と、プルアップ回路2の出力端とに接続され、第1の制御端が前記第1の制御信号端子CKに接続され、第2の制御端が前記第2の制御信号端子CKBに接続され、
前記ホールド回路には、ゲートが前記第1の制御信号端子に接続され、ソースとドレインが互いに接続された第8のトランジスタM8が設置される。
第2のホールド回路4Bは、ゲートが前記ホールド回路の第2の制御端でありソースが第6のトランジスタM6のソースとプルアップ回路2の出力端とに接続されドレインが接地される第4のトランジスタM4と、ゲートが第7のトランジスタM7のゲートに接続されドレインが接地される第6のトランジスタM6と、ソースがプリチャージ回路1の出力端と前記リセット回路3の入力端とプルアップ回路2の制御端とに接続されドレインが接地される第7のトランジスタM7とを含み、
第1のホールド回路4Aと第2のホールド回路4Bは、第8のトランジスタM8のソースとドレイン、第5のトランジスタM5のソース、第6のトランジスタM6のゲート、第7のトランジスタM7のゲートを接続するプルダウンノードPDによって接続される。
本発明の実施例のシフトレジスタは図6に示すようであり、その特徴が実施例1と基本的に同じであって、実施例1との違い点は、第1のホールド回路4Aが、ゲートがプルアップ回路の制御端に接続され、ドレインが接地された第5のトランジスタM5と、制御端が前記ホールド回路の第1の制御端であり、ソースとドレインが第5のトランジスタM5のソースに接続される第8のトランジスタM8とを含み、
第2のホールド回路4Bは、ゲートが前記ホールド回路の第2の制御端であり、ソースが第7のトランジスタM7のソース及びプルアップ回路2の出力端に接続され、ドレインが接地される第4のトランジスタM4と、ゲートが第7のトランジスタM7のゲートと接続され、ソースがプリチャージ回路1の出力端とリセット回路3の入力端とプルアップ回路2の制御端とに接続され、ドレインが第7のトランジスタM7のソースに接続される第6のトランジスタM6と、ドレインが接地される第7のトランジスタM7とを含み、
第1のホールド回路4Aと第2のホールド回路4BはプルダウンノードPDによって接続され、プルダウンノードPDは、第8のトランジスタのソースとドレイン、第5のトランジスタのソース、第6のトランジスタのゲート、第7のトランジスタのゲートに接続されることである。
ステップS1で、プリチャージ回路がプルアップ回路に充電し、
ステップS2で、プルアップ回路がシフトレジスト回路のレベルをプルアップさせ、シフトレジスト回路がハイレベルを出力し、
ステップS3で、リセット回路がシフトレジスト回路をリセットさせ、
ステップS4で、シフトレジスタ回路がリセットされた後、ホールド回路はシフトレジスト回路の出力レベルをホールドする。
M2 第2のトランジスタ
M3 第3のトランジスタ
M4 第4のトランジスタ
M5 第5のトランジスタ
M6 第6のトランジスタ
M7 第7のトランジスタ
M8 第8のトランジスタ
PD プルダウンノード
PU プルアップノード
Reset リセット回路
RST リセット信号
STV 開始信号
Claims (10)
- シフトレジスタであって、複数の段のシフトレジスト回路を含み、前記複数の段のシフトレジスト回路の第N段のシフトレジスト回路は、
プルアップ回路にプリチャージするためのプリチャージ回路と、
プリチャージされた後、出力端にハイレベルを出力させるプルアップ回路と、
出力端がハイレベルを出力した後、前記第N段のシフトレジスト回路をリセットするリセット回路と、
前記第N段のシフトレジスト回路がリセットされた後、第N段のシフトレジスト回路の出力レベルをホールドするホールド回路と
を含み、
前記プリチャージ回路は、制御端と入力端が前段のシフトレジスト回路の出力端に接続され、出力端が前記リセット回路の入力端に接続され、
前記プルアップ回路は、入力端が第1の制御信号端子に接続され、
前記リセット回路は、制御端が後段のシフトレジスト回路の出力端に接続され、出力端が接地され、
前記ホールド回路は、前記プリチャージ回路の出力端と、前記リセット回路の入力端と、プルアップ回路の制御端と、プルアップ回路の出力端とに接続され、第1の制御端が前記第1の制御信号端子に接続され、第2の制御端が前記第2の制御信号端子に接続され、
前記ホールド回路には、ゲートが前記第1の制御信号端子に接続され、ソースとドレインが互いに接続された第8のトランジスタが設置されているシフトレジスタ。 - 前記ホールド回路は、前記第8のトランジスタが設置された第1のホールド回路と、第2のホールド回路とを含む請求項1に記載のシフトレジスタ。
- 前記第1のホールド回路は、ゲートが前記プルアップ回路の制御端に接続されドレインが接地される第5のトランジスタと、ゲートが前記ホールド回路の第1の制御端であり、ソースとドレインが前記第5のトランジスタのソースに接続される第8のトランジスタとを含み、
前記第2のホールド回路は、ゲートが前記ホールド回路の第2の制御端でありソースが第6のトランジスタのソースと前記プルアップ回路の出力端とに接続されドレインが接地される第4のトランジスタと、ゲートが第7のトランジスタのゲートに接続されドレインが接地される第6のトランジスタと、ソースが前記プリチャージ回路の出力端と前記リセット回路の入力端と前記プルアップ回路の制御端とに接続されドレインが接地される前記第7のトランジスタとを含み、
前記第1のホールド回路と第2のホールド回路は、第8のトランジスタのソースとドレイン、前記第5のトランジスタのソース、前記第6のトランジスタのゲート、前記第7のトランジスタのゲートを接続するプルダウンノードによって接続される請求項2に記載のシフトレジスタ。 - 前記第1のホールド回路は、ゲートが前記プルアップ回路の制御端に接続され、ドレインが接地された第5のトランジスタと、制御端が前記ホールド回路の第1の制御端であり、ソースとドレインが前記第5のトランジスタのソースに接続される第8のトランジスタとを含み、
前記第2のホールド回路は、ゲートが前記ホールド回路の第2の制御端であり、ソースが第7のトランジスタのソース及び前記プルアップ回路の出力端に接続され、ドレインが接地される第4のトランジスタと、ゲートが前記第7のトランジスタのゲートと接続され、ソースが前記プリチャージ回路の出力端と前記リセット回路の入力端と前記プルアップ回路の制御端とに接続され、ドレインが前記第7のトランジスタのソースに接続される第6のトランジスタと、ドレインが接地される前記第7のトランジスタとを含み、
前記第1のホールド回路と第2のホールド回路はプルダウンノードによって接続され、前記プルダウンノードは、第8のトランジスタのソースとドレイン、前記第5のトランジスタのソース、前記第6のトランジスタのゲート、前記第7のトランジスタのゲートに接続される請求項2に記載のシフトレジスタ。 - 前記プリチャージ回路は、ゲートが制御端であり、ソースが入力端であり、ドレインが出力端である第1のトランジスタを含む請求項1に記載のシフトレジスタ。
- 前記リセット回路は、ゲートが制御端であり、ソースが入力端であり、ドレインが出力端である第2のトランジスタを含む請求項1に記載のシフトレジスタ。
- プルアップ回路は、ゲートが制御端でありソースが入力端であり、ドレインが出力端である第3のトランジスタと、一端が前記第3のトランジスタのゲートに接続され他端が前記第3のトランジスタのドレインに接続されるキャパシタとを含む請求項1に記載のシフトレジスタ。
- ゲート駆動回路であって、
請求項1〜7のいずれか1項に記載のシフトレジスタを含むゲート駆動回路。 - 表示装置であって、
請求項8に記載のゲート駆動回路を含む表示装置。 - ゲート駆動方法であって、以下のステップを含み、
プリチャージ回路がプルアップ回路に充電し(S1)、
プルアップ回路がシフトレジスト回路のレベルをプルアップさせ、シフトレジスト回路がハイレベルを出力し(S2)、
リセット回路がシフトレジスト回路をリセットさせ(S3)、
シフトレジスト回路がリセットされた後、ホールド回路がシフトレジスト回路の出力レベルをホールドし(S4)、
前記ステップS4で、ホールド回路における第8のトランジスタの等価容量は第8のトランジスタのオン又はオフによって変化し、第8のトランジスタがオンされる場合の等価容量は第8のトランジスタがオフされる場合の等価容量より大きいゲート駆動方法。
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