JP2015179881A - 半導体装置 - Google Patents

半導体装置 Download PDF

Info

Publication number
JP2015179881A
JP2015179881A JP2015137716A JP2015137716A JP2015179881A JP 2015179881 A JP2015179881 A JP 2015179881A JP 2015137716 A JP2015137716 A JP 2015137716A JP 2015137716 A JP2015137716 A JP 2015137716A JP 2015179881 A JP2015179881 A JP 2015179881A
Authority
JP
Japan
Prior art keywords
substrate
circuit
transistor
layer
signal
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Withdrawn
Application number
JP2015137716A
Other languages
English (en)
Inventor
木村 肇
Hajime Kimura
肇 木村
敦司 梅崎
Atsushi Umezaki
敦司 梅崎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Semiconductor Energy Laboratory Co Ltd filed Critical Semiconductor Energy Laboratory Co Ltd
Priority to JP2015137716A priority Critical patent/JP2015179881A/ja
Publication of JP2015179881A publication Critical patent/JP2015179881A/ja
Withdrawn legal-status Critical Current

Links

Images

Classifications

    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
    • G11C19/00Digital stores in which the information is moved stepwise, e.g. shift registers
    • G11C19/28Digital stores in which the information is moved stepwise, e.g. shift registers using semiconductor elements
    • GPHYSICS
    • G02OPTICS
    • G02FOPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G02F1/1333Constructional arrangements; Manufacturing methods
    • G02F1/1345Conductors connecting electrodes to cell terminals
    • G02F1/13454Drivers integrated on the active matrix substrate
    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
    • G11C19/00Digital stores in which the information is moved stepwise, e.g. shift registers
    • G11C19/30Digital stores in which the information is moved stepwise, e.g. shift registers using opto-electronic devices, i.e. light-emitting and photoelectric devices electrically- or optically-coupled
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/12Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body
    • H01L27/1214Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs
    • H01L27/1218Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being other than a semiconductor body, e.g. an insulating body comprising a plurality of TFTs formed on a non-semiconducting substrate, e.g. driving circuits for AMLCDs with a particular composition or structure of the substrate
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2300/00Aspects of the constitution of display devices
    • G09G2300/04Structural and physical details of display devices
    • G09G2300/0404Matrix technologies
    • G09G2300/0408Integration of the drivers onto the display substrate
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2330/00Aspects of power supply; Aspects of display protection and defect management
    • G09G2330/02Details of power systems and of start or stop of display operation
    • G09G2330/021Power management, e.g. power saving
    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611Control of matrices with row and column drivers
    • G09G3/3648Control of matrices with row and column drivers using an active matrix
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/66007Multistep manufacturing processes
    • H01L29/66075Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
    • H01L29/66227Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
    • H01L29/66409Unipolar field-effect transistors
    • H01L29/66477Unipolar field-effect transistors with an insulated gate, i.e. MISFET
    • H01L29/66742Thin film unipolar transistors
    • H01L29/66772Monocristalline silicon transistors on insulating substrates, e.g. quartz substrates

Landscapes

  • Physics & Mathematics (AREA)
  • Power Engineering (AREA)
  • Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Computer Hardware Design (AREA)
  • Optics & Photonics (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Chemical & Material Sciences (AREA)
  • Mathematical Physics (AREA)
  • Thin Film Transistor (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)
  • Liquid Crystal Display Device Control (AREA)
  • Liquid Crystal (AREA)
  • Devices For Indicating Variable Information By Combining Individual Elements (AREA)
  • Shift Register Type Memory (AREA)
  • Control Of El Displays (AREA)
  • Electroluminescent Light Sources (AREA)

Abstract

【課題】消費電力の低い半導体装置および表示装置を提供することを目的する。【解決手段】単結晶半導体基板から、単結晶半導体層を分離し、それを絶縁基板に固定し、絶縁基板上でTFTを形成する。そして、そのTFTを用いて、駆動回路を形成する。そのTFTは、活性層が概ね単結晶状態にあるため、電流特性が良い。その結果、消費電力が低く、薄型で、小型な表示装置を形成することが出来る。また、コントローラとソースドライバ中のシフトレジスタを、同じ電源電圧で動作させる。これにより、消費電力を下げることが出来る。【選択図】図1

Description

本発明は、物、方法、または、物を生産する方法に関する。特に、表示装置または半導体
装置に関する。特に、単結晶半導体を絶縁基板に固定して形成された表示装置に関する。
近年、画素だけでなく、駆動回路もガラス基板上に形成した表示装置が開発されている。
画素には、液晶素子や有機EL素子などが用いられている。そのとき、ガラス基板上では
、低温ポリシリコンで形成された薄膜トランジスタ(TFT)を用いて、回路が形成され
ている。しかしながら、TFTは、単結晶で形成されるトランジスタと比較すると、電流
特性が悪く、しきい値電圧が大きい。したがって、電源電圧や信号振幅を大きくして、動
作させている。振幅を大きくするためには、レベルシフタ回路などが用いられている(例
えば、特許文献1参照)。
特開2000−259111号公報
しかしながら、電源電圧や信号振幅が大きいため、低温ポリシリコンのTFTで形成され
た回路は、非常に消費電力が大きいという問題点があった。また、低温ポリシリコンのT
FTで形成された回路で動作させるためには、電源電圧を高くする必要があった。そのた
め、低温ポリシリコンのTFTで形成された回路専用の電源電圧を供給する必要があった
。専用の電源電圧を供給する電源回路は、そのモジュールの大きさが大きいため、表示装
置の小型化や軽量化の妨げとなった。また、電源回路は、電力の利用効率が低かった。そ
のため、無駄になってしまう電力も多く、消費電力が大きくなってしまっていた。
このような問題に鑑み、消費電力の少ない半導体装置及び表示装置を提供することを課題
とする。または、小型の半導体装置及び表示装置を提供することを課題とする。または、
薄型の半導体装置及び表示装置を提供することを課題とする。
そこで、単結晶半導体基板から、単結晶半導体層を取り出し、それを絶縁基板に固定し、
絶縁基板上でTFTを形成する。または、単結晶半導体基板を絶縁基板に貼り付け、単結
晶半導体基板を分離することによって、単結晶半導体基板の一部の単結晶半導体層を絶縁
基板に固定し、絶縁基板上でTFTを形成する。そして、そのTFTを用いて、駆動回路
を形成する。そのTFTは、活性層が概ね単結晶状態にあるため、電流特性が良い。その
結果、消費電力が低く、薄型で、小型な表示装置を形成することが出来る。
単結晶半導体としては、代表的には単結晶シリコンが適用される。その他に、水素イオン
注入剥離法のようにして単結晶半導体基板から分離可能であるシリコン、ゲルマニウム、
その他、ガリウムヒ素、インジウムリンなどの化合物半導体による単結晶半導体層を適用
することもできる。また、絶縁基板としては、代表的には、ガラス基板が用いられる。そ
の他に、プラスチック基板、ステンレス基板など、さまざまな絶縁基板もしくは絶縁表面
を有する基板を用いることが出来る。
本発明は、薄膜トランジスタを有するシフトレジスタと、コントローラとを有し、薄膜ト
ランジスタは、単結晶半導体基板を絶縁基板に貼り付け、単結晶半導体基板を分離するこ
とによって、絶縁基板に固定された単結晶半導体層を有し、コントローラおよびシフトレ
ジスタに電源電圧が供給され、電源電圧の大きさが3ボルト以下であることを特徴として
いる。
また、本発明は、薄膜トランジスタを有するシフトレジスタと、コントローラとを有し、
薄膜トランジスタは、単結晶半導体基板を絶縁基板に貼り付け、単結晶半導体基板を分離
することによって、絶縁基板に固定された単結晶半導体層を有し、コントローラおよびシ
フトレジスタに電源電圧が供給され、コントローラから信号が出力され、シフトレジスタ
に信号が入力されることを特徴としている。
また、本発明は、ソースドライバとコントローラとを有し、ソースドライバは、薄膜トラ
ンジスタを有するシフトレジスタと、レベルシフタとを有し、薄膜トランジスタは、単結
晶半導体基板を絶縁基板に貼り付け、単結晶半導体基板を分離することによって、絶縁基
板に固定された単結晶半導体層を有し、レベルシフタは、能動負荷を有し、コントローラ
およびシフトレジスタに電源電圧が供給されることを特徴としている。
また、本発明は、前記構成において、絶縁基板は、ガラス基板であることを特徴としてい
る。
また、本発明は、前記構成において、単結晶半導体基板は、シリコン基板であり、単結晶
半導体層は、シリコン層であることを特徴としている。
また、本発明は、前記構成において、表示素子を具備することを特徴としている。
また、本発明は、前記構成において、液晶素子を具備することを特徴としている。
また、本発明は、前記構成において、発光素子を具備することを特徴としている。
また、本発明は、前記構成において、操作スイッチを具備することを特徴としている。
なお、スイッチは、様々な形態のものを用いることができる。例としては、電気的スイッ
チや機械的なスイッチなどがある。つまり、電流の流れを制御できるものであればよく、
特定のものに限定されない。例えば、スイッチとして、トランジスタ(例えば、バイポー
ラトランジスタ、MOSトランジスタなど)、ダイオード(例えば、PNダイオード、P
INダイオード、ショットキーダイオード、MIM(Metal Insulator
Metal)ダイオード、MIS(Metal Insulator Semicond
uctor)ダイオード、ダイオード接続のトランジスタなど)、サイリスタなどを用い
ることが出来る。または、これらを組み合わせた論理回路をスイッチとして用いることが
出来る。
機械的なスイッチの例としては、デジタルマイクロミラーデバイス(DMD)のように、
MEMS(マイクロ・エレクトロ・メカニカル・システム)技術を用いたスイッチがある
。そのスイッチは、機械的に動かすことが出来る電極を有し、その電極が動くことによっ
て、接続と非接続とを制御して動作する。
スイッチとしてトランジスタを用いる場合、そのトランジスタは、単なるスイッチとして
動作するため、トランジスタの極性(導電型)は特に限定されない。ただし、オフ電流を
抑えたい場合、オフ電流が少ない方の極性のトランジスタを用いることが望ましい。オフ
電流が少ないトランジスタとしては、LDD領域を有するトランジスタやマルチゲート構
造を有するトランジスタ等がある。または、スイッチとして動作させるトランジスタのソ
ース端子の電位が、低電位側電源(Vss、GND、0Vなど)の電位に近い状態で動作
する場合はNチャネル型トランジスタを用いることが望ましい。反対に、ソース端子の電
位が、高電位側電源(Vddなど)の電位に近い状態で動作する場合はPチャネル型トラ
ンジスタを用いることが望ましい。なぜなら、Nチャネル型トランジスタではソース端子
が低電位側電源の電位に近い状態で動作するとき、Pチャネル型トランジスタではソース
端子が高電位側電源の電位に近い状態で動作するとき、ゲートとソースの間の電圧の絶対
値を大きくできるからである。ソースフォロワ動作をしてしまうことが少ないため、出力
電圧の大きさが小さくなってしまうことが少ないからである。
なお、Nチャネル型トランジスタとPチャネル型トランジスタの両方を用いて、CMOS
型のスイッチをスイッチとして用いてもよい。CMOS型のスイッチにすると、Pチャネ
ル型トランジスタまたはNチャネル型トランジスタのどちらか一方のトランジスタが導通
すれば電流が流れるため、スイッチとして機能しやすくなる。例えば、スイッチへの入力
信号の電圧が高い場合でも、低い場合でも、適切に電圧を出力させることが出来る。さら
に、スイッチをオンまたはオフさせるための信号の電圧振幅値を小さくすることが出来る
ので、消費電力を小さくすることも出来る。
なお、スイッチとしてトランジスタを用いる場合、スイッチは、入力端子(ソース端子ま
たはドレイン端子の一方)と、出力端子(ソース端子またはドレイン端子の他方)と、導
通を制御する端子(ゲート端子)とを有している。一方、スイッチとしてダイオードを用
いる場合、スイッチは、導通を制御する端子を有していない場合がある。そのため、トラ
ンジスタよりもダイオードをスイッチとして用いた方が、端子を制御するための配線を少
なくすることが出来る。
なお、AとBとが接続されている、と明示的に記載する場合は、AとBとが電気的に接続
されている場合と、AとBとが機能的に接続されている場合と、AとBとが直接接続され
ている場合とを含むものとする。ここで、A、Bは、対象物(例えば、装置、素子、回路
、配線、電極、端子、導電膜、層、など)であるとする。したがって、所定の接続関係、
例えば、図または文章に示された接続関係に限定されず、図または文章に示された接続関
係以外のものも含むものとする。
例えば、AとBとが電気的に接続されている場合として、AとBとの電気的な接続を可能
とする素子(例えば、スイッチ、トランジスタ、容量素子、インダクタ、抵抗素子、ダイ
オードなど)が、AとBとの間に1個以上配置されていてもよい。あるいは、AとBとが
機能的に接続されている場合として、AとBとの機能的な接続を可能とする回路(例えば
、論理回路(インバータ、NAND回路、NOR回路など)、信号変換回路(DA変換回
路、AD変換回路、ガンマ補正回路など)、電位レベル変換回路(電源回路(昇圧回路、
降圧回路など)、信号の電位レベルを変えるレベルシフタ回路など)、電圧源、電流源、
切り替え回路、増幅回路(信号振幅または電流量などを大きく出来る回路、オペアンプ、
差動増幅回路、ソースフォロワ回路、バッファ回路など)、信号生成回路、記憶回路、制
御回路など)が、AとBとの間に1個以上配置されていてもよい。あるいは、AとBとが
直接接続されている場合として、AとBとの間に他の素子や他の回路を挟まずに、AとB
とが接続されていてもよい。
なお、AとBとが直接接続されている、と明示的に記載する場合は、AとBとが直接接続
されている場合(つまり、AとBとの間に他の素子や他の回路を間に介さずに接続されて
いる場合)を含むものとする。
なお、AとBとが電気的に接続されている、と明示的に記載する場合は、AとBとが電気
的に接続されている場合(つまり、AとBとの間に別の素子や別の回路を挟んで接続され
ている場合)と、AとBとが機能的に接続されている場合(つまり、AとBとの間に別の
回路を挟んで機能的に接続されている場合)と、AとBとが直接接続されている場合(つ
まり、AとBとの間に別の素子や別の回路を挟まずに接続されている場合)とを含むもの
とする。つまり、電気的に接続されている、と明示的に記載する場合は、単に、接続され
ている、とのみ明示的に記載されている場合と同じであるとする。
なお、表示素子、表示素子を有する装置である表示装置、発光素子、発光素子を有する装
置である発光装置は、様々な形態を用いたり、様々な素子を有することが出来る。表示素
子、または発光素子としては、例えば、EL素子(有機物及び無機物を含むEL素子、有
機EL素子、無機EL素子)、電子放出素子、液晶素子、電子インク、電気泳動素子、グ
レーティングライトバルブ(GLV)、プラズマディスプレイパネル(PDP)、デジタ
ルマイクロミラーデバイス(DMD)、圧電セラミックディスプレイ、カーボンナノチュ
ーブ、などを用いることができる。これらは、電気磁気的作用により、コントラスト、輝
度、反射率、透過率などが変化する素子である。なお、EL素子を用いた表示装置として
はELディスプレイ、電子放出素子を用いた表示装置としてはフィールドエミッションデ
ィスプレイ(FED)やSED方式平面型ディスプレイ(SED:Surface−co
nduction Electron−emitter Disply)など、液晶素子
を用いた表示装置としては液晶ディスプレイ(透過型液晶ディスプレイ、半透過型液晶デ
ィスプレイ、反射型液晶ディスプレイ、直視型液晶ディスプレイ、投射型液晶ディスプレ
イ)、電子インクや電気泳動素子を用いた表示装置としては電子ペーパーがある。
なお、EL素子とは、陽極と、陰極と、陽極と陰極との間に挟まれたEL層とを有する素
子である。なお、EL層としては、1重項励起子からの発光(蛍光)を利用するもの、3
重項励起子からの発光(燐光)を利用するもの、1重項励起子からの発光(蛍光)を利用
するものと3重項励起子からの発光(燐光)を利用するものとを含むもの、有機物によっ
て形成されたもの、無機物によって形成されたもの、有機物によって形成されたものと無
機物によって形成されたものとを含むもの、高分子の材料、低分子の材料、高分子の材料
と低分子の材料とを含むものなどを用いることができる。ただし、これに限定されず、E
L素子として様々なものを用いることができる。
なお、電子放出素子とは、先鋭な陰極に高電界を集中して電子を引き出す素子である。例
えば、電子放出素子として、スピント型、カーボンナノチューブ(CNT)型、金属―絶
縁体―金属を積層したMIM(Metal−Insulator−Metal)型、金属
―絶縁体―半導体を積層したMIS(Metal−Insulator−Semicon
ductor)型、MOS型、シリコン型、薄膜ダイオード型、ダイヤモンド型、表面伝
導エミッタSCD型、金属―絶縁体―半導体−金属型等の薄膜型、HEED型、EL型、
ポーラスシリコン型、表面伝導(SED)型などを用いることができる。ただし、これに
限定されず、電子放出素子として様々なものを用いることができる。
なお、液晶素子とは、液晶の光学的変調作用によって光の透過または非透過を制御する素
子であり、一対の電極、及び液晶により構成される。なお、液晶の光学的変調作用は、液
晶にかかる電界(横方向の電界、縦方向の電界又は斜め方向の電界を含む)によって制御
される。なお、液晶素子としては、ネマチック液晶、コレステリック液晶、スメクチック
液晶、ディスコチック液晶、サーモトロピック液晶、リオトロピック液晶、低分子液晶、
高分子液晶、強誘電液晶、反強誘電液晶、主鎖型液晶、側鎖型高分子液晶、プラズマアド
レス液晶(PALC)、バナナ型液晶などを挙げることができる。また液晶の駆動方式と
しては、TN(Twisted Nematic)モード、STN(Super Twi
sted Nematic)モード、IPS(In−Plane−Switching)
モード、FFS(Fringe Field Switching)モード、MVA(M
ulti−domain Vertical Alignment)モード、PVA(P
atterned Vertical Alignment)モード、ASV(Adva
nced Super View)モード、ASM(Axially Symmetri
c aligned Micro−cell)モード、OCB(Optical Com
pensated Birefringence)モード、ECB(Electrica
lly Controlled Birefringence)モード、FLC(Fer
roelectric Liquid Crystal)モード、AFLC(AntiF
erroelectric Liquid Crystal)モード、PDLC(Pol
ymer Dispersed Liquid Crystal)モード、ゲストホスト
モードなどを用いることができる。ただし、これに限定されず、液晶素子及びその駆動方
式として様々なものを用いることができる。
なお、電子ペーパーとしては、光学異方性と染料分子配向のような分子により表示される
もの、電気泳動、粒子移動、粒子回転、相変化のような粒子により表示されるもの、フィ
ルムの一端が移動することにより表示されるもの、分子の発色/相変化により表示される
もの、分子の光吸収により表示されるもの、電子とホールが結合して自発光により表示さ
れるものなどのことをいう。例えば、電子ペーパーの表示方法として、マイクロカプセル
型電気泳動、水平移動型電気泳動、垂直移動型電気泳動、球状ツイストボール、磁気ツイ
ストボール、円柱ツイストボール方式、帯電トナー、電子粉流体、磁気泳動型、磁気感熱
式、エレクトロウェッテイング、光散乱(透明/白濁変化)、コレステリック液晶/光導
電層、コレステリック液晶、双安定性ネマチック液晶、強誘電性液晶、2色性色素・液晶
分散型、可動フィルム、ロイコ染料による発消色、フォトクロミック、エレクトロクロミ
ック、エレクトロデポジション、フレキシブル有機ELなどを用いることができる。ただ
し、これに限定されず、電子ペーパー及びその表示方法として様々なものを用いることが
できる。ここで、マイクロカプセル型電気泳動を用いることによって、電気泳動方式の欠
点である泳動粒子の凝集、沈殿を解決することができる。電子粉流体は、高速応答性、高
反射率、広視野角、低消費電力、メモリー性などのメリットを有する。
なお、プラズマディスプレイパネルは、電極を表面に形成した基板と、電極及び微小な溝
を表面に形成し且つ溝内に蛍光体層を形成した基板とを狭い間隔で対向させて、希ガスを
封入した構造を有する。なお、電極間に電圧をかけることによって紫外線を発生させ、蛍
光体を光らせることで、表示を行うことができる。なお、プラズマディスプレイパネルと
しては、DC型PDP、AC型PDPでもよい。ここで、プラズマディスプレイパネルの
駆動方式としては、AWS(Address While Sustain)駆動、サブ
フレームをリセット期間、アドレス期間、維持期間に分割するADS(Address
Display Separated)駆動、CLEAR(High−Contrast
,Low Energy Address and Reduction of Fal
se Contour Sequence)駆動、ALIS(Alternate Li
ghting of Surfaces)方式、TERES(Technology o
f Reciprocal Sustainer)駆動などを用いることができる。ただ
し、これに限定されず、プラズマディスプレイパネルの駆動方式としては、様々なものを
用いることができる。
なお、光源を必要とする表示装置、例えば、液晶ディスプレイ(透過型液晶ディスプレイ
、半透過型液晶ディスプレイ、反射型液晶ディスプレイ、直視型液晶ディスプレイ、投射
型液晶ディスプレイ)、グレーティングライトバルブ(GLV)を用いた表示装置、デジ
タルマイクロミラーデバイス(DMD)を用いた表示装置などの光源としては、エレクト
ロルミネッセンス、冷陰極管、熱陰極管、LED、レーザー光源、水銀ランプなどを用い
ることができる。ただし、これに限定されず、光源して様々なものを用いることができる
なお、トランジスタとして、様々な形態のトランジスタを用いることが出来る。よって、
用いるトランジスタの種類に限定はない。例えば、非晶質シリコン、多結晶シリコン、微
結晶(マイクロクリスタル、セミアモルファスとも言う)シリコンなどに代表される非単
結晶半導体膜を有する薄膜トランジスタ(TFT)などを用いることが出来る。TFTを
用いる場合、様々なメリットがある。例えば、単結晶シリコンの場合よりも低い温度で製
造できるため、製造コストの削減、又は製造装置の大型化を図ることができる。製造装置
を大きくできるため、大型基板上に製造できる。そのため、同時に多くの個数の表示装置
を製造できるため、低コストで製造できる。さらに、製造温度が低いため、耐熱性の弱い
基板を用いることができる。そのため、透光性を有する基板上にトランジスタを製造でき
る。そして、透光性を有する基板上のトランジスタを用いて表示素子での光の透過を制御
することが出来る。あるいは、トランジスタの膜厚が薄いため、トランジスタを構成する
膜の一部は、光を透過させることが出来る。そのため、開口率が向上させることができる
なお、多結晶シリコンを製造するときに、触媒(ニッケルなど)を用いることにより、
結晶性をさらに向上させ、電気特性のよいトランジスタを製造することが可能となる。そ
の結果、ゲートドライバ回路(走査線駆動回路)やソースドライバ回路(信号線駆動回路
)、信号処理回路(信号生成回路、ガンマ補正回路、DA変換回路など)を基板上に一体
形成することが出来る。
なお、微結晶シリコンを製造するときに、触媒(ニッケルなど)を用いることにより、結
晶性をさらに向上させ、電気特性のよいトランジスタを製造することが可能となる。この
とき、レーザー照射を行うことなく、熱処理を加えるだけで、結晶性を向上させることが
できる。その結果、ゲートドライバ回路(走査線駆動回路)やソースドライバ回路の一部
(アナログスイッチなど)を基板上に一体形成することが出来る。さらに、結晶化のため
にレーザー照射を行わない場合は、シリコンの結晶性のムラを抑えることができる。その
ため、高画質の画像を表示することが出来る。
ただし、触媒(ニッケルなど)を用いずに、多結晶シリコンや微結晶シリコンを製造する
ことは可能である。
なお、シリコンの結晶性を、多結晶または微結晶などへと向上させることは、パネル全体
で行うことが望ましいが、それに限定されない。パネルの一部の領域のみにおいて、シリ
コンの結晶性を向上させてもよい。選択的に結晶性を向上させることは、レーザー光を選
択的に照射することなどにより可能である。例えば、画素以外の領域である周辺回路領域
にのみ、レーザー光を照射してもよい。または、ゲートドライバ回路、ソースドライバ回
路等の領域にのみ、レーザー光を照射してもよい。あるいは、ソースドライバ回路の一部
(例えば、アナログスイッチ)の領域にのみ、レーザー光を照射してもよい。その結果、
回路を高速に動作させる必要がある領域にのみ、シリコンの結晶化を向上させることがで
きる。画素領域は、高速に動作させる必要性が低いため、結晶性が向上されなくても、問
題なく画素回路を動作させることが出来る。結晶性を向上させる領域が少なくて済むため
、製造工程も短くすることが出来、スループットが向上し、製造コストを低減させること
が出来る。必要とされる製造装置の数も少なくて製造できるため、製造コストを低減させ
ることが出来る。
または、半導体基板やSOI基板などを用いてトランジスタを形成することが出来る。こ
れらにより、特性やサイズや形状などのバラツキが少なく、電流供給能力が高く、サイズ
の小さいトランジスタを製造することができる。これらのトランジスタを用いると、回路
の低消費電力化、又は回路の高集積化を図ることができる。
または、ZnO、a−InGaZnO、SiGe、GaAs、酸化インジウム酸化亜鉛(
IZO)、インジウム錫酸化物(ITO)、SnOなどの化合物半導体または酸化物半導
体を有するトランジスタや、さらに、これらの化合物半導体または酸化物半導体を薄膜化
した薄膜トランジスタなどを用いることが出来る。これらにより、製造温度を低くでき、
例えば、室温でトランジスタを製造することが可能となる。その結果、耐熱性の低い基板
、例えばプラスチック基板やフィルム基板に直接トランジスタを形成することが出来る。
なお、これらの化合物半導体または酸化物半導体を、トランジスタのチャネル部分に用い
るだけでなく、それ以外の用途で用いることも出来る。例えば、これらの化合物半導体ま
たは酸化物半導体を抵抗素子、画素電極、透光性を有する電極として用いることができる
。さらに、それらをトランジスタと同時に成膜又は形成できるため、コストを低減できる
または、インクジェットや印刷法を用いて形成したトランジスタなどを用いることが出来
る。これらにより、室温で製造、低真空度で製造、又は大型基板上に製造することができ
る。マスク(レチクル)を用いなくても製造することが可能となるため、トランジスタの
レイアウトを容易に変更することが出来る。さらに、レジストを用いる必要がないので、
材料費が安くなり、工程数を削減できる。さらに、必要な部分にのみ膜を付けるため、全
面に成膜した後でエッチングする、という製法よりも、材料が無駄にならず、低コストに
できる。
または、有機半導体やカーボンナノチューブを有するトランジスタ等を用いることができ
る。これらにより、曲げることが可能な基板上にトランジスタを形成することが出来る。
そのため、有機半導体やカーボンナノチューブを有するトランジスタなどを用いた装置は
衝撃に強くできる。
さらに、様々な構造のトランジスタを用いることができる。例えば、MOS型トランジス
タ、接合型トランジスタ、バイポーラトランジスタなどをトランジスタとして用いること
が出来る。MOS型トランジスタを用いることにより、トランジスタのサイズを小さくす
ることが出来る。よって、多くのトランジスタを搭載することができる。バイポーラトラ
ンジスタを用いることにより、大きな電流を流すことが出来る。よって、高速に回路を動
作させることができる。
なお、MOS型トランジスタ、バイポーラトランジスタなどを1つの基板に混在させて形
成してもよい。これにより、低消費電力、小型化、高速動作などを実現することが出来る
その他、様々なトランジスタを用いることができる。
なお、トランジスタは、様々な基板を用いて形成することが出来る。基板の種類は、特定
のものに限定されることはない。その基板としては、例えば、単結晶半導体基板、SOI
基板、ガラス基板、石英基板、プラスチック基板、紙基板、セロファン基板、石材基板、
木材基板、布基板(天然繊維(絹、綿、麻)、合成繊維(ナイロン、ポリウレタン、ポリ
エステル)若しくは再生繊維(アセテート、キュプラ、レーヨン、再生ポリエステル)な
どを含む)、皮革基板、ゴム基板、ステンレス・スチル基板、ステンレス・スチル・ホイ
ルを有する基板などを用いることが出来る。あるいは、人などの動物の皮膚(表皮、真皮
)又は皮下組織を基板として用いてもよい。または、ある基板を用いてトランジスタを形
成し、その後、別の基板にトランジスタを転置してもよい。トランジスタが転置される基
板としては、単結晶半導体基板、SOI基板、ガラス基板、石英基板、プラスチック基板
、紙基板、セロファン基板、石材基板、木材基板、布基板(天然繊維(絹、綿、麻)、合
成繊維(ナイロン、ポリウレタン、ポリエステル)若しくは再生繊維(アセテート、キュ
プラ、レーヨン、再生ポリエステル)などを含む)、皮革基板、ゴム基板、ステンレス・
スチル基板、ステンレス・スチル・ホイルを有する基板などを用いることができる。ある
いは、人などの動物の皮膚(表皮、真皮)又は皮下組織をトランジスタが転置される基板
として用いてもよい。または、ある基板を用いてトランジスタを形成し、その基板を研磨
して薄くしてもよい。研磨される基板としては、単結晶半導体基板、SOI基板、ガラス
基板、石英基板、プラスチック基板、紙基板、セロファン基板、石材基板、木材基板、布
基板(天然繊維(絹、綿、麻)、合成繊維(ナイロン、ポリウレタン、ポリエステル)若
しくは再生繊維(アセテート、キュプラ、レーヨン、再生ポリエステル)などを含む)、
皮革基板、ゴム基板、ステンレス・スチル基板、ステンレス・スチル・ホイルを有する基
板などを用いることができる。あるいは、人などの動物の皮膚(表皮、真皮)又は皮下組
織を研磨される基板として用いてもよい。これらの基板を用いることにより、特性のよい
トランジスタの形成、消費電力の小さいトランジスタの形成、壊れにくい装置の製造、耐
熱性の付与、軽量化、又は薄型化を図ることができる。
なお、トランジスタの構成は、様々な形態をとることができる。特定の構成に限定されな
い。例えば、ゲート電極が2個以上のマルチゲート構造を用いてもよい。マルチゲート構
造にすると、チャネル領域が直列に接続されるため、複数のトランジスタが直列に接続さ
れた構成となる。マルチゲート構造により、オフ電流の低減、トランジスタの耐圧向上に
よる信頼性の向上を図ることができる。あるいは、マルチゲート構造により、飽和領域で
動作する時に、ドレイン・ソース間電圧が変化しても、ドレイン・ソース間電流があまり
変化せず、傾きがフラットである電圧・電流特性を得ることができる。傾きがフラットで
ある電圧・電流特性を利用すると、理想的な電流源回路や、非常に高い抵抗値をもつ能動
負荷を実現することが出来る。その結果、特性のよい差動回路やカレントミラー回路を実
現することが出来る。別の例として、チャネルの上下にゲート電極が配置されている構造
でもよい。チャネルの上下にゲート電極が配置されている構造にすることにより、チャネ
ル領域が増えるため、電流値の増加、又は空乏層ができやすくなることによるS値の低減
を図ることができる。チャネルの上下にゲート電極が配置されると、複数のトランジスタ
が並列に接続されたような構成となる。
あるいは、チャネル領域の上にゲート電極が配置されている構造でもよいし、チャネル領
域の下にゲート電極が配置されている構造でもよい。あるいは、正スタガ構造または逆ス
タガ構造でもよいし、チャネル領域が複数の領域に分かれていてもよいし、チャネル領域
が並列に接続されていてもよいし、チャネル領域が直列に接続されていてもよい。あるい
は、チャネル領域(もしくはその一部)にソース電極やドレイン電極が重なっていてもよ
い。チャネル領域(もしくはその一部)にソース電極やドレイン電極が重なる構造にする
ことにより、チャネル領域の一部に電荷がたまって、動作が不安定になることを防ぐこと
ができる。あるいは、LDD領域を設けても良い。LDD領域を設けることにより、オフ
電流の低減、又はトランジスタの耐圧向上による信頼性の向上を図ることができる。また
、LDD領域を設けることにより、飽和領域で動作する時に、ドレイン・ソース間電圧が
変化しても、ドレイン・ソース間電流があまり変化せず、傾きがフラットである電圧・電
流特性を得ることができる。
なお、トランジスタは、様々なタイプを用いることができ、様々な基板を用いて形成させ
ることができる。したがって、所定の機能を実現させるために必要な回路の全てが、同一
の基板に形成されていてもよい。例えば、所定の機能を実現させるために必要な回路の全
てが、ガラス基板、プラスチック基板、単結晶半導体基板、またはSOI基板を用いて形
成されていてもよく、さまざまな基板を用いて形成されていてもよい。所定の機能を実現
させるために必要な回路の全てが同じ基板を用いて形成されていることにより、部品点数
の削減によるコストの低減、又は回路部品との接続点数の低減による信頼性の向上を図る
ことができる。あるいは、所定の機能を実現させるために必要な回路の一部が、ある基板
に形成されており、所定の機能を実現させるために必要な回路の別の一部が、別の基板に
形成されていてもよい。つまり、所定の機能を実現させるために必要な回路の全てが同じ
基板を用いて形成されていなくてもよい。例えば、所定の機能を実現させるために必要な
回路の一部は、ガラス基板上にトランジスタを用いて形成され、所定の機能を実現させる
ために必要な回路の別の一部は、単結晶半導体基板に形成され、単結晶半導体基板を用い
て形成されたトランジスタで構成されたICチップをCOG(Chip On Glas
s)でガラス基板に接続して、ガラス基板上にそのICチップを配置してもよい。あるい
は、そのICチップをTAB(Tape Automated Bonding)やプリ
ント基板を用いてガラス基板と接続してもよい。このように、回路の一部が同じ基板に形
成されていることにより、部品点数の削減によるコストの低減、又は回路部品との接続点
数の低減による信頼性の向上を図ることができる。あるいは、駆動電圧が高い部分及び駆
動周波数が高い部分の回路は、消費電力が大きくなってしまうので、そのような部分の回
路は同じ基板に形成せず、そのかわりに、例えば、単結晶半導体基板にその部分の回路を
形成して、その回路で構成されたICチップを用いるようにすれば、消費電力の増加を防
ぐことができる。
なお、一画素とは、明るさを制御できる要素一つ分を示すものとする。よって、一例とし
ては、一画素とは、一つの色要素を示すものとし、その色要素一つで明るさを表現する。
従って、そのときは、R(赤)G(緑)B(青)の色要素からなるカラー表示装置の場合
には、画像の最小単位は、Rの画素とGの画素とBの画素との三画素から構成されるもの
とする。なお、色要素は、三色に限定されず、三色以上を用いても良いし、RGB以外の
色を用いても良い。例えば、白色を加えて、RGBW(Wは白)としてもよい。あるいは
、RGBに、例えば、イエロー、シアン、マゼンタ、エメラルドグリーン、朱色などを一
色以上追加してもよい。あるいは、例えば、RGBの中の少なくとも一色に類似した色を
、RGBに追加してもよい。例えば、R、G、B1、B2としてもよい。B1とB2とは
、どちらも青色であるが、少し周波数が異なっている。同様に、R1、R2、G、Bとし
てもよい。このような色要素を用いることにより、より実物に近い表示を行うことができ
る。このような色要素を用いることにより、消費電力を低減することが出来る。別の例と
しては、1つの色要素について、複数の領域を用いて明るさを制御する場合は、その領域
一つ分を一画素としてもよい。よって、一例として、面積階調を行う場合または副画素(
サブ画素)を有している場合、一つの色要素につき、明るさを制御する領域が複数あり、
その全体で階調を表現するわけであるが、明るさを制御する領域の一つ分を一画素として
もよい。よって、その場合は、一つの色要素は、複数の画素で構成されることとなる。あ
るいは、明るさを制御する領域が1つの色要素の中に複数あっても、それらをまとめて、
1つの色要素を1画素としてもよい。よって、その場合は、一つの色要素は、一つの画素
で構成されることとなる。あるいは、1つの色要素について、複数の領域を用いて明るさ
を制御する場合、画素によって、表示に寄与する領域の大きさが異なっている場合がある
。あるいは、一つの色要素につき複数ある、明るさを制御する領域において、各々に供給
する信号を僅かに異ならせるようにして、視野角を広げるようにしてもよい。つまり、1
つの色要素について、複数個ある領域が各々有する画素電極の電位が、各々異なっていて
もよい。その結果、液晶分子に加わる電圧が各画素電極によって各々異なる。よって、視
野角を広くすることが出来る。
なお、一画素(三色分)と明示的に記載する場合は、RとGとBの三画素分を一画素と考
える場合であるとする。一画素(一色分)と明示的に記載する場合は、一つの色要素につ
き、複数の領域がある場合、それらをまとめて一画素と考える場合であるとする。
なお、画素は、マトリクス状に配置(配列)されている場合がある。ここで、画素がマト
リクスに配置(配列)されているとは、縦方向もしくは横方向において、画素が直線上に
並んで配置されている場合、又はギザギザな線上に配置されている場合を含む。よって、
例えば三色の色要素(例えばRGB)でフルカラー表示を行う場合に、ストライプ配置さ
れている場合、又は三つの色要素のドットがデルタ配置されている場合も含む。さらに、
ベイヤー配置されている場合も含む。なお、色要素は、三色に限定されず、それ以上でも
よく、例えば、RGBW(Wは白)、又はRGBに、イエロー、シアン、マゼンタなどを
一色以上追加したものなどがある。なお、色要素のドット毎にその表示領域の大きさが異
なっていてもよい。これにより、低消費電力化、又は表示素子の長寿命化を図ることがで
きる。
なお、画素に能動素子を有するアクティブマトリクス方式、または、画素に能動素子を有
しないパッシブマトリクス方式を用いることが出来る。
アクティブマトリクス方式では、能動素子(アクティブ素子、非線形素子)として、トラ
ンジスタだけでなく、さまざまな能動素子(アクティブ素子、非線形素子)を用いること
が出来る。例えば、MIM(Metal Insulator Metal)やTFD(
Thin Film Diode)などを用いることも可能である。これらの素子は、製
造工程が少ないため、製造コストの低減、又は歩留まりの向上を図ることができる。さら
に、素子のサイズが小さいため、開口率を向上させることができ、低消費電力化や高輝度
化をはかることが出来る。
なお、アクティブマトリクス方式以外のものとして、能動素子(アクティブ素子、非線形
素子)を用いないパッシブマトリクス型を用いることも可能である。能動素子(アクティ
ブ素子、非線形素子)を用いないため、製造工程が少なく、製造コストの低減、又は歩留
まりの向上を図ることができる。能動素子(アクティブ素子、非線形素子)を用いないた
め、開口率を向上させることができ、低消費電力化や高輝度化をはかることが出来る。
なお、トランジスタとは、ゲートと、ドレインと、ソースとを含む少なくとも三つの端子
を有する素子であり、ドレイン領域とソース領域の間にチャネル領域を有しており、ドレ
イン領域とチャネル領域とソース領域とを介して電流を流すことが出来る。ここで、ソー
スとドレインとは、トランジスタの構造や動作条件等によって変わるため、いずれがソー
スまたはドレインであるかを限定することが困難である。そこで、本書類においては、ソ
ース及びドレインとして機能する領域を、ソースもしくはドレインと呼ばない場合がある
。その場合、一例としては、それぞれを第1端子、第2端子と表記する場合がある。ある
いは、それぞれを第1の電極、第2の電極と表記する場合がある。あるいは、ソース領域
、ドレイン領域と表記する場合がある。
なお、トランジスタは、ベースとエミッタとコレクタとを含む少なくとも三つの端子を
有する素子であってもよい。この場合も同様に、エミッタとコレクタとを、第1端子、第
2端子と表記する場合がある。
なお、ゲートとは、ゲート電極とゲート配線(ゲート線、ゲート信号線、走査線、走査信
号線等とも言う)とを含んだ全体、もしくは、それらの一部のことを言う。ゲート電極と
は、チャネル領域を形成する半導体と、ゲート絶縁膜を介してオーバーラップしている部
分の導電膜のことを言う。なお、ゲート電極の一部は、LDD(Lightly Dop
ed Drain)領域またはソース領域(またはドレイン領域)と、ゲート絶縁膜を介
してオーバーラップしている場合もある。ゲート配線とは、各トランジスタのゲート電極
の間を接続するための配線、各画素の有するゲート電極の間を接続するための配線、又は
ゲート電極と別の配線とを接続するための配線のことを言う。
ただし、ゲート電極としても機能し、ゲート配線としても機能するような部分(領域、
導電膜、配線など)も存在する。そのような部分(領域、導電膜、配線など)は、ゲート
電極と呼んでも良いし、ゲート配線と呼んでも良い。つまり、ゲート電極とゲート配線と
が、明確に区別できないような領域も存在する。例えば、延伸して配置されているゲート
配線の一部とチャネル領域がオーバーラップしている場合、その部分(領域、導電膜、配
線など)はゲート配線として機能しているが、ゲート電極としても機能していることにな
る。よって、そのような部分(領域、導電膜、配線など)は、ゲート電極と呼んでも良い
し、ゲート配線と呼んでも良い。
なお、ゲート電極と同じ材料で形成され、ゲート電極と同じ島(アイランド)を形成して
つながっている部分(領域、導電膜、配線など)も、ゲート電極と呼んでも良い。同様に
、ゲート配線と同じ材料で形成され、ゲート配線と同じ島(アイランド)を形成してつな
がっている部分(領域、導電膜、配線など)も、ゲート配線と呼んでも良い。このような
部分(領域、導電膜、配線など)は、厳密な意味では、チャネル領域とオーバーラップし
ていない場合、又は別のゲート電極と接続させる機能を有していない場合がある。しかし
、製造時の仕様などの関係で、ゲート電極またはゲート配線と同じ材料で形成され、ゲー
ト電極またはゲート配線と同じ島(アイランド)を形成してつながっている部分(領域、
導電膜、配線など)がある。よって、そのような部分(領域、導電膜、配線など)もゲー
ト電極またはゲート配線と呼んでも良い。
なお、例えば、マルチゲートのトランジスタにおいて、1つのゲート電極と、別のゲート
電極とは、ゲート電極と同じ材料で形成された導電膜で接続される場合が多い。そのよう
な部分(領域、導電膜、配線など)は、ゲート電極とゲート電極とを接続させるための部
分(領域、導電膜、配線など)であるため、ゲート配線と呼んでも良いが、マルチゲート
のトランジスタを1つのトランジスタと見なすことも出来るため、ゲート電極と呼んでも
良い。つまり、ゲート電極またはゲート配線と同じ材料で形成され、ゲート電極またはゲ
ート配線と同じ島(アイランド)を形成してつながっている部分(領域、導電膜、配線な
ど)は、ゲート電極やゲート配線と呼んでも良い。さらに、例えば、ゲート電極とゲート
配線とを接続させている部分の導電膜であって、ゲート電極またはゲート配線とは異なる
材料で形成された導電膜も、ゲート電極と呼んでも良いし、ゲート配線と呼んでも良い。
なお、ゲート端子とは、ゲート電極の部分(領域、導電膜、配線など)または、ゲート電
極と電気的に接続されている部分(領域、導電膜、配線など)について、その一部分のこ
とを言う。
なお、ある配線をゲート配線、ゲート線、ゲート信号線、走査線、走査信号線などと呼ぶ
場合、配線にトランジスタのゲートが接続されていない場合もある。この場合、ゲート配
線、ゲート線、ゲート信号線、走査線、走査信号線は、トランジスタのゲートと同じ層で
形成された配線、トランジスタのゲートと同じ材料で形成された配線またはトランジスタ
のゲートと同時に成膜された配線を意味している場合がある。例としては、保持容量用配
線、電源線、基準電位供給配線などがある。
なお、ソースとは、ソース領域とソース電極とソース配線(ソース線、ソース信号線、デ
ータ線、データ信号線等とも言う)とを含んだ全体、もしくは、それらの一部のことを言
う。ソース領域とは、P型不純物(ボロンやガリウムなど)やN型不純物(リンやヒ素な
ど)が多く含まれる半導体領域のことを言う。従って、少しだけP型不純物やN型不純物
が含まれる領域、いわゆる、LDD(Lightly Doped Drain)領域は
、ソース領域には含まれない。ソース電極とは、ソース領域とは別の材料で形成され、ソ
ース領域と電気的に接続されて配置されている部分の導電層のことを言う。ただし、ソー
ス電極は、ソース領域も含んでソース電極と呼ぶこともある。ソース配線とは、各トラン
ジスタのソース電極の間を接続するための配線、各画素の有するソース電極の間を接続す
るための配線、又はソース電極と別の配線とを接続するための配線のことを言う。
しかしながら、ソース電極としても機能し、ソース配線としても機能するような部分(領
域、導電膜、配線など)も存在する。そのような部分(領域、導電膜、配線など)は、ソ
ース電極と呼んでも良いし、ソース配線と呼んでも良い。つまり、ソース電極とソース配
線とが、明確に区別できないような領域も存在する。例えば、延伸して配置されているソ
ース配線の一部とソース領域とがオーバーラップしている場合、その部分(領域、導電膜
、配線など)はソース配線として機能しているが、ソース電極としても機能していること
になる。よって、そのような部分(領域、導電膜、配線など)は、ソース電極と呼んでも
良いし、ソース配線と呼んでも良い。
なお、ソース電極と同じ材料で形成され、ソース電極と同じ島(アイランド)を形成して
つながっている部分(領域、導電膜、配線など)や、ソース電極とソース電極とを接続す
る部分(領域、導電膜、配線など)も、ソース電極と呼んでも良い。さらに、ソース領域
とオーバーラップしている部分も、ソース電極と呼んでも良い。同様に、ソース配線と同
じ材料で形成され、ソース配線と同じ島(アイランド)を形成してつながっている領域も
、ソース配線と呼んでも良い。このような部分(領域、導電膜、配線など)は、厳密な意
味では、別のソース電極と接続させる機能を有していない場合がある。しかし、製造時の
仕様などの関係で、ソース電極またはソース配線と同じ材料で形成され、ソース電極また
はソース配線とつながっている部分(領域、導電膜、配線など)がある。よって、そのよ
うな部分(領域、導電膜、配線など)もソース電極またはソース配線と呼んでも良い。
なお、例えば、ソース電極とソース配線とを接続させている部分の導電膜であって、ソー
ス電極またはソース配線とは異なる材料で形成された導電膜も、ソース電極と呼んでも良
いし、ソース配線と呼んでも良い。
なお、ソース端子とは、ソース領域や、ソース電極や、ソース電極と電気的に接続されて
いる部分(領域、導電膜、配線など)について、その一部分のことを言う。
なお、ある配線をソース配線、ソース線、ソース信号線、データ線、データ信号線などと
呼ぶ場合、配線にトランジスタのソース(ドレイン)が接続されていない場合もある。こ
の場合、ソース配線、ソース線、ソース信号線、データ線、データ信号線は、トランジス
タのソース(ドレイン)と同じ層で形成された配線、トランジスタのソース(ドレイン)
と同じ材料で形成された配線またはトランジスタのソース(ドレイン)と同時に成膜され
た配線を意味している場合がある。例としては、保持容量用配線、電源線、基準電位供給
配線などがある。
なお、ドレインについては、ソースと同様である。
なお、半導体装置とは半導体素子(トランジスタ、ダイオード、サイリスタなど)を含む
回路を有する装置のことをいう。さらに、半導体特性を利用することで機能しうる装置全
般を半導体装置と呼んでもよい。また、半導体材料を有する装置のことを半導体装置と言
う。
なお、表示素子とは、光学変調素子、液晶素子、発光素子、EL素子(有機EL素子、無
機EL素子又は有機物及び無機物を含むEL素子)、電子放出素子、電気泳動素子、放電
素子、光反射素子、光回折素子、デジタルマイクロミラーデバイス(DMD)、などのこ
とを言う。ただし、これに限定されない。
なお、表示装置とは、表示素子を有する装置のことを言う。なお、表示装置は、表示素子
を含む複数の画素を含んでいても良い。なお、表示装置は、複数の画素を駆動させる周辺
駆動回路を含んでいても良い。なお、複数の画素を駆動させる周辺駆動回路は、複数の画
素と同一基板上に形成されてもよい。なお、表示装置は、ワイヤボンディングやバンプな
どによって基板上に配置された周辺駆動回路、いわゆる、チップオングラス(COG)で
接続されたICチップ、または、TABなどで接続されたICチップを含んでいても良い
。なお、表示装置は、ICチップ、抵抗素子、容量素子、インダクタ、トランジスタなど
が取り付けられたフレキシブルプリントサーキット(FPC)を含んでもよい。なお、表
示装置は、フレキシブルプリントサーキット(FPC)などを介して接続され、ICチッ
プ、抵抗素子、容量素子、インダクタ、トランジスタなどが取り付けられたプリント配線
基盤(PWB)を含んでいても良い。なお、表示装置は、偏光板または位相差板などの光
学シートを含んでいても良い。なお、表示装置は、照明装置、筐体、音声入出力装置、光
センサなどを含んでいても良い。ここで、バックライトユニットのような照明装置は、導
光板、プリズムシート、拡散シート、反射シート、光源(LED、冷陰極管など)、冷却
装置(水冷式、空冷式)などを含んでいても良い。
なお、照明装置とは、バックライトユニット、導光板、プリズムシート、拡散シート、反
射シート、光源(LED、冷陰極管、熱陰極管など)、冷却装置などを有している装置の
ことをいう。
なお、発光装置とは、発光素子などを有している装置のことをいう。表示素子として発光
素子を有している場合は、発光装置は、表示装置の具体例の一つである。
なお、反射装置とは、光反射素子、光回折素子、光反射電極などを有している装置のこと
をいう。
なお、液晶表示装置とは、液晶素子を有している表示装置をいう。液晶表示装置には、直
視型、投写型、透過型、反射型、半透過型などがある。
なお、駆動装置とは、半導体素子、電気回路、電子回路を有する装置のことを言う。例え
ば、ソース信号線から画素内への信号の入力を制御するトランジスタ(選択用トランジス
タ、スイッチング用トランジスタなどと呼ぶことがある)、画素電極に電圧または電流を
供給するトランジスタ、発光素子に電圧または電流を供給するトランジスタなどは、駆動
装置の一例である。さらに、ゲート信号線に信号を供給する回路(ゲートドライバ、ゲー
ト線駆動回路などと呼ぶことがある)、ソース信号線に信号を供給する回路(ソースドラ
イバ、ソース線駆動回路などと呼ぶことがある)などは、駆動装置の一例である。
なお、表示装置、半導体装置、照明装置、冷却装置、発光装置、反射装置、駆動装置など
は、互いに重複して有している場合がある。例えば、表示装置が、半導体装置および発光
装置を有している場合がある。あるいは、半導体装置が、表示装置および駆動装置を有し
ている場合がある。
なお、Aの上にBが形成されている、あるいは、A上にBが形成されている、と明示的に
記載する場合は、Aの上にBが直接接して形成されていることに限定されない。直接接し
てはいない場合、つまり、AとBと間に別の対象物が介在する場合も含むものとする。こ
こで、A、Bは、対象物(例えば、装置、素子、回路、配線、電極、端子、導電膜、層、
など)であるとする。
従って例えば、層Aの上に(もしくは層A上に)、層Bが形成されている、と明示的に記
載されている場合は、層Aの上に直接接して層Bが形成されている場合と、層Aの上に直
接接して別の層(例えば層Cや層Dなど)が形成されていて、その上に直接接して層Bが
形成されている場合とを含むものとする。なお、別の層(例えば層Cや層Dなど)は、単
層でもよいし、複層でもよい。
さらに、Aの上方にBが形成されている、と明示的に記載されている場合についても同様
であり、Aの上にBが直接接していることに限定されず、AとBとの間に別の対象物が介
在する場合も含むものとする。従って例えば、層Aの上方に、層Bが形成されている、と
いう場合は、層Aの上に直接接して層Bが形成されている場合と、層Aの上に直接接して
別の層(例えば層Cや層Dなど)が形成されていて、その上に直接接して層Bが形成され
ている場合とを含むものとする。なお、別の層(例えば層Cや層Dなど)は、単層でもよ
いし、複層でもよい。
なお、Aの上にBが直接接して形成されている、と明示的に記載する場合は、Aの上に直
接接してBが形成されている場合を含み、AとBと間に別の対象物が介在する場合は含ま
ないものとする。
なお、Aの下にBが、あるいは、Aの下方にBが、の場合についても、同様である。
なお、明示的に単数として記載されているものについては、単数であることが望ましい。
ただし、これに限定されず、複数であることも可能である。同様に、明示的に複数として
記載されているものについては、複数であることが望ましい。ただし、これに限定されず
、単数であることも可能である。
単結晶半導体基板から、単結晶半導体層を取り出し、それを絶縁基板に固定し、絶縁基板
上でTFTを形成し、そのTFTを用いて、駆動回路を形成する。その結果、消費電力が
低く、薄型で、小型な表示装置を形成することが出来る。
本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の動作電圧を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の製造工程を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の半導体装置の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の電子機器の構成を説明する図。 本発明の半導体装置の上面図および断面図を説明する図。
以下、本発明の実施の形態について図面を参照しながら説明する。但し、本発明は多くの
異なる態様で実施することが可能であり、本発明の趣旨及びその範囲から逸脱することな
くその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って
本発明の実施の形態の記載内容に限定して解釈されるものではない。なお、以下に説明す
る本発明の構成において、同一部分又は同様な機能を有する部分は異なる図面間で共通の
符号を用いて示し、同一部分又は同様な機能を有する部分の詳細な説明は省略する。
(第1の実施の形態)
図1に示すように、ガラス基板101に、画素配列104、画素を駆動する駆動回路とし
て、ソースドライバ102、ゲートドライバ103が配置されている。ただし、これに限
定されず、さまざまな回路を配置出来る。これらの回路の全てまたは一部は、単結晶半導
体基板から、単結晶半導体層を取り出し、それを絶縁基板に固定し、絶縁基板上で形成し
たTFT、または、単結晶半導体基板を絶縁基板に貼り付け、単結晶半導体基板を分離す
ることによって、単結晶半導体基板の一部の単結晶半導体層を絶縁基板に固定し、絶縁基
板上で形成されたTFTを用いて構成されている。なお、単結晶半導体基板から、単結晶
半導体層を取り出し、それを絶縁基板に固定し、絶縁基板上で形成したTFT、または、
単結晶半導体基板を絶縁基板に貼り付け、単結晶半導体基板を分離することによって、単
結晶半導体基板の一部の単結晶半導体層を絶縁基板に固定し、絶縁基板上で形成されたT
FTは、以下、単結晶TFTと呼ぶ。なお、単結晶TFTについて、その製造方法は、別
の実施の形態で述べる。なお、本実施の形態では、絶縁基板として、ガラス基板を用いて
いる。
少なくとも、ソースドライバ102、ゲートドライバ103の全てまたは一部は、単結晶
TFTを用いて形成されている。単結晶TFTは、活性層(チャネル領域、LDD領域、
ソース領域又はドレイン領域など)が、概ね単結晶状態にあるため、たいへん電流特性が
よい。また、しきい値電圧の絶対値も、非常に小さい。つまり、単結晶TFTは、通常の
単結晶半導体基板に形成されたトランジスタまたはSOI基板を用いて形成されたトラン
ジスタと、同レベルのトランジスタ特性を有している。したがって、単結晶半導体基板や
SOI基板を用いて形成された集積回路(IC)と、同レベルの電源電圧で動作させるこ
とが出来る。その結果、低い消費電力で動作させることが出来る。
図1は、ソースドライバ102に供給される信号、電源107などに着目し、図面を記載
している。そして、少なくとも第1の電源電圧111および第2の電源電圧112が、電
源107からソースドライバ102に供給される。そして、第1の電源電圧111は、ソ
ースドライバ102およびゲートドライバ103を制御するコントローラ106にも供給
される。通常、第2の電源電圧112の方が、第1の電源電圧111よりも、高い電位を
有している。また、図示していないが、コントローラ106およびソースドライバ102
などには、接地電位も供給されている。
電源107は、インダクタ、レギュレータ、電源ICなどで構成されている。
コントローラ106は、単結晶半導体基板やSOI基板を用いて形成された集積回路(I
C)である。したがって、低い電源電圧で動作させることが出来る。
電源107およびコントローラ106は、ガラス基板101以外の場所に配置されている
。例えば、電源107およびコントローラ106は、基板105に配置されている。ただ
し、これに限定されない。例えば、各々別の基板に配置されていてもよい。あるいは、ガ
ラス基板101に、COG(チップオングラス)で配置されている場合もある。あるいは
、電源107またはコントローラ106の一部が、ガラス基板101上で、TFTを用い
て形成されていてもよい。
そして、コントローラ106から、信号110がソースドライバ102に供給されている
。このとき、コントローラ106とソースドライバ102で、信号110の振幅の大きさ
は同じである。ここで信号110の振幅の大きさが同じであるということは、必ずしもコ
ントローラ106とソースドライバ102で信号110の振幅が完全に一致することを意
味しない。例えば、信号の遅延、配線抵抗、寄生容量、他の信号とのクロストークなどの
影響によるノイズで、コントローラ106とソースドライバ102の間で信号110の振
幅が乱れたとしても、信号100の振幅の大きさが同じであるとみなす。信号110は、
タイミング信号、クロック信号などである。コントローラ106には、接地電位および第
1の電源電圧111が供給されている。そして、コントローラ106では、接地電位およ
び第1の電源電圧111を用いて、様々な処理を行っている。そのため、信号110のロ
ーレベルおよびハイレベルの電位は、接地電位または第1の電源電圧111と概ね同じ大
きさの電位を有している。
なお、接地電位の例は、0ボルトである。第1の電源電圧111の例は、3ボルト、5ボ
ルト、1.8ボルトなどである。望ましくは、3ボルト以下が望ましい。より望ましくは
、1.0ボルト以下が望ましい。出願時の技術レベルでは、単結晶半導体基板やSOI基
板を用いて形成された集積回路(IC)は、3ボルトで動作させることが多い。したがっ
て、そのICをそのまま利用することができ、コストの低い汎用品を用いることが出来る
。ただし、ICの動作電圧の低電圧化が進んでいるため、さらに低い電圧で動作させるよ
うになってきている。
ソースドライバ102の構成の一例を図2に示す。第1の電源電圧111および信号11
0がシフトレジスタ501に入力される。なお、図示していないが、シフトレジスタ50
1には、接地電位も供給されている。したがって、シフトレジスタ501は、接地電位お
よび第1の電源電圧111を用いて、動作を行う。信号110としては、スタートパルス
信号、クロック信号などがコントローラ106から供給されている。
ここで、シフトレジスタ501は、単結晶TFTを用いて形成されている。その結果、供
給される電圧および信号の電圧が小さくても、正常に動作させることが出来る。
もし仮に、従来の低温ポリシリコンTFTまたは従来の高温ポリシリコンTFTを用いて
シフトレジスタが構成されている場合は、コントローラに供給されているのと同じ電源電
圧、つまり、接地電位および第1の電源電圧111がシフトレジスタに供給されても、シ
フトレジスタは動作することが出来ない。従来の低温ポリシリコンTFTまたは従来の高
温ポリシリコンTFTは、しきい値電圧の絶対値が高く、移動度が低い、というように電
流特性が悪いからである。そこで、仮に、シフトレジスタに供給される電源電圧の大きさ
を大きくしたとする。ただし、コントローラ106の信号110の振幅は、接地電位また
は第1の電源電圧111と概ね同じ大きさであるとする。その場合、シフトレジスタを構
成するインバータなどが、うまくオンオフすることが出来ず、ずっとオンしている状況に
なってしまい、正常に動作することが難しい。また、トランジスタの特性がばらつくと、
さらに正常動作が困難となる。そこで、シフトレジスタに供給する信号(スタートパルス
信号、クロック信号など)の振幅を、大きくしたときの電源電圧と同程度まで、レベルシ
フトする必要が出てくる。そのためのレベルシフタ回路を、ガラス基板上に作製したい場
合、高速に動作するクロック信号は正常に動作させにくいものとなる。仮に動作したとし
ても、波形がゆがんでしまい、回路の動作に支障をきたしてしまう。または、ガラス基板
の外の集積回路でレベルシフタ回路を配置する場合は、部品を追加する必要があり、コス
トが上昇してしまう。その上、シフトレジスタの電源電圧が大きいため、消費電力が大き
くなってしまう。さらに、コントローラに供給する電源とは別の電源電圧を供給するため
には、さらに電源回路が必要となってしまう。電源回路は、サイズが大きいため、装置を
小型にすること、薄型にすることなどに悪い影響を与えてしまう。
しかしながら、シフトレジスタ501を、単結晶TFTを用いて形成することにより、こ
れらの課題を解決することが出来る。単結晶TFTを用いることにより、コントローラ1
06から出力される信号110の電位を、ガラス基板101の内外を問わず、レベルシフ
トする必要がない。したがって、シフトレジスタ501に供給する信号の振幅を大きくす
るためのレベルシフタ回路を削除することが出来る。そのため、部品点数を減らすことが
出来る。また、同じ電源をコントローラ106とシフトレジスタ501に供給して動作さ
せることが出来るため、シフトレジスタ501において、電源電圧を大きくする必要がな
い。そのため、消費電力を低くすることが出来る。そして、電源回路を増やす必要もない
。電源回路は、サイズが大きいため、電源回路のサイズの分だけ、小型にすること、薄型
にすることが可能となる。また、シフトレジスタ501に供給される電源と同じ電位を有
する信号110が供給されるため、シフトレジスタを構成するインバータなどは、うまく
オンオフすることができ、正常に動作させることが出来る。また、出力波形がゆがんでし
まうこともない。
このように、ガラス基板101上に、単結晶TFTを用いてシフトレジスタ501を作製
することにより、シフトレジスタ501に供給する信号の振幅を大きくするためのレベル
シフタ回路を削除することが出来る。
ただし、画素配列104には、様々な表示素子、例えば、液晶素子、発光素子(EL素子
(有機物及び無機物を含むEL素子、有機EL素子、無機EL素子)、電子放出素子など
)、電気泳動素子などが配置されており、それぞれの素子の特性に合わせて、必要となる
電圧のレベルが決まってくる。したがって、シフトレジスタ501から出力された信号を
レベルシフトするために、レベルシフタ502を配置する。レベルシフタ502には、第
1の電源電圧111および第2の電源電圧112が少なくとも供給されている。レベルシ
フタ502によって電圧振幅が大きくなった信号が、サンプリング回路503に供給され
る。サンプリング回路503では、ビデオ信号がサンプリングされ、画素配列104に供
給される。
なお、レベルシフタ502またはサンプリング回路503は、単結晶TFTで作製されて
いることが望ましい。ただし、これに限定されない。
なお、ソースドライバ102の構成は、図2に限定されない。さまざまな構成をとること
が出来る。例えば、デジタルのビデオ信号が供給される場合のソースドライバ102の構
成例を図3に示す。シフトレジスタ501から出力された信号は、レベルシフトされるこ
となく、ラッチ1回路601に供給される。さらに、ラッチ1回路601から出力された
信号は、レベルシフトされることなく、ラッチ2回路602に供給される。ラッチ1回路
601およびラッチ2回路602も、単結晶TFTを用いて形成されている。したがって
、ラッチ1回路601およびラッチ2回路602にも、少なくとも、接地電位および第1
の電源電圧111が供給されている。したがって、シフトレジスタと同様、低い電圧で動
作することとなる。なお、ラッチ1回路601には、デジタルのビデオ信号が供給される
が、この信号のローレベルおよびハイレベルの電位も、接地電位または第1の電源電圧1
11と概ね同じ大きさの電位を有している。よって、消費電力が低く動作させることが出
来る。
このように、ガラス基板101上に、単結晶TFTを用いてシフトレジスタ501、ラッ
チ1回路601およびラッチ2回路602を作製することにより、シフトレジスタ501
に供給する信号の振幅を大きくするためのレベルシフタ回路を削除することが出来る。
ただし、画素配列104に適切な電圧を供給するため、レベルシフタ502を配置する。
そして、デジタル信号をアナログ信号に変換するため、DAC603を配置する。ただし
、画素配列104にデジタル信号を供給する場合は、DAC603は省略することが出来
る。そして、画素配列104に、ビデオ信号が供給される。
なお、レベルシフタ502またはDAC603は、単結晶TFTで作製されていることが
望ましい。ただし、これに限定されない。
図1乃至図3において、ソースドライバ102に着目して述べてきた。次に、ゲートドラ
イバについて述べる。図4には、ゲートドライバ103に供給される信号、電源107な
どに着目し、図面を記載している。そして、少なくとも第1の電源電圧111および第3
の電源電圧212が、電源107からゲートドライバ103に供給される。なお、図示し
ていないが、コントローラ106およびゲートドライバ103などには、接地電位も供給
されている。
そして、コントローラ106から、信号210がゲートドライバ103に供給されている
。このとき、コントローラ106とゲートドライバ103で、信号210の振幅の大きさ
は同じである。ここで信号210の振幅の大きさが同じであるということは、必ずしもコ
ントローラ106とゲートドライバ103で信号210の振幅が完全に一致することを意
味しない。例えば、信号の遅延、配線抵抗、寄生容量、他の信号とのクロストークなどの
影響によるノイズで、コントローラ106とゲートドライバ103の間で信号210の振
幅が乱れたとしても、信号210の振幅の大きさが同じであるとみなす。信号210は、
タイミング信号、クロック信号などである。コントローラ106には、接地電位および第
1の電源電圧111が供給されている。そして、コントローラ106では、接地電位およ
び第1の電源電圧111を用いて、様々な処理を行っている。そのため、信号210のロ
ーレベルおよびハイレベルの電位は、接地電位または第1の電源電圧111と概ね同じ大
きさの電位を有している。
ゲートドライバ103の構成の一例を図5に示す。第1の電源電圧111および信号21
0がシフトレジスタ701に入力される。なお、図示していないが、シフトレジスタ70
1には、接地電位も供給されている。したがって、シフトレジスタ701は、接地電位お
よび第1の電源電圧111を用いて、動作を行う。信号210としては、スタートパルス
信号、クロック信号などがコントローラ106から供給されている。
ここで、シフトレジスタ701は、単結晶TFTを用いて形成されている。その結果、供
給される電圧および信号の電圧が小さくても、正常に動作させることが出来る。そのため
、ソースドライバの場合と同様、様々なメリットがある。
このように、ガラス基板101上に、単結晶TFTを用いてシフトレジスタ701を作製
することにより、シフトレジスタ701に供給する信号の振幅を大きくするためのレベル
シフタ回路を削除することが出来る。
ただし、画素配列104に適切な電圧を供給するため、レベルシフタ702を配置する。
そして、波形のなまりを低減するために、バッファ703を配置する。そして、画素配列
104に、選択信号が供給される。
なお、レベルシフタ702またはバッファ703は、単結晶TFTで作製されていること
が望ましい。ただし、これに限定されない。
このように、ガラス基板101上に、単結晶TFTを用いてシフトレジスタ、ラッチ回路
などを作製することにより、シフトレジスタに供給する信号の振幅を大きくするためのレ
ベルシフタ回路を削除することが出来る。図6(A)(B)に、電圧の推移を示す。図6
(A)には、ソースドライバの電圧の推移を示す。コントローラ側1601aでは、0〜
3Vで電位が変化する信号、0Vの電源電位、3Vの電源電位を用いる。そして、ガラス
基板上に形成されたTFT側1602aでは、シフトレジスタ、ラッチ回路などは、0〜
3Vで電位が変化する信号、0Vの電源電位、3Vの電源電位を用いる。その後、画素に
入力するため、画素に適応した電圧、例えば、―6〜6Vにレベルシフトさせる。その結
果、殆どの領域は、ICと同じ電圧で動作させ、画素とその近接部のみ、適応した電圧で
動作させることができ、消費電力を低減することが出来る。図6(B)には、ゲートドラ
イバの電圧の推移を示す。TFT側1602bのゲートドライバにおいても、ソースドラ
イバと同様、殆どの領域は、コントローラ側1601aのICと同じ電圧で動作させ、画
素とその近接部のみ、適応した電圧で動作させることができ、消費電力を低減することが
出来る。
なお、図1または図4において、第2の電源電圧112または第3の電源電圧212は、
電源107から第1の電源電圧111とは別に供給されているが、これに限定されない。
図7に示すように、昇圧回路301を用いて第1の電源電圧111から新たな電圧を作り
出しても良い。図7では、昇圧回路301が、第1の電源電圧111を用いて、第2の電
源電圧312または第3の電源電圧313を作り出して、ソースドライバ102またはゲ
ートドライバ103に供給している。
なお、昇圧回路301は、単結晶TFTで作製されていることが望ましい。ただし、これ
に限定されない。
なお、図1、図4または図7において、電源107は、コントローラ106などに電源電
圧を供給しているが、これに限定されない。様々な回路に電源電圧を供給している。例え
ば、図8に示すように、メモリ401、グラフィック用プロセッサ402などにも電源電
圧を供給している。これらすべてに、同じ電源電圧を供給することで、装置を小さくする
、或いは軽くすることが出来る。
なお、本実施の形態において、様々な図を用いて述べてきたが、各々の図で述べた内容(
一部でもよい)は、別の図で述べた内容(一部でもよい)に対して、適用、組み合わせ、
又は置き換えなどを自由に行うことが出来る。さらに、これまでに述べた図において、各
々の部分に関して、別の部分を組み合わせることにより、さらに多くの図を構成させるこ
とが出来る。
同様に、本実施の形態の各々の図で述べた内容(一部でもよい)は、別の実施の形態の図
で述べた内容(一部でもよい)に対して、適用、組み合わせ、又は置き換えなどを自由に
行うことが出来る。さらに、本実施の形態の図において、各々の部分に関して、別の実施
の形態の部分を組み合わせることにより、さらに多くの図を構成させることが出来る。
なお、本実施の形態は、他の実施の形態で述べた内容(一部でもよい)を、具現化した場
合の一例、少し変形した場合の一例、一部を変更した場合の一例、改良した場合の一例、
詳細に述べた場合の一例、応用した場合の一例、関連がある部分についての一例などを示
している。したがって、他の実施の形態で述べた内容は、本実施の形態への適用、組み合
わせ、又は置き換えを自由に行うことができる。
(第2の実施の形態)
本実施の形態では、第1の実施の形態で述べた構成の具体例を示す。図9(A)に、シフ
トレジスタの一例を示す。シフトレジスタは、クロックドインバータ801、インバータ
802、NAND回路803などによって構成されている。コントローラ106から送ら
れた信号は、配線800を通してシフトレジスタに入力される。それから、クロックドイ
ンバータ801、インバータ802、NAND回路803などを介して、配線804から
出力される。なお、クロックドインバータ801には、クロック信号(CLK)およびク
ロック反転信号(CLKB)が入力されている。上記図3におけるラッチ1回路601、
ラッチ2回路602も、クロックドインバータ、インバータ、などから構成されており、
図9(A)と類似した回路構成となっている。
図9(B)に、シフトレジスタの中で用いられているクロックドインバータ801の一例
を示す。クロックドインバータ801は、第1のPチャネル型トランジスタ809、第2
のPチャネル型トランジスタ810、第1のNチャネル型トランジスタ811、第2のN
チャネル型トランジスタ812から構成されている。高電位側電源線805が第1のPチ
ャネル型トランジスタ809に接続されており、低電位側電源線806が第2のNチャネ
ル型トランジスタ812に接続されている。第2のPチャネル型トランジスタ810及び
第1のNチャネル型トランジスタ811のゲート電極に接続されている配線807から入
力された信号は、第2のPチャネル型トランジスタ810及び第1のNチャネル型トラン
ジスタ811のソース電極またはドレイン電極に接続されている配線808から出力され
る。なお、クロック信号が第2のNチャネル型トランジスタ812に入力され、クロック
反転信号が第1のPチャネル型トランジスタ809に入力されている。
ガラス基板上で結晶TFTを用いて形成されたシフトレジスタ、または、クロックドイン
バータ、インバータ、NAND回路などに、ICで形成されたコントローラ106から信
号が入力されている。この部分をトランジスタレベルで記載した図を図10〜図12に示
す。
図10では、コントローラ側901の回路として、例えば、インバータ905が配置され
ている。インバータ905は、第1のPチャネル型トランジスタ908及び第1のNチャ
ネル型トランジスタ909から構成される。TFT側902の回路としては、例えば、イ
ンバータ906が配置されている。インバータ906は、第2のPチャネル型トランジス
タ910及び第2のNチャネル型トランジスタ911から構成される。そして、高電位側
電源線903及び低電位側電源線904によって、インバータ905で用いられた電源電
圧が、ガラス基板上で結晶TFTを用いて形成されたインバータ906にも、供給されて
いる。つまり、コントローラ側901と、TFT側902とで、同じ電源電圧を用いてい
る。したがって、高電位側電源線903は、インバータ905およびインバータ906の
第1のPチャネル型トランジスタ908及び第2のPチャネル型トランジスタ910に接
続されている。また、低電位側電源線904は、インバータ905およびインバータ90
6の第1のNチャネル型トランジスタ909及び第2のNチャネル型トランジスタ911
に接続されている。そのため、レベルシフタが必要ない。インバータ906は、活性層が
概ね単結晶状態にあるため、電流特性が良い。しきい値電圧の絶対値も小さく、移動度も
大きい。したがって、ICと同じ電源電圧を供給されても、動作させることが出来る。そ
の結果、消費電力が低く、薄型で、小型な表示装置を形成することが出来る。また、イン
バータ905が出力し、配線907を介して、インバータ906に入力される信号の振幅
は、電源電圧に等しいため、回路は正常に動作し、波形のひずみもない。
図10では、TFT側の回路がインバータ906の場合について述べたが、クロックドイ
ンバータなどの場合も同様である。図11,図12に、TFT側の回路がクロックドイン
バータの場合の例を示す。図11では、コントローラ側1001の回路として、例えば、
インバータ1005が配置されている。インバータ1005は、第1のPチャネル型トラ
ンジスタ1008及び第1のNチャネル型トランジスタ1009から構成される。TFT
側1002の回路としては、例えば、クロックドインバータ1006が配置されている。
クロックドインバータ1006は、第2のPチャネル型トランジスタ1010、第3のP
チャネル型トランジスタ1011、第2のNチャネル型トランジスタ1012及び第3の
Nチャネル型トランジスタ1013から構成される。そして、高電位側電源線1003及
び低電位側電源線1004によって、インバータ1005で用いられた電源電圧が、ガラ
ス基板上で結晶TFTを用いて形成されたクロックドインバータ1006にも、供給され
ている。つまり、コントローラ側1001と、TFT側1002とで、同じ電源電圧を用
いている。したがって、高電位側電源線1003は、インバータ1005およびクロック
ドインバータ1006の第1のPチャネル型トランジスタ1008及び第2のPチャネル
型トランジスタ1010に接続されている。また、低電位側電源線1004は、インバー
タ1005およびクロックドインバータ1006の第1のNチャネル型トランジスタ10
09及び第3のNチャネル型トランジスタ1013に接続されている。そのため、レベル
シフタが必要ない。クロックドインバータ1006は、活性層が概ね単結晶状態にあるた
め、電流特性が良い。しきい値電圧の絶対値も小さく、移動度も大きい。したがって、I
Cと同じ電源電圧を供給されても、動作させることが出来る。その結果、消費電力が低く
、薄型で、小型な表示装置を形成することが出来る。また、インバータ1005が出力し
、配線1007を介して、クロックドインバータ1006に入力される信号の振幅は、電
源電圧に等しいため、回路は正常に動作し、波形のひずみもない。
図12には、クロックで制御される部分にコントローラから信号が入る場合のクロックド
インバータ1106a、1106bの場合について示す。図12では、コントローラ側1
101の回路として、インバータ1105a、およびインバータ1105bが配置されて
いる。インバータ1105aは、第1のPチャネル型トランジスタ1111及び第1のN
チャネル型トランジスタ1112から構成される。インバータ1105bは、第2のPチ
ャネル型トランジスタ1113及び第2のNチャネル型トランジスタ1114から構成さ
れる。TFT側1102の回路としては、クロックドインバータ1106aおよびクロッ
クドインバータ1106bが配置されている。クロックドインバータ1106aは、第3
のPチャネル型トランジスタ1115、第4のPチャネル型トランジスタ1116、第3
のNチャネル型トランジスタ1117及び第4のNチャネル型トランジスタ1118から
構成される。クロックドインバータ1106bは、第5のPチャネル型トランジスタ11
19、第6のPチャネル型トランジスタ1120、第5のNチャネル型トランジスタ11
21及び第6のNチャネル型トランジスタ1122から構成される。
コントローラ側1101のインバータ1105aから、配線1107および配線1108
を通して、TFT側1102のクロックドインバータ1106a、クロックドインバータ
1106bのクロック同期用TFTである第3のPチャネル型トランジスタ1115、第
6のNチャネル型トランジスタ1122に信号が供給される。コントローラ側1101の
インバータ1105bから、配線1109および配線1110を通して、TFT側110
2のクロックドインバータ1106a、クロックドインバータ1106bのクロック同期
用TFTである第4のNチャネル型トランジスタ1118、第5のPチャネル型トランジ
スタ1119に信号が供給される。そして、インバータ1105a、1105bで用いら
れた電源電圧が、高電位側電源線1103及び低電位側電源線1104によって、ガラス
基板上で結晶TFTを用いて形成されたクロックドインバータ1106a、1106bに
も、供給されている。つまり、コントローラ側1101と、TFT側1102とで、同じ
電源電圧を用いている。したがって、高電位側電源線1103は、インバータ1105a
、1105b、クロックドインバータ1106a、1106bのPチャネル型トランジス
タに接続されている。また、低電位側電源線1104は、インバータ1105a、110
5b、クロックドインバータ1106a、1106bのNチャネル型トランジスタに接続
されている。そのため、レベルシフタが必要ない。クロックドインバータ1106a、1
106bは、活性層が概ね単結晶状態にあるため、電流特性が良い。しきい値電圧の絶対
値も小さく、移動度も大きい。したがって、ICと同じ電源電圧を供給されても、動作さ
せることが出来る。その結果、消費電力が低く、薄型で、小型な表示装置を形成すること
が出来る。また、インバータ1105a、1105bが出力し、クロックドインバータ1
106a、1106bに入力される信号の振幅は、電源電圧に等しいため、回路は正常に
動作し、波形のひずみもない。
つぎに、上記図2に示したレベルシフタ502、上記図5に示したレベルシフタ702の
構成例を示す。図13(A)、(B)に、回路図を示す。図13(A)のレベルシフタは
、第1のPチャネル型トランジスタ1201、第1のNチャネル型トランジスタ1202
、第2のPチャネル型トランジスタ1203および第2のNチャネル型トランジスタ12
04から構成される。第1のPチャネル型トランジスタ1201と第2のPチャネル型ト
ランジスタ1203は高電位側電源線1205によって接続され、第1のNチャネル型ト
ランジスタ1202と第2のNチャネル型トランジスタ1204は、低電位側電源線12
06によって接続される。配線1207から信号が入力され、配線1208からは、反転
した信号が入力され、配線1209から増幅された信号が出力される。図13(B)のレ
ベルシフタは、第1のPチャネル型トランジスタ1210、第2のPチャネル型トランジ
スタ1211、第1のNチャネル型トランジスタ1212、第3のPチャネル型トランジ
スタ1213、第4のPチャネル型トランジスタ1214および第2のNチャネル型トラ
ンジスタ1215から構成される。第1のPチャネル型トランジスタ1210と第3のP
チャネル型トランジスタ1213は高電位側電源線1216によって接続され、第1のN
チャネル型トランジスタ1212と第2のNチャネル型トランジスタ1215は、低電位
側電源線1217によって接続される。配線1218から信号が入力され、配線1219
からは、反転した信号が入力され、配線1220から増幅された信号が出力される。ただ
し、図13(A)、(B)のレベルシフタでは、出力信号の波形が整うのが遅く、十分に
動作できない場合がある。結晶TFTを用いた回路の場合、ずっと低い電圧で動作させ、
画素の直前で、大きな電圧にレベルシフトさせることになる。したがって、レベルシフト
量が非常に多く、出力信号の波形が整うのに多くの時間が掛かるからである。
そこで、図14〜図16に示すように、能動負荷回路(アクティブ負荷、アクティブロー
ド、カレントミラー回路などとも言う)を配置したレベルシフタ回路を用いればよい。図
14は、Nチャネル型トランジスタを用いた能動負荷回路1301を用いたレベルシフタ
を示している。図14のレベルシフタは第1のPチャネル型トランジスタ1302、第2
のPチャネル型トランジスタ1303、第1のNチャネル型トランジスタ1304および
第2のNチャネル型トランジスタ1305から構成される。第1のPチャネル型トランジ
スタ1302と第2のPチャネル型トランジスタ1303は高電位側電源線1306によ
って接続され、第1のNチャネル型トランジスタ1304と第2のNチャネル型トランジ
スタ1305は、低電位側電源線1307によって接続される。配線1308から信号が
入力され、配線1309からは、反転した信号が入力され、配線1310から増幅された
信号が出力される。能動負荷回路1301は、第1のNチャネル型トランジスタ1304
および第2のNチャネル型トランジスタ1305から構成され、2つのトランジスタのゲ
ート電極が互いに接続され、第1のNチャネル型トランジスタ1304のゲート電極とド
レイン電極とが接続されている。
図15には、Pチャネル型トランジスタを用いた能動負荷回路1401を用いたレベルシ
フタを示している。図15のレベルシフタは第1のPチャネル型トランジスタ1402、
第2のPチャネル型トランジスタ1403、第1のNチャネル型トランジスタ1404お
よび第2のNチャネル型トランジスタ1405から構成される。第1のPチャネル型トラ
ンジスタ1402と第2のPチャネル型トランジスタ1403は高電位側電源線1406
によって接続され、第1のNチャネル型トランジスタ1404と第2のNチャネル型トラ
ンジスタ1405は、低電位側電源線1407によって接続される。配線1408から信
号が入力され、配線1409からは、反転した信号が入力され、配線1410から増幅さ
れた信号が出力される。能動負荷回路1401は、第1のPチャネル型トランジスタ14
02および第2のPチャネル型トランジスタ1403から構成され、2つのトランジスタ
のゲート電極が互いに接続され、第1のPチャネル型トランジスタ1402のゲート電極
とドレイン電極とが接続されている。
図16には、差動増幅回路と類似した形にしたレベルシフタであり、能動負荷回路150
1を用いている。図16のレベルシフタは第1のPチャネル型トランジスタ1502、第
2のPチャネル型トランジスタ1503、第3のPチャネル型トランジスタ1504、第
1のNチャネル型トランジスタ1505および第2のNチャネル型トランジスタ1506
から構成される。第1のPチャネル型トランジスタ1502は高電位側電源線1507に
よって接続され、第1のNチャネル型トランジスタ1505と第2のNチャネル型トラン
ジスタ1506は、低電位側電源線1508によって接続される。配線1509から信号
が入力され、配線1510からは、反転した信号が入力され、配線1511から増幅され
た信号が出力される。能動負荷回路1501は、第1のNチャネル型トランジスタ150
5および第2のNチャネル型トランジスタ1506から構成され、2つのトランジスタの
ゲート電極が互いに接続され、第1のNチャネル型トランジスタ1505のゲート電極と
ドレイン電極とが接続されている。
このような能動負荷回路を配置したレベルシフタ回路を用いれば、素早く出力信号を切り
替えられるので、レベルシフト量が非常に多くても、正常にレベルシフトさせることが出
来る。
次に、図17に昇圧回路301の具体例を示す。図17の昇圧回路301は、第1乃至第
4トランジスタ1701乃至1704と、第1乃至第4のコンデンサ1705乃至170
8と、インバータ1709から構成されている。配線1710から入力された電圧は、昇
圧されて配線1711から出力される。チャージポンプ回路を用いて、昇圧回路を構成す
ることが出来る。トランジスタとコンデンサの段数を変えることにより、出力電圧を調整
することが出来る。
なお、本実施の形態において、様々な図を用いて述べてきたが、各々の図で述べた内容(
一部でもよい)は、別の図で述べた内容(一部でもよい)に対して、適用、組み合わせ、
又は置き換えなどを自由に行うことが出来る。さらに、これまでに述べた図において、各
々の部分に関して、別の部分を組み合わせることにより、さらに多くの図を構成させるこ
とが出来る。
同様に、本実施の形態の各々の図で述べた内容(一部でもよい)は、別の実施の形態の図
で述べた内容(一部でもよい)に対して、適用、組み合わせ、又は置き換えなどを自由に
行うことが出来る。さらに、本実施の形態の図において、各々の部分に関して、別の実施
の形態の部分を組み合わせることにより、さらに多くの図を構成させることが出来る。
なお、本実施の形態は、他の実施の形態で述べた内容(一部でもよい)を、具現化した場
合の一例、少し変形した場合の一例、一部を変更した場合の一例、改良した場合の一例、
詳細に述べた場合の一例、応用した場合の一例、関連がある部分についての一例などを示
している。したがって、他の実施の形態で述べた内容は、本実施の形態への適用、組み合
わせ、又は置き換えを自由に行うことができる。
(第3の実施の形態)
つぎに、単結晶TFTの製造方法について述べる。
SOI基板を図18(A)(B)に示す。図18(A)においてベース基板2100は絶
縁表面を有する基板若しくは絶縁基板であり、アルミノシリケートガラス、アルミノホウ
ケイ酸ガラス、バリウムホウケイ酸ガラスのような電子工業用に使われる各種ガラス基板
が適用される。その他に石英ガラス、シリコンウエハーのような半導体基板も適用可能で
ある。SOI層2102は単結晶半導体であり、代表的には単結晶シリコンが適用される
。その他に、水素イオン注入剥離法のようにして単結晶半導体基板から分離可能であるシ
リコン、ゲルマニウム、その他、ガリウムヒ素、インジウムリンなどの化合物半導体によ
る単結晶半導体層を適用することもできる。
このようなベース基板2100とSOI層2102の間には、平滑面を有し親水性表面を
形成する接合層2104を設ける。この接合層2104として酸化シリコン層が適してい
る。特に有機シランガスを用いて化学気相成長法により作製される酸化シリコン層が好ま
しい。有機シランガスとしては、珪酸エチル(TEOS:化学式Si(OC
、テトラメチルシラン(TMS:化学式Si(CH)、テトラメチルシクロテトラ
シロキサン(TMCTS)、オクタメチルシクロテトラシロキサン(OMCTS)、ヘキ
サメチルジシラザン(HMDS)、トリエトキシシラン(SiH(OC)、ト
リスジメチルアミノシラン(SiH(N(CH)等のシリコン含有化合物を用
いることができる。
上記平滑面を有し親水性表面を形成する接合層2104は5nm乃至500nmの厚さで
設けられる。この厚さであれば、被成膜表面の表面荒れを平滑化すると共に、当該膜の成
長表面の平滑性を確保することが可能である。また、接合する基板との歪みを緩和するこ
とができる。ベース基板2100にも同様の酸化シリコン層を設けておいても良い。すな
わち、絶縁表面を有する基板若しくは絶縁性のベース基板2100にSOI層2102を
接合するに際し、接合を形成する面の一方若しくは双方に、好ましくは有機シランを原材
料として成膜した酸化シリコン層でなる接合層2104を設けることで強固な接合を形成
することができる。
図18(B)はベース基板2100にバリア層2105と接合層2104を設けた構成を
示す。SOI層2102をベース基板2100に接合した場合に、ベース基板2100と
して用いられるガラス基板からアルカリ金属若しくはアルカリ土類金属のような可動イオ
ン不純物が拡散してSOI層2102が汚染されることを防ぐことができる。また、ベー
ス基板2100側の接合層2104は適宜設ければ良い。
図19(A)はSOI層2102と接合層2104の間に窒素含有絶縁層2120を設け
た構成を示す。窒素含有絶縁層2120は窒化シリコン層、窒化酸化シリコン層若しくは
酸化窒化シリコン層から選ばれた一又は複数の膜を積層して形成する。例えば、SOI層
2102側から酸化窒化シリコン層、窒化酸化シリコン層を積層して窒素含有絶縁層21
20とすることができる。接合層2104がベース基板2100と接合を形成するために
設けるのに対し、窒素含有絶縁層2120は、可動イオンや水分等の不純物がSOI層2
102に拡散して汚染されることを防ぐために設けることが好ましい。
なお、ここで酸化窒化シリコン膜とは、その組成として、窒素よりも酸素の含有量が多い
ものであって、ラザフォード後方散乱法(RBS:Rutherford Backsc
attering Spectrometry)及び水素前方散乱法(HFS:Hydr
ogen Forward Scattering)を用いて測定した場合に、濃度範囲
として酸素が50〜70原子%、窒素が0.5〜15原子%、Siが25〜35原子%、
水素が0.1〜10原子%の範囲で含まれるものをいう。また、窒化酸化シリコン膜とは
、その組成として、酸素よりも窒素の含有量が多いものであって、RBS及びHFSを用
いて測定した場合に、濃度範囲として酸素が5〜30原子%、窒素が20〜55原子%、
Siが25〜35原子%、水素が10〜30原子%の範囲で含まれるものをいう。但し、
酸化窒化シリコンまたは窒化酸化シリコンを構成する原子の合計を100原子%としたと
き、窒素、酸素、Si及び水素の含有比率が上記の範囲内に含まれるものとする。
図19(B)はベース基板2100に接合層2104を設けた構成である。ベース基板2
100と接合層2104との間にはバリア層2105が設けられていることが好ましい。
ベース基板2100として用いられるガラス基板からアルカリ金属若しくはアルカリ土類
金属のような可動イオン不純物が拡散してSOI層2102が汚染されることを防ぐため
である。また、SOI層2102には酸化シリコン層2121が形成されている。この酸
化シリコン層2121が接合層2104と接合を形成し、ベース基板2100上にSOI
層2102を固定する。酸化シリコン層2121は熱酸化により形成されたものが好まし
い。また、接合層2104と同様にTEOSを用いて化学気相成長法により成膜したもの
を適用しても良い。また、酸化シリコン層2121としてケミカルオキサイドを適用する
こともできる。ケミカルオキサイドは、例えばオゾン含有水で半導体基板表面を処理する
ことで形成することができる。ケミカルオキサイドは半導体基板の表面の平坦性を反映し
て形成されるので好ましい。
このようなSOI基板の製造方法について図20(A)乃至図20(C)と図21を参照
して説明する。
図20(A)に示す半導体基板2101は清浄化されており、その表面から電界で加速さ
れたイオンを所定の深さに添加し、脆化層2103を形成する。イオンの添加はベース基
板に転置するSOI層の厚さを考慮して行われる。当該単SOI層の厚さは5nm乃至5
00nm、好ましくは10nm乃至200nmの厚さとする。イオンを添加する際の加速
電圧はこのような厚さを考慮して、半導体基板2101に添加されるようにする。脆化層
2103は水素、ヘリウム若しくはフッ素に代表されるハロゲンのイオンを添加すること
で形成される。この場合、一種類のイオン又は同一の原子から成る質量数の異なる複数の
種類のイオンを添加することが好ましい。水素イオンを添加する場合には、H、H
、H イオンを含ませると共に、H イオンの割合を高めておくことが好ましい。水
素イオンを添加する場合に、H、H 、H イオンを含ませると共に、H イオ
ンの割合を高めておくと添加効率を高めることができ、添加時間を短縮することができる
。このような構成とすることで、分離を容易に行うことができる。
イオンを高ドーズ条件で添加する必要があり、半導体基板2101の表面が粗くなってし
まう場合がある。そのためイオンが添加される表面に窒化シリコン層若しくは窒化酸化シ
リコン層などによりイオン添加に対する保護膜を50nm乃至200nmの厚さで設けて
おいても良い。
次に、図20(B)で示すようにベース基板と接合を形成する面に接合層2104として
酸化シリコン層を形成する。酸化シリコン層としては上述のように有機シランガスを用い
て化学気相成長法により作製される酸化シリコン層が好ましい。その他に、シランガスを
用いて化学気相成長法により作製される酸化シリコン層を適用することもできる。化学気
相成長法による成膜では、単結晶半導体基板に形成した脆化層2103から脱ガスが起こ
らない温度として、例えば350℃以下の成膜温度が適用される。また、単結晶若しくは
多結晶半導体基板からSOI層を分離する熱処理は、成膜温度よりも高い熱処理温度が適
用される。
図20(C)はベース基板2100と半導体基板2101の接合層2104が形成された
面とを密接させ、この両者を接合させる態様を示す。接合を形成する面は、十分に清浄化
しておく。そして、ベース基板2100と接合層2104を密着させることにより接合が
形成される。この接合はファン・デル・ワールス力が作用しており、ベース基板2100
と半導体基板2101とを圧接することで水素結合により強固な接合を形成することが可
能である。
良好な接合を形成するために、表面を活性化しておいても良い。例えば、接合を形成する
面に原子ビーム若しくはイオンビームを照射する。原子ビーム若しくはイオンビームを利
用する場合には、アルゴン等の不活性ガス中性原子ビーム若しくは不活性ガスイオンビー
ムを用いることができる。その他に、プラズマ照射若しくはラジカル処理を行う。このよ
うな表面処理により200℃乃至400℃の温度であっても異種材料間の接合を形成する
ことが容易となる。
ベース基板2100と半導体基板2101を接合層2104を介して貼り合わせた後は、
加熱処理又は加圧処理を行うことが好ましい。加熱処理又は加圧処理を行うことで接合強
度を向上させることが可能となる。加熱処理の温度は、ベース基板2100の耐熱温度以
下であることが好ましい。加圧処理においては、接合面に垂直な方向に圧力が加わるよう
に行い、ベース基板2100及び半導体基板2101の耐圧性を考慮して行う。
図21において、ベース基板2100と半導体基板2101を貼り合わせた後、熱処理を
行い、脆化層2103を劈開面として半導体基板2101をベース基板2100から分離
する。熱処理の温度は接合層2104の成膜温度以上、ベース基板2100の耐熱温度以
下で行うことが好ましい。例えば、400℃乃至600℃の熱処理を行うことにより、脆
化層2103に形成された微小な空洞の体積変化が起こり、脆化層2103に沿って劈開
することが可能となる。接合層2104はベース基板2100と接合しているので、ベー
ス基板2100上には半導体基板2101と同じ結晶性のSOI層2102が残存するこ
ととなる。
図22はベース基板2100側に接合層を設けてSOI層を形成する工程を示す。図22
(A)は酸化シリコン層2121が形成された半導体基板2101に電界で加速されたイ
オンを所定の深さに添加し、脆化層2103を形成する工程を示している。水素、ヘリウ
ム若しくはフッ素に代表されるハロゲンのイオンの添加は図20(A)の場合と同様であ
る。半導体基板2101の表面に酸化シリコン層2121を形成しておくことでイオンド
ーピングによって表面がダメージを受け、平坦性が損なわれるのを防ぐことができる。
図22(B)は、バリア層2105及び接合層2104が形成されたベース基板2100
と半導体基板2101の酸化シリコン層2121が形成された面を密着させて接合を形成
する工程を示している。ベース基板2100上の接合層2104と半導体基板2101の
酸化シリコン層2121を密着させることにより接合が形成される。
その後、図22(C)で示すように半導体基板2101を分離する。半導体基板2101
を分離する熱処理は図21の場合と同様にして行う。このようにして図19(B)で示す
SOI基板を得ることができる。
このように、本形態によれば、ガラス基板等の耐熱温度が700℃以下のベース基板21
00であっても接合部の接着力が強固なSOI層2102を得ることができる。ベース基
板2100として、アルミノシリケートガラス、アルミノホウケイ酸ガラス、バリウムホ
ウケイ酸ガラスの如き無アルカリガラスと呼ばれる電子工業用に使われる各種ガラス基板
を適用することが可能となる。すなわち、一辺が1メートルを超える基板上に単結晶半導
体層を形成することができる。このような大面積基板を使って液晶ディスプレイのような
表示装置のみならず、半導体集積回路を製造することができる。
図27(A)乃至(C)と図28(A)及び(B)は、半導体基板2101にBOX層2
122を設けてSOI層を形成する場合の工程を示す。ここで、BOX層とは、シリコン
酸化物でなる埋め込み酸化物(Buried Oxide)層のことを指す。図27(A
)はBOX層2122を有する半導体基板2101に電界で加速されたイオンを所定の深
さに添加し、脆化層2103を形成する工程を示している。水素、ヘリウム若しくはフッ
素に代表されるハロゲンのイオンの添加は図20(A)の場合と同様である。ここで、イ
オン分布のピーク位置がBOX層2122となるようにする。つまり、脆化層2103が
BOX層2122の中となる。
図27(B)は、ベース基板と接合を形成する面に接合層2104として酸化シリコン層
を形成する工程を示す。酸化シリコン層としては上述のように有機シランガスを用いて化
学気相成長法により作製される酸化シリコン層が好ましい。その他に、シランガスを用い
て化学気相成長法により作製される酸化シリコン層を適用することもできる。化学気相成
長法による成膜では、単結晶半導体基板に形成した脆化層2103から脱ガスが起こらな
い温度として、例えば350℃以下の成膜温度が適用される。また、単結晶若しくは多結
晶半導体基板からSOI層を分離する熱処理は、成膜温度よりも高い熱処理温度が適用さ
れる。
図27(C)は、ベース基板2100と半導体基板2101の接合層2104が形成され
た面とを密接させ、この両者を接合させる工程を示す。接合を形成する面は、十分に清浄
化しておく。そして、ベース基板2100と接合層2104を密着させることにより接合
が形成される。この接合はファン・デル・ワールス力が作用しており、ベース基板210
0と半導体基板2101とを圧接することで水素結合により強固な接合を形成することが
可能である。
良好な接合を形成するために、表面を活性化しておいても良い。例えば、接合を形成する
面に原子ビーム若しくはイオンビームを照射する。原子ビーム若しくはイオンビームを利
用する場合には、アルゴン等の不活性ガス中性原子ビーム若しくは不活性ガスイオンビー
ムを用いることができる。その他に、プラズマ照射若しくはラジカル処理を行う。このよ
うな表面処理により200℃乃至400℃の温度であっても異種材料間の接合を形成する
ことが容易となる。
ベース基板2100と半導体基板2101を接合層2104を介して貼り合わせた後は、
加熱処理又は加圧処理を行うことが好ましい。加熱処理又は加圧処理を行うことで接合強
度を向上させることが可能となる。加熱処理の温度は、ベース基板2100の耐熱温度以
下であることが好ましい。加圧処理においては、接合面に垂直な方向に圧力が加わるよう
に行い、ベース基板2100及び半導体基板2101の耐圧性を考慮して行う。
図28(A)において、ベース基板2100と半導体基板2101を貼り合わせた後、熱
処理を行い脆化層2103を劈開面として半導体基板2101をベース基板2100から
分離する。熱処理の温度は接合層2104の成膜温度以上、ベース基板2100の耐熱温
度以下で行うことが好ましい。例えば、400℃乃至600℃の熱処理を行うことにより
、脆化層2103に形成された微小な空洞の体積変化が起こり、脆化層2103に沿って
劈開することが可能となる。接合層2104はベース基板2100と接合しているので、
ベース基板2100上には半導体基板2101と同じ結晶性のSOI層2102が残存す
ることとなる。
図28(B)は、ベース基板2100に残存するBOX層2122を希フッ酸でウエット
エッチングして除去する工程を示す。
図27(A)乃至(C)と図28(A)及び(B)とに示した工程では、分離面のダング
リングボンド、結晶欠陥などは、BOX層2122に発生する。つまり、ベース基板21
00が有する半導体層には、ダングリングボンド、結晶欠陥などが発生しない。そして、
BOX層2122を除去することによって、半導体層の膜厚均一性を損なうことを防止す
ることができる。
次いで、SOI基板を用いた半導体装置について図23と図24を参照して説明する。図
23(A)において、ベース基板2100に接合層2104を介してSOI層2102が
設けられている。SOI層2102上には、素子形成領域に合わせて窒化シリコン層21
23、酸化シリコン層2106を形成する。酸化シリコン層2106は、素子分離のため
にSOI層2102をエッチングするときのハードマスクとして用いる。窒化シリコン層
2123はエッチングストッパーである。
SOI層2102の膜厚は5nm乃至500nm、好ましくは10nm乃至200nmの
厚さとすることが好ましい。SOI層2102の厚さは、図20で説明した脆化層210
3の深さを制御することにより適宜設定できる。SOI層2102にはしきい値電圧を制
御するために、硼素、アルミニウム、ガリウムなどのp型不純物を添加する。例えば、p
型不純物として硼素を5×1017cm−3以上1×1018cm−3以下の濃度で添加
されていても良い。
図23(B)は、酸化シリコン層2106をマスクとしてSOI層2102、接合層21
04をエッチングする工程である。SOI層2102及び接合層2104の露出した端面
に対してプラズマ処理により窒化する。この窒化処理により、少なくともSOI層210
2の周辺端部には窒化シリコン層2107が形成される。窒化シリコン層2107は絶縁
性であり、SOI層2102の端面でのリーク電流が流れるのを防止する効果がある。ま
た、耐酸化作用があるので、SOI層2102と接合層2104との間に、端面から酸化
膜が成長してバーズビークが形成されるのを防ぐことができる。
図23(C)は、素子分離絶縁層2108を堆積する工程である。素子分離絶縁層210
8はTEOSを用いて酸化シリコン層を化学気相成長法で堆積する。素子分離絶縁層21
08はSOI層2102が埋め込まれるように厚く堆積する。
図23(D)は窒化シリコン層2123が露出するまで素子分離絶縁層2108を除去す
る工程を示している。この除去工程は、ドライエッチングによって行うこともできるし、
化学的機械研磨によって行っても良い。窒化シリコン層2123はエッチングストッパー
となる。素子分離絶縁層2108はSOI層2102の間に埋め込まれるように残存する
。窒化シリコン層2123はその後除去する。
図23(E)において、SOI層2102が露出した後ゲート絶縁層2109、ゲート電
極2110、サイドウォール絶縁層2111を形成し、第1不純物領域2112、第2不
純物領域2113を形成する。絶縁層2114は窒化シリコンで形成し、ゲート電極21
10をエッチングするときのハードマスクとして用いる。
図24(A)において、層間絶縁層2115を形成する。層間絶縁層2115はBPSG
(BorophosphoSilicate Glass)膜を形成してリフローにより
平坦化させる。また、TEOSを用いて酸化シリコン層を形成し化学的機械研磨処理によ
って平坦化しても良い。平坦化処理においてゲート電極2110上の絶縁層2114はエ
ッチングストッパーとして機能する。層間絶縁層2115にはコンタクトホール2116
を形成する。コンタクトホール2116は、サイドウォール絶縁層2111を利用してセ
ルフアラインコンタクトの構成となっている。
その後、図24(B)で示すように、六フッ化タングステンを用い、CVD法でコンタク
トプラグ2117を形成する。さらに絶縁層2118を形成し、コンタクトプラグ211
7に合わせて開口を形成して配線2119を設ける。配線2119はアルミニウム若しく
はアルミニウム合金で形成し、上層と下層にはバリアメタルとしてモリブデン、クロム、
チタンなどの金属膜で形成する。
このように、ベース基板2100に接合されたSOI層2102を用いて電界効果トラン
ジスタを作製することができる。本形態に係るSOI層2102は、結晶方位が一定の単
結晶半導体であるため、均一で高性能な電界効果トランジスタを得ることができる。すな
わち、閾値電圧や移動度などトランジスタ特性として重要な特性値の不均一性を抑制し、
高移動化などの高性能化を達成することができる。
なお、本実施の形態において、様々な図を用いて述べてきたが、各々の図で述べた内容(
一部でもよい)は、別の図で述べた内容(一部でもよい)に対して、適用、組み合わせ、
又は置き換えなどを自由に行うことが出来る。さらに、これまでに述べた図において、各
々の部分に関して、別の部分を組み合わせることにより、さらに多くの図を構成させるこ
とが出来る。
同様に、本実施の形態の各々の図で述べた内容(一部でもよい)は、別の実施の形態の図
で述べた内容(一部でもよい)に対して、適用、組み合わせ、又は置き換えなどを自由に
行うことが出来る。さらに、本実施の形態の図において、各々の部分に関して、別の実施
の形態の部分を組み合わせることにより、さらに多くの図を構成させることが出来る。
なお、本実施の形態は、他の実施の形態で述べた内容(一部でもよい)を、具現化した場
合の一例、少し変形した場合の一例、一部を変更した場合の一例、改良した場合の一例、
詳細に述べた場合の一例、応用した場合の一例、関連がある部分についての一例などを示
している。したがって、他の実施の形態で述べた内容は、本実施の形態への適用、組み合
わせ、又は置き換えを自由に行うことができる。
(第4の実施の形態)
SOI基板の製造方法について図25と図26を参照して説明する。図25(A)は、自
然酸化膜が除去された単結晶シリコン基板2301にSiHガスとNOガスを用い、
プラズマCVD法で100nmの厚さで酸化窒化シリコン層2305を形成する。さらに
SiHガス、NOガス及びNHガスを用い、50nmの厚さで窒化酸化シリコン層
2306を成膜する。
そして、図25(B)で示すように、窒化酸化シリコン層2306の表面からイオンドー
ピング装置を用い水素イオンを添加する。イオンドーピング装置はイオン化したガスを質
量分離せず、そのまま電界で加速して基板に添加させる方式である。この装置を用いると
、大面積基板であっても高効率に高ドーズのイオンドーピングを行うことができる。本例
では、水素をイオン化して単結晶シリコン基板2301に脆化層2303を形成する。イ
オンドーピングは加速電圧80kVで、ドーズ量は2×1016/cmとして行う。
この場合、一種類のイオン又は同一の原子から成る質量数の異なる複数の種類のイオンを
添加することが好ましい。水素イオンを添加する場合には、H、H 、H イオン
を含ませると共に、H イオンの割合を約80%にまで高めておくことが好ましい。こ
のように質量数が小さく高次のイオンを単結晶シリコン基板2301に多く含ませること
により、熱処理工程において脆化層2303の劈開を容易なものとすることができる。こ
の場合において、単結晶シリコン基板2301のイオンドーピング面に窒化酸化シリコン
層2306及び酸化窒化シリコン層2305を設けておくことで、イオンドーピングによ
り単結晶シリコン基板2301の表面荒れを防ぐことができる。
次に、図25(C)で示すように窒化酸化シリコン層2306上に酸化シリコン層230
4を形成する。酸化シリコン層2304はプラズマCVD法で、珪酸エチル(TEOS:
化学式Si(OC)と酸素ガスを用いて50nmの厚さで成膜する。成膜温度
は350℃以下として、脆化層2303から水素が離脱しないようにする。
図26(A)は、オゾン含有水を用いて超音波洗浄されたガラス基板2300と単結晶シ
リコン基板2301を、酸化シリコン層2304を挟んで重ね合わせ、押圧することで接
合を形成する工程を示している。その後、窒素雰囲気中において400℃で10分間の熱
処理を行い、さらに500℃にて2時間の熱処理を行い、さらに400℃で数時間保持し
た後、室温まで徐冷した。これにより図26(B)で示すように、脆化層2303に亀裂
を形成させて単結晶シリコン基板2301を分離すると共に、酸化シリコン層2304と
ガラス基板2300との接合を強固なものとすることができる。
このようにしてガラス基板2300上に単結晶シリコン層2302を、ガラス基板230
0が歪まない温度で形成することができる。本例で作製される単結晶シリコン層2302
はガラス基板2300と強固に接合しており、テープ剥離試験を行っても該シリコン層が
分離することはない。すなわち、アルミノシリケートガラス、アルミノホウケイ酸ガラス
、バリウムホウケイ酸ガラスの如き無アルカリガラスと呼ばれる電子工業用に使われる各
種ガラス基板上に単結晶シリコン層を設けることが可能となり、一辺が1メートルを超え
る基板を使って様々な集積回路、表示装置を製造することが可能となる。
なお、本実施の形態において、様々な図を用いて述べてきたが、各々の図で述べた内容(
一部でもよい)は、別の図で述べた内容(一部でもよい)に対して、適用、組み合わせ、
又は置き換えなどを自由に行うことが出来る。さらに、これまでに述べた図において、各
々の部分に関して、別の部分を組み合わせることにより、さらに多くの図を構成させるこ
とが出来る。
同様に、本実施の形態の各々の図で述べた内容(一部でもよい)は、別の実施の形態の図
で述べた内容(一部でもよい)に対して、適用、組み合わせ、又は置き換えなどを自由に
行うことが出来る。さらに、本実施の形態の図において、各々の部分に関して、別の実施
の形態の部分を組み合わせることにより、さらに多くの図を構成させることが出来る。
なお、本実施の形態は、他の実施の形態で述べた内容(一部でもよい)を、具現化した場
合の一例、少し変形した場合の一例、一部を変更した場合の一例、改良した場合の一例、
詳細に述べた場合の一例、応用した場合の一例、関連がある部分についての一例などを示
している。したがって、他の実施の形態で述べた内容は、本実施の形態への適用、組み合
わせ、又は置き換えを自由に行うことができる。
(第5の実施の形態)
本実施形態においては、第1の実施の形態で述べた表示装置の画素構造について説明する
。特に、有機EL素子を用いた表示装置の画素構造について説明する。
図45(A)は、1つの画素に2つのトランジスタを有する画素の上面図(レイアウト図
)の一例である。図45(B)は、図45(A)に示すX−X’の部分の断面図の一例で
ある。
図45は、第1のトランジスタ3105、第1の配線3106、第2の配線3107、第
2のトランジスタ3108、第3の配線3111、対向電極3112、コンデンサ311
3、画素電極3115、隔壁3116、有機導電体膜3117、有機薄膜3118及び基
板3119を示している。なお、第1のトランジスタ3105はスイッチング用トランジ
スタとして、第1の配線3106はゲート信号線として、第2の配線3107はソース信
号線として、第2のトランジスタ3108は駆動用トランジスタとして、第3の配線31
11は電流供給線として、それぞれ用いられるのが好適である。
第1のトランジスタ3105のゲート電極は、第1の配線3106と電気的に接続され、
第1のトランジスタ3105のソース電極及びドレイン電極の一方は、第2の配線310
7と電気的に接続され、第1のトランジスタ3105のソース電極及びドレイン電極の他
方は、第2のトランジスタ3108のゲート電極及びコンデンサ3113の一方の電極と
電気的に接続されている。なお、第1のトランジスタ3105のゲート電極は、複数のゲ
ート電極によって構成されている。こうすることで、第1のトランジスタ3105のオフ
状態におけるリーク電流を低減することができる。
第2のトランジスタ3108のソース電極及びドレイン電極の一方は、第3の配線311
1と電気的に接続され、第2のトランジスタ3108のソース電極及びドレイン電極の他
方は、画素電極3115と電気的に接続されている。こうすることで、画素電極3115
に流れる電流を、第2のトランジスタ3108によって制御することができる。
画素電極3115上には、有機導電体膜3117が設けられ、さらに有機薄膜3118(
有機化合物層)が設けられている。有機薄膜3118(有機化合物層)上には、対向電極
3112が設けられている。なお、対向電極3112は、全ての画素で共通に接続される
ように、一面に形成されていてもよく、シャドーマスクなどを用いてパターン形成されて
いてもよい。
有機薄膜3118(有機化合物層)から発せられた光は、画素電極3115又は対向電極
3112のうちいずれかを透過して発せられる。
図45(B)において、画素電極側、すなわちトランジスタ等が形成されている側に光が
発せられる場合を下面放射、対向電極側に光が発せられる場合を上面放射と呼ぶ。
下面放射の場合、画素電極3115は透光性を有する導電膜によって形成されるのが好適
である。逆に、上面放射の場合、対向電極3112は透光性を有する導電膜によって形成
されるのが好適である。
カラー表示の発光装置においては、R,G,Bそれぞれの発光色を持つEL素子を塗り分
けても良いし、単色のEL素子を一面に塗り、カラーフィルタによってR,G,Bの発光
を得るようにしても良い。
なお、図45に示した構成はあくまで一例であり、画素レイアウト、断面構成、EL素子
の電極の積層順等に関して、図45に示した構成以外にも、様々な構成をとることができ
る。また、発光層は、図示した有機薄膜で構成される素子の他に、LEDのような結晶性
の素子、無機薄膜で構成される素子など、様々な素子を用いることができる。
なお、本実施の形態において、様々な図を用いて述べてきたが、各々の図で述べた内容(
一部でもよい)は、別の図で述べた内容(一部でもよい)に対して、適用、組み合わせ、
又は置き換えなどを自由に行うことが出来る。さらに、これまでに述べた図において、各
々の部分に関して、別の部分を組み合わせることにより、さらに多くの図を構成させるこ
とが出来る。
同様に、本実施の形態の各々の図で述べた内容(一部でもよい)は、別の実施の形態の図
で述べた内容(一部でもよい)に対して、適用、組み合わせ、又は置き換えなどを自由に
行うことが出来る。さらに、本実施の形態の図において、各々の部分に関して、別の実施
の形態の部分を組み合わせることにより、さらに多くの図を構成させることが出来る。
なお、本実施の形態は、他の実施の形態で述べた内容(一部でもよい)を、具現化した場
合の一例、少し変形した場合の一例、一部を変更した場合の一例、改良した場合の一例、
詳細に述べた場合の一例、応用した場合の一例、関連がある部分についての一例などを示
している。したがって、他の実施の形態で述べた内容は、本実施の形態への適用、組み合
わせ、又は置き換えを自由に行うことができる。
(第6の実施の形態)
本実施形態においては、電子機器の例について説明する。
図29は表示パネル4101と、回路基板4111を組み合わせた表示パネルモジュール
を示している。表示パネル4101は画素部4102、走査線駆動回路4103及び信号
線駆動回路4104を有している。回路基板4111には、例えば、コントロール回路4
112及び信号分割回路4113などが形成されている。表示パネル4101と回路基板
4111とは接続配線4114によって接続されている。接続配線にはFPC等を用いる
ことができる。
第1の実施の形態のように、表示パネル4101上の走査線駆動回路4103及び信号線
駆動回路4104のシフトレジスタに、単結晶半導体基板から単結晶半導体層を分離し、
それをガラス基板に固定することで形成された単結晶TFTを用いることで、消費電力が
低く、薄型で、小型な表示パネルモジュールを形成することが出来る。
図29に示した表示パネルモジュールによって、テレビ受像機を完成させることができる
。図30は、テレビ受像機の主要な構成を示すブロック図である。チューナ4201は映
像信号と音声信号を受信する。映像信号は、映像信号増幅回路4202と、映像信号増幅
回路4202から出力される信号を赤、緑、青の各色に対応した色信号に変換する映像信
号処理回路4203と、その映像信号を駆動回路の入力仕様に変換するためのコントロー
ル回路4212により処理される。コントロール回路4212は、走査線側と信号線側に
それぞれ信号を出力する。デジタル駆動する場合には、信号線側に信号分割回路4213
を設け、入力デジタル信号をm個(mは正の整数)に分割して供給する構成としても良い
チューナ4201で受信した信号のうち、音声信号は音声信号増幅回路4205に送られ
、その出力は音声信号処理回路4206を経てスピーカ4207に供給される。制御回路
4208は受信局(受信周波数)及び音量の制御情報を入力部4209から受け、チュー
ナ4201又は音声信号処理回路4206に信号を送出する。
図30とは別の形態の表示パネルモジュールを組み込んだテレビ受像器について図31(
A)に示す。図31(A)において、筐体4301内に収められた表示画面4302は、
表示パネルモジュールで形成される。なお、スピーカ4303、操作スイッチ4304、
入力手段4305、センサ4306(力、変位、位置、速度、加速度、角速度、回転数、
距離、光、液、磁気、温度、化学、音声、時間、硬度、電場、電流、電圧、電力、放射線
、流量、湿度、傾度、振動、におい又は赤外線を測定する機能を含むもの)、マイクロフ
ォン4307などが適宜備えられていてもよい。
図31(B)に、ワイヤレスでディスプレイのみを持ち運び可能なテレビ受像器を示す。
筐体4312にはバッテリー及び信号受信器が収められており、そのバッテリーで表示部
4313、スピーカ部4317、センサ4319(力、変位、位置、速度、加速度、角速
度、回転数、距離、光、液、磁気、温度、化学、音声、時間、硬度、電場、電流、電圧、
電力、放射線、流量、湿度、傾度、振動、におい又は赤外線を測定する機能を含むもの)
及びマイクロフォン4320を駆動させる。バッテリーは充電器4310で繰り返し充電
が可能となっている。充電器4310は映像信号を送受信することが可能で、その映像信
号をディスプレイの信号受信器に送信することができる。図31(B)に示す装置は、操
作キー4316によって制御される。あるいは、図31(B)に示す装置は、操作キー4
316を操作することによって、充電器4310に信号を送ることが可能である。つまり
、映像音声双方向通信装置であってもよい。あるいは、図31(B)に示す装置は、操作
キー4316を操作することによって、充電器4310に信号を送り、さらに充電器43
10が送信できる信号を他の電子機器に受信させることによって、他の電子機器の通信制
御も可能である。つまり、汎用遠隔制御装置であってもよい。なお、入力手段4318な
どが適宜備えられていてもよい。なお、本実施の形態の各々の図で述べた内容(一部でも
よい)を表示部4313に適用することができる。
図32(A)は、表示パネル4401とプリント配線基板4402を組み合わせたモジュ
ールを示している。表示パネル4401は、複数の画素が設けられた画素部4403と、
第1の走査線駆動回路4404、第2の走査線駆動回路4405と、選択された画素にビ
デオ信号を供給する信号線駆動回路4406を備えていてもよい。第1の実施の形態のよ
うに、表示パネル4401上の第1の走査線駆動回路4404、第2の走査線駆動回路4
405及び信号線駆動回路4406のシフトレジスタに、単結晶半導体基板から単結晶半
導体層を分離し、それをガラス基板に固定することで形成された単結晶TFTを用いるこ
とで、消費電力が低く、薄型で、小型なモジュールを形成することが出来る。
プリント配線基板4402には、コントローラ4407、中央処理装置(CPU)440
8、メモリ4409、電源回路4410、音声処理回路4411及び送受信回路4412
などが備えられている。プリント配線基板4402と表示パネル4401は、フレキシブ
ル配線基板(FPC)4413により接続されている。フレキシブル配線基板(FPC)
4413には、保持容量、バッファ回路などを設け、電源電圧又は信号にノイズの発生、
及び信号の立ち上がり時間の増大を防ぐ構成としても良い。なお、コントローラ4407
、音声処理回路4411、メモリ4409、中央処理装置(CPU)4408、電源回路
4410などは、COG(Chip On Glass)方式を用いて表示パネル440
1に実装することもできる。COG方式により、プリント配線基板4402の規模を縮小
することができる。
プリント配線基板4402に備えられたインターフェース(I/F)部4414を介して
、各種制御信号の入出力が行われる。そして、アンテナとの間の信号の送受信を行うため
のアンテナ用ポート4415が、プリント配線基板4402に設けられている。
図32(B)は、図32(A)に示したモジュールのブロック図を示す。このモジュール
は、メモリ4409としてVRAM4416、DRAM4417、フラッシュメモリ44
18などが含まれている。VRAM4416にはパネルに表示する画像のデータが、DR
AM4417には画像データ又は音声データが、フラッシュメモリ4418には各種プロ
グラムが記憶されている。
電源回路4410は、表示パネル4401、コントローラ4407、中央処理装置(CP
U)4408、音声処理回路4411、メモリ4409、送受信回路4412を動作させ
る電力を供給する。ただし、パネルの仕様によっては、電源回路4410に電流源が備え
られている場合もある。
中央処理装置(CPU)4408は、制御信号生成回路4420、デコーダ4421、レ
ジスタ4422、演算回路4423、RAM4424、中央処理装置(CPU)4408
用のインターフェース(I/F)部4419などを有している。インターフェース(I/
F)部4419を介して中央処理装置(CPU)4408に入力された各種信号は、一旦
レジスタ4422に保持された後、演算回路4423、デコーダ4421などに入力され
る。演算回路4423では、入力された信号に基づき演算を行い、各種命令を送る場所を
指定する。一方デコーダ4421に入力された信号はデコードされ、制御信号生成回路4
420に入力される。制御信号生成回路4420は入力された信号に基づき、各種命令を
含む信号を生成し、演算回路4423において指定された場所、具体的にはメモリ440
9、送受信回路4412、音声処理回路4411、コントローラ4407などに送る。
メモリ4409、送受信回路4412、音声処理回路4411、コントローラ4407は
、それぞれ受けた命令に従って動作する。以下その動作について簡単に説明する。
入力手段4425から入力された信号は、インターフェース(I/F)部4414を介し
てプリント配線基板4402に実装された中央処理装置(CPU)4408に送られる。
制御信号生成回路4420は、ポインティングデバイス又はキーボードなどの入力手段4
425から送られてきた信号に従い、VRAM4416に格納してある画像データを所定
のフォーマットに変換し、コントローラ4407に送付する。
コントローラ4407は、パネルの仕様に合わせて中央処理装置(CPU)4408から
送られてきた画像データを含む信号にデータ処理を施し、表示パネル4401に供給する
。コントローラ4407は、電源回路4410から入力された電源電圧、又は中央処理装
置(CPU)4408から入力された各種信号をもとに、Hsync信号、Vsync信
号、クロック信号(CLK)、交流電圧(AC Cont)、切り替え信号L/Rを生成
し、表示パネル4401に供給する。
送受信回路4412では、アンテナ4428において電波として送受信される信号が処理
されており、具体的にはアイソレータ、バンドパスフィルタ、VCO(Voltage
Controlled Oscillator)、LPF(Low Pass Filt
er)、カプラ、バランなどの高周波回路を含んでいてもよい。送受信回路4412にお
いて送受信される信号のうち音声情報を含む信号が、中央処理装置(CPU)4408か
らの命令に従って、音声処理回路4411に送られる。
中央処理装置(CPU)4408の命令に従って送られてきた音声情報を含む信号は、音
声処理回路4411において音声信号に復調され、スピーカ4427に送られる。マイク
4426から送られてきた音声信号は、音声処理回路4411において変調され、中央処
理装置(CPU)4408からの命令に従って、送受信回路4412に送られる。
コントローラ4407、中央処理装置(CPU)4408、電源回路4410、音声処理
回路4411、メモリ4409を、本実施形態のパッケージとして実装することができる
勿論、本実施の形態はテレビ受像機に限定されず、パーソナルコンピュータのモニタをは
じめ、鉄道の駅又は空港などにおける情報表示盤、街頭における広告表示盤など特に大面
積の表示媒体として様々な用途に適用することができる。
次に、図33を参照して、携帯電話の構成例について説明する。
表示パネル4501はハウジング4530に脱着自在に組み込まれる。ハウジング453
0は表示パネル4501のサイズに合わせて、形状又は寸法を適宜変更することができる
。表示パネル4501を固定したハウジング4530はプリント基板4531に嵌入され
モジュールとして組み立てられる。
表示パネル4501はFPC4513を介してプリント基板4531に接続される。プリ
ント基板4531には、スピーカ4532、マイクロフォン4533、送受信回路453
4、CPU、コントローラなどを含む信号処理回路4535及びセンサ4541(力、変
位、位置、速度、加速度、角速度、回転数、距離、光、液、磁気、温度、化学、音声、時
間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾度、振動、におい又は赤外
線を測定する機能を含むもの)が形成されている。このようなモジュールと、入力手段4
536、バッテリー4537を組み合わせ、アンテナ4540と共に、筐体4539に収
納する。表示パネル4501の画素部は筐体4539に形成された開口窓から視認できよ
うに配置する。
図33に示した携帯電話は、様々な情報(静止画、動画、テキスト画像など)を表示する
機能を有する。カレンダー、日付又は時刻などを表示部に表示する機能を有する。表示部
に表示した情報を操作又は編集する機能を有する。様々なソフトウェア(プログラム)に
よって処理を制御する機能を有する。無線通信機能を有する。無線通信機能を用いて他の
携帯電話、固定電話又は音声通信機器と通話する機能を有する。無線通信機能を用いて様
々なコンピュータネットワークに接続する機能を有する。無線通信機能を用いて様々なデ
ータの送信又は受信を行う機能を有する。着信、データの受信、又はアラームに応じてバ
イブレータが動作する機能を有する。着信、データの受信、又はアラームに応じて音が発
生する機能を有する。なお、図33に示した携帯電話が有する機能はこれに限定されず、
様々な機能を有することができる。
図34で示す携帯電話機は、操作スイッチ類4604、マイクロフォン4605などが備
えられた本体(A)4601と、表示パネル(A)4608、表示パネル(B)4609
、スピーカ4606、センサ4611(力、変位、位置、速度、加速度、角速度、回転数
、距離、光、液、磁気、温度、化学、音声、時間、硬度、電場、電流、電圧、電力、放射
線、流量、湿度、傾度、振動、におい又は赤外線を測定する機能を含むもの)などが備え
られた本体(B)4602とが、蝶番4610で開閉可能に連結されている。表示パネル
(A)4608と表示パネル(B)4609は、回路基板4607と共に本体(B)46
02の筐体4603の中に収納される。表示パネル(A)4608及び表示パネル(B)
4609の画素部は筐体4603に形成された開口窓から視認できるように配置される。
表示パネル(A)4608と表示パネル(B)4609は、その携帯電話機4600の機
能に応じて画素数などの仕様を適宜設定することができる。例えば、表示パネル(A)4
608を主画面とし、表示パネル(B)4609を副画面として組み合わせることができ
る。
本実施形態に係る携帯電話機は、その機能又は用途に応じてさまざまな態様に変容し得る
。例えば、蝶番4610の部位に撮像素子を組み込んで、カメラ付きの携帯電話機として
も良い。操作スイッチ類4604、表示パネル(A)4608、表示パネル(B)460
9を一つの筐体内に納めた構成としても、上記した作用効果を奏することができる。表示
部を複数個そなえた情報表示端末に本実施形態の構成を適用しても、同様な効果を得るこ
とができる。
図34に示した携帯電話は、様々な情報(静止画、動画、テキスト画像など)を表示する
機能を有する。カレンダー、日付又は時刻などを表示部に表示する機能を有する。表示部
に表示した情報を操作又は編集する機能を有する。様々なソフトウェア(プログラム)に
よって処理を制御する機能を有する。無線通信機能を有する。無線通信機能を用いて他の
携帯電話、固定電話又は音声通信機器と通話する機能を有する。無線通信機能を用いて様
々なコンピュータネットワークに接続する機能を有する。無線通信機能を用いて様々なデ
ータの送信又は受信を行う機能を有する。着信、データの受信、又はアラームに応じてバ
イブレータが動作する機能を有する。着信、データの受信、又はアラームに応じて音が発
生する機能を有する。なお、図34に示した携帯電話が有する機能はこれに限定されず、
様々な機能を有することができる。
本実施の形態に係る携帯電話機は、第1の実施の形態のように、表示パネル上の走査線駆
動回路及び信号線駆動回路のシフトレジスタに、単結晶半導体基板から単結晶半導体層を
分離し、それをガラス基板に固定することで形成された単結晶TFTを用いることで、携
帯電話の低消費電力化を図り、携帯電話機の一回の充電による使用時間を長くすることが
できる。また、携帯電話機の低コスト化を図ることができる。また、薄型で、小型な携帯
電話機を作製することが出来る。
本実施の形態の各々の図で述べた内容(一部でもよい)を様々な電子機器に適用すること
ができる。具体的には、電子機器の表示部に適用することができる。そのような電子機器
として、ビデオカメラ、デジタルカメラなどのカメラ、ゴーグル型ディスプレイ、ナビゲ
ーションシステム、音響再生装置(カーオーディオ、オーディオコンポ等)、コンピュー
タ、ゲーム機器、携帯情報端末(モバイルコンピュータ、携帯電話、携帯型ゲーム機又は
電子書籍等)、記録媒体を備えた画像再生装置(具体的にはDigital Versa
tile Disc(DVD)等の記録媒体を再生し、その画像を表示しうるディスプレ
イを備えた装置)などが挙げられる。
図35(A)はディスプレイであり、筐体4711、支持台4712、表示部4713、
入力手段4714、センサ4715(力、変位、位置、速度、加速度、角速度、回転数、
距離、光、液、磁気、温度、化学、音声、時間、硬度、電場、電流、電圧、電力、放射線
、流量、湿度、傾度、振動、におい又は赤外線を測定する機能を含むもの)、マイクロフ
ォン4716、スピーカ4717、操作キー4718、LEDランプ4719等を含む。
図35(A)に示すディスプレイは、様々な情報(静止画、動画、テキスト画像など)を
表示部に表示する機能を有する。なお、図35(A)に示すディスプレイが有する機能は
これに限定されず、様々な機能を有することができる。
図35(B)はカメラであり、本体4731、表示部4732、受像部4733、操作キ
ー4734、外部接続ポート4735、シャッターボタン4736、入力手段4737、
センサ4738(力、変位、位置、速度、加速度、角速度、回転数、距離、光、液、磁気
、温度、化学、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾度
、振動、におい又は赤外線を測定する機能を含むもの)、マイクロフォン4739、スピ
ーカ4740、LEDランプ4741等を含む。図35(B)に示すカメラは、静止画を
撮影する機能を有する。動画を撮影する機能を有する。撮影した画像(静止画、動画)を
自動で補正する機能を有する。撮影した画像を記録媒体(外部又はカメラに内蔵)に保存
する機能を有する。撮影した画像を表示部に表示する機能を有する。なお、図35(B)
に示すカメラが有する機能はこれらに限定されず、様々な機能を有することができる。
図35(C)はコンピュータであり、本体4751、筐体4752、表示部4753、キ
ーボード4754、外部接続ポート4755、ポインティングデバイス4756、入力手
段4757、センサ4758(力、変位、位置、速度、加速度、角速度、回転数、距離、
光、液、磁気、温度、化学、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量
、湿度、傾度、振動、におい又は赤外線を測定する機能を含むもの)、マイクロフォン4
759、スピーカ4760、LEDランプ4761、リーダ/ライタ4762等を含む。
図35(C)に示すコンピュータは、様々な情報(静止画、動画、テキスト画像など)を
表示部に表示する機能を有する。様々なソフトウェア(プログラム)によって処理を制御
する機能を有する。無線通信又は有線通信などの通信機能を有する。通信機能を用いて様
々なコンピュータネットワークに接続する機能を有する。通信機能を用いて様々なデータ
の送信又は受信を行う機能を有する。なお、図35(C)に示すコンピュータが有する機
能はこれらに限定されず、様々な機能を有することができる。
図42(A)はモバイルコンピュータであり、本体5411、表示部5412、スイッチ
5413、操作キー5414、赤外線ポート5415、入力手段5416、センサ541
7(力、変位、位置、速度、加速度、角速度、回転数、距離、光、液、磁気、温度、化学
、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾度、振動、にお
い又は赤外線を測定する機能を含むもの)、マイクロフォン5418、スピーカ5419
、LEDランプ5420等を含む。図42(A)に示すモバイルコンピュータは、様々な
情報(静止画、動画、テキスト画像など)を表示部に表示する機能を有する。表示部にタ
ッチパネルの機能を有する。カレンダー、日付又は時刻などを表示する機能を表示部に有
する。様々なソフトウェア(プログラム)によって処理を制御する機能を有する。無線通
信機能を有する。無線通信機能を用いて様々なコンピュータネットワークに接続する機能
を有する。無線通信機能を用いて様々なデータの送信又は受信を行う機能を有する。なお
、図42(A)に示すモバイルコンピュータが有する機能はこれらに限定されず、様々な
機能を有することができる。
図42(B)は記録媒体を備えた携帯型の画像再生装置(たとえば、DVD再生装置)で
あり、本体5431、筐体5432、表示部A5433、表示部B5434、記録媒体(
DVD等)読み込み部5435、操作キー5436、スピーカ部5437、入力手段54
38、センサ5439(力、変位、位置、速度、加速度、角速度、回転数、距離、光、液
、磁気、温度、化学、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度
、傾度、振動、におい又は赤外線を測定する機能を含むもの)、マイクロフォン5440
、LEDランプ5441等を含む。表示部A5433は主として画像情報を表示し、表示
部B5434は主として文字情報を表示することができる。
図42(C)はゴーグル型ディスプレイであり、本体5451、表示部5452、イヤホ
ン5453、支持部5454、入力手段5455、センサ5456(力、変位、位置、速
度、加速度、角速度、回転数、距離、光、液、磁気、温度、化学、音声、時間、硬度、電
場、電流、電圧、電力、放射線、流量、湿度、傾度、振動、におい又は赤外線を測定する
機能を含むもの)、マイクロフォン5457、スピーカ5458、LEDランプ5459
等を含む。図42(C)に示すゴーグル型ディスプレイは、外部から取得した画像(静止
画、動画、テキスト画像など)を表示部に表示する機能を有する。なお、図42(C)に
示すゴーグル型ディスプレイが有する機能はこれに限定されず、様々な機能を有すること
ができる。
図43(A)は携帯型遊技機であり、筐体5511、表示部5512、スピーカ部551
3、操作キー5514、記憶媒体挿入部5515、入力手段5516、センサ5517(
力、変位、位置、速度、加速度、角速度、回転数、距離、光、液、磁気、温度、化学、音
声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾度、振動、におい又
は赤外線を測定する機能を含むもの)、マイクロフォン5518、LEDランプ5519
等を含む。図43(A)に示す携帯型遊技機は、記録媒体に記録されているプログラム又
はデータを読み出して表示部に表示する機能を有する。他の携帯型遊技機と無線通信を行
って情報を共有する機能を有する。なお、図43(A)に示す携帯型遊技機が有する機能
はこれらに限定されず、様々な機能を有することができる。
図43(B)はテレビ受像機能付きデジタルカメラであり、本体5531、表示部553
2、操作キー5533、スピーカ5534、シャッターボタン5535、受像部5536
、アンテナ5537、入力手段5538、センサ5539(力、変位、位置、速度、加速
度、角速度、回転数、距離、光、液、磁気、温度、化学、音声、時間、硬度、電場、電流
、電圧、電力、放射線、流量、湿度、傾度、振動、におい又は赤外線を測定する機能を含
むもの)、マイクロフォン5540、LEDランプ5541等を含む。図43(B)に示
すテレビ受像機付きデジタルカメラは、静止画を撮影する機能を有する。動画を撮影する
機能を有する。撮影した画像を自動で補正する機能を有する。アンテナから様々な情報を
取得する機能を有する。撮影した画像、又はアンテナから取得した情報を保存する機能を
有する。撮影した画像、又はアンテナから取得した情報を表示部に表示する機能を有する
。なお、図43(B)に示すテレビ受像機付きデジタルカメラが有する機能はこれらに限
定されず、様々な機能を有することができる。
図44は携帯型遊技機であり、筐体5611、第1表示部5612、第2表示部5613
、スピーカ部5614、操作キー5615、記録媒体挿入部5616、入力手段5617
、センサ5618(力、変位、位置、速度、加速度、角速度、回転数、距離、光、液、磁
気、温度、化学、音声、時間、硬度、電場、電流、電圧、電力、放射線、流量、湿度、傾
度、振動、におい又は赤外線を測定する機能を含むもの)、マイクロフォン5619、L
EDランプ5620等を含む。図44に示す携帯型遊技機は、記録媒体に記録されている
プログラム又はデータを読み出して表示部に表示する機能を有する。他の携帯型遊技機と
無線通信を行って情報を共有する機能を有する。なお、図44に示す携帯型遊技機が有す
る機能はこれらに限定されず、様々な機能を有することができる。
図35(A)乃至(C)、図42(A)乃至(C)、図43(A)及び(B)、及び図4
4に示したように、電子機器は、何らかの情報を表示するための表示部を有することを特
徴とする。第1の実施の形態のように、表示部の走査線駆動回路及び信号線駆動回路のシ
フトレジスタに、単結晶半導体基板から単結晶半導体層を分離し、それをガラス基板に固
定することで形成された単結晶TFTを用いることで、消費電力が低く、長時間の電池駆
動が可能である電子機器を作製することが出来る。
次に、半導体装置の応用例を説明する。
図36に、半導体装置を、建造物と一体にして設けた例について示す。図36は、筐体4
810、表示部4811、操作部であるリモコン装置4812、スピーカ部4813等を
含む。半導体装置は、壁かけ型として建物と一体となっており、設置するスペースを広く
必要とすることなく設置可能である。
図37に、建造物内に半導体装置を、建造物と一体にして設けた別の例について示す。表
示パネル4901は、ユニットバス4902と一体に取り付けられており、入浴者は表示
パネル4901の視聴が可能になる。表示パネル4901は入浴者が操作することで情報
を表示する機能を有する。広告又は娯楽手段として利用できる機能を有する。
なお、半導体装置は、図37で示したユニットバス4902の側壁だけではなく、様々な
場所に設置することができる。たとえば、鏡面の一部又は浴槽自体と一体にするなどとし
てもよい。このとき、表示パネル4901の形状は、鏡面又は浴槽の形状に合わせたもの
となっていてもよい。
図38に、半導体装置を、建造物と一体にして設けた別の例について示す。表示パネル5
002は、柱状体5001の曲面に合わせて湾曲させて取り付けられている。なお、ここ
では柱状体5001を電柱として説明する。
図38に示す表示パネル5002は、人間の視点より高い位置に設けられている。電柱の
ように屋外で繰り返し林立している建造物に表示パネル5002を設置することで、不特
定多数の視認者に広告を行なうことができる。ここで、表示パネル5002は、外部から
の制御により、同じ画像を表示させること、及び瞬時に画像を切替えることが容易である
ため、極めて効率的な情報表示、及び広告効果が得られる。表示パネル5002に自発光
型の表示素子を設けることで、夜間であっても、視認性の高い表示媒体として有用である
といえる。電柱に設置することで、表示パネル5002の電力供給手段の確保が容易であ
る。災害発生時などの非常事態の際には、被災者に素早く正確な情報を伝達する手段とも
なり得る。
なお、表示パネル5002としては、たとえば、フィルム状の基板に有機トランジスタな
どのスイッチング素子を設けて表示素子を駆動することにより画像の表示を行なう表示パ
ネルを用いることができる。
第1の実施の形態のように、表示パネルの走査線駆動回路及び信号線駆動回路のシフトレ
ジスタに、単結晶半導体基板から単結晶半導体層を分離し、それをガラス基板に固定する
ことで形成された単結晶TFTを用いることで、消費電力が低い表示パネルを作製するこ
とが出来る。なお、本実施形態において、建造物として壁、柱状体、ユニットバスを例と
したが、本実施形態はこれに限定されず、様々な建造物に半導体装置を設置することがで
きる。
次に、半導体装置を、移動体と一体にして設けた例について示す。
図39は、半導体装置を、自動車と一体にして設けた例について示した図である。表示パ
ネル5102は、自動車の車体5101と一体に取り付けられており、車体の動作又は車
体内外から入力される情報をオンデマンドに表示することができる。なお、ナビゲーショ
ン機能を有していてもよい。
なお、半導体装置は、図39で示した車体5101だけではなく、様々な場所に設置する
ことができる。たとえば、ガラス窓、ドア、ハンドル、シフトレバー、座席シート、ルー
ムミラー等と一体にしてもよい。このとき、表示パネル5102の形状は、設置するもの
の形状に合わせたものとなっていてもよい。
図40は、半導体装置を、列車車両と一体にして設けた例について示した図である。
図40(a)は、列車車両のドア5201のガラスに表示パネル5202を設けた例につ
いて示した図である。従来の紙による広告に比べて、広告切替えの際に必要となる人件費
がかからないという利点がある。表示パネル5202は、外部からの信号により表示部で
表示される画像の切り替えを瞬時に行なうことが可能であるため、たとえば、電車の乗降
客の客層が入れ替わる時間帯ごとに表示パネルの画像を切り替えることができ、より効果
的な広告効果が得られる。
図40(b)は、列車車両のドア5201のガラスの他に、ガラス窓5203、及び天井
5204に表示パネル5202を設けた例について示した図である。このように、半導体
装置は、従来では設置が困難であった場所に容易に設置することが可能であるため、効果
的な広告効果を得ることができる。半導体装置は、外部からの信号により表示部で表示さ
れる画像の切り替えを瞬時に行なうことが可能であるため、広告切替え時のコスト及び時
間が削減でき、より柔軟な広告の運用及び情報伝達が可能となる。
なお、半導体装置は、図40で示したドア5201、ガラス窓5203、及び天井520
4だけではなく、様々な場所に設置することができる。たとえば、つり革、座席シート、
てすり、床等と一体にしてもよい。このとき、表示パネル5202の形状は、設置するも
の形状に合わせたものとなっていてもよい。
図41は、半導体装置を、旅客用飛行機と一体にして設けた例について示した図である。
図41(a)は、旅客用飛行機の座席上部の天井5301に表示パネル5302を設けた
ときの、使用時の形状について示した図である。表示パネル5302は、天井5301と
ヒンジ部5303を介して一体に取り付けられており、ヒンジ部5303の伸縮により乗
客は表示パネル5302の視聴が可能になる。表示パネル5302は乗客が操作すること
で情報を表示する機能を有する。広告又は娯楽手段として利用できる機能を有する。図4
1(b)に示すように、ヒンジ部を折り曲げて天井5301に格納することにより、離着
陸時の安全に配慮することができる。なお、緊急時に表示パネル5302の表示素子を点
灯させることで、情報伝達手段及び誘導灯としても利用可能である。
なお、半導体装置は、図41で示した天井5301だけではなく、様々な場所に設置する
ことができる。たとえば、座席シート、座席テーブル、肘掛、窓等と一体にしてもよい。
複数の人が同時に視聴できる大型の表示パネルを、機体の壁に設置してもよい。このとき
、表示パネル5302の形状は、設置するもの形状に合わせたものとなっていてもよい。
第1の実施の形態のように、表示パネルの走査線駆動回路及び信号線駆動回路のシフトレ
ジスタに、単結晶半導体基板から単結晶半導体層を分離し、それをガラス基板に固定する
ことで形成された単結晶TFTを用いることで、消費電力が低い表示パネルを作製するこ
とが出来る。なお、本実施形態において、移動体としては電車車両本体、自動車車体、飛
行機車体について例示したがこれらに限定されず、自動二輪車、自動四輪車(自動車、バ
ス等を含む)、電車(モノレール、鉄道等を含む)、船舶等、様々なものに設置すること
ができる。半導体装置は、外部からの信号により、移動体内における表示パネルの表示を
瞬時に切り替えることが可能であるため、移動体に半導体装置を設置することにより、移
動体を不特定複数の顧客を対象とした広告表示板、災害発生時の情報表示板、等の用途に
用いることが可能となる。
なお、本実施の形態において、様々な図を用いて述べてきたが、各々の図で述べた内容(
一部でもよい)は、別の図で述べた内容(一部でもよい)に対して、適用、組み合わせ、
又は置き換えなどを自由に行うことが出来る。さらに、これまでに述べた図において、各
々の部分に関して、別の部分を組み合わせることにより、さらに多くの図を構成させるこ
とが出来る。
同様に、本実施の形態の各々の図で述べた内容(一部でもよい)は、別の実施の形態の図
で述べた内容(一部でもよい)に対して、適用、組み合わせ、又は置き換えなどを自由に
行うことが出来る。さらに、本実施の形態の図において、各々の部分に関して、別の実施
の形態の部分を組み合わせることにより、さらに多くの図を構成させることが出来る。
なお、本実施の形態は、他の実施の形態で述べた内容(一部でもよい)を、具現化した場
合の一例、少し変形した場合の一例、一部を変更した場合の一例、改良した場合の一例、
詳細に述べた場合の一例、応用した場合の一例、関連がある部分についての一例などを示
している。したがって、他の実施の形態で述べた内容は、本実施の形態への適用、組み合
わせ、又は置き換えを自由に行うことができる。
101 ガラス基板
102 ソースドライバ
103 ゲートドライバ
104 画素配列
105 基板
106 コントローラ
107 電源
110 信号
111 第1の電源電圧
112 第2の電源電圧
210 信号
212 第3の電源電圧
301 昇圧回路
312 第2の電源電圧
313 第3の電源電圧
401 メモリ
402 グラフィック用プロセッサ
501 シフトレジスタ
502 レベルシフタ
503 サンプリング回路
601 ラッチ1回路
602 ラッチ2回路
603 DAC
701 シフトレジスタ
702 レベルシフタ
703 バッファ

Claims (1)

  1. 第1のトランジスタを有するコントローラを有し、
    第2のトランジスタを有するシフトレジスタを有し、
    第3のトランジスタを有し、
    前記第1のトランジスタは、第1のチャネル形成領域を有し、
    前記第2のトランジスタは、第2のチャネル形成領域を有し、
    前記第3のトランジスタは、第3のチャネル形成領域を有し、
    シリコン基板に、前記第1のチャネル形成領域を有し、
    シリコン層に、前記第2のチャネル形成領域を有し、
    酸化物半導体層に、前記第3のチャネル形成領域を有し、
    基板の上方に、前記シリコン層と前記酸化物半導体層とを有することを特徴とする半導体装置。
JP2015137716A 2007-05-18 2015-07-09 半導体装置 Withdrawn JP2015179881A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2015137716A JP2015179881A (ja) 2007-05-18 2015-07-09 半導体装置

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
JP2007133517 2007-05-18
JP2007133517 2007-05-18
JP2015137716A JP2015179881A (ja) 2007-05-18 2015-07-09 半導体装置

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
JP2014127835A Division JP5778832B2 (ja) 2007-05-18 2014-06-23 半導体装置

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2018052059A Division JP6522189B2 (ja) 2007-05-18 2018-03-20 半導体装置

Publications (1)

Publication Number Publication Date
JP2015179881A true JP2015179881A (ja) 2015-10-08

Family

ID=40026999

Family Applications (7)

Application Number Title Priority Date Filing Date
JP2008127971A Active JP5568220B2 (ja) 2007-05-18 2008-05-15 半導体装置
JP2014127835A Active JP5778832B2 (ja) 2007-05-18 2014-06-23 半導体装置
JP2015137716A Withdrawn JP2015179881A (ja) 2007-05-18 2015-07-09 半導体装置
JP2018052059A Expired - Fee Related JP6522189B2 (ja) 2007-05-18 2018-03-20 半導体装置
JP2019081507A Withdrawn JP2019135790A (ja) 2007-05-18 2019-04-23 半導体装置
JP2020203935A Withdrawn JP2021064793A (ja) 2007-05-18 2020-12-09 半導体装置
JP2021212249A Withdrawn JP2022058429A (ja) 2007-05-18 2021-12-27 半導体装置

Family Applications Before (2)

Application Number Title Priority Date Filing Date
JP2008127971A Active JP5568220B2 (ja) 2007-05-18 2008-05-15 半導体装置
JP2014127835A Active JP5778832B2 (ja) 2007-05-18 2014-06-23 半導体装置

Family Applications After (4)

Application Number Title Priority Date Filing Date
JP2018052059A Expired - Fee Related JP6522189B2 (ja) 2007-05-18 2018-03-20 半導体装置
JP2019081507A Withdrawn JP2019135790A (ja) 2007-05-18 2019-04-23 半導体装置
JP2020203935A Withdrawn JP2021064793A (ja) 2007-05-18 2020-12-09 半導体装置
JP2021212249A Withdrawn JP2022058429A (ja) 2007-05-18 2021-12-27 半導体装置

Country Status (2)

Country Link
US (2) US8803781B2 (ja)
JP (7) JP5568220B2 (ja)

Families Citing this family (51)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN101593056A (zh) * 2008-05-30 2009-12-02 康准电子科技(昆山)有限公司 输入/输出装置
US8736587B2 (en) * 2008-07-10 2014-05-27 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
JP5484109B2 (ja) * 2009-02-09 2014-05-07 三菱電機株式会社 電気光学装置
US8872751B2 (en) * 2009-03-26 2014-10-28 Semiconductor Energy Laboratory Co., Ltd. Liquid crystal display device having interconnected transistors and electronic device including the same
KR101752640B1 (ko) 2009-03-27 2017-06-30 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체장치
WO2011010543A1 (en) * 2009-07-18 2011-01-27 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method for manufacturing semiconductor device
US9715845B2 (en) * 2009-09-16 2017-07-25 Semiconductor Energy Laboratory Co., Ltd. Semiconductor display device
CN107180608B (zh) * 2009-10-09 2020-10-02 株式会社半导体能源研究所 移位寄存器和显示装置以及其驱动方法
KR101779349B1 (ko) * 2009-10-14 2017-09-18 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 장치 및 그 제작 방법
CN106200185A (zh) * 2009-10-16 2016-12-07 株式会社半导体能源研究所 显示设备
KR102065330B1 (ko) 2009-10-16 2020-01-13 가부시키가이샤 한도오따이 에네루기 켄큐쇼 액정 표시 장치의 제작 방법
WO2011048923A1 (en) * 2009-10-21 2011-04-28 Semiconductor Energy Laboratory Co., Ltd. E-book reader
KR101819644B1 (ko) 2009-10-21 2018-01-17 가부시키가이샤 한도오따이 에네루기 켄큐쇼 전압 조정 회로
KR101751908B1 (ko) * 2009-10-21 2017-06-28 가부시키가이샤 한도오따이 에네루기 켄큐쇼 전압 조정 회로
JP5740132B2 (ja) 2009-10-26 2015-06-24 株式会社半導体エネルギー研究所 表示装置及び半導体装置
IN2012DN03080A (ja) * 2009-10-30 2015-07-31 Semiconductor Energy Lab
US10441185B2 (en) * 2009-12-16 2019-10-15 The Board Of Trustees Of The University Of Illinois Flexible and stretchable electronic systems for epidermal electronics
JP6046491B2 (ja) 2009-12-16 2016-12-21 ザ ボード オブ トラスティーズ オブ ザ ユニヴァーシティー オブ イリノイ コンフォーマル電子機器を使用した生体内での電気生理学
KR20240118180A (ko) 2009-12-18 2024-08-02 가부시키가이샤 한도오따이 에네루기 켄큐쇼 액정 표시 장치
CN102640207A (zh) * 2009-12-18 2012-08-15 株式会社半导体能源研究所 液晶显示装置及其驱动方法
US8759917B2 (en) * 2010-01-04 2014-06-24 Samsung Electronics Co., Ltd. Thin-film transistor having etch stop multi-layer and method of manufacturing the same
KR102031848B1 (ko) * 2010-01-20 2019-10-14 가부시키가이샤 한도오따이 에네루기 켄큐쇼 전자 기기 및 전자 시스템
KR101299256B1 (ko) * 2010-01-29 2013-08-22 가부시키가이샤 한도오따이 에네루기 켄큐쇼 반도체 기억 장치
WO2011096275A1 (en) * 2010-02-05 2011-08-11 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
WO2011122280A1 (en) * 2010-03-31 2011-10-06 Semiconductor Energy Laboratory Co., Ltd. Semiconductor display device
KR101887336B1 (ko) * 2010-04-23 2018-08-09 가부시키가이샤 한도오따이 에네루기 켄큐쇼 표시 장치 및 그 구동 방법
KR101928897B1 (ko) * 2010-08-27 2018-12-13 가부시키가이샤 한도오따이 에네루기 켄큐쇼 기억 장치, 반도체 장치
US8854220B1 (en) * 2010-08-30 2014-10-07 Exelis, Inc. Indicating desiccant in night vision goggles
TWI418880B (zh) * 2010-12-10 2013-12-11 Au Optronics Corp 主動式液晶面板
US8735263B2 (en) 2011-01-21 2014-05-27 Semiconductor Energy Laboratory Co., Ltd. Method for manufacturing SOI substrate
TWI657580B (zh) * 2011-01-26 2019-04-21 日商半導體能源研究所股份有限公司 半導體裝置及其製造方法
US9023684B2 (en) * 2011-03-04 2015-05-05 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
JP5520868B2 (ja) * 2011-03-31 2014-06-11 京セラドキュメントソリューションズ株式会社 通信装置および通信システム
KR102392401B1 (ko) 2011-05-13 2022-04-28 가부시키가이샤 한도오따이 에네루기 켄큐쇼 표시 장치
US8995218B2 (en) * 2012-03-07 2015-03-31 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device
US9324449B2 (en) * 2012-03-28 2016-04-26 Semiconductor Energy Laboratory Co., Ltd. Driver circuit, signal processing unit having the driver circuit, method for manufacturing the signal processing unit, and display device
TWI471658B (zh) * 2012-04-09 2015-02-01 Chunghwa Picture Tubes Ltd 膽固醇液晶顯示器及其驅動方法
TWM472858U (zh) * 2013-07-18 2014-02-21 Univ Chung Hua 外界觸發記憶型液晶光學薄膜
CN104978924B (zh) 2014-04-10 2017-07-25 上海和辉光电有限公司 发光控制驱动器、发光控制与扫描驱动器及显示装置
US9735614B2 (en) * 2014-05-18 2017-08-15 Nxp Usa, Inc. Supply-switching system
CN105139798B (zh) * 2015-10-20 2017-08-25 京东方科技集团股份有限公司 一种用于触摸屏的驱动电路、内嵌式触摸屏及显示装置
JP6662017B2 (ja) * 2015-12-16 2020-03-11 株式会社リコー エレクトロクロミック装置、及びエレクトロクロミック調光装置
US10680115B2 (en) 2015-12-22 2020-06-09 Intel Corporation P-channel oxide semiconductor thin film transistor
US20170287943A1 (en) * 2016-03-31 2017-10-05 Qualcomm Incorporated High aperture ratio display by introducing transparent storage capacitor and via hole
CN107799072B (zh) * 2016-09-07 2020-08-11 元太科技工业股份有限公司 电子纸显示器装置
US10355673B2 (en) * 2016-09-29 2019-07-16 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and electronic device
US10319743B2 (en) * 2016-12-16 2019-06-11 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, display system, and electronic device
US10706799B2 (en) * 2017-12-06 2020-07-07 Au Optronics Corporation Display device without a driver IC
WO2020074999A1 (ja) 2018-10-12 2020-04-16 株式会社半導体エネルギー研究所 半導体装置、および半導体装置の作製方法
JPWO2021053707A1 (ja) 2019-09-17 2021-03-25
DE102020124496A1 (de) * 2020-09-21 2022-03-24 Audi Aktiengesellschaft Verfahren zum Betreiben von wenigstens zwei mit einem Gleichstromnetzwerk verbundenen Wechselrichtern und Kraftfahrzeug

Citations (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000299469A (ja) * 1999-02-12 2000-10-24 Semiconductor Energy Lab Co Ltd 半導体装置およびその作製方法
JP2002244153A (ja) * 2001-02-14 2002-08-28 Seiko Epson Corp 電気光学装置、その製造方法及び電子機器
JP2002287653A (ja) * 2001-01-19 2002-10-04 Sony Corp 表示装置およびその製造方法、ならびに携帯端末およびその製造方法
JP2002333870A (ja) * 2000-10-31 2002-11-22 Matsushita Electric Ind Co Ltd 液晶表示装置、el表示装置及びその駆動方法、並びに副画素の表示パターン評価方法
US20040023444A1 (en) * 2002-07-09 2004-02-05 Semiconductor Energy Laboratory Co., Ltd. Method of manufacturing a semiconductor device
JP2004048029A (ja) * 2002-07-09 2004-02-12 Semiconductor Energy Lab Co Ltd 半導体装置の作製方法
US6777716B1 (en) * 1999-02-12 2004-08-17 Semiconductor Energy Laboratory Co., Ltd. Semiconductor display device and method of manufacturing therefor
JP2005049832A (ja) * 2003-07-14 2005-02-24 Semiconductor Energy Lab Co Ltd 液晶表示装置
JP2005166911A (ja) * 2003-12-02 2005-06-23 Seiko Epson Corp 半導体装置の製造方法、半導体装置、電気光学装置の製造方法、電気光学装置および電子機器
JP2005209851A (ja) * 2004-01-22 2005-08-04 Seiko Epson Corp 電気光学装置の製造方法および電気光学装置、電子機器
US20060244689A1 (en) * 2005-04-19 2006-11-02 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, display device and electronic apparatus
WO2006123584A1 (ja) * 2005-05-19 2006-11-23 Sharp Kabushiki Kaisha レベルシフタ、それを備えたシフトレジスタ、およびそれを備えた表示装置
JP2006323370A (ja) * 2005-04-19 2006-11-30 Semiconductor Energy Lab Co Ltd 半導体装置、表示装置、及び電子機器
US20070072439A1 (en) * 2005-09-29 2007-03-29 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
JP2007123861A (ja) * 2005-09-29 2007-05-17 Semiconductor Energy Lab Co Ltd 半導体装置及びその作製方法

Family Cites Families (57)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2967126B2 (ja) * 1990-09-05 1999-10-25 セイコーインスツルメンツ株式会社 平板型光弁基板用半導体集積回路装置
US6067062A (en) * 1990-09-05 2000-05-23 Seiko Instruments Inc. Light valve device
US5206749A (en) 1990-12-31 1993-04-27 Kopin Corporation Liquid crystal display having essentially single crystal transistors pixels and driving circuits
US5258325A (en) 1990-12-31 1993-11-02 Kopin Corporation Method for manufacturing a semiconductor device using a circuit transfer film
DE69223009T2 (de) 1991-08-02 1998-04-02 Canon Kk Flüssigkristall-Anzeigeeinheit
JP2824818B2 (ja) 1991-08-02 1998-11-18 キヤノン株式会社 アクティブマトリックス液晶表示装置
FR2681472B1 (fr) 1991-09-18 1993-10-29 Commissariat Energie Atomique Procede de fabrication de films minces de materiau semiconducteur.
US5705424A (en) 1992-09-11 1998-01-06 Kopin Corporation Process of fabricating active matrix pixel electrodes
CA2143647C (en) 1992-09-11 2005-11-15 Mark B. Spitzer Color filter system for display panels
US5781164A (en) 1992-11-04 1998-07-14 Kopin Corporation Matrix display systems
US5642129A (en) 1994-03-23 1997-06-24 Kopin Corporation Color sequential display panels
JP3401918B2 (ja) * 1994-07-04 2003-04-28 株式会社デンソー 半導体装置
JP4103968B2 (ja) 1996-09-18 2008-06-18 株式会社半導体エネルギー研究所 絶縁ゲイト型半導体装置
JP4401448B2 (ja) * 1997-02-24 2010-01-20 株式会社半導体エネルギー研究所 半導体装置の作製方法
US6388652B1 (en) 1997-08-20 2002-05-14 Semiconductor Energy Laboratory Co., Ltd. Electrooptical device
US6686623B2 (en) 1997-11-18 2004-02-03 Semiconductor Energy Laboratory Co., Ltd. Nonvolatile memory and electronic apparatus
JP2000012864A (ja) 1998-06-22 2000-01-14 Semiconductor Energy Lab Co Ltd 半導体装置の作製方法
US6271101B1 (en) 1998-07-29 2001-08-07 Semiconductor Energy Laboratory Co., Ltd. Process for production of SOI substrate and process for production of semiconductor device
JP4476390B2 (ja) 1998-09-04 2010-06-09 株式会社半導体エネルギー研究所 半導体装置の作製方法
JP2000259111A (ja) 1999-01-08 2000-09-22 Semiconductor Energy Lab Co Ltd 半導体表示装置およびその駆動回路
EP1020839A3 (en) 1999-01-08 2002-11-27 Sel Semiconductor Energy Laboratory Co., Ltd. Semiconductor display device and driving circuit therefor
JP4372943B2 (ja) * 1999-02-23 2009-11-25 株式会社半導体エネルギー研究所 半導体装置およびその作製方法
US6879313B1 (en) * 1999-03-11 2005-04-12 Sharp Kabushiki Kaisha Shift register circuit, image display apparatus having the circuit, and driving method for LCD devices
JP3588007B2 (ja) * 1999-05-14 2004-11-10 シャープ株式会社 双方向シフトレジスタ、および、それを用いた画像表示装置
TW517260B (en) * 1999-05-15 2003-01-11 Semiconductor Energy Lab Semiconductor device and method for its fabrication
JP2001159877A (ja) * 1999-09-20 2001-06-12 Sharp Corp マトリクス型画像表示装置
JP4690554B2 (ja) * 2001-01-11 2011-06-01 東芝モバイルディスプレイ株式会社 平面表示装置
JP4212791B2 (ja) 2000-08-09 2009-01-21 シャープ株式会社 液晶表示装置ならびに携帯電子機器
JP2002123228A (ja) * 2000-10-17 2002-04-26 Seiko Epson Corp 電気光学パネル、その駆動方法および電子機器
JP3643025B2 (ja) * 2000-10-20 2005-04-27 シャープ株式会社 アクティブマトリクス型表示装置およびその製造方法
JP2003050405A (ja) * 2000-11-15 2003-02-21 Matsushita Electric Ind Co Ltd 薄膜トランジスタアレイ、その製造方法およびそれを用いた表示パネル
JP2003017703A (ja) 2001-06-29 2003-01-17 Toshiba Corp 平面表示装置およびその製造方法
JP4439766B2 (ja) 2001-08-02 2010-03-24 シャープ株式会社 薄膜トランジスタ装置及びその製造方法
JP2003249631A (ja) * 2002-02-25 2003-09-05 Sony Corp 半導体基板の製造方法および半導体基板ならびに半導体装置
JP2003271108A (ja) * 2002-03-18 2003-09-25 Hitachi Ltd 液晶表示装置
JP2003284325A (ja) * 2002-03-20 2003-10-03 Sanyo Electric Co Ltd チャージポンプ回路およびチャージポンプ回路を備えた表示装置
JP2003282885A (ja) 2002-03-26 2003-10-03 Sharp Corp 半導体装置およびその製造方法
JP2003281897A (ja) * 2002-03-26 2003-10-03 Hitachi Ltd 不揮発性メモリ、半導体集積回路およびその製造方法
US7119365B2 (en) 2002-03-26 2006-10-10 Sharp Kabushiki Kaisha Semiconductor device and manufacturing method thereof, SOI substrate and display device using the same, and manufacturing method of the SOI substrate
US20030188426A1 (en) * 2002-04-05 2003-10-09 Display Research Laboratories, Inc. Method and system for fabricating and transferring microcircuits
JP3637911B2 (ja) * 2002-04-24 2005-04-13 セイコーエプソン株式会社 電子装置、電子機器、および電子装置の駆動方法
JP3984938B2 (ja) * 2002-09-02 2007-10-03 キヤノン株式会社 シフトレジスタ及び表示装置及び情報表示装置
JP2004146082A (ja) 2002-10-21 2004-05-20 Semiconductor Energy Lab Co Ltd 表示装置
JP4653659B2 (ja) * 2003-08-05 2011-03-16 東芝モバイルディスプレイ株式会社 自己発光表示装置の駆動方法
GB2410826A (en) * 2004-02-07 2005-08-10 Sharp Kk Active matrix liquid crystal display
JP5008823B2 (ja) * 2004-03-19 2012-08-22 シャープ株式会社 表示装置
US7183147B2 (en) * 2004-03-25 2007-02-27 Semiconductor Energy Laboratory Co., Ltd. Light emitting device, method for manufacturing thereof and electronic appliance
JP2006098536A (ja) * 2004-09-28 2006-04-13 Sharp Corp 液晶表示装置
US7863611B2 (en) 2004-11-10 2011-01-04 Canon Kabushiki Kaisha Integrated circuits utilizing amorphous oxides
JP5053537B2 (ja) 2004-11-10 2012-10-17 キヤノン株式会社 非晶質酸化物を利用した半導体デバイス
JP4560502B2 (ja) * 2005-09-06 2010-10-13 キヤノン株式会社 電界効果型トランジスタ
JP5078246B2 (ja) * 2005-09-29 2012-11-21 株式会社半導体エネルギー研究所 半導体装置、及び半導体装置の作製方法
US7982215B2 (en) 2005-10-05 2011-07-19 Idemitsu Kosan Co., Ltd. TFT substrate and method for manufacturing TFT substrate
KR100732849B1 (ko) * 2005-12-21 2007-06-27 삼성에스디아이 주식회사 유기 발광 표시장치
TWI292281B (en) * 2005-12-29 2008-01-01 Ind Tech Res Inst Pixel structure of active organic light emitting diode and method of fabricating the same
JP2007286150A (ja) * 2006-04-13 2007-11-01 Idemitsu Kosan Co Ltd 電気光学装置、並びに、電流制御用tft基板及びその製造方法
US8222076B2 (en) * 2006-08-02 2012-07-17 Xerox Corporation Fabricating amorphous zinc oxide semiconductor layer

Patent Citations (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000299469A (ja) * 1999-02-12 2000-10-24 Semiconductor Energy Lab Co Ltd 半導体装置およびその作製方法
US6777716B1 (en) * 1999-02-12 2004-08-17 Semiconductor Energy Laboratory Co., Ltd. Semiconductor display device and method of manufacturing therefor
JP2002333870A (ja) * 2000-10-31 2002-11-22 Matsushita Electric Ind Co Ltd 液晶表示装置、el表示装置及びその駆動方法、並びに副画素の表示パターン評価方法
JP2002287653A (ja) * 2001-01-19 2002-10-04 Sony Corp 表示装置およびその製造方法、ならびに携帯端末およびその製造方法
JP2002244153A (ja) * 2001-02-14 2002-08-28 Seiko Epson Corp 電気光学装置、その製造方法及び電子機器
US20040023444A1 (en) * 2002-07-09 2004-02-05 Semiconductor Energy Laboratory Co., Ltd. Method of manufacturing a semiconductor device
JP2004048029A (ja) * 2002-07-09 2004-02-12 Semiconductor Energy Lab Co Ltd 半導体装置の作製方法
JP2005049832A (ja) * 2003-07-14 2005-02-24 Semiconductor Energy Lab Co Ltd 液晶表示装置
JP2005166911A (ja) * 2003-12-02 2005-06-23 Seiko Epson Corp 半導体装置の製造方法、半導体装置、電気光学装置の製造方法、電気光学装置および電子機器
JP2005209851A (ja) * 2004-01-22 2005-08-04 Seiko Epson Corp 電気光学装置の製造方法および電気光学装置、電子機器
US20060244689A1 (en) * 2005-04-19 2006-11-02 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, display device and electronic apparatus
JP2006323370A (ja) * 2005-04-19 2006-11-30 Semiconductor Energy Lab Co Ltd 半導体装置、表示装置、及び電子機器
WO2006123584A1 (ja) * 2005-05-19 2006-11-23 Sharp Kabushiki Kaisha レベルシフタ、それを備えたシフトレジスタ、およびそれを備えた表示装置
US20070072439A1 (en) * 2005-09-29 2007-03-29 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
JP2007123861A (ja) * 2005-09-29 2007-05-17 Semiconductor Energy Lab Co Ltd 半導体装置及びその作製方法

Also Published As

Publication number Publication date
JP5568220B2 (ja) 2014-08-06
JP2022058429A (ja) 2022-04-12
JP2014170970A (ja) 2014-09-18
US20140334596A1 (en) 2014-11-13
JP6522189B2 (ja) 2019-05-29
US8803781B2 (en) 2014-08-12
US20080284710A1 (en) 2008-11-20
JP2009004757A (ja) 2009-01-08
JP2018129522A (ja) 2018-08-16
JP2019135790A (ja) 2019-08-15
JP5778832B2 (ja) 2015-09-16
JP2021064793A (ja) 2021-04-22

Similar Documents

Publication Publication Date Title
JP5778832B2 (ja) 半導体装置
US20240213276A1 (en) Semiconductor device
US20080284934A1 (en) Liquid crystal display device
JP5520437B2 (ja) 表示装置
US8431451B2 (en) Display device and method for manufacturing the same
JP2009008890A (ja) 表示装置及び電子機器

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20150710

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20160727

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20160802

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20160929

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20161013

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20170214

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20170801

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20170920

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20171226

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20180320

A761 Written withdrawal of application

Free format text: JAPANESE INTERMEDIATE CODE: A761

Effective date: 20180322