JP2015153811A - 半導体装置及びその製造方法 - Google Patents

半導体装置及びその製造方法 Download PDF

Info

Publication number
JP2015153811A
JP2015153811A JP2014024242A JP2014024242A JP2015153811A JP 2015153811 A JP2015153811 A JP 2015153811A JP 2014024242 A JP2014024242 A JP 2014024242A JP 2014024242 A JP2014024242 A JP 2014024242A JP 2015153811 A JP2015153811 A JP 2015153811A
Authority
JP
Japan
Prior art keywords
semiconductor chip
chip
underfill resin
semiconductor
resin material
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP2014024242A
Other languages
English (en)
Other versions
JP2015153811A5 (ja
JP6242231B2 (ja
Inventor
翔太 三木
Shota Miki
翔太 三木
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Shinko Electric Industries Co Ltd
Original Assignee
Shinko Electric Industries Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Shinko Electric Industries Co Ltd filed Critical Shinko Electric Industries Co Ltd
Priority to JP2014024242A priority Critical patent/JP6242231B2/ja
Priority to US14/567,056 priority patent/US9633978B2/en
Publication of JP2015153811A publication Critical patent/JP2015153811A/ja
Publication of JP2015153811A5 publication Critical patent/JP2015153811A5/ja
Application granted granted Critical
Publication of JP6242231B2 publication Critical patent/JP6242231B2/ja
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/065Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L25/0657Stacked arrangements of devices
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • H01L21/563Encapsulation of active face of flip-chip device, e.g. underfilling or underencapsulation of flip-chip, encapsulation preform on chip or mounting substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/50Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/36Assembling printed circuits with other printed circuits
    • H05K3/368Assembling printed circuits with other printed circuits parallel to each other
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/02Bonding areas; Manufacturing methods related thereto
    • H01L2224/04Structure, shape, material or disposition of the bonding areas prior to the connecting process
    • H01L2224/0401Bonding areas specifically adapted for bump connectors, e.g. under bump metallisation [UBM]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/1302Disposition
    • H01L2224/13022Disposition the bump connector being at least partially embedded in the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/1302Disposition
    • H01L2224/13024Disposition the bump connector being disposed on a redistribution layer on the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/1302Disposition
    • H01L2224/13025Disposition the bump connector being disposed on a via connection of the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • H01L2224/13001Core members of the bump connector
    • H01L2224/13075Plural core members
    • H01L2224/1308Plural core members being stacked
    • H01L2224/13082Two-layer arrangements
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L2224/14Structure, shape, material or disposition of the bump connectors prior to the connecting process of a plurality of bump connectors
    • H01L2224/141Disposition
    • H01L2224/1418Disposition being disposed on at least two different sides of the body, e.g. dual array
    • H01L2224/14181On opposite sides of the body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16135Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/16145Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • H01L2224/16146Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked the bump connector connecting to a via connection in the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16135Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/16145Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • H01L2224/16148Disposition the bump connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked the bump connector connecting to a bonding area protruding from the surface
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/16235Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a via metallisation of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/16238Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation the bump connector connecting to a bonding area protruding from the surface of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/17Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
    • H01L2224/171Disposition
    • H01L2224/1718Disposition being disposed on at least two different sides of the body, e.g. dual array
    • H01L2224/17181On opposite sides of the body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32135Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/32145Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32245Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73203Bump and layer connectors
    • H01L2224/73204Bump and layer connectors the bump connector being embedded into the layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73253Bump and layer connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/74Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies and for methods related thereto
    • H01L2224/75Apparatus for connecting with bump connectors or layer connectors
    • H01L2224/757Means for aligning
    • H01L2224/75743Suction holding means
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/81001Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector involving a temporary auxiliary member not forming part of the bonding apparatus
    • H01L2224/81005Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector involving a temporary auxiliary member not forming part of the bonding apparatus being a temporary or sacrificial substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/8119Arrangement of the bump connectors prior to mounting
    • H01L2224/81191Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed only on the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/8119Arrangement of the bump connectors prior to mounting
    • H01L2224/81193Arrangement of the bump connectors prior to mounting wherein the bump connectors are disposed on both the semiconductor or solid-state body and another item or body to be connected to the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • H01L2224/818Bonding techniques
    • H01L2224/81801Soldering or alloying
    • H01L2224/81815Reflow soldering
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/8319Arrangement of the layer connectors prior to mounting
    • H01L2224/83191Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L2224/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • H01L2224/8319Arrangement of the layer connectors prior to mounting
    • H01L2224/83192Arrangement of the layer connectors prior to mounting wherein the layer connectors are disposed only on another item or body to be connected to the semiconductor or solid-state body
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/91Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L2224/80 - H01L2224/90
    • H01L2224/92Specific sequence of method steps
    • H01L2224/921Connecting a surface with connectors of different types
    • H01L2224/9212Sequential connecting processes
    • H01L2224/92122Sequential connecting processes the first connecting process involving a bump connector
    • H01L2224/92125Sequential connecting processes the first connecting process involving a bump connector the second connecting process involving a layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/04All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
    • H01L2225/065All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/06503Stacked arrangements of devices
    • H01L2225/06513Bump or bump-like direct electrical connections between devices, e.g. flip-chip connection, solder bumps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/04All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
    • H01L2225/065All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/06503Stacked arrangements of devices
    • H01L2225/06517Bump or bump-like direct electrical connections from device to substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/04All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
    • H01L2225/065All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/06503Stacked arrangements of devices
    • H01L2225/06541Conductive via connections through the device, e.g. vertical interconnects, through silicon via [TSV]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/04All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers
    • H01L2225/065All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/06503Stacked arrangements of devices
    • H01L2225/06589Thermal management, e.g. cooling
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • H01L23/3107Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
    • H01L23/3121Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/34Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
    • H01L23/36Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
    • H01L23/367Cooling facilitated by shape of device
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/12Structure, shape, material or disposition of the bump connectors prior to the connecting process
    • H01L24/13Structure, shape, material or disposition of the bump connectors prior to the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L24/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L24/17Structure, shape, material or disposition of the bump connectors after the connecting process of a plurality of bump connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L24/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/73Means for bonding being of different types provided for in two or more of groups H01L24/10, H01L24/18, H01L24/26, H01L24/34, H01L24/42, H01L24/50, H01L24/63, H01L24/71
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/74Apparatus for manufacturing arrangements for connecting or disconnecting semiconductor or solid-state bodies
    • H01L24/75Apparatus for connecting with bump connectors or layer connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/83Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/91Methods for connecting semiconductor or solid state bodies including different methods provided for in two or more of groups H01L24/80 - H01L24/90
    • H01L24/92Specific sequence of method steps
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/102Material of the semiconductor or solid state bodies
    • H01L2924/1025Semiconducting materials
    • H01L2924/10251Elemental semiconductors, i.e. Group IV
    • H01L2924/10253Silicon [Si]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/14Integrated circuits
    • H01L2924/143Digital devices
    • H01L2924/1432Central processing unit [CPU]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/156Material
    • H01L2924/157Material with a principal constituent of the material being a metal or a metalloid, e.g. boron [B], silicon [Si], germanium [Ge], arsenic [As], antimony [Sb], tellurium [Te] and polonium [Po], and alloys thereof
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/04Assemblies of printed circuits
    • H05K2201/041Stacked PCBs, i.e. having neither an empty space nor mounted components in between
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/10Details of components or other objects attached to or integrated in a printed circuit board
    • H05K2201/10613Details of electrical connections of non-printed components, e.g. special leads
    • H05K2201/10954Other details of electrical connections
    • H05K2201/10977Encapsulated connections
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3431Leadless components
    • H05K3/3436Leadless components having an array of bottom contacts, e.g. pad grid array or ball grid array components

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Manufacturing & Machinery (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
  • Wire Bonding (AREA)

Abstract

【課題】配線基板の上に2つの半導体チップがフリップチップ接続によって積層され、それらの間にアンダーフィル樹脂が充填された半導体装置において、信頼性よくアンダーフィル樹脂を充填できる新規な構造を提供する。【解決手段】配線基板5と、配線基板5の上にフリップチップ接続された第1半導体チップ6と、配線基板5と第1半導体チップ6の間に充填され、かつ第1半導体チップ6の周囲に配置された台座部31を備えた第1アンダーフィル樹脂30と、第1半導体チップ6の上にフリップチップ接続され、第1半導体チップ6より面積が大きな第2半導体チップ7と、第1半導体チップ6と第2半導体チップ7の間に充填され、かつ第1アンダーフィル樹脂30の台座部31の上面及び第2半導体チップ7の側面を被覆する第2アンダーフィル樹脂32とを含む。【選択図】図19

Description

本発明は、半導体装置及びその製造方法に関する。
従来、配線基板の上に半導体チップがフリップチップ接続された半導体装置がある。そのような半導体装置では、さらなる実装の高密度化を図るため、配線基板の上に第1半導体チップをフリップチップ接続した後に、第1半導体チップの上に第2半導体チップをフリップチップ接続して積層する技術が開発されている。
特開2013−55313号公報
後述する予備的事項の欄で説明するように、配線基板の上に第1半導体チップ及び第2半導体チップが順にフリップチップ接続され、それらの間にアンダーフィル樹脂が充填された半導体装置がある。
そのような半導体装置では、上側の第2半導体チップが下側の第1半導体チップの面積よりも大きい場合は、第2半導体チップの側面をアンダーフィル樹脂で被覆することが困難であり、十分な信頼性が得られない課題がある。
配線基板の上に2つの半導体チップがフリップチップ接続によって積層され、それらの間にアンダーフィル樹脂が充填された半導体装置及びその製造方法において、信頼性よくアンダーフィル樹脂を形成できる新規な構造を提供することを目的とする。
以下の開示の一観点によれば、配線基板と、前記配線基板の上にフリップチップ接続された第1半導体チップと、前記配線基板と前記第1半導体チップの間に充填され、かつ前記第1半導体チップの周囲に配置された台座部を備えた第1アンダーフィル樹脂と、前記第1半導体チップの上にフリップチップ接続され、前記第1半導体チップより面積が大きな第2半導体チップと、前記第1半導体チップと前記第2半導体チップの間に充填され、かつ前記第1アンダーフィル樹脂の台座部の上面及び前記第2半導体チップの側面を被覆する第2アンダーフィル樹脂とを有する半導体装置が提供される。
また、その開示の他の観点によれば、配線基板の上に第1封止樹脂材を形成する工程と、前記第1封止樹脂材に第1半導体チップの電極を押し込んで前記配線基板にフリップチップ接続し、前記配線基板と前記第1半導体チップとの間に第1アンダーフィル樹脂を充填すると共に、前記第1半導体チップの周囲に前記第1アンダーフィル樹脂により台座部を形成する工程と、前記第1半導体チップの上に第2封止樹脂材を形成する工程と、前記第2封止樹脂材に第2半導体チップの電極を押し込んで前記第1半導体チップにフリップチップ接続し、前記第1半導体チップと前記第2半導体チップとの間に第2アンダーフィル樹脂を充填すると共に、前記第1アンダーフィル樹脂の台座部の上面及び第2半導体チップの側面を前記第2アンダーフィル樹脂で被覆する工程と有する半導体装置の製造方法が提供される。
以下の開示によれば、半導体装置では、配線基板の上に第1半導体チップと第2半導体チップが順にフリップチップ接続されている。配線基板と第1半導体チップとの間に第1アンダーフィル樹脂が充填されており、第1アンダーフィル樹脂は第1半導体チップの周囲に配置された台座部を備えている。
さらに、第2半導体チップは第1半導体チップよりも面積が大きく設定されている。このため、第1アンダーフィル樹脂の台座部の上面に第2アンダーフィル樹脂を延在させることにより、第2半導体チップの側面を第2アンダーフィル樹脂で確実に被覆することができる。
これにより、第2半導体チップの側面から内部の電子回路への水分の侵入が阻止され、信頼性を向上させることができる。
図1(a)及び(b)は予備的事項に係る半導体装置の製造方法を示す断面図(その1)である。 図2は予備的事項に係る半導体装置の製造方法を示す断面図(その2)である。 図3(a)及び(b)は予備的事項に係る半導体装置の製造方法を示す断面図(その3)である。 図4は予備的事項に係る半導体装置の製造方法を示す断面図(その4)である。 図5は予備的事項に係る半導体装置の製造方法を示す断面図(その5)である。 図6は実施形態の半導体装置の製造方法を示す断面図(その1)である。 図7は実施形態の半導体装置の製造方法を示す断面図(その2)である。 図8(a)〜(d)は実施形態の半導体装置の製造方法を示す断面図及び平面図(その3)である。 図9は実施形態の半導体装置の製造方法を示す断面図(その4)である。 図10は実施形態の半導体装置の製造方法を示す断面図(その5)である。 図11は実施形態の半導体装置の製造方法を示す断面図(その6)である。 図12は実施形態の半導体装置の製造方法を示す断面図(その7)である。 図13は実施形態の半導体装置の製造方法を示す断面図(その8)である。 図14は実施形態の半導体装置の製造方法を示す断面図(その9)である。 図15は実施形態の半導体装置の製造方法を示す断面図(その10)である。 図16は実施形態の半導体装置の製造方法を示す断面図(その11)である。 図17は実施形態の半導体装置の製造方法を示す断面図(その12)である。 図18は実施形態の半導体装置の製造方法を示す断面図(その13)である。 図19は実施形態の半導体装置を示す断面図(その1)である。 図20は実施形態の半導体装置を示す断面図(その2)である。
以下、実施の形態について、添付の図面を参照して説明する。
実施形態を説明する前に、基礎となる予備的事項について説明する。
予備的事項に係る半導体装置の製造方法では、図1(a)に示すように、まず、上面に接続パッドPを備えた配線基板100を用意する。
次いで、図1(b)に示すように、配線基板100の上に先封止用の未硬化の封止樹脂材200aを形成する。さらに、図2に示すように、第1半導体チップ300を用意する。
第1半導体チップ300は素子形成面側にバンプ電極320を備え、背面側に接続電極340を備えている。半導体チップ300のバンプ電極320と接続電極340とは、不図示の貫通電極を介して接続されている。
そして、図2に図3(a)を加えて参照すると、第1半導体チップ300のバンプ電極320を封止樹脂材200aに押し込み、配線基板100の接続パッドPに圧接させる。
さらに、加熱処理することにより、第1半導体チップ300のバンプ電極320の先端のはんだ(不図示)をリフローさせて、第1半導体チップ300のバンプ電極320を配線基板100の接続パッドPにフリップチップ接続する。
これにより、第1半導体チップ300と配線基板100との間に封止樹脂材200aから形成されるアンダーフィル樹脂200が充填される。アンダーフィル樹脂200は、第1半導体チップ300の側面を被覆して形成される。
さらに、図3(b)に示すように、第1半導体チップ300の上に封止樹脂材220aを形成する。続いて、図4に示すように、素子形成面側にバンプ電極420を備えた第2半導体チップ400を用意する。第2半導体チップ400の面積は、第1半導体チップ300の面積よりも一回り大きく設定されている。
そして、図4に図5を加えて参照すると、第2半導体チップ400のバンプ電極420を封止樹脂材220aに押し込み、第1半導体チップ300の接続電極340に圧接させる。
さらに、加熱処理することにより、第2半導体チップ400のバンプ電極420の先端のはんだ(不図示)をリフローさせて、第2半導体チップ400のバンプ電極420を第1半導体チップ300の接続電極340にフリップチップ接続する。
これにより、第2半導体チップ400と第1半導体チップ300との間、及び第2半導体チップ400と配線基板100との間に、封止樹脂材220aから形成されるアンダーフィル樹脂220が充填される。
このとき、図5に示すように、第2半導体チップ400の面積は第1半導体チップ300の面積よりも大きく設定されている。このため、第1半導体チップ300上の封止樹脂材220aは第2半導体チップ400の側面まで流動できずに、第2半導体チップ400の下面に留まった状態となる。
従って、第2半導体チップ400の側面の全体が大気に露出した状態となる。また、第2半導体チップ400の素子形成面の外周部も露出した状態となる。このため、図5の構造の半導体装置では、第2半導体チップ400の素子形成領域の側面から内部に水分が侵入し、特性劣化及び故障などを引き起こしやすくなり、信頼性を確保できなくなる。
以下に説明する実施形態の半導体装置では、上側の第2半導体チップの面積が下側の第1半導体チップの面積よりも大きい場合であっても、第2半導体チップの側面をアンダーフィル樹脂で確実に被覆して信頼性を確保することができる。
(実施形態)
図6〜図18は実施形態の半導体装置の製造方法を示す図、図19及び図20は実施形態の半導体装置を示す図である。以下、半導体装置の製造方法を説明しながら、半導体装置の構造について説明する。
実施形態の配線基板の製造方法では、まず、図6に示すような配線基板5を用意する。配線基板5は、厚み方向の中央部にコア基板10を備えている。コア基板10はガラスエポキシ樹脂などの絶縁材料から形成される。
コア基板10の両面側に銅又は銅合金からなる第1配線層20がそれぞれ形成されている。コア基板10には厚み方向に貫通するスルーホールTHが形成されている。スルーホールTHの内壁にはスルーホールめっき層21が形成されており、スルーホールTHの残りの孔には樹脂体Rが充填されている。あるいは、コア基板10のスルーホールTHの全体に貫通電極が充填された構造を採用してもよい。
コア基板10の両面側の第1配線層20はスルーホールめっき層21を介して相互接続されている。コア基板10の両面側には、第1配線層20の接続部上にビアホールVHが配置された層間絶縁層12がそれぞれ形成されている。層間絶縁層12は、エポキシ樹脂又はポリイミド樹脂などの絶縁性樹脂から形成される。
また、両面側の層間絶縁層12の上には、ビアホールVHを介して第1配線層20に接続される第2配線層22がそれぞれ形成されている。第2配線層22は銅又は銅合金から形成される。
さらに、両面側の層間絶縁層12の上には、第2配線層22の接続部上に開口部14aが配置されたソルダレジスト層14がそれぞれ形成されている。ソルダレジスト層14は、ポリイミド樹脂又はアクリル樹脂などの絶縁性樹脂から形成される。
そして、コア基板10の上面側の第2配線層22の接続部に、ニッケル/金めっき層、又ははんだ層などの接続電極CEが形成されている。
そして、配線基板5に対して、温度:125℃程度で加熱処理することにより、水分を飛ばして乾燥させる。さらに、アルゴンプラズマで配線基板5の上面を処理することにより、濡れ性を向上させる。これにより、先封止用の封止樹脂材を形成するための前処理が完了する。
次いで、図7に示すように、配線基板5の上に先封止用の第1封止樹脂材30aを形成する。第1封止樹脂材30aの好適な一例としては、最低溶融粘度が300Pa・sのエポキシ系樹脂、又は最低溶融粘度が20Pa・s〜90Pa・sのアクリル系樹脂が使用される。
配線基板5には複数のチップ搭載領域が画定されており、図7では1つのチップ搭載領域が示されている。配線基板5の上に第1封止樹脂材30aを形成する具体例としては、まず、図8(a)に示すように、配線基板5の各チップ搭載領域の上に開口部24aが設けられたマスキングテープ24を貼付する。
図8(b)の平面図に示すように、マスキングテープ24の開口部24aは、四角形の各辺の中央が外側に延びた八角形の形状で形成される。
次いで、図8(c)に示すように、マスキングテープ24が貼付された配線基板5の上に未硬化の樹脂シート30xを押圧して貼り付ける。さらに、図8(d)に示すように、マスキングテープ24を配線基板5から引き剥がす。
これにより、マスキングテープ24の上に配置された部分の樹脂シート30xがマスキングテープ24と同時に除去される。その結果、マスキングテープ24の複数の開口部24aに配置された部分の樹脂シート30xが第1封止樹脂材30aとして配線基板5の上に残される。
このようにして、配線基板5の複数のチップ搭載領域に樹脂シート30xがそれぞれ分離されて配置され、第1封止樹脂材30aが島状に並んで形成される。第1封止樹脂材30aは、マスキングテープ24の開口部24aの形状に対応して八角形の形状で形成される。第1封止樹脂材30aを八角形の形状で形成する理由は、後述する第2封止樹脂材の変形に対応させるためである。
なお、樹脂シート30xを貼付する代わりに、ディスペンサなどによって液状樹脂を配線基板5の複数のチップ搭載領域に塗布してもよい。液状樹脂を使用する場合は、マスキングテープ24を必ずしも貼付する必要はない。
続いて、図9に示すように、第1半導体チップ6を用意する。第1半導体チップ6は、例えば、シリコン基板を使用するCPUチップである。
第1半導体チップ6では、シリコンからなるチップ基板40にその厚み方向に貫通するスルーホールTHが形成されている。また、スルーホールTHの内面及びチップ基板40の上面及び下面に絶縁層41が形成されている。
絶縁層41としては、シリコン酸化層(SiO2層)、シリコン窒化層(SiN層)及びポリイミド層などから選択される。そして、スルーホールTH内に銅又は銅合金からなる貫通電極42が充填されている。
貫通電極42の上端にはニッケル/金めっき層、又ははんだ層などの接続電極CExが形成されている。
また、チップ基板40の下面には貫通電極42の下端に接続される配線層44が形成されている。配線層44は、アルミニウム又は銅、あるいは、それらの合金から形成される。さらに、チップ基板40の下面に配線層44の接続部上に開口部45aが設けられたパッシベーション膜45が形成されている。
パッシベーション膜45は、シリコン酸化層、シリコン窒化層、又はポリイミド樹脂などから形成される。
配線層44の接続部には柱状電極PEが立設しており、柱状電極PEの先端に丸まったバンプ状のはんだ層46が形成されている。柱状電極PEは、例えば、銅又は銅合金からなる。また、第1半導体チップ6の柱状電極PEの配列ピッチは、例えば80μm〜100μmである。
このようにして、第1半導体チップ6の下面側の柱状電極PEが配線層44、貫通電極42を介して上面側の接続電極CExに電気的に接続されて、上下面側が導通可能な構造となっている。
第1半導体チップ6の下面側が素子形成面となっており、素子形成面には、不図示のトランジスタ、キャパシタ及び抵抗などの各種の素子が形成されており、それらが多層配線に接続されて電子回路が作り込まれている。
そして、第1半導体チップ6内の電子回路が配線層44を介して柱状電極PEに接続されている。
前述した図7の第1封止樹脂材30aの面積は、第1半導体チップ6の面積より大きく設定されている。例えば、第1封止樹脂材30aの面積は9mm×9mm程度であり、第1半導体チップ6の面積は6mm×6mm程度である。
次いで、図10に示すように、図7の第1封止樹脂材30aが形成された配線基板5をボンディングステージ(不図示)の上に配置し、配線基板5を100℃程度に加熱して第1封止樹脂材30aを軟化させた状態とする。
そして、前述した図9の第1半導体チップ6の背面をボンディングツール16に吸着固定させる。ボンディングツール16の面積は、第1半導体チップ6の面積より大きく設定されており、配線基板5上の第1封止樹脂材30aの面積とほぼ同一である。このため、ボンディングツール16の周縁部16aが第1半導体チップ6の側面から外側にはみ出して露出した状態となる。
続いて、ボンディングツール16に吸着固定した第1半導体チップ6の柱状電極PEを配線基板5上の第1封止樹脂材30aに押し込む。これにより、図11に示すように、第1半導体チップ6の柱状電極PEをはんだ層46を介して配線基板5の接続電極CEに圧接させてフリップチップ実装する。
続いて、リフロー加熱することにより、はんだ層46を溶融させて第1半導体チップ6の柱状電極PEを配線基板5の接続電極CEにはんだ層46によって接合する。
さらに、第1封止樹脂材30aがエポキシ樹脂からなる場合は、温度:180℃、処理時間:1時間の条件で加熱処理して第1封止樹脂材30aを硬化させる。これにより、第1半導体チップ6と配線基板5との間に第1アンダーフィル樹脂30が充填される。
このとき、第1半導体チップ6の外側に配置された第1封止樹脂材30aがボンディングツール16の周縁部16aによって押圧されて成型される。その後に、ボンディングツール16を第1半導体チップ6から取り外す。
これにより、図12に示すように、第1半導体チップ6を取り囲む周囲の領域に、第1半導体チップ6と配線基板5との間の第1アンダーフィル樹脂30が延在して形成された環状の台座部31が形成される。そして、第1アンダーフィル樹脂30の台座部31の上面は第1半導体チップ6の上面と同一面となる。
このようにして、第1アンダーフィル樹脂30のフィレット部分に多くの樹脂が配置されるようにし、フィレット部分を成型することにより、第1半導体チップ6の周囲に第1アンダーフィル樹脂30の台座部31を配置する。
台座部31を含む第1アンダーフィル樹脂30の面積は、12mm×12mm程度である。
次いで、図13に示すように、図12の構造体の第1半導体チップ6の上に第2封止樹脂材32aを形成する。第2封止樹脂材32aは、前述した第1封止樹脂材30aの形成方法と同様な方法で形成される。
第2封止樹脂材32aの好適な一例としては、最低溶融粘度が10Pa・s〜90Pa・s、好適には30Pa・s〜50Pa・sのエポキシ系樹脂、又は最低溶融粘度が20Pa・s〜90Pa・sのアクリル系樹脂が使用される。
このように、第2封止樹脂32aとしては、最低溶融粘度の数値が二桁のものが好ましく、エポキシ系樹脂を使用する場合は、前述した第1封止樹脂材30aよりも最低溶融粘度が低い樹脂材が使用される。
第2封止樹脂材32aとして溶融粘度の低い樹脂を使用する理由は、以下の通りである。後述するように第2半導体チップの狭ピッチの柱状電極を低い荷重で第2封止樹脂32aに押し込んでフリップチップ接続する際に、接続部分への樹脂やフィラーの噛み込みの発生を防止するためである。
次いで、図14に示すように、第1半導体チップ6の上に積層される第2半導体チップ7を用意する。第2半導体チップ7は、例えば、シリコン基板を使用するメモリチップである。第2半導体チップ7の面積は第1半導体チップ6の面積より大きく設定されている。前述した図13の第2封止樹脂材32aの面積は、第2半導体チップ7の面積に対応するように設定される。
また、第2半導体チップ7の面積は台座部31を含む第1アンダーフィル樹脂30の面積よりも小さく設定されている。
第2半導体チップ7では、シリコンからなるチップ基板50の下面側の素子形成面に接続パッドPが形成されている。第2半導体チップ7は、第1半導体チップ6と同様に素子形成面に電子回路が作り込まれており、接続パッドPが電子回路に接続されている。
また、素子形成面側に最外層として、接続パッドPの上に開口部52aが配置されたパッシベーション膜52が形成されている。パッシベーション膜52は、シリコン酸化層、シリコン窒化層、又はポリイミド樹脂などから形成される。
さらに、接続パッドPにはパッシベーション膜52から外側に立設する柱状電極PExが接続されており、柱状電極PExの先端にはんだ層54が形成されている。柱状電極PExは、例えば、銅又は銅合金から形成される。
第2半導体チップ7の柱状電極PExの配列ピッチは例えば40μm程度であり、第1半導体チップ6の柱状電極PEよりも狭ピッチ化されている。
そして、図15に示すように、図14の第2半導体チップ7の背面をボンディングツール16に吸着固定させる。続いて、ボンディングツール16に吸着固定した第2半導体チップ7の柱状電極PExを第1半導体チップ6上の第2封止樹脂材32aに押し込む。
これにより、図16に示すように、第2半導体チップ7の柱状電極PExをはんだ層54を介して第1半導体チップ6の接続電極CExに圧接させてフリップチップ実装する。
続いて、リフロー加熱することにより、はんだ層54を溶融させて第2半導体チップ7の柱状電極PExを第1半導体チップ6の接続電極CExにはんだ層54によって接合する。
その後に、第2封止樹脂材32aがエポキシ樹脂からなる場合は、温度:165℃、処理時間:2時間の条件で加熱処理して,第2封止樹脂材32aを硬化させる。これにより、第2半導体チップ7と、第1半導体チップ6及び第1アンダーフィル樹脂30との間に第2アンダーフィル樹脂32が充填される。
このとき、第2半導体チップ7を第2封止樹脂材32aに押し込む際に、第2封止樹脂材32aは第1アンダーフィル樹脂30の台座部31の上に流動しながら第2半導体チップ7の側面を被覆する。
これにより、第2半導体チップ7の面積が第1半導体チップ6の面積よりも大きい場合であっても、第2半導体チップ7の側面を第2アンダーフィル樹脂32で確実に封止することができる。
前述したように、第2半導体チップ7の柱状電極PExの配列ピッチは、第1半導体チップ6の柱状電極PEと比較してかなり狭く設定され、第1半導体チップ6との間隔も狭くなる。
しかも、第2半導体チップ7をフリップチップ接続する際に、第1半導体チップ6へのダメージを低減させるため、第2半導体チップ7に印加する荷重を低くする必要がある。
このため、第2封止樹脂材32aの溶融粘度が高い場合は、第1半導体チップ6の接続電極CExと第2半導体チップ7の柱状電極PExとの間に樹脂やフィラーの噛み込みが発生する懸念がある。
そこで、本願発明者は、第2封止樹脂材32aとして、最低溶融粘度が100Pa・s以上(300Pa.s)のエポキシ樹脂材と、最低溶融粘度が100Pa・s未満(50Pa・s)のエポキシ樹脂材とを振り分けて実験を行った。そして、両者の樹脂材において、第1半導体チップ6の接続電極CExと第2半導体チップ7の柱状電極PExとの接合の様子をSEM(走査電子顕微鏡)にて観察した。
その結果によれば、最低溶融粘度が100Pa・s以上(300Pa.s)の粘度が高いエポキシ樹脂材では、第2半導体チップ7の柱状電極PExの先端のはんだ層54と第1半導体チップ6の接続電極CExとの間に樹脂やフィラーが残る噛み込みが発生しており、電気接続の信頼性が得られないことが分かった。
これに対して、最低溶融粘度が100Pa・s未満(50Pa・s)の粘度が低いエポキシ樹脂材では、第2半導体チップ7の柱状電極PExの先端のはんだ層54と第1半導体チップ6の接続電極CExとの間に樹脂は確認されず、良好な接合が得られることが確認された。
このように、狭ピッチの柱状電極PExを備えた第2半導チップ7を先封止技術で第1半導体チップ6に低い荷重でフリップチップ接続する際には、溶融粘度の低い樹脂材を使用することが有効であることが確認された。
また、第2半導体チップ7は比較的面積が大きいことから、平面視して四角状の第2封止樹脂材32aに第2半導体チップ7を押し込む際に、第2封止樹脂材32aの4つの角部よりも各辺の中央が外側に延びて、より顕著な八角状の形状になりやすい。
このため、前述した図8で説明したように、第1封止樹脂材30aは、第2封止樹脂材32aの変形に対応できるように、平面視して八角形の形状で形成される。
これにより、第2アンダーフィル樹脂32が第1アンダーフィル樹脂30の側面に流れて形成されることが防止される。第1アンダーフィル樹脂30の側面に第2アンダーフィル樹脂32が流れて形成されると膜剥がれなどが発生して信頼性が低下するため、第1アンダーフィル樹脂30の側面に第2アンダーフィル樹脂32が流れ込まないようにする。
その後に、図17に示すように、第2半導体チップ7からボンディングツール16を取り外す。
あるいは、図18に示すように、前述したような先封止技術を使用しないで、第1半導体チップ6の接続電極CExに第2半導体チップ7の柱状電極PExをフリップチップ接続した後に、それらの隙間に第2アンダーフィル樹脂32を充填してもよい。
この場合は、第1アンダーフィル樹脂30の台座部31の上にディスペンサ18から樹脂を塗布できるので、図17と同様に第2半導体チップ7の側面を第2アンダーフィル樹脂32で確実に封止することができる。
次いで、図19に示すように、配線基板5及び第2半導体チップ7の上にモールド樹脂34を形成して、第1、第2アンダーフィル樹脂30、32の側面から第2半導体チップ7の上面までを樹脂封止する。
なお、第1、第2アンダーフィル樹脂30、32によって第1、第2半導体チップ6,7が十分に保護される場合は、モールド樹脂34を省略してもよい。
さらに、配線基板5の下面側の第2配線層22の接続部にはんだボールを搭載するなどして外部接続端子Tを形成する。その後に、第1半導体チップ6及び第2半導体チップ7が積層された各チップ搭載領域が得られるように、配線基板5を切断する。
以上により、実施形態の半導体装置1が製造される。
図19に示すように、実施形態の半導体装置1では、前述した図6の配線基板5の上面側の接続電極CEに前述した図9の第1半導体チップ6の柱状電極PEがはんだ層46を介してフリップチップ接続されている。
第1半導体チップ6と配線基板5との間には第1アンダーフィル樹脂30が充填されている。第1アンダーフィル樹脂30は、第1半導体チップ6と配線基板5との間の領域から第1半導体チップ6の周囲の領域に延在する環状の台座部31を備えて形成されている。
さらに、第1半導体チップ6の上面側の接続電極CExには、前述した図14の第2半導体チップ7の柱状電極PExがはんだ層54を介してフリップチップ接続されている。また、第1半導体チップ6と第2半導体チップ7との間に第2アンダーフィル樹脂32が充填されている。
第2アンダーフィル樹脂32は、第1半導体チップ6と第2半導体チップ7との間の領域から第1アンダーフィル樹脂30の台座部31の上に延在し、第2半導体チップ7の側面を封止している。
第2半導体チップ7の下面側の素子形成領域の側面が少なくとも第2アンダーフィル樹脂32で封止されていればよく、第2半導体チップ7の背面側に近い側面は露出していてもよい。
第2半導体チップ7の面積は第1半導体チップ6の面積よりも大きく設定されている。しかし、第1半導体チップ6の周囲に第1アンダーフィル樹脂30の台座部31が配置され、第2半導体チップ7の側面は、第1半導体チップ6の側面と第1アンダーフィル樹脂30の台座部31の側面との間の領域に配置されている。
このため、台座部31上に配置された第2封止樹脂材32aから形成される第2アンダーフィル樹脂32によって第2半導体チップ7の側面を確実に封止することができる。
あるいは、第1アンダーフィル樹脂30の台座部31をさらに外側に延ばし、第2封止樹脂材32aを厚くすることにより、第2半導体チップ7の側面の全体を第2アンダーフィル樹脂32で封止することも可能である。
このように、本実施形態の半導体装置1は、第1半導体チップ6の周囲に第1アンダーフィル樹脂30の台座部31を配置している。このため、第1半導体チップ6の上にそれより面積が大きな第2半導体チップ7がフリップチップ接続されるとしても、第1アンダーフィル樹脂30の台座部31の上に第2アンダーフィル樹脂32を配置することができる。
これにより、第1半導体チップ6の側面より外側に配置される第2半導体チップ7の側面を第2アンダーフィル樹脂32で封止することが可能になる。
その結果、第2半導体チップ7の素子形成領域の側面を第2アンダーフィル樹脂32で確実に封止することができる。よって、第2半導体チップ7の電子回路への水分の侵入が阻止され、特性劣化及び故障などの不具合の発生が防止される。
図20には、実施形態の変形例の半導体装置1aが示されている。図20の変形例の半導体装置1aでは、前述した図17の第2半導体チップ7の背面(上面)が露出するようにモールド樹脂34が第1、第2アンダーフィル樹脂30,32及び第2半導体チップ7の周囲に形成されている。
さらに、第2半導体チップ7の上面及びモールド樹脂34の上面に接着層36を介して放熱部材60が接着されている。接着層36として、TIM(Thermal Interface Material)と呼ばれるような熱伝導性に優れた樹脂による接着剤が使用される。
これにより、第2半導体チップ7の背面に放熱部材60が接続されて、放熱性に優れた半導体装置となる。放熱部材60としては、銅などからなるヒートスプレッダ、放熱フィンを備えたヒートシンク、又はヒートパイプなどを使用することができる。
(その他の形態)
前述した実施形態では、配線基板5の上に第1半導体チップ6及び第2半導体チップ7を順にフリップチップ接続して積層している。この形態の他に、配線基板5の代わりに、半導体チップを採用し、3つの半導体チップを積層して同様な構成としてもよい。
あるいは、第1半導体チップ6の代わりに、シリコンインターポーザなどの他の配線基板を採用し、配線基板の上に他の配線基板及び半導体チップを積層して同様な構成としてもよい。
さらには、第1半導体チップ5及び第2半導体チップの代わりに、各種の配線基板を採用し、3つの配線基板を積層して同様な構成としてもよい。
1,1a…半導体装置、5…配線基板、6…第1半導体チップ、7…第2半導体チップ、10…コア基板、12…層間絶縁層、14…ソルダレジスト層、14a,24a,45a…開口部、16…ボンディングツール、16a…周縁部、20…第1配線層、21…スルーホールめっき層、22…第2配線層、24…マスキングテープ、30…第1アンダーフィル樹脂、31…台座部、30a…第1封止樹脂材、30x…樹脂シート、32…第2アンダーフィル樹脂、32a…第2封止樹脂材、34…モールド樹脂、36…接着層、40,50…チップ基板、41…絶縁層、42…貫通電極、44…配線層、45,52…パッシベーション膜、46,54…はんだ層、60…放熱部材、CE,CEx…接続電極、P…接続パッド、PE,PEx…柱状電極、R…樹脂体,TH…スルーホール、VH…ビアホール。

Claims (8)

  1. 配線基板と、
    前記配線基板の上にフリップチップ接続された第1半導体チップと、
    前記配線基板と前記第1半導体チップの間に充填され、かつ前記第1半導体チップの周囲に配置された台座部を備えた第1アンダーフィル樹脂と、
    前記第1半導体チップの上にフリップチップ接続され、前記第1半導体チップより面積が大きな第2半導体チップと、
    前記第1半導体チップと前記第2半導体チップの間に充填され、かつ前記第1アンダーフィル樹脂の台座部の上面及び前記第2半導体チップの側面を被覆する第2アンダーフィル樹脂と
    を有することを特徴とする半導体装置。
  2. 前記第2半導体チップの側面は、前記第1半導体チップの側面と前記第1アンダーフィル樹脂の台座部の側面との間の領域に配置されていることを特徴とする請求項1に記載の半導体装置。
  3. 前記第1半導体チップの上面と前記1のアンダーフィル樹脂の台座部の上面とは、同一面となっていることを特徴とする請求項1又は2に記載の半導体装置。
  4. 配線基板の上に第1封止樹脂材を形成する工程と、
    前記第1封止樹脂材に第1半導体チップの電極を押し込んで前記配線基板にフリップチップ接続し、前記配線基板と前記第1半導体チップとの間に第1アンダーフィル樹脂を充填すると共に、前記第1半導体チップの周囲に前記第1アンダーフィル樹脂により台座部を形成する工程と、
    前記第1半導体チップの上に第2封止樹脂材を形成する工程と、
    前記第2封止樹脂材に第2半導体チップの電極を押し込んで前記第1半導体チップにフリップチップ接続し、前記第1半導体チップと前記第2半導体チップとの間に第2アンダーフィル樹脂を充填すると共に、前記第1アンダーフィル樹脂の台座部の上面及び第2半導体チップの側面を前記第2アンダーフィル樹脂で被覆する工程と
    有することを特徴とする半導体装置の製造方法。
  5. 配線基板の上に封止樹脂材を形成する工程と、
    前記封止樹脂材に第1半導体チップの電極を押し込んで前記配線基板にフリップチップ接続し、前記配線基板と前記第1半導体チップとの間に第1アンダーフィル樹脂を充填すると共に、前記第1半導体チップの周囲に前記第1アンダーフィル樹脂により台座部を形成する工程と、
    前記第1半導体チップの上に第2半導体チップをフリップチップ接続する工程と、
    前記第1半導体チップと前記第2半導体チップとの間に第2アンダーフィル樹脂を充填すると共に、前記第1アンダーフィル樹脂の台座部の上面及び第2半導体チップの側面を前記第2アンダーフィル樹脂で被覆する工程と
    有することを特徴とする半導体装置の製造方法。
  6. 前記第1アンダーフィル樹脂を充填する工程において、
    前記第1半導体チップは、前記第1半導体チップよりも面積が大きなボンディングツールに固定された状態で前記第1封止樹脂材に押し込まれ、
    前記ボンディングツールの周縁部の下面で前記第1封止樹脂材の周縁部が押圧されて前記台座部が形成され、前記台座部の上面と前記第1半導体チップの上面とが同一面となることを特徴とする請求項4又は5に記載の半導体装置の製造方法。
  7. 前記第2アンダーフィル樹脂は、前記第1アンダーフィル樹脂よりも溶融粘度が低い樹脂材から形成されることを特徴とする請求項4に記載の半導体装置の製造方法。
  8. 前記第1半導体チップの上に前記第2半導体チップをフリップチップ接続する工程において、前記第2半導体チップの側面は、前記第1半導体チップの側面と前記第1アンダーフィル樹脂の台座部の側面との間の領域に配置されることを特徴とする請求項4乃至7のいずれか一項に記載の半導体装置の製造方法。
JP2014024242A 2014-02-12 2014-02-12 半導体装置及びその製造方法 Active JP6242231B2 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP2014024242A JP6242231B2 (ja) 2014-02-12 2014-02-12 半導体装置及びその製造方法
US14/567,056 US9633978B2 (en) 2014-02-12 2014-12-11 Semiconductor device and method of manufacturing the same

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2014024242A JP6242231B2 (ja) 2014-02-12 2014-02-12 半導体装置及びその製造方法

Publications (3)

Publication Number Publication Date
JP2015153811A true JP2015153811A (ja) 2015-08-24
JP2015153811A5 JP2015153811A5 (ja) 2016-11-24
JP6242231B2 JP6242231B2 (ja) 2017-12-06

Family

ID=53775605

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2014024242A Active JP6242231B2 (ja) 2014-02-12 2014-02-12 半導体装置及びその製造方法

Country Status (2)

Country Link
US (1) US9633978B2 (ja)
JP (1) JP6242231B2 (ja)

Families Citing this family (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
TWI566305B (zh) * 2014-10-29 2017-01-11 巨擘科技股份有限公司 製造三維積體電路的方法
KR102356810B1 (ko) * 2015-01-22 2022-01-28 삼성전기주식회사 전자부품내장형 인쇄회로기판 및 그 제조방법
JP6478853B2 (ja) * 2015-07-14 2019-03-06 新光電気工業株式会社 電子部品装置及びその製造方法
JP6489965B2 (ja) * 2015-07-14 2019-03-27 新光電気工業株式会社 電子部品装置及びその製造方法
US10957672B2 (en) * 2017-11-13 2021-03-23 Taiwan Semiconductor Manufacturing Company, Ltd. Package structure and method of manufacturing the same
US11075133B2 (en) * 2018-06-29 2021-07-27 Taiwan Semiconductor Manufacturing Company, Ltd. Underfill structure for semiconductor packages and methods of forming the same
JP2020047793A (ja) * 2018-09-19 2020-03-26 株式会社東芝 半導体装置の製造方法
JP2022002261A (ja) * 2020-06-22 2022-01-06 キオクシア株式会社 ストレージ装置

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002184936A (ja) * 2000-12-11 2002-06-28 Matsushita Electric Ind Co Ltd 半導体装置およびその製造方法
JP2003258034A (ja) * 2002-03-06 2003-09-12 Mitsubishi Electric Corp 多層配線基体の製造方法および多層配線基体
JP2011054851A (ja) * 2009-09-03 2011-03-17 Toshiba Corp 半導体装置の製造方法
JP2011061004A (ja) * 2009-09-10 2011-03-24 Elpida Memory Inc 半導体装置及びその製造方法
JP2015122445A (ja) * 2013-12-24 2015-07-02 ルネサスエレクトロニクス株式会社 半導体装置およびその製造方法

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3683179B2 (ja) * 2000-12-26 2005-08-17 松下電器産業株式会社 半導体装置及びその製造方法
KR101719636B1 (ko) * 2011-01-28 2017-04-05 삼성전자 주식회사 반도체 장치 및 그 제조 방법
JP5357241B2 (ja) 2011-08-10 2013-12-04 新光電気工業株式会社 半導体装置及び半導体装置の製造方法
JP2013115190A (ja) * 2011-11-28 2013-06-10 Elpida Memory Inc 半導体装置の製造方法
JP2013138177A (ja) * 2011-11-28 2013-07-11 Elpida Memory Inc 半導体装置の製造方法

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002184936A (ja) * 2000-12-11 2002-06-28 Matsushita Electric Ind Co Ltd 半導体装置およびその製造方法
JP2003258034A (ja) * 2002-03-06 2003-09-12 Mitsubishi Electric Corp 多層配線基体の製造方法および多層配線基体
JP2011054851A (ja) * 2009-09-03 2011-03-17 Toshiba Corp 半導体装置の製造方法
JP2011061004A (ja) * 2009-09-10 2011-03-24 Elpida Memory Inc 半導体装置及びその製造方法
JP2015122445A (ja) * 2013-12-24 2015-07-02 ルネサスエレクトロニクス株式会社 半導体装置およびその製造方法

Also Published As

Publication number Publication date
US20150228624A1 (en) 2015-08-13
US9633978B2 (en) 2017-04-25
JP6242231B2 (ja) 2017-12-06

Similar Documents

Publication Publication Date Title
JP6242231B2 (ja) 半導体装置及びその製造方法
JP5579402B2 (ja) 半導体装置及びその製造方法並びに電子装置
TWI508255B (zh) 散熱型覆晶封裝構造
US9691676B2 (en) Semiconductor device and method for manufacturing the same
US9698072B2 (en) Low-stress dual underfill packaging
TWI413223B (zh) 嵌埋有半導體元件之封裝基板及其製法
JP6478853B2 (ja) 電子部品装置及びその製造方法
TW201501248A (zh) 功率覆蓋結構及其製造方法
JP2014049476A (ja) 電子部品内蔵基板及び電子部品内蔵基板の製造方法
TWI724744B (zh) 半導體裝置及半導體裝置之製造方法
JP6489965B2 (ja) 電子部品装置及びその製造方法
JP2012069903A (ja) 半導体装置及びその製造方法
US20120146242A1 (en) Semiconductor device and method of fabricating the same
JP2013021058A (ja) 半導体装置の製造方法
TW201448139A (zh) 嵌埋式基板封裝構造及其製造方法
TWI688067B (zh) 半導體裝置及其製造方法
US20130277828A1 (en) Methods and Apparatus for bump-on-trace Chip Packaging
US10115693B2 (en) Solder layer of a semiconductor chip arranged within recesses
TWI576979B (zh) 封裝基板及其製造方法
TWI631684B (zh) 中介基板及其製法
TWI591788B (zh) 電子封裝件之製法
TWI814524B (zh) 電子封裝件及其製法與電子結構及其製法
TWI541952B (zh) 半導體封裝件及其製法
TWI529881B (zh) The structure and method of composite carrier board for chip - scale wafer - level package
WO2014171403A1 (ja) 半導体装置

Legal Events

Date Code Title Description
A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20161004

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20161004

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20170612

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20170725

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20170906

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20171031

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20171107

R150 Certificate of patent or registration of utility model

Ref document number: 6242231

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150