JP2013251671A - 半導体装置 - Google Patents
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Abstract
【解決手段】本半導体装置(10(20))は、第1外部端子(LDD、(HDD、VREG、VCC))に接続される第1信号線(L_LD(L_HD))と第2外部端子(LDS(GND、VSS))に接続される第2信号線(L_LS(L_LGND))との間に設けられ、ゲート電極が第3信号線(L_LG(L_EG))に接続されるパワートランジスタ(DMNL(DMNE))を有する。本半導体装置は更に第1信号線と第3信号線との間の電圧をクランプするクランプ回路(144)と、第3信号線と第2信号線との間に設けられた第1抵抗素子(R1)と、第3信号線と第2信号線との間の電圧を監視する監視部(143)とを有する。クランプ回路は、クランプ電圧が変更可能に構成され、監視部は、第3信号線と第2信号線との間の電圧が所定の閾値を超えたら、クランプ電圧が小さくなるように制御する。
【選択図】図4
Description
先ず、本願において開示される代表的な実施の形態について概要を説明する。代表的な実施の形態についての概要説明で括弧を付して参照する図面中の参照符号はそれが付された構成要素の概念に含まれるものを例示するに過ぎない。
本願の代表的な実施の形態に係る半導体装置(10(20))は、第1外部端子(LDD、(HDD、VREG、VCC))に接続される第1信号線(L_LD(L_HD))と、第2外部端子(LDS(GND、VSS))に接続される第2信号線(L_LS(L_LGND))と、第3信号線(L_LG(L_EG))と、を有する。また本半導体装置は、前記第1信号線と前記第2信号線との間に設けられ、ゲート電極が前記第3信号線に接続されるパワートランジスタ(DMNL(DMNE))を有する。前記半導体装置は更に、前記第1信号線と前記第3信号線との間に設けられ、前記第1信号線と前記第3信号線との間の電圧をクランプするクランプ回路(144)と、前記第3信号線と前記第2信号線との間に設けられた第1抵抗素子(R1)と、前記パワートランジスタのゲート電圧を監視する監視部(143)と、を有する。前記クランプ回路は、クランプ電圧が変更可能に構成され、前記監視部は、前記ゲート電圧が所定の閾値を超えたら、前記クランプ回路のクランプ電圧が小さくなるように制御する。
項1の半導体装置において、前記クランプ回路は、直列接続された複数のダイオード(ZD1〜ZD5)を含んで構成され、前記監視部は、前記複数のダイオードのうち一部のダイオード(ZD1)に並列に電流経路を形成させることにより、前記クランプ回路のクランプ電圧を小さくする。
項2の半導体装置において、前記クランプ回路は、前記一部のダイオードの両端に接続されたスイッチ素子(DMP1)を更に有し、前記監視部は、前記スイッチ素子をオンさせることで前記電流経路を形成させる。
項1乃至3の何れかの半導体装置において、前記複数のダイオードは、ツェナーダイオードを含む。
項3又は4の半導体装置において、前記監視部は、ゲート電極が前記第3信号線に接続される第1トランジスタ(DMN1)と、一端が前記第1トランジスタのソース電極に接続され、他端が前記第2信号線に接続され、入力された電流に応じて両端に電圧を発生させる電圧生成部(146)とを有する。前記監視部は、更に、一端が前記第1トランジスタのドレイン電極と前記第1信号線との間に設けられた負荷素子(R3)を有する。前記スイッチ素子は、前記負荷素子の両端の電位差に応じてオン・オフが制御される。
項5の半導体装置において、前記パワートランジスタと前記第1トランジスタは、同一種類のトランジスタ(DMOS)である。
項1乃至6の何れかの半導体装置において、前記パワートランジスタは、DMOSトランジスタである。
項1乃至8の何れかの半導体装置(140)において、前記パワートランジスタのオン・オフを指示する制御信号(SL)に応じて、前記第3信号線に前記パワートランジスタを駆動するための駆動電圧を出力する駆動電圧生成部(141)を更に有する。
項8の半導体装置において、前記監視部は、前記クランプ回路の前記クランプ電圧を、第1電圧(VCLMP1)から前記第1電圧よりも小さい第2電圧(VCLMP2)に切り替えることで、クランプ電圧が小さくなるように制御する。前記第2電圧は、切り替えた後の前記第1信号線と前記第2信号線との間の電圧が前記パワートランジスタの絶対最大定格よりも大きくなるように調整された電圧である。
項8又は9の半導体装置において、前記第1信号線と前記第2信号線との間の電圧が所定の電圧値を超えたことを検出したら検出信号(SD)を活性化させる過電圧検出部(142)を更に有し、前記駆動電圧生成部は、前記検出信号が活性化されたら前記駆動電圧の出力を停止する。
項8乃至10の何れかの半導体装置(10)において、外部から入力された信号に基づいて、前記制御信号を生成する制御部(15)を更に有する。
項1乃至7の何れかの半導体装置(16、16_2)において、前記第1外部端子は、第1電源電圧(VDDH)の供給を受ける電源端子(HDD、VCC)であり、前記第2外部端子は、前記第1電源電圧より低い第2電源電圧(グラウンド電圧)の供給を受ける電源端子(GND、VSS)である。
項1乃至7の何れかの半導体装置(16_1)において、前記第1外部端子は、信号を入力又は出力するための信号端子(VREG)であり、前記第2外部端子は、前記信号端子に供給される電圧よりも低い電源電圧(グラウンド電圧)の供給を受ける電源端子(VSS)である。
実施の形態について更に詳述する。
図1は、本願の一実施の形態に係る半導体装置を例示するブロック図である。同図に示されるシステムU1は、例えば自動車の制御システムの一部であって、自動車における運転席のエアバックや助手席のエアバック等の作動を制御するエアバック制御システムである。
実施の形態2では、ESD保護回路に上記ローサイドドライバ回路14の出力段の回路構成を適用した応用例を示す。
図9に、上記ESD保護回路16の別の適用例として、高電圧電源から電圧を生成するレギュレータ回路を備える半導体装置を例示する。
1 ECU
2 センサ部
3 エアバックユニット
30 スクイブ
31 エアバック
10 スクイブドライバ回路
11 マイクロコントローラ
12 ドライバ部
13 ハイサイドドライバ回路
DMNH パワートランジスタ
130 プリドライバ回路
14 ローサイドドライバ回路
DMNL パワートランジスタ
140 プリドライバ回路
15 制御信号生成部
HDD、HDS、LDD、LDS、GND 端子
L_HD、L_HS、L_LD、L_LS、L_LGND 信号線
VDDH スクイブ点火用電源
32_1,32_2 ハーネス
Cext1、Cext2、Cext3 外部容量
Zext1、Zext2 外部ツェナーダイオード
15 制御信号生成部
16 ESD保護素子
17 ESD保護ダイオード
SL、SH 制御信号
Inp 誘導性電流
50 ノイズ源
141 ゲート駆動回路
SW1、SW2 スイッチ素子
MP1 Pチャネル型のMOSトランジスタ
MN1 Nチャネル型のMOSトランジスタ
142 過電圧検出回路
SD 検出信号
R1〜R5 抵抗素子
147 スイッチ制御回路
143 ゲート電圧監視回路
144 クランプ回路
ZD1〜ZDn ツェナーダイオード
DMP1 P型のDMOSトランジスタ
145 プルダウン回路
DMN1 トランジスタ
146 閾値調整回路
D1、D2 ダイオード
500 破壊耐圧BVdsの特性
501 ids−vds特性(VGS=0V)
502 ids−vds特性(VGS=2V)
503 ids−vds特性(VGS=4V)
504 ids−vds特性(VGS=8V)
Avds 絶対最大定格電圧
VDT 過電圧に係る検出閾値電圧
VGT ゲート検出閾値電圧
701 ローサイドドライバ回路14のアクティブクランプ動作における動作負荷線
702 アクティブクランプ動作時クランプ電圧を可変しない場合の動作負荷線(比較例)
703 ゲート検出閾値電圧VGTの特性
VDS1 ゲート電圧検出時のドレイン・ソース間電圧
VDS2 クランプ電圧の切替後のドレイン・ソース間電圧
Idb2 実施の形態1に係るパワートランジスタDMNLの破壊時のドレイン電流
Idb1 比較例に係るパワートランジスタDMNLの破壊時のドレイン電流
Bvds2 実施の形態1に係るパワートランジスタDMNLの破壊時の電圧
Bvds1 比較例に係るパワートランジスタDMNLの破壊時の電圧
DMNE ESD保護回路におけるパワートランジスタ
L_EG 信号線
20 半導体装置
VCC 電源端子
VREG 外部端子
VSS グラウンド端子
16_1、16_2 ESD保護回路
201 レギュレータ回路(被保護回路)
DMP3、DMP4 P型のトランジスタ
DMN2 N型のトランジスタ
R10〜R13 分圧抵抗
DH 高耐圧のダイオード
OP オペアンプ
Claims (13)
- 第1外部端子に接続される第1信号線と、
第2外部端子に接続される第2信号線と、
第3信号線と、
前記第1信号線と前記第2信号線との間に設けられ、ゲート電極が前記第3信号線に接続されるパワートランジスタと、
前記第1信号線と前記第3信号線との間に設けられ、前記第1信号線と前記第3信号線との間の電圧をクランプするクランプ回路と、
前記第3信号線と前記第2信号線との間に設けられた第1抵抗素子と、
前記パワートランジスタのゲート電圧を監視する監視部と、を有し、
前記クランプ回路は、クランプ電圧が変更可能に構成され、
前記監視部は、前記ゲート電圧が所定の閾値を超えたら、前記クランプ回路のクランプ電圧が小さくなるように制御する半導体装置。 - 前記クランプ回路は、直列接続された複数のダイオードを含んで構成され、
前記監視部は、前記複数のダイオードのうち一部のダイオードに並列に電流経路を形成させることにより、前記クランプ回路のクランプ電圧を小さくする請求項1に記載の半導体装置。 - 前記クランプ回路は、前記一部のダイオードの両端に接続されたスイッチ素子を更に有し、
前記監視部は、前記スイッチ素子をオンさせることで前記電流経路を形成させる請求項2に記載の半導体装置。 - 前記複数のダイオードは、ツェナーダイオードを含む請求項2の半導体装置。
- 前記監視部は、ゲート電極が前記第3信号線に接続される第1トランジスタと、
一端が前記第1トランジスタのソース電極に接続され、他端が前記第2信号線に接続され、入力された電流に応じて両端に電圧を発生させる電圧生成部と、
一端が前記第1トランジスタのドレイン電極と前記第1信号線との間に設けられた負荷素子と、を有し、
前記スイッチ素子は、前記負荷素子の両端の電位差に応じてオン・オフが制御される請求項3に記載の半導体装置。 - 前記パワートランジスタと前記第1トランジスタは、同一種類のトランジスタである請求項5に記載の半導体装置。
- 前記パワートランジスタは、DMOSトランジスタである請求項2に記載の半導体装置。
- 前記パワートランジスタのオン・オフを指示する制御信号に応じて、前記第3信号線に前記パワートランジスタを駆動するための駆動電圧を出力する駆動電圧生成部を更に有する、請求項2に記載の半導体装置。
- 前記監視部は、前記クランプ回路の前記クランプ電圧を、第1電圧から前記第1電圧よりも小さい第2電圧に切り替えることで、クランプ電圧が小さくなるように制御し、
前記第2電圧は、切り替えた後の前記第1信号線と前記第2信号線との間の電圧が前記パワートランジスタの絶対最大定格よりも大きくなるように調整された電圧である請求項8に記載の半導体装置。 - 前記第1信号線と前記第2信号線との間の電圧が所定の電圧値を超えたことを検出したら検出信号を活性化させる過電圧検出部を更に有し、
前記駆動電圧生成部は、前記検出信号が活性化されたら前記駆動電圧の出力を停止する請求項9に記載の半導体装置。 - 外部から入力された信号に基づいて、前記制御信号を生成する制御部を更に有する請求項10に記載の半導体措置。
- 前記第1外部端子は、第1電源電圧の供給を受ける電源端子であり、
前記第2外部端子は、前記第1電源電圧より低い第2電源電圧の供給を受ける電源端子である請求項1に記載の半導体装置。 - 前記第1外部端子は、信号を入力又は出力するための信号端子であり、
前記第2外部端子は、前記信号端子に供給される電圧よりも低い電源電圧の供給を受ける電源端子である請求項1に記載の半導体装置。
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