JP2011100519A - メモリシステム - Google Patents
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Abstract
【解決手段】複数のメモリセルを含む複数のブロックを有するメモリセルアレイと、前記メモリセルの読み出しレベルを変更可能な電圧生成部と、を有する不揮発性半導体記憶装置と、前記不揮発性半導体記憶装置の書き込み、読み出し、消去を制御する制御部とを具備し、前記制御部は、前記不揮発性半導体記憶装置の使用開始時と時間経過後とで読み出しレベルを変える。
【選択図】図10
Description
図1は、メモリシステムとしてのSSD100の構成例を示すブロック図である。SSD100は、ATAインタフェース(ATA I/F)2などのメモリ接続インタフェースを介してパーソナルコンピュータあるいはCPUコアなどのホスト装置(以下、ホストと略す)1と接続され、ホスト1の外部メモリとして機能する。また、SSD100は、RS232Cインタフェース(RS232C I/F)などの通信インタフェース3を介して、デバッグ用/製造検査用機器200との間でデータを送受信することができる。
第1の実施形態は、メモリシステムの信頼性を向上するため、メモリシステムの使用の初期と所定の時間経過後とで、NAND型フラッシュメモリの読み出しレベルを変化させている。使用の初期とは、例えば、メモリシステム出荷後、ユーザが実際にメモリシステムを使用し始める時を指す。所定の時間経過後とは、実時間を計測することで決定しても良いし、メモリシステム内部でNAND型フラッシュメモリに所定の動作(書き込み、読み出し、または消去動作)を繰り返した回数によって決定しても良い。
次に、第2の実施形態について説明する。上記第1の実施形態はPD,RD、DRの影響を除去するため、管理領域を参照し、読み出しレベルVA,VB,VCや、読み出し電圧Vreadを+方向又は−方向に変化させて読み出し動作を行った。この読み出し動作の後、ECCを判定し、エラービット数が多い場合、そのブロックをリフレッシュした。
図15は、第3の実施形態を示している。第3の実施形態は、第1、第2の実施形態を組み合わせた読み出し動作である。すなわち、第1に実施形態において説明したモニタリードは、電源起動時、又は任意のタイミングで実行された。これに対して、第3の実施形態は、読み出し動作において、ECCエラーが発生した場合、読み出しレベルを+/−の両方にシフトして読み出し動作を行い、そのときのシフトデータを管理テーブルに記録し、次の読み出し動作において、管理テーブルに記録されたシフトデータに基づき読み出し動作を行うものである。
図16は、第4の実施形態を示している。第4の実施形態は、リフレッシュ動作によりDRの影響が低減されたシステムに適用される。このようなシステムの場合、PD、RDの影響を考慮して読み出し動作が実行される。
Claims (17)
- 複数のメモリセルを含む複数のブロックを有するメモリセルアレイと、
前記メモリセルの読み出しレベルを変更可能な電圧生成部と、
を有する不揮発性半導体記憶装置と、
前記不揮発性半導体記憶装置の書き込み、読み出し、消去を制御する制御部とを具備し、
前記制御部は、前記不揮発性半導体記憶装置の使用開始時と時間経過後とで読み出しレベルを変えることを特徴とするメモリシステム。 - 前記制御部は、前記不揮発性半導体記憶装置の書き込み回数、消去回数、読み出し回数の少なくとも1つに応じて前記読み出しレベルを変えることを特徴とする請求項1記載のメモリシステム。
- 前記制御部は、前記メモリセルに設定された閾値電圧を読み出すための本来の読み出しレベルより高い読み出しレベルと、前記本来の読み出しレベルより低い読み出しレベルとの一方で、前記メモリセルから1回データを読み出すことを特徴とする請求項2記載のメモリシステム。
- 前記制御部は、前記メモリセルに設定された閾値電圧を読み出すための本来の読み出しレベルより高い読み出しレベルと、前記本来の読み出しレベルより低い読み出しレベルの両方で、前記メモリセルからデータを読み出すことを特徴とする請求項2記載のメモリシステム。
- 前記制御部は、前記不揮発性半導体記憶装置の放置時間を記録する管理領域を有し、前記管理領域に記録された放置時間が規定時間以上である場合、前記メモリセルに設定された閾値電圧を読み出すための本来の読み出しレベルより低い読み出しレベルで、前記メモリセルからデータを読み出すことを特徴とする請求項2記載のメモリシステム。
- 前記制御部は、前記不揮発性半導体記憶装置の前記複数のブロックのブロック毎の書き込み回数、消去回数、読み出し回数、及び書き込み、消去時の電圧印加回数を管理する管理部を有し、前記管理部により管理されたデータに基づき、メモリセルの読み出しレベルを変えることを特徴とする請求項2記載のメモリシステム。
- 前記制御部は、前記システムの起動時、又は予め定められたタイミングで、異なる複数の読み出しレベルを用いてブロック毎にモニタリードを実行し、エラービット数の最も少ない読み出しレベルをステータスデータとして管理領域に記録し、データの読み出し時、前記管理領域に記録されたステータスデータに基づき、読み出しレベルを設定することを特徴とする請求項1記載のメモリシステム。
- 複数のメモリセルを含む複数のブロックを有するメモリセルアレイと、
前記メモリセルの読み出しレベルを変更可能な電圧生成部と、
を有する不揮発性半導体記憶装置と、
前記不揮発性半導体記憶装置の書き込み、読み出し、消去を制御する制御部とを具備し、
前記制御部は、読み出されたデータからエラーを検出するエラー検知部を有し、
前記エラー検出部によりエラーが検出された場合、再度読み出しを繰り返すリトライ読み出しを行うことを特徴とするメモリシステム。 - 前記制御部は、メモリセルの本来の読み出しレベルより高くシフトされた読み出しレベルと、前記本来の読み出しレベルより低い読み出しレベルを用いて前記リトライ読み出しを行うことを特徴とする請求項8記載のメモリシステム。
- 前記制御部は、読み出し時間を変えて前記リトライ読み出しを行うことを特徴とする請求項8記載のメモリシステム。
- 前記制御部は、メモリセルのセンスノードのプリチャージ電圧を変えること、読み出し時のセンス回数を変えることのうちの1により前記読み出し時間を変えることを特徴とする請求項10記載のメモリシステム。
- 前記制御部は、選択ワード線に隣接する非選択ワード線の読み出し電圧を、本来の読み出し電圧より高く設定して前記リトライ読み出しを行うことを特徴とする請求項10記載のメモリシステム。
- 複数のメモリセルを含む複数のブロックを有するメモリセルアレイと、
前記メモリセルの読み出しレベルを変更可能な電圧生成部と、
を有する不揮発性半導体記憶装置と、
前記不揮発性半導体記憶装置の書き込み、読み出し、消去を制御する制御部とを具備し、
前記制御部は、読み出されたデータからエラーを検出するエラー検知部と、
管理データを記録する管理領域とを有し、
前記制御部は、前記エラー検出部によりエラーが検出された場合、メモリセルの本来の読み出しレベルより高くシフトされた読み出しレベルと、前記本来の読み出しレベルより低い読み出しレベルを用いてリトライ読み出しを行い、これらリトライ読み出しの結果が良好な読み出しレベルのデータを前記管理領域に記録することを特徴とするメモリシステム。 - 前記制御部は、読み出し時、前記管理領域に記録されたデータに基づき読み出しレベルを設定することを特徴とする請求項12記載のメモリシステム。
- 複数のメモリセルを含む複数のブロックを有するメモリセルアレイと、
前記メモリセルの読み出しレベルを変更可能な電圧生成部と、
を有する不揮発性半導体記憶装置と、
前記不揮発性半導体記憶装置の書き込み、読み出し、消去を制御する制御部とを具備し、
前記制御部は、読み出されたデータからエラーを検出するエラー検知部を有し、
前記制御部は、前記エラー検出部によりエラーが検出された場合、メモリセルの本来の読み出しレベルより高くシフトされた読み出しレベルで読み出し動作を行い、エラー検知部の判定の結果、エラーが少ない場合、次の読み出し動作を前記高くシフトされた読み出しレベルで行うことを特徴とするメモリシステム。 - 前記制御部は、前記メモリセルの本来の読み出しレベルより高くシフトされた読み出しレベルで読み出し動作を行い、エラー検知部の判定の結果、エラーが多い場合、前記メモリセルの本来の読み出しレベルより低くシフトされた読み出しレベルで読み出し動作を行うことを特徴とする請求項15記載のメモリシステム。
- 前記制御部は、前記メモリセルの本来の読み出しレベルより低くシフトされた読み出しレベルで読み出し動作を行った場合、リフレッシュ動作を行うことを特徴とする請求項16記載のメモリシステム。
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