JP2011028237A - 表示装置及び電子機器 - Google Patents
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Abstract
【解決手段】表示装置は、第1及び第2のゲートドライバを有する。第1及び第2のゲートドライバは、それぞれ複数のフリップフロップ回路と、複数の転送信号生成回路とを有する。フリップフロップ回路と転送信号生成回路は共に、第1の入力端子に入力された信号を半クロック周期分遅らせて出力する回路である。また、転送信号生成回路の出力端子は、後段のフリップフロップ回路の第1の入力端子に直結される。そのため、転送信号生成回路からフリップフロップ回路へ入力される信号の遅延若しくは鈍りを低減することができる。
【選択図】図2
Description
本実施の形態では、本発明の一態様である表示装置の一例を示す。具体的には、第1及び第2のゲートドライバを有するアクティブマトリクス型の表示装置について図1乃至図3を用いて説明する。
図1は、アクティブマトリクス型の表示装置100を示す図である。表示装置100は、画素部101と、ソースドライバ102と、第1のゲートドライバ103Aと、第2のゲートドライバ103Bと、各々が平行又は略平行に配列されたm(mは正の整数)本のソース線1041〜104mと、各々が平行又は略平行に配列されたn(nは正の整数)本のゲート線1051〜105nとを有する。なお、画素部101は、表示装置100の中央部に設けられ、ソースドライバ102は、画素部101の一辺に近接して設けられ、第1のゲートドライバ103Aと第2のゲートドライバ103Bは、ソースドライバ102が設けられた辺とは異なる辺に近接し、且つ画素部101を間に挟んで対向するように設けられる。また、ソースドライバ102は、m本のソース線1041〜104mを介して画素部101に電気的に接続され、第1のゲートドライバ103Aは、n本のゲート線1051〜105nの奇数番目を介して、画素部101に電気的に接続され、第2のゲートドライバ103Bは、n本のゲート線1051〜105nの偶数番目を介して、画素部101に電気的に接続される。
表示装置100において、ソースドライバ102は、画素部101が有する各画素10711〜107nmへ映像信号を出力する回路であり、第1のゲートドライバ103A及び第2のゲートドライバ103Bは、ソースドライバ102と画素10711〜107nmの電気的な接続を制御する回路である。
図2は、アクティブマトリクス型の表示装置100が有する第1のゲートドライバ103A及び第2のゲートドライバ103Bの詳細な構成例を示すブロック図である。
図3は、タイミングチャートを示す図である。なお、図3には、クロック信号(CK)、反転クロック信号(CKB)、第1のスタートパルス信号(SP1)、第2のスタートパルス信号(SP2)、第1のフリップフロップ回路の出力信号(F1OUT)乃至第4のフリップフロップ回路の出力信号(F4OUT)、及び第1の転送信号生成回路の出力信号(T1OUT)乃至第4の転送信号生成回路の出力信号(T4OUT)を示している。なお、クロック信号(CK)は、一定周期でハイ(以下、Hと示す)レベルの信号とロウ(以下、Lと示す)レベルの信号を繰り返す信号であり、反転クロック信号(CKB)は、クロック信号のHレベルとLレベルが反転した信号である。
本実施の形態では、実施の形態1に示したフリップフロップ回路及び転送信号生成回路に適用可能な回路の具体例について図4及び図5を用いて説明する。具体的には、トランジスタを用いてフリップフロップ回路及び転送信号生成回路を構成する例について示す。なお、トランジスタのソース端子及びドレイン端子は、トランジスタの構造や動作条件等によって替わるため、いずれがソース端子又はドレイン端子であるかを特定することが困難である。そこで、以下においては、ソース端子及びドレイン端子の一方を第1端子、ソース端子及びドレイン端子の他方を第2端子と表記し、区別することとする。
図4は、実施の形態1に示した第1のゲートドライバ103Aが有する第kのフリップフロップ回路(Fk)及び第kの転送信号生成回路(Tk)に適用可能な回路の一例を示す図である。なお、本実施の形態で示す第kのフリップフロップ回路(Fk)は、第1のトランジスタ401乃至第4のトランジスタ404を有し、第kの転送信号生成回路(Tk)は、第5のトランジスタ405乃至第8のトランジスタ408を有する。また、本実施の形態では、第kのフリップフロップ回路用ストップパルス信号(STP(Fk))として第kの転送信号生成回路の出力信号(TkOUT)を用い、第kの転送信号生成回路用ストップパルス信号(STP(Tk))として第k+2のフリップフロップ回路の出力信号(Fk+2OUT)を用いる。
図5は、図4に示した第kのフリップフロップ回路(Fk)及び第kの転送信号生成回路(Tk)の入力信号及び出力信号のタイミングチャートを示す図である。以下に、第kのフリップフロップ回路(Fk)及び第kの転送信号生成回路(Tk)の動作について説明する。
本実施の形態では、第kのフリップフロップ回路用ストップパルス信号(STP(Fk))及び第kの転送信号生成回路用ストップパルス信号(STP(Tk))として、それぞれ第kの転送信号生成回路(Tk)の出力信号及び第k+2のフリップフロップ回路(Fk+2)の出力信号を適用したが、本実施の形態の構成は、当該構成に限定されない。
本実施の形態では、実施の形態1に示したフリップフロップ回路及び転送信号生成回路に適用可能な回路の実施の形態2とは異なる具体例について図6及び図7を用いて説明する。
図6は、実施の形態1に示した第1のゲートドライバ103Aが有する第kのフリップフロップ回路(Fk)及び第kの転送信号生成回路(Tk)に適用可能な回路の一例を示す図である。本実施の形態で示す第kのフリップフロップ回路(Fk)は、第1のトランジスタ601乃至第5のトランジスタ605と、インバータ回路600とを有し、第kの転送信号生成回路(Tk)は、第6のトランジスタ606乃至第8のトランジスタ608を有する。なお、図6に示す回路は、図4に示した第kのフリップフロップ回路(Fk)にインバータ回路600と、第5のトランジスタ605とを付与し、且つ第kの転送信号生成回路(Tk)における第8のトランジスタ408を削除した回路であると言い換えることができる。
図6に示した第kのフリップフロップ回路(Fk)は、インバータ回路600と、ゲート端子がインバータ回路600の出力端子に電気的に接続され、第1端子が接地電位(VSS)線に電気的に接続され、第2端子がインバータ回路600の入力端子に電気的に接続された第5のトランジスタ605とを有する。このように、インバータ回路600と電気的に接続された第5のトランジスタ605は、一度オンすると常にオンし続けることになる。第5のトランジスタ605がオン状態にあると、第3のトランジスタ603のゲート端子の電位が接地電位(VSS)に保たれることになる。そのため、第3のトランジスタ603のゲート端子にノイズが侵入した場合であっても、第3のトランジスタ603がオンすることがない。つまり、表示装置の画像若しくは映像に不良をきたすことがなく、表示装置の性能を向上させることができる。
本実施の形態では、フリップフロップ回路が5つのトランジスタ601〜605及びインバータ回路600で構成され、転送信号生成回路が3つのトランジスタ606〜608で構成される例について示したが、実施の形態は、当該構成に限定されない。例えば、第kのフリップフロップ回路(Fk)及び第kの転送信号生成回路(Tk)が共に、図6に示した第kのフリップフロップ回路(Fk)又は第kの転送信号生成回路(Tk)と同一の構成であってもよい。また、実施の形態2(図4)に示した回路と、本実施の形態(図6)に示した回路とを組み合わせてフリップフロップ回路及び転送信号生成回路を構成してもよい。
本実施の形態では、実施の形態1に示したフリップフロップ回路及び転送信号生成回路に適用可能な回路の実施の形態2及び3とは異なる具体例について図8及び図9を用いて説明する。
図8は、実施の形態1に示した第1のゲートドライバ103Aが有する第kのフリップフロップ回路(Fk)及び第kの転送信号生成回路(Tk)に適用可能な回路の一例を示す図である。本実施の形態で示す第kのフリップフロップ回路(Fk)は、第1のトランジスタ801乃至第5のトランジスタ805と、制御回路800とを有し、第kの転送信号生成回路(Tk)は、第6のトランジスタ806乃至第9のトランジスタ809を有する。なお、図8に示す回路は、図4に示した回路に制御回路800及び第5のトランジスタ805を付与し、且つ第6のトランジスタ806(図4における第5のトランジスタ405に相当)の第1端子がゲート端子ではなく、電源電位(VDD)線に電気的に接続された回路であると言い換えることができる。
図9(A)、(B)に示した制御回路800A、800Bは、クロック信号(CK)又はクロック信号(CK)に同調した信号を出力する。そのため、第3のトランジスタ803のゲート端子にノイズが侵入した場合であっても、第4のトランジスタ804及び第5のトランジスタ805がオンすることによって、ノイズを除去することができる。また、第4のトランジスタ804及び第5のトランジスタ805が常にオンすることがなく、第4のトランジスタ804及び第5のトランジスタ805の劣化を抑制することができる。つまり、表示装置の映像に不良をきたすことがなく、表示装置の性能及び信頼性を向上させることができる。
本実施の形態では、フリップフロップ回路が5つのトランジスタ801〜805及び制御回路800で構成され、転送信号生成回路が4つのトランジスタ806〜809で構成される例について示したが、実施の形態は、当該構成に限定されない。例えば、第kのフリップフロップ回路(Fk)及び第kの転送信号生成回路(Tk)が共に、図8に示した第kのフリップフロップ回路(Fk)又は第kの転送信号生成回路(Tk)と同一の構成であってもよい。また、実施の形態2(図4)又は実施の形態3(図6)に示した回路と、本実施の形態(図8)に示した回路とを組み合わせて、フリップフロップ回路及び転送信号生成回路を構成してもよい。
本実施の形態では、実施の形態2乃至4に示したフリップフロップ回路及び転送信号生成回路が有するトランジスタの具体例について説明する。
本実施の形態では、実施の形態1に示した表示装置を備えた電子機器の一例について、図11乃至図13を用いて説明する。
101 画素部
102 ソースドライバ
103A 第1のゲートドライバ
103B 第2のゲートドライバ
1041 ソース線
104n ソース線
1051 ゲート線
1052 ゲート線
1053 ゲート線
105m ゲート線
106A フレキシブルプリント基板
106B フレキシブルプリント基板
10711 画素
107nm 画素
401 トランジスタ
402 トランジスタ
403 トランジスタ
404 トランジスタ
405 トランジスタ
406 トランジスタ
407 トランジスタ
408 トランジスタ
600 インバータ回路
600A インバータ回路
600B インバータ回路
601 トランジスタ
602 トランジスタ
603 トランジスタ
604 トランジスタ
605 トランジスタ
606 トランジスタ
607 トランジスタ
608 トランジスタ
701A トランジスタ
701B トランジスタ
702A トランジスタ
702B トランジスタ
703B トランジスタ
704B トランジスタ
800 制御回路
800A 制御回路
800B 制御回路
801 トランジスタ
802 トランジスタ
803 トランジスタ
804 トランジスタ
805 トランジスタ
806 トランジスタ
807 トランジスタ
808 トランジスタ
809 トランジスタ
901A 容量素子
901B トランジスタ
902A トランジスタ
902B トランジスタ
903B トランジスタ
904B トランジスタ
1001 画素部
1002A 第1のゲートドライバ
1002B 第2のゲートドライバ
10031 ゲート線
10032 ゲート線
1003k ゲート線
5000 筐体
5001 表示部
5002 第2表示部
5003 スピーカ
5004 LEDランプ
5005 操作キー
5006 接続端子
5007 センサ
5008 マイクロフォン
5009 スイッチ
5010 赤外線ポート
5011 記録媒体読込部
5015 シャッターボタン
5016 受像部
5018 支持台
5019 外部接続ポート
5020 ポインティングデバイス
5021 リーダ/ライタ
5022 筐体
5023 表示部
5024 リモコン装置
5025 スピーカ
5026 表示部
5027 浴槽
5028 表示部
5029 車体
5030 天井
5031 表示部
5032 ヒンジ部
5033 光源
5034 投射レンズ
Claims (7)
- 各々が平行又は略平行に配列された複数のゲート線と、
前記ゲート線の奇数行目の各々に電気的に接続された第1のゲートドライバと、
前記ゲート線の偶数行目の各々に電気的に接続された第2のゲートドライバと、を有し、
前記第1のゲートドライバは、
出力端子が第k行目(kは3以上の奇数)のゲート線に電気的に接続され、第1の入力端子が第k―2の転送信号生成回路の出力端子に電気的に接続され、第2の入力端子がクロック信号線に電気的に接続され、第3の入力端子が第kのフリップフロップ回路用ストップパルス信号線に電気的に接続された、第kのフリップフロップ回路と、
出力端子が第k+2のフリップフロップ回路の第1の入力端子に電気的に接続され、第1の入力端子が前記第kのフリップフロップ回路の出力端子に電気的に接続され、第2の入力端子が反転クロック信号線に電気的に接続され、第3の入力端子が第kの転送信号生成回路用ストップパルス信号線に電気的に接続された、第kの転送信号生成回路と、を有し、
前記第2のゲートドライバは、
出力端子が第k+1行目のゲート線に電気的に接続され、第1の入力端子が第k―1の転送信号生成回路の出力端子に電気的に接続され、第2の入力端子が前記反転クロック信号線に電気的に接続され、第3の入力端子が第k+1のフリップフロップ回路用ストップパルス信号線に電気的に接続された、第k+1のフリップフロップ回路と、
出力端子が第k+3のフリップフロップ回路の第1の入力端子に電気的に接続され、第1の入力端子が前記第k+1のフリップフロップ回路の出力端子に電気的に接続され、第2の入力端子が前記クロック信号線に電気的に接続され、第3の入力端子が第kの転送信号生成回路用ストップパルス信号線に電気的に接続された、第k+1の転送信号生成回路と、を有する表示装置。 - 請求項1において、
前記第1のゲートドライバが有するフリップフロップ回路及び転送信号生成回路並びに前記第2のゲートドライバが有するフリップフロップ回路及び転送信号生成回路の回路構成が同一である表示装置。 - 請求項1又は請求項2において、
前記第kのフリップフロップ回路の第3の入力端子が、前記第kのフリップフロップ回路用ストップパルス信号線を介して、前記第kの転送信号生成回路の出力端子に電気的に接続され、
前記第k+1のフリップフロップ回路の第3の入力端子が、前記第k+1のフリップフロップ回路用ストップパルス信号線を介して、前記第k+1の転送信号生成回路の出力端子に電気的に接続された表示装置。 - 請求項1又は請求項2において、
前記第kのフリップフロップ回路の第3の入力端子が、前記第kのフリップフロップ回路用ストップパルス信号線を介して、前記第k+1のフリップフロップ回路の出力端子に電気的に接続され、
前記第k+1のフリップフロップ回路の第3の入力端子が、前記第k+1のフリップフロップ回路用ストップパルス信号線を介して、前記第k+2のフリップフロップ回路の出力端子に電気的に接続された表示装置。 - 請求項1乃至請求項4のいずれか一項において、
前記第kの転送信号生成回路の第3の入力端子が、前記第kの転送信号生成回路用ストップパルス信号線を介して、前記第k+2のフリップフロップ回路の出力端子に電気的に接続され、
前記第k+1の転送信号生成回路の第3の入力端子が、前記第k+1の転送信号生成回路用ストップパルス信号線を介して、前記第k+3のフリップフロップ回路の出力端子に電気的に接続された表示装置。 - 請求項1乃至請求項4のいずれか一項において、
前記第kの転送信号生成回路の第3の入力端子が、前記第kの転送信号生成回路用ストップパルス信号線を介して、前記第k+1の転送信号生成回路の出力端子に電気的に接続され、
前記第k+1の転送信号生成回路の第3の入力端子が、前記第k+1の転送信号生成回路用ストップパルス信号線を介して、前記第k+2の転送信号生成回路の出力端子に電気的に接続された表示装置。 - 請求項1乃至請求項6のいずれか一項に記載の表示装置を備えた電子機器。
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