JP2001339002A - 半導体パッケージ及びその製造方法 - Google Patents
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Abstract
導体パッケージにおいて、ビアホール導通部の信頼性が
高く、かつ歩留まりの良い半導体パッケージ及びその製
造方法を提供する。 【解決手段】両面銅張基板(1)の両面間の導通路を形
成するためのビアホールを(3)、半導体パッケージ
(2)の配線パターン間で共有させるようにかつその開
孔形を長孔状に形成し、半裁する線上で切り分けて半導
体パッケージを製造する。また、ビアホールは、銅張層
(10)をエッチング処理にて開口した後、該開口位置
の基板材(11)をレーザ加工処理によって円形開孔に
削除し、該円形開孔の複数個を連続させることにより長
孔状に形成する。
Description
に半導体パッケージの配線パターンの複数個を行列状に
形成し、所定位置に半導体チップを取付けて基板全体を
樹脂封止した後、切り分けて半導体パッケージを製造す
る技術分野に属し、特に、両面銅張基板において両面間
の導通のためのビアホールを半導体パッケージの端部側
に配置し、ビアホールを半裁する線上で切り分けて製造
する半導体パッケージ及びその製造方法に関する。
る半導体パッケージ(以下「パッケージ」と略称す
る。)において、両面銅張基板(以下「基板」と略称す
る。)には、上面側に配置する半導体チップ等とワイヤ
接続する内部端子と、表面実装のために基板下面側に配
設された外部端子とを電気的に接続するため、基板非貫
通型のビアホール、又は基板貫通型のスルーホールが用
いられていた。
板内の特定の2層間を電気的に接続するための非貫通の
開孔であり、4層以上の多層基板ではインナービアとも
呼ばれている。また、スルーホールと比較すると、機械
的強度が高い点又は樹脂封止工程におけるスルーホール
への樹脂材進入防止作業の工程が削除される点で優れて
いると言える。
ケージ間で共有させるべくパッケージの外周側端部に配
置し、樹脂封止体の切り分け時にビアホール等を半裁す
る線上で切り分けて、パッケージに対する基板の占有比
率を小さくすることも行われていた。
0−294400で開示されているように、基板上に配
置形成したスルーホールをメッキ等の導体で閉孔処理す
る方法や、片面側銅張層をエッチングで円形状に除去し
た後、反対側の銅張層を残すようにレーザ光を照射して
基板材(エポキシ樹脂、ガラスエポキシ樹脂、等)除去
加工し、その後加工した内周面を導通処理する方法があ
った。
特開平10−294400で開示されているスルーホー
ルを閉孔する方法は、閉孔処理における機械的強度の確
保等に特殊技術が必要となり、コストアップの原因とな
っていた。ちなみに、近年は4、6、8層以上のいわゆ
る多層基板では、基板積層時にインナービアを形成する
ビルドアップ工法という方法が採用されている。
成する方法では、先ず、表層の銅張層をエッチング処理
にて円形状に除去後、レーザ光を照射して基板材を除去
し、かつ反対側の銅張層を残すように出力調整して処理
するため、その段取設定が煩雑微妙であると共にその断
面形状は完全な円柱状とならず、図5(A)に示すよう
に周辺縁部に処理屑Dの残滓や未削除部が残ってしまっ
ていた。その結果、このビアホールの内面をメッキ処理
により導通処理を施した場合、図5(B)に示すよう
に、メッキ層と反対側の銅張層との導通のために一体化
させる接触部分を十分確保できないことに加え、その接
触部分に界面Eが残ってビアホールの半裁時や外部衝撃
により、図5(C)に示すように、接触部分が剥がれる
ことがあり導通不良の原因となっていた。
るべく為されたものであり、両面銅張基板のビアホール
を共通化して一括樹脂封止形成して行う半導体パッケー
ジ及びその製造方法において、ビアホールを用いた両面
間の導通路形成を確実なものにすると共に、ビアホール
の半裁時においても、導通部の接触部分が剥離したりせ
ずに信頼性が高く、かつ歩留まりの向上を目的とした半
導体パッケージ及びその製造方法を提供するものであ
る。
め、本願発明にかかる半導体パッケージ及びその製造方
法は、以下のように構成している。すなわち、本願発明
の半導体パッケージは、両面銅張基板(1)の両面間に
多数個の半導体パッケージ(2)の配線パターンを行列
状に形成し、前記基板(1)の両面間の導通路を形成す
るためのビアホール(3)を、1単位の半導体パッケー
ジ(2)の配線パターン間で共有させるようにかつその
開孔形を長孔状に形成し、該配線パターンの所定位置に
半導体チップ(20)を取付けて配線した後に基板
(1)全体を樹脂封止し、該ビアホール(3)を半裁す
る線上で切り分けて製造することを特徴としている。
路を形成するためのビアホール(3)を1単位半導体パ
ッケージ(2)の配線パターン間で共有させるようにし
て、多数個の半導体パッケージ(2)の配線パターンを
行列状に形成し、所定位置に半導体チップ(20)を取
付けて該基板(1)全体を樹脂封止した後、前記ビアホ
ール(3)を半裁する線上で切り分けて半導体パッケー
ジ(2)を製造する本願発明の半導体パッケージの製造
方法において、前記ビアホール(3)の開孔形を長孔状
に形成したことを特徴としている。
両面銅張基板(1)の片面側銅張層(10)の所定位置
をエッチング処理にて開口した後、該開口位置の基板材
(11)をレーザ加工処理によって円形開孔(31)に
削除し、該円形開孔(31)の複数個を連続させること
により開孔形を長孔状に形成するようにしてもよい。な
お、上記において、括弧付きで記した図面符号は、発明
の理解を容易にするため参考として付記したもので、こ
の図面上の形態に限定するものでないことはもちろんで
ある。
ケージ及びその製造方法の実施形態例について、図面に
基づき詳細に説明する。図1は本実施形態の半導体パッ
ケージの外観を示す斜視図であり、図2は本実施形態の
ビアホールが配置された基板を示す外観図であり、図3
は本実施形態のビアホール形成の順序を示す断面図であ
り、図4は本実施形態の樹脂封止(A)、モールド金型
の一部拡大(B)、及び切断工程(C)を示す断面図で
あり、図5は従来のビアホールを示す断面図である。
示すように基板1上のステージ21に搭載した半導体チ
ップ20と、該ステージ21の周囲に配置したワイヤ接
続用の内部端子22と、半導体チップ20の電極20a
と内部端子22を接続するワイヤ23と、基板1の裏面
側の外部端子24と、パッケージ2の端部側であって、
内部端子22と外部端子24とを導通する半裁された長
孔状のビアホール3と、から成り全体を樹脂封止した構
成となっている。かかる構成自体は従来と同様であるた
め詳細は省略する。
ジ及びその製造方法における要点であるビアホール3の
形成の実施形態例について詳述する。図2に示すよう
に、先ず、一方側の銅張層10をエッチング処理により
所定位置に所定個数の長孔状の開口部30を形成する。
本実施形態におけるこの開口部30は、例えば、径が
0.15mmで長手方向が0.35mmの寸法を有する
ものであり、その配置位置は、後工程で配線パターンを
行列状に形成した時に、そのパターンの端部に位置し、
さらにビアホール3の長手方向の中心線位置で切断した
場合に、隣接するパッケージ2間でそれぞれ共有する位
置に設定している。また、放熱効果をより向上させるた
め、パッケージ2の内面側にも放熱用ビアホール32を
配置してもよい(図2の二点鎖線部)。
部30の長手方向の一端側に接するように、かつ、他方
側(反対側)の銅張層10にダメージを与えぬように出
力調整したレーザ光を照射して樹脂層11を除去して略
円柱状の開孔31aを形成する。次いで(B)開口部3
0の長手方向の他端側に接するように樹脂層11を除去
して略円柱状の開孔31bを形成する。最後に(C)上
記で照射した位置の間に開孔31cを形成するように照
射して中間部に残った樹脂層11を除去する。この結
果、除去された開孔31a、31b、31cが3つ連続
することになり、長孔状の開孔形をもったビアホール3
が形成される。その後、電解メッキ法によりビアホール
3の内面に導通処理を行う。この工程では、本実施形態
例のビアホール3は、図3(C)に示すように、その断
面はすり鉢状になるが、長孔状の形状により多くの接触
面積が確保できることになる。
る加工は、ガルバノシステムを搭載したレーザドリルマ
シンにより高速(例えば1000穴/1秒)に処理して
いる。
き付け、現像、溶解の処理にて、配線パターンであるス
テージ21、内部端子22及び外部端子24等を所定位
置に所定個数を形成し、半導体チップ20をステージ2
1に搭載し、ワイヤ接続を行う。
ットし、樹脂封止用の樹脂25aの充填を行い、樹脂封
止体25を形成する。このモールド金型4の雌型金型4
0の底面40aには断面がV字状の凸条部40bを格子
状に形成してあり、その凸条部40bの稜線40cは基
板1側のビアホール3の中心を結ぶ線と上下対応して一
致させている。この凸条部40bにより樹脂封止体25
の上面に格子状かつV字状の溝25b(以下「V溝」と
略称。)がビアホール3と上下方向で対応一致する位置
に形成されることになる。また、雌型金型40と樹脂2
5aの離型性を良くするため、フッ素樹脂フィルム40
dを該雌型金型40の底面40aに介在させておく等し
ても良い。
断装置5に固定し、切断刃50にてV溝25bに沿って
切断していき、1単位毎のパッケージ2に切り分ける。
この時、切断刃50の肉厚はビアホール3の円周部に達
しない厚さに設定されているため、当該ビアホール3は
分割されて、それぞれ隣接するパッケージ2の内部端子
22と外部端子24とを接続する導通手段として機能す
ることになる。そして、このビアホール3の分割面はパ
ッケージ2の樹脂封止体25の切断面と略一致すること
になるため、基板1の部分がパッケージ2の外周輪郭よ
り延出することはなく、小型化が図られている。
製造方法では、ビアホールが長孔状の開口形に形成され
ているため、ビアホール内周面の導通処理における導通
部の物理的な接続強度が向上すると共に、ビアホールの
半裁時の剥離等にも強く、パッケージの電気的接続にお
ける信頼性が向上する。このことは、パッケージ製造に
おける歩留まり向上に寄与し、生産効率及び製造コスト
の低減に貢献するものである。
斜視図である。
示す外観図である。
面図である。
工程の一部拡大(B)、及び切断工程(C)を示す断面
図である。。
8)
両面銅張基板(1)の片面側銅張層(10)の所定位置
をエッチング処理にて開口した後、該開口位置の基板材
(11)をレーザ加工処理によって円形開孔(31)に
削除し、該円形開孔(31)の複数個を連続させること
により開孔形を長孔状に形成するようにしてもよい。さ
らに、樹脂封止工程時に、雌型金型(40)と樹脂封止
の樹脂(25a)の間にフッ素樹脂フィルム(40d)
を介在させるようにしてもよい。なお、上記において、
括弧付きで記した図面符号は、発明の理解を容易にする
ため参考として付記したもので、この図面上の形態に限
定するものでないことはもちろんである。
ットし、樹脂封止用の樹脂25aの充填を行い、樹脂封
止体25を形成する。このモールド金型4の雌型金型4
0の底面40aには断面がV字状の凸条部40bを格子
状に形成してあり、その凸条部40bの稜線40cは基
板1側のビアホール3の中心を結ぶ線と上下対応して一
致させている。この凸条部40bにより樹脂封止体25
の上面に格子状かつV字状の溝25b(以下「V溝」と
略称。)がビアホール3と上下方向で対応一致する位置
に形成されることになる。また、雌型金型40と樹脂2
5aの離型性を良くするため、フッ素樹脂フィルム40
dを該雌型金型40の底面40aに介在させるようにし
ている。
Claims (3)
- 【請求項1】両面銅張基板(1)の両面間に多数個の半
導体パッケージ(2)の配線パターンを行列状に形成
し、 前記基板(1)の両面間の導通路を形成するためのビア
ホール(3)を、1単位の半導体パッケージ(2)の配
線パターン間で共有させるようにかつその開孔形を長孔
状に形成し、 該配線パターンの所定位置に半導体チップ(20)を取
付けて配線した後に基板(1)全体を樹脂封止し、 該ビアホール(3)を半裁する線上で切り分けて製造す
ることを特徴とした半導体パッケージ。 - 【請求項2】両面銅張基板(1)の両面間の導通路を形
成するためのビアホール(3)を1単位の半導体パッケ
ージ(2)の配線パターン間で共有させるようにして、
多数個の半導体パッケージ(2)の配線パターンを行列
状に形成し、所定位置に半導体チップ(20)を取付け
て該基板(1)全体を樹脂封止した後、前記ビアホール
(3)を半裁する線上で切り分けて半導体パッケージ
(2)を製造する半導体パッケージの製造方法におい
て、 前記ビアホール(3)の開孔形を長孔状に形成したこと
を特徴とする半導体パッケージの製造方法。 - 【請求項3】ビアホール(3)の形成において、 両面銅張基板(1)の片面側銅張層(10)の所定位置
をエッチング処理にて開口した後、該開口位置の基板材
(11)をレーザ加工処理によって円形開孔(31)に
削除し、該円形開孔(31)の複数個を連続させること
により長孔状の開孔形としたことを特徴とする半導体パ
ッケージの製造方法。
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